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JP4222772B2 - Image signal processing device - Google Patents
JP4222772B2
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透 渡辺
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2009-02-12 Publication of JP4222772B2 publication Critical patent/JP4222772B2/en
本願発明は、固体撮像素子から出力される画像信号に対して所定の信号処理を施し、所定のフォーマットに従う画像信号を外部機器に出力する画像信号処理装置に関する。 The present invention performs a predetermined signal processing on the image signal output from the solid-state imaging device, an image signal processing apparatus for outputting an image signal conforming to a predetermined format to an external device.
固体撮像素子（ＣＣＤイメージセンサ）を用いたデジタルスチルカメラ等の撮像装置においては、動作電源にバッテリが多く用いられる。 In the image pickup apparatus such as a digital still camera using a solid-state imaging device (CCD image sensor), the battery is often used in the operating power supply. このようなバッテリは、出力電圧の幅が限られているため、ＣＣＤイメージセンサの駆動用にレギュレート回路や昇圧回路が設けられる。 Such batteries, the width of the output voltage is limited, regulator circuit and booster circuit is provided for driving the CCD image sensor. 図７は、水平ドライバ８、信号処理回路９、タイミング制御回路１３及び出力回路を内蔵する信号処理装置７を示すものであり、この信号処理装置７を採用する撮像装置の構成を示すブロック図である。 Figure 7 is a horizontal driver 8, which shows a signal processing circuit 9, a timing control circuit 13 and the output signal processing unit 7 with a built-in circuit, a block diagram showing a configuration of an imaging apparatus employing the signal processor 7 is there. ここに示す撮像装置は、レギュレート回路２が入力側に設けられ、バッテリから供給される電源電圧を所定の電圧に変換し、レギュレート回路２から供給される単一の動作電圧で動作するように構成されている。 Imaging device shown here, regulator circuit 2 is provided on the input side, it converts the power supply voltage supplied from the battery to a predetermined voltage, to operate in a single operation voltage supplied from regulator circuit 2 It is configured.
ＣＣＤイメージセンサ３は、例えば、フレーム転送型であり、撮像部、蓄積部、水平転送部及び出力部より構成される。 CCD image sensor 3 is, for example, a frame transfer type, the image pickup unit, a storage unit, composed of the horizontal transfer section and an output section. 撮像部は、入射される光に応答して発生する情報電荷を複数の受光画素に蓄積する。 Imaging unit accumulates information charges generated in response to light incident on a plurality of light receiving pixels. 蓄積部は、撮像部から取り込んだ１画面分の情報電荷を一時的に保持する。 Storage unit temporarily stores one screen of information charges taken from the imaging unit. 水平転送部は、蓄積部から出力された情報電荷を逐次取り込み、水平方向に転送して順次１画素単位で出力する。 Horizontal transfer portion sequentially takes in the output information charges from the storage unit, and outputs sequentially one pixel is transferred to the horizontal direction. 出力部は、水平転送部から出力された情報電荷を、１画素単位で電荷量に対応する電圧値に変換し、画像信号Ｙ(t)として出力する。 The output unit outputs the output information charges from the horizontal transfer unit, and converted into a voltage value corresponding to the charge amount in one pixel unit, as image signal Y (t).
駆動装置４は、昇圧回路４及び垂直ドライバ６よりなり、昇圧回路４及び垂直ドライバ６の各回路が同一の半導体基板上に形成されて構成される。 Driver 4 is made of a step-up circuit 4 and a vertical driver 6, and each circuit of the step-up circuit 4 and a vertical driver 6 is formed on the same semiconductor substrate.
昇圧回路５は、レギュレート回路２から供給される調整電圧Ｖ K （例えば、２.９Ｖ）を所定の電圧に昇圧して、ＣＣＤイメージセンサ３に供給すると共に、垂直ドライバ６に供給する。 Booster circuit 5, the adjustment voltage V K supplied from the regulator circuit 2 (e.g., 2.9 V) to boost to a predetermined voltage, and supplies the CCD image sensor 3 is supplied to the vertical driver 6. この昇圧回路５は、正電圧発生用チャージポンプと負電圧発生用チャージポンプとを含み、正電圧発生用チャージポンプで調整電圧Ｖ Kを正電圧側の所定電圧Ｖ OH （例えば、５Ｖ）に昇圧し、負電圧発生用チャージポンプで負電圧側の所定電圧Ｖ OL （例えば、−５Ｖ）に昇圧する。 The boosting circuit 5, and a positive voltage generation charge pump and a negative voltage generating charge pump boosts the regulated voltage V K at a positive voltage generating charge pump to a predetermined voltage V OH positive voltage side (eg, 5V) and boosts the predetermined voltage V OL of the negative voltage side at the negative voltage generating charge pump (e.g., -5V).
垂直ドライバ６は、負電圧発生用チャージポンプで生成された負電圧側の所定電圧Ｖ OLを受けて動作し、フレーム転送クロックφｆ及び垂直転送クロックφｖを生成してＣＣＤイメージセンサ３の撮像部及び蓄積部に供給する。 Vertical driver 6 operates in response to a predetermined voltage V OL of the negative voltage side generated by the negative voltage generating charge pump, the imaging unit of the CCD image sensor 3 generates a frame transfer clock φf and vertical transfer clock φv and and it supplies the accumulation unit. ここで、フレーム転送クロックφｆ及び垂直転送クロックφｖは、タイミング制御回路１３から供給されるフレームシフトタイミング信号ＦＴ、垂直同期信号ＶＴ及び水平同期信号ＨＴに従うタイミングで生成される。 The frame transfer clock φf and vertical transfer clock φv a frame shift timing signal FT supplied from the timing control circuit 13 is generated at a timing according to the vertical synchronizing signal VT and the horizontal synchronizing signal HT. これにより、撮像部に蓄積される情報電荷がフレームシフトタイミング信号ＦＴに従うタイミングで蓄積部にフレーム転送され、蓄積部に保持される情報電荷が垂直同期信号ＶＴ及び水平同期信号ＨＴに従うタイミングで水平転送部にライン転送される。 Thus, the information charges accumulated in the imaging unit is frame transferred to the storage unit at a timing according to frame shift timing signal FT, the horizontal transfer timing information charges held in the storage section according to the vertical synchronizing signal VT and the horizontal synchronizing signal HT is the line transferred to the department.
水平ドライバ８は、レギュレート回路２から供給される調整電圧Ｖ Kを受けて動作し、水平転送クロックφｈを生成してＣＣＤイメージセンサ３の水平転送部に供給する。 Horizontal driver 8 operates by receiving a regulated voltage V K supplied from the regulator circuit 2, and supplies the horizontal transfer portion of the CCD image sensor 3 generates a horizontal transfer clock .phi.h. ここで、水平転送クロックφｈは、タイミング制御回路１３から供給される垂直同期信号及び水平同期信号に従うタイミングで生成される。 Here, the horizontal transfer clock φh is generated at a timing according to the vertical synchronizing signal and the horizontal synchronizing signal supplied from the timing control circuit 13. これにより、水平転送部に取り込まれた情報電荷が、水平同期信号ＨＴに従うタイミングで順次１画素単位で水平転送されて、画像信号Ｙ(t)として出力される。 Thus, information charges captured in the horizontal transfer portion, in order one pixel at a time in accordance with the horizontal synchronizing signal HT are horizontally transferred, are output as image signal Y (t).
信号処理回路９は、アナログ処理部１０、Ａ／Ｄ変換器１１、デジタル処理部１２から構成される。 The signal processing circuit 9, the analog processing unit 10, A / D converter 11 and a digital processing unit 12. アナログ処理部１０は、ＣＣＤイメージセンサ３から出力される画像信号Ｙ(t)に対して、ＣＤＳ(Correlated Double Sampling：相関二重サンプリング)、ＡＧＣ（Automatic Gain Control：自動利得制御）等のアナログ信号処理を施す。 Analog processing unit 10 subjects the image signal output from the CCD image sensor 3 Y (t), CDS (Correlated Double Sampling: correlated double sampling), AGC (Automatic Gain Control: AGC) such as an analog signal processing is performed. ＣＤＳでは、リセットレベルと信号レベルとを繰り返す画像信号Ｙ(t)に対し、リセットレベルをクランプした後に信号レベルを取り出すようにして、信号レベルの連続する画像信号を生成する。 In CDS, the image signal Y (t) repeating the reset level and the signal level, so as to take out the signal level after clamping the reset level, and generates an image signal of consecutive signal levels. ＡＧＣでは、ＣＤＳで取り出された画像信号を１画面、或いは、１垂直走査期間単位で積分して、その積分データを所定の範囲内に収めるようにゲインのフィードバック制御を行う。 In AGC, 1 screen image signal taken out by the CDS, or by integrating with one vertical scanning period unit performs gain feedback control so accommodate the integrated data within a predetermined range. Ａ／Ｄ変換器１１は、アナログ処理部１０から出力される画像信号をＣＣＤイメージセンサ３の出力タイミングに同期して規格化し、デジタル信号の画像データＹ(n)を出力する。 A / D converter 11, normalized by synchronizing the image signal output from the analog processing unit 10 to the output timing of the CCD image sensor 3, and outputs the image data Y (n) of the digital signal.
デジタル処理部１２は、画像データＹ(n)に対して、色分離、マトリクス演算等の処理を施し、輝度信号及び色差信号を含む画像データＹ'(n)を生成する。 The digital processing unit 12 subjects the image data Y (n), color separation, subjected to a treatment of the matrix calculation or the like to generate image data Y '(n) including a luminance signal and color difference signals. 例えば、色分離処理においては、ＣＣＤイメージセンサ３の撮像部に装着されるカラーフィルタの色配列に従って画像データＹ(n)を振り分け、複数の色成分信号を生成する。 For example, in the color separation processing, distributing the image data Y (n) according to the color arrangement of the color filter mounted on the image pickup section of the CCD image sensor 3, and generates a plurality of color component signals. また、マトリクス演算処理においては、振り分けた各色成分を合成して輝度信号を生成すると共に、各色成分から輝度成分を差し引いて色差信号を生成する。 Further, the matrix operation processing, with synthesizes the respective color components distributed for generating a luminance signal, and generates the color difference signals by subtracting the luminance component from each color component.
タイミング制御回路１３は、一定周期の基準クロックＣＫをカウントする複数のカウンタから構成され、ＣＣＤイメージセンサ３の垂直走査及び水平走査のタイミングを決定する。 The timing control circuit 13 includes a plurality of counters for counting the reference clock CK having a predetermined period, to determine the timing of the vertical scanning and horizontal scanning of the CCD image sensor 3. タイミング制御回路１３は、クロック供給端子（図示せず）を介して供給される基準クロックＣＫを分周して、フレームタイミング信号ＦＴ、垂直同期信号ＶＴ及び水平同期信号ＨＴを生成し、垂直ドライバ６及び水平ドライバ８に供給する。 The timing control circuit 13, a reference clock CK supplied via the clock supply terminal (not shown) by dividing a frame timing signal FT, generates a vertical synchronizing signal VT and the horizontal synchronizing signal HT, the vertical driver 6 and it supplies the horizontal driver 8. また、タイミング制御回路１３は、アナログ処理部１０、Ａ／Ｄ変換器１１及びデジタル処理部１２に対してタイミング信号を供給し、各回路の動作をＣＣＤイメージセンサ３の動作タイミングに同期させる。 The timing control circuit 13 supplies a timing signal to the analog processing unit 10, A / D converter 11 and the digital processing unit 12 synchronizes the operation of each circuit in the operation timing of the CCD image sensor 3.
出力回路１４は、調整電圧Ｖ Kを受けて動作し、信号処理回路９から出力される画像データＹ'(n)を取り込んで、ＣＰＵ（C entral Processing Unit）１６、メモリ１７、ディスプレイドライバ１８等の外部機器にシステムバス１５を介して出力する。 The output circuit 14 operates in response to regulated voltage V K, captures image data Y '(n) output from the signal processing circuit 9, CPU (C entral Processing Unit ) 16, a memory 17, a display driver 18, etc. is output via the system bus 15 to the external device. ＣＰＵ１６は、外部から命令される指示に応答して、撮像装置、メモリ１７、ディスプレイドライバ１８の動作を統括的に制御する。 CPU16, in response to an instruction which is an instruction from the external, the imaging device, a memory 17 generally controls the operation of the display driver 18. メモリ１７は、例えば、フラッシュメモリ、メモリカード等の脱着可能なリムーバブルメモリ、ハードディスク等の固定メモリであり、撮像装置から出力される画像データＹ'(n)を記憶する。 Memory 17 is, for example, a flash memory, a fixed memory of the removable memory, a hard disk or the like detachable such as a memory card, stores image data Y output from the imaging device '(n). ディスプレイドライバ１８は、撮像装置から出力される画像データＹ'(n)を受けて表示パネル１９を駆動し、再生画像を表示する。 Display driver 18, the image data Y 'by receiving (n) drives the display panel 19 outputted from the imaging device, and displays a reproduced image.
そして、上述の構成を有する撮像装置は、次のように動作する。 The imaging device having the configuration described above operates as follows. 先ず、バッテリからの電源電圧Ｖ DD （例えば、３.２Ｖ）が供給されると、レギュレート回路２に取り込まれ、電源電圧Ｖ DDよりも低い調整電圧Ｖ K （例えば、２.９Ｖ）に調整されて出力される。 First, the power supply voltage V DD from the battery (e.g., 3.2 V) when is supplied, is taken into regulator circuit 2, adjust the power supply voltage V DD from the lower regulated voltage V K (e.g., 2.9 V) which is to be output. 次いで、この調整電圧Ｖ Kは、駆動装置４及び信号処理装置７内の各回路に供給される。 Then, the adjustment voltage V K is supplied to each circuit of the drive device 4 and a signal processing device 7.
駆動装置４側に供給された調整電圧Ｖ Kは、正電圧発生用チャージポンプで正電圧側の所定電圧（例えば、５Ｖ）に昇圧されて電子シャッタ用の排出電圧としてＣＣＤイメージセンサ３に供給される。 Adjusting the voltage V K which is supplied to the drive device 4 side, a positive voltage generating charge pump positive voltage side of the predetermined voltage (eg, 5V) is boosted to be supplied to the CCD image sensor 3 as the discharge voltage for the electronic shutter that. また、駆動回路５に取り込まれた調整電圧Ｖ Kは、負電圧発生用チャージポンプで負電圧側の所定の電圧（例えば、−５Ｖ）に昇圧されて垂直ドライバ６に供給される。 The adjustment voltage V K incorporated in the drive circuit 5, a predetermined voltage of the negative voltage side at the negative voltage generating charge pump (e.g., -5V) is supplied to the vertical driver 6 is raised to. そして、垂直ドライバ６を動作させ、ＣＣＤイメージセンサ３のフレーム転送及びライン転送に必要なクロックパルスφｆ、φｖが生成され、撮像部及び蓄積部に供給される。 Then, by operating the vertical driver 6, CCD image sensor 3 of the frame transfer and clock pulses φf required line transfer, .phi.v is generated and supplied to the imaging unit and the storage unit.
一方、信号処理装置７側に供給された調整電圧Ｖ Kは、水平ドライバ８、信号処理回路９、タイミング制御回路１３及び出力回路１４の各回路に取り込まれ、各回路を動作させる。 On the other hand, regulated voltage V K which is supplied to the signal processing unit 7 side, the horizontal driver 8, the signal processing circuit 9, incorporated into the circuit of the timing control circuit 13 and the output circuit 14, to operate each circuit. タイミング制御回路１３で、各種のタイミング信号が生成されて各回路に供給され、水平ドライバ８でＣＣＤイメージセンサ３の水平転送に必要なクロックパルスφｈが生成される。 In the timing control circuit 13, various timing signals are supplied is generated in each circuit, the clock pulse φh required horizontal transfer CCD image sensor 3 in the horizontal driver 8 is generated. また、信号処理回路９でＣＣＤイメージセンサ３から出力される画像信号Ｙ(t)に対して所定のアナログ信号処理及びデジタル信号処理が施され、画像信号Ｙ'(n)が出力回路１４からシステムバス１５を介して出力される。 The predetermined analog signal processing and digital signal processing is performed on the image signal outputted by the signal processing circuit 9 from the CCD image sensor 3 Y (t), the image signal Y '(n) from the output circuit 14 System is output via the bus 15.
上述した撮像装置に搭載される信号処理装置においては、バッテリからの電源電圧をレギュレート回路で所定の調整電圧に調整した後、信号処理装置を構成するすべての回路に共通に供給するように構成している。 In the signal processing device mounted on the above-described imaging apparatus, after adjusting to a predetermined regulated voltage power supply voltage regulator circuit from the battery, configured to commonly supplied to all the circuits constituting the signal processing device doing. このため、信号処理装置内の回路に供給される電源電圧は単一であり、レギュレート回路では、通常、信号処理回路よりも動作電圧の高い出力回路の動作電圧に合わせて調整電圧の電圧値が設定されている。 Therefore, the power supply voltage supplied to the circuit in the signal processing device is a single, in the regulator circuit, usually, the voltage value of the adjustment voltage in accordance with the operating voltage of the high output circuit operating voltage than the signal processing circuit There has been set. このため、信号処理回路は、レギュレート回路で設定される調整電圧よりも低い電源電圧で動作するにも拘わらず、それよりも高い電源電圧が供給されており、不要な電力を消費している。 Therefore, the signal processing circuit, despite operating at lower supply voltages than the regulated voltage set by regulator circuit is supplied with power supply voltage higher than, it consumes unnecessary power . これにより、撮像装置全体としての消費電力を増大させているという問題があった。 Thus, there is a problem that increases the power consumption of the entire imaging apparatus.
また、従来の構成において、消費電力を抑制するために、信号処理装置の動作の必要がないときに調整電圧の出力を停止することが考えられる。 Further, in the conventional structure, in order to suppress power consumption, it is conceivable to stop the output of the regulated voltage when there is no need of operation of the signal processing apparatus. しかしながら、出力回路への供給電圧の電圧レベルを外部機器の入力レベルに常に合わせておく必要があるため、容易に電源電圧の供給を停止することができない。 However, since it is necessary to always align the voltage level of the supply voltage to the output circuit to the input level of the external device, it is impossible to stop the supply of easily supply voltage. 例えば、ＣＣＤイメージセンサが信号出力を停止しており、外部機器が動作している場合、電源電圧の供給を停止すると、外部機器側から出力回路側へシステムバスを介して電流が流れ得る。 For example, if a CCD image sensor stops signal output, if the external device is operating, stopping the supply of power supply voltage, can current flows through the system bus from the external device to the output circuit side. このときに流れる電流の電流量が、外部機器側、或いは出力回路側の電流許容量を越える場合、各機器を破壊してしまうおそれがある。 The current amount of the current flowing at this time, the external device, or if it exceeds the current capacity of the output circuit side, which may destroy the respective devices. 従って、信号処理装置が動作を停止していても、外部機器が動作を続けていれば、レギュレート回路の出力を停止することができない。 Therefore, even if the signal processing device has stopped operation, the external device if the continued operation, it is impossible to stop the output of the regulator circuit. このため、信号処理装置では、動作的には停止状態であるにも拘わらず、電源電圧が供給され続けるという状況にあった。 Therefore, the signal processing device, the operation manner despite a stopped state, the power supply voltage was in situation continues to be supplied. これにより、信号処理回路で電流リークが発生し、不要な電力消費がなされてしまうという不都合が生じていた。 Thus, current leakage occurs in the signal processing circuit, unnecessary power consumption had occurred inconvenience that made.
そこで、本願発明は、不要な電力消費を削減して消費電力を低減することのできる画像信号処理装置の提供を目的とする。 Accordingly, the present invention has an object to provide an image signal processing apparatus capable of reducing power consumption by reducing unnecessary power consumption.
本願発明は、上述の課題に鑑み、なされたもので、その特徴とするところは、固体撮像素子から出力される画像信号に対して所定の信号処理を施し、所定のフォーマットに従う画像信号を外部機器に出力する画像信号処理装置において、電源電圧を取り込んで前記固体撮像素子の出力レベルに応じた第１の電圧を発生する第１のレギュレート回路と、前記電源電圧を取り込んで前記外部機器の入力レベルに応じた第２の電圧を発生する第２のレギュレート回路と、前記固体撮像素子及び前記外部機器の少なくとも一方の動作に応じて前記電源電圧、或いは前記第２の電圧の何れかを選択して出力する切換回路と、前記第１の電圧を受けて動作し、前記固体撮像素子から出力される画像信号に対して所定の信号処理を施す信号処理回路と、前記 The present invention has been made in view of the problems described above, was made, and it is characterized, it performs predetermined signal processing on the image signal output from the solid-state imaging device, an external device image signal conforming to a predetermined format in the image signal processing apparatus for output to a first regulator circuit for generating a first voltage according to the output level of the solid-state imaging device captures the power voltage, input of the external device takes in the power supply voltage select a second regulator circuit to generate a second voltage corresponding to the level, the solid-state imaging element and the power supply voltage in response to operation of at least one of the external device, or one of the second voltage a switching circuit for and outputting said first voltage operates by receiving a signal processing circuit for performing predetermined signal processing on the image signal output from the solid-state imaging device, the 換回路の出力電圧を受けて動作し、前記信号処理回路で信号処理の施された画像信号を出力する出力回路と、を備えたことにある。 It operates by receiving an output voltage of the circuit, in that and an output circuit for outputting an image signal subjected to the signal processing by the signal processing circuit.
本願発明によれば、信号処理回路に対して第１のレギュレート回路から第１の電圧を供給し、出力回路に対して第２のレギュレート回路から第２の電圧を供給する。 According to the present invention, it provides a first voltage from the first regulator circuit to the signal processing circuit, supplies a second voltage from the second regulator circuit to the output circuit. これにより、信号処理回路及び出力回路に対し、独立して電源電圧を供給することができる。 Thus, to the signal processing circuit and the output circuit can supply a power supply voltage independently. また、出力回路の前段には、固体撮像素子及び外部機器の少なくとも一方の動作に応じて、電源電圧、或いは第２の電圧の何れかを選択的に出力する切換回路が設けられる。 Further, in the preceding stage of the output circuit, in response to operation of at least one of the solid-state imaging device and an external device, a power supply voltage or switching circuit for outputting either the selectively of the second voltage is provided. これにより、その時々に応じた電源電圧を出力回路に供給することができる。 Thus, it is possible to supply the power supply voltage in response time to time to the output circuit.
図１は、本願発明の信号処理装置を採用する撮像装置の構成を示すブロック図である。 Figure 1 is a block diagram showing the configuration of an image pickup apparatus employing the signal processing apparatus of the present invention. 尚、この図において、図５と同一の構成については同じ符号が付してある。 Note that in this figure are denoted by the same reference numerals are given to the same configuration as FIG. 本願発明の特徴とするところは、信号処理装置２１内の信号処理回路９及び出力回路１４に対して、それぞれレギュレート回路を設け、各回路に独立して電源電圧を供給することにある。 It is a feature of the present invention, the signal processing circuit 9 and the output circuit 14 of the signal processing device 21, respectively provided with regulator circuit is to supply a power supply voltage independently to each circuit. 更に、外部からの電源電圧とレギュレート回路からの出力電圧との何れかを一方を選択して出力する切換回路を設け、ＣＣＤイメージセンサ３及び外部機器の動作に応じて出力回路への供給電圧を切り替えることを特徴とする。 Furthermore, a switching circuit for selecting and outputting one of either the power supply voltage and the output voltage from the regulator circuit from the outside is provided, the supply voltage to the output circuit in response to operation of the CCD image sensor 3 and the external device and switches the.
信号処理装置２１は、水平ドライバ８、信号処理回路９及び出力回路１４から構成され、ＣＣＤイメージセンサ３から出力される画像信号Ｙ(t)に対して所定の信号処理を施し、信号処理の施された画像信号を、ＣＰＵ１６、メモリ１７、ディスプレイドライバ１８等の外部機器に出力する。 The signal processing unit 21 is composed of a horizontal driver 8, the signal processing circuit 9 and the output circuit 14, performs predetermined signal processing on the image signal Y output from the CCD image sensor 3 (t), facilities of the signal processing an image signal, CPU 16, memory 17, and outputs to an external device such as a display driver 18. 更に、信号処理装置２１は、第１及び第２のレギュレート回路２２、２３を有し、水平ドライバ８及び信号処理回路９の前段に第１のレギュレート回路２２が配置され、出力回路１１の前段に第２のレギュレート回路２３が配置される。 Furthermore, the signal processing device 21 includes a first and second regulators 22 and 23, the first regulator circuit 22 is arranged in front of the horizontal driver 8 and the signal processing circuit 9, the output circuit 11 second regulator circuit 23 is arranged in front.
第１及び第２のレギュレート回路２２、２３は、電源供給端子を介してバッテリ（図示せず）から供給される電源電圧Ｖ DDを取り込んで所定の調整電圧を生成する。 The first and second regulators 22 and 23, generates a predetermined regulated voltage takes in the power supply voltage V DD supplied from the battery (not shown) via a power supply terminal. これら第１及び第２のレギュレート回路２２、２３は、次段の回路に合わせて出力電圧が設定されている。 These first and second regulators 22 and 23, combined output voltage is set to the next circuit. 第１のレギュレート回路２２は、その出力電圧が次続の水平ドライバ８及び信号処理回路９の最適動作電圧（例えば、２.０〜２.５Ｖ）と同等となるように設定されており、第１の電圧Ｖ Aを出力する。 The first regulator circuit 22, the output voltage is the optimum operating voltage of the succeeding horizontal driver 8 and the signal processing circuit 9 (e.g., 2.0～2.5V) and is set to be equal, outputting a first voltage V a. 第２のレギュレート回路２３は、その出力電圧が出力回路１４の最適動作電圧（例えば、２.９Ｖ）、即ち、外部機器の入力レベルに対応するように設定されており、第２の電圧Ｖ Bを出力する。 Second regulator circuit 23, the output voltage is the optimum operating voltage of the output circuit 14 (e.g., 2.9 V), i.e., are set to correspond to the input level of the external device, the second voltage V and outputs the B.
このように信号処理装置２１内に複数のレギュレート回路を設け、信号処理回路９及び出力回路１４に対してそれぞれレギュレート回路を配置することで、独立して電源電圧を供給することができる。 Thus a plurality of regulating circuits to the signal processing device 21, by arranging the regulator circuit respectively to the signal processing circuit 9 and the output circuit 14 can supply the power supply voltage independently. これにより、不要な電力消費を回避することができ、消費電力の低減を図ることができる。 This makes it possible to avoid unnecessary power consumption, it is possible to reduce power consumption. 更に、レギュレート回路の出力電圧の設定を、信号処理回路９及び出力回路１４の各回路の最適な動作電圧に合わせて行うことで、それぞれに適した電源電圧を供給することができる。 Furthermore, the setting of the output voltage of the regulator circuit, by performing in accordance with the optimum operating voltage of each circuit of the signal processing circuit 9 and the output circuit 14 can supply the power supply voltage suitable for each. これにより、各回路の動作特性の向上を図ることができる。 Thus, it is possible to improve the operating characteristics of each circuit.
また、第１及び第２のレギュレート回路２２、２３は、ＣＣＤイメージセンサ３の動作状態に応じて動作するように構成されている。 The first and second regulators 22 and 23 are configured to operate in accordance with the operation state of the CCD image sensor 3. 具体的には、ＣＣＤイメージセンサ３の動作状態に応じてＣＰＵ１６から出力される制御信号ＣＥを受けて動作するように構成され、ＣＣＤイメージセンサ３が動作を停止しているとき、第１及び第２の電圧Ｖ A 、Ｖ Bの出力を停止して、出力側の電位を接地電位Ｖ G （例えば、０Ｖ）に引き下げる。 Specifically, it is configured to operate in response to a control signal CE outputted from CPU16 in accordance with the operation state of the CCD image sensor 3, when the CCD image sensor 3 has stopped operation, first and second second voltage V a, and stops the output of the V B, pull down the output side of the potential to the ground potential V G (e.g., 0V). このようにＣＣＤイメージセンサ３の動作状態に応じてレギュレート回路の出力を停止することで、ＣＣＤイメージセンサ３が停止中に電源電圧が供給されるのが防止される。 By thus stopping the output of the regulator circuit in accordance with the operation state of the CCD image sensor 3, the CCD image sensor 3 is prevented from the power supply voltage is supplied during the stop. これにより、ＣＣＤイメージセンサ３が停止中の電力消費を回避することができる。 This allows the CCD image sensor 3 to avoid power consumption stopped.
切換回路２４は、電源電圧Ｖ DDと第２の電圧Ｖ Bとを取り込み、外部機器の入力レベルに応じて電源電圧Ｖ DDと第２の電圧Ｖ Bとの何れか一方を選択的に出力する。 Switching circuit 24 takes in the power supply voltage V DD and the second voltage V B, selectively outputs one of the power supply voltage V DD and the second voltage V B according to the input level of the external device . 切換回路２４は、２つの入力端子２４ａ、２４ｂと１つの出力端子２４ｃを備えて構成され、一方の入力端子２４ａが第２のレギュレート回路２３に接続され、他方の入力端子２４ｂが電源供給端子に接続される。 Switching circuit 24 has two input terminals 24a, is configured with 24b and one output terminal 24c, one input terminal 24a is connected to the second regulator circuit 23, the other input terminal 24b is a power supply terminal It is connected to. そして、出力端子２４ｃが出力回路１４に接続される。 The output terminal 24c is connected to the output circuit 14. また、切換回路２４は、その接続状態を切り替える制御信号ＳＥをＣＰＵ１６から受けるように構成され、制御信号ＳＥに応答して出力電圧Ｖ Hを切り替える。 Further, the switching circuit 24 is configured to receive a control signal SE for switching the connection state from the CPU 16, switches the output voltage V H in response to the control signal SE. つまり、ＣＰＵ１６から切換回路２４に対して、ＣＣＤイメージセンサ３及び外部機器の動作状態に応じて出力を切り替えるように指示が与えられ、切換回路２４はその指示に従って２つの入力端子２４ａ、２４ｂと出力端子２４ｃとの接続状態を切り替える。 That is, for the switching circuit 24 from the CPU 16, an instruction is given to switch the output in accordance with the operation state of the CCD image sensor 3 and the external device, the switching circuit 24 is two input terminals 24a according to the instruction, 24b and the output It switches the connection state of the terminal 24c.
図２は、第１及び第２のレギュレート回路２２、２３の一例を示す回路構成図である。 Figure 2 is a circuit diagram showing an example of the first and second regulators 22, 23. 第１及び第２のレギュレート回路２２、２３の各回路は、基本的に同一の構成であり、接続切換部３１、Ｐチャンネル型トランジスタ３２、抵抗器列３３、コンパレータ３４及び基準電圧発生部３５で構成される。 Each circuit of the first and second regulators 22 and 23 is basically the same configuration, connection switching part 31, P-channel transistor 32, resistor string 33, a comparator 34 and a reference voltage generating unit 35 in constructed. 接続切換部３１は、電源供給端子とＰチャンネル型トランジスタ３２との間に接続される。 Connection switching part 31 is connected between the power supply terminal and the P-channel transistor 32. Ｐチャンネル型トランジスタ３２は、接続切換部３１とレギュレート回路の出力端子との間に接続され、ゲートがコンパレータ３４の出力端子に接続される。 P-channel transistor 32 is connected between the output terminal of the connection switching part 31 and the regulator circuit, a gate connected to the output terminal of the comparator 34. 抵抗器列３３は、Ｐチャンネル型トランジスタ３２のドレインと接地側との間に抵抗器３３ａ及び抵抗器３３ｂが直列に接続されて構成され、抵抗器３３ａと抵抗器３３ｂとの中間点がコンパレータ３４の非反転入力端子に接続される。 Resistor string 33, the resistor 33a and the resistor 33b between the drain and the ground side of the P-channel transistor 32 which are connected in series, the middle point between the resistor 33a and the resistor 33b is a comparator 34 It is connected to the non-inverting input terminal. 基準電圧発生部３５は、コンパレータ３４の反転入力端子に接続される。 Reference voltage generator 35 is connected to the inverting input terminal of the comparator 34.
第１及び第２のレギュレート回路２２、２３は、次のように動作する。 The first and second regulators 22, 23 operates as follows. ここで、抵抗器３３ａ及び抵抗器３３ｂの抵抗値をそれぞれＲ1、Ｒ2とする。 Here, the resistance value of the resistor 33a and the resistor 33b to the respective R1, R2. 先ず、電源供給端子を介して電源電圧Ｖ DDが供給されると、Ｐチャンネル型トランジスタ３２がオンし、電源電圧Ｖ DDが抵抗器列３３に供給される。 First, when the power supply voltage V DD via the power supply terminal is supplied, P-channel transistor 32 is turned on, the power supply voltage V DD is supplied to the resistor string 33. 次いで、抵抗器列３３によって電源電圧Ｖ DDが分圧されて、抵抗器列３３の中間点の電位Ｖ XがＶ X ＝（Ｒ2／（Ｒ1＋Ｒ2））・Ｖ DDとなり、コンパレータ３４の非反転入力端子に供給される。 Then, the power supply voltage V DD by a resistor string 33 is divided, the resistors potential V X of the midpoint V of the column 33 X = (R2 / (R1 + R2)) · V DD , and the non-inverting input of the comparator 34 It is supplied to the terminal.
次いで、コンパレータ３４が分圧電圧Ｖ Xと反転入力端子に供給される基準電圧Ｖ Rとの電位差に応じて動作し、分圧電圧Ｖ Xと基準電圧Ｖ Rが等しくなるようにＰチャンネル型トランジスタ３２のオン抵抗を制御する。 Then, operates in accordance with the potential difference between the reference voltage V R the comparator 34 is supplied to the inverting input terminal and the divided voltage V X, P-channel transistors so that the divided voltage V X and the reference voltage V R is equal to 32 controls the oN resistance of the. 具体的には、基準電圧Ｖ Rよりも分圧電圧Ｖ Xの方が高い場合にＰチャンネル型トランジスタ３２をオンする方向に動作し、基準電圧Ｖ Rよりも分圧電圧Ｖ Xの方が低い場合にＰチャンネル型トランジスタ３２をオフする方向に動作する。 Specifically, when the direction of the divided voltage V X is higher than the reference voltage V R to operate in a direction to turn on the P-channel transistor 32, towards the divided voltage V X is lower than the reference voltage V R It operates in a direction to turn off the P-channel-type transistor 32 when. そして、抵抗器列３３を構成する各抵抗器３３ａ、３３ｂの抵抗値Ｒ 1 、Ｒ 2の比と、基準電圧発生部３５から出力される基準電圧Ｖ Rとによって、一定の電圧Ｖ OUT =（（Ｒ1＋Ｒ2）／Ｒ2）・Ｖ Rがレギュレート回路の出力端子側に生成され、調整電圧として次段の回路に供給される。 Then, each resistor 33a constituting the resistor string 33, the ratio of the resistance values R 1, R 2 of 33b, by the reference voltage V R output from the reference voltage generator 35, a constant voltage V OUT = ( (R1 + R2) / R2) · V R is generated on the output terminal side of the regulator circuit, it is supplied to the next-stage circuit as an adjustment voltage.
このようにレギュレート回路から出力される調整電圧は、抵抗器列３３の分圧比及び基準電圧Ｖ Rによって決定される。 Adjusting the voltage thus output from the regulator circuit is determined by the division ratio and the reference voltage V R of the resistor string 33. 従って、第１及び第２のレギュレート回路２２、２３の各回路では、次段の回路の最適動作電圧に応じて、抵抗器列３３の分圧比及び基準電圧Ｖ Rが設定され、各回路に適した調整電圧が生成される。 Therefore, in the circuits of the first and second regulators 22 and 23, in accordance with the optimum operating voltage of the next-stage circuit, the voltage division ratio and the reference voltage V R of the resistor string 33 is set, each circuit suitable adjustment voltage is generated.
また、第１及び第２のレギュレート回路２２、２３は、上述の構成に加え、接続切換部３１、コンパレータ３４及び基準電圧発生部３５が、ＣＣＤイメージセンサ３の動作状態に応じて動作するように構成されている。 The first and second regulators 22 and 23, in addition to the configuration described above, the connection switching unit 31, a comparator 34 and a reference voltage generating unit 35, so as to operate in accordance with the operation state of the CCD image sensor 3 It is configured. 具体的には、接続切換部３１、コンパレータ３４及び基準電圧発生部３５は、制御信号ＣＥを受けて動作し、制御信号ＣＥがＣＣＤイメージセンサ３の動作中に対応するレベルを示すとき、接続切換部３１が電源供給端子とＰチャンネル型トランジスタ３２とを接続し、基準電圧発生部３５が基準電圧Ｖ Rを出力し、コンパレータ３４が分圧電圧Ｖ Xと基準電圧Ｖ Rとを等しくするようにＰチャンネル型トランジスタ３１のオン抵抗を制御する。 Specifically, the connection switching unit 31, a comparator 34 and a reference voltage generating unit 35 operates in response to control signals CE, when the control signal CE indicates a level corresponding to the running of the CCD image sensor 3, connection switching part 31 connects the power supply terminal and a P-channel transistor 32, reference voltage generator 35 outputs a reference voltage V R, as the comparator 34 is equal to the divided voltage V X and the reference voltage V R It controls the oN resistance of the P-channel transistor 31. 一方、制御信号ＣＥがＣＣＤイメージセンサ３の動作の停止に対応するレベルを示すとき、接続切換部３１が電源供給端子とＰチャンネル型トランジスタ３２との接続を遮断し、コンパレータ３４及び基準電圧発生部３５がその動作を停止する。 On the other hand, when the control signal CE indicates a level corresponding to the stop of the operation of the CCD image sensor 3, connection switching part 31 to cut off the connection between the power supply terminal and the P-channel transistor 32, a comparator 34 and a reference voltage generator 35 to stop its operation.
このようにＣＣＤイメージセンサ３の動作の停止に応じて、レギュレート回路を構成する各部の動作を停止することで、レギュレート回路自身での電力消費量を削減することができる。 Thus in accordance with the stop of the operation of the CCD image sensor 3, by stopping the operation of each portion constituting the regulator circuit, it is possible to reduce the power consumption in the regulator circuit itself. これにより、消費電力を更に低減させることができる。 Thus, it is possible to further reduce power consumption.
図３は、図１の信号処理装置の動作を示すタイミング図である。 Figure 3 is a timing diagram illustrating the operation of the signal processor of FIG. 尚、この図において、ＣＰＵ１６から出力される制御信号ＣＥは、ＣＣＤイメージセンサ３の動作中に対してＨレベルが対応付けられ、停止中に対してＬレベルが対応付けられるものとする。 Incidentally, in this figure, the control signal CE outputted from CPU16 is the H level associated with respect of the operation of the CCD image sensor 3, it is assumed that L level is associated relative stopped. また、制御信号ＣＥと同様にＣＰＵ１６から出力される制御信号ＳＥは、切換回路２４の出力電圧Ｖ Hの電源電圧Ｖ DD側への切り替えに対し、Ｈレベルが対応付けられ、第２の電圧Ｖ B側への切り替えに対し、Ｌレベルが対応付けられるものとする。 The control signal SE output from CPU16 same as the control signal CE, compared switching to the power supply voltage V DD of the output voltage V H of the switching circuit 24, the H level associated with the second voltage V to switch to B side, it is assumed that L level is associated.
以下の説明において、電源電圧Ｖ DDの電圧値をＶ D [Ｖ]とし、第１及び第２のレギュレート回路２２、２３で生成される第１及び第２の電圧Ｖ A 、Ｖ Bの電圧値をそれぞれＶa[Ｖ]、Ｖb[Ｖ]とし、更に、接地点Ｖ GNDの電圧値をＶ G [Ｖ]と定義する。 In the following description, the voltage value of the power supply voltage V DD and V D [V], the first and second voltage V A generated by the first and second regulators 22 and 23, a voltage of V B values respectively Va [V], and Vb [V], further defines the voltage value of the ground point V GND and V G [V].
先ず、タイミングｔ1において、ＣＣＤイメージセンサ３及び外部機器が駆動中である。 First, at timing t1, CCD image sensor 3 and the external device is being driven. このとき、ＣＰＵ１６から出力される制御信号ＣＥはＨレベルを示し、制御信号ＳＥはＬレベルを示す。 At this time, the control signal CE outputted from CPU16 is H level, the control signal SE indicates a L level. この結果、制御信号ＣＥに応答して、第１及び第２のレギュレート回路２２、２３が電源電圧Ｖ D [Ｖ]（例えば、３.２Ｖ）を取り込んで第１の電圧Ｖ AとしてＶa[Ｖ]（例えば、２.０〜２.５Ｖ）、第２の電圧Ｖ BとしてＶb[Ｖ]（例えば、２.９Ｖ)を発生する。 As a result, the control signal in response to the CE, the first and second regulators 22 and 23 supply voltage V D [V] (e.g., 3.2 V) Va [as the first voltage V A captures V] (e.g., 2.0~2.5V), Vb [V] as the second voltage V B (e.g., 2.9 V) to generate a. 一方、制御信号ＳＥに応答して、切換回路２４が入力端子２４ａと出力端子２４ｃとを接続するように動作し、出力電圧Ｖ Hとして第２の電圧Ｖ B側を選択する。 On the other hand, in response to a control signal SE, it operates as the switching circuit 24 connects the input terminal 24a and output terminal 24c, to select the second voltage V B side as the output voltage V H. そして、出力回路２４に動作電圧として電圧Ｖb[Ｖ]が供給される。 Then, the voltage Vb [V] is supplied as an operating voltage to the output circuit 24. これにより、ＣＣＤイメージセンサ３から出力される画像信号Ｙ(t)に対し、信号処理回路９で所定の信号処理が施されると共に、処理の施された画像信号Ｙ'(n)が出力回路１４を介して外部機器側に出力される。 Thus, the image signal Y (t) outputted from the CCD image sensor 3, a predetermined signal processing by the signal processing circuit 9 is performed, the image signal Y subjected to the process' (n) is the output circuit is output to the external device through the 14.
次いで、タイミングｔ2において、ＣＣＤイメージセンサ３のみが動作を停止し、外部機器が動作を続ける。 Then, at timing t2, only the CCD image sensor 3 stops operating, the external device continues to operate. このとき、制御信号ＣＥはＬレベルに立ち下がり、制御信号ＳＥはＨレベルに立ち上がる。 At this time, the control signal CE falls to L level, the control signal SE rises to H level. この結果、制御信号ＣＥに応答して、第１及び第２のレギュレート回路２２、２３が第１及び第２の電Ｖ A 、Ｖ Bの出力を停止し、その出力電圧をＶ G [Ｖ]（例えば、０Ｖ）とする。 As a result, the control signal in response to the CE, the first and second regulators 22 and 23 the first and second conductive V A, and stops the output of the V B, the output voltage V G [V ] and (e.g., 0V). 一方、制御信号ＳＥに応答して、切換回路２４が入力端子２４ｂと出力端子２４ｃを接続するように動作し、出力電圧Ｖ Hとして電源電圧Ｖ DD側を選択する。 On the other hand, the control signal in response to SE, operates as the switching circuit 24 connects the input terminal 24b and the output terminal 24c, to select the power supply voltage V DD side as the output voltage V H. そして、信号処理回路９への動作電圧の供給を停止し、出力回路１４にのみ動作電圧として電圧Ｖ D [Ｖ]を供給する。 Then, by stopping the supply of the operating voltage to the signal processing circuit 9 supplies a voltage V D [V] as the operating voltage only to the output circuit 14. これにより、出力回路１４の出力側をハイインピーダンス状態に設定し、外部機器側から出力回路側へ電流が流れるのを防止する。 Thus, to set the output side of the output circuit 14 to a high impedance state, to prevent the external device current from flowing to the output circuit side. 従って、信号処理装置２１と外部機器との接続を維持したままで、信号処理回路９への電源電圧の供給を停止することができる。 Accordingly, while maintaining the connection between the signal processing unit 21 and the external device, it is possible to stop the supply of power supply voltage to the signal processing circuit 9. 換言すれば、外部機器の動作状態に拘わらず、ＣＣＤイメージセンサ３の動作状態に合わせて、信号処理回路９への電源電圧の供給を停止することができ、不要な電力消費を防止することができる。 In other words, regardless of the operating state of the external device, in accordance with the operation state of the CCD image sensor 3, it is possible to stop the supply of power supply voltage to the signal processing circuit 9, it is possible to prevent unnecessary power consumption it can.
そして、タイミングｔ3において、ＣＣＤイメージセンサ３に続いて外部機器が動作を停止する。 Then, at timing t3, the external device stops operation following the CCD image sensor 3. このとき、制御信号ＣＥはＬレベルを保持し、制御信号ＳＥはＬレベルに立ち下がる。 At this time, the control signal CE is at the L level, the control signal SE falls to L level. この結果、第１及び第２のレギュレート回路２２、２３からの第１及び第２の電圧Ｖ A 、Ｖ Bの出力は停止されたまま、制御信号ＳＥに応答して、切換回路２４が第２の電圧Ｖ B側を選択するように動作する。 As a result, the first and second voltage V A from the first and second regulators 22 and 23, the output of V B is kept stopped, in response to a control signal SE, is switching circuit 24 first the second voltage V B side operates to select. これにより、出力回路１４への電源電圧の供給が停止される。 Thus, the supply of the power supply voltage to the output circuit 14 is stopped. 従って、ＣＣＤイメージセンサ３及び外部機器が動作を停止しているとき、信号処理回路９及び出力回路１４に対して電源電圧が供給されるのが防止される。 Therefore, when the CCD image sensor 3 and the external device has stopped operating, the power supply voltage to the signal processing circuit 9 and the output circuit 14 is supplied is prevented. これは、信号処理装置が外部に接続されるバッテリを電源として動作している場合、特に有効である。 This is when operating a battery signal processing apparatus is connected to the external as a power source, is particularly effective. 即ち、バッテリを電源として用いているものの場合、電源供給側でバッテリからの電圧の供給をカットする手段を備えていないものがあり、このタイプのものでは、ＣＣＤイメージセンサ３及び外部機器を含むシステム全体が停止しているにも拘わらず、信号処理装置に電源電圧が供給され得る。 That is, when although using a battery as a power source, may not have the means for cutting the supply of the voltage from the battery in the power supply side, but this type of system, including a CCD image sensor 3 and the external device overall despite being stopped, the power supply voltage may be supplied to the signal processor. 従って、信号処理回路９及び出力回路１４が動作を停止していても、回路内部で電流リークが発生することがあり、実質的には電力が消費されている。 Therefore, the signal processing circuit 9 and the output circuit 14 is also stopped operating, there is a current leakage in the circuit occurs, substantially been consumed power. そこで、ＣＣＤイメージセンサ３及び外部機器が停止しているときにおいては、電源電圧の供給を停止することで、各回路で発生する電流リークを確実に防止することができ、不要な電力消費を回避することができる。 Therefore, at the time when the CCD image sensor 3 and the external device is stopped, by stopping the supply of power supply voltage, it is possible to reliably prevent current leak generated in each circuit, avoid unnecessary power consumption can do.
ところで、信号処理装置２１には、出力電圧に制限のあるバッテリが電源として接続されるとは限らず、既にレギュレートされた電源電圧が供給される場合もある。 Meanwhile, the signal processing unit 21, a battery with limited output voltage is not necessarily be connected as a power source, there is a case where the power supply voltage which has already been regulated is supplied. このとき、調整電圧の電圧値が外部機器の入力レベル、即ち、出力回路１４で必要な電源電圧（例えば、２.９Ｖ）に設定されていることがあり得る。 At this time, the input level of the voltage value of the adjustment voltage is an external device, i.e., the required supply voltage output circuit 14 (e.g., 2.9 V) may be set to. このような場合、ＣＣＤイメージセンサ３が動作中のとき、切換回路２４は電源電圧Ｖ DD側を選択するように動作する。 In this case, when the CCD image sensor 3 is in operation, the switching circuit 24 operates to select the power supply voltage V DD side. この結果、出力回路１４には電源電圧Ｖ DDが第２のレギュレート回路２３を介さずに直接供給され、電力消費が抑制される。 As a result, the output circuit 14 the power supply voltage V DD is supplied directly without using the second regulator circuit 23, power consumption is suppressed. つまり、レギュレート回路を介して電源電圧を供給すると、レギュレート回路で少なからず電圧降下が生じて電力が消費されるが、出力回路１４に直接電源電圧Ｖ DDを供給することで、この電力消費を回避することができる。 That is, when supplying the power supply voltage via a regulator circuit, it is no small voltage drop regulator circuit power is consumed occurs, supplying a direct power supply voltage V DD to the output circuit 14, the power consumption it can be avoided. 尚、外部機器の動作状態に対しては、図３に示すものと同様に動作する。 Incidentally, with respect to the operating state of the external device operates similarly to that shown in FIG. 即ち、外部機器が動作中のとき、切換回路２４が電源電圧Ｖ DD側を選択してシステムバス１５の接続状態を維持する。 That is, when an external device is in operation, to maintain the connection state of the system bus 15 the switching circuit 24 selects the power supply voltage V DD side. 一方、外部機器が動作を停止するとき、切換回路２４が第２の電圧Ｖ B側を選択して出力回路１４への電源電圧の供給を停止する。 On the other hand, when the external device stops operating, the switching circuit 24 to stop the supply of power supply voltage to the second voltage V B side output circuit 14 selects the.
図４は、本願発明の第２の実施形態を示す図であり、本願発明の信号処理装置を採用する撮像装置の構成を示すブロック図である。 Figure 4 is a diagram showing a second embodiment of the present invention, is a block diagram showing the configuration of an image pickup apparatus employing the signal processing apparatus of the present invention. この図において、図１と同一の構成については、同じ符号が付してあり、その説明を割愛する。 In this figure, the same components as in FIG. 1, the same reference numerals are denoted, and their explanation is omitted here.
信号処理装置２１'は、水平ドライバ８、信号処理回路９、タイミング制御回路１３、出力回路１４、第１乃至第３のレギュレート回路２２、２３、４１及び切換回路２４で構成される。 The signal processing unit 21 ', a horizontal driver 8, and a signal processing circuit 9, a timing control circuit 13, output circuit 14, first to third regulator circuit 22,23,41 and switching circuit 24. この信号処理装置２１'は、アナログ処理部１０及びＡ／Ｄ変換器１１の前段に第１のレギュレート回路２２を設け、出力回路１４の前段に第２のレギュレート回路２３を設け、更に、デジタル処理部１２及びタイミング制御回路１３の前段に第３のレギュレート回路４１を設ける。 The signal processing unit 21 ', a first regulator circuit 22 provided before the analog processing section 10 and the A / D converter 11, a second regulator circuit 23 provided before the output circuit 14, further, in front of the digital processing unit 12 and the timing control circuit 13 is provided a third regulator circuit 41.
第１のレギュレート回路２２は、アナログ処理部１０及びＡ／Ｄ変換器１１の最適な動作電圧（例えば、２.５Ｖ）と同等の電圧を出力するように設定されており、バッテリ（図示せず）からの電源電圧Ｖ DDを取り込んで、第１の電圧Ｖ Aを生成する。 The first regulator circuit 22, the optimum operating voltage of the analog processing section 10 and the A / D converter 11 (e.g., 2.5V) is set to output the same voltage, the battery (shown It captures supply voltage V DD from not), to generate a first voltage V a. 第２のレギュレート回路２３は、出力回路１４の最適動作電圧（例えば、２.９Ｖ）、即ち、外部機器の入力レベルに対応する電圧を出力するように設定されており、バッテリからの電源電圧Ｖ DDを取り込んで、第１の電圧Ｖ Aより電圧値の高い第２の電圧Ｖ Bを生成する。 Second regulator circuit 23, the optimum operating voltage of the output circuit 14 (e.g., 2.9 V), i.e., is set to output a voltage corresponding to the input level of the external device, a power supply voltage from the battery It captures V DD, and generates a high voltage value than the first voltage V a second voltage V B. 第３のレギュレート回路４１は、デジタル処理部１２及びタイミング制御回路１３の最適な動作電圧（例えば、２.０Ｖ）と同等の電圧を出力するように設定されており、バッテリからの電源電圧Ｖ DDを取り込んで、第１の電圧Ｖ Aより電圧値の低い第３の電圧Ｖ Cを生成する。 Third regulator circuit 41, the optimum operating voltage of the digital processing section 12 and the timing control circuit 13 (e.g., 2.0 V) is set so as to output the same voltage as the power supply voltage V from the battery It captures DD, and generates a third voltage V C lower voltage value than the first voltage V a.
このように、アナログ処理部１０及びデジタル処理部１２の各部に対してレギュレート回路を配置することで、アナログ処理部１０及びデジタル処理部１２の各部に適した電源電圧を供給することができる。 Thus, by arranging the regulator circuit to each unit of the analog processing section 10 and the digital processing unit 12 can supply the power supply voltage that is suitable for each part of the analog processor 10 and the digital processing unit 12. これにより、各部の信号処理動作における特性の向上を図ることができる。 Thus, it is possible to improve the characteristics in each part of the signal processing operation. 更に、第３のレギュレート回路４１で、第１の電圧Ｖ Aより電圧値の低い第３の電圧Ｖ Cを生成し、独立してデジタル処理部１２に供給することで、消費電力の低減を図ることができる。 Further, in the third regulator circuit 41 generates the third voltage V C lower voltage value than the first voltage V A, independently to supply to the digital processing unit 12, a reduction in power consumption it is possible to achieve.
また、第３のレギュレート回路４１は、図２に示す第１及び第２のレギュレート回路２２、２３と同一の構成であり、デジタル処理部１２の最適な動作電圧に応じて抵抗器列の分圧比及び基準電圧発生部の基準電圧が設定されていると共に、制御信号ＣＥを受けて動作するように構成される。 The third regulator circuit 41 has the same configuration as the first and second regulators 22 and 23 shown in FIG. 2, the resistor string according to the optimum operating voltage of the digital processing unit 12 with a reference voltage division ratio and the reference voltage generator is set, configured to operate in response to a control signal CE. 即ち、制御信号ＣＥを介して出力電圧の停止が指示されたとき、第１乃至第３の電圧Ｖ A 〜Ｖ Cの出力を停止すると共に、レギュレート回路内部の基準電圧発生部及びコンパレータの動作を停止する。 That is, when the stop of the output voltage via a control signal CE is instructed, stops the output of the first to third voltage V A ~V C, regulator circuit internal reference voltage generating portion and the operation of the comparator a stop. これにより、ＣＣＤイメージセンサ３が動作を停止しているときに、アナログ処理部１０及びデジタル処理部１２に電源電圧が供給されるのが防止されると共に、レギュレート回路自身における電力消費が防止される。 Thus, when the CCD image sensor 3 has stopped operation, with the power supply voltage is supplied to the analog processing unit 10 and the digital processing unit 12 is prevented, the power consumption in the regulator circuit itself is prevented that. この結果、消費電力の低減を図ることができる。 As a result, it is possible to reduce power consumption.
図５は、本願発明の第３の実施形態の構成を示す図であり、本願発明の信号処理装置を採用する撮像装置の構成を示すブロック図である。 Figure 5 is a diagram showing a configuration of a third embodiment of the present invention, is a block diagram showing the configuration of an image pickup apparatus employing the signal processing apparatus of the present invention. 尚、この図において、図１乃至図４に示すものと同一の構成については、同じ符号が付してあり、その説明を割愛する。 In the figure, the same components as those shown in FIGS. 1-4, the same numerals are denoted, and their explanation is omitted here.
この第３の実施形態において、先の第１の実施形態や第２の実施形態と相違する点は、外部レギュレート回路２を設け、この外部レギュレート回路２からの出力電圧を信号処理装置５１内の水平ドライバ８、アナログ処理部１０及びＡ／Ｄ変換器１１に供給する点にある。 In this third embodiment, differences from the first embodiment and the second embodiment of the first, the provided external regulator circuit 2, the output voltage signal processing apparatus from the external regulator circuit 2 51 horizontal driver 8 of the inner lies in supplying the analog processing section 10 and the a / D converter 11.
外部レギュレート回路２は、図７に示すものと同一の構成を有し、その出力電圧（調整電圧Ｖ K ）を信号処理装置５１に供給する。 External regulator circuit 2 has the same structure as that shown in FIG. 7, and supplies its output voltage (regulated voltage V K) to the signal processor 51. ただし、この第３の実施形態では、調整電圧Ｖ Kが水平ドライバ８、アナログ処理部１０及びＡ／Ｄ変換器１１の最適な動作電圧（例えば、２．５Ｖ）に合わせて設定されている。 However, this third embodiment, the adjustment voltage V K is horizontal driver 8, an optimum operating voltage of the analog processing section 10 and the A / D converter 11 (e.g., 2.5V) is set in accordance with the. 第３の実施形態においては、この外部レギュレート回路２からの出力電圧が、信号処理装置５１に対する電源電圧となっている。 In the third embodiment, the output voltage from the external regulator circuit 2 has a power supply voltage to the signal processing device 51.
信号処理装置５１は、先の信号処理装置２１、２１'と同様に、水平ドライバ８、信号処理回路９、タイミング制御回路１３及び出力回路１４を有し、デジタル処理部１２の前段に第１のレギュレート回路２２、出力回路１４の前段に切換回路２４を設け、更にその前段に第２のレギュレート回路２３を設けて構成される。 The signal processing unit 51, similarly to the previous signal processing device 21, 21 ', the horizontal driver 8, the signal processing circuit 9 includes a timing control circuit 13 and the output circuit 14, first in front of the digital processing unit 12 regulator circuit 22, the switching circuit 24 provided before the output circuit 14, further constructed a second regulator circuit 23 provided in the preceding stage.
第１のレギュレート回路２２は、デジタル処理部１２及びタイミング制御回路１３の最適な動作電圧（例えば、２．０Ｖ）と同等の電圧を出力するように設定されており、外部レギュレート回路２からの電源電圧を取り込んで、第１の電圧Ｖ A 'を生成する。 The first regulator circuit 22, the optimum operating voltage of the digital processing section 12 and the timing control circuit 13 (e.g., 2.0 V) is set so as to output the same voltage, external regulator circuit 2 It captures the power supply voltage to generate a first voltage V a '. 切換回路２４は、図１及び図４と同様に、２つの入力端子２４ａ、２４ｂを備えており、各入力端子が第２のレギュレート回路２３、外部レギュレート回路２に接続される。 Switching circuit 24, like FIG. 1 and FIG. 4, two input terminals 24a, provided with a 24b, the input terminal is the second regulator circuit 23 is connected to an external regulator circuit 2. そして、制御信号ＳＥに応答して動作し、２つの入力端子の何れか一方と出力端子２４ｃとを導通させる。 Then, the control signal operates in response to SE, thereby turning on the one output terminal 24c of the two input terminals. 第２のレギュレート回路２３は、外部レギュレート回路２からの電源電圧を取り込み、出力回路１４の動作電圧に合わせて設定される調整電圧（例えば、１．８Ｖ）に変換して第２の電圧Ｖ B 'として出力する。 Second regulator circuit 23 takes in the power supply voltage from an external regulator circuit 2, the adjusting voltage set in accordance with the operating voltage of the output circuit 14 (e.g., 1.8V) a second voltage is converted to is output as V B '.
図６は、図５の動作を説明するタイミング図である。 Figure 6 is a timing diagram illustrating the operation of Figure 5. 撮像装置及び外部機器が共に動作するタイミングｔ１〜ｔ２において、入力端子２４ａ側を選択して出力回路１４へ第２の電圧Ｖ B 'を出力すると共に、撮像装置だけが動作を停止するタイミングｔ２〜ｔ３において、入力端子２４ｂ側を選択して出力回路１４へ調整電圧Ｖ Kを出力する。 In the timing t1~t2 the imaging device and the external device are operated together, select the input terminal 24a side to the output circuit 14 outputs the second voltage V B ', the timing t2~ only imaging apparatus stops operating in t3, and it outputs the regulated voltage V K selects the input terminal 24b side to the output circuit 14. そして、撮像装置及び外部機器の両者が動作を停止するタイミングｔ３以降において、入力端子２４ａ側を選択して第２のレギュレート回路２３の出力側の電位Ｖ G [V]（例えば、０Ｖ）を出力回路１４へ出力する。 Then, in the subsequent timing t3 when both the imaging device and the external device stops operation, selects the input terminal 24a side output potential V G [V] of the second regulator circuit 23 (e.g., 0V) and outputs it to the output circuit 14. この結果、出力回路１４へは、撮像装置及び外部機器の動作状態に応じた電圧が、適宜供給されることとなる。 As a result, the output circuit 14, a voltage corresponding to the operation state of the image pickup device and the external device, and is supplied as appropriate.
この第３の実施形態によれば、第１の実施形態や第２の実施形態と同様に、信号処理回路５１内の各回路に適した電圧を供給することができると共に、撮像装置及び外部機器の動作状態に応じて出力回路１４への供給電圧を切り換えることができる。 According to the third embodiment, as in the first embodiment and the second embodiment, the voltage it is possible to supply suitable for each circuit in the signal processing circuit 51, the image pickup device and the external device supply voltage in response to the operating state to the output circuit 14 can be switched. これにより、信号処理装置５１の動作特性を向上させることができると共に、撮像装置の動作が停止しているとき、或いは、撮像装置及び外部機器の両者の動作が停止しているときの不要な電力消費を防止することができる。 Thus, it is possible to improve the operating characteristics of the signal processing apparatus 51, when the operation of the imaging device is stopped, or unnecessary power when the imaging device and both the operation of the external device is stopped it is possible to prevent the consumption.
以上、図１乃至図６を参照しつつ、本願発明の実施形態を説明した。 Above, with reference to FIGS. 1 to 6 have been described embodiments of the present invention. 以上の実施形態においては、水平ドライバ８に対して、アナログ処理部１０及びＡ／Ｄ変換器１１と同等の電圧を供給する構成としているが、これに限られるものではない。 In the above embodiment, the horizontal driver 8, although constituting a supply equivalent voltage and the analog processing unit 10 and the A / D converter 11 is not limited thereto. 例えば、ＣＣＤイメージセンサ３の仕様によって、水平ドライバ８の最適な動作電圧がアナログ処理部１０及びＡ／Ｄ変換器１１の動作電圧よりもデジタル処理部１２及びタイミング制御回路１３の動作電圧に近くなったような場合には、デジタル処理部１２及びタイミング制御回路１３と同等の電圧を供給する構成としても良い。 For example, the specifications of the CCD image sensor 3, is close to the operating voltage of the digital processing section 12 and the timing control circuit 13 than the operation voltage of the optimum operating voltage of the horizontal driver 8 analog processing unit 10 and the A / D converter 11 If the like may be configured to supply the same voltage and the digital processing unit 12 and the timing control circuit 13.
本願発明によれば、信号処理回路及び出力回路のそれぞれにレギュレート回路を設けることで、信号処理回路及び出力回路の各回路に対して、独立して電源電圧を供給することができる。 According to the present invention, by providing the regulator circuit to each of the signal processing circuit and the output circuit, to each circuit of the signal processing circuit and the output circuit can supply a power supply voltage independently. 更に、出力回路に供給する電圧を選択する切換回路を設けることで、固体撮像素子及び外部機器のそれぞれの動作状態に適した電源電圧を供給することができる。 Further, by providing the switching circuit for selecting the voltage supplied to the output circuit, it can supply a power source voltage suitable for each operating state of the solid-state imaging device and an external device. これにより、不要な電力消費を防止することができ、消費電力の低減を図ることができる。 Thus, it is possible to prevent unnecessary power consumption, it is possible to reduce power consumption.
【図１】本願発明の第１の実施形態を示す図であり、本願発明の信号処理装置を採用する撮像装置の構成を示すブロック図である。 Figure 1 is a view showing a first embodiment of the present invention, is a block diagram showing the configuration of an image pickup apparatus employing the signal processing apparatus of the present invention.
【図２】図１のレギュレート回路の一例を示す回路構成図である。 2 is a circuit diagram showing an example of a regulator circuit of Figure 1.
【図３】図１の動作を説明するタイミング図である。 3 is a timing diagram illustrating the operation of Figure 1.
【図４】本願発明の第２の実施形態を示す図であり、本願発明の信号処理装置を採用する撮像装置の構成を示すブロック図である。 [Figure 4] is a diagram showing a second embodiment of the present invention, is a block diagram showing the configuration of an image pickup apparatus employing the signal processing apparatus of the present invention.
【図５】本願発明の第３の実施形態を示す図であり、本願発明の信号処理装置を採用する撮像装置の構成を示すブロック図である。 [Figure 5] is a diagram showing a third embodiment of the present invention, is a block diagram showing the configuration of an image pickup apparatus employing the signal processing apparatus of the present invention.
【図６】図５の動作を説明するタイミング図である。 6 is a timing diagram illustrating the operation of Figure 5.
【図７】従来の撮像装置の構成を示すブロック図である。 7 is a block diagram showing a configuration of a conventional imaging apparatus.
２：レギュレート回路３：ＣＣＤイメージセンサ４：駆動装置５：昇圧回路６：垂直ドライバ７、２１、２１'、５１：信号処理装置８：水平ドライバ９：信号処理回路１０：アナログ処理部１１：Ａ／Ｄ変換器１２：デジタル処理部１３：タイミング制御回路１４：出力回路１５：システムバス１６：メモリ１７：ディスプレイドライバ２２：第１のレギュレート回路２３：第２のレギュレート回路２４：切換回路４１：第３のレギュレート回路３１：接続切換部３２：Ｐチャンネル型トランジスタ３３：抵抗器列３４：コンパレータ３５：基準電圧発生部 2: regulating circuit 3: CCD image sensor 4: drive unit 5: the step-up circuit 6: a vertical driver 7,21,21 ', 51: signal processing device 8: horizontal driver 9: Signal processing circuit 10: an analog processing unit 11: a / D converter 12: the digital processing unit 13: a timing control circuit 14: output circuit 15: system bus 16: memory 17: display driver 22: the first regulator circuit 23: second regulator circuit 24: switching circuit 41: third regulator circuit 31: connection switching part 32: P-channel transistors 33: resistor string 34: comparator 35: reference voltage generator
固体撮像素子から出力される画像信号に対して所定の信号処理を施し、所定のフォーマットに従う画像信号を外部機器に出力する画像信号処理装置において、 Performs predetermined signal processing on the image signal output from the solid-state imaging device, the image signal processing apparatus for outputting an image signal conforming to a predetermined format to an external device,
電源電圧を取り込んで前記固体撮像素子の出力レベルに応じた第１の電圧を発生する第１のレギュレート回路と、 A first regulator circuit for generating a first voltage that takes in the power supply voltage according to the output level of the solid-
前記電源電圧を取り込んで前記外部機器の入力レベルに応じた第２の電圧を発生する第２のレギュレート回路と、 A second regulator circuit for generating a second voltage according to the input level of the external device takes in the power supply voltage,
前記電源電圧、或いは前記第２のレギュレート回路の出力電圧の何れかを選択して出力する切換回路と、 Said power supply voltage, or a switching circuit for selecting and outputting one of the output voltage of the second regulator circuit,
前記第１のレギュレート回路の出力電圧を受けて動作し、前記固体撮像素子から出力される画像信号に対して所定の信号処理を施す信号処理回路と、 A signal processing circuit for performing predetermined signal processing on the first operates by receiving an output voltage of the regulator circuit, the image signal output from the solid-state imaging device,
前記切換回路の出力電圧を受けて動作し、前記信号処理回路で信号処理の施された画像信号を出力する出力回路と、を備え、 The switching operates by receiving an output voltage of the circuit, and an output circuit for outputting an image signal subjected to the signal processing by the signal processing circuit,
前記第１及び第２のレギュレート回路は、前記固体撮像素子の動作が停止されている少なくとも一部の期間に、前記第１及び第２の電圧の出力を停止し、 It said first and second regulators, at least in a portion of the period the operation of the solid-state imaging device is stopped, to stop the output of the first and second voltage,
前記切換回路は、前記固体撮像素子が動作しているとき、或いは、前記固体撮像素子及び前記外部機器の両方が動作を停止しているとき、前記第２のレギュレート回路の出力電圧を選択し、前記固体撮像素子が動作を停止しているときであって前記外部機器が動作しているとき、前記電源電圧を選択して出力することを特徴とする画像信号処理装置。 It said switching circuit, when the solid-state imaging device is operating, or, when both of the solid-state imaging device and the external device has stopped operating, to select the output voltage of the second regulator circuit when said external device comprising at when the solid-state imaging device has stopped operation is operating, the image signal processing apparatus characterized by selecting and outputting the power supply voltage.
請求項１に記載の画像信号処理装置において、 The image signal processing apparatus according to claim 1,
前記電源電圧を取り込んで第３の電圧を発生する第３のレギュレート回路を更に備え、 Further comprising a third regulator circuit for generating a third voltage takes in the power supply voltage,
前記信号処理回路は、前記固体撮像素子から出力される画像信号に対して所定のアナログ信号処理を施すアナログ処理部と、前記アナログ信号処理が施された後、デジタル信号に変換された画像信号を取り込んで所定のデジタル信号処理を施すデジタル処理部と、を含み、 The signal processing circuit includes an analog processing unit performs predetermined analog signal processing on the image signal output from the solid-state imaging device, after the analog signal processing has been performed, the image signal converted into a digital signal anda digital processor for performing predetermined digital signal processing is taken,
前記アナログ処理部は、前記第１のレギュレート回路の出力電圧を受けて動作し、 The analog processing unit operates by receiving an output voltage of the first regulator circuit,
前記デジタル処理部は、前記第３のレギュレート回路の出力電圧を受けて動作することを特徴とする画像信号処理装置。 The digital processing unit, the image signal processing apparatus characterized by operating in response to an output voltage of the third regulator circuit.
請求項２に記載の画像信号処理装置において、 The image signal processing apparatus according to claim 2,
前記第３の電圧が前記第１の電圧より電圧値が低いことを特徴とする画像信号処理装置。 An image signal processing apparatus wherein the third voltage is equal to or lower voltage value than the first voltage.
前記第３のレギュレート回路は、前記固体撮像素子の動作が停止されている少なくとも一部の期間に、前記第３の電圧の出力を停止することを特徴とする画像信号処理装置。 It said third regulator circuit, at least a portion of the period the operation of the solid-state imaging device is stopped, the image signal processing apparatus characterized by stopping the output of the third voltage.
前記アナログ処理部は、前記電源電圧を受けて動作し、 The analog processing unit operates by receiving the power supply voltage,
前記デジタル処理部は、前記第１のレギュレート回路の出力電圧を受けて動作することを特徴とする画像信号処理装置。 The digital processing unit, the image signal processing apparatus characterized by operating in response to an output voltage of the first regulator circuit.
JP2002107735A 2001-08-01 2002-04-10 Image signal processing device Active JP4222772B2 (en)
JP2001-233806 2001-08-01
JP2001233806 2001-08-01
JP2002107735A JP4222772B2 (en) 2001-08-01 2002-04-10 Image signal processing device
CN 02141334 CN1219399C (en) 2001-08-01 2002-07-05 Image signal processor
TW91116858A TW566037B (en) 2001-08-01 2002-07-29 Image signal processor
US10/208,588 US7173664B2 (en) 2001-08-01 2002-07-30 Image signal processor with reduced power consumption
KR20020045214A KR100496846B1 (en) 2001-08-01 2002-07-31 Image signal processing apparatus
JP2003116045A JP2003116045A (en) 2003-04-18
JP4222772B2 true JP4222772B2 (en) 2009-02-12
ID=26619772
JP2002107735A Active JP4222772B2 (en) 2001-08-01 2002-04-10 Image signal processing device
US (1) US7173664B2 (en)
JP (1) JP4222772B2 (en)
KR (1) KR100496846B1 (en)
CN (1) CN1219399C (en)
TW (1) TW566037B (en)
JP2011223270A (en) * 2010-04-08 2011-11-04 Toshiba Corp Solid-state image pickup device and control action therefor
CN104320573B (en) * 2014-09-19 2018-01-26 深圳电科技有限公司 Parameter adjusting method and system of the image pickup apparatus
JPH0517745B2 (en) 1988-03-11 1993-03-10 Konishiroku Photo Ind
JPH0282774A (en) 1988-09-19 1990-03-23 Olympus Optical Co Ltd Electronic camera system
JPH02248170A (en) 1989-03-22 1990-10-03 Toshiba Corp Electronic camera
JP2937236B2 (en) 1996-11-18 1999-08-23 日本電気株式会社 Switching regulator
JP3728036B2 (en) 1996-12-10 2005-12-21 キヤノン株式会社 Digital camera
JPH10337001A (en) 1997-05-28 1998-12-18 Canon Inc Switching regulator and image pickup unit
FR2789190B1 (en) * 1999-01-28 2001-06-01 St Microelectronics Sa Power-controlled high rejection rate of the noise of a power supply
2002-04-10 JP JP2002107735A patent/JP4222772B2/en active Active
2002-07-05 CN CN 02141334 patent/CN1219399C/en not_active IP Right Cessation
2002-07-29 TW TW91116858A patent/TW566037B/en active
2002-07-30 US US10/208,588 patent/US7173664B2/en active Active
2002-07-31 KR KR20020045214A patent/KR100496846B1/en not_active IP Right Cessation
US7173664B2 (en) 2007-02-06
CN1219399C (en) 2005-09-14
JP2003116045A (en) 2003-04-18
KR20030013262A (en) 2003-02-14
TW566037B (en) 2003-12-11
US20030026615A1 (en) 2003-02-06
CN1400812A (en) 2003-03-05
KR100496846B1 (en) 2005-06-22
US7719595B1 (en) 2010-05-18 Preview mode low resolution output system and method
JP4144578B2 (en) 2008-09-03 The solid-state imaging device, a pixel signal processing method
JP5164531B2 (en) 2013-03-21 The solid-state imaging device
EP0828383B1 (en) 2004-12-01 Electronic camera and battery voltage controlling method employed therein
US8629935B2 (en) 2014-01-14 Solid-state imaging device and imaging apparatus
KR20020060093A (en) 2002-07-16 Solid state imaging device and image input apparatus
US7619669B2 (en) 2009-11-17 Power savings with multiple readout circuits
WO2005091624A1 (en) 2005-09-29 Automatic gain control circuit
KR100403290B1 (en) 2003-10-30 High speed readout architecture for analog storage arrays
JP2003298899A (en) 2003-10-17 Imaging unit
US7183815B2 (en) 2007-02-27 Drive apparatus for CCD image sensor