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Timestamp: 2018-11-13 23:43:46
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JP2005201813A - Semiconductor test equipment and manufacturing method of contact - Google Patents
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JP2005201813A
JP2005201813A JP2004009614A JP2004009614A JP2005201813A JP 2005201813 A JP2005201813 A JP 2005201813A JP 2004009614 A JP2004009614 A JP 2004009614A JP 2004009614 A JP2004009614 A JP 2004009614A JP 2005201813 A JP2005201813 A JP 2005201813A
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<P>PROBLEM TO BE SOLVED: To provide a semiconductor device testing equipment with a contact for electrically connecting to a terminal part of an electronic device, and a manufacturing method capable of arranging with a small pitch by improving work precision and lessening plastic deformation and capable of mass production at low cost. <P>SOLUTION: The contact 45 formed on a plate body 42 composed of 1st to 4th columnar parts 46-49 of different height, and a holding part 41 composed of the plate body 42 and the frame body 43 are formed by a silicon substrate, and the surface of the 1st to the 4th columnar parts 46-49 is provided with a conductive metal 52, and the 4th columnar part 49 with the through hole electrode 55 connected with the conductive metal 52. <P>COPYRIGHT: (C)2005,JPO&NCIPI
本発明は、半導体検査装置及びコンタクタの製造方法に係り、特に端子部を有する電子装置の検査を行う際、電子装置の端子部と電気的に接続されるコンタクトを備えた半導体検査装置及びコンタクトの製造方法に関する。 The present invention relates to a method of manufacturing a semiconductor inspection device and a contactor, in particular when inspecting the electronic device having a terminal portion, the semiconductor inspection apparatus and the contacts having a contact that is the terminal portions electrically connected to the electronic device It relates to a method for manufacturing.
近年の半導体装置の高密度化に伴い、半導体装置の外部接続端子も多ピン化する傾向にある。 Increases in density of semiconductor devices in recent years tends to be more pins external connection terminals of the semiconductor device. 一方において、半導体装置には小型化の要求もある。 On the other hand, the semiconductor device is also a need for miniaturization. このため、外部接続端子を高密度に配設する必要がある。 Therefore, it is necessary to dispose the external connection terminals at a high density. これに対応しうるパッケージとして、ＢＧＡ（Ball Grid Array）やＣＳＰ（Chip Size Package）が知られている。 As a package may correspond to, BGA (Ball Grid Array) and CSP (Chip Size Package) has been known.
このＢＧＡ（Ball Grid Array）やＣＳＰ（Chip Size Package）は、その底面部に小径のはんだボールが格子状に配列されている。 The BGA (Ball Grid Array) and CSP (Chip Size Package), the small-diameter solder balls are arranged in a lattice pattern on the bottom surface portion. このようにはんだボールを格子状に配設することにより、そのピッチ間隔を縮小化でき、よって半導体装置の高密度化及び小型化を図ることができる。 By arranging in this manner the solder balls in a grid pattern, it can be reduced of the pitch, thus it is possible to increase the density and size of the semiconductor device. また、半導体装置は高い信頼性を要求されるため、出荷前に信頼性試験が実施される。 Further, since the semiconductor device requiring high reliability, the reliability test is performed before shipment. この信頼性試験では、半導体装置に実際に試験信号を供給して試験を行うため、テスターに接続されたコンタクトを半導体装置のはんだボールに接続させる必要がある。 In the reliability tests, for testing by supplying the actual test signals to the semiconductor device, it is necessary to connect a contact connected to the tester to the solder balls of the semiconductor device.
図１は、従来技術のコンタクトを示した図である。 Figure 1 is a diagram showing the contact of the prior art. 同図に示されるコンタクト１０は、ポコピンと一般に称されるものである。 Contact 10 shown in the figure is what is referred to Pokopin generally. このコンタクト１０は、大略すると軸部１１と、ＢＧＡのはんだボールと接続される上部プランジャ１２と、検査装置（テスター）と接続される下部プランジャ１３と、コイルスプリング１４とにより構成されている。 The contact 10, when generally a shaft portion 11, an upper plunger 12 that is connected to the BGA solder balls, and the lower plunger 13 which is connected inspection unit (tester) is constituted by a coil spring 14.
各プランジャ１２，１３の間には、コイルスプリング１４が配設されており、このコイルスプリング１４により上部プランジャ１２は下部プランジャ１３に対して上下方向（図１中に示した矢印方向）に変位可能な構成とされている。 Between the plungers 12 and 13, a coil spring 14 is disposed, an upper plunger 12 by the coil spring 14 is vertically displaceable (arrow direction shown in FIG. 1) with respect to the lower plunger 13 there is a Do configuration. また、ハウジング１５には貫通孔が形成されており、コンタクト１０はこの貫通孔に配設されている（例えば、特許文献１参照。）。 Further, the housing 15 is formed with a through hole, the contact 10 is disposed in the through hole (e.g., see Patent Document 1.).
図２は、従来技術であるワイヤ形状のコンタクトを示した図である。 Figure 2 is a diagram illustrating the contact wire shape is prior art. コンタクト２０は、軟質コア２１と、軟質コア２１を内包するように配設された硬質シェル２２とにより構成されている。 Contact 20 includes a soft core 21 is constituted by a rigid shell 22 which is arranged so as to include a soft core 21. 軟質コア２１は、ワイヤボンディング技術により形成される。 Soft core 21 is formed by a wire bonding technique. 硬質シェル２２は、軟質コア２１を内包するようにめっき法により形成される（例えば、特許文献２参照。）。 Hard shell 22 is formed by plating so as to include a soft core 21 (e.g., see Patent Document 2.).
特開２００１−２５５３４０号公報 JP 2001-255340 JP 特開平１１−１２６８００号公報 JP 11-126800 discloses
しかし、コンタクト１０の場合には、コイルスプリング１４等の機械的部品を使用しているため、コンタクト１０を狭いピッチで配設することが困難であるという問題点があった。 However, in the case of contact 10, due to the use of mechanical components such as a coil spring 14, there is a problem that it is difficult to dispose the contact 10 at a narrow pitch. また、コンタクト１０は、手作業で作成されるため、加工精度が悪いという問題や製造コストが高く、大量生産できないという問題があった。 In addition, contact 10, to be created by hand, machining accuracy is high is a problem and the manufacturing cost of bad, there is a problem that can not be mass-produced. また、コンタクト１０は、部品点数が多く必要なため、コストが高くなるという問題があった。 The contact 10 is, for parts that are most needed, the cost is high.
ワイヤボンディング技術により形成したコンタクト２０の場合は、形状が複雑なため、狭ピッチでコンタクト２０を配設することが困難であるという問題点があった。 For contact 20 formed by the wire bonding technique, since the shape is complicated, there is a problem that it is difficult to dispose the contacts 20 at a narrow pitch. また、コンタクト２０はワイヤ形状であるため、へたりやすく、塑性変形しやすいという問題点があった。 The contact 20 is for a wire shape, easy to have enough to, there is a problem that plastic easily deformed.
そこで本発明は、上述した問題点に鑑みなされたものであり、加工精度を向上させて狭いピッチで配置することができ、かつ塑性変形の小さくして、低コストで大量生産することのできるコンタクトを備えた半導体検査装置及びコンタクトの製造方法を提供することを目的とする。 Contact The present invention has been made in view of the problems described above, the machining accuracy is improved can be arranged at a narrow pitch, and by reducing the plastic deformation can be mass-produced at low cost and to provide a semiconductor inspection device and a contact fabrication process of having a.
上記課題を解決するために本発明では、次に述べる各手段を講じたことを特徴とするものである。 In the present invention in order to solve the above problems, it is characterized in that by practice of the means described below.
請求項１記載の発明では、連続的に配置された高さの異なる複数の柱状部により構成され、被検査物となる電子装置の端子部が接続されるコンタクトと、前記複数の柱状部の少なくとも表面に形成された導電体層と、前記コンタクトを保持する保持部と、前記複数の柱状部の少なくとも一つを貫通するよう形成され、前記導電体層と前記保持部の背面側から導通するスルーホール電極とを有しており、前記コンタクト及び保持部が一のシリコン基板から一体的に形成されてなることを特徴とする半導体検査装置により、解決できる。 In the first aspect of the present invention, is composed of a plurality of columnar portions having different heights are continuously arranged, and the contact terminal portions of the electronic device to be an inspection object are connected, at least of the plurality of columnar portions a conductor layer formed on the surface, a holding portion for holding the contacts, is formed to penetrate at least one of said plurality of columnar portions, conducts from the back side of the holding portion and the conductive layer through It has a hole electrode, the semiconductor inspection device characterized by comprising integrally formed the contact and holding unit from a silicon substrate, can be solved.
上記発明によれば、連続的に配置された高さの異なる複数の柱状部と、スルーホール電極及び導電体層とにより構成されたコンタクトと、コンタクトを保持する保持部とを一のシリコン基板を用いて一体的に形成するため、例えば、半導体装置の加工に適用されるフォトエッチング技術を用いて加工精度を向上させて、従来のコンタクトと比較して、コンタクトを狭いピッチで配置することができると共に、塑性変形の小さいコンタクトを低コストで大量生産することができる。 According to the invention, the height of different columnar portions that are successively arranged, the contacts constituted by a through-hole electrode and the conductor layer, the first silicon substrate and a holding portion for holding the contact to integrally formed with, for example, it is possible to improve the processing accuracy by using a photo-etching technique applied to processing of a semiconductor device, as compared with the conventional contact, placing the contact at a narrow pitch together, they can be mass-produced at low cost a small contact with the plastic deformation.
請求項２記載の発明では、前記複数の柱状部は、平面視した状態において、スパイラル状に配置されていることを特徴とする請求項１に記載の半導体検査装置により、解決できる。 In the invention of claim 2, wherein said plurality of columnar portions, in a plan view, the semiconductor inspection device according to claim 1, characterized in that it is arranged in a spiral shape, it can be solved.
上記発明によれば、平面視した状態において、高さの異なる複数の柱状部をスパイラル状に配置することにより、電子装置の端子部と柱状部との接触位置がずれた場合でも導電体層と電子装置の端子部とを電気的に精度良く接続することができる。 According to the invention, in a plan view, by arranging a plurality of columnar portions having different heights in a spiral shape, a conductive layer even when the contact position is shifted between the terminal portion and the columnar portion of the electronic device and a terminal portion of the electronic device electrically can be accurately connected. また、複数の柱状部をスパイラル状に配置することにより、コンタクトの強度を増加させることができる。 Further, by arranging a plurality of the columnar portion in a spiral shape, it is possible to increase the strength of the contact.
請求項３記載の発明では、前記保持部は、前記複数の柱状部を囲繞する枠体により構成されており、前記複数の柱状部の少なくとも一つは、前記枠体に一体的に形成され、前記複数の柱状部のそれぞれの底面部は、前記枠体の底面部と面一になるように構成されていることを特徴とする請求項１または２に記載の半導体検査装置により、解決できる。 In the invention of claim 3, wherein said holding unit is constituted by a frame body surrounding said plurality of columnar portions, at least one of said plurality of columnar portions is integrally formed on the frame, each of the bottom portion of the plurality of columnar portions, the semiconductor inspection device according to claim 1 or 2, characterized in that it is configured such that the bottom surface flush with the frame member, can be solved.
上記発明によれば、複数の柱状部の少なくとも一つは、保持部である枠体に一体的に形成されているため、複数の柱状部は保持部に対してバネ性を有することができる。 According to the invention, at least one of the plurality of columnar portions, since they are integrally formed with the frame body is holding unit, the plurality of columnar portions may have a spring characteristic with respect to the holding portion. これにより、電子装置の端子部の当接による複数の柱状部の塑性変形を小さくすることができ、コンタクトの寿命を長くすることができる。 Thus, it is possible to reduce the plastic deformation of the plurality of columnar portions by abutting the terminal part of the electronic device, it is possible to increase the life of the contacts.
請求項４記載の発明では、連続的に配置された高さの異なる第１乃至第Ｎの柱状部により構成され、前記第１乃至第Ｎの柱状部は保持部により支持されており、被検査物となる電子装置の端子部が前記第１乃至第Ｎの柱状部のいずれかに接続されるコンタクトの製造方法であって、一のシリコン基板を用いて、前記保持部及び第Ｎ−１の柱状部に対応した位置の前記シリコン基板上に第Ｎ−１のレジスト膜を形成する処理と、前記シリコン基板上における第Ｎ−１のレジスト膜上及び第Ｎの柱状部に対応した位置に前記第Ｎ−１のレジスト膜とは特性の異なる第Ｎのレジスト膜を形成する処理とを順次繰り返し行い、第１乃至第Ｎのレジスト膜を形成する第１の工程と、 In the invention of claim 4, it is constituted by the columnar portion of the successively arranged having different heights first to N, the columnar portion of the first through N is supported by the holding portion, to be inspected a contact method of manufacturing the terminal portion of the electronic device to be things which are connected to one of the columnar portion of the first through N, with one of the silicon substrate, the holding portion and the N-1 wherein a process of forming the first N-1 of the resist film on the silicon substrate at positions corresponding to the columnar portion, at a position corresponding to the columnar portion of the N-1 of the resist film and the N in the silicon substrate the first N-1 of the resist film sequentially repeated subjected to a process of forming a resist film of the N having different characteristics, a first step of forming a resist film of the first to N,
前記第Ｎのレジスト膜をマスクとして所定の深さのエッチングを行なった後、該第Ｎのレジスト膜を剥離処理する工程を順次繰り返し行い、第１乃至第Ｎの柱状部と保持部とを形成する第２の工程と、前記第１乃至第Ｎの柱状部のすくなくとも表面に導電体層を形成する工程とを有したことを特徴とするコンタクトの製造方法により、解決できる。 After performing etching of a predetermined depth using the resist film of the first N as a mask, successively repeating performed step of peeling treatment the resist film of said N, form a holding portion and the columnar portion of the first through N the second step and the method for producing a contact, characterized in that a step of forming a conductive layer on at least the surface of the columnar portion of the first through N to be solved.
請求項５記載の発明では、連続的に配置された高さの異なる第１乃至第４の柱状部により構成され、前記第１乃至第４の柱状部は枠体と板体とを備えた保持部により支持されており、被検査物となる電子装置の端子部が前記第１乃至第４の柱状部のいずれかに接続されるコンタクトの製造方法であって、前記第１の柱状部及び枠体に対応した位置のシリコン基板上に第１のレジスト膜を形成する工程と、前記第２の柱状部に対応した位置のシリコン基板上と前記第１のレジスト膜上とに、前記第１のレジスト膜とは特性の異なる第２のレジスト膜を形成する工程と、前記第３の柱状部に対応した位置のシリコン基板上と前記第２のレジスト膜上とに、前記第２のレジスト膜とは特性の異なる第３のレジスト膜を形成する工程と、前記第４の柱 In the invention of claim 5, wherein is composed of a serially arranged different heights first to fourth columnar portion, the columnar portion of the first to fourth and a frame body and the plate member holding is supported by part, a method for producing a contact terminal portion of the electronic device to be the inspection object is to be connected to one of the columnar portion of the first to fourth, the first columnar portion and the frame forming a first resist film on a silicon substrate at positions corresponding to the body, on the on the second of said silicon substrate at positions corresponding to the columnar portion first resist film, the first a resist film and forming a second resist film having different characteristics, said third to the silicon substrate at positions corresponding with the second resist film in the columnar portion, the second resist film forming a different third resist film characteristics, the fourth column 部に対応した位置のシリコン基板上と前記第３のレジスト膜上とに、前記第３のレジスト膜とは特性の異なる第４のレジスト膜を形成する工程と、前記第４のレジスト膜をマスクとして、第１の深さのエッチングをする工程と、前記第４のレジスト膜の剥離し、前記第３のレジスト膜をマスクとして、第２の深さのエッチングをする工程と、前記第３のレジスト膜の剥離し、前記第２のレジスト膜をマスクとして、第３の深さのエッチングをする工程と、前記第２のレジスト膜の剥離し、前記第１のレジスト膜をマスクとして、第４の深さのエッチングし、第１乃至第４の柱状部と、前記第１乃至第４の柱状部の底面部を支持する前記板体と、前記枠体とを形成する工程と、前記第１のレジスト膜を剥離し、前記第４の柱状部に貫通孔を形 To position the silicon substrate and of the on the third resist film corresponding to section, said the step and the third resist film to form a different fourth resist film characteristics, the fourth resist film mask as the steps of etching the first depth, and peeling of the fourth resist film as a mask the third resist film, a step of etching the second depth, the third peeling of the resist film as a mask the second resist film, a step of etching the third depth, and peeling of the second resist film, the first resist film as a mask, a fourth and the depth of the etching, the first to fourth column part, and the plate body for supporting a bottom portion of the columnar portion of the first to fourth, and forming with said frame body, the first resist film was peeled off, form a through-hole in the columnar portion of the fourth するための開口部を有した第５のレジスト膜を形成する工程と、前記第５のレジスト膜をマスクとしてエッチングを行い、前記第４の柱状部に貫通孔を形成する工程と、前記第１乃至第４の柱状部の少なくとも表面に導電体層を形成すると共に、前記貫通孔の内部に導電体を充填し、スルーホール電極を形成する工程とを有したことを特徴とするコンタクトの製造方法により、解決できる。 Forming a fifth resist film having an opening for the steps of performing etching to form a through hole in the fourth column part of the fifth resist film as a mask, the first to thereby form the fourth conductor layer at least on the surface of the columnar portion of said filling a conductor inside the through hole, a manufacturing method of a contact, characterized in that a step of forming a through-hole electrode by, it can be solved.
上記発明によれば、第１乃至第４の柱状部は、第１乃至第４の柱状部の底面部は板体に支持されているため、電子装置の端子部が第１乃至第４の柱状部のいずれかに当接された際、板体により第１乃至第４の柱状部の位置の変位が抑制されて、導電体層と端子部との間をしっかりと電気的に接続することができる。 According to the invention, the columnar portion of the first to fourth bottom surface portion of the first to fourth column part because it is supported by the plate member, the pole terminals of the first to fourth electronic devices when in contact with the one of parts, and the displacement of the position of the first to fourth column part is prevented by the plate member, it securely electrically connecting between the conductive layer and the terminal portion it can.
請求項６記載の発明では、連続的に配置された高さの異なる第１乃至第４の柱状部により構成され、前記第１乃至第４の柱状部は枠体形状とされた保持部により支持されており、前記第１乃至第４の柱状部の少なくとも一つは前記保持部と一体的に形成され、被検査物となる電子装置の端子部が前記第１乃至第４の柱状部のいずれかに接続されるコンタクトの製造方法であって、一のシリコン基板を用いて、前記第１の柱状部及び枠体に対応した位置のシリコン基板上に、前記第１の柱状部に貫通孔を設けるための開口部を有した第１のレジスト膜を形成する工程と、前記第２の柱状部に対応した位置のシリコン基板上と前記第１のレジスト膜上とに、前記第１のレジスト膜とは特性の異なる第２のレジスト膜を形成する工程と、前記第３の Supporting the invention described in claim 6, is constituted by first to fourth column part heights which are sequentially arranged differently, the columnar portion of the first to fourth by the holding portion which is a frame body shaped being at least one of the first to fourth columnar portion is integrally formed with the holding portion, one terminal portion of the electronic device as a object to be inspected of the first to fourth column part a method for manufacturing a contact to be crab connected, using one of the silicon substrate, the first columnar portion and on the silicon substrate at positions corresponding to the frame body, the first columnar portion into the through hole forming a first resist film having an opening for providing, on the on the second of said silicon substrate at positions corresponding to the columnar portion first resist film, the first resist film and forming a second resist film having different characteristics, the third 状部に対応した位置のシリコン基板上と前記第２のレジスト膜上とに、前記第２のレジスト膜とは特性の異なる第３のレジスト膜を形成する工程と、前記第４の柱状部に対応した位置のシリコン基板上と前記第３のレジスト膜上とに、前記第３のレジスト膜とは特性の異なる第４のレジスト膜を形成する工程と、前記第４のレジスト膜をマスクとして、第１の深さのエッチングをする工程と、前記第４のレジスト膜の剥離し、前記第３のレジスト膜をマスクとして、第２の深さのエッチングをする工程と、前記第３のレジスト膜の剥離し、前記第２のレジスト膜をマスクとして、第３の深さのエッチングをする工程と、前記第２のレジスト膜の剥離し、前記第１のレジスト膜をマスクとして、第４の深さのエッチングを行い、前記第１乃至 In the silicon substrate at positions corresponding with the second resist film to Jo portion, and forming a different third resist film of said second resist film characteristics, the columnar portion of the fourth in the corresponding positions of the silicon substrate and on the third resist film, and forming the third resist film and the fourth with different characteristics of the resist film, the fourth resist film as a mask, a step of etching the first depth, the peeling and the fourth resist film as a mask the third resist film, a step of etching the second depth, the third resist film and the release, as a mask the second resist film, a step of etching the third depth, and peeling of the second resist film as a mask the first resist film, the fourth depth perform the etching, the first to ４の柱状部と、前記保持部と、該保持部と前記第１乃至第４の柱状部に形成された貫通部と、前記貫通孔とを形成する工程と、前記第１乃至第４の柱状部の少なくとも表面に導電体層を形成すると共に、前記貫通孔の内部に導電体を充填し、スルーホール電極を形成する工程とを有したことを特徴とするコンタクトの製造方法により、解決できる。 4 and the columnar portion of said holding portion, and a through portion formed in the first to columnar portion of the fourth and the holding portion, and forming the said through hole, said first to fourth column and forming a conductive layer on at least the surface of the part, the internally to fill the conductor of the through hole, the method for producing a contact, characterized in that a step of forming a through-hole electrode, can be solved.
上記発明によれば、第１乃至第４の柱状部の少なくとも一つは、保持部に一体的に形成されているため、第１乃至第４の柱状部は保持部に対してバネ性を有する。 According to the invention, at least one of the first to fourth column part, because they are integrally formed with the holding portion, the columnar portion of the first through fourth has a spring characteristic with respect to the holding portion . これにより、第１乃至第４の柱状部の塑性変形を小さくすることができ、コンタクトの寿命を長くすることができる。 Thus, it is possible to reduce the plastic deformation of the columnar portion of the first to fourth, it is possible to increase the life of the contacts.
本発明は、加工精度を向上させて狭いピッチで配置することができ、かつ塑性変形の小さくして、低コストで大量生産することのできるコンタクトを備えた半導体検査装置及びコンタクトの製造方法を提供することができる。 The present invention, machining accuracy improves can be arranged at a narrow pitch, and by reducing the plastic deformation, provides a semiconductor inspection apparatus and the contact manufacturing method of having a contact which can be mass produced at low cost can do.
次に、図面に基づいて本発明の実施例を説明する。 Next, an embodiment of the present invention will be described with reference to the drawings.
始めに、図３乃至図５を参照して、本発明の第１実施例によるコンタクトを備えた半導体検査装置について説明する。 First, with reference to FIGS. 3 to 5, description will be given of a semiconductor inspection device including a contact according to a first embodiment of the present invention. 図３は、本発明の第１実施例の半導体検査装置の平面図であり、図４は、図３に示したコンタクトの斜視図であり、図５は、図３に示した半導体検査装置のＡ―Ａ線方向の断面図である。 Figure 3 is a plan view of a semiconductor inspection device of the first embodiment of the present invention, FIG. 4 is a perspective view of a contact shown in FIG. 3, FIG. 5, the semiconductor inspection apparatus shown in FIG. 3 it is a cross-sectional view along the line a-a. なお、図４において、Ｚ，Ｚ方向は、鉛直方向を示している。 Incidentally, in FIG. 4, Z, Z-direction indicates the vertical direction. また、図５に示した６０Ｂは、コンタクト４５及び保持部４１の背面（以下、背面６０Ｂとする）を示している。 Also, 60B shown in FIG. 5 shows a rear of the contact 45 and the holding portion 41 (hereinafter referred to as the back 60B).
半導体検査装置４０は、大略すると保持部４１と、コンタクト４５と、計測部５８（図５参照）とにより構成されており、コンタクト４５及び保持部４１は、一のシリコン基板に一体的に形成されている。 The semiconductor testing apparatus 40 includes a holding portion 41 that generally, the contact 45 is constituted by a measuring unit 58 (see FIG. 5), the contact 45 and the holding portion 41 is integrally formed on one of the silicon substrate ing. 保持部４１は、コンタクト４５を囲繞するよう枠体形状に構成されており、コンタクト４５と保持部４１との間には、貫通部８３が形成されている。 Holding portion 41 is formed into the frame shape so as to surround the contact 45, between the holding portion 41 and the contact 45, through portion 83 is formed. なお、図示してはいないが、半導体検査装置４０には、複数のコンタクト４５が格子状に配列された構成とされている。 Although not shown, the semiconductor inspection device 40 is a structure where a plurality of contacts 45 are arranged in a grid pattern.
コンタクト４５は、大略すると複数の柱状部である第１乃至第４の柱状部４６〜４９と、導電体層５２と、スルーホール電極５５とにより構成されている。 Contact 45, when generally a plurality of first to fourth is a columnar portion of the columnar portion 46-49, a conductor layer 52 is constituted by a through-hole electrode 55. 第１乃至第４の柱状部４６〜４９は、連続的に配置された高さの異なる複数の柱状部であり、第１の柱状部４６の高さが最も高く、第２の柱状部４７、第３の柱状部４８、第４の柱状部４９の順で高さが低くなるように構成されている。 The first to fourth column part 46-49 is a plurality of columnar portions having different heights are continuously arranged, the height of the first columnar portion 46 is the highest, the second columnar portion 47, third columnar portion 48, sequentially in the height of the fourth column part 49 is configured to be lower. また、第１乃至第４の柱状部４６〜４９は、第１乃至第４の柱状部４６〜４９のそれぞれの底面部（背面６０Ｂ）が面一となるように形成されている。 Further, first to fourth column part 46 to 49, each of the bottom portions of the first to fourth column part 46-49 (back 60B) is formed so as to be flush.
第１乃至第４の柱状部４６〜４９は、平面視した状態（図３の状態）において、スパイラル状に配置されており、コンタクト４５は、第４の柱状部４９を介して保持部４１により片持ち梁状に支持されている。 The first to fourth column part 46 to 49, in a plan view state (state of FIG. 3), are arranged in a spiral shape, the contact 45, the holding portion 41 via the fourth column part 49 It is supported like a cantilever.
このような構成とすることにより、コンタクト４５は、枠体形状の保持部４１に対してバネ性を有することができる。 With such a configuration, the contact 45 may have a spring against the holding portion 41 of the frame shape. これにより、電子装置の端子部が当接された際、コンタクト４５の塑性変形を小さくすることができ、コンタクト４５の寿命を長くすることができる。 Accordingly, when the terminals of the electronic device is in contact, it is possible to reduce the plastic deformation of the contact 45, it is possible to increase the life of the contact 45. また、第１乃至第４の柱状部４６〜４９をスパイラル状に配置することにより、それぞれの柱状部が支えあうためコンタクト４５の強度を増加させることができる。 Further, by arranging the first to fourth column part 46-49 in a spiral shape, it is possible to increase the strength of the contact 45 for each of the columnar portion support each other.
第１乃至第４の柱状部４６〜４９の表面には、導電体層５２がそれぞれ形成されている。 The first to the surface of the fourth columnar section 46-49, the conductive layer 52 are formed. 最も高さの低い第４の柱状部４９には、第４の柱状部４９をＺ，Ｚ方向に貫通する貫通孔内にスルーホール電極５５が形成されている。 Most low profile fourth column part 49, the fourth column part 49 Z, through-hole electrodes 55 in the through hole penetrating in the Z direction are formed. このスルーホール電極５５は、導電体層５２を形成する際に同時に形成される。 The through-hole electrode 55 is formed simultaneously with the formation of the conductive layer 52. スルーホール電極５５は、背面６０Ｂと導電体層５２との間を電気的に接続するためのものである。 Through-hole electrode 55 is for electrically connecting between the rear 60B and the conductor layer 52. 計測部５８は、スルーホール電極５５と電気的に接続されている。 Measuring unit 58 is electrically coupled to the through-hole electrode 55. 計測部５８は、電子装置５６からの入出力の信号に基づき、電子装置５６の検査を行うためのものである。 Measurement unit 58, based on the input and output of signals from the electronic device 56 is for inspecting the electronic device 56. 検査対象となる電子装置５６には、ＣＳＰやＢＧＡの他に半導体素子がある。 The electronic device 56 to be tested, there is a semiconductor device in addition to the CSP or BGA.
半導体検査装置４０による電子装置５６の検査は、導電体層５２が形成された第１の柱状部４６の上面部に、電子装置５６の端子部５７を当接し、スルーホール電極５５を介して計測部５８と電子装置５６との間を電気的に接続することで行われる。 Inspection of the electronic device 56 by the semiconductor inspection device 40, the upper surface portion of the first columnar portion 46 conductive layer 52 is formed, abuts the terminal portion 57 of the electronic device 56, via the through-hole electrode 55 measurements It is performed by electrical connection between the parts 58 and the electronic device 56.
以上説明したような構成とすることにより、コンタクト４５及び保持部４１は、一のシリコン基板に一体的に形成され、かつその方法としては後述するように半導体装置の加工に適用される精密加工技術を用いて加工を行うことが可能となる。 With the described above configuration, the contact 45 and the holding portion 41 is integrally formed on one of the silicon substrate, and precision processing technique as a method applied to processing of a semiconductor device as described below it is possible to perform processing with. このため加工精度を向上させて、従来のコンタクトと比較して、コンタクト４５を狭いピッチで配置することができると共に、コンタクト４５を低コストで大量生産することができる。 Therefore to improve the machining accuracy, as compared with the conventional contact, it is possible to arrange the contact 45 at a narrow pitch, it is possible to mass produce contact 45 at a low cost. また、材料にシリコン基板を用いているため、従来技術と比較して、コンタクト４５の塑性変形を抑制することができる。 Moreover, the use of the silicon substrate to the material, can be compared with the prior art, to suppress the plastic deformation of the contact 45.
次に、図６乃至図４０を参照して、第１実施例のコンタクト４５を備えた半導体検査装置４０の製造方法について説明する。 Next, with reference to FIGS 40, a method for manufacturing the semiconductor inspection device 40 with the contact 45 of the first embodiment. 図６は、第１実施例の半導体検査装置の製造工程を示した平面図（その１）であり、図７は、図６に示した構造体のＣ−Ｃ線方向の断面図である。 Figure 6 is a plan view showing a manufacturing process of a semiconductor inspection device of the first embodiment are (1), FIG. 7 is a cross-sectional view along the line C-C of the structure shown in FIG.
始めに、図６乃至図７に示すように、保持部４１に対応したシリコン基板６０上の領域６３と、第１の柱状部４６とに対応したシリコン基板６０上の領域６１とに第１のレジスト膜６２を形成する。 First, as shown in FIGs 6-7, a region 63 on the silicon substrate 60 corresponding to the holding portion 41, first in the region 61 of the silicon substrate 60 corresponding to the first columnar portion 46 forming a resist film 62. 第１のレジスト膜６２には、例えば、主成分がフェノール系樹脂からなり、副成分としてメラミン系、エポキシ系及び感光剤等を含む液状のレジストを塗布後、加熱処理を施したものが好適である。 The first resist film 62, for example, the main component is a phenol resin, a melamine as a secondary component, after coating a liquid resist containing an epoxy and a photosensitive agent or the like, preferably those subjected to heat treatment is there.
図８は、本実施例の半導体検査装置の製造工程を示した平面図（その２）であり、図９は、図８に示した構造体のＣ−Ｃ線方向の断面図である。 Figure 8 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 2), Fig. 9 is a sectional view along the line C-C of the structure shown in FIG. 続いて、図８乃至図９に示すように、第２の柱状部４７に対応したシリコン基板６０上の領域６４と、第１のレジスト膜６２上とに、第１のレジスト膜６２とは特性の異なる第２のレジスト膜６５を形成する。 Subsequently, as shown in FIGS. 8 to 9, a region 64 on the silicon substrate 60 corresponding to the second columnar portion 47, into an upper first resist film 62, the first resist film 62 properties forming a second resist film 65 having different. 第２のレジスト膜６５には、例えば、主成分がノボラック樹脂やナフトキノンジアジド誘電体からなる液状のレジスト膜が好適である。 The second resist film 65, for example, a resist film of liquid main component consisting of a novolak resin and naphthoquinone diazide dielectric is preferred.
図１０は、本実施例の半導体検査装置の製造工程を示した平面図（その３）であり、図１１は、図１０に示した構造体のＣ−Ｃ線方向の断面図であり、図１２は、図１０に示した構造体のＤ−Ｄ線方向の断面図である。 Figure 10 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 3), FIG. 11 is a sectional view along the line C-C of the structure shown in FIG. 10, FIG. 12 is a cross-sectional view of line D-D direction of the structure shown in FIG. 10.
次に、図１０乃至図１２に示すように、第３の柱状部４８に対応したシリコン基板６０上の領域６６と、第２のレジスト膜６５上とに第２のレジスト膜６５とは特性の異なる第３のレジスト膜６７を形成する。 Next, as shown in FIGS. 10 to 12, the third region 66 of the silicon substrate 60 corresponding to the columnar portion 48, the characteristics and the second resist film 65 on the second resist film 65 above to form different third resist film 67. 第３のレジスト膜６７には、例えば、主成分がフェノール系樹脂からなり、副成分としてメラミン系、エポキシ系及び感光剤等を含む液状のレジストを塗布後、加熱処理を施したものが好適である。 The third resist film 67, for example, the main component is a phenol resin, a melamine as a secondary component, after coating a liquid resist containing an epoxy and a photosensitive agent or the like, preferably those subjected to heat treatment is there.
図１３は、本実施例の半導体検査装置の製造工程を示した平面図（その４）であり、図１４は、図１３に示した構造体のＣ−Ｃ線方向の断面図であり、図１５は、図１３に示した構造体のＥ−Ｅ線方向の断面図である。 Figure 13 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 4), FIG. 14 is a sectional view along the line C-C of the structure shown in FIG. 13, FIG. 15 is a cross-sectional view of line E-E direction of the structure shown in FIG. 13.
次に、図１３乃至図１５に示すように、第４の柱状部４９に対応したシリコン基板６０上の領域７２と、第３のレジスト膜６７上とに第３のレジスト膜６７とは特性の異なる第４のレジスト膜７１を形成する。 Next, as shown in FIGS. 13 to 15, an area 72 on the silicon substrate 60 corresponding to the fourth column part 49, the characteristics and the third resist film and the upper 67 third resist film 67 forming a resist film 71 of a different fourth. この際、第４の柱状部４９に対応した領域７２に設けられた第４のレジスト膜７１と、保持部４１に対応した領域６３とに設けられた第４のレジスト膜７１とが連続するように一体的に形成する。 In this case, so that a fourth resist film 71 provided in a region 72 corresponding to the fourth column part 49, a fourth resist film 71 provided on a region 63 corresponding to the holding portion 41 is continuous integrally formed on. これにより、第４のレジスト膜７１をマスクとしてエッチング加工した際、第４の柱状部４９は保持部４１に支持される。 Accordingly, when the etching of the fourth resist film 71 as a mask, a fourth columnar portion 49 is supported by the holding portion 41. 第４のレジスト膜７１には、例えば、主成分がノボラック樹脂やナフトキノンジアジド誘電体からなる液状のレジスト膜が好適である。 The fourth resist film 71, for example, a resist film of liquid main component consisting of a novolak resin and naphthoquinone diazide dielectric is preferred.
図１６は、本実施例の半導体検査装置の製造工程を示した平面図（その５）であり、図１７は、図１６に示した構造体のＣ−Ｃ線方向の断面図であり、図１８は、図１６に示した構造体のＥ−Ｅ線方向の断面図である。 Figure 16 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 5), FIG. 17 is a sectional view along the line C-C of the structure shown in FIG. 16, FIG. 18 is a cross-sectional view of line E-E direction of the structure shown in FIG. 16. なお、図１７乃至図１８において、Ｈ１は第１のエッチングにより形成された溝部７３の深さ（以下、深さＨ１とする）を示している。 Note that, in FIGS. 17 to 18, H1 represents the depth of the groove 73 formed by the first etching (hereinafter referred to as the depth H1).
続いて、図１６乃至図１８に示すように、第４のレジスト膜７１をマスクとして、第１のエッチングを行い、基板６０の表面６０Ａを基準として深さＨ１の溝部７３を形成する。 Subsequently, as shown in FIGS. 16 to 18, a fourth resist film 71 as a mask, a first etching to form a groove 73 of depth H1 relative to the surface 60A of the substrate 60. その後、第４のレジスト膜７１の剥離処理を行う。 Thereafter, the peeling process of the fourth resist film 71.
図１９は、本実施例の半導体検査装置の製造工程を示した平面図（その６）であり、図２０は、図１９に示した構造体のＣ−Ｃ線方向の断面図であり、図２１は、図１９に示した構造体のＥ−Ｅ線方向の断面図である。 Figure 19 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 6), 20 is a cross-sectional view along the line C-C of the structure shown in FIG. 19, FIG. 21 is a cross-sectional view of line E-E direction of the structure shown in FIG. 19. なお、図２０乃至図２１において、Ｈ２は第２のエッチングによるエッチングの深さ（以下、深さＨ２とする）を示している。 Note that, in FIGS. 20 to 21, H2 shows the depth of etching by the second etching (hereinafter referred to as the depth H2).
続いて、図１９乃至図２１に示すように、第３のレジスト膜６７をマスクとして、第２のエッチングを行い、シリコン基板６０の表面６０Ａを基準として深さ（Ｈ１＋Ｈ２）の溝部７５と、第４の柱状部４９に対応した領域７２に段差部７６を形成する。 Subsequently, as shown in FIGS. 19 to 21, a third resist film 67 as a mask, the second etching, the groove 75 of the depth of the surface 60A of the silicon substrate 60 as a reference (H1 + H2), the in the area 72 corresponding to the fourth column part 49 forming the step portion 76. この段差部７６は、シリコン基板６０の表面６０Ａを基準として深さＨ２の段差を有している。 The step portion 76 has a step of depth H2 of the surface 60A of the silicon substrate 60 as a reference. その後、第３のレジスト膜６７の剥離処理を行う。 Thereafter, the peeling process of the third resist film 67.
図２２は、本実施例の半導体検査装置の製造工程を示した平面図（その７）であり、図２３は、図２２に示した構造体のＣ−Ｃ線方向の断面図であり、図２４は、図２２に示した構造体のＥ−Ｅ線方向の断面図である。 Figure 22 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 7), FIG. 23 is a sectional view along the line C-C of the structure shown in FIG. 22, FIG. 24 is a cross-sectional view of line E-E direction of the structure shown in FIG. 22. なお、図２３乃至図２４において、Ｈ３は第３のエッチングのエッチング量（エッチングの深さ、以下、深さＨ３とする）を示している。 Note that, in FIGS. 23 through 24, H3 represents the etching of the third etch (etch depth, hereinafter referred to as depth H3).
次に、図２２乃至図２４に示すように、第２のレジスト膜６５をマスクとして、第３のエッチングを行い、シリコン基板６０の表面６０Ａを基準として深さ（Ｈ１＋Ｈ２＋Ｈ３）の溝部７７と、第４の柱状部４９に対応した領域７２に深さ（Ｈ２＋Ｈ３）の段差部７９と、第３の柱状部４８に対応した領域６６に深さＨ３の段差部８１とを形成する。 Next, as shown in FIGS. 22 to 24, the second resist film 65 as a mask, the third etching, the groove 77 of the depth of the surface 60A of the silicon substrate 60 as a reference (H1 + H2 + H3), the 4 deep in a region 72 corresponding to the columnar portion 49 of the stepped portion 79 of the (H2 + H3), forming the stepped portion 81 of the third depth H3 in the area 66 corresponding to the columnar portion 48. その後、第２のレジスト膜６５の剥離処理を行う。 Thereafter, the peeling process of the second resist film 65.
図２５は、本実施例の半導体検査装置の製造工程を示した平面図（その８）であり、図２６は、図２５に示した構造体のＣ−Ｃ線方向の断面図であり、図２７は、図２５に示した構造体のＥ−Ｅ線方向の断面図である。 Figure 25 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 8), FIG. 26 is a sectional view along the line C-C of the structure shown in FIG. 25, FIG. 27 is a cross-sectional view of line E-E direction of the structure shown in FIG. 25. なお、図２６乃至図２７において、Ｈ４は第４のエッチングによるエッチングの深さ（以下、深さＨ４とする）を示している。 Note that, in FIGS. 26 to 27, H4 indicates the depth of etching by the fourth etching (hereinafter referred to as depth H4).
次に、図２５乃至図２７に示すように、第１のレジスト膜６２をマスクとして、第４のエッチングを行い、貫通部８３と、保持部４１と、領域７２にシリコン保持部４１の上面４１Ａを基準として深さ（Ｈ２＋Ｈ３＋Ｈ４）の段差を有した第４の柱状部４９と、領域６６に深さ（Ｈ３＋Ｈ４）の段差を有した第３の柱状部４８と、領域６４に深さＨ４の段差を有した第２の柱状部４７と、第１の柱状部４６とを形成する。 Next, as shown in FIGS. 25 to 27, the first resist film 62 as a mask, the fourth etching, the through portion 83, a holding portion 41, the upper surface of the silicon holding portion 41 in the region 72 41A the first had a step depth as a reference (H2 + H3 + H4) 4 of the columnar portion 49, a third columnar portion 48 has a step depth in the region 66 (H3 + H4), the step of depth H4 in the region 64 a second columnar portion 47 having a form a first columnar portion 46. 第１の柱状部４６の上面４６Ａは、保持部４１の上面４１Ａと面一になるように構成されている。 Upper surface 46A of the first columnar portion 46 is configured such that the top surface 41A is flush with the holder 41.
なお、深さＨ１〜Ｈ４は、Ｈ１＝Ｈ２＝Ｈ３＝Ｈ４となるように構成しても良いし、深さＨ１〜Ｈ４をそれぞれ異なるように構成しても良い。 The depth H1~H4 is, H1 = H2 = H3 = H4 and may be configured such that may constitute the depth H1~H4 differently respectively. また、Ｈ１＝Ｈ２＝Ｈ３＝Ｈ４の場合には、Ｈ１を例えば５０μｍに設定することができる。 In the case of H1 = H2 = H3 = H4, may be set H1 for example, 50 [mu] m. また、第１乃至第４の柱状部４６〜４９の幅は、例えばｍ１５〜５０μｍ程度の大きさに形成することができる。 The width of the first to fourth column part 46 to 49 may be formed, for example, about m15~50μm in size.
図２８は、本実施例の半導体検査装置の製造工程を示した平面図（その９）であり、図２９は、図２８に示した構造体のＡ−Ａ線方向の断面図であり、図３０は、本実施例の半導体検査装置の製造工程を示した断面図である。 Figure 28 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 9), FIG. 29 is a sectional view along the line A-A of the structure shown in FIG. 28, FIG. 30 is a sectional view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment.
次に、図２８乃至図２９に示すように、第１のレジスト膜６２の剥離処理を行い、続いて、第４の柱状部４９にスルーホール電極５５を形成するための、貫通孔形成用の開口部９２を有したレジスト膜９１を形成する。 Next, as shown in FIGS. 28 to 29, it performs a peeling process of the first resist film 62, followed by for forming a through-hole electrode 55 to fourth column part 49, the through hole formed forming a resist film 91 having an opening 92. その後、図３０に示すように、レジスト膜９１をマスクとしてエッチングを行い、貫通孔９４を形成する。 Thereafter, as shown in FIG. 30, by etching using the resist film 91 as a mask to form a through-hole 94.
図３１は、本実施例の半導体検査装置の製造工程を示した平面図（その１０）であり、図３２は、図３１に示した領域Ｇに形成された第１乃至第４の柱状部の斜視図であり、図３３は、図３１に示した構造体のＡ−Ａ線方向の断面図である。 Figure 31 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 10), FIG. 32, the first to fourth columnar portion formed in a region G shown in FIG. 31 is a perspective view, FIG. 33 is a sectional view along the line a-a of the structure shown in FIG. 31. 続いて、図３１乃至図３３に示すように、レジスト膜９１の剥離処理を行う。 Subsequently, as shown in FIGS. 31 to 33, performs the stripping treatment of the resist film 91.
図３４は、本実施例の半導体検査装置の製造工程を示した平面図（その１１）であり、図３５は、図３４に示した構造体のＡ―Ａ線方向の断面図である。 Figure 34 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (part 11), FIG. 35 is a sectional view along the line A-A of the structure shown in FIG. 34. 次に、図３４乃至図３５に示すように、図３３に示した構造体上及び貫通孔９４の内部に、めっき膜を形成する際に必要なシード層９５を形成する。 Next, as shown in FIGS. 34 to 35, the interior of the structure and on the through-hole 94 shown in FIG. 33, a seed layer 95 required to form a plating film. シード層９５は、例えば、スパッタ法や、ＣＶＤ法により形成することができる。 The seed layer 95 is, for example, can be formed by a sputtering method or, CVD method. シード層９５には、Ｔｉ膜、Ｗ膜、Ｃｒ膜等を用いることができる。 The seed layer 95, it is possible to use a Ti film, W film, Cr film or the like.
図３６は、本実施例の半導体検査装置の製造工程を示した断面図である。 Figure 36 is a sectional view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment. 続いて、図３６に示すように、コンタクト４５及び保持部４１の背面６０Ｂにシード層９６を貼り付ける。 Subsequently, as shown in FIG. 36, paste seed layer 96 on the back surface 60B of the contact 45 and the holding portion 41. シード層９６には、例えば、基材がＣｕの導電性テープを用いることができる。 The seed layer 96, for example, can be the substrate is a conductive tape Cu.
図３７は、本実施例の半導体検査装置の製造工程を示した平面図（その１２）であり、図３８は、図３７に示した構造体のＡ―Ａ線方向の断面図である。 Figure 37 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 12), FIG. 38 is a sectional view along the line A-A of the structure shown in FIG. 37. 図３７乃至図３８に示すように、コンタクト４５及び保持部４１の背面６０Ｂに設けたシード層９６から給電を行い、めっき処理を施すことにより、第１乃至第４の柱状部４９の上面及び側面にめっき膜９８を形成する。 As shown in FIGS. 37 to 38, carried out feeding from the seed layer 96 provided on the rear surface 60B of the contact 45 and the holding portion 41, by performing the plating process, the upper and side surfaces of the first to fourth column part 49 to form a plating film 98 in. これにより、貫通孔９４の内部には、シード層９５とめっき膜９８とよりなるスルーホール電極５５が形成され、コンタクト４５及び保持部４１にはシード層９５とめっき膜９８とよりなる導電体層５２が形成される。 Thus, inside the through-hole 94, are formed through-hole electrode 55 further comprising a seed layer 95 and the plating film 98, become more conductive layer and the plating film 98 and the seed layer 95 in the contact 45 and the holding portion 41 52 is formed. めっき膜には、例えば、Ｎｉ合金、Ｃｕ、金等の膜を用いることができる。 The plating film, for example, may be used Ni alloy, Cu, films such as gold.
図３９は、本実施例の半導体検査装置の製造工程を示した平面図（その１３）であり、図４０は、図３９に示した半導体検査装置のＡ―Ａ線方向の断面図である。 Figure 39 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 13), FIG. 40 is a sectional view along the line A-A of the semiconductor inspection apparatus shown in FIG 39. 次に、図３９乃至図４０に示すように、コンタクト４５の表面及びスルーホール電極５５以外のシード層９５，９６及びめっき膜９８（導電体層５２）の剥離処理を行うことで、半導体検査装置４０が形成される。 Next, as shown in FIGS. 39 to 40, by performing a release treatment of the seed layer 95, 96 and the plating film 98 other than the surface and the through-hole electrode 55 of the contact 45 (conductive layer 52), the semiconductor inspection device 40 is formed.
以上、説明したような工程により、半導体検査装置４０のコンタクト４５を製造することにより、半導体装置等の加工に適用されるフォトエッチング技術を用いて加工精度を向上させて、従来のコンタクトと比較して、コンタクトを狭いピッチで配置することができると共に、塑性変形の小さいコンタクト４５を低コストで大量生産することができる。 Above, by the process as described, by making contact 45 of the semiconductor inspection device 40, to improve the processing accuracy by using a photo-etching technique applied to processing such as semiconductor device, compared with the conventional contact Te, it is possible to arrange the contact at a narrow pitch, can be mass-produced at low cost a small contact 45 of plastic deformation. なお、導電体層５２には、導電性金属の替わりに、ポリピロールやポリアセチレン等の導電性高分子の膜を用いることができ、これら導電性高分子によりスルーホール電極５５を形成することができる。 Note that the conductive layer 52, instead of the conductive metal may be used a film of conductive polymer such as polypyrrole or polyacetylene, it is possible to form the through-hole electrode 55 by these conductive polymers. また、ポリピロールを適用する場合には、ポリピロールの溶液を塗布することで、ポリピロールの皮膜を形成することができる。 Further, in the case of applying a polypyrrole, by applying a solution of polypyrrole, it is possible to form a coating of polypyrrole.
次に、図４１乃至図４３を参照して、本発明の第２実施例によるコンタクトを備えた半導体検査装置の製造方法について説明する。 Next, with reference to FIGS. 41 through 43, a method for manufacturing the semiconductor inspection device including a contact according to a second embodiment of the present invention. 図４１は、第４のエッチング後の第２実施例の半導体検査装置を示した平面図であり、図４２は、図４１に示した構造体のＣ−Ｃ線方向の断面図であり、図４３は、図４１に示した構造体のＥ−Ｅ線方向の断面図である。 Figure 41 is a plan view showing a semiconductor inspection apparatus in the second embodiment after fourth etching, FIG. 42 is a sectional view along the line C-C of the structure shown in FIG. 41, FIG. 43 is a cross-sectional view of line E-E direction of the structure shown in FIG. 41. なお、本実施例の半導体検査装置の製造方法は、第１実施例の半導体検査装置４０の製造方法の変形例である。 The manufacturing method of the semiconductor inspection apparatus of this embodiment is a modification of the method of manufacturing the semiconductor inspection device 40 of the first embodiment. したがって、図４１乃至図４３において、図２５乃至図２７と同一構成部分には同一の符号を付す。 Therefore, in FIG. 41 to FIG. 43, the same reference numerals are assigned to the same components as in FIG. 25 to FIG. 27.
本実施例では、第４のエッチングを行うことで、第１乃至第４の柱状部４６〜４９が形成されると共に、厚さＨ５を有した板体８７と、保持部４１とが形成される。 In this embodiment, by performing the fourth etching, the first to fourth columnar portion 46-49 is formed, a plate member 87 having a thickness H5, a holding portion 41 is formed . また、第１乃至第４の柱状部４６〜４９と保持部４１との間には、溝部８５が形成される。 Between the holder 41 and the first to fourth column part 46-49, the groove 85 is formed. 第４のエッチング後には、研磨又はエッチングにより板体８７は除去される。 After the fourth etching, the plate member 87 by polishing or etching is removed. 板体８７が除去された後は、先に説明した図２８乃至図４０と同様な工程により、導電金属５２とスルーホール電極５５とを形成して、半導体検査装置４０を製造する。 After the plate member 87 has been removed, the same as in FIG. 28 to FIG. 40 described earlier step, to form the conductive metal 52 and the through-hole electrodes 55, to produce the semiconductor inspection device 40.
このように第４のエッチング後に、第１乃至第４の柱状部４６〜４９の底面と保持部４１底面とを支持する板体８７が残るよう加工を行うことで、フォトリソ装置やエッチング装置等の加工装置間を搬送する際、製造途中の半導体検査装置４０の強度を維持することができる。 Thus after fourth etching, by performing processing so that the plate member 87 for supporting the holding portion 41 bottom surface and the bottom surface of the first to fourth column part 46-49 remain, photolithography apparatus or an etching apparatus or the like when transporting between processing equipment, it is possible to maintain the strength of the semiconductor inspection device 40 in the process of production.
始めに、図４４乃至図４６を参照して、本発明の第３実施例によるコンタクトを備えた半導体検査装置について説明する。 First, with reference to FIG. 44 through FIG. 46, a description will be given of a semiconductor inspection device including a contact according to a third embodiment of the present invention. 図４４は、本発明の第３実施例のコンタクトを備えた半導体検査装置の平面図であり、図４５は、図４４に示したコンタクトの斜視図であり、図４６は、図４４に示した半導体検査装置のＡ―Ａ線方向の断面図である。 Figure 44 is a plan view of a semiconductor inspection device including a contact of a third embodiment of the present invention, FIG 45 is a perspective view of a contact shown in Figure 44, Figure 46, shown in FIG. 44 it is a cross-sectional view along the line a-a of the semiconductor inspection device. なお、図４５において、Ｚ，Ｚ方向は、鉛直方向を示している。 Incidentally, in FIG. 45, Z, Z-direction indicates the vertical direction.
半導体検査装置１００は、大略すると保持部１０１と、コンタクト１０５と、計測部５８（図４６参照）とにより構成されており、コンタクト１０５及び保持部１０１は、一のシリコン基板に一体的に形成されている。 The semiconductor inspection device 100 includes a holding portion 101 that generally, the contact 105 is constituted by a measuring unit 58 (see FIG. 46), the contact 105 and the holding portion 101 is integrally formed on one of the silicon substrate ing. 保持部１０１は、枠体形状をしており、コンタクト１０５を囲繞するよう構成されている。 Holding portion 101 has a frame shape and is configured to surround the contact 105. 保持部１０１は、コンタクト１０５を構成する第１の柱状部１０６と一体的に形成されている。 Holding portion 101 is integrally formed with the first columnar portion 106 which constitutes the contact 105. また、コンタクト１０５と保持部１０１との間には、貫通部１０２が形成されている。 Between the holder 101 and the contact 105, through region 102 is formed. これによりコンタクト１０５は、保持部１０１に対して可撓性を有した状態で支持されている。 Thereby the contact 105 is supported in a state having a flexible with respect to the holding portion 101.
このような構成とすることにより、コンタクト１０５は保持部１０１に対してバネ性を有することができる。 With such a configuration, the contact 105 may have a spring characteristic with respect to the holding portion 101. これにより、電子装置５６の端子部５７が当接された際のコンタクト１０５の塑性変形を小さくすることができ、コンタクト１０５の寿命を長くすることができる。 Thus, it is possible to reduce the plastic deformation of the contact 105 when the terminal portions 57 of the electronic device 56 is in contact, it is possible to increase the life of the contact 105.
コンタクト１０５は、複数の柱状部である第１乃至第４の柱状部１０６〜１０９と、導電金属１１４と、スルーホール電極１１１とにより構成されている。 Contact 105 includes a first to fourth column part 106 to 109 is a plurality of columnar portions, and the conductive metal 114 is constituted by a through-hole electrode 111. 第１乃至第４の柱状部１０６〜１０９は、連続的に配置された高さの異なる複数の柱状部である。 The first to fourth column part 106 to 109 are a plurality of columnar portions having different heights are continuously arranged. 第１の柱状部１０６の高さが最も高く、第２の柱状部１０７、第３の柱状部１０８、第４の柱状部１０９の順で高さが低くなるよう構成されている。 First it is the highest height of the columnar portion 106, the second columnar section 107, the third columnar section 108, the order in the height of the fourth column part 109 is configured to be lower. また、第１乃至第４の柱状部１０６〜１０９は、平面視した状態（図４４の状態）において、スパイラル状に配置され、第１乃至第４の柱状部１０６〜１０９のそれぞれの底面部１０６Ａ〜１０９Ａは面一となるように構成されている。 Further, first to fourth column part 106 to 109, in the plan view state (state of FIG. 44), they are arranged in a spiral shape, the first to each of the bottom portion 106A of the fourth column part 106-109 ~109A is configured to be flush.
第１乃至第４の柱状部４６〜４９の底面部１０６Ａ〜１０９Ａには、電子装置５６の端子部５７と電気的に接続するための導電金属１１４がそれぞれ形成されている。 The first through the bottom portion of the fourth columnar portion 46 to 49 106A to, conductive metal 114 to the terminal portion 57 electrically connected to the electronic device 56 are respectively formed. このように第１乃至第４の柱状部４６〜４９の底面部１０６Ａ〜１０９Ａを面一とすることにより、電子装置５６の端子部５７が接続可能な領域を広くすることができ、コンタクト１０５と電子装置５６との間を精度良く電気的に接続することができる。 By thus first through the bottom portion 106A~109A of the fourth columnar portion 46-49 and flush, it is possible to the terminal portion 57 of the electronic device 56 to increase the connectable area, the contact 105 it is possible to accurately electrically connect the electronic device 56.
第１の柱状部１０６には、第１の柱状部１０６をＺ，Ｚ方向に貫通する貫通孔内にスルーホール電極１１１が形成されている。 The first columnar section 106, the through-hole electrode 111 is formed in the through hole penetrating the first column part 106 Z, in the Z direction. このスルーホール電極１１１は、第１の柱状部１０６の表面部１０６Ｂと導電金属１１４との間を電気的に接続するためのものであり、導電金属１１４を形成する際に同時に形成される。 The through-hole electrode 111 is provided for electrically connecting between the surface portion 106B and the conductive metal 114 of the first columnar section 106 is formed simultaneously with the formation of the conductive metal 114. 計測部５８は、スルーホール電極１１１と電気的に接続されている。 Measuring unit 58 is electrically coupled to the through-hole electrode 111. 計測部５８は、電子装置５６からの入出力の信号に基づき、電子装置５６の検査を行うためのものである。 Measurement unit 58, based on the input and output of signals from the electronic device 56 is for inspecting the electronic device 56.
電子装置５６の検査は、導電金属１１１が形成された第４の柱状部１０９の面に電子装置５６の端子部５７を当接させ、スルーホール電極１１１を介して半導体検査装置１００に設けられた計測部５８と電子装置５６との間を電気的に接続することで行われる。 Inspection of the electronic device 56, the surface of the fourth column part 109 in which the conductive metal 111 is formed is brought into contact with the terminal portion 57 of the electronic device 56, provided in the semiconductor inspection device 100 through the through-hole electrode 111 It is performed by electrically connecting the measuring part 58 and the electronic device 56.
上記構成とすることにより、狭いピッチでコンタクト１０５を配置することができ、かつ低コストで大量生産することができる。 By the above-described configuration, it is possible to arrange the contact 105 at a narrow pitch, and can be mass-produced at low cost.
次に、図４７乃至図７３を参照して、第３実施例のコンタクト１０５を備えた半導体検査装置１００の製造方法について説明する。 Next, with reference to FIGS. 47 to 73, a description will be given of a third manufacturing method of the semiconductor inspection device 100 including the contact 105 of the embodiment. 図４７は、第２実施例の半導体検査装置の製造工程を示した平面図（その１）であり、図４８は、図４７に示した構造体のＩ−Ｉ線方向の断面図である。 Figure 47 is a plan view showing a manufacturing process of the semiconductor inspection apparatus in the second embodiment is (1), FIG. 48 is a cross-sectional view of line I-I direction of the structure shown in FIG. 47.
始めに、図４７乃至図４８に示すように、保持部１０１に対応したシリコン基板１２０上の領域１２１と、第１の柱状部１０６とに対応したシリコン基板１２０上の領域１２２とに第１のレジスト膜１２３を形成する。 First, as shown in FIGS. 47 to 48, an area 121 on the silicon substrate 120 corresponding to the holding portion 101, the first to the region 122 of the silicon substrate 120 corresponding to the first columnar section 106 forming a resist film 123. この際、第１の柱状部１０６に対応した領域１２２に設けるレジスト膜１２３には、開口部１２４を形成する。 At this time, the resist film 123 provided on the region 122 corresponding to the first columnar section 106, to form an opening 124. この開口部１２４は、後に第１の柱状部１０６に貫通孔を設けるためのものである。 The opening 124 is for providing the through hole in the first columnar section 106 later. なお、第１のレジスト膜１２３には、例えば、主成分がフェノール系樹脂からなり、副成分としてメラミン系、エポキシ系及び感光剤等を含む液状のレジストを塗布後、加熱処理を施したものが好適である。 Note that the first resist film 123, for example, the main component is a phenol resin, a melamine as a secondary component, after coating a liquid resist containing an epoxy and a photosensitive agent or the like, those subjected to heat treatment it is preferred.
図４９は、本実施例の半導体検査装置の製造工程を示した平面図（その２）であり、図５０は、図４９に示した構造体のＩ−Ｉ線方向の断面図であり、図５１は、図４９に示した構造体のＪ−Ｊ線方向の断面図である。 Figure 49 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 2), FIG. 50 is a cross-sectional view of line I-I direction of the structure shown in FIG. 49, FIG. 51 is a cross-sectional view of the line J-J direction of the structure shown in FIG 49.
続いて、図４９乃至図５１に示すように、第２の柱状部１０７に対応したシリコン基板１２０上の領域１２６と、第１のレジスト膜１２３上とに、第１のレジスト膜１２３とは特性の異なる、開口部１２８を設けた第２のレジスト膜１２７を形成する。 Subsequently, as shown in FIG. 49 through FIG. 51, a second region 126 on the silicon substrate 120 corresponding to the columnar portion 107, into an upper first resist film 123, the first resist film 123 properties different, to form a second resist film 127 having an opening portion 128. 第２のレジスト膜１２７には、例えば、主成分がノボラック樹脂やナフトキノンジアジド誘電体からなる液状のレジスト膜が好適である。 The second resist film 127, for example, a resist film of liquid main component consisting of a novolak resin and naphthoquinone diazide dielectric is preferred.
図５２は、本実施例の半導体検査装置の製造工程を示した平面図（その３）であり、図５３は、図５２に示した構造体のＩ−Ｉ線方向の断面図であり、図５４は、図５２に示した構造体のＪ−Ｊ線方向の断面図である。 Figure 52 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 3), FIG. 53 is a cross-sectional view of line I-I direction of the structure shown in FIG. 52, FIG. 54 is a cross-sectional view of the line J-J direction the structure shown in FIG. 52.
次に、図５２乃至図５４に示すように、第３の柱状部１０８に対応したシリコン基板１２０上の領域１３１と、第２のレジスト膜１２７上とに第２のレジスト膜１２７とは特性の異なる第３のレジスト膜１３２を形成する。 Next, as shown in FIG. 52 to FIG. 54, a third columnar section 108 region 131 on the silicon substrate 120 corresponding to, the characteristics and the second resist film 127 on the upper second resist film 127 to form different third resist film 132. この第３のレジスト膜１３２には、開口部１２８を露出する開口部１３３が形成されている。 This third resist film 132, openings 133 for exposing the opening portion 128 is formed. 第３のレジスト膜１３２には、例えば、主成分がフェノール系樹脂からなり、副成分としてメラミン系、エポキシ系及び感光剤等を含む液状のレジストを塗布後、加熱処理を施したものが好適である。 The third resist film 132, for example, the main component is a phenol resin, a melamine as a secondary component, after coating a liquid resist containing an epoxy and a photosensitive agent or the like, preferably those subjected to heat treatment is there.
図５５は、本実施例の半導体検査装置の製造工程を示した平面図（その４）であり、図５６は、図５５に示した構造体のＩ−Ｉ線方向の断面図であり、図５７は、図５５に示した構造体のＪ−Ｊ線方向の断面図である。 Figure 55 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 4), FIG. 56 is a cross-sectional view of line I-I direction of the structure shown in FIG. 55, FIG. 57 is a cross-sectional view of the line J-J direction of the structure shown in FIG 55.
次に、図５５乃至図５７に示すように、第４の柱状部１０９に対応したシリコン基板１２０上の領域１３６と、第３のレジスト膜１３２上とに第３のレジスト膜１３２とは特性の異なる第４のレジスト膜１３７を形成する。 Next, as shown in FIG. 55 through FIG. 57, an area 136 on the silicon substrate 120 corresponding to the fourth column part 109, the third resist film 132 and the characteristics on the upper third of the resist film 132 to form different fourth resist film 137. 第４のレジスト膜１３７には、開口部１３３を露出する開口部１３８が形成されている。 The fourth resist film 137, openings 138 for exposing the opening portion 133 is formed. 第４のレジスト膜１３７には、例えば、主成分がノボラック樹脂やナフトキノンジアジド誘電体からなる液状のレジスト膜が好適である。 The fourth resist film 137, for example, a resist film of liquid main component consisting of a novolak resin and naphthoquinone diazide dielectric is preferred.
図５８は、本実施例の半導体検査装置の製造工程を示した平面図（その５）であり、図５９は、図５８に示した構造体のＩ−Ｉ線方向の断面図であり、図６０は、図５８に示した構造体のＪ−Ｊ線方向の断面図である。 Figure 58 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 5), FIG. 59 is a cross-sectional view of line I-I direction of the structure shown in FIG. 58, FIG. 60 is a cross-sectional view of the line J-J direction of the structure shown in FIG 58. なお、図５８乃至図６０において、Ｌ１は第１のエッチングにより形成された溝部１４１の深さ（エッチングの深さ、以下、深さＬ１とする）を示している。 Note that in FIG. 58 through FIG. 60, L1 represents the depth of the first groove 141 formed by etching (etching depth, hereinafter referred to as depth L1).
続いて、図５８乃至図６０に示すように、第４のレジスト膜１３７をマスクとして、第１のエッチングを行い、シリコン基板１２０の表面を基準として深さＬ１の溝部１４１を形成する。 Subsequently, as shown in FIG. 58 through FIG. 60, a fourth resist film 137 as a mask, a first etching to form the groove 141 of the depth L1 of the surface of the silicon substrate 120 as a reference. その後、第４のレジスト膜１３７の剥離処理を行う。 Thereafter, the peeling process of the fourth resist film 137.
図６１は、本実施例の半導体検査装置の製造工程を示した平面図（その６）であり、図６２は、図６１に示した構造体のＩ−Ｉ線方向の断面図であり、図６３は、図６１に示した構造体のＪ−Ｊ線方向の断面図である。 Figure 61 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 6), FIG 62 is a cross-sectional view of line I-I direction of the structure shown in FIG. 61, FIG. 63 is a cross-sectional view of the line J-J direction of the structure shown in FIG 61. なお、図６１乃至図６３において、Ｌ２は第２のエッチングのエッチング量（エッチングの深さ、以下、深さＬ２とする）を示している。 Note that in FIG. 61 through FIG. 63, L2 indicates the amount of etching of the second etching (etch depth, hereinafter referred to as depth L2).
続いて、図６４乃至図６６に示すように、第３のレジスト膜１３２をマスクとして、第２のエッチングを行い、シリコン基板１２０の表面を基準として深さ（Ｌ１＋Ｌ２）の溝部１４６と、第４の柱状部１０９に対応した領域１３６に深さＬ２の段差部１４２とを形成する。 Subsequently, as shown in FIG. 64 to FIG. 66, a third resist film 132 as a mask, the second etching, the groove 146 of the depth of the surface of the silicon substrate 120 as a reference (L1 + L2), a fourth forming a stepped portion 142 of the depth L2 in the area 136 corresponding to the columnar portion 109 of the. その後、第３のレジスト膜１３２の剥離処理を行う。 Thereafter, the peeling process of the third resist film 132.
図６４は、本実施例の半導体検査装置の製造工程を示した平面図（その７）であり、図６５は、図６４に示した構造体のＩ−Ｉ線方向の断面図であり、図６６は、図６４に示した構造体のＪ−Ｊ線方向の断面図である。 Figure 64 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 7), FIG. 65 is a cross-sectional view of line I-I direction of the structure shown in FIG. 64, FIG. 66 is a cross-sectional view of the line J-J direction of the structure shown in FIG 64. なお、図６４乃至図６６において、Ｌ３は第３のエッチングのエッチング量（エッチングの深さ、以下、深さＬ３とする）を示している。 Note that in FIG. 64 through FIG. 66, L3 represents the etching of the third etch (etch depth, hereinafter referred to as the depth L3).
次に、図６７乃至図６９に示すように、第２のレジスト膜１２７をマスクとして、第３のエッチングを行い、シリコン基板１２０の表面を基準として深さ（Ｌ１＋Ｌ２＋Ｌ３）の溝部１５２と、第４の柱状部１０９に対応した領域１３６に深さ（Ｌ２＋Ｌ３）の段差部１４８と、第３の柱状部１０８に対応した領域１３１に深さＨ３の段差部１４９とを形成する。 Next, as shown in FIGS. 67 to 69, as a mask the second resist film 127, the third etching is performed, the depth of the surface of the silicon substrate 120 as a reference (L1 + L2 + L3) of the groove 152, fourth of the depth region 136 corresponding to the columnar portion 109 and the stepped portion 148 of the (L2 + L3), to form the stepped portion 149 of the third depth H3 in the area 131 corresponding to the columnar portion 108. その後、第２のレジスト膜１２７の剥離処理を行う。 Thereafter, the peeling process of the second resist film 127.
図６７は、本実施例の半導体検査装置の製造工程を示した平面図（その８）であり、図６８は、図６７に示した構造体のＩ−Ｉ線方向の断面図であり、図６９は、図６７に示した構造体のＪ−Ｊ線方向の断面図である。 Figure 67 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 8), FIG. 68 is a cross-sectional view of line I-I direction of the structure shown in FIG. 67, FIG. 69 is a cross-sectional view of the line J-J direction of the structure shown in FIG 67. なお、図６７乃至図６９において、Ｌ４は第４のエッチングのエッチング量（エッチングの深さ、以下、深さＬ４とする）を示している。 Note that, in FIGS. 67 to 69, L4 denotes the etching amount of a fourth etching (etch depth, hereinafter referred to as depth L4).
次に、図６７乃至図６９に示すように、第１のレジスト膜１２３をマスクとして、第４のエッチングを行い、貫通部１０２と、保持部１０１と、領域１３６に保持部１０１の上面に対して深さ（Ｌ２＋Ｌ３＋Ｌ４）の段差を有した第４の柱状部１０９と、領域１３１に保持部１０１の上面に対して深さ（Ｌ３＋Ｌ４）の段差を有した第３の柱状部１０８と、領域１２６に保持部１０１の上面に対して深さＬ４の段差を有した第２の柱状部１０７と、領域１２２に保持部１０１の上面と面一となる上面を有した第１の柱状部１０６とが形成される。 Next, as shown in FIGS. 67 to 69, the first resist film 123 as a mask, the fourth etching, the through portion 102, and the holding portion 101, with respect to the upper surface of the holding portion 101 in a region 136 having a step depth (L2 + L3 + L4) Te fourth columnar portion 109, and the third columnar section 108 has a step depth with respect to the upper surface of the holding portion 101 in a region 131 (L3 + L4), region 126 in the second columnar portion 107 having a stepped depth L4 with respect to the upper surface of the holding portion 101, and a first columnar section 106 has an upper surface composed flush with the upper surface of the holding portion 101 in a region 122 It is formed. また、第１の柱状部１０６には、スルーホール電極１１１を形成するための貫通孔１２５が形成される。 Further, the first columnar section 106, a through hole 125 for forming the through-hole electrode 111 are formed.
このように構成することで、第１の柱状部１０６と第２の柱状部１０７との間には深さＬ４の段差、第２の柱状部１０７と第３の柱状部１０８との間には深さＬ３の段差、第３の柱状部１０８と第４の柱状部１０９との間には深さＬ２の段差が形成される。 With this configuration, the first columnar section 106 stepped depth L4 is formed between the second columnar section 107, and the second columnar section 107 is between the third columnar section 108 step depth L3, the step depth L2 is formed between the third columnar section 108 and the fourth column part 109. なお、深さＬ１〜Ｌ４は、Ｌ１＝Ｌ２＝Ｌ３＝Ｌ４となるように構成しても良いし、Ｌ１〜Ｌ４の値をそれぞれ異なるよう構成しても良い。 The depth L1 to L4 may be configured such that L1 = L2 = L3 = L4, may be configured different so the value of L1 to L4. Ｌ１＝Ｌ２＝Ｌ３＝Ｌ４の場合には、例えば、Ｌ１を５０μｍに設定することができる。 In the case of L1 = L2 = L3 = L4, for example, it can be set L1 to 50 [mu] m. また、第１乃至第４の柱状部１０６〜１０９の幅は、例えば、１５〜５０μｍ程度の大きさに形成することができる。 The width of the first to fourth column part 106 to 109, for example, can be formed to a size of about 15 to 50 m.
図７０は、本実施例の半導体検査装置の製造工程を示した平面図（その９）であり、図７１は、図７０に示した構造体のＩ−Ｉ線方向の断面図であり、図７２は、図７０に示した構造体のＪ−Ｊ線方向の断面図である。 Figure 70 is a plan view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment (Part 9), FIG. 71 is a cross-sectional view of line I-I direction of the structure shown in FIG. 70, FIG. 72 is a cross-sectional view of the line J-J direction of the structure shown in FIG 70. なお、図７０は、コンタクト１０５の底面部側から視た平面図である。 Incidentally, FIG. 70 is a plan view seen from the bottom side of the contact 105. また、図７１乃至図７３は、同図の上側にコンタクト１０５の底面部が位置するよう図示している。 Further, FIG. 71 through FIG. 73, the bottom surface portion of the contact 105 on the upper side of the figure is shown to be located.
その後、第１のレジスト膜１２３は除去され、図７０乃至図７２に示すように、第１乃至第４の柱状部１０６〜１０９の底面部１０６Ａ〜１０９Ａには、シード層１２６とめっき膜１２７とよりなる導電金属１１４が形成されると共に、貫通孔１２５には、シード層１２６とめっき膜１２７とよりなるスルーホール電極１１１が形成される。 Thereafter, the first resist film 123 is removed, as shown in FIG. 70 to FIG. 72, the first through the bottom portion of the fourth columnar portion 106 to 109 106A to, a seed layer 126 and the plated film 127 together become more conductive metal 114 is formed, the through hole 125, the through-hole electrode 111 more as a seed layer 126 and the plating film 127 is formed. シード層１２６には、例えば、Ｔｉ膜、Ｗ膜、Ｃｒ膜等を用いることができる。 The seed layer 126, for example, may be a Ti film, W film, Cr film or the like. また、めっき膜には、例えば、Ｎｉ合金、Ｃｕ、金等の膜を用いることができる。 Further, the plated film, for example, may be used Ni alloy, Cu, films such as gold. なお、導電金属１１４及びスルーホール電極１１１を形成する工程は、先に説明した第１実施例と同様な手法により行うことができるので説明を省略する。 The step of forming the conductive metal 114 and the through-hole electrode 111 is omitted since it is possible to perform the same procedure as the first embodiment described above.
このような工程により半導体検査装置１００のコンタクト１０５を製造することにより、半導体装置等の加工に適用されるフォトエッチング技術を用いて加工精度を向上させて、従来のコンタクトと比較して、コンタクト１０５を狭いピッチで配置することができると共に、塑性変形の小さいコンタクト１０５を低コストで大量生産することができる。 By making contact 105 of the semiconductor inspection device 100 by such process, to improve the processing accuracy by using a photo-etching technique applied to machining such as a semiconductor device, as compared with the conventional contact, the contact 105 it is possible to place a narrow pitch, can be mass-produced at low cost a small contact 105 of plastic deformation. なお、本実施例において、第４の柱状部１０９を保持部１０１に対して、一体的に形成しても良い。 In the present embodiment, the fourth column part 109 relative to the holding portion 101 may be integrally formed.
以上、本発明の好ましい実施例について詳述したが、本発明はかかる特定の実施形態に限定されるものではなく、特許請求の範囲内に記載された本発明の要旨の範囲内において、種々の変形・変更が可能である。 Have been described in detail preferred embodiments of the present invention, the present invention is not limited to such specific embodiments, within the scope of the present invention described in the claims, various variations and modifications are possible. なお、スルーホール電極を設ける位置は、複数の柱状部のうちのいずれか１つに設ければ良く、第１乃至第３実施例の位置に限定されない。 The position of providing the through-hole electrodes may be provided on any one of the plurality of columnar portions is not limited to the position of the first to third embodiments.
本発明は、加工精度を向上させて狭いピッチで配置することができ、かつ塑性変形の小さくして、低コストで大量生産することのできるコンタクトを備えた半導体検査装置及びコンタクトの製造方法に適用できる。 The present invention, machining accuracy improves can be arranged at a narrow pitch, and by reducing the plastic deformation applied to the semiconductor inspection device and a manufacturing method of the contacts having a contact which can be mass produced at low cost it can.
従来技術のコンタクトを示した図である。 Is a diagram showing the contact of the prior art. 従来技術であるワイヤ形状のコンタクトを示した図である。 Is a diagram illustrating the contact wire shape is prior art. 本発明の第１実施例の半導体検査装置の平面図である。 It is a plan view of a semiconductor inspection device of the first embodiment of the present invention. 図３に示したコンタクトの斜視図である。 It is a perspective view of the contact shown in Fig. 図３に示した半導体検査装置のＡ―Ａ線方向の断面図である。 It is a cross-sectional view along the line A-A of the semiconductor inspection apparatus shown in FIG. 第１実施例の半導体検査装置の製造工程を示した平面図（その１）である。 Plan view showing a manufacturing process of the semiconductor inspection device according to the first embodiment; FIG. 図６に示した構造体のＣ−Ｃ線方向の断面図である。 It is a cross-sectional view along the line C-C of the structure shown in FIG. 本実施例の半導体検査装置の製造工程を示した平面図（その２）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus according to the present embodiment; FIG. 図８に示した構造体のＣ−Ｃ線方向の断面図である。 It is a cross-sectional view along the line C-C of the structure shown in FIG. 本実施例の半導体検査装置の製造工程を示した平面図（その３）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 3). 図１０に示した構造体のＣ−Ｃ線方向の断面図である。 Is a cross-sectional view along the line C-C of the structure shown in FIG. 10. 図１０に示した構造体のＤ−Ｄ線方向の断面図である。 It is a cross-sectional view of line D-D direction of the structure shown in FIG. 10. 本実施例の半導体検査装置の製造工程を示した平面図（その４）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 4). 図１３に示した構造体のＣ−Ｃ線方向の断面図である。 Is a cross-sectional view along the line C-C of the structure shown in FIG. 13. 図１３に示した構造体のＥ−Ｅ線方向の断面図である。 It is a cross-sectional view of line E-E direction of the structure shown in FIG. 13. 本実施例の半導体検査装置の製造工程を示した平面図（その５）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 5). 図１６に示した構造体のＣ−Ｃ線方向の断面図である。 Is a cross-sectional view along the line C-C of the structure shown in FIG. 16. 図１６に示した構造体のＥ−Ｅ線方向の断面図である。 It is a cross-sectional view of line E-E direction of the structure shown in FIG. 16. 本実施例の半導体検査装置の製造工程を示した平面図（その６）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 6). 図１９に示した構造体のＣ−Ｃ線方向の断面図である。 Is a cross-sectional view along the line C-C of the structure shown in FIG. 19. 図１９に示した構造体のＥ−Ｅ線方向の断面図である。 It is a cross-sectional view of line E-E direction of the structure shown in FIG. 19. 本実施例の半導体検査装置の製造工程を示した平面図（その７）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 7). 図２２に示した構造体のＣ−Ｃ線方向の断面図である。 Is a cross-sectional view along the line C-C of the structure shown in FIG. 22. 図２２に示した構造体のＥ−Ｅ線方向の断面図である。 It is a cross-sectional view of line E-E direction of the structure shown in FIG. 22. 本実施例の半導体検査装置の製造工程を示した平面図（その８）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 8). 図２５に示した構造体のＣ−Ｃ線方向の断面図である。 Is a cross-sectional view along the line C-C of the structure shown in FIG. 25. 図２５に示した構造体のＥ−Ｅ線方向の断面図である。 It is a cross-sectional view of line E-E direction of the structure shown in FIG. 25. 本実施例の半導体検査装置の製造工程を示した平面図（その９）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 9). 図２８に示した構造体のＡ−Ａ線方向の断面図である。 It is a cross-sectional view along the line A-A of the structure shown in FIG. 28. 本実施例の半導体検査装置の製造工程を示した断面図である。 It is a sectional view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment. 本実施例の半導体検査装置の製造工程を示した平面図（その１０）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 10). 図３１に示した領域Ｇに形成された第１乃至第４の柱状部の斜視図である。 It is a perspective view of the first to fourth columnar portion formed in a region G shown in FIG. 31. 図３１に示した構造体のＡ−Ａ線方向の断面図である。 It is a cross-sectional view along the line A-A of the structure shown in FIG. 31. 本実施例の半導体検査装置の製造工程を示した平面図（その１１）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 11). 図３４に示した構造体のＡ―Ａ線方向の断面図である。 It is a cross-sectional view along the line A-A of the structure shown in FIG. 34. 本実施例の半導体検査装置の製造工程を示した断面図である。 It is a sectional view showing a manufacturing process of the semiconductor inspection apparatus according to the present embodiment. 本実施例の半導体検査装置の製造工程を示した平面図（その１２）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 12). 図３７に示した構造体のＡ―Ａ線方向の断面図である。 It is a cross-sectional view along the line A-A of the structure shown in FIG. 37. 本実施例の半導体検査装置の製造工程を示した平面図（その１３）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 13). 図３９に示した半導体検査装置のＡ―Ａ線方向の断面図である。 It is a cross-sectional view along the line A-A of the semiconductor inspection apparatus shown in FIG 39. 第４のエッチング後の第２実施例の半導体検査装置を示した平面図である。 Is a plan view showing a semiconductor inspection device according to the fourth second embodiment after etching. 図４１に示した構造体のＣ−Ｃ線方向の断面図である。 Is a cross-sectional view along the line C-C of the structure shown in FIG. 41. 図４１に示した構造体のＥ−Ｅ線方向の断面図である。 It is a cross-sectional view of line E-E direction of the structure shown in FIG. 41. 本発明の第３実施例のコンタクトを備えた半導体検査装置の平面図である。 It is a plan view of a semiconductor inspection device including a contact of a third embodiment of the present invention. 図４４に示したコンタクトの斜視図である。 It is a perspective view of the contact shown in Figure 44. 図４４に示した半導体検査装置のＡ―Ａ線方向の断面図である。 It is a cross-sectional view along the line A-A of the semiconductor inspection apparatus shown in FIG 44. 第２実施例の半導体検査装置の製造工程を示した平面図（その１）である。 Plan view showing a manufacturing process of the semiconductor inspection apparatus in the second embodiment; FIG. 図４７に示した構造体のＩ−Ｉ線方向の断面図である。 It is a cross-sectional view of line I-I direction of the structure shown in FIG. 47. 本実施例の半導体検査装置の製造工程を示した平面図（その２）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus according to the present embodiment; FIG. 図４９に示した構造体のＩ−Ｉ線方向の断面図である。 It is a cross-sectional view of line I-I direction of the structure shown in FIG. 49. 図４９に示した構造体のＪ−Ｊ線方向の断面図である。 It is a cross-sectional view of the line J-J direction of the structure shown in FIG 49. 本実施例の半導体検査装置の製造工程を示した平面図（その３）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 3). 図５２に示した構造体のＩ−Ｉ線方向の断面図である。 It is a cross-sectional view of line I-I direction of the structure shown in FIG. 52. 図５２に示した構造体のＪ−Ｊ線方向の断面図である。 It is a cross-sectional view of the line J-J direction of the structure shown in FIG 52. 本実施例の半導体検査装置の製造工程を示した平面図（その４）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 4). 図５５に示した構造体のＩ−Ｉ線方向の断面図である。 It is a cross-sectional view of line I-I direction of the structure shown in FIG. 55. 図５５に示した構造体のＪ−Ｊ線方向の断面図である。 It is a cross-sectional view of the line J-J direction of the structure shown in FIG 55. 本実施例の半導体検査装置の製造工程を示した平面図（その５）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 5). 図５８に示した構造体のＩ−Ｉ線方向の断面図である。 It is a cross-sectional view of line I-I direction of the structure shown in FIG. 58. 図５８に示した構造体のＪ−Ｊ線方向の断面図である。 It is a cross-sectional view of the line J-J direction of the structure shown in FIG 58. 本実施例の半導体検査装置の製造工程を示した平面図（その６）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 6). 図６１に示した構造体のＩ−Ｉ線方向の断面図である。 It is a cross-sectional view of line I-I direction of the structure shown in FIG. 61. 図６１に示した構造体のＪ−Ｊ線方向の断面図である。 It is a cross-sectional view of the line J-J direction of the structure shown in FIG 61. 本実施例の半導体検査装置の製造工程を示した平面図（その７）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 7). 図６４に示した構造体のＩ−Ｉ線方向の断面図である。 It is a cross-sectional view of line I-I direction of the structure shown in FIG. 64. 図６４に示した構造体のＪ−Ｊ線方向の断面図である。 It is a cross-sectional view of the line J-J direction of the structure shown in FIG 64. 本実施例の半導体検査装置の製造工程を示した平面図（その８）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 8). 図６７に示した構造体のＩ−Ｉ線方向の断面図である。 It is a cross-sectional view of line I-I direction of the structure shown in FIG. 67. 図６７に示した構造体のＪ−Ｊ線方向の断面図である。 It is a cross-sectional view of the line J-J direction of the structure shown in FIG 67. 本実施例の半導体検査装置の製造工程を示した平面図（その９）である。 Plan views showing the manufacturing process of the semiconductor inspection apparatus in one embodiment (No. 9). 図７０に示した構造体のＩ−Ｉ線方向の断面図である。 It is a cross-sectional view of line I-I direction of the structure shown in FIG. 70. 図７０に示した構造体のＪ−Ｊ線方向の断面図である。 It is a cross-sectional view of the line J-J direction of the structure shown in FIG 70.
１０、２０、４５、１０５、１５１ コンタクト １１ 軸部 １２ 上部プランジャ １３ 下部プランジャ １４ コイルスプリング １５ ハウジング ２１ 軟質コア ２２ 硬質シェル ４０、１００、１５０ 半導体検査装置 ４１、１０１ 保持部 ４１Ａ、４６Ａ 上面 １６１ 枠体 ４６、１０６、１５２ 第１の柱状部 ４７、１０７、１５３ 第２の柱状部 ４８、１０８、１５４ 第３の柱状部 ４９、１０９、１５５ 第４の柱状部 ５２、１１４ 導電金属 ５５、１１１、１５６ スルーホール電極 ５６ 電子装置 ５７ 端子部 ５８ 計測部 ６０、１２０ シリコン基板 ６０Ａ 表面 ６０Ｂ 背面 ６１、６３、６４、６６、７２、Ｇ、１２１、１２２、１２６、１３１、１３６ 領域 ６２、１２３ 第１のレジスト膜 ６５、１２７ 第２のレジスト膜 ６７、１３２ 10,20,45,105,151 contact 11 shaft section 12 upper plunger 13 lower plunger 14 a coil spring 15 housing 21 soft core 22 hard shell 40,100,150 semiconductor inspection device 41,101 holding portion 41A, 46A upper surface 161 frame 46,106,152 first columnar portion 47,107,153 second columnar portion 48,108,154 third columnar portion 49,109,155 fourth columnar portion 52,114 conductive metal 55,111,156 through-hole electrodes 56 electronic device 57 terminal portion 58 measuring unit 60, 120 the silicon substrate 60A surface 60B back 61,63,64,66,72, G, 121,122,126,131,136 region 62,123 first resist film 65,127 second resist film 67,132 第３のレジスト膜 ７１、１３７ 第４のレジスト膜 ７３、７５、７７、８５、１４１、１４６、１５２ 溝部 ７６、７９、１８１、４２、１４８、１４９ 段差部 ８７ 板体 ９１ レジスト膜 ９２、１２４、１２８、１３３、１３８ 開口部 ９４、１２５ 貫通孔 ９５、９６、１２６ シード層 ９８、１２７ めっき膜 ８３、１０２ 貫通部 １０６Ａ〜１０８Ａ 底面部 １０６Ｂ 表面部 Ｈ１〜Ｈ５、Ｌ１〜Ｌ４ 深さ Third resist film 71,137 fourth resist film 73,75,77,85,141,146,152 groove 76,79,181,42,148,149 stepped portion 87 plate body 91 resist film 92,124, 128,133,138 opening 94,125 through hole 95,96,126 seed layer 98,127 plating film 83,102 transmembrane portion 106A~108A bottom portion 106B surface portion H1 to H5, L1 to L4 depth
連続的に配置された高さの異なる複数の柱状部により構成され、被検査物となる電子装置の端子部が接続されるコンタクトと、 Is composed of continuously-arranged plurality of columnar portions of different heights was, and the contact terminal portions of the electronic device to be an inspection object is connected,
前記複数の柱状部の少なくとも表面に形成された導電体層と、 A conductor layer formed on at least a surface of said plurality of columnar portions,
前記コンタクトを保持する保持部と、 A holder for holding the contacts,
前記柱状部の少なくとも一つを貫通するよう形成され、前記導電体層と前記保持部の背面側から導通するスルーホール電極とを有しており、 The formed to penetrate at least one of the columnar portion has a through hole electrode to conduct from the rear side of the holding portion and the conductor layer,
前記コンタクト及び保持部が一のシリコン基板から一体的に形成されてなることを特徴とする半導体検査装置。 Semiconductor inspection device characterized in that the contact and holding portion, which are integrally formed from one silicon substrate.
前記複数の柱状部は、平面視した状態において、スパイラル状に配置されていることを特徴とする請求項１に記載の半導体検査装置。 It said plurality of columnar portions, in a plan view, the semiconductor inspection apparatus according to claim 1, characterized in that it is arranged in a spiral shape.
前記保持部は、前記複数の柱状部を囲繞する枠体により構成されており、 The holding portion is constituted by a frame body surrounding said plurality of columnar portions,
前記複数の柱状部の少なくとも一つは、前記枠体に一体的に形成され、 At least one of the plurality of columnar portions is integrally formed on the frame,
前記複数の柱状部のそれぞれの底面部は、前記枠体の底面部と面一になるように構成されていることを特徴とする請求項１または２に記載の半導体検査装置。 Wherein each of the bottom portions of the plurality of columnar portions, the semiconductor inspection apparatus according to claim 1 or 2, characterized in that it is configured such that the bottom surface flush with the frame.
連続的に配置された高さの異なる第１乃至第Ｎの柱状部により構成され、前記第１乃至第Ｎの柱状部は保持部により支持されており、被検査物となる電子装置の端子部が前記第１乃至第Ｎの柱状部のいずれかに接続されるコンタクトの製造方法であって、 Is constituted by the columnar portion of the successively arranged different heights first to N, the columnar portion of the first through N is supported by the holding portion, the terminal portion of the electronic device to be the inspection subject there a method for producing a contact connected to one of the columnar portion of the first through N,
一のシリコン基板を用いて、前記保持部及び第Ｎ−１の柱状部に対応した位置の前記シリコン基板上に第Ｎ−１のレジスト膜を形成する処理と、 Using one of a silicon substrate, a process of forming the first N-1 of the resist film on the silicon substrate at positions corresponding to the holding portion and the columnar portion of the N-1,
前記シリコン基板上における第Ｎ−１のレジスト膜上及び第Ｎの柱状部に対応した位置に前記第Ｎ−１のレジスト膜とは特性の異なる第Ｎのレジスト膜を形成する処理とを順次繰り返し行い、第１乃至第Ｎのレジスト膜を形成する第１の工程と、 Sequentially repeating the process for forming a resist film of the N-1 of the resist film and the N column part in corresponding positions to the first N-1 of the resist film and the first N having different characteristics in the silicon substrate perform a first step of forming a resist film of the first to N,
前記第Ｎのレジスト膜をマスクとして所定の深さのエッチングを行なった後、該第Ｎのレジスト膜を剥離処理する工程を順次繰り返し行い、第１乃至第Ｎの柱状部と保持部とを形成する第２の工程と、 After performing etching of a predetermined depth using the resist film of the first N as a mask, successively repeating performed step of peeling treatment the resist film of said N, form a holding portion and the columnar portion of the first through N a second step of,
前記第１乃至第Ｎの柱状部のすくなくとも表面に導電体層を形成する工程とを有したことを特徴とするコンタクトの製造方法。 Method for producing a contact, characterized in that a step of forming a conductive layer on at least the surface of the columnar portion of the first through N.
連続的に配置された高さの異なる第１乃至第４の柱状部により構成され、前記第１乃至第４の柱状部は枠体形状とされた保持部により支持されており、前記第１乃至第４の柱状部の少なくとも一つは前記保持部と一体的に形成され、被検査物となる電子装置の端子部が前記第１乃至第４の柱状部のいずれかに接続されるコンタクトの製造方法であって、 It is composed of serially arranged first to fourth column part different heights, the columnar portion of the first through fourth is supported by a holding portion which is a frame body shape, the first to at least one fourth of the columnar portion is formed to the holding portion and integrally, the production of contact terminals of the electronic device to be the inspection object is to be connected to any of the first to fourth column part there is provided a method,
一のシリコン基板を用いて、前記第１の柱状部及び枠体に対応した位置のシリコン基板上に、前記第１の柱状部に貫通孔を設けるための開口部を有した第１のレジスト膜を形成する工程と、 Using one of the silicon substrate, the first columnar portion and on the silicon substrate at positions corresponding to the frame, a first resist film having an opening for providing the through hole in the first columnar section forming a,
前記第２の柱状部に対応した位置のシリコン基板上と前記第１のレジスト膜上とに、前記第１のレジスト膜とは特性の異なる第２のレジスト膜を形成する工程と、 And forming the second to the silicon substrate at positions corresponding with the first resist film in the columnar portion, the first resist film and the second resist film having different characteristics,
前記第３の柱状部に対応した位置のシリコン基板上と前記第２のレジスト膜上とに、前記第２のレジスト膜とは特性の異なる第３のレジスト膜を形成する工程と、 And forming the third to the silicon substrate at positions corresponding with the second resist film in the columnar portion, the third resist film having different properties than the second resist film,
前記第４の柱状部に対応した位置のシリコン基板上と前記第３のレジスト膜上とに、前記第３のレジスト膜とは特性の異なる第４のレジスト膜を形成する工程と、 And forming the fourth to the silicon substrate at positions corresponding with the said third resist film on the columnar portion, the third resist film and the fourth with different characteristics of the resist film,
前記第４のレジスト膜をマスクとして、第１の深さのエッチングをする工程と、 As a mask the fourth resist film, a step of etching the first depth,
前記第４のレジスト膜の剥離し、前記第３のレジスト膜をマスクとして、第２の深さのエッチングをする工程と、 Peeling of the fourth resist film as a mask the third resist film, a step of etching the second depth,
前記第３のレジスト膜の剥離し、前記第２のレジスト膜をマスクとして、第３の深さのエッチングをする工程と、 Peeling of the third resist film as a mask the second resist film, a step of etching the third depth,
前記第２のレジスト膜の剥離し、前記第１のレジスト膜をマスクとして、第４の深さのエッチングを行い、前記第１乃至第４の柱状部と、前記保持部と、該保持部と前記第１乃至第４の柱状部に形成された貫通部と、前記貫通孔とを形成する工程と、 Peeling of the second resist film as a mask the first resist film, and the fourth etched depth, the first to fourth column part, and the holding portion, and said holding portion said first through penetration portion formed in the fourth column part, and forming with said through hole,
前記第１乃至第４の柱状部の少なくとも表面に導電体層を形成すると共に、前記貫通孔の内部に導電体を充填し、スルーホール電極を形成する工程とを有したことを特徴とするコンタクトの製造方法。 Contact, characterized in that said as to form a conductive layer to the first to at least the surface of the fourth columnar section, filled with a conductor inside the through hole, having a step of forming a through-hole electrode the method of production.
連続的に配置された高さの異なる第１乃至第４の柱状部により構成され、前記第１乃至第４の柱状部は枠体形状とされた保持部により支持されており、被検査物となる電子装置の端子部が前記第１乃至第４の柱状部のいずれかに接続されるコンタクトの製造方法であって、 It is composed of serially arranged first to fourth column part different heights, the columnar portion of the first through fourth is supported by a holding portion which is a frame shape, and the object to be inspected terminal portion of the electronic device comprising the method of manufacturing a contact connected to one of the columnar portion of the first to fourth,
前記第１の柱状部及び枠体に対応した位置のシリコン基板上に、前記第１の柱状部に貫通孔を設けるための開口部を有した第１のレジスト膜を形成する工程と、 Said first columnar portion and on the silicon substrate at positions corresponding to the frame body, a step of forming a first resist film having an opening for providing the through hole in the first columnar section,
前記第２のレジスト膜の剥離し、前記第１のレジスト膜をマスクとして、第４の深さのエッチングを行い、前期第１乃至第４の柱状部、前記保持部、及び前記貫通孔を形成する工程と、 Peeling of the second resist film as a mask the first resist film, the columnar portion of the fourth etched depth, year first to fourth, the holding portion, and forming the through hole a step of,
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