システムLSI

システムLSI () とは、一般的にマイクロコントローラを含んで組み込みシステム製品の主要な電子回路を1チップ程度に集積した半導体素子であり、SoCによる具体的な部品という性格もある。狭義にはカスタムLSIだけを指すが、広義にはカスタムLSIに汎用のCPUやDSPを加えたLSIを含める。
特に民生分野の大量生産品で、情報家電などの複雑なシステムにおいて、LSIの小型化、高性能化およびコスト削減のためにシステムLSIを開発して使用している。デジタル回路を中心に構成されており、入出力部にアナログ回路を持つものも多い。なお、以下の説明内では、電子回路技術としては純然たるアナログ領域で動作しているクロック回路やインターフェース回路も組込側での分類を優先してデジタル回路の説明として扱っており、アナログ回路は組込側でビデオ信号や音声信号のようなアナログ信号を扱う回路のみに限定している。
分類.
内部回路による分類.
システムLSIは内部に以下の回路の1つ、または複数が含まれ、それらの種類で分類できる。
つまり、以下の電子回路を含んで特定の用途に向けた専用の電子部品がシステムLSIである。
エンベデット・セルアレイやスタンダード・セルアレイでは、チップサイズが自由に選べるので、埋め込むマクロの割合を増やせればベーシック・セルによる性能の制約は緩和されるために、ライブラリ化に向く。マスクは専用なのでコスト高となる。
記憶素子には、Flash、SRAM、フューズが使われる。Flashとはフラッシュメモリのことであり、不揮発性なのでこのままで記憶内容が保持できる。SRAM は揮発性なのでこのままで記憶内容が保持できないため、外部にPROMやフラッシュメモリを外付けして起動時に毎回読み込む必要があり、2009年現在ではこの方式は少なくなっている。フューズは厳密には記憶素子ではなく電気的に配線を焼き切ったもので、原理上、再書き込みは行えない。PLDやFPGA用の記憶素子にはフラッシュメモリの採用が多くなっている。CLB方式とALM方式では、縦横に走る配線の交点やCLB、LABの配線との入出力接続は、記憶素子の"Hi"、"Low"によって接続／非接続を決定している。
PLD類はマスクから作るだけのコストに見合った販売数量が期待出来ない特殊用途向きの製品や量産前の試作で使用されることが多い。
設計分担による分類.
システムLSIは回路構成とは別に、以下に示す設計分担の違いによっても分類できる。
これらはシステムLSIの設計時の分担範囲の違いであり、システムLSIの組み込み先となる最終製品を製造するユーザーがどこまで半導体の設計に関与するか、またはほとんど関与せずに半導体製造者に任せてしまうのかという、その関与の度合いによる違いを表している。
ASSPは、半導体製造者がシステムLSIの仕様からすべてを設計する。このためカスタムLSIではなく、汎用LSIとなる。
ASCPは、ユーザーが仕様からRTL記述までを行い、半導体製造者が論理検証以降を設計する。
ASICは、ユーザーが仕様から論理検証までを行い、半導体製造者がレイアウト以降を設計する。
COTは、ユーザーが各種の設計ツールを自前で所有して、マスクパターンまでを行う。半導体製造者はユーザーが設計を行えるようにパラメータを提供し、マスクパターンに基づいて半導体を製造する。
用途.
2009年現在では用途は多岐に渡り、人とのインターフェースを必要とする多くの電子機器に使用されている。液晶画面を持つ機器では使用されていることが外部からも比較的容易に予見できるが、最適な充電制御のために充電式バッテリーの1個ずつに内蔵されたものや、RFタグのように専用装置でしかインターフェースできないものが登場しており、こういったものは外見からは存在が予想できないものもある。大量生産されれば設計コストは希薄化されて、部品点数削減、小型化、省電力、信頼性向上、多機能化、部品コスト削減などが期待できるため、民生用電気製品に広く使用されている。
開発方法.
ビルディング・ブロックとマクロ.
規模の大きな半導体素子となるため、全てを最初から設計していては開発に時間とコストが掛かりすぎるため、既に設計した回路部分を機能ごとにブロック化して使い回すことが行われる。こういったブロックをいくつか組み合わせば、求める回路設計の大部分が済むものもあり、こういったビルディング・ブロックによる設計手法での機能ごとにブロック化されたものは「マクロ」と呼ばれる。
社内の設計部門に「マクロ」を持っておけば、1度設計した機能は次の設計時にそのまま再使用することで期間短縮と費用の低減が図れ、こういった動作検証済みのマクロという設計資産をいくつも規格化して「ライブラリ」として保有しておけば、以降の設計は独自回路部分の設計とマクロ同士を結びつけるだけで回路設計が済むようになる。
再使用を前提にすればベーシックセルのような無駄だが短時間での設計が行える手法ではなく、ゲートやトランジスタのレベルから配置を最適化した設計手法が採れるために、結果として性能も向上する。高機能インターフェース回路や画像処理専用回路のような汎用的に求められる機能のマクロでは、自社製品用のマクロを他社に有償で使用権を販売したり、そういった有償での使用権販売だけを目的にマクロの開発を行う会社も存在し、このような使用権が販売されるマクロはIP（Intellectual Property、設計資産）と呼ばれる。
マクロには「ソフトマクロ」「ファームマクロ」「ハードマクロ」が存在する。
IPとして他社に使用権を販売する場合には、ファームマクロIPやハードマクロIPにすることでソフトマクロのようにRTLによる低位で論理構造まで見える情報は外部に出さないようにされる傾向がある。
多様なマクロ.
スタンダード・セルは矩形で構成され、「セル高さ」と呼ばれるセルの幅をライブラリで統一することで、ダイ上で並べ易くして占有面積の効率を高めている。セル高さは電源線と接地線という平行する2本の駆動用電源に挟まれた幅であり、それらの7分の1から12分の1程度の幅で配線トラックが平行して走る。
高機能なマクロとして以下のものが挙げられる。
集積化の過程.
従来、単体の半導体部品や抵抗などがICやLSIへと集積されたように、回路基板上に個別に載せていたコントローラやインターフェース用回路のIC、メモリICなども次第にシステムLSIに統合されるようにっている。SoCでは、（概念として）全てが1チップ化される。