Itanium
2002年7月8日に発表。0.18 μmプロセスで製造される第一世代のItanium 2。IA-64命令セットにbranchlong命令が追加され、実行ユニットを4から6へ増加、キャッシュ周りが再設計されるなどして性能が最大2倍向上しているが、その恩恵を受けるにはItanium2向けに再コンパイルする必要がある。なおIA-32性能も大幅に改善されたが、同時期のx86プロセッサの性能には遠く及ばず、Mckinleyでのx86コード実行速度はクロック周波数が2/3のPentium IIと同等である。開発初期段階ではFlagstaff (フラッグスタッフ) という名称で開発されていた。
Montecito の機能強化版。2007年10月31日即日販売された。名称はDual-Core Itanium Processor 9100番台。
製造プロセスルールは90 nm、最高1.66 GHzの動作周波数、667 MHzのFSBを備え、104W以下の消費電力で動作。2つのプロセッサとチップセットが同じバスに搭載された3ロードバスによって、エンタープライズおよびハイパフォーマンスコンピューティング (HPC) での使用において、優れた能力を発揮する。
また、サーバの利用が低い時の消費電力を削減する新機能「デマンド・ベース・スイッチング」(DBS) により、エネルギーコストの低減にも寄与する。
さらに2008年第1四半期からコアレベルロックステップ機能付きモデルを出荷開始する。この機能はプロセッサーコア内で起こるエラーの検出を確実に行うことでデータの完全性とアプリケーションの信頼性を向上させる新技術である。
2012年11月9日発表。9500シリーズは、Tukwila の後継プロセッサとしてPoulsonとの開発コード名で開発された。製造プロセスルールは45 nmはスキップして32 nmを採用し、最大8コア、マルチスレッド処理を強化し、特に仮想化などの並列処理用の命令を追加した。Intel VT-x, VT-d, VT-i 対応。クロックは最大2.53 GHzとなった。2010年から実施しているXeonとの基盤要素共通化を反映させたとしている。対応メモリは DDR3-800 と DDR3-1067。
IA-64だけでなく、IA-32ベースのアプリケーションも実行可能である。 Montecitoより前のCPUでは、IA-32を処理するハードウェアデコーダが搭載されていた。この機能はWindows Itanium EditionにおけるWin32エミュレーションレイヤーでかつて使われていた(Itaniumに移植されなかったプログラム、OCX、DLLの実行に必須で、特にActiveXに対する後方互換性は重大な課題であった)。Montecitoからはハードウェアデコーダは削除され、EFIでIA-32エミュレータがロードされるようになった。
キャッシュ設計上の興味深い点としてL2キャッシュがALUを使わずにセマフォーを操作できるロジックを備えている点である。デュアルコアである2006年7月発売の製品Montecitoを皮切りに、以降のItaniumファミリはマルチコアチップとなる。