SPARC
SPARC64 VIおよびSPARC64 VIIでは、マルチコア・マルチスレッド対応がなされている。
2009年に発表されたSPARC64 VIIIfxはHPC向け製品である。2-Way SMTからシングルスレッドになったが、コア数は4コアから8コアに増えた。また、メモリーコントローラがプロセッサに統合され、新規に開発されたHPC向け命令拡張「HPC-ACE (High Performance Computing - Arithmetic Computational Extensions)」が実装され、レジスタ本数が増加し、SIMD命令が強化された。
SPARC64 VIIIfxは、2011年6月、同年11月と2期連続でTOP500リスト首位を獲得したスーパーコンピュータの「京」に採用されている。
2011年に発表されたSPARC64 IXfxはSPARC64 VIIIfxと同じくHPC向け製品である。クロック周波数が2GHzから1.848GHzに低下したものの、コア数は8コアから16コアに倍増し、メモリ帯域も64GB/sから85GB/sと向上している。
SPARC64 IXfxは、富士通のスーパーコンピュータPRIMEHPC FX10(2011年11月7日に販売開始、2012年1月より出荷)に採用されている。
アーキテクチャ上、用途に合わせて規模を変更できる点は、実装するレジスタ・ウィンドウの個数である。仕様では3個から32個までのウィンドウ実装を許可していて、実装者は32個を実装して関数コール性能を向上させるか、3個だけ実装してコンテキスト切り替え性能を向上させるか、あるいはその中間を選択できる。このため、SPARCのアーキテクチャはC言語など構造化プログラミング言語に向けて最適化されているとも言われる。同様なレジスタ・ウィンドウを持つアーキテクチャとして、Intel i960、AMD 29000がある。
SPARCバージョン8(1987年)では、浮動小数点レジスタファイルは16本の倍精度レジスタを持つ。各レジスタは2本の単精度レジスタとしても使用でき、全部で32本の単精度レジスタとなる。2本の倍精度レジスタを四倍精度レジスタとして使用することもでき、全体で8本の四倍精度レジスタとなる。SPARCバージョン9(1995年)ではさらに16本の倍精度レジスタを追加したが、これらは単精度レジスタとしては使用できない(四倍精度レジスタ8本としては使用可能)。
タグ付き加減算命令はLSBの2ビットを無視して加減算を行う。これは、MLやLISPなどのタグ付きの整数フォーマットを使うような言語の実装に有効と思われる。
↑ M7: Next Generation SPARC. Hotchips 26 – August 12, 2014. Stephen Phillips
↑ Oracle's SPARC T7 and SPARC M7 Server Architecture. October 2015
↑ SPARC S7 プロセッサ データシート Oracle
↑ SPARC64TM XII: Fujitsu’s latest 12 Core Processor for Mission Critical Servers COOL Chips 20 講演資料、富士通 2017
↑ SPARC M8 プロセッサ データシート Oracle
↑ 馬場敬信『コンピュータアーキテクチャ 改定4版』、オーム社、平成28年11月15日 改定4版 第1刷 発行、80ページ
↑ PRIMEHPC FX10 : 富士通
↑ 【PC Watch】 富士通、最大23.2PFLOPSを実現するスパコンを発売 ~京で用いた技術をさらに発展
↑ “富士通とオラクル、新UNIXサーバ「Fujitsu M10」を全世界に提供開始”. 富士通 (2013年4月10日). 2014年5月22日閲覧。