Super Harvard Architecture Single-Chip Computer
チップ外部のメモリーにもアクセスすることが可能である。 この外部メモリーは1つのサイズのワード用に1つの領域を設定することしかできない。 メモリーの消費を抑えるために32ビットワード用に外部メモリーを設定すると、 チップ内のメモリーにコード用と拡張された浮動小数点数のための領域を設定しなくては いけなくなる。 こうなると、オペレーティングシステムはオーバーレイを使って48ビットのデータを 命令の実行に応じてチップ内のメモリーに転送することで対応することとなる。 DMAエンジンがこのために用いられる。 真のページングは、外部のMMUなしには実現不可能である。
SHARCは32ビットのワード単位でのアドレス空間を持ち、ワードサイズに応じて16GB、 20GB、24GBがそれぞれ上限となる。
SHARCの命令は、32ビットの即値をオペランドとしてとることができる。 32ビットの即値をオペランドとしてとらない命令は2つ以上同時に実行可能である。 多くの命令は条件節を伴い、アセンブリー言語では「if 条件」を前に付けて表現する。 条件には多くの選択肢があり、x86におけるフラグレジスターのように使うことができる。
2つの遅延スロットがあり、ジャンプの後にはそのジャンプに続く2つの命令が実行されるのが 通常である。
SHARCプロセッサーはループ制御機能を持っている。 最大6段階まであれば、ループを終了させるか判断するために、通常のブランチ命令と 状態変数を利用する必要はない。
SHARCは2セットのレジスターを持っている。 コードにより、この2つの間をすぐに切り替えることができる。 これによりアプリケーションとOSや、2つのスレッド間でのコンテクストスイッチを高速に実行できる。