オープンコレクタ
しかしながら、電子と正孔の移動速度の違いゆえにPMOSがNMOSよりも動作が遅いこと、現在ではHレベル(Vdd)は異なってもLレベル(Vss)については接地の電位に統一する設計がほとんどであること、一見すると似た構造を持つPMOSやECLでは正電位を接地するためPチャネルオープンドレインでも電圧を変換することは難しいことから、標準ロジックにおけるラインアップがきわめて少ない。
CMOSから見ると、ごく初期のダイオードを用いたAND (OR) 回路 (DRTL) は、CMOS出力などをダイオードを用いてNチャネル(Pチェネル)オープンドレインの出力レベルに変換したあと、ワイアードAND (OR) を用いているように見える。
現在のLSIにおいて、オープンコレクタが必要になりそうなほど巨大なAND回路が必要な場合、疑似NMOSやHMOSによるNOR回路が主に用いられる。CMOSのNORではPMOSを直列接続する場所がボトルネックになるため、遅延が(入力数)×(EFTの動作遅延)になるのに対し、NMOSのNOR回路は入力数が少ない時の遅延が大きい一方、NチャネルMOS-FETがもっぱら並列接続されて直列のPチャネルFETは用いないため、配線の長さの増加した分だけが遅延に影響するので入力数の増加に伴う遅延の増加が穏やかなためである(PMOSによるNAND回路も同様)。