Nios II
Nios IIはAvalonスイッチ・ファブリックを組み込まれた周辺機器とのインターフェースとして使用している。唯一のバスマスターが一度バスにアクセスするプロセッサベースシステムにおける従来型のバスに比べ、Avalonスイッチ・ファブリックは、スレーブ側の調停スキームを使用し、複数のマスターが同時に操作できるようにしている。
Nios II本来の命令と同じように、ユーザの定義した命令も2基までの32ビットの読み込み元レジスタから値を読み込むことができる。オプションとして32ビットの書き込み先レジスタに結果を書き戻すこともできる。カスタム命令を使うことにより、システムの設計者は求めるパフォーマンスに合致するようにシステムのハードウェアを細かく調整することができ、設計者は簡単に命令をC言語またはC++言語によるマクロとして扱うことができる。
Nios II/eコアはFPGAのロジックを可能な限り最小限使用するように設計されている。これは、低コストなCyclone II FPGAを使用する場合に特に効率が良くなる。Nios II/eの機能は、以下のようである。
最大2GBまでの外部アドレス空間
JTAGデバッグモジュール
700より少ない論理素子数
オプションのデバッグ用の拡張
最大256のカスタム命令