TurboSPARC
TurboSPARCは、単純なスカラー順序設計であった。フェッチ段階では、16KBの直接マップされた命令キャッシュから2つの命令がフェッチされる。デコード段階で、1つの命令がデコードされ、そのオペランドがレジスタファイルから読み取られる。実行はステージ3で始まる。 TurboSPARCには、整数ユニットと浮動小数点ユニットがあった。乗算と除算を除くほとんどの整数算術命令には、シングルサイクルのレイテンシがある。乗算と除算はFPUが実行した。乗算のレイテンシーは7サイクルだった、除算のレイテンシーは8〜33サイクルだった。除算と平方根を除くほとんどの浮動小数点算術命令には、4サイクルのレイテンシがあった。
メモリアクセスはステージ4で発生する。 TurboSPARCには16KBのデータキャッシュがある。キャッシュは直接マップされ、ライトバック書き込みポリシーを使用する。データキャッシュヒットが発生した場合、データは同じサイクルで返され、ステージ5でエラーがないかチェックされる。整数演算の結果とロードは、ステージ6の間にレジスタファイルに書き込まれる。より多くのサイクルを要する浮動小数点命令は、ステージ7までに完了し、ステージ8の間に浮動小数点レジスタファイルに書き込まれる。
TurboSPARCには、L2キャッシュ、メモリ、AFXインターフェイス、およびSBusインターフェイス用の統合コントローラーがあった。 256 KB、512 KB、または1MBの外部L2キャッシュがサポートされていた。キャッシュは内部クロック周波数 (170MHz)の半分 (85 MHz)または3分の1 (56.