Memori akses acak dinamis

Biasanya, produsen menetapkan bahwa setiap baris harus refresh setiap 64 ms atau kurang, menurut standar JEDEC . Refresh logika umumnya digunakan dengan DRAMs untuk me-refresh secara otomatis. Hal ini membuat sirkuit yang lebih rumit, tetapi ini biasanya kekecewaan terhapuskan oleh fakta bahwa DRAM adalah lebih murah dan kapasitas lebih besar dari SRAM. Beberapa sistem refresh setiap baris dalam sebuah lingkaran yang ketat terjadi sekali setiap 64 ms.Sistem lain refresh satu baris pada satu waktu - misalnya, dengan sistem 2 13 = 8192 baris akan memerlukan refresh rate dari satu baris setiap 7,8 μs (64 ms / 8192 baris). Beberapa waktu-nyata sistem refresh sebagian memori pada satu waktu berdasarkan waktu eksternal yang memerintah pengoperasian dari sistem, seperti blanking interval vertikal yang terjadi setiap 10 sampai 20 ms video dalam peralatan. Semua metode memerlukan beberapa jenis counter untuk melacak yang baris berikutnya adalah untuk refresh. Hampir semua DRAM chips yang memasukan counter; beberapa jenis yang tua memerlukan refresh logika eksternal. (Pada beberapa kondisi, sebagian besar data di DRAM dapat dipulihkan walaupun belum DRAM refresh selama beberapa menit.)
Dinamis random akses memori yang diproduksi sebagai sirkuit terpadu(ICS) disimpan dalam gudang dan dimount ke dalam paket plastik dengan logam pin untuk koneksi ke kontrol sinyal dan bus. Saat ini, ini adalah paket DRAM pada umumnya sering dikumpulkan ke modul plug-in untuk penanganan lebih mudah.
Beberapa jenis modul standar adalah:Modul DRAM Umum