Memori akses acak dinamis

DRAM biasanya diatur dalam persegi array satu kapasitor dan transistor per sel. Panjang garis yang menghubungkan setiap baris dikenal sebagai "baris kata". Setiap kolom sedikitnya terdiri dari dua baris, masing-masing terhubung ke setiap penyimpanan sel di kolom. Mereka biasanya dikenal sebagai + dan - bit baris. Amplifier perasa pada dasarnya adalah sepasang inverters lintas yang terhubung antara bit baris. Yakni, inverter pertama terhubung dari + bit baris ke - bit baris, dan yang kedua terhubung dari - baris ke bit + baris.
Untuk membaca bit baris dari kolom, terjadi operasi berikut: