УСТРОЙСТВО КОНТРОЛЯ ОШИБОК В ЦИФРОВЫХ СИСТЕМАХ ПЕРЕДАЧИ НА БАЗЕ ТЕХНОЛОГИИ АТМ

Устройство контроля ошибок в цифровых системах передачи на базе технологии ATM (Asynchronous Transfer Mode), содержащее проверяемую цифровую систему передачи и компаратор, отличающееся тем, что дополнительно введены блоки коммутации передачи и приема, счетчики единичных импульсов передачи и приема, блоки управления передачи и приема, блоки памяти передачи и приема, блоки определения параметров передачи и приема, блок объединения, электронный ключ, второй вход которого соединен с выходом компаратора, первый вход которого подключен к первому выходу блока памяти приема, первый и второй входы которого соединены соответственно с первым и вторым выходами блока определения параметров приема, первый вход которого подключен к второму выходу блока памяти приема, четвертый и третий входы которого соединены соответственно со вторым и третьим выходами блока управления приема, четвертый выход которого подключен ко второму входу блока определения параметров приема, а первый выход блока управления приема соединен со вторым входом счетчика единичных импульсов приема, выход которого подключен к пятому входу блока памяти приема, а первый вход счетчика единичных импульсов приема соединен с первым выходом блока коммутации приема, второй выход которого подключен ко второму входу компаратора, а второй и третий входы блока коммутации приема соединены соответственно с шестым и пятым выходами блока управления приема, вход которого подключен ко второму выходу проверяемой цифровой системы передачи, являющемуся ее выходом синхронизации, и к четвертому входу блока коммутации приема, первый вход которого соединен с первым входом электронного ключа и с первым выходом проверяемой цифровой системы передачи, являющимся ее информационным выходом, первый вход которой является его информационным входом, соединен с выходом блока объединения, первый вход которого соединен с информационным входом устройства контроля ошибок в цифровых системах передачи на базе технологии ATM и с первым входом блока коммутации передачи, четвертый вход которого подключен ко второму входу проверяемой цифровой системы передачи и ко входу частоты синхронизации, к пятому входу блока объединения, ко входу блока управления передачи, седьмой и восьмой выходы которого подключены соответственно к четвертому и третьему входу блока объединения, а пятый и шестой выходы подключены соответственно к третьему и второму входам блока коммутации передачи, выход которого соединен с первым входом счетчика единичных импульсов передачи, второй вход которого подключен к первому выходу блока управления передачи, второй и третий выходы которого соединены соответственно с четвертым и третьим входами блока памяти передачи, пятый вход которого подключен к выходу счетчика единичных импульсов передачи, первый выход блока памяти передачи соединен со вторым входом блока объединения, а второй выход блока памяти передачи подключен к первому входу блока определения параметров передачи, первый выход которого соединен с первым входом блока памяти передачи, второй вход которого подключен ко второму выходу блока определения параметров передачи, второй вход которого соединен с четвертым выходом блока управления передачи.