榎本忠儀

榎本 忠儀（えのもと ただよし）は日本の電子工学者、教育者榎本忠儀 - reserchmapTadayoshi Enomoto - IEEE Xplore (英語)。米国オハイオ州立大学 博士 (Doctor of Philosophy)。
(株)日本電気(NEC)中央研究所 部長、中央大学理工学部 教授を経て、2014年より中央大学 名誉教授名誉教授 - 中央大学。半導体、集積回路 (LSI)、動画像圧縮方式の研究に取り組み、「動画像符号化プロセッサ」の開発に世界で初めて成功する等、数々の先駆的業績を上げた。電子情報通信学会で最も権威ある「功績賞」、LSI分野において世界最高の栄誉である “Best Paper Award of IEEE Journal of Solid-State Circuits” (最優秀論文賞)等を受賞すると共に、IEEE Fellow (EEE フェロー)、IEEE Life Fellow、電子情報通信学会フェローおよび電子情報通信学会名誉員に選出された。

 概要 
高速プロセッサA 200MFLOPS 100MHz 64b BiCMOS vector-pipelined-processor, Digest of 1991 IEEE Int. Solid-State Circuits Conference (ISSCC’91), pp. 256-257, Feb. 1991 (英語)、低電力メモリ“A self-controllable-voltage-level (SVL) circuit for low-power, high-speed CMOS circuits”, Proc. of 2002 IEEE European Solid-State Circuits Conference (ESSCIRC’2002), C21.05, pp. 411-414, Sept. 2002 (英語)、機能メモリ、等の半導体集積回路(LSI)の分野および高速に動画像を符号化“Fast motion estimation algorithm and low-power CMOS motion estimation array LSI for MPEG-2 encoding”, Proc. of 1999 IEEE Int. Symp. on Circuits and Systems (ISCAS’99), vol. IV, pp. 203-206, May/June 1999 (英語)するアルゴリズムの分野で多くの実績をあげた榎本忠儀 - J-GLOBAL。特に、将来のディジタル化、オンライン化に向け、実時間で動画像を符号化する動画像符号化プロセッサ(Video Signal Processor;VSP)榎本忠儀 「(招待論文) 動画像符号化プロセッサの歴史と将来展望」、電子情報通信学会論文誌、エレクトロニクスソサイエティ和文論文誌500号記念論文特集、Vol. J92-C、No. 8、pp. 477-487、2009年8月“A microprogrammable realtime video signal processor (VSP) LSI for motion compensation and vector quantization”, Proc. of 1987 IEEE Custom Integrated Circuits Conference (CICC’87), pp. 303-306, May 1987 (英語)“A micro programmable realtime video signal processor (VSP) LSI”, IEEE, J. of Solid-State Circuits, vol. SC-22, no. 6, pp. 1117-1123, Dec. 1987 (英語)Tadayoshi Enomoto, “(Invited Paper) High-throughput technologies for video signal processor (VSP) LSIs”, IEICE Tran. on Electronics, Vol. E79-C, No. 4, pp. 459 - 471, April 1996 (英語)
の開発に世界で初めて成功し、実用化したこと(1987年)、動画像符号化の基本特許で、業界標準技術として広く定着している「高速動画像符号化処理方式」
を発明(特許)「動画像符号化器とその制御方式」 - Google Patents(US Patent) “Motion picture coder and system for controlling the same” - Google Patents (英語)
したこと(1993年)、並びに動画像符号化を高速に演算するアルゴリズムである「高速サブサンプリング法」(2009年)“Fast sub-sampling block matching algorithm employing adaptively assigned sizes and locations of search windows”, Proc. of 2009 IEEE Int. Symp. on Circuits and Systems (ISCAS’2009), B3L-F4, pp. 1653-1656, May 2009 (英語)
および「帯状探索窓法」(2010年)「(特許)ブロックマッチング処理回路およびブロックマッチング処理方法」 - Google Patents“Stick-shaped window search (SSWS)” block matching algorithm for motion vector estimation”, Proc. of 2010 IEEE Int. Conference on Signal Processing (ICSP’2010), pp. 1117-1120, Beijing, China, Oct. 2010 (英語)を開発したこと、などが注目される。これらの先駆的研究は今日のオンライン会議、オンライン授業、などで必須なパソコン、スマートフォン、4K・8Kテレビを始めとするディジタル動画像通信機器やオンライン技術の基盤を構築すると共に、その普及と発展に貢献した。

大容量機能メモリ“A 2K-word dictionary search processor (DISP) LSI with an approximate word search capability”, IEEE Journal of Solid-State Circuits, Vol. 27, No. 6, pp. 883-891, June 1992 (英語)の研究によりIEEE Journal of Solid-State Circuitsの最優秀論文賞(Best Paper Award)(1992年)“Best Paper Award”、動画像符号化プロセッサの開発と実用化により1995年度電子情報通信学会の業績賞(1996年)第33回電(1995年度 平成7年度) 電子情報通信学会 業績賞、低消費電力平方根プロセッサの研究によりIEEE ASP-DAC Best Design Award (2006年) 、「画像LSIシステム設計技術」の著作により第21回電気通信普及財団のテレコムシステム技術賞(2006年)第21回 電気通信普及財団賞 (テレコムシステム技術賞) 入賞、低電圧SRAMメモリ“Single-power-supply Six-transistor CMOS SRAM Enabling Low-voltage Writing, Low-voltage Reading, and Low Standby Power Consumption”, IEICE Tran. on Electronics, vol. E-106-C, no. 9, pp. 466-476, Sept. 2023 (英語)の開発により2023年度電子情報通信学会の論文賞(2024年)論文賞 (会誌)論文賞第80回 (令和5年度) 電子情報通信学会 論文賞Best Paper Award (英文)中大理工HP 信学会 論文賞日大理工HP 信学会 論文賞、半導体集積回路(LSI)の研究・開発・教育への貢献により2024年度電子情報通信学会の功績賞(2025年)第86回 (2024年度) 推薦の辞a (和文)(歴代功績賞受賞者一覧)第86回 (2024年度) 推薦の辞b (和文)(会誌)第86回 (2024年度) 推薦の辞c (英文)各賞受賞者歴代功績賞受賞者一覧中大理工HP 信学会 功績賞、等を受賞すると共に、IEEE Fellow(米国電気電子学会フェロー)(1998年)1998 New Fellows - IEEE JAPAN CouncilIEEE Fellow - IEEE Fellow Directory、IEEE Life Fellow (IEEE生涯フェロー)(2012年)IEEE Life Fellow - IEEE Life Fellow、電子情報通信学会フェロー(2001年)平成13年フェロー称号贈呈者 - 電気情報通信学会および電子情報通信学会名誉員(2026年)の称号が授与された。

 学歴 
 日本大学
 1968年 日本大学 理工学部 電気工学科 卒業、学士号 取得
 オハイオ州立大学 (Ohio State University; OSU)
 1970年-1975年 オハイオ州立大学 (Ohio State University; OSU) より“4-year Ohio State University Fellowship” (4年間の奨学金授与および授業料免除) を得て、(株)日本電気(NEC)に在籍のまま、同大学 大学院へ留学
 1972年 オハイオ州立大学 大学院 修士課程 (電子工学専攻) 卒業、Master of Science (M. Sc) (修士号) 取得
 1975年 オハイオ州立大学 大学院 博士課程 (電子工学専攻) 卒業、Doctor of Philosophy (Ph. D) (博士号) 取得
 学位論文(Dissertation) “Photoconductance and luminescence in zinc-sulfide due to infrared stimulation”Tadayoshi Enomoto, “Photoconductance and Luminescence in Zinc-sulfide Due to Infrared Stimulation”, Ph. D. Dissertation, Ohio State University, pp. 1-162, Mar. 20, 1975 – WorldCat (英語)

 職歴 
 オハイオ州立大学 (Ohio State University; OSU)
 1971年-1975年 オハイオ州立大学 大学院 Research Associate (研究員) (NEC技術員と兼務)
 (株)日本電気 (NEC)
 1968年-1975年 (株)日本電気 私設通信事業部 電話交換機設計技術員
 1975年-1980年 (株)日本電気 中央研究所 電子デバイス研究部 研究員
 1980年-1984年 (株)日本電気 中央研究所 電子デバイス研究部 主任
 1984年-1986年 (株)日本電気 マイクロエレクトロニクス研究所 集積回路研究部 課長
 1986年-1992年 (株)日本電気 マイクロエレクトロニクス研究所 システムULSI研究部 部長
 中央大学
 1992年-2014年 中央大学 理工学部 情報工学科 教授
 1993年-2014年 中央大学 大学院 理工学研究科 教授
 2014年- 中央大学 名誉教授
 日本大学
 1998年-2012年 日本大学 大学院 理工学研究科 非常勤講師
 最高裁判所 知的財産高等裁判所
 2008年-2012年 最高裁判所 知的財産高等裁判所 専門委員

 称号 
 オハイオ州立大学 (Ohio State University; OSU)
 1975年- Doctor of Philosophy (Ph. D) (博士号)Tadayoshi Enomoto, “Photoconductance and Luminescence in Zinc-sulfide Due to Infrared Stimulation”, Ph. D. Dissertation, Ohio State University, pp. 1-162, Mar. 20, 1975 – WorldCat (英語)
 中央大学
 2014年- 中央大学 名誉教授
 IEEE (Institute of Electrical and Electronics Engineers) (米国 電気電子学会)
 1998年- EEE Fellow (EEE フェロー)
 2012年- IEEE Life Fellow (EEE 生涯フェロー)
 電子情報通信学会
 2001年- 電子情報通信学会 フェロー
 2013年- 電子情報通信学会 終身会員
 2026年- 電子情報通信学会 名誉員

 研究業績 
 動画像符号化プロセッサ 
 プログラム方式を採用した動画像符号化プロセッサ 
1987年、動画像符号化プロセッサ(Video Signal Processor; VSP)を世界に先駆けて開発し、その実用化に成功した。VSPは動画像を実時間で符号化・復号化するプロセッサで、今日の4K・8Kテレビ放送や移動通信システム(スマートフォーン、等)に必須のデバイスである。本VSPはProgrammable VSP(P-VSP)と呼ばれ、様々な規格、方式、応用に対応するため、プログラム方式“A micro programmable real-time video signal processor (VSP) for motion compensation”, IEEE J. of Solid-State Circuits, Vol. SC-23, No. 4, pp. 907-915, Aug. 1988 (英語)が採用されている。また、P-VSP“A micro programmable realtime video signal processor (VSP) LSI”, IEEE, J. of Solid-State Circuits, vol. SC-22, no. 6, pp. 1117-1123, Dec. 1987 (英語)には多様な符号化処理に必要な回路がフル搭載されているTadayoshi Enomoto, “(Invited Paper) High-throughput technologies for video signal processor (VSP) LSIs”, IEICE Tran. on Electronics, Vol. E79-C, No. 4, pp. 459 - 471, April 1996 (英語)。本P-VSPは予測符号化(動きベクトル検出＋動き補償フレーム間予測)を処理する3段パイプライン加算系ユニットおよび変換符号化(離散的コサイン変換＋量子化＋可変長符号化)を処理する2段パイプライン積和系ユニットで構成されている。パイプラインの1段目は絶対値演算機能付きALU(米国特許 第4,849,921号“Arithmetic Circuit for Calculating the Absolute Value of the Difference between a Pair of Input Signals” (英語)、カナダ特許第1,257,003号“Arithmetic Circuit” - Google Patents (英語))、乗算回路、正規化回路、2段目は累算回路、シフタ、3段目は最小値検出回路で構成される。さらにデータメモリ(RAM、ROM)、等も搭載されている。12個のP-VSPを搭載したモジュール“Realtime video signal processor module”, Proc. of 1987 IEEE Int. Conference on Acoustics, Speech and Signal Processing (ICASSP’87), pp.1961-1964, Dallas, Texas, April 1987 (英語)を3台用いて実時間ビデオ信号処理プロセッサシステム“A real-time video signal processor suitable for motion picture coding applications”, IEEE, Tran. on Circuits and Systems，vol. CAS-36, no. 10, pp. 1259-1266, Oct. 1989 (英語)を構築した(1987年)。本システムを14.3 MHzで動作させると、H.261に準拠するテレビ会議用CIF(Common Intermediate Format/176ピクセル×144ピクセル)画像を実時間処理できる。P-VSPの発表を機会に多数の企業がVSP開発に参入することにより、ディジタルマルチメディア時代が始まった。

 動画像符号化プロセッサの高速化 
1989年、変換符号化に必須な畳み込み演算を効率よく処理するため、SSSP(Super high Speed Signal Processor)“200MHz 16bit BiCMOS Signal Processor”, Digest of Tech. Paper, 1989 IEEE Int. Solid-State Circuits Conference (ISSCC’89), THPM12.8, pp. 172-173, 330, New York, NY, Feb. 1989 (英語)を開発した。本SSSPの開発に当たり、冗長二進数高速積和演算回路(米国特許 第4,985,861号)「冗長二進数高速積和演算回路」“High speed digital signal processor for signed digit numbers” (英語)を発明し、3次のブースデコーダを用いた乗算回路や微細Bi-CMOSプロセス技術を採用した。この結果、本SSSPは当時の世界最高速度(200MHz)“A 200-MHz 16-bit super high-speed signal processor (SSSP) LSI”, IEEE J. of Solid-State Circuits, Vol. SC-24, No. 6, pp.1668-1674, Dec. 1989 (英語)で動作することに成功した。1991年、動画像符号化処理に必要な回路をフル搭載したS-VSP](Super-high-speed VSP)“A 250MHz 16bit 1million Transistor BiCMOS Super High Speed Video Signal Processor”, Digest of Tech. Paper, 1991 IEEE Int. Solid-State Circuits Conference (ISSCC’91), FP15.4, pp. 254-255, 325, San Francisco, CA, Feb. 1991 (英語)を開発した。上述のSSSP、PLLクロックドライバ、ダブルバッファ方式の2ポート画像メモリ、等を搭載することにより、大量画像データの高速ベクトル演算を可能にし、250MHz動作“250-MHz BiCMOS super-high-speed video signal processor (S-VSP) ULSI”, IEEE J. of Solid-State Circuits, Vol. SC-26, No. 12, pp. 1876-1884, Dec. 1991 (英語)
を達成した。本S-VSPを2個用いると、上述の実時間ビデオ信号処理プロセッサシステムが構築できる。

 並列・パイプライン符号化処理方式を採用した動画像符号化プロセッサ 
動画像符号化は画素ブロック(m画素×n画素)毎に処理される。従来の符号化は、1個の画素ブロックに対して、まず予測符号化を施し、次に変換符号化を施していた。このため、処理時間が長かった。これを解決するために、1個の画素ブロックに予測符号化を施している時、これと並列に1個前の画素ブロックに変換符号化を施し、かつそれぞれの処理をパイプライン化するブロック単位の「並列・パイプライン動画像符号化処理方式」(特開平05-300494、米国特許 第5,394,189号)を開発し、VSP3(Video Signal Parallel Pipeline Processor)に適用した(1993年)“A 300MHz 16bit BiCMOS Video Signal Processor”, Digest of Tech. Paper, 1993 IEEE Int. Solid-State Circuits Conference (ISSCC’93), WP2.6, pp. 37-38, 258, San Francisco, CA, Feb. 1993 (英語)。本方式はVSPを構築する上で避けることができない基本特許であり、業界標準技術として広く定着している。本方式の導入により、VSP3の符号化処理時間は大幅に短縮され、動作速度は大幅(300MHz)に高速化された“A 300MHz, 16bit, Programmable Video Signal Processor ULSI for a Single Chip Teleconferencing Systems”, Proc. of 1993 IEEE European Solid-State Circuits Conference (ESSCIRC’93), pp. 94-97, Seville, Spain, Sept. 1993 (英語)“A 300-MHz, 16-b, BiCMOS video signal processor”, IEEE Jour. of Solid-State Circuits, Vol. 28, No. 12, pp. 1321-1330, Dec. 1993 (英語)。なお、前出の実時間ビデオ信号処理プロセッサシステムはたった1個のVSP3で構築できる。

 高速動きベクトル検出アルゴリズムと動画像符号化プロセッサ 
前出の「動きベクトル検出」に従来は「全探索法」が用いられていた。処理時間が長い「全探索法」の課題を解決するため、最適動きベクトルが検出された時点で探索を自動的に停止させ、VSPを高速化する「中断法」(特開平10-271514)(1998年)「(特許) 動画像情報の信号処理方法及びその装置」 - Google Patentsを世界で初めて開発し、MPEG-2対応のVSPに適用した。中断法は探索処理を停止すると同時に、電源も停止できるので、VSPの低電力化に有効である。中断法は2000年代初頭に国内各社が開発した携帯TV電話向けVSPに採用され、VSPの急速な普及に貢献した。対象画素ブロックに対して本中断法を複数回繰り返す「多重中断法」(2007年) “A Multiple block-matching step (MBS) algorithm for H.26x/MPEG4 motion estimation and a low-power CMOS absolute differential accumulator circuit”,IEICE Tran. on Electronics, vol. E90-C, no. 4, pp. 718-726, April 2007 (英語)を開発することにより、動きベクトル検出をさらに高速化した。「動的電圧・周波数スケーリング方式 (Dynamic Voltage and Frequency Scaling Technique; DVFST)」を有効活用できる「適応的中断条件算出法」(特開2005-130424)(2005年)「(特許) 動画像情報の信号処理方法」 - Google Patentsを発明し、低消費電力VSP“A low power 90-nm CMOS motion estimation processor implementing dynamic voltage and frequency scaling (DVFS) and fast motion estimation algorithm”, Proc. of 2008 IEEE Int. Symp. on Circuits and Systems (ISCAS’2008), B3L-B.2, pp. 1672-1675, May 2008 (英語) “A low power multimedia processor implementing dynamic voltage and frequency scaling technique”, Proc. of 2013 IEEE Asia and South Pacific Design Automation Conference (ASP-DAC’2013), Design Contest, 1D-3, pp.75-76, Jan. 2013(英語)を開発した。4K、8Kテレビ放送に向けVSPを超高速化するために、探索ポイント数を極限まで削減した「高速サブサンプリング法」(2009年)“Fast sub-sampling block matching algorithm employing adaptively assigned sizes and locations of search windows”, Proc. of 2009 IEEE Int. Symp. on Circuits and Systems (ISCAS’2009), B3L-F4, pp. 1653-1656, May 2009 (英語)を開発した。さらに本アルゴリズムを改良した「帯状探索窓法」(特開2013-026966)(2013年)「(特許)ブロックマッチング処理回路およびブロックマッチング処理方法」 - Google Patentsおよび多入力差分絶対値和回路“Stick-shaped window search (SSWS)” block matching algorithm for motion vector estimation”, Proc. of 2010 IEEE Int. Conference on Signal Processing (ICSP’2010), pp. 1117-1120, Beijing, China, Oct. 2010 (英語)を開発した。帯状探索窓法は、処理測度を「全探索法」の約400倍に高速化し、回路の消費電力を全探索法の1/16,000に削減した。さらに、処理測度を帯状探索窓法より約2倍高速化した「額縁形探索窓法」(2013年) “額縁形探索窓”を採用した8K-UHDTV向け速超高速動きベクトル検出アルゴリズム"、信学技報、ICD-2013-75、pp. 23-28、2013年10月7日も開発した。

 ZnSの発光と伝導 
予め紫外線を照射した極低温の硫化亜鉛(ZnS)結晶に電界を加え、赤外線を照射すると、ZnS結晶が光(ルミネセンス)を発する“Long‐wavelength infrared stimulation of luminescence in ZnS”, Phys. Stat. Sol. (a), Vol. 32, pp. 269-278, Nov. 16, 1975 (英語)と同時にZnS結晶中に電流が流れることを初めて明らかにした“Relations between IR induced photoconductivity and IR stimulated luminescence in ZnS”, Solid-State Electrics，Pergamon Press, Vol. 19, No. 10, pp. 883-890, Oct. 1976 (英語)。発光量と電流量の諸特性(赤外線特性、温度特性、過渡・減衰特性)がほぼ一致することから、発光と電流は同一不純物センターに起因していることがわかった。さらに、不純物センターが浅いエネルギー準位(0.033 eV)、中間のエネルギー準位(0.25 - 0.42 eV)、深いエネルギー準位(0.84 - 2.15 eV)に存在していることも明らかにした“Investigation on trap distribution and photoelectronic effect due to UV, IR and visible light excitation in self-activated ZnS crystals”, Journal of Physics and Chemistry of Solids, Pergamon Press, Vol. 38, No. 3, pp. 247-253, 1977 (英語)。以上の研究成果は、オハイオ州立大学フェローシップ大学院生並びに研究員として同大学に在籍した期間の研究成果であり、学位論文 (Dissertation) “Photoconductance and luminescence in zinc-sulfide due to infrared stimulation”および上記学術論文として公開されている。

 アナログ集積回路 
 電荷結合素子(CCD)と各種フィルタへの応用 
1975年よりSi半導体集積回路(LSI)の研究に従事する。まず、電荷結合素子(CCD)やMOSFETを用いたアナログMOS-LSIの開発に着手した。代表的なCCD LSIとして、多数の浮遊電極型タップを実装したCCD遅延線(1979年)(日本国特許1309909、1349893)、新たに開発した二重分割電極(double- split-electrode)型CCDを搭載した音声チャネルフィルタ(左;49タップ送信フィルタ、右;54タップ受信フィルタ)(1979年)"High performance C.C.D channel filter for a P.C.M. codec",IEE Electronics Letter, vol. 15, no. 25, pp. 817-818, Dec. 6, 1979 (英語)“Monolithic minimum phase CCD channel filter for a PCM codec employing overlapping-double-split-electrode technique”, IEEE Trans. on Circuits and Systems, Vol. CAS-27, No. 6, pp. 457-463, June 1980 (英語)(日本国特許1377077)、非巡回形マツチドフイルタ(日本国特許1496458、1508158)(1981年)、等がある。

 アナログMOS-LSIとアナログ比例縮小則 (スケーリングルール) 
上述の浮遊電極型タップ付きCCD遅延線を搭載したLSIとして、学習機能を持つ世界初の集積化アナログ自動等化器(1982年)“Adaptive equalizer for wideband digital communication networks”, Digest of 1982 IEEE Int. Solid-State Circuits Conference (ISSCC’82), pp. 150-151, Feb. 1982 (英語)、二次元逆フィルター(1979年)および最小位相非巡回型フィルタ(1979年)がある。本アナログ自動等化器は線形自動等化器や非線形自動等化器に応用された。学習機能は重み係数を適応的に更新する機能で、エコーキャンセラー、ニューラルネットワーク、等に必須の機能である。MOSFETの微細化・縮小化による回路への効果や影響を定量化するため、MOS演算増幅器(1982年) “High-speed NMOS operational amplifier fabricated using VLSI technology”, IEE Electronics Letter, vol. 18, no. 4, pp. 159-161, Feb. 18, 1982 (英語)を基本に「アナログMOS回路の比例縮小則(スケーリングルール)」を確立した(1983年)“Design, fabrication, and performance of scaled analog ICs”, IEEE Journal of Solid-State Circuits, Vol. SC-18, No. 4, pp. 395-402, Aug. 1983 (英語)。これよりアナログMOS回路の諸特性(スルーレート、開ループ利得、等)が飛躍的に向上することが示された。さらにスイッチトキャパシタ(SC)を搭載したアナログMOS-LSIとして、アナログ遅延線(1982年)、オフセットエラーキャンセラー(1983年)、4象限アナログ乗算回路(1985年)“Integrated MOS four-quadrant analog multiplier using switched capacitor technology for analog signal processer ICs”, IEEE Journal of Solid-State Circuits, Vol. SC-20, No. 4, pp.852-859, Aug. 1985 (英語)、等がある。

 3次元デバイス 
3次元デバイス(3D-IC)を構築する製造技術に多数のチップやウェハを積み重ねる方法(「積み重ね法」または「張り付け法」)があるSOI構造形成技術。ELVIC(Elemental Level Vertically Integrated Circuit)“Promising new fabrication process developed for stacked LSI’s”, Proc. of 1984 IEEE Int. Electron Devices Meeting (IEDM’84), pp. 816-819, Dec. 1984 (英語)“(Invited Talk) Fabrication Process, Application and Future for an Elemental Level Vertically Integrated Circuits (ELVIC)”, Proc. of 1985 Fall Meeting of Material Research Society (MRS’85), vol. 53, pp. 383-393, Boston, MA, Dec. 1985(英語)“Fabrication process, experimental results and application for an elemental level vertically integrated circuit (ELVIC)”, J. of Materials Research，Material Research Society, Vol. 1, No. 4, pp. 552-559, July/Aug. 1986 (英語)と呼ぶ「積み重ね法」(米国特許 第4,612,083号)(1984年)“(US Patent) Process of fabricating three-dimensional semiconductor device” - Google Patents (英語)、(欧州特許 第016815B1号)(1992年)“(Europian Patent) Process of fabricating three-dimensional semiconductor device” - (英語)、(日本国特許1760133)(1993年)、(日本国特許1899777)(1995年)を開発した。
ELVIC技術は、(a)チップを三次元的に積層する技術、(b)各チップの表面と底面を導通する垂直配線を形成する技術からなる。(b)はチップを上下に貫通するビアホールを形成するエッチング工程とビアホールに垂直配線を埋め込む工程、からなる。本ELVIC技術は無線ICタグチップ(ミューチップ)、等の両面電極を形成するために不可避な技術として現在も広く利用されている。
異なる半導体材料で形成されたデバイスを同一チップ上に形成することは難しい。この問題を解消するために「積み重ね法」を適用した。CMOS回路が形成されたSiチップの上にInGaAsP/IbP発光ダイオードが形成された化合物半導体チップを重ねた3D-ICを作成して、その特性を評価した「InGaAsP/InP発光ダイオードとSiデバイスとの積層構造化」、昭60年度電子通信学会半導体・材料部門全国大会、予稿集 (分冊1)、283、p. 98、1985年11月。
他の3D-IC技術として、絶縁膜上に単結晶Si層を生成したSOI(Silicon on Insulator)を作成し、Si層の結晶方位とSOIの表面形態を評価した。さらに、表面形態とMOSFETのしきい値の関係を評価した“Influence of the SOI surface morphology on crystal orientation and device characteristics”, Procs. of 1987 Fall Meeting of the Material Research Society (MRS’87), Boston, Material Research Society, (Mat. Res. Soc. Symp Proc.,) vol. 107, pp. 409-414, Dec. 1987 (英語)。SOI基板を用いてMOSFETを製造する技術「絶縁ゲート形トランジスタの製造方法」、(日本国特許1496467)(1989年)、等開発した。

 ディジタル集積回路 
 プロセッサ 
スーパーコンピュータ用として世界に先駆けて開発したCMOSベクトルパイプラインプロセッサ(Vector Pipelined Processor; VPP)(1991年)A 200MFLOPS 100MHz 64b BiCMOS vector-pipelined-processor, Digest of 1991 IEEE Int. Solid-State Circuits Conference (ISSCC’91), pp. 256-257, Feb. 1991 (英語)、無制限の誤り(誤字・脱字)を含む単語の検索が可能な辞書検索プロセッサ(Dictionary Search Processor; DISP)(1990年)“A 1.2-million transistor, 33 MHz, 20-bit dictionary search processor with a 160 kb CAM”, Digest 1982 IEEE Int. Solid-State Circuits Conference (ISSCC’90), pp. 254-255, Feb. 1991 (英語)、企業内LANに向けた情報検索プロセッサ(1988年)、高基数・スケーリング方式を採用した浮動小数点除算回路(2003年)「高基数・スケーリング方式浮動小数点除算回路の高速化と小形化」 電子情報通信学会論文誌、Vol. J86-C、No. 8、pp. 853 - 862、2003年8月、動きベクトル検出プロセッサ(2001年)“Fast motion estimation algorithm and low power 0.13μm CMOS motion estimation circuits”, Proc. of 2001 IEEE Int. Symp. on Circuits and Systems (ISCAS’2001), vol. II, pp. 449-452, Sydney, Australia, May 2001 (英語)、平方根回路(2005年)“A low dynamic power and low leakage power CMOS square-root circuit”, Proc. of 2005 IEEE Int. Symp. on Circuits and Systems (ISCAS’2005), A4P-V.8, pp.1678-1681, Kobe, Japan, May 2005 (英語)(2006年)“A low dynamic power and low leakage power 90-nm CMOS square-root circuit”, Proc. of 2006 IEEE Asia and South Pacific Design Automation Conference (ASP-DAC’2006), 1D-1, pp. 90-91, Jan. 2006 (英語)、「適応的中断条件算出法」(特開2005-130424)(2005年)の発明により、動的電圧・周波数スケーリング法(Dynamic Voltage and Frequency Scaling Technique; DVFST)を実現した初の動画像符号化プロセッサ
(VSP)(2008年)
(2013年)

等、様々な高性能CMOSプロセッサを開発した。上記VPPはNECのスーパコンピュータSX-4に搭載された。SX-4はCMOS集積回路を採用した初のスーパコンピュータである。


 高速ディジタル回路 
回路を並列化・パイプライン化して高速化する技術として、並列差分絶対値和回路(米国特許 第4,849,921号)(1989年)、並列ALU(カナダ 特許第1,257,003号)(1989年)、桁上げの無い冗長二進数演算を生かした積和演算回路(米国特許 第4,985,861号)(1991年)、浮動小数点乗算/除算/論理演算器(1991年)、プログラム方式チップ搭載型クロックパルス発生回路)(1993年)、ALUの高速例外処理手法と回路)(1993年)、等の発明がある。回路を小型化およびクリティカルパスを短縮して高速化する技術として、多入力演算器(特開平10-269197)(1998年)(公開特許公報) 多入力演算器 - j-platpat、差分絶対値和回路(2001年)Fast motion estimation algorithm and low power CMOS motion estimator for MPEG encoding”, IEICE Tran. on Electronics, vol. E86-C, no. 4, pp. 535 - 545, April 2003 (英語)“Low-power CMOS circuit techniques for motion estimators”, Proc. of 2003 IEEE Int. Symp. on Circuits and Systems (ISCAS’2003), Vol. V, pp. 409-412, May 2003. (英語)、マルチプレクサ(2004年)、等の開発がある。

 ディジタル集積回路の低消費電力化 
 充放電電流による消費電力の削減技術 
LSIの動作時消費電力(Pat)は充放電電流による消費電力(Pcd)と貫通電流による消費電力(Psc)の和である。Pcdは論理ゲート数(G)、クロック周波数(f)、電源電圧(V)の2乗に比例する。fを維持したまま、無条件でPcdを削減する第1の手段はGの削減、第2の手段はクリティカルパスのゲート段数(g)の短縮によるVの降圧、である。
CMOS差分絶対値和回路に2段パイプライン方式を導入し、累算回路部の1/2(上位ビット部)をカウンタに置換することにより、G、gを大幅に削減した。この結果、f(=220MHz)を維持したまま、Vを73%に降圧できた。従って、Pcdが従来形の55.2%に低減された。回路アーキテクチャや信号処理アルゴリズムの改良により、G、gを削減したCMOS平方根回路も開発した。Vを77%に降圧することができたので、f(=570MHz)を維持したまま、Patが従来の27.1%に削減された。本平方根回路はIEEE(米国電気電子学会)ASP-DAC University LSI Design Contest Best Design AwardのSpecial Feature Awardを受賞した(2006年)。

 貫通電流による消費電力の削減技術 
レジスタアレイ “Clock driver design for low-power high-speed 90-nm CMOS register array”, IEICE Tran. on Electronics, vol. E91-C, no. 4, pp. 553-561, April 2008 (英語)を駆動するクロックドライバの「電力削減方法」(特開2003-162558)(2003年)(公開特許公報) 半導体集積回路の消費電力算出方法 - j-platpatを開発した。k段目駆動回路に比べ、(k+1)段目負荷回路が大きな多段のクロックドライバでは負荷回路に流れる貫通電流による消費電力(Psc)が無視できない。1段目プレ回路(1個のインバータ)、2段目駆動回路(m個のインバータ)、3段目負荷回路(N=m・nのインバータ)で構成される3段クロック木を設計・試作して、Pscが最小となる回路構成を解析した。Nを固定して、mを増す(nを減少する)と、駆動回路のPscは徐々に増し、負荷回路のPscは急速に減少する。プレ回路のPscは無視できるほど小さい。一方、プレ回路、駆動回路のPcdは単調増加し、負荷回路のPcdはほぼ一定である。これより、総消費電力(Pat=Pcd+Psc)が最小となるmの値が存在することがわかる。一般的には、Patが最小となるmは約Nの平方根(=n)で与えられる (特開2003-162558)(2003年)。同様に、クロック木の総遅延時間が最小となるmもnとほぼ等しく、その値は約Nの平方根である。

 半導体メモリ 
 データ保持とリーク電流削減を両立する自己制御電圧レベル変換 (SVL) 回路 
スマートフォン、タブレット端末機器、等の携帯機器では待ち受け時(待機時)でもリーク電流が流れ、電力を消費する。この電力を待機時消費電力(Pst)と呼ぶ。電源を切れば、この問題は解決されるが、揮発性メモリ{SRAM、DRAMやDelay Flip-Flop(D-FF)}に記憶されたデータは消失してしまう。この問題を解決するため、待機時のデータ保持とリーク電流削減を両立できる自己制御電圧レベル変換回路(特開2002-288984)(2002年)(特許) 低電力半導体集積回路 - j-platpatを開発した。本回路はSVL(Self-Controllable Voltage Level-conversion)回路 “A self-controllable voltage level (SVL) circuit for low-power, high-speed CMOS circuits”, Proc. of the European Solid-State Circuits Conference (ESSCIRC’2002), C21.05, pp. 411-414, Sept. 2002 (英語)“A self-controllable voltage level (SVL) circuit and its low-power, high-speed CMOS circuit applications”, IEEE Jour. of Solid-State Circuits, Vol. 38, No. 7, pp. 1220 - 1226, July 2003 (英語)と呼ばれ、SRAMやD-FFが動作している時、記憶回路に規格電圧(V)を加え、停止している時、記憶回路にVよりvだけ低い降圧電圧(V-v)を供給する。SVL回路は、Vを供給するpMOSFET(pS)、(V-v)を供給するnMOSFET(nS)、放電用pMOSFET(pSd)で構成される極めて簡単な回路である。記憶回路が停止している時、記憶回路のpMOSFETにバックゲートバイアス(v)が掛かり(内部電界が緩和され)、pMOSFETのしきい値電圧が高くなる。この結果、pMOSFETに流れるリーク電流が減少し、Pstが削減される。同時に記憶データが保持される。さらに読み出しみマージンおよび書き込みマージンも向上する。このように、SVL回路は極めて簡単な回路であるが、その効果は極めて大きい。

 SRAM への適用 
キャッシュメモリに必須なSRAMにSVL回路(M-SVL)を適用した。ワード線電位が0となり、SRAMが待機(データ保持)状態になると、M-SVLのpSmがoff、nSmがonとなり、記憶回路(モリセル)に降圧電圧(V-v)が供給される。今、ノードN1 およびN0の電位をそれぞれ0および(V-v)とすると、U1(pMOSFET)がoffとなる。この時、U1にバックゲートバイアス(v)が掛かり、U1のしきい値電圧が高くなるため、U1に流れるリーク電流が減少する。従って、off 状態のU1およびon状態のD1を介したリーク電流が減少し、Pstが削減される。同時に記憶データが保持される。SVL回路を適用した改良型SRAMのデータ保持マージンは従来形SRAMの59.5%であったが、リーク電流によるPstは大幅に減少し、従来形SRAMの約1/11 (9.17%)となった。
改良型SRAMが書き込みをしている時、メモリセルに降圧電圧(V-v)を、ワード線にVを供給する。書き込みマージンは大幅に改善され、従来型SRAMの1.31倍であった “A large “read” and “write” margins, low leakage power, six-transistor 90-nm CMOS SRAM”, IEICE Tran. on Electronics, vol. E94-C, no. 4, pp. 530-538, April 2011 (英語)。
改良型SRAMが読み出しをしている時、メモリセルにVを、ワード線に(V-v)を供給する。読み出しマージンも大幅に改善され、従来型SRAMの2.09倍であった。なお、SVL回路の面積オーバーヘッドは僅かに1.383%である“Development of a low standby power six-transistor CMOS SRAM employing a single power supply”, IEICE Tran. on Electronics, vol. E101-C, no. 10, pp. 822-830, Oct. 2018 (英語)「動作マージンの拡大とリーク電流の低減を両立した1電源6-Tr CMOS SRAMの開発」、信学技報、VLD2014-160、pp. 43-48、2015年3月2日。

「低リーク電流SRAM」は電子情報通信学会 集積回路専門委員会、第8回システムLSIワークショップの「ポスター賞」(2004年)を、「自己制御電圧レベル変換 (SVL) 回路」は第7回LSI IPデザイン・アワード「研究助成賞」(2005年)を、「データ読み出し・データ書き込み性能を改善したSRAM」は電子情報通信学会、第80回 (2023年度 令和5年度) 「論文賞」(2024年)を受賞した。

 Delay Flip-Flop (D-FF) への適用
パイプラインレジスタやレジスタファイルの基本回路であるD-FFにSVL回路を適用した “Low standby power CMOS delay flip-flop with data retention capability”, Proc. of 2019 IEEE Asia and South Pacific Design Automation Conference (ASP-DAC’2019), Design Contest, 1A-11, pp. 21-22, Tokyo, Japan, Jan. 2019 (英語)。D-FFの記憶回路(ラッチ)はSRAMの記憶回路(モリセル)とほぼ同一の回路構成である。D-FFが待機(データ保持)している時、SVL回路は記憶回路(ラッチ)に降圧電圧(V-v)を供給する。従って、リーク電流によるPstが減少し、同時にデータが保持される。SVL回路を適用した改良型D-FFのデータ保持マージンは従来形D-FFの72%であったが、Pstは大幅に減少し、従来形D-FFの約1/7 (14.81%)となった。なお、SVL回路の面積オーバーヘッドは11.62%である“Single-power-supply Six-transistor CMOS SRAM Enabling Low-voltage Writing, Low-voltage Reading, and Low Standby Power Consumption”, IEICE Tran. on Electronics, vol. E-106-C, no. 9, pp. 466-476, Sept. 2023 (英語)“Development of a low standby power six-transistor CMOS SRAM employing a single power supply”, IEICE Tran. on Electronics, vol. E101-C, no. 10, pp. 822-830, Oct. 2018 (英語)「動作マージンの拡大とリーク電流の低減を両立した1電源6-Tr CMOS SRAMの開発」、信学技報、VLD2014-160、pp. 43-48、2015年3月2日。

 高速GaAs集積回路 
GaAs MESFET回路の基本回路はE/D DCFL(Enhancement/Depletion Direct Coupled FET Logic)回路であるので、動作速度はNANDゲートよりNORゲートの方が速い。この特性を活かして、NORゲートのみで構成したフリップフロップ(D-FF)(1997年)“A low power and high speed 0.25μm GaAs D-FF”, Proc. of 1997 IEEE European Solid-State Circuits Conference (ESSCIRC’97), pp.300-303, Sept. 1997 (英語)“Low-voltage, low-power, high-speed 0.25μm GaAs HEMT delay flip-flops”, IEICE Tran. on Electronics, vol. E83-C, no. 11, pp. 1776 - 1787. Nov. 2000 (英語)を開発した。さらに3.2GHz PLLクロック発生器(1994年)“Design of a 3.2GHz 50mW 0.5μm PLL-based clock generator with 1V power supply”, IEICE Tran. on Electronics, vol. E77-C, no. 12, pp. 1957-1965, Dec. 1994 (英語)を始め、500MHz RISCプロセッサ(1997年)「1W 500MHz 24b GaAs RISCプロセッサの設計」、1997年電子情報通信学会総合大会、エレクトロニクス講演論文集2、C-10-24、p.115、1997年3月、1.67GHz 加算回路(1999年)“A high speed, low power 16bit 0.25μm GaAs binary look-ahead carry (BLC) adder based on NOR gates for wireless communication”, Proc. of 1999 IEEE MTT-S Int. Topical Symp. on Technologies for Wireless Applications (ITSTWA’99), T4.4, pp. 151-155, Feb. 1999 (英語)“Designs of building blocks for high-speed, low-power processors”、IEICE Tran. on Electronics, vol. E85-C, no. 2, pp. 331 - 338, Feb. 2002 (英語)、3.5GOPS 動きベクトル検出回路(1999年)、8:1MUX/1:8 DEMUX(20001年)、等の超高速ディジタルLSIやアナログ回路である1.54GHz 演算増幅回路(1994年)を開発した。待機時のリーク電流を削減するため、DC/DCレベル変換回路(1995年) “A dynamically controllable DC/DC level converter and its application to high speed, low power circuits”, Proc. of 2000 IEEE European Solid-State Circuits Conference (ESSCIRC’2000), pp. 60-63, Sept. 2000 (英語)“A dynamically controllable DC/DC level converter and its application to high speed, low power circuits”, Proc. of 2000 IEEE European Solid-State Circuits Conference (ESSCIRC’2000), pp. 60-63, Sept. 2000 (英語]
も開発した。これをSRAM(1996年)“(Invited Paper) Low power design technology for digital LSIs”, IEICE Tran. on Electronics, vol. E79-C, no. 12, pp. 1639 - 1649, Dec. 1996 (英語)、レジスタファイル(2000年)に適用した結果、待機時のデータ保持と低電力化が同時に得られるようになった。

 著書 
 単著 
 『CMOS集積回路 -入門から実用まで-』CMOS集積回路 -入門から実用まで-CMOS集積回路 -入門から実用まで-CMOS集積回路 -入門から実用まで- 培風館、pp.1-229、1996年10月30日、ISBN 4-563-03510-6。
 『ナノCMOS集積回路』ナノCMOS集積回路ナノCMOS集積回路ナノCMOS集積回路培風館、pp.1-277、2010年05月11日、ISBN 978-4-563-06776-2。
 『画像LSIシステム設計技術』画像LSIシステム設計技術画像LSIシステム設計技術画像LSIシステム設計技術コロナ社、pp.1-319、2003年09月08日、ISBN 978-4-339-01263-7。
 第21回電気通信普及財団テレコムシステム技術賞 (2006年)「(著書) 画像LSIシステム設計技術

 共著 
 古川静二郎 (編著)、『SOI構造形成技術』SOI構造形成技術SOI構造形成技術産業図書、1987年10月23日、ISBN 978-4-7828-5625-3（分担箇所：第8.1節「張り付け法による各種LSI形成技術」、pp.193-203)。
 電子情報通信学会 (編)、堀口勝治 (編著)、『ULSI設計技術』ULSI設計技術ULSI設計技術ULSI設計技術コロナ社、1993年8月20日、ISBN 978-4-88552-116-4（分担箇所：第5章「DSP設計技術」、pp.139-185)。
 電子情報通信学会 (編)、『電子情報通信ハンドブック』電子情報通信ハンドブック電子情報通信ハンドブックオーム社、1998年11月、ISBN 978-4-274-03514-2、(分担箇所：6.2編「高速化技術、パイプライン処理 (集積回路の)」、pp. 684-685 および6.5編、「信号・データ処理LSI、概要、動画像処理用DSP、最近の動画像圧縮 (符号化) LSI技術」、pp.721-731)。
 映像情報メディア学会 (編)、『映像情報メディア工学大事典』映像情報メディア工学大事典映像情報メディア工学大事典オーム社、2010年6月15日、ISBN 978-4274208690 （分担箇所：技術編、第4部門、画像半導体技術、第1章「概要 動画像符号化プロセッサの歴史と将来展望」、pp. 258-269)。

 代表的な論文 
 光誘起伝導 
 [01] “Photoconductance and luminescence in zinc-sulfide due to infrared stimulation”, 学位論文 (Ph. D. Dissertation), Tadayoshi Enomoto, Ohio State University, pp. 1-162, Mar. 20, 1975.
 [02] “Long‐wavelength infrared stimulation of luminescence in ZnS”, Phys. Stat. Sol. (a), Vol. 32, pp. 269-278, Nov. 16, 1975.
 [03] “Relation between IR Induced Photo-conductivity and IR Stimulated Luminescence in ZnS”, Solid-State Electrics，Pergamon Press, vol. 19, no. 10, pp. 883-890, Oct. 1976..
 [04] “Investigation on trap distribution and photoelectronic effect due to UV, IR and visible light excitation in self-activated ZnS crystals”, Journal of Physics and Chemistry of Solids, Pergamon Press, Vol. 38, No. 3, pp. 247-253, 1977.
 集積回路製造技術 
 [05] “Fabrication process, experimental results and application for an elemental level vertically integrated circuit (ELVIC)”, Material Research Society, J. of Materials Research，vol. 1, no. 4, pp. 552-559, Aug. 1986“Fabrication process, experimental results and application for an elemental level vertically integrated circuit (ELVIC)”, Material Research Society, J. of Materials Research，vol. 1, no. 4, pp. 552-559, Aug. 1986. (英語).
 アナログ集積回路 
 [06]「集積化アナログ自動等化器」、電子情報通信学会、論文誌、vol. J65-C、no. 11、pp. 937-944、1982年11月集積化アナログ自動等化器」、電子情報通信学会、論文誌、vol. J65-C、no. 11、pp. 937-944、1982年11月。。
 [07] “Single-chip adaptive transversal filter IC employing switched capacitor technology”, IEEE, J. of Selected Areas in Communications, SAC-2, no. 2, pp. 324-333, Mar. 1984  “Single-chip adaptive transversal filter IC employing switched capacitor technology”, IEEE, J. of Selected Areas in Communications, SAC-2, no. 2, pp. 324-333, Mar. 1984(英語). 
 ディジタル集積回路 
 [08] “A 200-MHz 16-bit super high-speed signal processor (SSSP) LSI”, IEEE, J. of Solid-State Circuits, vol. SC-24, no. 6, pp.1668-1674, Dec. 1989. 

 [10] “A 2K-word dictionary search processor (DISP) LSI with an approximate word search capability”, IEEE, Jour. of Solid-State Circuits, vol. 27, no. 6, pp. 883-891, June 1992.
 動画像符号化プロセッサ 
 [11] “A micro programmable real-time video signal processor (VSP) LSI”, IEEE, J. of Solid-State Circuits, vol. SC-22, no. 6, pp. 1117-1123, Dec. 1987 .
 [12] “A micro programmable real-time video signal processor (VSP) for motion compensation”, IEEE, J. of Solid-State Circuits, vol. SC-23, no. 4, pp. 907-915, Aug. 1988.

 [14] “A 300-MHz 16-b BiCMOS video signal processor”, IEEE, Jour. of Solid-State Circuits, vol. 28, no. 12, pp. 1321-1330, Dec. 1993.
 [15] “(Invited Paper) High-throughput technologies for video signal processor (VSP) LSIs”, IEICE, Tran. on Electronics, vol. E79-C, no. 4, pp. 459 - 471, April 1996.
 [16]「(招待論文) 動画像符号化プロセッサの歴史と将来展望」電子情報通信学会、論文誌(エレクトロニクス)、vol. J92-C、no. 8、エレクトロニクスソサイエティ和文論文誌500号記念論文特集、pp. 477-487、2009年8月。
 動画像符号化アルゴリズム 
 [17] “Fast motion estimation algorithm and low power CMOS motion estimator for MPEG encoding”, IEICE, Tran. on Electronics, vol. E86-C, no. 4, pp. 535 - 545, April 2003.
 [18] “A multiple block-matching Step (MBS) algorithm for H.26x/MPEG4 motion estimation and a low-power CMOS absolute differential accumulator circuit”, IEICE, Tran. on Electronics, vol. E90-C, no. 4, pp. 718-726, April 2007.
 [19] “Stick-Shaped Window Search (SSWS)” Block Matching Algorithm for Motion Vector Estimation”, Proc. of 2010 IEEE Int. Conference on Signal Processing (ICSP’2010), pp. 1117-1120, Beijing, China, Oct. 2010.
 [20] “A low power multimedia processor implementing dynamic voltage and frequency scaling technique and fast motion estimation algorithm called “adaptively assigned breaking-off condition (A2BC)”, IEICE, Tran. on Electronics, vol. E96-C, no. 4, pp. 424-432, April 2013.
 集積回路の低電力化技術 
 [21] “A self-controllable voltage level (SVL) circuit and its low-power, high-speed CMOS circuit applications”, IEEE, Jour. of Solid-State Circuits, Vol. 38, no. 7, pp. 1220 - 1226, July 2003.
 [22] “Clock driver design for low-power high-speed 90-nm CMOS register array”, IEICE, Tran. on Electronics, vol. E91-C, no. 4, pp. 553-561, April 2008.
 [23] “Low dynamic power and low leakage power techniques for CMOS square-root circuit”, IEICE, Tran. on Electronics, vol. E92-C, no. 4, pp. 409-416, April 2009.
 [24] “Development of a low standby power six-transistor CMOS SRAM employing a single power supply”, IEICE, Tran. on Electronics, vol. E101-C, no. 10, pp. 822-830, Oct. 2018.
 [25] “Low standby power CMOS delay flip-flop with data retention capability”, Proc. of 2019 IEEE Asia and South Pacific Design Automation Conference (ASP-DAC’2019), Design Contest, 1A-11, pp. 21-22, Tokyo, Japan, Jan. 2019.
 [26] “Single-power-supply six-transistor CMOS SRAM enabling low-voltage writing, low-voltage reading, and low standby power consumption”, IEICE Tran. on Electronics, vol. E-106-C, no. 9, pp. 466-476, Sept. 2023.
 [27] “A low dynamic power and low leakage power 90nm CMOS square-root circuit”, Proc. of 2006 IEEE Asia and South Pacific Design Automation Conference (ASP-DAC’2006), 1D-1, pp. 90-91, Jan. 2006.

他の論文：
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 代表的な特許 
 集積回路の製造技術 
 [01] United States Patent No. US4,612,083A 1986年09月16日 “Process of fabricating three-dimensional semiconductor device” (3D-IC製造技術)
 アナログ集積回路 
 [02] 日本国特許 特開昭58-003334 1983年01月10日「自動等化器」
 ディジタル集積回路 
 [03] European Patent No. EP0,207,462A2 1985年06月28日 “Comparator circuit” (比較回路)
 [04] Canada Patent No. CA1,257,003A 1989年07月04日 “Arithmetic circuit” (差分絶対値和回路)
 [05] United States Patent No. US4,849,921A 1989年07月18日 “Arithmetic circuit” (差分絶対値和回路)
 [06] United States Patent No. US4,985,861A 1991年01月15日 “High speed digital signal processor for signed digit numbers” (冗長二進数差分絶対値和回路)
 [07] 日本国特許 特開平10-2691971998年10月09日「多入力演算器」(差分絶対値和回路)
 動画像符号化アルゴリズム 
 [08] 日本国特許 特開平05-3004941993年11月12日「(並列・パイプライン)動画像符号化器とその制御方式」
 [09] United States Patent No. US5,394,189A1995年02月28日 “Motion picture coder and system for controlling the same (並列・パイプライン動画像符号化処理方式)”
 [10] 日本国特許 特開平10-2715141998年10月09日「動画像情報の信号処理方法(中断法)及びその装置」
 [11] 日本国特許 特開2005-1304242005年05月19日「動画像情報の信号処理方法(AABCS法)」
 [12] 日本国特許 特開2013-0269662013年02月04日「ブロックマッチング処理回路およびブロックマッチング処理方法(SSWS法)」
 集積回路の低消費電力化技術 
 [13] 日本国特許 特開2002-2889842002年10月04日「低電力半導体集積回路(SVL回路)」
 [14] 日本国特許 特開2003-1625582003年06月06日「半導体集積回路の(貫通電流による)消費電力算出方法」

他の特許外国・国内特許 - Google Patents 外国・国内特許 - reserchmap国内特許 - J-GLOBAL

 受賞・表彰 
 日本国外 
 Ohio State University (オハイオ州立大学) 
 『オハイオ州立大学フェローシップ (4-year Ohio State University Fellowship)』 1970年10月〜1974年9月 Ohio State University
 本フェローシップは博士号 (Ph. D.) 取得に必要な生活費を支給すると共に授業料も免除する (This four-year scholarship is designed to enable us to complete a research program leading to a Ph. D. The scholarship includes all stipend and tuition fees for the entire four-year period)
 IEEE (Institute of Electrical and Electronics Engineers; IEEE) (米国 電気電子学会) 
 『IEEE JSSC 最優秀論文賞 (1992 Best Paper Award of IEEE Journal of Solid-State Circuits)』 1993年2月 IEEE Solid-State Circuits Council
 受賞論文 “A 2K-word Dictionary Search Processor (DISP) LSI with an Approximate Word Search Capability”, IEEE Journal of Solid-State Circuits, vol. 27, no. 6, pp 883 - 891, June 1992
 『IEEE フェロー (IEEE Fellow)』“IEEE Fellow” 1998年1月 IEEE
 選出理由 「マルチメディア向けマイクロプロセッサLSIの先駆的開発への貢献 (for contributions to the development of integrated circuits for multimedia)」
 『IEEE ASP-DAC最優秀LSI設計賞 (IEEE Asia and South Pacific Design Automation Conference University LSI Design Contest Best Design Award; Special Feature Award)』 2006年1月 IEEE ASP-DAC
 受賞論文 “A Low Dynamic Power and Low Leakage Power 90nm CMOS Square-Root Circuit”, Proc. of 2006 IEEE ASP-DAC, 1D-1, pp. 90 - 91, Yokohama, Japan, Jan. 25, 2006
 『IEEE 生涯フェロー (IEEE Life Fellow)』 2012年1月 IEEE
 選出理由 「永年にわたるIEEEへの支援とその発展への貢献 (in recognition of the many years of loyal membership and support of the activities of IEEE)」
 MORIS (Magneto-Optical Recording International Symposium) 
 『感謝状 (Letter of thanks for contribution to administration of MORIS)』 2006年6月 MORIS Steering CommitteeMagneto-Optical Recording International Symposium

 日本国内 
 電子情報通信学会 
 『電子情報通信学会 論文賞』(第80回 2023年度 令和5年度) 2024年6月 電子情報通信学会
 受賞論文 “Single-power-supply Six-transistor CMOS SRAM Enabling Low-voltage Writing, Low-voltage Reading, and Low Standby Power Consumption”, IEICE Tran. on Electronics, vol. E-106-C, no. 9, pp. 466-476, Sep. 2023
 『電子情報通信学会 業績賞』(第33回 1995年度 平成7年度) 1996年5月 電子情報通信学会
 受賞理由 「マルチメディアに向けた動画像プロセッサLSIの研究・開発」榎本忠儀、山田八郎、「マルチメディアに向けた動画像プロセッサLSIの研究・開発」、電子情報通信学会誌、vol. 79、No. 6、p. 551、1996年6月25日
 『電子情報通信学会 功績賞』(第86回 2024年度 令和6年度) 2025年6月 電子情報通信学会
 受賞理由 「半導体集積回路(LSI)とこれを応用したシステムに関する研究・開発・実用化への貢献および多数の優秀な半導体技術者を産業界に送り出した実績」
 『電子情報通信学会 システムLSIワークショップ 最優秀ポスター賞』 2004年11月 電子情報通信学会 集積回路専門委員会集積回路研究専門委員会
 受賞論文 「CMOSスイッチ2個でリーク電流削減とデータ保持を両立」低リーク電流SRAMの開発、第8回システムLSIワークショップ、信学会、集積回路研究会、予稿集、pp. 231-234、2004年11月29-30日
 『電子情報通信学会 フェロ−』電子情報通信学会フェロ−13年度フェロー称号贈呈式記念写真集 エレクトロニクスソサイエティ会場の贈呈者 2001年9月 電子情報通信学会
 選出理由 「動画像符号化プロセッサと動画像符号化アルゴリズムの先駆的開発と実用化への貢献」
 『電子情報通信学会 終身会員』 2013年1月 電子情報通信学会
 選出理由「電子情報通信学会への長年にわたる支援と同学会の発展に貢献した業績」
 『電子情報通信学会 名誉員』2026年 電子情報通信学会
 選出理由「半導体集積回路(LSI)とこれを応用したシステム技術に関する研究・開発・実用化への貢献、多数の優秀な半導体技術者を産業界に送り出した実績および長年にわたる電子情報通信学会への支援と同学会の発展への貢献」

 電気通信普及財団 
 『電気通信普及財団賞』(テレコムシステム技術賞 入賞)(第21回) 2006年3月 電気通信普及財団
 受賞著作「(著書) 画像LSIシステム設計技術」
 IPアワード運営委員会 
 『LSI IPデザイン・アワード研究助成賞』 2005年5月 IPアワード運営委員会
 選出理由 「高性能自己制御電圧レベル変換回路の開発」
 日本大学 
 『日本大学 総長賞』 1968年3月 日本大学
 『日本大学 稲田賞』 1968年3月 日本大学理工学部電気工学科
 本賞は専門科目 (電気工学) の成績優秀者に贈呈される賞で、本学科の稲田金次郎教授稲田金次郎にちなんで稲田賞と名付けられた
 『日本大学 学会・協会賞受賞者にたいする表彰』 1996年 1999年 2001年2005年 2006年 2025年 日本大学理工学部
 日本電気 (NEC) 
 『日本電気 功績賞』「高速自動等化器集積回路の研究・開発」 1982年6月 日本電気 (NEC)
 『日本電気 功績賞』「新超LSI積層プロセス技術 (ELVIC技術) の研究」 1985年5月 日本電気 (NEC)
 『日本電気 功績賞』「実時間動画像処理プロセッサの研究開発」“A Realtime Microprogramable Video Signal LSI”, Digest of Tech. Paper, 1987 IEEE Int. Solid-State Circuits Conference (ISSCC’87), THPM15.3, pp. 184-185, 393, New York, NY, Feb. 1987 1988年2月 日本電気 (NEC)
 中央大学 
 『中央大学 学術研究奨励賞』「新しい分野のLSIの実現方式の研究」 1994年3月 中央大学「中央大学学術研究表彰」について
 『中央大学 学術研究奨励賞』「マルチメディアに向けた動画像プロセッサLSIの研究・開発」 1997年3 中央大学
 『中央大学 学術研究奨励賞』「動画像プロセッサLSIの研究」 1999年3月 中央大学
 『中央大学 学術研究奨励賞』「動画像符号化LSIの先駆的な研究」 2002年3月 中央大学
 『中央大学 学術研究奨励賞』「リーク電流削減回路の研究」 2005年3月 中央大学
 『中央大学 学術研究奨励賞』「画像LSIシステム設計技術」 2007年3月 中央大2006年度中央大学学術研究奨励賞受賞者一覧
 『中央大学 名誉教授』 2014年3月 中央大学

 メディア報道 
 アナログ集積回路 
 [01]「2重分割電極型CCDを用いた世界初のPCMコーデック用音声チャネルフィルタを開発」(1979年12月6日)、日経エレクトロニクス (1980年1月21日/p. 94)。
 [02]「デジタル通信に向けた自動等化器を世界に先駆けて1チップ集積化に成功」(1982年2月11日)、日経エレクトロニクス (1982年4月12日/pp. 98-102)。
 [03]「微細加工技術を用いた世界初のnMOSオペアンプを開発」(1982年2月18日)、電子材料 (1982年6月/p. 19)。
 3次元デバイス 
 [04]「超LSI積層プロセスを世界に先駆けて開発 - 3次元デバイス(3D-IC)へ布石 -」(1984年12月4日)、朝日新聞 (12月6日/夕刊)、毎日新聞 (12月4日/朝刊)、読売新聞 (12月4日/朝刊)、日本経済新聞 (12月4日/朝刊)、日刊工業新聞 (12月4日/朝刊)、日本工業新聞 (12月4日/朝刊)、電波新聞 (12月4日/朝刊)、サンケイ新聞 (12月4日/朝刊)、化学工業日報 (12月4日/朝刊)、The Japan Times (12月5日/朝刊)、日経エレクトロニクス (12月17日/no. 358、p. 144)、電子情報通信学会会誌 (3月/vol. 68、no. 3、pp. 318-319)、電気学会会誌 (4月/vol. 105、no. 4、pp. 361-362)、他。
 [05] 「レーザアニールSOIにデジタル回路の開発に世界で初めて成功」(1985年4月)、Electronics Week (April 8, 1985/ pp. 16-17)、ニュートン (1986年12月/vol. 6、no. 12、p. 79)、他。
 半導体メモリ 
 [06] 「世界最高速 (5n秒) 1Mbit ECL Bi-CMOS SRAMの開発に成功」(1990年2月16日)“(Invited Paper) Reviews and prospects of SRAM technology”, IEICE Trans. on Electronics, Vol. E74, No. 4, pp. 119-129, April 1991、日経産業新聞 (2月16日/朝刊4面)、産経新聞 (2月16日/夕刊)、日刊工業新聞 (2月12日/朝刊7面)、日刊工業新聞 (2月16日/朝刊11面)、電波新聞 (2月16日/朝刊6面)、電気新聞 (2月16日/夕刊)、電子情報通信学会会誌 (4月/ Vol. 73、No. 4、p. 440)、他。
 ディジタル集積回路 
 動画像符号化プロセッサ 
 [07]「多彩な動画像処理を実時間(リアルタイム)で実現できるマイクロプログラマブル動画像処理プロセッサLSIを世界に先駆けて開発」(1987年2月28日)、日本経済新聞 (2月28日/朝刊7面)、日刊工業新聞 (2月28日/朝刊11面)、日本工業新聞 (2月28日/朝刊1面)、電波新聞 (2月28日/朝刊6面)、電気新聞 (3月6日/朝刊5面)、化学工業新聞 (3月2日朝刊5面)、日経データプロ・マイコン (3月/速報版、pp. 5-6)、日経エレクトロニクス (5月4日/ no. 420、pp. 117-122)、他。
 [08] 「動画像を高速処理する並列プロセッサシステムの開発 -超大型電算機に匹敵-」(1987年11月18日)“A Real-time Video Signal Processor Suitable for Motion Picture Coding Applications”, IEEE, Tran. on Circuits and Systems，vol. CAS-36, no. 10, pp. 1259-1266, Oct. 1989.、日経産業新聞 (11月18日)
 [09] 「世界最高速 (200MHz) のディジタル信号処理プロセッサLSIの開発に成功」(1989年2月15日)“200MHz 16bit BiCMOS Signal Processor”, Digest of Tech. Paper, 1989 IEEE Int. Solid-State Circuits Conference (ISSCC’89), THPM12.8, pp. 172-173, 330, New York, NY, Feb. 1989、日本経済新聞 (2月15日/朝刊8面)、日経産業新聞 (2月15日/朝刊5面)、産経新聞 (2月15日/朝刊3面)、日刊工業新聞 (2月15日/朝刊8面)、日本工業新聞 (2月15日/朝刊5面)、日本工業新聞 (2月27日/朝刊7面)、電波新聞 (2月15日/朝刊1面)。
 [10] 「世界最高速 (250MHz) のビデオ信号処理プロセッサLSIの開発に成功」(1991年2月13日)“A 250MHz 16bit 1million Transistor BiCMOS Super High Speed Video Signal Processor”, Digest of Tech. Paper, 1991 IEEE Int. Solid-State Circuits Conference (ISSCC’91), FP15.4, pp. 254-255, 325, San Francisco, CA, Feb. 1991.、日経産業新聞 (2月18日/朝刊)、産経新聞 (2月18日/朝刊9面)、日刊工業新聞 (2月13日/朝刊11面)、日本工業新聞 (2月13日/朝刊5面)、電波新聞 (2月13日/朝刊8面)、半導体産業新聞 (2月13日/朝刊)、The Japan Times (2月16日/朝刊)、Electronic Engineering Times (2月25日)、Electronic World News (3月13日)、日経エレクトロニクス (2月18日/no. 520、pp. 139 - 140)、他。
 [11] 「ブロック単位の並列・パイプライン処理符号化方式を採用した300MHz超高速動画像符号化処理プロセッサLSIの開発に世界で初めて成功」(1993年2月23日)“A 300MHz 16bit BiCMOS Video Signal Processor”, Digest of Tech. Paper, 1993 IEEE Int. Solid-State Circuits Conference (ISSCC’93), WP2.6, pp. 37-38, 258, San Francisco, CA, Feb. 1993、電波新聞、電気新聞、日刊工業新聞、日本工業新聞
 [12] 「マルチメディア双方向ワイアレス通信を支える撮像素子搭載の動画像符号化LSIの研究で財団法人電気通信普及財団より研究調査助成金を受ける」(2001年4月23日)、電波タイムズ (4月23日/朝刊4面)。
 データ検索プロセッサ 
 [13] 「従来より1,000倍速い超高速LAN用情報検索プロセッサLSの開発に成功」(1988年5月21) 「機能メモリのアーキテクチャとその並列計算への応用：2. 集積回路技術からみた機能メモリの現状と展望」、情報処理、Vol. 32、No. 12、pp. 1239-1248、1991年12月.、朝日新聞 (5月21日)
 [14] 「160キロビット連想メモリを搭載した辞書検索プロセッサ (DISP) の開発に成功」(1990年2月16日)“A 1.2million Transistor, 33MHz 20bit Dictionary Search Processor with a 160kbit CAM”, Digest of Tech. Paper, 1990 IEEE Int. Solid-State Circuits Conference (ISSCC’90), THAM5.4, pp. 90-91, 271, San Francisco, CA, Feb. 1990、毎日新聞 (2月16日/朝刊1面)、日経産業新聞 (2月16日/朝刊4面)、産経新聞 (2月16日/朝刊1面)、日刊工業新聞 (2月16日/朝刊11面)、日本工業新聞 (2月16日/朝刊1面)、電波新聞 (2月16日/朝刊6面)、電気新聞 (2月16日/夕刊)、東京タイムズ (2月16日/夕刊)、日刊工業新聞 (2月12日/朝刊7面)、日経データプロ・マイコン速報版 (3月/焦点、No. 2、p. 32)、電子情報通信学会会誌 (4月/ Vol. 73、No. 4、p. 441)、他。
 ベクトルパイプライン処理プロセッサ 
 [15] 「不動小数点演算 (毎秒2億回) が可能なスーパコンピュータ用ベクトルパイプライン処理プロセッサLSIの開発に世界で初めて成功」(1991年2月14日)“A 200MFLOPS 100MHz 64bit BiCMOS Vector-Pipelined Processor”, Digest of Tech. Paper, 1991 IEEE Int. Solid-State Circuits Conference (ISSCC’91), FP15.5, pp. 256-257, 325, San Francisco, CA, Feb. 1991、朝日新聞 (2月14日/朝刊3面)、東京新聞 (2月14日/朝刊)、日本経済新聞 (2月12日/夕刊08面)、日本経済新聞 (2月14日/朝刊11面)、日本経済新聞 (2月18日/朝刊17面)、日経産業新聞 (2月14日/朝刊01面)、日経産業新聞 (2月14日/朝刊05面)、日刊工業新聞 (2月14日/朝刊09面)、日本工業新聞 (2月14日/朝刊05面)、日本工業新聞 (2月22日/朝刊06面)、電波新聞 (2月14日/朝刊01面)、電気新聞 (2月14日/朝刊)、他。

 社会活動 
 IEEE (米国電気電子学会) 
 Transactions on Very Large Scale Integration (VLSI), Associate Editor (1997-1999)
 Journal of Solid-State Circuits, Associate Editor (2000-2003)
  電子情報通信学会 (信学会) 
 エレクトロニクス研究グループ、運営委員会、委員 (1993年5月-1997年4月)
 集積回路研究専門委員会、幹事 (1987年5月-1991年4月)、副委員長 (1991年5月-1993年4月)、委員長 (1993年5月-1995年4月)、顧問 (1995年5月-)
 電子デバイス研究専門委員会、委員 (1991年5月-1993年4月)、副委員長 (1993年5月-1995年4月)、委員長 (1995年5月-1997年4月)、顧問 (1997年5月-2002年4月)
 英文論文誌 (エレクトロニクス)、大会特集編集委員会、委員 (1988年4月号、1988年10月号、1989年10月号、1990年4月号)
 和文論文誌 (エレクトロニクス)、小特集編集委員会、委員 (1989年2月号、1989年5月号)
 英文論文誌 (エレクトロニクス)、小特集編集委員会、委員 (1991年4月号、1991年11月号、1992年11月号、1993年5月号、1993年11月号、1994年5月号、1994年11月号、1995年7月号、1996年5月号、1996年7月号、1997年12月号、1998年5月号)、アドバイザー (2002年2月号)
 英文論文誌 (エレクトロニクス)、編集委員会、委員 (1991年5月-1995年4月)、アドバイザリー (1993年5月-1997年4月)、顧問 (1995年5月-1997年4月)
 英文論文誌 (エレクトロニクス)、小特集編集委員会、委員長
 「高性能ASICとカーエレクトロニクス」、1993年12月号「高性能ASICとカーエレクトロニクス」
 「マルチメディアに向けた低消費電力LSI技術」、1995年12月号「マルチメディアに向けた低消費電力LSI技術」
 「LSIの低電圧・低消費電力化技術」、1996年12月号「LSIの低電圧・低消費電力化技術」
 「ディープサブミクロン時代のシステムLSIに向けた低電力、低リーク、低電圧及び高速化技術」、2009年4月号「ディープサブミクロン時代のシステムLSIに向けた低電力、低リーク、低電圧及び高速化技術」
 中央大学 
 理工学部 情報工学科 学科長 (1995年、2004年)
 理工学研究所 運営委員 (1992年-1996年、2005年-2014年)
 経産省 工業技術院 次世代産業基盤開発制度 新機能素子協会 
 三次元回路素子開発研究員 (1982年-1986年)
  日本国際賞 
 受賞候補者推薦委員 (2007年-2016年)
  最高裁判所 
 知的財産高等裁判所 専門委員 (2008年-2012年)

 脚注 

Category:日本大学出身の人物
Category:オハイオ州立大学出身の人物
Category:Doctor取得者
Category:日立製作所の人物
Category:日本電気の人物
Category:中央大学の教員
Category:日本の電子工学者
Category:IEEEフェロー
Category:生年未記載
Category:存命人物