Архитектура процессоров

ФГОУ СПО «Ярославский промышленно-экономический техникум»







Архитектура процессоров

реферат

по учебной дисциплине 

«Технические средства информатизации»

Р 230103.08АСУ.42





Студент 

Д.В. Щевелёв



Преподаватель

Д.А. Макеев











Большинство современных процессоров для персональных компьютеров, в общем, основаны на той или иной версии циклического процесса последовательной обработки информации, изобретённого Джоном фон Нейманом.  Джон фон Нейман придумал схему постройки компьютера в 1946 году. 

 	Отличительной особенностью архитектуры фон Неймана является то, что инструкции и данные хранятся в одной и той же памяти. 

Этапы цикла выполнения: 

Процессор выставляет число, хранящееся в регистре счётчика команд, на шину адреса, и отдаёт памяти команду чтения; 

Выставленное число является для памяти адресом; память, получив адрес и команду чтения, выставляет содержимое, хранящееся по этому адресу, на шину данных, и сообщает о готовности; 

Процессор получает число с шины данных, интерпретирует его как команду (машинную инструкцию) из своей системы команд и исполняет её; 

Если последняя команда не является командой перехода, процессор увеличивает на единицу (в предположении, что длина каждой команды равна единице) число, хранящееся в счётчике команд; в результате там образуется адрес следующей команды; 

И далее с начала цикла…

Данный цикл выполняется неизменно, и именно он называется процессом (откуда и произошло название устройства). 

Во время процесса процессор считывает последовательность команд, содержащихся в памяти, и исполняет их. Такая последовательность команд называется программой и представляет алгоритм полезной работы процессора. Очерёдность считывания команд изменяется в случае, если процессор считывает команду перехода — тогда адрес следующей команды может оказаться другим. Другим примером изменения процесса может служить случай получения команды останова или переключение в режим обработки аппаратного прерывания. 

Команды центрального процессора являются самым нижним уровнем управления компьютером, поэтому выполнение каждой команды неизбежно и безусловно. 

Скорость перехода от одного этапа цикла к другому определяется тактовым генератором. Тактовый генератор вырабатывает импульсы, служащие ритмом для центрального процессора. Частота тактовых импульсов называется тактовой частотой. 



Конвейерная архитектура (pipelining) была введена в центральный процессор с целью повышения быстродействия. Обычно для выполнения каждой команды требуется осуществить некоторое количество однотипных операций, например: выборка команды из ОЗУ, дешифрация команды, адресация операнда в ОЗУ, выборка операнда из ОЗУ, выполнение команды, запись результата в ОЗУ. Каждую из этих операций сопоставляют одной ступени конвейера. Например, конвейер микропроцессора с архитектурой MIPS-I содержит четыре стадии: 

получение и декодирование инструкции (Fetch) 

выполнение арифметических операций (Arithmetic Operation) 

адресация и выборка операнда из ОЗУ (Memory access) 

сохранение результата операции (Store) 

Факторы, снижающие эффективность конвейера: 

простой конвейера, когда некоторые ступени не используются (напр., адресация и выборка операнда из ОЗУ не нужны, если команда работает с регистрами); 

ожидание: если следующая команда использует результат предыдущей, то последняя не может начать выполняться до выполнения первой (это преодолевается при использовании внеочередного выполнения команд, out-of-order execution); 

очистка конвейера при попадании в него команды перехода (эту проблему удаётся сгладить, используя предсказание переходов). 

Некоторые современные процессоры имеют более 30 ступеней в конвейере, что увеличивает производительность процессора, однако приводит к большому времени простоя (например, в случае ошибки в предсказании условного перехода.) 



Есть так же Суперскалярная архитектура

Способность выполнения нескольких машинных инструкций за один такт процессора. Появление этой технологии привело к существенному увеличению производительности. 





CISC-процессоры

Complex Instruction Set Computing — вычисления со сложным набором команд. Процессорная архитектура, основанная на усложнённом наборе команд. Типичными представителями CISC является семейство микропроцессоров Intel x86 (хотя уже много лет эти процессоры являются CISC только по внешней системе команд) 



RISC-процессоры

Reduced Instruction Set Computing (technology) — вычисления с сокращённым набором команд. Архитектура процессоров, построенная на основе сокращённого набора команд. Характеризуется наличием команд фиксированной длины, большого количества регистров, операций типа регистр-регистр, а также отсутствием косвенной адресации. Концепция RISC разработана Джоном Коком (John Cocke) из IBM Research, название придумано Дэвидом Паттерсоном (David Patterson). 



Самая распространённая реализация этой архитектуры представлена процессорами серии PowerPC, включая G3, G4 и G5. Довольно известная реализация данной архитектуры — процессоры серий MIPS и Alpha. 



Многоядерные процессоры



Содержат несколько процессорных ядер в одном корпусе (на одном или нескольких кристаллах). 

Процессоры, предназначенные для работы одной копии операционной системы на нескольких ядрах представляют собой высокоинтегрированную реализацию системы «Мультипроцессор». 



На данный момент массово доступны процессоры с двумя и четырех ядрами в частности Intel Core 2 Duo и Intel Core 2 Quad на ядре Kentsfield





Параллельная архитектура



Архитектура фон Неймана обладает тем недостатком, что она последовательная. Какой бы огромный массив данных ни требовалось обработать, каждый его байт должен будет пройти через центральный процессор, даже если над всеми байтами требуется провести одну и ту же операцию. Этот эффект называется узким горлышком фон Неймана. 





Для преодоления этого недостатка предлагались и предлагаются архитектуры процессоров, которые называются параллельными. Параллельные процессоры используются в суперкомпьютерах. 

Возможными вариантами параллельной архитектуры могут служить (по классификации Флинна): 

SISD — один поток команд, один поток данных; 

SIMD — один поток команд, много потоков данных; 

MISD — много потоков команд, один поток данных; 

MIMD — много потоков команд, много потоков данных. 



Развитием архитектуры VLIW/EPIC в мире занимаются всего четыре компании: Intel, Transmeta, IBM и «Эльбрус». Есть исследовательские проекты, например, в Университете Северной Каролины, были и попытки создания коммерческих VLIW-процессоров в первой половине 80-х, но они опередили свое время. Новых за два-три года появиться не может — требуется слишком высокий уровень квалификации. IBM, судя по всему, не форсирует лабораторные разработки процессора ForestaPC, который проектируется уже 13 лет.









































































Список литературы:



Богачев К.Ю.  «Архитектура процессоров»

ru.wikipedia.org

www.lab-vm.ru

и другие электронные справочники