Newsgroup: it.comp.hardware.video-3d
Titolo: 4 pipe, 8 pipe...

Dunque, come tutti sanno le 9800SE si softmoddano a 9800pro abilitando
anche le 4 pipe non utlizzate. Come tutti sanno i chip sulle 9800SE
altro non sono che normali chip 9800pro provenienti da wafer che non
hanno passato i test di perfetta funzionalità.
Tuttavia, diciamo che su una 9800SE due pipeline non vanno. Come sanno
quali pipeline utilizzare? Le provano e poi le settano scheda per
scheda? Non mi pare pratico. E allora come fanno? Illuminatemi,
grazie.

 scheda? Non mi pare pratico. E allora come fanno? Illuminatemi,
Faranno test a campione, come AMD con gli Athlon -> Duron e intel con i
P4 -> Celeron.
-- 
ColdShine
"L'esperienza è un'insegnante severa: prima ci esamina e solo dopo ci fa
lezione."
 - legge di Vernon Sanders

P4 -> Celeron.
Non hai capito un tubo.
Io vorrei sapere come decidono quali pipeline utilizzare, non quali
chip.
E tra parentesi, gli athlon non c'entrano niente coi duron, nč i P4
coi celeron: sono chip completamente diversi, che nascono da maschere
diverse.


Mah... potrebbe esserci una sorta di dispositivo integrato nel chip
che esclude in modo automatico le pipeline  dal ciclo elaborativoche
dovessero risultare difettose.
Comunque è solo un ipotesi, visto che conosco i processi produttivi
che sovraintendono a tutto questo.
Ciao

 diverse.
Dillo agli ultimi Duron Applebread (con cache nascosta) o agli ultimi 
Athlon XP Thorton (versione castrata dei Barton, sempre con cache nascosta).
Poi fammi sapere cosa rispondono.
-- 
       -  Togli all'indirizzo e-mail _NOSPAM_ per rispondere -
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:: Firma 2003/2004 in costruzione ::   
http://www.edengames.net
   ::

Poi fammi sapere cosa rispondono.
Mi inchino innanzo a cotanta sapienza, tuttavia questo in realtà non
mi interessa, la mia domanda era un'altra.

dovessero risultare difettose.
Eh già, e come lo determina, che sono difettose?

Eh già, e come lo determina, che sono difettose?
Beh, forse con lo stesso principio con cui si testa la ram: dai un
valore in input e sai che deve ritornarti un certo risultato in
output, se sbaglia è difettoso.
Però qui stiamo viaggiando con la fantasia, in verità dovresti
chiederlo ad un ingegnere ATI.
Ciao.
-----------------------------------------------------------
-+- Dumah, Demone dell'Agonia -+-
"Muhahahahahahahahahah... ah... aaaah... aaaaaatchoooooo... 
snif... prrrrrrt... snif snif... ehm... Muhahahahahahahah..."


In effetti forse è la cosa più corretta da fare... ^_^


--------------------------------
Inviato via 
http://arianna.libero.it/usenet/


Se non č un ingegnere maleducato si...;)

chiederlo ad un ingegnere ATI.
Bah, forse basterebbe anche chiedere a chi fa i driver moddati.
Certo che, ragazzi, tecnicamente siete scarsini, vi esaltate tanto con
benchmark, overclock e cazzate simili, ma basta fare una domanda un
filo tecnica per mostrare quanto, in realtà, ne sappiate poco.
A dire il vero io un paio di idee su come si possa fare le ho, non le
ho postate prima perchè pensavo che ci fosse qualcuno -davvero-
competente.
ciao.

 diverse.
Ok, ciao troll. Vai a diffondere ignoranza altrove.
-- 
ColdShine
"L'esperienza č un'insegnante severa: prima ci esamina e solo dopo ci fa


competente.
Ci scusi signor Conoscenza Intergalattica, torneremo subito a
studiare.
Lorenz, a studiare ignorantone!!


 ha scritto nel messaggio
news:9mutvvgras7iail2m...@4ax.com...


Certo centra poco con .video-3d
Veramente a me pare che c'entri molto! A meno che, ovviamente, questo
non sia solo una bacheca di esposizione punteggi di benchmark.

grazie.
direi che sia piu' che sufficiente un semplice test sul "rumore" dei
segnali, la stragrande maggioranza dei problemi salta fuori a questo
livello.
molto probabilmente per questione di design del chip le pipeline sono
suddivise in due banchi, quindi la scelta e' abbastanza semplice -
banco "a" opprue banco "b" e non pipeline per pipeline.
interessante notare che la sezione grafica viene inizializzata
piuttosto tardi durante il caricamento di windows, quindi fino a che
non viene caricato "ati2mtag.sys" anche se le pipes sono difettose la
cosa non crea problemi - dal che si puo' facilmente supporre che il
genere di "difetti" effettivamente riscontrabili su queste schede sia
molto ridotto - nella maggior parte dei casi un chip difettoso viene
cestinato.
--
    (iao!!oai)                                    (ICQ: 10860566)
    //.aurizio
[WARNING!: togliete _nessuno_ per rispondere]
    Il segreto per essere considerato un creativo sta nel non fare
    mai riconoscere le proprie fonti [A. Einstein]

 banco "a" opprue banco "b" e non pipeline per pipeline.
Bisongerebbe vedre se in effetti la disposizione delle pipeline è realmente
come dici... hai qualche fonte a riguardo?
 Saluti

 competente.
Allora "illuminaci" tu oh Dio della microelettronica....;-P

come dici... hai qualche fonte a riguardo?
niente di solido purtroppo, soltanto la descrizione funzionale che ne
fa Ati e i vari diagrammi...
otto banchi sono difficili da gestire a livello di interconnessioni
interne, un singolo banco crea dei datapath critici troppo lunghi con
conseguente aumento delle latenze, due o quattro e' un buon
compromesso - considerando le 9600 probabilmente il "blocchetto" di
quattro pipes e' gia' separato come unita' funzionale in modo da
poterlo adattare alla versione RV con un semplice passaggio nel
compilatore... 


 --
In effetti il discorso dell'adattamento dell'architettura in funzione
delle versioni RV potrebbe far pensare che sia come dici te.
Saluti

 A me viene in mente almeno un sistema...
Basta fargli fare 8 cicli di calcolo per determinare la piena funzionalità
degli stadi di pipeline confrontanto (ovviamente via sw) la correttezza dei
risultati.
3 righe di codice, considerando l'inizializzazione di un for.
-- 
Free your mind.
Hyundai Tiburon ('98) Driver & Owner
Blaupunkt Woodstock DAB52
Vita[7]= 0

 3 righe di codice, considerando l'inizializzazione di un for.
Ah, essendo gli stadi di pipeline una parte integrante del core del chip il
test viene effettuato prima che esso venga "saldato" al pcb in una "scheda
emulata" a parte.
Byez
