Newsgroup: it.comp.hardware
Titolo: Avete sentito del nuovo bug del Pentium ?

   Premessa: noi end users non dobbiamo ASSOLUTAMENTE preoccuparci di
questo bug (chiamato "F0 bug").
   Comunque, da quanto ho letto, se il Pentium (sia liscio che MMX)
esegue un certo codice APPOSITAMENTE scritto, si inchioda anziche'
segnalare semplicemente un errore come invece accade sul mio
AMD486/133 :)  Qualcuno ha ipotizzato che se venisse scritto un virus
contenente quel codice ci sarebbe un blak-out di dimensioni
planetarie, vista la diffusione del pentium. Qualcuno ha anche
insinuato, scherzosamente (speriamo :) che Saddam stia gia' preparando
qualcosa del genere...
   Nei newsgroups internazionali questa vicenda ha scatenato un vero
putiferio, ma ripeto, a noi non ce ne po' frega' de meno di questo
bug. A Intel forse puo' interessare di piu'... se non altro come
(ri)caduta di immagine.
   Bye bye.
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qualcuno ha da vendere un p200 no mmx  o l'equivalente amd
se si e-mail me

 (ri)caduta di immagine.
Ma l'immagine di Intel
si è mai (ri)sollevata?
Ciao
********************************
Angelo Russello
ci...@usa.net
REMOVE skassa BEFORE REPLYING!!
********************************

 (ri)caduta di immagine.
Forse adesso ti interessa un po' di piu' ;)
P.S.
Non l'ho ancora provato ma lo faro' piu' tardi.
-- 
Andrea Vettori
------------------------
vet...@computer.org
http://www.dei.unipd.it/~vettori
    (italiano)
http://www.geocities.com/ResearchTriangle/9236
   (english)

 
Cio nonostante, ha ancora il 70% del mercato.
Spero che se anche questa ultima e vera la intel si becchi tante di quelle
cause da chiudere, pur avendo io un intel.
Oramai i processori sono come le macchine, nessuno esce piů perfetto:
almeno perň per le macchine ci sono i meccanici !!!
Saluti
Simone C.

Noi disponiamo del Cyrix P200+ a circa 220.000 + iva.
Oppure abbiamo questa offerta :
N.1 Personal Computer Pentium AMD K6 200Mhz MMX
Motherboard Intel TX 512 Kbytes cache sincrona (supporta 233 Mhz)
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casse
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Memoria RAM 64 Mbytes SDRAM sincrona 64 bits-10ns (128 pins)
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Lire 1.760.000 +IVA con fattura e garanzia 1 anno.
Noi siamo ad Asti.
Ciao.
Maurizio
E-mail : 
pierma...@geocities.com


 mp

Tanto per essere precisi :
Per lire 220.000 (con fattura) sono compresi :
Kit originale Cyrix con:
Processore 6x86L  P200+ (ultima generazione senza bug)
Dissipatore originale x Cyrix con ventola grande termostatata.
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CD ROM Cyrix con tools, utility e informazioni per quasi tutte le
piastre madri.
Manuale di installazione
Garanzia 1 anno !!!!
Spese di spedizione a mezzo corriere urgente incluse.
I processori che come dici tu si trovano a lire 135.000 prezzo
rivenditore (mi sembra troppo poco) sono nudi e crudi con nessuna
garanzia, se vanno bene OK, se no li butti nel cesso (non saranno quelli
di seconda scelta che la IBM scarta dalle sue linee di produzione??).
A parlare si fa presto, a vendere patacche si fa prima ancora.
Ciao.
Maurizio


 mp

> >=> Demand a new CPU from Intel.
Questa è la soluzione dei tecnici Intel:
Per Penitum Pro e Pentim II niente problemi: alla Intel hanno pensato bene
di
permettere l'upgrade del microcodice via software.
http://support.intel.com/support/processors/pentium/ppiie/descrip.htm
   Pentium processor invalid instruction erratum
   Erratum Technical Description
   Problem: The CMPXCHG8B instruction compares an 8 byte value in EDX and
   EAX with an 8 byte value in memory (the destination operand). The only
   valid destination operands for this instruction are memory operands.
   If the destination operand is a register the processor should generate
   an invalid opcode exception, execution of the CMPXCHG8B instruction
   should be halted and the processor should execute the invalid opcode
   exception handler. This erratum occurs if the LOCK prefix is used with
   the CMPXCHG8B instruction with an (invalid) register destination
   operand. In this case, the processor may not start execution of the
   invalid opcode exception handler because the bus is locked. This
   results in a system hang.
   Implication: If an (invalid) register destination operand is used with
   the CMPXCHG8B instruction and the LOCK prefix, the system may hang. No
   memory data is corrupted and the user can perform a system reset to
   return to normal operation. Note that the specific invalid code
   sequence necessary for this erratum to occur is not normally generated
   in the course of programming nor is such a sequence generated by
   commercially available software.
   This erratum only applies to Pentium? processors, Pentium processors
   with MMX&#153; technology, Pentium OverDrive? processors and Pentium
   OverDrive processors with MMX technology. Pentium Pro processors,
   Pentium II processors and i486&#153; and earlier processors are not
   affected.
   Workaround: The recommended workaround for protected mode operating
   systems is to always create a page not present fault when an invalid
   opcode exception occurs. This page not present fault will be serviced
   before the invalid opcode exception and thus prevent the lock
   condition from occurring. The implementation details will differ
   depending on the operating system.
   The workaround has two parts. First, the Interrupt Descriptor Table
   (IDT) is aligned such that any invalid opcode exception will cause a
   page not present fault. Second, the page fault handler is modified to
   recognize and correctly dispatch the invalid opcode exception and
   certain other exceptions that are now routed through the page fault
   handler.
   Part I, IDT Alignment:
    1. Align the Interrupt Descriptor Table (IDT) such that it spans a
       4KB page boundary by placing the first entry starting 56 bytes
       from the end of the first 4KB page. This places the first seven
       entries (0-6) on the first 4KB page, and the remaining entries on
       the second page.
    2. The page containing the first seven entries of the IDT must not
       have a mapping in the OS page tables. This will cause any of
       exceptions 0-6 to generate a page not present fault. A page not
       present fault prevents the bus lock condition and gives the OS
       complete control to process these exceptions as appropriate. Note
       that exception 6 is the invalid opcode exception, so with this
       scheme an OS has complete control of any program executing an
       invalid CMPXCHG8B instruction.
   Part II, Page Fault Handler Modifications:
    1. Recognize accesses to the first page of the IDT by testing the
       fault address in CR2. Page not present faults on other addresses
       can be processed normally.
    2. For page not present faults on the first page of the IDT, the OS
       must recognize and dispatch the exception which caused the page
       not present fault. Before proceeding, test the fault address in
       CR2 to determine if it is in the address range corresponding to
       exceptions 0-6.
    3. Calculate which exception caused the page not present fault from
       the fault address in CR2.
    4. Depending on the operating system, certain privilege level checks
       may be required, along with adjustments to the interrupt stack.
    5. Jump to the normal handler for the appropriate exception.
   This workaround should only be implemented on Intel processors that
   return Family=5 via the CPUID instruction.
   75/90/100/120/133/150/166/200 MHz Pentium Processors and
   120/133/150/166/200/233 MHz Pentium Processors with MMX
   Technology
   60 MHz and 66 MHz Pentium Processors
   63/83/120/125/133/150/166 MHz Pentium OverDrive Processors and
   125/150/166/180/200 MHz Pentium OverDrive Processors with MMX
   Technology

di seconda scelta che la IBM scarta dalle sue linee di produzione??).
scusate se mi intrometto, ma perche' queste cos (che di certo non sono
ovvie, perche io i processori li ho sempre visti vendere "nudi e
crudi") non le hai dette subito ma dopo che qualcuno ha fatto presente
che il tuo prezzo era alto?
Anche i P166MMX li vendi con tutta quell'attrezzatura? A quanto?
Ciao.