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Titolo: Perchè non fanno simm a 20ns?

Sempre più schede video utilizzano ram edo a 20ns.
Non capisco come mai non si vedono simm o dimm così.
Il costo non dovrebbe essere molto elevato ma le prestazioni...
Invece continuano a rifilarci questa sola di sdram.

Guarda che i dimm a 168pin hanno 10ns d'accesso!!
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tyz...@yahoo.com
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Guarda che i dimm a 168pin hanno 10ns d'accesso!!
non è del tutto esatto.
In lettura di 4 bit hanno 10ns di accesso al 2-3-4 bit, ma il primo è
sempre a 60ns. Invece con ram edo a 25-20ns anche il primo è a quella
velocità e c'è un notevole incremento di prestazioni..

Guarda che i dimm a 168pin hanno 10ns d'accesso!!
Esatto, ma finche' i timing saranno dei 5-1-1-1 c'e' cmq poco
da star allegri...  :-)
Ciao,
st.

Invece continuano a rifilarci questa sola di sdram.
Io ho dimm sdram da 10 ns e da un bel po'. Dov'e' il problema?
Francesco Castura'
Porto San Giorgio(AP)
fcas...@tin.it

 non è del tutto esatto.
Infatti, un conto e parlare di ram sincrone SDRAM un conto è parlare di
memorie ASINCRONE che sono le normali DIMM
Le prime sono sincronizzate con il clock del processore e riescono a
funzionare a velocitò elevate il che non vuol dire che restituiscan i dati
richiesti dopo solo un ciclo di clock ( che massimo e 100Mhz 10n ma di
norma e 66 Mhz quindi meno ) al contrario le ram asincrone restituiscono i
dati richiesti dopo l'intervallo di tempo che viene dichiarato come tempo
di accesso: 60 ns in genere a volte meno. Le SRAM poi sono quelle della
cache e vanno a 10ns reali asincroni ma sono flip-flop e non condensatori
che vanno ricaricati ( refresh) ogni tot. tempo, consumano moltissimo ed
hanno un numero di componenti per cella assai più elevato rispetto alle ram
di largo uso. ( le usavano in quantità massicce ed assai rapide 5ns i cray,
i supercomputer piu' potenti ) Diciamo che quindi si confonde la dicitura
tempo di accesso delle ram asincrone applicandola a quelle sincrone per cui
invece si parla di frequenza massima di funzionamentro 100Mhz=10ns che
viene restituita secondo un ordine di misura temporale per costituire una
maggiore attrattiva. Aggiungerei inoltre che il timings attuale massimo di
circa  5-1-1-1 con le ram sincorne si ottiene perchè per avere il primo
byte in uscita la ram al suo interno compie delle operazioni in sincrono
con il clock del bus e solo dal secondo e per altri tre SUCCESSIVI si
ritrova quelle 'operazioni di ricerca della cella di memoria' già fatte per
cui procede alla massima velocità. Ma 5-1-1-1 si riferisce sempre al clock
di sistema che a 100Mhz vuol dire 50ns-10ns-10ns-10ns a 66Mhz NO.
Saluti
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Simone C.
My address is altered to avoid spamming:
                 change XXXX with ErreSoft.
Il mio indirizzo di email è alterato per evitare spamming:
                 sostituire  XXXXX con ErreSoft..

On 10 Feb 1998 06:49:56 GMT, "Simone C." <Sim...@XXXXXX.com> wrote:
Guarda che secondo me c'è un po' di confusione e la cosa è più
semplice di quanto sembri in realtà.
Il fatto di chiamare le nuove ram "sincrone" è una cazzata commerciale
fraintesa dalla totalità. Tutte le ram sono sincronizzate con il bus
tanto è vero che anche con ram da 70ns la velocità varia se si ha un
bus da 50mhz o da 66mhz o da 75mhz ecc.
Le sdram sono sincrone perchè il loro timing è 5-1-1-1: cioè per
accedere al II-III-IV bit bisogna solo aspettare il segnale del clock.
La dram edo o normale invece (5-2-2-2 o 5-3-3-3) oltre al clock hanno
bisogno di altri comandi per rinfrescare i circuiti che si prendono
gli altri cicli, mentre la sdram faceva tutto da sola con il solo
segnale di clock. Molta gente crede invece che edo e fpm sono
indipendenti dal bus (essendo asincrone) e che quindi vanno alla
stessa velocità qualsiasi sia i mhz del bus.
Ora abbiamo detto che tutte le ram in commercio hanno il primo bit
fermo a 5 cicli. Con un bus a 66mhz per accedere ad un bit nella ram
ci vogliono una settantina di ns; con 75 mhz una 60ntina. (per gli
altri tre bit dipende dal tipo di ram usata e si ricava facendo 1/66 o
2/66 o 3/66 ecc.)
Dopo tutto questo sproloquio ripeto la mia domanda. Perchè non fanno
ram "con il primo bit" a 25ns come quelle per la voodoo 2 tanto per
intenderci?
Non venitemi a dire problemi di costi perchè io 200k per 16mb (o più
realisticamente 32mb) ce li spenderei volentieri. 

accedere al II-III-IV bit bisogna solo aspettare il segnale del clock.
                       ^^^
Permettimi di correggerti.
Si parla di letture di 32 bit alla volta (Dword) e non di singoli bit.
(forse sono addirittura 64 non ricordo bene).
Quindi ogni line fill dovrebbe essere di 32+32+32+32 =128 bit =16 byte
Ciao
Cordialmente.
Kevin
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Quindi ogni line fill dovrebbe essere di 32+32+32+32 =128 bit =16 byte
Non sono sicuro al 100%, ma mi sembra che ho ragione io. Conferme o
smentite?

smentite?
che io sappia le cpu di classe Pentium accedono alla memoria con un
bus a 64bit per cui mi pare poco realistico ipotizzare la lettura di
1bit alla volta, semmai leggera' word di 64bit con burst di 4 o piu'
word (non ricordo con esattezza quanto siano lunghi), cioe' come
minimo legge 64+64+64+64=256bit
Gianpaolo Bottin
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