VHDL

VHDL; VHSIC merupakan salah satu jenis bahasa HDL yang digunakan untuk mendeskripsikan berbagai fungsi rangkaian digital seperti FPGA, Gerbang logika, Flip-flop, dan sebagainya. VHDL juga bisa digunakan sebagai bahasa pemrograman untuk simulasi rangkaian dari komponen-komponen digital. HDL digunakan perancang perangkat keras (hardware) untuk menuliskan sifat, sinyal dan fungsionalitas deskripsi berbasis hardware dari suatu rangkaian. Pendekatan transistor digunakan oleh perancang yang bekerja pada tingkat gerbang dan transistor. Perancang mengaplikasikan rancangannya dalam software pada tingkat abstraksi yang lebih tinggi. Metodologi ini dipadukan dengan tool sintesis untuk menerjemahkan dan mengoptimalkan deskripsi dari suatu rancangan. Mesin sintesis digunakan untuk memetakan rancangan bagian fisik, seperti application specific integrated circuit (ASIC) atau field programmable gate array (FPGA). Meskipun kemampuan fitur yang terdapat pada pendekatan ini mampu digunakan, tetapi hardware description language (HDL) belum dapat diterima secara luas karena banyak rancangan yang menggunakan ukuran dan kompleksitas rancangan dapat diselesaikan menggunakan masukan skematik dan banyak perancang kurang mengenal HDL.