DELAY UNIT FOR PRODUCING A DELAYED OUTPUT SIGNAL

Abstract: 1. Delay unit for producing an output signal (9) which is delayed by a defined delay period (T + t4 ) compared with an input signal (1), consisting of - a comparator (2), at one input of which the input signal (1) is present and at the second input of which a trigger threshold (3) is present, - a preselection counter (4) for setting the delay period (T + t4 ) step by step, an output signal of the comparator (2) being present at an enable input of the preselection counter (4) and a count being predetermined at this preselection counter (4) by a computer via a bus (11) and further via signal lines (13), - a constant-frequency signal generator (5) for emitting counting pulses (14) to the preselection counter (4), - a ramp signal generator (6) for finely divising the delay period (T + t4 ), an output signal of the comparator (2) and an output signal of the preselection counter (4) being combined to form the control signal of the ramp signal generator (6) and an output signal (16) of the ramp signal generator (6) being generated at the output of the latter, the sequence of the output signal (16) of the ramp signal generator (6) being interrupted with the first positive edge of the counting pulses (14) to the preselection counter (4) after arrival of the input signal (1) and the preselection counter (4) being enabled, - a device (8) for generating a reference signal (15) for the output signal (16) of the ramp signal generator (6), in which arrangement the magnitude of the reference signal (15) can be predetermined by the computer via the bus (11) and further signal lines (12) to the device (8), - a further comparator (7) in which the output signal (16) of the ramp signal generator (6) is compared with the reference signal (15) and which emits the delayed output signal (9) at its output, - and a further device (10) for feeding back the delayed output signal at the output of the further comparator (7) to the preselection counter (4) for automatically loading a new count into the preselection counter (4) independently of the computer.

Description: Verfahren und Verzögerungseinheit zur Erzeugung eines ver zöerten Ausqanqssiqnals. Die Erfindung betrifft ein Verfahren nach dem Oberbegriff des Anspruchs 1 und eine Verzögerungseinheit nach dem Oberbegriff des Anspruchs 2 zur Erzeugung eines gegenüber einem Eingangssignal um eine definierte Verzögerungszeit verzögerten Ausgangssignals. Zur Messung schneller elektrischer Signale, d.h. zur Bestimmung eines Spannungsverlaufs als Funktion der Zeit, können zum Teil nur Sampling-Verzahren, wie sie z.B. in Sampling Oszillografen verwirklicht sind, verwendet werden. Dieses Messprinzip, nämlich, einen Spannungsverlauf als Funktion der Zeit mit Hilfe eines Sampling-Verfahrens zu messen, wird z.B. auch zur Messung von internen Signalen bei integrierten Schaltkreisen angewandt. Dies geschieht beispielsweise mit Hilfe der Elektronenstrahl messtechnik in einem Raseer-Elek- tronenmikroskop mit einer Ausrüstung für stroboskopisohe Potentialkontrastmessungen. Ein solches Elektronenstrahlmess- gerät ist beispielsweise in der US-Patentschrift 4 413 181 beschrieben. Für den Stroboskopbetrieb in einem solchen Elektronenstrahlmessgerät wird eine Verzögerungseinheit zur Festlegung des Messzeitpunkts mit sehr hoher Zeitgenauigkeit benötigt. Bei einem Elektronenstrahlmessgerät soll eine solche Verzögerungseinheit darüber hinaus auch rechner steuerbar sein und eine hohe Repetitionsrate beim Eintasten des Elektronenstrahles ermöglichen. Verzögerungseinheiten mit sehr hoher Zeitgenaulgkeit, die eine hohe Repetitionsrate beim Messen von schnellen Signalen zulassen, werden in jedem Sampling-System benötigt. Zur Darstellung des Spannungsverlaufs als Funktion der Zeit in zyklisch arbeitenden integrierten Schaltungen werden bei der Elektronenstrahlmesstechnik stroboskopische Abbildungsverfahren verwendet. Dabei wird eine gepulste Elektronensonde synchron mit dem Zyklus des Spannungsverlaufs an einem Schaltungsknoten innerhalb einer integrierten Schaltung auf einen oder mehrere solcher Schaltungsknoten gerichtet. Dabei werden am Auftreffort der gepulsten Elektronensonde Sekundärelektronen ausgelöst Diese Sekundärelektronen werden in einem Detektor nachgewiesen und liefern das Messsignal. Soll nun ein grösserer Bereich des zyklischen Spannungsverlaufs am Spannungsknoten innerhalb der integrierten Schaltung abgebildet werden, so muss der Einschaltzeitpunkt (die Phase) der Elektronensonde bezüglich des Zyklusbeginnes um definierte Beträge verschoben werden. Dieses Verschieben der Phase der Elektronensonde bezüglich eines zyklischen Spannungsverlaufs an einem Schaltungsknoten erfordert eine hohe Zeitgenauigkeit des Nesszeitpunkts, zu dem die gepulste Elektronensonde auf den Schaltungsknoten auftrifft. Für sehr hochfrequente Spannungsverläufe an solchen Schaltungsknoten wird eine hohe Repetitionsrate der Elektronensonde benötigt. Bisher wird an Elektronenstrahlmessgeräten ein Boxcar-tnte- grator, z.B. Model 162 der Fa. Princeton Applied Research, verwendet. (siehe die bereits genannte US-Patentschrift Nr. 4 413 181), der die Phasenschiebung für die gepulste Elektronensonde und für die Nesssignalverarbeitung bezüglich des Spannungsverlaufs an einem Schaltungsknoten eines MeBob- jekts über einen analogen Rampengenerator mit umschaltbarer Anstiegszeit und somit mit konstanter relativer Genaugkeit von 0,05% erreicht. Dies bedeutet bei Verzögerungszeiten von 10 gs zwischen dem Eingangssignal der Verzögerungseinheit, beispielsweise dem Zyklusbeginn eines zyklischen Span nungsverlaufes, und dem Ausgangssignal, beispielsweise einem Signal zur Erzeugung eines Elektronenpulses bzw. einem Gate Signal zur Verarbeitung eines Messsignals, eine Genauigkeit der Verzögerungszeit bzw. eine Zeitauflösung von ca. 5 ns. Bei Änderung des Messbereiches muss bei Verwendung eines solchen Boxcar-Integrators von Hand an diesem Gerät umgeschaltet werden. Eine Rechnersteuerung ist daher bei Verwendung eines solchen Boxcar-Integrators nur bedingt, nämlich nur innerhalb jeweils eines einzigen Messbereiches möglich. Die maximale Repetitionsrate eines solchen Boxcar-Integrators beträgt 2 MHz, wobei die Repetitionsrate durch die Verarbeitungsgeschwindigkeit im Gerät, speziell durch die Trigger Aufbereitung und die Rampensteuerung, begrenzt ist. Eine Genauigkeit einer Verzögerungszeit bzw. eine Zeitauflösung von ca. 5 ns und eine maximale Repetitionsrate von 2 NHz sind inzwischen für viele Anwendungsfälle bei der Elektronenstrahlmesstechnik nicht mehr ausreichend. Aus der Diplomarbeit "Aufbau und Erprobung eines Mikroprozessor-gesteuerten Sampling-Systems für den Sub-NanoseRun- den-Bereich" von A. Dallmann, Universität Düsseldorf, DE, Oktober 1982, sind ein Verfahren und eine Verzögerungseinheit der eingangs genannten Art zur Erzeugung eines verzögerten Ausgangssignals bekannt. In einer Verzögerungseinheit nach dieser Diplomarbeit wird die Verzögerungszeit in groben Schritten von 20 ns durch Zählen eines 50-MHz-Quarzsignals eingestellt. Eine feinere Unterteilung der Verzögerungszeit wird durch ein schnelles Rampensignal mit einer Grenzauflösung von weniger-als 0,5 ns erzielt. Bei einer Verzögerungseinheit nach dieser Diplomarbeit sind die Signale eines solchen Quarzgenerators, der eine ausrelchende Frequenzstabilität aufweisen soll, nicht mit dem Eingangssi gnal synchronisierbar. Daher startet bei einer Verzögerungseinheit nach dieser Diplomarbeit das Eingangssignal zunächst den Ablauf des schnellen Rampensignals. Sodann wird dieser Ablauf des schnellen Rampensignals jedoch während einer vorgewählten Zählzeit eines 50-MHz-Zählers unterbrochen. Nach Ende dieser vorgewählten Zählzeit erreicht das schnelle Rampensignal schliesslich eine vorgegebene Referenzspannung und löst dabei das verzögerte Ausgangssignal der Verzögerungseinheit aus. Die für das Rampensignal verwendete Referenzspannung kann von einem Rechner über einen Digital-/Analog-Wandler eingestellt werden. Die vorgewählte Zählzeit und die für das Rampensignal verwendete Referenzspannung können jedoch auch mit Hilfe einer anderen Vorrichtung, ohne Verwendung eines Rechners, vorgegeben werden. Bei einer Yerzögerungseinheit nach der genannten Diplomarbeit werden sowohl das Anlegen eines neuen Zählerstandes an den50-MHz-Zähler als auch das Laden des jeweils neuen Zählerstandes sowie das Starten eines Betriebsmodus der Verzögerungseinheit, in dem das nächste ankommende Eingangssignal das nächste verzögerte Ausgangs signal auslöst, von einem Rechner gesteuert. Die Steuerung dieses 3etriebs- ab laufs der Verzögerungseinheit zwischen zwei verzögerten Ausgangssignalen ist umfangreich und langwierig. Diese Steuerung des Betriebsablaufs durch den Rechner begrenzt die maximale Repetitionsrate der Verzögerungseinheit. Der vorliegenden Erfindung liegt die Aufgabe zugrunde, ein Verfahren und eine Verzögerungseinheit der eingangs genannten Art zur Erzeugung eines verzögerten Ausgangssignals anzugeben, die wesentlich höhere Repetitionsraten als nach dem Stand der Technik möglich zulassen. Diese Aufgabe wird erfindungsgemäss durch ein Verfahren zur Erzeugung eines verzögerten Ausgangssignals nach dem Anspruch 1 und durch eine Verzögerungseinheit nach dem Anspruch 2 gelöst. Ausgestaltungen und Vorteile der Erfindung sind in der Beschreibung und in der Zeichnung dargestellt. Bei einem Verfahren und bei einer Verzögerungseinheit nach der Erfindung wird nach jedem verzögerten Ausgangs signal ein neuer, vorgewählter Zählerstand automatisch,.d.h. unabhängig von einem Rechner, in einen Zählbaustein geladen. Auf diese Weise werden beispielsweise Repetitionsraten von 20 MHz ermöglicht. Ein Verfahren und eine Verzögerungseinheit nach der Erfindung genügen damit beispielsweise den Erfordernissen, die in der Elektronenstrahlmesstechnik an ein solches Verfahren und an eine solche Verzögerungseinheit gestellt werden. Ein erfindungsgemässes Verfahren und eine Verzögerungseinheit nach der Erfindung können auch bei anderen Messsystemen ausserhalb der Elektronenstrahl messtechnik zur Analyse von schnellen Signalen überall dort eingesetzt werden, wo eine hohe Repetitionsrate benötigt oder vorteilhaft ist. Ein erfindungsgemässes Verfahren und eine Verzögerungseinheit nach der Erfindung ermöglichen eine konstante absolute Zeitgenauigkeit von 0,5 ns sowohl bei kurzen als auch bei langen Verzögerungszeiten. Darüber hinaus ermöglichen ein erfin dungsgemässes Verfahren und eine Verzögerungseinheit nach der Erfindung eine minimale Verzögerungszeit von ca. 15 ns zwischen Signaleingang und Signalausgang. Bei vielen Messsystemen ist es vorteilhaft, wenn sie von einem Rechner gesteuert werden können. Ein Verfahren und eine Verzögerungseinheit nach der Erfindung ermöglichen eine einfache Steuerung über einen Rechner. Ausführungsbeispiele der Erfindung sind in' der Zeichnung dargestellt und werden im folgenden näher erläutert. Fig.1 zeigt ein Blockschaltbild einer erfindungsgemässen Verzögerungseinheit. Fig.2 zeigt ein Signaldiagramm für ein erfindungsgemässes Verfahren und für eine Verzögerungseinheit nach der Erfindung. Fig.5 zeigt ein Ausführungsbeispiel für eine Verzögerungs einheit nach der Erfindung. Fig.1 zeigt eine Verzögerungseinheit nach der Erfindung. Das Eingangssignal (Trigger) 1 trifft auf einen Eingang eines Komparators 2, an dessen zweitem Eingang eine Triggerschwelle 3 anliegt. Sobald der Ausgang dieses Komparators 2 von einem Eingangssignal 1 auf einen bestimmten Spannungspegel eingestellt worden ist, wird dieser Ausgang des Komparators 2 verriegelt, so dass dieses Ausgangssignal des Komparators 2 auch nach Abklingen desJenigen Eingangssignals 1, das die Einstellung dieses Ausgangssignals des Komparators 2 auf einen bestimmten Spannungspegel verursacht hat, erhalten bleibt. Das Ausgangssignal des Komparators 2 ist mit einem 50-MHz-Vorwahlzähler 4 so verbunden, dass dieser Vorwahlzäh ler 4 von dem Ausgangssignal des Komparators 2 dazu veran lasst werden kann, von einem eingestellten Zählerstand nach Null zu zählen. Der voreingestellte Zählerstand an diesem Vorwahlzähler 4 wird von einem Rechner über einen MPU-Bus 11 und weiter über Signalleitungen 13 zwischen dem Bus 71 und dem Vorwahlzähler 4 vorgegeben. Ein 50-MHZ-Generaicr 5 gibt den Takt vor, in dem der 50-MHz-Vorwahlzähler 4 von dem voreingestellten Zählerstand nach Nuil zählt. Das Ausgangssignal des Komparators 2 und das Ausgangssignal des Vorwahlzählers 4 werden zum Steuersignal eines Rampengenerators 6 zusammengefügt. Das Ausgangssignal 16 des Rampengenerators 6 wird in einem weiteren Komparator 7 mit einer Referenzspannung 15 verglichen. Die Grösse der Referenzspannung 15 kann wiederum von einem Rechner über den MPU-Bus 11 über Signalleitungen 12 zwischen diesem Bus und einem Digital-/Analog-Wandler 8 und weiter über diesen Digital-/Analog-Wandler 8 vorgegeben werden. Am Ausgang des Komparators 7 erscheint das verzögerte Ausgangs signal 9. Dieses verzögerte Ausgangssignal 9 wird über eine Signalleitung 10 zum Vorwahlzähler 4 zurückgeführt. Fig.2 zeigt ein Signaldiagramm für ein Verfahren und für eine Verzögerungseinheit nach der Erfindung. Das Eingangssignal 1 zeigt eine positive Flanke zum Zeitpunkt t=O. Das Ausgangssignal 14 des Quarzgenerators 5 ist phasenmässig mit dem Eintreffen des Eingangssignals 1 nicht korreliert. Die positive Flanke des Eingangssignals 1 startet über das Steuersignal 17, das in diesem Fall vom Ausgang des Komparators 2 gebildet wird, den Ablauf des Rampensignals 16. Sobald nach Eintreffen des Eingangssignals 1 die erste positive Flanke des Quarzsignals 14 auftritt, wird über einen Ausgang des Vorwahl zählers 4 das Steuersignal 17 auf Eins gesetzt und der Ablauf des Rampensignals 16 unterbrochen, so dass das Rampensignal 16 zunächst denjenigen Wert beibehält, den es bei Auftreten der ersten positiven Flanke des Quarzsignals 14 nach Eintreffen des Eingangssignals 1 aufgewiesen hat. Mit Auftreten der ersten positiven Flanke des Quarzsignals 14 nach Eintreffen des Eingangssignals 1 wird der programmierbare Vorwahlzähler 4 freigegeben, der vom eingestellten Zählerstand nach Null zählt. Der Takt für dieses Zählen von eingestellten Zählerstand nach Null wird vdm Quarzsignal 14 gebildet. Die Zählzeit des Vorwahlzählers 4 beträgt dabei t Wird das Quarzsignal 14 von einem 50-MHz-Generator 5 erzeugt, so beträgt der zeitliche Abstand zwischen zwei Pulsen dieses Quarzsignals 14 20 ns. Umfasst der voreingestellte Zählerstand im Vorwahlzähler 4 n Takte des Quarzsignals 14, so beträgt die Zählzeit t n.20 ns. Nach Ablauf der Zählzeit t des Vorwahl zählers 4 wird die Unterbrechung des Rampensignals 15 aufgehoben. Nach einer Zeit T erreicht das Rampensignal 16 eine Spannung U, die so gewählt ist, dass die Summe der Zeiten t1 und t2, zu denen das Rampensignal 16 sich so weit verändert hat, dass es diese Spannung U erreicht hat,- gerade 20 ns, das ist die Dauer eines Taktes des Quarzsignals 14, beträgt. Nach Ablauf der Zeit T verändert sich das Rampensignal 16 über einen weiteren Zeitraum t4 weiterhin so, dass es zum Zeitpunkt T+t4 den Wert der Referenzspannung 15 erreicht. Sobald das Rampensignal 16 diesen Wert der Referenzspannung 15 erreicht, wird das verzögerte Ausgangssignal 9 ausgelöst. Dieses verzögerte dusgangssi- gnal 9 wird gleichzeitig als Signal 10 zum Vorwahlzähler 4 zurückgeleitet, wo dieses Signal 10 das Laden eines neuen Zählerstandes unabhängig vom Rechner in den Vorwahl zähler 4 veranlasst. Der Wert der Referenzspannung 15 befindet sich zwischen der Spannung U und einer Spannung UT+20 Diese . Spannung UT+20 würde vom Rampensignal 16 nach Ablauf einer Zeit T+20 ns erreicht werden. Das Rampensignal 16 erreicht unabhängig von der Phasenlage des Quarzsignals 14 bezüglich der Phasenlage des Eingangssignals 1 und unabhängig vom Zählerstand n des Vorwahlzählers 4 zur Zeit T den Wert U. Im Zeitintervall zwischen der Zeit T und der Zeit T+20 ns geschieht die Feinaufteilung der Gesamtverzögerungszeit. Daher muss die Referenzspannung 15 zwischen der Spannung U zur Zeit T und der Spannung U zur Zeit T+20 ns liegen. Für Verzögerungszeiten kleiner als 40 ns kann die Zählmethode nicht verwendet werden. Für Verzögerungszeiten kleiner als 40 ns wird der Zähler abgeschaltet und eine rein analoge Verzögerung durchgeführt. Dabei wird von der positiven Flanke des Eingangssignals 1 über den Ausgang des Komparators 2 der Ablauf des Rampensignals 16 gestartet. Dieses Rampensignal 16 läuft sodann ohne Unterbrechung solange ab, bis der Wert des Rampensignals 16 den Wert der Referenzspannung 15 erreicht und dabei das verzögerte Ausgangssignal 9 auslöst. Fig.3 zeigt ein Ausführungsbeispiel für eine Verzögerungseinheit nach der Erfindung. In einer Schaltung für eine erfindungsgemässe Verzögerungseinheit müssen möglichst kurze Anstiegszelten und Verzögerungszeiten bzw. Jitter erzielt werden können. Dabei ist folgendes zu beachten: Bei hochohmigem Aufbau können schon durch nahezu unvermeidbare XLeitungs- kapazitäten von einigen pF längere Aufladezeiten auftreten. Beispielsweise beträgt die Zeitkonstante, die als das Produkt von Widerstand und Kapazität angegeben werden kann, 20 ns bei einem Widerstand von 1 kOhm und einer Kapazität von 20 pF. Weiter. muss der Aufbau der Schaltung für eine erfindungsgemässe Verzögerungseinheit möglichst niederinduktiv erfolgen. Bauteile mit hohen induktiven Komponenten, wie z.B. Drahtwiderstände oder Elektrolytkondensatoren, dürfen in kritischen Baugruppen nicht verwendet werden. Darüber hinaus müssen die verwendeten Halbleiter geringe Sperrschichtkapazitäten und hohe Grenzfrequenzen und somit kurze Anstiegszeiten aufweisen. Die Anforderungen, die aus diesen Gründen an Dioden und Transistoren zu stellen sind, werden jedoch bereits von einfachen Bautypen, wie z.B. 1 N 914, BC 237, BC 307 usw., erfüllt. Sit solch einfachen Bautypen können bereits Schaltzeiten von 2-3 ns erreicht werden. Bei der Schaltungskonzeption ist weiterhin folgendes zu beachten: Beim Umschalten eines pn-Ubergangs vom gesperrten in den leitenden Zustand tritt nur eine kurze Verzögerung ein. Anders ist es beim Übergang vom leitenden in den gesperrten Zustand. Dabei müssen zum einen die freien Ladungs- träger aus der Sperrschicht ausgeräumt werden und zum anderen muss die Sperrschichtkapazität über den Lastwiderstand aufgeladen werden. Daher darf der Lastwiderstand nicht zu gross sein, damit die vorgegebene Sperrschichtkapazität von einigen 10 pF schnell genug aufgeladen werden kann. Ausserdem muss die Zahl der freien Ladungsträger in der Sperrschicht möglichst niedrig gehalten werden, zumindest muss dafür gesorgt werden, dass kein Betrieb der Sperrschicht im Sättigungsbereich vorkommt. Denn bei einer Sperrschicht im Sät- tigungsbereich findet eine Uberflutung der Sperrschicht mit freien Ladungsträgern statt Die Leitfähigkeit der Halbleiterschaltelemente ist zwar sehr gut, aber beim Umschalten in dengesperrten Zustand tritt zusätzlich eine Freiwerde-Zeit auf, die bei Kleinleistungs-Transistoren einige 1C ps betragen kann. An die integrierten Bausteine, die in einer erfindungsgemä ssen Verzögerungseinheit verwendet werden, sind die gleichen Anforderungen zu stellen wie an die diskreten Komponenten. Bei dem Aufbau der Schaltung werden in den britischen Baugruppen ECL-IC's (Serie 10 000) und ECL-Komparatoren (High Speed-Komparator SP 9685) verwendet, da die anderen Serien von integrierten Bausteinen nicht schnell genug sind. Der Aufbau der Schaltung soll niederinduktiv ohne grössere Störungen und Reflexionen sein. Um dies zu erreichen, kön nen eine Seite der Platine weitgehend als Masse-Seite ausgebildet und neben die Signal bahnen noch Masse-Bahnen gelegt werden. Dadurch werden kleine Induktivitäten und bei entsprechender Breite der Leiterbahnen (Mikrostrip) eine definierte Impedanz erzielt werden. Einzelheiten hinsichtlich von ECL-Bausteinen lassen sich dem Buch "MECL High-Speed Integrated-Circuits", Motorola Semiconductors (1978) entnehmen. Die Steuerung einer erfindungsgemässen Verzögerungseinheit übernimmt ein Mikroprozessorsystem. Im Ausführungsbeispiel wird ein Mehrkartensystem mit kommerziell gelieferten Karten (MPC) gewählt. Dazu gehört einmal eine MPU-Karte MPC 103 mit einem Mikroprozessor 6802 (Motorola), mit einem 16 kByte EPROM und mit einem 2 kByte RAM. Weiter gehören dazu zwei Stück 8 kByte RAM-Karten MPC 112. Als Eingabe-Medium kann eine Fernschreibmaschine Teletype Model 43 dienen,' die über eine Seriell-Schnittstelle MPADA 04A (TTY-Interface) angeschlossen werden kann. Dabei ist über die Tastatur der Fern- schreibmaschine eine Eingabe und über das Druckwerk eine Ausgabe möglich. Als weiteres Ausgabe-Medium kann ein 9 Zoll Monitor dienen, der über eine Karte MPC 402 (Video-Interface) angeschlossen werden kann. Als weiteres Ausgabe-Medium kann ein Magnetbandgerät Typ DCD 1(3 M-Company) dienen, das über eine 8 Bit-Parallel-Interface-Karte MPC 250 angeschlossen werden kann. Als weiteres Ausgabe-Medium kann ein Plotter Watanabe Digiplot dienen, der über eine weitere Interface Karte MPC 250 angeschlossen werden kann. Dieses Mikroprozessorsystem steuert eine erfindungsgemässe Verzögerungseinheit über einen MPU-Bus 11 mit Hilfe der Steuersignale 12, 13. Die Steuersignale 12 gelangen zum Digital-/Analog-Wandler 8 für die Referenzspannung. Dieser Digital-/Analog-Wandler 8 besteht aus einer Karte MPC 124. Die Steuersignale 13 gelangen zum Vorwahlzähler 4, der im Ausführungsbeispiel nach Fig.3 im wesentlichen aus dem ECL-Zähler Z1 und dem TTL-Zähler Z2 besteht. In einer sehr einfachen Ausführungsform muss eine Verzögerungseinheit nach der Erfindung nicht notwendig von einem Mikroprozessorsystem gesteuert werden. Grundsätzlich genügt zur Steuerung einer Verzögerungseinheit nach der Erfindung irgendeine Vorrichtung, die in definierter Weise die Signale 12, 13 an eine Verzögerungseinheit nach der Erfindung abgeben kann. Um eine über die gesamte Zeitskala konstante Genauigkeit für die Verzögerungszeit von unter 1 ns zu erzielen und um eine Rechne rs teuerung der Verzögerungszeit zu ermöglichen, wird folgendes Prinzip gewählt: Der Verzögerungszeitbereich wird in Schritten durch Zählen eines Signals 14 grob unterteilt. Eine Feinunterteilung des Verzögerungszeitoe- reiches zwischen jeweils zwei Schritten der Grobunterteilung erfolgt mit Hilfe eines Rampengenerators 6, dessen momentane Amplitude 16 mit einer vorgegebenen Gleichspannung 15 verglichen wird. Der 8 Bit-Digital-/Analog-Wandler 8 ermöglicht bei der Feinaufteilung eines Zeitbereiches von 20 ns eine minimale Auflösung von 0,1 ns. Dies liegt deutlich unter der Auflösung der anderen Komponenten in der Schaltung nach Fig.3. Bei einer Genauigkeit des Signals 14 von ca. 10 5% und bei einer Linearität des Rampengenerators 6 besser als 1% ist daher eine Genauigkeit von besser 0,5 ns über den gesamten Verzögerungszeitbereich zu erwarten. Der Rampengenerator 6 wird dabei stets mit der gleichen Anstiegszeit betrieben; Umschalt- elemente werden dabei nicht benötigt. Zur Erzeugung des Signals 14 wird ein 50-MHz-Quarzgenerator 5 verwendet. Das Signal 14 wird in Fig.3 von einer Oszillatorschaltung erzeugt, die bei ungefährer Abstimmung des Resonanzkreises auf 50 NHz zuverlässig auf der Oberwelle schwingt. Einzelheiten dieser Schaltung sind in Applikationsberichten für TTL-integrierte Schaltkreise von Texas Instruments zu finden. Die Schaltung zur Erzeugung des Signals 14 weist überdies eine Auskoppelstufe auf. Diese Auskoppelstufe verhindert die Belastung des Schwingkreises und verstärkt die Signalamplitude des Signals 14 auf eine Spannung von ca. 3 VSS. tm Digitalteil der Schaltung nach Fig.3 werden folgende Komponenten benutzt: SP 9685 High-Speed-tomparatoren 2,7 jeweils mit Latch (Verriegelung). Die Ausgänge dieser Komparatoren 2, 7 weisen ECL-Pegel auf. Der Komparator 2 wird für die Aufbereitung des Eingangssignals 1 und der Komparator 7 wird für den Vergleich des Rampensignals 16 mit der Referenzspannung 15 benötigt. Ein ECL-Zähler MC 10136 dient als Zähler Z1 . Dieser Zähler Z1 wird als programmierbarer synchroner 4 Bit-Vorwahl zähler bis 100 MHz in der ersten Zählstufe verwendet. Ein TTL-Zähler 74LS191 dient als Zähler Z2. Dieser Zähler Z2 wird als programmierbarer synchroner 4 Bit-Vorwahlzähler: bis 5 MHz in der zweiten Zählstufe verwendet. Ein ECL-Dual D-Flipflop MC 10231 dient als Flipflop FF1. Dieses Flipflop FF1 wird zur Steuerung des Rampengenerators 6 verwendet. ECL OR-Gatter MC 10103 4 x 2 OR Gate werden als Gatter N1 N2, N3, N4, N7 verwendet. ECL OR-Gatter MC 10109 4/5 OR/ NOR Gate werden als Gatter N5, N6 verwendet. Bei einem positiven Spannungssprung des Eingangssignals 1 wird der Ausgang Q des Komparators 2 auf den logischen Wert 1 gelegt. Uber das Gatter N1 wird der Komparator 2 verriegelt, so dass die Ausgangssignale des Komparators 2 auch nach Abklingen des positiven Spannungssprungs des Eingangssignals 1 erhalten bleiben. Somit liegt am D-Eingang des Flipflops FF1 eine logische "1" an Bei der nächsten positiven Flanke des Signals 14 wird auch der Ausgang Q des Flipflops FF1 auf den logischen Wert "1 It gelegt. Gleichzeitig erhält der Zäh- ler Z1 von diesem Flipflop FF1 ein Carry In-Signal und beginnt ab der zweiten positiven Flanke des Signals 14 vom eingestellten Zählerstand nach Null zu zählen. Der Zähler Z1 wird also erst dann freigegeben, wenn das Flipflop FF1 bereits geschaltet ist. Der Zähler Z1 zählt also im Ausführungsbeispiel nach Fig.3 erst den zweiten Impuls des Signals 14 nach Auftreten der positiven Flanke des Eingangssignals 1. Dieses Schaltungsprinzip verhindert bei fehlender Korrelation zwischen Eingangssignal 1 und Signal 14, dass unter gewissen Umständen eine der beiden integrierten Schaltungen FF1, Z1 bereits schaltet, dass die andere dieser beiden inte- grierten Schaltungen FF1, Z1 jedoch erst beim nächsten Taktimpuls schaltet. Da der Zähler Z1 bei einer Schaltung nach Fig.3, also im Gegensatz zum Signaldiagramm nach Fig.2, erst den zweiten Impuls des Signals 14 zählt, muss der Zähler stand, der über die Signale 13 an den Vorwahlzähler 4 angelegt wird, bei einer Schaltung nach Fig.3 um 1 niedriger sein im Vergleich zu einer Schaltung, bei der das Signaldiagramm nach Fig.2 verwirklicht ist. Der Zähler Z1 zählt die vier niederwertigen Bits des über die Signale 13 vorgegebenen Zählerstandes, der Zähler Z2 zählt über die Konverter K1, KIl die vier höherwertigen Bits des über die Signale 13 vorgegebenen Zählerstandes. Als Konverter K1-K12 werden Konverter ECL-TTL MC 10125 bzw. TTL-ECL MC 10124 verwendet. Beim Zählerstand "00" sind die Ausgänge QO-Q3 des Zählers Z1 jeweils auf den logischen Wert "O" gelegt, der Min/Max-Ausgang des Zählers Z2 weist in diesem Fall den logischen Wert 1 auf. Somit wird in diesem Fall auch der invertierte Ausgang des Gatters N5 auf den logischen Wert "1" gelegt, weil alle Eingänge des Gatters N5 in diesem Fall jeweils den logischen Wert "O" aufweisen, und infolgedessen wird auch das Flipflop FF1 zurückgesetzt. Das Ausgangssignal Q des Flipflops FF1 und das invertierte Ausgangssignal des Komparators 2 werden im Gatter N2 zum Steuersignal 17 des Rampengenerators 6 zusammengefügt. Gleichzeitig mit dem Reset des Flipflops FF1 wird ein weiteres Flipflop FF2 gesetzt und dadurch das Clock-Signal des Flipflops FF1 blockiert. Dadurch wird verhindert, dass das Signal 14 ein weiteres Umschalten des Flipflops FF1 veranlassen kann. Für Verzögerungszeiten unter 40 ns wird über die Signale 13 am Eingang X1 des Konverters K12 eine logische "1" angelegt und zugleich der Zählerstand auf "00" gesetzt. Somit werden über das Gatter N3 und das Flipflop FF2 das Flipflop FF1 gesperrt und die Zähler Z1, Z2 passiviert. Das Eingangssignal 1 wird in diesem Fall für Verzögerungszeiten unter 40 ns, also ohne zeitliche Unterbrechung, über das Gatter N2 direkt zum Rampengenerator 6 geleitet. Das Anlegen eines jeden neuen Zählerstandes an die Eingänge der Zähler Z1, Z2 geschieht vom Mikroprozessor aus zwischen dem Eintreffen eines Eingangssignals 1 am Eingang der Verzögerungseinheit, sofern dieses Eingangssignal 1 den Ausgang Q des Komparators 2 auf den logischen Wert "1" schaltet und somit eine Verriegelung des Ausgangssignals dieses Komparators 2 veranlasst, und dem Eintreffen eines weiteren Eingangssignals 1, das nach Abgabe eines verzögerten Ausgangssignals 9 von der Verzögerungseinheit als nächstes Eingangssignal 1 wiederum den Ausgang Q des Komparators 2 auf den logischen Wert "1" schalten kann. Dieses Anlegen eines neuen Zählerstandes an die Eingänge der Zähler Z1, Z2 wird vom invertierten Ausgang des Komparators 2 über einen invertierenden Konverter K3 über das Trigger-Signal X5 veranlasst. Das Trigger-Signal X5 löst dabei im Mikroprozessorsystem den Ablauf des Anlegens des neuen Zählerstandes an die Dateneingänge dO, d7 der Zähler Z1, Z2 aus. Die Eingänge T1, T2 weisen stets jeweils den logischen Wert O auf. Das Signal 10, das dem invertierten verzögerten Ausgangssignal 9 entspricht, bildet zusammen mit dem Signal T1 die beiden Eingänge des Gatters N7. Solange das Signal 10 den logischen Wert "1" aufweist, solange also das verzögerte Ausgangssignal 9 am Ausgang des Komparators 7 noch nicht erschienen ist, kann der an die Eingänge dO, d7 der Zähler Z1, Z2 angelegte neue Zählerstand nicht in diese Zähler übernommen werden. Sobald das Signal 10 den logischen Wert "O" annimmt, d.h. sobald das verzögerte Ausgangssignal 9 am Ausgang des Komparators 7 erscheint, weisen beide Eingänge des Gatters N7 den logischen Wert tOtt auf. In diesem Fall werden die beiden Eingänge Sl, S2 des Zählers Z1 auf den logischen Wert ' 0" gesetzt. Dieses Setzen der beiden Eingänge S1, S2 des Zählers Z1 hat fünf Konsequenzen: 1. werden die vier niederwertigen Bits dO, d3 des neuen Zäh lerstandes in den Zähler Z1 übernommen, 2. wird über das Gatter & und über den Konverter K2 der Zähler Z2 angesteuert und werden die vier höherwertigen Bits d4, d7 des neuen Zählerstandes in den Zähler Z2 ein gelesen, 3. wird über den invertierten Ausgang des Gatters N6 das Flipflop FF2 zurückgesetzt, 4. werden über den invertierten Ausgang des Gatters N6 ebenso die Latch-Kreise der Komparatoren 2, 7 über die Gatter N1, N4 zurückgesetzt, 5. wird der Ladekondensator C1 durch Transistor T4 im Ram pengenerator 6 entladen. Unmittelbar nach Abklingen des verzögerten Ausgangssignals 9 weist das Signal 10 wieder den logischen Wert "1 tt auf. Dies bedeutet, dass nunmehr der Eingang S1 des Zählers Z1 den logischen Wert 1?1kl aufweist, während der Eingang S2 des Zählers Z1 immer noch den Wert "O" aufweist. Damit ist im Zähler Z1 der Betriebsmodus Mount down" gesetzt. Vom nächsten positiven Spannungssprung des Eingangssignals 1 wird sodann das nächste verzögerte Ausgangssignal 9 ausgelöst. Die Erfindung ermöglicht ein automatisches, rechnerunabhçn- giges Laden eines neuen Zählerstandes in den Vorwahlzänler 4 und ein automatisches, rechnerunabhängiges Bereitstellen der Verzögerungseinheit dafür, dass ein neu eintreffendes Eingangssignal 1 ein weiteres verzögertes Ausgangssignal 9 aus löst. Damit werden hohe Repetitionsraten des gesamten Ness- systems ermöglicht. In der Elektronenstrahlmesstechnik ist es beispielsweise notwendig, dass ein Zyklus eines periodischen Spannungsverlaufes an einem Schaltungsknoten in einem MeBobjekt in möglichst kurzer Zeit vollständig aufgezeichnet wird. Eine solche Aufzeichnung eines Zyklus eines periodischen Spannungsverlaufes geschieht überlicherweise mit Hilfe des Sampling-Prinzips. Um den Zyklus eines periodischen Signalverlaufes zeitaufgelöst aufnehmen zu können, wird dabei die Phase, mit der die Elektronensonde bezüglich des Zyklus des periodischen Signalverlaufes auf einem Schaltungsknoten auftrifft, über die verschiedenen Messimpulse hinweg variiert. Die Elektronensonde wird also periodisch mit der Periode des aufzuzeichnenden Spannungsverlaufes am Schaltungsknoten gepulst, jeder Puls der Elektronensonde weist. dabei bezüglich des Zyklus des aufzuzeichnenden Spannungsverlaufes eine andere Phase auf. Wenn die Phase der gepulsten Elektronensonde bezüglich des aufzuzeichnenden periodischen Signalverlaufes über den gesamten Zyklus dieses aufzuzeichnenden Si gnalverlaufes hinweg verschoben worden ist, so ist über die Messsignalverarbeitung ein ganzer Zyklus des zu untersuchenden periodischen Signalverlaufes aufgezeichnet worden. Das Sampling-Prinzip in der Elektronenstrahlmesstechnik ist beispielsweise in der US-Patentschrift 4 220 853 beschrieben. Die Messsignalverarbeitung kann bei einer Messung nach dem Sampling-Prinzip mit Hilfe eines Zeitfensters (gate) erfolgen. Die Zeitauflösung einer Messung wird dann nur von der Torzeit des Zeitfensters und von der Genauigkeit der Zeitpunkte, zu denen die gepulste Elektronensonde mit einer jeweils definierten Verzögerungszeit (Phase) auf einen Schaltungsknoten auftrifft, bestimmt. Dabei kommt es nicht so sehr auf die absolute Genauigkeit der Verzögerungszeiten als vielmehr auf die Reproduzierbarkeit (Jitter) dieser Verzögerungszeiten an. Synchron mit der gepulsten Elektronen- sonde wird über das verzögerte Ausgangssignal 9 auch das Gate der Messsignalverarbeitung angesteuert. Wenn beispielsweise in der Elektronenstrahlmesstechnik die Verzögerungszeiten (Phasen) der gepulsten Elektronensonde bezüglich eines zu'untersuchenden periodischen Spannungsverlaufes immer in derselben definierten Weise variiert werden, können die Signale 12, 13 auch von einem relativ einfach ausgestalteten Zähler abgegeben werden. In einem solchen Fall wird nicht unbedingt ein aufwendiges Mikroprozessorsystem benötigt. Bei einer Verzögerungseinheit nach der Erfindung durchläuft das Eingangssignal 1 vom Eingang bis zum Rampengenerator 6 lediglich zwei Bauteile, nämlich den Komparator 2 und das Gatter N2. Dadurch wird eine sehr kurze Verzögerungszeit bis zum Start des Rampengenerators 6 von ca. 4 ns erreicht. Der Rampengenerator 6 besteht aus folgenden Baugruppen: - einer Konstantstromquelle mit der integrierten Schaltung IC1 und dem Transistor T5, - einem Umschalter mit den Transistoren T1, T2, - einer Entladestufe mit dem Transistor T4, - einer Auskoppelstufe mit dem Transistor T3, - einer Aufbereitung der Referenzspannung mit dem inte grierten Schaltkreis IC2 und mit einer Vergleichsstufe mit dem Komparator 7 und dem Gatter N4. Abhängig von den Spannungen an den Basiselektroden der Transistoren T1, T2 fliesst der Konstantstrom vom Kollektcr des Transistors T5 entweder in den Ladekondensator C1 oder über den Widerstand R3 ab. Die Spannung an der Basis des Transistors T1 beträgt stets ca. -7,5 Volt. Über die tHider- stände R5; R6, R7 wird das Steuersignal 17 für den Rampengenerator 6 auf den richtigen Pegel gebracht: Die logische tt1 It entspricht einer Spannung -7,1 Volt und die logische "O" entspricht einer Spannung -7,9 Volt. Bei einer logischen "O" am Ausgang des Gatters N2 wird also der Ladekondensator C1 geladen. Bei einer logischen "1" des Steuersignals 17 hält der Ladekondensator Cl den momentanen Spannungswert. Das Rampensignal 16 gelangt über den Source-Folger T an den invertierenden Eingang des Komparators 7. Das Rampensignal 16 kann dort einen Wert zwischen +2,5 Volt und -5,7 Volt einnehmen. Dabei beträgt die Spannung U, die das Rampensignal 16 zur Zeit T einnimmt, 0,6 Volt. Die DC-Vergleichs spannung 15 muss daher also für Verzögerungszeiten grösser als 20 ns Werte zwischen 0,6 Volt und -2,0 Volt und für Verzögerungszeiten kleiner als 20 ns Werte zwischen 2,5 Volt und 0,6 Volt annehmen. Um den Abgleichvorgang zu vereinfachen, wird dies folgendermassen realisiert: Für Verzögerungszeiten kleiner als 20 ns werden am Eingang des Digital /Analog-Wandlers 8 die Zahlen 00-7F und für Verzögerungszeiten grösser als 20 ns die Zahlen 80-FF verwendet. Dadurch wird das Signal X1 für Verzögerungszeiten kleiner als 40 ns nicht mehr benötigt. Dem Ausgangssignal 15 des Digital-/ Analog-Wandlers 8 wird eine Konstantspannung zur Nullpunktseinstellung aufaddiert. Dabei kann man über das Potentiometer P1 den Konstantstrom, über das Potentiometer P3 den Nullpunkt der Referenzspannung 15 und über das Potentiometer P4 die Verstärkung der Referenzspannung 15 einstellen. Der Komparator 7 vergleicht die Rampenspannung 16 mit der Referenzspannung 15 und liefert einen ECL-Spannungssprung als verzögertes Ausgangssignal 9. ber einen Konverter S10 kann ein TTL-Signal als Gate-Si- gnal zu einer Messsignalverarbeitungseinrichtung gelangen. Die Erfindung ist nicht auf die beschriebenen AusfüArungs- beispiele beschränkt. Wichtig ist, - dass Verzögerungszeiten grob unterteilt werden können und dass die Grobunterteilung feiner unterteilt werden kann, - dass zur Grobunterteilung ein Zähler mit vorgebbarem Zähl stand verwendet wird, - dass ein Eingangssignal das Ablaufen des Zählers und das Ablaufen einer Einrichtung zur feineren Unterteilung aus lösen kann, - dass dadurch im Vergleich mit einer vorgebbaren Referenz spannung ein in definierter Weise verzögertes Ausgangssignal ausgelöst werden kann und - dass dieses Ausgangssignal das automatische Laden eines neuen Zählerstandes in den Zähler veranlasst, wodurch eine sehr hohe Repetitionsrate ermöglicht wird. Sofern ein ausreichend frequenzstabiles Eingangssignal 1 vorliegt, kann dieses Eingangssignal 1 mit dem Signal 14 synchronisiert werden. Eine solche Synchronisation ermöglicht es, dass vom Eingangssignal 1 direkt der Ablauf des Zählvorgangs im Vorwahlzähler 4 ausgelöst wird und dass erst anschliessend der Rampengenerator 6 ohne zeitliche Unterbrechung solange angesteuert wird, bis das Rampensignal 16 den Wert der Referenzspannung 15 erreicht hat.

Claims: Patentansprüche = 1. Verfahren zur Erzeugung eines gegenüber einem Eingangssignal (1) um eine definierte Verzögerungszeit (tut4) verzögerten Ausgangssignals (9), bei dem die Verzögerungszeit (T+t4) schrittweise durch Zählen eines frequenzstabilen hochfrequenten Signals (14) entsprechend einem vorgegebenen Zählerstand (13) unterteilt wird, bei dem eine Feinunterteilung der Verzögerungszeit (T+t4) durch ein Rampensignal (16) erreicht wird, bei dem das Rampensignal (16) mit einem vorgegebenen Referenzsignal (15) verglichen wird, um nach der definierten Verzögerungszeit (T+t4) das verzögerte Ausgangssignal (9) abzugeben, dadurch g e k e n n z e i c h n e t dass über das verzögerte Ausgangssignal (9, 10) automatisch, doch. unabhängig von einem Rechner, das Laden eines neuen Zählerstandes (13) ausgelöst wird. 2. Verzögerungseinheit zur Erzeugung eines gegenüber einem Eingangssignal (1) um eine definierte Verzögerungszeit (tut4) verzögerten Ausgangssignals (9), - mit einem Zähler (4) zur schrittweisen Einstellung der Verzögerungszeit (T+t4), - mit einem frequenzstabilen Signalgeber (5) zur Abgabe von Signalen (14) an diesen Zähler (4), - mit einem Rampensignalgeber (6) zur Feinunterteilung der Verzögerungszeit (T+t4), - mit einer Einrichtung (8) zur Erzeugung eines Referenzsi gnals (15) für das Ausgangssignal (16) des Rampensignalge bers (6), g e k e n n z e i c h n e t durch eine Einrichtung (10) zur Rückführung des Ausgangssignals (9) zum Zähler (4) zum automatischen, rechnerunabhängigen Laden eines neuen Zählerstandes (13) in den Zähler (4).

Inventors: DALLMANN, ACHIM, DIPL.-PHYS.
Applicants: SIEMENS AKTIENGESELLSCHAFT
Application year: 1984
Main classification: H03K5
IPC codes: G01R31, H03K5, G01R13