それぞれの発光色が異なる複数の光源の点滅を独立に制御し、且つm行n列m、nは、4以上の自然数に配設された複数の画素毎に各発光色を呈する光の透過を制御することで画像を形成する液晶表示装置の駆動方法であって、第1の色を呈する光の透過を制御するための画像信号の入力が1行目に配設されたn個の画素乃至A行目Aは、m/2以下の自然数に配設されたn個の画素に対して順次行われる第1の期間内において、1行目に配設されたn個の画素乃至B行目Bは、A/2以下の自然数に配設されたn個の画素に対する前記第1の色を呈する光の透過を制御するための画像信号の入力が行われた後に、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素のそれぞれに対して前記第1の色を呈する光を供給する第1の工程と、前記第1の色と異なる第2の色を呈する光の透過を制御するための画像信号の入力が1行目に配設されたn個の画素乃至A行目に配設されたn個の画素に対して順次行われる第2の期間内において、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素に対する前記第2の色を呈する光の透過を制御するための画像信号の入力が行われた後に、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素のそれぞれに対して前記第2の色を呈する光を供給する第2の工程と、前記第1の色及び前記第2の色と異なる第3の色を呈する光の透過を制御するための画像信号の入力が1行目に配設されたn個の画素乃至A行目に配設されたn個の画素に対して順次行われる第3の期間内において、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素に対する前記第3の色を呈する光の透過を制御するための画像信号の入力が行われた後に、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素のそれぞれに対して前記第3の色を呈する光を供給する第3の工程と、を有し、前記第1の工程乃至前記第3の工程のそれぞれを少なくとも1回含む第1の工程順序にしたがって各工程を行うことで、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素に第1の画像を形成し、前記第1の工程乃至前記第3の工程のそれぞれを少なくとも1回含み、且つ前記第1の工程順序と異なる第2の工程順序にしたがって各工程を行うことで、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素に、前記第1の画像に続いて第2の画像を形成する液晶表示装置の駆動方法。請求項1において、前記第1の色を呈する光の透過を制御するための画像信号の入力がA1行目に配設されたn個の画素乃至2A行目に配設されたn個の画素に対して順次行われる第4の期間内において、A1行目に配設されたn個の画素乃至AB行目に配設されたn個の画素に対する前記第1の色を呈する光の透過を制御するための画像信号の入力が行われた後に、A1行目に配設されたn個の画素乃至AB行目に配設されたn個の画素のそれぞれに対して前記第1の色を呈する光を供給する第4の工程と、前記第2の色を呈する光の透過を制御するための画像信号の入力がA1行目に配設されたn個の画素乃至2A行目に配設されたn個の画素に対して順次行われる第5の期間内において、A1行目に配設されたn個の画素乃至AB行目に配設されたn個の画素に対する前記第2の色を呈する光の透過を制御するための画像信号の入力が行われた後に、A1行目に配設されたn個の画素乃至AB行目に配設されたn個の画素のそれぞれに対して前記第2の色を呈する光を供給する第5の工程と、前記第3の色を呈する光の透過を制御するための画像信号の入力がA1行目に配設されたn個の画素乃至2A行目に配設されたn個の画素に対して順次行われる第6の期間内において、A1行目に配設されたn個の画素乃至AB行目に配設されたn個の画素に対する前記第3の色を呈する光の透過を制御するための画像信号の入力が行われた後に、A1行目に配設されたn個の画素乃至AB行目に配設されたn個の画素のそれぞれに対して前記第3の色を呈する光を供給する第6の工程と、を有し、前記第4の期間は、前記第1の期間に続く期間であり、前記第5の期間は、前記第2の期間に続く期間であり、前記第6の期間は、前記第3の期間に続く期間である液晶表示装置の駆動方法。請求項1又は請求項2において、前記第1の工程順序における最初の工程及び最後の工程が、前記第1の工程であり、前記第2の工程順序における最初の工程及び最後の工程が、前記第2の工程である液晶表示装置の駆動方法。請求項1乃至請求項3のいずれか一項において、前記第1の色を呈する光の視感度が、前記第2の色を呈する光の視感度より高く、且つ前記第3の色を呈する光の視感度より高く、前記第1の工程順序に含まれる前記第1の工程の数が、前記第1の工程順序に含まれる第2の工程の数の同数以上であり、且つ前記第1の工程順序に含まれる第3の工程の数の同数以上であり、前記第2の工程順序に含まれる前記第1の工程の数が、前記第2の工程順序に含まれる第2の工程の数の同数以上であり、且つ前記第2の工程順序に含まれる第3の工程の数の同数以上である液晶表示装置の駆動方法。請求項1乃至請求項4のいずれか一項において、前記第1の色を呈する光、前記第2の色を呈する光、及び前記第3の色を呈する光を混色すると白色光となる液晶表示装置の駆動方法。上述したように、フィールドシーケンシャル方式によって表示を行う液晶表示装置では特定色を呈する光毎に表示期間が時間分割される。そのため、短時間の表示が遮られること例えば、利用者の瞬きに起因して特定の表示情報が欠落することがある。この場合、利用者に視認される表示が、本来の表示情報に基づく表示から変化劣化すること静的なカラーブレイク、静的な色割れともいうになる。また、続けて表示される画像における表示物の変位量が大きいこと例えば、動きが速いスポーツ映像の表示に起因して連続するフレームにおける表示情報が連続性を失うことがある。この場合、当該表示物の輪郭周辺部において利用者に視認される表示が所望の表示から変化劣化すること動的なカラーブレイク、動的な色割れともいうになる。そこで、本発明の一態様は、フィールドシーケンシャル方式によって表示を行う液晶表示装置の画質の低下を抑制することを課題の一とする。本発明の一態様は、それぞれの発光色が異なる複数の光源の点滅を独立に制御し、且つm行n列m、nは、4以上の自然数に配設された複数の画素毎に各発光色を呈する光の透過を制御することで画像を形成する液晶表示装置の駆動方法であって、第1の色を呈する光の透過を制御するための画像信号の入力が1行目に配設されたn個の画素乃至A行目Aは、m/2以下の自然数に配設されたn個の画素に対して順次行われる第1の期間内において、1行目に配設されたn個の画素乃至B行目Bは、A/2以下の自然数に配設されたn個の画素に対する第1の色を呈する光の透過を制御するための画像信号の入力が行われた後に、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素のそれぞれに対して第1の色を呈する光を供給する第1の工程と、第1の色と異なる第2の色を呈する光の透過を制御するための画像信号の入力が1行目に配設されたn個の画素乃至A行目に配設されたn個の画素に対して順次行われる第2の期間内において、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素に対する第2の色を呈する光の透過を制御するための画像信号の入力が行われた後に、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素のそれぞれに対して第2の色を呈する光を供給する第2の工程と、第1の色及び第2の色と異なる第3の色を呈する光の透過を制御するための画像信号の入力が1行目に配設されたn個の画素乃至A行目に配設されたn個の画素に対して順次行われる第3の期間内において、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素に対する第3の色を呈する光の透過を制御するための画像信号の入力が行われた後に、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素のそれぞれに対して第3の色を呈する光を供給する第3の工程と、を有し、第1の工程乃至第3の工程のそれぞれを少なくとも1回含む第1の工程順序にしたがって各工程を行うことで、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素に第1の画像を形成し、第1の工程乃至第3の工程のそれぞれを少なくとも1回含み、且つ第1の工程順序と異なる第2の工程順序にしたがって各工程を行うことで、1行目に配設されたn個の画素乃至B行目に配設されたn個の画素に、第1の画像に続いて第2の画像を形成する液晶表示装置の駆動方法である。本発明の一態様の液晶表示装置の駆動方法では、画素部の特定の領域に含まれる複数の画素の一部に対する画像信号の入力と、当該一部とは異なる複数の画素の一部に対する光の供給とを並行して行う。これにより、当該領域に含まれる複数の画素の全てに対して画像信号が入力された後に、それらに対して光を供給する期間を設ける必要がなくなる。すなわち、当該領域に含まれる複数の画素の全てに対して画像信号が入力された直後から、それらに対する次の画像信号の入力を開始することが可能となる。したがって、本発明の一態様の液晶表示装置の駆動方法においては、画像信号の入力頻度を向上することが可能となる。これにより、液晶表示装置におけるフレーム周波数を向上することが可能となる。その結果、フィールドシーケンシャル方式によって表示を行う液晶表示装置において生じる表示の変化劣化を抑制することが可能である。なお、フィールドシーケンシャル方式によって表示を行う液晶表示装置におけるフレーム周波数の向上は、上述の静的なカラーブレイク及び動的なカラーブレイクの発生の抑制に有効である。また、本発明の一態様の液晶表示装置の駆動方法では、続けて表示される2枚の画像を異なる光の供給順序によって形成する。これにより、続けて表示される画像における表示物の変位量が大きい場合に生じる動的なカラーブレイクを抑制することが可能となる。具体的に述べると、フィールドシーケンシャル方式によって表示を行う液晶表示装置においては、表示物の変位方向側の輪郭周辺部は画像形成の際に最初に供給される光が使用者に強く視認され、且つ当該表示物の変位方向とは反対側の輪郭周辺部は画像形成の際に最後に供給される光が使用者に強く視認される。したがって、当該最初に供給される光又は当該最後に供給される光が、続けて表示される画像において同一であると、当該表示物の一部の輪郭周辺部が本来の色ではなく、当該最初に供給される光が呈する色又は当該最後に供給される光が呈する色として利用者に視認されやすくなる。これに対して、本発明の一態様の液晶表示装置の駆動方法では、当該最初に供給される光及び当該最後に供給される光を、続いて表示される2枚の画像の形成に際して異ならせることが可能である。したがって、当該表示物の一部の輪郭周辺部が本来の色とは異なる色として利用者に視認される蓋然性を低下させることが可能である。その結果、フィールドシーケンシャル方式によって表示を行う液晶表示装置において生じる表示の変化劣化を抑制することが可能である。以下では、本発明の実施の形態について図面を用いて詳細に説明する。ただし、本発明は以下の説明に限定されず、本発明の趣旨およびその範囲から逸脱することなくその形態および詳細を様々に変更し得ることは、当業者であれば容易に理解される。したがって、本発明は以下に示す実施の形態の記載内容に限定して解釈されるものではない。まず、本発明の一態様の液晶表示装置について図1~図6を参照して説明する。<液晶表示装置の構成例>図1Aは、液晶表示装置の構成例を示す図である。図1Aに示す液晶表示装置は、画素部10と、走査線駆動回路11と、信号線駆動回路12と、各々が平行又は略平行に配設され、且つ走査線駆動回路11によって電位が制御されるm本の走査線13と、各々が平行又は略平行に配設され、且つ信号線駆動回路12によって電位が制御されるn本の信号線14と、を有する。さらに、画素部10は、3つの領域領域101~領域103に分割され、領域毎にマトリクス状に配設された複数の画素を有する。なお、各走査線13は、画素部10においてm行n列に配設された複数の画素のうち、いずれかの行に配設されたn個の画素に電気的に接続されている。また、各信号線14は、m行n列に配設された複数の画素のうち、いずれかの列に配設されたm個の画素に電気的に接続されている。図1Bは、図1Aに示す液晶表示装置が有する画素15の回路図の一例を示す図である。図1Bに示す画素15は、ゲートが走査線13に電気的に接続され、ソース及びドレインの一方が信号線14に電気的に接続されたトランジスタ16と、一方の電極がトランジスタ16のソース及びドレインの他方に電気的に接続され、他方の電極が容量電位を供給する配線容量線ともいうに電気的に接続された容量素子17と、一方の電極がトランジスタ16のソース及びドレインの他方及び容量素子17の一方の電極に電気的に接続され、他方の電極が共通電位を供給する配線共通電位線ともいうに電気的に接続された液晶素子18と、を有する。なお、トランジスタ16は、nチャネル型のトランジスタである。また、容量電位と共通電位を同一の電位とすることが可能である。<走査線駆動回路11の構成例>図2Aは、図1Aに示す液晶表示装置が有する走査線駆動回路11の構成例を示す図である。図2Aに示す走査線駆動回路11は、第1の走査線駆動回路用クロック信号GCK1を供給する配線乃至第4の走査線駆動回路用クロック信号GCK4を供給する配線と、第1のパルス幅制御信号PWC1を供給する配線乃至第6のパルス幅制御信号PWC6を供給する配線と、1行目に配設された走査線13_1に電気的に接続された第1のパルス出力回路20_1、乃至、m行目に配設された走査線13_mに電気的に接続された第mのパルス出力回路20_mと、を有する。なお、ここでは、第1のパルス出力回路20_1~第kのパルス出力回路20_kkは、m/2未満の4の倍数が、領域101に配設された走査線13_1~走査線13_kに電気的に接続され、第k1のパルス出力回路20_k1~第2kのパルス出力回路20_2kが、領域102に配設された走査線13_k1~走査線13_2kに電気的に接続され、第2k1のパルス出力回路20_2k1~第mのパルス出力回路20_mが領域103に配設された走査線13_2k1~走査線13_mに電気的に接続されていることとする。また、第1のパルス出力回路20_1乃至第mのパルス出力回路20_mは、第1のパルス出力回路20_1に入力される走査線駆動回路用スタートパルスGSPをきっかけとしてシフト期間毎にシフトパルスを順次シフトする機能を有する。さらに、第1のパルス出力回路20_1乃至第mのパルス出力回路において複数のシフトパルスのシフトを並行して行うことが可能である。すなわち、第1のパルス出力回路20_1乃至第mのパルス出力回路20_mにおいてシフトパルスのシフトが行われている期間内であっても、第1のパルス出力回路20_1に走査線駆動回路用スタートパルスGSPを入力することが可能である。図2Bは、上記信号の具体的な波形の一例を示す図である。図2Bに示す第1の走査線駆動回路用クロック信号GCK1は、周期的にハイレベルの電位高電源電位Vddとロウレベルの電位低電源電位Vssを繰り返す、デューティー比が1/4の信号である。また、第2の走査線駆動回路用クロック信号GCK2は、第1の走査線駆動回路用クロック信号GCK1から1/4周期分位相がずれた信号であり、第3の走査線駆動回路用クロック信号GCK3は、第1の走査線駆動回路用クロック信号GCK1から1/2周期位相がずれた信号であり、第4の走査線駆動回路用クロック信号GCK4は、第1の走査線駆動回路用クロック信号GCK1から3/4周期位相がずれた信号である。第1のパルス幅制御信号PWC1は、周期的にハイレベルの電位高電源電位Vddとロウレベルの電位低電源電位Vssを繰り返す、デューティー比が1/3の信号である。また、第2のパルス幅制御信号PWC2は、第1のパルス幅制御信号PWC1から1/6周期位相がずれた信号であり、第3のパルス幅制御信号PWC3は、第1のパルス幅制御信号PWC1から1/3周期位相がずれた信号であり、第4のパルス幅制御信号PWC4は、第1のパルス幅制御信号PWC1から1/2周期位相がずれた信号であり、第5のパルス幅制御信号PWC5は、第1のパルス幅制御信号PWC1から2/3周期位相がずれた信号であり、第6のパルス幅制御信号PWC6は、第1のパルス幅制御信号PWC1から5/6周期位相がずれた信号である。なお、ここでは、第1の走査線駆動回路用クロック信号GCK1乃至第4の走査線駆動回路用クロック信号GCK4のパルス幅と第1のパルス幅制御信号PWC1乃至第6のパルス幅制御信号PWC6のパルス幅の比は、3:2とする。上述した液晶表示装置においては、第1のパルス出力回路20_1乃至第mのパルス出力回路20_mのそれぞれとして、同一の構成を有する回路を適用することができる。ただし、パルス出力回路が有する複数の端子の電気的な接続関係は、パルス出力回路毎に異なる。具体的な接続関係について図2A、Cを参照して説明する。第1のパルス出力回路20_1乃至第mのパルス出力回路20_mのそれぞれは、端子21~端子27を有する。なお、端子21~端子24及び端子26は入力端子であり、端子25及び端子27は出力端子である。まず、端子21について述べる。第1のパルス出力回路20_1の端子21は、走査線駆動回路用スタートパルスGSPを供給する配線に電気的に接続され、第2のパルス出力回路20_2~第mのパルス出力回路20_mの端子21は、前段のパルス出力回路の端子27に電気的に接続されている。次いで、端子22について述べる。第4a-3のパルス出力回路aは、m/4以下の自然数の端子22は、第1の走査線駆動回路用クロック信号GCK1を供給する配線に電気的に接続され、第4a-2のパルス出力回路の端子22は、第2の走査線駆動回路用クロック信号GCK2を供給する配線に電気的に接続され、第4a-1のパルス出力回路の端子22は、第3の走査線駆動回路用クロック信号GCK3を供給する配線に電気的に接続され、第4aのパルス出力回路の端子22は、第4の走査線駆動回路用クロック信号GCK4を供給する配線に電気的に接続されている。次いで、端子23について述べる。第4a-3のパルス出力回路の端子23は、第2の走査線駆動回路用クロック信号GCK2を供給する配線に電気的に接続され、第4a-2のパルス出力回路の端子23は、第3の走査線駆動回路用クロック信号GCK3を供給する配線に電気的に接続され、第4a-1のパルス出力回路の端子23は、第4の走査線駆動回路用クロック信号GCK4を供給する配線に電気的に接続され、第4aのパルス出力回路の端子23は、第1の走査線駆動回路用クロック信号GCK1を供給する配線に電気的に接続されている。次いで、端子24について述べる。第2b-1のパルス出力回路bは、k/2以下の自然数の端子24は、第1のパルス幅制御信号PWC1を供給する配線に電気的に接続され、第2bのパルス出力回路の端子24は、第4のパルス幅制御信号PWC4を供給する配線に電気的に接続され、第2c-1のパルス出力回路cは、k/21以上k以下の自然数の端子24は、第2のパルス幅制御信号PWC2を供給する配線に電気的に接続され、第2cのパルス出力回路の端子24は、第5のパルス幅制御信号PWC5を供給する配線に電気的に接続され、第2d-1のパルス出力回路dは、k1以上m/2以下の自然数の端子24は、第3のパルス幅制御信号PWC3を供給する配線に電気的に接続され、第2dのパルス出力回路の端子24は、第6のパルス幅制御信号PWC6を供給する配線に電気的に接続されている。次いで、端子25について述べる。第xのパルス出力回路xは、m以下の自然数の端子25は、x行目に配設された走査線13_xに電気的に接続されている。次いで、端子26について述べる。第yのパルス出力回路yは、m-1以下の自然数の端子26は、第y1のパルス出力回路の端子27に電気的に接続され、第mのパルス出力回路の端子26は、第mのパルス出力回路用ストップ信号STPを供給する配線に電気的に接続されている。なお、第mのパルス出力回路用ストップ信号STPは、仮に第m1のパルス出力回路が設けられていれば、当該第m1のパルス出力回路の端子27から出力される信号に相当する信号である。具体的には、これらの信号は、実際にダミー回路として第m1のパルス出力回路を設けること、又は外部から当該信号を直接入力することなどによって第mのパルス出力回路に供給することができる。各パルス出力回路の端子27の接続関係は既出である。そのため、ここでは前述の説明を援用することとする。<パルス出力回路の構成例>図3Aは、図2A、Cに示すパルス出力回路の構成例を示す図である。図3Aに示すパルス出力回路は、トランジスタ31乃至トランジスタ39を有する。トランジスタ31は、ソース及びドレインの一方が高電源電位Vddを供給する配線以下、高電源電位線ともいうに電気的に接続され、ゲートが端子21に電気的に接続されている。トランジスタ32は、ソース及びドレインの一方が低電源電位Vssを供給する配線以下、低電源電位線ともいうに電気的に接続され、ソース及びドレインの他方がトランジスタ31のソース及びドレインの他方に電気的に接続されている。トランジスタ33は、ソース及びドレインの一方が端子22に電気的に接続され、ソース及びドレインの他方が端子27に電気的に接続され、ゲートがトランジスタ31のソース及びドレインの他方並びにトランジスタ32のソース及びドレインの他方に電気的に接続されている。トランジスタ34は、ソース及びドレインの一方が低電源電位線に電気的に接続され、ソース及びドレインの他方が端子27に電気的に接続され、ゲートがトランジスタ32のゲートに電気的に接続されている。トランジスタ35は、ソース及びドレインの一方が低電源電位線に電気的に接続され、ソース及びドレインの他方がトランジスタ32のゲート及びトランジスタ34のゲートに電気的に接続され、ゲートが端子21に電気的に接続されている。トランジスタ36は、ソース及びドレインの一方が高電源電位線に電気的に接続され、ソース及びドレインの他方がトランジスタ32のゲート、トランジスタ34のゲート、並びにトランジスタ35のソース及びドレインの他方に電気的に接続され、ゲートが端子26に電気的に接続されている。なお、トランジスタ36のソース及びドレインの一方が、低電源電位Vssよりも高電位であり且つ高電源電位Vddよりも低電位である電源電位Vccを供給する配線に電気的に接続されている構成とすることもできる。トランジスタ37は、ソース及びドレインの一方が高電源電位線に電気的に接続され、ソース及びドレインの他方がトランジスタ32のゲート、トランジスタ34のゲート、トランジスタ35のソース及びドレインの他方、並びにトランジスタ36のソース及びドレインの他方に電気的に接続され、ゲートが端子23に電気的に接続されている。なお、トランジスタ37のソース及びドレインの一方が、電源電位Vccを供給する配線に電気的に接続されている構成とすることもできる。トランジスタ38は、ソース及びドレインの一方が端子24に電気的に接続され、ソース及びドレインの他方が端子25に電気的に接続され、ゲートがトランジスタ31のソース及びドレインの他方、トランジスタ32のソース及びドレインの他方、並びにトランジスタ33のゲートに電気的に接続されている。トランジスタ39は、ソース及びドレインの一方が低電源電位線に電気的に接続され、ソース及びドレインの他方が端子25に電気的に接続され、ゲートがトランジスタ32のゲート、トランジスタ34のゲート、トランジスタ35のソース及びドレインの他方、トランジスタ36のソース及びドレインの他方、並びにトランジスタ37のソース及びドレインの他方に電気的に接続されている。なお、以下においては、トランジスタ31のソース及びドレインの他方、トランジスタ32のソース及びドレインの他方、トランジスタ33のゲート、並びにトランジスタ38のゲートが電気的に接続されたノードをノードAとし、トランジスタ32のゲート、トランジスタ34のゲート、トランジスタ35のソース及びドレインの他方、トランジスタ36のソース及びドレインの他方、トランジスタ37のソース及びドレインの他方、並びにトランジスタ39のゲートが電気的に接続されたノードをノードBとして説明する。<パルス出力回路の動作例>上述したパルス出力回路の動作例について図3B~Dを参照して説明する。なお、ここでは、第1のパルス出力回路20_1の端子21に入力される走査線駆動回路用スタートパルスGSPの入力タイミングを制御することで、第1のパルス出力回路20_1、第k1のパルス出力回路20_k1、及び第2k1のパルス出力回路20_2k1の端子27から同一タイミングでシフトパルスを出力する場合の動作例について説明する。具体的には、図3Bは、走査線駆動回路用スタートパルスGSPが入力される際の第1のパルス出力回路20_1の各端子に入力される信号の電位、並びにノードA及びノードBの電位を示しており、図3Cは、第kのパルス出力回路20_kからハイレベルの電位が入力される際の第k1のパルス出力回路20_k1の各端子に入力される信号の電位、並びにノードA及びノードBの電位を示しており、図3Dは、第2kのパルス出力回路20_2kからハイレベルの電位が入力される際の第2k1のパルス出力回路20_2k1の各端子に入力される信号の電位、並びにノードA及びノードBの電位を示している。なお、図3B~Dでは、各端子に入力される信号を括弧書きで付記している。また、それぞれの後段に配設されるパルス出力回路第2のパルス出力回路20_2、第k2のパルス出力回路20_k2、第2k2のパルス出力回路20_2k2の端子25から出力される信号Gout2、Goutk2、Gout2k2及び端子27から出力される信号SRout2=第1のパルス出力回路20_1の端子26の入力信号、SRoutk2=第k1のパルス出力回路20_k1の端子26の入力信号、SRout2k2=第2k1のパルス出力回路20_2k1の端子26の入力信号も付記している。なお、図中において、Goutは、パルス出力回路の走査線に対する出力信号を表し、SRoutは、当該パルス出力回路の、前段及び後段のパルス出力回路に対する出力信号を表している。まず、図3Bを参照して、第1のパルス出力回路20_1に走査線駆動回路用スタートパルスGSPとしてハイレベルの電位が入力される場合について説明する。期間t1において、端子21にハイレベルの電位高電源電位Vddが入力される。これにより、トランジスタ31、35がオン状態となる。そのため、ノードAの電位がハイレベルの電位高電源電位Vddからトランジスタ31のしきい値電圧分下降した電位に上昇し、且つノードBの電位が低電源電位Vssに下降する。これに付随して、トランジスタ33、38がオン状態となり、トランジスタ32、34、39がオフ状態となる。以上により、期間t1において、端子27から出力される信号は、端子22に入力される信号となり、端子25から出力される信号は、端子24に入力される信号となる。ここで、期間t1において、端子22及び端子24に入力される信号は、共にロウレベルの電位低電源電位Vssである。そのため、期間t1において、第1のパルス出力回路20_1は、第2のパルス出力回路20_2の端子21、及び画素部において1行目に配設された走査線にロウレベルの電位低電源電位Vssを出力する。期間t2において、各端子に入力される信号は期間t1から変化しない。そのため、端子25及び端子27から出力される信号も変化せず、共にロウレベルの電位低電源電位Vssを出力する。期間t3において、端子24にハイレベルの電位高電源電位Vddが入力される。なお、ノードAの電位トランジスタ31のソースの電位は、期間t1においてハイレベルの電位高電源電位Vddからトランジスタ31のしきい値電圧分下降した電位まで上昇している。そのため、トランジスタ31はオフ状態となっている。この時、端子24にハイレベルの電位高電源電位Vddが入力されることで、トランジスタ38のソースとゲートの容量結合によって、ノードAの電位トランジスタ38のゲートの電位がさらに上昇するブートストラップ動作。また、当該ブートストラップ動作を行うことによって、端子25から出力される信号が端子24に入力されるハイレベルの電位高電源電位Vddから下降することがない。そのため、期間t3において、第1のパルス出力回路20_1は、画素部において1行目に配設された走査線にハイレベルの電位高電源電位Vdd=選択信号を出力する。期間t4において、端子22にハイレベルの電位高電源電位Vddが入力される。ここで、ノードAの電位は、ブートストラップ動作によって上昇しているため、端子27から出力される信号が端子22に入力されるハイレベルの電位高電源電位Vddから下降することがない。そのため、期間t4において、端子27からは、端子22に入力されるハイレベルの電位高電源電位Vddが出力される。すなわち、第1のパルス出力回路20_1は、第2のパルス出力回路20_2の端子21にハイレベルの電位高電源電位Vdd=シフトパルスを出力する。また、期間t4において、端子24に入力される信号はハイレベルの電位高電源電位Vddを維持するため、第1のパルス出力回路20_1から画素部において1行目に配設された走査線に対して出力される信号は、ハイレベルの電位高電源電位Vdd=選択信号のままである。なお、期間t4における当該パルス出力回路の出力信号には直接関与しないが、端子21にロウレベルの電位低電源電位Vssが入力されるためトランジスタ35はオフ状態となる。期間t5において、端子24にロウレベルの電位低電源電位Vssが入力される。ここで、トランジスタ38はオン状態を維持する。そのため、期間t5において、第1のパルス出力回路20_1から画素部において1行目に配設された走査線に対して出力される信号は、ロウレベルの電位低電源電位Vssとなる。期間t6において、各端子に入力される信号は期間t5から変化しない。そのため、端子25及び端子27から出力される信号も変化せず、端子25からはロウレベルの電位低電源電位Vssが出力され、端子27からはハイレベルの電位高電源電位Vdd=シフトパルスが出力される。期間t7において、端子23にハイレベルの電位高電源電位Vddが入力される。これにより、トランジスタ37がオン状態となる。そのため、ノードBの電位がハイレベルの電位高電源電位Vddからトランジスタ37のしきい値電圧分下降した電位に上昇する。つまり、トランジスタ32、34、39がオン状態となる。また、これに付随して、ノードAの電位がロウレベルの電位低電源電位Vssへと下降する。つまり、トランジスタ33、38がオフ状態となる。以上により、期間t7において、端子25及び端子27から出力される信号は、共に低電源電位Vssとなる。すなわち、期間t7において、第1のパルス出力回路20_1は、第2のパルス出力回路20_2の端子21、及び画素部において1行目に配設された走査線に低電源電位Vssを出力する。次いで、図3Cを参照して、第k1のパルス出力回路20_k1の端子21に第kのパルス出力回路20_kからシフトパルスとしてハイレベルの電位が入力される場合について説明する。期間t1及び期間t2において、第k1のパルス出力回路20_k1の動作は、上述した第1のパルス出力回路20_1と同様である。そのため、ここでは前述の説明を援用することとする。期間t3において、各端子に入力される信号は期間t2から変化しない。そのため、端子25及び端子27から出力される信号も変化せず、共にロウレベルの電位低電源電位Vssを出力する。期間t4において、端子22及び端子24にハイレベルの電位高電源電位Vddが入力される。なお、ノードAの電位トランジスタ31のソースの電位は、期間t1においてハイレベルの電位高電源電位Vddからトランジスタ31のしきい値電圧分下降した電位まで上昇している。そのため、トランジスタ31は、期間t1においてオフ状態となっている。ここで、端子22及び端子24にハイレベルの電位高電源電位Vddが入力されることで、トランジスタ33のソースとゲート、及びトランジスタ38のソースとゲートの容量結合によって、ノードAの電位トランジスタ33、38のゲートの電位がさらに上昇するブートストラップ動作。また、当該ブートストラップ動作を行うことによって、端子25及び端子27から出力される信号が端子22及び端子24に入力されるハイレベルの電位高電源電位Vddから下降することがない。そのため、期間t4において、第k1のパルス出力回路20_k1は、画素部においてk1行目に配設された走査線及び第k2のパルス出力回路20_k2の端子21にハイレベルの電位高電源電位Vdd=選択信号、シフトパルスを出力する。期間t5において、各端子に入力される信号は期間t4から変化しない。そのため、端子25及び端子27から出力される信号も変化せず、ハイレベルの電位高電源電位Vdd=選択信号、シフトパルスを出力する。期間t6において、端子24にロウレベルの電位低電源電位Vssが入力される。ここで、トランジスタ38はオン状態を維持する。そのため、期間t6において、第k1のパルス出力回路20_k1から画素部においてk1行目に配設された走査線に対して出力される信号は、ロウレベルの電位低電源電位Vssとなる。期間t7において、端子23にハイレベルの電位高電源電位Vddが入力される。これにより、トランジスタ37がオン状態となる。そのため、ノードBの電位がハイレベルの電位高電源電位Vddからトランジスタ37のしきい値電圧分下降した電位に上昇する。つまり、トランジスタ32、34、39がオン状態となる。また、これに付随して、ノードAの電位がロウレベルの電位低電源電位Vssへと下降する。つまり、トランジスタ33、38がオフ状態となる。以上により、期間t7において、端子25及び端子27から出力される信号は、共に低電源電位Vssとなる。すなわち、期間t7において、第k1のパルス出力回路20_k1は、第k2のパルス出力回路20_k2の端子21、及び画素部においてk1行目に配設された走査線に低電源電位Vssを出力する。次いで、図3Dを参照して、第2k1のパルス出力回路20_2k1の端子21に第2kのパルス出力回路20_2kからシフトパルスとしてハイレベルの電位が入力される場合について説明する。期間t1乃至期間t3において、第2k1のパルス出力回路20_2k1の動作は、上述した第k1のパルス出力回路20_k1と同様である。そのため、ここでは前述の説明を援用することとする。期間t4において、端子22にハイレベルの電位高電源電位Vddが入力される。なお、ノードAの電位トランジスタ31のソースの電位は、期間t1においてハイレベルの電位高電源電位Vddからトランジスタ31のしきい値電圧分下降した電位まで上昇している。そのため、トランジスタ31は、期間t1においてオフ状態となっている。ここで、端子22にハイレベルの電位高電源電位Vddが入力されることで、トランジスタ33のソースとゲートの容量結合によって、ノードAの電位トランジスタ33のゲートの電位がさらに上昇するブートストラップ動作。また、当該ブートストラップ動作を行うことによって、端子27から出力される信号が端子22に入力されるハイレベルの電位高電源電位Vddから下降することがない。そのため、期間t4において、第2k1のパルス出力回路20_2k1は、第2k2のパルス出力回路20_2k2の端子21にハイレベルの電位高電源電位Vdd=シフトパルスを出力する。なお、期間t4における当該パルス出力回路の出力信号には直接関与しないが、端子21にロウレベルの電位低電源電位Vssが入力されるためトランジスタ35はオフ状態となる。期間t5において、端子24にハイレベルの電位高電源電位Vddが入力される。ここで、ノードAの電位は、ブートストラップ動作によって上昇しているため、端子25から出力される信号が端子24に入力されるハイレベルの電位高電源電位Vddから下降することがない。そのため、期間t5において、端子25からは、端子22に入力されるハイレベルの電位高電源電位Vddが出力される。すなわち、第2k1のパルス出力回路20_2k1は、画素部において2k1行目に配設された走査線にハイレベルの電位高電源電位Vdd=選択信号を出力する。また、期間t5において、端子22に入力される信号はハイレベルの電位高電源電位Vddを維持するため、第2k1のパルス出力回路20_2k1から第2k2のパルス出力回路20_2k2の端子21に対して出力される信号は、ハイレベルの電位高電源電位Vdd=シフトパルスのままである。期間t6において、各端子に入力される信号は期間t5から変化しない。そのため、端子25及び端子27から出力される信号も変化せず、共にハイレベルの電位高電源電位Vdd=選択信号、シフトパルスを出力する。期間t7において、端子23にハイレベルの電位高電源電位Vddが入力される。これにより、トランジスタ37がオン状態となる。そのため、ノードBの電位がハイレベルの電位高電源電位Vddからトランジスタ37のしきい値電圧分下降した電位に上昇する。つまり、トランジスタ32、34、39がオン状態となる。また、これに付随して、ノードAの電位がロウレベルの電位低電源電位Vssへと下降する。つまり、トランジスタ33、38がオフ状態となる。以上により、期間t7において、端子25及び端子27から出力される信号は、共に低電源電位Vssとなる。すなわち、期間t7において、第2k1のパルス出力回路20_2k1は、第2k2のパルス出力回路20_2k2の端子21、及び画素部において2k1行目に配設された走査線に低電源電位Vssを出力する。図3B~Dに示すように、第1のパルス出力回路20_1乃至第mのパルス出力回路20_mでは、走査線駆動回路用スタートパルスGSPの入力タイミングを制御することで、複数のシフトパルスのシフトを並行して行うことが可能である。具体的には、走査線駆動回路用スタートパルスGSPの入力後、第kのパルス出力回路20_kの端子27からシフトパルスが出力されるタイミングと同じタイミングで再度走査線駆動回路用スタートパルスGSPを入力することによって、第1のパルス出力回路20_1及び第k1のパルス出力回路20_k1から同じタイミングでシフトパルスを出力させることが可能である。また、同様に走査線駆動回路用スタートパルスGSPを入力することによって、第1のパルス出力回路20_1、第k1のパルス出力回路20_k1、及び第2k1のパルス出力回路20_2k1から同じタイミングでシフトパルスを出力させることが可能である。加えて、第1のパルス出力回路20_1、第k1のパルス出力回路20_k1、及び第2k1のパルス出力回路20_2k1は、上記の動作に並行して、それぞれ異なるタイミングで走査線に対する選択信号の供給を行うことが可能である。すなわち、上述した走査線駆動回路は、固有のシフト期間を有するシフトパルスを複数シフトし且つ同一タイミングにおいてシフトパルスが入力された複数のパルス出力回路がそれぞれ異なるタイミングで走査線に対して選択信号を供給することが可能である。<信号線駆動回路12の構成例>図4Aは、図1Aに示す液晶表示装置が有する信号線駆動回路12の構成例を示す図である。図4Aに示す信号線駆動回路12は、第1の出力端子乃至第nの出力端子を有するシフトレジスタ120と、画像信号DATAを供給する配線と、トランジスタ121_1乃至トランジスタ121_nと、を有する。なお、トランジスタ121_wwは、1以上n以下の自然数は、ソース及びドレインの一方が画像信号DATAを供給する配線に電気的に接続され、ソース及びドレインの他方が画素部においてw列目に配設された信号線14_wに電気的に接続され、ゲートがシフトレジスタ120の第wの出力端子に電気的に接続されている。また、シフトレジスタ120は、信号線駆動回路用スタートパルスSSPとしてハイレベルの電位が入力されることをきっかけとしてシフト期間毎に順次第1の出力端子乃至第nの出力端子からハイレベルの電位を出力する機能を有する。すなわち、トランジスタ121_1乃至トランジスタ121_nは、シフト期間毎に順次オン状態となる。図4Bは、画像信号DATAを供給する配線が供給する画像信号のタイミングの一例を示す図である。図4Bに示すように、画像信号DATAを供給する配線は、期間t4において、1行目に配設された画素用画像信号data1を供給し、期間t5において、k1行目に配設された画素用画像信号datak1を供給し、期間t6において、2k1行目に配設された画素用画像信号data2k1を供給し、期間t7において、2行目に配設された画素用画像信号data2を供給する。以下、同様に画像信号DATAを供給する配線は、特定の行に配設された画素用画像信号を順次供給する。具体的には、s行目sは、k未満の自然数に配設された画素用画像信号→ks行目に配設された画素用画像信号→2ks行目に配設された画素用画像信号→s1行目に配設された画素用画像信号という順序で画像信号を供給する。上述した走査線駆動回路及び信号線駆動回路が当該動作を行うことにより、走査線駆動回路が有するパルス出力回路におけるシフト期間毎に画素部に配設された3行の画素に対する画像信号の入力を行うことが可能である。すなわち、上述した走査線駆動回路及び信号線駆動回路が当該動作を行うことにより、m行n列に配設された複数の画素に対して、3種類の画像信号の走査を並行して行うことが可能である。<バックライトの構成例>図5は、図1Aに示す液晶表示装置の画素部10の背後に設けられるバックライトの構成例を示す図である。図5に示すバックライトは、マトリクス状に配設された複数のバックライトユニット40を有する。なお、バックライトユニット40は、赤Rを呈する光の光源、緑Gを呈する光の光源、及び青Bを呈する光の光源を有する。また、複数のバックライトユニット40における光源の点滅は、バックライト制御回路41によって制御される。なお、ここでは、バックライト制御回路41は、m行n列に配設された複数の画素のうちt行n列ここでは、tは、k/4とするに配設された画素に対して光を照射するためのバックライトユニット群42毎に、光源の点滅を制御できることとする。すなわち、当該バックライト制御回路41は、1行目乃至t行目用バックライトユニット群~2k3t1行目乃至m行目用バックライトユニット群において点灯される光を独立に制御できることとする。さらに、バックライト制御回路41は、バックライトユニット群42に含まれるバックライトユニット40が有する3種の光源のいずれか一を点灯させること、いずれか二つを同時に点灯させること、及び全て同時に点灯させることが可能であることとする。なお、当該3種の光源の全てを同時に点灯させた場合、バックライトユニット40は、白Wを呈する光を発光することとする。また、当該光源としては、LEDLight-EmittingDiodeなどを適用することが可能である。<液晶表示装置の動作例>図6は、上述した液晶表示装置における画像信号の走査と、バックライトが有する1行目乃至t行目用バックライトユニット群~2k3t1行目乃至m行目用バックライトユニット群のそれぞれにおいて点灯される光のタイミングとを示す図である。なお、図6において縦軸は画素部における行1行目乃至m行目を表し、横軸は時間を表している。上述した液晶表示装置では、1行目に配設された画素~m行目に配設された画素に対して順次画像信号を入力するのではなく、k行分隔離されて配設された画素に対して順次画像信号を入力する1行目に配設された画素→k1行目に配設された画素→2k1行目に配設された画素→2行目に配設された画素という順序で画像信号を入力することが可能である。これにより、図6に示すように期間T1において、1行目に配設されたn個の画素乃至t行目に配設されたn個の画素に対する青Bを呈する光の透過を制御するための画像信号の走査、k1行目に配設されたn個の画素乃至kt行目に配設されたn個の画素に対する緑Gを呈する光の透過を制御するための画像信号の走査、及び2k1行目に配設されたn個の画素乃至2kt行目に配設されたn個の画素に対する赤Rを呈する光の透過を制御するための画像信号の走査を並行して行うことが可能である。また、図6に示すように期間T2において、1行目乃至t行目用バックライトユニット群において青Bを呈する光の光源を点灯させ、且つk1行目乃至kt行目用バックライトユニット群において緑Gを呈する光の光源を点灯させ、且つ2k1行目乃至2kt行目用バックライトユニット群において赤Rを呈する光の光源を点灯させることが可能である。なお、期間T2は、t1行目に配設されたn個の画素乃至k行目に配設されたn個の画素に対する青Bを呈する光の透過を制御するための画像信号の走査、kt1行目に配設されたn個の画素乃至2k行目に配設されたn個の画素に対する緑Gを呈する光の透過を制御するための画像信号の走査、及び2kt1行目に配設されたn個の画素乃至m行目に配設されたn個の画素に対する赤Rを呈する光の透過を制御するための画像信号の走査が並行して行われる期間である。具体的に述べると、図6に示す液晶表示装置の動作は、以下の工程順序にしたがって各工程を行うことで画像以下では、1行目に配設されたn個の画素乃至t行目に配設されたn個の画素における画像について述べるを形成する液晶表示装置の動作であると表現できる。まず、第1の工程として、赤Rを呈する光の透過を制御するための画像信号の入力が1行目に配設されたn個の画素乃至k行目に配設されたn個の画素に対して順次行われる期間Ta内において、1行目に配設されたn個の画素乃至t行目に配設されたn個の画素に対する赤Rを呈する光の透過を制御するための画像信号の入力が行われた後に、1行目に配設されたn個の画素乃至t行目に配設されたn個の画素のそれぞれに対して赤Rを呈する光を供給する。次いで、第2の工程として、緑Gを呈する光の透過を制御するための画像信号の入力が1行目に配設されたn個の画素乃至k行目に配設されたn個の画素に対して順次行われる期間Tb内において、1行目に配設されたn個の画素乃至t行目に配設されたn個の画素に対する緑Gを呈する光の透過を制御するための画像信号の入力が行われた後に、1行目に配設されたn個の画素乃至t行目に配設されたn個の画素のそれぞれに対して緑Gを呈する光を供給する。なお、当該期間Tbにおいては、k1行目に配設されたn個の画素乃至2k行目に配設されたn個の画素に対する赤Rを呈する光の透過を制御するための画像信号の順次入力を並行して行う。そして、k1行目に配設されたn個の画素乃至kt行目に配設されたn個の画素に対する赤Rを呈する光の透過を制御するための画像信号の入力が行われた後に、k1行目に配設されたn個の画素乃至kt行目に配設されたn個の画素のそれぞれに対して赤Rを呈する光を供給する。次いで、第3の工程として、青Bを呈する光の透過を制御するための画像信号の入力が1行目に配設されたn個の画素乃至k行目に配設されたn個の画素に対して順次行われる期間Tc内において、1行目に配設されたn個の画素乃至t行目に配設されたn個の画素に対する青Bを呈する光の透過を制御するための画像信号の入力が行われた後に、1行目に配設されたn個の画素乃至t行目に配設されたn個の画素のそれぞれに対して青Bを呈する光を供給する。なお、当該期間Tcにおいては、k1行目に配設されたn個の画素乃至2k行目に配設されたn個の画素に対する緑Gを呈する光の透過を制御するための画像信号の順次入力、及び、2k1行目に配設されたn個の画素乃至m行目に配設されたn個の画素に対する赤Rを呈する光の透過を制御するための画像信号の順次入力を並行して行う。そして、k1行目に配設されたn個の画素乃至kt行目に配設されたn個の画素に対する緑Gを呈する光の透過を制御するための画像信号の入力が行われた後に、k1行目に配設されたn個の画素乃至kt行目に配設されたn個の画素のそれぞれに対して緑Gを呈する光を供給し、且つ、2k1行目に配設されたn個の画素乃至2kt行目に配設されたn個の画素に対する赤Rを呈する光の透過を制御するための画像信号の入力が行われた後に、2k1行目に配設されたn個の画素乃至2kt行目に配設されたn個の画素のそれぞれに対して赤Rを呈する光を供給する。次いで、第4の工程として、赤Rを呈する光の透過を制御するための画像信号の入力が1行目に配設されたn個の画素乃至k行目に配設されたn個の画素に対して順次行われる期間Td内において、1行目に配設されたn個の画素乃至t行目に配設されたn個の画素に対する赤Rを呈する光の透過を制御するための画像信号の入力が行われた後に、1行目に配設されたn個の画素乃至t行目に配設されたn個の画素のそれぞれに対して赤Rを呈する光を供給する。なお、当該期間Tdにおいては、k1行目に配設されたn個の画素乃至2k行目に配設されたn個の画素に対する青Bを呈する光の透過を制御するための画像信号の順次入力、及び、2k1行目に配設されたn個の画素乃至m行目に配設されたn個の画素に対する緑Gを呈する光の透過を制御するための画像信号の順次入力を並行して行う。そして、k1行目に配設されたn個の画素乃至kt行目に配設されたn個の画素に対する青Bを呈する光の透過を制御するための画像信号の入力が行われた後に、k1行目に配設されたn個の画素乃至kt行目に配設されたn個の画素のそれぞれに対して青Bを呈する光を供給し、且つ、2k1行目に配設されたn個の画素乃至2kt行目に配設されたn個の画素に対する緑Gを呈する光の透過を制御するための画像信号の入力が行われた後に、2k1行目に配設されたn個の画素乃至2kt行目に配設されたn個の画素のそれぞれに対して緑Gを呈する光を供給する。図6に示す液晶表示装置の動作は、上述の第1の工程乃至第4の工程を続けて行うことによって、画像1行目に配設されたn個の画素乃至t行目に配設されたn個の画素における画像を形成する動作であると表現できる。また、図6に示す液晶表示装置の動作では、続けて表示される2枚の画像を異なる光の供給順序によって形成する。具体的には、図6に示す液晶表示装置の動作においては、1枚目の画像を、赤Rを呈する光→緑Gを呈する光→青Bを呈する光→赤Rを呈する光の順で供給することで形成し、2枚目の画像を、緑Gを呈する光→青Bを呈する光→赤Rを呈する光→緑Gを呈する光の順で供給することで形成する。端的に述べると、図6に示す液晶表示装置の動作では、各光源の点灯順は変更せず、且つ各光源の点灯周波数をフレーム周波数の4/3倍とすることで、続けて表示される2枚の画像を異なる光の供給順序によって形成している。<本明細書で開示される液晶表示装置について>本明細書で開示される液晶表示装置の駆動方法では、画素部の特定の領域に含まれる複数の画素の一部に対する画像信号の入力と、当該一部とは異なる複数の画素の一部に対する光の供給とを並行して行うことが可能である。これにより、当該領域に含まれる複数の画素の全てに対して画像信号が入力された後に、それらに対して光を供給する期間を設ける必要がなくなる。すなわち、当該領域に含まれる複数の画素の全てに対して画像信号が入力された直後から、それらに対する次の画像信号の入力を開始することが可能となる。したがって、本明細書で開示される液晶表示装置の駆動方法においては、画像信号の入力頻度を向上することが可能となる。これにより、液晶表示装置におけるフレーム周波数を向上することが可能となる。その結果、フィールドシーケンシャル方式によって表示を行う液晶表示装置において生じる表示の変化劣化を抑制することが可能である。なお、フィールドシーケンシャル方式によって表示を行う液晶表示装置におけるフレーム周波数の向上は、上述の静的なカラーブレイク及び動的なカラーブレイクの発生の抑制に有効である。また、本明細書で開示される液晶表示装置の駆動方法では、続けて表示される2枚の画像を異なる光の供給順序によって形成する。これにより、続けて表示される画像における表示物の変位量が大きい場合に生じる動的なカラーブレイクを抑制することが可能となる。具体的に述べると、フィールドシーケンシャル方式によって表示を行う液晶表示装置においては、表示物の変位方向側の輪郭周辺部は画像形成の際に最初に供給される光が使用者に強く視認され、且つ当該表示物の変位方向とは反対側の輪郭周辺部は画像形成の際に最後に供給される光が使用者に強く視認される。したがって、当該最初に供給される光又は当該最後に供給される光が続けて表示される画像において同一であると、当該表示物の一部の輪郭周辺部が本来の色ではなく、当該最初に供給される光が呈する色又は当該最後に供給される光が呈する色として利用者に視認されやすくなる。これに対して、本明細書で開示される液晶表示装置の駆動方法では、当該最初に供給される光及び当該最後に供給される光を、続いて表示される2枚の画像の形成に際して異ならせることが可能である。したがって、当該表示物の一部の輪郭周辺部が本来の色とは異なる色として利用者に視認される蓋然性を低下させることが可能である。その結果、フィールドシーケンシャル方式によって表示を行う液晶表示装置において生じる表示の変化劣化を抑制することが可能である。また、本明細書で開示される液晶表示装置は、上記の動作を簡便な画素構成でありながら実現することが可能である。具体的には、特許文献1で開示される液晶表示装置の画素には、本明細書で開示される液晶表示装置の画素の構成に加えて、電荷の移動を制御するトランジスタが必要になる。また、該トランジスタのスイッチングを制御するための信号線も別途必要になる。これに対し、本明細書で開示される液晶表示装置の画素構成は、簡便である。すなわち、本明細書で開示される液晶表示装置は、特許文献1で開示される液晶表示装置と比較して画素の開口率を向上させることが可能である。また、画素部に設けられる配線数を低減することで各種配線間に生じる寄生容量を低減することが可能である。すなわち、画素部に設けられる各種配線の高速駆動が可能となる。また、図6に示す液晶表示装置の動作のようにバックライトを点灯する場合、隣接するバックライトユニット群が異なる色を呈することがない。具体的には、期間T1において画像信号の走査が行われる領域に対して当該走査後にバックライトユニット群を点灯する場合、隣接するバックライトユニット群が異なる色を呈することがない。例えば、期間T1において、k1行目に配設されたn個の画素からkt行目に配設されたn個の画素に対して緑Gを呈する光の透過を制御するための画像信号の走査が終了した後にk1行目乃至kt行目用バックライトユニット群において緑Gの光源を点灯させる際に、3t1行目乃至k行目用バックライトユニット群及びkt1行目乃至k2t行目用バックライトユニット群においては、緑Gの光源が点灯される又は点灯自体が行われない赤R、青Bの光源が点灯されることがない。そのため、特定の色の画像情報が入力された画素を、当該特定の色と異なる色を呈する光が透過する確率を低減することが可能である。<変形例>上述した液晶表示装置は、本発明の一態様であり、当該液晶表示装置と異なる点を有する液晶表示装置も本発明には含まれる。例えば、上述した液晶表示装置においては、画素部10を3つの領域に分割し、該3つの領域に並行して画像信号を供給する構成について示したが、本発明の液晶表示装置は、当該構成に限定されない。すなわち、本発明の液晶表示装置では、画素部10を3つ以外の複数の領域に分割し、該複数の領域のそれぞれに対する画像信号の供給を並行して行う構成とすることが可能である。なお、当該領域数を変化させる場合、当該領域数に応じて走査線駆動回路用クロック信号及びパルス幅制御信号を設定する必要があることを付記する。また、上述した液晶表示装置においては、液晶素子に印加される電圧を保持するための容量素子が設けられる構成図1B参照について示したが、当該容量素子を設けない構成とすることも可能である。この場合、画素の開口率を向上させることが可能である。また、画素部に設けられる容量配線を削除することができるため、画素部に設けられる各種配線の高速駆動が可能となる。また、パルス出力回路として、図3Aに示したパルス出力回路に、ソース及びドレインの一方が高電源電位線に電気的に接続され、ソース及びドレインの他方がトランジスタ32のゲート、トランジスタ34のゲート、トランジスタ35のソース及びドレインの他方、トランジスタ36のソース及びドレインの他方、トランジスタ37のソース及びドレインの他方、並びにトランジスタ39のゲートに電気的に接続され、ゲートがリセット端子Resetに電気的に接続されたトランジスタ50を付加した構成図7A参照を適用することが可能である。なお、当該リセット端子には、画素部に1枚の画像が形成された後の期間においてハイレベルの電位が入力され、その他の期間においてはロウレベルの電位が入力される。なお、トランジスタ50は、ハイレベルの電位が入力されることでオン状態となるトランジスタである。これにより、各ノードの電位を初期化することができるので、誤動作を防止することが可能となる。なお、当該初期化を行う場合には、画素部に1枚の画像が形成される期間後且つ次の画像が形成される期間前に初期化期間を設ける必要があることを付記する。また、パルス出力回路として、図3Aに示したパルス出力回路に、ソース及びドレインの一方がトランジスタ31のソース及びドレインの他方並びにトランジスタ32のソース及びドレインの他方に電気的に接続され、ソース及びドレインの他方がトランジスタ33のゲート及びトランジスタ38のゲートに電気的に接続され、ゲートが高電源電位線に電気的に接続されたトランジスタ51を付加した構成図7B参照を適用することも可能である。なお、トランジスタ51は、ノードAの電位がハイレベルの電位となる期間図3B~Dに示した期間t1~期間t6においてオフ状態となる。そのため、トランジスタ51を付加した構成とすることで、期間t1~t6において、トランジスタ33のゲート及びトランジスタ38のゲートと、トランジスタ31のソース及びドレインの他方並びにトランジスタ32のソース及びドレインの他方との電気的な接続を遮断することが可能となる。これにより、期間t1~期間t6に含まれる期間において、当該パルス出力回路で行われるブートストラップ動作時の負荷を低減することが可能である。また、パルス出力回路として、図7Bに示したパルス出力回路に、ソース及びドレインの一方がトランジスタ33のゲート並びにトランジスタ51のソース及びドレインの他方に電気的に接続され、ソース及びドレインの他方がトランジスタ38のゲートに電気的に接続され、ゲートが高電源電位線に電気的に接続されたトランジスタ52を付加した構成図8A参照を適用することも可能である。なお、上述したようにトランジスタ52を設けることによって、当該パルス出力回路で行われるブートストラップ動作時の負荷を低減することが可能である。特に、当該パルス出力回路がトランジスタ33のソースとゲートとの容量結合のみによってノードAの電位を上昇させる場合図3D参照における負荷の低減による効果が大きい。また、パルス出力回路として、図8Aに示したパルス出力回路からトランジスタ51を削除し、且つソース及びドレインの一方がトランジスタ31のソース及びドレインの他方、トランジスタ32のソース及びドレインの他方、並びにトランジスタ52のソース及びドレインの一方に電気的に接続され、ソース及びドレインの他方がトランジスタ33のゲートに電気的に接続され、ゲートが高電源電位線に電気的に接続されたトランジスタ53を付加した構成図8B参照を適用することも可能である。なお、上述したようにトランジスタ53を設けることによって、当該パルス出力回路で行われるブートストラップ動作時の負荷を低減することが可能である。また、当該パルス出力回路に生じる不正パルスが、トランジスタ33、38のスイッチングに与える影響を軽減することが可能である。また、上述した液晶表示装置においては、バックライトユニットとして赤R、緑G、青Bのいずれか一の光を発光する3種の光源を横に直線的に並べる構成図5参照について示したが、バックライトユニットの構成は、当該構成に限定されない。例えば、当該3種の光源を三角形配置してもよいし、当該3種の光源を縦に直線的に並べてもよいし、赤Rを呈する光の光源のみを有するバックライトユニット、緑Gを呈する光の光源のみを有するバックライトユニット、及び青Bを呈する光の光源のみを有するバックライトユニットを別途設けてもよい。また、上述した液晶表示装置においては、バックライトとして直下型方式のバックライトを適用する構成図5参照について示したが、当該バックライトとしてエッジライト方式のバックライトを適用することも可能である。また、上述した液晶表示装置においては、バックライトとして赤Rを呈する光、緑G、及び青Bを呈する光の光源を組み合わせて用いる構成について示したが、本発明の液晶表示装置は、当該構成に限定されない。すなわち、本発明の液晶表示装置では、任意の色を呈する光源を組み合わせてバックライトを構成することが可能である。例えば、赤R、緑G、青B、白W、若しくは赤R、緑G、青B、黄Yの4色の光源を組み合わせて用いること、又はシアンC、マゼンタM、イエローYの3色の光源を組み合わせて用いることなどが可能である。なお、白Wを呈する光を発光する光源は、発光効率が高いため、当該光源を用いてバックライトユニットを構成することで消費電力を低減することが可能である。また、バックライトユニットが補色の関係にある2色の光源を有する場合例えば、青Bと黄Yの2色の光源を有する場合、当該2色を呈する光を混色することで白Wを呈する光を形成することも可能である。さらに、淡色の赤R、緑G、及び青B、並びに濃色の赤R、緑G、及び青Bの6色の光源を組み合わせて用いること、又は赤R、緑G、青B、シアンC、マゼンタM、イエローYの6色の光源を組み合わせて用いることなども可能である。このように、より多種の光源を組み合わせて用いることで、当該液晶表示装置において表現できる色域を拡大し、画質を向上させることが可能である。また、上述した液晶表示装置においては、1枚の画像が形成される期間の前後に、画像信号の走査又は特定のバックライトユニット群における光源の点灯が行われない期間黒挿入期間ともいうを設ける構成図6参照について示したが、当該期間を設けずに連続的に行う画像形成動作を行う構成図9参照とすることが可能である。これにより、当該液晶表示装置におけるフレーム周波数を向上させることが可能である。なお、図6においては、特定のバックライトユニット群において光源の点灯が行われない期間を設ける構成について例示しているが、これに加えて、各画素に対して光を透過させないための画像信号を入力する構成とすることも可能である。また、上述した液晶表示装置においては、3種の光源のいずれか1種を2回点灯させ、且つその他の2種を1回点灯させることで画像を形成する構成図6参照について示したが、本発明の液晶表示装置の画像形成方法は、当該構成に限定されない。例えば、3種の光源のそれぞれを1回点灯させることで画像を形成する構成図10参照とすること、3種の光源に含まれる特定の2種を2回以上点灯させることで画像を形成する構成図11参照とすること、若しくは3種の光源のそれぞれを2回以上点灯させることで画像を形成する構成図示しない、又は3種の光源のそれぞれを少なくとも1回且つ3種の光源のうち2種以上を同時に少なくとも1回点灯させることで画像を形成する構成図示しないとすることが可能である。なお、3種の光源のうち2種以上を同時に点灯させることで1枚の画像を形成する場合、当該画像の輝度を向上させることが可能である。ここで、図11に示す液晶表示装置の動作について詳述する。図11に示す液晶表示装置の動作では、各画素に緑Gを呈する光を少なくとも2回以上供給することで、画像を形成する。端的に述べると、図11に示す液晶表示装置の動作では、赤Rを呈する光の光源の点灯→緑Gを呈する光の光源の点灯→青Bを呈する光の光源の点灯→緑Gを呈する光の光源の点灯という点灯順は変更せず、且つ、赤R及び青Bを呈する光の光源の点灯周波数をフレーム周波数の5/4倍とし且つ緑Gを呈する光の光源の点灯周波数をフレーム周波数の5/2倍としている。図11に示す液晶表示装置の動作においては、視感度の高い緑Gを呈する光の光源の点灯周波数を向上させることができるため、フリッカーの発生を抑制することが可能である。なお、変形例として述べた構成の複数を、図1~図6を参照して説明した液晶表示装置に対して適用することも可能である。<具体例>以下では、上述した液晶表示装置の具体例について説明する。図12Aは、上述した液晶表示装置の画素の構成例を示す上面図であり、図12Bは、図12A中の線分A-A’、線分B-B’における断面図である。図12Aに示す画素は、走査線801と、信号線802と、共通電位線803と、容量線804と、トランジスタ805と、画素電極806と、共通電極807と、容量素子808と、を有する。また、これらは、基板全面に成膜された薄膜を複数に分離加工することによって得られる第1の導電層851、半導体層852、第2の導電層853、第3の導電層854透明電極層ともいうを用いて構成される。具体的には、走査線801、トランジスタ805のゲート電極、及び容量素子808の一方の電極は、第1の導電層851を用いて構成される。さらに、走査線801及びトランジスタ805は、分離加工されることによって得られる一の導電層を用いて構成され、容量素子808の一方の電極は、当該一の導電層とは異なる導電層を用いて構成される。また、トランジスタ805の半導体層は、半導体層852を用いて構成される。また、信号線802、トランジスタ805のソース及びドレインの一方、トランジスタ805のソース及びドレインの他方、並びに容量素子808の他方の電極は、第2の導電層853を用いて構成される。さらに、信号線802並びにトランジスタ805のソース及びドレインの一方は、分離加工されることによって得られる一の導電層を用いて構成され、トランジスタ805のソース及びドレインの他方並びに容量素子808の他方の電極は、当該一の導電層とは異なる導電層によって構成される。また、共通電位線803、液晶素子の画素電極806、及び共通電極807は、第3の導電層854を用いて構成される。さらに、共通電位線803及び共通電極807は、分離加工されることによって得られる一の導電層を用いて構成され、液晶素子の画素電極806は、当該一の導電層とは異なる導電層を用いて構成される。なお、トランジスタ805のソース及びドレインの他方並びに容量素子808の他方の電極と、液晶素子の画素電極806とはコンタクトホール855において接続されている。図13は、図12Aに示す画素の構成例から第3の導電層854を除去した図である。図13に示すように、ここでは、第1の導電層851容量素子808の一方の電極と、第2の導電層853容量素子808の他方の電極とを重畳させることで容量素子808を形成している。図12A、図13に示す画素では、画素電極806及び共通電極807は、それぞれ櫛歯状に形成し、間隔をあけて嵌合するよう構成されている。当該構成とすることで画素電極806と共通電極807との間に横電界を発生させ、ブルー相を示す液晶材料などを制御することができる。なお、ブルー相は液晶相の一つであり、コレステリック液晶を昇温していくと、コレステリック相から等方相へ転移する直前に発現する相である。ブルー相は狭い温度範囲でしか発現しないため、カイラル剤や紫外線硬化樹脂を添加して温度範囲を改善する。具体的には、5重量以上のカイラル剤を混合させた液晶組成物を液晶1415に用いる。ブルー相を示す液晶とカイラル剤とを含む液晶組成物は、応答時間が10μsec.以上100μsec.以下と短く、光学的等方性であるため配向処理が不要であり、視野角依存性が小さい。このような特性を有する液晶は、上述した液晶表示装置画像を形成するために複数回の画像信号を各画素に入力することが必要な液晶表示装置が有する液晶として特に好ましい。次に、図12Bに示す断面図の構成について説明する。本明細書で開示される液晶表示装置に適用できるトランジスタの構造は特に限定されず、例えばゲート電極が、ゲート絶縁層を介して、半導体層の上側に配置されるトップゲート構造、又はゲート電極が、ゲート絶縁層を介して、半導体層の下側に配置されるボトムゲート構造のスタガ型及びプレーナ型などを用いることができる。また、トランジスタはチャネル形成領域が一つ形成されるシングルゲート構造でも、二つ形成されるダブルゲート構造もしくは三つ形成されるトリプルゲート構造であってもよい。また、チャネル領域の上下にゲート絶縁層を介して配置された2つのゲート電極層を有する、デュアルゲート型でもよい。図12Bに示すトランジスタ805は、逆スタガ型のトランジスタである。トランジスタ805は、絶縁表面を有する基板400上に、ゲート電極層401、ゲート絶縁層402、半導体層403、n型半導体層404、ソース電極層405a、及びドレイン電極層405bを含む。また、トランジスタ805を覆い、半導体層403に積層する絶縁層407が設けられている。絶縁層407上にはさらに絶縁層409が形成されている。絶縁表面を有する基板400に使用することができる基板に大きな制限はないが、バリウムホウケイ酸ガラスやアルミノホウケイ酸ガラスなどのガラス基板を用いる。ボトムゲート構造のトランジスタ805において、下地膜となる絶縁層を基板とゲート電極層の間に設けてもよい。下地膜は、基板からの不純物元素の拡散を防止する機能があり、窒化シリコン層、酸化シリコン層、窒化酸化シリコン層、又は酸化窒化シリコン層から選ばれた一又は複数の層による単層または積層構造により形成することができる。ゲート電極層401の材料は、モリブデン、チタン、クロム、タンタル、タングステン、アルミニウム、銅、ネオジム、スカンジウム等の金属材料またはこれらを主成分とする合金材料を用いて、単層でまたは積層して形成することができる。ゲート絶縁層402は、プラズマCVD法又はスパッタリング法等を用いて、酸化シリコン層、窒化シリコン層、酸化窒化シリコン層、窒化酸化シリコン層、酸化アルミニウム層、窒化アルミニウム層、酸化窒化アルミニウム層、窒化酸化アルミニウム層、又は酸化ハフニウム層を単層で又は積層して形成することができる。半導体層403に用いる半導体材料としては、アモルファスシリコン、微結晶シリコン、ポリシリコン、酸化物半導体、有機半導体等を用いることができる。また、n型半導体層404は、半導体層403にn型不純物元素を導入して用いればよい。ソース電極層405a、ドレイン電極層405bに用いる導電膜としては、例えば、Al、Cr、Cu、Ta、Ti、Mo、Wから選ばれた元素、または上述した元素を成分とする合金か、上述した元素を組み合わせた合金膜等を用いることができる。また、Al、Cuなどの金属層の下側又は上側の一方または双方にTi、Mo、Wなどの高融点金属層を積層させた構成としてもよい。また、Al膜に生ずるヒロックやウィスカーの発生を防止する元素Si、Nd、Scなどが添加されているAl材料を用いることで耐熱性を向上させることが可能となる。また、ソース電極層405a、ドレイン電極層405bこれと同じ層で形成される配線層を含むとなる導電膜としては導電性の金属酸化物で形成してもよい。導電性の金属酸化物としては酸化インジウムIn2O3、酸化スズSnO2、酸化亜鉛ZnO、酸化インジウム酸化スズ合金In2O3―SnO2、ITOと略記する、酸化インジウム酸化亜鉛合金In2O3―ZnOまたはこれらの金属酸化物材料に酸化シリコンを含ませたものを用いることができる。絶縁層407は、代表的には酸化シリコン膜、酸化窒化シリコン膜、酸化アルミニウム膜、または酸化窒化アルミニウム膜などの無機絶縁膜を用いることができる。絶縁層409としては、トランジスタ起因の表面凹凸を低減するための平坦化絶縁膜として機能するものが好ましい。絶縁層409としては、ポリイミド、アクリル、ベンゾシクロブテン、等の有機材料を用いることができる。また上記有機材料の他に、低誘電率材料low-k材料等を用いることができる。なお、これらの材料で形成される絶縁膜を複数積層させることで、平坦化絶縁膜を形成してもよい。なお、絶縁層407及び絶縁層409には、コンタクトホールが設けられ、当該コンタクトホールにおいて画素電極410とドレイン電極層405bとが直接接する構成とする。また、絶縁層409上には、画素電極410の他に共通電極及び共通電位線図示しないが引き回されることとなる。なお、画素電極410及び共通電極に用いる導電膜としては、例えば、Al、Cr、Cu、Ta、Ti、Mo、Wから選ばれた元素、または上述した元素を主成分とする合金か、上述した元素を組み合わせた合金膜等を用いることができる。また、Al、Cuなどの金属層の下側又は上側の一方または双方にTi、Mo、Wなどの高融点金属層を積層させた構成としてもよい。また、Al膜に生ずるヒロックやウィスカーの発生を防止する元素Si、Nd、Scなどが添加されているAl材料を用いることで耐熱性を向上させることが可能となる。また、画素電極410及び共通電極となる導電膜としては導電性の金属酸化物で形成してもよい。導電性の金属酸化物としては酸化インジウムIn2O3、酸化スズSnO2、酸化亜鉛ZnO、酸化インジウム酸化スズ合金In2O3―SnO2、ITOと略記する、酸化インジウム酸化亜鉛合金In2O3―ZnOまたはこれらの金属酸化物材料に酸化シリコンを含ませたものを用いることができる。なお、画素電極410及び共通電極となる導電膜は、画素電極410及び共通電極による横電界が液晶に印加しやすいように、膜厚を大きくすることが好ましい。この場合、画素電極410及び共通電極に透光性を有しない材料を用いる場合、画素の開口率が著しく低下することが懸念されるため、予め画素電極410及び共通電極の下部にリブ状の透明構造体を設ける構成とすることが好ましい。<液晶表示装置を搭載した各種電子機器について>以下では、本明細書で開示される液晶表示装置を搭載した電子機器の例について図14を参照して説明する。図14Aは、ノート型のパーソナルコンピュータを示す図であり、本体2201、筐体2202、表示部2203、キーボード2204などによって構成されている。図14Bは、携帯情報端末PDAを示す図であり、本体2211には表示部2213と、外部インターフェイス2215と、操作ボタン2214等が設けられている。また、操作用の付属品としてスタイラス2212がある。図14Cは、電子ペーパーの一例として、電子書籍2220を示す図である。電子書籍2220は、筐体2221および筐体2223の2つの筐体で構成されている。筐体2221および筐体2223は、軸部2237により一体とされており、該軸部2237を軸として開閉動作を行うことができる。このような構成により、電子書籍2220は、紙の書籍のように用いることが可能である。筐体2221には表示部2225が組み込まれ、筐体2223には表示部2227が組み込まれている。表示部2225および表示部2227は、続き画面を表示する構成としてもよいし、異なる画面を表示する構成としてもよい。異なる画面を表示する構成とすることで、例えば右側の表示部図14Cでは表示部2225に文章を表示し、左側の表示部図14Cでは表示部2227に画像を表示することができる。また、図14Cでは、筐体2221に操作部などを備えた例を示している。例えば、筐体2221は、電源2231、操作キー2233、スピーカー2235などを備えている。操作キー2233により、頁を送ることができる。なお、筐体の表示部と同一面にキーボードやポインティングデバイスなどを備える構成としてもよい。また、筐体の裏面や側面に、外部接続用端子イヤホン端子、USB端子、またはACアダプタおよびUSBケーブルなどの各種ケーブルと接続可能な端子など、記録媒体挿入部などを備える構成としてもよい。さらに、電子書籍2220は、電子辞書としての機能を持たせた構成としてもよい。また、電子書籍2220は、無線で情報を送受信できる構成としてもよい。無線により、電子書籍サーバから、所望の書籍データなどを購入し、ダウンロードする構成とすることも可能である。なお、電子ペーパーは、情報を表示するものであればあらゆる分野に適用することが可能である。例えば、電子書籍以外にも、ポスター、電車などの乗り物の車内広告、クレジットカード等の各種カードにおける表示などに適用することができる。図14Dは、携帯電話機を示す図である。当該携帯電話機は、筐体2240および筐体2241の二つの筐体で構成されている。筐体2241は、表示パネル2242、スピーカー2243、マイクロフォン2244、ポインティングデバイス2246、カメラ用レンズ2247、外部接続端子2248などを備えている。また、筐体2240は、当該携帯電話機の充電を行う太陽電池セル2249、外部メモリスロット2250などを備えている。また、アンテナは筐体2241内部に内蔵されている。表示パネル2242はタッチパネル機能を備えており、図14Dには映像表示されている複数の操作キー2245を点線で示している。なお、当該携帯電話は、太陽電池セル2249から出力される電圧を各回路に必要な電圧に昇圧するための昇圧回路を実装している。また、上記構成に加えて、非接触ICチップ、小型記録装置などを内蔵した構成とすることもできる。表示パネル2242は、使用形態に応じて表示の方向が適宜変化する。また、表示パネル2242と同一面上にカメラ用レンズ2247を備えているため、テレビ電話が可能である。スピーカー2243およびマイクロフォン2244は音声通話に限らず、テレビ電話、録音、再生などが可能である。さらに、筐体2240と筐体2241はスライドし、図14Dのように展開している状態から重なり合った状態とすることができ、携帯に適した小型化が可能である。外部接続端子2248はACアダプタやUSBケーブルなどの各種ケーブルと接続可能であり、充電やデータ通信が可能になっている。また、外部メモリスロット2250に記録媒体を挿入し、より大量のデータの保存および移動に対応できる。また、上記機能に加えて、赤外線通信機能、テレビ受信機能などを備えたものであってもよい。図14Eは、デジタルカメラを示す図である。当該デジタルカメラは、本体2261、表示部A2267、接眼部2263、操作スイッチ2264、表示部B2265、バッテリー2266などによって構成されている。図14Fは、テレビジョン装置を示す図である。テレビジョン装置2270では、筐体2271に表示部2273が組み込まれている。表示部2273により、映像を表示することが可能である。なお、ここでは、スタンド2275により筐体2271を支持した構成を示している。テレビジョン装置2270の操作は、筐体2271が備える操作スイッチや、別体のリモコン操作機2280により行うことができる。リモコン操作機2280が備える操作キー2279により、チャンネルや音量の操作を行うことができ、表示部2273に表示される映像を操作することができる。また、リモコン操作機2280に、当該リモコン操作機2280から出力する情報を表示する表示部2277を設ける構成としてもよい。なお、テレビジョン装置2270は、受信機やモデムなどを備えた構成とするのが好適である。受信機により、一般のテレビ放送の受信を行うことができる。また、モデムを介して有線または無線による通信ネットワークに接続することにより、一方向送信者から受信者または双方向送信者と受信者間、あるいは受信者間同士などの情報通信を行うことが可能である。