電源線から発光素子に供給される電流量を制御する駆動トランジスタと、前記駆動トランジスタと前記発光素子とを電気的に接続する素子導通部と、オン状態に変化することで前記駆動トランジスタをダイオード接続する初期化トランジスタと、前記駆動トランジスタと前記初期化トランジスタとを電気的に接続する接続部とが基板上に配置された発光装置であって、前記電源線は、所定の方向に延在する第1部分を含み、前記素子導通部および前記接続部は、前記電源線と同層から形成され、前記駆動トランジスタを挟んで前記第1部分の幅方向における一方の側に位置することを特徴とする発光装置。前記駆動トランジスタのゲート電極に電気的に接続された容量素子を具備し、前記容量素子は、前記駆動トランジスタを挟んで前記接続部および前記素子導通部の反対側に配置され、前記電源線の第1部分は、前記容量素子と重なり合う請求項1に記載の発光装置。選択信号に応じてオン状態またはオフ状態となる選択トランジスタを具備し、前記駆動トランジスタのゲート電極は、オン状態となった前記選択トランジスタを介してデータ線から供給されるデータ信号に応じた電位に設定され、前記選択トランジスタは、前記容量素子を挟んで前記駆動トランジスタとは反対側に配置される請求項2に記載の発光装置。前記駆動トランジスタと前記選択トランジスタと前記初期化トランジスタとを各々が含む複数の単位素子が前記所定の方向とは交差する方向に配列し、前記選択トランジスタは、前記所定の方向に沿った一方の側に配置され、前記初期化トランジスタは、前記所定の方向に沿った他方の側に配置される請求項3に記載の発光装置。電源線から発光素子に供給される電流量を制御する駆動トランジスタと、前記駆動トランジスタと前記発光素子とを電気的に接続する素子導通部と、オン状態に変化することで前記駆動トランジスタをダイオード接続する初期化トランジスタと、前記駆動トランジスタと前記初期化トランジスタとを電気的に接続する接続部とが基板上に配置された発光装置であって、前記電源線は、所定の方向に延在する第1部分を含み、前記素子導通部および前記接続部は、前記電源線と同層から形成され、前記素子導通部は、前記駆動トランジスタを挟んで前記第1部分の幅方向における一方の側に位置し、前記接続部は、前記駆動トランジスタに対して前記第1部分の幅方向における他方の側に位置することを特徴とする発光装置。前記駆動トランジスタのゲート電極に電気的に接続された容量素子を具備し、前記容量素子は、前記駆動トランジスタと前記接続部との間隙に配置され、前記電源線の第1部分は、前記容量素子と重なり合う請求項1に記載の発光装置。選択信号に応じてオン状態またはオフ状態となる選択トランジスタを具備し、前記駆動トランジスタのゲート電極は、オン状態となった前記選択トランジスタを介してデータ線から供給されるデータ信号に応じた電位に設定され、前記選択トランジスタは、前記容量素子を挟んで前記駆動トランジスタとは反対側に配置される請求項6に記載の発光装置。前記駆動トランジスタと前記素子導通部と前記初期化トランジスタと前記接続部とを各々が含む複数の単位素子が前記所定の方向とは交差する方向に配列し、前記電源線は、前記各単位素子に対応する複数の前記第1部分と、相互に隣接する各第1部分を連結する第2部分とを含む請求項1または請求項5に記載の発光装置。請求項1から請求項8の何れかに記載の発光装置を具備する電子機器。ところで、以上の構成においては、発光素子の発光に関わる各要素を電気的に接続するための配線が必要となる。例えば、駆動トランジスタと初期化トランジスタとを電気的に接続するための配線以下接続部というや駆動トランジスタと発光素子とを電気的に接続するための配線以下素子導通部というである。しかしながら、これらの配線の各々を別個の工程にて形成するとすれば、製造プロセスの煩雑化や製造コストの増大が問題となる。この問題を解決するための方策としては、ひとつの導電膜のパターニングによって接続部や素子導通部を他の要素例えば電源線と同工程で形成するという方法も考えられる。しかしながら、この方法のもとでは、接続部や素子導通部を避ける形状に電源線などの他の要素を形成する必要がある。そして、このような制約から例えば電源線に充分な線幅を確保できず、この結果として電源線の抵抗が充分に低減されないといった問題が発生し得る。以上のような事情を背景として、本発明は、電源線の抵抗を抑制しながら接続部や素子導通部を電源線と同層から形成するという課題の解決を目的としている。本発明に係る発光装置の第1の特徴は、電源線から発光素子に供給される電流量を制御する駆動トランジスタと、駆動トランジスタと発光素子とを電気的に接続する素子導通部例えば図7の素子導通部71と、オン状態に変化することで駆動トランジスタをダイオード接続する初期化トランジスタと、駆動トランジスタと初期化トランジスタとを電気的に接続する接続部例えば図7の接続部61とが基板上に配置され、電源線は、所定の方向に延在する第1部分例えば図7に図示された電源線15を含み、素子導通部および接続部は、電源線と同層から形成され、駆動トランジスタを挟んで第1部分の幅方向例えば図7のY方向における一方の側に位置することにある。本態様の具体例は第1実施形態として後述される。この構成によれば、素子導通部や接続部が電源線と同層から形成されるため、各部が別層から形成された構成と比較して、製造工程の簡素化や製造コストの低減が実現される。さらに、駆動トランジスタを挟んで第1部分の幅方向における一方の側に接続部や素子導通部が配置されるから、駆動トランジスタを挟んで他方の側に電源線のスペースを確保することができる。したがって、電源線を充分な面積あるいは線幅に形成してその抵抗を抑制することができる。なお、複数の要素が同層から形成されるとは、共通の膜体単層であるか複数層であるかは不問であるの選択的な除去によって複数の要素が同工程で形成されることを意味し、各要素が相互に離間しているか連続しているかは不問である。本発明の好適な態様においては、駆動トランジスタのゲート電極に電気的に接続された容量素子例えば図2の容量素子C1や図20または図21の容量素子C2がさらに設けられ、容量素子は、駆動トランジスタを挟んで接続部および素子導通部の反対側に配置され、電源線の第1部分は、容量素子と重なり合う。この態様によれば、容量素子と重なり合うように電源線が形成されるから、電源線の面積をさらに充分に確保することができる。より具体的な態様においては、選択信号に応じてオン状態またはオフ状態となる選択トランジスタがさらに設けられ、駆動トランジスタのゲート電極は、オン状態となった選択トランジスタを介してデータ線から供給されるデータ信号に応じた電位に設定され、選択トランジスタは、容量素子を挟んで駆動トランジスタとは反対側に配置される。この態様によれば、容量素子を挟んで駆動トランジスタとは反対側の選択トランジスタが配置されるから、例えば駆動トランジスタと容量素子との間隙に選択トランジスタが配置された構成と比較して、電源線の面積線幅を充分に確保するとともに電源線の形状を単純化例えば切欠などを含まない単純な帯状することが可能である。複数の単位素子が配列する構成も好適に採用される。各単位素子は、駆動トランジスタと選択トランジスタと初期化トランジスタとを含み、所定の方向とは交差する方向さらには所定の方向に配列する。この態様において、所定の方向に沿った一方の側例えば図8におけるX方向の負側に選択トランジスタを配置し、所定の方向に沿った他方の側例えば図8におけるX方向の正側に初期化トランジスタを配置してもよい。この構成によれば、所定の方向に沿った位置が選択トランジスタと初期化トランジスタとで相違するから、選択トランジスタと初期化トランジスタとの電気的な絶縁を維持しながら、各単位素子の間隙例えば図8の領域Bを狭小化することが可能である。本発明に係る発光装置の第2の特徴は、電源線から発光素子に供給される電流量を制御する駆動トランジスタと、駆動トランジスタと発光素子とを電気的に接続する素子導通部例えば図15の素子導通部72と、オン状態に変化することで駆動トランジスタをダイオード接続する初期化トランジスタと、駆動トランジスタと初期化トランジスタとを電気的に接続する接続部例えば図15の接続部62とが基板上に配置された発光装置であって、電源線は、所定の方向に延在する第1部分例えば図15の第1部分151を含み、素子導通部および接続部は、電源線と同層から形成され、素子導通部は、駆動トランジスタを挟んで第1部分の幅方向における一方の側例えば図15におけるY方向の負側に位置し、接続部は、駆動トランジスタに対して第1部分の幅方向における他方の側例えば図15におけるY方向の正側に位置することにある。この態様の具体例は第2実施形態として後述される。この構成によれば、素子導通部や接続部が電源線と同層から形成されるため、第1の態様と同様に、各部が別層から形成された構成と比較して、製造工程の簡素化や製造コストの低減が実現される。また、駆動トランジスタを挟んで相互に反対側の各領域に素子導通部および接続部の各々が形成されるから、素子導通部と接続部との間隙に電源線のスペースを確保することができる。したがって、電源線を充分な面積あるいは線幅に形成してその抵抗を抑制することができる。第2の特徴に係る発光装置の好適な態様においては、駆動トランジスタのゲート電極に電気的に接続された容量素子例えば図2の容量素子C1や図20または図21の容量素子C2がさらに設けられ、容量素子は、駆動トランジスタと接続部との間隙に配置され、電源線の第1部分は、容量素子と重なり合う。この態様によれば、容量素子と重なり合うように電源線が形成されるから、電源線の面積をさらに充分に確保することができる。さらに好適な態様においては、選択信号に応じてオン状態またはオフ状態となる選択トランジスタが設けられ、駆動トランジスタのゲート電極は、オン状態となった選択トランジスタを介してデータ線から供給されるデータ信号に応じた電位に設定され、選択トランジスタは、容量素子を挟んで駆動トランジスタとは反対側に配置される。この態様によれば、容量素子を挟んで駆動トランジスタとは反対側の選択トランジスタが配置されるから、例えば駆動トランジスタと容量素子との間隙に選択トランジスタが配置された構成と比較して、電源線の面積線幅を充分に確保するとともに電源線の形状を単純化例えば切欠などを含まない単純な帯状することが可能である。以上に例示したように駆動トランジスタのゲート電極に容量素子が接続された構成においては、電源線は容量素子の一部のみと重なり合ってもよいしその全部と重なり合ってもよい。なお、以上に例示した各態様における容量素子は、典型的には駆動トランジスタのゲート電極の電位を設定または保持するために利用される。例えば、ひとつの態様における容量素子例えば図2の容量素子C1は、駆動トランジスタのゲート電極とデータ線との間に介在する。この構成においては、容量素子における容量カップリングによって、駆動トランジスタのゲート電極がデータ線の電位の変動量に応じた電位に設定される。また、その他の態様における容量素子例えば図20や図21の容量素子C2は、駆動トランジスタのゲート電極と定電位が供給される配線例えば電源線との間に介在する。この構成においては、データ線から駆動トランジスタのゲート電極に供給された電位が容量素子に保持される。本発明の第1および第2の特徴に係る発光装置の具体的な態様において、駆動トランジスタと素子導通部と初期化トランジスタと接続部とを各々が含む複数の単位素子が所定の方向とは交差する方向に配列し、電源線は、各単位素子に対応する複数の第1部分と、相互に隣接する各第1部分を連結する第2部分例えば図15における第2部分152とを含む。この態様によれば、電源線が第1部分のみからなる構成と比較して電源線の抵抗をさらに低減することができる。本発明に係る発光装置は各種の電子機器に利用される。この電子機器の典型例は、発光装置を表示装置として利用した機器である。この種の電子機器としては、パーソナルコンピュータや携帯電話機などがある。もっとも、本発明に係る発光装置の用途は画像の表示に限定されない。例えば、光線の照射によって感光体ドラムなどの像担持体に潜像を形成するための露光装置露光ヘッド、液晶装置の背面側に配置されてこれを照明する装置バックライト、あるいは、スキャナなどの画像読取装置に搭載されて原稿を照明する装置など各種の照明装置など、様々な用途に本発明の発光装置を適用することができる。<A:発光装置の電気的な構成>図1は、本発明の各実施形態に係る発光装置Dの電気的な構成を示すブロック図である。同図に示すように、発光装置Dは、複数の選択線11と複数の初期化線12と複数のデータ線13とを有する。各選択線11および各初期化線12はX方向に延在する。各データ線13はX方向に直交するY方向に延在する。選択線11および初期化線12の各対とデータ線13との各交差には単位素子画素Pが配置される。したがって、これらの単位素子PはX方向およびY方向にわたってマトリクス状に配列する。ひとつの単位素子Pは発光の最小の単位となる要素である。各単位素子Pには電源線15を介して高位側の電源電位Vddが供給される。図2は、各単位素子Pの構成を示す回路図である。同図に示すように、電源線15から接地線接地電位Gndに至る経路上には発光素子Eと駆動トランジスタTdrとが配置される。発光素子Eは、有機EL材料からなる発光層23を第1電極21陽極と第2電極22陰極との間に介在させた素子である。第1電極21は、単位素子Pごとに相互に離間して形成される。第2電極22は、複数の単位素子Pにわたって連続に形成されて接地Gndされる。発光層23は、第1電極21から第2電極22に流れる電流量に応じた光量で発光する。駆動トランジスタTdrは、発光素子Eに供給される電流量をゲート電極の電位以下ゲート電位というVgに応じて制御するためのpチャネル型の薄膜トランジスタである。駆動トランジスタTdrのソース電極Sは電源線15に接続され、そのドレイン電極Dは発光素子Eの第1電極21に接続される。駆動トランジスタTdrのゲート電極とドレイン電極発光素子Eの第1電極21との間には、両者の電気的な接続を制御するためのnチャネル型のトランジスタ以下では初期化トランジスタというTintが介在する。初期化トランジスタTintのゲート電極は初期化線12に接続される。初期化線12には駆動回路図示略から初期化信号Sbが供給される。初期化信号Sbがアクティブレベルとなって初期化トランジスタTintがオン状態に変化すると、駆動トランジスタTdrのゲート電極とドレイン電極とが電気的に接続ダイオード接続される。図2に示すように、単位素子Pは、電極E1と電極E2とから構成される容量素子C1を含む。電極E1は駆動トランジスタTdrのゲート電極に接続される。電極E2とデータ線13との間には、両者の電気的な接続を制御するnチャネル型のトランジスタ以下選択トランジスタというTslが介在する。選択トランジスタTslのゲート電極は選択線11に接続される。選択線11には駆動回路図示略から選択信号Saが供給される。なお、駆動トランジスタTdrや選択トランジスタTslや初期化トランジスタTintの導電型は図2の例示から適宜に変更される。次に、ひとつの単位素子Pの動作を初期化期間と書込期間と駆動期間とに区分して説明する。まず、初期化期間においては、駆動回路図示略からデータ線13に所定の電位Vrefが供給されるとともに選択線11の選択信号Saと初期化線12の初期化信号Sbとがアクティブレベルハイレベルを維持する。したがって、容量素子C1の電極E2にはデータ線13から選択トランジスタTslを介して電位Vrefが供給される。また、初期化トランジスタTintがオン状態に変化することで駆動トランジスタTdrがダイオード接続される。したがって、駆動トランジスタTdrのゲート電位Vgは、電源線15に供給される電源電位Vddと駆動トランジスタTdrの閾値電圧Vthとの差分値Vg=Vdd-Vthに収束する。次に、初期化期間の経過後の書込期間においては、初期化信号Sbが非アクティブレベルローレベルに遷移する。したがって、初期化トランジスタTintがオフ状態に変化して駆動トランジスタTdrのダイオード接続は解除される。また、選択トランジスタTslがオン状態に維持されたまま、データ線13から電極E2に供給される電位Vrefがデータ電位Vdataに変更される。データ電位Vdataは、単位素子Pに指定された階調に応じた電位である。駆動トランジスタTdrのゲート電極のインピーダンスは充分に高いから、電極E2が電位Vrefからデータ電位Vdataまで変化量ΔV=Vref-Vdataだけ変動すると、電極E1の電位は、容量素子C1における容量カップリングによって、初期化期間にて設定された電位Vg=Vdd-Vthから変動する。このときの電極E1の電位の変化量は、容量素子C1とその他の寄生容量例えば駆動トランジスタTdrのゲート容量やその他の配線に寄生する容量との容量比に応じて定まる。より具体的には、容量素子C1の容量値をCとして寄生容量の容量値をCsとすると、電極E1の電位の変化量はΔVC/CCsと表現される。したがって、駆動トランジスタTdrのゲート電位Vgは、書込期間の終点において以下の式1のレベルに設定される。Vg=Vdd-Vth-kΔV......1ただし、k=C/CCs次いで、書込期間の経過後の駆動期間においては、選択信号Saが非アクティブレベルに遷移して選択トランジスタTslがオフ状態に変化する。そして、駆動トランジスタTdrのゲート電位Vgに応じた電流が電源線15から駆動トランジスタTdrのソース電極とドレイン電極とを経由して発光素子Eに供給される。この電流の供給によって発光素子Eはデータ電位Vdataに応じた光量で発光する。いま、駆動トランジスタTdrが飽和領域で動作する場合を想定すると、駆動期間にて発光素子Eに供給される電流量Iは以下の式2によって表現される。ただし、式2におけるβは駆動トランジスタTdrの利得係数であり、Vgsは駆動トランジスタTdrのゲート-ソース間の電圧である。I=β/2Vgs-Vth2......2=β/2Vdd-Vg-Vth2式1の代入によって式2は以下のように変形される。I=β/2kΔV2すなわち、発光素子Eに供給される電流量Iは駆動トランジスタTdrの閾値電圧Vthに依存しない。したがって、本実施形態によれば、各駆動トランジスタTdrの閾値電圧Vthのバラツキ設計値からの相違や他の単位素子Pの駆動トランジスタTdrとの相違に起因した発光素子Eの光量の誤差輝度のムラを抑制することができる。<B:単位素子Pの具体的な構造>次に、図面を参照して、以上に説明した単位素子Pの具体的な構造を説明する。なお、以下で参照する各図面においては、説明の便宜のために、各要素の寸法や比率を実際の装置から適宜に異ならせてある。<B-1:第1実施形態>まず、本発明の第1実施形態に係る発光装置Dの単位素子Pの具体的な構成を説明する。図3は、ひとつの単位素子Pの構成を示す平面図であり、図4は、図3におけるIV-IV線からみた断面図である。なお、図3は平面図であるが、各要素の把握を容易化するために、図3と共通する要素については適宜に図3と同態様のハッチングが施されている。以下で参照する他の平面図についても同様である。図4に示すように、駆動トランジスタTdrや発光素子Eといった図2の各要素は基板10の面上に形成される。基板10は、ガラスやプラスチックなど各種の絶縁性材料からなる板状の部材である。なお、基板10を覆う絶縁性の膜体例えば酸化珪素や窒化珪素の膜体を下地として基板10の面上に単位素子Pの各要素を形成してもよい。また、本実施形態の発光装置Dはトップエミッション型である。したがって、基板10に光透過性は要求されない。図5ないし図7は、単位素子Pが形成される各段階における基板10の面上の様子を示す平面図である。なお、図5ないし図7においては、図3に図示された第1電極21が形成されるべき領域Aが二点鎖線によって併記されている。図4および図5に示すように、基板10の面上には、半導体層31と半導体層41とがシリコンなどの半導体材料によって形成される。半導体層31と半導体層41とは、基板10の全域にわたって連続に形成された膜体のパターニングによって同一の工程で一括的に形成される。なお、半導体層31と半導体層41との関係のように、複数の要素が共通の膜体単層および複数層の何れであるかは不問であるの選択的な除去によって同一の工程で形成されることを以下では単に同層から形成されると表記する。同層から形成された各要素は当然に同一の材料からなり、各々の膜厚は略一致する。複数の要素が同層から形成される構成によれば、その各々が別層から形成される構成と比較して、製造工程の簡素化や製造コストの低減が実現されるという利点がある。図4および図5に示すように、半導体層31は、第1素子部311と第2素子部312とを含む。第1素子部311は、駆動トランジスタTdrの半導体層として機能する略矩形状の部分である。第2素子部312は、初期化トランジスタTintの半導体層として機能する部分であり、第1素子部311からみてX方向の正側かつY方向の負側の領域すなわち第1素子部311の右上部に形成される。さらに詳述すると、第2素子部312は、図5に示すように、第1素子部311からY方向の負側に連続する部分312aと、この部分312aからX方向の正側に延在する部分312bと、部分312bからY方向の正側に延在する部分312cとを含む。半導体層41は、半導体層31からみてY方向の正側に配置された部分であり、図2の容量素子C1を構成する略矩形状の電極E2と、電極E2からY方向に延在する素子部411とを含む。素子部411は、選択トランジスタTslの半導体層として機能する部分であり、電極E2からみてX方向の負側かつY方向の正側の領域すなわち電極E2の左下部に形成される。図4に示すように、半導体層31と半導体層41とが形成された基板10の表面はその全域にわたってゲート絶縁層L0に覆われる。図4および図6に示すように、ゲート絶縁層L0の面上には、選択線11と初期化線12と中間導電体51と第1データ線部131とが導電性材料によって同層から形成される。選択線11は、複数の単位素子PにわたってX方向に延在して半導体層41の素子部411と重なり合う。素子部411のうちゲート絶縁層L0を挟んで選択線11に対向する領域が選択トランジスタTslのチャネル領域である。初期化線12は、複数の単位素子PにわたってX方向に延在して半導体層31の第2素子部312と重なり合う。第2素子部312の部分312aおよび部分312cの各々のうちゲート絶縁層L0を挟んで初期化線12に対向する領域が初期化トランジスタTintのチャネル領域である。すなわち、本実施形態における初期化トランジスタTintはデュアルゲート構造のトランジスタである。中間導電体51は、選択線11と初期化線12との間隙の領域に形成された部分であり、電極E1とゲート電極511と連結部513とを含む。電極E1は、基板10に垂直な方向からみて半導体層41の電極E2と重なり合う略矩形状の部分である。図4および図6に示すように、ゲート絶縁層L0誘電体を挟んで電極E1と電極E2とが対向することによって図2の容量素子C1が構成される。連結部513は、電極E1の右上部からY方向の負側に延在する。ゲート電極511は、電極E1と間隔をあけて連結部513からX方向の負側に延在する部分であり、第1素子部311の略全幅X方向の寸法にわたって第1素子部311と重なり合う。図4に示すように、第1素子部311のうちゲート絶縁層L0を挟んでゲート電極511に対向する領域が駆動トランジスタTdrのチャネル領域311cである。また、第1素子部311のうちチャネル領域311cよりも電極E2側の領域すなわち、図6のように基板10に垂直な方向からみてゲート電極511と電極E1との間隙に位置する領域はソース領域311sであり、その反対側の領域はドレイン領域311dである。第1データ線部131は、図2のデータ線13を構成する部分である。この第1データ線部131は、中間導電体51からみてX方向の負側の領域に配置され、選択線11と初期化線12との間隙にてY方向に延在する。図8は、図6の段階にある4個の単位素子PがX方向およびY方向にわたって配列する様子を示す平面図である。図6および図8に示すように、各単位素子Pにおいて、Y方向の負側の周縁に形成された第2素子部312初期化トランジスタTintはX方向の正側に位置し、Y方向の正側の周縁に形成された素子部411選択トランジスタTslはX方向の負側に位置する。いま、第2素子部312と素子部411とが各単位素子PにおけるX方向の同じ側に配置された構成を想定する。この構成においては、第2素子部312と素子部411とを確実に離間させるために、Y方向に隣接する各単位素子Pの間隙の領域図8の領域Bに相当する領域を充分に確保する必要があるから、単位素子Pの高精細化が阻害されるという問題がある。これに対し、本実施形態においては、第2素子部312および素子部411のX方向における位置が相違するから、図8に示すように、第2素子部312と素子部411とは領域B内にてX方向に沿って交互に配列する。この構成によれば、領域Bを狭小化した場合であっても第2素子部312と素子部411とは確実に離間するから、単位素子Pの高精細化が容易であるという利点がある。図4に示すように、中間導電体51や第1データ線部131が形成されたゲート絶縁層L0の表面はその全域にわたって第1絶縁層L1に覆われる。図4および図7に示すように、第1絶縁層L1の面上には、接続部61と素子導通部71と電源線15と第2データ線部132とが導電性材料によって同層から形成される。図7のように基板10に垂直な方向からみると、接続部61は、第2素子部312の部分312cにおけるY方向の正側の端部と中間導電体51ゲート電極511とに重なり合う。そして、接続部61は、第1絶縁層L1とゲート絶縁層L0とを貫通するコンタクトホールHa1を介して部分312cに導通するとともに、第1絶縁層L1を貫通するコンタクトホールHa2を介して中間導電体51に導通する。すなわち、駆動トランジスタTdrのゲート電極511容量素子C1の電極E1と初期化トランジスタTintとは接続部61を介して電気的に接続される。なお、本明細書におけるコンタクトホールとは、絶縁層の一方の側に位置する要素と絶縁層の他方の側に位置する要素とを電気的に接続するための部分であり、より具体的には絶縁層をその厚さ方向に貫通する部分孔や穴である。コンタクトホールの平面的な形状は任意である。素子導通部71は、駆動トランジスタTdrと発光素子Eとの間に介在して両者を電気的に接続する部分であり、基板10に垂直な方向からみると、駆動トランジスタTdrを挟んで容量素子C1とは反対側の領域すなわち駆動トランジスタTdrに対してY方向の負側の領域に配置される。本実施形態の素子導通部71は、基板10に垂直な方向からみて第1素子部311のドレイン領域311dに重なり合う部分711と、初期化線12を挟んで部分711とは反対側に位置する部分712とが連続する形状である。基板10に垂直な方向からみて第1絶縁層L1のうちドレイン領域311dと重なり合う領域には、第1絶縁層L1とゲート絶縁層L0とを貫通する複数のコンタクトホールHa3が形成される。これらのコンタクトホールHa3はゲート電極511が延在するX方向すなわち駆動トランジスタTdrのチャネル幅の方向に配列する。素子導通部71の部分711は、各コンタクトホールHa3を介してドレイン領域311dに導通する。次に、図9は、図8の段階にある4個の単位素子PがX方向およびY方向にわたって配列する様子を示す平面図である。図7および図9に示すように、電源線15は、複数の単位素子Pの配列に沿ってX方向に延在する帯状の配線である。この電源線15は、基板10に垂直な方向からみて、各単位素子Pの容量素子C1と駆動トランジスタTdrのソース領域311sとの双方に重なり合う。図7に示すように、第1絶縁層L1のうちソース領域311sと重なり合う領域には、第1絶縁層L1とゲート絶縁層L0とを貫通する複数のコンタクトホールHa4が形成される。これらのコンタクトホールHa4はゲート電極511が延在するX方向に配列する。電源線15は、各コンタクトホールHa4を介して駆動トランジスタTdrのソース領域311sに導通する。本実施形態の電源線15は、基板10に垂直な方向からみて、選択トランジスタTsl素子部411や選択線11および初期化トランジスタTint第2素子部312や初期化線12と重なり合わないように、その形状や寸法が選定されている。換言すると、電源線15は、図9に示すように、選択線11に沿った各選択トランジスタTslの配列と初期化線12に沿った各初期化トランジスタTintの配列との間隙の領域にてX方向に延在する。第2データ線部132は、第1データ線部131と協働してデータ線13を構成する部分であり、図7および図9に示すように各電源線15の間隙にてY方向に延在する。図7に示すように、第2データ線部132のうちY方向の正側下側の端部132aは、第1データ線部131におけるY方向の負側上側の端部131a図6参照と重なり合う。端部132aと端部131aとは第1絶縁層L1を貫通するコンタクトホールHa5を介して相互に導通する。同様に、第2データ線部132のうちY方向の負側の端部132bと第1データ線部131におけるY方向の正側の端部131b図6参照とはコンタクトホールHa6を介して相互に導通する。以上のように、Y方向に沿って交互に配列する第1データ線部131と第2データ線部132とが電気的に接続されることによって、Y方向に直線状に延在するデータ線13が構成される。図7に示すように、第2データ線部132には分岐部134が連設される。分岐部134は、選択線11を挟んで容量素子C1とは反対側に位置する部分であり、X方向に延在して半導体層41の素子部411と重なり合う。この分岐部134は、第1絶縁層L1とゲート絶縁層L0とを貫通するコンタクトホールHa7を介して素子部411に導通する。すなわち、選択トランジスタTslとデータ線13とは分岐部134を介して電気的に接続される。図7および図9に示すように、各単位素子Pの容量素子C1は、そのX方向の正側に隣接する他の単位素子Pに対応したデータ線13に隣接する。図10は、任意のひとつの単位素子P1とそのX方向の正側に隣接する他の単位素子P2との近傍を拡大して示す断面図である。同図においては、単位素子P1の中間導電体51ここでは特に容量素子C1の電極E1と、単位素子P2に対応したデータ線13の第1データ線部131とが図示されている。中間導電体51と第1データ線部131とは同層から形成されて相互に近接するから、図10に示すように、中間導電体51の電極E1と第1データ線部131とは容量的に結合して両者間には容量寄生容量Caが付随する。したがって、単位素子P1の電極E1さらには駆動トランジスタTdrのゲート電極511の電位Vgは、本来ならば単位素子P1に対応したデータ線13の電位の変動量単位素子P1の階調に応じた電圧のみによって設定されるべきにも拘わらず、実際には単位素子P2に対応した第1データ線部131の電位の変動量単位素子P2の階調に応じた電圧の影響も受ける。すなわち、各単位素子Pの駆動トランジスタTdrにおけるゲート電位Vgを正確に設定できず、この結果として発光素子Eの光量に誤差が生じる可能性がある。図7に示すように、第1データ線部131と電源線15とは第1絶縁層L1を挟んで対向する。したがって、第1データ線部131と電源線15との間には容量が形成される。本実施形態においては、図10に示すように、単位素子P2の第1データ線部131と電源線15との間に形成される容量Cbの容量値c2が、この第1データ線部131と単位素子P1の中間導電体51電極E1との間に付随する容量Caの容量値c1よりも大きい。この構成によれば、単位素子P2の第1データ線部131の電位の変動によって単位素子P1の中間導電体51電極E1に与えられる影響が容量Cbによって低減される。したがって、各単位素子Pにおける駆動トランジスタTdrのゲート電位Vgやこのゲート電位Vgに応じた発光素子Eの光量を高い精度で所期値に設定することができる。本実施形態においては、以上の条件c2>c1が満たされるように、第1データ線部131と電源線15との距離第1絶縁層L1の膜厚や、単位素子P1の中間導電体51と単位素子P2の第1データ線部131との間隔が選定されている。さらに詳述すると、単位素子P2の第1データ線部131と電源線15との距離第1絶縁層L1の膜厚は、単位素子P1の中間導電体51と単位素子P2の第1データ線部131との間隔よりも小さい。また、単位素子P2の第1データ線部131と電源線15とが第1絶縁層L1を挟んで対向する面積すなわち基板10に垂直な方向からみて第1データ線部131と電源線15とが重なり合う部分の面積は、この第1データ線部131と単位素子P1の中間導電体51とが対向する面積すなわち中間導電体51の側端面基板10に垂直な側面のうち第1データ線部131の側端面に対向する領域の面積よりも大きい。以上のように各部の寸法や間隔を選定することによって容量値c2を容量値c1よりも大きくすることができる。ただし、データ線13のデータ電位Vdataに応じて駆動トランジスタTdrのゲート電位Vgを正確に設定するためには、任意の単位素子P2における容量Cbの容量値c2が、その単位素子P2の容量素子C1の容量値Cゲート電極511に容量Csが寄生する場合には容量素子C1と寄生容量Csとの合成容量よりも小さいことが望ましい。この条件を満たすために、例えば、第1データ線部131と電源線15との間隙は、容量素子C1における電極E1と電極E2との間隙よりも大きい寸法に選定される。さらに詳述すると、第1データ線部131と電源線15との間に介在する第1絶縁層L1すなわち容量Cbの誘電体の膜厚は、電極E1と電極E2との間に介在するゲート絶縁層L0容量素子C1の誘電体の膜厚よりも大きい寸法に選定される。また、電極E1と電極E2との対向する面積すなわち容量素子C1の面積が第1データ線部131と電源線15との対向する面積よりも大面積とされた構成によっても、容量Cbの容量値c2は容量素子C1の容量値Cよりも小さくなる。さて、図4に示すように、第2データ線部132や電源線15が形成された第1絶縁層L1の表面はその全域にわたって第2絶縁層L2に覆われる。図3および図4に示すように、第2絶縁層L2の表面には第1電極21が形成される。第1電極21は、基板10に垂直な方向からみて素子導通部71や駆動トランジスタTdrや容量素子C1と重なり合う略矩形状の電極である。本実施形態の第1電極21は、アルミニウムや銀などの金属またはこれらの金属を主成分とする合金など光反射性の導電性材料によって形成される。この第1電極21は、第2絶縁層L2を貫通するコンタクトホールHa8を介して素子導通部71の部分712に導通する。すなわち、駆動トランジスタTdrのドレイン領域311dと発光素子Eの第1電極21とは素子導通部71を介して電気的に接続される。第1電極21が形成された第2絶縁層L2の面上には、各単位素子Pの境界を仕切る形状格子状の隔壁25が形成される。この隔壁25は、相隣接する第1電極21を電気的に絶縁させる役割すなわち第1電極21の電位の個別的な制御を可能とする役割を担う。各発光素子Eの発光層23は、隔壁25の内周面に包囲されて第1電極21を底面とする窪みに形成される。なお、発光層23による発光を促進または効率化するための各種の機能層正孔注入層、正孔輸送層、電子注入層、電子輸送層、正孔ブロック層、電子ブロック層が発光層23に積層された構成としてもよい。図4に示すように、第2電極22は、複数の単位素子Pにわたって連続に形成されて発光層23および隔壁25を覆う電極である。したがって、隔壁25は、各発光素子Eの間隙の領域において各第1電極21と第2電極22とを電気的に絶縁する。換言すると、隔壁25は、第1電極21と第2電極22との間に電流が流れる領域すなわち実際に発光する領域を画定する。第2電極22は、ITOIndiumTinOxideやIZOIndiumZincOxideといった光透過性の導電性材料によって形成される。したがって、発光層23から基板10とは反対側に出射した光と発光層23から基板10側に出射して第1電極21の表面で反射した光とは第2電極22を透過して出射する。すなわち、本実施形態の発光装置Dはトップエミッション型である。第2電極22はその全域にわたって封止材図示略に覆われる。この封止材は、第2電極22を保護する第1層と、第2電極22の表面の段差を平坦化する第2層と、第2電極22や発光層23への不純物例えば水分の浸入を防止する第3層バリア層とが第2電極22側からこの順番に積層された構造となっている。以上に説明したように、本実施形態においては、駆動トランジスタTdrを挟んで容量素子C1とは反対側の領域に素子導通部71が配置される。この構成によれば、容量素子C1に要求される容量値を低減できるという効果が奏される。この効果について詳述すると以下の通りである。いま、基板10に垂直な方向からみて駆動トランジスタTdrと容量素子C1との間隙に素子導通部71が配置された構成以下構成1というを想定する。この構成1においては、容量素子C1の電極E1と素子導通部71とが第1絶縁層L1を挟んで近接する。したがって、図11に破線で図示されるように、電極E1と素子導通部71第1電極21との間には容量Cxが付随する。書込期間において電極E1の電位はΔVC/CCsだけ変化する。構成1における容量値Csは、電極E1と素子導通部71とが容量的に結合しない場合と比較して容量Cxの分だけ増大するから、データ線13の電位の変動量ΔVに対する駆動トランジスタTdrのゲート電位Vgの変動量は制限される。したがって、ゲート電位Vgを変動量ΔVに応じて広範囲に変動させるためにはすなわち発光素子Eの光量の範囲を充分に確保するためには、ゲート絶縁層L0の膜厚の低減や電極E1および電極E2の面積の増大といった方策によって、容量素子C1に充分な容量値Cを確保する必要がある。ゲート絶縁層L0の膜厚を低減するには限界があるから、構成1においては結局のところ電極E1や電極E2の面積を増大させる必要がある。しかしながら、容量素子C1の面積を増大した場合には単位素子Pの高精細化が制限されるという問題がある。なお、第1絶縁層L1を充分な膜厚に形成することで電極E1と素子導通部71とを離間させれば、構成1においても容量Cxは低減される。しかしながら、第1絶縁層L1を厚く形成すると、クラックなど成膜の不良が発生し易くなるという問題や、コンタクトホールの不良例えば第1絶縁層L1のうちコンタクトホールの部分が完全に除去されないといった不良に起因して各要素が完全には導通されないといった問題が生じ得るから、この方法による容量Cxの低減には限界がある。これに対し、本実施形態においては、駆動トランジスタTdrを挟んで容量素子C1とは反対側の領域に素子導通部71が配置されるから、電極E1と素子導通部71とに付随する容量Cxは構成1と比較して充分に低減される。したがって、容量素子C1の面積を構成1ほど増大させなくても、駆動トランジスタTdrのゲート電極511のゲート電位Vgさらには発光素子Eの光量を広範囲にわたって変化させることができる。また、本実施形態においては、電源線15と同層から形成される素子導通部71および接続部61の双方が、基板10に垂直な方向からみて駆動トランジスタTdrのY方向の負側すなわち電源線15の幅方向の一方の側に位置する。この構成によれば、第1絶縁層L1の表面のうち駆動トランジスタTdrに対してY方向の正側電源線15の幅方向の他方の側に、電源線15が形成されるスペースを充分に確保することが可能である。したがって、電源線15を幅広に形成してその抵抗を低減できるという効果が奏される。特に、本実施形態においては、容量素子C1と重なり合うように電源線15が形成されるから、例えば電源線15が駆動トランジスタTdrのソース領域31sのみと重なり合う構成と比較して、電源線15の抵抗は大幅に低減される。そして、この低抵抗化によって電源線15の面内における電圧降下が抑制されるから、各単位素子Pに供給される電源電位Vddのバラツキやこれに起因した各発光素子Eの光量のバラツキを低減できる。また、例えば素子導通部71や接続部61が駆動トランジスタTdrと容量素子C1との間隙に配置された構成においては、素子導通部71や接続部61を避ける形状に電源線15を形成する必要がある。しかしながら、このように電源線15の形状を複雑化すると、製造技術上の理由から電源線15の断線や損傷が発生し易いという問題がある。これに対し、本実施形態によれば、駆動トランジスタTrを挟んで素子導通部71や接続部61とは反対側に電源線15のスペースが確保されるから、図7に例示したように電源線15を単純な帯状の形状とすることが可能である。この結果として電源線15の断線や破損が抑制されるから、本実施形態によれば発光装置Dの歩留まりを向上することも可能である。ところで、電源線15の低抵抗化という観点のみからすれば、駆動トランジスタTdrや容量素子C1だけでなく選択トランジスタTslや初期化トランジスタTintにも電源線15が重なり合う構成以下構成2というとしてもよい。しかしながら、この構成2においては、選択トランジスタTslや選択線11が電源線15と容量的に結合しすなわち両者間に容量が寄生し、この容量に起因して選択信号Saに波形の鈍りが発生し易いという問題がある。同様に、初期化トランジスタTintや初期化線12と電源線15との間に付随する容量も、初期化信号Sbの波形の鈍りの原因となり得る。したがって、構成2においては、選択トランジスタTslや初期化トランジスタTintのスイッチングが遅延するという問題がある。これに対し、本実施形態においては、基板10に垂直な方向からみて、選択トランジスタTslや選択線11および初期化トランジスタTintや初期化線12には電源線15が重なり合わないから、これらの要素と電源線15との間に寄生する容量は構成2と比較して低減される。したがって、本実施形態によれば、選択信号Saや初期化信号Sbの波形の鈍りを抑制して選択トランジスタTslや初期化トランジスタTintを高速に動作させることができる。<B-2:第2実施形態>次に、本発明の第2実施形態における単位素子Pの具体的な構成を説明する。図12は、本実施形態における単位素子Pの構成を示す平面図であり、図13ないし図15は、単位素子Pが形成される各段階における基板10の面上の様子を示す平面図である。なお、以下に示す各形態において、第1実施形態と共通する要素には同一の符号を付してその説明を適宜に省略する。図13に示すように、基板10の面上には半導体層32と半導体層42と半導体層45とが半導体材料によって同層から形成される。半導体層32は、駆動トランジスタTdrを構成する略矩形状の部分である。半導体層42は、半導体層32からみてY方向の正側に形成された部分であり、略矩形状の電極E2と、電極E2の左下部からX方向に延在する素子部421とを含む。素子部421は、選択トランジスタTslの半導体層として機能する部分である。半導体層45は、初期化トランジスタTintを構成する部分であり、半導体層42を挟んで半導体層32とは反対側の領域にてX方向に延在する。以上の各部が形成された基板10の表面はゲート絶縁層L0に覆われる。図14に示すように、ゲート絶縁層L0の面上には、第1データ線部131と選択線11および初期化線12と中間導電体52と第1中継配線部171とが同層から形成される。第1データ線部131は、第1実施形態と同様にデータ線13を構成する部分であり、中間導電体52からみてX方向の正側の領域にてY方向に延在する。初期化線12は、X方向に延在する部分からY方向の負側に分岐して半導体層45に重なり合う第1ゲート電極121と第2ゲート電極122とを有する。半導体層45のうち第1ゲート電極121および第2ゲート電極122の各々と重なり合う部分が初期化トランジスタTintのチャネル領域である。同様に、選択線11は、X方向に延在する部分からY方向の負側に分岐して半導体層42の素子部421に重なり合う第1ゲート電極111と第2ゲート電極112とを有する。第1ゲート電極111と第2ゲート電極112とは間隔をあけてX方向に隣接する。素子部421のうちゲート絶縁層L0を挟んで第1ゲート電極111および第2ゲート電極112の各々と重なり合う部分が選択トランジスタTslのチャネル領域である。以上のように、本実施形態の選択トランジスタTslおよび初期化トランジスタTintは、デュアルゲート構造の薄膜トランジスタである。中間導電体52は、電極E2に対向して容量素子C1を構成する電極E1と、電極E1からY方向の負側に連続するゲート電極521と、電極E1のうちX方向における略中央からY方向の正側に突出する接続部523とを含む。ゲート電極521は、半導体層32のY方向に沿った全寸法にわたって半導体層32と重なり合うようにY方向に延在する。図14に示すように、半導体層32のうちゲート絶縁層L0を挟んでゲート電極521に対向する領域が駆動トランジスタTdrのチャネル領域32cである。また、チャネル領域32cを挟んでX方向の負側の領域はドレイン領域32dであり、その反対側の領域はソース領域32sである。第1中継配線部171は、初期化トランジスタTintと駆動トランジスタTdrのドレイン領域32dとを電気的に接続するための配線以下中継配線というを構成する部分であり、中間導電体52からみてX方向の負側の領域にてY方向に延在する。すなわち、本実施形態における中間導電体52は第1データ線部131と第1中継配線部171との間隙に配置される。以上の各部が形成されたゲート絶縁層L0の表面はその全域にわたって第1絶縁層L1に覆われる。図12および図15に示すように、第1絶縁層L1の面上には、第2データ線部132と接続部62と第2中継配線部172と素子導通部72と電源線15とが形成される。第2データ線部132は、第1実施形態と同様に、第1データ線部131と協働してデータ線13を構成する配線である。すなわち、第2データ線部132は、コンタクトホールHb1を介して第1データ線部131の上端部131a図14参照に導通する端部132aからY方向に延在して端部132bに至る。端部132bは、コンタクトホールHb2を介して第1データ線部131の下端部131b図14参照に導通する。また、本実施形態の第2データ線部132は、第1絶縁層L1とゲート絶縁層L0とを貫通するコンタクトホールHb3を介して素子部421の端部に導通する。すなわち、データ線13と選択トランジスタTslとはコンタクトホールHb3を介して電気的に接続される。図14および図15に示すように、接続部62は、中間導電体52の接続部523と半導体層45のX方向における正側の端部451とに重なり合うようにY方向に延在する。接続部62は、第1絶縁層L1を貫通するコンタクトホールHb4を介して接続部523電極E1やゲート電極521に導通するとともに、第1絶縁層L1とゲート絶縁層L0とを貫通するコンタクトホールHb5を介して半導体層45の端部451に導通する。すなわち、容量素子C1の電極E1さらには駆動トランジスタTdrのゲート電極521と初期化トランジスタTintとは接続部62を介して電気的に接続される。図15のように基板10に垂直な方向からみると、接続部62は、選択トランジスタTslの第1ゲート電極111と第2ゲート電極112との間隙の領域内に位置する。したがって、接続部62は第1ゲート電極111や第2ゲート電極112と重なり合わない。ここで、例えば第1ゲート電極111または第2ゲート電極112と接続部62とが重なり合う構成においては、両者が容量的に結合する。したがって、接続部62の電位すなわち電極E1や駆動トランジスタTdrのゲート電極511の電位の変動に伴なって第1ゲート電極111の電位も変化し、この結果として初期化信号Sbの波形が鈍る場合がある。初期化信号Sbの波形の鈍りは初期化トランジスタTintの動作の動作の遅延の原因となる。これに対し、本実施形態においては、第1ゲート電極111や第2ゲート電極112とは重なり合わないように接続部62が形成されるから、接続部62と第1ゲート電極111や第2ゲート電極112との間の容量的な結合は抑制される。したがって、接続部62の電位の変動が初期化トランジスタTintに与える影響が低減され、この結果として初期化トランジスタTintを高速に動作させることが可能となる。また、以上のように初期化トランジスタTintと容量素子C1の電極E1とが接続部62を介して導通する構成によれば、選択トランジスタTslや初期化トランジスタTintのチャネル長を充分に確保できるから、チャネル長が制限される構成と比較して選択トランジスタTslや初期化トランジスタTintにおける電流のリークを抑制することが可能である。選択トランジスタTslや初期化トランジスタTintは駆動トランジスタTdrのゲート電極521に接続されるから、各々における電流のリークの削減によって、駆動期間におけるゲート電極521の電位の変動が抑制される。したがって、本実施形態によれば、発光素子Eの光量を高い精度で所期値に維持することが可能である。図15の素子導通部72は、第1実施形態の素子導通部71と同様に駆動トランジスタTdrのドレイン電極と発光素子Eの第1電極21との間に介在して両者を電気的に接続する部分である。この素子導通部72は、Y方向に延在する部分721と、駆動トランジスタTdrを挟んで容量素子C1とは反対側に位置する部分722とが連続する形状略L字状である。部分721は、第1中継配線部171の端部171a図14参照と半導体層32のドレイン領域32dとに重なり合う。部分721は、第1絶縁層L1を貫通するコンタクトホールHb6を介して上端部171aに導通する。第1絶縁層L1のうちドレイン領域32dと重なり合う領域には、第1絶縁層L1とゲート絶縁層L0とを貫通する複数ここでは2個のコンタクトホールHb7が形成される。これらのコンタクトホールHb7はゲート電極521が延在するY方向すなわち駆動トランジスタTdrのチャネル幅の方向に配列する。素子導通部72の部分721は、各コンタクトホールHb7を介してドレイン領域32dに導通する。第2中継配線部172は、図14および図15に示すように、半導体層45におけるX方向の負側の端部452と第1中継配線部171とに重なり合うようにY方向に延在する配線である。この第2中継配線部172は、第1絶縁層L1とゲート絶縁層L0とを貫通するコンタクトホールHb8を介して端部452に導通するとともに、第1絶縁層L1を貫通するコンタクトホールHb9を介して第1中継配線部171の下端部171bに導通する。以上のように、初期化トランジスタTintと駆動トランジスタTdrのドレイン領域32dさらには素子導通部72とは、第1中継配線部171と第2中継配線部172とから構成される中継配線17を介して電気的に接続される。図16は、図15の段階にある4個の単位素子PがX方向およびY方向にわたって配列する様子を示す平面図である。図15および図16に示すように、本実施形態における電源線15は、複数の単位素子PにわたってX方向に延在する第1部分151と、複数の単位素子PにわたってY方向に延在する第2部分152とが交差する形状格子状の配線である。図15に示すように、第1絶縁層L1のうち半導体層32のソース領域32sと重なり合う領域には、第1絶縁層L1とゲート絶縁層L0とを貫通する複数ここでは2個のコンタクトホールHb10が形成される。これらのコンタクトホールHb10はゲート電極521が延在するY方向に配列する。電源線15第2部分152は、各コンタクトホールHb10を介してソース領域32sに導通する。第1部分151は、各第2データ線部132の間隙の領域と、第2中継配線部172および素子導通部72部分721の間隙の領域とを通過するようにX方向に延在する。したがって、図15や図16のように基板10に垂直な方向からみると、第1部分151は、第1データ線部131と第1中継配線部171と容量素子C1とに重なり合う。また、第2部分152は、素子導通部72部分722および第2データ線部132の間隙の領域と、接続部62および第2データ線部132の間隙の領域とを通過するようにY方向に延在する。図15や図16に示すように、電源線15は、選択トランジスタTslや初期化トランジスタTintに重なり合わない。以上の各要素が形成された第1絶縁層L1の表面はその全域にわたって第2絶縁層L2に覆われる。図12に示すように、発光素子Eやその間隙を仕切る隔壁25は第2絶縁層L2の面上に形成される。素子導通部72の部分722は、第1実施形態と同様に、第2絶縁層L2を貫通するコンタクトホールHb11を介して第1電極21に導通する。図12に示すように、発光素子Eや隔壁25の具体的な構成は第1実施形態と同様である。以上に説明したように、本実施形態においては、駆動トランジスタTdrを挟んで容量素子C1とは反対側に素子導通部72が配置される。したがって、第1実施形態と同様に、電極E1と素子導通部72とに寄生する容量図11の容量Cxが削減され、この結果として容量素子C1の容量値を削減することができる。また、選択トランジスタTslや初期化トランジスタTintと重なり合わないように電源線15が形成されるから、第1実施形態と同様に、選択トランジスタTslや初期化トランジスタTintを所期のタイミングにて高速に動作させることができる。また、本実施形態においては、素子導通部72や接続部62や第2中継配線部172が電源線15と同層から形成され、かつ、駆動トランジスタTdrを挟んでX方向の負側すなわち電源線15の幅方向の一方の側に素子導通部72が配置されるとともにその反対側電源線15の幅方向における他方の側に接続部62や第2中継配線部172が配置される。したがって、素子導通部72と接続部62第2中継配線部172との間隙に、電源線15のうちX方向に延在する第1部分151が形成されるべきスペースを充分に確保することが可能である。さらに、基板10に垂直な方向からみて容量素子C1と重なり合うスペースも電源線15の形成に利用できる。したがって、第1実施形態と同様に、電源線15第1部分151を幅広に形成してその抵抗を低減できるという効果が奏される。しかも、本実施形態においては、Y方向に延在する第2部分152によって各第1部分151が連結されるから、電源線15が第1部分151のみから構成される場合と比較して、電源線15の抵抗をいっそう低減することができる。また、電源線15の第1部分151の形状が単純な帯状とされるから、電源線15と同層から形成される要素素子導通部72や接続部62を避けるように電源線15が複雑な形状に形成された構成と比較して、電源線15の断線や破損を抑制することができる。また、本実施形態においては、各単位素子PにおけるX方向の正側の周縁に沿ってデータ線13が延在するとともにX方向の負側の周縁に沿って中継配線17が延在する。この構成において、例えば図16に示すように任意のひとつの単位素子P1とそのX方向の負側に隣接する他の単位素子P2とに着目すると、単位素子P1の容量素子C1と単位素子P2に対応したデータ線13との間には単位素子P1の中継配線17が介在する。したがって、ひとつの単位素子Pの容量素子C1とこれに隣接する単位素子Pのデータ線13とが近接する第1実施形態の構成と比較して、単位素子P1の容量素子C1と単位素子P2のデータ線13との間に形成される容量は低減される。この構成によれば、単位素子P2のデータ線13の電位の変動が単位素子P1の容量素子C1に与える影響が低減されるから、各単位素子Pにおける駆動トランジスタTdrのゲート電位Vgやこのゲート電位Vgに応じた発光素子Eの光量を高い精度で所期値に設定することができる。<第2実施形態の変形例>次に、以上に説明した第2実施形態の変形例を説明する。図17は、本変形例において第1絶縁層L1が形成された段階図14の段階を示す平面図である。第2実施形態においては、駆動トランジスタTdrのゲート電極521がY方向に延在する構成を例示した。これに対し、本変形例においては、図17に示すようにゲート電極521がX方向に延在する。なお、本変形例のうち第2実施形態と同様の要素については共通の符号を付してその説明を適宜に省略する。図17に示すように、本実施形態の中間導電体52は、電極E1の左上部からY方向の負側に延在する連結部525と、この連結部525からX方向に延在して半導体層32と重なり合うゲート電極521とを含む。ゲート電極521は、半導体層32のX方向における全寸法にわたってX方向に延在する。半導体層32のうちゲート絶縁層L0を挟んでゲート電極521に対向する領域が駆動トランジスタTdrのチャネル領域32cである。また、チャネル領域32cを挟んで電極E1側の領域がソース領域32sであり、その反対側の領域がドレイン領域32dである。図18は、図17の段階からさらに電源線15や素子導通部72が形成された段階図15の段階を示す平面図である。図18に示すように、素子導通部72は、駆動トランジスタTdrを挟んで容量素子C1とは反対側の領域に略矩形状に形成される。図17および図18に示すように、素子導通部72は、ゲート電極511が延在するX方向すなわち駆動トランジスタTdrのチャネル長の方向に配列する複数のコンタクトホールHb7を介してドレイン領域32dに導通する。また、電源線15は、ゲート電極511に沿ってX方向に配列する複数のコンタクトホールHb10を介してソース領域32sに導通する。以上に説明したように駆動トランジスタTdrのゲート電極521はX方向に延在するから、ドレイン領域32dは、ゲート電極521を挟んで容量素子C1とは反対側の領域に、X方向に沿って長尺状に形成される。この構成においては、駆動トランジスタTdrに沿ってY方向に延在する部分第1実施形態の部分721を素子導通部72に形成する必要がない。したがって、本変形例によれば、図18と図15との対比から理解されるように、電源線15のうちゲート電極521の方向に延在する第1部分151を、第2実施形態よりも幅広に形成できるという利点がある。また、本変形例においては、各コンタクトホールHb7とコンタクトホールHb6中継配線17と素子導通部72とが導通する部分とコンタクトホールHb1第1データ線部131と第2データ線部132とが導通する部分とがX方向に沿って直線状に配列する。したがって、各コンタクトホールHb7Hb6Hb1のY方向における位置が相違する構成と比較して、X方向に沿って直線状帯状に延在する第1部分151の線幅を充分に確保することができる。ところで、第2実施形態においては、電源線15の第1部分151と直交する方向にゲート電極521が延在する。したがって、ゲート電極521の長さより厳密には素子導通部72の部分721の長さが増加するほど第1部分151の線幅は縮小される。これに対し、本変形例においては、第1部分151と平行な方向にゲート電極521が延在するから、第1部分151の線幅を縮小することなくゲート電極521の長さを増加させることができる。ゲート電極521の長さは駆動トランジスタTdrのチャネル幅に相当するから、本変形例によれば、第1部分151の線幅を維持しながら駆動トランジスタTdrのチャネル幅を増大させることができる。このようにチャネル幅が大きい駆動トランジスタTdrによれば、電源線15から駆動トランジスタTdrを経由して発光素子Eに供給される電流量を充分に確保できるという利点がある。<C:変形例>以上の形態には様々な変形が加えられる。具体的な変形の態様を例示すれば以下の通りである。なお、以下の各態様を適宜に組み合わせてもよい。<C-1:変形例1>以上の各形態における単位素子Pの電気的な構成は適宜に変更される。本発明に適用される単位素子Pの具体的な態様を以下に例示する。1図19に示すように、駆動トランジスタTdrと発光素子Eとの間にトランジスタ以下発光制御トランジスタというTcntが介在する構成としてもよい。この発光制御トランジスタTcntは、駆動トランジスタTdrのドレイン電極と発光素子Eの第1電極21との電気的な接続を、発光制御線14に供給される発光制御信号Scに応じて制御するスイッチング素子である。発光制御トランジスタTcntがオン状態に変化すると電源線15から発光素子Eへの電流の経路が形成されて発光素子Eの発光が許可され、発光制御トランジスタTcntがオフ状態に変化するとこの経路が遮断されて発光素子Eの発光が禁止される。したがって、この構成によれば、初期化期間や書込期間を除外した駆動期間のみにおいて発光制御トランジスタTcntをオン状態として発光素子Eを発光させるといった具合に、発光素子Eが実際に発光する期間を正確に規定することができる。第1実施形態および第2実施形態の各々において、発光制御トランジスタTcntは、例えば駆動トランジスタTdrを挟んで容量素子C1とは反対側すなわちY方向の負側に配置される。この態様によれば、例えば発光制御トランジスタTcntが駆動トランジスタTdrと容量素子C1との間隙の領域に配置された構成と比較して、電源線15を駆動トランジスタTdrおよび容量素子C1の双方と重なり合うように幅広に形成できるという利点がある。2図20に示すように、駆動トランジスタTdrのゲート電極とソース電極電源線15との間に容量素子C2が介挿された構成としてもよい。この構成によれば、書込期間にて設定された駆動トランジスタTdrのゲート電位Vgを駆動期間にて容量素子C2に保持できるという利点がある。もっとも、駆動トランジスタTdrのゲート電極の面積チャネル領域の面積が充分に確保される構成においては、この駆動トランジスタTdrのゲート容量によってゲート電位Vgが保持される。したがって、第1実施形態および第2実施形態のように容量素子C2が配置されない構成であっても、駆動期間にてゲート電位Vgを保持することは可能である。3図21に示す構成の単位素子Pも採用される。この単位素子Pにおいては、以上の各形態における容量素子C1や初期化トランジスタTint初期化線12が形成されず、駆動トランジスタTdrのゲート電極とデータ線13との電気的な接続が選択トランジスタTslによって制御される。また、駆動トランジスタTdrのゲート電極とソース電極電源線15との間には容量素子C2が介在する。この構成において選択トランジスタTslがオン状態に変化すると、発光素子Eに指定された階調に応じたデータ電位Vdataがデータ線13から選択トランジスタTslを経由して駆動トランジスタTdrのゲート電極に供給される。このときに容量素子C2にはデータ電位Vdataに応じた電荷が蓄積されるから、選択トランジスタTslがオフ状態に変化しても、駆動トランジスタTdrのゲート電位Vgはデータ電位Vdataに維持される。したがって、発光素子Eには、駆動トランジスタTdrのゲート電位Vgに応じた電流データ電位Vdataに応じた電流が継続的に供給される。この電流の供給によって発光素子Eはデータ電位Vdataに応じた輝度で発光する。図21の容量素子C2は、例えば以上の各形態における容量素子C1と同様の態様で基板10の面上に配置される。この形態によっても第1実施形態から第2実施形態と同様の作用および効果が奏される。以上のように、駆動トランジスタTdrのゲート電極に接続される容量素子は、容量カップリングによって駆動トランジスタTdrのゲート電位Vgを設定するための容量素子C1であってもよいし、データ線13から駆動トランジスタTdrのゲート電極に供給されるデータ電位Vdataを保持するための容量素子C2であってもよい。<C-2:変形例2>以上の形態においては第1電極21が光反射性の材料によって形成された構成を例示したが、発光層23から基板10側への出射光が第1電極21とは別個の反射層によって基板10とは反対側に反射される構成としてもよい。この構成においては、光反射性の材料によって第1絶縁層L1の面上に反射層が形成され、この反射層を覆うように第1電極21が形成される。第1電極21は、ITOやIZOなどの光透過性の導電性材料によって形成される。また、以上の形態においては第2電極22が光透過性の材料によって形成された構成を例示したが、遮光性または光反射性を有する導電性材料を充分に薄く形成した電極が第2電極22とされた構成によっても発光層23からの放射光を透過させることができる。もっとも、発光層23からの出射光が基板10を透過して出射するボトムエミッション型の発光装置にも本発明は適用される。この構成においては、例えば、光反射性の導電性材料によって第2電極22が形成されるとともに光透過性の導電性材料によって第1電極21が形成される。そして、発光層23から基板10側への出射光と、発光層23から基板10とは反対側に出射して第2電極22の表面にて反射した光とが、第1電極21および基板10を透過して出射する。<C-3:変形例3>第1実施形態や第2実施形態においては電源線15が選択トランジスタTslおよび初期化トランジスタTintの何れにも重なり合わない構成を例示したが、電源線15が選択トランジスタTslと重なり合う構成や電源線15が初期化トランジスタTintと重なり合う構成も採用される。<C-4:変形例4>第2実施形態においては、接続部62が選択トランジスタTslの第1ゲート電極111と第2ゲート電極112との間隙の領域に形成される構成を例示した。これと同様に、電源線15の第2部分152が初期化トランジスタTintの第1ゲート電極121と第2ゲート電極122との間隙の領域に形成されてもよい。<C-5:変形例5>第1実施形態においては、電源線15がX方向に延在する部分本発明における第1部分のみを含む構成を例示したが、第2実施形態のように、これらの部分の各々を相互に連結するようにY方向に延在する部分以下第2部分というを電源線15が含む構成としてもよい。この第2部分は、例えば、図7に図示された接続部61と素子導通部71との間隙の領域や各単位素子Pの間隙の領域にてY方向に延在し、Y方向に隣接する各電源線15第1部分を相互に連結する。この構成によれば、第1実施形態と比較して電源線15の抵抗を低減することが可能である。<C-6:変形例6>以上の各形態においては、隔壁25の内周縁の内側の領域のみに発光層23が形成された構成を例示したが、基板10の全面より詳細には第2絶縁層L2の全面にわたって発光層23が連続に形成された構成としてもよい。この構成によれば、例えば、スピンコート法などの低廉な成膜技術を発光層23の形成に採用できるという利点がある。なお、第1電極21は発光素子Eごとに個別に形成されるから、発光層23が複数の発光素子Eにわたって連続するとは言っても、発光層23の光量は発光素子Eごとに個別に制御される。以上のように発光層23が複数の発光素子Eにわたって連続する構成においては隔壁25を省略してもよい。なお、隔壁25で仕切られた各空間に発光材料の液滴を吐出するインクジェット法液滴吐出法で発光層23を形成する場合には、以上の各形態のように第2絶縁層L2の面上に隔壁25を配置した構成が好適に採用される。ただし、発光層23を発光素子Eごとに形成するための方法は適宜に変更される。より具体的には、基板10の全域に形成された発光材料の膜体を選択的に除去する方法や、レーザ転写LITILaserInducedThermalImaging法など各種のパターニング技術によっても発光層23は発光素子Eごとに形成される。この場合には、隔壁25の形成を不要としながら発光素子Eごとに独立に発光層23を形成できる。以上のように、本発明の発光装置において隔壁25は必ずしも必要な要素ではない。<C-7:変形例7>以上の各形態においては有機EL材料からなる発光層23を含む発光素子Eを例示したが、本発明における発光素子はこれに限定されない。例えば、無機EL材料からなる発光層を含む発光素子やLEDLightEmittingDiode素子など様々な発光素子を採用することができる。本発明における発光素子は、電気エネルギの供給典型的には電流の供給によって発光する素子であれば足り、その具体的な構造や材料の如何は不問である。<D:応用例>次に、本発明に係る発光装置を利用した電子機器の具体的な形態を説明する。図22は、以上に説明した何れかの形態に係る発光装置Dを表示装置として採用したモバイル型のパーソナルコンピュータの構成を示す斜視図である。パーソナルコンピュータ2000は、表示装置としての発光装置Dと本体部2010とを備える。本体部2010には、電源スイッチ2001およびキーボード2002が設けられている。この発光装置Dは有機EL材料の発光層23を発光素子Eに使用しているので、視野角が広く見易い画面を表示できる。図23に、各形態に係る発光装置Dを適用した携帯電話機の構成を示す。携帯電話機3000は、複数の操作ボタン3001およびスクロールボタン3002、ならびに表示装置としての発光装置Dを備える。スクロールボタン3002を操作することによって、発光装置Dに表示される画面がスクロールされる。図24に、各形態に係る発光装置Dを適用した携帯情報端末PDA:PersonalDigitalAssistantsの構成を示す。情報携帯端末4000は、複数の操作ボタン4001および電源スイッチ4002、ならびに表示装置としての発光装置Dを備える。電源スイッチ4002を操作すると、住所録やスケジュール帳といった各種の情報が発光装置Dに表示される。なお、本発明に係る発光装置が適用される電子機器としては、図22から図24に示したもののほか、デジタルスチルカメラ、テレビ、ビデオカメラ、カーナビゲーション装置、ページャ、電子手帳、電子ペーパー、電卓、ワードプロセッサ、ワークステーション、テレビ電話、POS端末、プリンタ、スキャナ、複写機、ビデオプレーヤ、タッチパネルを備えた機器等などが挙げられる。また、本発明に係る発光装置の用途は画像の表示に限定されない。例えば、光書込み型のプリンタや電子複写機といった画像形成装置においては、用紙などの記録材に形成されるべき画像に応じて感光体を露光する書込みヘッドが使用されるが、この種の書込みヘッドとしても本発明の発光装置を利用することができる。