複数の走査信号線に対してトランジスタを導通させる電位であるアクティブ電位を順に出力する表示装置の駆動回路であって、前記複数の走査信号線に、それぞれ電気的に接続された複数の出力回路を備え、前記複数の出力回路のうち、一の出力回路は、前記複数の走査信号線のうちの一の走査信号線とクロック信号線との電気的接続を制御する第1トランジスタと、前記第1トランジスタのゲートに接続され、前記走査信号線に前記アクティブ電位が出力される期間を含む期間である第1期間にアクティブ電位となる第1ノードと、トランジスタを導通させない電位である非アクティブ電位を保持する非アクティブ信号線と前記第1ノードとを、前記第1期間以外の期間である第2期間において電気的に接続するように制御する第2トランジスタと、前記第2トランジスタのゲートに接続された第2ノードと、を有し、前記第2ノードは、アクティブ電位を保持するための2種類の充電のタイミングを有している、ことを特徴とする駆動回路。請求項1に記載の駆動回路であって、前記一の出力回路には、前記第2ノードをアクティブ電位を保持するために、整流作用のある素子を介して接続される第1充電線と、整流作用のある素子を介して接続される第2充電線と、が共に接続されている、ことを特徴とする駆動回路。請求項2に記載の駆動回路であって、前記第1充電線及び前記第2充電線のいずれか一方には、前記複数の出力回路に入力される同一周期の複数のクロック信号のうち、一のクロック信号が入力され、いずれか他方には、前記複数の出力回路のうち他の出力回路の一の走査信号線が接続される、ことを特徴とする駆動回路。請求項3に記載の駆動回路であって、前記一のクロック信号は、前記複数の出力回路に入力される同一周期の複数のクロック信号のうち、前記第1トランジスタに接続された前記クロック信号線に入力されるクロック信号がアクティブ電圧となるタイミングの前2分の1周期の間にアクティブ電圧となるクロック信号である、ことを特徴とする駆動回路。請求項3又は4に記載の駆動回路であって、前記他の出力回路の一の走査信号線は、前記一の出力回路の走査信号線への出力後に順に出力される出力のうち、直後の3出力のうちのいずれか一の出力である、ことを特徴とする駆動回路。請求項2に記載の駆動回路であって、前記第1充電線及び前記第2充電線には、前記複数の出力回路に入力される同一周期の複数のクロック信号のうち、2つの異なるクロック信号が入力される、ことを特徴とする駆動回路。画面に複数の画素を有する表示装置であって、請求項1~6のいずれか一項に記載の駆動回路と、前記複数の画素のそれぞれに配置され、階調値に基づく電圧を前記複数の画素の各々に保持するための画素トランジスタと、を備え、前記駆動回路の走査信号線は、前記画面の一行分の前記画素の前記画素トランジスタのゲートに接続されている、ことを特徴とする表示装置。図16には、駆動回路に複数含まれる出力回路の一例である走査信号線Gnに出力するための出力回路910が示されている。図17は、図16の出力回路910の動作のタイミングチャートである。Vnはクロック信号を表し、VGPLの電位はLow電位に固定されている。クロック信号Vnは、周期が同じでタイミングの異なる8つのクロック信号である8相クロック信号であり、この回路では走査信号線Gn-2がHigh電位になったことをトリガーとして、ノードN1及びN2の電位を変化させ、クロック信号VnはのHigh電位を走査信号線Gnに出力するようになっている。図18は、出力回路910を動作させたときのノードN2の電圧の変化の詳細を概略的に示している。ノードN2は、走査信号線GnにHigh電位を出力しない期間では、トランジスタT2を導通させるためにHigh電位に維持されている必要があるが、トランジスタT3、T4及びT7からリークが起こり、少しずつ電位の低下が起こっている。これを補うためにクロック信号Vn4のHigh電位になるタイミングでダイオード接続されたトランジスタT3を介して充電を行い、ノードN2のHigh電位を維持するようにしている。上述のような駆動回路の出力回路において、トランジスタT5のドレイン側の電位変化によるトランジスタT5の充放電の回数を減らすために、より多相のクロックを用い、クロック信号Vnの周波数を低くすることが考えられる。例えば、上述の出力回路910のクロック信号Vnに16相クロックを用いた場合のタイミングチャートを図19に示す。この場合には、クロック信号Vn4の間隔が大きくなるため、ノードN2へ充電を行う機会が減少し、図20に示されるように、ノードN2の電位が維持されない恐れがある。本発明は、上述の事情に鑑みてされたものであり、より多相のクロックを用いた場合であっても、安定した走査信号を出力し、表示品質の高い表示装置を提供することを目的とする。本発明の駆動回路は、複数の走査信号線に対してトランジスタを導通させる電位であるアクティブ電位を順に出力する表示装置の駆動回路であって、前記複数の走査信号線に、それぞれ電気的に接続された複数の出力回路を備え、前記複数の出力回路のうち、一の出力回路は、前記複数の走査信号線のうちの一の走査信号線とクロック信号線との電気的接続を制御する第1トランジスタと、前記第1トランジスタのゲートに接続され、前記走査信号線に前記アクティブ電位が出力される期間を含む期間である第1期間にアクティブ電位となる第1ノードと、トランジスタを導通させない電位である非アクティブ電位を保持する非アクティブ信号線と前記第1ノードとを、前記第1期間以外の期間である第2期間において電気的に接続するように制御する第2トランジスタと、前記第2トランジスタのゲートに接続された第2ノードと、を有し、前記第2ノードは、アクティブ電位を保持するための2種類の充電のタイミングを有している、ことを特徴とする駆動回路である。また、本発明の駆動回路において、前記一の出力回路には、前記第2ノードをアクティブ電位を保持するために、整流作用のある素子を介して接続される第1充電線と、整流作用のある素子を介して接続される第2充電線と、が共に接続されていてもよい。また、本発明の駆動回路において、前記第1充電線及び前記第2充電線のいずれか一方には、前記複数の出力回路に入力される同一周期の複数のクロック信号のうち、一のクロック信号が入力され、いずれか他方には、前記複数の出力回路のうち他の出力回路の一の走査信号線が接続されていてもよい。また、本発明の駆動回路において、前記一のクロック信号は、前記複数の出力回路に入力される同一周期の複数のクロック信号のうち、前記第1トランジスタに接続された前記クロック信号線に入力されるクロック信号がアクティブ電圧となるタイミングの前2分の1周期の間にアクティブ電圧となるクロック信号とすることができる。ここで2分の1周期の周期はクロック信号の周期を意味している。また、本発明の駆動回路において、前記他の出力回路の一の走査信号線は、前記一の出力回路の走査信号線への出力後に順に出力される出力のうち、直後の3出力のうちのいずれか一の出力としてもよい。また、本発明の駆動回路において、前記第1充電線及び前記第2充電線には、前記複数の出力回路に入力される同一周期の複数のクロック信号のうち、2つの異なるクロック信号が入力されることとしてもよい。本発明の表示装置は、画面に複数の画素を有する表示装置であって、上述した駆動回路のうちいずれかの駆動回路と、前記複数の画素のそれぞれに配置され、階調値に基づく電圧を前記複数の画素の各々に保持するための画素トランジスタと、を備え、前記駆動回路の走査信号線は、前記画面の一行分の前記画素の前記画素トランジスタのゲートに接続されている、ことを特徴とする表示装置である。以下、本発明の第1~第4実施形態について、図面を参照しつつ説明する。なお、図面において、同一又は同等の要素には同一の符号を付し、重複する説明を省略する。[第1実施形態]図1には、本発明の一実施形態に係る表示装置100が概略的に示されている。この図に示されるように、表示装置100は、上フレーム110及び下フレーム120に挟まれるように固定された表示パネル200等から構成されている。なお、本実施形態では、表示パネル200は液晶表示パネルであることとする。図2には、図1の表示パネル200の構成が示されている。表示パネル200は、TFTThinFilmTransistor:薄膜トランジスタ基板220とカラーフィルタ基板230の2枚の基板を有し、これらの基板の間には液晶組成物が封止されている。TFT基板220は、表示領域202の両側に配置され、走査信号線G1~G480に対して順に所定の電圧を印加する駆動回路210と、表示領域202において走査信号線G1~G480に垂直に交差するように延びる不図示の複数のデータ信号線に対して画素の階調値に対応する電圧を印加すると共に、駆動回路210を制御する駆動ICIntegratedCircuit260とを有している。また、駆動回路210は、走査信号線Gnn=1~480にそれぞれ接続された出力回路310を有している。表示領域202の一方の側の出力回路310は、奇数番号の走査信号線Gnn:奇数を制御し、他方の側の出力回路310は、偶数番号の走査信号線Gnn:偶数を制御している。図3は、出力回路310の回路構成について示す図であり、図4は、図3の出力回路310の動作のタイミングチャートである。出力回路310は、周期が同じでタイミングの異なる16のクロック信号である16相クロック信号で動作し、偶数番目の走査信号線を駆動する駆動回路と奇数番目の走査信号線を駆動する駆動回路が表示領域202の両側にそれぞれ配置されているため、表示領域202の片側に配置された駆動回路210のみについては、実質的に8相クロックで動作している。次に、出力回路310の動作について説明する。ここで、Vnはクロック信号を表し、VGPLの電位はLow電位に固定されている。これらの信号はいずれも出力回路310の外部から入力される。まず、走査信号線Gn-2がHigh電位になると、トランジスタT7のゲートがHigh電位となってトランジスタT7が導通することによりノードN2はVGPLに接続されLow電位となる。また、この走査信号線Gn-2は、ダイオード接続されたトランジスタT1にも入力されているため、これに接続されたノードN1はHigh電位アクティブ電位となり、容量C1に電位差を生じさせると共に、トランジスタT5を導通させる。ノードN1はトランジスタT4のゲート信号にもなっているため、ノードN2はトランジスタT4によってもVGPLと接続されLow電位にされる。次に、クロック信号VnがHigh電位になると、トランジスタT5が導通していることから容量C1の一方の電極の電位がHigh電位となり、いわゆるブートストラップにより他方の電極側であるトランジスタT5のゲート電位はより押し上げられる。これにより、走査信号線GnのHigh電位は確定される。走査信号線GnがHigh電位である書込み期間に、不図示のデータ信号線に各画素の階調値に基づくデータ信号電圧が印加され、後述する走査信号線Gnの立ち下がりにより、印加された階調値に基づく電圧が画素に保持される。クロック信号VnがLow電位となると、走査信号線GnもLow電位となるが、これを確定させるため、High電位になるクロック信号Vn4をダイオード接続されたトランジスタT3に入力し、ノードN2をHigh電位にし、High電位となったノードN2がゲートに接続されたトランジスタT6は、走査信号線GnとVGPLとを導通させ、走査信号線GnをLow電位としている。一方、2水平駆動期間後にHigh電位になった走査信号線Gn4をトランジスタT9のゲートに入力して、ノードN1とVGPLとを導通させ、ノードN1をLow電位としている。ここで、本実施形態においては、出力回路310は、整流素子として作用するダイオード接続されたトランジスタT3を介してノードN2に接続され、クロック信号Vn4が印加される第1充電線361と、ダイオード接続されたトランジスタT3Aを介してノードN2に接続され、クロック信号Vn12が印加される第2充電線362とを有している。したがって、図5に示されるように、クロック信号Vn4に加えてクロック信号Vn4がLow電位である期間にHigh電位となるクロック信号Vn12を用いて充電しているため、ノードN2のHigh電位を維持することができ、駆動回路はより安定的な走査信号を出力することができ、表示装置の表示品質を高めることができる。ここで、第2充電線362に印加されるクロック信号は、クロック信号Vn12としたが、クロック信号VnがHigh電位アクティブ電位となる前2分の1周期の期間にアクティブ電位となるクロック信号であればよい。[第2実施形態]本発明の第2実施形態について説明する。第2実施形態に係る表示装置の構成は、第1実施形態の図1及び図2に示される構成と同様であるため、重複する説明を省略する。図6には、第2実施形態の表示装置に係る出力回路320の構成が示されている。第1実施形態における出力回路310と異なる点は、トランジスタT3に入力される信号が、クロック信号Vn4ではなく、走査信号線Gn4の出力を入力している点である。図7には、図6の出力回路を用いた動作のタイミングの詳細が概略的に示されている。トランジスタT5を導通させないためのノードN2のHigh電位は、クロック信号VnがHigh電位となるときに維持されていればよいため、図7で示されるように、基本的に第2充電線362に入力されるクロック信号Vn12におけるタイミングにおける充電があればよい。しかしながら、走査信号線Gnへ出力を行った後のタイミングでは、ノードN2をLow電位に下げる必要があるため、第1充電線361には、一垂直同期期間に一回High電位となる走査信号線Gn4の出力が印加されている。これにより、クロック信号Vn12以外のタイミングでノードN2への充電がほとんどなくなることから、例えばトランジスタT2及びT6への負荷が減り、閾値のシフト等の発生を抑制することができると共に、クロック信号VnがHigh電位となるときにノードN2のHigh電位を維持することができるため、駆動回路はより安定的な走査信号を出力することができ、表示装置の表示品質を高めることができる。[第3実施形態]本発明の第3実施形態について説明する。第3実施形態に係る表示装置の構成は、第1実施形態の図1及び図2に示される構成と同様であるため、重複する説明を省略する。図8には、第3実施形態の表示装置に係る出力回路330の構成が示されている。第2実施形態における出力回路320と異なる点は、第1充電線361及びトランジスタT9のゲートに入力される信号が、走査信号線Gn4の出力ではなく、走査信号線Gn3の出力となっている点である。図9には、図8の回路を用いた動作のタイミングが概略的に示されている。第2実施形態と同様に、第1充電線361には、一垂直同期期間に一回High電位となる走査信号線Gn3の出力が印加されているが、走査信号線Gn3は、走査信号線Gn4より一つ早いタイミングでHigh電位となるため、図9に示されるように、より早くノードN2をHigh電位に上げる、つまりノードN1をLow電位に下げることができる。これにより、走査信号線Gnに出力に直接関わるトランジスタT5のゲート電圧が高い期間を減らすことができ、トランジスタT5の閾値のシフトを抑制することができると共に、クロック信号Vn12以外のタイミングでノードN2への充電がほとんどなくなることからトランジスタT2及びT6への負荷も減り、これらのトランジスタについても閾値のシフト等の発生を抑制することができる。また、クロック信号VnがHigh電位となるときにノードN2のHigh電位を維持することができるため、駆動回路はより安定的な走査信号を出力することができ、表示装置の表示品質を高めることができる。ここで、第1充電線361に印加される走査信号線の出力は、走査信号線Gn3の出力としたが、走査信号線Gnの出力直後の他の走査信号線の3出力のうちのいずれか一の出力であればよい。[第4実施形態]第4実施形態に係る表示装置の構成は、第1実施形態の図1及び図2に示される構成と同様であるため、重複する説明を省略する。図10には、第4実施形態の表示装置に係る出力回路410の構成が示されている。また、図11には、出力回路410を用いた場合の動作のタイミングチャートが示されている。第1実施形態における出力回路310と異なる点は、ダイオード接続されたトランジスタT3Aを用いておらず、トランジスタT3には、8相のクロック信号Vm2を入力している点である。このようにした場合であっても、図12に示されるように、ノードN2のHigh電位を維持することができるため、駆動回路はより安定的な走査信号を出力することができ、表示装置の表示品質を高めることができる。図13には、出力回路410の変形例である出力回路420が示されており、図14には出力回路420の動作のタイミングチャートが示されている。出力回路410と異なる点は、ダイオード接続されたトランジスタT3に入力される8相のクロック信号がクロック信号Vm2のタイミングとは異なるクロック信号Vmである点と、トランジスタT9のゲートに入力される信号が走査信号線Gn3への出力信号である点である。このような構成にした場合には、図15に示されるように、より早くノードN1のHigh電位を下げることができ、走査信号線Gnに出力に直接関わるトランジスタT5のゲート電圧が高い期間を減らすことができ、トランジスタT5の閾値のシフトを抑制することができる。また、ノードN2のHigh電位を維持することができるため、駆動回路はより安定的な走査信号を出力することができ、表示装置の表示品質を高めることができる。また、上述の各実施形態の表示装置においては、8相又は16相のクロック信号を用いることとしたが、これら以外のクロック信号も用いることができる。また、上述の各実施形態の液晶表示装置は、液晶表示装置に限らず、有機EL表示装置、電界放出ディスプレイ装置FED及び駆動回路としてシフトレジスタを用いるその他の表示装置に用いることができる。