"第1方向に延長された複数のゲートラインと、第2方向に延長された複数のデータラインと、第1電極が前記ゲートラインに連結され第2電極が前記データラインに連結されるスイッチング素子と、前記スイッチング素子の第3電極に連結された画素電極とを有する液晶パネルと、前記ゲートラインの第1端部に連結され前記複数のゲートラインに順次にゲート駆動信号を印加するためのゲート駆動部と、前記データラインに連結され前記データラインにデータ駆動信号を印加するためのデータ駆動部と、次のゲートラインに印加される第1ゲート駆動信号に応答して現在ゲートラインに印加される第2ゲート駆動信号を放電させるための放電部と、を含むことを特徴とする液晶表示装置。前記放電部は、第1電極が前記現在ゲートラインに連結され、第2電極が放電電圧入力端子に連結され、前記第1ゲート駆動信号によって駆動され前記第2ゲート駆動信号を前記放電電圧に放電させるトランジスタからなることを特徴とする請求項1記載の液晶表示装置。前記ゲート駆動部は、第1クロック、及び前記第1クロックと反対の位相を有する第2クロックの提供を受け、前記第1及び第2クロックは第1区間の間、前記ゲート駆動信号のレベルを決定し、第2区間の間、前記第1及び第2クロックの充電または放電させることを特徴とする請求項1記載の液晶表示装置。前記第1クロックは前記第1区間で第1電源電圧Vonを保持し、前記第2区間で第1極性を有し、前記第2クロックは前記第1区間で前記第1電源電圧Vonと極性が反転した第2電源電圧Voffを保持し、前記第2区間で前記第1極性と極性が反転した第2極性を有し、第1クロック及び第2クロックは、傾きを有することを特徴とする請求項3記載の液晶表示装置。第1方向に延長された複数のゲートラインと、前記第1方向と直交する第2方向に延長された複数のデータラインと、第1電極が前記ゲートラインに連結され第2電極が前記データラインに連結されるスイッチング素子と、前記スイッチング素子の第3電極に連結された画素電極とを有する液晶パネルと、前記ゲートラインの第1端部に連結され前記ゲートラインに順次にゲート駆動信号を印加するための第1ゲート駆動部と、前記第1ゲート駆動部の誤動作の際駆動され、前記ゲートラインの第2端部に連結され前記ゲートラインに順次に前記ゲート駆動信号を印加するための第2ゲート駆動部と、前記データラインに連結され前記データラインにデータ信号を印加するためのデータ駆動部と、前記第1ゲート駆動部の動作の際次のゲートラインに印加される第1ゲート駆動信号に応答して現在のゲートラインに印加された第2ゲート駆動信号を放電させるための第1放電部と、前記第2ゲート駆動部の動作の際前記第2ゲート駆動信号によって駆動され前記第2ゲート駆動信号を放電させるための第2放電部と、を含むことを特徴とする液晶表示装置。前記第1ゲート駆動部に連結された外部連結端子をさらに含み、前記外部連結端子は開示信号が入力される第1入力端子と、第1クロックが入力される第2入力端子と、第1クロックと同位相における極性が反転された第2クロックが入力される第3入力端子と、第1電源電圧が入力される第4入力端子と、第2電源電圧が入力される第5入力端子と、で構成されることを特徴とする請求項5記載の液晶表示装置。前記第1及び第2クロックは、第1区間の間前記ゲート駆動信号のレベルを決定し、第2区間の間前記第1及び第2クロックの充電または放電させることを特徴とする請求項6記載の液晶表示装置。前記第2ゲート駆動部に連結された外部連結端子をさらに含み、前記外部連結端子は開始信号が入力される第1入力端子と、第1クロックと第1電源電圧が選択的に印加される第2入力端子と、第1クロックと反転の位相を有する第2クロックと第2電源電圧が選択的に印加される第3入力端子と、第1電源電圧と第2電源電圧が選択的に印加される第4入力端子と、第2電源電圧が入力される第5入力端子と、で構成されることを特徴とする請求項5記載液晶表示装置。前記第1及び第2クロックは、前記ゲート駆動信号のレベルを決定する第1区間と、前記第1及び第2クロックが充電または放電される第2区間と、で区分されることを特徴とする請求項8記載の液晶表示装置。前記第1放電部は、第1電極が前記現在のゲートラインに連結され第2電極が放電電圧入力端子に連結され、前記第1ゲート駆動信号によって駆動され前記第2ゲート駆動信号を前記放電電圧に放電させる第1トランジスタからなることを特徴とする請求項5記載の液晶表示装置。前記第2放電部は、第1電極が前記現在のゲートラインに連結され、第2電極が放電電圧入力端子に連結され、前記第1ゲート駆動信号によって駆動され前記第2ゲート駆動信号を前記放電電圧に放電させる第2トランジスタからなることを特徴とする請求項5記載の液晶表示装置。従って、本発明の目的は、上記課題を解決することができる液晶表示装置を提供することにある。第1方向に延長された複数のゲートラインと、第2方向に延長された複数のデータラインと、第1電極が前記ゲートラインに連結され第2電極が前記データラインに連結されるスイッチング素子と、前記スイッチング素子の第3電極に連結された画素電極とを有する液晶パネルと、前記ゲートラインの第1端部に連結され前記複数のゲートラインに順次にゲート駆動信号を印加するためのゲート駆動部と、前記データラインに連結され前記データラインにデータ駆動信号を印加するためのデータ駆動部と、次のゲートラインに印加される第1ゲート駆動信号に応答して現在ゲートラインに印加される第2ゲート駆動信号を放電させるための放電部と、を含むことを特徴とする液晶表示装置を提供する。ここで、前記放電部は、第1電極が前記現在ゲートラインに連結され、第2電極が放電電圧入力端子に連結され、前記第1ゲート駆動信号によって駆動され前記第2ゲート駆動信号を前記放電電圧に放電させるトランジスタからなることを特徴とする。ここで、前記ゲート駆動部は、第1クロック、及び前記第1クロックと反対の位相を有する第2クロックの提供を受け、前記第1及び第2クロックは第1区間の間、前記ゲート駆動信号のレベルを決定し、第2区間の間、前記第1及び第2クロックの充電または放電させることを特徴とする。ここで、前記第1クロックは前記第1区間で第1電源電圧Vonを保持し、前記第2区間で第1極性を有し、前記第2クロックは前記第1区間で前記第1電源電圧Vonと極性が反転した第2電源電圧Voffを保持し、前記第2区間で前記第1極性と極性が反転した第2極性を有し、第1クロック及び第2クロックは、傾きを有することを特徴とする。第1方向に延長された複数のゲートラインと、前記第1方向と直交する第2方向に延長された複数のデータラインと、第1電極が前記ゲートラインに連結され第2電極が前記データラインに連結されるスイッチング素子と、前記スイッチング素子の第3電極に連結された画素電極とを有する液晶パネルと、前記ゲートラインの第1端部に連結され前記ゲートラインに順次にゲート駆動信号を印加するための第1ゲート駆動部と、前記第1ゲート駆動部の誤動作の際駆動され、前記ゲートラインの第2端部に連結され前記ゲートラインに順次に前記ゲート駆動信号を印加するための第2ゲート駆動部と、前記データラインに連結され前記データラインにデータ信号を印加するためのデータ駆動部と、前記第1ゲート駆動部の動作の際次のゲートラインに印加される第1ゲート駆動信号に応答して現在のゲートラインに印加された第2ゲート駆動信号を放電させるための第1放電部と、前記第2ゲート駆動部の動作の際前記第2ゲート駆動信号によって駆動され前記第2ゲート駆動信号を放電させるための第2放電部と、を含むことを特徴とする液晶表示装置を提供する。ここで、前記第1ゲート駆動部に連結された外部連結端子をさらに含み、前記外部連結端子は開示信号が入力される第1入力端子と、第1クロックが入力される第2入力端子と、第1クロックと同位相における極性が反転された第2クロックが入力される第3入力端子と、第1電源電圧が入力される第4入力端子と、第2電源電圧が入力される第5入力端子と、で構成されることを特徴とする。ここで、前記第1及び第2クロックは、第1区間の間前記ゲート駆動信号のレベルを決定し、第2区間の間前記第1及び第2クロックの充電または放電させることを特徴とする。ここで、前記第2ゲート駆動部に連結された外部連結端子をさらに含み、前記外部連結端子は開始信号が入力される第1入力端子と、第1クロックと第1電源電圧が選択的に印加される第2入力端子と、第1クロックと反転の位相を有する第2クロックと第2電源電圧が選択的に印加される第3入力端子と、第1電源電圧と第2電源電圧が選択的に印加される第4入力端子と、第2電源電圧が入力される第5入力端子と、で構成されることを特徴とする。ここで、前記第1及び第2クロックは、前記ゲート駆動信号のレベルを決定する第1区間と、前記第1及び第2クロックが充電または放電される第2区間と、で区分されることを特徴とする。ここで、前記第1放電部は、第1電極が前記現在のゲートラインに連結され第2電極が放電電圧入力端子に連結され、前記第1ゲート駆動信号によって駆動され前記第2ゲート駆動信号を前記放電電圧に放電させる第1トランジスタからなることを特徴とする。ここで、前記第2放電部は、第1電極が前記現在のゲートラインに連結され、第2電極が放電電圧入力端子に連結され、前記第1ゲート駆動信号によって駆動され前記第2ゲート駆動信号を前記放電電圧に放電させる第2トランジスタからなることを特徴とする。また、ゲートラインの一端に放電トランジスタを形成し、次のステージが動作される以前に現在のステージを放電させることで液晶表示装置のゲート駆動信号の遅延を防止することができる。また、ゲートラインの一端には第1ゲート駆動部が配置されゲートの他端には第1ゲート駆動部が誤動作を起こすとき動作されゲートラインを駆動する第2ゲート駆動部を配置することによって液晶表示装置が正常的に駆動することができる。以下、図面を参照して本発明の望ましい一実施形態をより詳細に説明する。図1は本発明の一実施形態による液晶表示装置を示すブロック図である。図1に示すように、液晶表示装置400はゲート駆動部110とデータ駆動部120が形成された液晶パネル100、外部から信号に応答して液晶パネル100を制御するタイミング制御部200、及びゲート駆動部110に提供される第1及び第2クロックCKV、CKVBを発生するクロック発生部300を含む。タイミング制御部200は各種タイミング信号を発生してゲート駆動部110とデータ駆動部120を制御する。即ち、外部から提供される水平同期信号であるHsyncHorizontalsynchronizer信号に同期されデータ駆動部で画像データ信号をアナログ値に変換してアナログ値であるデータ信号をデータラインに印加することを命令する水平開始信号であるSTHstartHorizontal信号をデータ駆動部に出力する。また、垂直同期信号であるVsyncVerticalsynchronizer信号に同期され第1垂直開始信号であるSTVStartvertical信号をクロック発生部に出力する。タイミング制御部200は、ゲート駆動信号の周期を決定するゲートクロック信号であるCPVClockPulseVertical信号、ゲート駆動信号をイネーブルさせるゲートオンイネーブル信号であるOEOutputEnable信号、第1及び第2クロックの充放電を制御する充放電制御信号であるCHC信号をクロック発生部に出力する。一方、液晶パネル100は第1方向に延長された複数のゲートラインG1~Gn、第1方向と直交する第2方向に延長された複数のデータラインD1~Dm、ゲートラインとデータラインD1~Dmに連結されたTFT130、及びTFT130に連結された画素データ140で構成される。また、液晶パネル100にはゲートラインG1~Gnに順次に駆動信号を印加するためのゲート駆動部110と、データラインD1~Dmにデータ信号を印加するためのデータ駆動部120が具備される。具体的に、液晶パネルは、TFT基板、カラーフィルター基板、TFT基板とカラーフィルター基板との間に形成された液晶層で構成され、ゲートラインG1~Gn、データラインD1~Dm、TFT130及び画素電極140はTFT基板上に形成される。データ駆動部120はSTH信号に応答して液晶パネル100の各画素に印加されるデータ信号を生成する。ここで、データ信号は各画素を充電させるための充電電圧である。ゲート駆動部110は複数のステージが従属的に連結された一つのシフトレジストからなり、各ゲートラインは各ステージの出力端子と結合される。従って、各ステージが順次に駆動されながらゲートラインG1~Gnに順次にゲート駆動信号を出力する。即ち、ゲート駆動部110は、第1垂直開始信号STVと反対の位相を有する第2垂直開始信号STVB信号に応答してゲートラインG1~Gnに順次にハイレベル区間を有するゲート駆動信号を印加してデータ信号が各画素に印加されることを制御する。ここで、ゲート信号はゲートラインG1~Gnに連結されているTFT130を駆動するのに十分な電圧レベルを有する。TFT130がゲート信号によって駆動されると、データ信号はTFT130を通じて画素電極140に印加され液晶層を充電させる。クロック発生部300はタイミング制御部200から提供されるCPV信号及びOE信号に応答して互いに反転された位相を有する第1及び第2クロックCKV、CKVBを出力する。ここで、第1クロックCKVはゲート駆動部110の奇数番目のステージに提供され、第2クロックCKVBはゲート駆動部110の偶数番目のステージに提供される。このようなクロック発生部300は、CPV信号、イネーブルOE信号及び第1垂直開始信号であるSTV信号に応答して第1及び第2クロックCKV、CKVBがゲート駆動信号を決定する一定電圧を有するように発生させる第1及び第2電圧印加回路と、ゲートクロック信号であるCPV信号と充放電信号であるCHC信号に応答して第1及び第2クロックが互いに充放電することができるように制御する充放電回路と、を含む。また、クロック発生部300は、第1垂直開始信号であるSTV信号をゲート駆動部110からゲートラインG1~Gnに順次に印加するために、順次にゲート駆動信号を出力することを命令する第2垂直開始信号であるSTVB信号をゲート駆動部110に出力する。従って、第1クロックCKVと第2クロックCKVBは第1区間では一定電圧を保持し、第2区間では互いに充放電する。これにより、第1及び第2クロックによってゲート駆動信号のパルス幅が減少され高速動作を可能にする。また、このような構造は第1及び第2クロックを発生させるためにクロック発生部300に提供される別途の制御信号を使用せず、既存のタイミング制御部200から出力されるCPV信号とOE信号をそのまま使用することができる。図2は図1に示されたクロック発生部のブロック図であり、図3は図2に示された入力信号のタイミング図である。図2に示すように、クロック発生部300は、第1クロックイネーブル信号であるOCSOddClockPulse信号と第2クロックイネーブル信号であるECSEvenClockPulse信号を出力するためのD-フリップフロップ310、OCS信号に応答して第1クロックCKVを出力するための第1電圧印加回路320、ECS信号に応答して第2クロックCKVBを出力するための第2電圧印加回路330、及び第1クロックCKV及び第2クロックCKVBを互いに充放電充電共有させるための充放電回路340を含む。具体的に、D-フリップフロップ310はSTV信号の入力を受け、OE信号に同期し、第1端QBを通じてECS信号を出力し第2端Qを通じてOCS信号を出力する。ここで、OE信号はゲート波形の遅延現象分だけゲート駆動部110の出力を抑制させる役割を遂行する。即ち、OE信号はゲート波形が遅延される時間の間ハイ状態を有し発生される1H周期のパルスである。第1電圧印加回路320は、ゲートクロック信号であるCPV信号、イネーブル信号であるOE信号及びOCS信号に応答して第1区間の間一定電圧を保持する第1クロックイネーブル信号であるCKVを出力する。また、第2電圧印加回路330は、CPV信号、OE信号及びECS信号に応答して第1区間の間一定電圧を保持する第2クロックCKVBを出力する。充放電回路340はCPV信号の入力を受け、第1及び第2電圧印加回路のターンオフの際、駆動され第1及び第2クロックCKV、CKVBを充放電させる。図3に示されたように、CPV信号は1H周期に発生され、OE信号がゲート波形遅延時間の間一定デューティ期間のハイ状態を有するように1H周期に発生される。このとき、CPV信号がハイ状態でありOE信号のロー状態のとき定義される第3区間t3では第1及び第2電圧印加回路320、330が駆動され、CPV信号がロー状態であり、OE信号がロー状態であるかハイ状態であるとき定義される第4区間t4では充放電回路340が駆動される。第3及び第4区間t3、t4の間には第1及び第2電圧印加回路320、330と充放電回路340が全部駆動されない第5区間t5が備えられる。即ち、第5区間t5はCPV信号がロー状態でありOE信号がロー状態である区間として定義され、充放電回路340の駆動時間を遅延させ形成される第4区間t4の前段に定義される。充放電回路340の駆動時間の遅延については以後充放電回路340の回路図を説明するとき詳細に見てみる。以下、図面を参照してクロック発生部300の内部を構成回路について具体的に説明する。図4は図2に示されたD-フリップフロップの回路図であり、図5は図4に示されたD-フリップフロップのタイミング図である。図4及び図5に示すように、第1垂直開始信号STVと反転の位相を有する第2垂直開始信号STVB信号に応答してD-フリップフロップ310がクリアーされ、D-フリップフロップ310の第1端子QBから出力される第2クロックイネーブル信号ECSはハイレベルになる。即ち、D-フリップフロップ310は、第1垂直開始信号であるSTV信号を受信し、クロック端子CLKに入力されるOE信号に同期して2Hを1周期にとして第1クロックイネーブル信号OCS及び第2クロックイネーブル信号ECSををそれぞれ出力する。このとき、第1クロックイネーブル信号OCSは、ゲート駆動部の奇数番目のステージに提供される第1クロックCKVを出力する第1電圧印加回路320をイネーブルさせる。また、第1クロックイネーブル信号ECSは、ゲート駆動部の偶数番目のステージに提供される第2クロックCKVBを出力する第2電圧印加回路330をイネーブルさせる。図6ではCPV、OE及びOCSによって第1クロックCKVを発生する第1電圧印加回路320を説明し、図6では、CPV、OE及びECSによって第2クロックCKVBを発生する第2電圧印加回路330を説明する。図6は図2に示された第1電圧印加回路の回路図であり、図7は図2に示された第2電圧印加回路の回路図である。図6に示すように、第1電圧印加回路320は、ハイレベルの前記OCS信号に応答して前記第1クロックCKVに第1電源電圧Vonを出力するための第1電源電圧供給部321と、ローレベルのOCS信号に応答して前記第1クロックCKVに第2電源電圧Voffを出力するための第2電源電圧供給部323を含む。第1電源電圧供給部321はオン電圧発生部321aとオン電圧発生部321aの駆動を制御する第1制御部321bで構成される。第1制御部321bは、第トランジスタT1、第トランジスタT2、第1抵抗R1及び第2抵抗R2で構成される。具体的に、第1トランジスタT1はエミッター端がOE信号入力端子に連結されコレクタ端が第2トランジスタT2のエミッター端に連結される。第1抵抗R1は第1トランジスタT1のベース端とOCS信号入力端子との間に連結される。また、第2トランジスタT2はコレクタ端がオン電圧発生部321aに連結される。第2抵抗R2は第2トランジスタT2のベース端とCPV信号入力端子との間に連結される。従って、第1トランジスタT1はOCS信号とOE信号との電圧差によって動作され、第2トランジスタT2は第1トランジスタT1が駆動されることによって印加されるOE信号とCPV信号との電圧差によって駆動されることでオン電圧発生部321aの動作を制御する。一方、オン電圧発生部321aは第3トランジスタT3、第3ないし第5抵抗R3~R5からなる。具体的に、第3トランジスタT3はエミッター端が第1電源電圧に連結され、コレクタ端が出力端CKVに連結される。また、第3抵抗R3は第3トランジスタT3のエミッター端と第3トランジスタT3のベース端との間に連結され、第4及び第5抵抗R4、R5は第3トランジスタT3のベース端と第2トランジスタT2のコレクタ端との間で直列連結される。従って、第3トランジスタT3は、第1クロック信号CKVを出力する。第2電源電圧供給部323はオフ電圧発生部323aと、オフ電圧発生部323aを制御する第2制御部323bを有する。第2制御部323bは第4及び第5トランジスタT4、T5、第6ないし第11抵抗R6~R11で構成される。具体的に、第4トランジスタT4はエミッター端がCPV信号入力端子に連結されコレクタ端が第5トランジスタT5に連結される。また、第6抵抗R6は第4トランジスタT4のエミッター端とベース端との間に連結され、第7及び第8抵抗R7、R8は第4トランジスタT4のベース端とOE信号入力端子との間に直列連結される。一方、第5トランジスタT5はコレクタ端がオフ電圧発生部323aに連結される。第9抵抗R9は第5トランジスタT5のエミッター端とベース端との間に連結され、第10及び第11抵抗R10、R11は第5トランジスタT5のベース端とOCS信号入力端子との間で直列連結される。第4トランジスタT4は、CPV信号とOE信号の電圧差によって駆動されCPV信号を出力し出力された信号とOCS信号の電圧差によって第5トランジスタT5が駆動されCPV信号を出力する。このとき、出力されたCPV信号がオフ電圧発生部323aに提供される。一方、オフ電圧発生部323aは第6トランジスタT6、第12ないし第14抵抗R12~R14からなる。具体的に、第6トランジスタT6はエミッター端が第2電源電圧に連結されコレクタ端が出力端CKVに連結される。また、第12抵抗R12は第5トランジスタT5のエミッター端と第13及び第14抵抗R13、R14の第1端に並列連結され、第13抵抗R13の第2端は第6トランジスタT6のエミッター端に連結され第14抵抗R14の第2端は第6トランジスタT6のベース端に連結さされる。従って、第6トランジスタT6が第2制御部323bから出力されるCPV信号によって駆動されると出力端CKVには第2電源電圧が出力される。図6に提示された第1ないし第6トランジスタT1~T6はバイポーラ接合電界トランジスタBipolarJunctionTransistor;BJTであることが望ましい。図7に示すように、第2電圧印加回路330はECS信号のハイ区間に応答して前記第2クロックCKVBに第1電源電圧を出力するための第1電源電圧供給部331とECS信号のロー区間に応答して前記第2クロックCKVBに第2電源電圧Voffを出力するための第2電源電圧供給部333を含む。第1電源電圧供給部331はオン電圧発生部331aとオン電圧発生部331aの駆動を制御する第1制御部331bで構成される。第1制御部331bは第1及び第2トランジスタT1、T2、第1及び第2抵抗R1、R2で構成される。具体的に、第1トランジスタT1はエミッター端がOE信号入力端子に連結されコレクタ端が第2トランジスタT2に連結される。第1抵抗R1は第1トランジスタT1のベース端とECS信号入力端子との間に連結される。また、第2トランジスタT2はエミッター端が第1トランジスタT1に連結され、コレクタ端がオン電圧発生部331aに連結され、第2抵抗R2は第2トランジスタT2のベース端とCPV信号入力端子との間に連結される。従って、第1トランジスタT1はECS信号とOE信号との電圧差によって動作され、第2トランジスタT2は第1トランジスタT1が駆動されることによって印加されるOE信号とCPV信号との電圧差によって駆動されることでオン電圧発生部331aの動作を制御する。一方、オン電圧発生部331aは第3トランジスタT3、第3ないし第5抵抗R3~R5からなる。具体的に、第3トランジスタT3はエミッター端が第1電源電圧によって連結され、コレクタ端が出力端CKVBに連結される。また、第3抵抗R3は第3トランジスタT3のエミッター端とベース端との間に連結され、第4及び第5抵抗R4、R5は第3トランジスタT3のベース端と第2トランジスタT2のコレクタ端との間で直列連結される。従って、第3トランジスタT3は第2クロック信号CKVBを端子に出力する。第2電源電圧供給部333はオフ電圧発生部333aと、オフ電圧発生部333aを制御する第2制御部333bを有する。第2制御部333bは第4及び第5トランジスタT4、T5、第6ないし第11抵抗R6~R11からなる。具体的に、第4トランジスタT4はエミッター端がCPV信号入力端子に連結されコレクタ端が第5トランジスタT5のエミッター端に連結される。また、第6抵抗R6の第4トランジスタT4のエミッター端とベース端との間に連結され、第7及び第8抵抗R7、R8は第4トランジスタT4のベース端とOE信号入力端子との間で直列連結される。一方、第5トランジスタT5はコレクタ端がオフ電圧発生部333aに連結される。第9抵抗R9は第5トランジスタT5のエミッター端とベース端との間に連結され、第10及び第11抵抗R10、R11は第5トランジスタT5のベース端とECS信号入力端子との間で直列連結される。第4トランジスタT4は、ゲートクロック信号CPVとイネーブル信号OEとの電圧差に応答してゲートクロック信号CPV信号を出力する。また、第5トランジスタT5は、第4トランジスタT4から出力されたゲートクロック信号CPVと第2クロックイネーブル信号ECSとの電圧差に応答してCPV信号を出力する。このとき、第5トランジスタT5から出力されたCPV信号はオフ電圧発生部333aに提供される。一方、オフ電圧発生部333aは第6トランジスタT6、第12ないし第14抵抗R12~R14からなる。具体的に、第6トランジスタT6はエミッター端が第2電源電圧に連結されコレクタ端が出力端CKVBに連結される。第12抵抗R12は第5トランジスタT5のエミッター端と第13及び第14抵抗R13、R14の第1端に並列連結され、第13抵抗R13の第2端は第6トランジスタT6のエミッター端に連結され第14抵抗R14の第2端は第6トランジスタT6のベース端に連結される。従って、第6トランジスタT6が第2制御部333bに出力されるCPV信号によってターンオンされると出力端CKVBには第2電源電圧が出力される。図7に提示された第1ないし第6トランジスタT1~T6はBJTであることが望ましい。図8は図2に示された充放電回路を示す回路図である。図8に示すように、充放電回路340は第1及び第2クロックCKV、CKVBを充電放電させる充電部341、充電部材341を駆動する充電駆動部342、充電駆動部342を制御する充電制御部343を有する。充電制御部343は第1ないし第3トランジスタT1~T3、第1ないし第10抵抗R1~R10からなる。具体的に、第1トランジスタT1はエミッター端がCPV信号入力端子に連結されコレクタ端は第4抵抗R4の第1端に連結される。第1抵抗R1は第1トランジスタT1のエミッター端とベース端との間に連結され、第2及び第3抵抗R2、R3は第1トランジスタT1のベース端とグランド電圧入力端子Voとの間で直列連結される。また、第4抵抗R4は第2トランジスタT2のベース端に連結された第5抵抗R5と第2トランジスタT2のエミッター端に連結された第6抵抗R6に並列連結される。第3トランジスタT3はエミッター端が第1電源電圧入力端子Vonに連結され、コレクタ端が第10抵抗R10を経由して第2トランジスタT2のコレクタ端に連結される。第7抵抗R7は第3トランジスタT3のエミッター端とベース端との間に連結され、第8及び第9抵抗R8、R9は第3トランジスタT3のベース端とCPV信号入力端子との間に直列連結される。充電駆動部342は第4及び第5トランジスタT4、T5、第11ないし第14抵抗R11~R14からなる。具体的に、第4トランジスタT4はエミッター端が第2クロック端子CKVBに連結されコレクタ端が第12抵抗R12を経て第1クロック端子CKVに連結される。第11抵抗R11は第4トランジスタT4のベース端と充放電制御信号CHC入力端子との間に連結される。また、第5トランジスタT5はエミッター端が第12抵抗R12に連結されコレクタ端が第13抵抗R13を経て第1クロック端子CKVに連結される。第14抵抗R14は第5トランジスタT5のベース端と充放電制御信号CHCの入力端子との間に連結される。充電部341は第1クロック端子CKVとグランド電圧入力端子Voとの間に連結された第1キャパシタC1と、第2クロック端子CKVBとグランド電圧入力端子Voとの間に連結された第2キャパシタC2と、で構成される。従って、充放電回路340は第1及び第2電圧印加回路320、330の第3及び第6トランジスタT3、T6がターンオンされた状態でCPV信号がロー状態であるとき駆動される。即ち、CPV信号がロー信号であると第1トランジスタT1がターンオフされそれによって第2トランジスタT2もターンオフされる。このとき、CPV信号と第1電源電圧によってターンオンされた第3トランジスタT3を通じて第1電源電圧は充電駆動部342に印加される。従って、充電駆動部342の第5トランジスタT5は第1電源電圧とCHC信号によってターンオンされ第2キャパシタC2を充電させる。このとき、充電電圧が第2クロック端子CKVBに出力される。一方、第1キャパシタC1は放電動作を遂行することによって放電電圧を第1クロック端子CKVに出力する。一方、第6トランジスタT6はCHC信号によってターンオンされ第1ノードの電位が上昇されながら第1キャパシタC1が充電される。従って、第1クロック端子CKVに充電電圧を出力する。それと同時に第2キャパシタC2が放電され第2クロック端子CKVBに放電電圧を出力する。このように、第1及び第2電圧印加回路320、330がターンオフされた状態でCPV信号がローに発生されると、第1及び第2クロックCKV、CKVBが互いに充放電を共有しながら出力される。このとき、第1及び第2電圧印加回路320、330が動作していない期間に充放電回路340を駆動するためには、充電駆動部342に第1電源電圧が提供される時間を、第3トランジスタT3のコレクタに接続される第10抵抗によって遅延させる必要がある。従って、図3に示された第5区間t5を確保することができ、第1及び第2クロック電源印加回路320、330と充放電回路340とが同時に駆動されることを防止することができる。図9は図2に示されたクロック発生部から出力される第1及び第2クロックをシミュレーションした波形図であり、図10は図1及び図2クロックを出力するのに必要な電流をシミュレーションした波形図である。但し、第1電源電圧は20Vであり、第2電源電圧は-14Vである。図9及び図10に示すように、第1クロックCKVは第1区間t1では第1電源電圧を保持し、第2区間t2では第1極性の傾きを有して出力される。一方、第2クロックCKVBは第1区間t1では第1電源電圧と位相の反転された第2電源電圧を保持し、第2区間t2では第1極性と位相の反対された第2極性の一定傾きを有して出力される。各クロックCKV、CKVBのt1t2=1Hで、t2時間の間、位相が異なる第1及び第2クロックCKV、CKVBを充放電chargesharingするようになる。そして、クロック発生部300では従来の波形でより半分程度の電圧遷移をさせ、クロック発生部300での消費電力を半分以下に減少させることができる。消費電力Pは次の数式1のように表される。電圧遷移が半分程度に減少されるとき、消費電力は数式1のように電圧遷移の二乗に比例するので、クロック発生部300での消費電力が14程度に減少される。即ち、第1及び第2クロックCKV、CKVBを発生するためのクロック発生部300の消費電力が減少される。図11は第1及び第2クロックによる各ステージの出力波形を示す波形図である。図11に示すように、第2クロックの上昇エッジでi番目のステージからi番面のゲート駆動信号が出力される。以後、i1番目のステージから出力されたi1番目のゲート駆動信号が第1電圧V1レベルに至ったときi番目のゲート駆動信号が放電され、第1電圧V1の時間分だけi番目のゲート駆動信号のハイレベル保持時間が減少される。このように、ゲート駆動部110に第1及び第2クロックCKV、CKVBを印加するとゲート駆動信号のパルス幅が調節されることで第1及び第2クロックCKV、CKVBは液晶表示装置400の高速動作を可能にする。図1ないし図11でのクロック発生部300に提供され第1及び第2電圧印加回路320、330と充放電回路340を制御するクロック発生制御信号がCPV信号とOE信号である場合本発明の実施形態として説明した。しかし、クロック発生制御信号はここに限定されず多様な形態に具現されることができる。以後、図12及び図13ではクロック発生制御信号の他の形態を示す図面である。図12及び図13は本発明の他の形態によるクロック発生制御信号を示す波形図である。図12に示すように、クロック発生制御信号は1H周期を有する第1制御信号CT1と1H周期を有し第1制御信号CT1と部分的に反転された位相を有する第2制御信号CT2を含む。ここで、第1及び第2制御信号CT1、CT2は第1及び第2電圧印加回路320,330と充放電回路340の駆動を制御する。具体的に、第1制御信号CT1がハイ状態であり第2制御信号CT2がロー状態のとき定義される第3区間t3では第1及び第2電圧印加回路320,330が駆動される。第1制御信号CT1がロー状態であり第2制御信号CT2がハイ状態のとき定義される第4区間t4では充放電回路340が駆動される。また、第3及び第4区間t3、t4の間に存在し、第1制御信号CT1と第2制御信号CT2が全部ロー状態のとき定義される第5区間t5では第1及び第2電圧印加回路320,330と充放電回路340が全部動作しない。従って、第1及び第2電圧印加回路320,330の動作と充放電回路340の動作が同時に駆動される現象を防止することができる。一方、図13に示されたようにクロック発生回路は1H周期を有する第3制御信号と、1H周期を有し第3制御信号がロー状態のときハイ状態に発生される第4制御信号と、からなることができる。ここで、第3及び第4制御信号CT3、CT4は第1及び第2電圧印加回路と320,330充放電回路340の駆動を制御する。具体的に、第3制御信号CT3がハイ状態であり第4制御信号CT4がロー状態のとき、定義される第3区間t3では第1及び第2電圧印加回路が動作する。また、第3制御信号CT3がロー状態であり第4制御信号CT4がロー状態のとき定義される第4区間t4では充放電回路が動作する。第3区間t3と第4区間t4との間に存在され、第3制御信号CT3がロー状態であり、第4制御信号CT4がハイ状態のとき定義される第5区間t5では第1及び第2電圧印加回路と充放電回路が全部動作しない。従って、第1及び第2電圧印加回路の動作と充放電回路の動作が同時に駆動される現象を防止することができる。図14は本発明の他の実施形態による液晶表示装置を示す概略図であり、図15は図14に示された遅延防止部の概略図である。図16は放電部の電流のシミュレーション結果を示す波形図であり、図17は図14に示された液晶表示装置のゲート駆動信号のシミュレーション結果を示す波形図である。図14に示すように、液晶表示装置500はゲート駆動部110、電極駆動部120及び放電部150が形成された液晶パネル100を含む。液晶パネル100には第1方向に延長された複数のゲートラインG1~Gnと、第1方向と直交する第2方向に延長された複数のデータラインD1~Dmが形成される。前記ゲートラインG1~GnとデータラインD1~Dmによって定義される領域には第1電極131が前記ゲートラインG1~Gnに連結され第2電極132が前記データラインD1~Dmに連結されるTFT130が形成される。TFT130は第1電極131に提供されるゲート駆動信号によって駆動され第2電極132に提供されるデータ信号を画素電極140に出力するスイッチング素子である。ゲート駆動部110はゲートラインG1~Gnの第1端部に連結され前記ゲートラインG1~Gnに順次にゲート駆動信号を印加する。また、データ駆動部120はデータラインD1~Dmに連結されゲート駆動信号が印加されることによってデータラインD1~Dmにデータ信号を印加する。一方、放電部150は第1端部と向き合うゲートラインG1~Gnの第2端部それぞれに連結される。図15に示されたように、放電部150は次のゲートラインGi1に印加される第1ゲート駆動信号によって駆動され現在ゲートラインGiに印加された第2ゲート駆動信号を放電電圧、即ち、第2電源電圧Voffに放電させる。ここで、iは1よりは大きくnよりは小さい自然数である。放電部150は第1電極155aが現在ゲートラインGiに連結され、第2電極155bが第2電源電圧入力端子に連結され、第3電極155cが次のゲートラインGi1に連結された放電トランジスタ155からなる。即ち、第1ゲート駆動信号が放電トランジスタ155のしきい電圧以上に増加されると放電トランジスタ155が駆動され第2ゲート駆動信号を第2電源電圧Voffに放電させる。図16及び図17に示すように、第1ゲート駆動信号が放電トランジスタ155のしきい電圧以上に上昇されると、放電トランジスタ155が駆動されながら第2ゲート駆動信号を第2電源電圧Voffに放電させる。従って、放電トランジスタ155は第1ゲート駆動信号がプルアップされる以前に第2ゲート駆動信号を十分に放電させ第2ゲート駆動信号が遅延される現象を防止することができる。図18は従来のゲート駆動信号をシミュレーションした波形図であり、図19は図14に示された液晶パネルによるゲート駆動信号をシミュレーションした波形図である。図18及び図19では一つのゲートラインに連結された一番目のスイッチング素子に印加される一番目の駆動信号Vfirst、中間部分のスイッチング素子に印加される中間ゲート駆動信号Vcenter、最後のスイッチング素子に印加される最後のゲート駆動信号Vendを示す。図18に示すように、第1、第2及び第3ゲート駆動信号Vfirst、Vcenter、Vendは、‘140μs’付近で完全に放電される。また、各ゲート駆動信号が第2電源電圧Voffに到達する時間もそれぞれ異なることで示された。一方、図19に示すように、第1、第2及び第3ゲート駆動信号Vfirst、Vcenter、Vendそれぞれ印加されるゲート駆動信号は‘136μs’近傍で完全に放電される。即ち、図18に示す従来の第1、第2及び第3ゲート駆動信号Vfirst、Vcenter、Vendと比較すると、本願発明の第1、第2及び第3ゲート駆動信号Vfirst、Vcenter、Vendは、従来より‘4μs’程度ゲート駆動信号の遅延を短縮させることができる。また、ゲート駆動信号が第2電源電圧に到達する時間もそれぞれ一致することでゲート駆動信号の全体的な遅延特性を改善することができる。図20及び図21は本発明の他の実施形態による液晶表示装置を示す概略図である。図20に示すように、液晶表示装置600は第1ゲート駆動部160、第2ゲート駆動部170、データ駆動部120、第1放電部180及び第2放電部190を含む。具体的に、液晶パネル100には第1方向に延長された複数のゲートラインG1~Gnと、第1方向と直交する第2方向に延長された複数のデータラインD1~Dmが形成される。ゲートラインG1~GnとデータラインD1~Dmに定義される領域には第1電極がゲートラインG1~Gnに連結され第2電極がデータラインD1~Dmに連結されるTFT130が形成される。TFT130は第1電極から提供されるゲート駆動信号によって駆動され第2電極を通じて提供されるデータ信号を画素電極140に印加するスイッチング素子である。また、液晶パネル100上にはゲートラインG1~Gnの第1端部に連結されゲートラインG1~Gnに順次にゲート駆動信号を印加するための第1ゲート駆動部160、データラインD1~Dmの一端部に連結されゲート駆動信号が印加されると同時にデータラインD1~Dmにデータ信号を出力するデータ駆動部120が具備される。一方、液晶パネル100には第1ゲート駆動部160の誤動作の際駆動され、ゲートラインG1~Gnの第2端部に連結されゲートラインG1~Gnに順次にゲート駆動信号を印加するための第2ゲート駆動部170がさらに具備される。従って、第1ゲート駆動部160が誤動作する場合第2ゲート駆動部170が動作されることで液晶パネル100を正常的に駆動することができる。第1及び第2ゲート駆動部160、170それぞれは、従属的に連結された複数のステージからなる一つのシフトレジスタから構成され、互いに同一の構成を有する。図20に示されたように、第1ゲート駆動部160は外部から提供される信号の入力を受ける5個の外部入力端子を具備する。具体的に、外部入力端子はSTV信号入力端子、第1クロック入力端子CKV、第2クロック入力端子CKVB、第1電源電圧入力端子、及び第2電源電圧入力端子Voffを含む。また、前記第2ゲート駆動部170は5個の外部入力端子を具備する。このとき、第1ゲート駆動部160が正常的に駆動される場合には前記外部入力端子を通じてSTV信号、第1電源電圧、及び第2電源電圧のみの提供を受ける。即ち、第1クロック入力端子CKVには第1電源電圧Vonが印加され、第2クロック入力端子にも第1電源電圧が印加される。また、第1電源電圧入力端子には第2電源電圧が印加される。従って、第1ゲート駆動部160が正常的に駆動される場合第2ゲート駆動部170はバイアス状態を保持する。しかし、第1ゲート駆動部160が誤動作を起こすと第1クロック入力端子CKVには第1クロックCKVが提供され、第2クロック入力端子CKVBには第2クロックCKVが提供され、第1電源電圧入力端子には第1電源電圧が提供されることによって正常的なゲート駆動信号を出力する。一方、第1ゲート駆動部160の動作の際、ゲート駆動信号の遅延を防止するためにゲートラインG1~Gnの第2端部には第1放電部180が連結され、第2ゲート駆動部170の動作の際、ゲート駆動信号の遅延を防止するためにゲートラインG1~Gnの第1端部には第2放電部190が連結される。具体的に、第1放電部180は第1電極が現在ゲートラインの第1端部に連結され、第2電極が第2電源電圧入力端子Voffに連結され、第3電極が次のゲートラインの第1端部に連結された第1放電トランジスタからなる。従って、第1放電トランジスタは第1ゲート駆動部160から出力され次のゲートラインに印加される第1ゲート駆動信号によって駆動され現在のゲートラインに印加された第2ゲート駆動信号を第2電源電圧Voffに放電させる。一方、第2放電部190は第1電極が現在ゲートラインの第2端部に連結され第2電極が第2電源電圧入力端子Vofに連結され第3電極が次のゲートラインの第2端部に連結された第2放電トランジスタからなる。従って、第2放電トランジスタは第2ゲート駆動部170から出力され次のゲートラインに印加される第1ゲート駆動信号によって駆動され現在のゲートラインに印加された第2ゲート駆動信号を第2電源電圧Voffに放電させる。図20ではゲートラインG1~Gnの第1端部に第1ゲート駆動部160が配置され、第2端部に第2ゲート駆動部170が配置された構造を提示した。しかし、第1及び第2ゲート駆動部160、170は互いに反対に配置されることができる。このような構造は図20に示される。図21に示された液晶表示装置700でゲートラインG1~Gnの第1端部には第1ゲート駆動部160が配置され、第2端部には第1ゲート駆動部160が誤動作を起こす場合動作される第2ゲート駆動部170が配置される。図22は図20に示された第1ゲート駆動部の内部構成を示す回路図であり、図23は図22に示された第1ゲート駆動部の出力をシミュレーションした波形図である。但し、第1ゲート駆動部160は各ステージが従属的に連結された一つのシフトレジスタからなり、各ステージは同一の構成を有する。図22に示すように、シフトレジスタの各ステージ161はプルアップ部161a、プルダウン部161b、プルアップ駆動部161c及びプルダウン駆動部161dを含む。プルアップ部161aはクロック入力端子CKVにドレインが連結され、第1ノードN1にゲートが連結され、現在端出力端子Goutiにソースが連結された第1NMOSトランジスタNT1から構成される。プルダウン部161bは出力端子OUTにドレインが連結され、第2ノードN2にゲートが連結され、ソースが第2電源電圧Voffに連結された第2NMOSトランジスタNT2から構成される。プルアップ駆動部161cはキャパシタC1、第3ないし第5NMOSトランジスタNT3~NT5から構成される。キャパシタC1は第1ノードN1と出力端子との間に連結される。第3トランジスタNT3は第1電源電圧Vonにドレインが連結され、端子Gouti-1にゲートが連結され、第1ノードN1にソースが連結される。第4NMOSトランジスタNT4は第1ノードN1にドレインが連結され、次の端出力端子Gouti1にゲートが連結され、ソースが第2電源電圧Voffに連結される。第5NMOSトランジスタNT5は第1ノードN1にドレインが連結され、第2ノードN2にゲートが連結され、ソースが第2電源電圧に連結される。プルダウン駆動部161dは第6及び第7NMOSトランジスタNT6、NT7から構成される。第6NMOSトランジスタNT6は第1電源電圧Vonにドレインとゲートが共通に結合され、第2ノードN2にソースが連結される。第7NMOSトランジスタNT7は第2ノードN2にドレインが連結され、第1ノードN1にゲートが連結され、ソースが第2電源電圧Voffに結合される。このとき、第6NMOSトランジスタNT6のサイズは第7NMOSトランジスタNT7のサイズより約16倍程度大きく形成される。第1クロック、第2クロックCKV、CKVB及びSTV信号がシフトレジストに供給されると、各ステージから順次にゲート駆動信号が出力される。具体的に、各ステージでは以前ステージの出力信号に応答して第1クロックCKVのハイレベル区間を出力端子にゲート駆動信号Goutiに発生する。現在端出力端子Goutiに第1クロックのハイレベル区間が表れ出すと、この出力電圧がキャパシタC1にブートストラップBOOTSTRAPされプルアップトランジスタNT11のゲート電圧がターンオン電圧VDD以上に上昇するようになる。従って、第1NMOSトランジスタNT1が完全な導通状態を保持するようになる。このとき、第3NMOSトランジスタNT3のサイズは完全道通状態を保持するようになる。このとき、第3NMOSトランジスタNT3のサイズは第5NMOSトランジスタNT5のサイズより約2倍程度大きいのでSTV信号によって第5NMOSトランジスタがターンオンされても第1NMOSトランジスタNT1をターンオン状態に遷移させる。一方、プルダウン駆動部161dは入力信号によって第7NMOSトランジスタNT7がターンオフされ第2ノードN2が第1電源電圧Vonに上昇され第2NMOSトランジスタNT2をターンオンさせる。従って、出力端子Goutiの出力信号の電圧が第2電源電圧状態である。このとき、以前ステージの出力端子Gouti-1によって第7NMOSトランジスタNT7がターンオンされるので第2ノードN2の電位が第2電源電圧Voffにダウンされる。以後、第6NMOSトランジスタNT6はターンオンされても、第7NMOSトランジスタNT7のサイズが第6NMOSトランジスタNT6のサイズより約16倍程度大きいので第2ノードN2は第2電源電圧状態に保持される。従って、第2NMOSトランジスタNT2はターンオン状態からターンオフ状態に遷移される。現在端出力端子Goutiの電圧が第2電源電圧Voff状態に遷移されると、第7NMOSトランジスタNT7がターンオフされるので、第6NMOSトランジスタNT6を通じて第2ノードN2に第1電源電圧Vonのみ供給される状態であるので第2ノードN2の電位は第2電源電圧Voffで第1電源電圧に上昇され始める。第2ノードN2の電位が上昇され始めると、第5NMOSトランジスタNT5がターンオンされ始め、これによりキャパシタの充電電圧は第5NMOSトランジスタNT5を通じて放電され始める。従って、第1NMOSトランジスタNT1もターンオフされ始める。続いて、次端出力信号Gout1がターンオン電圧に上昇されることによって、第4NMOSトランジスタNT4がターンオンされる。このとき、第4NMOSトランジスタNT4のサイズは第5NMOSトランジスタNT5より約2倍程度大きいので第1ノードN1の電位は第5NMOSトランジスタNT5のみターンオンされたときよりさらに速く第2電源電圧にダウンされる。従って、第1NMOSトランジスタNT1はターンオフされ、第2NMOSトランジスタNT2はターンオンされ、現在端出力端子Goutiは第1電源電圧Vonから第2電源電圧Voffにダウンされる。次端の出力信号Gouti1がローレベルに下降され第4NMOSトランジスタNT4がターンオフされても第2ノードN2は第6NMOSトランジスタNT6を通じて第1電源電圧Vonにバイアス状態を保持する。また、第1ノードN1はターンオン状態を保持する第5NMOSトランジスタNT5を通じて第2電源電圧Voffを保持する。従って、第2ノードN2の電位が第1電源電圧Vonに保持されるので第2NMOSトランジスタNT2がターンオフされる誤動作の懸念のない動作が行われる。図24は図20に示された第2ゲート駆動部の第1電源電圧入力端子に第1電源電圧を印加する場合第1ゲート駆動部の出力をシミュレーションした波形図である。図25は図20に示された第2ゲート駆動部の第1及び第2クロック入力端子に第2電源電圧を印加する場合、第1ゲート駆動部の出力をシミュレーションした波形図である。図24に示すように第2ゲート駆動部170の外部入力端子のうち第1電源電圧圧力端子Vonに第1電源電圧vonをそのまま提供した場合第1ゲート駆動部160から出力される各ステージの出力波形が不良になる。従って、液晶表示装置の表示特性が低下される。一方、図25に示されたように第2ゲート駆動部170の外部入力端子のうち第1及び第2クロック入力端子CKV、CKVBに第2電源電圧Voffを提供する場合、第1ゲート駆動部160から出力される各ステージの出力波形の電圧レベルがダウンされる。このような電圧降下は第1ゲート駆動部160を駆動させるための消費電力を増加させる。従って、第1ゲート駆動部160が正常駆動の際、第2ゲート駆動部170の第1及び第2クロック入力端子CKV、CKVBに第1電源電圧を印加し、第1電源電圧入力端子Vonに第2電源電圧を印加することが望ましい。前述した液晶表示装置によると、クロック発生部はゲート駆動信号を決定する第1区間と互いに充放電する第2区間を有する第1及び第2クロックを発生してゲート駆動部に印加することによってゲート駆動信号のパルス幅を調節する。従って、ゲートラインが高速に動作され与えられた時間、即ち、一つのフレームの間該当ゲートラインを全部駆動することができ高解像度を有する液晶表示装置を具現することができる。また、ゲートラインの一端に放電トランジスタを形成して次のゲートラインが動作される以前に現在ゲートラインを放電させる。従って、ゲート駆動信号の遅延を防止することができる。また、ゲートラインの一端には第1ゲート駆動部が配置されゲートラインの他端には第1ゲート駆動部が誤動作を起こすとき動作されゲートラインを駆動する第2ゲート駆動部が配置される。従って、第1ゲート駆動部がまともに動作されなくても第2ゲート駆動部によって液晶表示装置が正常的に駆動されることができる。以上、本発明の実施形態によって詳細に説明したが、本発明はこれに限定されず、本発明が属する技術分野において通常の知識を有する者であれば、本発明の思想と精神を離れることなく、本発明を修正または変更できる。"