"複数個組み合わせて使用されることでカラー表示装置の駆動が可能な液晶表示駆動装置は、第1の端子と、第2の端子と、第3の端子と、第1のデータラッチ回路と、第2のデータラッチ回路と、変換回路と、サンプルホールド回路と、出力アンプ回路と、を有し、前記第1の端子には、画像データの伝送開始通知制御信号が入力され、前記第2の端子には、前記画像データの入力許可信号が入力され、前記第3の端子には、前記画像データが入力され、前記第1のデータラッチ回路は、前記第3の端子より入力された前記画像データを順次取り込み、第2のデータラッチ回路は、前記第1データラッチ回路に取り込まれた前記画像データを取り込み、一括して前記変換回路に送り、前記変換回路は、前記第2のデータラッチ回路より送られてきた前記画像データ対応するアナログの駆動電圧に変換して出力し、前記サンプルホールド回路は、前記カラー表示装置の前記駆動に使用される出力端子の出力端子数に対応した数だけ設けられ、前記変換回路から出力された前記アナログの駆動電圧を保持し、前記出力アンプ回路は、前記出力端子数に対応した数だけ設けられ前記サンプルホールド回路に保持された前記アナログの駆動電圧を前記出力端子から出力し、画像データの伝送開始通知制御信号が入力される第1の端子と、前記第1の端子に前記伝送開始通知制御信号が入力され前記第2の端子に前記入力許可信号が入力されることによって前記第3の端子から入力される画像データを前記第1のデータラッチ回路に取り込み可能とされ、前記変換回路は、前記サンプルホールド回路および前記出力アンプの複数のグループに共通の回路として設けられることによって時分割動作され、前記変換回路により一度に変換される前記画像データは、前記カラー表示装置によるカラー表示の赤色と緑色と青色のいずれかの同一色の画像データであり、前記画像データは同一色の複数の画像データが連続して入力され前記変換回路で前記アナログの駆動電圧に変換され、前記駆動電圧は前記サンプルホールド回路に保持され前記出力アンプに入力されることを特徴とする液晶表示駆動装置。前記第1のデータラッチ回路への前記画像データの取り込みのデータラッチタイミングを示すクロック信号が入力される第4の端子と、前記第1のデータラッチ回路に取り込まれた前記画像データが全て前記第2のデータラッチ回路から前記変換回路に送られ、前記変換回路によって前記アナログの駆動電圧に変換されて前記サンプルホールド回路および前記出力アンプを介して前記カラー表示装置に出力されたことを示す画像出力完了信号を出力する第5の端子と、前記第4の端子より入力されるクロック信号を計数するカウンタとを有し、前記画像データの前記入力許可信号の入力後に前記カウンタは前記クロック信号の計数を開始し、前記カウンタの計数値が所定値に達したときに前記画像出力完了信号を前記第5の端子に出力し、前記画像出力完了信号は複数個組み合わせて使用される他のカラー表示装置のうちの1つのカラー表示装置の画像データの入力許可信号として用いられることを特徴とする請求項1に記載の液晶表示駆動装置。前記画像データは、前記カラー表示の前記赤色の画像データと前記緑色の画像データと前記青色の画像データであり、前記出力端子および前記出力アンプは、前記赤色の画像信号に関わるものと、前記緑色の画像信号に関わるものと、前記青色の画像信号に関わるものとが、所定の順序で繰り返し配置され、前記出力アンプは、2つおきに配置されているもの同士が同一色のグループとされていることを特徴とする請求項2に記載の液晶表示駆動装置。前記第1端子に入力された初回の前記画像データの前記伝送開始通知制御信号と2回目の画像データの前記伝送開始通知制御信号との間に前記第4の端子に入力されたクロック信号の数を保持するレジスタと、前記レジスタに保持された数と前記カウンタにより計数されたクロック信号の数とを比較する比較手段とを備え、前記第1の端子に入力される前記伝送開始通知制御信号が、初回の前記伝送開始通知制御信号と2回目の前記伝送開始通知制御信号との間のクロック信号数に対応する時間よりも長くなったときに、前記カウンタの計数値が前記レジスタに保持された数よりも数多くなり、前記第2のデータラッチ回路に対してデータの取り込みを指示する信号を与えるように構成されていることを特徴とする請求項2に記載の液晶表示駆動装置。前記赤色と前記緑色と前記青色から選択された第1の色の複数の画像データが連続して前記第3の端子に入力された後、前記赤色と前記緑色と前記青色から選択された第2の色の複数の画像データが連続して前記第3の端子に入力される前に該第2の色に対応した画素のガンマ特性に応じて前記変換回路に供給される階調電圧値を調整するガンマ補正がなされるように構成されていることを特徴とする請求項2~請求項4のいずれかに記載の液晶表示駆動装置。外部より印加された電圧を分圧して複数の階調電圧を生成し前記変換回路へ供給する階調電圧生成回路を備え、前記階調電圧生成回路に前記外部から印加される前記電圧が変化されることにより、前記ガンマ補正がなされるように構成されていることを特徴とする請求項5に記載の液晶表示駆動装置。請求項5に記載の構成を有する複数個の液晶表示駆動装置と、該複数個の液晶表示駆動装置の前記出力端子から出力される駆動電圧を信号入力端子に受け表示を行なう前記カラー表示装置としてのカラー液晶表示パネルと、該カラー液晶表示パネルの複数の走査線を順次駆動する走査線駆動装置と、前記第1の端子に入力される前記画像データの前記伝送開始通知制御信号を生成し前記液晶表示駆動装置を制御する制御装置と、を備え、前記複数個の液晶表示駆動装置の前記第1の端子の各端子には前記制御装置が出力する前記伝送開始通知制御信号が入力され、前記複数個の液晶表示駆動装置のうち1番目の液晶表示駆動装置の前記第2の端子は定電位点に接続され、前記複数個の液晶表示駆動装置のうちで2番目以降の各液晶表示駆動装置の前記第2の端子はその前段の液晶表示駆動装置の前記第5の端子に接続されていることを特徴とする液晶表示システム。前記複数個の液晶表示駆動装置の各液晶表示駆動装置は外部より印加された電圧を分圧して複数の階調電圧を生成し前記変換回路へ供給する階調電圧生成回路を備え、前記制御装置は、前記液晶表示駆動装置へ前記赤色と前記緑色と前記青色から選択された第1の色の画像データを複数の前記カラー表示装置全てに供給した後、前記赤色と前記緑色と前記青色から選択された第2の色の画像データを複数の前記カラー表示装置全てに供給して、その後、前記赤色と前記緑色と前記青色から選択された第3の色の画像データを複数の前記カラー表示装置全てに供給する動作を繰り返して、複数の前記カラー表示装置全てに同一色の画像データを供給されるまでは前記伝送開始通知制御信号を同一の周期で発生し、各色の画像データを切り替える際は前記周期よりも長い周期で前伝送開始通知制御信号を発生し、前記第3の色の画像データの供給終了後に、前記階調電圧生成回路に与える電圧を切り替えて階調電圧を調整してガンマ補正を行なわせることを特徴とする請求項7に記載の液晶表示システム。外部より入力される画像データを順次取り込む第1ラッチ回路と、前記第1ラッチ回路に順次取り込まれた画像データを一括して取り込む第2ラッチ回路と、前記第2ラッチ回路に順次取り込まれた画像データに応じた電圧を画像信号として出力する変換回路と、前記変換回路により出力された画像信号を保持するホールド回路と、前記ホールド回路に保持されている画像信号に応じた駆動電圧を出力する出力アンプと、を備え、前記変換回路は前記半導体チップの長手方向と直交する方向に沿って複数個並んで配置され、前記複数個の変換回路の形成領域の上方に前記変換回路に階調電圧を供給する複数の配線が配設されていることを特徴とする1個の半導体チップに形成された液晶駆動用半導体集積回路装置。前記変換回路は、正の電圧を生成するものと、負の電圧を生成するものとからなり、前記正の電圧を生成する複数の変換回路の形成領域と前記負の電圧を生成する複数の変換回路の形成領域は、前記半導体チップの長手方向に並んで設けられ、各形成領域において、複数の変換回路がそれぞれ前記半導体チップの長手方向と直交する方向に沿って並んで配置され、前記正の電圧を生成する前記複数の変換回路の前記形成領域および前記負の電圧を生成する前記複数の変換回路の前記形成領域の上方に前記変換回路へ前記階調電圧を供給する複数の配線がそれぞれ配設されていることを特徴とする請求項9に記載の液晶駆動用半導体集積回路装置。近年、液晶表示装置における画像データは複数の画素データから構成される。1つの画素データは、1画素あたり、8ビットの赤色データRと、8ビットの緑色データGと、8ビットの青色データBとで構成されており、液晶パネルの諧調表示は各色R/G/Bあたり256段階であるものが多い。しかしながら、液晶表示装置の高画質化に伴い、より高諧調度の表示が行なえる液晶表示装置が要求されるようになって来た。そこで、本発明者らは、例えば、1画素の画素データを構成する各色R/G/Bデータを10ビットとし、各色R/G/Bあたり1024段階のような諧調表示を行なえるソースドライバについて検討した。その結果、画像信号出力端子Y1,Y2......YnごとにDA変換回路DAC1,DAC2......DACnを設ける方式にあっては、DA変換回路に諧調電圧を供給する配線の数が正負合わせて2048本必要になる。そのため、諧調電圧を供給する配線の配線領域の幅が広くなり、これらの諧調電圧を供給する配線給電線とも言うの下に、DA変換回路を配置したとしても、無駄なスペースが生じることになる。従って、液晶ドライバ、すなわち、ソースドライバが形成される半導体チップのサイズが大きくなり、ソースドライバの大幅なコストアップにつながるという課題があることを、発明者らは見出した。これを解決するには、ソースドライバに搭載するDA変換回路の数を減らし、DA変換回路を時分割動作させればよいが、そのようにすると画像データを入力してからアナログ電圧として出力されるまでの時間が長くなってしまう。また、表示画面の大型化や高精細化に伴いソース線の数の多い液晶パネルが提供されるようになってきているため、ソース線の数の異なる液晶パネルが共存している。それらの液晶パネルに共通のソースドライバを使用できるようにするには、最大のソース線の液晶パネルに合わせて画像信号出力端子を設けることも解決法のひとつである。しかし、そのようなソースドライバは、そのチップサイズが極端に大きくなってしまうため、有効な手法ではないことも発明者らは見出した。そこで、1つのソースドライバの有する画像信号出力端子の数を制限し、複数のソースドライバを用いて液晶表示システムを構成することが考えられる。かかる手法は、ソースドライバのチップサイズを小さくする上で有効である。しかしながら、この場合、画像データを送るべきソースドライバを切り換える際のタイミングに注意を払う必要がある。そのタイミングが不正確であると、画像データをソースドライバに正しく取り込めなかったり、画像データをソースドライバに伝送するための伝送時間が長くなってしまったりするなどのおそれが発生する。この発明の目的は、表示駆動装置液晶ドライバ、液晶駆動用半導体集積回路の小型化を図ることにある。この発明の他の目的は、複数の表示駆動装置液晶ドライバを組み合わせて表示装置液晶表示装置を構成する可能な表示駆動装置液晶ドライバを提供することにある。この発明のさらに他の目的は、カラー表示パネルカラー液晶パネルの各色の特性に応じたガンマ補正を動的に行なえる複数の表示駆動装置液晶ドライバを提供することにある。この発明のさらに他の目的は、チップサイズの増大を抑えつつ高諧調度の表示を行なうことができる複数の表示駆動装置液晶ドライバを提供することにある。この発明の前記ならびにそのほかの目的と新規な特徴については、本明細書の記述および添付図面から明らかになるであろう。本願において開示される発明のうち代表的なものの概要を説明すれば、下記のとおりである。すなわち、アナログ階調電圧に変換された画像信号を出力する最終段の出力アンプを複数のグループに分け、画像データをアナログ階調電圧に変換するディジタル-アナログDA変換回路を上記グループに共通の回路として設けて、グループを切り替えながらDA変換回路を時分割動作させる。また、上記最終段の出力アンプは同一色の画像信号に関わるもの同士を選択してグループ化し、DA変換回路と出力アンプとの間にはセレクタ機能を設けてDA変換回路でアナログ階調電圧に変換された画像信号を所望の出力アンプに振り分けるようにしたものである。上記した手段によれば、DA変換回路を時分割動作させるためDA変換回路の数が画像信号出力端子の数よりも少なくて済み、表示駆動装置液晶ドライバの小型化を図ることができる。本発明の表示駆動装置液晶ドライバを複数個組み合わせて使用する画像表示システムでは、ある表示駆動装置液晶ドライバでDA変換している間に、他の表示駆動装置液晶ドライバではDA変換された画像信号を出力アンプへ伝送させることができる。そのため、画像データを入力してから所定の時間内に階調電圧として出力させることができ、画像データを表示駆動装置液晶ドライバに正しく取り込めなかったり、データ伝送所要時間が長くなったりするのを防止することができる。また、最終段の出力アンプは同一色の画像信号に関わるもの同士を選択してグループ化しているため、表示制御装置液晶コントローラは表示パネル液晶パネルの1ラインに関し、同一色の画像データを連続して転送することができる。色データの切替えは1ラインにR/G/B各データの3回で済むため、色データの切替えの際に、各色の階調電圧を動的に変更することによってガンマ補正を行なうことが可能となる。それに伴う遅れは極めて小さいので、データ伝送タイミングやシステム構成を大きく変えることなくガンマ補正を行なうことができる。さらに、本願の他の発明は、画像データをアナログ階調電圧に変換する複数のDA変換回路を、半導体チップのほぼ中央に、半導体チップの長手方向と直交する方向に並べて配置し、DA変換回路に諧調電圧を供給する複数の配線を半導体チップの長手方向と直交する方向に沿って配設するようにしたものである。上記した手段によれば、表示駆動装置液晶ドライバが1024階調のような多段階の画像信号を出力するものであり、諧調電圧を供給する配線の領域の幅が広くなる場合にも、これらの諧調電圧を供給する配線給電線の下にDA変換回路を配置したときに無駄なスペースが生じさせることがなく、これにより半導体チップのサイズを低減させることができる。本願において開示される発明のうち代表的なものによって得られる効果を簡単に説明すれば下記のとおりである。すなわち、本出願の発明に従うと、表示駆動装置液晶ドライバ、液晶駆動用半導体集積回路の小型化を実現することができる。また、本出願の発明に従うと、複数の表示駆動装置液晶ドライバを組み合わせて表示装置液晶表示システムを構成する可能な表示駆動装置液晶ドライバを実現する。さらに、本出願の発明に従うと、カラー表示パネルカラー液晶パネルの各色の特性に応じたガンマ補正を動的に行なえる表示駆動装置液晶ドライバを実現することができる。また、チップサイズの増大を抑えつつ高諧調度の表示を行なうことができる表示駆動装置液晶ドライバ、液晶駆動用半導体集積回路を実現することができる。以下、本発明の好適な実施例を図面に基づいて説明する。図1は、本発明を適用した液晶ドライバ回路の概略構成を示す。特に制限されるものでないが、図1に示されている各回路ブロックは単結晶シリコンのような1個の半導体チップ上に半導体集積回路として構成される。本実施例の液晶ドライバ回路は、複数の走査線と複数の信号線とが格子状に配設され各交点に画素が設けられているドットマトリックス型のカラー液晶パネルの信号線に印加される画像信号Y1~Ynを出力する回路である。本発明において、特に制限されないが、1画素の画素データは、赤色R/緑色G/青色Bの各色データがそれぞれ10ビットとされた30ビットで構成されるものとして、以下実施例が説明される。本実施例の液晶ドライバ回路は、10ビットの入力画像データ赤色R/緑色G/青色Bの3つ色データのうち、1つの色データの10ビットを示すD9~D0を順次取り込む第1ラッチ部110と、該第1ラッチ部110に取り込まれた画像データを一括して転送する第2ラッチ部120と、入力画像データD9~D0がオール1のときに画素を黒とするかオール0のときに画素を黒とするかに応じてデータを反転させるデータ反転回路130と、上記第1ラッチ部110のどこに入力画像データD9~D0を取り込ませるか指定するラッチ位置指定回路140と、外部から供給される階調電圧V0~V8,V9~V17をラダー抵抗で分圧して正極性および負極性それぞれ1024階調の電圧を生成する階調電圧生成回路150と、生成された電圧の中から前記第2ラッチ部120に保持されている画像データに応じた電圧を選択することでディジタル信号をアナログ階調電圧に変換するデコーダセレクタ部160と、変換されたアナログ電圧を保持するサンプルホールド部170と、ホールドされた電圧に応じた画像信号Y1~Ynを生成して出力する出力アンプ部180と、外部から入力されるクロック信号や制御信号に基づいて半導体チップ内部の回路を所定の順序に従って動作させる内部制御信号を生成するタイミング制御部190などから構成される。タイミング制御部190には、本実施例の液晶ドライバ回路を複数個シリーズに接続して当該回路の出力数n本よりも多い信号線を有する液晶パネルを駆動するシステムを構成する場合に、所定の端子EIO1の状態に応じて先頭の液晶ドライバ回路最初の画像データが供給されるICか否かを判定するとともに、当該回路がすべての画像信号Y1~Ynを出力したことを示す信号を所定の端子EIO2より出力する機能が設けられている。具体的には、先頭の液晶ドライバ回路の端子EIO1を電源電圧Vccに固定するとともに、前段の液晶ドライバ回路の端子EIO2を次段の端子EIO1に接続することにより、複数の液晶ドライバ回路を順次画像データ取込み状態にさせることができる。図2は、図1に示されている液晶ドライバ回路のうちデコーダ部160とサンプルホールド部170および出力アンプ部180を取り出してより詳細に構成を示したものである。本実施例においては、サンプルホールド部170および出力アンプ部180にそれぞれ480個の単位サンプルホールド回路S/H1~S/H480とボルテージフォロワとして動作する出力アンプAMP1~AMP480が設けられているのに対し、1/12の数40個のDA変換回路DAC1~DAC40およびボルテージフォロワとして動作するアンプが設けられている。ここでは、デコーダ部160を構成する40個の回路を便宜的にDA変換回路と呼んでいるが、階調電圧生成回路150から供給される複数の階調電圧の中から入力コードに応じた電圧を選択して出力させるスイッチ素子のみからなるセレクタによりデコーダ部160を構成することができる。上記デコーダ部160の40個の出力は、40本の信号線からなるバスBUSを介して上記480個の単位サンプルホールド回路S/H1~S/H480のうちいずれか40個に取り込まれるように構成されている。具体的には、デコーダ部160には同一色の画像データが40個まとめて入力されるようにされ、480個の出力端子Y1~Y480のうち、Y1,Y4,Y7......Y478は液晶パネルの赤色R画素に接続された信号線に対応して赤色画像信号が、Y2,Y5,Y8......Y479は液晶パネルの緑色G画素に接続された信号線に対応して緑色画像信号が、Y3,Y6,Y9......Y480は液晶パネルの青色B画素に接続された信号線に対応して青色画像信号がそれぞれ出力されるように、デコーダ部160において変換された40個の画像信号はサンプルホールド回路S/H1~S/H480のうち2つおき計40個のサンプルホールド回路に取り込まれる。DA変換回路DAC1......DAC40は正電圧出力用と負電圧出力用のものが交互に配置されている。つまり、奇数番目のDA変換回路DAC1,DAC3......DAC47が正電圧を出力するようにされると、偶数番目のDA変換回路DAC2,DAC4......DAC48は負電圧を出力するようにされる。そして、あるビットの画素データはマルチプレクサMPX1により、正電圧出力用DA変換回路DACiと負電圧出力用DA変換回路DACi1に交互に入力されてアナログ電圧に変換され、サンプルホールド回路に伝送されマルチプレクサMPX2を介して出力される。このとき、マルチプレクサMPX1とMPX2は同じように動作される。すなわち、マルチプレクサMPX1が画像データをスルーさせている時はマルチプレクサMPX2も画像信号をスルーさせ、マルチプレクサMPX1が画像データを交差させている時はマルチプレクサMPX2も画像信号を交差させるように信号経路を切り替える。これによって、液晶パネルの各画素の電極は正の電圧と負の電圧が交互に印加されて交流駆動され、液晶の劣化が防止されるようになっている。図3には、本実施例の液晶ドライバ回路100を複数個使用して1280×768ドットのカラー液晶パネル200を駆動するシステムを構成した場合のブロック図が示されている。カラー液晶パネル200のライン方向には、8個の液晶ドライバ回路DRV1~DRV8が配置され、これらの液晶ドライバ回路DRV1~DRV8が4個ずつ2組に分けられ、各組の先頭の液晶ドライバ回路DRV1,DRV5の端子EIO1は電源電圧Vccに固定されるとともに、残りの液晶ドライバ回路DRV2~DRV4,DRV6~8の端子EIO1には、前段の液晶ドライバ回路の端子EIO2が電気的に結合されることにより、4個ずつ直列形態に接続されている。300はカラー液晶パネル200のコモン線TFTパネルではゲート線と呼ばれるを順番に選択レベルにする走査線駆動回路コモンドライバ、400は走査線駆動回路300に対するタイミング制御信号を生成したり、上記液晶ドライバ回路に供給する画像データD9~D0や液晶ドライバ回路を制御する制御信号DSS、動作クロックCL1,CL2を生成する液晶表示コントローラである。液晶表示コントローラ400は、2つの走査線駆動回路に対する画像データD9~D0を同時に出力するようにされる。また、この実施例では、画像データの伝送開始を知らせる制御信号DSSや取込みタイミングを知らせるクロックCL2を2組の液晶ドライバ回路DRV1~DRV4,DRV5~DRV8に対してそれぞれ別個に生成して与えるように構成されているが、これらの信号は共通の信号として与えるようにすることも可能である。図4~図6には、図3のような液晶表示システムにおいて、それぞれ組をなす4つの液晶ドライバ回路DRV1~DRV4またはDRV5~DRV8のデコーダ部160からサンプルホールド部160へ送る画像信号の伝送タイミングが示されている。図4~図6における時間の流れは、図4→図5→図6であり、また各図においては先ず左から右へ向かい、右端に達するとその下の左端へ向かうというような流れである。図4~図6から分かるように、本実施例の液晶表示システムでは、先ず赤色の画像データが40個ずつ16回に分けて伝送されDA変換されてホールドされた後、緑色の画像データが40個ずつ16回に分けて伝送されDA変換されてホールドされ、その後、青色の画像データが40個ずつ16回に分けて伝送されDA変換されてホールドされる。これによって、液晶パネルの1ラインの半分の640個のドットに対する1920個の画像データの伝送、ホールドが行われる。そして、本実施例の液晶表示システムでは、赤色の画像データの伝送から、緑色の画像データの伝送、さらに青色の画像データの伝送へと移る際に若干の遅延時間を設け、その間に各色の画素のガンマ特性に応じて出力する電圧を変化させるガンマ補正を動的に行うようになっている。このように、本実施例の液晶表示システムでは、比較的容易にガンマ補正を動的に行なうことができるのは、赤、緑、青の各色の画像データがそれぞれまとめて伝送されるためである。カラー液晶パネルの構成に応じて一方の端の信号線に対する画像データから他方の端の信号線に対する画像データまで順番に伝送する方式の表示システムにおいては、赤色の画像データの伝送と、緑色の画像データの伝送と、青色の画像データの伝送が繰り返されるか混在して伝送されるので、各色の画像データの伝送ごとにガンマ補正を行わなくてはならない。そのため、画像データの数だけガンマ補正のための遅延時間を設けなくてはならず、そのようにすると1水平期間中にすべての画像データの伝送を終了することができなくなる。これに対し、本実施例の液晶表示システムでは、赤、緑、青の各色の画像データがそれぞれまとめて伝送されるため、1水平期間中に3回だけガンマ補正のための遅延時間を設けてやればよいので、1水平期間中にすべての画像データの伝送を終了することができる。なお、本実施例の液晶ドライバ回路におけるガンマ補正は、図1の階調電圧生成回路150に外部から与える電圧V0~V8,V9~V17を、赤,緑,青の各色のガンマ特性に応じて切り替えてやることで実現することができる。図7には、図3の液晶表示システムにおける液晶表示コントローラ400から液晶ドライバ回路DRV1~DRV4DRV5~DRV8についても同様に対して供給されるデータサンプリング開始制御信号DSSやデータの取込みタイミング等を知らせるクロックCL1,CL2、画像データD9~D0、各液晶ドライバ回路DRV1~DRV4から出力されるデータ伝送終了信号EIO2のタイミングが示されている。このうち、クロックCL1は1水平期間を示す信号、制御信号DSSは各液晶ドライバ回路DRV1~DRV4のそれぞれのデータサンプリング開始タイミングを知らせる信号で、1水平期間中にすなわちクロックCL1の1周期に4回制御信号DSSが立ち上がる。一方、CL2は画像データD9~D0の取込みタイミングを知らせるクロックで、この実施例ではクロックCL2の立下がりと立上がりのそれぞれで画像データを取り込むように液晶ドライバ回路が構成されているため、1つの液晶ドライバ回路が40個のまとまった画像データを取り込む期間すなわちデータサンプリング開始制御信号DSSの1周期の期間におけるクロックCL2のパルス数は20個である。なお、最初の液晶ドライバ回路DRV1が画像データの取り込みを開始するのは、データサンプリング開始制御信号DSSが変化してからクロックCL2の2パルスだけ後の時点からとされている。また、各液晶ドライバ回路が40個の画像データを取り込んだことを知らせる信号EIO2は、実際の最後のデータの取り込みタイミングよりもクロックCL2の2パルス前に立ち上がるようにされている。これにより、液晶ドライバ回路DRV2~DRV4は、画像データを前段のドライバのデータ取込み終了から時間遅れなく連続して取り込むことができる。次に、実施例の液晶ドライバ回路DRVのチップ内部の動作について説明する。液晶ドライバ回路DRVの内部の各回路ブロックは、タイミング制御部190からの制御信号によって所定のタイミングで動作され、タイミング制御部190は外部から入力されるクロック信号や制御信号に基づいて内部の回路を所定の順序に従って動作させる内部制御信号を生成する。図8には、タイミング制御部190の構成例が示されている。本実施例のタイミング制御部190は、入力信号EIO1に基づいて画像データを取り込む初段ラッチ回路110やクロックを計数する後述のカウンタを動作させるかスタンバイ状態にさせるかを示す制御信号STB,CEN等を生成する動作開始判定回路191と、1水平期間を示すクロックCL1に基づいて1水平期間中のデータサンプリング開始制御信号DSSの数を計数しサンプルホールド部170に対するイネーブル信号SHENを生成するDSSカウンタ192と、データラッチタイミングを与えるクロックCL2を分周して第1ラッチ部110に取り込まれた画像データを一括して第2ラッチ部120に転送させるタイミングを与えるラッチタイミング信号DLTを生成するクロック制御回路193と、出力アンプ部180に対しLCD画像信号の出力を許可する出力イネーブル信号OENを生成するLCD出力制御回路194などを備える。図1には示されていないが、実施例の液晶ドライバ回路は、第2ラッチ部120が1段目のラッチ回路121と2段目のラッチ回路122からなる2段構成とされており、タイミング制御部190は1段目のラッチ回路121と2段目のラッチ回路122を順次ラッチ動作させるクロックを生成して供給するようにされている。これにより、1段目のラッチ回路121がマスタラッチとして動作し、2段目のラッチ回路122がスレーブラッチとして動作して、第2ラッチ部120に取り込まれた画像データが直ちに次段のデコーダ部160へ供給されてしまうのを防止することができる。さらに、タイミング制御部190は、データサンプリング開始制御信号DSS間のクロックCL2の数を計数するCL2カウンタ195や、1ライン中初回のDSS信号間のクロックCL2の数を保持するCL2数レジスタ196、1ライン中初回のDSS信号間のクロックCL2の数と2回目以降のDSS信号間のクロックCL2の数とを比較するコンパレータ197、該コンパレータ197の比較結果に基づいて、外部からのDSS信号が初回のDSS信号間のクロックCL2の数よりも長い期間入力されなかった場合に、第2ラッチ部120の後段のラッチ回路122に対してデータのラッチを指示するためのクロック信号DLCを半導体チップ内部で自動的に発生するラッチクロック発生回路198を備える。ラッチクロック発生回路198を設けたのは、本実施例の液晶ドライバ回路を使用しガンマ補正を行なう表示システムにおいては、図9に示すように、各色の画像データの転送期間にガンマ補正のための余裕期間Taを設けるためにDSS信号を少し遅れて入力させることがあるので、DSS信号にのみ基づいてラッチ回路122に対するラッチクロック信号DLCを生成したのでは、ラッチのタイミングが遅れてしまうためである。また、本実施例のタイミング制御回路においては、CL2カウンタ195が所定数16クロックを計数した時点で次段の液晶ドライバ回路に対するEIO2信号を立ち上げるようにすることができる。これにより、次段の液晶ドライバ回路がこの信号をEIO1端子に受けるように接続をしておくことによって、複数の液晶ドライバ回路を使用した表示システムにおいて、液晶表示コントローラは各ドライバに対して独自の開始信号を送ることなく、連続した画像データの伝送が可能となる。そのため、表示システムの設計者の負担を軽減することができる。図10には、実施例の液晶ドライバ回路を8個使用して4個ずつペアにして順に画像データを転送することで液晶パネルへのカラー表示を行なわせる図3のような液晶表示システムにおける液晶ドライバ回路DRV1~DRV4DRV5~DRV8についても同様に対して供給されるデータサンプリング開始制御信号DSSやクロックCL1のタイミングと、各液晶ドライバ回路DRV1~DRV4内で生成されるクロックイネーブル信号CENと、サンプルホールドイネーブル信号SHENと、次段の液晶ドライバ回路に対するEIO2信号のタイミングが示されている。図11には、サンプルホールド部170の単位サンプルホールド回路の構成例が、図12にはその動作タイミングが示されている。本実施例の単位サンプルホールド回路は、デコーダ部160でAD変換された電圧を保持ための1組のホールド容量CH1,CH2と、入力側のアンプAMPiの出力端子と前記ホールド容量CH1,CH2の一方の端子がそれぞれ接続されたノードN1,N2との間に接続された一対のスイッチSW11,SW12と、前記ノードN1,N2と出力側のアンプAMPoの入力端子との間に接続された一対のスイッチSW21,SW22とにより構成されている。図2のアンプAMP1~AMP480が図11のアンプAMPoに相当する。上記一対のスイッチSW11,SW12は制御信号EN11,EN12によってオンオフされるとともに、スイッチSW21,SW22は制御信号EN21,EN22によってオンオフされる。そして、スイッチSW11がオンされるときはSW22がオンされ、スイッチSW12がオンされるときはSW21がオンされるように制御信号EN11,EN12,EN21,EN22によって制御される。さらに、スイッチSW11とSW21は同時にオン状態にされることがないように、またスイッチSW12とSW22も同時にオン状態にされることがないように、サンプルホールドイネーブル信号SHENに基づいてそれぞれの制御信号EN11,EN12,EN21,EN22が生成される。本実施例の単位サンプルホールド回路は、スイッチSW11がオン状態にされるとスイッチSW21がオフ状態にされて、ホールド容量CH1にデコーダ部160でAD変換された電圧画像信号がサンプリングされる。このとき、反対側のホールド容量CH2はスイッチSW22がオン状態にされスイッチSW12がオフ状態にされることにより、直前にサンプリングした電圧を出力する状態となる。ホールド容量CH1に入力電圧がサンプリングされると、スイッチSW11がオフ状態にされスイッチSW12がオン状態にされることにより、サンプリングした電圧を出力する状態となる。このとき、反対側のホールド容量CH2はスイッチSW12がオン状態にされ、スイッチSW22がオフ状態にされて、デコーダ部160でAD変換された電圧で充電されてサンプリングを行なうようにされる。上記のような動作を繰り返すことにより、1組のホールド容量CH1とCH2がサンプリング状態とホールド状態を交互に繰り返し、デコーダ部160から出力された電圧画像信号が連続して画像信号がサンプリングされ、次々と出力される。図13には、本実施例の液晶ドライバ回路を構成する各回路ブロックの半導体チップ上でのレイアウトの一例が示されている。図13において、図2に示されている回路と同一の回路には同一の符号が付されている。図13から分かるように、本実施例の液晶ドライバICにおいては、半導体チップのほぼ中央に、正電圧を出力するDA変換回路POS-DACと負電圧を出力するDA変換回路NEG-DACが半導体チップの長手方向に並んで配置され、その上方にマルチプレクサMPXが、また下方にランダムロジックからなるタイミング制御回路190および抵抗ラダーからなる諧調電圧生成回路150TGRLが配置されている。そして、これらの回路の左右には、対称的に、上から順に、マルチプレクサMPX2、出力アンプAMP、サンプルホールド回路S/Hが配置され、さらにこれらと同一の回路が上下対称的に、サンプルホールド回路S/H、出力アンプAMP、マルチプレクサMPX2の順に配置されている。さらに、正電圧を出力するDA変換回路POS-DACと負電圧を出力するDA変換回路NEG-DACは、図14に示すように、それぞれ20個の単位DA変換回路DAC1~DAC20が半導体チップの長手方向と直交する方向に並んで配置され、その上に諧調電圧生成回路TGRLから出力される階調電圧を供給する1024本の給電線が配設されている。画像データが8ビットで256階調の液晶ドライバICは、図15に示すように、マルチプレクサMPX2、出力アンプAMP、デコーダ部DAC、レベルシフタ、マルチプレクサMPX1、タイミング制御回路および諧調電圧生成回路TGRLが順に配置され、デコーダ部の単位DA変換回路は半導体チップの長手方向に沿って出力端子の数と同じ数だけ配置されたチップレイアウトが一般であった。かかるレイアウトを本実施例の液晶ドライバICのように画像データが10ビットで1024階調の液晶ドライバICに適用すると、DA変換回路列の上に従来の4倍の数の給電線を半導体チップの長手方向に沿って配設しなければならなくなり、給電線の長さが非常に長くなるとともに給電線の幅が大幅に増加して給電線の下方にむだなスペースが生じてしまう。これに対し、図13および図14に示すようなレイアウトに従うと、階調電圧の給電線を半導体チップの長手方向と直交する方向に沿って配設すればよいため、給電線の長さが短くなるとともに、複数の給電線のレイアウト幅が大幅に増加しても給電線の下方にむだなスペースを生じさせることなくDA変換回路を配置することができるようになる。その結果、高階調化に伴うチップサイズの増加を大幅に抑制することができるという利点がある。以上本発明者によってなされた発明を実施例に基づき具体的に説明したが、本発明は上記実施例に限定されるものではなく、その要旨を逸脱しない範囲で種々変更可能であることはいうまでもない。例えば、前記実施例では、画像データが10ビットで階調電圧が1024段階である場合について説明したが、それに限定されるものでなく、画像データが9ビットで階調電圧が512段階の場合や、画像データが11ビットで階調電圧が2048段階の場合にも適用することができる。また、前記実施例では、480個の出力アンプに対して40個すなわち1/12個のDA変換回路を設けているが、1/8個あるいは1/16個などであっても良い。さらに、前記実施例では、画像データに同期して入力されるクロック信号を計数するカウンタの計数値が所定値に達したときに画像データの取り込み終了を示す信号EIO2を出力する端子を設け、該端子の信号を次段のドライバICにデータ取り込み許可信号EIO1として入力しているが、信号EIO2を出力する端子を省略し、データ取り込み許可信号EIO1を液晶表示コントローラ400から与えるように構成することも可能である。"