タイマー割り込みの第一の周期を、所定の係数を乗じた第二の周期に短縮させ、前記タイマー割り込みとは非同期な処理を待機するタスクの待機時間について、前記第一の周期単位の周期数を前記所定の係数で除した周期数に補正し、補正後の前記周期数の前記タイマー割り込みの発生により前記待機時間を計測する処理をコンピュータが実行する試験方法。タスクからの待機要求に応じ、前記非同期な処理を待機するタスクに関する識別情報を記憶する記憶部を参照して、該待機要求に係るタスクに関して前記周期数の補正の要否を判定する処理を前記コンピュータが実行する請求項2記載の試験方法。タイマー割り込みの第一の周期を、所定の係数を乗じた第二の周期に短縮させ、前記タイマー割り込みとは非同期な処理を待機するタスクの待機時間について、前記第一の周期単位の周期数を前記所定の係数で除した周期数に補正し、補正後の前記周期数の前記タイマー割り込みの発生により前記待機時間を計測する処理をコンピュータに実行させる試験プログラム。タイマー割り込みの第一の周期を、所定の係数を乗じた第二の周期に短縮させる短縮部と、前記タイマー割り込みとは非同期な処理を待機するタスクの待機時間について、前記第一の周期単位の周期数を前記所定の係数で除した周期数に補正する補正部と、補正後の前記周期数の前記タイマー割り込みの発生により前記待機時間を計測する計測部とを有する情報処理装置。しかしながら、ソフトウェアの時間タイマー割り込みの周期を加速する方法では、タイマー割り込みとは非同期に動作するハードウェアにアクセスし、当該ハードウェアの応答待ちを行うようなタスクについて、加速試験が困難であるという問題がある。すなわち、タスクの応答待ち時間は加速されている一方で、ハードウェアの処理は、加速されないからである。その結果、タスクは、応答待ちから起床又は復帰しても、ハードウェアからの応答を得ることができず、タイムアウト等の異常を認識してしまう可能性がある。この点について、図を用いて更に詳しく説明する。図1は、タイマー割り込みの周期を加速しない場合のタスク動作と時間との関係の一例を示す図である。同図は、処理の実行主体ごとに、処理の実行タイミングを示す。すなわち、同図の水平方向は、時間軸を示す。同図では、タイマー割り込みの周期が4ミリ秒であることが示されている。なお、タイマー割り込みの周期ごとに、付与されている数値0~24は、同図の開始時からの相対的な実時間ミリ秒を示す。一方、垂直方向には、処理の実行主体として、タスクスケジューラ、タスク1、タスク2、タスク3、及び周辺ハードウェア等が列挙されている。タスクスケジューラは、一定時間後にタスクを起動するためのスケジュール情報としてのタイマーリストを有し、タスクを起床させる処理を実施する。タスク1、2、及び3は、タスクスケジューラに登録されているタスクである。周辺ハードウェアは、例えば、メモリ、HDDHardDiskDrive等、タスクからアクセス対象とされるハードウェアである。ここでは、タスク3の動作に注目する。タスク3は、時刻8において、周辺ハードウェアに処理要求を行った後、16ミリ秒間の待機waitをOSに要求する。周辺ハードウェアの処理の終了を待機するためである。タスクスケジューラは、待機時間をタイマー割り込みの周期数に変換する。ここでは、16÷4=4周期に変換される。そこで、タスクスケジューラは、4周期後の時刻24にタスク3を起床させる。一方、周辺ハードウェアの処理は、開始から12ミリ秒後の時刻20で完了している。したがって、時刻24に起床したタスク3は、周辺ハードウェアからの応答を得ることができ、以降の処理を継続することができる。一方、図2は、タイマー割り込みの周期を2分の1に加速した場合のタスク動作と時間との関係の一例を示す図である。同図の見方は、図1と同様である。同図において、タイマー割り込みの周期は、2ミリ秒に加速されている。タスク3の処理内容は、図1と同様である。すなわち、タスク3は、時刻2において、周辺ハードウェアに処理要求を行った後、16ミリ秒間の待機waitを開始する。なお、同図における時刻2は、タイマー割り込みの周期数では3周期目であり、タスク3やタスクスケジューラにとって、図1における時刻4と同じタイミングに相当する。タスクスケジューラは、待機時間をタイマー割り込みの周期数に変換する。ここでも、16÷4=4周期に変換される。タスクスケジューラは、タイマー割り込みの周期が加速されていることを知らず、カウンタ値への変換式は、図1の場合と変わらないからである。そこで、タスクスケジューラは、4周期後の時刻12にタスク3を起床させる。一方、周辺ハードウェアの処理は、開始から12ミリ秒後の時刻16まで待たないと完了しない。したがって、時刻12に起床したタスク3は、周辺ハードウェアからの応答を得ることができず、タスク3はタイムアウト等を認識してしまう。そこで、タイマー割り込みとは非同期な処理を待機するソフトウェアに関しても加速試験を行うことのできる試験方法、試験プログラム、及び情報処理装置の提供を目的とする。そこで上記課題を解決するため、試験方法は、タイマー割り込みの第一の周期を、所定の係数を乗じた第二の周期に短縮させ、前記タイマー割り込みとは非同期な処理を待機するタスクの待機時間について、前記第一の周期単位の周期数を前記所定の係数で除した周期数に補正し、補正後の前記周期数の前記タイマー割り込みの発生により前記待機時間を計測する処理をコンピュータが実行する。タイマー割り込みとは非同期な処理を待機するソフトウェアに関しても加速試験を行うことができる。以下、図面に基づいて本発明の実施の形態を説明する。図3は、本発明の実施の形態における試験装置のハードウェア構成例を示す図である。図3の試験装置10は、それぞれバスBで相互に接続されているドライブ装置100、補助記憶装置102、メモリ装置103、CPU104、及びインタフェース装置105等を有する。試験装置10での処理を実現するプログラムは、記録媒体101によって提供される。プログラムを記録した記録媒体101がドライブ装置100にセットされると、プログラムが記録媒体101からドライブ装置100を介して補助記憶装置102にインストールされる。但し、プログラムのインストールは必ずしも記録媒体101より行う必要はなく、ネットワークを介して他のコンピュータよりダウンロードするようにしてもよい。補助記憶装置102は、インストールされたプログラムを格納すると共に、必要なファイルやデータ等を格納する。メモリ装置103は、プログラムの起動指示があった場合に、補助記憶装置102からプログラムを読み出して格納する。CPU104は、メモリ装置103に格納されたプログラムに従って試験装置10に係る機能を実行する。インタフェース装置105は、ネットワークに接続するためのインタフェースとして用いられる。なお、記録媒体101の一例としては、CD-ROM、DVDディスク、又はUSBメモリ等の可搬型の記録媒体が挙げられる。また、補助記憶装置102の一例としては、HDDHardDiskDrive又はフラッシュメモリ等が挙げられる。記録媒体101及び補助記憶装置102のいずれについても、コンピュータ読み取り可能な記録媒体に相当する。なお、試験装置10には、マウス及びキーボード等の入力装置や、液晶ディスプレイ等の表示装置が接続されていてもよい。また、試験装置10をネットワークに接続する必要が無い場合、試験装置10は、インタフェース装置105を備えていなくてもよい。図4は、第一の実施の形態における試験装置の機能構成例を示す図である。同図には、CPU104、加速値設定部11、及びOS12等が示されている。CPU104は、カウンタ部141、割り込み部142、及びI/Oコントローラ部143等を含む。カウンタ部141は、後述されるカウンタ値加速部123より設定されるカウンタ値を所定の周波数以下、カウンタ周波数という。に基づく周期でデクリメントする。カウンタ部141は、カウンタ値が0になると、その旨を割り込み部142に通知する。すなわち、カウンタ部141は、カウンタ値を用いてタイマー割り込みの発生時期を検知する。以下、単にカウンタ値というとき、カウンタ部141が利用するカウンタ値をいう。割り込み部142は、カウンタ部141からの通知に応じ、タイマー割り込みを発生させる。I/Oコントローラ部143は、周辺I/Oデバイスd1~dn以下、それぞれを区別しない場合、周辺I/Oデバイスdという。とのデータの入出力を制御する。なお、本実施の形態において、周辺I/Oデバイスdは、タイマー割り込み又はタイマー割り込みの周期とは非同期に動作するハードウェアの一例である。周辺I/Oデバイスdの一例としては、図3に示される、補助記憶装置102、メモリ装置103、又はドライブ装置100等である。また、周辺I/Oデバイスdは、外部記憶媒体等、試験装置10の外部の装置であってもよい。加速値設定部11は、タイマー割り込みの周期を短縮させるための係数以下、加速値という。をOS12に設定する。加速値は、0より大きく1以下の値を有する。加速値が1である場合、タイマー割り込みの周期は短縮されない。加速値設定部11は、例えば、GUIGraphicalUserInterfaceを表示させ、当該GUIを介して加速値を取得してもよいし、補助記憶装置102が記憶する加速値を取得してもよい。なお、加速値設定部11は、試験装置10にインストールされたプログラムがCPU104に実行させる処理により実現される。OS12は、試験装置10にインストールされているOS12OperatingSystemである。同図において、OS12は、加速値受付部121、カウンタ値設定部122、カウンタ値加速部123、タイマー割り込み捕捉部124、タスク管理部125、時刻更新部126、割り込み回数更新部127、待機処理部128、及び加速解消部129等を有する。これら各部は、OS12に含まれるプログラムが試験装置10に実行させる処理により実現される。加速値受付部121は、加速値設定部11より加速値の設定を受け付ける。加速値受付部121は、受け付けた加速値をカウンタ値加速部123及び加速解消部129に通知する。カウンタ値設定部122は、タイマー割り込みが発生するたびに、カウンタ値をカウンタ値加速部123に設定する。カウンタ値加速部123は、カウンタ値設定部122よりカウンタ値が設定されるたびに、当該カウンタ値に、加速値受付部121より通知されている加速値を乗じた値カウンタ値を、カウンタ部141に設定する。したがって、加速値が0より大きく1未満である場合、カウンタ値は、カウンタ値設定部122が有する本来の値より小さくなる。その結果、タイマー割り込みの周期が短縮する。タイマー割り込み捕捉部124は、いわゆる割り込みハンドラとして機能する。すなわち、タイマー割り込み捕捉部124は、CPU104が発生させるタイマー割り込みを捕捉又は検知する。タイマー割り込み捕捉部124は、捕捉したタイマー割り込みに応じて、例えば、カウンタ値設定部122、タスク管理部125、時刻更新部126、及び割り込み回数更新部127等を呼び出す。待機処理部128は、タスクからの待機要求wait要求に応じ、当該タスクを待機要求において指定された待機時間だけ待機させるための処理を実行する。タスクとは、OS12が管理する処理の実行単位をいう。例えば、スレッド又はプロセスが処理の実行単位の一例である。待機処理部128は、タスクの待機時間に関して、秒単位の値を、タイマー割り込みの発生周期単位の値以下、単に周期数という。に換算する。具体的には、タスクは、OS12に対して待機要求を行う際に、待機時間を秒単位の値によって指定する。待機処理部128は、当該秒単位の値を、タイマー割り込みの周期によって除することにより、待機時間を周期数に換算する。待機処理部128は、換算結果の周期数を、加速解消部129又はタスク管理部125に通知する。例えば、待機要求に係るタスクがI/O処理を行うタスクであれば、当該周期数は、加速解消部129に通知される。一方、待機要求に係るタスクがI/O処理を行わないタスク例えば、CPU104のみで動作するタスクであれば、当該周波数は、直接的にタスク管理部125に通知される。直接的にとは、加速解消部129を経由せずに、ということである。なお、I/O処理とは、周辺I/Oデバイスdへの処理要求を行い、当該処理要求に対する応答を待機することをいう。加速解消部129は、I/O処理を行うタスクの待機時間に関して、加速値に基づく加速を解消する。具体的には、加速解消部129は、待機処理部128より通知された周期数を、加速値によって除することにより補正する。加速解消部129は、補正後の周期数以下、補正周期数という。をタスク管理部125に通知する。なお、加速値は、例えば、加速値受付部121より取得される。タスク管理部125は、OS12上で動作するタスクのスケジューリング等を行う。タスク管理部125は、タイマーリストTLを有する。タイマーリストTLは、各タスクのスケジュール情報である。例えば、タイマーリストTLには、各タスクを実行する時間が記録されている。時刻更新部126は、OS12が管理する時刻情報を更新する。割り込み回数更新部127は、割り込み回数を保持する変数の値を更新する。上記したように、タスク管理部125及び時刻更新部126は、タイマー割り込み捕捉部124によって呼び出される。すなわち、タスク管理部125及び時刻更新部126は、タイマー割り込みの発生を契機として処理を実行する。したがって、タイマー割り込みの周期が加速されることにより、タスク管理部125及び時刻更新部12等の処理周期も加速される。その結果、タスク管理に関する時間が加速短縮されたり、時刻の進行が加速されたりする。例えば、タスク管理部125は、待機中のタスクの起床時期を、待機処理部128より通知される周期数又は加速解消部129より通知される補正周期数を用いて検知する。すなわち、タスク管理部125は、待機開始後のタイマー割り込みが、当該周期数又は当該補正周期数によって示される回数分発生したことによって、待機時間の満了を検知する。換言すれば、タスク管理部125は、当該周期数又は当該補正周期数の示す回数のタイマー割り込みの発生によって、待機時間を計測する。したがって、待機時間が、加速解消部129より通知される補正周期数に基づいて計測される場合、当該待機時間は加速されたものとなる。すなわち、当該待機時間は、タスクによって指定された実時間より短縮されたものとなる。一方、待機時間が、待機処理部128より通知される周期数に基づいて計測される場合、当該待機時間は加速されたものにはならない。すなわち、当該待機時間は、タスクによって指定された実時間通りとなる。以下、試験装置10における処理手順について説明する。図5は、加速値受付部が実行する処理手順の一例を説明するためのフローチャートである。ステップS101において、加速値受付部121は、加速値設定部11より加速値を受け付ける。続いて、加速値受付部121は、当該加速値を、カウンタ値加速部123及び加速解消部129のそれぞれに通知するS102。続いて、待機処理部128について説明する。図6は、第一の実施の形態の待機処理部の機能構成例を示す図である。同図において、待機処理部128は、待機要求受付部131、識別情報取得部132、待機時間換算部133、及び判定部134等を有する。待機要求受付部131は、タスクより待機要求を受け付ける。待機要求は、例えば、wait関数をインタフェースとして受け付けられる。識別情報取得部132は、待機要求に係るタスク以下、待機タスクという。が、I/O処理を実行するタスクであるか否かを識別又は判定するための識別情報を取得する。第一の実施の形態では、タスク名が当該識別情報として利用される。タスク名とは、例えば、タスクに係るプログラムファイル名である。したがって、識別情報取得部132は、待機タスクよりタスク名を取得する。なお、待機処理部128は、各タスクと同一プロセス空間内で処理を実行する。したがって、識別情報取得部132は、待機タスクのタスク名を容易に取得することができる。待機時間換算部133は、待機要求において指定される、秒単位の待機時間を周期数に換算する。判定部134は、待機タスクの待機時間に関して、加速解消部129による補正加速の解消の要否を判定する。具体的には、判定部134は、識別情報取得部132によって取得される識別情報に基づいて、待機タスクがI/O処理を実行するか否かを判定する。第一の実施の形態では、当該識別情報としてのタスク名が、I/O処理識別テーブルTBに含まれているか否かによって、待機タスクがI/O処理を実行するか否かを判定する。判定部134は、判定結果に応じて、タスク管理部125又は加速解消部129に、周期数を通知する。I/O処理識別テーブルTBには、I/O処理を実行するタスクのタスク名の一覧が記録されている。I/O処理識別テーブルTBは、例えば、補助記憶装置102に記憶されている。続いて、待機処理部128の処理手順について説明する。図7は、第一の実施の形態の待機処理部が実行する処理手順の一例を説明するためのフローチャートである。待機要求受付部131によって、タスク待機タスクより待機要求が受け付けられるとS111でYes、識別情報取得部132は、待機タスクのタスク名を取得するS112。続いて、待機時間換算部133は、待機要求に指定された秒単位の待機時間を、タイマー割り込みの周期によって除することにより、周期数に換算するS113。続いて、判定部134は、待機タスクのタスク名がI/O処理識別テーブルTBに含まれているか否かに基づいて、待機タスクがI/O処理を実行するか否かを判定するS114。当該タスク名が、I/O処理識別テーブルTBに含まれている場合、すなわち、待機タスクがI/O処理を実行する場合S115でYes、判定部134は、加速解消部129に周期数を通知するS116。一方、当該タスク名が、I/O処理識別テーブルTBに含まれていない場合、すなわち、待機タスクがI/O処理を実行しない場合S115でNo、判定部134は、タスク管理部125に周期数を通知するS117。タスク管理部125は、当該周期数に基づいて、待機タスクの起床時期をタイマーリストTLに登録する。続いて、加速解消部129の処理手順について説明する。図8は、加速解消部が実行する処理手順の一例を説明するためのフローチャートである。待機処理部128より周期数が通知されるとS121でYes、加速解消部129は、当該周期数を加速値によって除することにより、補正周期数を算出するS122。なお、加速値は、図5のステップS102において、加速値受付部121より通知されている。続いて、加速解消部129は、補正周期数をタスク管理部125に通知するS123。タスク管理部125は、当該補正周期数に基づいて、待機タスクの起床時期をタイマーリストTLに登録する。続いて、図4に示される各部が連携して実行する全体の処理手順について説明する。図9は、試験装置全体の処理手順の一例を説明するためのフローチャートである。カウンタ部141は、カウンタ値加速部123より設定されたカウンタ値をカウンタ周波数に基づく周期で1ずつ減算するS201、S202。カウンタ値が0になると、割り込み部142は、タイマー割り込みを発生させるS203。タイマー割り込みは、タイマー割り込み捕捉部124によって捕捉される。タイマー割り込み部142は、タイマー割り込みの捕捉に応じ、タスク管理部125、時刻更新部126、割り込み回数更新部127、及びカウンタ値設定部122等を呼び出すS204。タスク管理部125は、タイマー割り込み捕捉部124からの呼び出しに応じ、起動時期又は起床時期となったタスクを起動又は起床させるS205。また、時刻更新部126は、タイマー割り込み捕捉部124からの呼び出しに応じ、OS12が管理する時刻情報を更新するS206。また、割り込み回数更新部127は、タイマー割り込み捕捉部124からの呼び出しに応じ、割り込み回数を保持する変数の値に1を加算するS207。また、カウンタ値設定部122は、タイマー割り込み捕捉部124からの呼び出しに応じ、カウンタ値を算出する。カウンタ値は、タイマー割り込み捕捉部124からの呼び出し時に通知される、タイマー割り込みの周波数タイマー割り込みの周期の逆数によってカウンタ周波数を除することにより算出される。カウンタ値設定部122は、算出されたカウンタ値をカウンタ値加速部123へ通知するS208。カウンタ値加速部123は、通知されたカウンタ値に、加速値受付部121より通知されている加速値を乗ずることにより、加速されたカウンタ値を算出する。カウンタ値加速部123は、算出されたカウンタ値をカウンタ部141に設定するS209。一方、ステップS205において起動されたタスクは、所定の処理を実行するS211。例えば、タスクは、周辺I/Oデバイスdへ処理要求を行う。タスクは、当該処理要求に対する応答を待機するため、待機時間を指定して、待機処理部128に待機要求を入力するS212。待機処理部128は、当該タスク内例えば、当該タスクに係るプロセス空間において、図7を用いて説明した待機処理を実行するS213。なお、当該タスクは、I/O処理を実行するため、当該タスクのタスク名は、I/O処理識別テーブルTBに登録されている。したがって、タスク管理部125には、補正周期数すなわち、加速が解消された周期数が通知される。その結果、当該タスクは、補正周期数が示す回数のタイマー割り込みの発生後、すなわち、待機要求に指定した秒数通りの時間の経過後に、起床される。続いて、試験装置10の動作例について、各パラメータに具体的な値を当てはめて説明する。図10は、タイマー割り込みの周期を加速しない場合の試験装置の動作の具体例を説明するための図である。同図において、カウンタ周波数は、66MHz、タイマー割り込みの周波数は、250Hzすなわち、タイマー割り込みの周期は、4ミリ秒であるとする。ステップS301において、加速値受付部121は、加速値設定部11より、加速値として1の設定を受け付ける。すなわち、タイマー割り込みの周期を加速しないことが設定される。続いて、加速値受付部121は、カウンタ値加速部123及び加速解消部129に、加速値として1を通知するS302。タイマー割り込み捕捉部124は、4ミリ秒の周期でタイマー割り込みを発生させるために、4ミリ秒の逆数である250Hzを、タイマー割り込みの周波数として、カウンタ値設定部122に設定するS303。カウンタ値設定部122は、カウンタ周波数66MHzをタイマー割り込みの周波数250Hzで除することにより、カウンタ値266666を算出し、当該カウンタ値をカウンタ値加速部123に設定するS304。カウンタ値加速部123は、カウンタ値に加速値を乗じた値266666×1=266666を、カウンタ値としてカウンタ部141に設定するS305。カウンタ部141は、1000/66MHzの周期で、カウンタ値266666をデクリメントし、カウンタが0になった時点で割り込み部142へ通知を行うS306。割り込み部142は、カウンタ部141からの通知に応じて、タイマー割り込みを発生させるS307。タイマー割り込み捕捉部124は、タイマー割り込みの発生に応じて、ステップS303を実行する。すなわち、ステップS303以降は、タイマー割り込みの発生に応じて繰り返し実行される。その結果、266666/66MHz=4ミリ秒の周期で、タイマー割り込みが発生する。このような状態において、タスク1、2、及び3がOS12上で動作しており、タスク3が、I/O処理を実行するタスクであるとする。すなわち、タスク3のタスク名は、I/O処理識別テーブルTBに登録されていることとする。ここから先は、図10に加え、図11も参照しながら説明する。図11は、タイマー割り込みの周期を加速しない場合の試験装置におけるタスク動作と時間との関係の一例を示す図である。同図は、処理の実行主体ごとに、処理の実行タイミングを示す。すなわち、同図の水平方向は、時間軸を示す。一方、垂直方向には、処理の実行主体として、タスク管理部125、加速解消部129、待機処理部128、タスク1、タスク2、タスク3、及び周辺ハードウェアd等が列挙されている。周辺I/Oデバイスdに対して処理要求を行った後、タスク3は、16ミリ秒の待機時間を指定して、待機処理部128に対して待機要求を行うS308。待機処理部128は、カウンタ値設定部122よりタイマー割り込み周波数250Hzを取得し、待機要求に指定された待機時間16ミリ秒を周期数に換算する。周期数は、待機時間16ミリ秒をタイマー割り込み周期1000/250Hzで除することにより算出される。したがって、16ミリ秒/1000/250Hz=4周期が、周期数となる。タスク3のタスク名はI/O処理識別テーブルTBに登録されている。したがって、待機処理部128は、当該周期数を加速解消部129に通知するS309。加速解消部129は、当該周期数を加速値受付部121より通知された加速値によって除することにより、補正周期数を算出する。したがって、補正周期数は、4/1=4周期となる。加速解消部129は、当該補正周期数をタスク管理部125に通知するS310。タスク管理部125は、通知された補正期数分のタイマー割り込みの発生後に、タスク3を起床させるS311。ここで、タイマー割り込みの周期は4ミリ秒である。したがって、4×4=16ミリ秒後に、タスク3は起床される。すなわち、タスク3が待機要求に指定した待機時間通りにタスク3は起床される。一方、周辺I/Oデバイスdの処理時間は、12ミリ秒である。したがって、タスク3は、起床後において、周辺I/Oデバイスdからの応答を得ることができ、処理を継続することができる。次に、タイマー割り込みの周期を2分の1に加速した場合について説明する。図12は、タイマー割り込みの周期を2分の1に加速した場合の試験装置の動作の具体例を説明するための図である。同図において、カウンタ周波数は、66MHz、タイマー割り込みの周波数は、250Hzすなわち、タイマー割り込みの周期は、4ミリ秒であるとする。ステップS401において、加速値受付部121は、加速値設定部11より、加速値として0.5の設定を受け付ける。すなわち、タイマー割り込みの周期を2分の1に加速することが設定される。続いて、加速値受付部121は、カウンタ値加速部123及び加速解消部129に、加速値として0.5を通知するS402。タイマー割り込み捕捉部124は、4ミリ秒の周期でタイマー割り込みを発生させるために、4ミリ秒の逆数である250Hzを、タイマー割り込みの周波数として、カウンタ値設定部122に設定するS403。カウンタ値設定部122は、カウンタ周波数66MHzをタイマー割り込みの周波数250Hzで除することにより、カウンタ値266666を算出し、当該カウンタ値をカウンタ値加速部123に設定するS404。カウンタ値加速部123は、カウンタ値に加速値を乗じた値266666×0.5=133333を、カウンタ値としてカウンタ部141に設定するS405。カウンタ部141は、1000/66MHzの周期で、カウンタ値133333をデクリメントし、カウンタが0になった時点で割り込み部142へ通知を行うS406。割り込み部142は、カウンタ部141からの通知に応じて、タイマー割り込みを発生させるS407。タイマー割り込み捕捉部124は、タイマー割り込みの発生に応じて、ステップS403を実行する。すなわち、ステップS403以降は、タイマー割り込みの発生に応じて繰り返し実行される。その結果、133333/66MHz=2ミリ秒の周期で、タイマー割り込みが発生する。このような状態において、タスク1、2、及び3がOS12上で動作しており、タスク3が、I/O処理を実行するタスクであるとする。すなわち、タスク3のタスク名は、I/O処理識別テーブルTBに登録されていることとする。ここから先は、図12に加え、図13も参照しながら説明する。図13は、タイマー割り込みの周期を2分の1に加速した場合の試験装置におけるタスク動作と時間との関係の一例を示す図である。同図の見方は、図11と同じである。周辺I/Oデバイスdに対して処理要求を行った後、タスク3は、16ミリ秒の待機時間を指定して、待機処理部128に対して待機要求を行うS408。待機処理部128は、カウンタ値設定部122よりタイマー割り込み周波数250Hzを取得し、待機要求に指定された待機時間16ミリ秒を周期数に換算する。周期数は、待機時間16ミリ秒をタイマー割り込み周期1000/250Hzで除することにより算出される。したがって、16ミリ秒/1000/250Hz=4周期が、周期数となる。タスク3のタスク名はI/O処理識別テーブルTBに登録されている。したがって、待機処理部128は、当該周期数を加速解消部129に通知するS409。加速解消部129は、当該周期数を加速値受付部121より通知された加速値によって除することにより、補正周期数を算出する。したがって、補正周期数は、4/0.5=8周期となる。加速解消部129は、当該補正周期数をタスク管理部125に通知するS410。タスク管理部125は、通知された補正周期数分のタイマー割り込みの発生後に、タスク3を起床させるS411。ここで、タイマー割り込みの周期は2ミリ秒である。したがって、2×8=16ミリ秒後に、タスク3は起床される。すなわち、タスク3が待機要求に指定した待機時間通りにタスク3は起床される。一方、周辺I/Oデバイスdの処理時間は、12ミリ秒である。したがって、タスク3は、起床後において、周辺I/Oデバイスdからの応答を得ることができ、処理を継続することができる。上述したように、第一の実施の形態によれば、タイマー割り込みの周期を加速又は短縮させる一方で、該周期とは非同期に動作するハードウェアからの応答の待機時間に関しては、該加速を解消させることができる。すなわち、当該待機時間に関して、実時間に戻すことができる。したがって、タイマー割り込みの周期と非同期に動作するハードウェアに関するI/O処理を含むソフトウェア全体の加速試験の実施を可能とすることができる。その結果、例えば、一定周期でインクリメント又はデクリメントされる変数のオーバーフロー又はアンダーフローを短時間で検出することができる。また、ソフトウェアの長期稼動の安定性の確認に要する時間を短縮化することができる。また、タイマー等に基づいて、予め決められた日時又は時刻でスケジュールされた動作するソフトウェア又は当該ソフトウェアによって制御される装置に関して、スケジュールの内容を変更することなく、試験の所要時間を短縮することができる。なお、タイマー割り込みの周期とは非同期な対象は、ハードウェアに限られない。例えば、試験装置10とネットワークを介して接続されるコンピュータにおいて動作するソフトウェアであってもよい。すなわち、試験装置10において動作するタスクが、当該ソフトウェアに対して処理要求を行い、当該処理要求に対する応答を待機する際に、加速の解消が行われてもよい。次に、第二の実施の形態について説明する。第二の実施の形態では、待機処理部128が実行する処理内容の一部が、第一の実施の形態と異なる。図14は、第二の実施の形態の待機処理部の機能構成例を示す図である。図14中、図6と同一部分には同一符号を付し、その説明は省略する。第二の実施の形態において、I/O処理を実行する待機タスクは、I/O処理のための待機であるか否を示すフラグ情報を、例えば、メモリ装置103に記録する。待機処理部128の識別情報取得部132は、当該フラグ情報をメモリ装置103より取得する。判定部134は、当該フラグ情報に基づいて、待機タスクが、I/O処理のための待機であるのか否かを判定し、判定結果に応じて、周期数をタスク管理部125又は加速解消部129に通知する。このように、待機要求に係るタスクがI/O処理のための待機であるのか否かの判定方法は、所定の方法に限定されない。上記以外においても、例えば、I/O処理のための待機要求とそうでない待機要求とを受け付けるためのAPIApplicationProgramInterfaceが明確に区別されてもよい。また、待機要求に係るタスクがアクセスする仮想アドレスを監視し、当該仮想アドレスが、周辺I/OデバイスdのメモリマップドI/O領域に対応するものであれば、当該タスクによる待機要求は、I/O処理のための待機に関するものであると判定されてもよい。すなわち、待機要求に係るタスクに関する何らかの識別情報に基づいて、I/O処理のための待機であるか否かが判定されればよい。次に、第三の実施の形態について説明する。第三の実施の形態では、予め指定した実際の日時に加速試験を自動的に開始させ、予め指定した実際の日時に加速試験を自動的に終了させたい場合について説明する。図15は、第三の実施の形態を説明するための図である。図15中、図4と同一部分には同一符号を付し、その説明は省略する。また、図15において、OS12の構成要素の一部は、便宜上省略されている。同図において、タスク1は、タスク1は、RTCRealTimeClock30を周期的に読み出す常駐型のプログラムである。また、例えば、補助記憶装置102には、試験開始日時及び試験終了日時が予め記録されている。なお、RTC30は電源が切られている間も内蔵電池から電源供給を受けて、時刻の更新を行っている時計であり、情報処理装置には一般的に採用されている。タスク1は、周期的に、RTC30より時刻情報を読み出した時刻情報と、試験開始日時とを比較する。タスク1は、試験開始日時の到来を検知すると、加速値設定部11に0より大きく1未満の加速値を設定する。加速値設定部11は、当該加速値を、加速値受付部121に設定するS503。その結果、タイマー割り込みの周期が加速され、加速試験が行われる。一方、タスク1は、加速試験中においても、周期的に、RTC30より時刻情報を読み出した時刻情報と、試験終了日時とを比較する。タスク1は、試験終了日時の到来を検知すると、加速値設定部11に加速値として1を設定する。その結果、加速試験は終了する。なお、加速試験中において、タスク1自身も、加速された動作を行っているが例えば、RTC30の時刻情報の読み出し周期の短縮等が発生しているが、RTC30より読み出される時刻情報は、実際の時刻を示すものである。したがって、試験終了日時に指定された実際の日時に加速試験を終了させることができる。加速試験が実施されると、OS12の時刻情報も加速されるため、現在時刻の把握が困難となるが、本実施の形態によれば、加速動作中のタスクであっても実際の時刻を把握することができる。次に、第四の実施の形態について説明する。第四の実施の形態では、所定のシーケンスに基づいて、試験装置10が外部の被試験装置を制御する例について説明する。図16は、第四の実施の形態を説明するための図である。同図において、試験装置10と被試験装置50とは、例えば、LANLocalAreaNetwork等のネットワークを介して接続されている。試験装置10のハードウェア構成及び機能構成等は、図3又は図4において説明した通りである。試験装置10上で動作するタスク以下、試験タスクという。は、被試験装置50の電源のON/OFF制御を、予め設定されたスケジュールで繰り返し実行する。このような場合、試験装置10のOS12に、0より大きく1未満の加速値を設定することで、当該スケジュールを早期に消化することができる。但し、被試験装置50は、電源OFFの指示の受け付け後に電源がOFFされるまで或る程度時間を要し、また、電源ONの指示の受け付け後に定常状態となるまでに或る程度時間を要する。したがって、試験タスクには、被試験装置50が電源ON時又は電源OFF時に必要とする時間を考慮した制御が求められる。但し、スケジュール情報において、当該時間が考慮されたスケジュールが設定されていたとしても、加速試験中においては、当該時間も加速されてしまう。そこで、試験装置10は、試験タスクを、図17に示されるように動作させる。図17は、第四の実施の形態における試験タスク及び被試験装置の動作例を示す図である。同図において、L1で示される線は、試験タスクのON/OFF制御を示す。一方、L2で示される線は、試験タスクのON/OFF指示に応じて被試験装置50のON/OFF動作を示す。また、M1で示される部分には、試験装置10の動作状態加速モード又は実時間モードが示されている。加速試験モードとは、OS12に対して0より大きく1未満の加速値が設定された状態、すなわち、タイマー割り込みの周期が加速された状態を示す。実時間モードは、OS12に対して加速値として1が設定された状態、すなわち、タイマー割り込みの周期が加速されていない状態を示す。なお、横軸に付与されている時刻は、試験装置10のOS12が管理する時刻情報が示す時刻である。例えば、試験タスクは、スケジュール情報に基づいて、8:00に電源ONの指示を被試験装置50に対して行うと共に、加速値として1を加速値設定部11に設定する。その結果、試験装置10は、実時間モードとなる。したがって、試験タスクは、スケジュール情報において指定されている、被試験装置50の制御開始時刻の8:10まで、実時間で待機する。一方、被試験装置50は、電源ONの指示を受けて、電源をONさせる。電源ONの開始後、被試験装置50は、10分弱を要して、定常状態となる。8:10になると、試験タスクは、加速値設定部11に0より大きく1未満の加速値を設定し、被試験装置50に対して各種の制御を遠隔的に行う。したがって、当該制御は、加速モードにおいて行われる。その後、スケジュール情報において、電源OFFの時刻として指定されている18:00になると、試験タスクは、被試験装置50は、加速値として1を加速値設定部11に設定する。その結果、試験装置10は、実時間モードとなる。したがって、試験タスクは、スケジュール情報において指定されている、被試験装置50の制御開始時刻の18:10まで、実時間で待機する。一方、被試験装置50は、電源OFFの指示を受けて、電源をOFFさせる。電源OFFの開始後、被試験装置50は、10分弱を要して、電源OFF状態となる。18:10になると、試験タスクは、加速値設定部11に0より大きく1未満の加速値を設定し、例えば、電源がOFFされたか否かの確認等を被試験装置50関して行う。したがって、当該確認等は、加速モードにおいて行われる。上記のように、加速試験モードと実時間モードとを適切に切り替えることで、被試験装置50の電源ON時又は電源OFF時の所要時間に同期させつつ、かつ、試験全体に要する時間を短縮することができる。なお、第四の実施の形態では、被試験装置50の電源のON/OFF制御を一例として説明しているが、ON/OFF時以外において、試験装置10と被試験装置50との間で経過時間を合わせたい場合に、実時間モードへの切り替えが行われてもよい。ところで、第四の実施の形態の試験タスクに係るプログラムが、加速試験を予定しないで実装されている場合、すなわち、当該プログラムに加速値設定部11への加速値の設定処理が実装されていない場合、例えば、図18に示されるように、当該プログラムが改変されてもよい。図18は、第四の実施の形態の試験タスクに係るプログラムの改変例を示す図である。同図において、Aは、改変前のプログラム領域を示す。当該プログラム領域には、電源ONの指示を行うための領域ON指示領域と、電源OFFの指示を行うための領域OFF指示領域とが含まれる。斯かるプログラム領域に対して、ON指示領域及びOFF指示領域の前後に、加速値の設定ステップを追加するバイナリパッチを適用することにより、当該プログラム領域をBに示されるように改変することができる。Bにおいては、ON指示領域又はOFF指示領域の前に加速値として1を設定するステップが含まれている。また、ON指示領域又はOFF指示領域の後に加速値として0<α<1を設定するステップが含まれている。Bに示されるプログラム領域を有することにより、試験タスクは、図17において説明した制御を行うことができる。なお、本実施の形態において、カウンタ値加速部123は、短縮部の一例である。加速解消部129は、補正部の一例である。タスク管理部125は、計測部の一例である。以上、本発明の実施例について詳述したが、本発明は斯かる特定の実施形態に限定されるものではなく、特許請求の範囲に記載された本発明の要旨の範囲内において、種々の変形変更が可能である。以上の説明に関し、更に以下の項を開示する。付記1タイマー割り込みの第一の周期を、所定の係数を乗じた第二の周期に短縮させ、前記タイマー割り込みとは非同期な処理を待機するタスクの待機時間について、前記第一の周期単位の周期数を前記所定の係数で除した周期数に補正し、補正後の前記周期数の前記タイマー割り込みの発生により前記待機時間を計測する処理をコンピュータが実行する試験方法。付記2タスクからの待機要求に応じ、前記非同期な処理を待機するタスクに関する識別情報を記憶する記憶部を参照して、該待機要求に係るタスクに関して前記周期数の補正の要否を判定する処理を前記コンピュータが実行する付記2記載の試験方法。付記3タイマー割り込みの第一の周期を、所定の係数を乗じた第二の周期に短縮させ、前記タイマー割り込みとは非同期な処理を待機するタスクの待機時間について、前記第一の周期単位の周期数を前記所定の係数で除した周期数に補正し、補正後の前記周期数の前記タイマー割り込みの発生により前記待機時間を計測する処理をコンピュータに実行させる試験プログラム。付記4タスクからの待機要求に応じ、前記非同期な処理を待機するタスクに関する識別情報を記憶する記憶部を参照して、該待機要求に係るタスクに関して前記周期数の補正の要否を判定する処理を前記コンピュータに実行させる付記3記載の試験プログラム。付記5タイマー割り込みの第一の周期を、所定の係数を乗じた第二の周期に短縮させる短縮部と、前記タイマー割り込みとは非同期な処理を待機するタスクの待機時間について、前記第一の周期単位の周期数を前記所定の係数で除した周期数に補正する補正部と、補正後の前記周期数の前記タイマー割り込みの発生により前記待機時間を計測する計測部とを有する情報処理装置。付記6タスクからの待機要求に応じ、前記非同期な処理を待機するタスクに関する識別情報を記憶する記憶部を参照して、該待機要求に係るタスクに関して前記周期数の補正の要否を判定する判定部を有する付記5記載の情報処理装置。