撮像素子と、前記撮像素子により取得された動画像データを格納するメインメモリと、前記メインメモリに格納された動画像データを圧縮処理する動画圧縮部と、前記撮像素子により取得された動画像データから任意のタイミングで静止画フレームを取得する静止画フレーム取得部と、前記静止画フレーム取得部により取得された静止画フレームの一部である静止画データを格納するラインメモリと、前記ラインメモリに格納された静止画データを圧縮処理する静止画圧縮部とを有し、前記静止画圧縮部は、前記動画像データの前記メインメモリへの格納と並行してリアルタイムで前記静止画データを圧縮処理し、前記メインメモリは、前記動画像データを格納すると共に、前記静止画圧縮部によりリアルタイムで圧縮処理された圧縮データを格納することを特徴とする画像処理装置。前記画像処理装置はタイミング調整用バッファをさらに有し、前記タイミング調整用バッファは、前記動画像データが前記メインメモリへ格納される際のタイミングと、前記静止画圧縮部によりリアルタイムで圧縮処理された圧縮データが前記メインメモリへ格納される際のタイミングとを調整することを特徴とする請求項1に記載の画像処理装置。前記ラインメモリは、3面以上のnnは1以上の整数ラインからなるメモリから構成され、それらメモリの一部は、前記静止画圧縮部による前記静止画データの圧縮処理における処理レートの変動を吸収するバッファとして機能すると共に、その圧縮処理後の圧縮データが前記ラインメモリへ格納される際のタイミングを調整するバッファとして機能することを特徴とする請求項1又は2に記載の画像処理装置。前記画像処理装置はサイズ変換部をさらに有し、前記サイズ変換部は前記静止画フレーム選択部により選択された静止画フレームのサイズをリアルタイムに変換することを特徴とする請求項1~請求項3のいずれか1項に記載の画像処理装置。前記画像処理装置は主画像サイズ変換部及び副画像サイズ変換部をさらに有し、前記主画像サイズ変換部は前記静止画フレーム取得部により取得された静止画フレームのサイズをリアルタイムに変換して主画像データを生成し、前記副画像サイズ変換部は前記静止画フレーム取得部により取得された静止画フレームのサイズをリアルタイムに変換して副画像データを生成することを特徴とする請求項1~請求項4のいずれか1項に記載の画像処理装置。前記副画像サイズ変換部は、前記主画像サイズ変換部が生成した前記主画像データのサイズをリアルタイムに変換して副画像データを生成することを特徴とする請求項5に記載の画像処理装置。前記ラインメモリは、前記主画像サイズ変換部により生成された主画像データの一部を格納し、前記静止画圧縮部は、前記動画像データの前記メインメモリへの格納と並行してリアルタイムで前記主画像データを圧縮処理し、前記副画像サイズ変換部が生成した副画像データは圧縮処理することなく前記メインメモリに格納することを特徴とする請求項5項に記載の画像処理装置。前記サイズ変換部はサイズ変換用ラインメモリを備え、前記サイズ変換用ラインメモリは、前記静止画フレーム、前記主画像データ又は前記副画像データの一部を格納するラインメモリを有する、ことを特徴とする請求項1~請求項7のいずれか1項に記載の画像処理装置。前記画像処理装置は動画像用サイズ変換部をさらに有し、前記動画サイズ変換部は前記撮像素子により取得された動画像データのサイズを変換すし、前記メインメモリは、前記動画像用サイズ変換部によりサイズ変換された動画像データを格納することを特徴とする請求項1~請求項8のいずれか1項記載の画像処理装置。前記メインメモリは、前記撮像素子により取得された第1動画像データ又は外部メモリから読み込まれた圧縮動画データが伸張された第2動画像データを格納し、前記ラインメモリは、前記メインメモリから読み出された前記第1又は第2動画データから任意のタイミングで取得された静止画フレームの一部である静止画データを格納し、前記静止画圧縮部は前記ラインメモリに格納された前記静止画データの圧縮処理を行う、請求項1~請求項9のいずれか1項に記載の画像処理装置。撮像素子により取得された動画像データをメインメモリに格納する動画像格納工程と、前記撮像素子により取得された動画像データから任意のタイミングで取得された静止画フレームの一部である静止画データをラインメモリに格納するラインメモリ格納工程と、前記ラインメモリに格納された前記静止画データに対しリアルタイムで圧縮処理を行う静止画圧縮工程と、前記静止画圧縮工程にてリアルタイムに圧縮処理された圧縮データを前記メインメモリに格納する静止画格納工程とを有し、前記動画格納工程と、前記ラインメモリ格納工程から静止画格納工程の全工程が並行して実施されることを特徴とする画像処理方法。動画像の記録と並行して静止画像の記録処理をコンピュータに実行させるためのプログラムであって、撮像素子により取得された動画像データをメインメモリに格納する動画像格納処理と、前記撮像素子により取得された動画像データから任意のタイミングで取得された静止画フレームの一部である静止画データをラインメモリに格納するラインメモリ格納処理と、前記ラインメモリに格納された前記静止画データに対しリアルタイムで圧縮処理を行う静止画圧縮処理と、前記静止画圧縮処理にてリアルタイムに圧縮処理された圧縮データを前記メインメモリに格納する静止画格納処理とを有し、前記動画像格納処理と、前記ラインメモリ格納処理、前記静止画圧縮処理及び前記静止画格納処理とを並行して実施することを特徴とするプログラム。上述の特許文献1を含む従来の撮像装置においては、通常、静止画撮影をする際には、撮像素子等を介して取得された画像データを一度メインメモリに格納し、画質補正等を行った後にJPEG等の形式で圧縮して主画像ストリームを生成する。更に、必要に応じてメインメモリの画像をサムネイル用のサイズにサイズ変換してJPEG等の形式で圧縮してサムネイル用のストリームを生成する。そして、これらをEXIFとしてパッケージすることで一般的なJPEGファイルが生成される。この一連の処理以下、静止画エンコード処理という。においては、1メインメモリへの画像データの書き込み処理2メインメモリから画像データを読み出しながら、読み出された画像データをJPEG形式へエンコード処理3エンコード処理されたデータのメインメモリへのストリームの書き込み処理等の処理によりメインメモリに対するアクセスが多数発生するため、メモリバス帯域を圧迫する。このため、メモリ処理クロック周波数を高くしたりバス幅を広げたりする必要が生じ、結果、コストが高くなったり、消費電力が増加する等の問題点があった。高速に静止画エンコード処理を行なおうとすると上記問題点が顕著となる。特に動画撮影と共に静止画撮影をする場合、撮像素子から取得された動画像データをメインメモリに書き込むのと同時に、静止画データをメインメモリに書き込み、エンコードして再度メインメモリへ書き込むという一連の静止画エンコード処理が必要となるが、この場合、動画像データをメインメモリに書き込む処理と静止画データをメインメモリに書き込む処理を同時に行うと、メモリのバス帯域が不足するため、高速に静止画データを取得することが不可能となる。すなわち、従来の撮像装置のように、フレームメモリに静止画データを書き込んでから静止画エンコード処理を動画撮影に伴う処理と同時に行なう場合は、フレームメモリのバス帯域が不足するため、同一フレーム期間に書き込みと読み出しを同時に行うことができない。このため、約10枚以上ないし全フレームの静止画エンコード処理が不可能となり、例えば1秒60フレームからなる動画像において、60フレームのうち処理可能な数枚のフレームを選択してJPEGファイル化を行わなければならないという問題点があった。また、ユーザが主画像サイズとして、撮像素子から出力されるサイズではなく1/2や1/3などの縮小サイズを望む場合、更に主画像のリサイズ処理のために時間がかかり高速な静止画処理ができなくなる。本発明は、このような問題点を解決するためになされたものであり、動画撮影と並行して、高速に静止画データをリアルタイムにエンコードしてメインメモリに格納することが可能な撮像装置、撮像方法、及びプログラムを提供することを目的とする。本発明にかかる画像処理装置は、撮像素子と、前記撮像素子により取得された動画像データを格納するメインメモリと、前記メインメモリに格納された動画像データを圧縮処理する動画圧縮部と、前記撮像素子により取得された動画像データから任意のタイミングで静止画フレームを取得する静止画フレーム取得部と、前記静止画フレーム取得部により取得された静止画フレームの一部である静止画データを格納するラインメモリと、前記ラインメモリに格納された静止画データを圧縮処理する静止画圧縮部とを有し、前記静止画圧縮部は、前記動画像データの前記メインメモリへの格納と並行してリアルタイムで前記静止画データを圧縮処理し、前記メインメモリは、前記動画像データを格納すると共に、前記静止画圧縮部によりリアルタイムで圧縮処理された圧縮データを格納するものである。また、前記画像処理装置はタイミング調整用バッファをさらに有し、前記タイミング調整用バッファは、前記動画像データが前記メインメモリへ格納される際のタイミングと、前記静止画圧縮部によりリアルタイムで圧縮処理された圧縮データが前記メインメモリへ格納される際のタイミングとを調整することができる。さらに、前記ラインメモリは、3面以上のnnは1以上の整数ラインからなるメモリから構成され、それらメモリの一部は、前記静止画圧縮部による前記静止画データの圧縮処理における処理レートの変動を吸収するバッファとして機能すると共に、その圧縮処理後の圧縮データが前記ラインメモリへ格納される際のタイミングを調整するバッファとして機能させることができ、ラインメモリを3面以上有することで、圧縮後のデータをメインメモリに格納する際等のタイミングを制御することができる。さらにまた、前記画像処理装置はサイズ変換部をさらに有し、前記サイズ変換部は前記静止画フレーム選択部により選択された静止画フレームのサイズをリアルタイムに変換することができ、静止画フレームのサイズをリアルタイムで変換することができる。また、前記画像処理装置は主画像サイズ変換部及び副画像サイズ変換部をさらに有し、前記主画像サイズ変換部は前記静止画フレーム取得部により取得された静止画フレームのサイズをリアルタイムに変換して主画像データを生成し、前記副画像サイズ変換部は前記静止画フレーム取得部により取得された静止画フレームのサイズをリアルタイムに変換して副画像データを生成するものとすることができ、主画像と共に副画像サイズの画像を取得することができる。また、前記副画像サイズ変換部は、前記主画像サイズ変換部が生成した前記主画像データのサイズをリアルタイムに変換して副画像データを生成することができ、主画像サイズに縮小されたデータを使用して副画像データを生成するため、副画像サイズ変換処理を軽くすることができる。さらに、前記ラインメモリは、前記主画像サイズ変換部により生成された主画像データの一部を格納し、前記静止画圧縮部は、前記動画像データの前記メインメモリへの格納と並行してリアルタイムで前記主画像データを圧縮処理し、前記副画像サイズ変換部が生成した副画像データは圧縮処理することなく前記メインメモリに格納するものとすることができ、副画像データは容量が小さいため、リアルタイムで圧縮しなくてもよい。さらにまた、前記サイズ変換部はサイズ変換用ラインメモリを備え、前記サイズ変換用ラインメモリは、前記静止画フレーム、前記主画像データ又は前記副画像データの一部を格納するラインメモリを有することができ、サイズ変換部からの出力タイミングを調整する等することができる。また、前記画像処理装置は動画像用サイズ変換部をさらに有し、前記動画サイズ変換部は前記撮像素子により取得された動画像データのサイズを変換すし、前記メインメモリは、前記動画像用サイズ変換部によりサイズ変換された動画像データを格納することができ、動画像データのサイズを変換することも可能である。さらに、前記メインメモリは、前記撮像素子により取得された第1動画像データ又は外部メモリから読み込まれた圧縮動画データが伸張された第2動画像データを格納し、前記ラインメモリは、前記メインメモリから読み出された前記第1又は第2動画データから任意のタイミングで取得された静止画フレームの一部である静止画データを格納し、前記静止画圧縮部は前記ラインメモリに格納された前記静止画データの圧縮処理を行うことができ、メインメモリに格納されている非圧縮の動画像データから静止画フレームを取得し、その圧縮データを生成することができる。本発明にかかる画像処理方法は、撮像素子により取得された動画像データをメインメモリに格納する動画像格納工程と、前記撮像素子により取得された動画像データから任意のタイミングで取得された静止画フレームの一部である静止画データをラインメモリに格納するラインメモリ格納工程と、前記ラインメモリに格納された前記静止画データに対しリアルタイムで圧縮処理を行う静止画圧縮工程と、前記静止画圧縮工程にてリアルタイムに圧縮処理された圧縮データを前記メインメモリに格納する静止画格納工程とを有し、前記動画格納工程と、前記ラインメモリ格納工程から静止画格納工程の全工程が並行して実施されるものである。本発明にかかるプログラムは、動画像の記録と並行して静止画像の記録処理をコンピュータに実行させるためのプログラムであって、撮像素子により取得された動画像データをメインメモリに格納する動画像格納処理と、前記撮像素子により取得された動画像データから任意のタイミングで取得された静止画フレームの一部である静止画データをラインメモリに格納するラインメモリ格納処理と、前記ラインメモリに格納された前記静止画データに対しリアルタイムで圧縮処理を行う静止画圧縮処理と、前記静止画圧縮処理にてリアルタイムに圧縮処理された圧縮データを前記メインメモリに格納する静止画格納処理とを有し、前記動画像格納処理と、前記ラインメモリ格納処理、前記静止画圧縮処理及び前記静止画格納処理とを並行して実施するものである。本発明によれば、動画撮影と並行して、高速に静止画データをリアルタイムにエンコードしてメインメモリに格納することが可能な撮像装置、撮像方法、及びプログラムを提供することができる。以下、本発明を適用した具体的な実施の形態について、図面を参照しながら詳細に説明する。この実施の形態は、本発明を、動画像の取得と並列して高速に静止画像を取得することができる撮像装置に適用したものである。上述したように、動画撮影と共に静止画撮影をする場合、従来は、メインメモリのバス帯域が不足するため、1秒間60フレームとしても、せいぜい数枚乃至10枚の静止画フレームを取得することしかできない。これに対し、本実施の形態にかかる撮像装置は、メインメモリの上記バス帯域に関する問題を解決するため、動画撮影と共に静止画撮影をする場合であっても、毎秒10枚以上の高速撮影が可能である。さらには、通常撮像素子から出力されるフレームレート同等の速度、例えば毎秒60フレームのうち、全フレームを静止画フレームとして取得することができるものである。<本発明の実施の形態1>図1は、本実施の形態にかかる撮像装置を示すブロック図である。本実施の形態にかかる撮像装置1は、撮像素子を介して動画像データを取得しつつ、ユーザの指示に基づく任意のタイミングで動画像データから静止画フレームを取得し、その静止画フレームをリアルタイムでエンコード圧縮処理を行うものである。ここで、リアルタイムでのエンコード処理とは、動画像データカメラ画像の入力フレームレートと同じフレームレートで静止画フレームのエンコード処理、例えばJPEGエンコード処理を行うこという。また、以下では、静止画フレームは、ユーザの指示に基づく任意のタイミングで取得されるものとして説明するが、例えば、静止画フレーム自動取得モード等を用意し、被写体の笑顔等、特定の対象を自動で検知し、当該検知結果に応じて自動で静止画フレームを取得するようにしてもよい。上記動作を実現するため、撮像装置1は、レンズ11及びレンズを通じて入射した入射光を光電変換し画像データを生成する撮像素子12等からなる撮像部を有する。さらに、撮像装置1は、DDRDoubleDataRateメインメモリ16、動画コーデック20、ラインメモリ22、及びJPEGコーデック23を有している。これらDDRメインメモリ16、動画コーデック20、ラインメモリ22、及びJPEGコーデック23は、それぞれバス10を介して接続される。DDRメインメモリ16には、撮像素子12により取得された動画像データが書き込まれる。動画コーデック20は、メインメモリに書き込まれた動画像データを圧縮処理する動画圧縮部として機能する。動画コーデック20は、さらに、圧縮された画像データを伸張する動画像伸張部としても機能する、撮像素子12から取得された動画像データは一旦DDRメインメモリ16に書き込みされその後、動画コーデック20によりエンコード処理される。一方、静止画の方は、静止画フレーム取得部図示せずにより、撮像素子12で取得された動画像データから任意のタイミングで静止画フレームを取得し、ラインメモリ22にその静止画フレームの一部である静止画データを格納する。なお、例えば1秒間に60フレームからなる動画像データの60フレーム全部を静止画データとして取得する場合は、カメラ信号処理部13からの動画像データを順次ラインメモリ22に格納すればよく、静止画フレーム取得部は不要である。また、ユーザの指示により任意のタイミングで静止画フレームを取得する場合は、例えばユーザが撮像装置1の図示しないシャッタボタンを押下したタイミングに基づき、動画像データから所定枚数の静止画フレームから得られる静止画データをラインメモリ22に入力できるようにスイッチ動作するスイッチ等により構成することができる。また、JPEGコーデック23は、ラインメモリ22に格納された静止画データを圧縮処理する静止画圧縮部として機能する。JPEGコーデック23は、圧縮された静止画データを伸張する伸張部としても機能する。このJPEGコーデック23は、撮影中の動画像データのDDRメインメモリ16への書き込みと並行してリアルタイムで静止画データをエンコード処理する。このとき、DDRメインメモリ16は、動画像データが書き込まれると共に、JPEGコーデック23によりリアルタイムでエンコード処理されたエンコードデータが書き込まれる。このように構成された撮像装置1においては、動画像データから取得した静止画フレームをDDRメインメモリ16に書き込みせずに、直接リアルタイムにエンコードしてからDDRメインメモリ16に書き込みする。DDRメインメモリ16に撮像画像から取得された静止画フレーム以下、非圧縮の画像データを生データともいう。を書き込みせず、エンコードしてから書き込みするようにすることで、DDRメインメモリ16のバス10のバス帯域に対する負荷を低減する。このことにより、多画素の画像サイズの静止画データを1秒間に60フレーム等の速度で高速撮影処理することが可能となる。以下、本実施の形態にかかる撮像装置1について更に詳細に説明する。撮像装置1は、さらに、カメラ信号処理部13と、カメラ信号処理部13の制御のもと、レンズ11のズーム倍率や焦点距離を制御するズームフォーカス制御部14を有する。また、各ブロックを制御するCPUCentralProcessingUnit15、SDカードSDMemoryCard17、及びUSBUniversalSerialBus18を有する。さらに、サイズ変換部19、サイズ変換部21、ビデオ信号処理部24、HDMIHighDefinitionMultimediaInterface25及びLCDLiquidCrystalDisplay:液晶ディスプレイ26等を有する。各処理部は、バス10を介して接続されている。カメラ信号処理部13は、図示しない同期信号発生部やY/C処理部等を有している。同期信号発生部は、生成される画像データの水平サイズ及び垂直サイズに対応し、かつ内部クロックに同期した水平同期信号及び垂直同期信号を生成する。撮像部からの画像データは、この水平同期信号及び垂直同期信号に同期した画像データをカメラ信号処理部13に入力する。Y/C処理部では、撮像部により生成された複数の画像データを順次Y/C処理する。Y/C処理とは画像データを輝度データYと色データCに分離、変換する処理である。すなわち、カメラ信号処理部13は、撮像データから色分離、白バランス調整、及びY/C処理等の一連のカメラ信号処理した動画像データを出力する。サイズ変換部19は、カメラ信号処理部13から出力される動画像データのサイズを変換する。この動画像データは、一旦DDRメインメモリ16に書き込みされる。動画コーデック20は、記録時には、上述したように、一旦DDRメインメモリ16に書き込みされた動画像データを、例えばH264/AVC規格やMPEG2規格に準じた形式でエンコード処理を実施する。エンコード後のエンコードデータはDDRメインメモリ16に書き込みされ、必要に応じてSDカード17等の外部メモリに転送される。また、再生時には、例えばSDカード17等の外部メモリから読み出され、DDRメインメモリ16に書き込みされたエンコード済み動画像データに対してデコード処理を実施する。サイズ変換部21は上述のように静止画フレーム取得部図示せずにより取得された静止画フレームのサイズを変換する。なお、これらのサイズ変換部19及びサイズ変換部21は必要に応じて設ければよい。SDカード17は、大容量の外部記憶媒体であり、このSDカード17に動画像データや静止画データが書き込まれ、LCD26により表示する等することができる。SDカード17に格納されている画像データは、一旦DDRメインメモリ16に書き込みされ、動画コーデック20によりデコードされ、ビデオ信号処理部24を介してLCD26に出力されたり、HDMI25を介して出力されることができる。また、撮像装置1は、USB18を介して様々な周辺機器に接続される。ビデオ信号処理部24は、デコードした画像データをHDMI25やLCD26に応じた形式の出力データに変換する一連のビデオ信号処理を実施し、LCD26を介して画像を表示したり、HDMI25を介してテレビモニタ等の外部モニタ装置等に画像データを出力する。<通常撮影ルートと高速撮影ルート>ところで、本実施の形態にかかる撮像装置1は、DDRメインメモリ16に書き込みされた生データ又はデコード済みの動画像データから静止画フレームを取得し、サイズ変換部21によりサイズ変換し、ラインメモリ22を介してJPEGコーデック23によりエンコードしてDDRメインメモリ16に書き込みするというルートも有している。つまり、DDRメインメモリ16は、撮像素子12により取得された動画像データ第1動画像データ又はSDカード17等の外部メモリから読み込まれたエンコード済み動画像データがデコードされた動画像データ第2動画像データを書き込みする。この場合、第1動画像データ、第2動画像データについても、ユーザの指示等による任意のタイミングで静止画フレームが取得され、サイズ変換部21に出力される。そして、静止画フレームはサイズ変換部21によりその画像サイズが変換され、ラインメモリ22にその一部の静止画データが順次書き込みされ、JPEGコーデック23にて、ラインメモリ22に書き込みされた静止画データのエンコードを行ってDDRメインメモリ16にエンコードされたエンコードデータが出力される。なお、DDRメインメモリ16に書き込みされた生データ又はデコード済みの動画データ第1及び第2動画像データから静止画フレームを取得する場合、ユーザが指定したタイミングのフレーム1枚のみならず、その近傍の複数枚のフレームを加重平均するなどして合成し1枚の静止画フレームを取得するようにしてもよい。ここで、本実施の形態1にかかる撮像装置1のDDRメインメモリ16は、カメラ信号処理部13からDDRメインメモリ16を経由せずにJPEGエンコードする場合以下、高速撮影ルートともいう。にはラインメモリ22を3面で使用することが好ましく、DDRメインメモリ16を経由してJPEGエンコードする場合以下、通常ルートともいう。は、ラインメモリ22の3面のうちの2面を使用するようにしてもよい。以下、本実施の形態1におけるDDRメインメモリ16を3面構成とする理由について説明する。通常ルートの場合、DDRメインメモリ16から生データを転送することになるが、生データ転送の場合、転送のボトルネックはDDRメインメモリ16のバス10のバス帯域に依存する。したがって、通常ルートの場合には、後述するバス帯域を使用する優先度を上げるなどしてバス帯域を確保すれば2面構成とすることが可能となる。本実施の形態1にかかる撮像装置1の高速撮影ルート時のボトルネックの1つはJPEGコーデック23のエンコードの処理能力に依存する。JPEGコーデック23は、通常、入力データ量>エンコードデータ量の大小関係が成立するが、画像の複雑度によってはハフマン符号の割り当て等によりエンコードデータ量が多くなり上の式が逆転することがある。その場合、瞬間的に画像データのリード処理が滞りラインメモリ22の2面を使用するだけでは処理が破綻する可能性があり、ラインメモリ22を3面構成とする必要がある。言い換えればJPEGコーデック23において、入力の転送レート<出力のデータ転送レートの状態が常になりたてば2面構成のみでの処理が可能となる。しかし、瞬間的に入力の転送レート>出力のデータ転送レートの状態が発生する場合があり、このとき、DDRメインメモリ16を3面構成としておけば、画像データのリード処理が滞ってもそれを吸収することができる。本実施の形態においては、動画撮影時に静止画を同時に取得する場合は、高速撮影ルートを通り、カメラ信号処理部13からの静止画データが直接エンコードされ、DDRメインメモリ16に書き込まれるため、従来のように生データが書き込まれる場合に比して、データ量を削減することができる。これにより、DDRメインメモリ16のバス10のバス帯域を確保することができ、毎秒60枚取得される静止画フレーム等のエンコード済みの静止画データのDDRメインメモリ16への書き込みが可能となるのである。また、ラインメモリ22は、nnは1以上の整数ラインからなるラインメモリを3面以上有していることが好ましい。ラインメモリを3面設けることにより、一部のラインメモリを、リアルタイムなエンコード処理時の処理レートの変動を吸収するバッファとして機能させると共に、エンコード処理後のエンコードデータがDDRメインメモリ16へ書き込みされる際のタイミングを調整するバッファとして機能させることができる。<静止画フレームのリアルタイム記録処理>ここで、本実施の形態にかかる撮像装置1は、上述したように、動画像の記録と並列して高速に静止画フレームをリアルタイムでエンコードして記録する処理以下、高速撮影ルートで静止画フレームをエンコードする処理をリアルタイム記録処理ともいう。また、静止画フレームのエンコード処理をリアルタイムに実行する各処理部を総称して、静止画リアルタイム処理部という。が可能な装置である。次に、この静止画フレームのリアルタイム記録処理の詳細について説明する。<1静止画リアルタイム処理部の基本構成>図2は、静止画フレームのリアルタイム記録処理を実現する基本構成を示す図である。なお、図2及び後述する図3乃至図16において、図1に示す撮像装置1と同一の構成要素には同一の符号を付し、その詳細な説明を省略する。また、図2乃至図6においては、静止画フレームのリアルタイム記録処理を説明するために撮像装置の一部を抜き出して示している。図2に示すように、動画像と共に入力される静止画フレームD1についてのリアルタイム記録処理を実施するパス高速撮影ルートR1と、DDRメインメモリ16に書き込みされた生データ又はデコード済みの動画像データから取得した静止画フレームD2について、エンコードするパス通常ルートとを切り替えるセレクタ27を有している。高速撮影ルートR1において、撮像素子12より取得された動画像データから取得された静止画フレームをリアルタイムでエンコードする場合は、セレクタ27を介してこの静止画フレームD1が選択され、これがラインメモリ22に順次入力される。ラインメモリ22は、1フレーム分の静止画データ未満のデータを書き込みする。ラインメモリ22の詳細については後述する。ラインメモリ22の後段に配置されたJPEGエンコーダ23aは、ラインメモリ22から出力される静止画データをJPEG形式にエンコードして出力する。このエンコードデータはDDRメインメモリ16に書き込みされる。一方、通常ルートの場合は、DDRメインメモリ16に書き込みされている生データの動画像データが使用される。この動画像データは、例えばレンズ11及び撮像素子12を介して取得された動画像データがDDRメインメモリ16に書き込みされたものである。または、SDカード17等の外部メモリから入力されたエンコード済み動画像データが一旦DDRメインメモリ16に書き込みされ、これが図1に示す動画コーデック20にてデコードされて再びDDRメインメモリ16に書き込みされたものである。いずれの場合も生データ又はデコード済みである非圧縮の動画像データである。これらの動画像データに対しても、ユーザの指示に基づく任意のタイミングで静止画フレームが取得されてサイズ変換部21へ出力される。このDDRメインメモリ16からサイズ変換部21、ラインメモリ22を介してJPEGコーデック23によりエンコード処理されるルートが通常ルートである。JPEGコーデック23にてエンコードされたエンコード静止画データはDDRメインメモリ16に書き込みされる。<2静止画リアルタイム処理部の第1の変形例>次に、図2に示す基本構成の変形例について説明する。図3乃至5は、それぞれ第1乃至3の変形例を示すブロック図である。先ず、第1の変形例である図3に示す例は、カメラ信号処理部13の後段であって、セレクタ27の前段にサイズ変換部21を設けた例である。本変形例では高速撮影ルートR1における静止画フレームをサイズ変換部21にてサイズ変換することで、エンコード後のデータ容量を小さくすることができる。また、ユーザは取得する静止画データを所望のサイズのデータとすることができる。本変形例においては、通常パスについては、DDRメインメモリ16から静止画フレームD2が取得され、セレクタ27を介してラインメモリ22に入力され、JPEGエンコーダ23aによりエンコードされるパスと、DDRメインメモリ16から同じく静止画フレームD3が取得され、サイズ変換部21によりサイズ変換されてからセレクタ27を介してラインメモリ22に入力され、JPEGエンコーダ23aによりエンコードされるパスと2つの経路を有している。すなわち、ユーザはサイズ変換するか否かを選択することができる。<3静止画リアルタイム処理部の第2の変形例>次に、第2の変形例である図4に示す例は、カメラ信号処理部13を介して入力される動画像データから取得された静止画フレームのサイズをリアルタイムに変換して主画像データ及び副画像データを生成するそれぞれ主画像サイズ変換部21a及び副画像サイズ変換部21bとを有する。また、主画像サイズ変換部21a及び副画像サイズ変換部21bに対応して、それぞれラインメモリ22a、22bと、JPEGエンコーダ23a、23bとが設けられている。ラインメモリ22a、22bの動作はラインメモリ22と同様であり、JPEGエンコーダ23bの動作はJPEGエンコーダ23aと同様である。そしてセレクタ27は、カメラ信号処理部13からの動画像データから取得された静止画フレームD1が主画像サイズ変換部21aにより主画像サイズにサイズ変換されたもの、同じく静止画フレームD1が副画像サイズ変換部21bにより副画像サイズにサイズ変換されたもの、DDRメインメモリ16に書き込みされている生データ又はデコード済みの動画像データから取得された静止画フレームD2、又は同じくDDRメインメモリ16の生データ又はデコード済みの動画像データから取得された静止画フレームD3がサイズ変換部21a若しくはサイズ変換部21bによりサイズ変換された静止画データのいずれかを選択し、ラインメモリ22a又はラインメモリ22bに出力する。本第2の変形例においては、サイズ変換部21a、ラインメモリ22a及びJPEGコーデック23aにより、副画像サイズの静止画データのリアルタイムエンコード処理をすることができる。こうしてリアルタイムエンコード処理され、そのエンコードデータがDDRメインメモリ16に書き込みされるルートを主画像高速撮影ルートR1とする。この主画像高速撮影ルートは、図3に示す高速撮影ルートに対応している。一方、サイズ変換部21b、ラインメモリ22b及びJPEGコーデック23bにより、サムネイル等の副画像サイズの静止画データのリアルタイムエンコード処理をすることができる。こうしてリアルタイムエンコード処理され、そのエンコードデータがDDRメインメモリ16に書き込みされるルートを副画像高速撮影ルートR2とする。本第2の変形例においても、主画像高速撮影ルートR1又は副画像高速撮影ルートR2により、リアルタイムに静止画フレームを取得し静止画圧縮データに変換し、DDRメインメモリ16へ書き込む。JPEGエンコード時の量子化係数にもよるが、一般的にJPEGエンコードを行うと元の画像サイズの1/3程度のデータ量となる。よって、上述の実施の形態1及び第1の変形例1と同様に、DDRメインメモリ16のバス10のバス帯域への負荷を軽減し、これにより高速な静止画撮影が可能となる。また、撮像素子12から出力される画像サイズをリアルタイムで縮小することで、ユーザの希望する様々なサイズのJPEGファイルを、縮小しないとき同様の処理時間でエンコードが可能となる。さらに、インデックス用の副画像サムネイルをリアルタイムに主画像データと並列処理縮小及びメインメモリへの転送をすることでEXIFパッケージ処理をより高速に実現することができる。さらにまた、主画像データとサムネイル画像データを並列処理するため、回路構成次第で縮小処理に必要なラインメモリを主画像データとサムネイルデータとで共有することができる。<4静止画リアルタイム処理部の第3の変形例>次に、上記のように、主画像サイズ変換部及び副画像サイズ変換部のリソースを共有する例を第3の変形例として説明する。第3の変形例である図5に示すように、本変形例においては、主画像高速撮影ルートR1と副画像高速撮影ルートR2とで、主画像サイズ変換部21cを共有している。この主画像サイズ変換部21cは、主画像のサイズ変換を行う。したがって、主画像サイズ変換部21cの出力はセレクタ27に入力される。セレクタ27は、モードに応じて主画像高速撮影ルートR1からの静止画データD1と、DDRメインメモリ16に書き込みされた生データ又はデコード済みの動画像データから取得された静止画フレームD3のいずれかを選択出力する。セレクタ27に選択され出力された静止画データはラインメモリ22aに入力され、次いでJPEGエンコーダ23aに入力され、エンコードされたDDRメインメモリ16に書き込みされる。そして、本第3の変形例においては、主画像サイズ変換部21cに直列に接続された副画像サイズ変換部21dを有している。通常、主画像サイズの方が副画像サイズより大きい。よって先ず主画像サイズ変換部21cによりサイズ変換した静止画フレームを副画像サイズ変換部21dによりサイズ変換する方が、動画像データから取得した静止画フレームD1のサイズ変換をするより、サイズ変換の度合いが小さくてすむ。したがって、本変形例においては、主画像サイズ変換部21cの結果を利用して副画像サイズ変換部21dで静止画フレームの変換を行う。これにより、副画像サイズ変換部21dにおける演算処理量を低減することができる。すなわち、様々な縮小率を実現するには、サムネイル生成の方が水平画素数は少ないものの、間引きの縮小率が高いため、垂直フィルタ回路で利用するラインメモリスケーラ用バッファ212a/bの必要ライン数が多くなる。そこで、システム構成を工夫することにより、主画像用画像データに対しプリフィルタ処理してラインメモリに書き込んだデータに対し、サムネイル用画像データには追加で周波数特性を落とすフィルタ処理を実施すれば、残りのサムネイル画像データのラインメモリのリソースを他に振り分けることができる。また、本第3の変形例においては、副画像高速撮影ルートR2に、JPEGコーデックを有していない。これは、副画像データは、主画像データと比較すると大きさが小さいため、データ容量もそれほど大きくないためである。したがって、リアルタイムにエンコード処理をせずに、非圧縮のデータとしてDDRメインメモリ16に書き込みするようにすることも可能である。<5静止画リアルタイム処理部の第4の変形例>次に図6は、図2に示す基本構成の第4の変形例にかかり、動画像データの撮影ルートR3を合わせて示している。図1における撮像装置1と比較すると、サイズ変換部19を有していない点が異なる。その他の構成は図1に示す撮像装置と同様である。動画撮影ルートR3では、カメラ信号処理部13からの動画像データは一旦DDRメインメモリ16に書き込みされる。その後、動画エンコーダ20aにより、動画像データが、例えばH.264/AVC規格又はMPEG2規格準拠のエンコードデータとされ、DDRメインメモリ16に書き戻される。<本発明の実施の形態1の詳細>次に、本実施の形態1について、更に詳細に説明する。図7は、カメラ信号処理部13とDDRメインメモリ16との間の高速撮影ルート及び動画像撮影ルートに関するブロックを示す図である。本例においては、撮像装置1は、カメラ信号処理部13から出力される動画像データから取得された静止画フレームをエンコードする2つのパスを有している。1つは主画像となる静止画データに関するパス以下、パス1という。であり、もう1つは副画像サムネイルとなる静止画データに関するパス以下、パス2という。である。パス1の方は、第1の入力画像選択部28、主画像サイズ変換部21a、及びラインメモリ22aからなり、ラインメモリ22aからの静止画データがJPEGコア23cに入力され、リアルタイムエンコードされる。パス2の方は、第2の入力画像選択部29、副画像サイズ変換部21b、及びラインメモリ22bからなり、ラインメモリ22bからの静止画データがJPEGコア23cに入力され、リアルタイムエンコードされる。なお、上述したように、パス2の方の静止画データは、リアルタイムにエンコードする必要はなく、一旦DDRメインメモリ16aに書き込みされるようにしてもよい。ここで、主画像サイズ変換部21aは、サイズ変換部211a、スケーラ用バッファ212aを有し、副画像サイズ変換部21bは、サイズ変換部211b、スケーラ用バッファ212bを有する。スケーラ用バッファ212a、212bは、ラインメモリである。主画像サイズ変換部21a、サイズ変換部21bは、基本的にはカメラ信号処理部13から入力される静止画データをそれぞれ主画像用、サムネイル用のサイズに変換する。この主画像サイズ変換部21a、副画像サイズ変換部21bについての詳細は後述する。ラインメモリ22aは、メモリコントローラ221a、SRAM等からなるバッファ222aを有し、ラインメモリ22bは、メモリコントローラ221b、バッファ222bを有する。バッファ222a、222bは、それぞれ3面及び2面のバッファである。また、JPEGコア23cにも、例えば2面構成のバッファ231が接続されている。バッファ222a、222bは、例えばSRAMからなり、その機能については後述する。メモリコントローラ221a、221bは、例えばSRAMをラインメモリとして機能させるために、バッファ222a、222bへのデータアクセスを制御する。また、主画像サイズ変換部21a、21bと、JPEGコア23cとでクロック周波数が異なる場合は、当該クロック周波数を変換する処理等も行うことができる。JPEGコア23cは、JPEGコーデック及びインターフェースを有し、エンコードなしの場合は、主画像については主画像YUVデータを、サムネイルについては、サムネイルYUVデータをDDRメインメモリ16aに転送する。エンコード有りの場合は、主画像データをエンコードすると共にストリームをDDRメインメモリ16aに転送する。また、サムネイル画像については、サムネイル画像データをエンコードすると共にストリームをDDRメインメモリ16aに転送する。ここで、本例におけるDDRメインメモリ16aは、DDRインターフェースも含むものとなっている。第1の入力画像選択部28及び第2の入力画像選択部29は、複数ルートからの入力画像データを選択する図2乃至図6に示したセレクタ27の機能を有する。基本的には、通常動画撮影時にはDDRメインメモリ16aからの生動画像データ又はデコード済みの動画像データから取得された静止画フレームを選択する。また、動画撮影時の静止画撮影時には、高速撮影ルートからの静止画フレームを選択する。動画再生時には動画再生ルート、すなわちDDRメインメモリ16aに書き込みされている生動画像データ又はデコード済みの動画像データから取得された入力静止画フレームを選択する。主画像サイズ変換部21a、サイズ変換部21bでは、カメラ信号処理部13からの動画像データ又はDDRメインメモリ16aからの動画像データから取得された静止画フレームがそれぞれ主画像用、サムネイル用のサイズに変換される。水平方向、及び垂直方向のサイズ変換を施された静止画フレームは、メモリコントローラ221a、221bに制御されるそれぞれバッファ222a、222bに格納される。このラインメモリ22a、22bを構成するバッファ222a、222bは、8×8DCTに必要な画素を記憶するための8ライン分のバッファであり、Y8ライン×3面C8ライン×3面フォーマット4:2:2の場合Y16ライン×3面C8ライン×3面画像フォーマット4:2:0の場合の構成となっている。面数はシングルポート時とする。3面としたのは、後述するように、後段に控えるJPEGエンコード処理のリアルタイム処理で一時的に処理負担が増して処理レートが下がった場合の処理低下を吸収すると共に、その後段のDDRメインメモリ16aへの書き込み処理が停滞した場合の遅延を吸収するためである。なお、システム構成によっては2面構成とすることも可能である。JPEGコア23cにより、主画像エンコードなし時のYUV転送主画像エンコード有り時のエンコード処理ストリーム転送サムネイルエンコードなし時のYUV転送サムネイルエンコード有り時のエンコード処理ストリーム転送等が実施される。また、主画像エンコード時にはDDRメインメモリ16aの転送前にストリーム用バッファ231を使用する。バッファ231は、SRAM2面構成等とすることができる。なお、容量はシステム構成により様々であり、DDRメインメモリ16aに転送データを書き込みするための書き込み処理が停滞した場合の遅延を吸収することができればよい。<サイズ変換部の処理>次に、サイズ変換部21について詳細に説明する。図8は、サイズ変換部21の詳細を示すブロック図である。取得される静止画データに応じて、2チャンネル構成となっている。これにより、2ラインプログレッシブならODD奇数番目、EVEN偶数番目同時に入力された場合にもデータを処理することができる。2チャンネル同時とすることにより、カメラ処理の処理クロックレートを下げることができる。入力画像は、水平フィルタch141、水平フィルタch242で、必要な周波数特性に制限される。例えば、サンプリング周波数をfsの水平1024画素×垂直768ラインを512画素×384ラインに間引くとした場合、フィルタのカットオフ周波数をfs/4になるように設定してフィルタリングする。そして、水平間引き回路43で512画素に間引きし、スケーラ用バッファ212aに書き込みする。水平フィルタ回路41、42による周波数特性の制限を行わないで間引きを実行すると、いわゆるモワレ折り返し歪が発生する。スケーラ処理ラインメモリコントローラ44では、水平間引き回路43により間引きした画像データのスケール調整をする。具体的には、間引き後のデータについて、サンプル点がサンプリング点の間にある場合フィルタリング処理された画像信号2サンプル分から補間後サンプルの距離に応じて演算して値を求めて、画素間の直線補間等を実施する。水平補間後の静止画フレームは、垂直フィルタ回路45、46に出力される。水平方向と同様に折り返し歪の発生を抑制するため、垂直フィルタ回路45、46により、ラインメモリスケーラ用バッファ212aから読み出された静止画データに対して垂直方向にフィルタリング処理する。フィルタリング後に、垂直間引き回路47により垂直間引きを行い、必要な画像データのみ、その後段のメモリコントローラ221a、221bを介してラインメモリ222a、222bに書き込みする。ここで、サイズ変換は、主画像とサムネイル画像とで、独立して並列処理することができる。また、スケーラ用バッファ212aを共有してバッファサイズを削減することも可能である。例えば、主画像用静止画データを、水平フィルタ回路41、42における周波数特性削減処理でfs/4にする場合について考える。その後段に直列で接続されたサムネイル用水平フィルタ回路48、49でのフィルタ処理では水平160画素×垂直120ラインとする。したがって、サイズ変換部211aのみそれぞれ独立使用:fs/12.8処理必要サイズ変換部211a211bスケーラ1スケーラ2後段に直列で接続する:fs/6.4処理前段でfs/2→fs/4のためで構成され、後段に直列で接続する方が、周波数特性の制限幅が少なくてすむ。制限幅が少ない場合、同じ次数ならば帯域の制限効率がよく画質メリットを生じる。一方、同程度の画質でよいのであれば、次数を減らすことが可能となる。その結果、スケーラ用バッファ212bの必要ラインメモリが少なくなり、余ったラインメモリを他のリソースに振り分けることができる。サムネイル用のサイズ変換部は、垂直フィルタ回路45、46と垂直間引き回路47との間の信号が使用される。すなわち、主画像用のサイズ変換部でサイズ変換された後の静止画データのサイズ変換を行う。サムネイル用のサイズ変換部も、水平フィルタ回路48、49、水平間引き回路、スケーラ処理ラインメモリコントローラ、垂直フィルタ回路、垂直間引き回路を同様に有し、同様の処理によりサイズ変換した静止画画像を出力する。バッファ222a、222bに書き込みされた静止画データは、例えば8ラインデータとして書き込みされる毎にDDRメインメモリ16aへ転送される。DDRメインメモリ16a側の処理は、システムに応じて様々であるが、静止画ルートや動画ルート、その他カメラ制御信号のための演算結果などをDDRメインメモリ16aに書き込みするのが通常である。したがって、静止画フレームのリアルタイム記録処理のデータレート以上のレートを処理できる帯域を確保するよう構成されている。ただし、静止画フレームのリアルタイム記録処理以外のデータでバス10のバス帯域を占有する瞬間も有り得る。よっって、撮像装置は、DDRメインメモリ16aの処理遅延を吸収するために、スケーラ用バッファ212a、212b、バッファ222a、222b、及びストリーム用バッファ231などを有している。<3面構成のラインメモリについて>次に、ラインメモリ22を3面構成とすることが好ましい理由について説明する。図9は、8ラインメモリが2面構成の例を示す図、図10は、8ラインメモリが2面構成の例を示す図である。図9に示すように、2面構成のラインメモリ50は、8ラインメモリ51、52がスイッチ61により切り替えられる。また、図10に示すように、3面構成のラインメモリ70は、8ラインメモリ71乃至73がスイッチ82により切り替えられる。図11は、ラインメモリ50への書き込み期間及び読み出し期間、並びにJPEGエンコード期間を示すタイミングチャートである。ラインメモリ50の書き込みは、8水平同期期間T1乃至T8継続して行い、読み出しは、JPEGエンコーダが8ライン分のデータをエンコードするタイミングとほぼ等しくなる。JPEGエンコーダのエンコード期間は、入力画像データによって処理にかかる演算量が変化する。ほとんどの場合は、圧縮率が1以下であり、エンコード処理は8ライン以下の処理期間であるが、複雑な絵柄の場合には、圧縮率が1以上となり、8ライン以上の処理期間となる場合がある。図11において期間T11で複雑な絵柄になるとする。この場合、ラインメモリ51が画像データを読み出す期間が8ライン分の長さT6より長くなり、ラインメモリ51の書き込み期間T7とタイミングが重なる期間T12が発生する。この期間は、読み出そうとするラインメモリ上に、新しいデータの書き込みが発生するため、正しいJPEGエンコードが行なえなくなる。図12は、3面構成のラインメモリ80への書き込み期間、読み出し期間、JPEGエンコード期間を示す図である。図12に示すように、JPEGエンコーダのエンコード期間が、入力画像が複雑な絵柄の場合で、8ライン以上の処理期間となる期間T11の場合でも、ラインメモリ72を読み出す期間R5が8ラインより長くなり、書き込みを行なうラインメモリがメモリライン71T7であるので、同一ラインメモリにおいてタイミングが重なる期間が発生せず、正しくJPEGエンコードを行なうことができる。すなわち、ラインメモリ22を、8ラインメモリの3面構成とすることによって、圧縮率を1近傍とした場合にも、タイミングを気にする必要がなくなる。このように、一部のラインメモリを、静止画フレームのリアルタイム処理時の処理レートの変動を吸収するバッファとして機能させることができる。一方で、このラインメモリは、圧縮処理後の圧縮データがDDRメインメモリ16へ書き込みされる際のタイミングを調整するバッファとして機能させることも可能である。<バス10の調停処理>DDRメインメモリ16aのバス10にデータデータを出力する際には、バス10の調停が行なわれ、バス10へのデータ出力が許可されるブロックが優先度に応じて決定される。出力が許可されたブロックはデータをDDRメインメモリ16aに出力し、それ以外の許可されなかったブロックは出力許可が出されるまで出力を停止する。すなわち、JPEGコーデック23がJPEGエンコードストリームをDDRメインメモリ16aのバス10に出力する際、バス10への出力が許可されなければ、JPEGストリームの出力を停止する動作を行なう。図13は、同じく、3面構成のラインメモリ80への書き込み期間、読み出し期間、JPEGエンコード期間の他の例を示す図である。図13において、期間T13で示す期間は、他のブロックがバス10への出力を許可され、JPEGコーデック23はJPEGストリームをバス10に出力できなくなる期間を示す。JPEGコーデック23は、出力が許可されるまで出力段に設けられたバッファにJPEGエンコードストリームを蓄積する。出力許可後にバッファからDDRメインメモリ16aのバス10へJPEGエンコードストリームを出力すれば、JPEGストリームを途切れさせることなく動作が可能である。出力段のバッファ容量以上の期間、出力許可が得られない場合には、JPEGストリームが途切れてしまうため、バッファ容量は大きく余裕をもたせる必要がある。ここで、ラインメモリ22の8ラインメモリを使用することで、DDRメインメモリ16の出力バッファ容量が足りなくなることを防ぐことができる。すなわち、ラインメモリ22の8ラインメモリからの読み出しタイミングをDDRメインメモリ16aのバス10への出力が可能となるまで遅らせてR4、JPEGエンコードの開始を遅らせることにより、JPEGストリームをDDRメインメモリ16aに転送するタイミングを遅らせることができる。なお、図13においては、説明のためJPEGストリームの占める割合を大きくとっているが、実際には、動画用のサイズ変換出力、動画コーデック、及びビデオ処理等を合わせた状態で、このようなタイミングが発生する。後述の実施の形態2にて説明するように、各ブロックのDDRメインメモリ16aバス10への出力段は、バス出力できないことに対応するためにバッファを有している。そして、本例のように、JPEGコーデック23の前段にあるラインメモリ22の8ラインメモリも、バス出力を調整するバッファと同様の役割を持たせることが可能である。<撮像装置1による動画再生時の静止画キャプチャ動作>次に、動画再生時の静止画キャプチャ動作について説明しておく。なお、本動作は従来の撮像装置の動作と同様である。図14は、撮像装置の再生時の動作を説明する図である。図14に示すように、動画再生時には、DDRメインメモリ16に書き込みされているエンコード済みのエンコード動画データが動画デコーダ20bに入力され、デコードされてDDRメインメモリ16に書き込みされる。デコードされた動画像データは、上述したように、ビデオ信号処理部24にてビデオ信号処理され、LCD26やHDMI25に出力される。また、DDRメインメモリ16に書き込みされている生データ又はデコード済みの動画像データをLCD26に出力し表示することで任意のタイミングでユーザがシャッタを押すことができる。この場合、シャッタのタイミングに応じた静止画フレームが取得され、セレクタ27を介してJPEGエンコーダ23aに入力され、エンコードされてDDRメインメモリ16に書き込みされる。なお、動画像データから静止画フレームを取得する場合に、2枚以上のフレームから平均又は加重平均して1枚の静止画フレームを生成するようにしてもよい。本実施の形態においては、撮影中の動画像データから取得した静止画フレームをメインメモリに書き込みせずに直接リアルタイムにエンコードすることで、最小の回路規模、最小の動作クロック、及びそれに伴う最小の消費電力を実現しつつ、多画素の画像サイズであってもより枚数の多い、例えば1秒間に60フレーム等の高速撮影処理を実現することができる。さらに、通常、動画取得処理を行ないながらの静止画取得処理は、システム的に負担がかかる。したがって実現するためにはコストが増大し、バスクロック周波数を高める等、LSI生成難易度が上がると共に消費電力の増加に繋がったり、動画処理レートが低減する等のデメリットや制限が発生するが、本実施の形態においては、静止画処理を高効率化することができ動画取得処理に影響を及ぼすことなく高速な静止画取得処理を実行することができる。すなわち、必要最小限の構成で動画再生時においても高速、高効率に静止画キャプチャを実現することができる。<本発明の実施の形態2.>次に、本発明の実施の形態2について説明する。図15は、本実施の形態にかかる撮像装置を示すブロック図である。図2に示すように、本実施の形態にかかる撮像装置1aにおいては、静止画フレーム取得部94が設けられている。上述したように、1秒間60フレームからなる動画像データの全フレームを高速撮影ルートR1にて処理する場合は、全データを順次サイズ変換部21、ラインメモリ22、JPEGコーデック23に送ればよく、特に静止画フレーム取得部94を設ける必要はない。ユーザが動画を撮像しながら又は動画を再生しながら任意のタイミングでシャッタを押して静止画撮影をする場合は、静止画フレーム取得部94にはそのシャッタタイミングが入力され、そのスイッチング動作等により、カメラ信号処理部13から出力される動画像データ又はDDRメインメモリ16に書き込みされているデコード済みの動画データから所定のフレームの画像データがサイズ変換部21側へ流れるようにする。そして、本実施の形態にかかる撮像装置においては、動画像データがDDRメインメモリ16へ書き込みされる際及びJPEGコーデック23からのエンコードデータがDDRメインメモリ16へ書き込みされる際等にDDRメインメモリ16のバス10の使用を調停するための複数のタイミング調整用バッファ91乃至93が設けられている。また、複数のタイミング調整用バッファ91乃至93を制御する調停部として機能するアービタ95を有する。高速撮影ルートR1を通る静止画データはエンコードされてDDRメインメモリ16に書き込みされるが、あるタイミングにおいては、DDRメインメモリ16のバス10のバス帯域が不足する場合があり、このバス帯域をこの複数のタイミング調整用バッファ91乃至93を使用して調停する必要が生じる場合がある。なお、ここでは、タイミング調整用バッファ91乃至93のみ図示しているが、SDカード17やビデオ信号処理部24等にも必要に応じてタイミング調整用バッファを設けてもよいことは勿論である。<アービタ95の制御>図16は、アービタ95の制御を説明するための図である。本例においては、アービタ95は、動画像データのサイズ変換部19のサイズ変換後のDDRメインメモリ16へのデータの書き込みA、動画コーデック20のDDRメインメモリ16からの読み出しB、動画コーデック20のDDRメインメモリ16への書き込みC、及びJPEGコーデック23のエンコードデータのDDRメインメモリ16への書き込みD動作について調停する場合について説明する。図16には、サイズ変換部19、動画コーデック20のリード時、動画コーデック20のライト時、JPEGコーデック23のDDRメインメモリ16へのアクセスリクエストをアービタ95に伝えるリクエスト信号と、アクセスが許可されない場合にアービタ95からうけとるウェイト信号とを示している。アービタ95は、リクエスト信号を受け取ると、他にリクエスト信号を受け取っておらず、DDRメインメモリ16のバス10のバス帯域が空いていれば、アクセスを許可する。一方、アービタ95が複数のリクエスト信号を受け取った場合、例えばタイミングT21においては、優先度3の動画コーデックリードのリクエスト信号と、優先度4の動画コーデックライトのリクエスト信号とが出力されている。この場合、アービタ95は、動画コーデックライトのウェイト信号を出力し、動画コーデックライトを停止させ、より優先度が高い優先度3の動画コーデックリードの処理を実行させる。また、タイミングT22でリクエスト信号を出力した動画コーデックライトがライトしている間に、優先度2のサイズ変換部19がリクエスト信号を出力している。ただし、この後、より優先度が高い優先度1のJPEGコーデック23からリクエスト信号が出力されている。したがって、サイズ変換部19は優先度がJPEGコーデック23より低いため、再びウェイト状態となり、JPEGコーデック23のライト動作が終了したタイミングT24で、サイズ変換部19のライド動作が許可されることとなる。このように頻繁に発生するウェイト時に、タイミング調整用バッファ91乃至93にデータを蓄えることで、サイズ変換部19、動画コーデック20、JPEGコーデック23の動作を途切れないようにすることができる。上述したように、本実施の形態にかかる撮像装置は、動画撮影時に高速静止画撮影を可能とするため、静止画フレームをDDRメインメモリ16に書き込みすることなく、直接リアルタイムにエンコードする。このことにより、静止画フレームの生データをDDRメインメモリ16に一旦書き込みした後、エンコードするという従来のルートに比して、DDRメインメモリ16のバス10のバス帯域にかかる負荷を低減することができ、結果、高速静止画撮影を可能としている。すなわち、従来は、動画撮像と同時では、1秒間に複数枚、高々10枚程度しか静止画撮影を行うことができなかった。これに対し、本実施の形態においては、静止画フレームをDDRメインメモリ16に書き込みすることなくリアルタイムにエンコードしてからDDRメインメモリ16に書き込みすることで、例えば1秒間に60フレームからなる動画像データの全フレームについて静止画フレームの取得が可能となる。そして、動画撮影時に高速静止画撮影をすると、DDRメインメモリ16のメモリ帯域幅が不足する場合が生じる。このような場合であっても、本実施の形態のように、タイミング調整用バッファ91乃至93等を設け、アービタ95でバス10の調停を実施することで、DDRメインメモリ16への処理を滞りなく実施することができる。また、タイミング調整用バッファ91は、JPEGコーデック23のDDRメインメモリ16のバス帯域使用時のタイミングを調整するために設けられているが、上述したように、本実施の形態にかかるJPEGコーデック23は、8ラインメモリの3面構成となっている。よって、このラインメモリの一部をタイミング調整用バッファ91の代わりに使用してもよい。本実施の形態においても実施の形態1と同様に、静止画撮影において、高効率処理、高速処理、及び低コスト化が可能な撮像装置を提供することができる。特に動画撮影時においても効率的な静止画処理により、より低コストで高速な静止画処理を可能とする。なお、本発明は上述した実施の形態のみに限定されるものではなく、本発明の要旨を逸脱しない範囲において種々の変更が可能であることは勿論である。例えば、上述の実施の形態では、ハードウェアの構成として説明したが、これに限定されるものではなく、任意の処理を、CPUCentralProcessingUnitにコンピュータプログラムを実行させることにより実現することも可能である。この場合、コンピュータプログラムは、様々なタイプの非一時的なコンピュータ可読媒体nontransitorycomputerreadablemediumを用いて格納され、コンピュータに供給することができる。非一時的なコンピュータ可読媒体は、様々なタイプの実体のある記録媒体tangiblestoragemediumを含む。非一時的なコンピュータ可読媒体の例は、磁気記録媒体例えばフレキシブルディスク、磁気テープ、ハードディスクドライブ、光磁気記録媒体例えば光磁気ディスク、CD-ROMReadOnlyMemory、CD-R、CD-R/W、半導体メモリ例えば、マスクROM、PROMProgrammableROM、EPROMErasablePROM、フラッシュROM、RAMrandomaccessmemoryを含む。また、プログラムは、様々なタイプの一時的なコンピュータ可読媒体transitorycomputerreadablemediumによってコンピュータに供給されてもよい。一時的なコンピュータ可読媒体の例は、電気信号、光信号、及び電磁波を含む。一時的なコンピュータ可読媒体は、電線及び光ファイバ等の有線通信路、又は無線通信路を介して、プログラムをコンピュータに供給できる。