"電気光学素子を含むメモリ内蔵の画素が行列状に配置された表示装置における各画素を駆動する駆動回路であって、階調データの各ビットに対応し、かつ対応ビットの重みに応じた期間となる複数のサブフィールドで1フレーム期間を分割するとともに、期間の相対的に長い1または複数のサブフィールドを、期間の相対的に短いサブフィールドの期間と等しい期間に分割することにより複数の分割サブフィールドを生成する分割部と、各サブフィールドおよび各分割サブフィールドに対応するビットに従って画素の電気光学素子をオンまたはオフすることで、1フレーム期間中のオン期間またはオフ期間の割合を制御するオンオフ期間制御部とを含む駆動回路。前記分割部は、少なくとも一部の分割サブフィールドを、1フレーム期間内において分割前とは異なる区間に配置する請求項1に記載の駆動回路。前記分割部は、各分割サブフィールドを、互いに隣接する分割サブフィールドの分割元のサブフィールドが互いに異なるように配置する請求項2に記載の駆動回路。前記分割部は、一部の分割サブフィールドを1フレーム期間の期初寄りに配置する請求項2に記載の駆動回路。前記分割部は、フレーム期間ごとに、少なくとも一部の分割サブフィールドであって、かつ分割元のサブフィールドが互いに異なる分割サブフィールド同士の位置を互いに入れ替える請求項2に記載の駆動回路。前記分割部は、1フレーム期間内または複数フレーム期間内において、ビット配列を時間対称配置にする請求項5に記載の駆動回路。電気光学素子を含むメモリ内蔵の画素が行列状に配置された表示領域と、各画素を駆動する駆動回路とを備え、前記駆動回路は、階調データの各ビットに対応し、かつ対応ビットの重みに応じた期間となる複数のサブフィールドで1フレーム期間を分割するとともに、期間の相対的に長い1または複数のサブフィールドを、期間の相対的に短いサブフィールドの期間と等しい期間に分割することにより複数の分割サブフィールドを生成する分割部と、各サブフィールドおよび各分割サブフィールドに対応するビットに従って画素の電気光学素子をオンまたはオフすることで、1フレーム期間中のオン期間またはオフ期間の割合を制御するオンオフ期間制御部とを有する表示装置。電気光学素子を含むメモリ内蔵の画素が行列状に配置された表示装置の駆動方法であって、階調データの各ビットに対応し、かつ対応ビットの重みに応じた期間となる複数のサブフィールドで1フレーム期間を分割するとともに、期間の相対的に長い1または複数のサブフィールドを、期間の相対的に短いサブフィールドの期間と等しい期間に分割することにより複数の分割サブフィールドを生成する分割ステップと、各サブフィールドおよび各分割サブフィールドに対応するビットに従って画素の電気光学素子をオンまたはオフすることで、1フレーム期間中のオン期間またはオフ期間の割合を制御するオンオフ期間制御ステップとを含む表示装置の駆動方法。図20は、垂直方向にグラデーションとなっている映像以下、単にグラデーション映像と称する。が垂直上方に変移する動画が、図18のデジタル駆動で表示される様子を模式的に表したものである。図20Aは、グラデーション映像を観察者が視認したときの映像の一部を表したものである。図20Bは、nフレーム目~n2フレーム目において、グラデーション映像が垂直上方に時間的に変化する様子をデジタル表示したものである。図20Cは、グラデーション映像が垂直上方に時間的に変化しているときにその動画を観察者が視認したときの映像の一部を表したものである。図20から、階調のわずかな違いで白黒の位相が反転するような階調表示法が用いられている場合に、グラデーション映像が垂直方向に時間的に変移することにより、白黒の位相が反転する画素において黒い筋L1が発生することがわかる。グラデーション映像は、人の顔の輪郭付近に発生する。そのため、人の顔が移動している映像において、人の顔の輪郭付近に上記の黒い筋L1が発生しやすい。人の顔の輪郭付近に発生する黒い筋L1は、人の顔の輪郭に沿って形成されるため、擬似輪郭と呼ばれる。擬似輪郭は、映像品質を著しく損なうため、擬似輪郭の生じにくい駆動方法の開発が望まれている。本技術はかかる問題点に鑑みてなされたものであり、その第1の目的は、擬似輪郭の生じにくい駆動回路およびそれを備えた表示装置を提供することにある。また、第2の目的は、擬似輪郭の生じにくい表示装置の駆動方法を提供することにある。本技術による駆動回路は、電気光学素子を含むメモリ内蔵の画素が行列状に配置された表示装置における各画素を駆動する回路である。駆動回路は、分割部と、オンオフ期間制御部とを含んでいる。分割部は、階調データの各ビットに対応し、かつ対応ビットの重みに応じた期間となる複数のサブフィールドで1フレーム期間を分割するようになっている。分割部は、また、期間の相対的に長い1または複数のサブフィールドを、期間の相対的に短いサブフィールドの期間と等しい期間に分割することにより複数の分割サブフィールドを生成するようになっている。一方のオンオフ期間制御部は、各サブフィールドおよび各分割サブフィールドに対応するビットに従って画素の電気光学素子をオンまたはオフすることで、1フレーム期間中のオン期間またはオフ期間の割合を制御するようになっている。本技術による表示装置は、電気光学素子を含むメモリ内蔵の画素が行列状に配置された表示領域と、各画素を駆動する駆動回路とを備えている。この表示装置において、駆動回路は、上記の分割部と同一の構成要素の分割部と、上記のオンオフ期間制御部と同一の構成要素のオンオフ期間制御部とを備えている。本技術による表示装置の駆動方法は、液晶セルを含むメモリ内蔵の画素が行列状に配置された表示装置の駆動方法である。この駆動方法は、以下の2つのステップを含んでいる。A階調データの各ビットに対応し、かつ対応ビットの重みに応じた期間となる複数のサブフィールドで1フレーム期間を分割するとともに、期間の相対的に長い1または複数のサブフィールドを、期間の相対的に短いサブフィールドの期間と等しい期間に分割することにより複数の分割サブフィールドを生成し、さらに、少なくとも一部の分割サブフィールドを、1フレーム期間内において分割前とは異なる区間に配置する分割ステップB各サブフィールドおよび各分割サブフィールドに対応するビットに従って画素の電気光学素子をオンまたはオフすることで、1フレーム期間中のオン期間またはオフ期間の割合を制御するオンオフ期間制御ステップ本技術による駆動回路、表示装置、および表示装置の駆動方法では、期間の相対的に長い1または複数のサブフィールドが、期間の相対的に短いサブフィールドの期間と等しい期間に分割される。これにより、階調のわずかな違いで発生した白黒の境界が長い時間に渡って存在する度合いを少なくすることが可能である。本技術による駆動回路、表示装置、および表示装置の駆動方法によれば、階調のわずかな違いで発生した白黒の境界が長い時間に渡って存在する度合いを少なくすることができるようにしたので、筋の発生を抑制することができる。これにより、擬似輪郭を生じにくくすることができる。その結果、高い映像品質を得ることができる。以下、発明を実施するための形態について、図面を参照して詳細に説明する。なお、説明は以下の順序で行う。1.実施の形態表示装置2.変形例表示装置<1.実施の形態>[構成]図1は、本技術による一実施の形態に係る表示装置1の概略構成を表したものである。この表示装置1は、表示パネル10と、表示パネル10を駆動する周辺回路20とを備えている。表示パネル10表示パネル10は、行方向に延在する複数の走査線WSLと、列方向に延在する複数のデータ線DTLとを有しており、走査線WSLとデータ線DTLとが互いに交差する箇所に対応して画素11を有している。表示パネル10内の複数の画素11は、表示パネル10の画素領域10A全面に渡って行方向および列方向に2次元配置されている。画素11は、表示パネル10上の画面を構成する最小単位の点に対応するものである。表示パネル10がカラー表示パネルである場合には、画素11は、例えば赤、緑または青などの単色の光を発する副画素に相当し、表示パネル10がモノクロ表示パネルである場合には、画素11は、単色光例えば白色光を発する画素に相当する。画素11は、図示しないが、電気光学素子を含むメモリ内蔵の画素である。電気光学素子の種類としては、例えば、液晶セルや、有機ELElectroLuminescenceセルなどが挙げられる。メモリの種類としては、例えば、SRAMStaticRandomAccessMemoryやDRAMDynamicRandomAccessMemoryなどが挙げられる。画素11は、対応する1本の走査線WSLが選択されたとき、対応するデータ線DTLに供給された信号データビットの書込みに応じて発光状態または消光状態となり、その後、当該走査線WSLが非選択となっても、書込みによる発光状態または消光状態が継続するようになっている。そのため、周辺回路20は、画素11が発光状態となっている期間点灯期間、または画素11が消光状態となっている期間消灯期間の、1フレーム期間における割合を制御することにより、階調表示を実現している。画素11の点灯期間または消灯期間の単位としてサブフィールドという概念がある。サブフィールドとは、画素11の階調を規定する階調データの各ビットに対応し、かつ当該対応ビットの重みに応じた期間の単位を指している。一般に、例えば、5ビットからなる階調データによって32階調を表現する場合、例えば、図18に示したように、例えば数ms幅の1ビットのデータを単位として、期間の比が1:2:4:8:16の5つのデータが用意され、これら5つのデータの組み合わせにより32階調が表現される。上記の階調表示法では、図2Aに示したように、階調データの各ビット1bit~5bitに対応し、かつ対応ビットの重みに応じた期間となるサブフィールドSF1~SF5で、信号データが規定される。本実施の形態では、さらに、画素11の点灯期間または消灯期間の単位として、期間の相対的に長いつまり高階調側のサブフィールドに対して分割サブフィールドが適用されている。分割サブフィールドとは、期間の相対的に長いサブフィールドを、期間の相対的に短いサブフィールドの期間と等しい期間に分割することにより生成される断片化されたサブフィールドを指している。例えば、図2Bに示したように、階調データの4ビット目および5ビット目に対応するサブフィールドSF4,SF5が、サブフィールドSF4よりも期間の相対的に短いサブフィールドSF3の期間と等しい期間に分割されている。これにより、サブフィールドSF4から、2つの分割サブフィールドSF4-1,SF4-2が生成され、サブフィールドSF5から、4つの分割サブフィールドSF5-1,SF5-2,SF5-3,SF5-4が生成されている。分割サブフィールドSF4-1,SF4-2,SF5-1,SF5-2,SF5-3,SF5-4の期間は、低階調側のサブフィールドSF1,SF2の期間よりも長くなっており、信号データにおいて最も長い期間となっている。ここで、分割サブフィールドに対応するビットは、分割サブフィールドの分割元のサブフィールドに対応するビットと等しくなっている。例えば、分割サブフィールドSF4-1,SF4-2に対応するビットは、サブフィールドSF4に対応するビットと等しくなっている。同様に、分割サブフィールドSF5-1,SF5-2,SF5-3,SF5-4に対応するビットは、サブフィールドSF5に対応するビットと等しくなっている。本実施の形態では、例えば、5ビットによって32階調が表現された階調データ図18参照が入力される場合、例えば、図3に示したように、例えば数ms幅の1ビットのデータを単位として、期間の比が4:4:4:4:1:2:4:4:4の9つのデータが用意され、これら9つのデータの組み合わせにより32階調が表現される。このとき、先頭から2番目の期間および8番目の期間が、分割サブフィールドSF4-1,SF4-2に対応する期間である。また、先頭から1番目の期間、3番目の期間、7番目の期間および9番目の期間が、分割サブフィールドSF5-1,SF5-2,SF5-3,SF5-4に対応する期間である。この階調表示法では、図18に示した階調表示法と比べて、互いに隣接する2つの画素における階調のわずかな違いで、白黒の境界が長い時間に渡って固定される度合いが少なくなっている。上記の階調表示法では、少なくとも一部の分割サブフィールドが、1フレーム期間内において分割前とは異なる区間に配置される。さらに、各分割サブフィールドは、互いに隣接する分割サブフィールドの分割元のサブフィールドが互いに異なるように配置されている。例えば、図2Bに示したように、サブフィールドSF4から生成された分割サブフィールドSF4-1は、サブフィールドSF5から生成された分割サブフィールドSF5-1,SF5-2に隣接して配置されている。また、サブフィールドSF4から生成された分割サブフィールドSF4-2は、サブフィールドSF5から生成された分割サブフィールドSF5-3,SF5-4に隣接して配置されている。同様に、サブフィールドSF5から生成された分割サブフィールドSF5-1は、信号データの先頭に配置されており、かつサブフィールドSF4から生成された分割サブフィールドSF4-1に隣接して配置されている。また、サブフィールドSF5から生成された分割サブフィールドSF5-2は、サブフィールドSF4から生成された分割サブフィールドSF4-1と、分割されていないサブフィールドSF3とに隣接して配置されている。また、サブフィールドSF5から生成された分割サブフィールドSF5-3は、サブフィールドSF4から生成された分割サブフィールドSF4-2と、分割されていないサブフィールドSF2とに隣接して配置されている。また、サブフィールドSF5から生成された分割サブフィールドSF5-4は、信号データの最後尾に配置されており、かつサブフィールドSF4から生成された分割サブフィールドSF4-2に隣接して配置されている。一部の分割サブフィールドは1フレーム期間の期初寄りに配置されていることが好ましい。例えば、図2Bに示したように、サブフィールドSF5から生成された分割サブフィールドSF5-1が1フレーム期間信号データの先頭に配置されている。さらに、例えば、図2Bに示したように、サブフィールドSF4から生成された分割サブフィールドSF4-1が1フレーム期間信号データの先頭から2番目に配置されている。また、例えば、フレーム期間に関係なく、分割サブフィールドの位置が固定されていてもよい。例えば、図4に示したように、nフレーム、n1フレーム、n2フレームのいずれにおいても、信号データが、先頭から順に、SF5-1、SF4-1、SF5-2、SF3、SF1、SF2、SF5-3、SF4-2、およびSF5-4の順番で規定されていてもよい。また、例えば、フレーム期間ごとに、少なくとも一部の分割サブフィールドであって、かつ分割元のサブフィールドが互いに異なる分割サブフィールド同士の位置が互いに入れ替えられていてもよい。さらに、フレーム期間ごとに、分割サブフィールドおよびサブフィールの位置が互いに入れ替えられていてもよい。例えば、図5に示したように、nフレームにおいて、信号データが、先頭から順に、SF5-1、SF4-1、SF5-2、SF3、SF1、SF2、SF5-3、SF4-2、およびSF5-4の順番で規定されているとする。このとき、n1フレームでは、1番目のSF51と2番目のSF4-1とが互いに入れ替えられ、3番目のSF52と4番目のSF3とが互いに入れ替えられ、8番目のSF42と9番目のSF5-4とが互いに入れ替えられている。さらに、n2フレームでは、1番目のSF41と2番目のSF5-1とが互いに入れ替えられ、3番目のSF3と4番目のSF5-2とが互いに入れ替えられ、8番目のSF54と9番目のSF4-2とが互いに入れ替えられている。周辺回路20次に、周辺回路20の構成についての説明を行う。周辺回路20は、例えば、図1に示したように、変換回路30、コントローラ40、垂直駆動回路50および水平駆動回路60を有している。コントローラ40は、図示しない上位装置から供給される同期信号20Bから、変換回路30、垂直駆動回路50、および水平駆動回路60の動作タイミングを制御する制御信号40A,40B,40Cを生成するものである。同期信号20Bとしては、例えば、垂直同期信号、水平同期信号、ドットクロック信号などが挙げられる。制御信号40A,40B,40Cとしては、例えば、クロック信号、ラッチ信号、フレーム開始信号、サブフィールド開始信号などが挙げられる。変換回路30は、例えば、図6に示したように、フレームメモリ31、書込回路32、読出回路33およびデコーダ34を含んでいる。フレームメモリ31は、少なくとも表示領域10Aの解像度よりも多い記憶容量を有する映像表示用メモリであり、例えば、行アドレスと、列アドレスと、行アドレスおよび列アドレスと関連付けられた各画素11の階調データとを記憶することができるようになっている。書込回路32は、同期信号20B利用して、映像信号20Aの書込アドレスWadを生成するとともに、同期信号20Bに同期してフレームメモリ31に出力するようになっている。書込みアドレスWadは、例えば、行アドレスおよび列アドレスを含んでいる。読出回路33は、制御信号40Aに基づいて、読出アドレスRadを生成し、フレームメモリ31に出力するようになっている。デコーダ34は、フレームメモリ31から出力された階調データを信号データ30Aとして出力するようになっている。垂直駆動回路50は、水平駆動回路60から入力される制御信号60A後述と、制御信号40Cから特定されるアドレスデータとに基づいて、各画素11を行単位で選択するための走査パルスを走査線WSLに出力するようになっている。垂直駆動回路50は、例えば、図7A~Dに示したように、SF5-1,SF4-1,SF5-2,SF3,SF1,SF2,SF5-3,SF4-2,SF5-4の並び順および期間に対応して、各走査線WSLに選択パルスを順次出力するようになっている。水平駆動回路60は、制御信号40Bと、信号データ30Aとに基づいて、画素11の電気光学素子をオンまたはオフすることで、1F中のオン期間またはオフ期間の割合を段階的に制御するようになっている。水平駆動回路60は、信号データ30Aの高ビット側のサブフィールドを、信号データ30Aの低ビット側のサブフィールドの期間と同じ期間の分割サブフィールドに分割するようになっている。水平駆動回路60は、信号データ30Aとして、5ビットによって32階調が表現された階調データ図18参照が入力された場合、例えば、図2Bに示したように、階調データの4ビット目および5ビット目に対応するサブフィールドSF4,SF5を、サブフィールドSF4よりも期間の相対的に短いサブフィールドSF3の期間と等しい期間に分割するようになっている。これにより、サブフィールドSF4から、2つの分割サブフィールドSF4-1,SF4-2が生成され、サブフィールドSF5から、4つの分割サブフィールドSF5-1,SF5-2,SF5-3,SF5-4が生成される。次に、水平駆動回路60は、少なくとも一部の分割サブフィールドを、1フレーム期間内において分割前とは異なる区間に配置するようになっている。さらに、水平駆動回路60は、各分割サブフィールドを、互いに隣接する分割サブフィールドの分割元のサブフィールドが互いに異なるように配置するようになっている。このとき、水平駆動回路60は、例えば、図2Bに示したように、サブフィールドSF1,SF2,SF3および分割サブフィールドSF4-1,SF4-2,SF5-1,SF5-2,SF5-3,SF5-4を、SF5-1,SF4-1,SF5-2,SF3,SF1,SF2,SF5-3,SF4-2,SF5-4の順に配置するようになっている。このとき、水平駆動回路60が、一部の分割サブフィールドを1フレーム期間の期初寄りに配置するようになっていることが好ましい。水平駆動回路60は、例えば、図2Bに示したように、分割サブフィールドSF5-1を1フレーム期間信号データの先頭に配置するようになっている。水平駆動回路60は、さらに、例えば、図2Bに示したように、分割サブフィールドSF4-1を1フレーム期間信号データの先頭から2番目に配置するようになっている。また、水平駆動回路60は、少なくとも一部の分割サブフィールドを、1フレーム期間内において分割前とは異なる区間に配置するともに、各分割サブフィールドを、互いに隣接する分割サブフィールドの分割元のサブフィールドが互いに異なるように配置する際に、1フレーム期間内において、ビット配列を時間対称配置にすることが好ましい。また、水平駆動回路60は、少なくとも一部の分割サブフィールドを、1フレーム期間内において分割前とは異なる区間に配置するともに、各分割サブフィールドを、互いに隣接する分割サブフィールドの分割元のサブフィールドが互いに異なるように配置する際に、複数フレーム期間内において、ビット配列を時間対称配置にすることが好ましい。ここで、時間対称配置とは、ある時間を基準として、それよりも前の期間の白黒の位相と、それよりも後の期間の白黒の位相とが対称またはおおむね対称となっていることを指している。1フレーム期間内において、ビット配列を時間対称配置にするという場合は、例えば、サブフィールドSF1を基準として、それよりも前の期間SF5-1,SF4-1,SF5-2,SF3の白黒の位相と、それよりも後の期間SF2,SF5-3,SF4-2,SF5-4の白黒の位相とが対称またはおおむね対称となっていることを指している。例えば、図5Bの16ライン目に示したように、サブフィールドSF1を基準として、それよりも前の期間SF5-1,SF4-1,SF5-2,SF3の白黒の位相は、0101となっている。一方、図5Bの16ライン目に示したように、サブフィールドSF1を基準として、それよりも後の期間SF2,SF5-3,SF4-2,SF5-4の白黒の位相は、1010となっている。ここで、1010は、サブフィールドSF1において0101を折り返したものに等しい。従って、図5Bの16ライン目において、サブフィールドSF1よりも前の期間の白黒の位相0101と、サブフィールドSF1よりも後の期間の白黒の位相1010とは、サブフィールドSF1を基準として対称となっているといえる。また、複数フレーム期間内において、ビット配列を時間対称配置にするという場合は、例えば、nフレーム期間とn1フレーム期間との境界を基準として、nフレーム期間における階調データの白黒の位相と、n1フレーム期間における階調データの白黒の位相とが対称またはおおむね対称となっていることを指している。例えば、図5Bの16ライン目に示したように、nフレーム期間の階調データは、101000101となっている。一方、図5Bの16ライン目に示したように、nフレーム期間の階調データは、101000101となっている。ここで、101000101は、nフレーム期間とn1フレーム期間との境界において101000101を折り返したものに等しい。従って、図5Bの16ライン目において、nフレーム期間の白黒の位相101000101と、n1フレーム期間の白黒の位相101000101とは、nフレーム期間とn1フレーム期間との境界を基準として対称となっているといえる。ところで、1フレーム期間内または複数フレーム期間内において、ビット配列が、時間対称配置となっている場合、前半のビット配列によって生成される筋と、後半のビット配列によって生成される筋とが、白黒反転の関係となっている。つまり、一方の筋は黒い筋となっており、他方の筋は、白い筋となっている後述の図16の左側の図を参照。ここで、人間の目では、白黒反転の経時的な変化は積分値として認識される。そのため、1フレーム期間内または複数フレーム期間内において、ビット配列が、時間対称配置となっている場合には、人間の目では、黒い筋と、白い筋とが互いに相殺し合い、筋が生じていないように認識される。水平駆動回路60は、例えば、図5に示したように、フレーム期間ごとに、少なくとも一部の分割サブフィールドであって、かつ分割元のサブフィールドが互いに異なる分割サブフィールド同士の位置を互いに入れ替えるようになっている。水平駆動回路60は、さらに、例えば、図5に示したように、フレーム期間ごとに、期間が互いに等しい分割サブフィールドおよびサブフィールの位置を互いに入れ替えるようになっている。水平駆動回路60は、例えば、図5に示したように、nフレームにおいて、信号データを、先頭から順に、SF5-1、SF4-1、SF5-2、SF3、SF1、SF2、SF5-3、SF4-2、およびSF5-4の順番で規定するようになっている。このとき、水平駆動回路60は、n1フレームでは、1番目のSF51と2番目のSF4-1とを互いに入れ替え、3番目のSF52と4番目のSF3とを互いに入れ替え、8番目のSF42と9番目のSF5-4とを互いに入れ替えるようになっている。さらに、水平駆動回路60は、n2フレームでは、1番目のSF41と2番目のSF5-1とを互いに入れ替え、3番目のSF3と4番目のSF5-2とを互いに入れ替え、8番目のSF54と9番目のSF4-2とを互いに入れ替えるようになっている。なお、水平駆動回路60は、例えば、フレーム期間に関係なく、分割サブフィールドの位置を固定するようになっていてもよい。水平駆動回路60は、例えば、図4に示したように、nフレーム、n1フレーム、n2フレームのいずれにおいても、信号データを、先頭から順に、SF5-1、SF4-1、SF5-2、SF3、SF1、SF2、SF5-3、SF4-2、およびSF5-4の順番で規定するようになっていてもよい。また、水平駆動回路60は、補正後の信号データ30Aのサブフィールドおよび分割サブフィールドの並び順および期間に対応した制御信号60Aを垂直駆動回路50に出力するようになっている。効果次に、従来の一般的なデジタル駆動と対比しつつ、本実施の形態の表示装置1の効果について説明する。従来の一般的なPWMのデジタル駆動では、5ビット32階調の場合を例にとると、例えば、図18に示したような階調表示法が用いられる。具体的には、図18に示したように、例えば数ms幅の1ビットのデータを単位として、期間の比が1:2:4:8:16の5つのデータを用意し、これら5つのデータの組み合わせにより32階調が表現される。図19は、従来の一般的なデジタル駆動における順次走査の信号データと、走査線に印加される選択パルスとの関係を表したものである。ここでは、説明の都合上、走査線が3本の場合を示している。図19からわかるように、従来の一般的なデジタル駆動の表示装置では、階調データの各ビット本例では、1bit~5bitに対応し、かつ対応ビットの重みに応じた期間となるサブフィールドSF1~SF5で1フレーム期間1Fが分割されている。そして、各サブフィールドSF1~SF5に対応するビットに従って画素の電気光学素子がオンまたはオフされることで、1F中のオン期間またはオフ期間の割合が段階的に制御される。さらに、走査線を介した画素へのデータ書込みは、サブフィールドSF1~SF5ごとに線順次走査で行われる。図20は、グラデーション映像が垂直上方に変移する動画が、図19のデジタル駆動で表示される様子を模式的に表したものである。図20Aは、グラデーション映像を観察者が視認したときの映像の一部を表したものである。図20Bは、nフレーム目~n2フレーム目において、グラデーション映像が垂直上方に時間的に変化する様子をデジタル表示したものである。図20Cは、グラデーション映像が垂直上方に時間的に変化しているときにその動画を観察者が視認したときの映像の一部を表したものである。図20から、階調のわずかな違いで白黒の位相が反転するような階調表示法が用いられている場合に、グラデーション映像が垂直方向に時間的に変移することにより、白黒の位相が反転する画素において黒い筋L1が発生することがわかる。グラデーション映像は、人の顔の輪郭付近に発生する。そのため、人の顔が移動している映像において、人の顔の輪郭付近に上記の黒い筋L1が発生しやすい。人の顔の輪郭付近に発生する黒い筋L1は、人の顔の輪郭に沿って形成されるため、擬似輪郭と呼ばれる。擬似輪郭は、映像品質を著しく損なう。一方、本実施の形態では、画素11の点灯期間または消灯期間の単位として、期間の相対的に長いつまり高階調側のサブフィールドに対して分割サブフィールドが適用される。さらに、互いに隣接する分割サブフィールドの分割元のサブフィールドが互いに異なるように各分割サブフィールドが配置される。例えば、図2Bに示したように、階調データの4ビット目および5ビット目に対応するサブフィールドSF4,SF5が、サブフィールドSF4よりも期間の相対的に短いサブフィールドSF3の期間と等しい期間に分割されることにより、サブフィールドSF4から、2つの分割サブフィールドSF4-1,SF4-2が生成され、サブフィールドSF5から、4つの分割サブフィールドSF5-1,SF5-2,SF5-3,SF5-4が生成される。そのため、例えば、5ビットからなる階調データによって32階調を表現する場合、例えば、図3に示したように、例えば数ms幅の1ビットのデータを単位として、期間の比が4:4:4:4:1:2:4:4:4の9つのデータが用意され、これら9つのデータの組み合わせにより32階調が表現される。この階調表示法では、図18に示した階調表示法と比べて、階調のわずかな違いで、白黒の境界が長い時間に渡って固定される度合いが少なくなっている。図8、図9は、グラデーション映像が垂直上方に変移する動画が、図7と同様のデジタル駆動で表示される様子を模式的に表したものである。図8は、図4に示したように、nフレーム、n1フレーム、n2フレームのいずれにおいても、信号データが、先頭から順に、SF5-1、SF4-1、SF5-2、SF3、SF1、SF2、SF5-3、SF4-2、およびSF5-4の順番で規定されているときのものである。図9は、図5に示したように、フレーム期間ごとに、少なくとも一部の分割サブフィールドであって、かつ分割元のサブフィールドが互いに異なる分割サブフィールド同士の位置を互いに入れ替えているときのものである。図8A,図9Aは、グラデーション映像を観察者が視認したときの映像の一部を表したものである。図8B,図9Bは、nフレーム目~n2フレーム目において、グラデーション映像が垂直上方に時間的に変化する様子をデジタル表示したものである。図8C,図9Cは、グラデーション映像が垂直上方に時間的に変化しているときにその動画を観察者が視認したときの映像の一部を表したものである。図8,図9から、階調のわずかな違いで白黒の位相が反転するような階調表示法が用いられている場合に、グラデーション映像が垂直方向に時間的に変移したとしても、階調のわずかな違いで発生した白黒の境界が長い時間に渡って存在する度合いを少なくすることができる。これにより、図20に示したような黒い筋L1の発生を抑制することができる。従って、本実施の形態の階調表示法では、擬似輪郭を生じにくくすることができる。その結果、高い映像品質を得ることができる。また、本実施の形態において、少なくとも一部の分割サブフィールドが、1フレーム期間内において分割前とは異なる区間に配置されるともに、各分割サブフィールドが、互いに隣接する分割サブフィールドの分割元のサブフィールドが互いに異なるように配置される際に、1フレーム期間内または複数フレーム期間内において、ビット配列が時間対称配置となっている場合には、前半のビット配列によって生成される筋と、後半のビット配列によって生成される筋とが、白黒反転の関係となる。そのため、この場合には、人間の目では、黒い筋と、白い筋とが互いに相殺し合い、筋が生じていないように認識される。従って、このような階調表示法を用いることにより、擬似輪郭をさらに生じにくくすることができる。その結果、より高い映像品質を得ることができる。<2.変形例>変形例1上記実施の形態では、各分割サブフィールドは、互いに隣接する分割サブフィールドの分割元のサブフィールドが互いに異なるように配置されていたが、互いに等しくなるように配置されていてもよい。例えば、図10A,Bに示したように、水平駆動回路60は、サブフィールドSF4から生成された分割サブフィールドSF4-1,SF4-2を、サブフィールドSF4の位置に配置するようになっている。さらに、例えば、図10A,Bに示したように、水平駆動回路60は、サブフィールドSF5から生成された分割サブフィールドSF5-1,SF5-2,SF5-3,SF5-4を、サブフィールドSF5の位置に配置するようになっている。そのため、例えば、5ビットによって32階調が表現された階調データ図18参照が入力される場合、例えば、図11に示したように、例えば数ms幅の1ビットのデータを単位として、期間の比が1:2:4:4:4:4:4:4:4の9つのデータが用意され、これら9つのデータの組み合わせにより32階調が表現される。この階調表示法では、図18に示した階調表示法と比べて、階調のわずかな違いで、白黒の境界が長い時間に渡って固定される度合いが少なくなっている。ここで、先頭から4番目の期間および5番目の期間が、分割サブフィールドSF4-1,SF4-2に対応する期間である。また、先頭から6番目の期間、7番目の期間、8番目の期間および9番目の期間が、分割サブフィールドSF5-1,SF5-2,SF5-3,SF5-4に対応する期間である。この階調表示法では、分割サブフィールドSF4-1,SF4-2に対応するビットが、サブフィールドSF4に対応するビットと必ずしも等しくなっていない。同様に、分割サブフィールドSF5-1,SF5-2,SF5-3,SF5-4に対応するビットが、サブフィールドSF5に対応するビットと必ずしも等しくなっていない。そのため、本変形例では、例えば、ある範囲内の階調においては、サブフィールドSF3に対応するビットが、分割サブフィールドSF4-2に対応するビットに割り当てられている。また、例えば、上記とは別の範囲内の階調においては、サブフィールドSF3,分割サブフィールドSF41,SF4-2に対応するビットが、分割サブフィールドSF5-2,SF5-3,SF5-4に対応するビットに割り当てられている。さらに、例えば、上記とは別の範囲内の階調においては、サブフィールドSF3に対応するビットが、分割サブフィールドSF5-4に対応するビットに割り当てられている。この階調表示法では、図18に示した階調表示法と比べて、階調のわずかな違いで、白黒の境界が長い時間に渡って固定される度合いが少なくなっている。次に、図11に示した階調表示法を実現する方法について説明する。図12は、外部から入力された階調データを上記の階調表示法に補正する方法の一例を表したものである。図13は、図12における階調データを模式的に表したものである。まず、例えば、図12A,図13Aに示したように、5ビットによって32階調が表現された階調データが外部から入力される場合に、水平駆動回路60は、階調データの高ビット側のサブフィールドを、階調データの低ビット側のサブフィールドの期間と同じ期間の分割サブフィールドに分割する。例えば、図12B,図13Bに示したように、水平駆動回路60は、階調データの4ビット目のサブフィールドを、階調データの3ビット目のサブフィールドの期間と同じ期間で2つの分割サブフィールドに分割する。さらに、水平駆動回路60は、階調データの5ビット目のサブフィールドを、階調データの3ビット目のサブフィールドの期間と同じ期間で4つの分割サブフィールドに分割する。次に、水平駆動回路60は、最も期間の長いサブフィールドおよび分割サブフィールドに対応するビットの並びを、1白は1白同士が、0黒は0黒同士が互いに隣接するように並び替える。水平駆動回路60は、例えば、図12B,C,図13B,Cに示したように、分割後の階調データのうち、最も期間の長いサブフィールドおよび分割サブフィールドであるSF3~SF5-4に対応するビットの並びを、1白が低ビット側でまとまるとともに0黒が高ビット側でまとまるように、並び替える。これにより、図11に示した階調表示法を実現することができる。本変形例において、垂直駆動回路50は、制御信号40Cから特定されるアドレスデータに基づいて、各画素11を行単位で選択するための走査パルスを走査線WSLに出力するようになっている。垂直駆動回路50は、例えば、図14A~Dに示したように、サブフィールドSF1,SF2,SF3および分割サブフィールドSF4-1,SF4-2,SF5-1,SF5-2,SF5-3,SF5-4で1フレーム期間1Fを分割し、分割した期間ごとに、各走査線WSLに選択パルスを順次出力するようになっている。なお、図14Aの例では、垂直駆動回路50は、SF1,SF2,SF3,SF4-1,SF4-2,SF5-1,SF5-2,SF5-3,SF5-4の並びで1フレーム期間1Fを分割している。図15は、グラデーション映像が垂直上方に変移する動画が、図14と同様のデジタル駆動で表示される様子を模式的に表したものである。図15Aは、グラデーション映像を観察者が視認したときの映像の一部を表したものである。図15Bは、nフレーム目~n2フレーム目において、グラデーション映像が垂直上方に時間的に変化する様子をデジタル表示したものである。なお、図15A,Cは、nフレーム期間およびn2フレーム期間n偶数フレーム期間において、階調が大きくなるにつれて、低ビット側から白が埋められている。一方、図15Bは、n1フレーム期間n奇数フレーム期間において、階調が大きくなるにつれて、高ビット側から白が埋められている。図15Cは、グラデーション映像が垂直上方に時間的に変化しているときにその動画を観察者が視認したときの映像の一部を表したものである。図15から、階調のわずかな違いで白黒の位相が反転するような階調表示法が用いられている場合に、グラデーション映像が垂直方向に時間的に変移すると、n偶数のフレーム間で、白黒の位相が反転する画素において黒い筋がわずかに発生する場合があり、n奇数のフレーム間で、白黒の位相が反転する画素において白い筋がわずかに発生する場合がある。しかし、n偶数のフレームと、n奇数のフレームとが混在する動画においては、図16に示したように、黒い筋と、白い筋とが互いに相殺し合い、筋が消える。従って、本変形例の階調表示法でも、擬似輪郭を生じにくくすることができる。その結果、高い映像品質を得ることができる。変形例2上記実施の形態およびその変形例に係る階調表示は、シャッタ機能を有する偏向眼鏡で3D映像を視聴する3D表示装置に適用することも可能である。図17Aは、垂直駆動回路50が各画素行を走査するとともに、水平駆動回路60が各画素行に右目用の信号データおよび左目用の信号データを交互に印加している様子を表したものである。図17Bは、信号データの一例を表したものである。図17Aにおいて、シャッタメガネの開放オン期間は、1フレーム期間全てとなっており、さらに、シャッタメガネの開放オン期間に、表示下ライン画素行nの液晶応答立下りが完了するように、走査速度とシャッタメガネの開放オン期間とが設定されている。そのため、画素行の上と下で位相が異なるものの、どちらも前後が黒表示で挟まれており、均一な3D表示が可能となっている。本変形例において、水平駆動回路60は、右目用の信号データと、左目用の信号データとを交互に印加する際に、それらの間に、液晶応答期間と黒挿入期間を設けている。これにより、右目画像が表示されている期間と、左目用画像が表示されている期間とが互いに異なる期間に生成されるので、クロストークの発生を低減することができる。また、本変形例において、水平駆動回路60は、信号データとして、図17Bに示したもの図2Bと同様のものを印加するようになっている。これにより、信号データの期初においてオーバードライブ的な駆動が可能になる。以上、実施の形態および変形例を挙げて本技術を説明したが、本技術は上記実施の形態等に限定されるものではなく、種々変形が可能である。例えば、上記実施の形態等では、変換回路30、垂直駆動回路50および水平駆動回路60の駆動をコントローラ40が制御していたが、他の回路がこれらの駆動を制御するようにしてもよい。また、変換回路30、垂直駆動回路50および水平駆動回路60の制御は、ハードウェア回路で行われていてもよいし、ソフトウェアプログラムで行われていてもよい。また、例えば、本技術は以下のような構成を取ることができる。1電気光学素子を含むメモリ内蔵の画素が行列状に配置された表示装置における各画素を駆動する駆動回路であって、階調データの各ビットに対応し、かつ対応ビットの重みに応じた期間となる複数のサブフィールドで1フレーム期間を分割するとともに、期間の相対的に長い1または複数のサブフィールドを、期間の相対的に短いサブフィールドの期間と等しい期間に分割することにより複数の分割サブフィールドを生成する分割部と、各サブフィールドおよび各分割サブフィールドに対応するビットに従って画素の電気光学素子をオンまたはオフすることで、1フレーム期間中のオン期間またはオフ期間の割合を制御するオンオフ期間制御部とを含む駆動回路。2前記分割部は、少なくとも一部の分割サブフィールドを、1フレーム期間内において分割前とは異なる区間に配置する2に記載の駆動回路。3前記分割部は、各分割サブフィールドを、互いに隣接する分割サブフィールドの分割元のサブフィールドが互いに異なるように配置する2に記載の駆動回路。4前記分割部は、一部の分割サブフィールドを1フレーム期間の期初寄りに配置する2または3に記載の駆動回路。5前記分割部は、フレーム期間ごとに、少なくとも一部の分割サブフィールドであって、かつ分割元のサブフィールドが互いに異なる分割サブフィールド同士の位置を互いに入れ替える2ないし4のいずれか一項に記載の駆動回路。6前記分割部は、1フレーム期間内または複数フレーム期間内において、ビット配列を時間対称配置にする5に記載の駆動回路。7電気光学素子を含むメモリ内蔵の画素が行列状に配置された表示領域と、各画素を駆動する駆動回路とを備え、前記駆動回路は、階調データの各ビットに対応し、かつ対応ビットの重みに応じた期間となる複数のサブフィールドで1フレーム期間を分割するとともに、期間の相対的に長い1または複数のサブフィールドを、期間の相対的に短いサブフィールドの期間と等しい期間に分割することにより複数の分割サブフィールドを生成する分割部と、各サブフィールドおよび各分割サブフィールドに対応するビットに従って画素の電気光学素子をオンまたはオフすることで、1フレーム期間中のオン期間またはオフ期間の割合を制御するオンオフ期間制御部とを有する表示装置。8電気光学素子を含むメモリ内蔵の画素が行列状に配置された表示装置の駆動方法であって、階調データの各ビットに対応し、かつ対応ビットの重みに応じた期間となる複数のサブフィールドで1フレーム期間を分割するとともに、期間の相対的に長い1または複数のサブフィールドを、期間の相対的に短いサブフィールドの期間と等しい期間に分割することにより複数の分割サブフィールドを生成する分割ステップと、各サブフィールドおよび各分割サブフィールドに対応するビットに従って画素の電気光学素子をオンまたはオフすることで、1フレーム期間中のオン期間またはオフ期間の割合を制御するオンオフ期間制御ステップとを含む表示装置の駆動方法。"