アプリケーションマニュアル
Real Time Clock Module

RX4901CE/RX8901CE
製品名称
RX4901CE XS A0
RX4901CE XB A0
RX4901CE XS B0
RX4901CE XB B0
RX4901CE XS C0
RX4901CE XB C0
RX4901CE XS D0
RX4901CE XB D0
RX8901CE XS A0
RX8901CE XB A0
RX8901CE XS B0
RX8901CE XB B0

製品型番X1B000471000115
X1B000471000215
X1B000471000315
X1B000471000415
X1B000471000515
X1B000471000615
X1B000471000715
X1B000471000815
X1B000481000115
X1B000481000215
X1B000481000315
X1B000481000415

本マニュアルのご使用につきましては、次の点にご留意願います。
1.

本資料の内容については、予告無く変更することがあります。弊社製品のご購入およびご使用にあたりましては事前に弊社営業窓口で最新の情報をご確認いただきますとともに、弊社ホームページなどを通じて公開される最新情報に常にご注意ください。

2.

本資料の一部または全部を、弊社に無断で転載または複製など他の目的に使用することは堅くお断りします。

3.

本資料に掲載されている応用回路、プログラム、使用方法などはあくまでも参考情報であり、これらに起因する第三者の知的財権およびその他の権利侵害ならびに損害の発生に対し、弊社はいかなる保証を行うものではありません。また、本資料によって第三者または弊社の知的財産権およびその他の権利の実施権の許諾を行うものではありません。

4.

弊社製品のご使用にあたりましては、弊社製品の誤作動や故障により生命・身体に危害を及ぼすことまたは財産が侵害されることのないよ
うに、お客様の責任において、お客様のハードウェア、ソフトウェア、システムに必要な安全設計を行うようお願いします。
なお、設計および使用に際しては、弊社製品に関する最新の情報 (本資料、仕様書、データシート、マニュアル、弊社ホームページなど)をご確認いただき、それに従ってください。また、上記資料などに掲載されている製品データ、図、表などに示す技術的な内容、プログラム、アルゴリズムその他応用回路例などの情報を使用する場合は、お客様の製品単独およびシステム全体で十分に評価を行い、お客様の責任において適用可否の判断をお願いします。

5.

弊社は正確さを期すために慎重に本資料を作成しておりますが、本資料に掲載されている情報に誤りがないことを保証するものではありません。万一、本資料に掲載されている情報の誤りによってお客様に損害が生じた場合においても、弊社は一切その責任を負いかねます。

6.

弊社製品の分解、解析、リバースエンジニアリング、改造、改変、翻案、複製などは堅くお断りします。

7.

弊社製品は、一般電子機器製品用途および弊社指定用途に使用されることを意図して設計、開発、製造しています (指定用途)。この指定
用途の範囲を超えて、特別または高度な品質、信頼性が要求され、その誤動作や故障により生命・身体に危害を及ぼす恐れ、膨大な財物損
害を引き起こす恐れ、もしくは社会に深刻な影響を及ぼす恐れのある以下を含む用途 (特定用途) に使用されることを意図していません。
【特定用途】
宇宙機器 (人工衛星・ロケットなど) / 輸送車両並びにその制御機器 (自動車・航空機・列車・船舶など)
医療機器 / 海底中継機器 / 発電所制御機器/防災・防犯装置 / 交通用機器 / 金融関連機器
上記と同等の信頼性を必要とする用途
お客様に置かれましては、製品を指定用途に限定して使用されることを強く推奨いたします。もし指定用途以外の用途で製品のご使用およびご購入を希望される場合、弊社はお客様の特定用途に弊社製品を使用されることへの商品性、適合性、安全性について、明示的・黙示的に関わらず、いかなる保証をおこなうものではありません。お客様が特定用途での弊社製品の使用を希望される場合は、弊社営業窓口まで
事前にご連絡ください。

8.

本資料に掲載されている弊社製品および弊社技術を国内外の法令および規制により製造・使用・販売が禁止されている機器・システムに使用することはできません。また、弊社製品および弊社技術を大量破壊兵器等の開発目的、および軍事利用の目的、その他軍事用途等に使用しないでください。弊社製品または弊社技術を輸出または海外に提供する場合は、「外国為替及び外国為替法」、「米国輸出管理規則(EAR)」、その他輸出関連法令を遵守し、係る法令の定めるところにより必要な手続きを行ってください。

9.

弊社は、お客様が本資料に掲載されている諸条件に反したことに起因して生じたいかなる損害 (直接・間接を問わず) に関して、一切その責任を負いかねます。また、お客様が弊社製品を第三者に譲渡、貸与などをしたことにより、損害 (直接・間接を問わず) が発生した場
合、弊社は一切その責任を負いかねます。

10. 本資料についての詳細に関するお問合せ、その他お気付きの点などがありましたら、弊社営業窓口までご連絡ください。
11. 本資料に掲載されている会社名、商品名は、各社の商標または登録商標です。

©Seiko Epson Corporation 2022, All rights reserved.

ETM63J 改訂履歴
Rev. No.

Date

Page

01

2021/12/06

All
8
98

Description
新規登録
VDD = VBAT = GND の状態を 10 秒以上保持を 100ms 以上保持に修正しました。
2.2.1 電源投入シーケンス
5.6 5.6 電源投入特性

43
43ページバックアップ電池実装時の注意 を新たに追加しました02

2022/10/12

100

この追記に伴い 100 ページ "７実装上の注意事項"の「バックアップ電池実装」の記述は削除されました。

101 10293

参考回路例 注意書き *1 *2 *3 を改訂しました。
各回路例の電池をBackup Battery に統一しました。

消費電流11 の条件説明を改訂しました。

RX4901CE/RX8901CE
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i

はじめに
本書は、セイコーエプソン製RTC (リアルタイムクロック) モジュールRX4901CEおよびRX8901CEの機能、制御方法、仕様、電気的特性を記載したアプリケーションマニュアルです。RX4901CE/RX8901CEを搭載する製品の設計者向けに作成されています。
RX4901CEはSPI、RX8901CEはI2C-Busを介してホストデバイスからアクセスします。これらのインターフェイ
スの動作および制御方法については、ホストデバイスのマニュアル等を参照してください。

本書内の表記や記号について
数値の表記
本マニュアルは、10進数、2進数、16進数の数値を扱います。
10進数 例: 1, 10, 123 (一般的な数値や日付、時刻など)
2進数 例: 0b0, 0b10, 0b1111 (制御ビットの設定値、読み出し値など)
16進数 例: 0x0, 0xF, 0xFF (アドレスやレジスターの設定値など)

レジスター/ビット名の表記
本マニュアルではレジスター名とビット名を次のように記載しています。
レジスター名: レジスターSEC
TSTP_INTE.STOPビット
レジスターTSTP_INTE内のSTOPビットを表します。

ビット名:

TCTL.FSEL[1:0]ビット
レジスターTCTL内のFSEL1とFSEL0ビットの2ビットを表します。

チャネル番号の表記
タイムスタンプ機能にはチャネルごとに同一機能を持つ端子や制御ビットが用意されています。この
端子名やビット名にはチャネル番号 (例: 1 〜 3) が含まれています。特に分けて説明する必要がない
場合、本書ではこの数値を“n”として複数チャネルを一括して説明しています。また、同一機能のビッ
トでもビット数が異なる場合は、ビット番号を“x”と表記しています。その他、名称の一部が共通な複数のビットを“***”を使用し、一つにまとめている場合もあります。
端子名:EVIN1、EVIN2、EVIN3 → EVINn

ビット名: EVIN_EN.EVIN1EN、EVIN_EN.EVIN2EN、EVIN_EN.EVIN2EN→ EVIN_EN.EVINnEN
BUF1_STAT.PTR[5:0]、BUF2_STAT.PTR[3:0]、BUF3_STAT.PTR[3:0]→ BUFn_STAT.PTR[x:0]EVIN_EN.EVIN1CPEN、CAP_EN.VBATLCPENなど→ ***CPEN

RX4901CE/RX8901CE
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ii

目

次

ETM63J 改訂履歴 ................................................................................................................................ i
43 ページバックアップ電池実装時の注意 を新たに追加しました .................................................... i

はじめに .............................................................................................................................................. ii
本書内の表記や記号について ............................................................................................................. ii
数値の表記 ...................................................................................................................................ii
レジスター/ビット名の表記 .........................................................................................................ii
チャネル番号の表記 .....................................................................................................................ii

目

次 iii

1 概要 ................................................................................................................................ 1
1.1

特長 ............................................................................................................................................... 11.2

ブロック図 .................................................................................................................................... 2
RX4901CE .................................................................................................................................. 2
RX8901CE .................................................................................................................................. 3

1.3 端子 ............................................................................................................................................... 4
1.3.1 端子配置図 .............................................................................................................................. 4RX4901CE .................................................................................................................................. 4RX8901CE .................................................................................................................................. 41.3.2

端子説明 ................................................................................................................................. 4記号の意味 .................................................................................................................................. 42 電源と初期化 .................................................................................................................. 62.1

電源 ............................................................................................................................................... 6

2.2 初期化 ........................................................................................................................................... 8
2.2.1 電源投入シーケンス ............................................................................................................... 8
2.2.2 発振開始時間 .......................................................................................................................... 8
2.2.3 初期設定 ............................................................................................................................... 10
初期設定手順 ............................................................................................................................. 10

2.3

動作モード ...................................................................................................................................11
VDD 立ち上がり待機状態 ........................................................................................................... 11
イニシャルモード ..................................................................................................................... 11
ノーマルモード ......................................................................................................................... 11
ノーマルモード (バックアップモードへ移行可能) .................................................................. 11
バックアップモード .................................................................................................................. 11

3 機能 .............................................................................................................................. 13
3.1 ホストインターフェイス ............................................................................................................ 13
3.1.1 RX4901CE レジスターへのアクセス (SPI)......................................................................... 13
SPI インターフェイス端子 ....................................................................................................... 13
レジスターライト ..................................................................................................................... 14
レジスターリード ..................................................................................................................... 15

3.1.2

RX8901CE レジスターへのアクセス (I2C-Bus) .................................................................. 16
I2C-Bus インターフェイス端子 ................................................................................................. 16
スレーブアドレス ..................................................................................................................... 16
レジスターライト ..................................................................................................................... 16
レジスターリード ..................................................................................................................... 17

3.2 時計/カレンダー機能 .................................................................................................................. 18
3.2.1 概要 ....................................................................................................................................... 18
3.2.2 動作 ....................................................................................................................................... 19
計時バッファーを介した時計/カレンダーカウンターへのアクセス ........................................ 19
時計/カレンダーの初期設定と計時の開始 ................................................................................ 21
時計/カレンダーの読み出し ...................................................................................................... 21
うるう年の判定 ......................................................................................................................... 22
うるう秒の挿入手順 .................................................................................................................. 22

3.3 温度補償機能 .............................................................................................................................. 23
3.3.1 動作 ....................................................................................................................................... 23
温度補償間隔の設定 .................................................................................................................. 23
温度補償動作フラグ VTMPLF フラグ (0x0E) ........................................................................ 23

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3.4 時刻更新割り込み機能 ................................................................................................................ 24
3.4.1 概要 ....................................................................................................................................... 24
3.4.2 動作 ....................................................................................................................................... 24
割り込み周期の選択 .................................................................................................................. 24
割り込み許可/禁止手順 ............................................................................................................. 24
割り込み動作 ............................................................................................................................. 25

3.5 アラーム機能 .............................................................................................................................. 26
3.5.1 概要 ....................................................................................................................................... 26
3.5.2 動作 ....................................................................................................................................... 26
アラーム設定手順 ..................................................................................................................... 26
アラーム設定例 ......................................................................................................................... 27
アラーム割り込み ..................................................................................................................... 28

3.6 ウェイクアップタイマー機能 ..................................................................................................... 29
3.6.1 概要 ....................................................................................................................................... 29
3.6.2 動作 ....................................................................................................................................... 29
ソースクロック ......................................................................................................................... 29
プリセットデータ (ウェイクアップタイマー割り込み周期).................................................... 29
カウント動作条件 ..................................................................................................................... 30
ウェイクアップタイマー設定手順 ............................................................................................ 30
カウントアップの開始 .............................................................................................................. 31
一時停止 .................................................................................................................................... 31
カウンターデータの読み出し ................................................................................................... 32
カウンターのリセット .............................................................................................................. 32
ウェイクアップタイマー割り込み ............................................................................................ 32

3.7 FOUT 出力機能 ........................................................................................................................... 34
3.7.1 概要 ....................................................................................................................................... 34
3.7.2 動作 ....................................................................................................................................... 34
初期設定 .................................................................................................................................... 34
FOUT 出力の制御 (FOE 端子を使用しない場合) ..................................................................... 34
FOUT 出力の制御 (FOE 端子を使用する場合) ........................................................................ 35
FOUT 端子からのウェイクアップタイマー割り込み信号出力 ................................................. 35

3.8 自己監視機能 .............................................................................................................................. 36
3.8.1 概要 ....................................................................................................................................... 36
3.8.2 自己監視フラグ機能 ............................................................................................................. 36
パワーオンリセット発生検出: PORF フラグ ........................................................................... 36
水晶発振停止検出: OSCSTPF フラグ ...................................................................................... 36
日時データ無効警告: VLF フラグ ............................................................................................. 36
VDD 電圧低下検出: VDDLF フラグ............................................................................................. 36
VBAT 電圧低下検出: VBATLF フラグ .......................................................................................... 37
温度補償更新停止検出: VTMPLF フラグ .................................................................................. 37

3.9 バックアップ電源切り替え機能 ................................................................................................. 38
3.9.1 概要 ....................................................................................................................................... 38
3.9.2 動作 ....................................................................................................................................... 38
動作モード ................................................................................................................................ 38
バックアップ電源切り替え機能を使用する場合の設定 ........................................................... 39
バックアップ電源切り替え機能を使用しない場合の設定 ........................................................ 39
バックアップ電源切り替えの動作 ............................................................................................ 39
小容量 EDLC 使用時の注意 ...................................................................................................... 43
バックアップ電池実装時の注意 ................................................................................................ 43

3.10 タイムスタンプ機能 ................................................................................................................... 44
3.10.1 概要 ....................................................................................................................................... 44
3.10.2 タイムスタンプトリガー ...................................................................................................... 45
外部イベント入力 (EVINn 端子)トリガー ................................................................................ 45
内部イベントトリガー .............................................................................................................. 47
コマンドトリガー ..................................................................................................................... 47

3.10.3 タイムスタンプバッファー .................................................................................................. 47
タイムスタンプデータ .............................................................................................................. 47
タイムスタンプバッファーの動作モード ................................................................................. 48
タイムスタンプバッファーの書き込みモード .......................................................................... 49

3.10.4 動作 ....................................................................................................................................... 49
初期設定 .................................................................................................................................... 49
RX4901CE/RX8901CE
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タイムスタンプキャプチャー動作 ............................................................................................ 52
コマンドトリガーの発行 .......................................................................................................... 56
タイムスタンプデータの読み出し ............................................................................................ 58
タイムスタンプデータのクリア ................................................................................................ 61

3.10.5 タイムスタンプ (イベント検出) 割り込み .......................................................................... 62

4 レジスター .................................................................................................................... 63
4.1

レジスター一覧 ........................................................................................................................... 63

4.2

レジスター詳細説明 ................................................................................................................... 67

記号の意味 ................................................................................................................................ 63
Bank 0 ....................................................................................................................................... 63
Bank 1 ....................................................................................................................................... 64
Bank 2 ....................................................................................................................................... 64
Bank 3 ....................................................................................................................................... 65
Bank 4 ....................................................................................................................................... 65
Bank 5 ....................................................................................................................................... 65
Bank 6 (FIFO モードでのタイムスタンプデータ読み出し時) .................................................. 66
Bank 6 (ダイレクトモードでのタイムスタンプデータ読み出し時) ......................................... 66
Bank 6 (SRAM モード) ............................................................................................................. 66
0x00: SEC (Second Data) ......................................................................................................... 67
0x01: MIN (Minute Data) ........................................................................................................... 67
0x02: HOUR (Hour Data) .......................................................................................................... 67
0x03: WEEKDAY (Day-of-Week Data)...................................................................................... 67
0x04: DAY (Day Data) ............................................................................................................... 68
0x05: MONTH (Month Data) ..................................................................................................... 68
0x06: YEAR (Year Data) ........................................................................................................... 68
0x07: ALM_MIN (Minute Alarm) ................................................................................................ 69
0x08: ALM_HOUR (Hour Alarm) ............................................................................................... 69
0x09: ALM_WEEKDAY (Day-of-Week Alarm / Day Alarm) ....................................................... 70
0x0A: WTCNT_L (Wakeup Timer Counter Low) ....................................................................... 71
0x0B: WTCNT_M (Wakeup Timer Counter Middle) .................................................................. 71
0x0C: WTCNT_H (Wakeup Timer Counter High) ..................................................................... 71
0x0D: TCTL (Timer Control) ...................................................................................................... 71
0x0E: INTF (Status Flag) .......................................................................................................... 73
0x0F: TSTP_INTE (Timer Stop and Interrupt Enable) .............................................................. 74
0x10: SUBSEC_L (Sub-Second Data Low) .............................................................................. 75
0x11: SUBSEC_H (Sub-Second Data High) ............................................................................. 75
0x12: SEC_MIR (Mirrored Second Data, = 0x00)..................................................................... 76
0x13: MIN_MIR (Mirrored Minute Data, = 0x01) ....................................................................... 76
0x14: HOUR_MIR (Mirrored Hour Data, = 0x02) ...................................................................... 76
0x15: WEEKDAY_MIR (Mirrored Day-of-Week Data, = 0x03) ................................................. 76
0x16: DAY_MIR (Mirrored Day Data, = 0x04) ........................................................................... 76
0x17: MONTH_MIR (Mirrored Month Data, = 0x05) ................................................................. 76
0x18: YEAR_MIR (Mirrored Year Data, = 0x06) ....................................................................... 77
0x20: EVIN_EN (Event Input Enable) ....................................................................................... 77
0x21: EVIN1_CFG (EVIN1 Configuration) ................................................................................ 77
0x23: EVIN2_CFG (EVIN2 Configuration) ................................................................................ 77
0x25: EVIN3_CFG (EVIN3 Configuration) ................................................................................ 77
0x22: EVIN1_FLT (EVIN1 Noise Filter) ..................................................................................... 78
0x24: EVIN2_FLT (EVIN2 Noise Filter) ..................................................................................... 78
0x26: EVIN3_FLT (EVIN3 Noise Filter) ..................................................................................... 78
0x27: BUF1_CFG1 (BUF1 Configuration 1) ............................................................................. 79
0x2A: BUF2_CFG1 (BUF2 Configuration 1) ............................................................................. 79
0x2D: BUF3_CFG1 (BUF3 Configuration 1) ............................................................................. 79
0x28: BUF1_STAT (BUF1 Status) ............................................................................................. 80
0x2B: BUF2_STAT (BUF2 Status) ............................................................................................ 80
0x2E: BUF3_STAT (BUF3 Status) ............................................................................................ 80
0x29: BUF1_CFG2 (BUF1 Configuration 2) ............................................................................. 80
0x2C: BUF2_CFG2 (BUF2 Configuration 2) ............................................................................. 80
0x2F: BUF3_CFG2 (BUF3 Configuration 2) ............................................................................. 80
0x30: ALM_SEC (Second Alarm) .............................................................................................. 81
0x31: ALM_MIN_MIR (Mirrored Minute Alarm, = 0x07) ............................................................ 82
0x32: ALM_HOUR_MIR (Mirrored Hour Alarm, = 0x08) ........................................................... 82
0x33: ALM_WEEKDAY_MIR (Mirrored Day-of-Week Alarm / Day Alarm, = 0x09) ................... 82
0x34: UPDISEL (Time Update Interrupt Select) ....................................................................... 82

RX4901CE/RX8901CE
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0x37: PWSW_CFG (Power Switch Configuration) ................................................................... 82
0x38: WTICFG (Wakeup Timer Interrupt Configuration) .......................................................... 83
0x39: WTCTL (Wakeup Timer Control) ..................................................................................... 84
0x3A: WTCNT_L_MIR (Mirrored Wakeup Timer Counter Low, = 0x0A) .................................. 85
0x3B: WTCNT_M_MIR (Mirrored Wakeup Timer Counter Middle, = 0x0B) ............................. 85
0x3C: WTCNT_H_MIR (Mirrored Wakeup Timer Counter High, = 0x0C) ................................ 85
0x41: WRCMD_CFG (Write Command Configuration) ............................................................ 85
0x42: WRCMD_TRG (Write Command Trigger) ....................................................................... 86
0x43: EVNT_INTE (Event Interrupt Enable) ............................................................................. 87
0x44: CAP_EN (Capture Enable) ............................................................................................. 88
0x46: BUF_INTF (Buffer Interrupt Factor) ................................................................................ 88
0x47: EVNT_INTF (Event Interrupt Factor) .............................................................................. 89
0x4E: BUF_FULLF (Buffer Full Flag) ........................................................................................ 90
0x4F: BUF_OVWF (Buffer Overwrite Flag) ............................................................................... 90
0x51: EVIN1_EVCNT (EVIN1 Event Counter) .......................................................................... 91
0x52: EVIN2_EVCNT (EVIN2 Event Counter) .......................................................................... 91
0x53: EVIN3_EVCNT (EVIN3 Event Counter) .......................................................................... 91
0x54: EVINMON (EVIN Monitor) ............................................................................................... 91

5 電気的特性 .................................................................................................................... 92
5.1

絶対最大定格 .............................................................................................................................. 92

5.2

推奨動作条件 .............................................................................................................................. 925.3周波数特性 .................................................................................................................................. 92

5.4

DC 特性 ....................................................................................................................................... 93
DC 特性 ..................................................................................................................................... 93
温度補償回路動作と消費電流 ................................................................................................... 94
バックアップ電源切り替え素子特性 (参考) ............................................................................. 94

5.5

AC 特性 ....................................................................................................................................... 96
RX4901CE AC 特性 .................................................................................................................. 96
RX8901CE AC 特性 .................................................................................................................. 97

5.6

電源投入特性 .............................................................................................................................. 98

6 パッケージ .................................................................................................................... 996.1

外形寸法図 .................................................................................................................................. 99

6.2

マーキングレイアウト ................................................................................................................ 99

7 実装上の注意事項 ....................................................................................................... 100
静電気 ..................................................................................................................................... 100
ノイズ ..................................................................................................................................... 100
入力端子の電圧 ....................................................................................................................... 100
未使用入力端子の処理 ............................................................................................................ 100
はんだ付け温度 ....................................................................................................................... 100
実装機 ..................................................................................................................................... 100
超音波洗浄 .............................................................................................................................. 100
実装方向 .................................................................................................................................. 100
端子間リーク ........................................................................................................................... 100

8 参考回路例 .................................................................................................................. 101
図表一覧 ......................................................................................................................... 103
図 ............................................................................................................................................. 103
表 ............................................................................................................................................. 104

RX4901CE/RX8901CE
ETM63J-02

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Seiko Epson Corporation

vi

1

概要

1 概要
RX4901CE/RX8901CEは、32.768 kHzデジタル温度補償型水晶発振器 (DTCXO) を搭載したRTC (リアルタイム
クロック) モジュールです。RTCの基本機能である時刻カレンダー、時刻アラーム、ウェイクアップタイマー、
時刻更新割り込みに加え、外部または内部のイベント発生日時を最大32回記録可能なタイムスタンプなどの、豊富な機能があります。さらに、主電源への電流逆流防止制御を含むバックアップ電源自動切り替え機能や、常時温度補正された32.768 kHzのクロック出力と、独自の低消費電流技術の組み合わせにより、各種システムの時計カレンダー情報やタイムスタンプの長期運用を実現します。
RX4901CE
①

XS
②

A0
③

① 機種名 CE タイプパッケージ 3.2 x 2.5 x 1.0 mm② 周波数精度③ Pin Option A0~D0 ：Option A~D
表 1.1 製品ラインナップ
製品名称

インターフェイス

RX4901CE Option A XS

3線SPI

デフォルト端子機能
Pin 4 *1

Pin 10 *2

FOUT

EVIN2

周波数精度 *3
XS

RX4901CE Option A XB

XB

RX4901CE Option B XS

EVIN3

XS

RX4901CE Option B XB

XB

RX4901CE Option C XS

4線SPI

FOUT

DI

XS

RX4901CE Option C XB

XB

RX4901CE Option D XS

EVIN3

XS

RX4901CE Option D XB

XB
I2C-BusRX8901CE Option A XS

FOUT

EVIN2

XS

RX8901CE Option A XB

XB

RX8901CE Option B XS

EVIN3

XS

RX8901CE Option B XB

XB

*1 製品によりPin 4のデフォルト機能が異なります。起動後にレジスターの設定によってFOUT (クロック出力) 端子またはEVIN3 (外部イベン
ト入力) 端子に切り替え可能です。
*2 Option A/B Pin 10のデフォルト機能はEVIN2です。起動後にレジスターの設定によってFOE (FOUT出力制御) 端子に切り替え可能です。
*3 XSとXB (精度) の違いについては、“5.3 周波数特性”の周波数安定度を参照してください。

1.1 特長表 1.2

特長RX4901CE
Option B
Option C

製品ラインナップ
Option A

RX8901CE
Option A
Option B

Option D

4線SPI

I2C-Bus

ホストインターフェイス

3線SPI

水晶発振器

32.768 kHzデジタル温度補償型水晶発振器 (DTCXO) を搭載

時計/カレンダー• 秒、分、時、日、月、年をカウントするBCDカウンターならびに曜日カウンター、
1/1024秒をカウントするバイナリーカウンターを搭載• うるう年の自動補正機能搭載 うるう秒補正操作可能• 時刻更新割り込みを発生可能 (1秒、1分、1時間の各時刻 (カウンター) 更新時)

ウェイクアップタイマー• 976.56 µs ～ 32年周期で割り込みを発生可能• 主電源動作あるいはバックアップ電源動作の積算時間計として使用可能

アラーム

秒から日 (または曜日) までを指定し、割り込みを発生可能

タイム
トリガー要因スタンプ 記録データ

外部イベント (EVIN) 入力、RTC内電圧低下/発振停止検出、ホストからのコマンド入力
1/1024秒 〜 1秒、秒、分、時、日、月、年、トリガー要因、内部ステータス

記録可能なイベント数

最大32イベント

外部イベント入力端子 *1(EVIN2)、(EVIN3)(EVIN3)

SRAMメモリー

容量、256バイトを搭載 (タイムスタンプデータの記録領域と兼用)

クロック出力 (FOUT) *1• 32.768 kHz、1024 Hz、または1 Hz出力を選択可能• レジスターまたはFOE入力 (レジスター選択) により出力を制御可能

自己監視機能発振停止、VDD/VBAT電圧低下を検出し割り込みを発生可能

RX4901CE/RX8901CE
ETM63J-02

EVIN1、(EVIN2)、(EVIN3)

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1

1
RX4901CE
Option B
Option C

製品ラインナップ
Option A

Option D

概要

RX8901CE
Option A
Option B

バックアップ電源切り替え機能• VDD/VBAT電圧を監視し、ノーマルモード (VDD動作) とバックアップモード (VBAT動作) を切り替え• バックアップ二次電池/容量の充電制御

動作電圧 (VDD)

1.60 V 〜 5.5 V

動作温度-40 °C 〜 +105 °C*1 EVIN3入力とFOUT出力はどちらか一方のみ使用可能です。EVIN2入力とFOE入力はどちらか一方のみ使用可能です。

1.2 ブロック図
RX4901CE
Oscillator(DTCXO)

32.768 kHz

Divider

Clock/
calendar

FOUT
controller
/INT

Alarm

Interrupt
controller
GND

EVIN2/
FOE

Wakeup timer

Option A

FOUT/
EVIN3

Event trigger
controller

Option B

GND

Pull-up/down
control

VDDTime stamp

CE
GND

Power
controller/
switchingcircuitBus interface(3-wire SPI)

CLK
DIO

VDD
VBAT
GND
VOUT

RX4901CE Option A/B
図 1.1

RX4901CE Option A/Bブロック図

RX4901CE/RX8901CE
ETM63J-02

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1
Oscillator(DTCXO)

32.768 kHz

Divider

概要

Clock/
calendar

FOUT
controller
/INT

Alarm

Interrupt
controller
GND

Wakeup timer

Option C

FOUT/
EVIN3

Event trigger
controller

Option D

GND

Pull-up/down
control

VDDTime stamp

CE
GND

Power
controller/
switchingcircuitBus interface(4-wire SPI)

CLK
DO
DI

VDD
VBAT
GND
VOUT

RX4901CE Option C/D
図 1.2

RX4901CE Option C/Dブロック図

RX8901CE
Oscillator(DTCXO)

32.768 kHz

Divider

Clock/
calendar

FOUT
controller
/INT

Alarm

Interrupt
controller
GND

Wakeup timer

EVIN1
EVIN2/
FOE

Event trigger
controller

Option A

FOUT/
EVIN3

Time stamp
Option B

GND

Pull-up/down
control

VDD

SCL

Power
controller/
switchingcircuitBus interface
(I2C)

VDD
VBAT
GND
VOUT

SDA

RX8901CE Option A/B

GND

図 1.3

RX8901CE Option A/Bブロック図

RX4901CE/RX8901CE
ETM63J-02

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3

1

概要

1.3 端子1.3.1 端子配置図
RX4901CE
端子名

No.

No.

端子名

VDD
VOUT
VBAT
FOUT/EVIN3
CLK

1
2
3
4
5

10
9
8
7
6

EVIN2 (デフォルト)/FOE
GND
/INT
DIO
CE

図 1.4

RX4901CE Option A/B端子配置図

端子名

No.

No.

端子名

VDD
VOUT
VBAT
FOUT/EVIN3
CLK

1
2
3
4
5

10
9
8
7
6

DI
GND
/INT
DO
CE

図 1.5

RX4901CE Option C/D端子配置図

RX8901CE
端子名

No.

No.

端子名

VDD
VOUT
VBAT
FOUT/EVIN3
SCL

1
2
3
4
5

10
9
8
7
6

EVIN2 (デフォルト)/FOE
GND
/INT
SDA
EVIN1

図 1.6

RX8901CE Option A/B端子配置図

1.3.2 端子説明
記号の意味
入出力

I:
O:
I/O:

入力端子
出力端子
入出力端子

初期状態

Hi-Z:
PU:
PD:

ハイインピーダンス
プルアップ
プルダウン

機種別欄

✓:
*1:
*2:
–:

あり
EVIN3入力とFOUT出力はどちらか一方のみ使用可能 (レジスターで選択)
EVIN2入力とFOE入力はどちらか一方のみ使用可能 (レジスターで選択)なし

RX4901CE/RX8901CE
ETM63J-02

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4

1
表 1.3
端子名

入出力 初期状態

EVIN1

概要

端子説明

機能

RX4901CE
A

B

C

RX8901CE
D

A

B

I

PU
–
–
–
–
外部イベント入力端子✓✓(1 MΩ) これらの端子の入力信号がタイムスタンプのトリガーとして使用されま––✓*2 ✓*2✓*2 ✓*2
す (バックアップ時でも検出可能)。
プログラマブルなプルアップ/プルダウン抵抗とノイズフィルターを内蔵(✓)*1 ✓*1 (✓)*1 ✓*1 (✓)*1 ✓*1
しています。

CLK

I

Hi-Z

3線/4線SPIシリアルクロック入力端子
本端子はノーマルモードではフローティング状態禁止です。バックアップモードではフローティング状態が許可されます。

✓

✓

✓

✓

–

–

DIO

I/O

Hi-Z

3線SPIシリアルデータ入出力端子
本端子はノーマルモードではフローティング状態禁止です。バックアップモードではフローティング状態が許可されます。

✓

✓

–

–

–

–

DO

O

Hi-Z

4線SPIシリアルデータ出力端子

–

–

✓

✓

–

–

DI

I

Hi-Z

4線SPIシリアルデータ入力端子
本端子はノーマルモードではフローティング状態禁止です。バックアップモードではフローティング状態が許可されます。

–

–

✓

✓

–

–

CE

I

✓

✓

✓

✓

–

–

SCL

I

Hi-Z

I2C-Busシリアルクロック入力端子
本端子はノーマルモードではフローティング状態禁止です。バックアップモードではフローティング状態が許可されます。
外部で5.5 Vまでプルアップすることが可能です。

–

–

–

–

✓

✓

SDA

I/O

Hi-Z

I2C-Busシリアルデータ入出力端子 (N-chオープンドレイン)
本端子はノーマルモードではフローティング状態禁止です。バックアップモードではフローティング状態が許可されます。
外部で5.5 Vまでプルアップすることが可能です。

–

–

–

–

✓

✓

FOUT

O

Hi-Z

クロック出力端子 (CMOS)
32.768 kHz (デフォルト)、1024 Hz、1 Hz出力が選択可能です。
ウェイクアップタイマー割り込み出力 (CMOS) に切り替え可能です。

✓*1 (✓)*1 ✓*1 (✓)*1 ✓*1 (✓)*1

FOE

I

Hi-Z

FOUT出力制御端子(✓)*2 (✓)*2
本端子は、ノーマルモードでもバックアップモードでも、フローティング
状態禁止です。

–

–

/INT

O

Hi-Z

割り込み出力端子 (N-chオープンドレイン)
ウェイクアップタイマー/時刻更新/アラーム/イベント検出割り込み信号の出力が選択可能で、複数選択時はNOR出力となります。
本端子は、バックアップモードでも有効となります。
外部で5.5 Vまでプルアップすることが可能です。

✓

✓

✓

✓

✓

✓

VDD

–

–

主電源端子
ノーマルモード時は、この端子から内部に電源が供給されます。

✓

✓

✓

✓

✓

✓

VOUT

–

–

内部動作電圧出力端子
バックアップ電源切り替え機能使用時は、1.0 µFの安定化コンデンサを接続してください。

✓

✓

✓

✓

✓

✓

VBAT

–

–

バックアップ電源端子
大容量キャパシタ (EDLC)、二次電池、一次電池等のバックアップ用電源を接続してください。
バックアップモード時は、この端子から電源が供給されます。

✓

✓

✓

✓

✓

✓

GND

–

–

グラウンド端子

✓

✓

✓

✓

✓

✓

EVIN2
EVIN3

PD
3線/4線SPIスレーブセレクト入力端子(300 kΩ) プルダウン抵抗を内蔵しています。

(✓)*2 (✓)*2

注: • 未使用の入力/入出力端子は、内蔵プルアップ/プルダウンが有効でない場合、オープンや中間電位にしないでください。
• FOUT出力、/INT出力を使用しない場合はオープンにしてください。
• すべての入力/入出力端子は、動作電源電圧にかかわらず5.5 Vまで入力可能な、入力トレラント構成です。

RX4901CE/RX8901CE
ETM63J-02

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52電源と初期化

2 電源と初期化
2.1 電源RX4901CE/RX8901CEの電源端子を下表に示します。
表 2.1

電源端子一覧

端子名

機能

VDD

主電源端子
ノーマルモード時は、この端子から内部に電源が供給されます。

VOUT

内部動作電圧出力端子
1 µFの安定化コンデンサを接続してください。

VBAT

バックアップ電源端子
大容量キャパシタ (EDLC)、二次電池、一次電池等のバックアップ用電源を接続してください。
バックアップモード時は、この端子から電源が供給されます。

GND

グラウンド端子RX4901CE/RX8901CEの通常動作時は、VDDに供給されている主電源電圧で動作します (ノーマルモード)。VDD
電圧が規定以下に低下した場合には、ホストインターフェイスが使用できなくなるものの、VBATに供給されているバックアップ電源電圧にRTCの電源が切り替わり、発振回路と時計/カレンダー機能を維持し、内部データを保持します (バックアップモード)。この電源の切り替えは、バックアップ電源切り替え回路により自動的に行われます (詳細は“3.9 バックアップ電源切り替え機能”を参照)。
動作電源電圧範囲については、“5.2 推奨動作条件”を参照してください。
電源切り替え回路の構成を以下に示します。
VDD

VDD電圧低下検出
SW1
内部回路

VOUT

SW2
SW3
VBAT電圧低下検出

図 2.1

VBAT

電源切り替え回路

電源の接続例を以下に示します。
(1) 二次電池を使用した電源バックアップ構成例(PWSW_CFG.INIEN = 1, PWSW_CFG.CHGEN = 1)

図 2.2

電源接続例 (1)RX4901CE/RX8901CE
ETM63J-02

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62電源と初期化(2) 一次電池を使用した電源バックアップ構成例
VDD
VDD
SW1

0.1 µFVOUT
1.0 µF

SW2
SW3

VBAT
R
一次電池

(PWSW_CFG.INIEN = 1, PWSW_CFG.CHGEN = 0)

図 2.3

電源接続例 (2)(3) 単一電源の構成例 (電源バックアップなし)
VDD
VDD
SW1

VOUT
0.1 µF

SW2
SW3

VBAT

VDD、VBAT、VOUTをすべてショートしてください。
(PWSW_CFG.INIEN = 0, PWSW_CFG.CHGEN = 0, PWSW_CFG.SWSEL[1:0] = 0b10)

図 2.4

電源接続例 (3)(4) 一次電池を使用した電源バックアップ構成例 (電源バックアップ機能不使用)
VDD
VDD
SW1

0.1 µFVOUT
1.0 µF

SW2
SW3

VBAT
R
一次電池

外部主電源と一次電池をRX4901CE/RX8901CEのダイオードを介して並列に接続(PWSW_CFG.INIEN = 0, PWSW_CFG.CHGEN = 0, PWSW_CFG.SWSEL[1:0] = 0b01)

図 2.5

電源接続例 (4)

注: • 各バイパスコンデンサは可能な限り各端子の直近に配置してください。
• VBAT端子に外部電源デバイスや大型電池を接続する場合は、必要に応じてVBAT端子に0.1 µF以上のバイパス
コンデンサを接続してください。
• 電源切り替え機能を動作させる場合、VOUT端子には1 µFを接続してください。

RX4901CE/RX8901CE
ETM63J-02

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7

2電源と初期化

2.2 初期化
2.2.1 電源投入シーケンス
RX4901CE/RX8901CEの電源投入時は、先に供給されたVDDまたはVBAT電圧でパワーオンリセットが実行されます。確実にパワーオンリセットを実行させるため、電源スロープ (tR1、“5.6 電源投入特性”参照) の仕様を満足させてください。図 2.6のtCLは、パワーオンリセットが解除されるまでの時間を示しています。
VDDおよびVBAT電源をOFFした後に再度電源をONする場合は、その間にVDD = VBAT = GNDの状態を100ms以上保持し、その後は初回の電源立ち上げの仕様を満足するように、電源を再投入してください。
VDD

tR1

tR1

VMAIN
VACC (Min.)+VDET1VCLK (Min.)
GND

VOUT

VACC (Min.)-VDET1

VDD駆動

VMAIN
VBAT駆動

VBATTERY - Vf (SW2)+VDET1VCLK (Min.)
GND
VBAT

VACC (Min.)+VDET1VDD OFF時間

VDD駆動
VBATTERY-VDET1VCLK (Min.)+VDET1GNDレベルtR1

tR1

VBATTERYVBAT OFF時間
GND
VBAT先投入(一次電池実装時)

VBAT - VDD同時投入(VBAT = VDD = GND)

VLF、0クリア可能 ⇒レジスターアクセス可能

インターフェイス
tCL

tCD

図 2.6

VLF、0クリア可能 ⇒レジスターアクセス可能
tCL

電源投入シーケンス

2.2.2 発振開始時間
VDDまたはVBAT電圧が投入されると、水晶発振回路が発振を開始します。また、VDD投入から40 ms後にホスト
インターフェイスが利用可能になります。ただし、時計/カレンダーカウンターの設定/読み出しができるようになるためには、水晶発振回路の内部波形の振幅が十分な大きさになるまでの待ち時間が必要です。これが、発振開始時間 (tSTA、“5.3 周波数特性”参照) です。
この待ち時間を確保するためには、INTF.OSCSTPFビットとINTF.VLFビットのクリアを繰り返し試行する方法
か、VDDまたはVBAT電圧の投入開始からtSTAが経過するまでホスト側で待機する方法があります。前者の方法
は、時計/カレンダーカウンターを設定/読み出しできるようになるまでの待機時間が、より短くなります。一方後者の方法は、より待ち時間が長い分、水晶発振回路の周波数が安定するため、より高い時刻精度で時計/
カレンダーカウンターを設定できます。
INTF.OSCSTPFビットとINTF.VLFビットは、水晶発振回路が発振を開始した直後は、発振停止検出によって1にセットされます。この間は、これらのビットにホストインターフェイスを介して0を書き込んでも、0にクリ
アできません。その後しだいに内部発振波形の振幅が成長すると、発振停止検出が解除され、INTF.OSCSTPF
ビットとINTF.VLFビットがクリア可能になります。したがって、任意の時間間隔でこれらのビットのクリアを試行し、クリアできるようになった時点で、時計/カレンダーカウンターの設定/読み出しが可能になります。

RX4901CE/RX8901CE
ETM63J-02

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82電源と初期化

電源 (VDD) 投入時
VDD
電源 (VDD)GND

VOUT

VACC (Min.) (インターフェイス電圧)
VCLK (計時保持電圧)

内部発振波形(イメージ)
INTF.VLFビットなどのフラグ確認のアクセスが可能

40 ms

VLF “1”VLF “0”VLFクリア可能でレジスター設定が可能

FOUT
tSTA: 発振開始時間 (発振安定待ち時間)
時計/カレンダー設定などのアクセス推奨範囲

図 2.7

発振開始シーケンス

バックアップモードからノーマルモードへの復帰時
VACC (Min.) (インターフェイス電圧)
VCLK (計時保持電圧)

VOUT
VDD
バックアップモード
からの電源復帰

FOUT
40 ms

図 2.8

INTF.VLFビットなどのフラグ確認/クリア
およびレジスターアクセスが可能

バックアップモードからの復帰

RX4901CE/RX8901CE
ETM63J-02

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92電源と初期化

2.2.3 初期設定
初期電源投入時とバックアップ中のINTF.VLFビット = 0 → 1を伴う電圧低下発生後は初期設定が必要です。
その一例を以下に示します。

初期設定手順1.

電源投入後、あるいはバックアップモードからの復帰後、40 ms以上の待ち時間を取る。

2.

POR解除と発振開始の検出 (INTF.VLFビットのポーリング)
INTF.VLFビットは、電源電圧の低下によるパワーオンリセットの発行、または発振停止を検出した場
合に1にセットされます。
2.1.

INTF.VLFビットを読み出し、値が0だった場合は手順3へ
INTF.VLFビット = 1の場合は、以下項目の2.2.～2.4.の処理を行う。

2.2.

レジスターINTFに0x00を書き込み、INTF.VLFビットのクリアの試行、および割り込みフラグのクリアをする。
- PORFビット(パワーオンリセット検出フラグ)- OSCSTPFビット(発振停止検出フラグ)- UFビット(時刻更新割り込みフラグ)- TFビット(ウェイクアップタイマー割り込みフラグ)- AFビット(アラーム割り込みフラグ)- EVFビット(イベント検出割り込みフラグ)- VLFビット(RTC初期化割り込みフラグ)- VTMPLFビット(温度補償動作停止検出割り込みフラグ)

2.3.

任意の待ち時間を取る。

2.4.

手順2.1へ戻る。

3.

バックアップモードからの復帰だった場合は、初期設定終了。そうでない場合は手順4へ

4.

バックアップ電源切り替え機能の設定 (レジスターPWSW_CFG)- CHGENとINIENビット(バックアップバッテリー充電イネーブル/ディスエーブル)- VBATLDETENとVBATLDETBKビット (VBAT電圧検出イネーブル/ディスエーブル)- SWSEL[1:0]ビット(電源切り替えSWの設定)- VDDSAMP[1:0]ビット(VDD電圧サンプリング周期の設定)
詳細は、“3.9 バックアップ電源切り替え機能”を参照してください。

5.

Pin4, Pin10の端子割り当て機能の設定 (レジスターWTICFG)- FOEMUXビット(Pin 10: EVIN2またはFOEの選択)- EVIN3MUXビット(Pin 4: FOUTまたはEVIN3の選択)* RX4901CE Option C/DではPin 10の機能を選択することはできません。

6.

割り込み/カウンターのディスエーブル (レジスターTSTP_INTEに0x00を書き込む)- CSEL[1:0]ビット(温度センサー測定動作間隔)- UIEビット(時刻更新割り込みディスエーブル)- TIEビット(ウェイクアップタイマー割り込みディスエーブル)- AIEビット(アラーム割り込みディスエーブル)- EIEビット(イベント発生割り込みディスエーブル)- STOPビット(カウンターストップ)

7.

現在時刻の設定
詳細は、“3.2 時計/カレンダー機能”を参照してください。

8.

アラームの設定
詳細は、“3.5 アラーム機能”を参照してください。

9.

ウェイクアップタイマーの設定
詳細は、“3.6 ウェイクアップタイマー機能”を参照してください。

RX4901CE/RX8901CE
ETM63J-02

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102電源と初期化

2.3 動作モード
RX4901CE/RX8901CEには、5つの動作モードがあります。

VDD立ち上がり待機状態
VDDよりも先にバックアップバッテリーを接続するなどしてVBAT電源が+VLOW電圧よりも高くなると、この状態になります。32 kHzの発振回路が動作し始めます。ホストからレジスターへアクセスすることはできません。

イニシャルモードVDDが投入されてその電圧が+VDET1電圧よりも高くなり、さらに40 ms経過すると、このモードになります。
ホストからレジスターへアクセスできますが、32 kHzの発振回路が停止検出されているため、時計/カレン
ダーカウンターの設定/読み出しは無効です。また、INTF.OSCSTPFビットとINTF.VLFビットのクリアを試行しても、これらのビットはクリアされません。

ノーマルモード
RX4901CE/RX8901CEが主電源電圧VDDで動作する状態です。ホストから時計/カレンダーカウンターを含む、レジスターへのアクセスが可能です。電源切り替え機能は無効で、内蔵電源SWは固定されます。

ノーマルモード (バックアップモードへ移行可能)
RX4901CE/RX8901CEが主電源電圧VDDで動作する状態です。ホストから時計/カレンダーカウンターを含む、レジスターへのアクセスが可能です。主電源電圧VDDの電圧検出が常に行われており、VDDがVDD立ち下がり時検出電圧-VDET1以下になると、バックアップモードに遷移します。

バックアップモード
RX4901CE/RX8901CEがバックアップ電源VBATで動作する状態です。バックアップ電源VBATからVDD電源へ電流が流れ込まないよう、内蔵電源スイッチSW1が自動的に遮断状態になり、VDD端子はVBATから切り離されます。
ホストインターフェイスは無効になり、CE, CLK, DI, DIO, SDA, SCL入力はフローティング状態にすることができます。また、DO端子とFOUT出力はHi-Zになります。
VBAT電圧が計時電源電圧VCLK以上であれば、時計/カレンダー機能やEVINn入力、/INT出力は、ノーマルモー
ドと同様に機能します。
動作モード間の遷移を図 2.9に示します。

RX4901CE/RX8901CE
ETM63J-02

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2

電源と初期化開始

VBAT ≧ +VLOW
VDD
立ち上がり待機状態
VDD ≧ +VDET1+ 40 ms経過(

INTF.VLF = 1*
INTF.PORF = 1*
INTF.OSCSTPF = 1*
32 kHz発振
Host I/F 不可)

VDD ≧ +VDET1+ 40 ms経過
VOUT < -VLOW

イニシャルモード(
VOUT < VCLK

INTF.VLF = 1*
INTF.PORF = 1*
INTF.OSCSTPF = 1*
Host I/F 可)
発振停止非検出終了

VOUT < VCLK
バックアップモード

ノーマルモード
バックアップ電源
切り替え機能を無効に設定( INTF.VDDLF = 1* )( PWSW_CFG.INIEN = 0 )VDD ≧ +VDET1
VDD < -VDET1

バックアップ電源
切り替え機能を有効に設定

ノーマルモード(バックアップモードへ移行可能)( PWSW_CFG.INIEN = 1 )ホストインターフェイス
遮断状態を表す

1* ハードウェアによるセット
ホストインターフェイスでクリアできない

図 2.9

状態遷移図

RX4901CE/RX8901CE
ETM63J-02

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12

3

機能

3 機能
3.1 ホストインターフェイス
RX4901CEはホストインターフェイスとしてSPIを、RX8901CEはI2C-Busインターフェイスを搭載し、スレーブ
デバイスとして機能します。

3.1.1 RX4901CEレジスターへのアクセス (SPI)
RX4901CEのレジスターはSPIバスを介してアクセスすることができます。RX4901CEのSPIインターフェイスの仕様は以下のとおりです。
•
•
•
•
•
•
•
•
•

インターフェイス形式: RX4901CE Option A/B: 3線SPI、RX4901CE Option C/D: 4線SPI
スレーブデバイス
データ長:
8ビット
データフォーマット: MSBファースト
クロック極性:アイドル時HIGH
クロック位相:データを立ち上がりエッジでサンプリング、立ち下がりエッジでシフトアウト
最高通信速度:4 Mbit/s
アドレスオートインクリメント機能を搭載
CE (スレーブセレクト) 入力にプルダウン抵抗を内蔵
Cycle No.

1

2

3

4

5

6

7

8

CLK
DIO/DI/DO

MSB

LSB

データを立ち上がりでサンプリング
データを立ち下がりでシフトアウト

図 3.1

SPIデータフォーマットSPIインターフェイス端子RX4901CEには下表に示すSPIインターフェイス端子が用意されています。
表 3.1
端子名

RX4901CE Option A/B SPIインターフェイス端子

入出力

初期状態

CLK

I

Hi-Z

機能

SPIシリアルクロック入力端子

DIO

I/O

Hi-Z

SPIシリアルデータ入出力端子

CE

I

PD

SPIスレーブセレクト入力端子 (プルダウン抵抗を内蔵)

入出力

初期状態

CLK

I

Hi-Z

SPIシリアルクロック入力端子

DI

I

Hi-Z

SPIシリアルデータ入力端子

DO

O

Hi-Z

SPIシリアルデータ出力端子

CE

I

PD

SPIスレーブセレクト入力端子 (プルダウン抵抗を内蔵)

表 3.2
端子名

RX4901CE Option C/D SPIインターフェイス端子
機能

ホストとの接続
図 3.2にホストとの接続例を示します。

RX4901CE/RX8901CE
ETM63J-02

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3

ホスト(SPIマスタ)

SS

CE

SDIO

DIO

SCLK

CLK

機能

RX4901CE Option A/B (SPIスレーブ)

3線SPI

ホスト(SPIマスタ)

SS

CE

SDI

DO

SDO

DI

SCLK

CLK

RX4901CE Option C/D (SPIスレーブ)

4線SPI

図 3.2

SPIホストとRX4901CEの接続例

プルダウン抵抗 (CE端子)
RX4901CEはCE端子にプルダウン抵抗を内蔵しています。このプルダウン抵抗はソフトウェアによって切り離すことはできません。CE端子は常時プルダウンされます。

レジスターライト
ホストはCE信号をHIGHにしてRX4901CEをスレーブデバイスとして選択した後、同期クロック (CLK) と共に書き込みモードに設定したアドレスデータ (最初にデータを書き込むレジスターアドレス) と、8ビッ
ト単位の書き込みデータをRX4901CEのDIO (Option A/B) またはDI (Option C/D) 端子に送信します。図 3.3にデータ書き込み時の最初に送信するアドレスデータのビット構成を示します。
Bit 7

Bit 6

Bit 5

Bit 4
Bit 3
Bit 2
Bit 1
7-bit address
0(0b000 0000–0b110 1111)↑ 0は書き込みモードを指定

図 3.3

Bit 0

SPIデータライトアドレスデータ

RX4901CEレジスターへのデータライト動作を図 3.4に示します。8ビットデータの書き込みごとに、指定されたレジスターへの書き込みが行われ、それと同時に、レジスターアドレスは下位4ビットのみ自動的にインクリメントされます。レジスターアドレスの下位4ビットが0xFに達すると、ロールオーバーして0x0に戻ります。レジスターアドレスの上位3ビットは自動的にインクリメントしないため、アドレスの上位3ビットを変更する場合は、CE信号によるスレーブセレクトを一旦解除し (CE信号をLOWにする)、再度アドレ
スデータの送信を行ってください。
CE信号は最後の8ビットデータの送信が完了するまで解除しないでください。途中で解除した場合、途中まで送信された8ビット未満の書き込みデータは破棄され、レジスターには書き込まれません。
1つのレジスターへの書き込み
CE
CLK
DIO/DI 0 or 1

0

Raddr
(Address #)WRdata(Address #)0 or 1

複数レジスターへの連続書き込み
CE
CLK
DIO/DI 0 or 1

0

•••••

•••••

Raddr

WRdata 0

WRdata 1•••••(Address #)(Address #)(Address # + 1)

WRdata n

0 or 1(Address # + n)

レジスターへのデータ書き込みにより、レジスターアドレスがインクリメントされます。

■ ホスト → RX4901CE □ RX4901CE → ホスト
Raddr:
最初にアクセスするレジスターアドレス
WRdata n: レジスターに書き込む8ビットデータ

図 3.4

SPIレジスターライト

RX4901CE/RX8901CE
ETM63J-02

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3

機能

レジスターリード
ホストはCE信号をHIGHにして、RX4901CEをスレーブデバイスとして選択した後、同期クロック (CLK) を出力します。同時にそのクロックに同期して、読み出しモードに設定したアドレスデータ (最初にデータを読み出すレジスターアドレス) をRX4901CEのDIO (Option A/B) またはDI (Option C/D) 端子に送信します。アドレスデータを受け取ったRX4901CEは、8ビット単位の読み出しデータをクロックが停止するまで
DIO (Option A/B) またはDO (Option C/D) 端子からホストに送信します。この間のDI端子の入力は無効になります。図 3.5にデータ読み出し時の最初に送信するアドレスデータのビット構成を示します。
Bit 7

Bit 6

Bit 5

Bit 4
Bit 3
Bit 2
Bit 1
7-bit address
1(0b000 0000–0b110 1111)↑ 1は読み出しモードを指定

図 3.5

Bit 0

SPIデータリードアドレスデータ

RX4901CEレジスターのデータリード動作を図 3.6に示します。8ビットデータの読み出しごとに、レジス
ターアドレスは下位4ビットのみ自動的にインクリメントされ、0xFに達するとロールオーバーして0x0に戻ります。
アドレスの上位3ビットを変更する場合は、CE信号によるスレーブセレクトを一旦解除し、再度アドレス
データの送信を行ってください。
1つのレジスターの読み出し
RX4901CE Option A/B
CE
CLK
DIO

0 or 11

Raddr(Address #)RDdata0 or 1(Address #)RX4901CE Option C/D
CE
CLK
DI

0 or 1

1

DO

Raddr
Hi-Z
(Address #)0 or 1
RDdata(Address #)

Hi-Z

•••••

•••••

Raddr

RDdata 0

RDdata 1•••••(Address #)(Address #)(Address # + 1)

複数レジスターの連続読み出し
RX4901CE Option A/B
CE
CLK
DIO

0 or 1

1

RDdata n

0 or 1(Address # + n)

レジスターの読み出しにより、レジスターアドレスがインクリメントされます。

RX4901CE Option C/D
CE
•••••

CLK
DI

0 or 1

1

DO

Raddr

•••••
•••••

0 or 1Hi-Z

RDdata 0

RDdata 1(Address #)(Address #)(Address # + 1)•••••

0 or 1
RDdata nHi-Z(Address # + n)

レジスターの読み出しにより、レジスターアドレスがインクリメントされます。

■ ホスト → RX4901CE □ RX4901CE → ホスト
Raddr:
最初にアクセスするレジスターアドレス
RDdata n: レジスターから読み出した8ビットデータ

図 3.6

SPIレジスターリード

RX4901CE/RX8901CE
ETM63J-02

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3

機能

3.1.2 RX8901CEレジスターへのアクセス (I2C-Bus)
RX8901CEのレジスターはI2C-Busを介してアクセスすることができます。RX8901CEのI2C-Busインターフェイ
ス回路の仕様は以下のとおりです。
• スレーブデバイス• 標準モード (最大100 kbit/s)、およびファースト・モード (最大400 kbit/s) に対応• 7ビットスレーブアドレス 0x32

I2C-Busインターフェイス端子RX8901CEには下表に示すI2C-Busインターフェイス端子が用意されています。
表 3.3
端子名

I2C-Busインターフェイス端子

入出力

初期状態

機能

SCL

I

Hi-Z

I2C-Busシリアルクロック入力端子

SDA

I/O

Hi-Z

I2C-Busシリアルデータ入出力端子 (N-chオープンドレイン)

ホストとの接続
図 3.7にホストとの接続例を示します。
VDD
I2C-Bus

シリアルデータ (SDA)
シリアルクロック (SCL)
SDA

SCL

ホスト

図 3.7

SDA

SCL

RX8901CE

I2C-BusホストとRX8901CEの接続例

スレーブアドレス
RX8901CEには、下記のとおり7ビットのスレーブアドレスが定義されています。
←
Bit 7
0

Bit 6
1

図 3.8

→
R/W
スレーブアドレス
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
1
0
0
1
0
*
* 0: 書き込みモード, 1: 読み出しモード

RX8901CEのI2C-Busスレーブアドレス

レジスターライト
ホストがスタートコンディションと書き込みモード指定のスレーブアドレスをI2C-Busに出力することにより、通信を開始します。続いて、データを書き込む最初の8ビットレジスターアドレスを出力します。その後、8ビット単位の書き込みデータを必要数出力し、最後にストップコンディションを出力します。
RX8901CEは8ビットの受信ごとにACKをホストに返し、続くデータの受信に備えます。RX8901CEレジス
ターへのデータライト動作を図 3.9に示します。レジスターへの8ビットデータの書き込みごとに、レジス
ターアドレスは下位4ビットのみ自動的にインクリメントされ、0xFに達するとロールオーバーして0x0に戻ります。
アドレスの上位4ビットを変更する場合は、リピーテッドスタートコンディション 、またはストップコン
ディションとスタートコンディションを生成し、再度アドレスデータの送信を行ってください。
誤動作防止のため、スレーブアドレス受信から1秒以上経過してもストップコンディションが入力されず、
I2C-Busがビジー状態の場合、RX8901CEは自動的にI2C-Busインターフェイス回路を初期化してバスタイム
アウトします。その結果、SDAはHi-Zになり、スタートコンディション待ち状態になるため、通信を再開す
るにはスタートコンディションから送信し直してください。
RX4901CE/RX8901CE
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3

機能

1つのレジスターへの書き込み
I2C-Bus S

Saddr/W(0x64)A

Raddr
A(Address #)WRdataA(Address #)P

複数レジスターへの連続書き込み
I2C-Bus S

Saddr/W

A(0x64)Raddr

A(Address #)WRdata 0

A(Address #)WRdata 1

A•••••(Address #+1)

WRdata nA

P(Address #+n)

レジスターへのデータ書き込みにより、レジスターアドレスがインクリメントされます。

■ ホストによる動作□ RX8901CEによる動作
S: スタートコンディション, Sr: リピーテッドスタートコンディション,P: ストップコンディション, A: ACK, N: NACK,
Saddr/W: スレーブアドレス + W (0), Raddr: 最初にアクセスするレジスターアドレス,
WRdata n: レジスターに書き込む8ビットデータ

図 3.9

I2C-Busを介したレジスターライト

レジスターリード
ホストがスタートコンディションと書き込みモード指定のスレーブアドレスをI2C-Busに出力することにより、通信を開始します。続いて、データを読み出す最初の8ビットレジスターアドレスを出力します。その後、リピーテッドスタートコンディションと読み出しモード指定のスレーブアドレスを再度I2C-Busに出力します。このスレーブアドレスを受け取ったRX8901CEは8ビット単位の読み出しデータを、NACKを受信するまでホストに送信します。
ホストは各8ビットデータの受信後にACKをRX8901CEに返し、続くデータの送信を要求します。最後のデータを受信した場合、ホストはNACKを返し、ストップコンディションを生成して通信を終了します。
RX8901CEレジスターのデータリード動作を図 3.10に示します。8ビットデータの読み出しごとに、レジス
ターアドレスは下位4ビットの範囲で自動的にインクリメントされ、0xFに達するとロールオーバーして0x0に戻ります。
アドレスの上位4ビットを変更する場合は、リピーテッドスタートコンディション、またはストップコン
ディションとスタートコンディションを生成し、再度アドレスデータの送信を行ってください。
通信の最後に読み出されたアドレスはRX8901CEが保持しています。次回の読み出しを、読み出しアドレスを指定せずに、読み出しモード指定のスレーブアドレスの送信から開始した場合、RX8901CEは前回に続くアドレスからデータを出力します。
誤動作防止のため、スレーブアドレス受信から1秒以上経過してもストップコンディションが入力されず、
I2C-Busがビジー状態の場合、RX8901CEは自動的にI2C-Busインターフェイス回路を初期化してバスタイム
アウトします。その結果、SDAはHi-Zになり、スタートコンディション待ち状態になるため、この状態でデータリードを続けると、読み出しデータはすべて0xFFになります。
通信を再開するにはスタートコンディションから送信し直してください。
1つのレジスターの読み出し
I2C-Bus S

Saddr/W(0x64)A

Raddr
A(Address #)Sr

Saddr/R(0x65)A

Sr

Saddr/RA

RDdataN(Address #)P

複数レジスターの連続読み出し
I2C-Bus S

Saddr/W(0x64)

A

Raddr

A

(Address #)(0x65)

RDdata 1(Address #)A

RDdata 2A•••••(Address #+1)

RDdata nNP(Address #+n)

レジスターの読み出しにより、レジスターアドレスがインクリメントされます。

■ ホストによる動作□ RX8901CECEによる動作
S: スタートコンディション, Sr: リピーテッドスタートコンディション,P: ストップコンディション, A: ACK, N: NACK, Saddr/W: スレーブアドレス + W (0),Saddr/R: スレーブアドレス + R (1), Raddr: 最初にアクセスするレジスターアドレス,
RDdata n: レジスターから読み出した8ビットデータ

図 3.10I2C-Busを介したレジスターリード

RX4901CE/RX8901CE
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機能

3.2 時計/カレンダー機能
3.2.1 概要
時計/カレンダー機能の特長を以下に示します。
• 秒、分、時、日、月、年をカウントするBCDカウンターと曜日カウンターを搭載しています。
• うるう年の自動補正機能を搭載しています (自動補正が有効な年は、01年～99年までの範囲です)。
また、うるう秒補正操作が可能です。
• 1/1024秒のカウンター値の読み出し/書き込みが可能です。
• 計時バッファーを有し、計時カウンター動作にかかわらず、任意のタイミングでアクセスが可能です。
図 3.11にカウンターの構成を示します。

点線で囲まれた部分は計時バッファーを指します。計時バッファーは一括読み出し、書き込み可能です。
カッコ内の値はミラーレジスターのアドレスです。

図 3.11

時計/カレンダーカウンターの構成

水晶発振器

デジタル温度補償型水晶発振器回路 (DTCXO) で32.768 kHzクロックを発生します。

分周回路

32.768 kHzクロックを分周し、1024 Hz信号を生成します。

1/1024秒カウンター

1024 Hz信号をクロックとして0 ～ 1023/1024秒までをカウントするバイナリカウン
ターです。レジスターSECに秒カウンターの設定を書き込むことにより、0にクリアされます。TSTP_INTE.STOPビットに1を設定すると、このカウンターのカウント動作が停止します。

秒カウンター

1 Hz信号をクロックとして0 ～ 59秒までをカウントするBCDカウンターです。秒更新
時に時刻更新割り込みを発生可能です。

分カウンター

秒カウンターのオーバーフロー信号をクロックとして0 ～ 59分までをカウントする
BCDカウンターです。分更新時に時刻更新割り込みを発生可能です。

時カウンター

分カウンターのオーバーフロー信号をクロックとして0 ～ 23時までをカウントする
BCDカウンターです (24時間制固定)。時更新時に時刻更新割り込みを発生可能です。

日カウンター

時カウンターのオーバーフロー信号をクロックとして、月やうるう年に合わせ1 ～28/29/30/31までをカウントするBCDカウンターです。カウント値は1からとなり、0はス
キップされます。

曜日カウンター

7ビットのカウンターで、日カウンターに連動してビットがシフトされます。ビット0 ～ビット6が各曜日に個々に対応します。各ビットの曜日への割り付けは任意です。ただし、曜日の更新順序とビットシフトの方向を合わせて割り付けてください。

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3
表 3.4

機能

曜日の割り付け例

曜日(Bit 7)

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

16進数

日曜

–

0

0

0

0

0

0

1

0x01

月曜

–

0

0

0

0

0

1

0

0x02

火曜

–

0

0

0

0

1

0

0

0x04

水曜

–

0

0

0

1

0

0

0

0x08

木曜

–

0

0

1

0

0

0

0

0x10

金曜

–

0

1

0

0

0

0

0

0x20

土曜

–

1

0

0

0

0

0

0

0x40

月カウンター

日カウンターのオーバーフロー信号をクロックとして1月 ～ 12月までをカウントするBCDカウンターです。カウント値は1 ～ 12で、0はスキップされます。

年カウンター

月カウンターのオーバーフロー信号をクロックとして0年 ～ 99年までをカウントするBCDカウンターです。

3.2.2 動作
計時バッファーを介した時計/カレンダーカウンターへのアクセス
時計/カレンダーカウンター (1/1024秒、秒、分、時、曜日、日、月、年カウンター) は、1秒単位の情報が読み書きできるレジスターSEC ～ YEAR (アドレス0x00 ～ 0x06) か、1/1024秒単位の情報が読み書きできるレジスターSUBSEC_L ～ YEAR_MIR (アドレス0x10 ～ 0x18)に割り当てられた計時バッファーを介して、一括した書き込み、または読み出しをします。この計時バッファーは、複数のアドレスにまたがる
時計/カレンダーカウンターの情報を各カウンターに対して一括して一度にアクセスすることにより、正確な時刻情報の書き込み、または読み出しを行います。また、この計時バッファーの動作と、内蔵32.768 kHz
クロックに基づく時刻更新との競合は、自動的に調停されるため、ホストは任意のタイミングで計時バッ
ファーにアクセスできます。
計時バッファーから時計/カレンダーカウンターへの書き込み、または読み出しのタイミングは、ホストイ
ンターフェイスの種類によって、以下のように決まります。
SPIインターフェイス搭載機種の場合、CE信号の立ち下げ時に、計時バッファーに書き込まれた情報が、まとめて時計/カレンダーカウンターへ書き込まれます。また、CE信号の立ち上げ後、時計/カレンダーの読み出しコマンドの6クロック目の立ち上がりで、時計/カレンダーカウンターの値が、計時バッファーへ同時に一括して読み出されます。
SPI 時計/カレンダーカウンターリード時 (SEC 〜 YEARレジスターを連続リードする場合)

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機能

SPI 時計/カレンダーカウンターライト時 (SEC 〜 YEARレジスターを連続ライトする場合)

図 3.12

SPIインターフェイス 計時/カレンダーカウンターアクセスタイミング

I2C-Busインターフェイス搭載機種の場合、ストップコンディションまたはリピーテッドスタートコンディ
ションを受信したときに、計時バッファーに書き込まれた情報が、まとめて時計/カレンダーカウンターへ書き込まれます。また、7ビットのスレーブアドレスと、8ビット目のデータ転送の1 (リード) を受信した
後の、アクノリッジ送出中にSCLの立ち上がりを受信したとき、時計/カレンダーカウンターの値が、計時
バッファーへ同時に一括して読み出されます。
I2C-Bus 時計/カレンダーカウンターリード時 (SEC 〜 YEARレジスターを連続リードする場合)

I2C-Bus 時計/カレンダーカウンターライト時 (SEC 〜 YEARレジスターを連続ライトする場合)

図 3.13I2C-Busインターフェイス 計時/カレンダーカウンターアクセスタイミング

したがって、どちらのインターフェイス搭載機種でも、時計/カレンダーデータを書き込み、あるいは読み出すときは、アドレスのオートインクリメント機能を用いた複数バイトの連続アクセスを行ってください。
なお、I2C-Busインターフェイスにはタイムアウト機能があるため、1回の複数バイト連続アクセスは1秒以内に完了させる必要があります。

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機能

時計/カレンダーの初期設定と計時の開始
時計/カレンダーの初期設定には、1秒単位で設定する方法と、1/1024秒単位で設定する方法があります。それぞれ、レジスターSEC (アドレス0x00) からレジスター YEAR (アドレス06) まで、またはレジスター
SUBSEC_L (アドレス 0x10)からYEAR_MIR (アドレス 0x18) に時計/カレンダーの初期設定を書き込みます。
時計/カレンダーの計時の開始タイミングは、通信の終了をホストから送出する方法や、TSTP_INTE.STOP
ビットの解除をホストから書き込む方法で指定します。どちらの方法でも時刻精度に差はありません。
例: 1秒単位で時計/カレンダーを初期設定し、計時の開始タイミングは通信の終了で指定
1.

以下のレジスターに時計/カレンダーの情報を複数バイト連続書き込みする。
- レジスターSEC(アドレス0x00) (秒)- レジスターMIN(アドレス0x01) (分)- レジスターHOUR(アドレス0x02) (時)- レジスターWEEKDAY(アドレス0x03) (曜日)
- レジスターDAY(アドレス0x04) (日)- レジスターMONTH(アドレス0x05) (月)- レジスターYEAR(アドレス0x06) (年)2.

1での連続書き込みの終了 (SPIインターフェイスではCE信号の立ち下り。I2C-Busインターフェイ
スではストップコンディションかリピーテッドスタートコンディション) を受信したタイミング
で計時がスタートする。

例: 1秒単位で時計/カレンダーを初期設定し、計時の開始タイミングはTSTP_INTE.STOPビットの解除にて指定
1.

TSTP_INTE.STOPビットに1を書き込む。 (時計/カレンダーカウンターストップ)2.

以下のレジスターに時計/カレンダーの情報を複数バイト連続書き込みする。
- レジスターSEC(アドレス0x00) (秒)- レジスターMIN(アドレス0x01) (分)- レジスターHOUR(アドレス0x02) (時)- レジスターWEEKDAY(アドレス0x03) (曜日)
- レジスターDAY(アドレス0x04) (日)- レジスターMONTH(アドレス0x05) (月)- レジスターYEAR(アドレス0x06) (年)3.

TSTP_INTE.STOPビットに0を書き込む。 (時計/カレンダーカウンタースタート)

4.

SPIインターフェイスではレジスターTSTP_INTEのビット0 (STOPビット) が書き込まれるクロッ
クの立ち上がり、I2C-BusインターフェイスではレジスターTSTP_INTEに書き込んだ後のACK送出
時のSCLの立ち上がりのタイミングで計時がスタートする。

時計/カレンダーの読み出し
時計/カレンダーの情報を、1秒単位で読み出す場合はレジスターSEC (アドレス0x00) からレジスター
YEAR (アドレス0x06) まで、1/1024秒単位で読み出す場合はレジスターSUBSEC_L (アドレス0x10)から
YEAR_MIR (アドレス0x18) を読み出します。
SPIインターフェイス搭載機種の場合は、CE信号の立ち上げ後、時計/カレンダーの読み出しコマンドの６クロック目の立ち上がりで、その時点での時計/カレンダーカウンター値が、計時バッファーへ同時に一括して読み出されます。そして、計時バッファーに転送された時計/カレンダー情報を、レジスターSEC (アドレス0x00) か・らレジスター YEAR (アドレス0x06) まで、またはレジスターSUBSEC_L (アドレス0x10) からYEAR_MIR (アドレス0x18) までの範囲で、ホストが連続読み出しします。

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機能

I2C-Busインターフェイス搭載機種の場合は、まず、読み出し領域の先頭アドレスであるレジスターSEC (アドレス0x00) またはレジスターSUBSEC_L (アドレス0x10) をホストが書き込みます。次に、7ビットのス
レーブアドレスと、8ビット目のデータ転送の1 (リード) を受信した後の、アクノリッジ送出中のSCLの立
ち上がりを受信したとき、時計/カレンダーカウンターの値が、計時バッファーへ同時に一括して読み出されます。そして、計時バッファーの情報をホストが連続読み出しします。
時計/カレンダーデータの読み出し時、TSTP_INTE.STOPビットに1を書き込んで時計/カレンダーの各カウンターを停止しないようにしてください。各カウンターを停止させた場合は、計時誤差が増大してしまいます。

うるう年の判定
RX4901CE/RX8901CEは4の倍数の年をうるう年として判定し、自動的に2月の日数を設定します。2001年 ～2099年まではソフトウェアで対応する必要はありません。西暦2100年、2200年、2300年は、ソフトウェア
で2月を平年の日数に変更する必要があります。

うるう秒の挿入手順
レジスターSEC_MIR (アドレス0x12) に0x60を書き込むことで、うるう秒が挿入されます。この操作は、うるう秒挿入時刻の00秒 〜 01秒の間に行う必要があります。
0x60の書き込み時点で秒カウンターは60秒になり、その後の秒更新タイミングで秒カウンターは60秒から00秒に更新されます。0x60の書き込みから秒カウンターが00秒に更新される間、レジスターSECまたはSEC_MIR (アドレス0x00または0x12) からは60秒が読み出されます。
以降は通常どおり00秒から59秒までのカウント動作が行われます。
注: • アドレス0x00のレジスターSECに0x60を書き込むと1/1024秒カウンターがリセットされてしまいますので、うるう秒補正には、必ずアドレス0x12のレジスターSEC_MIRを使用してください。
• 00秒 〜 01秒の間でない時刻でのレジスターSEC_MIR (アドレス0x12) への0x60の書き込みは禁止です。

秒カウンター
分カウンター

0x57

0x58

0x59

レジスターSEC_MIR (アドレス0x12) へ0x60を書き込み
0x00 0x60
0x00
0x01
0x59
0x00

0x59

0x00

0x01

うるう秒挿入タイミング

図 3.14

うるう秒挿入タイミング

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機能

3.3 温度補償機能
RX4901CE/RX8901CEは高精度な温度補償回路を内蔵しています。弊社出荷検査時に、内蔵温度センサーの値に合わせた発振回路の周波数補正値を単品ごとに内蔵メモリーに記録しています。温度補償回路はこの値を基に、温度変化に起因する発振周波数の変動を補償します。

3.3.1 動作
温度補償間隔の設定
温度補償回路は電源電圧が温度補償電圧 (VTMP) の範囲であれば常に動作します。消費電流を低減するた
め、温度センサーの測定動作は間欠的に行われるようになっており、この実行間隔をTSTP_INTE.CSEL[1:0]ビットで表 3.5のとおり設定可能です。
表 3.5

温度補償データの更新間隔

TSTP_INTE.CSEL[1:0]

更新間隔

0b00
0b01
0b10
0b11

0.5秒
2秒 (デフォルト)
10秒
30秒

温度補償回路はこの間隔でIC内蔵の温度センサーで動作温度を測定し、その温度を元に発振周波数の変動を補正します。
周囲温度変化が急峻な環境では温度補償データの更新間隔を短くして、温度の変化に素早く追従させることが可能です。
室内などの比較的周囲温度の変化が緩やかな環境下では、温度補償データの更新間隔を長くすることで消費電流を抑えることができます。
温度補償回路はレジスター操作により停止させることはできません。ただし、電源電圧がVDET2以下に低下
すると、最後の温度補償データを保持したまま更新を停止します。ここから電源電圧がVTMP以上に復帰す
ると、温度補償更新動作が再開します。なお、このVDET2電圧低下時にイベント割り込みを発生可能です (詳細は、“3.10 タイムスタンプ機能”参照)。

温度補償動作フラグ

VTMPLFフラグ (0x0E)

VTMPLFフラグは、電源電圧が温度補償更新停止検出電圧 (VDET2) 以下に低下した場合に1にセットされます。
この場合、温度補償回路は停止し、停止した際の周波数補正条件で発振を継続します。VTMPLFフラグは、電源
電圧がVTMP以上に復帰した後に0を書き込むことによってクリアされます。

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23

3

機能

3.4 時刻更新割り込み機能
3.4.1 概要
RX4901CE/RX8901CEには時計カウンターの更新タイミングで割り込みを発生させる機能があります。その特長を以下に示します。
• 割り込みタイミングを毎秒更新、毎分更新、毎時更新から選択可能です。
• /INT端子のホストへの割り込み出力信号は一定時間経過後に自動解除されます。
図 3.15に時刻更新割り込み回路の構成を示します。
UIE
USEL[1:0]/INT

秒カウンター更新
分カウンター更新
時カウンター更新

UF

UFへの0書き込み
64 Hz

自動復帰
制御

図 3.15

時刻更新割り込み回路の構成

tRTN1

3.4.2 動作
割り込み周期の選択
時刻更新割り込みは、TCTL.USEL0ビットとUPDISEL.USEL1ビットで選択した秒、分、または時のいずれかのカウンター値が桁上げ更新されたタイミングで発生させることができます (1秒周期、1分周期、または1時間周期で割り込み発生、あるいは割り込みを発生させない)。/INT端子のホストへの割り込み出力信号
は一定時間 (tRTN1) 経過後に自動解除されます。
表 3.6

時刻更新割り込みイベントの選択

UPDISEL.USEL1

TCTL.USEL0

割り込みイベント/INT 自動解除時間 tRTN1

0
0
1
1

0
1
0
1

秒カウンター更新 (デフォルト)
分カウンター更新
時カウンター更新
割り込みイベントなし

7.812 ms–

割り込み許可/禁止手順
時刻更新割り込みは以下の手順で許可/禁止してください。

時刻更新割り込みを許可
1.

TSTP_INTE.UIEビットに0を書き込む。

(/INT出力をクリア)

2.

TCTL.USEL0ビットとUPDISEL.USEL1ビットを設定する。 (時刻更新割り込みイベントを選択)

3.

INTF.UFビットに0を書き込む。

(時刻更新割り込みフラグをクリア)

4.

TSTP_INTE.UIEビットに1を書き込む。

(時刻更新割り込み許可)

時刻更新割り込みを禁止
1.

TSTP_INTE.UIEビットに0を書き込む。

(/INT出力をクリア/出力禁止)

2.

INTF.UFビットに0を書き込む。

(時刻更新割り込みフラグをクリア)

RX4901CE/RX8901CE
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3

機能

割り込み動作
選択した割り込みのタイミングになると、INTF.UFビットが1にセットされます。このとき、TSTP_INTE.UIE
ビット = 1 (割り込み許可) であれば/INT端子がLOWになり、ホストに割り込み要求を出力します。/INT端
子は、TSTP_INTE.UIEビットに0を書き込むか、/INT端子のLOW出力開始からtRTN1 (7.812 ms) 後に自動的に
Hi-Zになります。INTF.UFビットは、割り込み要求発生から tRTN1が経過して/INT端子がHi-Zになってもクリアされず、ホストから0を書き込むことによってはじめてクリアされます。
ホストによる制御-1-0

TSTP_INTE.UIE*1/INT出力tRTN1*1- Hi-Z-0-1-0

INTF.UF
カウンター更新
割り込み周期

割り込み周期

割り込み周期*1 INTF.UFビットまたはTSTP_INTE.UIEビットに0を書き込んでビットをクリアすると、tRTN1を待たずに/INT端子が開放されます (Hi-Zになります)。

図 3.16

時刻更新割り込みタイミングチャート

RX4901CE/RX8901CE
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25

3

機能

3.5 アラーム機能
3.5.1 概要
アラーム機能の概要を以下に示します。
• 曜日または日、時、分、秒の組み合わせでアラーム時刻を設定可能です。
• それぞれの要素を任意に組み合わせてアラーム条件に設定できるため、
毎週金/土曜日の朝10時、毎月25日の夜7時のようなアラーム設定が簡単に設定可能です。
図 3.17にアラーム回路の構成を示します。
秒
カウンター

分
カウンター

時
カウンター

日
カウンター

曜日
カウンター

WADA
比較器

比較器

比較器

比較器

ALM_SEC

ALM_MIN

ALM_HOURALM_WEEKDAY
XWAE
XHAE

割り込み制御回路(アラーム割り込み)

/INT

XMAE
XSAE
AIE

図 3.17

AF

アラーム回路の構成

3.5.2 動作
アラーム設定手順
アラームを設定して割り込みを発生させる手順を以下に示します。
1.

TSTP_INTE.AIEビットに0を書き込む。

(アラーム割り込みディスエーブル)

2.

レジスターALM_SECでアラーム時刻の秒を設定する。
- XSAEビット(秒アラーム指定イネーブル/ディスエーブル)- SALM_H[2:0]ビット(10秒桁の指定)- SALM_L[3:0]ビット(1秒桁の指定)3.

レジスターALM_MIN (またはALM_MIN_MIR) でアラーム時刻の分を設定する。
- XMAEビット(分アラーム指定イネーブル/ディスエーブル)- MALM_H[2:0]ビット(10分桁の指定)- MALM_L[3:0]ビット(1分桁の指定)

4.

レジスターALM_HOUR (またはALM_HOUR_MIR) でアラーム時刻の時を設定する。
- XHAEビット(時アラーム指定イネーブル/ディスエーブル)- HALM_H[1:0]ビット(10時桁の指定)- HALM_L[3:0](1時桁の指定)RX4901CE/RX8901CE
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3
5.

機能

レジスターALM_WEEKDAY (またはALM_WEEKDAY_MIR) でアラーム時刻の曜日または日を設定する。
- XWAEビット(曜日/日アラーム指定イネーブル/ディスエーブル)
曜日を指定する場合 (TCTL.WADAビット = 0)
- WKALM[6:0]ビット(曜日の指定)曜日は月曜 〜 金曜のように複数の指定が可能です。
日を指定する場合 (TCTL.WADAビット = 1)
- DALM_H[1:0]ビット(10日桁の指定)- DALM_L[3:0]ビット(1日桁の指定)

6.

TCTL.WADAビットを設定する。

(日/曜日アラームの選択)

7.

INTF.AFビットに0を書き込む。

(アラーム割り込みフラグをクリア)

8.

TSTP_INTE.AIEビットに1を書き込む。

(アラーム割り込み許可)* X*AEビットを1に設定すると、そのレジスターの設定はアラーム条件から除外されます。たとえば、
ALM_WEEKDAY.XWAEビット = 1では、曜日/日の設定が無効になり、毎日指定時刻にアラームが発生します。ただし、すべてのX*AEビットを1にした場合は、1秒ごとにアラームが発生します。

アラーム設定例
曜日指定時のアラーム設定例 (TCTL.WADAビット = 0)
設定例1
XWAE

土

ALM_WEEKDAY (曜日アラーム)
金

木

水

火

月

日

ALM_HOUR(時アラーム)

ALM_MIN(分アラーム)ALM_SEC(秒アラーム)

0

0

1

1

1

1

1

0

0x07

0x00

XSAE = 1

毎週月曜 〜 金曜、午前7時00分00秒 〜 59秒の間、1秒ごとに繰り返しアラームが発生
設定例2
XWAE

土

ALM_WEEKDAY (曜日アラーム)
金

木

水

火

月

日

ALM_HOUR(時アラーム)

ALM_MIN(分アラーム)ALM_SEC(秒アラーム)

0

1

0

0

0

0

0

1

XHAE = 1

0x30

0x00

ALM_HOUR(時アラーム)

ALM_MIN(分アラーム)ALM_SEC(秒アラーム)

0x18

0x59

0x30

ALM_MIN(分アラーム)ALM_SEC(秒アラーム)XMAE = 1

XSAE = 1

毎週土曜と日曜、毎時30分00秒にアラームが発生
設定例3
ALM_WEEKDAY (曜日アラーム)
XWAE

土

金

木

水

火

月

日

0

1

1

1

1

1

1

1

1

X

X

X

X

X

X

X

毎日、午後6時59分30秒にアラームが発生
日指定時のアラーム設定例 (TCTL.WADAビット = 1)
設定例4
ALM_WEEKDAY (日アラーム)
XWAE

*

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

ALM_HOUR(時アラーム)

0

X

0

0

0

0

0

1

0x07

毎月1日、午前7時00分00秒 〜 59秒の間、1秒ごとに繰り返しアラームが発生

RX4901CE/RX8901CE
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3

機能

設定例5
XWAE

*

ALM_WEEKDAY (日アラーム)
Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

ALM_HOUR(時アラーム)

ALM_MIN(分アラーム)ALM_SEC(秒アラーム)

0

X

0

1

0

1

0

1

XHAE = 1

0x30

0x00

毎月15日、毎時30分00秒にアラームが発生
設定例6
XWAE

*

ALM_WEEKDAY (日アラーム)
Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

ALM_HOUR(時アラーム)

ALM_MIN(分アラーム)ALM_SEC(秒アラーム)

1

X

X

X

X

X

X

X

0x18

0x59

0x30

毎日、午後6時59分30秒にアラームが発生
X: 値は不問です。

アラーム割り込み
図 3.18にアラーム割り込み回路の構成を示します。
曜日/日比較結果
XWAE
時比較結果
/INT

AF

XHAE
分比較結果
XMAE

秒カウンター更新

秒比較結果

AFへの0書き込み

XSAE

AIE

図 3.18

アラーム割り込み回路の構成

アラーム割り込みは、時刻/カレンダーカウンターがレジスターALM_SEC、ALM_MIN、ALM_HOUR、
ALM_WEEKDAYで指定した日時に一致した時点で発生させることができます。
指定した曜日/日の指定時刻になると、INTF.AFビットが1にセットされます。このとき、TSTP_INTE.AIEビット = 1 (割り込み許可) であれば/INT端子がLOWになり、ホストに割り込み要求を出力します。1にセットされたINTF.AFビットは0を書き込むことによりクリアされます。同時に/INT端子がHi-Zになります。
*2

*1

*1

*2

ホストによる制御
TSTP_INTE.AIE
Hi-Z

Hi-Z

/INT出力L

L

Hi-Z Hi-Z
L

Hi-Z
L

INTF.AF
アラーム発生アラームイベント

アラームイベント

アラームイベント*1 INTF.AFビットに0を書き込んでこのビットをクリアすると、/INT端子がHi-Zに開放されます。
*2 TSTP_INTE.AIEビットを0にすると、/INT端子はINTF.AFビットの状態に依らずHi-Zに開放されます。

図 3.19

アラーム割り込みタイミングチャート

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3

機能

3.6 ウェイクアップタイマー機能
3.6.1 概要
ウェイクアップタイマー機能の概要を以下に示します。
•
•
•
•
•

24ビットプリセッタブルアップカウンターで構成されます。
ソースクロック: 1024 Hz、64 Hz、1 Hz、1/60 Hzから選択可能です。
976 µs 〜 32年までの任意の周期で割り込みを発生可能です。
割り込み出力をFOUT端子にも割り当て可能です。
電源切り替え機能と連動させて主電源動作の積算時間計としても利用可能です。

図 3.20にウェイクアップタイマーの構成を示します。

図 3.20

ウェイクアップタイマーの構成

3.6.2 動作ソースクロック
ソースクロックはTCTL.TSEL[1:0]ビットにより表 3.7に示す4種類から選択可能です。
表 3.7
TCTL.TSEL[1:0]

ウェイクアップタイマーソースクロックの選択
ソースクロック
周波数

周期/INT 自動復帰時間(tRTN2)0b00

1024 Hz976 µs488 µs

0b01

64 Hz

15.625 ms

7.812 ms

0b10

1 Hz

1秒

7.812 ms

0b11

1/60 Hz60秒

7.812 ms

* tRTN2は/INT端子がLOWになってから、自動的に開放される (Hi-Zになる) までの時間です。

プリセットデータ (ウェイクアップタイマー割り込み周期)
プリセットデータはカウント上限値を指定する値で、ウェイクアップタイマー割り込み周期を決定します。
ウェイクアップタイマー割り込みはカウンターが設定したプリセットデータを超えた時点で発生します。
プリセットデータは、TCTL.TEビット = 0の状態でレジスターWTCNT_L、WTCNT_M、WTCNT_Hに書き込みます。
注: • タイマー動作中 (TCTL.TEビット = 1) にレジスターWTCNT_L、WTCNT_M、WTCNT_Hにプリセットデー
タを書き込むことは禁止します。
• プリセットデータとして0x000000を設定することはできません。レジスターWTCNT_L、WTCNT_M、
WTCNT_Hに0x000000を書き込んだ場合は、ウェイクアップタイマーはカウントアップせず、割り込み要求は発生しません。
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3

機能

表 3.8に、ソースクロックの選択とプリセットデータの組み合わせによる割り込み周期の例を示します。
表 3.8

ウェイクアップタイマー割り込み周期
ソースクロック

プリセットデータ

1024 Hz
TCTL.TSEL[1:0] = 0b00

64 Hz
TCTL.TSEL[1:0] = 0b01

1 Hz
TCTL.TSEL[1:0] = 0b10

1/60 Hz
TCTL.TSEL[1:0] = 0b11

0
1
:
410
(0x00019A):
3840(0x000F00):
4096(0x001000):
16777215(0xFFFFFF)–
976 µs
:–15.625 ms
:

–
1秒
:

–
60秒
:

400.39 ms

6.406秒

410秒

410分

:

:

:

:

3.7500秒

60秒

3840秒

3840分

:

:

:

:

4秒

64秒

4096秒

4096分

:

:

:

:

4.55時間72.81時間4660時間31.9年

カウント動作条件
WTCTL.WTSTOPCTLビットを1に設定すると、WTCTL.WTMODSELビットの設定が有効になり、カウント
動作をノーマルモード時のみ、あるいはバックアップモード時のみに制限することができます。
表 3.9

ノーマルモード/バックアップモードの動作条件設定

WTCTL.WTSTOPCTL WTCTL.WTMODSEL

動作条件

0

X

ノーマルモード/バックアップモードの両モードでカウント可能

10

ノーマルモード時 (VDD動作時) のみカウント可能

1

バックアップモード時 (VBAT動作時) のみカウント可能

たとえば、ノーマルモード時のみ動作するように設定した場合、バックアップモードに切り替わるとカウント動作は停止しますが、その時点のカウント値は保持され、再びノーマルモードに戻った際は、保持していたカウント値からカウント動作を再開します。これにより、ノーマルモード動作時間の積算計として使用することもできます。

ウェイクアップタイマー設定手順
ウェイクアップタイマーを設定して割り込みを発生させる手順を以下に示します。
1.

TCTL.TEビットに0を書き込む。

(ウェイクアップタイマーディスエーブル)

2.

TSTP_INTE.TIEビットに0を書き込む。

(ウェイクアップタイマー割り込みディスエーブル)

3.

TCTL.TSEL[1:0]ビットを設定する。

(ソースクロックの選択)

4.

レジスターWTCNT_L、WTCNT_M、WTCNT_Hを設定する。
(ウェイクアップタイマー割り込み周期の設定)

5.

レジスターWTICFGを設定する。
- WTONETIMビット- WTIOUTビット(割り込み出力の設定)(/INT自動解除の設定)(割り込み出力端子の選択)

6.

レジスターWTCTLを設定する。
- WTMODSELとWTSTOPCTLビット- WTSTOPビットに0を書き込む。

(タイマー動作条件の設定)(ノーマル/バックアップモードの動作条件を選択)(一時停止の解除)

7.

INTF.TFビットに0を書き込む。

(ウェイクアップタイマー割り込みフラグをクリア)

8.

TSTP_INTE.TIEビットに1を書き込む。

(ウェイクアップタイマー割り込み許可)

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9.

TCTL.TEビットに1を書き込む。

機能(ウェイクアップタイマーイネーブル)

カウントを開始します。

カウントアップの開始
TCTL.TEビットが1になると、ウェイクアップタイマーは初期値 (1) をカウンターにロードしてカウント
アップを開始します。ただし、ソースクロックとは非同期にカウントを開始しますので、最初のカウント
アップまで、最大ソースクロック1周期の遅延を生じます。
TCTL.TE
内部ソースクロック
アップカウンター

誤差 カウント開始
1

ソースクロック周期231

初期値 (1) セット

2

プリセット値を超えた時点で初期値 (1) セット

プリセット値3

INTF.TF/INT
tRTN2

図 3.21

ウェイクアップタイマーカウントアップ動作

カウントアップによりカウンターがプリセット値を超えると、初期値 (1) がカウンターにロードされ、その値からカウントアップを継続します。
図 3.22にTCTLE.TEビットへの1書き込み後のカウント開始タイミングを示します。
RX4901CE
CLK
レジスターTCONへの書き込み

DIO/DI

TE

WADA

0

TSEL1 TSEL0
カウントスタート

RX8901CE
SCL
レジスターTCONへの書き込み

SDA (ホスト)

TE

WADA

0

TSEL1 TSEL0ACKSDA (RTC)
カウントスタート

図 3.22

ウェイクアップタイマーカウント開始タイミング

一時停止
動作中のウェイクアップタイマーを一時停止するには、WTCTL.WTSTOPビットに1を書き込みます。ウェ
イクアップタイマーはその時点のカウンター値を保持した状態で停止します。WTCTL.WTSTOPビットに0を書き込むと、ウェイクアップタイマーは保持していたカウント値からカウントアップを再開します。この一時停止動作もソースクロックとは非同期に行われますので、開始時と同様に誤差が生じます。
なお、他の制御ビットの設定状態によっては、WTCTL.WTSTOPビットでカウンターは停止しません。関係する制御ビットによるウェイクアップタイマーの動作状態を表 3.10に示します。

RX4901CE/RX8901CE
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3
表 3.10

ウェイクアップタイマーの動作制御

TCTL.TE

TSTP_INTE.
STOPWTCTL.
WTSTOPCTLWTCTL.
WTSTOP

1

0

0

0

カウントアップ動作をします。

1

カウントアップを一時停止します。

1

X

WTCTL.WTSTOPビットの設定は無効となり、1に設定してもカウンターは停止しません。

1

X

X

カウンターは停止します。
ただし、ソースクロック = 1024 Hzの場合は、
TSTP_INTE.STOPビット = 0と同じ動作となり
ます。

X

X

X

カウンターは停止しています。

0

機能

動作状態

カウンターデータの読み出し
TCTL.TEビット = 1のとき、レジスターWTCNT_L、WTCNT_M、WTCNT_Hからカウントアップ中のカウ
ント値を読み出すことができます。ただし、3つのレジスターを読み出す間にカウンター値が変化し、現在の正しい値を読み出せない可能性があるため、これらのレジスターの読み込みを、ウェイクアップタイマーのソースクロックの周期以内で2回行い、それぞれの値が同じだった場合に、正しく読み出せたものとしてください。読み出した値が不一致だった場合は、再度レジスターの読み込みを行ってください。
TCTL.TEビット = 0のときは、レジスターWTCNT_L、WTCNT_M、WTCNT_Hからウェイクアップタイマーのプリセット値が読み出されます。

カウンターのリセット
WTCTL.WTRSTビットに1を書き込むことで、動作中のカウンターをリセットすることができます。初期値(1) がロードされ、ウェイクアップタイマーはカウントを再開します。このとき、ウェイクアップタイマー
割り込みは発生しません。

ウェイクアップタイマー割り込み
図 3.23にウェイクアップタイマー割り込み回路の構成を示します。
FSEL[1:0]
1 Hz1024 Hz
32768 HzWTIOUT

FOUT

TIE
/INT
24ビットプリセッタブル
アップカウンター

TF

TFへの0書き込み

TSEL[1:0]

自動復帰
制御1024 Hz
64 Hz

図 3.23tRTN2WTONETIM

ウェイクアップタイマー割り込み回路の構成

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3

機能

ウェイクアップタイマー割り込みは、プリセットしたカウント周期で発生させることができます。
ウェイクアップタイマーのカウンター値が、カウントアップによってプリセット値を超えるタイミングで、INTF.TFビットが1にセットされます。このとき、TSTP_INTE.TIEビット = 1 (割り込み許可) であれば、/INT
端子がLOWになってホストへ割り込み要求を出力します。そして/INT自動復帰時間 (tRTN2、表 3.7参照) の経過後に、/INT端子はHi-Zに戻ります。なお、/INT信号のHi-Zへの自動復帰機能は、WTICFG.WTONETIM
ビットを1に設定することで無効にできます。
/INT端子は自動的にHi-Zに復帰する一方、1がセットされたINTF.TFビットは、ホストから0を書き込むまで1を保持します。INTF.TFビット、またはTSTP_INTE.TIEビットに0を書き込むと、/INT自動復帰時間が経過する前かどうかにかかわらず、/INT端子はHi-Zに戻ります。
ホストによる制御
カウント開始カウント停止-1-0

TCTL.TE-1-0

TSTP_INTE.TIE
*1

*1

*1

tRTN2

tRTN2

tRTN2

/INT出力tRTN2- Hi-Z-0-1-0

INTF.TF
カウンター > プリセット値
割り込み周期

割り込み周期

割り込み周期

割り込み周期

ウェイクアップタイマー動作期間*1 INTF.TFビット、TSTP_INTE.TIEビット、またはTCTL.TEビットを0クリアすると、tRTN2を待たずに/INT端子が開放されます(Hi-Zになります)。

図 3.24

ウェイクアップタイマー割り込みタイミングチャート

ウェイクアップタイマーの割り込み要求信号は、他の割り込み要求信号とNORされて/INT端子から出力されます (WTICFG.WTIOUTビット = 0の場合)。
FOUT端子を有効にした機種では、WTICFG.WTIOUTビットを1に設定することで、ウェイクアップタイマー
割り込み要求信号をFOUT端子から出力させることができます。
注: WTICFG.WTIOUTビット = 1の場合、FOUT信号とウェイクアップタイマー割り込み要求信号がNORされてFOUT 端 子 か ら 出 力 さ れ ま す 。 ウ ェ イ ク ア ッ プ タ イ マ ー 割 り 込 み 要 求 信 号 の み を 出 力 す る に は 、TCTL.FSEL[1:0]ビットを0b11に設定して、FOUT信号の出力を停止してください。

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3

機能

3.7 FOUT出力機能
3.7.1 概要
FOUT出力機能の概要を以下に示します。
• RX4901CE/RX8901CEで生成したクロックを外部に出力可能です。
• 出力クロックを32.768 kHz、1024 Hz、1 Hzから選択可能です。
• レジスターまたは外部入力信号 (FOE) によりFOUT出力を制御可能です。
図 3.25にFOUT出力回路の構成を示します。
発振回路

FSEL[1:0]

分周回路
16384 Hz:1024 Hz

STOP

FOE

32.768 kHz1024 Hz
1 Hz

出力制御

FOUT

ウェイクアップタイマー
割り込み出力1/1024秒
カウンター

図 3.25

FOUT出力回路の構成

3.7.2 動作
初期設定
FOUT出力 (Pin 4): Option AとC製品では、Pin 4はデフォルトでFOUTに設定されています。
Option BまたはD製品においてFOUT出力を使用するには、Pin 4の割り当て機能を変更(WTICFG.EVIN3MUXビットを0に設定) します。
FOE入力 (Pin 10): 外部入力信号 (FOE) によりFOUT出力を制御する場合は、Pin 10のI/O設定を変更(WTICFG.FOEMUXビットを1に設定) します。

FOUT出力の制御 (FOE端子を使用しない場合)
FOUT出力は、電源投入時はOFF (Hi-Z) です。FOUT出力の出力・停止 (Hi-Z) は、TCTL.FSEL[1:0]ビットで設定します。なお、1 Hz出力設定のみ、TSTP_INTE.STOPビットの設定も影響します。
表 3.11

FOUT出力の選択

TSTP_INTE.STOP TCTL.FSEL[1:0]01

出力クロック

0b00

32.768 kHz

0b011024 Hz

0b10

1 Hz

0b11

OFF (Hi-Z)

0b00

32.768 kHz

0b011024 Hz

0b10

H or L固定

0b11

OFF (Hi-Z)

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3

機能

FOUT出力の制御 (FOE端子を使用する場合)
初期設定時にWTICFG.FOEMUXビットを1に設定することにより、Pin 10への割り当て機能をEVIN2入力からFOE入力へ切り替え、FOE入力信号によってFOUT出力を制御します。また、出力クロック周波数を
TCTL.FSEL[1:0]ビット (表 3.11参照) で選択します。
FOE入力信号がHIGHレベルになっている間は、TCTL.FSEL[1:0]ビットの設定によって選択された周波数の
FOUT信号が、FOUT端子から出力されます。FOE入力信号がLOWレベルの場合、FOUT端子はHi-Zになりま
す。
FOE
FOUT

Hi-Z

Hi-Z

図 3.26FOE制御によるFOUT出力

FOUT端子からのウェイクアップタイマー割り込み信号出力
クロック出力が不要な場合、WTICFG.WTIOUTビットを1に設定することで、FOUT端子をウェイクアップ
タイマーの割り込み要求信号出力端子としても使用可能です。その際、TCTL.FSEL[1:0]ビットを0b11以外に設定されている場合、選択したクロックとウェイクアップタイマー割り込み要求信号がNORされてFOUT
端子から出力されます。

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機能

3.8 自己監視機能
3.8.1 概要
RX4901CE/RX8901CEは電源電圧や発振の状態を監視する機能を搭載しており、その結果をステータスフラグ
として読み出すことができます。また、これらのフラグはタイムスタンプのトリガーや記録内容、イベント割
り込み要因としても利用されます。監視対象は以下のとおりです。
•
•
•
•
•

パワーオンリセットの実行 (PORFフラグ、VLFフラグ)
発振停止 (OSCSTPFフラグ、VLFフラグ)
主電源電圧 (VDD) の低下 (VDDLFフラグ)
バックアップ電源電圧 (VBAT) の低下 (VBATLFフラグ)
電源電圧 (VDD/VBAT) の温度補償更新停止電圧以下への低下 (VTMPLFフラグ)

また、/INT端子は、PORFフラグとそれに伴うVLFフラグを除く、これらのステータスフラグの状態を外部デバイスに出力可能です。

3.8.2 自己監視フラグ機能
パワーオンリセット発生検出: PORFフラグ
PORFフラグ (INTF.PORFビット) は、電源投入後にパワーオンリセットが実行されたことを検出すると1にセットされます。その後パワーオンリセットが解除されても、このフラグは自動的には0に戻りません。
INTF.PORFビット = 1のときは、必要な初期設定等を行うとともに、INTF.PORFビットに0を書き込んで、フラグをクリアします。

水晶発振停止検出: OSCSTPFフラグ
OSCSTPFフラグ (INTF.OSCSTPFビット) は、内蔵の水晶発振が10 ms以上停止したことを検出すると1にセットされます。1にセットされた後、発振が再開しても、このフラグは自動的には0に戻りません。
INTF.OSCSTPFビット = 1のときは、必要な初期設定等を行うとともに、INTF.OSCSTPFビットに0を書き込
んで、フラグをクリアします。
このフラグは、タイムスタンプトリガーおよびイベント検出割り込みにも利用されます。詳細は“3.10.5 タ
イムスタンプ (イベント検出) 割り込み”を参照してください。

日時データ無効警告: VLFフラグ
VLFフラグ (INTF.VLFビット) は、上記のPORFフラグかOSCSTPFフラグがセットされた場合に1にセットされます。VDDの電源投入後やバックアップモードからの復帰後、このフラグであるINTF.VLFビットが1だった場合は、初期設定が必要です。INTF.VLFビットの操作を含むこの初期設定手順について、“2.2.3 初期設定”を参照してください。

VDD電圧低下検出: VDDLFフラグ
PWSW_CFG.INIENビット = 1 (バックアップ電源切り替え機能イネーブル) の場合にのみ有効です。
VDDLFフラグ (BUF_INTF.VDDLFビット) は、主電源電圧 (VDD) がVDD立ち下がり時検出電圧 (-VDET1) 未
満に低下した場合に1にセットされます。VDDがVDD立ち上がり時検出電圧 (+VDET1) 以上になっても、このフラグは自動的には0に戻りません。BUF_INTF.VDDLFビットは、VDDが+VDET1 以上に復帰した後に0を書き込むことによって、クリアされます。
このフラグは、タイムスタンプトリガーおよびイベント検出割り込みにも利用されます。詳細は“3.10.5 タ
イムスタンプ (イベント検出) 割り込み”を参照してください。

RX4901CE/RX8901CE
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機能

VBAT電圧低下検出: VBATLFフラグ
PWSW_CFG.INIENビット = 1 (バックアップ電源切り替え機能イネーブル) の場合にのみ有効です。
VBATLフラグ (BUF_INTF.VBATLFビット) は、バックアップ電源電圧 (VBAT) がVBAT立ち下がり時検出電
圧 (-VLOW) 未満に低下したことを2回連続して検出すると、1にセットされます。BUF_INTF.VBATLFビット
は、VBATがVBAT立ち上がり時検出電圧 (+VLOW) 以上に上昇した後に0を書き込むことによって、クリアされます。
このフラグは、タイムスタンプトリガーおよびイベント検出割り込みにも利用されます。詳細は“3.10.5 タ
イムスタンプ (イベント検出) 割り込み”を参照してください。

温度補償更新停止検出: VTMPLFフラグVTMPLFフラグ (INTF.VTMPLFビット) は、VOUT電圧 (VDDまたはVBAT) が温度補償更新停止電圧 (VDET2)以下に低下した場合に1にセットされます。この場合、温度補償回路は停止し、停止した際の周波数補正条
件で発振を継続します。INTF.VTMPLFビットは、VOUTがVTMP以上に復帰した後に0を書き込むことによって、クリアされます。
このフラグは、タイムスタンプトリガーおよびイベント検出割り込みにも利用されます。詳細は“3.10.5 タ
イムスタンプ (イベント検出) 割り込み”を参照してください。

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機能

3.9 バックアップ電源切り替え機能
3.9.1 概要
バックアップ電源切り替え機能は、主電源 (VDD) とバックアップ電源 (VBAT) の電圧値を監視し、動作電源
VOUTが適切に維持されるよう、主電源とバックアップ電源を切り替える機能です。主電源電圧の低下時には動作電源を主電源からバックアップ電源に切り替え、再度主電源が復帰したときは、動作電源を再び主電源に戻します。
• VDD電圧低下時には動作電源をVBATに切り替えます。
• VDD > VBATの場合にはVDDからVBATを充電できます。
• VBATで動作時にVDD電圧が復帰した場合は動作電源をVDDに切り替えます。
図 3.27に電源切り替え回路の構成を示します。
内部動作電圧VDD
VBATLDETBKSW1VBATLDETEN
電圧検出回路VDDLF
VTMPLF

VOUT

SW2
SW3

VBAT

VBATLFINIEN
CHGEN
SWSEL[1:0]

切り替え
制御回路

VDDSAMP[1:0]

図 3.27電源切り替え回路

3.9.2 動作
動作モード
バックアップ電源切り替え機能を有効にすると、2種類の動作モードが利用できるようになります。

ノーマルモード (バックアップモードへ移行可能)
RX4901CE/RX8901CEが主電源電圧VDDで動作する状態です。ホストから時計/カレンダーカウンターを含む、レジスターへのアクセスが可能です。主電源電圧VDDの電圧検出が常に行われており、VDDが電圧低下検出
電圧-VDET1以下になると、バックアップモードに遷移します。

バックアップモード
RX4901CE/RX8901CEがバックアップ電源VBATで動作する状態です。バックアップ電源VBATからVDD電源へ電流が流れ込まないよう、内蔵電源スイッチSW1が自動的に遮断状態になり、VDD端子はVBATから切り離されます。
ホストインターフェイスは無効になり、CE, CLK, DI, DIO, SDA, SCL入力はフローティング状態にすることができます。またDO端子とFOUT出力はHi-Zになります。
VBAT電圧が計時保持電圧VCLK以上であれば、時計/カレンダー機能やEVINn入力、/INT出力は、ノーマルモー
ドと同様に機能します。

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機能

バックアップ電源切り替え機能を使用する場合の設定
電源切り替え機能はデフォルトで無効に設定されているため、この機能を使用する場合は、レジスター
PWSW_CFGで以下の設定を行います。
1.

PWSW_CFG.CHGENビットを設定する。

(VBAT充電イネーブル/ディスエーブル)

VBATに二次電池等の充電可能な電池/EDLCを接続している場合は1に設定します。
2.

PWSW_CFG.INIENビットを1に設定する。

(電源切り替え機能イネーブル)

PWSW_CFG.INIENビット = 1に設定することで、SW1 〜 3の状態制御は、PWSW_CFG.SWSEL[1:0]
ビットによる設定が無効になり、バックアップ電源切り替え機能による自動制御に移行します。
3.

PWSW_CFG.VBATLDETBKビットを設定する。

(バックアップモード時VBAT電圧検出
イネーブル/ディスエーブル)

4.

PWSW_CFG.VBATLDETENビットを1に設定する。

(VBAT電圧検出イネーブル)

5.

PWSW_CFG.VDDSAMP[1:0]ビットを設定する。

(VDD電圧サンプリング周期設定)

バックアップ電源切り替え機能を使用しない場合の設定
電源切り替え機能はデフォルトで無効に設定されており、主電源 (VDD) とバックアップ電源 (VBAT) の切
り替えや、バックアップ電源 (VBAT) への充電は行われません。
電源投入直後は、電源の切り替えスイッチは (SW1 = OFF、SW2 = OFF、SW3 = ON) となり、主電源 (VDD)とバックアップ用電源 (VBAT) が本モジュール内のダイオードを介して並列に接続されます。このダイオードにより、VDDとVBATの間に電流は流れませんが、このダイオードの順方法電圧VFの分の電圧降下が生じる
ため、RTCの動作電源VOUTは、VDDとVBATの電圧の高いほうからVFだけ下がった電圧になります。
この電圧降下を避けるため、主電源 (VDD) のみを使用する場合は、PWSW_CFG.SWSEL[1:0]ビットを0b10に設定して、スイッチを (SW1 = ON、SW2 = OFF、SW3 = OFF) に設定します。(図 2.4参照)。
バックアップ電源切り替え機能を使用しない場合は、VBAT電圧低下検出機能は無効です。

バックアップ電源切り替えの動作
電源投入時
電源投入時は電源切り替え用の制御ビットとスイッチは以下のように設定されます。
PWSW_CFG.INIENビット = 0
PWSW_CFG.CHGENビット = 0
PWSW_CFG.SWSEL[1:0]ビット = 0b01

(電源切り替え機能ディスエーブル)(VBAT充電ディスエーブル)(SW1 = OFF、SW2 = OFF、SW3 = ON )
VDD

VOUT

SW1

図 3.28

SW2

VBAT

SW3

電源投入 ～ 初期設定

1.

電源投入直後は、主電源 (VDD) とバックアップ電源 (VBAT) がIC内蔵のダイオードを介して並列に接続されます。これにより、RX4901CE/RX8901CEは先に印可された電圧で起動します。

2.

ホストはレジスターPWSW_CFGに書き込みを行い、電源切り替え回路を使用するか否か、およびその他の条件を設定します。

注: 主電源 (VDD) 投入前にバックアップ電源 (VBAT) 用の電池をセットしただけでも水晶発振回路が動作するため、その消費電流が発生します。消費電流値については、“5.4 DC特性”節内の消費電流7 (IBAT3) 規格 (表 5.4) を参照してください。
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機能

切り替え制御1 (一次電池を使った電源バックアップ構成)
電源投入後、電源切り替え用の制御ビットを以下のように設定した場合は、図 3.29に示す制御が行われます。電源の接続例は図 2.3を参照してください。
PWSW_CFG.INIENビット = 1
PWSW_CFG.CHGENビット = 0
PWSW_CFG.VBATLDETENビット = 1
PWSW_CFG.VBATLDETBKビット = 1
PWSW_CFG.VDDSAMP[1:0]ビット(電源切り替え機能イネーブル)(VBAT充電ディスエーブル)(VBAT電圧検出イネーブル)(バックアップモード時VBAT電圧検出イネーブル)(VDD電圧サンプリング周期設定)
ノーマルモード

VDD電圧検出用SW1制御 [1回/1秒]
VDD
VOUT
VBAT

VDDより給電

VDD

VOUT

VBAT
VBAT電圧検出 [1回/3秒](VBAT vs -VLOW)

SW1

SW2

SW3

SW1

SW2

SW3

OFF*

OFF

OFF

ON

OFF

OFF

* OFF期間はPWSW_CFG.VDDSAMP[1:0]ビットで設定PWSW_CFG.VBATLDETENビット = 1

VDD電圧検出 [常に動作](VDD vs -VDET1 )VDD ≧ +VDET1

VDD < -VDET1

バックアップモード
VBATより給電

VDD

VOUT

VBAT

VDD電圧検出 [1回/31.25 ms](VDD vs +VDET1)

図 3.29

VBAT電圧検出 [1回/3秒](VBAT vs -VLOW)
SW1

SW2

SW3

OFF

ON

ON

PWSW_CFG.VBATLDETENビット = 1
および
PWSW_CFG.VBATLDETBKビット = 1

電源切り替え制御1 (VBATに一次電池を使用する場合)

1.

ノーマルモードで動作中は常時、VDD電圧がVDD低下検出電圧 (-VDET1) と比較され、-VDET1を下回るとバックアップ電源 (VBAT) に切り替わり、バックアップモードに移行します。

2.

バックアップモード中は31.25 msに1回、VDD電圧がVDD上昇検出電圧 (+VDET1) と比較され、+VDET1を上回ると主電源 (VDD) に切り替わり、ノーマルモードに移行します。

3.

PWSW_CFG.VBATLDETENビット = 1 (バックアップモードではさらにPWSW_CFG.VBATLDETBK
ビット = 1の設定も必要) の場合は3秒に1回、VBAT電圧がVBAT低下検出電圧 (-VLOW) と比較され、-VLOWを下回るとBUF_INTF.VBATLFビットが1にセットされ、タイムスタンプや割り込みのトリガーとなります。なお、この検出による電源切り替えは生じません。

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機能

切り替え制御2 (二次電池を使った電源バックアップ構成)
電源投入後、電源切り替え用の制御ビットを以下のように設定した場合は、図 3.30に示す制御が行われます。電源の接続例は図 2.2を参照してください。
PWSW_CFG.INIENビット = 1
PWSW_CFG.CHGENビット = 1
PWSW_CFG.VBATLDETENビット = 1
PWSW_CFG.VBATLDETBKビット = 1
PWSW_CFG.VDDSAMP[1:0]ビット

図 3.30(電源切り替え機能イネーブル)(VBAT充電イネーブル)(VBAT電圧検出イネーブル)(バックアップモード時BAT電圧検出イネーブル)(VDD電圧サンプリング周期設定)

電源切り替え制御2 (VBATに二次電池を使用する場合)

ノーマルモードとバックアップモードの切り替えは上記と同様で (“切り替え制御1”参照)、それにVBATへの充電制御が加わります。
1.

ノーマルモード時は3秒に2回、VBATがVDDと比較され、VBATがVDDを下回るとSWがすべてONとなり、VDDからVBATへの充電を開始します。VBATがVDDを上回るとSW2とSW3をOFFにして充電を停止します。
このどちらの状態でもVDD電圧低下検出は常時行われており、低下が検出されると、バックアップモードに移行します。

2.

バックアップモードではVBATの充電制御は行われません。

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機能

表 3.12に動作モードによる検出動作の実行状態を示します。
表 3.12動作モードによる検出動作

ノーマルモード (VDD 駆動)

バックアップモード(VBAT 駆動)

動作モード

PWSW_CFG.CHGEN = 1,
PWSW_CFG.INIEN = 1

PWSW_CFG.CHGEN = 0,
PWSW_CFG.INIEN = 1

PWSW_CFG.CHGEN = 0,
PWSW_CFG.INIEN = 0

VDD電圧監視

常時

常時

停止

1回/31.25 ms

VBAT充電監視2回/3.0秒

停止

停止

停止

VBAT電圧監視

1回/3.0秒

1回/3.0秒

1回/3.0秒

1回/3.0秒

VDD電圧低下検出サンプリング時間設定
電源切り替え機能が有効なノーマルモードでは、常に主電源 (VDD) がVDD低下検出電圧 (-VDET1) と比較され、電圧低下が検出されるとバックアップモードに遷移します。この動作において、SW1を一時的にOFFしてVDD端子をVOUT端子およびVBAT端子から切り離すことで、より高精度なVDD電圧低下検出を行うオプショ
ンがあります。
SW1のOFF時間は、主電源 (VDD) の電源断時の放電特性と、VBATへの充電電圧の低下を考慮して決定します。主電源の放電時間に応じて、SW1のOFF時間を長く設定します。ただし、SW1のOFF期間中のVBATへの充電電圧は、VDDからSW1に並列接続されたダイオードの順方向電圧VFの分だけ電圧降下するため、SW1のOFF時間が長すぎると、VBATの実効的な充電電圧が低下します。
SW1のOFF時間は、表 3.13に示したPWSW_CFG.VDDSAMP[1:0]ビットで設定します。
表 3.13SW1 OFF時間の設定

PWSW_CFG.VDDSAMP[1:0]

SW1 OFF 時間

0b00

OFFしない (デフォルト)

0b01

2 ms

0b10

128 ms0b11

256 ms
VDD-VDET1

SW1

C

浮遊容量

VOUT

SW2
SW3

VBAT

ノーマルモードEDLC

VDD電源OFF2 ms

SW1 OFF
VDD-VDET1256 msV DD 側のインピーダンスが低く、 V DD 電源OFFの際にV DD の放電特 性が急峻になる場合には、 SW1 OFF時間を2 msに設定可能です。

SW1 OFF
VDD-VDET1
VDD側のインピーダンスが高く、VDD電源OFFの際にVDDの放電特性が緩やかになる場合には、SW1 OFF時間を256 ms等に設定する必要があります。

図 3.31

VDD電圧監視用SW1間欠動作

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機能

小容量EDLC使用時の注意
バックアップ電源として小容量EDLCを使用した場合に、注意すべきVDD電圧低下検出動作の一例を図 3.32に示します。
VDD OFF時
VDD-VDET1

C

SW1

逆流防止用
ダイオードを接続

VDD
主電源
C

VOUT

SW2
SW3

ショットキーダイオード、
スイッチングダイオード等
IRおよびVF特性を確認して
ください。

VBAT

ノーマルモード

EDLC

A

B
1.0 s
VDD遮断

VDD
SW1 = OFFSW1 = ON

SW1 = OFFSW1 = OFF

SW1制御
*

*
VBATは1.1 V以上必要

VBAT
VBATからVDDへの逆流が発生* 2、128、256 ms選択可能

図 3.32

小容量EDLC使用時の注意

ノーマルモードで充電動作中、A点でVDD電圧低下が検出されなかった場合、SW1は次のOFF制御 (B点) ま
でONとなります。もしA点の直後にVDD電圧が低下またはVDDをOFFすると、EDLCの放電によりB点まで
VBATからVDDへの逆流が発生します。この逆流を防ぐには、VDD端子側にダイオードを挿入するなどの対策が必要です。

バックアップ電池実装時の注意
バックアップ電池をはんだ付け実装、あるいは実装された電池ホルダーにコイン電池などを装着する際は以下の取り扱いを守ってください。
RTCのVDDがOFFの状態で電池を先にセットされる場合は、チャタリング等の発生でRTCのパワーオンリセットが機
能せず、その後VDDが投入されると消費電流、時計精度、I2C/SPIインターフェィスが不安定な状態で起動する場
合がございます。その対策といたしまして、以下の処理 STEP1～STEP4をご案内致します。

STEP 1: RTCの電池を接続する+/-両端子をGNDレベルに固定してください。VDD,VIOのGND固定は無用です
STEP 2: この状態で電池を装着してください。
STEP 3: 電池装着から100ms以上経過後に、電池端子とGNDのショートを開放してください。
装置基板にリフロー、はんだ槽、手作業などで電池を先に実装された場合は、同様に電池の＋極をGNDに100ms以上ショート後に解放することでパワーオンリセットが機能して上記の不安定動作を回避可能です
STEP 4: 以上の処理後にVDD電源を投入してください。
ただし、先にRTCにVDD電源が投入されている状態で電池を装着される場合は上記の処理は不要です。

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機能

3.10 タイムスタンプ機能
3.10.1 概要
RX4901CE/RX8901CEには、EVINn端子入力の信号変化で生じる外部イベントや、自己監視機能で得られた電源電圧の低下や発振停止などの内部イベントが発生した時点の、日時やイベント要因などの情報を記録する
タイムスタンプ機能があります。主な機能と特長を以下に示します。
• タイムスタンプトリガー
外部イベント入力:- 最大3チャネル (EVIN1、EVIN2、EVIN3)- 内蔵プルアップ/ダウン抵抗を選択可能- トリガーエッジとして立ち上がりエッジ、立ち下がりエッジ、または両エッジを選択可能- ノイズフィルター (0 ～ 5000 ms、125 msステップ) を内蔵- イベントカウンターを内蔵- 入力端子の状態をモニター可能

内部イベント:- VBAT電圧低下検出- -VDET1電圧低下検出- VDET2電圧低下検出- 発振停止検出

コマンドトリガー:- 指定アドレスへの書き込みによりトリガーを発行• タイムスタンプバッファー- 256バイトSRAMを内蔵- 全体を1つのFIFOとしてデータを記録するFIFOモード、全体を3つの領域に分割してチャネルごとにデータを記録するダイレクトモード、SRAMとしてリード/ライトアクセスが可能なSRAMモードに対応- FIFOモードでは、イベント全種類のフルスタンプデータを最大32回分記録可能- ダイレクトモードでは、チャネルごとに10回分 (チャネル2は12回分) のイベ
ントのスタンプデータを記録可能- バッファーフル時の上書きを許可するオーバーライトモードと禁止するオー
バーライト禁止モードに対応• 記録データ

1/1024秒 〜 1秒、秒、分、時、日、月、年、EVINn端子の状態、電圧低下/発振の状態、タイムスタンプトリガー要因• タイムスタンプはバックアップモード時も取得可能• 外部イベントおよび内部イベント発生時に割り込みを発生可能
図 3.33にタイムスタンプ回路の構成を示します。

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発振回路

分周回路
16384 Hz:1024 HzSTOP

1/1024秒
カウンター

Bank 6
レジスター

SRAMMOD

1/1024 s ~ 1023/1024 s
タイムスタンプ
データ
キャプチャー
回路

時計/カレンダー秒:
年

秒/分/時/日/月/年

バッファー
制御回路

VBATLF
電源切り替え回路/ VDDLFVTMPLF
自己監視機能OSCSTPF
イベント
トリガー入力回路(アドレス0x41–0x42)

EVIN3
EVIN2
EVIN1

GND

EVF
EIE

SRAM
(256バイト)

割り込み制御回路(イベント検出割り込み)/INT***CPEN***IEN
イベント
カウンター

ノイズ
フィルター
プルアップ/ダウン
制御

OVWEN
INTCNT[x:0]PTR[x:0]
RDEN
RDPAGE[3:0]
FULLF
EMPTF
BUFnFULLF
BUFnOVWF
BUFnF

***F
:
***EVF

コマンド

Host

機能

EVCNT[5:0]

EVINnMONVDD

FLT[5:0]

POL[1:0]

PUPD[2:0]

図 3.33

タイムスタンプ回路の構成

3.10.2 タイムスタンプトリガー
RX4901CE/RX8901CEは外部または内部イベントの発生、もしくは特定レジスターへの書き込みをトリガーとして、その時点のタイムスタンプデータを取得してバッファーに書き込みます。それぞれのタイムスタンプト
リガーを、EVINnイベント入力トリガー、内部イベントトリガー、コマンドトリガーと言います。

外部イベント入力 (EVINn端子)トリガー
外部イベント入力トリガー信号はEVIN1 ～ EVIN3端子から入力されます。この外部イベントトリガー入力に関連する機能を以下に示します。

プルアップ/プルダウン抵抗
EVINn端子にはプルアップ/プルダウン抵抗が内蔵されており、その構成を選択することができます。
表 3.14

EVINn端子のプルアップ/ダウン

EVIN1_CFG.PUPD[2:0]
EVIN2_CFG.PUPD[2:0]
EVIN3_CFG.PUPD[2:0]

プルアップ/ダウン抵抗

0b000
0b001
0b010
0b011
0b100
その他

プルアップ/ダウンなし
プルアップ 500 kΩ
プルアップ 1 MΩ(デフォルト)
プルアップ 10 MΩ
プルダウン 500 kΩ
プルアップ/ダウンなし

ノイズフィルター
EVINn端子には入力信号のノイズを除去するノイズフィルター回路が設けられています。EVINn端子への入力信号を125 ms周期でサンプリングし、その結果がEVINn_FLT.FLT[5:0]ビットの設定回数分、連続して一致したときに、その論理値が入力されたと判定します。
EVIN1ノイズフィルター: EVIN1_FLT.FLT[5:0]ビット
EVIN2ノイズフィルター: EVIN2_FLT.FLT[5:0]ビット
EVIN3ノイズフィルター: EVIN3_FLT.FLT[5:0]ビット(フィルター時間 [ms] = FLT[5:0] × 125)

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機能

以下の図は、EVINn_FLT.FLT[5:0]ビット = 0x03に設定した例です。
125 ms

125 ms

125 ms

125 ms

125 ms

サンプリングクロック(周期 125 ms)
EVINn端子立ち上がりエッジ検出

EVINnサンプリング結果
EVINn判定結果(立ち上がりエッジ検出時, EVINn_FLT.FLT[5:0]ビット = 0x03)

図 3.34

EVINのノイズフィルター機能

注: • EVINn_FLT.FLT[5:0]ビットを0x00に設定した場合でも、有効な入力信号としてEVINn端子の入力信号1 ms以上のパルス幅が必要です。
• 入力信号は入力検出から5 ms後に取り込まれるため、タイムスタンプの取得まで5 msの遅延が生じます。
表 3.15

EVINn入力有効パルス幅

EVINn_FLT. FLT[5:0]

入力信号のエッジと125msごとのサンプリングタイミ
ングとの前後関係によって、エッジ入力が検出される場合とされない場合が生じるEVINnのパルス幅

常にエッジ入力が検出される
EVINnのパルス幅

0x00
0x01 (設定禁止)
0x02
0x03
:
0x27
0x28
0x29以上 (設定禁止)––
125 ms以上、250 ms未満
250 ms以上、375 ms未満:
4750 ms以上、4875 ms未満
4875 ms以上、5000 ms未満–

1 ms以上–250 ms以上
375 ms以上:
4875 ms以上
5000 ms以上–

入力検出
EVINn端子から入力される信号の検出エッジを設定可能です。
表 3.16
EVIN1_CFG.POL[1:0]
EVIN2_CFG.POL[1:0]
EVIN3_CFG.POL[1:0]

0b00
0b01
0b10
0b11

EVINn入力検出エッジ
検出エッジ

立ち下がりエッジ (デフォルト)立ち上がりエッジ
立ち下がりおよび立ち上がりエッジ

イベントカウンター
各EVINn入力には6ビットカウンターが設けられており、イベントトリガーの入力数を0から63の範囲でカウントすることができます。カウント値は以下のビットから読み出し可能です。
EVIN1イベントカウンター: EVIN1_EVCNT.EVCNT[5:0]ビット
EVIN2イベントカウンター: EVIN2_EVCNT.EVCNT[5:0]ビット
EVIN3イベントカウンター: EVIN3_EVCNT.EVCNT[5:0]ビット

モニター
EVINn端子の現在の状態 (入力ロジックレベル) をモニターするビットが用意されています。
EVIN1モニター: EVINMON.EVIN1MONビット
EVIN2モニター: EVINMON.EVIN2MONビット(1: HIGHレベル入力、0: LOWレベル入力)
EVIN3モニター: EVINMON.EVIN3MONビット
RX4901CE/RX8901CE
ETM63J-02

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46

3

機能

内部イベントトリガー
電源電圧の低下を検出した時点で、または発振の停止を検出した時点で内部イベントトリガーを発行することができます。
VBAT電圧低下検出-VDET1電圧低下検出
VDET2電圧低下検出
発振停止検出 (タイムスタンプデータの取得は、発振が再開したタイミングで作動します。)
注: 電圧低下を検出するには、PWSW_CFG.INIENビットを1に設定する必要があります。詳細は、“3.9 バックアッ
プ電源切り替え機能”を参照してください。

コマンドトリガー
WRCMD_CFG.CMDTRGENビットを1に設定した上でレジスターWRCMD_TRGに任意の値を書き込むことで、コマンドトリガーを発行可能です。

3.10.3 タイムスタンプバッファー
RX4901CE/RX8901CEには256バイトSRAMが搭載されており、取得したタイムスタンプデータを格納するタイ
ムスタンプバッファーとして使用されます。

タイムスタンプデータ
バッファーに取得するデータは以下のとおりで、アドレス0x60から0x69まで連続してアクセスすることにより読み出し可能です。
Address

Captured data

0x60
1/1024秒の分周カウンターデータ
0x61
0x62

秒データ (0–59)

Bit 7

Bit 6

SUBSEC1

SUBSEC0

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

2

1

–

–

–

–

–

–

SUBSEC9512

SUBSEC8SUBSEC7

SUBSEC6SUBSEC5SUBSEC4SUBSEC3

SUBSEC2

256

128

64

32

16

8

4

–

0x63

分データ (0–59)

–

0x64

時データ (0–23)–

日データ (1–31)

–

–

0x66

月データ (1–12)––

年データ (0–99)

0x68

内部ステータス0x69

データを取得したトリガー要因

SEC_L[3:0]

10秒桁 (BCD)

1秒桁 (BCD)MIN_H[2:0]

MIN_L[3:0]

10分桁 (BCD)

1分桁 (BCD)

–

0x65

0x67

SEC_H[2:0]

HOUR_H[1:0]

HOUR_L[3:0]

1時桁 (BCD)

1時桁 (BCD)

DAY_H[1:0]

DAY_L[3:0]

10日桁 (BCD)

1日桁 (BCD)–MONTH_H

MONTH1[3:0]

10月桁 (BCD)

1月桁 (BCD)YEAR_H[3:0]

YEAR_L[3:0]

10年桁 (BCD)

1年桁 (BCD)

EVIN3POL

EVIN2POL

EVIN1POL

EVIN3入力
ステータス

EVIN2入力
ステータス

EVIN1入力
ステータス

VBATLSTAT VTMPLSTAT–VDDLSTATOSCSTPSTATVBAT低下検出 VDET2低下検出 -VDET1低下検出 発振停止検出
ステータス
ステータス
ステータス
ステータス

EVIN3TRG * EVIN2TRG * EVIN1TRG * WRCMDTRG VBATLTRGVTMPLTRGVDDLTRG

OSCSTPTRG

EVIN3
EVIN2
EVIN1
コマンド
VBAT低下検出 VDET2低下検出 -VDET1低下検出 発振停止検出
トリガー発生 トリガー発生 トリガー発生 トリガー発生 トリガー発生 トリガー発生 トリガー発生 トリガー発生* ダイレクトモードでは“0”です。

図 3.35

タイムスタンプデータと読み出しアドレス

読み出し時はバッファー内のポインター/ページを指定し、該当データをこの領域から読み出せるようにします。

RX4901CE/RX8901CE
ETM63J-02

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3

機能

タイムスタンプバッファーの動作モード
タイムスタンプバッファーにはFIFOモード、ダイレクトモード、SRAMモードの3種類の動作モードが用意されています。

FIFOモード (EVIN_EN.DIRMODビット = 0, BUF1_CFG2.SRAMMODビット = 0)
バッファー全体を1つのFIFOとして使用し、ポインターでデータの読み出しと書き込みを管理します。トリ
ガー待ちの状態でも、バッファー内のデータの読み出しが可能です。また、全領域をすべてのトリガー要因が共有します。保存されるタイムスタンプにはトリガー要因が含まれているため、どのトリガーによって取得したタイムスタンプか判別できます。
データを読み出すまで、最大32回のスタンプデータのキャプチャーが可能です。
下図は、6回データをキャプチャーした状態の例です。
Read
Pointer→

Write
Pointer

→

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0
1
2
3
4
5
6
:
31

Bit 63

FIFO (BUF1)

Bit 0
トリガー要因EVIN1イベント入力トリガー
EVIN2イベント入力トリガー
EVIN3イベント入力トリガー
内部イベントトリガー
コマンドトリガー:

図 3.36

FIFOモードのタイムスタンプバッファー

ダイレクトモード (EVIN_EN.DIRMODビット = 1, BUF1_CFG2.SRAMMODビット = 0)
EVIN1 〜 EVIN3のイベント入力で生じるタイムスタンプを、それぞれ独立した3つのバッファー領域(BUF1、BUF2、BUF3) に分けてキャプチャーします。また、他のトリガーによるタイムスタンプの保存先
バッファー領域は、表 3.17を参照してください。
ただし、各バッファーはFIFOの形式はとらず、ポインターによる読み出し/書き込みの管理は行いません。
したがって、ダイレクトモードかつオーバーライトモードでのデータの読み出し時は、該当BUFに対する
スタンプデータのキャプチャー動作を停止させる必要があります。
表 3.17ダイレクトモードのBUF1 〜 BUF3

項目
BUF1
BUF2
BUF3
スタンプデータキャプチャー回数
10回
12回
10回
トリガー要因EVIN1イベント入力トリガー EVIN2イベント入力トリガー EVIN3イベント入力トリガー
コマンドトリガー
内部イベントトリガー

下図は、各バッファ―に2回データをキャプチャーした状態の例です。

BUF1

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1
:
9

BUF2

0
1
:
11

BUF3

0
1
:
9

図 3.37

Bit 63

Bit 0:

トリガー要因EVIN2イベント入力トリガー::

トリガー要因EVIN3イベント入力トリガー
内部イベントトリガー

各バッファ―に2回データをキャプチャーしたときのダイレクトモードのタイムスタンプバッファー

RX4901CE/RX8901CE
ETM63J-02

トリガー要因EVIN1イベント入力トリガー
コマンドトリガー

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3

機能

SRAMモード (EVIN_EN.DIRMODビット = 0/1, BUF1_CFG2.SRAMMODビット = 1)
このモードでは、Bank 6を通してタイムスタンプバッファーを通常のSRAMと同様にリード/ライトアクセ
スすることが可能です。SRAMは16バイト × 16ページで構成されます。アクセスするページを指定することにより、そのページの16アドレスに対してBank 6 (アドレス0x60 〜 0x6F) からデータを自由にリード/ライトできます。
SRAMのアクセス方法
1.

BUF1_CFG2.SRAMMODビットを1に設定する。

(SRAMモードに設定)

2.

BUF1_CFG2.RDPAGE[3:0]ビットを設定する。
(SRAMページ (0x0 〜 0xF) を指定)
Bank 6が指定したページをアクセスするウィンドウになります。

3.

アドレス0x60 〜 0x6F (SRAMアドレス0x0 〜 0xFに対応) 内の必要なアドレスに対してリード/ライトを行う。

タイムスタンプバッファーの書き込みモード
データのキャプチャーによりバッファーフルの状態になった後の動作を指定する2種類の書き込みモードが用意されています。

オーバーライトモード
読み出し前のデータは古いデータから上書きされます。
以下のビットを1に設定するとオーバーライトモードになります。
FIFOモード/BUF1書き込みモード設定: BUF1_CFG1.OVWENビット
BUF2書き込みモード設定:
BUF2_CFG1.OVWENビット
BUF3書き込みモード設定:
BUF3_CFG1.OVWENビット
オーバーライトが発生した場合はBUF_OVWF.BUFnOVWFビットが1にセットされます。

オーバーライト禁止モード
バッファーフル以降にタイムスタンプのトリガーが発行されると、オーバーライトのフラグはセットされますが、キャプチャーされたデータは破棄されます。読み出し前のデータは保護されます。
上記の書き込みモード設定ビットを0に設定するとオーバーライト禁止モードになります。

3.10.4 動作
初期設定
1.

/INTからのイベント検出割り込み出力を禁止
初期設定中に不要なイベント検出割り込みが発生することを防止するため、割り込みを禁止してくだ
さい。
1-1.

2.

(タイムスタンプイベント検出割り込みディスエーブル)

FIFOモード/ダイレクトモードの選択
2-1.

3.

TSTP_INTE.EIEビットを0に設定する。

EVIN_EN.DIRMODビットを設定する。

(FIFO/ダイレクトモードの選択)

EVIN入力の設定
3-1.

EVIN1入力を使用する場合、レジスターEVIN1_CFGとEVIN1_FLTの以下のビットを設定する。
- EVIN1_CFG.PUPD[2:0]ビット(プルアップ/プルダウン抵抗の設定)- EVIN1_CFG.POL[1:0]ビット(検出エッジを選択)- EVIN1_FLT.FLT[5:0]ビット(入力フィルター時間を設定)

RX4901CE/RX8901CE
ETM63J-02

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3

4.

機能

3-2.

EVIN2入力を使用する場合、レジスターEVIN2_CFGとEVIN2_FLTの以下のビットを設定する。
- EVIN2_CFG.PUPD[2:0]ビット(プルアップ/プルダウン抵抗の設定)- EVIN2_CFG.POL[1:0]ビット(検出エッジを選択)- EVIN2_FLT.FLT[5:0]ビット(入力フィルター時間を設定)

3-3.

EVIN3入力を使用する場合、レジスターEVIN3_CFGとEVIN3_FLTの以下のビットを設定する。
- EVIN3_CFG.PUPD[2:0]ビット(プルアップ/プルダウン抵抗の設定)- EVIN3_CFG.POL[1:0]ビット(検出エッジを選択)- EVIN3_FLT.FLT[5:0]ビット(入力フィルター時間を設定)

割り込みの設定
4-1.

外部イベント入力割り込みを許可する場合は、レジスターEVNT_INTEの以下のビットを1 (禁止する場合は0) に設定する。
- EVNT_INTE.EVIN1IENビット*1(EVIN1イベント入力割り込みを許可/禁止)- EVNT_INTE.EVIN2IENビット*1(EVIN2イベント入力割り込みを許可/禁止)*1- EVNT_INTE.EVIN3IENビット(EVIN3イベント入力割り込みを許可/禁止)

4-2.

内部イベント割り込みを許可する場合は、レジスターEVNT_INTEの以下のビットを1 (禁止する
場合は0) に設定する。
- EVNT_INTE.VBATLIENビット*1(VBAT電圧低下検出イベント割り込みを許可/禁止)*1- EVNT_INTE.VTMPLIENビット(VDET2電圧低下検出イベント割り込みを許可/禁止)- EVNT_INTE.VDDLIENビット*1(-VDET1電圧低下検出イベント割り込みを許可/禁止)*1- EVNT_INTE.OSCSTPIENビット(発振停止検出イベント割り込みを許可/禁止)*1 タイムスタンプデータの取得が許可されているか否かにかかわらず、これらのビットにより各イベントの発生による割り込みが許可/禁止されます。
5.

バッファーの設定
5a.

FIFOモード時 (BUF1)

5a-1. レジスターBUF1_CFG1の以下のビットを設定する。
- BUF1_CFG1.OVWENビット(オーバーライト/オーバーライト禁止モードの選択)- BUF1_CFG1.INTCNT[5:0]ビット*2(割り込みを発生させるバッファーデータ数の指定)*2 0x0に設定すると、BUF1のBUF_INTF.BUF1Fがセットされたときの割り込みは発生しません。
5b.

ダイレクトモード時 (BUF1 〜 BUF3)

5b-1. BUF1を使用する場合は、レジスターBUF1_CFG1の以下のビットを設定する。
- BUF1_CFG1.OVWENビット(オーバーライト/オーバーライト禁止モードの選択)- BUF1_CFG1.INTCNT[5:0]ビット*3(割り込みを発生させるバッファーデータ数の指定)
5b-2. BUF2を使用する場合は、レジスターBUF2_CFG1の以下のビットを設定する。
- BUF2_CFG1.OVWENビット(オーバーライト/オーバーライト禁止モードの選択)*3- BUF2_CFG1.INTCNT[3:0]ビット(割り込みを発生させるバッファーデータ数の指定)
5b-3. BUF3を使用する場合は、レジスターBUF3_CFG1の以下のビットを設定する。
- BUF3_CFG1.OVWENビット(オーバーライト/オーバーライト禁止モードの選択)- BUF3_CFG1.INTCNT[3:0]ビット*3(割り込みを発生させるバッファーデータ数の指定)*3 0x0に設定すると、BUFnのBUF_INTF.BUFnFがセットされたときの割り込みは発生しません。
6.

7.

コマンドトリガーによるイベントカウンターとバッファーのフラグのクリア
6-1.

レジスターWRCMD_CFGに0xF0を書き込む。

(クリアコマンド)

6-2.

レジスターWRCMD_TRGに任意の値を書き込む。

(コマンドトリガー発行)/INT端子からのイベント検出割り込み出力を許可
7-1.

TSTP_INTE.EIEビットを1に設定する。 (タイムスタンプイベント検出割り込みイネーブル)

RX4901CE/RX8901CE
ETM63J-02

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50

3
8.

タイムスタンプを取得する外部イベントを設定
8-1.

9.

機能

EVIN入力でタイムスタンプを取得する場合は、レジスターEVIN_ENの以下のビットを1に設定する。
- EVIN_EN.EVIN1CPENビット(EVIN1入力によるタイムスタンプキャプチャーを許可/禁止)- EVIN_EN.EVIN2CPENビット(EVIN2入力によるタイムスタンプキャプチャーを許可/禁止)- EVIN_EN.EVIN3CPENビット(EVIN3入力によるタイムスタンプキャプチャーを許可/禁止)

タイムスタンプを取得する内部イベントを設定
9-1.

内部イベントの発生時にタイムスタンプを取得する場合は、レジスターCAP_ENの以下のビットを1に設定する。
- CAP_EN.VBATLCPENビット(VBAT電圧低下検出イベントトリガーによるタイムスタンプキャプチャーを許可/禁止)- CAP_EN.VTMPLCPENビット(VDET2電圧低下検出イベントトリガーによるタイムスタンプキャプチャーを許可/禁止)- CAP_EN.VDDLCPENビット(-VDET1電圧低下検出イベントトリガーによるタイムスタンプキャプチャーを許可/禁止)- CAP_EN.OSCSTPCPENビット(発振停止検出イベントトリガーによるタイムスタンプキャプチャーを許可/禁止)

10. 外部イベントの入力受付許可10-1. EVIN端子からの外部イベント入力を許可する場合は、レジスターEVIN_ENの以下のビットを1に設定する。
- EVIN_EN.EVIN1ENビット*4(EVIN1からの外部イベント入力を許可/禁止)*4- EVIN_EN.EVIN2ENビット(EVIN2からの外部イベント入力を許可/禁止)- EVIN_EN.EVIN3ENビット*4(EVIN3からの外部イベント入力を許可/禁止)*4 EVIN_EN.EVINnENビットを0 (EVINn入力を禁止) に設定する場合は、EVIN_EN.EVINnCPEN
ビットも0に設定してください。

RX4901CE/RX8901CE
ETM63J-02

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3

機能

タイムスタンプキャプチャー動作
FIFOモード
タイムスタンプキャプチャーが許可されたイベントトリガーまたはコマンドトリガーが発生すると、
RX4901CE/RX8901CEはタイムスタンプデータをカウンターおよびフラグより取得し、<BUF1_STAT.
PTR[5:0]ビット + 1> が示すバッファーのページに書き込みます。この書き込みによりBUF1_STAT.
PTR[5:0]ビットはインクリメントされます。つまり、BUF1_STAT.PTR[5:0]ビットはバッファー内の読み出
し前のデータ数を保持しています。この値がBUF1_CFG1.INTCNT[5:0]ビットで指定したデータ数に一致す
るとBUF1のイベント入力割り込み要因が発生し、割り込みが許可されていれば/INT信号をアクティブにしてホストに割り込み要求を出力します。
データリード時は <BUF1_STAT.PTR[5:0]ビット = 1> が指し示すページからタイムスタンプデータが読み
出 さ れ ま す 。 こ の 読 み 出 し に よ り BUF1_STAT. PTR[5:0] ビ ッ ト は デ ク リ メ ン ト さ れ 、 同 時 に
BUF1_STAT.PTR[5:0]ビットが指し示すページ番号が更新されます。
図 3.38と図 3.39にデータのキャプチャーによるFIFOバッファー、ポインター、バッファーステータスビッ
トの状態を示します。
バッファーエンプティ(OVWEN = 0)
(INTCNT[5:0] = 32)
FULLF = 0
EMPTF = 1
PTR[5:0] = 0(デフォルト)PTR[5:0]
FIFO(物理 ページ)
0
1
0
2
1
3
2
4
3
5
4
6
5
7
6
8
7
9
8
10
9
11
10
12
11
13
12
14
13
15
14
16
15
17
16
18
17
19
18
20
19
21
20
22
21
23
22
24
23
25
24
26
25
27
26
28
27
29
28
30
29
31
30
32
31

10データをキャプチャー(OVWEN = 0)
(INTCNT[5:0] = 32)
FULLF = 0
EMPTF = 0
PTR[5:0] = 10
PTR[5:0]
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32

FIFO
0 (最古)
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31

32データをキャプチャー
バッファーフル(OVWEN = 0)
(INTCNT[5:0] = 32)
FULLF = 1
EMPTF = 0
PTR[5:0] = 32
PTR[5:0]
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32

FIFO
0 (最古)
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31

バッファーフルから
2トリガーが発生

10データを読み出し(OVWEN = 0)
(INTCNT[5:0] = 32)
FULLF = 1
EMPTF = 0
PTR[5:0] = 32

(OVWEN = 0)
(INTCNT[5:0] = 32)
FULLF = 0
EMPTF = 0
PTR[5:0] = 22

PTR[5:0]
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32

FIFO
0 (最古)
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31

FIFO
PTR[5:0]
0
23
0
24
1
25
2
26
3
27
4
28
5
29
6
30
7
31
8
32
9
1
10 (最古)
2
11
3
12
4
13
5
14
6
15
7
16
8
17
9
18
10
19
11
20
12
21
13
22
14
23
15
24
16
25
17
26
18
27
19
28
20
29
21
30
22
31

PTR[5:0] = INTCNT[5:0]
割り込み発生バッファー容量を超えた
データは破棄される
ただし、割り込みは発生

32データを読み出し

図 3.38

タイムスタンプキャプチャー動作 (FIFOモード + オーバーライト禁止モード)

RX4901CE/RX8901CE
ETM63J-02

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3
バッファーエンプティ(OVWEN = 1)
(INTCNT[5:0] = 32)
FULLF = 0
EMPTF = 1
PTR[5:0] = 0
BUF1OVWF = 0(デフォルト)PTR[5:0]
FIFO(物理 ページ)
0
1
0
2
1
3
2
4
3
5
4
6
5
7
6
8
7
9
8
10
9
11
10
12
11
13
12
14
13
15
14
16
15
17
16
18
17
19
18
20
19
21
20
22
21
23
22
24
23
25
24
26
25
27
26
28
27
29
28
30
29
31
30
32
31

10データをキャプチャー(OVWEN = 1)
(INTCNT[5:0] = 32)
FULLF = 0
EMPTF = 0
PTR[5:0] = 10
BUF1OVWF = 0
PTR[5:0]
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32

FIFO
0 (最古)
1
2
3
4
5
6
7
8
9 (最新)
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31

32データをキャプチャー
バッファーフル(OVWEN = 1)
(INTCNT[5:0] = 32)
FULLF = 1
EMPTF = 0
PTR[5:0] = 32
BUF1OVWF = 0

FIFO
PTR[5:0]010 (最古)
2
1
3
2
4
3
5
4
6
5
7
6
8
7
9
8
10
9
11
10
12
11
13
12
14
13
15
14
16
15
17
16
18
17
19
18
20
19
21
20
22
21
23
22
24
23
25
24
26
25
27
26
28
27
29
28
30
29
31
30
32
31 (最新)PTR[5:0] = INTCNT[5:0]
割り込み発生機能

バッファーフルから
2トリガーが発生

10データを読み出し(OVWEN = 1)
(INTCNT[5:0] = 32)
FULLF = 1
EMPTF = 0
PTR[5:0] = 32
BUF1OVWF = 1(OVWEN = 1)
(INTCNT[5:0] = 32)
FULLF = 0
EMPTF = 0
PTR[5:0] = 22
BUF1OVWF = 1

PTR[5:0]
0
31
32
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30

FIFO

FIFO
PTR[5:0]
0
21
0
22
1(最新)
23
2
24
3
25
4
26
5
27
6
28
7
29
8
30
9
31
10
32
11
1
12 (最古)
2
13
3
14
4
15
5
16
6
17
7
18
8
19
9
20
10
21
11
22
12
23
13
24
14
25
15
26
16
27
17
28
18
29
19
30
20
31

0
1 (最新)
2 (最古)
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
ページ0と1は上書きされる
割り込み発生32データを読み出し(BUF1OVWFはライトコマンド (BUF1FCLREN = 1) によりクリア)

図 3.39タイムスタンプキャプチャー動作 (FIFOモード + オーバーライトモード)

RX4901CE/RX8901CE
ETM63J-02

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53

3

機能

ダイレクトモード
タイムスタンプキャプチャーが許可されたイベントトリガーまたはコマンドトリガーが発生すると、
RX4901CE/RX8901CEはタイムスタンプデータをカウンターおよびフラグより取得し、イベントの種類で決められているBUFnに書き込みます。ダイレクトモードのバッファーはFIFOのようなポインターを持ちません。トリガーが発生した回数をBUFn_STAT.PTR[x:0]ビットに保持しており、データはこの値が示すページに 書き込 まれま す。デー タの書 き込み ごとに ト リガー 回数は インクリ メント されま す。この 値 がBUFn_CFG1.INTCNT[x:0]ビットで指定したデータ数に一致するとBUFnのイベント入力割り込み要因が発生し、割り込みが許可されていれば/INT信号をアクティブにしてホストに割り込み要求を出力します。
図 3.40と図 3.41にBUF1を例にデータのキャプチャーによるバッファーとバッファーステータスビットの状態を示します。

図 3.40

タイムスタンプキャプチャー動作 (ダイレクトモード + オーバーライト禁止モード)

RX4901CE/RX8901CE
ETM63J-02

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3
バッファーエンプティ

9データをキャプチャー(OVWEN = 1)
(INTCNT[5:0] = 10)
FULLF = 0
EMPTF = 1
PTR[5:0] = 0
BUF1OVWF = 0(デフォルト)PTR[5:0]
BUF1 RDPAGE[3:0]
PTR[5:0](物理 ページ)000(デフォルト)
1
1
1
0
2
2
2
1
3
3
3
2
4
4
4
3
5
5
5
4
6
6
6
5
7
7
7
6
8
8
8
7
9
9
9
A
8
10
10
10
9

バッファーフルから
2トリガーが発生

10データをキャプチャー
バッファーフル(OVWEN = 1)
(INTCNT[5:0] = 10)
FULLF = 0
EMPTF = 0
PTR[5:0] = 9
BUF1OVWF = 0(OVWEN = 1)
(INTCNT[5:0] = 10)
FULLF = 1
EMPTF = 0
PTR[5:0] = 10
BUF1OVWF = 0

BUF1

RDPAGE[3:0]
PTR[5:0]001
10 (最古)
2
2
1
3
3
2
4
4
3
5
5
4
6
6
5
7
7
6
8
8
7
9
9
8 (最新)
1010B
9(OVWEN = 1)
(INTCNT[5:0] = 10)
FULLF = 1
EMPTF = 0
PTR[5:0] = 10
BUF1OVWF = 1

BUF1

RDPAGE[3:0]
PTR[5:0]001
10 (最古)
2
2
C
1
3
3
2
4
4
3
5
5
4
6
6
5
7
7
6
8
8
7
9
9
8
10
10
9 (最新)BUF1

RDPAGE[3:0]01021 (最新)
32 (最古)
4
3
5
4
6
5
7
6
8
7
9
8
10
9
ページ0と1は上書きされる
割り込み発生PTR[5:0] = INTCNT[5:0]
割り込み発生FULLF = 0または
BUF1OVWF = 0の場合

機能

FULLF = 1またはBUF1OVWF = 1の場合

9データを読み出し
FULLF = 0
EMPTF = 1
PTR[5:0] = 9 (読み出し前と同じ)
BUF1OVWF = 0 (読み出し前と同じ)

PTR[5:0]、BUF1OVWFはライトコマンド(BUF1FCLREN = 1)によりクリア
EVIN1CPENを1、RDENとRDPAGE[3:0]を0に設定

PTR[5:0]
0
1
2
3
4
5
6
7
8
9
A
10

BUF1
0
1
2
3
4
5
6
7
8
9

RDPAGE[3:0]
0
1
2
3
4
5
6
7
8
9
10

EVIN1CPEN = 0、
RDEN = 1に設定後、
RDPAGE[3:0]をインクリメントしてページ1 〜 PTR[5:0]を連続読み出し
最新ページ = PTR[5:0]
最古ページ = 1

10データを読み出し
FULLF = 0
EMPTF = 1
PTR[5:0] = 9/10 ( 読み出し前と同じ)
BUF1OVWF = 0/1 (読み出し前と同じ)
PTR[5:0]
0
1
2
C
3
4
5
6
7
8
9
A
10
B

図 3.41

BUF1
0
1
2
3
4
5
6
7
8
9

RDPAGE[3:0]
0
1
2
3
4
5
6
7
8
9
10

タイムスタンプキャプチャー動作 (ダイレクトモード + オーバーライトモード)

RX4901CE/RX8901CE
ETM63J-02

EVIN1CPEN = 0、RDEN = 1に設定後、
RDPAGE[3:0]をインクリメントしてページ1 〜 10を連続読み出し
最新ページ = PTR[5:0]
最古ページ = PTR[5:0]/10 の剰余 + 1

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55

3

機能

バッファーフル/エンプティ
データが読み出されずにバッファーがフルになるとバッファーフルフラグ (BUFn_STAT.FULLFビットお
よびBUF_FULLF.BUFnFULLFビット*1) が1になります。
オーバーライト禁止モードに設定している場合、これ以降のイベントトリガーで取得したタイムスタンプ
データは、バッファーに空きができる (BUFn_STAT.FULLFビットが0になる) まで、破棄されます。ダイレ
クトモードの場合、BUFn_STAT.PTR[x:0]ビットはバッファーフル時の値に固定されます。
オーバーライトモードに設定している場合、新たに取得したデータで最も古いデータから順に上書きされます。ダイレクトモードの場合、BUFn_STAT.PTR[x:0]ビットは0に戻りトリガー回数のカウントを継続します。オーバーライトが発生すると、オーバーライトフラグ (BUF_OVWF.BUFnOVWFビット*2) が1にセットされます。
データがすべて読み出されてバッファーが空になると、バッファーエンプティフラグ (BUFn_STAT.EMPTF
ビット*3) が1にセットされます。
*1

バッファーフルフラグ: BUFn_STAT.FULLFビットは、データが読み出されてバッファーに空きができると自動的にクリアされます。また、WRCMD_CFG.BUFnFCLRENビット = 1のコマンドトリガーを実行することによってもクリアされます。
BUF_FULLF.BUFnFULLFビットはバッファーフルの履歴を表すフラグで、バッファーフル状態が解消
されても0を書き込むまでクリアされません。

*2

BUF_OVWF.BUFnOVWFビットは、WRCMD_CFG.BUFnFCLRENビット = 1のコマンドトリガーを実行することによりクリアされます。

*3

バッファーエンプティフラグ: BUFn_STAT.EMPTFビットは、バッファーにデータが書き込まれると自動的にクリアされます。また、WRCMD_CFG.BUFnFCLRENビット = 1のコマンドトリガーを実行する
ことによってもクリアされます。

コマンドトリガーの発行
RX4901CE/RX8901CEにはレジスターへの書き込みによりタイムスタンプトリガーを発生させる機能があります。その手順は以下のとおりです。
1.

WRCMD_CFG.CMDTRGENビットを1に設定する。

(コマンドトリガーを指定)

2.

WRCMD_TRG.WRTRG[7:0]ビットに任意の値を書き込む。

(コマンドトリガーの発行)

3.

BUF_INTF.BUF1Fビットが1にセットされたことを確認する。
あるいは、BUF1_CFG2.RDPAGE[3:0]ビットがインクリメントされたことを確認する。

4.

WRCMD_TRG.WRTRG[7:0]ビットが0x00に戻ったことを確認する。

手順3はタイムスタンプトリガーが正常に受けられたことを確認する手順です。
手順4はコマンドトリガー発行直後にタイムスタンプデータを読み出す場合や、次のコマンドトリガーを発行する場合に必要です。
注: • コマンドトリガーによるタイムスタンプはBUF1に保存されます。
• このタイムスタンプトリガーを連続して発行する場合は、それぞれのトリガーの間に5 ms以上のインターバ
ルが必要です。

コマンドトリガーによるタイムスタンプトリガーのタイミングを図 3.42に示します。
RX4901CEでは、レジスターWRCMD_TRGのデータのLSBのクロック立ち上がりエッジでコマンドトリガーが発行されます。
RX8901CEでは、レジスターWRCMD_TRGへのデータ送信に対するACK応答中のクロックの立ち上がり
エッジでコマンドトリガーが発行されます。

RX4901CE/RX8901CE
ETM63J-02

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56

3

機能

RX4901CE
CLK
DIO/DI

Bit 7

Bit 0
アドレス0x42に対する書き込みデータ

Bit 7

アドレス0x43に対する書き込みデータ
トリガー発生RX8901CESCL
SDA (Host)

Bit 7

Bit 0

Bit 7
アドレス0x43に対する書き込みデータ

アドレス0x42に対する書き込みデータ

SDA (RTC)

ACK
トリガー発生図 3.42

コマンドトリガータイミング

コマンドトリガーには上記のタイムスタンプトリガー以外に、以下の機能があります。
WRCMD_CFG.EVCNTCLRENビット:1に設定してコマンドトリガーを発行することにより、イベント
カウンター (レジスターEVINn_EVCNT) をクリアします。

WRCMD_CFG.BUF1FCLRENビット:1に設定してコマンドトリガーを発行することにより、以下のフラグをクリアします。
BUF1_STAT.FULLFビット (BUF1フルフラグ)
BUF1_STAT.EMPTFビット (BUF1エンプティフラグ)BUF1_STAT.PTR[5:0]ビット (BUF1イベントポインター)BUF_OVWF.BUF1OVWFビット (BUF1オーバーライトフラグ)

WRCMD_CFG.BUF2FCLRENビット:1に設定してコマンドトリガーを発行することにより、以下のフラグをクリアします。
BUF2_STAT.FULLFビット (BUF2フルフラグ)
BUF2_STAT.EMPTFビット (BUF2エンプティフラグ)BUF2_STAT.PTR[3:0]ビット (BUF2イベントポインター)BUF_OVWF.BUF2OVWFビット (BUF2オーバーライトフラグ)

WRCMD_CFG.BUF3FCLRENビット:1に設定してコマンドトリガーを発行することにより、以下のフラグをクリアします。
BUF3_STAT.FULLFビット (BUF3フルフラグ)
BUF3_STAT.EMPTFビット (BUF3エンプティフラグ)BUF3_STAT.PTR[3:0]ビット (BUF3イベントポインター)BUF_OVWF.BUF3OVWFビット (BUF3オーバーライトフラグ)

RX4901CE/RX8901CE
ETM63J-02

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57

3

機能

タイムスタンプデータの読み出し
FIFOモード
FIFOモードでのタイムスタンプデータ読み出し手順の一例を以下に示します。
1.

割り込み発生 (/INT = L) 後、レジスターINTFを読み出す。
INTF.EVFビット = 1の場合はタイムスタンプイベント検出割り込みが発生していますので、手順2以下を実行します。
それ以外の割り込みが発生した場合は、対応する割り込み処理を実行してください。

2.

レジスターEVNT_INTFとBUF_INTFを読み出して、発生している割り込み要因を特定する。
<レジスターEVNT_INTF内のフラグがセットされている場合>
EVIN1入力または内部イベントが発生したことを示します。表 3.18に各フラグのセット条件を示します。発生したイベントに従い、割り込み処理を実行してください。また、セットされたフラグは割り込み処理内で0を書き込んでクリアしてください。
<BUF_INTF.BUF1Fビットがセットされている場合>
この割り込みは、キャプチャーを許可しているイベントの発生により、BUF1_STAT.PTR[5:0]ビットが示すバッファー内のデータ数がBUF1_CFG1.INTCNT[5:0]ビットの設定値に一致すると発生します。
以下の操作を行い、データを読み出してください。

3.

割り込みを一時的に禁止する場合は、TSTP_INTE.EIEビットを0に設定する。
(タイムスタンプイベント検出割り込みディスエーブル)

4.

BUF_INTF.BUF1Fビットに0を書き込む。

5.

BUF1_STAT.PTR[5:0]ビットを読み出し、バッファーから読み出し可能なタイムスタンプデータ数を取
得する。

6.

アドレス0x60 〜 0x69の10バイトをバーストリード注して、1回分のタイムスタンプデータを取得する。
その後1 msの待ち時間を取り、さらにこの操作を手順5で取得したデータ数分繰り返し実行する。

(割り込みフラグをクリア)

このとき、BUF1_CFG2.RDPAGE[3:0]ビットによる読み出しページの指定は不要です。最初の読み出し
で最古のデータが得られ、その後順次新しいデータが読み出されます。BUF1_STAT. PTR[5:0]ビットは1回分の読み出しごとにデクリメントされ、必要回数の読み出し後は0になります。各アドレスの内容については図 3.35を参照してください。
注: • タイムスタンプデータは、必ずアドレス0x60 〜 0x69を連続的に読み出して取得してください。一部のみの読み出しは禁止します。
• 手順5で得られたデータ数 (回数) 以上の読み出しは行わないでください。

7.

BUF1_STAT.PTR[5:0]ビットが0またはBUF1_STAT.EMPTFビットが1になっていることを確認する。
もし、BUF1_STAT.PTR[5:0]ビットが0以外、あるいはBUF1_STAT.EMPTFビットが0の場合は、手順6の読み出し中に新たなトリガーが発生し、タイムスタンプデータが新たに追加されていますので、手順5〜 7を繰り返してください。

8.

TSTP_INTE.EIEビットを1に設定する (手順3で0に設定した場合)。
(タイムスタンプイベント検出割り込みイネーブル)

上記の手順はバッファーフルやオーバーライトを考慮していません。必要に応じ、それぞれのフラグを読み出して処理してください。

RX4901CE/RX8901CE
ETM63J-02

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58

3

機能

ダイレクトモード
ダイレクトモードでは、オーバーライト禁止モードとオーバーライトモードで推奨されているタイムスタ
ンプデータ読み出し手順が異なります。それぞれの読み出しの推奨手順を以下に示します。
〈オーバーライト禁止モード時〉
1.

割り込み発生 (/INT = L) 後、レジスターINTFを読み出す。
INTF.EVFビット = 1の場合はタイムスタンプイベント検出割り込みが発生していますので、手順2以下を実行します。
それ以外の割り込みが発生した場合は、対応する割り込み処理を実行してください。

2.

レジスターEVNT_INTFとBUF_INTFを読み出して、発生している割り込み要因を特定する。
<レジスターEVNT_INTF内のフラグがセットされている場合>
EVINn入力または内部イベントが発生したことを示します。表 3.18に各フラグのセット条件を示します。発生したイベントに従い、割り込み処理を実行してください。また、セットされているフラグは割り込み処理内で0を書き込んでクリアしてください。
<BUF_INTF.BUFnFビットがセットされている場合>
この割り込みは、キャプチャーを許可しているイベントの発生により、BUFn_STAT.PTR[x:0]ビットが示すバッファー内のデータ数がBUFn_CFG1.INTCNT[x:0]ビットの設定値に一致すると発生します。
以下の操作を行い、データを読み出してください。

以下、BUF1の割り込みが発生したものとして説明します。
3.

BUF1_STAT.PTR[5:0]ビットを読み出して最新タイムスタンプデータのページ番号を取得する。

4.

BUF1_CFG2.RDENビットを1に設定する。

5.

BUF1_CFG2.RDPAGE[3:0]ビットを0x1 (最古データのページ) に設定する。(読み出すページを指定)

6.

アドレス0x60 〜 0x69の10バイトをバーストリードして、1回分のタイムスタンプデータを取得する。

(BUF1の読み出しを許可)

各アドレスの内容については図 3.35を参照してください。
* タイムスタンプデータは、必ずアドレス0x60 〜 0x69を連続的に読み出して取得してください。一部のみの読み出しは禁止します。
7.

BUF1_CFG2.RDPAGE[3:0]ビットが手順3で読み込んだページ数に達していなければ、BUF1_CFG2.
RDPAGE[3:0]ビットをインクリメント (最古から最新データページまでを順次指定) し、手順6 〜
7を繰り返す。

8.

BUF1_CFG2.RDENビットを0に設定する。

9.

WRCMD_CFG.BUF1FCLRENビットを1に設定し、レジスターWRCMD_TRGに任意の値を書き込む。
(BUF1のフラグとページポインターをクリア)(BUF1の読み出しを禁止)

オーバーライト禁止モード時の注意
オーバーライト禁止モードでバッファーフルが発生した場合 (BUFn_STAT.PTR[x:0]ビット = 10
(BUF1/BUF3) または12 (BUF2)、BUFn_STAT.FULLFビット = 1)、バッファーフル以降に無効なタイ
ムスタンプトリガーがあったかどうかを判別できません。バッファーフルになる前に割り込みが発生するように設定し (たとえば、BUF1_CFG1.INTCNT[5:0]ビットを8回 (= 10回 - 2回) に設定)、デー
タ読み出し処理を行なうことを推奨します。
〈オーバーライトモード時〉
1.

割り込み発生 (/INT = L) 後、レジスターINTFを読み出す。
INTF.EVFビット = 1の場合はタイムスタンプイベント検出割り込みが発生していますので、手順2以下を実行します。
それ以外の割り込みが発生した場合は、対応する割り込み処理を実行してください。
* オーバーライトモード時は、割り込み (INTF.EVFビット = 1) を待たずに、任意のタイミングで読み出しを実行することが可能です。(その場合、手順1 (割り込み待ち) と 2 (割り込み要因の確認) は不要です。
）

RX4901CE/RX8901CE
ETM63J-02

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59

3

機能

2． レジスターEVNT_INTFとBUF_INTFを読み出して、発生している割り込み要因を特定する。
<レジスターEVNT_INTF内のフラグがセットされている場合>
EVINn入力または内部イベントが発生したことを示します。表 3.18に各フラグのセット条件を示します。発生したイベントに従い、割り込み処理を実行してください。また、セットされているフラグは割り込み処理内で0を書き込んでクリアしてください。
<BUF_INTF.BUFnFビット がセットされている場合>
オーバーライトモード時、この割り込みはキャプチャーを許可しているイベントの発生により、
BUFn_STAT.PTR[x:0]ビットが示すバッファー内のデータ数がBUFn_CFG1. INTCNT[x:0]ビットの設定値に一致またはそれ以上になることで発生します。ただし、内部ポインターが1周して0に戻ることで
BUF_INTF.BUFnFビットも0に戻り、次にポインターがBUFn_CFG1.INTCNT[x:0]ビットの設定値と一致するまでセットされなくなりますので、割り込み処理にはBUF_INTF. BUFnFビット = 1になった機会を見送らないようにする注意が必要です。以下の操作を行い、データを読み出してください。
以下、BUF1の割り込みが発生したものとして説明します。
3.

EVIN_EN.EVIN1CPENビットを0に設定してBUF1へのタイムスタンプキャプチャーを禁止する。(下記注意参照)*
BUF3の割り込みが発生した場合は、EVIN_EN.EVIN3CPENビットだけでなく、
CAP_EN.V***L.CPENビット、CAP_EN.OSCSTPCPENビットを0に設定して、BUF3へのタイムスタ
ンプキャプチャーを禁止します。

4.

レジスターBUF1_STATを読み出して最新タイムスタンプデータのページ番号 (BUF1_STAT.PTR[5:0]ビット) とバッファーフル状態か(BUF1_STAT.FULLFビット) を確認する。また、オーバーライトが発生しているかどうか (BUF_OVWF.BUF1OVWFビット) も確認してください。

5.

BUF1_CFG2.RDENビットを1に設定する。

6.

BUF1_CFG2.RDPAGE[3:0]ビットを0x1に設定する。 (読み出すページを指定)

7.

アドレス0x60 〜 0x69の10バイトをバーストリードして、1回分のタイムスタンプデータを取得する。

(BUF1の読み出しを許可)

各アドレスの内容については図 3.35を参照してください。
* タイムスタンプデータは、必ずアドレス0x60 〜 0x69を連続的に読み出して取得してください。一部のみの読み出しは禁止します。
8.

手順4で確認したバッファーフルの状態に従い、手順7をバッファー内の必要範囲で繰り返す。
<BUF1_STAT.FULLFビット = 0 (バッファーに空きがある場合)>
BUF1_CFG2.RDPAGE[3:0]ビットが手順4で読み込んだページ数に達していなければ、BUF1_CFG2.
RDPAGE[3:0]ビットをインクリメントし、手順7を繰り返します。ページ0x1から読み出したデータが最古のタイムスタンプデータです。
<BUF1_STAT.FULLFビット = 1 (バッファーフルの場合)>
BUF1_CFG2.RDPAGE[3:0]ビットを1 〜 10まで順次インクリメントしながら手順7を繰り返して実行し、一旦、すべてのタイムスタンプデータを読み出します。
手順4で確認したBUF_OVWF.BUF1OVWFビットが0 (オーバーライト未発生) の場合、最新のタイ
ムスタンプデータは、BUF1_CFG2.RDPAGE[3:0]ビット = 10のときに読み出されたデータが該当します。そこからデータを読み出し順に遡ると時系列が古いデータになっていきます。
BUF_OVWF.BUF1OVWFビットが1 (オーバーライト発生) の場合、最新のタイムスタンプデータは、
BUF1_CFG2.RDPAGE[3:0]ビットが手順4で確認したページ番号になった際に読み出されたデータが該当します。そこからデータを読み出し順に遡ると時系列が古いデータになっていきます。バッ
ファーはリングバッファ形式になっていますので、ページ番号は1回目のデータ取得ページ → 10
回目 → 9回目…の順で巡回します。最古のタイムスタンプデータは、BUF1_CFG2.RDPAGE[3:0]
ビットのページ指定が手順4の読み出し結果 + 1になった際の読み出しデータが該当します。

RX4901CE/RX8901CE
ETM63J-02

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60

3

機能

ただし、<手順4の読み出し結果 + 1>ページのデータは、読み出し中にタイムスタンプキャプチャー
が発生した場合は採用できません。読み出し後にBUF1_CFG2.PTR[3:0]ビットがインクリメントされていないかどうかを確認して判断する必要があります。
9.

BUF1_CFG2.RDENビットを0に設定する。

(BUF1の読み出しを禁止)

10. WRCMD_CFG.BUF1FCLRENビットを1に設定し、レジスターWRCMD_TRGに任意の値を書き込む。
(BUF1のフラグとページポインターをクリア)
11. EVIN_EN.EVIN1CPENビットを1に設定してBUF1へのタイムスタンプキャプチャーを許可する。(下記注意参照)
オーバーライトモード時の注意
ダイレクトモードかつオーバーライトモードの場合、同じバッファーの同じページに対するタイム
スタンプデータの読み出しとキャプチャーデータの書き込みが重なる可能性があります。たとえば、
BUFn_STAT.PTR[x:0]ビットが示す次のページ (それが0ページになる場合もあります) を読み出そうとした場合です。手順3と11はこれを回避するため、読み出そうとしているバッファーに対するキャプチャーデータの書き込みを一時的に禁止する操作です。ただし、この間は禁止したイベントを記録できなくなります。

タイムスタンプデータのクリア
バッファーエンプティ状態の設定“コマンドトリガーの発行”で説明したとおり、コマンドトリガーを発行してバッファーのフラグ/ポイン
ターを初期状態に設定可能です。これにより、バッファーをエンプティ状態に設定することができます (ダイレクトモードではBUF個別に設定可能)。
1.

WRCMD_CFG.BUFnFCLRENビットを1に設定する。

(BUFn初期化を指定)

2.

WRCMD_TRG.WRTRG[7:0]ビットに任意の値を書き込む。

(コマンドトリガーの発行)

3.

WRCMD_TRG.WRTRG[7:0]ビットが0x00に戻ったことを確認する。 (コマンド実行完了)

この方法で、SRAMのデータ自体はクリアされませんが、バッファーエンプティ状態になります。

SRAMの0クリア
SRAMを0クリアするには、以下の手順でSRAMモードに設定し、直接0を書き込みます。
1.

レジスターBUF1_CFG2の以下のビットを設定する。
- BUF1_CFG2.SRAMMODビットを1に設定する。
- BUF1_CFG2.RDPAGE[3:0]ビットを0x0に設定する。

(SRAMモードを指定)(ページ0を指定)

2.

アドレス0x60 〜 0x6Fに0x00を書き込む。

(ページをクリア)

3.

BUF1_CFG2.RDPAGE[3:0]ビット = 0xFの場合は終了する。
0xF以外の場合はBUF1_CFG2.RDPAGE[3:0]ビットをインクリメントする。
(次のページを指定)

4.

全ページがクリアされるまで、手順2と3を繰り返す。

5.

BUF1_CFG2.SRAMMODビットを0に設定する。

RX4901CE/RX8901CE
ETM63J-02(SRAMモードを解除)

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61

3

機能

3.10.5 タイムスタンプ (イベント検出) 割り込み
図 3.43にタイムスタンプ割り込み回路の構成を示します。
INTCNT[5:0]

BUF1

比較

BUF1F

比較

BUF2F

比較

BUF3F

PTR[5:0]
INTCNT[3:0]

BUF2

PTR[3:0]
INTCNT[3:0]

BUF3

PTR[3:0]
EVIN1入力イベント

EVIN1F

EVIN1IEN
EVIN2入力イベント

EVIN2F

EVIN2IEN

EVF/INT

EVIN3入力イベント
EVIN3IEN
VBAT電圧低下検出
VBATLIEN
VTMP電圧低下検出
VTMPLIEN
VDD電圧低下検出
VDDLIEN
発振停止検出OSCSTPIEN

EIE

EVIN3FVBATLEVFVTMPLEVFVDDLEVFOSCSTPEVF

図 3.43

タイムスタンプ割り込み回路の構成

タイムスタンプ機能には以下のイベント検出割り込み要因があります。
表 3.18
割り込み要因フラグ
BUF_INTF.BUF1F

割り込み許可ビット

イベント検出割り込み要因と制御ビット
割り込み要因フラグのセット条件

クリア条件

BUF_INTF.BUF3F

BUF1_CFG1.INTCNT[5:0] BUFn内のスタンプデータ数がINTCNT[x:0]ビットの設定値に
BUF2_CFG1.INTCNT[3:0] 一致した場合にセット
BUF3_CFG1.INTCNT[3:0] INTCNT[x:0]ビット = 0x0の場合はセットされない

EVNT_INTF.EVIN1F

EVNT_INTE.EVIN1IEN

EVNT_INTF.EVIN2F

EVNT_INTE.EVIN2IEN

EVNT_INTF.EVIN3F

EVNT_INTE.EVIN3IEN

EVNT_INTF.VBATLEVF

EVNT_INTE.VBATLIEN

VBAT電圧低下が検出されるとセット
VBATLIENビット = 0の場合はセットされない

0書き込みでクリア

EVNT_INTF.VTMPLEVF

EVNT_INTE.VTMPLIEN

VDET2電圧低下が検出されるとセット
VTMPLIENビット = 0の場合はセットされない

0書き込みでクリア

EVNT_INTF.VDDLEVF

EVNT_INTE.VDDLIEN-VDET1電圧低下が検出されるとセット
VDDLIENビット = 0の場合はセットされない

0書き込みでクリア

EVNT_INTF.OSCSTPEVF

EVNT_INTE.OSCSTPIEN 発振停止が検出されるとセット
OSCSTPIENビット = 0の場合はセットされない

BUF_INTF.BUF2F

0書き込みでクリア

EVINn端子からイベントトリガーが入力されると、バッファー 0書き込みでクリアに書き込まれたか否かにかかわらずセット
EVINnIENビット = 0の場合はセットされない

0書き込みでクリア

これらの要因は個別に割り込みの発生を許可/禁止できます。割り込みが許可されている要因が発生すると、割り込み要因フラグがセットされ、これによってINTF.EVFビットが1にセットされます。このとき、TSTP_INTE.EIE
ビット = 1 (割り込み許可) であれば/INT端子がLOWになり、ホストに割り込み要求を出力します。
1にセットされたINTF.EVFビットは、EVFビットへの0書き込みではクリアされません。INTF.EVFビットをクリアするためには、レジスターBUF_INTF、およびEVNT_INTFのフラグのすべてをクリアする必要があります。
INTF.EVFビットがクリアされると、同時に/INT端子がHi-Zになります。
RX4901CE/RX8901CE
ETM63J-02

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62

4

レジスター

4 レジスター
4.1 レジスター一覧
記号の意味
ビット名 = –:書き込み無効で、読み出し値は常に0です。
ビット名 = ×:
書き込み無効で、読み出し値は不定です。
ビット名 = (GP): 汎用ビットで0と1の書き込み/読み出しが可能です。
注: • アドレス値は {バンク番号, バンク内アドレス} です (例: 0x0F = バンク0, アドレス0xF)。
• レジスターへのアクセスは8ビット単位で行います。
• レジスターテーブルに記載のアドレス以外には書き込み/読み出しを行わないでください。
• 電源投入時またはバックアップからの復帰時にINTF.VLFビット = 1のときは､ 必ずすべてのレジスターを初期化してください。

Bank 0Address
0x00
0x01
0x02
0x03
0x04
0x05
0x06
0x07
0x08
0x09
0x0A
0x0B
0x0C
0x0D
0x0E
0x0F

Register name (function)
SEC(Second Data)
MIN(Minute Data)
HOUR(Hour Data)WEEKDAY(Day-of-Week Data)
DAY(Day Data)
MONTH(Month Data)
YEAR(Year Data)
ALM_MIN(Minute Alarm)
ALM_HOUR(Hour Alarm)
ALM_WEEKDAY(Day-of-Week Alarm / Day Alarm)
WTCNT_L(Wakeup Timer Counter Low)
WTCNT_M(Wakeup Timer Counter Middle)
WTCNT_H(Wakeup Timer Counter High)TCTL(Timer Control)
INTF(Status Flag)
TSTP_INTE(Timer Stop and Interrupt Enable)

Bit 7

Bit 6

Bit 5

Bit 4

Bit 2

Bit 1

SEC_H[2:0]

SEC_L[3:0]–

MIN_H[2:0]

MIN_L[3:0]––

HOUR_H[1:0]

Bit 0

HOUR_L[3:0]–

WEEK[6:0]

–

–

–

–

DAY_H[1:0]–

DAY_L[3:0]

MONTH_H

MONTH_L[3:0]

YEAR_H[3:0]
XMAE
XHAE
XWAE

YEAR_L[3:0]

MALM_H[2:0](GP)

MALM_L[3:0]

HALM_H[1:0]

HALM_L[3:0]
WKALM[6:0](GP)

DALM_H[1:0]

DALM_L[3:0]
WTCNT[7:0]
WTCNT[15:8]
WTCNT[23:16]

FSEL[1:0]
PORF

OSCSTPFCSEL[1:0]

USEL0

TE

WADA

–

UF

TF

AF

EVF

VLF

VTMPLF

UIE

TIE

AIE

EIE

–

STOP

RX4901CE/RX8901CE
ETM63J-02

Bit 3

–

TSEL[1:0]

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63

4

レジスター

Bank 1
Address
0x10
0x11
0x12
0x13
0x14
0x15
0x16
0x17
0x18

Register name (function)
SUBSEC_L(Sub-Second Data Low)
SUBSEC_H(Sub-Second Data High)SEC_MIR(Mirrored Second Data, = 0x00)
MIN_MIR(Mirrored Minute Data, = 0x01)
HOUR_MIR(Mirrored Hour Data, = 0x02)
WEEKDAY_MIR(Mirrored Day-of-Week Data, = 0x03)
DAY_MIR(Mirrored Day Data, = 0x04)
MONTH_MIR(Mirrored Mont Data, = 0x05)
YEAR_MIR(Mirrored Year Data, = 0x06)

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

–

–

–

–

–

–

SUBSEC[1:0]

SUBSEC[9:2]–

SEC_H[2:0]

SEC_L[3:0]–

MIN_H[2:0]

MIN_L[3:0]––

HOUR_H[1:0]

HOUR_L[3:0]–

WEEK[6:0]

–

–

–

–

DAY_H[1:0]–

DAY_L[3:0]

MONTH_H

MONTH_L[3:0]

YEAR_H[3:0]

YEAR_L[3:0]Bank 2
Address
0x20
0x21
0x22
0x23
0x24
0x25
0x26
0x27
0x28
0x29
0x2A
0x2B
0x2C
0x2D
0x2E
0x2F

Register name (function)
EVIN_EN(Event Input Enable)
EVIN1_CFG(EVIN1 Configuration)
EVIN1_FLT(EVIN1 Noise Filter)
EVIN2_CFG(EVIN2 Configuration)
EVIN2_FLT(EVIN2 Noise Filter)
EVIN3_CFG(EVIN3 Configuration)
EVIN3_FLT(EVIN3 Noise Filter)
BUF1_CFG1(BUF1 Configuration 1)
BUF1_STAT(BUF1 Status)
BUF1_CFG2(BUF1 Configuration 2)
BUF2_CFG1(BUF2 Configuration 1)
BUF2_STAT(BUF2 Status)
BUF2_CFG2(BUF2 Configuration 2)
BUF3_CFG1(BUF3 Configuration 1)
BUF3_STAT(BUF3 Status)
BUF3_CFG2(BUF3 Configuration 2)

Bit 7

Bit 6

Bit 5

Bit 4

–

DIRMOD

–

–

–

–

–

–

–

–

–

–

–

–

FLT[5:0]–OVWEN

INTCNT[5:0]

FULLF

EMPTF

PTR[5:0]

RDEN

SRAMMOD––

RDPAGE[3:0]

–

OVWEN

–

–

INTCNT[3:0]

FULLF

EMPTF

–

–

PTR[3:0]

RDEN

–

–

–

RDPAGE[3:0]

–

OVWEN

–

–

INTCNT[3:0]

FULLF

EMPTF

–

–

PTR[3:0]

RDEN

–

–

–

RDPAGE[3:0]

EVIN3CPEN EVIN2CPEN EVIN1CPEN
–

Bit 2

Bit 1

Bit 0

EVIN3EN

EVIN2EN

EVIN1EN

PUPD[2:0]

POL[1:0]

FLT[5:0]–

PUPD[2:0]

POL[1:0]

FLT[5:0]–

PUPD[2:0]

RX4901CE/RX8901CE
ETM63J-02

Bit 3

POL[1:0]Jump to Top / Bottom

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64

4

レジスター

Bank 3
Address
0x30
0x31
0x32
0x33
0x34
0x37
0x38
0x39
0x3A

0x3B

0x3C

Register name (function)

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

ALM_SEC(Second Alarm)
ALM_MIN_MIR(Mirrored Minute Alarm, = 0x07)
ALM_HOUR_MIR(Mirrored our Alarm, = 0x08)

XSAE

SALM_H[2:0]

SALM_L[3:0]

XMAE

MALM_H[2:0]

MALM_L[3:0]

ALM_WEEKDAY_MIR(Mirrored Day-of-Week Alarm / Day
Alarm, = 0x09)

XWAE

UPDISEL(Time Update Interrupt Select)
PWSW_CFG(Power Switch Configuration)
WTICFG(Wakeup Timer Interrupt
Configuration)
WTCTL(Wakeup Timer Control)
WTCNT_L_MIR(Mirrored Wakeup Timer Counter
Low, = 0x0A)
WTCNT_M_MIR(Mirrored Wakeup Timer Counter
Middle, = 0x0B)
WTCNT_H_MIR(Mirrored Wakeup Timer Counter
High, = 0x0C)

XHAE

–

(GP)

HALM_H[1:0](GP)

DALM_H[1:0]

Bit 0

XHAE
WKALM[6:0]
DALM_L[3:0]

–

–

–

CHGEN

INIEN

VBATLDET
BK

VBATLDETEN–

FOEMUX

EVIN3MUX–WTONETIM

WTRST

–

–

–

–
SWSEL[1:0]

–

USEL1

–

VDDSAMP[1:0]–

WTMODSEL WTSTOPCTLWTIOUT––WTSTOPWTCNT[7:0]

WTCNT[15:8]

WTCNT[23:16]

Bank 4Address
0x41
0x42
0x43
0x44
0x46
0x47
0x4E
0x4F

Register name (function)

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

WRCMD_CFG(Write Command Configuration)
WRCMD_TRG(Write Command Trigger)
EVNT_INTE(Event Interrupt Enable)
CAP_EN(Capture Enable)
BUF_INTF(Buffer Interrupt Factor)
EVNT_INTF(Event Interrupt Factor)
BUF_FULLF(Buffer Full Flag)
BUF_OVWF(Buffer Overwrite Flag)

EVCNT
CLREN

BUF3F
CLREN

BUF2F
CLREN

BUF1F
CLREN

–

–

–

CMDTRGENVTMPLIENVDDLIENOSCSTPIENWRTRG[7:0]
EVIN3IEN

EVIN2IEN

EVIN1IEN–VBATLIEN

–

–

–

–

VBATLCPEN VTMPLCPEN VDDLCPEN

BUF3F

BUF2F

BUF1F

–

VBATLF

–

VDDLF

–

EVIN3F

EVIN2F

EVIN1F–VBATLEVFVTMPLEVFVDDLEVFOSCSTPEVF

OSCSTPCPEN–

BUF3FULLF BUF2FULLF BUF1FULLF

–

–

–

–

–

BUF3OVWF BUF2OVWF BUF1OVWF

–

–

–

–

Bit 3

Bit 2

Bit 1

Bit 0

–

–

Bank 5Address
0x51
0x52
0x53
0x54

Register name (function)
EVIN1_EVCNT(EVIN1 Event Counter)
EVIN2_EVCNT(EVIN2 Event Counter)
EVIN3_EVCNT(EVIN3 Event Counter)
EVINMON(EVIN Monitor)

Bit 7

Bit 6

Bit 5

–

–

EVCNT[5:0]––

EVCNT[5:0]––

EVCNT[5:0]

EVIN3MON

EVIN2MON

EVIN1MON

Bit 4–

RX4901CE/RX8901CE
ETM63J-02––

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65

4

レジスター

Bank 6 (FIFOモードでのタイムスタンプデータ読み出し時)
Address
0x60
0x61
0x62
0x63
0x64
0x65
0x66
0x67
0x68
0x69

Register name (function)
TIMESTAMP_SUBSEC_L(SUBSEC Time Stamp Data Low)TIMESTAMP_SUBSEC_H(SUBSEC Time Stamp Data High)TIMESTAMP_SEC(SEC Time Stamp Data)
TIMESTAMP_MIN(MIN Time Stamp Data)
TIMESTAMP_HOUR(HOUR Time Stamp Data)
TIMESTAMP_DAY(DAY Time Stamp Data)
TIMESTAMP_MONTH(MONTH Time Stamp Data)
TIMESTAMP_YEAR(YEAR Time Stamp Data)
TIMESTAMP_EVSTAT(Event Status Time Stamp Data)
TIMESTAMP_TRG(Time Stamp Trigger Factor)

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

×

×

×

×

×

×

SUBSEC[1:0]

SUBSEC[9:2]×SEC_H[2:0]

SEC_L[3:0]×MIN_H[2:0]

MIN_L[3:0]××

HOUR_H[1:0]

HOUR_L[3:0]××

DAY_H[1:0]

DAY_L[3:0]

×

×

×

MONTH_H

MONTH_L[3:0]

YEAR_H[3:0]

YEAR_L[3:0]

EVIN3POL

EVIN2POL

EVIN1POL

EVIN3TRG

EVIN2TRG

EVIN1TRG

×

VDDLSTATOSCSTPSTATVTMPLTRGVDDLTRG

OSCSTPTRGVBATLSTAT VTMPLSTATWRCMDTRG VBATLTRG

Bank 6 (ダイレクトモードでのタイムスタンプデータ読み出し時)
Address
0x60
0x61
0x62
0x63
0x64
0x65
0x66
0x67
0x68
0x69

Register name (function)
TIMESTAMP_SUBSEC_L(SUBSEC Time Stamp Data Low)TIMESTAMP_SUBSEC_H(SUBSEC Time Stamp Data High)TIMESTAMP_SEC(SEC Time Stamp Data)
TIMESTAMP_MIN(MIN Time Stamp Data)
TIMESTAMP_HOUR(HOUR Time Stamp Data)
TIMESTAMP_DAY(DAY Time Stamp Data)
TIMESTAMP_MONTH(MONTH Time Stamp Data)
TIMESTAMP_YEAR(YEAR Time Stamp Data)
TIMESTAMP_EVSTAT(Event Status Time Stamp Data)
TIMESTAMP_TRG(Time Stamp Trigger Factor)

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

×

×

×

×

×

×

SUBSEC[1:0]

SUBSEC[9:2]×SEC_H[2:0]

SEC_L[3:0]×MIN_H[2:0]

MIN_L[3:0]××

HOUR_H[1:0]

HOUR_L[3:0]××

DAY_H[1:0]

DAY_L[3:0]

×

×

×

MONTH_H

MONTH_L[3:0]

YEAR_H[3:0]

YEAR_L[3:0]

EVIN3POL

EVIN2POL

EVIN1POL

×

×

×

×

Bit 7

Bit 6

Bit 5

Bit 4

Bit 7

Bit 6

Bit 5

Bit 4

VDDLSTATOSCSTPSTATVTMPLTRGVDDLTRG

OSCSTPTRG

Bit 3

Bit 2

Bit 1

Bit 0

Bit 3

Bit 2

Bit 1

Bit 0

VBATLSTAT VTMPLSTATWRCMDTRG VBATLTRG

Bank 6 (SRAMモード)
Address
Function
0x60 SRAM Page N Address 0x00x61 SRAM Page N Address 0x1
0x62 SRAM Page N Address 0x2
0x63 SRAM Page N Address 0x3
0x64 SRAM Page N Address 0x4
0x65 SRAM Page N Address 0x5
0x66 SRAM Page N Address 0x6
0x67 SRAM Page N Address 0x7
0x68 SRAM Page N Address 0x8
0x69 SRAM Page N Address 0x9
0x6A SRAM Page N Address 0xA
0x6B SRAM Page N Address 0xB
0x6C SRAM Page N Address 0xC
0x6D SRAM Page N Address 0xD
0x6E SRAM Page N Address 0xE
0x6F SRAM Page N Address 0xF

RX4901CE/RX8901CE
ETM63J-02

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66

4

レジスター

4.2 レジスター詳細説明※ Initial valueの“x”は初期値が不定であることを示します。

0x00: SEC (Second Data)
Bit No.

Bit 7

Bit name–

Initial value

0

R/W

R

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

SEC_H[2:0]
x

Bit 1

Bit 0

x

x

SEC_L[3:0]

x

x

x

x

R/W

R/W

Bits 6–4: SEC_H[2:0]
Bits 3–0: SEC_L[3:0]秒カウンターの設定と読み出しを行います。
SEC_H[2:0]ビットは10秒桁のBCDコード (0–5)、SEC_L[3:0]ビットは1秒桁のBCDコード (0–9) です。
このアドレスへの秒データの書き込みにより、1/1024秒カウンターがリセットされ、レジスター
SUBSEC_LおよびSUBSEC_Hが0にクリアされます。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

0x01: MIN (Minute Data)
Bit No.

Bit 7

Bit name–

Initial value

0

R/W

R

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

MIN_H[2:0]
x

Bit 1

Bit 0

x

x

MIN_L[3:0]

x

x

x

x

R/W

R/W

Bits 6–4: MIN_H[2:0]
Bits 3–0: MIN_L[3:0]
分カウンターの設定と読み出しを行います。
MIN_H[2:0]ビットは10分桁のBCDコード (0–5)、MIN_L[3:0]ビットは1分桁のBCDコード (0–9) です。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

0x02: HOUR (Hour Data)
Bit No.

Bit 7

Bit 6

Bit name––

Initial value

0

0

R/W

R

R

Bit 5

Bit 4

Bit 3

Bit 2

HOUR_H[1:0]
x

Bit 1

Bit 0

x

x

HOUR_L[3:0]
x

x

x

R/W

R/W

Bits 5–4: HOUR_H[1:0]
Bits 3–0: HOUR_L[3:0]時カウンターの設定と読み出しを行います。
HOUR_H[1:0]ビットは10時桁のBCDコード (0–2)、HOUR_L[3:0]ビットは1時桁のBCDコード (0–9)
です。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

0x03: WEEKDAY (Day-of-Week Data)
Bit No.

Bit 7

Bit name–

Initial value

0

R/W

R

Bit 6

Bit 5

Bit 4

Bit 3

x

x

x

Bit 1

Bit 0

x

x

x

x

R/W

RX4901CE/RX8901CE
ETM63J-02

Bit 2

WEEK[6:0]

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4

レジスター

Bits 6–0: WEEK[6:0]
曜日カウンターの設定と読み出しを行います。
WEEK[6:0]ビットの各ビットは下記の例のように曜日に1対1に対応しますので、今日の曜日に対応する1ビットのみセットしておきます。日カウンターが更新されると同時に各ビットは左にシフトします (ビット6はビット0にシフトします)。
曜日設定例
WEEK6
WEEK5
WEEK4
WEEK3
WEEK2
WEEK1
WEEK0
土曜日 (0x40) 金曜日 (0x20) 木曜日 (0x10) 水曜日 (0x08) 火曜日 (0x04) 月曜日 (0x02) 日曜日 (0x01)*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

0x04: DAY (Day Data)
Bit No.

Bit 7

Bit 6

Bit name––

Initial value

0

0

R/W

R

R

Bit 5

Bit 4

Bit 3

Bit 2

DAY_H[1:0]
x

Bit 1

Bit 0

x

x

DAY_L[3:0]
x

x

x

R/W

R/W

Bits 5–4: DAY_H[1:0]
Bits 3–0: DAY_L[3:0]
日カウンターの設定と読み出しを行います。
DAY_H[1:0]ビットは10日桁のBCDコード (0–3)、DAY_L[3:0]ビットは1日桁のBCDコード (0–9)です。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

*2

うるう年の動作については、3.2節内の“うるう年の判定”を参照してください。

0x05: MONTH (Month Data)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name–––

MONTH_H

Initial value

0

0

0

x

R/W

R

R

R

R/W

Bit 3

Bit 2

Bit 1

Bit 0

MONTH_L[3:0]
x

x

x

x

R/W

Bit 4:MONTH_H
Bits 3–0: MONTH_L[3:0]
月カウンターの設定と読み出しを行います。
MONTH_Hビットは10月桁のBCDコード (0–1)、MONTH_L[3:0]ビットは1月桁のBCDコード (0–9)です。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

0x06: YEAR (Year Data)
Bit No.

Bit 7

Bit 6

Bit name

Bit 5

Bit 4

Bit 3

Bit 2

YEAR_H[3:0]

Initial value

x

R/W

x

Bit 1

Bit 0

x

x

YEAR_L[3:0]
x

x

x

R/W

x
R/W

Bits 7–4: YEAR_H[3:0]
Bits 3–0: YEAR_L[3:0]
年カウンターの設定と読み出しを行います。
YEAR_H[3:0]ビットは10年桁のBCDコード (0–9)、YEAR_L[3:0]ビットは1年桁のBCDコード (0–9)です。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

RX4901CE/RX8901CE
ETM63J-02

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68

4

レジスター

0x07: ALM_MIN (Minute Alarm)
Bit No.

Bit 7

Bit name

XMAE

Initial value

1

R/W

Bit 6

Bit 5

x

R/W

Bit 7:

Bit 4

Bit 3

Bit 2

MALM_H[2:0]

Bit 1

Bit 0

x

x

MALM_L[3:0]

x

x

x

x

R/W

R/W

XMAE
このビットは分アラームの設定を有効/無効にします。
1 (R/W): 分アラーム無効
0 (R/W): 分アラーム有効1に設定すると本レジスターの設定が無効となり、分カウンターの内容はアラームの発生に影響を与えません。
0に設定すると本レジスターの設定が有効となり、分カウンターの値とMALM_H[2:0]/MALM_L[3:0]
ビット設定値の一致がアラーム発生条件となります。

Bits 6–4: MALM_H[2:0]
Bits 3–0: MALM_L[3:0]
アラームの分条件をBCDコードで設定します。
MALM_H[2:0]ビットでアラームの10分桁 (0–5)を、MALM_L[3:0]ビットで1分桁 (0–9)を設定します。
*1

アラーム機能の詳細については、“3.5 アラーム機能”を参照してください。

*2

アラーム機能を使用しない場合、本レジスターをリード/ライト可能な汎用レジスターとして使用することができます。ただし、不要な割り込みが発生することのないように、TSTP_INTE.AIEビットを0 (アラーム割り込みディスエーブル) に設定してください。

0x08: ALM_HOUR (Hour Alarm)
Bit No.

Bit 7

Bit 6

Bit name

XHAE

(GP)

Initial value
R/W

Bit 7:

1

x

R/W

R/W

Bit 5

Bit 4

Bit 3

Bit 2

HALM_H[1:0]
x

Bit 1

Bit 0

x

x

HALM_L[3:0]
x

x

x

R/W

R/W

XHAE
このビットは時アラームの設定を有効/無効にします。
1 (R/W): 時アラーム無効
0 (R/W): 時アラーム有効1に設定すると本レジスターの設定が無効となり、時カウンターの内容はアラームの発生に影響を与えません。
0に設定すると本レジスターの設定が有効となり、時カウンターの値とHALM_H[1:0]/HALM_L[3:0]
ビット設定値の一致がアラーム発生条件となります。

Bits 5–4: HALM_H[1:0]
Bits 3–0: HALM_L[3:0]
アラームの時条件をBCDコードで設定します。
HALM_H[1:0]ビットでアラームの10時桁 (0–2) を、HALM_L[3:0]ビットで1時桁 (0–9) を設定します。
*1

アラーム機能の詳細については、“3.5 アラーム機能”を参照してください。

*2

アラーム機能を使用しない場合、本レジスターをリード/ライト可能な汎用レジスターとして使用することができます。ただし、不要な割り込みが発生することのないように、TSTP_INTE.AIEビットを0 (アラーム割り込みディスエーブル) に設定してください。

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69

4

レジスター

0x09: ALM_WEEKDAY (Day-of-Week Alarm / Day Alarm)
Day-of-Week Alarm
Bit No.

Bit 7

Bit name

XWAE

Initial value

1

R/W

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

Bit 1

Bit 0

x

x

WKALM[6:0]
x

x

x

R/W

x
R/W

Day Alarm
Bit No.

Bit 7

Bit 6

Bit name

XWAE

(GP)

Initial value
R/W

1

x

R/W

R/W

Bit 5

Bit 4

Bit 3

Bit 2

DALM_H[1:0]xDALM_L[3:0]
x

x

x

R/W

R/W

注: 本レジスターはTCTL.WADAビットの設定により、機能が切り替わります。
TCTL.WADAビット = 0: Day-of-Week Alarm
TCTL.WADAビット = 1: Day Alarm

Bit 7:

XWAE
このビットは曜日/日アラームの設定を有効/無効にします。
1 (R/W): 曜日/日アラーム無効
0 (R/W): 曜日/日アラーム有効1に設定すると本レジスターの設定が無効となり、曜日および日カウンターの内容はアラームの発生に影響を与えません。
0に設定すると本レジスターの設定が有効となり、次の条件でアラームが発生します。
TCTL.WADAビット = 0: 曜日カウンターとWKALM[6:0]の同一ビットが共にセット
TCTL.WADAビット = 1: 日カウンターの値とDALM_H[1:0]/DALM_L[3:0]ビット設定値の一致

Bits 6–0: WKALM[6:0] (Day-of-Week Alarm)
アラームの曜日条件を設定します。
複数のビットを1にセットして、複数の曜日を指定可能です。
Bits 5–4: DALM_H[1:0] (Day Alarm)
Bits 3–0: DALM_L[3:0] (Day Alarm)
アラームの日条件をBCDコードで設定します。
DALM_H[1:0]ビットでアラームの10日桁 (0–3) を、DALM_L[3:0]ビットで1日桁 (0–9) を設定します。
*1

アラーム機能の詳細については、“3.5 アラーム機能”を参照してください。

*2

アラーム機能を使用しない場合、本レジスターをリード/ライト可能な汎用レジスターとして使用することができます。ただし、不要な割り込みが発生することのないように、TSTP_INTE.AIEビットを0 (アラーム割り込みディスエーブル) に設定してください。

RX4901CE/RX8901CE
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70

4

レジスター

0x0A: WTCNT_L (Wakeup Timer Counter Low)
0x0B: WTCNT_M (Wakeup Timer Counter Middle)
0x0C: WTCNT_H (Wakeup Timer Counter High)Wakeup Timer Counter Low
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

x

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

x

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

WTCNT[7:0]

Initial value

x

x

x

x

R/W

R/W

Wakeup Timer Counter Middle
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

WTCNT[15:8]

Initial value

x

x

x

x

R/W

R/W

Wakeup Timer Counter HighBit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

WTCNT[23:16]

Initial value

x

x

x

x

R/W

x
R/W

Bits 7–0: WTCNT[7:0](Wakeup Timer Counter Low)
WTCNT[15:8] (Wakeup Timer Counter Middle)
WTCNT[23:16] (Wakeup Timer Counter High)
書き込み時
ウェイクアップタイマーカウンターのプリセット値を設定します。プリセット値は1 〜 16777215の範囲で指定可能で、カウント周期を設定します。0x000000を書き込んだ場合は、0x000001に設定されます。アップカウント中にカウンターがプリセット値を超えると、初期値 (1) がカウンターにセットされます。
注: プリセット値は、TCTL.TEビット = 0 (ウェイクアップタイマーディスエーブル) の状態で設定してください。

読み出し時
TCTL.TEビット = 1 (ウェイクアップタイマーイネーブル) の場合、現在のカウンター値が読み出されます。
TCTL.TEビット = 0 (ウェイクアップタイマーディスエーブル) の場合、現在設定されているプリセット値が読み出されます。
注: カウンター値の読み出しは、ウェイクアップタイマーが動作中でも可能です。ただし、3つのレジスターを読み出す間にカウンター値が変化し、現在の正しい値を読み出せない可能性があります。連続して読み出しを行い、2回続けて同じ値だった場合に正しく読み出せたものとしてください。

*1 ウェイクアップタイマー機能の詳細については、“3.6 ウェイクアップタイマー機能”を参照してください。
*2 ウェイクアップタイマー機能を使用しない場合 (TCTL.TEビットとTSTP_INTE.TIEビットが共に0の場合)、
これらのレジスターをリード/ライト可能な汎用レジスターとして使用することができます。

0x0D: TCTL (Timer Control)
Bit No.

Bit 7

Bit name

Bit 6
FSEL[1:0]

Initial value

0

R/W

0
R/W

Bit 5

Bit 4

Bit 3

Bit 2

USEL0

TE

WADA

–

0

0

0

0

R/W

R/W

R/W

R

Bit 1

Bit 0
TSEL[1:0]

1

0
R/W

Bits 7–6: FSEL[1:0]
これらのビットは、FOUT出力周波数を選択します。

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4
表 4.1

Bit 5:

レジスター

FOUT出力の選択

TCTL.FSEL[1:0]

出力クロック

0b00
0b01
0b10
0b11

32.768 kHz (デフォルト)
1024 Hz
1 Hz
OFF

USEL0
このビットは、UPDISEL.USEL1ビットと共に時刻更新割り込みイベントの種類を選択します。
表 4.2

Bit 4:

時刻更新割り込みイベントの選択

UPDISEL.USEL1

TCTL.USEL0

割り込みイベント

0
0
1
1

0
1
0
1

秒カウンター更新 (デフォルト)
分カウンター更新
時カウンター更新
割り込みイベントなし

TE
このビットは、ウェイクアップタイマーの動作を許可/禁止します。
1 (R/W): ウェイクアップタイマーイネーブル
0 (R/W): ウェイクアップタイマーディスエーブル

Bit 3:

WADA
このビットは、アラーム発生条件の中で、曜日アラームと日アラームのどちらを使用するか選択します。
1 (R/W): 日アラーム
0 (R/W): 曜日アラーム

Bits 1–0: TSEL[1:0]
これらのビットは、ウェイクアップタイマーのソースクロックを選択します。
表 4.3

ウェイクアップタイマーソースクロックの選択

TCTL.TSEL[1:0]

ソースクロック

0b00
0b01
0b10
0b11

1024 Hz
64 Hz
1 Hz (デフォルト)
1/60 Hz*1

FOUT出力機能の詳細については、“3.7 FOUT出力機能”を参照してください。

*2

時刻更新割り込みの詳細については、“3.4 時刻更新割り込み機能”を参照してください。

*3 ウェイクアップタイマー機能の詳細については、“3.6 ウェイクアップタイマー機能”を参照してください。
*4

アラーム機能の詳細については、“3.5 アラーム機能”を参照してください。

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4

レジスター

0x0E: INTF (Status Flag)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

PORF

OSCSTPF

UF

TF

AF

EVF

VLF

VTMPLF

Initial value
R/W

Bit 7:

1

1

x

0

x

0

1

1

R/W

R/W

R/W

R/W

R/W

R/W

R

R/W

PORF
このビットは、電源投入後にパワーオンリセットが実行されたか否かを示す自己監視フラグです。
1 (R):
0 (R):
1 (W):
0 (W):

Bit 6:

パワーオンリセット検出
パワーオンリセット未検出
無効フラグをクリア(パワーオンリセットの解除時のみ有効)

OSCSTPF
このビットは、水晶発振器が発振を停止しているか否かを示す自己監視フラグです。
1 (R):
0 (R):
1 (W):
0 (W):

Bit 5:
Bit 4:
Bit 3:
Bit 2:

発振停止検出 (10 ms以上の発振停止検出によりセット)
発振停止未検出無効
フラグをクリア (発振停止の未検出時のみ有効)

UF
TF
AF
EVF
これらのビットは、RTC割り込みイベントが発生したことを示す割り込みフラグです。
1 (R):
0 (R):
1 (W):
0 (W):

割り込みイベント発生
割り込みイベント未発生
無効
フラグをクリア (EVFを除く)各ビットと割り込みイベントの対応は以下のとおりです。
UF: 時刻更新割り込み
TF: ウェイクアップタイマー割り込み
AF: アラーム割り込み
EVF: タイムスタンプイベント検出割り込み
ウェイクアップタイマー (TF)、時刻更新割り込み (UF) およびアラーム (AF) 割り込みでは、0の書
き込みによりフラグをクリアすると、/INT出力 (LOW) もインアクティブ (Hi-Z) になります。
ウェイクアップタイマーおよび時刻更新による/INTのLOW出力は、割り込みイベント発生から規定
時間後に自動的に解除されます。ただし、これらの割り込みフラグ (TF、UF) は自動クリアされません。
イベント検出およびタイムスタンプ機能には割り込みを発生させる各種のイベントが存在し、それぞ れ の イ ベ ン ト が 発 生し た 際 に セ ッ ト さ れ る 割 り 込 み フ ラ グ が レ ジス タ ー BUF_INTF およ び
EVNT_INTFに割り付けられています。EVFビットは、これらの割り込みフラグの1つまたは複数がセットされると同時に1になります。また、EVFビットはレジスターBUF_INTFおよびEVNT_INTFのフラグがすべてクリアされることにより0になります (EVFビットへの0書き込みではクリアされません)。このクリア操作により、/INT出力もインアクティブになります。

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4
Bit 1:

レジスター

VLF
このビットは、RTCの異常を示す自己監視フラグです。
1 (R):
0 (R):
1 (W):
0 (W):

Bit 0:

異常あり (PORFビット = 1またはOSCSTPFビット = 1)
異常なし
無効
フラグをクリア (パワーオンリセットの解除時、かつ発振停止の未検出時のみ有効)

VTMPLF
このビットは、VOUT電圧 (VDDまたはVBAT) が温度補償更新停止電圧を下回った履歴 (≦ VDET2) を示す自己監視フラグです。
1 (R):
0 (R):
1 (W):
0 (W):

電圧低下検出 (VDD or VBAT ≦ VDET2、温度補償更新停止)
電圧低下未検出無効
フラグをクリア (電圧正常時のみ有効)*1

自己監視機能の詳細については、“3.8 自己監視機能”を参照してください。

*2

各割り込みの詳細については、“3.4 時刻更新割り込み機能”、“3.6 ウェイクアップタイマー機能”、“3.5アラーム機能”、あるいは“3.10 タイムスタンプ機能”を参照してください。

0x0F: TSTP_INTE (Timer Stop and Interrupt Enable)
Bit No.

Bit 7

Bit name

Bit 6
CSEL[1:0]

Initial value

0

1

R/W

R/W

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

UIE

TIE

AIE

EIE

–

STOP

0

0

0

0

0

0

R/W

R/W

R/W

R/W

R

R/W

Bits 7–6: CSEL[1:0]
これらのビットは、温度センサー測定動作の実行間隔を設定します。
表 4.4

Bit 5:
Bit 4:
Bit 3:
Bit 2:

温度センサー測定動作の実行間隔

TSTP_INTE.CSEL[1:0]

実行間隔

0b00
0b01
0b10
0b11

0.5秒
2秒 (デフォルト)
10秒
30秒

UIE
TIE
AIE
EIE
これらのビットはRTC割り込みを許可します。
1 (W):
0 (W):

割り込みを許可
割り込みを禁止 (割り込み信号を解除注)

注: 全割り込みソースからの割り込み信号はNORされた後に/INT端子から出力されます。したがって、1つの割り込み信号を解除しても/INT信号がインアクティブになるとは限りません。

各ビットと割り込みの対応は以下のとおりです。
UIE:
TIE:
AIE:
EIE:

時刻更新割り込み
ウェイクアップタイマー割り込み
アラーム割り込み
タイムスタンプイベント検出割り込み

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4
Bit 0:

レジスター

STOP
カウンターの動作を制御します。
1 (W):
0 (W):
1 (R):
0 (R):

カウンターの動作を停止します。
カウンターの動作を開始します。
カウンター停止中
カウンター動作中

STOPビットで停止する動作は以下のとおりです。
1) 1/1024秒、秒、分、時、日、曜日、月、年カウンターの更新動作
これに伴い、時刻更新割り込み、アラーム割り込みも発生しません。
タイムスタンプの時刻データは停止した時刻になります。
2) ウェイクアップタイマー割り込み
ウェイクアップタイマーは機能を停止し、割り込みは発生しません。
3) FOUT出力
1 Hz選択時は出力がHまたはLに固定されます。
32.768 kHzまたは1024 Hzを選択している場合は、STOPビット = 1でも出力を継続します。
注: 時刻/カレンダーデータ読み出し時にSTOPビットでタイマーを停止させると、計時誤差が増大します。時刻/カレンダーデータ読み出し時は、STOPビットでカウンターを停止させないでください。

*1

温度補償動作については、“3.3 温度補償機能”を参照してください。

*2

各割り込みの詳細については、“3.4 時刻更新割り込み機能”、“3.6 ウェイクアップタイマー機能”、“3.5アラーム機能”、あるいは“3.10 タイムスタンプ機能”を参照してください。

0x10: SUBSEC_L (Sub-Second Data Low)
0x11: SUBSEC_H (Sub-Second Data High)Sub-Second Data Low
Bit No.

Bit 7

Bit name

Bit 6
SUBSEC[1:0]

Initial value
R/W

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

–

–

–

–

–

–

x

x

0

0

0

0

0

0

R/W

R/W

R

R

R

R

R

R

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

x

Sub-Second Data HighBit No.

Bit 7

Bit name

SUBSEC[9:2]

Initial value

x

x

x

x

R/W

R/W

Bits 7–6: SUBSEC[1:0] (Sub-Second Data Low)
Bits 7–0: SUBSEC[9:2] (Sub-Second Data High)1/1024秒カウンターの設定と読み出しを行います。このカウンターは10ビットのバイナリカウンターです。
SUBSEC_L.SUBSEC[1:0]ビットは1/1024秒カウンターの下位2ビット、SUBSEC_H.SUBSEC[9:2]ビッ
トは1/1024秒カウンターの上位8ビットです。
表 4.5
SUBSEC9 SUBSEC8

ビット
カウント値
(1024 Hz 周期)

512

256

SUBSEC[9:0]ビット

SUBSEC7

SUBSEC6SUBSEC5SUBSEC4SUBSEC3

128

64

32

16

8

SUBSEC2 SUBSEC1
4

2

SUBSEC01

データを取得する場合はこの2つのアドレスを連続して読み出してください。カウンター値を変更する場合も、2つのアドレスに連続して書き込んでください。これらのアドレスに続けてアドレス0x12〜 0x18をアクセスすることにより、時計/カレンダーカウンターデータの読み出し/書き込みも連続して行えます。

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75

4

レジスター

また、レジスターSEC (アドレス0x00) にデータを書き込むと、1/1024秒カウンターがリセットされ、レジスターSUBSEC_LとSUBSEC_Hは0になります。一方、レジスターSECのミラーアドレスである
レジスターSEC_MIR (アドレス0x12) へのデータ書き込みでは、1/1024秒カウンターがリセットされません。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

0x12: SEC_MIR (Mirrored Second Data, = 0x00)
Bit No.

Bit 7

Bit name–

Initial value

0

R/W

R

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

SEC_H[2:0]
x

Bit 1

Bit 0

x

x

SEC_L[3:0]

x

x

x

x

R/W

R/W

レジスターSECのミラーです。詳細は“0x00: SEC (Second Data)”を参照してください。ただし、このアドレスへの書き込みでは、1/1024秒カウンターはリセットされません。

0x13: MIN_MIR (Mirrored Minute Data, = 0x01)
Bit No.

Bit 7

Bit name–

Initial value

0

R/W

R

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

MIN_H[2:0]
x

Bit 1

Bit 0

x

x

MIN_L[3:0]

x

x

x

x

R/W

R/W

レジスターMINのミラーです。詳細は“0x01: MIN (Minute Data)”を参照してください。

0x14: HOUR_MIR (Mirrored Hour Data, = 0x02)
Bit No.

Bit 7

Bit 6

Bit name––

Initial value

0

0

R/W

R

R

Bit 5

Bit 4

Bit 3

Bit 2

HOUR_H[1:0]

Bit 1

Bit 0

x

x

HOUR_L[3:0]

x

x

x

x

R/W

R/W

レジスターHOURのミラーです。詳細は“0x02: HOUR (Hour Data)”を参照してください。

0x15: WEEKDAY_MIR (Mirrored Day-of-Week Data, = 0x03)
Bit No.

Bit 7

Bit name–

Initial value

0

R/W

R

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

WEEK[6:0]
x

x

x

x
R/W

レジスターWEEKDAYのミラーです。詳細は“0x03: WEEKDAY (Day-of-Week Data)”を参照してください。

0x16: DAY_MIR (Mirrored Day Data, = 0x04)
Bit No.

Bit 7

Bit 6

Bit name––

Initial value

0

0

R/W

R

R

Bit 5

Bit 4

Bit 3

Bit 2

DAY_H[1:0]
x

Bit 1

Bit 0

x

x

DAY_L[3:0]
x

x

x

R/W

R/W

レジスターDAYのミラーです。詳細は“0x04: DAY (Day Data)”を参照してください。

0x17: MONTH_MIR (Mirrored Month Data, = 0x05)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name–––

MONTH_H

Initial value

0

0

0

x

R/W

R

R

R

R/W

Bit 3

Bit 2

Bit 1

Bit 0

MONTH_L[3:0]
x

x

x

x

R/W

レジスターMONTHのミラーです。詳細は“0x05: MONTH (Month Data)”を参照してください。

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4

レジスター

0x18: YEAR_MIR (Mirrored Year Data, = 0x06)
Bit No.

Bit 7

Bit 6

Bit name

Bit 5

Bit 4

Bit 3

Bit 2

YEAR_H[3:0]

Initial value

x

x

R/W

Bit 1

Bit 0

x

x

YEAR_L[3:0]
x

x

x

x

R/W

R/W

レジスターYEARのミラーです。詳細は“0x06: YEAR (Year Data)”を参照してください。

0x20: EVIN_EN (Event Input Enable)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name–

DIRMOD

EVIN3CPEN

EVIN2CPEN

EVIN1CPEN

EVIN3EN

EVIN2EN

EVIN1EN

Initial value

0

0

0

0

0

0

0

0

R/W

R

R/W

R/W

R/W

R/W

R/W

R/W

R/W

Bit 6:DIRMOD
このビットは、タイムスタンプバッファーの動作モードを選択します。
1 (R/W): ダイレクトモード
0 (R/W): FIFOモード

Bit 5
Bit 4
Bit 3

EVIN3CPEN
EVIN2CPEN
EVIN1CPEN
これらのビットは、EVINn端子からの外部イベントトリガー入力によるタイムスタンプキャプチャー
(バッファーへのタイムスタンプデータの取得) を許可/禁止します。
1 (R/W): EVINnタイムスタンプキャプチャーイネーブル
0 (R/W): EVINnタイムスタンプキャプチャーディスエーブル
EVINnCPENビットの設定は、下記のEVINnENビット = 1の場合に有効となります。

Bit 2
Bit 1
Bit 0

EVIN3EN
EVIN2EN
EVIN1EN
これらのビットは、EVINn端子からの外部イベントトリガー入力を許可/禁止します。
1 (R/W): EVINnイベントトリガー入力イネーブル
0 (R/W): EVINnイベントトリガー入力ディスエーブル*1

タイムスタンプ機能の詳細については、“3.10 タイムスタンプ機能”を参照してください。

0x21: EVIN1_CFG (EVIN1 Configuration)
0x23: EVIN2_CFG (EVIN2 Configuration)
0x25: EVIN3_CFG (EVIN3 Configuration)
Bit No.

Bit 7

Bit 6

Bit 5

Bit name–––

Initial value

0

0

0

R/W

R

R

R

Bit 4

Bit 3

Bit 2

Bit 1

PUPD[2:0]
0

1

Bit 0
POL[1:0]

0

R/W

0

0
R/W

Bits 4–2: PUPD[2:0]
これらのビットは、EVINn端子のプルアップ/ダウン抵抗を選択します。

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77

4
表 4.6

レジスター

EVINn端子のプルアップ/ダウン

EVINn_CFG.PUPD[2:0]

プルアップ/ダウン抵抗

0b000
0b001
0b010
0b011
0b100
その他

プルアップ/ダウンなし
プルアップ 500 kΩ
プルアップ 1 MΩ (デフォルト)
プルアップ 10 MΩ
プルダウン 500 kΩ
プルアップ/ダウンなし

Bits 1–0: POL[1:0]
これらのビットは、タイムスタンプデータを取得するEVINn入力信号を取り込むための検出エッジの極性を選択します。
表 4.7

*1

EVINn入力検出エッジ極性

EVINn_CFG.POL[1:0]検出エッジ極性

0b00
0b01
0b10
0b11

立ち下がりエッジ (デフォルト)立ち上がりエッジ
立ち下がりおよび立ち上がりエッジ

タイムスタンプ機能の詳細については、“3.10 タイムスタンプ機能”を参照してください。

0x22: EVIN1_FLT (EVIN1 Noise Filter)
0x24: EVIN2_FLT (EVIN2 Noise Filter)
0x26: EVIN3_FLT (EVIN3 Noise Filter)
Bit No.

Bit 7

Bit 6

Bit name––

Initial value

0

0

R/W

R

R

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

FLT[5:0]
0

0

0
R/W

Bits 5–0: FLT[5:0]
これらのビットは、EVINn入力信号のノイズフィルター時間を設定します (FLT[5:0] x 125ms)。
表 4.8

*1

EVINn端子の入力有効パルス幅

EVINn_FLT. FLT[5:0]

入力信号のエッジと125msごとのサンプリングタイミ
ングとの前後関係によって、エッジ入力が検出される場合とされない場合が生じるEVINnのパルス幅

常にエッジ入力が検出される
EVINnのパルス幅

0x00
0x01 (設定禁止)
0x02
0x03
:
0x27
0x28
0x29以上 (設定禁止)––
125 ms以上、250 ms未満
250 ms以上、375 ms未満:
4750 ms以上、4875 ms未満
4875 ms以上、5000 ms未満–

1 ms以上–250 ms以上
375 ms以上:
4875 ms以上
5000 ms以上–

タイムスタンプ機能の詳細については、“3.10 タイムスタンプ機能”を参照してください。

RX4901CE/RX8901CE
ETM63J-02

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78

4

レジスター

0x27: BUF1_CFG1 (BUF1 Configuration 1)
0x2A: BUF2_CFG1 (BUF2 Configuration 1)
0x2D: BUF3_CFG1 (BUF3 Configuration 1)
BUF1 Configuration 1
Bit No.

Bit 7

Bit 6

Bit name–

OVWEN

Initial value

0

0

R/W

R

R/W

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

Bit 1

Bit 0

0

0

INTCNT[5:0]
0

0

0
R/W

BUF2/BUF3 Configuration 1
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

–

OVWEN

0

0

Initial value

0

0

0

0

R/W

R

R/W

R

R

Bit 6:

Bit 3

Bit 2
INTCNT[3:0]

0

0
R/W

OVWEN
このビットは、バッファー (FIFOまたはBUFn) が満杯になった後の書き込みモードを設定します。
1 (R/W): オーバーライトモード (古いデータから上書き)
0 (R/W): オーバーライト禁止モード (バッファーフル時は記録を停止、キャプチャーデータは破棄)

Bit 5–0: INTCNT[5:0] (BUF1 Configuration 1)
Bit 3–0: INTCNT[3:0] (BUF2/BUF3 Configuration 1)
これらのビットは、イベント入力割り込みを発生させるバッファー (BUFn) 内の入力データ数を設定します。
INTCNT[5:0]ビット (BUF1/FIFOバッファーイベント入力)
BUF1_STAT.PTR[5:0]ビットの値 (FIFOモード: バッファー内の残りデータ数、ダイレクトモード:
BUF1内に取得したデータ数) がINTCNT[5:0]ビットに設定した値に達すると、イベント入力割り込み要因が発生します。その後は、オーバーライト許可/禁止の設定にかかわらず、BUF1_STAT.PTR[5:0]ビットの値がINTCNT[5:0]ビットの設定値未満になるまで、FIFO/BUF1へのタイムスタンプキャプ
チャーが発生するたびにイベント入力割り込み要因が発生します。
例:1) INTCNT[5:0]ビット = 0x00の場合
イベント発生回数にかかわらず、イベント入力割り込み要因は発生しません。
2) INTCNT[5:0]ビット = 0x01の場合
イベントが発生するたびにイベント入力割り込み要因が発生します。
3) INTCNT[5:0]ビット = 0x20の場合 (FIFOモード時)
イベントトリガー入力によりバッファー (FIFO) 内に取得したデータ数が32個になると、イベン
ト入力割り込み要因が発生します。
INTCNT[3:0]ビット (BUF2/BUF3イベント入力) の機能も上記と同様です。設定範囲は下表に示すように異なります。
表 4.9
イベント入力数を指定する
制御ビット

BUF1_CFG1.INTCNT[5:0]ビット
BUF2_CFG1.INTCNT[3:0]ビット
BUF3_CFG1.INTCNT[3:0]ビット*1

割り込みを発生させるBUFnイベント入力数指定可能範囲FIFO モード

ダイレクトモード

0x00 〜 0x1F 0x00 〜 0x09 (BUF1)
無効
0x0 〜 0xB (BUF2)
無効
0x0 〜 0x9 (BUF3)

バッファー内の有効データ数を示す
ポインター

BUF1_STAT.PTR[5:0]ビット
BUF2_STAT.PTR[3:0]ビット
BUF3_STAT.PTR[3:0]ビット

タイムスタンプ機能の詳細については、“3.10 タイムスタンプ機能”を参照してください。

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ETM63J-02

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79

4

レジスター

0x28: BUF1_STAT (BUF1 Status)
0x2B: BUF2_STAT (BUF2 Status)
0x2E: BUF3_STAT (BUF3 Status)
BUF1 Status
Bit No.

Bit 7

Bit 6

Bit name

FULLF

EMPTF

Initial value

0

1

R/W

R

R

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

Bit 1

Bit 0

0

0

PTR[5:0]0

0

0R

BUF2/BUF3 Status
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

FULLF

EMPTF

–

–

Initial value

0

0

0

0

R/W

R

R

R

R

Bit 7:

Bit 3

Bit 2
PTR[3:0]

0

0
R

FULLF
このフラグは、バッファー (FIFOまたはBUFn) が満杯か否かを示します。
1 (R):
0 (R):

バッファーフル状態
バッファーに空きがある

FIFOモード時はBUF1_STAT.FULLFビットがバッファーの状態を示します。
1にセットされたフラグは、バッファーが読み出されて空きができると0に戻ります。
Bit 6:

EMPTF
このフラグは、バッファー (FIFOまたはBUFn) が空か否かを示します。
1 (R):
0 (R):

バッファーエンプティ状態
バッファーにデータがある

FIFOモード時はBUF1_STAT.EMPTFビットがバッファーの状態を示します。
1にセットされたフラグは、バッファーにデータが取り込まれると0に戻ります。
Bits 5–0: PTR[5:0] (BUF1 Status)
Bits 3–0: PTR[3:0] (BUF2/BUF3 Status)
これらのビットは、バッファー (FIFOまたはBUFn) 内のデータ格納数を示します。
FIFOモード:

読み出し可能なFIFO内の残りデータ数 (BUF1: 0 〜 32) を示します。

ダイレクトモード: バッファーBUFnに取得したデータ数 (取得回数、BUF1/BUF3: 0 〜 10、BUF2: 0〜 12) を示します。
注: FIFOモードでバッファーからスタンプデータを読み出した後、本レシスタのフラグとポインターが更新されるまで、最大1msの時間が必要です。

*1

タイムスタンプ機能の詳細については、“3.10 タイムスタンプ機能”を参照してください。

0x29: BUF1_CFG2 (BUF1 Configuration 2)
0x2C: BUF2_CFG2 (BUF2 Configuration 2)
0x2F: BUF3_CFG2 (BUF3 Configuration 2)
BUF1 Configuration 2
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

RDEN

SRAMMOD––

Initial value
R/W

0

0

0

0

R/W

R/W

R

R

Bit 3

Bit 2

Bit 1

Bit 0

0

0

Bit 1

Bit 0

0

0

RDPAGE[3:0]
0

0
R/W

BUF2/BUF3 Configuration 2
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

RDEN

–

–

–

Initial value
R/W

0

0

0

0

R/W

R

R

R

Bit 3

RDPAGE[3:0]0RX4901CE/RX8901CE
ETM63J-02

Bit 2
0
R/W

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80

4
Bit 7:

レジスター

RDEN
このビットは、ダイレクトモード時にスタンプデータを読み出すバッファー (BUFn) を選択します。
1 (R/W): BUFnリードイネーブル
0 (R/W): BUFnリードディスエーブル

Bit 6:SRAMMOD (BUF1 Configuration 2)
このビットは、SRAMモードでのバッファーの読み出し/書き込みを許可/禁止します。
1 (R/W): SRAMモードイネーブル
0 (R/W): SRAMモードディスエーブル

Bits 3–0: RDPAGE[3:0]
これらのビットは、ダイレクトモード時またはSRAMモード時にバッファーを読み出す際のページ番号を指定します。RDENビット = 1の場合にのみ有効です。
ダイレクトモード: ページ1 〜 10 (BUF1/3)、ページ1 〜 12 (BUF2)
ダイレクトモード時は、BUF3_STAT.PTR[3:0]ビットが示すページ番号以下を指定
するか、トリガー発生を禁止状態にして読み出す必要があります。
SRAMモード:*1

ページ0x0 〜 0xF

タイムスタンプ機能の詳細、SRAM/バッファーの読み出し/書き込み方法については、“3.10 タイムスタ
ンプ機能”を参照してください。

0x30: ALM_SEC (Second Alarm)
Bit No.

Bit 7

Bit name

XSAE

Initial value

0

R/W

Bit 6
0

R/W

Bit 7:

Bit 5

Bit 4

Bit 3

Bit 2

SALM_H[2:0]
0

Bit 1

Bit 0

0

0

SALM_L[3:0]
0

0

0

R/W

R/W

XSAE
このビットは秒アラームの設定を有効/無効にします。
1 (R/W): 秒アラーム無効
0 (R/W): 秒アラーム有効1に設定すると本レジスターの設定が無効となり、秒カウンターの内容はアラームの発生に影響を与えません。
0に設定すると本レジスターの設定が有効となり、秒カウンターの値とSALM_H[2:0]/SALM_L[3:0]
ビット設定値の一致がアラーム発生条件となります。

Bits 6–4: SALM_H[2:0]
Bits 3–0: SALM_L[3:0]
アラームの秒条件をBCDコードで設定します。
SALM_H[2:0]ビットでアラームの10秒桁 (0–5) を、SALM_L[3:0]ビットで1秒桁 (0–9) を設定します。
*1

アラーム機能の詳細については、“3.5 アラーム機能”を参照してください。

*2

アラーム機能を使用しない場合、本レジスターをリード/ライト可能な汎用レジスターとして使用することができます。ただし、不要な割り込みが発生することのないように、TSTP_INTE.AIEビットを0 (アラーム割り込みディスエーブル) に設定してください。

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4

レジスター

0x31: ALM_MIN_MIR (Mirrored Minute Alarm, = 0x07)
Bit No.

Bit 7

Bit name

XMAE

Initial value

1

R/W

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

MALM_H[2:0]
x

x

R/W

Bit 1

Bit 0

x

x

MALM_L[3:0]
x

x

x

R/W

R/W

レジスターALM_MINのミラーです。詳細は“0x07: ALM_MIN (Minute Alarm)”を参照してください。

0x32: ALM_HOUR_MIR (Mirrored Hour Alarm, = 0x08)
Bit No.

Bit 7

Bit 6

Bit name

XHAE

(GP)

Initial value
R/W

1

x

R/W

R/W

Bit 5

Bit 4

Bit 3

Bit 2

HALM_H[1:0]
x

Bit 1

Bit 0

x

x

HALM_L[3:0]
x

x

x

R/W

R/W

レジスターALM_HOURのミラーです。
詳細は“0x08: ALM_HOUR (Hour Alarm)”を参照してください。

0x33: ALM_WEEKDAY_MIR (Mirrored Day-of-Week Alarm / Day Alarm, = 0x09)
Mirrored Day-of-Week Alarm Register
Bit No.

Bit 7

Bit name

XWAE

Initial value

1

R/W

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

Bit 1

Bit 0

x

x

WKALM[6:0]
x

x

x

R/W

x
R/W

Mirrored Day Alarm Register
Bit No.

Bit 7

Bit 6

Bit name

XWAE

(GP)

Initial value
R/W

1

x

R/W

R/W

Bit 5

Bit 4

Bit 3

Bit 2

DALM_H[1:0]xDALM_L[3:0]
x

x

x

R/W

R/W

レジスターALM_WEEKDAYのミラーです。詳細は“0x09: ALM_WEEKDAY (Day-of-Week Alarm / Day
Alarm)”を参照してください。

0x34: UPDISEL (Time Update Interrupt Select)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

–

–

–

–

–

–

USEL1

–

Initial value

0

0

0

0

0

0

0

0

R/W

R

R

R

R

R

R

R/W

R

Bit 1:

USEL1
このビットは、TCTL.USEL0ビットと共に時刻更新割り込みイベントの種類を選択します。(表 4.2参照)0x37: PWSW_CFG (Power Switch Configuration)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

CHGEN

INIEN

VBATLDETBKVBATLDETEN

Initial value
R/W

Bit 7:

0

0

0

0

R/W

R/W

R/W

R/W

Bit 3

Bit 2

Bit 1

SWSEL[1:0]
0

1
R/W

Bit 0

VDDSAMP[1:0]
0

0
R/W

CHGEN
このビットは、VBATへの充電機能を制御します。
1 (R/W): 充電イネーブル
0 (R/W): 充電ディスエーブル
VBATに二次電池を接続している場合は、INIENビットを1に設定すると共に本ビットを1に設定し、電源切り替え機能およびVBATへの充電機能をイネーブルにします。

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4
Bit 6:

レジスター

INIEN
このビットは、電源切り替え機能を制御します。
1 (R/W): 電源切り替え機能イネーブル
0 (R/W): 電源切り替え機能ディスエーブル

Bit 5:VBATLDETBK
このビットは、VBATLDETENビット = 1 (VBAT電圧検出イネーブル) の場合に、バックアップモード
中もVBAT電圧の検出を行うか否かを選択します。
1 (R/W): バックアップモード時VBAT電圧検出イネーブル
0 (R/W): バックアップモード時VBAT電圧検出ディスエーブル

Bit 4:VBATLDETEN
このビットは、VBAT電圧の検出を行うか否かを選択します。
1 (R/W): VBAT電圧検出イネーブル
0 (R/W): VBAT電圧検出ディスエーブル

Bits 3–2: SWSEL[1:0]
これらのビットは、電源切り替え機能を使用しない場合の電源切り替えSWの状態を選択します。
表 4.10
PWSW_CFG.SWSEL[1:0]0b00
0b01 (デフォルト)
0b10
0b11 (設定禁止)

電源切り替えSWの固定

電源切り替えSW状態

電源構成例

SW1 = ON, SW2 = OFF, SW3 = ON 主電源 (VDD) のみを使用
SW1 = OFF, SW2 = OFF, SW3 = ON 一次電池を使った電源バックアップ構成
SW1 = ON, SW2 = OFF, SW3 = OFF 主電源 (VDD) のみを使用–
設定禁止

Bits 1–0: VDDSAMP[1:0]
これらのビットは、VDD電圧検出のために制御するSW1のOFF時間を選択します。
表 4.11SW1 OFF時間の設定

PWSW_CFG.VDDSAMP[1:0]

SW1 OFF 時間

0b00
0b01
0b10
0b11

OFFしない (デフォルト)2 ms
128 ms256 ms詳細は、3.9節の“VDD電圧低下検出サンプリング時間設定”を参照してください。
*1

電源切り替え機能の詳細については、“3.9 バックアップ電源切り替え機能”を参照してください。

0x38: WTICFG (Wakeup Timer Interrupt Configuration)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

FOEMUX

EVIN3MUX–WTONETIM––WTIOUT–

Initial value

0

0

0

0

0

0

0

0

R/W

R/W

R

R/W

R

R

R/W

R

R/W

Bit 7:FOEMUX
このビットは、Pin 10の機能を選択します。
1 (R/W): FOE (FOUT Enable) 入力
0 (R/W): EVIN2入力
FOE入力によるFOUT出力の制御については、3.7節の“FOUT出力の制御 (FOE端子を使用する場合)”を参照してください。

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4
Bit 6:

レジスター

EVIN3MUX
このビットは、Pin 4の機能を選択します。
1 (R/W): EVIN3入力
0 (R/W): FOUT出力

Bit 4:WTONETIM
このビットは、ウェイクアップタイマー割り込み発生時に/INT出力を自動解除するか否かを選択します。
1 (R/W): 自動解除しない (LOW出力)
0 (R/W): 自動解除する (7.812 ms幅のLOWパルス出力)

Bit 1:WTIOUT
このビットは、ウェイクアップタイマー割り込み信号の出力端子を選択します。
1 (R/W): FOUT端子から出力(CMOSバッファー出力)
0 (R/W): /INT端子から出力(Nchオープンドレイン出力)
ウェイクアップタイマー割り込み信号の出力端子にFOUT端子を選択した場合、FOUT端子からはウェイクアップタイマー割り込み信号とFOUT信号がNORされた信号が出力されます。したがって、
FOUT端子からウェイクアップタイマー割り込み信号だけを出力させる場合は、TCTL.FSEL[1:0]ビッ
トを0b11に設定してFOUT信号の出力を停止してください。
本ビットはEVIN3MUXビット = 0の場合にのみ有効です。

*1

ウェイクアップタイマー割り込みの詳細については、“3.6 ウェイクアップタイマー機能”を参照してください。

0x39: WTCTL (Wakeup Timer Control)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

WTRST

–

–

–

WTMODSELWTSTOPCTL–

WTSTOP

Initial value

0

0

0

0

0

0

0

0

R/W

W

R

R

R

R/W

R/W

R

R/W

Bit 7:

WTRST
このビットは、ウェイクアップタイマーにプリセット値をリロードします。
1 (W):
0 (W):

タイマープリセット
無効

本ビットへの1書き込みにより、ウェイクアップタイマーにリセットパルスが出力されます。リセッ
ト中はTCTL.TEビット = 0になります。リセット解除後、WTRSTビットは自動的にクリアされ、ウェ
イクアップタイマーはプリセット値をロードした状態から再スタートします。これにより、ウェイク
アップタイマーをウォッチドッグタイマーのように使用することができます。
本ビットからは、1書き込み後も常時0が読み出されます。
Bit 3:WTMODSEL
このビットは、ウェイクアップタイマーの動作をノーマルモードまたはバックアップモードの一方のみに制限します。
1 (R/W): ノーマルモード時はカウンターを停止
0 (R/W): バックアップモード時はカウンターを停止

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4
Bit 2:

レジスター

WTSTOPCTL
このビットは、WTMODSELビット、WTSTOPビットの機能を有効/無効に設定します。
1 (R/W): WTMODSEL有効、WTSTOP無効
0 (R/W): WTMODSEL無効、WTSTOP有効

Bit 0:WTSTOP
このビットは、ウェイクアップタイマーを一時停止します。
1 (R/W): ウェイクアップタイマーを一時停止
0 (R/W): ウェイクアップタイマーの一時停止を解除*1 ウェイクアップタイマー機能の詳細については、“3.6 ウェイクアップタイマー機能”を参照してください。

0x3A: WTCNT_L_MIR (Mirrored Wakeup Timer Counter Low, = 0x0A)
0x3B: WTCNT_M_MIR (Mirrored Wakeup Timer Counter Middle, = 0x0B)
0x3C: WTCNT_H_MIR (Mirrored Wakeup Timer Counter High, = 0x0C)
Mirrored Wakeup Timer Counter Low
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

x

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

x

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

WTCNT[7:0]

Initial value

x

x

x

x

R/W

R/W

Mirrored Wakeup Timer Counter Middle
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

WTCNT[15:8]

Initial value

x

x

x

x

R/W

R/W

Mirrored Wakeup Timer Counter HighBit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

WTCNT[23:16]

Initial value

x

x

x

x

R/W

x
R/W

レ ジ ス タ ー WTCNT_L 、 WTCNT_M 、 WTCNT_H の ミ ラ ー で す 。 詳 細 は “0x0A–0x0C: WTCNT_L/
WTCNT_M/WTCNT_H (Wakeup Timer Counter Low/Middle/High)”を参照してください。

0x41: WRCMD_CFG (Write Command Configuration)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

EVCNTCLREN

BUF3FCLREN

BUF2FCLREN

BUF1FCLREN

–

–

–

CMDTRGEN

Initial value
R/W

0

0

0

0

0

0

0

0

R/W

R/W

R/W

R/W

R

R

R

R/W

注: 本レジスターはレジスターWRCMD_TRG (アドレス0x42) への書き込み時に実行される機能を指定します。

Bit 7:

EVCNTCLREN
このビットは、コマンドトリガー実行時 (レジスターWRCMD_TRGへの書き込み時) にイベントカ
ウンターを初期化するか否かを指定します。
1 (R/W): イベントカウンターの初期化が有効
0 (R/W): イベントカウンターの初期化が無効
このビットを1に設定してコマンドトリガーを実行すると、EVIN1 〜 3のイベント入力回数をカウントしている以下のイベントカウンターがすべて初期化 (0クリア) されます。
EVIN1_EVCNT.EVCNT[5:0]ビット (EVIN1イベントカウンター)
EVIN2_EVCNT.EVCNT[5:0]ビット (EVIN2イベントカウンター)
EVIN3_EVCNT.EVCNT[5:0]ビット (EVIN3イベントカウンター)

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4
Bit 6:
Bit 5:
Bit 4:

レジスター

BUF3FCLREN
BUF2FCLREN
BUF1FCLREN
これらのビットは、コマンドトリガー実行時にBUFnのタイムスタンプフラグとイベントポインターを初期化するか否かを指定します。
1 (R/W): タイムスタンプフラグ/イベントポインター初期化が有効
0 (R/W): タイムスタンプフラグ/イベントポインター初期化が無効
これらのビットを1に設定してコマンドトリガーを実行すると、BUFnの以下の内容がすべて初期化されます。

Bit 0:<BUF1FCLREN>
BUF1_STAT.FULLFビット
BUF1_STAT.EMPTFビット
BUF1_STAT.PTR[5:0]ビット
BUF_OVWF.BUF1OVWFビット(BUF1フルフラグ)(BUF1エンプティフラグ)(BUF1イベントポインター)(BUF1オーバーライトフラグ)<BUF2FCLREN>
BUF2_STAT.FULLFビット
BUF2_STAT.EMPTFビット
BUF2_STAT.PTR[3:0]ビット
BUF_OVWF.BUF2OVWFビット(BUF2フルフラグ)(BUF2エンプティフラグ)(BUF2イベントポインター)(BUF2オーバーライトフラグ)<BUF3FCLREN>
BUF3_STAT.FULLFビット
BUF3_STAT.EMPTFビット
BUF3_STAT.PTR[3:0]ビット
BUF_OVWF.BUF3OVWFビット(BUF3フルフラグ)(BUF3エンプティフラグ)(BUF3イベントポインター)(BUF3オーバーライトフラグ)

CMDTRGEN
このビットは、コマンドトリガー実行時にBUF1のタイムスタンプトリガーを発行するか否かを指定します。
1 (R/W): BUF1タイムスタンプトリガー発行が有効
0 (R/W): BUF1タイムスタンプトリガー発行が無効
このビットを1に設定してコマンドトリガーを実行すると、BUF1のタイムスタンプトリガーが発行されます。このタイムスタンプトリガーを連続して発行する場合は、トリガーの間に5 ms以上のインターバルが必要です。タイムスタンプトリガーが正常に受け付けられたか否かについては、下記いず
れかのビットで確認してください。
BUF_INTF.BUF1Fビット
またはBUF1_CFG2.RDPAGE[3:0]ビット

1にセットされたことを確認
内容がインクリメントされたことを確認

0x42: WRCMD_TRG (Write Command Trigger)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

0

WRTRG[7:0]

Initial value

0

R/W

0

0

0
R/W

Bits 7–0: WRTRG[7:0]
このアドレスに任意の値を書き込むことにより、レジスターWRCMD_CFG (アドレス0x41) に設定されたコマンドトリガーを発行します (レジスターライトのタイミングで発行)。

RX4901CE/RX8901CE
ETM63J-02

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86

4

レジスター

コマンドトリガー発行後、コマンド実行が完了し、タイムスタンプトリガー発行時はデータの書き込
みとフラグなどへの反映が完了するまで、本レジスターは0x00以外の値を保持します。タイムスタン
プトリガー発行直後にスタンプデータを読み出す場合や次のコマンドトリガーを発行する場合は、その前に本レジスターを読み出し、0x00に戻っていることを確認してください。

0x43: EVNT_INTE (Event Interrupt Enable)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

EVIN3IEN

EVIN2IEN

EVIN1IEN–VBATLIENVTMPLIENVDDLIENOSCSTPIEN

Initial value
R/W

Bit 7:
Bit 6:
Bit 5:

0

0

0

0

0

0

0

0

R/W

R/W

R/W

R

R/W

R/W

R/W

R/W

EVIN3IEN
EVIN2IEN
EVIN1IEN
これらのビットは、EVINnイベント入力による割り込みの発生を許可/禁止します。
1 (R/W): EVINnイベント入力割り込みイネーブル
0 (R/W): EVINnイベント入力割り込みディスエーブル

Bit 3:VBATLIEN
このビットは、VBAT電圧低下検出によるイベントトリガーの発生を許可/禁止します。
1 (R/W): VBAT電圧低下検出イベントトリガーイネーブル
0 (R/W): VBAT電圧低下検出イベントトリガーディスエーブル
このビットが1の場合、VBAT電圧低下を検出するとイベントフラグ (EVNT_INTF.VBATLEVFビット)が1にセットされます。

Bit 2:VTMPLIEN
このビットは、VDET2電圧低下検出 (電源電圧が発振回路の温度調整動作下限電圧を下回ったことを検出) によるイベントトリガーの発生を許可/禁止します。
1 (R/W): VDET2電圧低下検出イベントトリガーイネーブル
0 (R/W): VDET2電圧低下検出イベントトリガーディスエーブル
このビットが1の場合、VDET2電圧低下を検出するとイベントフラグ (EVNT_INTF.VTMPLEVFビット)が1にセットされます。

Bit 1:VDDLIEN
このビットは、-VDET1電圧低下検出 (VDD電圧が-VDET1を下回ったことを検出) によるイベントトリ
ガーの発生を許可/禁止します。
1 (R/W): -VDET1電圧低下検出イベントトリガーイネーブル
0 (R/W): -VDET1電圧低下検出イベントトリガーディスエーブル
このビットが1の場合、VDD電圧低下を検出するとイベントフラグ (EVNT_INTF.VDDLEVFビット)が1にセットされます。

Bit 0:OSCSTPIEN
このビットは、発振停止検出によるイベントトリガーの発生を許可/禁止します。
1 (R/W): 発振停止検出イベントトリガーイネーブル
0 (R/W): 発振停止検出イベントトリガーディスエーブル
このビットが1の場合、発振停止を検出するとイベントフラグ (EVNT_INTF.OSCSTPEVFビット) が1にセットされます。

RX4901CE/RX8901CE
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87

4

レジスター

0x44: CAP_EN (Capture Enable)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

–

–

–

–

VBATLCPEN

VTMPLCPEN

VDDLCPENOSCSTPCPEN

Initial value

0

0

0

0

0

0

0

0

R/W

R

R

R

R

R/W

R/W

R/W

R/W

Bit 3:VBATLCPEN
このビットは、VBAT電圧低下検出のイベントトリガーによるタイムスタンプキャプチャーを許可/禁止します。
1 (R/W): VBAT電圧低下検出タイムスタンプキャプチャーイネーブル
0 (R/W): VBAT電圧低下検出タイムスタンプキャプチャーディスエーブル

Bit 2:VTMPLCPEN
このビットは、VDET2電圧低下検出 (電源電圧が発振回路の温度調整動作下限電圧を下回ったことを検出) のイベントトリガーによるタイムスタンプキャプチャーを許可/禁止します。
1 (R/W): VDET2電圧低下検出タイムスタンプキャプチャーイネーブル
0 (R/W): VDET2電圧低下検出タイムスタンプキャプチャーディスエーブル

Bit 1:VDDLCPEN
このビットは、-VDET1電圧低下検出 (VDD電圧が-VDET1を下回ったことを検出) のイベントトリガーによるタイムスタンプキャプチャーを許可/禁止します。
1 (R/W): -VDET1電圧低下検出タイムスタンプキャプチャーイネーブル
0 (R/W): -VDET1電圧低下検出タイムスタンプキャプチャーディスエーブル

Bit 0:OSCSTPCPEN
このビットは、発振停止検出のイベントトリガーによるタイムスタンプキャプチャーを許可/禁止します。
1 (R/W): 発振停止検出タイムスタンプキャプチャーイネーブル
0 (R/W): 発振停止検出タイムスタンプキャプチャーディスエーブル

実際に各イベントトリガーでタイムスタンプキャプチャーを実行させるためには、レジスターEVNT_INTE内の対応する***IENビットを1に設定してレジスターEVNT_INTFのイベントフラグ (***EVFビット) がセットされるようにしておく必要があります。

0x46: BUF_INTF (Buffer Interrupt Factor)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

BUF3F

BUF2F

BUF1F

–

VBATLF

–

VDDLF

–

Initial value

0

0

0

0

0

0

0

0

R/W

R/W

R/W

R

R/W

R

R/W

R

R/W

Bit 7:
Bit 6:
Bit 5:

BUF3F
BUF2F
BUF1F
これらのフラグは、タイムスタンプバッファーBUFnにイベントトリガー入力割り込み要因が発生したことを示します。
1 (R):
0 (R):
1 (W):
0 (W):

イベントトリガー入力発生
イベントトリガー入力なし
無効
フラグをクリア

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88

4

レジスター

各フラグは、BUF1_CFG1.INTCNT[5:0]ビット (BUF1)、BUF2_CFG1. INTCNT[3:0]ビット (BUF2)、
BUF3_CFG1.INTCNT[3:0]ビット (BUF3) で設定した数のデータが書き込まれた時点で1にセットされます。
Bit 3:VBATLF
このフラグは、VBAT電圧低下を2回連続して検出した場合にセットされます。
1 (R):
0 (R):
1 (W):
0 (W):

VBAT電圧低下を検出
VBAT電圧低下検出なし
無効
フラグをクリア (VBAT電圧復帰後)

VBAT電圧低下の状態が継続している場合、0書き込みによってフラグをクリアすることはできません。
Bit 1:

VDDLF
このフラグは、-VDET1電圧低下 (VDD電圧が-VDET1を下回ったこと) を検出した場合にセットされます。
1 (R):
0 (R):
1 (W):
0 (W):-VDET1電圧低下を検出-VDET1電圧低下検出なし
無効
フラグをクリア (VDD電圧復帰後)

このフラグは、-VDET1電圧低下を1回検出した時点でセットされます。-VDET1電圧低下の状態が継続している場合、0書き込みによってフラグをクリアすることはできません。

0x47: EVNT_INTF (Event Interrupt Factor)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

EVIN3F

EVIN2F

EVIN1F–VBATLEVFVTMPLEVFVDDLEVFOSCSTPEVF

Initial value
R/W

Bit 7:
Bit 6:
Bit 5:

0

0

0

0

0

0

0

0

R/W

R/W

R/W

R

R/W

R/W

R/W

R/W

EVIN3F
EVIN2F
EVIN1F
これらのフラグは、EVINnにイベント入力が発生したことを示します。
1 (R):
0 (R):
1 (W):
0 (W):

Bit 3:

EVINnイベント入力発生
EVINnイベント入力なし
無効
フラグをクリア

VBATLEVF
このフラグは、VBAT電圧低下検出イベントが発生したことを示します。
1 (R):
0 (R):
1 (W):
0 (W):

Bit 2:

VBAT電圧低下検出イベント発生
VBAT電圧低下検出イベント入力なし
無効
フラグをクリア

VTMPLEVF
このフラグは、VDET2電圧低下検出 (電源電圧が発振回路の温度調整動作下限電圧を下回ったことを検出) イベントが発生したことを示します。
1 (R):
0 (R):
1 (W):
0 (W):

VDET2電圧低下検出イベント発生
VDET2電圧低下検出イベント入力なし
無効
フラグをクリア

RX4901CE/RX8901CE
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4
Bit 1:レジスター

VDDLEVF
このフラグは、-VDET1電圧低下検出 (VDD電圧が-VDET1を下回ったことを検出) イベントが発生したことを示します。
1 (R):
0 (R):
1 (W):
0 (W):

Bit 0:-VDET1電圧低下検出イベント発生-VDET1電圧低下検出イベント入力なし
無効
フラグをクリア

OSCSTPEVF
このフラグは、発振停止検出イベントが発生したことを示します。
1 (R):
0 (R):
1 (W):
0 (W):

発振停止検出イベント発生
発振停止検出イベント入力なし
無効
フラグをクリア

発振停止検出イベントトリガーが発生した場合、発振再開後にタイムスタンプを取得します。
注: 本レジスターのフラグは、レジスターEVNT_INTEの対応する****IENビットが0の場合はイベントが発生してもセットされません。

0x4E: BUF_FULLF (Buffer Full Flag)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name–

BUF3FULLF

BUF2FULLF

BUF1FULLF

–

–

–

–

Initial value

0

0

0

0

0

0

0

0

R/W

R

R/W

R/W

R/W

R

R

R

R

Bit 6:
Bit 5:
Bit 4:

BUF3FULLF
BUF2FULLF
BUF1FULLF
これらのフラグは、BUFnでバッファーフルが発生したことを示します。
1 (R):
0 (R):
1 (W):
0 (W):

バッファーフル発生
バッファーフルの発生なし
無効
フラグをクリア

FIFOモード時はBUF1FULLFビットがバッファーフルの発生を示します。
これらのフラグは、バッファーが読み出されて空きができても自動的に0には戻りませんので、0を書き込んでクリアしてください。

0x4F: BUF_OVWF (Buffer Overwrite Flag)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name–

BUF3OVWFBUF2OVWFBUF1OVWF

–

–

–

–

Initial value

0

0

0

0

0

0

0

0

R/W

R

R

R

R

R

R

R

R

Bit 6:
Bit 5:
Bit 4:

BUF3OVWFBUF2OVWFBUF1OVWF
これらのフラグは、BUFnでオーバーライトが発生したことを示します。
1 (R):
0 (R):

オーバーライト発生
オーバーライトの発生なし

各フラグは、レジスターWRCMD_CFG内のBUFnFCLRENビットを1に設定してコマンドトリガーを
発行 (レジスターWRCMD_TRGへの書き込み) することによりクリアされます。
RX4901CE/RX8901CE
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4

レジスター

0x51: EVIN1_EVCNT (EVIN1 Event Counter)
0x52: EVIN2_EVCNT (EVIN2 Event Counter)
0x53: EVIN3_EVCNT (EVIN3 Event Counter)
Bit No.

Bit 7

Bit 6

Bit name––

Initial value

0

0

R/W

R

R

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

EVCNT[5:0]
0

0

0
R

Bits 5–0: EVCNT[5:0]
これらのビットは、EVINn端子からのイベント入力回数 (0 〜 63回) を示します。
入力回数が63回を超えた場合は、0に戻りカウントを継続します。
なお、EVIN_EN.EVINnENビット = 0の場合、EVINnイベント入力回数はカウントされません。

0x54: EVINMON (EVIN Monitor)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

EVIN3MON

EVIN2MON

EVIN1MON

–

–

–

–

–

Initial value

x

x

x

0

0

0

0

0

R/W

R

R

R

R

R

R

R

R

Bit 7:
Bit 6:
Bit 5:

EVIN3MON
EVIN2MON
EVIN1MON
これらのビットは、現在のEVINn端子入力レベルを示します。
1 (R):
0 (R):HIGHレベル
LOWレベルRX4901CE/RX8901CE
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91

5

電気的特性

5 電気的特性
5.1 絶対最大定格
表 5.1
項 目

記号

主電源電圧
内部動作用電源電圧
バックアップ電源電圧
入力電圧1

VDD
VOUT
VBAT
VIN1

出力電圧1
保存温度

VOUT1
TSTG

絶対最大定格条 件

GND = 0 V
単位

定格値

–
–
–
SCL, SDA, FOE, CE, CLK, DIO, DI, EVIN1, EVIN2,
EVIN3/INT, SDA, DIO, DO, FOUT
梱包状態を除く、単品での保存-0.3 〜 +6.5
-0.3 〜 +6.5
-0.3 〜 +6.5
-0.3 〜 +6.5

V
V
V
V

-0.3 〜 +6.5
-55 〜 +125

CV(注) • 電圧はすべて VSS = 0 V を基準とした値です。
• 上記、絶対最大定格を超えて使用した場合、永久破壊となることがあります。また、通常動作では推奨動作条件の範囲内で使用することが望ましく、この条件を越えると誤動作の原因になるとともに、信頼性に悪影響を及ぼすことがあります。
• 電圧は常に VDD ≧ VSS の条件を保持してください。
• 動作は電気的特性の範囲内で保証されます。

5.2 推奨動作条件
表 5.2
特記無き場合: GND = 0 V, Ta = -40 C 〜 +105 C
項 目
記号
動作電源電圧 1
インターフェイス電源電圧
バックアップ電源電圧
温度補償電圧計時電源電圧
動作温度範囲

VDD
VACC
VBAT
VTMP
VCLK
Ta

推奨動作条件条 件

主電源駆動時VDD端子電圧（I2C IF、SPI IF 3wire/4wire）
バックアップ電源電圧
温度補償動作が継続するVOUT電源電圧計時動作が継続するVOUT電源電圧
結露無きこと

Min.

Typ.

Max.

単位

1.60
1.60
1.10
1.60 2
VVLF 3
-40

3.0
3.0
3.0
3.0
3.0
+25

5.5
5.5
5.5
5.5
5.5
+105

V
V
V
V
V
C

1 電源端子近傍にノイズ対策用のバイパスコンデンサを必ず挿入してください。
2 温度補償電圧のMin.値未満では、温度に対応した周波数補正値更新機能が停止します。
3 VVLFは、VDD ≧ VACC(Min.)で初期設定後の計時保持下限値です。

5.3 周波数特性
表 5.3
特記無き場合: VDD = 3.0 V, GND = 0 V, Ta = -40 C 〜 +105 C
項 目
記号
出力周波数
周波数安定度fo∆f/f

周波数電圧特性
FOUTデューティ

f/V
Duty

水晶発振開始時間

tSTA

エージング
リフロー

fa
∆fref

周波数特性
条 件

Ta = +25 C
XS
Ta = 0 C 〜 +50 C
Ta = -40 C 〜 +85 C
Ta = +85 C 〜 +105 C
XB
Ta = 0 C 〜 +50 C
Ta = -40 C 〜 +85 C
Ta = +85 C 〜 +105 C
Ta = +25 C, VDD = 1.6 V 〜 5.5 V
Vth = 50% VDD, Ta = -40 C 〜 +105 C,
VDD = 1.6 V 〜 5.5 V
Ta = +25 C, VDD = 1.6 V 〜 5.5 V
Ta = -40 C 〜 +105C, VDD = 1.6 V 〜 5.5 V
Ta = +25 C, 電源電圧 = 3.0 V, 初年度
リフロー処理: 260 C Max., 2回

Min.

Typ.

Max.

–
–
–
–
–
–
–
40

32.768
–
–
–
–
–
–
–
–

±1.9 1±3.0 2±5.0 3±3.8 4±5.0 3±8.0 5
±1
60

–
–
–
–

0.5
–
–

1.0
3.0
±3
±3 6

単位
kHz
×10-6

×10-6/V%s
×10-6/year
×10-6

1 月差5秒以内 2 月差8秒以内 3 月差13.2秒以内  4 月差10秒以内 5 月差21秒以内
6 リフロー実装前後の周波数変化率で、常温放置24時間経過後に常温環境で測定した値

RX4901CE/RX8901CE
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92

5

電気的特性

5.4 DC特性
DC特性
表 5.4

DC特性

特記無き場合: VBAT = 1.1 V 〜 5.5 V, VDD = 1.6 V 〜 5.5 V, Ta = -40 C 〜 +105 C
項 目
記号
条 件
消費電流1

IDD1

消費電流2

IDD2

消費電流3

I32K1

消費電流4

I32K2

消費電流5

IBAT1

消費電流6

IBAT2

消費電流7

IBAT3

消費電流8

IDD3

消費電流9

IDD4

消費電流10

IDD5

消費電流11IDD6

VDD立ち上がり時検出電圧
VDD立ち下がり時検出電圧
温度補償更新停止検出電圧
VBAT立ち上がり時検出電圧
VBAT立ち下がり時検出電圧
VLF検出電圧“H”入力電圧+VDET1-VDET1
VDET2
+VLOW
-VLOW
VVLF
VIH

“L”入力電圧

VIL“H”出力電圧

VOH1
VOH2
VOH3
VOL1
VOL2
VOL3
VOL4
VOL5
VOL6
ILK

“L”出力電圧

入力リーク電流

Min.

Typ.

Max.

単位

VDD = 5 V

–

0.42

1.8

µA

VDD = 3 V

–

0.40

1.70

VDD = 5 V

–

1.10

3.10

VDD = 3 V

–

1.00

3.00

VBAT = 5 V

–

0.30

1.60

VBAT = 3 V

–

0.24

1.50

VBAT = 3 V

–

0.23

1.50

µA

VDD = 5 V

–

0.40

1.70

µA

VDD = 3 V

–

0.38

1.60

VDD = 5 V

–

55

100

VDD = 3 V
FSEL1, FSEL0 = 1,
INIEN = 1, CHGEN = 0
SCL, SDA = H, CE = L
VBAT → VDD電源切り替え電圧
VDD → VBAT電源切り替え電圧
検出電源系: VOUT
VBAT端子電圧
VBAT端子電圧
VOUT電源低下検出電圧
SCL, SDA, CE, CLK, DIO, DI, FOE
EVINn
SCL, SDA, CE, CLK, DIO, DI, FOE
EVINn
DIO, DO, VDD = 5.0 V, IOH = -1 mA
FOUT
VDD = 3.0 V, IOH = -1 mA
VDD = 3.0 V, IOH = -100 µA
FOUT
VDD = 5.0 V, IOL = 1 mA
VDD = 3.0 V, IOL = 1 mA
VDD = 3.0 V, IOL = 100 µA
DIO, DO, VDD = 5.0 V, IOL = 1 mA
/INT
VDD = 3.0 V, IOL = 1 mA
SDA
VDD ≧ 2.0 V, IOL = 3 mA
入力端子, 入力電圧 = VDD or GND

–

50

95

1.40
1.35
1.45
1.15
1.10
–
0.8 x VDD
0.8 x VOUT
GND - 0.3
GND - 0.3
4.5
2.2
2.9
GND
GND
GND
GND
GND
GND
-0.5

1.50
1.45
1.50
1.25
1.20
–
–
–
–
–
–
–
–
–
–
–
–
–
–
–

1.60
1.55
1.55
1.35
1.30
1.1
5.5
5.5
0.2 x VDD
0.2 x VOUT
5.0
3.0
3.0
GND + 0.5
GND + 0.8
GND + 0.1
GND + 0.25
GND + 0.4
GND + 0.4
0.5

/INT = Hi-Z
FOUT: 出力OFF (Hi-Z)
温度補償間隔: 2 s
FSEL1, FSEL0 = 1
INIEN = 1, CHGEN = 0
SCL, SDA = H, CE = L/INT = Hi-Z
FOUT: 32 kHz出力, CL = 0 pF
温度補償間隔: 2 s
FSEL1, FSEL0 = 0
INIEN = 1, CHGEN = 0
SCL, SDA = H, CE = L/INT= Hi-Z
FOUT: 出力OFF (Hi-Z)
温度補償間隔 2 s
FSEL1, FSEL0 = 1
INIEN = 1, CHGEN = 0
SCL, SDA = L, CE = L
初回電源投入時、VBATのみ投入
時の電流値/INT = Hi-Z
FOUT: 出力OFF (Hi-Z)
温度補償間隔: 非動作時
/INT = Hi-Z
FOUT: 出力OFF (Hi-Z)
温度補償間隔: 非動作時
FSEL1, FSEL0 = 1,
INIEN = 1, CHGEN = 0
SCL, SDA = H, CE = L/INT = Hi-Z
FOUT: 出力OFF (Hi-Z)
温度センサー測定動作期間内
図5.1 温度補償動作と消費電流参照

RX4901CE/RX8901CE
ETM63J-02

µA

µA

µA

V
V
V
V
V
V
V
V
V

V

V
V
µA

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93

5
項 目
出力リーク電流EVINn入力プルアップ抵抗

記号
ILKPD
IOZ
RUP1
RUP2
RUP3

EVINn入力プルダウン抵抗

RDWN3

CE入力プルダウン抵抗

RDWN1
RDWN2
VDD - VOUT電源間オフリーク電流 ISW1VBAT - VOUT電源間オフリーク電流 ISW2VBAT - VDD電源間オフリーク電流 ISW23
VDD - VOUT電源間SW ON電流ISWON1VBAT - VOUT電源間SW ON電流ISWON2条 件
EVIN端子, 入力電圧 = GND
出力端子, 出力電圧=VDD or GND
EVIN1/EVIN2/EVIN3端子 VDD = 3.0 V
500 kΩ設定
EVIN1/EVIN2/EVIN3端子 VDD = 3.0 V
1 MΩ設定EVIN1/EVIN2/EVIN3端子 VDD = 3.0 V
10 MΩ設定
EVIN1/EVIN2/EVIN3端子 VDD = 3.0 V
500 kΩ設定
CE端子 VDD = 5.0 V
CE端子 VDD = 3.0 V
VOUT = 5.0 V, VDD = 0.0 V
VBAT = 0.0 V, VOUT = 5.0 V
VBAT = 5.5 V, VOUT = 3.3 V
VDD - VOUT端子間内蔵SW = ON
∆V = +0.1 V, VOUT = 5.5 V, VDD = 5.4 V∆V = +0.1 V, VOUT = 3.0 V, VDD = 2.9 V
RSWON1 = 20 Ω 〜 100 Ω
VBAT - VOUT端子間内蔵SW = ON
∆V = +0.1 V, VOUT = 5.5 V, VBAT = 5.4 V∆V = +0.1 V, VOUT = 3.0 V, VBAT = 2.9 V
RSWON1 = 33 Ω 〜 200 Ω

電気的特性

Min.
-0.5
-0.5

Typ.
–
–

Max.
0.5
0.5

単位

100

500

2000

kΩ

0.2

1.0

4.0

MΩ

2.0

10.0

40.0

MΩ

100

500

2000

kΩ

75
150
–
–
–
1

150
300
–
–
–
–

300
600
50
50
150
5

kΩ
kΩ
nA
nA
nA
mA

500

–

3000

µA

µA

温度補償回路動作と消費電流
本機種は温度補償間隔ごとに温度センサーを動作させ、温度補償値の更新を行っているため、その期間は消費電流が増加します。IDD1, IDD2は、温度センサー測定動作の実行間隔 2 s 時の平均消費電流となります。
温度センサー測定動作期間 (約 0.52 ms)
温度センサー測定動作停止期間
IDD5, 6

平均消費電流IDD1, 2

IDD3, 4

温度補償間隔 (2 s)

図 5.1

温度補償回路動作と消費電流

バックアップ電源切り替え素子特性 (参考)
表 5.5
項 目

電源切り替え素子特性 (参考)
参考特性値

条 件

Pch-Switch 定格電流

40 mA Max.

SW1 = SW2 = SW3 = ON, +25 C

ダイオード順方向電圧 VF

0.60 V / 1 mA Typ.
0.85 V / 10 mA Typ.

VDD = 3.0 V, +25 C

ダイオード逆方向電流 IR

5 nA Max.

VR = 5.5 V, -40 C 〜 +105 C

RX4901CE/RX8901CE
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94

5

電気的特性

VDD

A
SW1

VOUT

RTC内部電源
SW2
SW3

主電源

VBAT
二次電池

図 5.2

二次電池充電経路図

1412Ichg (mA)

Ichg (mA)

10
8
6
4
2
0
0

図 5.3

1
2
3
Vdef = V DD – V BAT (V)VBAT充電特性 (VDD = 3.0 V)

4

50
45
40
35
30
25
20
15
10
5
0
0

図 5.4

2
4
Vdef = V DD – V BAT (V)6

VBAT充電特性 (VDD = 5.5 V)

32kHz 水晶振動子の温度特性とその時刻ズレ計算および RTC のバックアップ時間が簡単に求められる計算ツールを
弊社ホームページにご用意しておりますのでご利用ください。
以下の弊社リンクからダウンロードください。
リンク→ "RTC モジュール便利ツール"

RX4901CE/RX8901CE
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5

電気的特性

5.5 AC特性
RX4901CE AC特性
表 5.6RX4901CE AC特性

特記無き場合: GND = 0 V, VDD = 1.6 V 〜 5.5 V, Ta = -40 C 〜 +105 C
項 目記号

VDD = 1.8 V ± 0.2 V VDD = 3.0 V ± 10 % VDD = 5.0 V ± 10 %

条 件

Min.

Max.

Min.

Max.

Min.

Max.

単位

CLKクロック周期

tCLK

500

–

332

–

250

–

ns

CLK “H”パルス幅

tWH

250

–

166

–

125

–

ns

CLK “L”パルス幅

tWL

250

–

166

–

125

–

ns

CLK立ち上がり･立ち下り時間

tRF

–

100

–

50

–

40

ns

CLKセットアップ時間

tCLKS

50

–

30

–

30

–

ns

CEセットアップ時間

tCS

200

–

150

–

130

–

ns

CE保持時間

tCH

200

–

150

–

130

–

ns

CEリカバリー時間

tCR

300

–

200

–

150

–

ns

CE立ち上がり･立ち下り時間

tCERF

–

100

–

50

–

40

ns

書き込みデータセットアップ時間

tDS

100

–

50

–

40

–

ns

書き込みデータ保持時間

tDH

100

–

50

–

40

–

ns

読み出しデータ遅延時間

tRD

CL = 50 pF

–

200

–

150

–

150

ns

DO (DIO) 出力ディセーブル時間

tRZ

CL = 50 pF, RL = 10 kΩ

–

200

–

120

–

110

ns

1 VDD = 2.0 V 〜 2.7 VまではVDD = 1.8 V ± 0.2 V規格を、VDD = 3.3 V 〜 4.5 VまではVDD = 3.0 V ± 10%規格を使用してください。

CE
tCERF
tCLKS

tCS
tRF

tDH

M3

M2

A0
tRD

Hi-Z

DO

DIO

tCR

20%

tDS

DI

tCERF
tCH

80%

CLK
READ

tCLK
tWL tWH

tRF

tRZ
D7

D6

D0

M3

M2

A0

D7

D6

D0

M3

M2

A0

D7

D6

D0

A0

D7

D6

D0

WRITE
DI

Hi-Z

DO

DIO

M3

M2

* CLKおよびDI、DIOは、ノーマルモードでは、フローティング状態にならないようにしてください。

図 5.5

RX4901CE AC特性 (SPIタイミングチャート)

RX4901CE/RX8901CE
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5

電気的特性

RX8901CE AC特性
表 5.7RX8901CE AC特性

特記無き場合: GND = 0 V, VDD = 1.6 V 〜 5.5 V, Ta = -40 C 〜 +105 C
項 目

100kHz アクセス
(Standard mode)

記号400kHz アクセス
(Fast mode)

Min.

Max.

Min.

Max.

単位

SCLクロック周波数

fSCL

–

100

–

400

kHz

スタートコンディションセットアップ時間

tSU;STA

4.7

–

0.6

–

µs

スタートコンディションホールド時間

tHD;STA

4.0

–

0.6

–

µs

データセットアップ時間

tSU;DAT

250

–

100

–

ns

データホールド時間

tHD;DAT

0

–

0

–

ns

ストップコンディションセットアップ時間

tSU;STO

4.0

–

0.6

–

µs

ストップ-スタートコンディション間のバスフリー時間 tBUF

4.7

–

1.3

–

µs

SCL “L”時間

tLOW

4.7

–

1.3

–

µs

SCL “H”時間

tHIGH

4.0

–

0.6

–

µs

SCL,SDA立ち上がり時間

tr

–

1.0

–

0.3

µs

SCL,SDA立ち下がり時間

tf

–

0.3

–

0.3

µs

バス上の許容スパイク時間

tSP

–

50

–

50

ns

STOP
condition
(P)

START
condition(S)

ProtocolSTART
condition(S)
tSU;STA

Bit 7
MSB
(A7)
tLOW

Bit 6
(A6)

tHIGH

Bit 0
LSB
(R/W)

ACK
(A)

1/fSCLtSU;STA

SCL
(S)

tr

(P)

tf

SDA

tBUF

(S)

(A)

tHD;STAtSU;DAT

図 5.6

tHD;DATtSPtSU;STO

tHD;STA

RX8901CE AC特性 (I2C-Busタイミングチャート)

1 スレーブアドレス確定後、内部1 Hzクロック2カウントでI2C-BusインターフェイスがリセットされてSDAがHi-Zになります。このため、
I2C-Bus通信はスレーブアドレス送信からストップコンディションの生成までを1秒以内に完了してください。
2 データ書き込み時は8ビットデータ送信後のACKビットのSCL立ち上りで8ビットデータを取り込みます。8ビットデータ取込み前に通信が遮断された場合、8ビット未達のデータは書き込まれません。

RX4901CE/RX8901CE
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97

5

電気的特性

5.6 電源投入特性
表 5.8

電源投入特性

特記無き場合: GND = 0 V, VDD = 1.6 V 〜 5.5 V, Ta = -40 C 〜 +105 C
記号

条 件

Min.

Typ.

Max.

単位

初期電源立ち上げ時間1, *2

tR1

VDDまたはVBATに電源投入後、VDDまたはVBAT電圧が 3 V
GNDから上昇する電圧スロープ、電源電圧変動率 5 V

0.1

–

10

ms/V

0.5

–

10

ms/V

電源投入時アクセス待機時間

tCL

VDD = VACC (Min.)到達後、アクセス開始可能となる時間

40

–

–

ms

アクセス終了から、VDD電圧をtFのスロープで降下させるまでの待機時間

0

–

–

ms

項 目

電源降下前アクセス終了保持時間 tCD
電源立ち下げ時間tF

VDD電圧が下降する電圧スロープ、電源電圧変動率

1

–

–

ms/V

電源復帰立ち上げ時間tR2

VDDに電源再投入、あるいは再上昇する際の、VDD電圧が上昇する電圧スロープ、電源電圧変動率

0.1

–

–

ms/V

電源立上後アクセス待機時間tCU

電源復帰からVDD = VACC (Min.)到達後、アクセス開始可能と
なる時間

40

–

–

ms

1 パワーオンリセットは、VDD、VBATどちらか先に入力された電源で機能します。パワーオンリセットを確実に実行させるため、初期電源投入時は電源立ち上げ時間を満足させると共に、必ずGNDレベルから電源を立ち上げてください。
確実にパワーオンリセットを有効とするためには、電源OFF後、VDD = GNDの状態を100ms以上確保してください。
2 初回電源投入時のVDD電圧は、+VDET1以上まで上昇させてください。
3 バックアップ期間は電源に対するノイズ特性を示すものではありません。バックアップ期間は十分に長い時間とします。(60秒以上)
4 バックアップ中のVDD電圧監視は31.25 ms間隔の間欠動作のため、VDDが+VDET1に到達後から電源が切り替わるまでに最大31.25 msの遅延が生じます。
VDD

tR1

tF

VACC (Min.)+VDET1VCLK (Min.)
GND
VOUT

VACC (Min.)-VDET1VDD OFF時間

VBAT駆動+VDET1

バックアップ期間

VDD駆動

VMAIN
VBATTERY - Vf (SW2)+VDET1VCLK (Min.)
GND

VBAT

tR2

VMAIN

VDD駆動

VBAT駆動

VBATTERY-VDET1VCLK (Min.)+VDET1tR1

VBATTERY
GND
VLF、0クリア可能 ⇒レジスターアクセス可能

インターフェイスtCL

VLF、0クリア可能 ⇒レジスターアクセス可能
tCD

図 5.7

電源投入シーケンス

RX4901CE/RX8901CE
ETM63J-02

tCU

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98

6

パッケージ

6 パッケージ
6.1 外形寸法図• 外形寸法図• 推奨はんだ付けパターン図

0.9
1.1

*1

0.2 Min.

1.0 Max.

2.5 ± 0.2 (Typ. 2.54)

3.2 ± 0.2 (Typ. 3.24)

0.7

0.7

0.4

0.3

0.3

0.62

Unit: mm

0.42

0.4

0.35

1 パッケージの1ピンと10ピン側の短辺側面の金属パッドは、水晶振動子の検査用パッドです。
安定した発振のために、結露やほこりなどによるリーク電流がこのパッド間に生じないよう、
ご配慮ください。
5ピンと6ピン側の短辺側面の金属パッドは、RTC内部で接続されていません。

図 6.1

外形寸法図

6.2 マーキングレイアウト
(1)

(2)

(1) ロゴ(2) 形式(3)

R####S(3) 精度

A123A
(4)

(5)

(6)

R
4901
8901
S
B

(4) 1番ピンマーク(5) 製品オプション (例) A(6) 製造ロット

1→ RX→ RX4901CE→ RX8901CE→ 精度 XS→ 精度 XB→ Option A

1 表示内容は捺印と表示の大略を示すもので、字形、大きさ、および位置の詳細を規定するもの
ではありません。

図 6.2

マーキングレイアウト

RX4901CE/RX8901CE
ETM63J-02

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7

実装上の注意事項

7 実装上の注意事項
本モジュールは水晶振動子を内蔵していますので、過大な衝撃や振動を与えないでください。また、低消費電力実現のためにCMOSプロセスを採用していますので、実装作業時には静電気対策を実施してください。

静電気
本モジュールは静電気破壊保護回路を内蔵していますが、過大な静電気が加わると内部回路が破壊される
おそれがありますので、梱包および運搬容器には導電性素材を使用してください。
はんだごてや測定回路などは高電圧リークのないものを使用し、実装時や作業時も静電気対策をお願いします。

ノイズ
電源および入出力端子に過大な外来ノイズが印加されると、誤動作やラッチアップ等により内部回路が破壊されることがあります。安定動作のため本モジュールの電源端子のできるだけ近い場所に0.1 µF以上のセ
ラミックキャパシタを接続してください。また、本モジュールの近くには大きなノイズを発生するデバイスを配置しないでください。

入力端子の電圧
入力端子に許容範囲外の電圧が定常的に入力されると貫通電流が発生し、消費電流の増加やラッチアップなどの原因となり内部回路が破壊されることがあります。入力端子には入力電圧仕様に従いVIL Max.以下
VIH Min.以上の電圧を入力してください。

未使用入力端子の処理
入力端子の開放状態 = オープンでの使用は消費電流の増加や品質劣化の原因になります。内蔵のプルアッ
プ、またはプルダウン機能が適用されない未使用の入力端子は、VDDまたはGNDに固定してください。

はんだ付け温度パッケージ内部が+260°Cを超えるようなはんだ付けは、水晶振動子の特性劣化や内部回路の破壊につながります。弊社が提供するはんだ耐熱性評価プロファイルの範囲内となるように、実装前に温度や時間などの実装条件を確認してください。

実装機
汎用実装機を使用する場合、その動作条件等によっては実装時の衝撃で内蔵水晶振動子が破壊される可能性がありますので事前に確認してください。動作条件を変更した場合も同様に確認してください。また、実装作業においても、十分な静電気対策をお願いします。

超音波洗浄
超音波洗浄は､使用条件によっては内蔵水晶振動子が共振破壊される場合があります。洗浄機の種類 / パ
ワー / 時間 / 槽内の状態等の使用条件はお客様ごとに異なりますので、超音波洗浄に対する本モジュールの保証はいたしかねます。

実装方向逆向きの実装は本モジュールの破壊の原因となります。方向を確認した上で実装を行ってください。

端子間リーク
製品が汚れている、または結露している状態での電源投入は端子間に電流リークが生じる原因になります。
洗浄後は乾燥させてから電源を投入してください。

RX4901CE/RX8901CE
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100

8

8 参考回路例

VDD

VDD
1

MCU

RX4901CE
VDD

VDD

0.1 F

SDIO

DIO

SCLK

CLK

SS

CE

VOUT
1.0 F

IRQ

/INT

GPIO

EVINn

SLEEP
CLOCK

FOUT

VBAT
0.1 F

GND

GND

図 8.1

3

RX4901CE
VDD
0.1 F

MISO

DO

MOSI

DI

SCLK

CLK

VOUT
1.0 F

SS

CE

IRQ

/INT

GPIO

EVINn

図 8.2

2

VDD

VDD

*1
*2
*3

2

一般的なMCUとの接続回路例 (RX4901CE Option A/B)

1

SLEEP
CLOCK
GND

2

Backup Battery

VDD

MCU

参考回路例

VBAT
0.1 F

FOUT
GND

2

2

2
3

Backup Battery

一般的なMCUとの接続回路例 (RX4901CE Option C/D)

/INT 端子のプルアップ抵抗は 1 k Ω ～10kΩ を推奨します。
各バイパスコンデンサは RX4901 端子の直近に設置してください。
バッテリーの保護としてこの抵抗を挿入する場合、少なくとも 100μA の電流が供給可能な抵抗値を設定してください。
93 ページ DC 特性 消費電流 10(IDD5)および消費電流 11(IDD6) 参照。
また、電池メーカーの推奨電流値および UL 規格等の仕様に適合させる場合はそれらを優先して設定してください。
100μA 以上の電流供給量を持たせた場合でも RTC が規定以上の電流を消費することは有りません。

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101

8

VDD

VDD
1

MCU

RX8901CE
VDD

VDD

0.1 F

SDA

SDA

SCL

SCL

IRQ

/INT

VOUT
1.0 F

GPIO

EVINn

SLEEP
CLOCK

FOUT
VBAT

GND

図 8.3

*2
*3

0.1 F

GND

Other
I2C-Bus Device

*1

参考回路例

2

2

2
3

Backup Battery

一般的なMCUとの接続回路例 (RX8901CE)

各プルアップ抵抗は 1 k Ω ～10kΩ を推奨します。
SDA, SCL 信号が AC タイミング特性を満足するかオシロスコープ等で確認してください。
各バイパスコンデンサは 8901CE 端子の直近に設置してください。
バッテリーの保護としてこの抵抗を挿入する場合、少なくとも 100μA の電流が供給可能な抵抗値を設定してください。
93 ページ DC 特性 消費電流 10(IDD5)および消費電流 11(IDD6) 参照。
また、電池メーカーの推奨電流値および UL 規格等の仕様に適合させる場合はそれらを優先して設定してください。
100μA 以上の電流供給量を持たせた場合でも RTC が規定以上の電流を消費することは有りません。

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102

図表一覧

図表一覧
図
図 1.1 RX4901CE Option A/Bブロック図 ............................................................................................................... 2
図 1.2 RX4901CE Option C/Dブロック図 .............................................................................................................. 3
図 1.3 RX8901CE Option A/Bブロック図 ............................................................................................................... 3
図 1.4 RX4901CE Option A/B端子配置図 ............................................................................................................ 4
図 1.5 RX4901CE Option C/D端子配置図 ............................................................................................................ 4
図 1.6 RX8901CE Option A/B端子配置図 ............................................................................................................ 4
図 2.1 電源切り替え回路 ....................................................................................................................................... 6
図 2.2 電源接続例 (1)........................................................................................................................................... 6
図 2.3 電源接続例 (2)........................................................................................................................................... 7
図 2.4 電源接続例 (3)........................................................................................................................................... 7
図 2.5 電源接続例 (4)........................................................................................................................................... 7
図 2.6 電源投入シーケンス .................................................................................................................................... 8
図 2.7 発振開始シーケンス .................................................................................................................................... 9
図 2.8 バックアップモードからの復帰 ...................................................................................................................... 9
図 2.9 状態遷移図 ............................................................................................................................................... 12
図 3.1 SPIデータフォーマット ................................................................................................................................ 13
図 3.2 SPIホストとRX4901CEの接続例 ............................................................................................................... 14
図 3.3 SPIデータライトアドレスデータ ................................................................................................................... 14
図 3.4 SPIレジスターライト ................................................................................................................................... 14
図 3.5 SPIデータリードアドレスデータ ................................................................................................................... 15
図 3.6 SPIレジスターリード .................................................................................................................................. 15
図 3.7 I2C-BusホストとRX8901CEの接続例 ........................................................................................................ 16
図 3.8 RX8901CEのI2C-Busスレーブアドレス...................................................................................................... 16
図 3.9 I2C-Busを介したレジスターライト................................................................................................................ 17
図 3.10 I2C-Busを介したレジスターリード ............................................................................................................. 17
図 3.11 時計/カレンダーカウンターの構成 ............................................................................................................ 18
図 3.12 SPIインターフェイス 計時/カレンダーカウンターアクセスタイミング ........................................................... 20
図 3.13 I2C-Busインターフェイス 計時/カレンダーカウンターアクセスタイミング ..................................................... 20
図 3.14 うるう秒挿入タイミング ............................................................................................................................. 22
図 3.15 時刻更新割り込み回路の構成 ................................................................................................................. 24
図 3.16 時刻更新割り込みタイミングチャート ........................................................................................................ 25
図 3.17 アラーム回路の構成................................................................................................................................ 26
図 3.18 アラーム割り込み回路の構成 .................................................................................................................. 28
図 3.19 アラーム割り込みタイミングチャート ......................................................................................................... 28
図 3.20 ウェイクアップタイマーの構成 .................................................................................................................. 29
図 3.21 ウェイクアップタイマーカウントアップ動作 ................................................................................................. 31
図 3.22 ウェイクアップタイマーカウント開始タイミング ........................................................................................... 31
図 3.23 ウェイクアップタイマー割り込み回路の構成.............................................................................................. 32
図 3.24 ウェイクアップタイマー割り込みタイミングチャート ..................................................................................... 33
図 3.25 FOUT出力回路の構成 ............................................................................................................................ 34
図 3.26 FOE制御によるFOUT出力 ..................................................................................................................... 35
図 3.27 電源切り替え回路 ................................................................................................................................... 38
図 3.28 電源投入 ～ 初期設定 ........................................................................................................................... 39
図 3.29 電源切り替え制御1 (VBATに一次電池を使用する場合)............................................................................. 40
図 3.30 電源切り替え制御2 (VBATに二次電池を使用する場合)............................................................................. 41
図 3.31 VDD電圧監視用SW1間欠動作................................................................................................................. 42
図 3.32 小容量EDLC使用時の注意..................................................................................................................... 43
図 3.33 タイムスタンプ回路の構成 ....................................................................................................................... 45
図 3.34 EVINのノイズフィルター機能 ................................................................................................................... 46
図 3.35 タイムスタンプデータと読み出しアドレス ................................................................................................... 47
図 3.36 FIFOモードのタイムスタンプバッファー ..................................................................................................... 48
図 3.37 各バッファ―に2回データをキャプチャーしたときのダイレクトモードのタイムスタンプバッファー .................. 48
図 3.38 タイムスタンプキャプチャー動作 (FIFOモード + オーバーライト禁止モード) ............................................ 52
図 3.39 タイムスタンプキャプチャー動作 (FIFOモード + オーバーライトモード).................................................... 53
図 3.40 タイムスタンプキャプチャー動作 (ダイレクトモード + オーバーライト禁止モード) ...................................... 54
図 3.41 タイムスタンプキャプチャー動作 (ダイレクトモード + オーバーライトモード) ............................................. 55
図 3.42 コマンドトリガータイミング ........................................................................................................................ 57
図 3.43 タイムスタンプ割り込み回路の構成.......................................................................................................... 62
図 5.1 温度補償回路動作と消費電流 ................................................................................................................... 94
図 5.2 二次電池充電経路図 ................................................................................................................................ 95
図 5.3 VBAT充電特性 (VDD = 3.0 V) ..................................................................................................................... 95
図 5.4 VBAT充電特性 (VDD = 5.5 V) ..................................................................................................................... 95
RX4901CE/RX8901CE
ETM63J-02

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103

図表一覧
図 5.5
図 5.6
図 5.7
図 6.1
図 6.2
図 8.1
図 8.2
図 8.3

RX4901CE AC特性 (SPIタイミングチャート) ............................................................................................. 96
RX8901CE AC特性 (I2C-Busタイミングチャート) ...................................................................................... 97
電源投入シーケンス .................................................................................................................................. 98
外形寸法図 ............................................................................................................................................... 99
マーキングレイアウト ................................................................................................................................. 99
一般的なMCUとの接続回路例 (RX4901CE Option A/B) ....................................................................... 101
一般的なMCUとの接続回路例 (RX4901CE Option C/D) ....................................................................... 101
一般的なMCUとの接続回路例 (RX8901CE) .......................................................................................... 102

表
表 1.1 製品ラインナップ ......................................................................................................................................... 1
表 1.2 特長 ............................................................................................................................................................ 1
表 1.3 端子説明 .................................................................................................................................................... 5
表 2.1 電源端子一覧 ............................................................................................................................................. 6
表 3.1 RX4901CE Option A/B SPIインターフェイス端子 ...................................................................................... 13
表 3.2 RX4901CE Option C/D SPIインターフェイス端子 ..................................................................................... 13
表 3.3 I2C-Busインターフェイス端子 ..................................................................................................................... 16
表 3.4 曜日の割り付け例 ..................................................................................................................................... 19
表 3.5 温度補償データの更新間隔....................................................................................................................... 23
表 3.6 時刻更新割り込みイベントの選択 .............................................................................................................. 24
表 3.7 ウェイクアップタイマーソースクロックの選択 ............................................................................................... 29
表 3.8 ウェイクアップタイマー割り込み周期 .......................................................................................................... 30
表 3.9 ノーマルモード/バックアップモードの動作条件設定 ..................................................................................... 30
表 3.10 ウェイクアップタイマーの動作制御 ........................................................................................................... 32
表 3.11 FOUT出力の選択 ................................................................................................................................... 34
表 3.12 動作モードによる検出動作 ...................................................................................................................... 42
表 3.13 SW1 OFF時間の設定 ............................................................................................................................. 42
表 3.14 EVINn端子のプルアップ/ダウン ............................................................................................................... 45
表 3.15 EVINn入力有効パルス幅 ........................................................................................................................ 46
表 3.16 EVINn入力検出エッジ ............................................................................................................................. 46
表 3.17 ダイレクトモードのBUF1 〜 BUF3 ......................................................................................................... 48
表 3.18 イベント検出割り込み要因と制御ビット ..................................................................................................... 62
表 4.1 FOUT出力の選択 ..................................................................................................................................... 72
表 4.2 時刻更新割り込みイベントの選択 .............................................................................................................. 72
表 4.3 ウェイクアップタイマーソースクロックの選択 ............................................................................................... 72
表 4.4 温度センサー測定動作の実行間隔 ........................................................................................................... 74
表 4.5 SUBSEC[9:0]ビット ................................................................................................................................... 75
表 4.6 EVINn端子のプルアップ/ダウン ................................................................................................................. 78
表 4.7 EVINn入力検出エッジ極性 ....................................................................................................................... 78
表 4.8 EVINn端子の入力有効パルス幅 ............................................................................................................... 78
表 4.9 割り込みを発生させるBUFnイベント入力数 ............................................................................................... 79
表 4.10 電源切り替えSWの固定 .......................................................................................................................... 83
表 4.11 SW1 OFF時間の設定 ............................................................................................................................. 83
表 5.1 絶対最大定格 ........................................................................................................................................... 92
表 5.2 推奨動作条件 ........................................................................................................................................... 92
表 5.3 周波数特性 ............................................................................................................................................... 92
表 5.4 DC特性 .................................................................................................................................................... 93
表 5.5 電源切り替え素子特性 (参考) .................................................................................................................. 94
表 5.6 RX4901CE AC特性 ................................................................................................................................. 96
表 5.7 RX8901CE AC特性 ................................................................................................................................. 97
表 5.8 電源投入特性 ........................................................................................................................................... 98

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