アプリケーションマニュアル
Real Time Clock Module

RA4000CE/RA8000CE

製品名称
RA4000CE YB A0
RA4000CE YB B8RA4000CE YB C0
RA4000CE YB D0
RA4000CE YB E8
RA8000CE YB A0
RA8000CE YB B8RA8000CE YB C0
RA8000CE YB D0

製品型番X1B000491A00115
X1B000491A00915
X1B000491A01015
X1B000491A01115
X1B000491A01915
X1B000501A00115
X1B000501A00915
X1B000501A01015
X1B000501A01115

本マニュアルのご使用につきましては、次の点にご留意願います。
1.

本資料の内容については、予告無く変更することがあります。弊社製品のご購入およびご使用にあたりましては事前に弊社営業窓口で最新の情報をご確認いただきますとともに、弊社ホームページなどを通じて公開される最新情報に常にご注意ください。

2.

本資料の一部または全部を、弊社に無断で転載または複製など他の目的に使用することは堅くお断りします。

3.

本資料に掲載されている応用回路、プログラム、使用方法などはあくまでも参考情報であり、これらに起因する第三者の知的財権およびその他の権利侵害ならびに損害の発生に対し、弊社はいかなる保証を行うものではありません。また、本資料によって第三者または弊社の知的財産権およびその他の権利の実施権の許諾を行うものではありません。

4.

弊社製品のご使用にあたりましては、弊社製品の誤作動や故障により生命・身体に危害を及ぼすことまたは財産が侵害されることのないよ
うに、お客様の責任において、お客様のハードウェア、ソフトウェア、システムに必要な安全設計を行うようお願いします。
なお、設計および使用に際しては、弊社製品に関する最新の情報 (本資料、仕様書、データシート、マニュアル、弊社ホームページなど)をご確認いただき、それに従ってください。また、上記資料などに掲載されている製品データ、図、表などに示す技術的な内容、プログラム、アルゴリズムその他応用回路例などの情報を使用する場合は、お客様の製品単独およびシステム全体で十分に評価を行い、お客様の責任において適用可否の判断をお願いします。

5.

弊社は正確さを期すために慎重に本資料を作成しておりますが、本資料に掲載されている情報に誤りがないことを保証するものではありません。万一、本資料に掲載されている情報の誤りによってお客様に損害が生じた場合においても、弊社は一切その責任を負いかねます。

6.

弊社製品の分解、解析、リバースエンジニアリング、改造、改変、翻案、複製などは堅くお断りします。

7.

弊社製品は、一般電子機器製品用途および弊社指定用途に使用されることを意図して設計、開発、製造しています (指定用途)。この指定
用途の範囲を超えて、特別または高度な品質、信頼性が要求され、その誤動作や故障により生命・身体に危害を及ぼす恐れ、膨大な財物損
害を引き起こす恐れ、もしくは社会に深刻な影響を及ぼす恐れのある以下を含む用途 (特定用途) に使用されることを意図していません。
【特定用途】
宇宙機器 (人工衛星・ロケットなど) / 輸送車両並びにその制御機器
医療機器 / 海底中継機器 / 発電所制御機器/防災・防犯装置 / 交通用機器 / 金融関連機器
上記と同等の信頼性を必要とする用途
お客様におかれましては、製品を指定用途に限定して使用されることを強く推奨いたします。もし指定用途以外の用途で製品のご使用およびご購入を希望される場合、弊社はお客様の特定用途に弊社製品を使用されることへの商品性、適合性、安全性について、明示的・黙示的に関わらず、いかなる保証をおこなうものではありません。お客様が特定用途での弊社製品の使用を希望される場合は、弊社営業窓口まで
事前にご連絡ください。

8.

本資料に掲載されている弊社製品および弊社技術を国内外の法令および規制により製造・使用・販売が禁止されている機器・システムに使用することはできません。また、弊社製品および弊社技術を大量破壊兵器等の開発目的、および軍事利用の目的、その他軍事用途等に使用しないでください。弊社製品または弊社技術を輸出または海外に提供する場合は、「外国為替及び外国為替法」、「米国輸出管理規則(EAR)」、その他輸出関連法令を遵守し、係る法令の定めるところにより必要な手続きを行ってください。

9.

弊社は、お客様が本資料に掲載されている諸条件に反したことに起因して生じたいかなる損害 (直接・間接を問わず) に関して、一切その責任を負いかねます。また、お客様が弊社製品を第三者に譲渡、貸与などをしたことにより、損害 (直接・間接を問わず) が発生した場
合、弊社は一切その責任を負いかねます。

10. 本資料についての詳細に関するお問合せ、その他お気付きの点などがありましたら、弊社営業窓口までご連絡ください。
11. 本資料に掲載されている会社名、商品名は、各社の商標または登録商標です。

©Seiko Epson Corporation 2022, All rights reserved.

ETM64J 改訂履歴
Rev. No.

Date

01

2021/12/06

Page

All

Description

新規制定
2.2.1 電源投入シーケンス

P8

P20

「電源をOFFした後に再度電源をONする場合は必ずGNDレベルのOFF期間を10秒以上確保し、その後は初回の電源立上げの仕様を満足するように電源を投入して下さい。
」を以下に変更。
「電源をOFFした後に再度電源をONする場合は必ずGNDレベルのOFF期間を100ms以上確保し、その後は初回の電源立上げの仕様を満足するように電源を投入して下さい。
」
図3.11 SEC_BINカウンター

レジスタアドレスの誤記修正

BINモード

P25～P27

・SEC_BIN0 ～ SEC_BIN4のレジスタシンボル名を変更（_MIRを削除）
・SEC_BIN0 ～ SEC_BIN4のレジスタアドレスを変更（0x12 〜 0x16 (正)0x12 〜 0x16 (誤)）

レジスター
02

2022/07/29
P65, P66

・レジスタ一覧 Bank0 0x00~0x04のBIN modeをSEC_BIN0～4からNot usedに変更
・レジスタ一覧 Bank1 0x12~0x16のBIN modeをSEC_BIN0_MIR～4_MIRからSEC_BIN0～4に変更

レジスター
P72, P80

・レジスタ詳細説明のBank0 0x00~0x04のBIN mode、SEC_BIN0～4を削除
・レジスタ詳細説明のBank1 0x12~0x16のBIN mode、SEC_BIN0_MIR～
4_MIRのレジスタ名をSEC_BIN0～4に変更し、機能説明を0x00~0x04のSEC_BINから移動
電源投入シーケンス

P103「確実にパワーオンリセットを有効とするためには、電源OFF後、VDD=GNDの状態を10秒以上確保してください。
」を、以下の通りに変更。
「確実にパワーオンリセットを有効とするためには、電源OFF後、VDDがGNDレベルの状態を100ms以上確保してください。
」

RA4000CE/RA8000CE
ETM64J-02

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i

はじめに
本書は、セイコーエプソン製RTC (リアルタイムクロック) モジュールRA4000CEおよびRA8000CEの機能、制御方法、仕様、電気的特性を記載したアプリケーションマニュアルです。RA4000CE/RA8000CEを搭載する製品の設計者向けに作成されています。
RA4000CEはSPI、RA8000CEはI2C-Busを介してホストデバイスからアクセスします。これらのインターフェイ
スの動作および制御方法については、ホストデバイスのマニュアル等を参照してください。

本書内の表記や記号について
数値の表記
本マニュアルは、10進数、2進数、16進数の数値を扱います。
10進数
2進数
16進数

例: 1, 10, 123 (一般的な数値や日付、時刻など)
例: 0b0, 0b10, 0b1111 (制御ビットの設定値、読み出し値など)
例: 0x0, 0xF, 0xFF (アドレスやレジスターの設定値など)

レジスター/ビット名の表記
本マニュアルではレジスター名とビット名を次のように記載しています。
レジスター名:

レジスターSEC

ビット名:

TSTP_INTE.STOPビット
レジスターTSTP_INTE内のSTOPビットを表します。
TCTL.FSEL[1:0]ビット
レジスターTCTL内のFSEL1とFSEL0ビットの2ビットを表します。

チャネル番号の表記
タイムスタンプ機能にはチャネルごとに同一機能を持つ端子や制御ビットが用意されています。この端子名やビット名にはチャネル番号 (例: 1と2) が含まれています。特に分けて説明する必要がない場合、本書ではこの数値を“n”として複数チャネルを一括して説明しています。その他、名称の一部が共通な複数のビットを“***”を使用し、一つにまとめている場合もあります。
端子名:EVIN1、EVIN2 → EVINn

ビット名: EVINn_EN.EVIN1EN、EVINn_EN.EVIN2EN→ EVINn_EN.EVINnEN
EVINn_EN.EVIN1CPEN、CAP_EN.VTMPLCPENなど→ ***CPEN

RA4000CE/RA8000CE
ETM64J-02

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ii

目 次
ETM64J 改訂履歴 ................................................................................................................................ i
はじめに .............................................................................................................................................. ii
本書内の表記や記号について ............................................................................................................. ii
数値の表記 ..................................................................................................................................ii
レジスター/ビット名の表記 ........................................................................................................ii
チャネル番号の表記 ....................................................................................................................ii

目

次 iii

1 概要................................................................................................................................ 1
1.1

特長 ............................................................................................................................................... 11.2

ブロック図 .................................................................................................................................... 2
RA4000CE (3 線 SPI) ................................................................................................................ 2
RA4000CE (4 線 SPI) ................................................................................................................ 3
RA8000CE (I2C-Bus) ................................................................................................................. 4

1.3 端子 ............................................................................................................................................... 5
1.3.1 端子配置図 .............................................................................................................................. 5
RA4000CE ................................................................................................................................. 5
RA8000CE ................................................................................................................................. 51.3.2

端子説明 ................................................................................................................................. 6記号の意味 ................................................................................................................................. 62 電源と初期化 ................................................................................................................. 82.1

電源 ............................................................................................................................................... 8

2.2 初期化 ........................................................................................................................................... 8
2.2.1 電源投入シーケンス ............................................................................................................... 8
2.2.2 発振開始時間 .......................................................................................................................... 9
2.2.3 初期設定 ................................................................................................................................ 11
初期設定手順 (/RST 出力非搭載機種) ..................................................................................... 11
初期設定手順 (/RST 出力機能搭載機種) ................................................................................. 12

2.3

動作モード .................................................................................................................................. 13
POR 有効 ................................................................................................................................. 14
イニシャルモード .................................................................................................................... 14
ノーマルモード ........................................................................................................................ 14
セーフモード............................................................................................................................ 14

3 機能.............................................................................................................................. 15
3.1 ホストインターフェイス ............................................................................................................ 15
3.1.1 RA4000CE レジスターへのアクセス (SPI)......................................................................... 15
SPI インターフェイス端子 ...................................................................................................... 15
レジスターライト .................................................................................................................... 16
レジスターリード .................................................................................................................... 17

3.1.2

RA8000CE レジスターへのアクセス (I2C-Bus) .................................................................. 18
I2C-Bus インターフェイス端子 ................................................................................................ 18
スレーブアドレス .................................................................................................................... 18
レジスターライト .................................................................................................................... 18
レジスターリード .................................................................................................................... 19

3.2 時計/カレンダー機能 .................................................................................................................. 20
3.2.1 概要 ....................................................................................................................................... 20
3.2.2 動作 ....................................................................................................................................... 22
BCD モードと BIN モード ....................................................................................................... 22
計時バッファーを介した時計/カレンダーカウンターへのアクセス ....................................... 22
時計/カレンダーの初期設定と計時の開始 ............................................................................... 24
時計/カレンダーデータの読み出し .......................................................................................... 26
1/1024 秒のデータ読み出し/書き込み ..................................................................................... 27
RA4000CE/RA8000CE
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1/1024 秒のオフセット時刻合わせ .......................................................................................... 28
時計/カレンダーストップ手順 ................................................................................................. 29
うるう年の判定 ........................................................................................................................ 29
うるう秒補正手順 .................................................................................................................... 29

3.3 温度補償機能 .............................................................................................................................. 30
3.3.1 動作 ....................................................................................................................................... 30
温度補償間隔の設定 ................................................................................................................. 30
温度補償動作フラグ VTMPF フラグ(0x0E) .......................................................................... 30

3.4 論理緩急機能 .............................................................................................................................. 31
3.4.1 動作 ....................................................................................................................................... 31
論理緩急の動作 ........................................................................................................................ 31
補正量の設定............................................................................................................................ 31
論理緩急の開始 ........................................................................................................................ 32
論理緩急の停止 ........................................................................................................................ 32

3.4.2

論理緩急の他機能への影響 .................................................................................................. 32

3.5 時刻更新割り込み機能 ................................................................................................................ 33
3.5.1 概要 ....................................................................................................................................... 33
3.5.2 動作 ....................................................................................................................................... 33
割り込み周期の選択 ................................................................................................................. 33
割り込み許可/禁止手順 ............................................................................................................ 33
割り込み動作............................................................................................................................ 34

3.6 アラーム機能 .............................................................................................................................. 35
3.6.1 概要 ....................................................................................................................................... 35
3.6.2 動作 ....................................................................................................................................... 35
アラーム設定手順 .................................................................................................................... 35
アラーム設定例 ........................................................................................................................ 36
アラーム割り込み .................................................................................................................... 37

3.7 ウェイクアップタイマー機能 ..................................................................................................... 38
3.7.1 概要 ....................................................................................................................................... 38
3.7.2 動作 ....................................................................................................................................... 38
ソースクロック ........................................................................................................................ 38
カウントアップ/ダウンモード ................................................................................................. 39
プリセットデータ (ウェイクアップタイマー割り込み周期) .................................................. 39
カウント動作条件 (/RST 出力機能搭載機種のみ) ................................................................... 39
ウェイクアップタイマー設定手順 ........................................................................................... 40
カウントの開始 ........................................................................................................................ 40
一時停止 ................................................................................................................................... 41
カウンターデータの読み出し .................................................................................................. 42
カウンターのリセット ............................................................................................................. 42
ウェイクアップタイマー割り込み ........................................................................................... 43

3.8 FOUT 出力機能 ........................................................................................................................... 45
3.8.1 概要 ....................................................................................................................................... 45
3.8.2 動作 ....................................................................................................................................... 45
初期設定 ................................................................................................................................... 45
FOUT 出力の制御 (FOE 端子を使用しない場合).................................................................... 45
FOUT 出力の制御 (FOE 端子を使用する場合) ....................................................................... 46
FOUT 端子からのウェイクアップタイマー割り込み信号出力................................................ 46

3.9 リセット出力機能 ....................................................................................................................... 47
3.9.1 概要 ....................................................................................................................................... 47
3.9.2 動作 ....................................................................................................................................... 47
リセット出力用 VDD 電圧検出動作 ........................................................................................... 47
リセット出力フラグ ................................................................................................................. 47
リセット出力中の I/O 制御 ...................................................................................................... 47

3.10 自己監視機能 .............................................................................................................................. 48
RA4000CE/RA8000CE
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3.10.1 概要 ....................................................................................................................................... 48
3.10.2 自己監視フラグ .................................................................................................................... 48
パワーオンリセット発生検出: PORF フラグ .......................................................................... 48
水晶発振停止検出: OSCSTPF フラグ ..................................................................................... 48
日時データ無効警告: VLF フラグ ............................................................................................ 48
温度補償更新停止検出: VTMPLF フラグ ................................................................................. 48

3.10.3 自己監視フラグの端子出力機能 ........................................................................................... 48
3.11 タイムスタンプ機能 ................................................................................................................... 49
3.11.1 概要 ....................................................................................................................................... 49
3.11.2 タイムスタンプトリガー ...................................................................................................... 50
外部イベント入力 (EVINn 端子)トリガー ............................................................................... 50
内部イベントトリガー ............................................................................................................. 51
コマンドトリガー .................................................................................................................... 51

3.11.3 タイムスタンプバッファー .................................................................................................. 52
タイムスタンプデータ ............................................................................................................. 52
タイムスタンプバッファーの動作モード ................................................................................ 53
タイムスタンプバッファーの書き込みモード ......................................................................... 53

3.11.4 動作 ....................................................................................................................................... 54
初期設定 ................................................................................................................................... 54
タイムスタンプキャプチャー動作 ........................................................................................... 56
コマンドトリガーの発行 ......................................................................................................... 59
タイムスタンプデータの読み出し ........................................................................................... 60

3.11.5 タイムスタンプ (イベント検出) 割り込み .......................................................................... 62
3.11.6 SRAM モードでのリード/ライト ......................................................................................... 63
3.12 SOUT 出力機能 ........................................................................................................................... 64
ステータス出力 ........................................................................................................................ 64
DC 出力 .................................................................................................................................... 64

4 レジスター ................................................................................................................... 65
4.1

レジスター一覧 ........................................................................................................................... 65
記号の意味 ............................................................................................................................... 65
Bank 0 ...................................................................................................................................... 65
Bank 1 ...................................................................................................................................... 66
Bank 2 ...................................................................................................................................... 66
Bank 3 ...................................................................................................................................... 67
Bank 4 ...................................................................................................................................... 67
Bank 5 ...................................................................................................................................... 67
Bank 6/7 (ダイレクトモードでのタイムスタンプデータ (BCD) 読み出し時) ....................... 68
Bank 6/7 (ダイレクトモードでのタイムスタンプデータ (BIN) 読み出し時) ......................... 68
Bank 6/7 (SRAM モード) ......................................................................................................... 69

4.2

レジスター詳細説明 ................................................................................................................... 70
0x00: SEC (Second Data) [BCD モード] .............................................................................. 70
0x01: MIN (Minute Data) [BCD モード] ................................................................................. 70
0x02: HOUR (Hour Data) [BCD モード] ................................................................................ 70
0x03: WEEKDAY (Day-of-Week Data) [BCD モード] ........................................................... 70
0x04: DAY (Day Data) [BCD モード] ..................................................................................... 71
0x05: MONTH (Month Data) [BCD モード] ........................................................................... 71
0x06: YEAR (Year Data) [BCD モード] ................................................................................. 71
0x07: ALM_MIN (Minute Alarm) [BCD モード] ...................................................................... 72
0x08: ALM_HOUR (Hour Alarm) [BCD モード] ..................................................................... 72
0x09: ALM_WEEKDAY (Day-of-Week Alarm / Day Alarm) [BCD モード] ............................. 73
0x0A: WTCNT_L (Wakeup Timer Counter Low) ...................................................................... 74
0x0B: WTCNT_M (Wakeup Timer Counter Middle) ................................................................. 74
0x0C: WTCNT_H (Wakeup Timer Counter High) .................................................................... 74
0x0D: TCTL (Timer Control) ..................................................................................................... 74
0x0E: INTF (Status Flag) ......................................................................................................... 76
0x0F: TSTP_INTE (Timer Stop and Interrupt Enable) ............................................................. 77

RA4000CE/RA8000CE
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0x10: SUBSEC_L (Sub-Second Data Low) ............................................................................. 78
0x11: SUBSEC_H (Sub-Second Data High) ............................................................................ 78
0x12: SEC_MIR (Mirrored Second Data, = 0x00) [BCD モード] .......................................... 79
0x13: MIN_MIR (Mirrored Minute Data, = 0x01) [BCD モード] ............................................. 79
0x14: HOUR_MIR (Mirrored Hour Data, = 0x02) [BCD モード] ............................................ 80
0x15: WEEKDAY_MIR (Mirrored Day-of-Week Data, = 0x03) [BCD モード] ....................... 80
0x16: DAY_MIR (Mirrored Day Data, = 0x04) [BCD モード] ................................................ 80
0x17: MONTH_MIR (Mirrored Month Data, = 0x05) [BCD モード] ....................................... 80
0x18: YEAR_MIR (Mirrored Year Data, = 0x06) [BCD モード] ............................................. 80
0x12: SEC_BIN0 (Second Binary Data 0) [BIN モード] ........................................................ 80
0x13: SEC_BIN1 (Second Binary Data 1) [BIN モード] ........................................................ 80
0x14: SEC_BIN2 (Second Binary Data 2) [BIN モード] ........................................................ 80
0x15: SEC_BIN3 (Second Binary Data 3) [BIN モード] ........................................................ 80
0x16: SEC_BIN4 (Second Binary Data 4) [BIN モード] ........................................................ 80
0x19: OFS_SUBSEC_H (Offset Sub-Second Data High) ....................................................... 81
0x1A: OFS_SUBSEC_L (Offset Sub-Second Data Low) ........................................................ 81
0x1B: DIG_TRIM_H (Digital Trimming Data High) ................................................................... 82
0x1C: DIG_TRIM_L (Digital Trimming Data Low) .................................................................... 82
0x1D: TCTL_MIR (Mirrored Timer Control, = 0x0D) ................................................................ 82
0x1E: INTF_MIR (Mirrored Status Flag, = 0x0E) ..................................................................... 82
0x1F: CNTSEL (Counter Select) .............................................................................................. 82
0x20: EVIN_EN (Event Input Enable) ...................................................................................... 83
0x21: EVIN1_CFG (EVIN1 Configuration) ............................................................................... 84
0x23: EVIN2_CFG (EVIN2 Configuration) ............................................................................... 84
0x22: EVIN1_FLT (EVIN1 Noise Filter) .................................................................................... 84
0x24: EVIN2_FLT (EVIN2 Noise Filter) .................................................................................... 84
0x27: BUF1_CFG1 (BUF1 Configuration 1) ............................................................................ 85
0x28: BUF1_STAT (BUF1 Status) ........................................................................................... 86
0x29: BUF1_CFG2 (BUF1 Configuration 2) ............................................................................ 86
0x30: ALM_SEC (Second Alarm) ............................................................................................. 87
0x31: ALM_MIN_MIR (Mirrored Minute Alarm, = 0x07) ........................................................... 87
0x32: ALM_HOUR_MIR (Mirrored Hour Alarm, = 0x08) .......................................................... 87
0x33: ALM_WEEKDAY_MIR (Mirrored Day-of-Week Alarm / Day Alarm, = 0x09) .................. 87
0x34: UPDISEL (Time Update Interrupt Select) ...................................................................... 88
0x38: WTICFG (Wakeup Timer Interrupt Configuration) ......................................................... 88
0x39: WTCTL (Wakeup Timer Control) .................................................................................... 90
0x3A: WTCNT_L_MIR (Mirrored Wakeup Timer Counter Low, = 0x0A) ................................. 91
0x3B: WTCNT_M_MIR (Mirrored Wakeup Timer Counter Middle, = 0x0B) ............................ 91
0x3C: WTCNT_H_MIR (Mirrored Wakeup Timer Counter High, = 0x0C) ............................... 91
0x3D: TCTL_MIR (Mirrored Timer Control, = 0x0D) ................................................................ 91
0x3E: INTF_MIR (Mirrored Status Flag, = 0x0E) ..................................................................... 91
0x3F: TSTP_INTE_MIR (Mirrored Timer Stop and Interrupt Enable, = 0x0F) ......................... 91
0x41: WRCMD_CFG (Write Command Configuration) ........................................................... 91
0x42: WRCMD_TRG (Write Command Trigger) ...................................................................... 92
0x43: EVNT_INTE (Event Interrupt Enable) ............................................................................ 93
0x44: CAP_EN (Capture Enable) ............................................................................................ 93
0x45: INTF_MIR (Mirrored Status Flag, = 0x0E) ..................................................................... 94
0x46: BUF_INTF (Buffer Interrupt Factor) ............................................................................... 94
0x47: EVNT_INTF (Event Interrupt Factor) ............................................................................. 95
0x51: EVIN1_EVCNT (EVIN1 Event Counter) ......................................................................... 96
0x52: EVIN2_EVCNT (EVIN2 Event Counter) ......................................................................... 96
0x54: EVINMON (EVIN Monitor).............................................................................................. 96
0x55: SOUTCTL (SOUT Control)............................................................................................. 96

5 電気的特性 ................................................................................................................... 98
5.1

絶対最大定格 .............................................................................................................................. 985.2

推奨動作条件 .............................................................................................................................. 985.3周波数特性 .................................................................................................................................. 98

5.4

DC 特性 ....................................................................................................................................... 99

RA4000CE/RA8000CE
ETM64J-02

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DC 特性 .................................................................................................................................... 99
温度補償回路動作と消費電流 ................................................................................................ 100/RST 出力端子ありの場合の消費電流 ................................................................................... 100
状態遷移と自己監視機能の検出電圧 ..................................................................................... 100

5.5AC 特性 ..................................................................................................................................... 101
RA4000CE AC 特性 ............................................................................................................... 101
RA8000CE AC 特性 ............................................................................................................... 102

5.6

電源投入特性 ............................................................................................................................ 103

5.7

リセット出力特性 ..................................................................................................................... 104

6 パッケージ ................................................................................................................. 1056.1

外形寸法図 ................................................................................................................................ 105

6.2

マーキングレイアウト .............................................................................................................. 105

7 実装上の注意事項 ...................................................................................................... 106
静電気 .................................................................................................................................... 106
ノイズ .................................................................................................................................... 106
入力端子の電圧 ...................................................................................................................... 106
未使用入力端子の処理 ........................................................................................................... 106
はんだ付け温度 ...................................................................................................................... 106
実装機 .................................................................................................................................... 106
超音波洗浄 ............................................................................................................................. 106
実装方向 ................................................................................................................................. 106
端子間リーク.......................................................................................................................... 107
はんだ耐熱性評価プロファイル (参考) ................................................................................. 107

8 耐湿/静電耐圧特性 ..................................................................................................... 108
8.1

吸湿耐性水準 (MSL)................................................................................................................. 108

8.2

静電耐圧 .................................................................................................................................... 108

9 参考回路例 ................................................................................................................. 109
10 梱包情報 (参考) ......................................................................................................... 111
テーピング仕様 (TE0804L) ....................................................................................................111
リール仕様 ..............................................................................................................................111

図表一覧 ......................................................................................................................... 112
図 ............................................................................................................................................ 112
表 ............................................................................................................................................ 113

RA4000CE/RA8000CE
ETM64J-02

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vii

1

概要

1 概要
RA4000CE/RA8000CEは、32.768 kHzデジタル温度補償型水晶発振器 (DTCXO) を搭載し、AEC-Q100に準拠したリアルタイムクロックです。秒から年まで自動うるう年補正の時刻カレンダー回路、時刻アラーム、ウェイ
クアップタイマー、時刻更新割り込み、クロック出力、外部または内部イベント発生日時や自己監視機能による電源検出状態を2回記録可能なタイムスタンプ機能等の豊富な機能を備えています。本製品は低電力動作が可能なことに加え、AEC-Q100に準拠しており、車載用途に対応します。
・製品名称と各記号の意味は下記の通りです。
RA4000CE①

YB A 0② ③④① 機種名 CE タイプパッケージ 3.2 x 2.5 x 1.0 mm② 周波数精度③ Pin Option
A~E：Option A~E④ リセット出力機能
0：リセット機能無し
8：リセット機能有り（VDD 立下り時検出電圧：+2.4 V Typ.）
表 1.1 製品ラインナップ
製品名

インター

周波数

フェイス

精度 *1 入力 (EVINn)

RA4000CE Option A YB

クロック出力FOUT イネー

ステータス(/RST)(FOUT or /INT)

ブル (FOE)

出力 (SOUT)

外部イベント リセット出力

YB

2入力

–

✓

–

–

YB

2入力

✓

✓

–

–

RA4000CE Option C YB

YB

–

–

✓

–

–

RA4000CE Option D YB

YB

1入力

–

✓

–

✓

RA4000CE Option B YB

RA4000CE Option E YB

3線SPI

4線SPI

YB

1入力

✓

✓

–

✓

RA8000CE Option A YB

YB

2入力

–

✓

–

✓

RA8000CE Option B YB

YB

2入力

✓

✓

–

✓

YB

–

–

✓

–

–

YB

1入力

–

✓

✓

✓

RA8000CE Option C YB
RA8000CE Option D YB

I2C-Bus✓: あり、–: なし*1 精度 (YB) については、“5.3 周波数特性”の周波数安定度を参照してください。

1.1 特長表 1.2
製品ラインナップ特長

RA4000CE

RA8000CE
2

I C-Bus*1

ホストインターフェイス

3線SPIまたは4線SPI *1

水晶発振器• 32.768 kHzデジタル温度補償型水晶発振器 (DTCXO) を搭載

時計/カレンダー• 秒、分、時、日、月、年をカウントするBCDカウンターと曜日カウンターを搭載 [BCDモード]• 1/1024秒をカウントするバイナリーカウンターを搭載• UNIXタイム等の秒カウントが可能なバイナリーカウンターを搭載 [BINモード]• うるう年の自動補正機能搭載 うるう秒補正操作可能 [BCDモード]• 時刻更新割り込みを発生可能 (1秒、1分、1時間の各時刻 (カウンター) 更新時) [BCDモード]• 論理緩急機能を搭載

ウェイクアップタイマー• 976.56 µs ～ 32年周期で割り込みを発生可能• 積算時間計として使用可能• ウォッチドッグタイマーとして使用可能• EVIN2端子入力 (外部イベント入力) のユニバーサルカウンターとして使用可能

アラーム

秒から日 (または曜日) までを指定し、割り込みを発生可能 [BCDモード]

タイム
トリガー要因スタンプ• 外部イベント (EVINn) 入力 *1• 電源電圧低下検出/発振停止検出• ホストからのコマンド入力

記録データ• 1/1024秒データ• 時刻データ (秒、分、時、日、月、年 [BCDモード]、またはバイナリータイム[BINモード])• トリガー要因

RA4000CE/RA8000CE
ETM64J-02

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1
RA4000CE

製品ラインナップ

概要

RA8000CE• 内部ステータス
2イベント

記録可能なイベント数
クロック出力 (FOUT) *1• 32.768 kHz、1024 Hz、または1 Hz出力を選択可能• レジスターにより出力を制御可能

ステータス出力 (SOUT) *1

選択した内部フラグ (割り込みフラグ、電圧低下検出フラグ) の状態を出力可能

リセット出力*1

VDD電圧低下検出時にリセット信号を外部デバイスに出力可能

自己監視機能発振停止、VDD電圧低下を検出し割り込みを発生可能

動作電圧 (VDD)

1.60 V 〜 5.5 V

動作温度-40 °C 〜 +125 °C*1 表 1.1を参照してください。

1.2 ブロック図
RA4000CE (3線SPI)

Theoreticalregulation
Oscillator(DTCXO)

32.768 kHz/INTDivider
Clock/
calendarInterrupt
controller
GND

Alarm

/RST

/RST
controller

Option B

GND

FOUT
controller

FOUT

Wakeup timer
EVIN1
Event trigger
controller

EVIN2

Option A/B

GND

Pull-up/down
control

VDDTime stamp

CE
GND

Power
controller/
voltagedetector

Bus interface(3-wire SPI)

CLK
DIO

VDD
GND

RA4000CE Option A/B/C
図 1.1

RA4000CE Option A/B/Cブロック図

RA4000CE/RA8000CE
ETM64J-02

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1

概要

RA4000CE (4線SPI)

Theoreticalregulation
Oscillator(DTCXO)

32.768 kHz/INTDivider
Clock/
calendarInterrupt
controller
GND

Alarm
SOUT
controller

SOUT
/RST

/RST
controller

Option E

Wakeup timer

GND

EVIN2

GND

Pull-up/down
control

VDD

Event trigger
controllerTime stamp

CE
GND

Bus interface(4-wire SPI)

CLK
DO

Power
controller/
voltagedetector

DI

VDD
GND

RA4000CE Option D/E
図 1.2

RA4000CE Option D/Eブロック図

RA4000CE/RA8000CE
ETM64J-02

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1

概要

RA8000CE (I2C-Bus)

Theoreticalregulation
Oscillator(DTCXO)

32.768 kHz/INTDivider
Clock/
calendarInterrupt
controller
GND

Option A/B/D

Alarm

SOUT
controller

SOUT
/RST

/RST
controller

Option B

GND

FOUT

FOUT
controller

Wakeup timer

Event trigger
controllerTime stamp

FOE
Option D

EVIN1
Option A/B

EVIN2

Option A/B/D GND

Pull-up/down
control

VDD

Power
controller/
voltagedetector

SCL
Bus interface
(I2C)

SDA

GND

図 1.3

GND

RA8000CE Option A/B/C/D
RA8000CE Option A/B/C/Dブロック図

RA4000CE/RA8000CE
ETM64J-02

VDD

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1

概要

1.3 端子1.3.1 端子配置図
RA4000CE
端子名

No.

No.

端子名

端子名

No.

No.

端子名

EVIN1
VDD
CE
FOUT
N.C.

1
2
3
4
5

10
9
8
7
6

/INT
GND
CLK
DIO
EVIN2

EVIN1
VDD
CE
FOUT
/RST

1
2
3
4
5

10
9
8
7
6

/INT
GND
CLK
DIO
EVIN2

Option A

Option B

端子名

No.

No.

端子名

N.C.
VDD
CE
/INT
N.C.

1
2
3
4
5

10
9
8
7
6

N.C.
GND
CLK
DIO
N.C.

Option C
端子名

No.

No.

端子名

端子名

No.

No.

端子名

DI
VDD
CE
/INT
N.C.

1
2
3
4
5

10
9
8
7
6

SOUT
GND
CLK
DO
EVIN2

DI
VDD
CE
/INT
/RST

1
2
3
4
5

10
9
8
7
6

SOUT
GND
CLK
DO
EVIN2

Option D

Option E
図 1.4

RA4000CE端子配置図

RA8000CE
端子名

No.

No.

端子名

端子名

No.

No.

端子名

EVIN1
VDD
/INT
FOUT
N.C.

1
2
3
4
5

10
9
8
7
6

SOUT
GND
SCL
SDA
EVIN2

EVIN1
VDD
/INT
FOUT
/RST

1
2
3
4
5

10
9
8
7
6

SOUT
GND
SCL
SDA
EVIN2

Option A

Option B

端子名

No.

No.

端子名

端子名

No.

No.

端子名

N.C.
VDD
/INT
FOUT
N.C.

1
2
3
4
5

10
9
8
7
6

N.C.
GND
SCL
SDA
N.C.

FOE
VDD
/INT
FOUT
N.C.

1
2
3
4
5

10
9
8
7
6

SOUT
GND
SCL
SDA
EVIN2

Option C

Option D
図 1.5

RA8000CE端子配置図※ Option A, C, Dにおける「N.C.」No.1, 5, 6 PINは内蔵プルダウン抵抗が接続されます。
したがって、「N.C.」端子はオープンにしてください (電気的な接続をしないでください。)

RA4000CE/RA8000CE
ETM64J-02

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5

1

概要

1.3.2 端子説明
記号の意味
入出力

I:
O:
I/O:

初期状態

Hi-Z: ハイインピーダンス
PU: プルアップ
PD: プルダウン

機種別欄

✓:
–:

入力端子
出力端子
入出力端子

あり
なし
表 1.3

端子名 入出力 初期状態
EVIN1

I

EVIN2

端子説明

機能

RA4000CE

RA8000CE

A

B

C

D

E

A

B

C

D

外部イベント入力端子
PU✓(1 MΩ) これらの端子の入力信号がタイムスタンプのトリガーとして使用されます (リセット出力時 (セーフモード) でも検出可能)。
プログラマブルなプルアップ/プルダウン抵抗とノイズフィルターを内蔵 ✓しています。

✓

–

–

–

✓

✓

–

–

✓

–

✓

✓

✓

✓

–

✓

CLK

I

Hi-Z

3線/4線SPIシリアルクロック入力端子✓
本端子はノーマルモードではフローティング状態は禁止です。
WTICFG.RSTOPT1ビット = 0、且つセーフモードでは入力が無効となりフローティング状態が許可されます。

✓

✓

✓

✓

–

–

–

–

DIO

I/O

Hi-Z

3線SPIシリアルデータ入出力端子✓
ノーマルモード時の入力状態において本端子はフローティング状態禁止です。WTICFG.RSTOPT1ビット = 0、且つセーフモードでは入力が無効となりフローティング状態が許可されます。

✓

✓

–

–

–

–

–

–

DO

O

Hi-Z

4線SPIシリアルデータ出力端子–
本端子は、WTICFG.RSTOPT1ビット = 0、且つセーフモードでは出力が無効となりHi-Zになります。

–

–

✓

✓

–

–

–

–

DI

I

Hi-Z

4線SPIシリアルデータ入力端子–
本端子はノーマルモードではフローティング状態は禁止です。
WTICFG.RSTOPT1ビット = 0、且つセーフモードでは入力が無効となりフローティング状態が許可されます。

–

–

✓

✓

–

–

–

–

CE

I

3線/4線SPIスレーブセレクト入力端子PD✓(300 kΩ) プルダウン抵抗を内蔵しています。WTICFG.RSTOPT1ビット = 0、且つセーフモードでは入力が無効となりフローティング状態が許可されま
す。

✓

✓

✓

✓

–

–

–

–

SCL

I

Hi-Z

I2C-Busシリアルクロック入力端子–
本端子はノーマルモードではフローティング状態は禁止です。
WTICFG.RSTOPT1ビット = 0、且つセーフモードでは入力が無効となりフローティング状態が許可されます。外部で5.5 Vまでプルアップすることが可能です。

–

–

–

–

✓

✓

✓

✓

SDA

I/O

Hi-Z

I2C-Busシリアルデータ入出力端子 (N-chオープンドレイン)–
SCL信号に同期して、アドレス、データ、アクノリッジビットなどを入出力します。本端子は N-ch オープンドレイン出力です。外部で5.5 Vまで
プルアップすることが可能です。WTICFG.RSTOPT1ビット = 0、且つセーフモードでは入力が無効となりフローティング状態が許可されま
す。

–

–

–

–

✓

✓

✓

✓

FOUT

O

Hi-Z

クロック出力端子 (CMOS)✓
32.768 kHz、1024 Hz、1 Hz出力が選択可能です。
ウェイクアップタイマー割り込み出力 (CMOS) に切り替え可能です。
本端子は、WTICFG.RSTOPT0ビット = 0、且つセーフモードでは出力が無効となりHi-Zになります。

✓

–

–

–

✓

✓

✓

✓

FOE

I

Hi-Z

FOUT出力イネーブル入力端子–
H入力時、FOUT端子からレジスターで設定した周波数の矩形波が出力されます。L入力時、FOUT端子はHi-Z状態になります。本端子はノーマル
モードではフローティング状態は禁止です。WTICFG.RSTOPT1ビット =0、且つセーフモードでは入力が無効となりフローティング状態が許可さ
れます。

–

–

–

–

–

–

–

✓

/INT

O

Hi-Z

割り込み出力端子 (N-chオープンドレイン)✓
ウェイクアップタイマー/時刻更新/アラーム/イベント検出割り込み信号の出力が選択可能で、複数選択時はそれぞれのNOR出力となります。
本端子は、WTICFG.RSTOPT0ビット = 0、且つセーフモードでは出力が無効となりHi-Zになります。外部で5.5 Vまでプルアップすることが可能
です。

✓

✓

✓

✓

✓

✓

✓

✓

RA4000CE/RA8000CE
ETM64J-02

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6

1
端子名 入出力 初期状態

機能

RA4000CE

概要

RA8000CE

A

B

C

D

E

A

B

C

D

SOUT

O

Hi-Z

ステータス出力端子–
内部フラグ (TF/AF/UF/EF/VTMPLF/VLF) の一つを選択して、その状態を出力可能です。出力信号の極性も選択可能です。
本端子は、WTICFG.RSTOPT0ビット = 0、且つセーフモードでは出力が無効となりHi-Zになります。

–

–

✓

✓

✓

✓

–

✓

/RST

(I) /O

Hi-Z

リセット出力端子 (N-chオープンドレイン)–
VDD電圧の規定値未満への低下を検出した場合に、リセット信号を外部デバイスに出力可能です。VDD電圧が復帰 (既定値以上への上昇を検出) す
ると、その60 ms後にリセット出力が解除 (Hi-Z状態に設定) されます。
本端子は Nch オープンドレイン出力です。信号線の容量にあった適切なプルアップ抵抗を接続してください。外部プルアップ電圧はRTCのVDD以上の電圧としてください。
/RST端子のアサインされた機種(RA4000CE-B,E,RA8000CE-B)において、リセット出力機能を使用しない場合は、本端子をGNDに固定してく
ださい。

✓

–

–

✓

–

✓

–

–

VDD

–

–

主電源端子

✓

✓

✓

✓

✓

✓

✓

✓

✓

GND

–

–

グラウンド端子

✓

✓

✓

✓

✓

✓

✓

✓

✓

注: • 未使用の入力/入出力端子は、内蔵プルアップ/プルダウンが有効でない場合、オープンや中間電位にしないでください。
• 出力端子 (FOUT, SOUT, /INT, DO) を使用しない場合はオープンにしてください。
• /RST端子機能搭載機種で出力機能を使用しない場合は本端子をGNDに固定してください。
• 各入力端子はVDD電源電圧にかかわらず5.5 Vまで入力可能です。
• /INT出力端子はVDD電源電圧にかかわらず5.5 Vまでプルアップすることが可能です。
• /RST出力端子はVDD 〜 5.5 Vまでの範囲でプルアップすることが可能です。
• /RST端子機能未搭載機種はPin 5からLレベルが出力されます。オープンにしてください。

RA4000CE/RA8000CE
ETM64J-02

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7

2電源と初期化

2 電源と初期化
2.1 電源RA4000CE/RA8000CEの電源端子を下表に示します。
表 2.1

電源端子一覧

端子名

機能

VDD

主電源端子

GND

グラウンド端子RA4000CE/RA8000CEはVDDに供給されている電源電圧で動作します。
動作電源電圧範囲については、“5.2 推奨動作条件”を参照してください。
注: 基板設計において、バイパスコンデンサは可能な限りVDD端子の直近に配置してください。

2.2 初期化
2.2.1 電源投入シーケンス
RA4000CE/RA8000CEの電源投入時は、パワーオンリセットの処理が実行されます。確実にパワーオンリセッ
トを実行させるため、電源投入規格 (tR1、“5.6 電源投入特性”参照) の仕様を満足させてください。図 2.1のtCL
は、パワーオンリセットが解除されるまでの時間を示しています。
電源をOFFした後に再度電源をONする場合は、必ずGNDレベルのOFF期間を100ms以上確保し、その後は初回の電源立ち上げの仕様を満足するように、電源を再投入してください。

(1) /RST出力非搭載機種の場合
tR1

tF

tR2

VDD
電源VDD

VACC (Min.)VPOR (Max.)
GND+VDET1n

GND+VDET1n(VDD ≧ +VDET1n)VPOR (Min.)

内部 Vreg
内部POR-VDET1n

解除

解除

アサート

tSTA

インターフェイス

影響なし

t_int
tDELAY
128 ms 60 ms(Max.)

tCD
レジスターアクセス可能

レジスターアクセス可能
tDELAYS
188 ms(Max.)/RST

外部プルアップ (VDD)

tDELAYF

ノーマルモード期間

セーフモード期間

ノーマルモード期間(2) /RST出力機能搭載機種の場合
図 2.1

電源投入シーケンス

RA4000CE/RA8000CE
ETM64J-02

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82電源と初期化

2.2.2 発振開始時間
VDD電圧が投入されると、水晶発振回路が発振を開始します。また、VDD投入から40 ms後にホストインターフェ
イスが利用可能になります。ただし、時計/カレンダーカウンターの設定/読み出しができるようになるためには、水晶発振回路の内部波形の振幅が十分な大きさになるまでの待ち時間が必要です。これが、発振開始時間(tSTA、“5.3 周波数特性”参照)です。
/RST出力機能非搭載機種において、この待ち時間を確保するためには、INTF.OSCSTPFビットとINTF.VLFビットのクリアを繰り返し試行する方法か、VDD電圧の投入開始からtSTAが経過するまでホスト側で待機する方法があります。前者の方法は、時計/カレンダーカウンターを設定/読み出しできるようになるまでの待機時間が、より短くなります。一方後者の方法は、より待ち時間が長い分、水晶発振回路の周波数が安定するため、より高い時刻精度で時計/カレンダーカウンターを設定できます。
INTF.OSCSTPFビットとINTF.VLFビットは、水晶発振回路が発振を開始した直後は、発振停止検出によって1にセットされます。この間は、これらのビットにホストインターフェイスを介して0を書き込んでも、0にクリ
アできません。その後しだいに内部発振波形の振幅が成長すると、発振停止検出が解除され、INTF.OSCSTPF
ビットとINTF.VLFビットがクリア可能になります。したがって、任意の時間間隔でこれらのビットのクリアを試行し、クリアできるようになった時点で、時計/カレンダーカウンターの設定/読み出しが可能になります。
下記 (※) に示す機能のホストからの動作設定は、INTF.VLFビットクリア後に行ってください。
一方、/RST出力機能搭載機種は、VDD電圧が+VDET1nを上回るまでホストインターフェイスは遮断状態になります。VDD ≧ +VDET1n、且つtSTA経過後に/RST出力が解除され、通信が有効となり、すべてのレジスターアクセ
スが可能になります。
※

INTF.VLFビットクリア後に設定を行う必要がある機能:• 兼用端子の機能選択 (WTICFG. PINMUX[1:0]ビット設定)• 各種タイマー機能設定• FOUT出力の制御 (TCTL.FSEL[1:0]ビット設定)• 温度補償間隔の設定 (TSTP_INTE.CSEL[1:0]ビット設定)

RA4000CE/RA8000CE
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92電源と初期化

VDD
電源 (VDD)

VACC (Min.) (インターフェイス電圧)
VCLK (計時保持電圧)

GND
内部発振波形(イメージ)
INTF.VLFビットなどのフラグ確認のアクセスが可能

40 ms

VLF “1”VLF “0”VLFクリア可能でレジスタ設定が可能

FOUT
tSTA: 発振開始時間 (発振安定待ち時間)
時計/カレンダーなど
各種レジスタ設定が可能(1) /RST出力非搭載機種
VDD
電源 (VDD)

VACC (Min.) (インターフェイス電圧)
VCLK (計時保持電圧)

GND
内部発振波形(イメージ)FOUT/RST
tSTA: 発振開始時間 (発振安定待ち時間)
時計/カレンダーなど
各種レジスタ設定が可能

tSTA経過後にすべてのレジスターアクセスが可能になります。

(2) /RST出力機能搭載機種
図 2.2

発振開始シーケンス

RA4000CE/RA8000CE
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102電源と初期化

2.2.3 初期設定
初期電源投入時とINTF.VLFビット = 0 → 1を伴う電圧低下発生後は初期設定が必要です。
その一例を以下に示します。

初期設定手順 (/RST出力非搭載機種)
1.

初期電源投入後から40 ms以上の待ち時間を取る。

2.

POR解除と発振開始の検出 (INTF.VLFビットのポーリング)
INTF.VLFビットは、電源電圧の低下によるパワーオンリセットの発行、または発振停止を検出した場
合に1にセットされます。
2.1. INTF.VLFビットを読み出し、値が0だった場合は手順3へ
INTF.VLFビット = 1の場合は以下項目の2.2.～2.4.の処理を行います。
2.2. レジスターINTFに0x00を書き込み、FINTF.VLFビットのクリアの試行、及び割り込みフラグのクリアをする。
- PORFビット(パワーオンリセット検出フラグ)- OSCSTPFビット(発振停止検出フラグ)- UFビット(時刻更新割り込みフラグ)- TFビット(ウェイクアップタイマー割り込みフラグ)- AFビット(アラーム割り込みフラグ)- EVFビット(イベント検出割り込みフラグ)- VLFビット(RTC初期化割り込みフラグ)- VTMPLFビット(温度補償更新停止検出割り込みフラグ)
2.3. 任意の待ち時間を取る。
2.4. 手順2.1へ戻る

3.

割り込み/カウンターディスエーブル (レジスターTSTP_INTEに0x00を書き込む)- CSEL[1:0]ビット(温度補償動作間隔)- UIEビット(時刻更新割り込みディスエーブル)- TIEビット(ウェイクアップタイマー割り込みディスエーブル)- AIEビット(アラーム割り込みディスエーブル)- EIEビット(イベント発生割り込みディスエーブル)- STOPビット(カウンターストップ)

4.

現在時刻を設定する。
詳細は、“3.2 時計/カレンダー機能”を参照してください。

5.

アラームを設定する。
詳細は、“3.6 アラーム機能”を参照してください。

6.

ウェイクアップタイマーを設定する。
詳細は、“3.7 ウェイクアップタイマー機能”を参照してください。

RA4000CE/RA8000CE
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11

2

電源と初期化

初期設定手順 (/RST出力機能搭載機種)
1.

初期電源投入後、tSTA以上の待ち時間を取る。または、/RST出力が解除されていることを確認する。

2.

POR解除と発振開始の検出 (INTF.VLFビットのポーリング)
INTF.VLFビットは、電源電圧の低下によるパワーオンリセットの発行、または発振停止を検出した場
合に1にセットされます。
2.1. INTF.VLFビットを読み出し、値が0だった場合は手順3へ
INTF.VLFビット = 1の場合は以下項目の2.2.～2.4.の処理を行います。
2.2. レジスターINTFに0x00を書き込み、FINTF.VLFビットのクリアの試行、及び割り込みフラグのクリアをする。
- PORFビット(パワーオンリセット検出フラグ)- OSCSTPFビット(発振停止検出フラグ)- UFビット(時刻更新割り込みフラグ)- TFビット(ウェイクアップタイマー割り込みフラグ)- AFビット(アラーム割り込みフラグ)- EVFビット(イベント検出割り込みフラグ)- VLFビット(RTC初期化割り込みフラグ)- VTMPLFビット(温度補償更新停止検出割り込みフラグ)
2.3. 任意の待ち時間を取る。
2.4. 手順2.1へ戻る

3.

割り込み/カウンターディスエーブル (レジスターTSTP_INTEに0x00を書き込む)- CSEL[1:0]ビット(温度補償動作間隔)- UIEビット(時刻更新割り込みディスエーブル)- TIEビット(ウェイクアップタイマー割り込みディスエーブル)- AIEビット(アラーム割り込みディスエーブル)- EIEビット(イベント発生割り込みディスエーブル)- STOPビット(カウンターストップ)

4.

現在時刻を設定する。
詳細は、“3.2 時計/カレンダー機能”を参照してください。

5.

アラームを設定する。
詳細は、“3.6 アラーム機能”を参照してください。

6.

ウェイクアップタイマーを設定する。
詳細は、“3.7 ウェイクアップタイマー機能”を参照してください。

RA4000CE/RA8000CE
ETM64J-02

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122電源と初期化

2.3 動作モード
図 2.3にRA4000CE/RA8000CEの状態遷移図を示します。
VDD投入

ホストインターフェイス
遮断状 態を表す

POR有効(

INTF.VLF = 1*
INTF.PORF = 1*
INTF.OSCSTPF = 1*
32 kHz発振停止
Host I/F 不可)

1* ハードウェアによるセット
ホストインターフェイスでクリアできない

POR解除
VDD ≧ VACC (Min.)+ 40 ms経過

イニシャルモード(

INTF.VLF = 1*
INTF.PORF = 1*
INTF.OSCSTPF = 1*
32 kHz発振
Host I/F 可VDD電圧低下VDD < VCLK)

発振停止非検出(INTF.VLFのクリアが可能)+ 発振開始時間経過

ノーマルモード
通常動作可(1) /RST出力機能非搭載機種の場合
VDD投入

POR有効

(

INTF.VLF = 1*
INTF.PORF = 1*
INTF.OSCSTPF = 1*
32 kHz発振停止
Host I/F 不可/RST出力 = L

ホストインターフェイス
遮断状 態を表す)

ホストインターフェイス
レジスタ設定により遮断状 態の選択可能を表す
1* ハードウェアによるセット
ホストインターフェイスでクリアできない

POR解除
VDD ≧ VACC (Min.)VDD < VCLK

+ 発振開始時間経過
または/RST出力 = Hi-Zに変化

VDD < -VDET1

ノーマルモード

セーフモード/RST出力 = Hi-Z

ホストI/FとIOフローティングの可否をレジスタ選択/RST出力 = L

VDD ≧ +VDET1+ 60 msディレイ(2) /RST出力機能搭載機種の場合
図 2.3

状態遷移図

RA4000CE/RA8000CE
ETM64J-02

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2電源と初期化POR有効RA4000CE/RA8000CEがリセット状態です。ホストからアクセスすることはできません。
PORが有効であり、INTF.VLFビット = 1となります。
また、後述のノーマルモード、セーフモードからVDDがVCLKを下回ったことによりこの状態に遷移した場合
は、POR (パワーオンリセット) が実行されますので、内蔵水晶発振動作とレジスターによる計時データ等の保持は保証されません。ノーマルモードで動作中に、INTF.VLFビット = 1となった場合は、POR解除後に、イニシャルモードでのVLFクリアを経て、レジスター初期設定からやり直す必要があります。

イニシャルモード
POR解除後の発振開始状態であり、発振開始動作完了後にノーマルモードに移行します。ノーマルモードへの移行が完了したかどうかは、発振停止が非検出状態となり、INTF.VLFビットをゼロクリアできたことで判断可能です。

ノーマルモード
RA4000CE/RA8000CEが通常動作中で、ホストから時計/カレンダーカウンターを含む、レジスターアクセスが可能です。

セーフモードRA4000CE Option B/D, RA8000CE Option B (/RST出力機能搭載機種のみ有効)
これらの機種は、電源電圧VDDがVDD低下検出電圧-VDET1nを下回ると、/RST端子からリセット信号を出力します。その後、VDD電圧がVDD上昇検出電圧+VDET1n以上に復帰するとリセット出力は解除されます。リセッ
ト信号を出力している期間がセーフモードです。セーフモードでは、ホストインターフェイスは無効になり、FOE, CE, CLK, DI, DIO, SDA, SCL入力はフローティング状態にすることができます。また、DO, /INT,
FOUT, SOUT出力はHi-Zになります。これらの端子制御の有効・無効は、WTICFG.RSTOPT[1:0]ビットで選択が可能です。詳細は“3.9 リセット出力機能”を参照してください。

RA4000CE/RA8000CE
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3

機能

3 機能
3.1 ホストインターフェイス
RA4000CEはホストインターフェイスとしてSPIを、RA8000CEはI2C-Busインターフェイスを搭載し、スレーブ
デバイスとして機能します。

3.1.1 RA4000CEレジスターへのアクセス (SPI)
RA4000CEのレジスターはSPIバスを介してアクセスすることができます。RA4000CEのSPIインターフェイスの仕様は以下のとおりです。
•
•
•
•
•
•
•
•
•

インターフェイス形式 : RA4000CE Option A/B/C: 3線SPI、RA4000CE Option D/E: 4線SPI
スレーブデバイス
データ長: 8ビット
データフォーマット: MSBファースト
クロック極性: アイドル時HIGH
クロック位相: データを立ち上がりエッジでサンプリング、立ち下がりエッジでシフトアウト
最高通信速度: 4 Mbit/s
アドレスオートインクリメント機能を搭載
CE (スレーブセレクト) 入力にプルダウン抵抗を内蔵
Cycle No.

1

2

3

4

5

6

7

8

CLK
DIO/DI/DO

MSB

LSB

データを立ち上がりでサンプリング
データを立ち下がりでシフトアウト

図 3.1

SPIデータフォーマットSPIインターフェイス端子
RA4000CEには下表に示すSPIインターフェイス端子が用意されています。
表 3.1
端子名

RA4000CE Option A/B/C SPIインターフェイス端子

入出力

初期状態

CLK

I

Hi-Z

機能

SPIシリアルクロック入力端子

DIO

I/O

Hi-Z

SPIシリアルデータ入出力端子

CE

I

PD

SPIスレーブセレクト入力端子 (プルダウン抵抗を内蔵)

入出力

初期状態

CLK

I

Hi-Z

SPIシリアルクロック入力端子

DI

I

Hi-Z

SPIシリアルデータ入力端子

DO

O

Hi-Z

SPIシリアルデータ出力端子

CE

I

PD

SPIスレーブセレクト入力端子 (プルダウン抵抗を内蔵)

表 3.2
端子名

RA4000CE Option D/E SPIインターフェイス端子
機能

ホストとの接続
図 3.2にホストとの接続例を示します。

RA4000CE/RA8000CE
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3

ホスト(SPIマスター)

SS

CE

SDIO

DIO

SCLK

CLK

機能

RA4000CE Option A/B/C (SPIスレーブ)

3線SPI
SS

CE

SDI

DO

SDO

DI

SCLK

CLK

ホスト(SPIマスター)

RA4000CE Option D/E (SPIスレーブ)

4線SPI

図 3.2

SPIホストとRA4000CEの接続例

プルダウン抵抗 (CE端子)
RA4000CEはCE端子にプルダウン抵抗を内蔵しています。このプルダウン抵抗はソフトウェアによって切り離すことはできません。CE端子は常時プルダウンされます。

レジスターライト
ホストはCE信号をHIGHにしてRA4000CEをスレーブデバイスとして選択した後、同期クロック (CLK) と共に書き込みモードに設定したアドレスデータ (最初にデータを書き込むレジスターアドレス) と、8ビッ
ト単位の書き込みデータをRA4000CEのDIO (Option A/B/C) またはDI (Option D/E) 端子に送信します。図3.3にデータ書き込み時の最初に送信するアドレスデータのビット構成を示します。
Bit 7

Bit 6

Bit 5

Bit 4
Bit 3
Bit 2
Bit 1
7-bit address
0(0b000 0000–0b111 1111)↑ 0は書き込みモードを指定

図 3.3

Bit 0

SPIデータライトアドレスデータ

RA4000CEレジスターへのデータライト動作を図 3.4に示します。8ビットデータの書き込みごとに、指定されたレジスターへの書き込みが行われ、それと同時に、レジスターアドレスは下位4ビットのみ自動的にインクリメントされます。レジスターアドレスの下位4ビットが、0xFに達するとロールオーバーして0x0に戻ります。レジスターアドレスの上位3ビットは自動的にインクリメントしないため、アドレスの上位3ビットを変更する場合は、CE信号によるスレーブセレクトを一旦解除し (CE信号をLOWにする)、再度アドレス
データの送信を行ってください。
CE信号は最後の8ビットデータの送信が完了するまで解除しないでください。途中で解除した場合、途中まで送信された8ビット未満の書き込みデータは破棄され、レジスターには書き込まれません。
1つのレジスターへの書き込み
CE
CLK
DIO/DI 0 or 1

0

Raddr
(Address #)WRdata(Address #)0 or 1

複数レジスターへの連続書き込み
CE
CLK
DIO/DI 0 or 1

0

•••••

•••••

Raddr

WRdata 0

WRdata 1•••••(Address #)(Address #)(Address # + 1)

WRdata n

0 or 1(Address # + n)

レジスターへのデータ書き込みにより、レジスターアドレスがインクリメントされます。

■ ホスト →RA4000CE □RA4000CE → ホスト
Raddr:
最初にアクセスするレジスターアドレス
WRdata n: レジスターに書き込む8ビットデータ

図 3.4

SPIレジスターライト

RA4000CE/RA8000CE
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3

機能

レジスターリード
ホストはCE信号をHIGHにして、RA4000CEをスレーブデバイスとして選択した後、同期クロック (CLK) を出力します。同時にそのクロックに同期して、読み出しモードに設定したアドレスデータ (最初にデータを読み出すレジスターアドレス) をRA4000CEのDIO (Option A/B/C) またはDI (Option D/E) 端子に送信します。
アドレスデータを受け取ったRA4000CEは、8ビット単位の読み出しデータをクロックが停止するまでDIO(Option A/B/C) またはDO (Option D/E) 端子からホストに送信します。この間のDI端子の入力は無効になります。図 3.5にデータ読み出し時の最初に送信するアドレスデータのビット構成を示します。
Bit 7

Bit 6

Bit 5

Bit 4
Bit 3
Bit 2
Bit 1
7-bit address
1(0b000 0000–0b111 1111)↑ 1は読み出しモードを指定

図 3.5

Bit 0

SPIデータリードアドレスデータ

RA4000CEレジスターのデータリード動作を図 3.6に示します。8ビットデータの読み出しごとに、レジス
ターアドレスは下位4ビットのみ自動的にインクリメントされ、0xFに達するとロールオーバーして0x0に戻ります。
アドレスの上位3ビットを変更する場合は、CE信号によるスレーブセレクトを一旦解除し、再度アドレス
データの送信を行ってください。
1つのレジスターの読み出し
RA4000CE Option A/B/C
CE
CLK
DIO

0 or 11

Raddr(Address #)RDdata0 or 1(Address #)RA4000CE Option D/E
CE
CLK
DI

0 or 1

1

DO

Raddr
Hi-Z
(Address #)0 or 1
RDdata(Address #)

Hi-Z

•••••

•••••

Raddr

RDdata 0

RDdata 1•••••(Address #)(Address #)(Address # + 1)

複数レジスターの連続読み出し
RA4000CE Option A/B/C
CE
CLK
DIO

0 or 1

1

RDdata n

0 or 1(Address # + n)

レジスターの読み出しにより、レジスターアドレスがインクリメントされます。

RA4000CE Option D/E
CE
•••••

CLK
DI

0 or 1

1

DO

Raddr

•••••
•••••

0 or 1Hi-Z

RDdata 0

RDdata 1(Address #)(Address #)(Address # + 1)•••••

0 or 1
RDdata nHi-Z(Address # + n)

レジスターの読み出しにより、レジスターアドレスがインクリメントされます。

■ ホスト →RA4000CE □RA4000CE → ホスト
Raddr:
最初にアクセスするレジスターアドレス
RDdata n: レジスターから読み出した8ビットデータ

図 3.6

SPIレジスターリード

RA4000CE/RA8000CE
ETM64J-02

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3

機能

3.1.2 RA8000CEレジスターへのアクセス (I2C-Bus)
RA8000CEのレジスターはI2C-Busを介してアクセスすることができます。RA8000CEのI2C-Busインターフェイ
ス回路の仕様は以下のとおりです。
• スレーブデバイス• 標準モード (最大100 kbit/s)、およびファースト・モード (最大400 kbit/s) に対応• 7ビットスレーブアドレス 0x32

I2C-Busインターフェイス端子
RA8000CEには下表に示すI2C-Busインターフェイス端子が用意されています。
表 3.3
端子名

I2C-Busインターフェイス端子

入出力

初期状態

機能

SCL

I

Hi-Z

I2C-Busシリアルクロック入力端子

SDA

I/O

Hi-Z

I2C-Busシリアルデータ入出力端子 (N-chオープンドレイン)

ホストとの接続
図 3.7にホストとの接続例を示します。
VDD
I2C-Bus

シリアルデータ (SDA)
シリアルクロック (SCL)
SDA

SCL

ホスト

図 3.7

SDA

SCL

RA8000CE

I2C-BusホストとRA8000CEの接続例

スレーブアドレス
RA8000CEには、下記のとおり7ビットのスレーブアドレスが定義されています。
←
Bit 7
0

Bit 6
1

図 3.8

→
R/W
スレーブアドレス
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
1
0
0
1
0
*
* 0: 書き込みモード, 1: 読み出しモード

RA8000CEのI2C-Busスレーブアドレス

レジスターライト
ホストがスタートコンディションと書き込みモード指定のスレーブアドレスをI2C-Busに出力することにより、通信を開始します。続いて、データを書き込む最初の8ビットレジスターアドレスを出力します。その後、8ビット単位の書き込みデータを必要数出力し、最後にストップコンディションを出力します。
RA8000CEは8ビットの受信ごとにACKをホストに返し、続くデータの受信に備えます。RA8000CEレジス
ターへのデータライト動作を図 3.9に示します。レジスターへの8ビットデータの書き込みごとに、レジス
ターアドレスは下位4ビットのみ自動的にインクリメントされ、0xFに達するとロールオーバーして0x0に戻ります。
アドレスの上位4ビットを変更する場合はリピーテッドスタートコンディション、またはストップコンディ
ションとスタートコンディションを生成し、再度アドレスデータの送信を行ってください。
誤動作防止のため、スレーブアドレス受信から1秒以上経過してもストップコンディションが入力されず、
I2C-Busがビジー状態の場合、RA8000CEは自動的にI2C-Busインターフェイス回路を初期化してバスタイム
アウトします。その結果、SDAはHi-Zになり、スタートコンディション待ち状態になるため、通信を再開す
るにはスタートコンディションから送信し直してください。
RA4000CE/RA8000CE
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3

機能

1つのレジスターへの書き込み
I2C-Bus S

Saddr/W(0x64)A

Raddr
A(Address #)WRdataA(Address #)P

複数レジスターへの連続書き込み
I2C-Bus S

Saddr/WA

Raddr(0x64)

A(Address #)WRdata 0

A(Address #)WRdata 1

A•••••(Address #+1)

WRdata nA

P(Address #+n)

レジスターへのデータ書き込みにより、レジスターアドレスがインクリメントされます。

■ ホストによる動作□ RA8000CEによる動作
S: スタートコンディション, Sr: リピーテッドスタートコンディション,P: ストップコンディション, A: ACK, N: NACK,
Saddr/W: スレーブアドレス + W (0), Raddr: 最初にアクセスするレジスターアドレス,
WRdata n: レジスターに書き込む8ビットデータ

図 3.9

I2C-Busを介したレジスターライト

レジスターリード
ホストがスタートコンディションと書き込みモード指定のスレーブアドレスをI2C-Busに出力することにより、通信を開始します。続いて、データを読み出す最初の8ビットレジスターアドレスを出力します。その後、リピーテッドスタートコンディションと読み出しモード指定のスレーブアドレスを再度I2C-Busに出力します。このスレーブアドレスを受け取ったRA8000CEは8ビット単位の読み出しデータを、NACKを受信するまでホストに送信します。
ホストは各8ビットデータの受信後にACKをRA8000CEに返し、続くデータの送信を要求します。最後のデー
タを受信した場合、ホストはNACKを返し、ストップコンディションを生成して通信を終了します。
RA8000CEレジスターのデータリード動作を図 3.10に示します。8ビットデータの読み出しごとに、レジス
ターアドレスは下位4ビットのみ自動的にインクリメントされ、0xFに達するとロールオーバーして0x0に戻ります。
アドレスの上位4ビットを変更する場合は、リピーテッドスタートコンディション、またはストップコン
ディションとスタートコンディションを生成し、再度アドレスデータの送信を行ってください。
通信の最後に読み出されたアドレスはRA8000CEが保持しています。次回の読み出しを、読み出しアドレスを指定せずに、読み出しモード指定のスレーブアドレスの送信から開始した場合、RA8000CEは前回に続くアドレスからデータを出力します。
誤動作防止のため、スレーブアドレス受信から1秒以上経過してもストップコンディションが入力されず、
I2C-Busがビジー状態の場合、RA8000CEは自動的にI2C-Busインターフェイス回路を初期化してバスタイム
アウトします。その結果、SDAはHi-Zになり、スタートコンディション待ち状態になります。この状態でデータリードを続けると、読み出しデータはすべて0xFFになります。
通信を再開するにはスタートコンディションから送信し直してください。
1つのレジスターの読み出し
I2C-Bus S

Saddr/W(0x64)A

Raddr
A(Address #)Sr

Saddr/R(0x65)A

Sr

Saddr/RA

RDdataN(Address #)P

複数レジスターへの連続読み出し
I2C-Bus S

Saddr/W(0x64)

A

Raddr

A

(Address #)(0x65)

RDdata 1(Address #)A

RDdata 2A•••••(Address #+1)

RDdata nNP(Address #+n)

レジスターの読み出しにより、レジスターアドレスがインクリメントされます。

■ ホストによる動作□ RA8000CECEによる動作
S: スタートコンディション, Sr: リピーテッドスタートコンディション,P: ストップコンディション, A: ACK, N: NACK, Saddr/W: スレーブアドレス + W (0),Saddr/R: スレーブアドレス + R (1), Raddr: 最初にアクセスするレジスターアドレス,
RDdata n: レジスターから読み出した8ビットデータ

図 3.10I2C-Busを介したレジスターリード

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3

機能

3.2 時計/カレンダー機能
3.2.1 概要
時計/カレンダー機能の特長を以下に示します。
• 秒、分、時、日、月、年をカウントするBCDカウンターと曜日カウンターを搭載しています。[BCDモード]• UNIXタイム等のカウントが可能なバイナリーカウンターを搭載しています。[BINモード]• うるう年の自動補正機能を搭載しています。
（自動補正が有効な年は、01年～99年までの範囲です。
）また、うるう秒補正操作が可能です。[BCDモード]• 1/1024秒カウンター値の読み出し/書き込みが可能です。
• 計時バッファーを有し、計時カウンター動作に関わらず、任意のタイミングでアクセスが可能です。
図 3.11にカウンターの構成を示します。

点線で囲まれた部分は計時バッファーを指します。計時バッファーは一括読み出し、書き込み可能です。
カッコ内の値はミラーレジスターのアドレスです。

図 3.11

時計/カレンダーカウンターの構成

水晶発振回路デジタル温度補償型水晶発振回路 (DTCXO) で32.768 kHzクロックを発生します。

分周回路

32.768 kHzクロックを分周し、1024 Hz信号を生成します。

1/1024秒カウンター

1024 Hz信号をクロックとして0 ～ 1023/1024秒までをカウントするバイナリーカウン
ターです。このカウンターの計時開始時の初期値は、レジスターSECに秒カウンターの設定を書き込むことで0にクリアしたり、このカウンターに値を直接書き込むことで設定できます。また計時期間中は、調整したい時刻オフセットをレジスター
OFS_SUBSEC_H, L に 指 定 す る こ と で 、 1/1024 秒 単 位 の 時 刻 合 わ せ が 可 能 で す 。
TSTP_INTE.STOPビットに1を設定すると、このカウンターのカウント動作が停止します。

秒カウンター

1 Hz信号をクロックとして0 ～ 59秒までをカウントするBCDカウンターです。秒更新
時に時刻更新割り込みを発生可能です。レジスターSECまたはSEC_MIR (アドレス0x00
または0x12) で設定および読み出しが可能です。

分カウンター

秒カウンターのオーバーフロー信号をクロックとして0 ～ 59分までをカウントする
BCDカウンターです。分更新時に時刻更新割り込みを発生可能です。レジスターMINまたはMIN_MIR (アドレス0x01または0x13) で設定および読み出しが可能です。

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3

機能

時カウンター

分カウンターのオーバーフロー信号をクロックとして0 ～ 23時までをカウントする
BCDカウンターです (24時間制固定)。時更新時に時刻更新割り込みを発生可能です。
レジスターHOURまたはHOUR_MIR (アドレス0x02または0x14) で設定および読み出しが可能です。

日カウンター

時カウンターのオーバーフロー信号をクロックとして、月やうるう年に合わせ1 ～28/29/30/31までをカウントするBCDカウンターです。カウント値は1からとなり、0はス
キップされます。レジスターDAYまたはDAY_MIR (アドレス0x04または0x16) で設定および読み出しが可能です。

曜日カウンター

7ビットのカウンターで、日カウンターに連動してビットがシフトされます。ビット0 ～ビット6が各曜日に個々に対応します。各ビットの曜日への割り付けは任意です。ただし、曜日の更新順序とビットシフトの方向を合わせて割り付けてください。レジスター
WEEKDAYまたはWEEKDAY_MIR (アドレス0x03または0x15) で設定および読み出しが
可能です。
表 3.4

曜日の割り付け例(Bit 7)

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

16進数

日曜

–

0

0

0

0

0

0

1

0x01

月曜

–

0

0

0

0

0

1

0

0x02

火曜

–

0

0

0

0

1

0

0

0x04

水曜

–

0

0

0

1

0

0

0

0x08

木曜

–

0

0

1

0

0

0

0

0x10

金曜

–

0

1

0

0

0

0

0

0x20

土曜

–

1

0

0

0

0

0

0

0x40

曜日

月カウンター

日カウンターのオーバーフロー信号をクロックとして1月 ～ 12月までをカウントするBCDカウンターです。カウント値は1 ～ 12で、0はスキップされます。レジスター
MONTHまたはMONTH_MIR (アドレス0x05または0x17) で設定および読み出しが可能です。

年カウンター

月カウンターのオーバーフロー信号をクロックとして0年 ～ 99年までをカウントするBCDカウンターです。レジスターYEARまたはYEAR_MIR (アドレス0x06または0x18)
で設定および読み出しが可能です。

33ビットバイナリーカウンター
1 Hz信号をクロックとして、UNIXタイムなど、秒数のカウントを行うバイナリーカウ
ンターです。UNIXタイムのカウンターとして使用する場合、UNIXエポック (1970/01/01
0:00:00 UTC) を0として2242/03/16 12:56:31までカウント可能です。また、NTPタイムス
タンプのカウンターとして使用する場合は、NTPエポック (1900/01/01 0:00:00 UTC) を0として2172/03/14 12:56:31までカウント可能です。
※ 温度補償回路、論理緩急回路、時刻更新割り込みについては、それぞれ、“3.3 温度補償機能”、“3.4 論理
緩急機能”、“3.5 時刻更新割り込み機能”を参照してください。

RA4000CE/RA8000CE
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3

機能

3.2.2 動作BCDモードとBINモード
本RTCは、秒から年までの現在の日付と時刻を示すBCDカウンターと、1Hzクロックをカウントして、ある時点からの積算秒数を示すバイナリーカウンター (BINカウンター) を搭載しています。これらのカウン
ターは、どちらか一方または、両方が同時に動作可能です。ただし、計時バッファーは両カウンターに共通のため、どちらのカウンターをリード/ライトするか指定する必要があります。CNTSEL.ACCBCDビット =1 (デフォルト) の場合、BCDカウンターデータがリード/ライトされます。以降、この状態をBCDモードとして説明します。CNTSEL.ACCBCDビット = 0の場合はBINカウンターがリード/ライトされます。この状態
をBINモードとします。

計時バッファーを介した時計/カレンダーカウンターへのアクセス
時計/カレンダーカウンター（1/1024秒、秒、分、時、曜日、日、月、年カウンター）は、1秒単位の情報が読み書きできるレジスターSEC ～ YEAR (アドレス0x00 ～ 0x06) か、1/1024秒単位の情報が読み書きできるレジスターSUBSEC_L ～ YEAR_MIR (アドレス0x10 ～0x18) に割り当てられた計時バッファーを介して、一括した書き込み、または読み出しをします。この計時バッファーは、複数のアドレスにまたがる時計/カレンダーカウンターの情報を各カウンターに対して一括して一度にアクセスすることにより、正確な時
刻情報の書き込み、または読み出しを行います。また、この計時バッファーの動作と、内蔵32.768 kHzクロックに基づく時刻更新との競合は、自動的に調停されるため、ホストは任意のタイミングで計時バッファーにアクセスできます。
計時バッファーから時計/カレンダーカウンターへの書き込み、または読み出しのタイミングは、ホストイ
ンターフェイスの種類によって、以下のように決まります。
SPIインターフェイス搭載機種の場合、CE信号の立ち下げ時に、計時バッファーに書き込まれた情報が、まとめて時計/カレンダーカウンターへ書き込まれます。また、CE信号の立ち上げ後、時計/カレンダーの読み出しコマンドの6クロック目の立ち上がりで、時計/カレンダーカウンターの値が、計時バッファーへ同時に一括して読み出されます。
SPI 時計/カレンダーカウンターリード時 (SEC 〜 YEARレジスターを連続リードする場合)

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機能

SPI 時計/カレンダーカウンターライト時 (SEC 〜 YEARレジスターを連続ライトする場合)

図 3.12

SPIインターフェイス 計時/カレンダーカウンターアクセスタイミング

I2C-Busインターフェイス搭載機種の場合、ストップコンディションまたはリピーテッドスタートコンディ
ションを受信したときに、計時バッファーに書き込まれた情報が、まとめて時計/カレンダーカウンターへ書き込まれます。また、7ビットのスレーブアドレスと、8ビット目のデータ転送の1 (リード) を受信した後の、アクノリッジ送出中にSCLの立ち上がりを受信したとき、時計/カレンダーカウンターの値が、計時バッ
ファーへ同時に一括して読み出されます。
I2C-Bus 時計/カレンダーカウンターリード時 (SEC 〜 YEARレジスターを連続リードする場合)

I2C-Bus 時計/カレンダーカウンターライト時 (SEC 〜 YEARレジスターを連続ライトする場合)

図 3.13I2C-Busインターフェイス 計時/カレンダーカウンターアクセスタイミング

したがって、どちらのインターフェイス搭載機種でも、時計/カレンダーデータを書き込み、あるいは読み出すときは、アドレスのオートインクリメント機能を用いた複数バイトの連続アクセスを行ってください。
なお、I2C-Busインターフェイスにはタイムアウト機能があるため、1回の複数バイト連続アクセスは1秒以内に完了させる必要があります。

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機能

時計/カレンダーの初期設定と計時の開始
時計/カレンダーの初期設定には、1秒単位で指定する方法と、1/1024秒単位で設定する方法があります。それ
ぞれ、レジスターSEC (アドレス0x00) からレジスター YEAR (アドレス06) まで、またはレジスター
SUBSEC_L (アドレス 0x10)からYEAR_MIR (アドレス 0x18) に時計/カレンダーの初期設定を書き込みます。
時計/カレンダーの計時の開始タイミングは、通信の終了をホストから送出する方法や、TSTP_INTE.STOP
ビットの解除をホストから書き込む方法で指定します。どちらの方法でも時刻精度に差はありません。
時刻を設定して時計/カレンダーカウンターをスタートさせる手順を以下に示します。以下の例は、BCDモード、またはBINモードのどちらか一方を選択して使用する場合の手順です。
例: BCDモードで使用する場合で、1秒単位で時計/カレンダーを初期設定し、計時の開始タイミングは通信の終了で指定1.

2.

3.

CNTSELレジスターの以下のビットを設定する。
- CNTSEL.ACCBCDビットを1に設定する。
- CNTSEL.BINCNTENビットを0に設定する。
- CNTSEL.BCDCNTENビットを1に設定する。

(BCDモードを選択)(BINカウンターディスエーブル)(BCDカウンターイネーブル)

以下のレジスターに時刻と日付を設定する。
- レジスターSEC- レジスターMIN- レジスターHOUR- レジスターWEEKDAY- レジスターDAY- レジスターMONTH- レジスターYEAR

(秒)
(分)
(時)
(曜日)
(日)
(月)
(年)

2での連続書き込みの終了 (SPIインターフェイスではCE信号の立ち下がり。I2C-Busインターフェイ
スではストップコンディションかリピーテッドスタートコンディション) を受信したタイミングで計時がスタートする。

4a. <時刻更新割り込みを使用する場合>- TCTL.USEL0ビットとUPDISEL.USEL1ビットを設定する。 (時刻更新割り込み条件を設定)- INTF.UFビットに0を書き込む。
(時刻更新割り込みフラグをクリア)- TSTP_INTE.UIEビットに0を書き込む。
(/INT出力をクリア)- TSTP_INTE.UIEビットに1を書き込む。
(時刻更新割り込み許可)
4b. <時刻更新割り込みを使用しない場合>- TCTL.USEL0ビットとUPDISEL.USEL1ビットを0に設定する。(時刻更新割り込み条件ディスエーブル)- INTF.UFビットに0を書き込む。
(時刻更新割り込みフラグをクリア)- TSTP_INTE.UIEビットに0を書き込む。
(/INT出力をクリア/出力禁止)
例: BCDモードで使用する場合で、1秒単位で時計/カレンダーを初期設定し、計時の開始タイミングは
TSTP_INTE.STOPビットの解除にて指定
1.

TSTP_INTE.STOPビットに1を書き込む。

(時計/カレンダーカウンターストップ)2.

CNTSELレジスターの以下のビットを設定する。
- CNTSEL.ACCBCDビットを1に設定する。
- CNTSEL.BINCNTENビットを0に設定する。
- CNTSEL.BCDCNTENビットを1に設定する。

(BCDモードを選択)(BINカウンターディスエーブル)(BCDカウンターイネーブル)

以下のレジスターに時刻と日付を設定する。
- レジスターSEC- レジスターMIN- レジスターHOUR- レジスターWEEKDAY- レジスターDAY- レジスターMONTH- レジスターYEAR

(秒)
(分)
(時)
(曜日)
(日)
(月)
(年)

3.

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機能

4a. <時刻更新割り込みを使用する場合>- TCTL.USEL0ビットとUPDISEL.USEL1ビットを設定する。 (時刻更新割り込み条件を設定)- INTF.UFビットに0を書き込む。
(時刻更新割り込みフラグをクリア)- TSTP_INTE.UIEビットに0を書き込む。
(/INT出力をクリア)- TSTP_INTE.UIEビットに1を書き込む。
(時刻更新割り込み許可)
4b. <時刻更新割り込みを使用しない場合>- TCTL.USEL0ビットとUPDISEL.USEL1ビットを0に設定する。(時刻更新割り込み条件ディスエーブル)- INTF.UFビットに0を書き込む。
(時刻更新割り込みフラグをクリア)- TSTP_INTE.UIEビットに0を書き込む。
(/INT出力をクリア/出力禁止)
5.

設定時刻にTSTP_INTE.STOPビットに0を書き込む。

(時計/カレンダーカウンタースタート)

6.

SPIインターフェイスではレジスターTSTP_INTEのビット0 (STOPビット) が書き込まれるクロックの立ち上がり、I2C-BusインターフェイスではレジスターTSTP_INTEのビット0 (STOPビット) を書き込んだ際のSCL立ち上がりのタイミングで計時がスタートする。

注: BCDモードでアドレス0x00のレジスターSECを書き換えると、秒以下のカウンター (1/1024秒カウンター)
が0にクリアされます。たとえば、時刻を読み出して再び書き込むリードモデファイライトを行うと、このクリアに起因する誤差が累積して、時刻に大幅な遅れが生じる場合があります。
例: 9.9秒の時点で秒レジスターへのリードモデファイライトを行うとカウンターは9.0秒に戻されてしまいます。
アドレス0x12のレジスターSEC_MIRの書き換え、またはBINモードでの書き換えでは、秒以下のカウンターは0にクリアされません。

例: BINモードで使用する場合で、1/1024秒単位で時計/カレンダーを初期設定し、計時の開始タイミングは通信の終了で指定
1.

CNTSELレジスターの以下のビットを設定する。
- CNTSEL.ACCBCDビットを0に設定する。
- CNTSEL.BINCNTENビットを1に設定する。
- CNTSEL.BCDCNTENビットを0に設定する。

2.

(BINモードを選択)(BINカウンターイネーブル)(BCDカウンターディスエーブル)

レジスターSUBSEC_L, SUBSEC_H, SEC_BIN0 〜 SEC_BIN4にエポックからの経過秒数を設定する。
* アドレスのオートインクリメントを利用して連続的に書き込みます。

3.

2での連続書き込みの終了 (SPIインターフェイスではCE信号の立ち下がり。I2C-Busインターフェイ
スではストップコンディションかリピーテッドスタートコンディション) を受信したタイミングで計時がスタートする。

4.

時刻更新割り込みとアラーム割り込みを禁止する。
- INTF.UFビットに0を書き込む。
(時刻更新割り込みフラグをクリア)- ALM_***.*ALM_H/Lビットすべてを1に設定する。
(無効アラーム日時を設定)- INTF.AFビットに0を書き込む。
(アラーム割り込みフラグをクリア)- TCTL.USEL0ビットとUPDISEL.USEL1ビットを0に設定する。(時刻更新割り込み条件ディスエーブル)- TSTP_INTE.UIEビットに0を書き込む。
(時刻更新割り込みディスエーブル)- TSTP_INTE.AIEビットに0を書き込む。
(アラーム割り込みディスエーブル)* BCDカウンター停止時に時刻更新割り込みとアラーム割り込みを使用することはできません。

例: BINモードで使用する場合で、1/1024秒単位で時計/カレンダーを初期設定し、計時の開始タイミングは
TSTP_INTE.STOPビットの解除にて指定
1.

TSTP_INTE.STOPビットに1を書き込む。

(時計/カレンダーカウンターストップ)2.

CNTSELレジスターの以下のビットを設定する。
- CNTSEL.ACCBCDビットを0に設定する。
- CNTSEL.BINCNTENビットを1に設定する。
- CNTSEL.BCDCNTENビットを0に設定する。

(BINモードを選択)(BINカウンターイネーブル)(BCDカウンターディスエーブル)

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3.

機能

レジスターSUBSEC_L, SUBSEC_H, SEC_BIN0 〜 SEC_BIN4にエポックからの経過秒数を設定する。
* アドレスのオートインクリメントを利用して連続的に書き込みます。

4.

時刻更新割り込みとアラーム割り込みを禁止する。
- INTF.UFビットに0を書き込む。
(時刻更新割り込みフラグをクリア)- ALM_***.*ALM_H/Lビットすべてを1に設定する。
(無効アラーム日時を設定)- INTF.AFビットに0を書き込む。
(アラーム割り込みフラグをクリア)- TCTL.USEL0ビットとUPDISEL.USEL1ビットを0に設定する。(時刻更新割り込み条件ディスエーブル)- TSTP_INTE.UIEビットに0を書き込む。
(時刻更新割り込みディスエーブル)- TSTP_INTE.AIEビットに0を書き込む。
(アラーム割り込みディスエーブル)* BCDカウンター停止時に時刻更新割り込みとアラーム割り込みを使用することはできません。

5.

TSTP_INTE.STOPビットに0を書き込む。

(時計/カレンダーカウンタースタート)

6.

SPIインターフェイスではレジスターTSTP_INTEのビット0 (STOPビット) が書き込まれるクロックの立ち上がり、I2C-BusインターフェイスではレジスターTSTP_INTEのビット0 (STOPビット) を書き込んだ際のSCL立ち上がりのタイミングで計時がスタートする。

時計/カレンダーデータの読み出し
時計/カレンダーの情報を、1秒単位で読み出す場合はレジスターSEC (アドレス0x00) からレジスター
YEAR (アドレス0x06) まで、1/1024秒単位で読み出す場合はレジスターSUBSEC_L (アドレス0x10)から
YEAR_MIR (アドレス0x18) を連続で読み出します。どちらの場合も、読み出しアドレスの範囲は計時デー
タの必要範囲に応じて、一部分に限定して読み出すことも可能です。
また、BCDモードカウンター、BINモードカウンターの両方をイネーブル設定としている場合は、どちらか一方のカウンターを予め選択して計時データを読み出すことが可能です。

BCDモード時 (1秒単位での読み出し)
1.

CNTSELレジスターの以下のビットを設定する。
- CNTSEL.ACCBCDビットを1に設定する。
(BCDモードを選択)- CNTSEL.BINCNTENビット、CNTSEL.BCDCNTENビットは、前状態を持続する。(計時を継続します。)

2.

必要範囲のレジスターを連続リード (下記の例は、全データ一式をリード)- レジスターSECまたはSEC_MIR(アドレス0x00または0x12) (秒)- レジスターMINまたはMIN_MIR(アドレス0x01または0x13) (分)- レジスターHOURまたはHOUR_MIR(アドレス0x02または0x14) (時)- レジスターWEEKDAYまたはWEEKDAY_MIR(アドレス0x03または0x15) (曜日)
- レジスターDAYまたはDAY_MIR(アドレス0x04または0x16) (日)- レジスターMONTHまたはMONTH_MIR(アドレス0x05または0x17) (月)- レジスターYEARまたはYEAR_MIR(アドレス0x06または0x18) (年)BCDモード時 (1/1024秒単位での読み出し)
1.

CNTSELレジスターの以下のビットを設定する。
- CNTSEL.ACCBCDビットを1に設定する。
(BCDモードを選択)- CNTSEL.BINCNTENビット、CNTSEL.BCDCNTENビットは、前状態を持続する。(計時を継続します。)

2.

必要範囲のレジスターを連続リード (下記の例は、全データ一式をリード)- レジスターSUB_SEC_L, SUB_SEC_H(アドレス0x10 〜 0x11) (1/1024秒カウンターデータ)- レジスターSEC_MIR(アドレス0x12)(秒)- レジスターMIN_MIR(アドレス0x13)(分)- レジスターHOUR_MIR(アドレス0x14)(時)- レジスターWEEKDAY_MIR(アドレス0x15)(曜日)- レジスターDAY_MIR(アドレス0x16)(日)- レジスターMONTH_MIR(アドレス0x17)(月)- レジスターYEAR_MIR(アドレス0x18)(年)

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機能

BINモード時 (1秒単位での読み出し)
1.

CNTSELレジスターの以下のビットを設定する。
- CNTSEL.ACCBCDビットを0に設定する。
(BINモードを選択)- CNTSEL.BINCNTENビット、CNTSEL.BCDCNTENビットは、前状態を持続する。(計時を継続します。)

2.

必要範囲のレジスターを連続リード (下記の例は、全データ一式をリード)- レジスターSEC_BIN0 〜 SEC_BIN4(アドレス0x12 〜 0x16) (エポックからの秒数
バイナリ値[32:0])

BINモード時（1/1024秒単位での読み出し）
1.

CNTSELレジスターの以下のビットを設定する。
- CNTSEL.ACCBCDビットを0に設定する。
(BINモードを選択)- CNTSEL.BINCNTENビット、CNTSEL.BCDCNTENビットは、前状態を持続する。(計時を継続します。)

2.

必要範囲のレジスターを連続リード (下記の例は、全データ一式をリード)- レジスターSUB_SEC_L, SUB_SEC_H(アドレス0x10 〜 0x11) (エポックからの1/1024秒
カウント数バイナリ値[9:0])- レジスターSEC_BIN0 〜 SEC_BIN4(アドレス0x12 〜 0x16) (エポックからの秒数
バイナリ値[32:0])

SPIインターフェイス搭載機種の場合は、CE信号の立ち上げ後、時計/カレンダーの読み出しコマンドの6ク
ロック目の立ち上がりで、その時点での時計/カレンダーカウンター値が、計時バッファーへ同時に一括して読み出されます。そして計時バッファーに転送された時計/カレンダー情報を、レジスターSEC (アドレス0x00) からレジスター YEAR (アドレス0x 06) まで、またはレジスターSUBSEC_L (アドレス0x10) から
YEAR_MIR (アドレス0x18)までの範囲で、ホストが連続読み出しします。
I2C-Busインターフェイス搭載機種の場合は、まず、読み出し領域の先頭アドレスであるレジスターSEC (アドレス0x00) またはレジスターSUBSEC_L (アドレス0x10) をホストが書き込みます。次に、7ビットのス
レーブアドレスと、8ビット目のデータ転送の1 (リード) を受信した後の、アクノリッジ送出中のSCLの立
ち上がりを受信したとき、時計/カレンダーカウンターの値が、計時バッファーへ同時に一括して読み出されます。そして、計時バッファーの情報をホストが連続読み出しします。
時計/カレンダーデータの読み出し時、TSTP_INTE.STOPビットに1を書き込んで時計/カレンダーの各カウン
ターを停止しないようにしてください。各カウンターを停止させた場合は、計時誤差が増大してしまいます。

1/1024秒のデータ読み出し/書き込み
RA4000CE/RA8000CEでは、SUBSEC_L.SUBSEC[1:0]ビットとSUBSEC_H. SUBSEC[9:2]ビットで1/1024秒のカウンター値の読み出しと書き込みが可能です。ビットとカウント値の関係は次のとおりです。
ビット
カウント値
(1024Hz 周期)

表 3.5

SUBSEC[9:0]ビット

SUBSEC9SUBSEC8SUBSEC7

SUBSEC6SUBSEC5SUBSEC4

512

256

128

64

32

16

SUBSEC38

SUBSEC24SUBSEC1

2

SUBSEC01

このカウンターはアドレス0x10 (レジスターSUBSEC_L) と0x11 (レジスターSUBSEC_H) に割り付けられていますので、データを取得する場合はこの2つのアドレスを連続して読み出してください。カウンター値を変更する場合も、2つのアドレスに連続して書き込んでください。これらのアドレスに続けてアドレス
0x12 〜 0x18をアクセスすることにより、時計/カレンダーカウンターデータの読み出し/書き込みも連続して行えます。

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機能

1/1024秒のオフセット時刻合わせ
1/1024秒バイナリーカウンターは、レジスターSUBSEC_LとレジスターSUBSEC_Hに、1023カウント 〜 1
カウントのデータを直接書き込むことにより設定可能です。ただし、これらのレジスターから読み出した
秒以下のデータとホストデバイス内の計時データにはずれが生じる可能性があります。このずれを補正す
るため、RA4000CE/RA8000CEにはオフセット時刻合わせ機能 (以降、オフセット処理) が設けられています。その使用方法を以下に示します。
1.

BCDカウンターまたはBINカウンターを1秒以下の誤差に時刻合わせしておく。

2.

ホストが管理するマスターの計時データと本RTCから読み出した秒以下のデータの差分を2の補数(データ長11ビット) に変換し、秒以下データのオフセット値 (データに加減算されます) を求める。

3.

OFS_SUBSEC_L.OFSFINビット = 1 (オフセット処理実行可能) を確認する。

4.

2で取得した11ビット長のオフセット値のビット10をOFS_SUBSEC_H.OFS_SUBSEC[10]ビットに、ビッ
ト9～ビット0をOFS_SUBSEC_H.OFS_SUBSEC[9:5]ビットとOFS_SUBSEC_L.OFS_SUBSEC[4:0]ビットに書き込む。

5.

OFS_SUBSEC_L.OFSENビットに1を書き込む。(オフセット処理を開始)
この書き込み直後の秒カウンター更新時に、オフセット値が1/1024秒カウンターに反映されます。この処理は1度のみ行われ、これ以降の秒カウンター更新時は行われません。

6.

OFS_SUBSEC_L.OFSFINビットが0 → 1 (オフセット処理終了) になったことを確認する。
OFS_SUBSEC_L.OFSFINビットは、OFS_SUBSEC_L.OFSENビットに1が書き込まれるとクリアされ、オ
フセット処理が終了するとセットされます。

表 3.6 にオフセット値と時刻の補正量の関係を示します。
表 3.6

オフセット値と補正量
1/1024秒カウンター補正値

オフセット値 *

0x3FF
0x3FE
:
0x003
0x002
0x001
0x000
0x7FF
0x7FE
0x7FD
:
0x402
0x401
0x400

現在値 + 1023
現在値 + 1022:
現在値 + 3
現在値 + 2
現在値 + 1
現在値 + 0
現在値 - 1
現在値 - 2
現在値 - 3:
現在値 - 1022
現在値 - 1023
設定不可（禁止）

0b011 1111 1111
0b011 1111 1110:
0b000 0000 0011
0b000 0000 0010
0b000 0000 0001
0b000 0000 0000
0b111 1111 1111
0b111 1111 1110
0b111 1111 1101:
0b100 0000 0010
0b100 0000 0001
0b100 0000 0000

オフセット処理結果

1023/1024秒 進む
1022/1024秒 進む:
3/1024秒 進む
2/1024秒 進む
1/1024秒 進む
補正なし
1/1024秒 遅れる
2/1024秒 遅れる
3/1024秒 遅れる:
1022/1024秒 遅れる
1023/1024秒 遅れる－* オフセット値 (11ビット) = {OFS_SUBSEC[10], OFS_SUBSEC[9:5], OFS_SUBSEC[4:0]}
OFS_SUBSEC_L.OFSENへの1書き込み-1-0

OFS_SUBSEC_L.OFSFIN
秒更新タイミング

1/1024秒のカウンター
秒カウンターOFS_SUBSEC_L.OFSENへの1書き込み直後の秒カウンター更新タイミングで補正が実行されます。
設定したオフセット値が代入されます。

0x3FF
n (現 在の秒)

n + 1 または n
オフセット値がプラスまたはゼロの場合: n + 1
オフセット値がマイナスの場合:
n (秒更新なし)

図 3.14

オフセット処理タイミング

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機能

時計/カレンダーストップ手順
時計/カレンダーカウンターを停止するには、TSTP_INTE.STOPビットに1を書き込みます。
なお、TSTP_INTE.STOPビットでは、1/1024秒カウンター 、BCDカウンター (秒、分、時、曜日、日、月、年)、およびバイナリーカウンターが停止します。

うるう年の判定
BCDモード時は4の倍数の年をうるう年として判定し、自動的に2月の日数を設定します。2001年 ～ 2099
年まではソフトウェアで対応する必要はありません。
西暦2100年、2200年、2300年は、ソフトウェアで2月を平年の日数に変更する必要があります。

うるう秒補正手順
BCDモードでは、レジスターSEC_MIR (アドレス0x12) に0x60を書き込むことで、うるう秒が挿入されます。
この操作は、うるう秒挿入時刻の00秒 〜 01秒の間に行う必要があります。0x60の書き込み時点で秒カウンターは60秒になり、その後の秒更新タイミングで秒カウンターは60秒から00秒に更新されます。0x60の書き込みから秒カウンターが00秒に更新される間、レジスターSECまたはSEC_MIR (アドレス0x00または0x12) からは60秒が読み出されます。
以降は通常どおり00秒から59秒までのカウント動作が行われます。
注: レジスターSEC (アドレス0x00) に0x60を書き込むと1/1024秒カウンターがリセットされてしまいますので、注意してください。うるう秒補正には、必ずアドレス0x12のレジスターSEC_MIRを使用してください。00秒〜 01秒の間でない時刻でのレジスターSEC_MIR (アドレス0x12) への0x60の書き込みは禁止です。

秒カウンター
分カウンター

0x57

0x58

0x59

レジスターSEC_MIR (アドレス0x12) へ0x60を書き込み
0x00 0x60
0x00
0x01
0x59
0x00

0x59

0x00

0x01

うるう秒挿入タイミング

図 3.15

うるう秒挿入タイミング

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機能

3.3 温度補償機能
RA4000CE/RA8000CEは高精度な温度補償回路を内蔵しています。弊社出荷検査時に、内蔵温度センサーの値に合わせた発振回路の周波数補正値を単品ごとに内蔵メモリーに記録しています。温度補償回路はこの値を基に、温度変化に起因する発振周波数の変動を補償します。

3.3.1 動作
温度補償間隔の設定
温度補償回路は電源電圧が温度補償電圧 (VTMP) の範囲であれば常に動作します。消費電流を低減するため、
温度センサーの測定動作は間欠的に行われるようになっており、この実行間隔をTSTP_INTE.CSEL[1:0]ビッ
トで下表のとおり設定可能です。
表 3.7

温度補償データの更新間隔

TSTP_INTE.CSEL[1:0]

更新間隔

0b00
0b01
0b10
0b11

0.5秒
2.0秒 (デフォルト)
10.0秒
30.0秒

温度補償回路はこの間隔でIC内蔵の温度センサーで動作温度を測定し、その温度を元に発振周波数の変動を補正します。
周囲温度変化が急峻な環境では温度補償データの更新間隔を短くして、温度の変化に素早く追従させることが可能です。
室内などの比較的周囲温度の変化が緩やかな環境下では、温度補償データの更新間隔を長くすることで消費電流を抑えることができます。
温度補償回路はレジスター操作により停止させることはできません。ただし、電源電圧が温度補償更新停
止検出電圧VDET2以下に低下すると、最後の温度補償データを保持したまま更新を停止します。ここから電源電圧が温度補償電圧VTMP以上に復帰すると、温度補償更新動作が再開します。なお、このVDET2電圧低下時にイベント割り込みを発生可能です (詳細は、“3.11 タイムスタンプ機能”参照)。

温度補償動作フラグ

VTMPFフラグ(0x0E)

VTMPF フラグは、VDD 電圧が温度補償更新停止検出電圧 (VDET2) 以下に低下した場合に 1 にセットされます。
この場合、温度補償回路は停止し、停止した際の周波数補正条件で発振を継続します。VTMPF ビットは、VDD
が VTMP 以上に復帰した後に 0 を書き込むことによってクリアされます。

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機能

3.4 論理緩急機能
RA4000CE/RA8000CEは分周回路内で時刻の進み/遅れを補正する論理緩急機能を備えています。
• 補正周期:
32秒周期 (固定)• 補正可能範囲: -243.186 ppm ～ +243.186 ppm• 最小補正分解能: 0.954 ppm

3.4.1 動作
論理緩急の動作
DIG_TRIM_L.DTRIMENビットを1に設定すると論理緩急機能は動作を開始し、32秒を1周期として指定された緩急量の補正を行います。32秒の補正期間には125 msごとに256回の補正実行ポイントが設けられており、
DIG_TRIM_H.DTRIM[8:1] ビ ッ ト と DIG_TRIM_L.DTRIM[0] ビ ッ ト の 9 ビ ッ ト ( 以 降 は 簡 易 的 に 、
DIG_TRIM_H/L.DTRIM[8:0]ビットと表記します) に設定されている補正値で決まる補正実行ポイントで、補正処理が実行されるようになっています。この補正処理とは、分周回路の16.384 kHzクロックを生成する
分周段において、16.384 kHzクロックの1サイクル時間を32.768 kHzの1クロック分延長または短縮することです。
したがって、最小補正周期は、1/32.768 kHz ÷ 32s × 1回 = 0.954 ppmとなります。

補正量の設定発振周波数偏差の補正値 (DIG_TRIM_H/L.DTRIM[8:0]ビットに設定する値) は以下に示す2つの方法で求められます。
(1) 実測した内蔵発振周波数から論理緩急補正量を求める方法
FOUT端子から32 kHzクロックを出力させ、外部のユニバーサルカウンターなどで実際の周波数を計測します。その値から補正値を以下のように算出します。
DTRIM[8:0] = round(-f - 32768
× 106)
32768 × 0.954(-255 〜 +255)

f: FOUT出力を計測して得られた内蔵発振回路の発振周波数 [Hz]周波数のずれ量と最小補正分解能で算出された補正値は、表 3.8に示す2の補数表現の設定値に変換して
DIG_TRIM_H/L.DTRIM[8:0]ビットの設定値にします。設定値の範囲は-255 〜 +255です。
(2) 1024秒間の累計カウント誤差をタイムスタンプデータ (TIMESTAMP_SUBSEC_H/L.SUBSEC[9:0]、
0x3FF (1023カウント) 〜 0x000 (0カウント) の範囲) から求めて、論理緩急補正量を求める方法
外部よりEVINn端子に基準となる1 Hzの矩形波 (GSNNの1PPSタイムパルスなど) を入力し、1024秒の間隔を置いて秒以下のタイムスタンプデータを2個取得します。その差分から補正値を以下のように算出します。
DTRIM[8:0] = 0x200 - ΔSubSecCnt_1024s,

ΔSubSecCnt_1024s = B(SubSec) - A(SubSec)

A(SubSec): 1個目の1PPSパルスで取得したタイムスタンプデータ (Bank 6, SUBSEC[9:0]*)
B(SubSec): 1025個目の1PPSパルスで取得したタイムスタンプデータ (Bank 7, SUBSEC[9:0]*)* タイムスタンプデータの内容は図 3.33を、取得方法については“3.11 タイムスタンプ機能”を参照してください。
ΔSubSecCnt_1024sの範囲は、-255 〜 +255 です。
なお、この方法では、計測誤差として、最大1カウント分、±0.954 ppmが含まれます。

RA4000CE/RA8000CE
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3

機能

仮に1024秒間の計測時間を32秒間に短縮した場合は、得られた差分値 (0x200 - ΔSubSecCnt_1024s) を×32倍することで、DTRIM[8:0]の設定値に用いることが可能になります。最小補正分解能が0.954 ppmの32倍で、約30.518 ppmと粗くなりますが、計測時間の短縮が行なえます。この短縮方法では、計測誤差が最大1カウント分、±30.518 ppmが含まれます。
DIG_TRIM_H/L.DTRIM[8:0]ビットの設定による補正量は、表 3.8のようになります。
表 3.8

DIG_TRIM_H/L.DTRIM[8:0]ビット設定値と補正量

DIG_TRIM_H/L.DTRIM[8:0]設定値(1 単位 = 0.954 ppm)

0x0FF = +255
0x0FE = +254:
0x003 = +30x002 = +20x001 = +1
0x000 = ±00x1FF = -1
0x1FE = -2
0x1FD = -3:
0x102 = -254
0x101 = -255
0x100 (設定禁止)

論理緩急結果(32 秒周期の緩急量)+243.186 ppm+242.232 ppm

時計を早くする
時計を早くする:+2.861 ppm+1.907 ppm+0.954 ppm

時計を早くする
時計を早くする
時計を早くする
補正なし-0.954 ppm
時計を遅くする-1.907 ppm
時計を遅くする-2.861 ppm
時計を遅くする:-242.232 ppm
時計を遅くする-243.186 ppm
時計を遅くする–

論理緩急の開始
論理緩急動作は以下の手順で開始します。
1.

DIG_TRIM_H/L.DTRIM[8:0]の9ビットに補正量を2の補数で設定する。

2.

DIG_TRIM_L.DTRIMENビットを1に設定する。

(論理緩急イネーブル)

論理緩急の停止
DIG_TRIM_L.DTRIMENビットを0に設定すると、その時点で論理緩急動作が停止します。

3.4.2 論理緩急の他機能への影響
論理緩急機能は、32.768 kHzクロックには影響を与えませんが、16.384 kHz以下の分周クロックを使用する下記の機能に影響します。

(1) FOUT機能• 出力クロックに1024 Hzまたは1 Hzを選択した場合、クロック周期が最大±0.954 ppm変動します。
ただし、出力クロックに1Hzを選択し、DIG_TRIM_H/L.DTRIM[8:0]ビットの設定値が32の倍数の場合、出力クロックの周期は変動しません。
• 出力クロックに32.768 kHzを選択した場合、出力クロックの周波数は変動しません。

(2) ウェイクアップタイマー機能• ソースクロックに1024 Hz、64 Hz、1Hzを選択した場合、クロック周期が最大±0.954 ppm変動します。

RA4000CE/RA8000CE
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3

機能

3.5 時刻更新割り込み機能
3.5.1 概要
RA4000CE/RA8000CEには時計カウンターの更新タイミングで割り込みを発生させる機能があります。その特長を以下に示します。
• 割り込みタイミングを毎秒更新、毎分更新、毎時更新から選択可能です。
• /INT端子のホストへの割り込み出力信号は一定時間経過後に自動解除されます。
図 3.16に時刻更新割り込み回路の構成を示します。
UIE
USEL[1:0]/INT

秒カウンター更新
分カウンター更新
時カウンター更新

UF

UFへの0書き込み
自動復帰
制御

64 Hz

図 3.16

tRTN1

時刻更新割り込み回路の構成

注: 時計/カレンダーのBCDカウンターが停止していると本機能が正常に動作しません。
本機能を使用する場合は、BCDカウンターを必ず動作させてください (CNTSEL.BCDCNTENビット = 1)。

3.5.2 動作
割り込み周期の選択
時刻更新割り込みは、TCTL.USEL0ビットとUPDISEL.USEL1ビットで選択した秒、分、または時のいずれかのカウンター値が桁上げ更新されたタイミングで発生させることができます (1秒周期、1分周期、または1時間周期で割り込み発生、あるいは割り込みを発生させない)。/INT端子のホストへの割り込み出力信号は一定時間 (tRTN1) 経過後に自動解除されます。
表 3.9
UPDISEL.USEL1
00
1
1

TCTL.USEL00
1
01

時刻更新割り込みイベントの選択
割り込みイベント
秒カウンター更新 (デフォルト)
分カウンター更新
時カウンター更新
割り込みイベントなし/INT 自動解除時間 tRTN1
7.812 ms–

割り込み許可/禁止手順
時刻更新割り込みは以下の手順で許可/禁止してください。

時刻更新割り込みを許可
1.

TSTP_INTE.UIEビットに0を書き込む。

(/INT出力をクリア)

2.

TCTL.USEL0ビットとUPDISEL.USEL1ビットを設定する。 (時刻更新割り込みイベントを選択)

3.

INTF.UFビットに0を書き込む。

(時刻更新割り込みフラグをクリア)

4.

TSTP_INTE.UIEビットに1を書き込む。

(時刻更新割り込み許可)

時刻更新割り込みを禁止
1.

TSTP_INTE.UIEビットに0を書き込む。

(/INT出力をクリア/出力禁止)

2.

INTF.UFビットに0を書き込む。

(時刻更新割り込みフラグをクリア)

RA4000CE/RA8000CE
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3

機能

割り込み動作
選択した割り込みのタイミングになると、INTF.UFビットが1にセットされます。このとき、TSTP_INTE.UIE
ビット = 1 (割り込み許可) であれば/INT端子がLOWになり、ホストに割り込み要求を出力します。/INT端
子は、TSTP_INTE.UIEビットに0を書き込むか、/INT端子のLOW出力開始からtRTN1 (7.812 ms) 後に自動的に
Hi-Zになります。INTF.UFビットは、割り込み要求発生から tRTN1が経過して/INT端子がHi-Zになってもクリアされず、ホストから0を書き込むことによってはじめてクリアされます。
ホストによる制御-1-0

TSTP_INTE.UIE*1/INT出力tRTN1*1- Hi-Z-0-1-0

INTF.UF
カウンター更新
割り込み周期

割り込み周期

割り込み周期*1 INTF.UFビットまたはTSTP_INTE.UIEビットに0を書き込んでビットをクリアすると、tRTN1を待たずに/INT端子が開放されます (Hi-Zになります)。

図 3.17

時刻更新割り込みタイミングチャート

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3

機能

3.6 アラーム機能
3.6.1 概要
アラーム機能の概要を以下に示します。
• 曜日または日、時、分、秒の組み合わせでアラーム時刻を設定可能です。
• それぞれの要素を任意に組み合わせてアラーム条件に設定できるため、
毎週金/土曜日の朝10時、毎月25日の夜7時のようなアラーム設定が簡単に設定可能です。
図 3.18にアラーム回路の構成を示します。
秒
カウンター

分
カウンター

時
カウンター

日
カウンター

曜日
カウンター

WADA
比較器

比較器

比較器

比較器

ALM_SEC

ALM_MIN

ALM_HOURALM_WEEKDAY
XWAE
XHAE

割り込み制御回路(アラーム割り込み)

/INT

XMAE
XSAE
AIE

図 3.18

AF

アラーム回路の構成

注: 本機能を使用する場合は、BCDカウンターを必ず動作させてください (CNTSEL.BCDCNTENビット = 1)。

3.6.2 動作
アラーム設定手順
アラームを設定して割り込みを発生させる手順を以下に示します。
1.

TSTP_INTE.AIEビットに0を書き込む。

(アラーム割り込みディスエーブル)

2.

レジスターALM_SECでアラーム時刻の秒を設定する。
- XSAEビット(秒アラーム指定イネーブル/ディスエーブル)- SALM_H[2:0]ビット(10秒桁の指定)- SALM_L[3:0]ビット(1秒桁の指定)3.

レジスターALM_MIN (またはALM_MIN_MIR) でアラーム時刻の分を設定する。
- XMAEビット(分アラーム指定イネーブル/ディスエーブル)- MALM_H[2:0]ビット(10分桁の指定)- MALM_L[3:0]ビット(1分桁の指定)

4.

レジスターALM_HOUR (またはALM_HOUR_MIR) でアラーム時刻の時を設定する。
- XHAEビット(時アラーム指定イネーブル/ディスエーブル)- HALM_H[1:0]ビット(10時桁の指定)- HALM_L[3:0](1時桁の指定)

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3
5.

機能

レジスターALM_WEEKDAY (またはALM_WEEKDAY_MIR) でアラーム時刻の曜日または日を設定する。
- XWAEビット(曜日/日アラーム指定イネーブル/ディスエーブル)
曜日を指定する場合 (TCTL.WADAビット = 0)
- WKALM[6:0]ビット(曜日の指定)曜日は月曜 〜 金曜のように複数の指定が可能です。
日を指定する場合 (TCTL.WADAビット = 1)
- DALM_H[1:0]ビット(10日桁の指定)- DALM_L[3:0]ビット(1日桁の指定)

6.

TCTL.WADAビットを設定する。

(日/曜日アラームの選択)

7.

INTF.AFビットに0を書き込む。

(アラーム割り込みフラグをクリア)

8.

TSTP_INTE.AIEビットに1を書き込む。

(アラーム割り込み許可)* X*AEビットを1に設定すると、そのレジスターの設定はアラーム条件から除外されます。たとえば、
ALM_WEEKDAY.XWAEビット = 1では、曜日/日の設定が無効になり、毎日指定時刻にアラームが発生します。ただし、すべてのX*AEビットを1にした場合は、1秒ごとにアラームが発生します。

アラーム設定例
曜日指定時のアラーム設定例 (TCTL.WADAビット = 0)
設定例1
XWAE

土

ALM_WEEKDAY (曜日アラーム)
金

木

水

火

月

日

ALM_HOUR(時アラーム)

ALM_MIN(分アラーム)ALM_SEC(秒アラーム)

0

0

1

1

1

1

1

0

0x07

0x00

XSAE = 1

毎週月曜 〜 金曜、午前7時00分00秒 〜 59秒の間、1秒ごとに繰り返しアラームが発生
設定例2
XWAE

土

ALM_WEEKDAY (曜日アラーム)
金

木

水

火

月

日

ALM_HOUR(時アラーム)

ALM_MIN(分アラーム)ALM_SEC(秒アラーム)

0

1

0

0

0

0

0

1

XHAE = 1

0x30

0x00

ALM_HOUR(時アラーム)

ALM_MIN(分アラーム)ALM_SEC(秒アラーム)

0x18

0x59

0x30

ALM_MIN(分アラーム)ALM_SEC(秒アラーム)XMAE = 1

XSAE = 1

毎週土曜と日曜、毎時30分00秒にアラームが発生
設定例3
ALM_WEEKDAY (曜日アラーム)
XWAE

土

金

木

水

火

月

日

0

1

1

1

1

1

1

1

1

X

X

X

X

X

X

X

毎日、午後6時59分30秒にアラームが発生
日指定時のアラーム設定例 (TCTL.WADAビット = 1)
設定例4
ALM_WEEKDAY (日アラーム)
XWAE

*

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

ALM_HOUR(時アラーム)

0

X

0

0

0

0

0

1

0x07

毎月1日、午前7時00分00秒 〜 59秒の間、1秒ごとに繰り返しアラームが発生

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機能

設定例5
XWAE

*

ALM_WEEKDAY (日アラーム)
Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

ALM_HOUR(時アラーム)

ALM_MIN(分アラーム)ALM_SEC(秒アラーム)

0

X

0

1

0

1

0

1

XHAE = 1

0x30

0x00

毎月15日、毎時30分00秒にアラームが発生
設定例6
XWAE

*

ALM_WEEKDAY (日アラーム)
Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

ALM_HOUR(時アラーム)

ALM_MIN(分アラーム)ALM_SEC(秒アラーム)

1

X

X

X

X

X

X

X

0x18

0x59

0x30

毎日、午後6時59分30秒にアラームが発生
X: 値は不問です。

アラーム割り込み
図 3.19にアラーム割り込み回路の構成を示します。
曜日/日比較結果
XWAE
時比較結果
/INT

AF

XHAE
分比較結果
XMAE

秒カウンター更新

秒比較結果

AFへの0書き込み

XSAE

AIE

図 3.19

アラーム割り込み回路の構成

アラーム割り込みは、時刻/カレンダーカウンターがレジスターALM_SEC、ALM_MIN、ALM_HOUR、
ALM_WEEKDAYで指定した日時に一致した時点で発生させることができます。
指定した曜日/日の指定時刻になると、INTF.AFビットが1にセットされます。このとき、TSTP_INTE.AIEビット = 1 (割り込み許可) であれば/INT端子がLOWになり、ホストに割り込み要求を出力します。1にセットされたINTF.AFビットは0を書き込むことによりクリアされます。同時に/INT端子がHi-Zになります。
*2

*1

*1

*2

ホストによる制御
TSTP_INTE.AIE
Hi-Z

Hi-Z

/INT出力L

L

Hi-Z Hi-Z
L

Hi-Z
L

INTF.AF
アラーム発生アラームイベント

アラームイベント

アラームイベント*1 INTF.AFビットに0を書き込んでこのビットをクリアすると、/INT端子がHi-Zに開放されます。
*2 TSTP_INTE.AIEビットを0にすると、/INT端子はINTF.AFビットの状態に依らずHi-Zに開放されます。

図 3.20

アラーム割り込みタイミングチャート

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3

機能

3.7 ウェイクアップタイマー機能
3.7.1 概要
ウェイクアップタイマー機能の概要を以下に示します。
•
•
•
•
•
•

24ビットプリセッタブルアップ/ダウンカウンターで構成されます。
ソースクロック: 1024 Hz、64 Hz、1 Hz、1/60 Hz、外部クロック (EVIN2入力) から選択可能です。
976 µs 〜 32年までの任意の周期で割り込みを発生可能です。
割り込み出力をFOUT端子にも割り当て可能です。
ウォッチドッグタイマーとして使用可能です。
動作時間の積算計としても利用可能です。

図 3.21にウェイクアップタイマーの構成を示します。

図 3.21

ウェイクアップタイマーの構成

3.7.2 動作ソースクロック
ソースクロックはTCTL.TSEL[1:0]ビットおよびWTICFG.TSEL2ビットにより表 3.10に示す5種類から選択可能です。
表 3.10

ウェイクアップタイマーソースクロックの選択
周期/INT 自動復帰時間(tRTN2) *0b00

1024 Hz976 µs488 µs

0b01

64 Hz

15.625 ms

7.812 ms

0b10

1 Hz

1秒

7.812 ms

0b11

1/60 Hz60秒

7.812 ms

TCTL.TSEL[1:0]01

ソースクロック
周波数

WTICFG.TSEL2–

EVIN2端子入力 (外部イベント)

自動復帰なし* tRTN2は/INT端子がLOWになってから、自動的に開放される (Hi-Zになる) までの時間です。

ウェイクアップタイマーのソースクロックにEVIN2端子入力を選択した場合は、EVIN2からクロックを入力します。カウントクロックとして使用可能な最大クロック周波数は1024 Hzで、クロック波形のHパルス幅は488 µs以上が必要です。
注: WTICFG.TSEL2ビット = 1の場合、EVIN2端子への入力信号がウェイクアップタイマーのソースクロックになります。その際は、EVIN2端子のプルアップ/プルダウン設定は有効ですが、ノイズフィルターと入力検出エッジの設定は無効になります。

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3

機能

カウントアップ/ダウンモード
ウェイクアップタイマーのカウンターには、カウントアップとカウントダウンの2つのカウントモードがあり、WTICFG. UPDOWNMODビットによって使用するモードを選択します。
WTICFG.UPDOWNMODビット = 1: カウントアップモード
WTICFG.UPDOWNMODビット = 0: カウントダウンモード

プリセットデータ (ウェイクアップタイマー割り込み周期)
プリセットデータはカウント上限値を指定する値で、ウェイクアップタイマー割り込み周期を決定します。
ウェイクアップタイマー割り込みは、カウントアップモード時はカウンターが設定したプリセットデータを超えた時点で、カウントダウンモード時はカウンターが0になった時点で発生します。プリセットデータ
は、TCTL.TEビット = 0 (タイマーディスエーブル) の状態でレジスターWTCNT_L、WTCNT_M、WTCNT_Hに書き込みます。
注: • タイマー動作中 (TCTL.TEビット = 1) にレジスターWTCNT_L、WTCNT_M、WTCNT_Hにプリセットデー
タを書き込むことは禁止します。
• プリセットデータとして0x000000を設定することはできません。レジスターWTCNT_L、WTCNT_M、
WTCNT_Hに0x000000を書き込んだ場合は、ウェイクアップタイマーはカウントアップ/ダウンせず、割り込
み要求は発生しません。

表 3.11に、ソースクロックの選択とプリセットデータの組み合わせによる割り込み周期の例を示します。
表 3.111024 Hz
TCTL.TSEL[1:0] = 0b00
WTICFG.TSEL2 = 0b0

プリセットデータ

01:
410(0x00019A):
3840(0x000F00):
4096(0x001000):
16777215(0xFFFFFF)

ウェイクアップタイマー割り込み周期
ソースクロック
64 Hz
1 Hz
TCTL.TSEL[1:0] = 0b01
TCTL.TSEL[1:0] = 0b10
WTICFG.TSEL2 = 0b0
WTICFG.TSEL2 = 0b0

1/60 Hz
TCTL.TSEL[1:0] = 0b11
WTICFG.TSEL2 = 0b0–
976 µs
:–15.625 ms
:

–
1秒
:

–
60秒
:

400.39 ms

6.406秒

410秒

410分

:

:

:

:

3.7500秒

60秒

3840秒

3840分

:

:

:

:

4秒

64秒

4096秒

4096分

:

:

:

:

4.55時間72.81時間4660時間31.9年

カウント動作条件 (/RST出力機能搭載機種のみ)
WTCTL.WTSTOPCTLビットを1に設定すると、WTCTL.WTMODSELビットの設定が有効になり、ウェイク
アップタイマーのカウント動作をノーマルモード時 (リセット出力解除中) のみ、あるいはセーフモード時(リセット出力中) のみに制限することができます。
表 3.12

ノーマルモード/セーフモードにおけるウェイクアップタイマーのカウンターの動作条件設定

WTCTL.WTSTOPCTL WTCTL.WTMODSEL

動作条件

0

X

ノーマルモード/セーフモードの両モードでカウント可能

10

ノーマルモード時 (リセット出力解除中) のみカウント可能

1

セーフモード時 (リセット出力中) のみカウント可能

たとえば、ノーマルモード時のみ動作するように設定した場合、セーフモードに切り替わるとカウント動作は停止しますが、その時点のカウント値は保持され、再びノーマルモードに戻った時点でカウント動作も保持していたカウント値から再開します。これにより、ノーマルモード動作時間の積算計として使用することもできます。
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3

機能

ウェイクアップタイマー設定手順
ウェイクアップタイマーを設定して割り込みを発生させる手順を以下に示します。
1.

TCTL.TEビットに0を書き込む。

(ウェイクアップタイマーディスエーブル)

2.

TSTP_INTE.TIEビットに0を書き込む。

(ウェイクアップタイマー割り込みディスエーブル)

3.

TCTL.TSEL[1:0]ビットとWTICFG.TSEL2ビットを設定する。(ソースクロックの選択)

4.

レジスターWTCNT_L、WTCNT_M、WTCNT_Hを設定する。
(ウェイクアップタイマー割り込み周期の設定)

5.

レジスターWTICFGを設定する。
- WTONETIMビット- WTIOUTビット- UPDOWNMODビット(割り込み出力の設定)(/INT自動解除の設定)(割り込み出力端子の選択)(カウントアップ/ダウンモードの選択)

6.

レジスターWTCTLを設定する。
- WTMODSELとWTSTOPCTLビット- WTSTOPビットに0を書き込む。

(タイマー動作条件の設定)(ノーマル/セーフモードの動作条件を選択)(一時停止の解除)

7.

INTF.TFビットに0を書き込む。

(ウェイクアップタイマー割り込みフラグをクリア)

8.

TSTP_INTE.TIEビットに1を書き込む。

(ウェイクアップタイマー割り込み許可)

9.

TCTL.TEビットに1を書き込む。

(ウェイクアップタイマーイネーブル)

カウントを開始します。

カウントの開始
カウントアップモード
TCTL.TEビットが1になると、ウェイクアップタイマーは初期値 (1) をカウンターにロードしてカウント
アップを開始します。ただし、ソースクロックとは非同期にカウントを開始しますので、最初のカウント
アップまで、最大ソースクロック1周期の遅延が生じます。
TCTL.TE
内部ソースクロック
アップカウンター

誤差 カウント開始
1

ソースクロック周期23

初期値 (1) セット

プリセット値

1

2

プリセット値を超えた時点で初期値 (1) セット
3

INTF.TF/INT
tRTN2

図 3.22

ウェイクアップタイマーカウントアップ動作

カウントアップによりカウンターがプリセット値を超えると、初期値 (1) がカウンターにロードされ、その値からカウントアップを継続します。

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3

機能

カウントダウンモード
TCTL.TEビットが1になると、ウェイクアップタイマーはレジスターWTCNT_L、WTCNT_M、WTCNT_Hの値をカウンターにプリセットして、カウントダウンを開始します。ただし、ソースクロックとは非同期にカウントを開始しますので、最初のカウントまで、最大ソースクロック1周期の遅延が生じます。
TCTL.TE
内部ソースクロック
ダウンカウンター

誤差 カウント開始
3

カウンター

ソースクロック周期
2

1

プリセット

3

0
2

プリセット

プリセット値3

INTF.TF/INT
tRTN2

図 3.23

ウェイクアップタイマーカウントダウン動作

カウントダウンによりカウンターが0になると、レジスターWTCNT_L、WTCNT_M、WTCNT_Hの値がカウンターにロードされ、その値からカウントダウンを継続します。
図 3.24にTCTLE.TEビットへの1書き込み後のカウント開始タイミングを示します。
RA4000CE
CLK
レジスターTCONへの書き込み

DIO/DI

TE

WADA

0

TSEL1 TSEL0
カウントスタート

RA8000CE
SCL
レジスターTCONへの書き込み

SDA (ホスト)

TE

WADA

SDA (RTC)0

TSEL1 TSEL0
ACK
カウントスタート

図 3.24

ウェイクアップタイマーカウント開始タイミング

一時停止
動作中のウェイクアップタイマーを一時停止するには、WTCTL.WTSTOPビットに1を書き込みます。ウェ
イクアップタイマーはその時点のカウンター値を保持した状態で停止します。WTCTL.WTSTOPビットに0を書き込むと、ウェイクアップタイマーは保持していたカウント値からカウントを再開します。この一時停止動作もソースクロックとは非同期に行われますので、開始時と同様に誤差が生じます。
なお、他の制御ビットの設定状態によっては、WTCTL.WTSTOPビットでカウンターは停止しません。関係する制御ビットによるウェイクアップタイマーの動作状態を表 3.13に示します。

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表 3.13

ウェイクアップタイマーの動作制御

TCTL.TE

TSTP_INTE.
STOPWTCTL.
WTSTOPCTLWTCTL.
WTSTOP

1

0

0

0

カウント動作をします。

1

カウント動作を一時停止します。

1

X

WTCTL.WTSTOPビットの設定は無効となり、1に設定してもカウンターは停止しません。

1

X

X

カウンターは停止します。
ただし、ソースクロック = 1024 Hzまたは外部クロックの場合は、TSTP_INTE.STOPビット =0と同じ動作となります。

X

X

X

カウンターは停止しています。

0

機能

動作状態

カウンターデータの読み出し
TCTL.TEビット = 1のときレジスターWTCNT_L、WTCNT_M、WTCNT_Hからカウント動作中のカウント値を読み出すことができます。
このカウンターには、時計/カレンダーデータの読み出しに用いる計時バッファーと同様のリードバッファーがありますので、カウンターが動作している期間中も、任意のタイミングで正確なカウンター値を読み出せます。
カウントデータのリードバッファーへの取得タイミングは、SPIインターフェイス搭載機種の場合は、CE信
号の立ち上げ後、ウェイクアップタイマーカウンターの読み出しコマンドの6クロック目の立ち上がりです。
その時点でのウェイクアップタイマーカウンター値が、リードバッファーへ同時に一括して読み出されます。
そしてリードバッファーに転送されたカウント値情報を、レジスターWTCNT_L、WTCNT_M、WTCNT_H(アドレス0x0A 〜 0x0C) より、ホストが連続読み出しします。
I2C-Busインターフェイス搭載機種の場合は、まず、読み出し領域の先頭アドレスであるレジスター
WTCNT_L (アドレス0x0A) をホストが書き込みます。次に、7ビットのスレーブアドレスと、8ビット目のデータ転送の1 (リード) を受信した後の、アクノリッジ送出中のSCLの立ち上がりを受信したとき、ウェイ
クアップタイマーカウンターの値が、リードバッファーへ同時に一括して読み出されます。そして、リード
バッファーの情報をホストが連続読み出します。

TCTL.TEビット = 0のときレジスターWTCNT_L、WTCNT_M、WTCNT_Hからは、ウェイクアップタイマーのプリセット値が読み出されます。

カウンターのリセット
本ウェイクアップタイマーには、レジスター操作、または外部信号入力により、動作中のカウンターをリセットする機能があります。このリセットが入力されると、ウェイクアップタイマーは初期値 (カウントアップモード時は1、カウントダウンモード時はプリセット値) をカウンターにロードしてカウント動作を継続します。ただしこのときは、ウェイクアップタイマー割り込みは発生しません。
この機能を利用してウェイクアップタイマーをウォッチドッグタイマーとして使用することも可能です。

レジスター操作によるリセット
WTCTL.WTRSTビットに1を書き込むことで、動作中のカウンターをリセットすることができます。

外部信号入力によるリセット
WTCTL.EXWTRSTENビットを1に設定することにより外部リセット入力が有効になります。リセット信号として、977 µs以上の幅を持つHIGHパルスをEVIN2端子から入力します。
WTCTL.EXWTRSTENビット = 0の場合、EVIN2端子からのパルス入力があってもカウンターのリセット動
作は発生しません。
なお、WTCTL.EXWTRSTENビットの設定によらず、WTCTL.EWTRSTビットへの1書き込みによるレジス
ター操作でのリセットは有効です。
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機能

リセットウィンドウ
リセットウィンドウは、カウントダウンモードにおけるカウンターリセットの受付期間を、表 3.14に示されるように制限する機能です。受付期間はWTCTL.WTRSTWIN[1:0]ビットで指定します。このリセットウィ
ンドウ設定は、レジスター操作および外部信号入力のどちらのリセット操作にも有効です。また、ダウンカ
ウンターのプリセット値は、このリセット受付期間よりも大きい値に設定される必要があります。
表 3.14

リセットウィンドウの設定

WTCTL.WTRSTWIN[1:0]

リセット受付期間 (カウントダウンモード)

0b00
0b01
0b10
0b11

全期間 (デフォルト)
カウンター値 = 2 〜 1
カウンター値 = 16 〜 1
カウンター値 = 64 〜 1

TCTL.TE
内部ソースクロック
WTCTL.WTRSTWIN[1:0]0b01
リセット受付期間 (2カウント手前から)

ダウンカウンター

0xA 0x9

0x8

0x7

0x6

0x5

0x4

0x3

0x2

0x1

プリセット

0xA

0x9

0x8

0x7

0x6

0x5

0x4

0x3

0x6

0x5

0x4

0x3

2 A 0x9

プリセット

プリセット値

0xA/INT
WTCTL.WTRSTもしくはEVIN2入力による非同期リセットが発生した場合
カウンターリセット
ダウンカウンター

0xA 0x9

0x8

0x7

0x6

0x5

0x4

0x3

2 A 0x9

0x8

0x7* カウントダウンモード、プリセット値 = 0x00000Aに設定した場合

図 3.25

リセットウィンドウ設定時のタイマーリセットタイミング (非同期リセットタイミング)

ウェイクアップタイマー割り込み
図 3.26にウェイクアップタイマー割り込み回路の構成を示します。
FSEL[1:0]
1 Hz1024 Hz
32768 HzWTIOUT

FOUT

TIE
/INT
24ビットプリセッタブル
アップ/ダウンカウンター

TF

TFへの0書き込み

TSEL[1:0]

自動復帰
制御1024 Hz
64 Hz

図 3.26tRTN2WTONETIM

ウェイクアップタイマー割り込み回路の構成

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機能

ウェイクアップタイマー割り込みは、プリセットしたカウント周期で発生させることができます。
カウントアップモードではカウントアップによりカウンター値がプリセット値を超えるタイミングで、カ
ウントダウンモードではカウントダウンによりカウンターが0になる時点でウェイクアップタイマー割り込みが発生し、INTF.TFビットが1にセットされます。このとき、TSTP_INTE.TIEビット = 1 (割り込み許可)
であれば、/INT端子がLOWになってホストへ割り込み要求を出力します。そして、/INT自動復帰時間 (tRTN2、
表 3.10参照) 経過後に、自動的にHi-Zに戻ります。なお、/INT信号の自動復帰機能は、WTICFG.WTONETIM
ビットを1に設定することで無効にできます。
/INT端子は自動的にHi-Zに復帰する一方、1がセットされたINTF.TFビットは、ホストから0を書き込まれるまで1を保持します。INTF.TFビット、またはTSTP_INTE.TIEビットに0を書き込むと、/INT自動復帰時間が経過する前かどうかにかかわらず、/INT端子はHi-Zに戻ります。なお、タイマーソースクロックにEVIN2端
子入力を選択時は、WTICFG.WTONETIMビットの設定にかかわらず、/INT信号の自動復帰機能は無効です。
ホストによる制御
カウント開始カウント停止-1-0

TCTL.TE-1-0

TSTP_INTE.TIE
*1

*1

*1

tRTN2

tRTN2

tRTN2

/INT出力
tRTN2

-1
-0

INTF.TF
カウンター > プリセット値
またはカウンター = 0- Hi-Z-0

割り込み周期

割り込み周期

割り込み周期

割り込み周期

ウェイクアップタイマー動作期間*1 INTF.TFビット、TSTP_INTE.TIEビット、またはTCTL.TEビットを0クリアすると、tRTN2を待たずに/INT端子が開放されます(HiZになります)。

図 3.27

ウェイクアップタイマー割り込みタイミングチャート

ウェイクアップタイマーの割り込み要求信号は、WTICFG.WTIOUTビット = 0の場合、他の割り込み要求信号とNORされて/INT端子から出力されます。
WTICFG.WTIOUTビット ＝1の場合は、FOUT端子が有効な機種では、FOUT端子から出力します。
注: WTICFG.WTIOUTビット = 1の場合、FOUT信号とウェイクアップタイマー割り込み要求信号がNORされてFOUT 端 子 か ら 出 力 さ れ ま す 。 ウ ェ イ ク ア ッ プ タ イ マ ー 割 り 込 み 要 求 信 号 の み を 出 力 す る に は 、TCTL.FSEL[1:0]ビットを0b11に設定してFOUT信号の出力を停止してください。

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機能

3.8 FOUT出力機能
3.8.1 概要
FOUT出力機能の概要を以下に示します。
• RA4000CE/RA8000CEで生成したクロックを外部に出力可能です。
• 出力クロックを32.768 kHz、1024 Hz、1 Hzから選択可能です。
• レジスターまたは外部入力信号 (FOE) によりFOUT出力を制御可能です。
図 3.28にFOUT出力回路の構成を示します。
発振回路

FSEL[1:0]

分周回路
16384 Hz:1024 Hz

STOP

FOE

32.768 kHz1024 Hz
1 Hz

出力制御

FOUT

ウェイクアップタイマー
割り込み出力1/1024秒
カウンター

図 3.28

FOUT出力回路の構成

注: FOUT出力機能はFOUT端子を持つ機種でのみ有効です。また、外部信号によるFOUT出力制御機能は、FOE端子を持つ機種でのみ有効です。

3.8.2 動作
初期設定
機種によっては、FOUT端子とFOE端子が他の機能と兼用されています。このため、レジスター制御によって端子機能をFOUT出力用に切り替える初期設定が必要になる場合があります。詳細は、4.1節の “0x38:
WTICFG (Wakeup Timer Interrupt Configuration)”を参照してください。

FOUT出力の制御 (FOE端子を使用しない場合)
FOUT出力は、電源投入時はOFF (Hi-Z) です。FOUT出力の出力・停止 (Hi-Z) は、TCTL.FSEL[1:0]ビットで設定します。なお、1Hz出力設定のみ、TSTP_INTE.STOPビットの設定も影響します。
表 3.15

FOUT出力の選択

TSTP_INTE.STOP TCTL.FSEL[1:0]01

出力クロック

0b00

32.768 kHz

0b011024 Hz

0b10

1 Hz

0b11

OFF (Hi-Z)

0b00

32.768 kHz

0b011024 Hz

0b10

H or L 固定

0b11

OFF (Hi-Z)

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機能

FOUT出力の制御 (FOE端子を使用する場合)
FOE端子を持つ機種では、FOUT出力を、FOE入力信号で制御することができます。出力クロック周波数はTCTL.FSEL[1:0]ビット（表 3.15参照）で選択します。
FOE入力信号がHIGHレベルになっている間、TCTL.FSEL[1:0]ビットの設定によって選択された周波数の
FOUT信号が、FOUT端子から出力されます。FOE入力信号がLOWレベルの場合、FOUT端子はHi-Zになりま
す。
FOE
FOUT

Hi-Z

Hi-Z

図 3.29FOE制御によるFOUT出力

FOUT端子からのウェイクアップタイマー割り込み信号出力
クロック出力が不要な場合、WTICFG.WTIOUTビットを1に設定することで、FOUT端子をウェイクアップ
タイマーの割り込み要求信号出力端子としても使用可能です。その際、TCTL.FSEL[1:0]ビットが0b11以外に設定されている場合、選択したクロックとウェイクアップタイマー割り込み要求信号がNORされて、FOUT
端子から出力されます。

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機能

3.9 リセット出力機能
3.9.1 概要
RA4000CE/RA8000CEは、電源電圧の低下によるシステムの誤動作を防止するため、リセット出力機能を備えています。リセット出力機能は電源電圧VDDの低下を検出し、電圧が復帰するまで、外部デバイスにリセット
信号 (/RST) を出力します。
注: リセット出力機能は/RST端子を持つ機種でのみ有効です。

3.9.2 動作
リセット出力用VDD電圧検出動作
リセット出力はVDD電圧検出結果によって制御されます。
ノーマルモード時 (VDD電圧正常時) は、このVDD電圧低下検出機能が常時動作します。VDD電圧がVDD立ち下がり時検出電圧-VDET1nを下回ったことが検出されると、/RST端子からリセット信号 (アクティブLOW) が出
力され、RA4000CE/RA8000CEはセーフモードになります。
セーフモード時は、VDD電圧検出機能は間欠動作し、消費電力を抑えます。VDD電圧がVDD立ち上がり時検出電
圧+VDET1n以上に復帰したことが検出されると、その60 ms後にリセット出力が解除され (/RST端子=L→Hi-Z)、
RA4000CE/RA8000CEはノーマルモードに戻ります。
VDD立ち下がり時/立ち上がり時検出電圧 (-VDET1n、+VDET1n) およびセーフモード時の間欠動作間隔については、それぞれ“5.7 リセット出力特性”および図 5.2を参照してください。
tR1

tF

tR2

VDD
電源VDD

+VDET1n

VACC (Min.)VPOR (Max.)
GND

GND

+VDET1n

解除

解除

アサート
tSTA

I/O制御

I/Oディスエーブル

t_int
tDELAY
128 ms 60 ms(Max.)tCD

I/Oイネーブル

I/Oディスエーブル(CE, CLK, DI (DIO),
SCL, SDA, DO, /INT,
FOUT, SOUT)/RST(VDD ≧ +VDET1n)VPOR (Min.)

内部 Vreg
内部POR-VDET1n

外部プルアップ (VDD)

I/Oイネーブル
tDELAYS
188 ms(Max.)tDELAYF

ノーマルモード期間

図 3.30

セーフモード期間

ノーマルモード期間

リセット出力タイミング

リセット出力フラグ
リセット出力開始時に、リセット出力フラグ (BUF_INTF.RSTOFビット) が1にセットされます。このフラグはタイムスタンプを取得する内部イベントトリガーのひとつで、イベント検出割り込みを発生可能です。
VDD電圧が+VDET1n以上に復帰してセーフモードからノーマルモードに遷移し、リセット出力が解除された
後に、リセット出力フラグビットに0を書き込んで、フラグをクリアする必要があります。なおセーフモー
ド期間中では、リセット出力フラグは常に1にセットされるため、リセット出力フラグビットに0を書き込
んでもフラグはクリアできません。

リセット出力中のI/O制御
セーフモードにおける/INT, FOUT, SOUT出力の有効・無効と、ホストインターフェイスの有効・無効を、独立に設定することができます。
セーフモードにおける/INT, FOUT, SOUT出力の有効・無効は、WTICFG.RSTOPT0ビットで設定します。このビットを0 (無効) にした場合、セーフモードにおける/INT, FOUT, SOUTはすべてHi-Zになります。
セーフモードにおけるホストインターフェイスの有効・無効は、WTICFG.RSTOPT1ビットで設定します。
このビットを0（無効）にした場合、セーフモードにおけるホストインターフェイスの入力/入出力信号 FOE,
CE, CLK, DI, DIO, SDA, SCLは無効 (Hi-Zにすることが可能)、DO端子はHi-Zになります。
なお、EVINn端子からの入力はセーフモードでも有効です。
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機能

3.10 自己監視機能
3.10.1 概要
RA4000CE/RA8000CEは電源電圧や発振の状態を監視する機能を搭載しており、その結果をステータスフラグ
として読み出すことができます。また、これらのフラグはタイムスタンプのトリガーや記録内容、イベント割
り込み要因としても利用されます。監視対象は以下のとおりです。
• パワーオンリセットの実行 (PORFフラグ、VLFフラグ)• 発振停止 (OSCSTPFフラグ、VLFフラグ)• 電源電圧 (VDD) の温度補償更新停止電圧以下への低下 (VTMPLFフラグ)
また、/INT端子やSOUT端子を持つ機種では、 PORFフラグとそれに伴うVLFフラグを除く、これらのステー
タスフラグの状態を外部デバイスに出力可能です。

3.10.2 自己監視フラグ
パワーオンリセット発生検出: PORFフラグ
PORFフラグ (INTF.PORFビット) は、電源投入後にパワーオンリセットが実行されたことを検出すると1にセットされます。その後パワーオンリセットが解除されても、このフラグは自動的には0に戻りません。
INTF.PORFビット = 1のときは必要な初期設定等を行うと共に、INTF.PORFビットに0を書き込んで、フラグをクリアします。

水晶発振停止検出: OSCSTPFフラグ
OSCSTPFフラグ (INTF.OSCSTPFビット) は、内蔵の水晶発振が10 ms以上停止したことを検出すると1にセットされます。1にセットされた後、発振が再開しても、このフラグは自動的には0に戻りません。
INTF.OSCSTPFビット = 1のときは、必要な初期値設定等を行うと共に、INTF.OSCSTPFビットに0を書き込
んで、フラグをクリアします。
このフラグは、タイムスタンプトリガーおよびイベント検出割り込みにも利用されます。詳細は“3.11.5 タ
イムスタンプ (イベント検出) 割り込み”を参照してください。

日時データ無効警告: VLFフラグ
VLFフラグ (INTF.VLFビット) は上記のPORFフラグかOSCSTPFフラグがセットされた場合に1にセットされます。VDDの電源投入後やセーフモードからの復帰後、このフラグであるINTF.VLFビットが1だった場合
は、初期設定が必要です。INTF.VLFビットの操作を含むこの初期設定手順について、“2.2.3 初期設定”を参照してください。

温度補償更新停止検出: VTMPLFフラグVTMPLFフラグ (INTF.VTMPLFビット) は、VDD電圧が温度補償更新停止検出電圧 (VDET2) 以下に低下した
場合に1にセットされます。この場合、温度補償回路は停止し、停止した際の周波数補正条件で発振を継続します。INTF.VTMPLFビットは、VDDがVTMP以上に復帰した後に0を書き込むことによってクリアされます。
このフラグは、タイムスタンプトリガーおよびイベント検出割り込みにも利用されます。詳細は“3.11.5 タ
イムスタンプ (イベント検出) 割り込み”を参照してください。

3.10.3 自己監視フラグの端子出力機能/INT端子からは、イベント検出割り込みとしてフラグ内容を出力可能です。/INT端子からの出力機能は、タ
イムスタンプ割り込み機能の一部であるイベント検出割込み機能に含めて説明していますので“3.11.5 タ
イムスタンプ (イベント検出) 割り込み”を参照してください。
SOUT端子からは、ステータスフラグ設定状態の出力としてフラグ内容を出力可能です。SOUT端子からの出力機能の詳細は、“3.12 SOUT出力機能”を参照してください。
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機能

3.11 タイムスタンプ機能
3.11.1 概要
RA4000CE/RA8000CEには、EVINn端子入力の信号変化で生じる外部イベントや、自己監視機能で得られた電源電圧の低下や発振停止などの内部イベントが発生した時点の、日時やイベント要因などの情報を記録する
タイムスタンプ機能があります。主な機能と特長を以下に示します。
• タイムスタンプトリガー
外部イベント入力: - 最大2チャネル (EVIN1、EVIN2)- 内蔵プルアップ/ダウン抵抗を選択可能- トリガーエッジとして立ち上がりエッジ、立ち下がりエッジ、または両エッジを選択可能- ノイズフィルター (0 ～ 5000 ms、125 msステップ) を内蔵- イベントカウンターを内蔵 (各6ビット、外部イベント入力にのみ対応)- 入力端子の状態をモニター可能
内部イベント:- リセット出力 (-VDET1n電圧低下検出)- VDET2電圧低下検出- 発振停止検出
コマンドトリガー: - 指定アドレスへの書き込みによりトリガーを発行• タイムスタンプバッファー - 32バイトSRAMを内蔵- 選択した各イベントのタイムスタンプデータを2回分記録するダイレクト
モードと、SRAMとして全領域を任意にリード/ライトアクセス可能なSRAM
モードに対応- ダイレクトモードでは、バッファーフル時に2回目のタイムスタンプバッ
ファーへの上書きを許可するオーバーライトモードと、上書きを禁止する
オーバーライト禁止モードに対応• 記録データ- 1/1024秒 〜 1秒、BCD形式の時刻データ (秒、分、時、日 (曜日は除く)、月、
年) またはバイナリーカウンターデータ、EVINn端子の状態、電圧低下/発振の状態、タイムスタンプトリガー要因• タイムスタンプはセーフモード時も取得可能• 外部イベントおよび内部イベント発生時に割り込みを発生可能
図 3.31にタイムスタンプ回路の構成を示します。
発振回路

STOP

分周回路
16384 Hz–1024 Hz

1/1024秒カウンター

SRAM(Bank 6, 7)

1/1024 s ~1023/1024 s
データ
キャプチャー回路

BINSEL時計/カレンダー
秒–年
BCD (秒–年)
BIN (秒)自己監視機能/リセット出力機能

Host

RSTOF
VTMPLF
OSCSTPF

イベント
トリガー
入力回路

コマンド

EVIN2
EVIN1
プルアップ/ダウン
制御

バッファー
制御回路

秒

(アドレス0x41–0x42)

GND

SRAMMOD

タイムスタンプ

ノイズ
フィルター

EVIN入力制御/イベントカウンター

FLT[5:0]

POL[1:0]***F:***EVFOVWEN
FULLF
FULLIEN
EMPTF
EMPTIENOVWF
OVWIEN

EVF
EIE

割り込み
制御回路
(イベント検出
割り込み)

/INT

***CPEN***IENEVCNT[5:0]
EVINnMON

VDD

PUPD[2:0]

図 3.31

タイムスタンプ回路の構成

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機能

3.11.2 タイムスタンプトリガー
RA4000CE/RA8000CEは外部または内部イベントの発生、もしくは特定レジスターへの書き込みをトリガーとして、その時点のタイムスタンプデータを取得してバッファーに書き込みます。それぞれのタイムスタンプト
リガーを、EVINnイベント入力トリガー、内部イベントトリガー、コマンドトリガーと言います。

外部イベント入力 (EVINn端子)トリガー
外部イベント入力トリガー信号はEVIN1およびEVIN2端子から入力されます。この外部イベントトリガー入力に関連する機能を以下に示します。

プルアップ/プルダウン抵抗
EVINn端子にはプルアップ/プルダウン抵抗が内蔵されており、その構成を選択することができます。
表 3.16

EVINn端子のプルアップ/ダウン

EVIN1_CFG.PUPD[2:0]
EVIN2_CFG.PUPD[2:0]

プルアップ/ダウン抵抗

0b000
0b001
0b010
0b011
0b100
その他

プルアップ/ダウンなし
プルアップ 500 kΩ
プルアップ
1 MΩ (デフォルト)
プルアップ 10 MΩ
プルダウン 500 kΩ
プルアップ/ダウンなし

ノイズフィルター
EVINn端子には入力信号のノイズを除去するノイズフィルター回路が設けられています。EVINn端子への入力信号を125 ms周期でサンプリングし、その結果がEVINn_FLT.FLT[5:0]の設定回数分、連続して一致したときに、その論理値が入力されたと判定します。
EVIN1ノイズフィルター: EVIN1_FLT.FLT[5:0]ビット
EVIN2ノイズフィルター: EVIN2_FLT.FLT[5:0]ビット(フィルター時間 [ms] = FLT[5:0] × 125)以下の図は、FLT[5:0]=0x03に設定した例です。
125 ms

125 ms

125 ms

125 ms

125 ms

サンプリングクロック(周期 125 ms)
EVINn端子立ち上がりエッジ検出

EVINnサンプリング結果
EVINn判定結果(立ち上がりエッジ検出時, EVINn_FLT.FLT[5:0]ビット = 0x03)

図 3.32

EVINnのノイズフィルター機能

注: • EVINn_FLT.FLT[5:0]ビットを0x00に設定した場合でも、有効な入力信号としてEVINn端子の入力信号1 ms以上のパルス幅が必要です。
• 入力信号は入力検出から5 ms後に取り込まれるため、タイムスタンプの取得まで5 msの遅延が生じます。

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表 3.17

機能

EVINn入力有効パルス幅

EVINn_FLT. FLT[5:0]

入力信号のエッジと125msごとのサンプリングタイミ
ングとの前後関係によって、エッジ入力が検出される場合とされない場合が生じるEVINnのパルス幅

常にエッジ入力が検出される
EVINnのパルス幅

0x00
0x01 (設定禁止)
0x02
0x03
:
0x27
0x28
0x29以上 (設定禁止)––
125 ms以上、250 ms未満
250 ms以上、375 ms未満:
4750 ms以上、4875 ms未満
4875 ms以上、5000 ms未満–

1 ms以上–250 ms以上
375 ms以上:
4875 ms以上
5000 ms以上–

入力検出
EVINn端子に入力される信号の検出エッジを設定可能です。
表 3.18

EVINn入力検出エッジ

EVIN1_CFG.POL[1:0]
EVIN2_CFG.POL[1:0]

検出エッジ

0b00
0b01
0b10
0b11

立ち下がりエッジ (デフォルト)立ち上がりエッジ
立ち下がりおよび立ち上がりエッジ

イベントカウンター
各EVINn入力には6ビットカウンターが設けられており、イベントトリガーの入力数を0から63の範囲でカウントすることができます。カウント値は以下のビットから読み出し可能です。
EVIN1イベントカウンター: EVIN1_EVCNT.EVCNT[5:0]ビット
EVIN2イベントカウンター: EVIN2_EVCNT.EVCNT[5:0]ビット

モニター
EVINn端子の現在の状態 (入力ロジックレベル) をモニターするビットが用意されています。
EVIN1モニター: EVINMON.EVIN1MONビット
EVIN2モニター: EVINMON.EVIN2MONビット(1: HIGHレベル入力、0: LOWレベル入力)

内部イベントトリガー
電源電圧の低下を検出した時点で、または発振の停止を検出した時点で内部イベントトリガーを発行することができます。
リセット出力(VDD ＜ -VDET1n検出時にタイムスタンプデータを取得)
VDET2電圧低下検出 (VDD ≦ VDET2検出時にタイムスタンプデータを取得)
発振停止検出(タイムスタンプデータの取得は、発振が再開したタイミングで作動します。)

コマンドトリガー
WRCMD_CFG.CMDTRGENビットを1に設定した上でレジスターWRCMD_TRGに任意の値を書き込むことで、コマンドトリガーを発行可能です。

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機能

3.11.3 タイムスタンプバッファー
RA4000CE/RA8000CEには32バイトSRAM (レジスターRAM) が搭載されており、取得したタイムスタンプデー
タを格納するタイムスタンプバッファーとして使用されます。

タイムスタンプデータ
タイムスタンプバッファーは、イベントが発生した日時、内部ステータス、トリガー要因で構成されるタイ
ムスタンプデータを2回分格納可能です。記録する日時データは、BCDカウンターデータとBINカウンター
データのいずれかをBUF1_CFG1.BINSELビットで選択します。
タイムスタンプバッファー内のデータ構成を図 3.33に示します。バッファーがクリアされてから最初に取得したデータはBank 6 (アドレス0x60から0x69) から、2回目またはそれ以降の最新データはBank 7 (アドレス0x70から0x79) から読み出し可能です。バッファーに取得するデータは、アドレス0x60から0x69まで、あるいは、0x70から0x79まで連続してアクセスすることにより読み出し可能です。
BCDカウンターデータ取得時 (BUF1_CFG1.BINSELビット = 0)
Address
0x60
0x70
0x61
0x71
0x62
0x72
0x63
0x73
0x64
0x74
0x65
0x75
0x66
0x76
0x67
0x77

Captured data
1/1024秒の分周カウンターデータ

Bit 7

Bit 6

SUBSEC1

SUBSEC02
SUBSEC9512

1
SUBSEC8
256

秒BCDデータ (0–59)–

分BCDデータ (0–59)–

時BCDデータ (0–23)–

日BCDデータ (1–31)–

月BCDデータ (1–12)–

年BCDデータ (0–99)

内部ステータス

0x69
0x79

データを取得したトリガー要因

–

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

–

–

–

–

–

–

SUBSEC7
SUBSEC6
12864
SEC_H[2:0]
10秒桁 (BCD)
MIN_H[2:0]
10分桁 (BCD)
HOUR_H[1:0]–
10時桁 (BCD)
DAY_H[1:0]–
10日桁 (BCD)MONTH_H––
10月桁 (BCD)
YEAR_H[3:0]
10年桁 (BCD)

EVIN2POL

0x68
0x78

Bit 5

EVIN2入力
ステータス
EVIN2TRG

EVIN1POL
EVIN1入力
ステータス
EVIN1TRG

SUBSEC532

SUBSEC4SUBSEC3
168
SEC_L[3:0]
1秒桁 (BCD)MIN_L[3:0]
1分桁 (BCD)
HOUR_L[3:0]
1時桁 (BCD)
DAY_L[3:0]
1日桁 (BCD)MONTH1[3:0]
1月桁 (BCD)YEAR_L[3:0]
1年桁 (BCD)RSTOSTATVTMPLSTAT–

リセット出力 VDET2低下検出
ステータス
ステータス
WRCMDTRG RSTOTRG VTMPLTRGOVWFSTAT*
オーバー
EVIN2
EVIN1
コマンド
リセット出力 VDET2低下検出
ライト
トリガー発生 トリガー発生 トリガー発生 トリガー発生 トリガー発生
ステータス

–

–

SUBSEC2
4OSCSTP
STAT
発振停止検出ステータス
OSCSTPTRG
発振停止検出
トリガー発生* OVWFSTATはアドレス0x79にのみ存在します (アドレス0x69にはありません)。

BINカウンターデータ取得時 (BUF1_CFG1.BINSELビット = 1)
Address
0x60
0x70
0x61
0x71
0x62
0x72
0x63
0x73
0x64
0x74
0x65
0x75
0x66
0x76

Captured data
1/1024秒の分周カウンターデータ

秒バイナリーデータ0秒バイナリーデータ1
秒バイナリーデータ2
秒バイナリーデータ3秒バイナリーデータ4

0x67
0x77

–

0x68
0x78

内部ステータス

0x69
0x79

データを取得したトリガー要因

Bit 7

Bit 6

SUBSEC1

SUBSEC0

Bit 5

–
2
1
SUBSEC9SUBSEC8SUBSEC7512
256
128
SEC_BIN7
SEC_BIN6
SEC_BIN5
128 s
64 s
32 s
SEC_BIN15 SEC_BIN14 SEC_BIN13
32768 s16384 s8192 s
SEC_BIN23 SEC_BIN22 SEC_BIN21
8388608 s
4194304 s
2097152 s
SEC_BIN31 SEC_BIN30 SEC_BIN29
2147483648 s 1073741824 s 536870912 s
–

–

–

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

–

–

–

–

–

SUBSEC38
SEC_BIN1
2s
SEC_BIN9
512 s
SEC_BIN17
131072 s
SEC_BIN25
33554432 s

SUBSEC2
4
SEC_BIN0
1s
SEC_BIN8
256 s
SEC_BIN16
65536 s
SEC_BIN24
16777216 s
SEC_BIN32
4294967296 s

SUBSEC6SUBSEC5SUBSEC464
32
16
SEC_BIN4
SEC_BIN3
SEC_BIN2
16 s
8s
4s
SEC_BIN12 SEC_BIN11 SEC_BIN104096 s2048 s1024 s
SEC_BIN20 SEC_BIN19 SEC_BIN181048576 s
524288 s
262144 s
SEC_BIN28 SEC_BIN27 SEC_BIN26
268435456 s 134217728 s 67108864 s–––

RSTOSTATVTMPLSTAT––EVIN2POL–

EVIN2入力
ステータス
EVIN2TRG

EVIN1POL
EVIN1入力
ステータス
EVIN1TRG–

リセット出力 VDET2低下検出
ステータス
ステータス
WRCMDTRG RSTOTRG VTMPLTRGOVWFSTAT*
オーバー
EVIN2
EVIN1
コマンド
リセット出力 VDET2低下検出
ライト
トリガー発生 トリガー発生 トリガー発生 トリガー発生 トリガー発生
ステータス

–

–

OSCSTP
STAT
発振停止検出ステータス
OSCSTPTRG
発振停止検出
トリガー発生* OVWFSTATはアドレス0x79にのみ存在します (アドレス0x69にはありません)。

図 3.33

タイムスタンプデータと読み出しアドレス

RA4000CE/RA8000CE
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3

機能

タイムスタンプバッファーの動作モード
タイムスタンプバッファーにはダイレクトモード、SRAMモードの2種類の動作モードが用意されており、
BUF1_CFG2. SRAMMODビットで選択可能です。

ダイレクトモード (BUF1_CFG2.SRAMMODビット = 0)
タイムスタンプデータを読み出すためのモードで、ホストからバッファーへの書き込みは行えません。図3.33に示したとおり、Bank 6 (アドレス0x60から0x69) とBank 7 (アドレス0x70から0x79) からタイムスタン
プデータを読み出すことができます。

SRAMモード (BUF1_CFG2.SRAMMODビット = 1)
このモードでは、Bank 6 (アドレス0x60から0x6F) とBank 7 (アドレス0x70から0x7F) を通してバッファーを
通常のSRAMと同様にリード/ライトアクセスすることが可能です。SRAMの物理アドレスとリード/ライト
アドレスの関係は次のとおりです。
SRAMアドレス
0x00
0x01
0x02
0x03
:
0x0D
0x0E
0x0F
0x10
0x11
0x12
0x13
:
0x1D
0x1E
0x1F

図 3.34

SRAMデータR/Wアドレス
アドレス0x60
アドレス0x61
アドレス0x62
アドレス0x63:
アドレス0x6D
アドレス0x6E
アドレス0x6F
アドレス0x70
アドレス0x71
アドレス0x72
アドレス0x73:
アドレス0x7D
アドレス0x7E
アドレス0x7F

SRAMモード時のメモリーアクセス

タイムスタンプバッファーの書き込みモード
タイムスタンプバッファーがクリアされた状態から、バッファーに2回分のタイムスタンプデータが記録されると、バッファーフルの状態になります。これ以降の動作を指定する2種類の書き込みモードが用意されています。

オーバーライトモード
BUF1_CFG1.OVWENビットを1に設定すると、タイムスタンプバッファーはオーバーライトモードになります。バッファーフルの状態で、さらにタイムスタンプトリガーが発生すると、Bank 6に記録されたタイムス
タンプはそのままに、Bank 7へ新しいタイムスタンプが上書きされます。
オーバーライトが発生した場合はBUF1_STAT.OVWFビットが1にセットされます。

オーバーライト禁止モード
BUF1_CFG1.OVWENビットを0に設定すると、タイムスタンプバッファーはオーバーライト禁止モードになります。バッファーフルの状態でタイムスタンプトリガーが発生すると、オーバーライトのフラグ
BUF1_STAT.OVWFビットはセットされますが、キャプチャーされたデータは破棄され、Bank 6, Bank 7に記録されたタイムスタンプは保持されます。

RA4000CE/RA8000CE
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53

3

機能

3.11.4 動作
初期設定
1.

/INTからのイベント検出割り込み出力を禁止
初期設定中に不要なイベント検出割り込みが発生することを防止するため、割り込みを禁止してくだ
さい。
1-1.

2.

3.

TSTP_INTE.EIEビットを0に設定する。

(タイムスタンプイベント検出割り込みディスエーブル)

EVINn入力の設定
2-1.

EVIN1入力を使用する場合、レジスターEVIN1_CFGとEVIN1_FLTの以下のビットを設定する。
- EVIN1_CFG.PUPD[2:0]ビット(プルアップ/プルダウン抵抗の設定)- EVIN1_CFG.POL[1:0]ビット(検出エッジを選択)- EVIN1_FLT.FLT[5:0]ビット(入力フィルター時間を設定)

2-2.

EVIN2入力を使用する場合、レジスターEVIN2_CFGとEVIN2_FLTの以下のビットを設定する。
- EVIN2_CFG.PUPD[2:0]ビット(プルアップ/プルダウン抵抗の設定)- EVIN2_CFG.POL[1:0]ビット(検出エッジを選択)- EVIN2_FLT.FLT[5:0]ビット(入力フィルター時間を設定)

割り込みの設定
3-1.

外部イベント入力割り込みを許可する場合は、レジスターEVNT_INTEの以下のビットを1 (禁止する場合は0) に設定する。
- EVNT_INTE.EVIN1IENビット*1(EVIN1イベント入力割り込みを許可/禁止)*1- EVNT_INTE.EVIN2IENビット(EVIN2イベント入力割り込みを許可/禁止)

3-2.

内部イベント割り込みを許可する場合は、レジスターEVNT_INTEの以下のビットを1 (禁止する
場合は0) に設定する。
- EVNT_INTE.RSTOIENビット*1(リセット出力イベント割り込みを許可/禁止)*1- EVNT_INTE.VTMPLIENビット(VDET2電圧低下検出イベント割り込みを許可/禁止)- EVNT_INTE.OSCSTPIENビット*1(発振停止検出イベント割り込みを許可/禁止)*1 タイムスタンプデータの取得が許可されているか否かにかかわらず、これらのビットにより各イベントの発生による割り込みが許可/禁止されます。
3-3.

4.

バッファーの設定
4-1.

5.

タイムスタンプトリガー入力割り込みを許可する場合は、レジスターBUF1_CFG1の以下のビットを1 (禁止する場合は0) に設定する。
- BUF1_CFG1.FULLIENビット(バッファーフル (2回目取得) 割り込みを許可/禁止)- BUF1_CFG1.EMPTIENビット(バッファーエンプティ解消 (1回目取得) 割り込みを許可/禁止)- BUF1_CFG1.OVWIENビット(バッファーオーバーライト (3回目以降取得) 割り込みを許可/禁止)レジスターBUF1_CFG1の以下のビットを設定する。
- BUF1_CFG1.BINSELビット(日時データ形式 (BCD/BIN) の選択)
- BUF1_CFG1.OVWENビット(オーバーライト/オーバーライト禁止モードの選択)

コマンドトリガーによるイベントカウンターとバッファーのフラグのクリア
5-1.

必要に応じて、SRAMモードに移行し、バッファー内データをALL_1/0などにクリアする。
SRAMモードに関しては、“3.11.6 SRAMモードでのリード/ライト”を参照してください。

5-2.

レジスターWRCMD_CFGに0x90を書き込む。

(クリアコマンド)

5-3.

レジスターWRCMD_TRGに任意の値を書き込む。

(コマンドトリガー発行)

RA4000CE/RA8000CE
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3
6.

/INTからのイベント検出割り込み出力を許可
6-1.

7.

(タイムスタンプイベント検出割り込みイネーブル)

EVINn入力でタイムスタンプを取得する場合は、レジスターEVIN_ENの以下のビットを1 (禁止する場合は0) に設定する。
- EVIN_EN.EVIN1CPENビット(EVIN1入力によるタイムスタンプキャプチャーを許可/禁止)- EVIN_EN.EVIN2CPENビット(EVIN2入力によるタイムスタンプキャプチャーを許可/禁止)

タイムスタンプを取得する内部イベントを設定
8-1.

9.

TSTP_INTE.EIEビットを1に設定する。

タイムスタンプを取得する外部イベントを設定
7-1.

8.

機能

内部イベントの発生時にタイムスタンプを取得する場合は、レジスターCAP_ENの以下のビットを1 (禁止する場合は0) に設定する。
- CAP_EN.RSTOCPENビット(リセット出力イベントトリガーによるタイムスタンプキャプチャーを許可/禁止)- CAP_EN.VTMPLCPENビット(VDET2電圧低下検出イベントトリガーによるタイムスタンプキャプチャーを許可/禁止)- CAP_EN.OSCSTPCPENビット(発振停止検出イベントトリガーによるタイムスタンプキャプチャーを許可/禁止)

外部イベントの入力受付許可
9-1.

EVINn端子からの外部イベント入力を許可する場合は、レジスターEVIN_ENの以下のビットを1(禁止する場合は0) に設定する。
- EVIN_EN.EVIN1ENビット*2(EVIN1からの外部イベント入力を許可/禁止)- EVIN_EN.EVIN2ENビット*2(EVIN2からの外部イベント入力を許可/禁止)*2 EVIN_EN.EVINnENビットを0 (EVINn入力を禁止) に設定する場合は、EVIN_EN.EVINnCPENビッ
トも0に設定してください。

RA4000CE/RA8000CE
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3

機能

タイムスタンプキャプチャー動作
タイムスタンプキャプチャーが許可されたイベント、またはコマンドトリガーによるトリガーが発生すると、RA4000CE/RA8000CEはタイムスタンプデータをカウンターおよびフラグより取得し、バッファーに書き込みます。
バッファークリア後、最初に取得したタイムスタンプデータはBank 6のバッファーに、2回目に取得したデー
タはBank 7のバッファーに書き込まれます。その後の取得データはバッファーがコマンドによりクリアされるまで、オーバーライトモード時はBank 7のバッファーに上書きされ、オーバーライト禁止モード時は破棄されます。
図 3.35と図 3.36にデータのキャプチャーによるバッファーおよびバッファーステータスビットの状態を
示します。
初期状態

1回目

2回目

CLR *1

3回目

4回目

CLR *1

5回目

6回目

CLR *1

7回目

8回目

Bank 6不定

1st data

1st data

1st data

3rd data

3rd data

3rd data

5th data

5th data

5th data

7th data

7th data

Bank 7不定不定

2nd data 2nd data 2nd data 4th data

4th data

4th data

6th data

6th data

6th data

8th data

タイムスタンプ取得
バッファー

Bank 6読み出し↑

Bank 7読み出し

↑
↑

↑
↑

↑
↑

↑

フラグ/割り込み
BUF1_STAT.EMPTF

1

0

1

↑

バッファーエンプティ解消割り込み
BUF1_STAT.FULLF

0

0

0

↑

0

0

1

0

1

0

0

0

0x01

0x02

0x00

9回目

10回目

11回目

Bank 6 7th data

7th data

Bank 7 8th data

8th data

0

BUF1_STAT.OVWF

0

0

0x00

0

0

0

0

↑

0

0

1

0

0

0

0x01

0x02

0x00

···

69回目

70回目

7th data

7th data

7th data

8th data

8th data

8th data

0

0

0

↑

1

↑

0

バッファーフル割り込み

1

0

0

1

0

0

0

0

0x01

0x02

0x00

0x01

0x02

71回目

CLR *1

72回目

73回目

74回目

75回目

7th data

7th data

7th data 72nd data 72nd data 72nd data 72nd data

8th data

8th data

8th data

0

0

1

↑

↑

↑

バッファーオーバーライト割り込み
イベントカウンター *2
EVINn_EVCNT.ECNT[5:0]
タイムスタンプ取得
バッファー

8th data 73rd data 73rd data 73rd data

Bank 6読み出し
Bank 7読み出し
フラグ/割り込み
BUF1_STAT.EMPTF

0

BUF1_STAT.FULLF

0

0

0

0

1

1

1

1

1

↑

↑

0x03

0x04

↑

バッファーエンプティ解消割り込み
1

1

1

1

1

1

1

0

0

↑

バッファーフル割り込み
BUF1_STAT.OVWF

1

1

1

1

1

1

1

バッファーオーバーライト割り込み

↑

↑

↑

↑

↑

↑

↑

0x03

0x04

0x05

···

0x3F

0x00

0x01

0

0

0

イベントカウンター *2
EVINn_EVCNT.ECNT[5:0]

0x00

0x01

0x02

■ Bank 6への新データ書き込み■ Bank 7への新データ書き込み*1: CLR = レジスターWRCMD_CFGを0x90に設定してコマンドトリガーを実行*2: イベントカウンターの内容はEVINn入力以外のイベントトリガーが発生しなかった場合の値です。

図 3.35

タイムスタンプキャプチャー動作 (オーバーライト禁止モード)

RA4000CE/RA8000CE
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3

機能

初期状態

1回目

2回目

CLR *1

3回目

4回目

CLR *1

5回目

6回目

CLR *1

7回目

8回目

Bank 6不定

1st data

1st data

1st data

3rd data

3rd data

3rd data

5th data

5th data

5th data

7th data

7th data

Bank 7不定不定

2nd data 2nd data 2nd data 4th data

4th data

4th data

6th data

6th data

6th data

8th data

タイムスタンプ取得
バッファー

Bank 6読み出し↑

Bank 7読み出し

↑

↑

↑

↑

↑
↑

↑

フラグ/割り込み
BUF1_STAT.EMPTF

1

0

0

1

↑

バッファーエンプティ解消割り込み
BUF1_STAT.FULLF

0

0

0

0

1

0

BUF1_STAT.OVWF

0

0

1

↑

0

1

↑

バッファーフル割り込み

1

↑
0

0

↑

0

0

↑
1

0

0

↑

1
↑

0

0

0

0

0

0

0

0

0

0

0

0

0x00

0x01

0x02

0x00

0x01

0x02

0x00

0x01

0x02

0x00

0x01

0x02

9回目

10回目

11回目

···

63回目

64回目

65回目

CLR *1

66回目

67回目

68回目

69回目

Bank 6 7th data

7th data

7th data

7th data

7th data

7th data

7th data

7th data 66th data 66th data 66th data 66th data

バッファーオーバーライト割り込み
イベントカウンター *2
EVINn_EVCNT.ECNT[5:0]
タイムスタンプ取得
バッファー

Bank 7 9th data 10th data 11th data···

63rd data 64th data 65th data 65th data 65th data 67th data 68th data 69th data

Bank 6読み出し
Bank 7読み出し
フラグ/割り込み
BUF1_STAT.EMPTF

0

0

0

0

0

0

0

1

0

0

0

1

1

1

1

1

↑

↑

0x03

0x04

↑

バッファーエンプティ解消割り込み
BUF1_STAT.FULLF

1

1

1

1

1

1

1

0

0

↑

バッファーフル割り込み
BUF1_STAT.OVWF

1

1

1

1

1

1

1

バッファーオーバーライト割り込み

↑

↑

↑

↑

↑

↑

↑

0x03

0x04

0x05

···

0x3F

0x00

0x01

イベントカウンター

0

0

0

0

*2

EVINn_EVCNT.ECNT[5:0]

0x00

0x01

0x02

■ Bank 6への新データ書き込み■ Bank 7への新データ書き込み*1: CLR = レジスターWRCMD_CFGを0x90に設定してコマンドトリガーを実行*2: イベントカウンターの内容はEVINn入力以外のイベントトリガーが発生しなかった場合の値です。

図 3.36

タイムスタンプキャプチャー動作 (オーバーライトモード)

バッファーステータス
バッファーの状態を示す以下のフラグが用意されています。
• バッファーエンプティフラグ (BUF1_STAT.EMPTFビット)• バッファーフルフラグ (BUF1_STAT.FULLFビット)• バッファーオーバーライトフラグ (BUF1_STAT.OVWFビット)
初期状態では、バッファーはエンプティ状態 (バッファー内のデータは不定) となり、バッファーステータ
スフラグは以下のように設定されます。
BUF1_STAT.EMPTFビット = 1 (バッファーエンプティ)
BUF1_STAT.FULLFビット = 0 (バッファーに空きあり)
BUF1_STAT.OVWFビット = 0 (オーバーライトなし)

RA4000CE/RA8000CE
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3

機能

WRCMD_CFG.BUF1FCLRENビットを1 (バッファーステータスフラグリセット) に設定してコマンドトリガーを発行 (レジスターWRCMD_TRGに任意の値を書き込む) することによってもバッファーはエンプティ状態となり、バッファーステータスフラグも上記のとおりリセットされます。ただし、バッファーの内容は消去されずに残ります。バッファーデータを消去する場合は、SRAMモードに移行して、バッファーデータを書き換え可能です。SRAMモードに関しては、“3.11.6 SRAMモードでのリード/ライト”を参照ください。
1. 1回目のタイムスタンプデータを取得した場合
エンプティ状態から最初のタイムスタンプを取得すると、そのデータはBank 6のバッファーに書き込まれ、バッファーステータスフラグは以下のように設定されます。
BUF1_STAT.EMPTFビット = 0 (バッファーにデータあり)
BUF1_STAT.FULLFビット = 0 (バッファーに空きあり)
BUF1_STAT.OVWFビット = 0 (オーバーライトなし)
BUF1_STAT.EMPTFビットが0になった時点でバッファーエンプティ解消割り込みを発生可能です。この割 り込 みを 利用 して Bank 6の タイ ムス タン プデー タを 読み 出し ます 。な お、 この 読み 出し では
BUF1_STAT.EMPTFビットは1にリセットされません。
2. 2回目のタイムスタンプデータを取得した場合
1の後に2回目のタイムスタンプを取得すると、Bank 6が読み出されたか否かにかかわらず、そのデータ
はBank 7のバッファーに書き込まれ、バッファーステータスフラグは以下のように設定されます。
BUF1_STAT.EMPTFビット = 0 (バッファーにデータあり)
BUF1_STAT.FULLFビット = 1 (バッファーフル)BUF1_STAT.OVWFビット = 0 (オーバーライトなし)
BUF1_STAT.FULLFビット = 1になった時点でバッファーフル割り込みを発生可能です。この割り込みを利用してBank 7のタイムスタンプデータを読み出します。なお、この読み出しではBUF1_STAT.FULLF
ビットは0にクリアされません。
3. 3回目の (またはそれ以降の) タイムスタンプデータを取得した場合
オーバーライトモード時
バッファーフルの状態で新たなタイムスタンプを取得すると、Bank 6とBank 7が読み出されたか否かにかかわらず、そのデータはBank 7のバッファーに上書きされ、バッファーステータスフラグは以下のように設定されます。
BUF1_STAT.EMPTFビット = 0 (バッファーにデータあり)
BUF1_STAT.FULLFビット = 1 (バッファーフル)BUF1_STAT.OVWFビット = 1 (オーバーライトあり)
BUF1_STAT.OVWFビット = 1になった時点でバッファーオーバーライト割り込みを発生可能です。
バッファーステータスフラグがこの状態になった場合、Bank 7の読み出し前のデータは上書きされたことになります。これを防ぐには、Bank 6とBank 7の読み出し後にコマンドトリガー (バッファーステータ
スフラグリセット) を発行し、バッファーをエンプティ状態に戻しておく必要があります。
オーバーライト禁止モード時
バッファーフルの状態で新たなタイムスタンプが取得されると、そのデータはバッファーには書き込まれず破棄されます。バッファーステータスフラグは以下のように設定されます。
BUF1_STAT.EMPTFビット = 0 (バッファーにデータあり)
BUF1_STAT.FULLFビット = 1 (バッファーフル)BUF1_STAT.OVWFビット = 1 (オーバーライトあり)
オーバーライト禁止モードの場合も、3回目以降のタイムスタンプデータ取得時にBUF1_STAT. OVWF
ビットが1にセットされ、バッファーオーバーライト割り込みを発生可能です。ただし、Bank 6とBank 7
は初期状態またはバッファーステータスフラグリセットから2回目までのタイムスタンプデータを保持しています。
RA4000CE/RA8000CE
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58

3

機能

コマンドトリガーの発行
RA4000CE/RA8000CEにはレジスターへの書き込みによりタイムスタンプトリガーを発生させる機能があります。その手順は以下のとおりです。
1.

WRCMD_CFG.CMDTRGENビットを1に設定する。

(コマンドトリガーを指定)

2.

WRCMD_TRG.WRTRG[7:0]ビットに任意の値を書き込む。

(コマンドトリガーの発行)

3.

BUF_INTF.BUF1Fビットが1にセットされたことを確認する。
あるいは、BUF1_CFG2.RDPAGE[3:0]ビットがインクリメントされたことを確認する。

4.

WRCMD_TRG.WRTRG[7:0]ビットが0x00に戻ったことを確認する。

手順3はタイムスタンプトリガーが正常に受け付けられたことを確認する手順です。
手順4はコマンドトリガー発行直後にタイムスタンプデータを読み出す場合や、次のコマンドトリガーを発行する場合に必要です。
注: このタイムスタンプトリガーを連続して発行する場合は、それぞれのトリガーの間に5 ms以上のインターバルが必要です。

コマンドトリガーによるタイムスタンプトリガーのタイミングを図 3.37に示します。RA4000CE、RA8000CEともに、レジスターWRCMD_TRGのデータのLSBのクロック立ち上がりエッジでコマンドトリガーが発行されます。
RA4000CE
CLK
DIO/DI

Bit 7

Bit 0
アドレス0x42に対する書き込みデータ

Bit 7

アドレス0x43に対する書き込みデータ
トリガー発生RA8000CE
SCL
SDA (Host)

Bit 7

Bit 0

Bit 7
アドレス0x43に対する書き込みデータ

アドレス0x42に対する書き込みデータ

SDA (RTC)

ACK
トリガー発生図 3.37

コマンドトリガータイミング

コマンドトリガーには上記のタイムスタンプトリガー以外に、以下の機能もあります。
WRCMD_CFG.EVCNTCLRENビット: 1に設定してコマンドトリガーを発行することにより、イベントカウ
ンター (レジスターEVINn_EVCNT) をクリアします。
WRCMD_CFG.BUF1FCLRENビット: 1に設定してコマンドトリガーを発行することにより、以下のフラグをクリアします。
BUF1_STAT.FULLFビット (バッファーフルフラグ)
BUF1_STAT.EMPTFビット (バッファーエンプティフラグ)BUF1_STAT.OVWFビット (バッファーオーバーライトフラグ)

RA4000CE/RA8000CE
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59

3

機能

タイムスタンプデータの読み出し
タイムスタンプデータ読み出し手順の一例を以下に示します。
1.

割り込み発生 (/INT = L) 後、レジスターINTF (またはレジスターINTF_MIR) を読み出す。
INTF.EVFビット = 1の場合はタイムスタンプイベント検出割り込みが発生していますので、手順2以下を実行します。
それ以外の割り込みが発生した場合は、対応する割り込み処理を実行してください。

2.

レジスターEVNT_INTFとBUF_INTF を読み出して、発生している割り込み要因を特定する。
<レジスターEVNT_INTF内のフラグがセットされている場合>
EVINn入力または内部イベントが発生したことを示します。表 3.19に各フラグのセット条件を示します。発生したイベントに従い、割り込み処理を実行してください。また、セットされているフラグは割り込み処理内で0を書き込んでクリアしてください。

注: EVNT_INTF.RSTOEVFビット = 1の場合、BUF_INTF.RSTOFビットも同時にセットされています。この後、リセット出力イベントによりタイムスタンプデータを取得するためには、これら2つのフラグをクリアする必要があります。EVNT_INTF.RSTOEVFビットは0の書き込みで即時クリアされますが、BUF_INTF.RSTOFビット
はVDD電圧が+VDET1n以上に復帰するまでクリアできません。したがって、次のリセット出力イベントによるタ
イムスタンプデータの取得はVDD電圧が復帰した後に可能になります。BUF_INTF.RSTOFビットの詳細は、“3.9リセット出力機能”を参照してください。

<BUF_INTF.BUF1Fビット = 1の場合>
この割り込みは、キャプチャーを許可しているイベントの発生により、タイムスタンプデータがバッ
ファーに書き込まれることで発生します。
以下の操作を行い、データを読み出してください。
3.

割り込みを一時的に禁止する場合は、TSTP_INTE.EIEビットを0に設定する。
(タイムスタンプイベント検出割り込みディスエーブル)

4.

レジスターBUF1_STATを読み出し、バッファーの状態を確認する。
<状態1>
BUF1_STAT.EMPTFビット = 0 (バッファーにデータあり)
BUF1_STAT.FULLFビット = 0 (バッファーに空きあり)
BUF1_STAT.OVWFビット = 0 (オーバーライトなし)
Bank 6に1回目のタイムスタンプデータが書き込まれています。
<状態2>
BUF1_STAT.EMPTFビット = 0 (バッファーにデータあり)
BUF1_STAT.FULLFビット = 1 (バッファーフル)BUF1_STAT.OVWFビット = 0 (オーバーライトなし)
Bank 6に1回目のタイムスタンプデータ、Bank 7に2回目のタイムスタンプデータが書き込まれています。
<状態3>
BUF1_STAT.EMPTFビット = 0 (バッファーにデータあり)
BUF1_STAT.FULLFビット = 1 (バッファーフル)BUF1_STAT.OVWFビット = 1 (オーバーライトあり)
オーバーライト禁止モードの場合、Bank 6とBank 7には<状態2>と同じデータが保持されています。その後取得されたデータは破棄されました。
オーバーライトモードの場合、Bank 6には1回目のタイムスタンプデータが保持されています。Bank 7の読み出
し前のデータは、3回目以降の最新データで上書きされました。

5.

バッファーの状態に応じてタイムスタンプデータを読み出す。
Bank 6の読み出し時はアドレス0x60 〜 0x69の10バイトを、Bank 7の読み出し時はアドレス0x70 〜 0x79の10バ
イトを連続して読み出します。各アドレスの内容については図 3.33を参照してください。

RA4000CE/RA8000CE
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60

3

機能

以下の場合には、読み出し中にデータが更新される可能性がありますので、2回続けて読み出しを行い、内容が一致した場合にデータが有効と判断してください。
• BUF1_STAT.EMPTFビット = 1 (バッファーエンプティ) のときにBank 6を読み出す場合• BUF1_STAT.FULLFビット = 0 (バッファーに空きあり) のときにBank 7を読み出す場合• オーバーライトモード時の<状態2>と<状態3>でBank 7を読み出す場合<状態3>の場合は新たに取得したデータが破棄 (オーバーライト禁止モード時)、またはBank 7が上書き (オーバーライトモード時) されていますので、必要な処理を実行してください。
6.

コマンドトリガーを発行してEVINnイベントカウンターとバッファーのフラグをすべてクリアする。
- レジスターWRCMD_CFGに0x90を書き込む。
(クリアコマンド)- レジスターWRCMD_TRGに任意の値を書き込む。
(コマンドトリガー発行)

7.

レジスターWRCMD_TRGが0x00に戻ったことを確認する。 (コマンド実行完了)
手順6と7により、SRAMのデータ自体はクリアされませんが、バッファーエンプティ状態になります。
バッファーデータを消去する場合は、SRAMモードに移行して、バッファーデータを書き換え可能です。
SRAMモードに関しては、”3.11.6 SRAMモードでのリード/ライト”を参照ください。

8.

TSTP_INTE.EIEビットを1に設定する (手順3で0に設定した場合)。
(タイムスタンプイベント検出割り込みイネーブル)

RA4000CE/RA8000CE
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3

機能

3.11.5 タイムスタンプ (イベント検出) 割り込み
図 3.38にタイムスタンプ割り込み回路の構成を示します。

図 3.38

タイムスタンプ割り込み回路の構成

タイムスタンプ機能には以下のイベント検出割り込み要因があります。
表 3.19
割り込み要因フラグ
BUF1_STAT.FULLF

BUF1_STAT.EMPTF

BUF1_STAT.OVWF
BUF_INTF.BUF1F

EVNT_INTF.EVIN1F
EVNT_INTF.EVIN2F
EVNT_INTF.RSTOEVF
EVNT_INTF.VTMPLEVF
EVNT_INTF.OSCSTPEVF

割り込み許可ビット

イベント検出割り込み要因と制御ビット
割り込み要因フラグのセット条件

クリア条件

BUF1_CFG1.FULLIEN

2回目に取得したタイムスタンプデータがBank 7バッファーに書 コマンドトリガー
き込まれると (バッファーフル状態で) セット(バッファーステータス
FULLIENビット = 0の場合はセットされない
フラグリセット) 実行
BUF1_CFG1.EMPTIEN
初期状態、コマンドトリガー (バッファーステータスフラグリ* BUF1_STAT.EMPTF
セット) 実行により (バッファーエンプティ状態で) セット
ただし、1回目に取得したタイムスタンプデータがBank 6バッ ビットは1にリセット
ファーに書き込まれ、本フラグがクリアされることにより (バッファーにデータありで) 割り込み発生
EMPTIEN = 0の場合はクリアされない
BUF1_CFG1.OVWIEN
3回目またはそれ以降のタイムスタンプデータ取得時にセットOVWIENビット = 0の場合はセットされない↑
FULLFビット = 1、EMPTFビット = 0、もしくはOVWFビッ
ト = 1によりセット
FULLIENビット、EMPTIENビット、およびOVWIENビットがすべて0の場合はセットされない
EVNT_INTE.EVIN1IEN
EVINn端子からイベントトリガーが入力されると、バッファー 0書き込みでクリアに書き込まれたか否かにかかわらずセット
EVNT_INTE.EVIN2IEN
EVINnIENビット = 0の場合はセットされない
EVNT_INTE.RSTOIEN/RST端子からのリセット出力を開始するとセット
RSTOIENビット = 0の場合はセットされない
EVNT_INTE.VTMPLIEN VDET2電圧低下が検出されるとセット
VTMPLIENビット = 0の場合はセットされない
EVNT_INTE.OSCSTPIEN 発振停止が検出されるとセット
OSCSTPIENビット = 0の場合はセットされない

これらの要因は、個別に割り込みの発生を許可/禁止できます。割り込みが許可されている要因が発生すると、割り込み要因フラグがセットされ、これによって INTF.EVFビットが1にセットされます。このとき、
TSTP_INTE.EIEビット = 1 (割り込み許可) であれば/INT端子がLOWになり、ホストに割り込み要求を出力します。1にセットされたINTF.EVFビットは、EVFビットへの0書き込みではクリアされません。INTF.EVFビットをクリアするためには、レジスターBUF_INTFおよびEVNT_INTFのフラグのすべてをクリアする必要があります。INTF.EVFビットがクリアされると、同時に/INT端子がHi-Zになります。
RA4000CE/RA8000CE
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3

機能

3.11.6 SRAMモードでのリード/ライトBank 6とBank 7は、BUF1_CFG2.SRAMMODビットを1に設定することによってSRAMモードとなり、通常のレジスターと同様に全ビット、リード/ライトが可能になります。タイムスタンプデータの取得前に、前データをクリアする目的で使用することが可能です。
また、タイムスタンプデータを記録しない場合は、Bank 6とBank 7を汎用RAMとして使用することが可能です。
SRAMモードに設定する場合は、全イベントをタイムスタンプデータキャプチャー禁止に設定してください。

RA4000CE/RA8000CE
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3

機能

3.12 SOUT出力機能
SOUT端子には、ステータスフラグを出力するか、SOUTCTL.DCビットの論理値を出力する機能があります。
この機能は、SOUTCTL.DCEビットで選択します。

ステータス出力
SOUTCTL.DCEビット= 0の場合、SOUTCTL.SOUT[2:0]ビットで選択されている内部ステータスフラグ (割り込みフラグ) の状態がSOUT端子から外部に出力されます。表 3.20にSOUTCTL.SOUT[2:0]ビットで選択されるフラグを示します。
表 3.20SOUTCTL.SOUT[2:0]

0b000
0b001
0b010
0b011
0b100
0b101
0b110–0b111

SOUT端子から出力される内部ステータスフラグ
ステータスフラグ

INTF.TFビット (ウェイクアップタイマー割り込みフラグ)
INTF.AFビット (アラーム割り込みフラグ)
INFF.UFビット (時刻更新割り込みフラグ)
INTF.EFビット (イベント検出割り込みフラグ)
INTF.VTMPLFビット (温度補償更新停止検出フラグ)
INTF.VLFビット (日時データ無効警告フラグ)
Reserved

SOUTの信号極性は、SOUTCTL.SIGINVビットで指定します。

DC出力
SOUTCTL.DCEビット= 1の場合、SOUT端子はSOUTCTL.DCビットの論理値を出力します。SOUTCTL.DC
ビット = 0の場合はLレベルが、SOUTCTL.DCビット = 1の場合はHレベルが出力されます。

RA4000CE/RA8000CE
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4

レジスター

4 レジスター
4.1 レジスター一覧
記号の意味
ビット名 = –:書き込み無効で、読み出し値は常に0です。
ビット名 = ×:
書き込み無効で、読み出し値は不定です。
ビット名 = (GP): 汎用ビットで0と1の書き込み/読み出しが可能です。
注: • アドレス値は {バンク番号, バンク内アドレス} です (例: 0x0F = バンク0, アドレス0xF)。
• レジスターへのアクセスは8ビット単位で行います。
• レジスターテーブルに記載のアドレス以外には書き込み/読み出しを行わないでください。
• 電源投入時またはセーフモードからの復帰時にINTF.VLFビット = 1のときは､ 必ずすべてのレジスターを初期化してください。

Bank 0Address
0x00

0x01

0x02

0x03

0x04

0x05

0x06

0x07

0x08

0x09
0x0A
0x0B
0x0C
0x0D
0x0E
0x0F

Register name (function)
SEC
BCD mode(Second Data)
Not used
BIN modeMIN
BCD mode(Minute Data)
Not used
BIN mode
HOUR
BCD mode(Hour Data)
Not used
BIN modeWEEKDAYBCD mode(Day-of-Week Data)
Not used
BIN modeDAY
BCD mode(Day Data)
Not used
BIN modeMONTH
BCD mode(Month Data)
Not used
BIN mode
YEAR
BCD mode(Year Data)
Not used
BIN mode
ALM_MIN(Minute Alarm)
Not used
BIN mode
ALM_HOUR(Hour Alarm)
Not used
BIN mode
ALM_WEEKDAY(Day-of-Week Alarm / Day Alarm)
Not used
BIN mode
WTCNT_L(Wakeup Timer Counter Low)
WTCNT_M(Wakeup Timer Counter Middle)
WTCNT_H(Wakeup Timer Counter High)TCTL(Timer Control)
INTF(Status Flag)
TSTP_INTE(Timer Stop and Interrupt Enable)

Bit 7

Bit 6

–

Bit 5

Bit 4

Bit 2

–

–

–

–

Bit 1

Bit 0

SEC_L[3:0]
–

–

–

–

–

–

–

–

–

–

–

–

–

–

–

–

–

–

MIN_H[2:0]

MIN_L[3:0]

–

–

–

–

–

HOUR_H[1:0]

–

–

–

–

–

–

–

–

–

–

–

–

–

–

–

–

–

–

–

–

–

MONTH_H

–

–

–

–

HOUR_L[3:0]–

WEEK[6:0]

DAY_H[1:0]

DAY_L[3:0]

MONTH_L[3:0]––

YEAR_H[3:0]
–

–

XMAE

–

–

–

MALM_H[2:0]

(GP)

(GP)
(GP)

(GP)

(GP)

(GP)

(GP)
(GP)

DALM_H[1:0]
(GP)
(GP)

(GP)

–

–

–

(GP)

(GP)

(GP)

–
MALM_L[3:0]

XHAE

XWAE

–
YEAR_L[3:0]

(GP)

(GP)

(GP)

HALM_H[1:0]

HALM_L[3:0]

(GP)

(GP)
WKALM[6:0]
(GP)

(GP)

(GP)

(GP)

DALM_L[3:0]
(GP)
(GP)

(GP)

WTCNT[7:0]
WTCNT[15:8]
WTCNT[23:16]
FSEL[1:0]
PORF

OSCSTPFCSEL[1:0]

USEL0

TE

WADA

–

UF

TF

AF

EVF

VLF

VTMPLF

UIE

TIE

AIE

EIE

–

STOP

RA4000CE/RA8000CE
ETM64J-02

Bit 3

SEC_H[2:0]

TSEL[1:0]

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4

レジスター

Bank 1
Address
0x10
0x11

0x12

0x13

0x14

0x15

0x16

0x17
0x18
0x19
0x1A
0x1B
0x1C
0x1D
0x1E
0x1F

Register name (function)

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

SUBSEC_L
SUBSEC[1:0]
–
–
–
–
–
–
(Sub-Second Data Low)
SUBSEC_H
SUBSEC[9:2](Sub-Second Data High)SEC_MIR
BCD mode–
SEC_H[2:0]
SEC_L[3:0](Mirrored Second Data, = 0x00)
SEC_BIN0
BIN mode
SEC_BIN[7:0](Second Binary Data 0 )MIN_MIR
BCD mode–
MIN_H[2:0]
MIN_L[3:0](Mirrored Minute Data, = 0x01)
SEC_BIN1
BIN mode
SEC_BIN[15:8](Second Binary Data 1)
HOUR_MIR
BCD mode––
HOUR_H[1:0]
HOUR_L[3:0](Mirrored Hour Data, = 0x02)
SEC_BIN2
BIN mode
SEC_BIN[23:16](Second Binary Data 2)
WEEKDAY_MIR
BCD mode–
WEEK[6:0](Mirrored Day-of-Week Data, = 0x03)
SEC_BIN3
BIN mode
SEC_BIN[31:24](Second Binary Data 3)
DAY_MIR
BCD mode––
DAY_H[1:0]
DAY_L[3:0](Mirrored Day Data, = 0x04)
SEC_BIN4
BIN mode
–
–
–
–
–
–
–
SEC_BIN[32](Second Binary Data 4)
MONTH_MIR
BCD mode–––
MONTH_H
MONTH_L[3:0](Mirrored Mont Data, = 0x05)
YEAR_MIR
BCD mode
YEAR_H[3:0]
YEAR_L[3:0](Mirrored Year Data, = 0x06)
OFS_SUBSEC_H
OFS_
(GP)
(GP)
OFS_SUBSEC[9:5](Offset Sub-Second Data High)SUBSEC[10]OFS_SUBSEC_L
OFS_SUBSEC[4:0]–
OFSFIN
OFSEN(Offset Sub-Second Data Low)
DIG_TRIM_H
DTRIM[8:1](Digital Trimming Data High)DIG_TRIM_L
DTRIM[0]
–
–
–
–
–
–
DTRIMEN(Digital Trimming Data Low)
TCTL_MIRFSEL[1:0]
USEL0
TE
WADA
–
TSEL[1:0](Mirrored Timer Control, = 0x0D)
INTF_MIRPORF
OSCSTPF
UF
TF
AF
EVF
VLF
VTMPLF(Mirrored Status Flag, = 0x0E)
CNTSEL–––––
ACCBCDBINCNTEN BCDCNTEN(Counter Select)

Bank 2
Address
0x20
0x21
0x22
0x23
0x24
0x27
0x28
0x29

Register name (function)
EVIN_EN(Event Input Enable)
EVIN1_CFG(EVIN1 Configuration)
EVIN1_FLT(EVIN1 Noise Filter)
EVIN2_CFG(EVIN2 Configuration)
EVIN2_FLT(EVIN2 Noise Filter)
BUF1_CFG1(BUF1 Configuration 1)
BUF1_STAT(BUF1 Status)
BUF1_CFG2(BUF1 Configuration 2)

Bit 7

Bit 6

Bit 5

Bit 4

–

–

–

EVIN2CPEN EVIN1CPEN

–

–

–

PUPD[2:0]

–

–

Bit 2

Bit 1

Bit 0

–

EVIN2EN

EVIN1EN

–

–

–

–

BINSEL

OVWEN

–

–

–

FULLIENEMPTIENOVWIEN

FULLF

EMPTF

–

–

–

–

–

OVWF

–

SRAMMOD

–

–

–

–

–

–

POL[1:0]

FLT[5:0]–

PUPD[2:0]

POL[1:0]

FLT[5:0]

RA4000CE/RA8000CE
ETM64J-02

Bit 3

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4

レジスター

Bank 3
Address
0x30
0x31
0x32
0x33
0x34
0x38
0x39
0x3A

0x3B

0x3C
0x3D
0x3E
0x3F

Register name (function)

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

ALM_SEC(Second Alarm)
ALM_MIN_MIR(Mirrored Minute Alarm, = 0x07)
ALM_HOUR_MIR(Mirrored our Alarm, = 0x08)

XSAE

SALM_H[2:0]

SALM_L[3:0]

XMAE

MALM_H[2:0]

MALM_L[3:0]

ALM_WEEKDAY_MIR(Mirrored Day-of-Week Alarm / Day
Alarm, = 0x09)

XWAE

UPDISEL(Time Update Interrupt Select)
WTICFG(Wakeup Timer Interrupt
Configuration)
WTCTL(Wakeup Timer Control)
WTCNT_L_MIR(Mirrored Wakeup Timer Counter
Low, = 0x0A)
WTCNT_M_MIR(Mirrored Wakeup Timer Counter
Middle, = 0x0B)
WTCNT_H_MIR(Mirrored Wakeup Timer Counter
High, = 0x0C)
TCTL_MIR(Mirrored Timer Control, = 0x0D)
INTF_MIR(Mirrored Status Flag, = 0x0E)
TSTP_INTE_MIR(Mirrored Timer Stop and Interrupt
Enable, = 0x0F)

XHAE

(GP)

HALM_H[1:0](GP)

DALM_H[1:0]

HALM_L[3:0]
WKALM[6:0]––
PINMUX[1:0]

WTRST

Bit 0

–

DALM_L[3:0]–

RSTOPT[1:0]

EXWTRSTEN

WTRSTWIN[1:0]

–

–

USEL1

–

WTONETIM

TSEL2WTIOUT

UPDOWNMOD–

WTSTOPWTMODSEL WTSTOPCTLWTCNT[7:0]

WTCNT[15:8]

WTCNT[23:16]
FSEL[1:0]
PORF

OSCSTPFCSEL[1:0]

USEL0

TE

WADA

–

TSEL[1:0]

UF

TF

AF

EVF

VLF

VTMPLF

UIE

TIE

AIE

EIE

–

STOP

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

–

BUF1F
CLREN

–

–

–

CMDTRGEN

Bank 4Address
0x41
0x42
0x43
0x44
0x45
0x46
0x47

Register name (function)

Bit 7

WRCMD_CFG(Write Command Configuration)
WRCMD_TRG(Write Command Trigger)
EVNT_INTE(Event Interrupt Enable)
CAP_EN(Capture Enable)
INTF_MIR(Mirrored Status Flag, = 0x0E)
BUF_INTF(Buffer Interrupt Factor)
EVNT_INTF(Event Interrupt Factor)

EVCNT
CLREN

Bit 6
–

WRTRG[7:0]–

EVIN2IEN

EVIN1IEN

RSTOIEN–

VTMPLIEN–

OSCSTPIEN–––

RSTOCPEN–VTMPLCPEN–

OSCSTPCPEN

PORF

OSCSTPF

UF

TF

AF

EVF

VLF

VTMPLF

–

–

BUF1F

RSTOF

–

–

–

–

–

EVIN2F

EVIN1FRSTOEVF–VTMPLEVF–

OSCSTPEVF

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

–

–

EVCNT[5:0]––

EVCNT[5:0]–

EVIN2MON

EVIN1MON

–

–

–

–

DCE

DC

–

–

SIGINVBank 5Address
0x51
0x52
0x54
0x55

Register name (function)
EVIN1_EVCNT(EVIN1 Event Counter)
EVIN2_EVCNT(EVIN2 Event Counter)
EVINMON(EVIN Monitor)
SOUTCTL(SOUT Control)

RA4000CE/RA8000CE
ETM64J-02–

SOUT[2:0]

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67

4

レジスター

Bank 6/7 (ダイレクトモードでのタイムスタンプデータ (BCD) 読み出し時)
タイムスタンプデータ取得時の設定: BUF1_CFG1.BINSELビット = 0, CNTSEL.BCDCNTENビット = 1
Address
Register name (function)
0x60 TIMESTAMP_SUBSEC_L
0x70 (SUBSEC Time Stamp Data Low)
0x61 TIMESTAMP_SUBSEC_H
0x71 (SUBSEC Time Stamp Data High)
0x62 TIMESTAMP_SEC
0x72 (SEC Time Stamp Data)
0x63 TIMESTAMP_MIN
0x73 (MIN Time Stamp Data)
0x64 TIMESTAMP_HOUR
0x74 (HOUR Time Stamp Data)
0x65 TIMESTAMP_DAY
0x75 (DAY Time Stamp Data)
0x66 TIMESTAMP_MONTH
0x76 (MONTH Time Stamp Data)
0x67 TIMESTAMP_YEAR
0x77 (YEAR Time Stamp Data)
0x68 TIMESTAMP_EVSTAT
0x78 (Event Status Time Stamp Data)
0x69 TIMESTAMP_TRG
0x79 (Time Stamp Trigger Factor)

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

×

×

×

×

×

×

SUBSEC[1:0]

SUBSEC[9:2]×SEC_H[2:0]

SEC_L[3:0]×MIN_H[2:0]

MIN_L[3:0]××

HOUR_H[1:0]

HOUR_L[3:0]××

DAY_H[1:0]

DAY_L[3:0]

×

×

×

MONTH_H

MONTH_L[3:0]

YEAR_H[3:0]

YEAR_L[3:0]×EVIN2POL

EVIN1POL×

RSTOSTATVTMPLSTAT×

OSCSTPSTATOVWFSTAT*EVIN2TRG

EVIN1TRG

WRCMDTRG

RSTOTRG

VTMPLTRG

×

OSCSTPTRG* OVWFSTATはアドレス0x79にのみ存在します (アドレス0x69にはありません)。

Bank 6/7 (ダイレクトモードでのタイムスタンプデータ (BIN) 読み出し時)
タイムスタンプデータ取得時の設定: BUF1_CFG1.BINSELビット = 1, CNTSEL.BINCNTENビット = 1
Address
Register name (function)
0x60 TIMESTAMP_SUBSEC_L
0x70 (SUBSEC Time Stamp Data Low)
0x61 TIMESTAMP_SUBSEC_H
0x71 (SUBSEC Time Stamp Data High)
0x62 TIMESTAMP_SEC
0x72 (SEC Time Stamp Data)
0x63 TIMESTAMP_MIN
0x73 (MIN Time Stamp Data)
0x64 TIMESTAMP_HOUR
0x74 (HOUR Time Stamp Data)
0x65 TIMESTAMP_DAY
0x75 (DAY Time Stamp Data)
0x66 TIMESTAMP_MONTH
0x76 (MONTH Time Stamp Data)
0x67 TIMESTAMP_YEAR
0x77 (YEAR Time Stamp Data)
0x68 TIMESTAMP_EVSTAT
0x78 (Event Status Time Stamp Data)
0x69 TIMESTAMP_TRG
0x79 (Time Stamp Trigger Factor)

Bit 7

Bit 6

SUBSEC[1:0]

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

×

×

×

×

×

×

SUBSEC[9:2]
SEC_BIN[7:0]
SEC_BIN[15:8]
SEC_BIN[23:16]
SEC_BIN[31:24]
×

×

×

×

×

×

×

SEC_BIN32

×

×

×

×

×

×

×

×

×

EVIN2POL

EVIN1POL×

RSTOSTATVTMPLSTAT×

OSCSTPSTATOVWFSTAT*EVIN2TRG

EVIN1TRG

WRCMDTRG

RSTOTRG

VTMPLTRG

×

OSCSTPTRG* OVWFSTATはアドレス0x79にのみ存在します (アドレス0x69にはありません)。

RA4000CE/RA8000CE
ETM64J-02

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68

4

レジスター

Bank 6/7 (SRAMモード)
SRAMアクセス時の設定: BUF1_CFG2.SRAMMODビット = 1
Address
Function
0x60 SRAM Address 0x00
0x61 SRAM Address 0x01
0x62 SRAM Address 0x02
0x63 SRAM Address 0x03
0x64 SRAM Address 0x04
0x65 SRAM Address 0x05
0x66 SRAM Address 0x06
0x67 SRAM Address 0x07
0x68 SRAM Address 0x08
0x69 SRAM Address 0x09
0x6A SRAM Address 0x0A
0x6B SRAM Address 0x0B
0x6C SRAM Address 0x0C
0x6D SRAM Address 0x0D
0x6E SRAM Address 0x0E
0x6F SRAM Address 0x0F
0x70 SRAM Address 0x10
0x71 SRAM Address 0x11
0x72 SRAM Address 0x12
0x73 SRAM Address 0x13
0x74 SRAM Address 0x14
0x75 SRAM Address 0x15
0x76 SRAM Address 0x16
0x77 SRAM Address 0x17
0x78 SRAM Address 0x18
0x79 SRAM Address 0x19
0x7A SRAM Address 0x1A
0x7B SRAM Address 0x1B
0x7C SRAM Address 0x1C
0x7D SRAM Address 0x1D
0x7E SRAM Address 0x1E
0x7F SRAM Address 0x1F

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

RA4000CE/RA8000CE
ETM64J-02

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69

4

レジスター

4.2 レジスター詳細説明※1 Initial valueの“x”は初期値が不定であることを示します。
※2 [BCDモード]は、BCDモード時 (CNTSEL.ACCBCDビット = 1, CNTSEL.BCDCNTENビット = 1)にのみ使用可能なレジスターを示します。
[BINモード] は、BINモード時 (CNTSEL.ACCBCDビット = 0, CNTSEL.BINCNTENビット = 0)にのみ使用可能なレジスターを示します。

0x00: SEC (Second Data)
Bit No.

Bit 7

Bit name–

Initial value

0

R/W

R

Bit 6

[BCDモード]
Bit 5

Bit 4

Bit 3

Bit 2

SEC_H[2:0]
x

Bit 1

Bit 0

x

x

SEC_L[3:0]

x

x

x

x

R/W

R/W

Bits 6–4: SEC_H[2:0]
Bits 3–0: SEC_L[3:0]秒カウンターの設定と読み出しを行います。
SEC_H[2:0]ビットは10秒桁のBCDコード (0–5)、SEC_L[3:0]ビットは1秒桁のBCDコード (0–9) です。
このアドレスへの秒データの書き込みにより、1/1024秒カウンターがリセットされ、レジスター
SUBSEC_LおよびSUBSEC_Hが0にクリアされます。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

0x01: MIN (Minute Data) [BCDモード]
Bit No.

Bit 7

Bit name–

Initial value

0

R/W

R

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

MIN_H[2:0]
x

Bit 1

Bit 0

x

x

MIN_L[3:0]

x

x

x

x

R/W

R/W

Bits 6–4: MIN_H[2:0]
Bits 3–0: MIN_L[3:0]
分カウンターの設定と読み出しを行います。
MIN_H[2:0]ビットは10分桁のBCDコード (0–5)、MIN_L[3:0]ビットは1分桁のBCDコード (0–9) です。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

0x02: HOUR (Hour Data) [BCDモード]
Bit No.

Bit 7

Bit 6

Bit name––

Initial value

0

0

R/W

R

R

Bit 5

Bit 4

Bit 3

Bit 2

HOUR_H[1:0]
x

Bit 1

Bit 0

x

x

HOUR_L[3:0]
x

x

x

R/W

R/W

Bits 5–4: HOUR_H[1:0]
Bits 3–0: HOUR_L[3:0]時カウンターの設定と読み出しを行います。
HOUR_H[1:0]ビットは10時桁のBCDコード (0–2)、HOUR_L[3:0]ビットは1時桁のBCDコード (0–9)
です。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

0x03: WEEKDAY (Day-of-Week Data)
Bit No.

Bit 7

Bit name–

Initial value

0

R/W

R

Bit 6

Bit 5

[BCDモード]
Bit 4

Bit 3

x

x

x

Bit 1

Bit 0

x

x

x

x

R/W

RA4000CE/RA8000CE
ETM64J-02

Bit 2

WEEK[6:0]

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70

4

レジスター

Bits 6–0: WEEK[6:0]
曜日カウンターの設定と読み出しを行います。
WEEK[6:0]ビットの各ビットは下記の例のように曜日に1対1に対応しますので、今日の曜日に対応
する1ビットのみセットしておきます。日カウンターが更新されると同時に各ビットは左にシフトします (ビット6はビット0にシフトします)。
曜日設定例
WEEK6
WEEK5
WEEK4
WEEK3
WEEK2
WEEK1
WEEK0
土曜日 (0x40) 金曜日 (0x20) 木曜日 (0x10) 水曜日 (0x08) 火曜日 (0x04) 月曜日 (0x02) 日曜日 (0x01)*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

0x04: DAY (Day Data) [BCDモード]
Bit No.

Bit 7

Bit 6

Bit name––

Initial value

0

0

R/W

R

R

Bit 5

Bit 4

Bit 3

Bit 2

DAY_H[1:0]
x

Bit 1

Bit 0

x

x

DAY_L[3:0]
x

x

x

R/W

R/W

Bits 5–4: DAY_H[1:0]
Bits 3–0: DAY_L[3:0]
日カウンターの設定と読み出しを行います。
DAY_H[1:0]ビットは10日桁のBCDコード (0–3)、DAY_L[3:0]ビットは1日桁のBCDコード (0–9)です。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

*2

うるう年の動作については、3.3節内の“うるう年の判定”を参照してください。

0x05: MONTH (Month Data)[BCDモード]

Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name–––

MONTH_H

Initial value

0

0

0

x

R/W

R

R

R

R/W

Bit 3

Bit 2

Bit 1

Bit 0

MONTH_L[3:0]
x

x

x

x

R/W

Bit 4:MONTH_H
Bits 3–0: MONTH_L[3:0]
月カウンターの設定と読み出しを行います。
MONTH_Hビットは10月桁のBCDコード (0–1)、MONTH_L[3:0]ビットは1月桁のBCDコード (0–9)です。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

0x06: YEAR (Year Data)
Bit No.

Bit 7[BCDモード]

Bit 6

Bit name

Bit 5

Bit 4

Bit 3

Bit 2

YEAR_H[3:0]

Initial value

x

R/W

x

Bit 1

Bit 0

x

x

YEAR_L[3:0]
x

x

x

R/W

x
R/W

Bits 7–4: YEAR_H[3:0]
Bits 3–0: YEAR_L[3:0]
年カウンターの設定と読み出しを行います。
YEAR_H[3:0]ビットは10年桁のBCDコード (0–9)、YEAR_L[3:0]ビットは1年桁のBCDコード (0–9)です。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

RA4000CE/RA8000CE
ETM64J-02

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4
0x07: ALM_MIN (Minute Alarm)[BCDモード]

Bit No.

Bit 7

Bit 5

Bit name

XMAE

Initial value

1

R/W

Bit 6
x

R/W

Bit 7:

Bit 4

Bit 3

Bit 2

MALM_H[2:0]

レジスター

Bit 1

Bit 0

x

x

MALM_L[3:0]

x

x

x

x

R/W

R/W

XMAE
このビットは分アラームの設定を有効/無効にします。
1 (R/W): 分アラーム無効
0 (R/W): 分アラーム有効1に設定すると本レジスターの設定が無効となり、分カウンターの内容はアラームの発生に影響を与えません。0に設定すると本レジスターの設定が有効となり、分カウンターの値とMALM_H[2:0]/
MALM_L[3:0]ビット設定値の一致がアラーム発生条件となります。

Bits 6–4: MALM_H[2:0]
Bits 3–0: MALM_L[3:0]
アラームの分条件をBCDコードで設定します。
MALM_H[2:0]ビットでアラームの10分桁 (0–5)を、MALM_L[3:0]ビットで1分桁 (0–9)を設定します。
*1

アラーム機能の詳細については、“3.6 アラーム機能”を参照してください。

*2

アラーム機能を使用しない場合、本レジスターをリード/ライト可能な汎用レジスターとして使用することができます。ただし、不要な割り込みが発生することのないように、TSTP_INTE.AIEビットを0 (アラーム割り込みディスエーブル) に設定してください。

0x08: ALM_HOUR (Hour Alarm)
Bit No.

Bit 7

Bit 6

Bit name

XHAE

(GP)

Initial value
R/W

Bit 7:

1

x

R/W

R/W

[BCDモード]
Bit 5

Bit 4

Bit 3

Bit 2

HALM_H[1:0]
x

Bit 1

Bit 0

x

x

HALM_L[3:0]
x

x

x

R/W

R/W

XHAE
このビットは時アラームの設定を有効/無効にします。
1 (R/W): 時アラーム無効
0 (R/W): 時アラーム有効1に設定すると本レジスターの設定が無効となり、時カウンターの内容はアラームの発生に影響を与えません。
0に設定すると本レジスターの設定が有効となり、時カウンターの値とHALM_H[1:0]/HALM_L[3:0]
ビット設定値の一致がアラーム発生条件となります。

Bits 5–4: HALM_H[1:0]
Bits 3–0: HALM_L[3:0]
アラームの時条件をBCDコードで設定します。
HALM_H[1:0]ビットでアラームの10時桁 (0–2) を、HALM_L[3:0]ビットで1時桁 (0–9) を設定します。
*1

アラーム機能の詳細については、“3.6 アラーム機能”を参照してください。

*2

アラーム機能を使用しない場合、本レジスターをリード/ライト可能な汎用レジスターとして使用することができます。ただし、不要な割り込みが発生することのないように、TSTP_INTE.AIEビットを0 (アラーム割り込みディスエーブル) に設定してください。

RA4000CE/RA8000CE
ETM64J-02

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4
0x09: ALM_WEEKDAY (Day-of-Week Alarm / Day Alarm)

レジスター[BCDモード]

Day-of-Week Alarm
Bit No.

Bit 7

Bit name

XWAE

Initial value

1

R/W

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

Bit 1

Bit 0

x

x

WKALM[6:0]
x

x

x

R/W

x
R/W

Day Alarm
Bit No.

Bit 7

Bit 6

Bit name

XWAE

(GP)

Initial value
R/W

1

x

R/W

R/W

Bit 5

Bit 4

Bit 3

Bit 2

DALM_H[1:0]xDALM_L[3:0]
x

x

x

R/W

R/W

注: 本レジスターはTCTL.WADAビットの設定により、機能が切り替わります。
TCTL.WADAビット = 0: Day-of-Week Alarm
TCTL.WADAビット = 1: Day Alarm

Bit 7:

XWAE
このビットは曜日/日アラームの設定を有効/無効にします。
1 (R/W): 曜日/日アラーム無効
0 (R/W): 曜日/日アラーム有効1に設定すると本レジスターの設定が無効となり、曜日および日カウンターの内容はアラームの発生に影響を与えません。
0に設定すると本レジスターの設定が有効となり、次の条件でアラームが発生します。
TCTL.WADAビット = 0: 曜日カウンターとWKALM[6:0]の同一ビットが共にセット
TCTL.WADAビット = 1: 日カウンターの値とDALM_H[1:0]/DALM_L[3:0]ビット設定値の一致

Bits 6–0: WKALM[6:0] (Day-of-Week Alarm)
アラームの曜日条件を設定します。
複数のビットを1にセットして、複数の曜日を指定可能です。
Bits 5–4: DALM_H[1:0] (Day Alarm)
Bits 3–0: DALM_L[3:0] (Day Alarm)
アラームの日条件をBCDコードで設定します。
DALM_H[1:0]ビットでアラームの10日桁 (0–3) を、DALM_L[3:0]ビットで1日桁 (0–9) を設定します。
*1

アラーム機能の詳細については、“3.6 アラーム機能”を参照してください。

*2

アラーム機能を使用しない場合、本レジスターをリード/ライト可能な汎用レジスターとして使用することができます。ただし、不要な割り込みが発生することのないように、TSTP_INTE.AIEビットを0 (アラーム割り込みディスエーブル) に設定してください。

RA4000CE/RA8000CE
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73

4

レジスター

0x0A: WTCNT_L (Wakeup Timer Counter Low)
0x0B: WTCNT_M (Wakeup Timer Counter Middle)
0x0C: WTCNT_H (Wakeup Timer Counter High)Wakeup Timer Counter Low
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

1

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

0

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

WTCNT[7:0]

Initial value

0

0

0

0

R/W

R/W

Wakeup Timer Counter Middle
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

WTCNT[15:8]

Initial value

0

0

0

0

R/W

R/W

Wakeup Timer Counter HighBit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

WTCNT[23:16]

Initial value

0

0

0

0

R/W

0
R/W

Bits 7–0: WTCNT[7:0]
WTCNT[15:8]
WTCNT[23:16](Wakeup Timer Counter Low)
(Wakeup Timer Counter Middle)(Wakeup Timer Counter High)

書き込み時
ウェイクアップタイマーカウンターのプリセット値を設定します。プリセット値は1 〜 16777215の範囲で指定可能で、カウント周期を設定します。
カウントアップモードでは、カウントアップによりカウンターがプリセット値を超えると、初期値(1) がカウンターにロードされ、その値からアップカウントを継続します。
カウントダウンモードでは、カウント中にカウンターが0になると、プリセット値がカウンターにロードされ、その値からダウンカウントを継続します。
注: • プリセット値は、TCTL.TEビット = 0 (ウェイクアップタイマーディスエーブル) の状態で設定してください。
• プリセットデータとして0x000000を設定することはできません。レジスターWTCNT_L、WTCNT_M、
WTCNT_Hに0x000000を書き込んだ場合はウェイクアップタイマーはカウントアップ/ダウンせず、割込み要求は発生しません。カウンターリード値はTCTL.TEビット = 1, 0にかかわらず、0x000001とな
ります。

読み出し時
TCTL.TEビット = 1 (ウェイクアップタイマーイネーブル) の場合、現在のカウンター値が読み出されます。このカウンターにはリードバッファー機能がありますので、ウェイクアップタイマーが動
作中でも、任意のタイミングで3つのレジスターを連続して読み出すことで、正しい値が得られます。
TCTL.TEビット = 0 (ウェイクアップタイマーディスエーブル) の場合、現在設定されているプリセット値が読み出されます。
*1

ウェイクアップタイマー機能の詳細については、“3.7 ウェイクアップタイマー機能”を参照してください。

*2

ウェイクアップタイマー機能を使用しない場合 (TCTL.TEビットとTSTP_INTE.TIEビットが共に0の場
合)、これらのレジスターをリード/ライト可能な汎用レジスターとして使用することができます。

0x0D: TCTL (Timer Control)
Bit No.

Bit 7

Bit name
Initial value

Bit 6
FSEL[1:0]

0

R/W

0
R/W

Bit 5

Bit 4

Bit 3

Bit 2

USEL0

TE

WADA

–

0

0

0

0

R/W

R/W

R/W

R

Bit 1

Bit 0
TSEL[1:0]

1

0
R/W

Bits 7–6: FSEL[1:0]
RA4000CE/RA8000CE
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74

4

レジスター

これらのビットは、FOUT出力周波数を選択します。
表 4.1

Bit 5:FOUT出力の選択

TCTL.FSEL[1:0]

出力クロック

0b00
0b01
0b10
0b11

32.768 kHz (デフォルト)
1024 Hz
1 Hz
OFF

USEL0
このビットは、UPDISEL.USEL1ビットと共に時刻更新割り込みイベントの種類を選択します。
表 4.2

Bit 4:

時刻更新割り込みイベントの選択

UPDISEL.USEL1

TCTL.USEL0

割り込みイベント

0
0
1
1

0
1
0
1

秒カウンター更新 (デフォルト)
分カウンター更新
時カウンター更新
割り込みイベントなし

TE
このビットは、ウェイクアップタイマーの動作を許可/禁止します。
1 (R/W): ウェイクアップタイマーイネーブル
0 (R/W): ウェイクアップタイマーディスエーブル

Bit 3:

WADA
このビットは、アラーム発生条件の中で、曜日アラームと日アラームのどちらを使用するか選択します。
1 (R/W): 日アラーム
0 (R/W): 曜日アラーム

Bits 1–0: TSEL[1:0]
これらのビットは、ウェイクアップタイマーのソースクロックとして使用する内部クロックを選択
します。
表 4.3

ウェイクアップタイマーソースクロックの選択

TCTL.TSEL[1:0]

ソースクロック

0b00
0b01
0b10
0b11

1024 Hz
64 Hz
1 Hz (デフォルト)
1/60 Hz

この設定はWTICFG.TSEL2ビット = 0の場合に有効です。WTICFG.TSEL2ビット = 1の場合、EVIN2
端子から入力される外部クロックがソースクロックになります。
*1

FOUT出力機能の詳細については、“3.8 FOUT出力機能”を参照してください。

*2

時刻更新割り込みの詳細については、“3.5 時刻更新割り込み機能”を参照してください。

*3

ウェイクアップタイマー機能の詳細については、“3.7 ウェイクアップタイマー機能”を参照してください。

*4

アラーム機能の詳細については、“3.6 アラーム機能”を参照してください。

RA4000CE/RA8000CE
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75

4

レジスター

0x0E: INTF (Status Flag)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

PORF

OSCSTPF

UF

TF

AF

EVF

VLF

VTMPLF

Initial value
R/W

Bit 7:

1

1

x

x

x

0

1

1

R/W

R/W

R/W

R/W

R/W

R/W

R/W

R/W

PORF
このビットは、電源投入後にパワーオンリセットが実行されたか否かを示す自己監視フラグです。
1 (R):
0 (R):
1 (W):
0 (W):

Bit 6:

パワーオンリセット検出
パワーオンリセット未検出
無効フラグをクリア(パワーオンリセットの解除時のみ有効)

OSCSTPF
このビットは、水晶発振器が発振を停止しているか否かを示す自己監視フラグです。
1 (R):
0 (R):
1 (W):
0 (W):

Bit 5:
Bit 4:
Bit 3:
Bit 2:

発振停止検出 (10 ms以上の発振停止検出によりセット)
発振停止未検出無効
フラグをクリア(発振停止の未検出時のみ有効)

UF
TF
AF
EVF
これらのビットは、RTC割り込みイベントが発生したことを示す割り込みフラグです。
1 (R):
0 (R):
1 (W):
0 (W):

割り込みイベント発生
割り込みイベント未発生
無効
フラグをクリア (EVFを除く)各ビットと割り込みイベントの対応は以下のとおりです。
UF: 時刻更新割り込み
TF: ウェイクアップタイマー割り込み
AF: アラーム割り込み
EVF: タイムスタンプイベント検出割り込み
ウェイクアップタイマー割り込み (TF)、時刻更新割り込み (UF)、およびアラーム割り込み (AF)では、0の書き込みによりフラグをクリアすると、/INT出力 (LOW) もインアクティブ (Hi-Z) になります。ウェイクアップタイマーおよび時刻更新による/INTのLOW出力は、割り込みイベント発生から規定時間後に自動的に解除されます。ただし、これらの割り込みフラグ (TF、UF) は自動クリア
されません。
イベント検出およびタイムスタンプ機能には割り込みを発生させる各種のイベントが存在し、それぞれのイベント が発生した際にセット される割り込みフラグ がレジスター BUF_INTFおよ び
EVNT_INTFに割り付けられています。EVFビットは、これらの割り込みフラグの1つまたは複数がセットされると同時に1になります。また、EVFビットはレジスターBUF_INTFおよびEVNT_INTFのフラグがすべてクリアされることにより0になります (EVFビットへの0書き込みではクリアされません)。このクリア操作により、/INT出力もインアクティブになります。
Bit 1:

VLF
このビットは、RTCの異常を示す自己監視フラグです。

RA4000CE/RA8000CE
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76

4
1 (R):
0 (R):
1 (W):
0 (W):
Bit 0:

レジスター

異常あり (PORFビット = 1またはOSCSTPFビット = 1)
異常なし
無効
フラグをクリア (パワーオンリセットの解除時、かつ発振停止の未検出時のみ有効)

VTMPLF
このビットは、VDD電圧が温度補償更新停止電圧を下回った履歴 (≦ VDET2) を示す自己監視フラグです。
1 (R):
0 (R):
1 (W):
0 (W):

電圧低下検出 (VDD ≦ VDET2、温度補償更新停止)
電圧低下未検出無効
フラグをクリア (電圧正常時のみ有効)*1

自己監視機能の詳細については、“3.10 自己監視機能”を参照してください。

*2

各割り込みの詳細については、“3.5 時刻更新割り込み機能”、“3.7 ウェイクアップタイマー機能”、 “3.6アラーム機能”、あるいは“3.11 タイムスタンプ機能”を参照してください。

0x0F: TSTP_INTE (Timer Stop and Interrupt Enable)
Bit No.

Bit 7

Bit name

Bit 6
CSEL[1:0]

Initial value

0

1

R/W

R/W

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

UIE

TIE

AIE

EIE

–

STOP

0

0

0

0

0

0

R/W

R/W

R/W

R/W

R

R/W

Bits 7–6: CSEL[1:0]
これらのビットは、温度センサー測定動作の実行間隔を設定します。
表 4.4

Bit 5:
Bit 4:
Bit 3:
Bit 2:

温度センサー測定動作の実行間隔

TSTP_INTE.CSEL[1:0]

実行間隔

0b00
0b01
0b10
0b11

0.5秒
2.0秒 (デフォルト)
10.0秒
30.0秒

UIE
TIE
AIE
EIE
これらのビットはRTC割り込みを許可します。
1 (R/W): 割り込みを許可
0 (R/W): 割り込みを禁止 (割り込み信号を解除注)
各ビットと割り込みの対応は以下のとおりです。
UIE: 時刻更新割り込み
TIE: ウェイクアップタイマー割り込みAIE: アラーム割り込み
EIE: タイムスタンプイベント検出割り込み

Bit 0:

STOP
カウンターの動作を制御します。
1 (W):
0 (W):

カウンターの動作を停止します。
カウンターの動作を開始します。

RA4000CE/RA8000CE
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77

4
1 (R):
0 (R):

レジスター

カウンター停止中
カウンター動作中

STOPビットで停止する動作は以下のとおりです。
1) 1/1024秒、秒、分、時、日、曜日、月、年カウンターならびに秒のバイナリーカウンターの更新
動作
これに伴い、時刻更新割り込み、アラーム割り込みも発生しません。
タイムスタンプの時刻データは停止した時刻になります。
2) ウェイクアップタイマー割り込み
ウェイクアップタイマーは機能を停止し、割り込みは発生しません。
3) FOUT出力
1 Hz選択時は出力がHまたはLに固定されます。
32.768 kHzまたは1024 Hzを選択している場合は、STOPビット = 1でも出力を継続します。
注: 時刻/カレンダーデータ読み出し時にSTOPビットでタイマーを停止させると、計時誤差が増大します。時刻/カレン
ダーデータ読み出し時は、STOPビットでカウンターを停止させないでください。

*1

温度補償動作の詳細については、“3.3 温度補償機能”を参照してください。

*2

各割り込みの詳細については、“3.5 時刻更新割り込み機能”、“3.7 ウェイクアップタイマー機能”、 “3.6アラーム機能”、あるいは“3.11 タイムスタンプ機能”を参照してください。

0x10: SUBSEC_L (Sub-Second Data Low)
0x11: SUBSEC_H (Sub-Second Data High)Sub-Second Data Low
Bit No.

Bit 7

Bit name

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

–

–

–

–

–

–

0

0

0

0

0

0

R

R

R

R

R

R

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

x

SUBSEC[1:0]

Initial value

x

R/W

x
R/W

Sub-Second Data HighBit No.

Bit 7

Bit 6

Bit name

SUBSEC[9:2]

Initial value

x

x

x

x

R/W

R/W

Bits 7–6: SUBSEC[1:0] (Sub-Second Data Low)
Bits 7–0: SUBSEC[9:2] (Sub-Second Data High)1/1024秒カウンターの設定と読み出しを行います。このカウンターは10ビットのバイナリーカウン
ターです。
SUBSEC_L.SUBSEC[1:0]ビットは1/1024秒カウンターの下位2ビット、SUBSEC_H. SUBSEC[9:2]ビッ
トは1/1024秒カウンターの上位8ビットです。
表 4.5
ビット
カウント値
(1024Hz 周期)

SUBSEC[9:0]ビット

SUBSEC9SUBSEC8SUBSEC7

SUBSEC6SUBSEC5SUBSEC4SUBSEC3

SUBSEC2SUBSEC1

SUBSEC0

512

256

128

64

32

16

8

4

2

1

データを取得する場合はこの2つのアドレスを連続して読み出してください。カウンター値を変更する場合も、2つのアドレスに連続して書き込んでください。これらのアドレスに続けてアドレス0x12〜 0x18をアクセスすることにより、時計/カレンダーカウンターデータの読み出し/書き込みも連続して行えます。
また、レジスターSEC (アドレス0x00、BCDモード) にデータを書き込むと、1/1024秒カウンターがリセットされ、レジスターSUBSEC_LとSUBSEC_Hは0になります。一方、レジスターSECのミラーアドレスであるレジスターSEC_MIR (アドレス0x12)へのデータ書き込みでは、1/1024秒カウンターがリセットされません。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

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78

4

レジスター

0x12: SEC_MIR (Mirrored Second Data, = 0x00) [BCDモード]
Bit No.

Bit 7

Bit name–

Initial value

0

R/W

R

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

SEC_H[2:0]
x

x

Bit 1

Bit 0

x

x

SEC_L[3:0]
x

x

x

R/W

R/W

レジスターSECのミラーです。詳細は“0x00: SEC (Second Data)”を参照してください。ただし、このアドレスへの書き込みでは、1/1024秒カウンターはリセットされません。

0x13: MIN_MIR (Mirrored Minute Data, = 0x01) [BCDモード]
Bit No.

Bit 7

Bit name–

Initial value

0

R/W

R

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

MIN_H[2:0]
x

x

Bit 1

Bit 0

x

x

MIN_L[3:0]
x

x

R/W

x
R/W

レジスターMINのミラーです。詳細は“0x01: MIN (Minute Data)”を参照してください。

RA4000CE/RA8000CE
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4

レジスター

0x14: HOUR_MIR (Mirrored Hour Data, = 0x02) [BCDモード]
Bit No.

Bit 7

Bit 6

Bit name––

Initial value

0

0

R/W

R

R

Bit 5

Bit 4

Bit 3

Bit 2

HOUR_H[1:0]
x

Bit 1

Bit 0

x

x

HOUR_L[3:0]
x

x

x

R/W

R/W

レジスターHOURのミラーです。詳細は“0x02: HOUR (Hour Data)”を参照してください。

0x15: WEEKDAY_MIR (Mirrored Day-of-Week Data, = 0x03) [BCDモード]
Bit No.

Bit 7

Bit name–

Initial value

0

R/W

R

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

WEEK[6:0]
x

x

x

x
R/W

レジスターWEEKDAYのミラーです。詳細は“0x03: WEEKDAY (Day-of-Week Data)”を参照してください。

0x16: DAY_MIR (Mirrored Day Data, = 0x04) [BCDモード]
Bit No.

Bit 7

Bit 6

Bit name––

Initial value

0

0

R/W

R

R

Bit 5

Bit 4

Bit 3

Bit 2

DAY_H[1:0]
x

Bit 1

Bit 0

x

x

DAY_L[3:0]
x

x

x

R/W

R/W

レジスターDAYのミラーです。詳細は“0x04: DAY (Day Data)”を参照してください。

0x17: MONTH_MIR (Mirrored Month Data, = 0x05) [BCDモード]
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name–––

MONTH_H

Initial value

0

0

0

x

R/W

R

R

R

R/W

Bit 3

Bit 2

Bit 1

Bit 0

MONTH_L[3:0]
x

x

x

x

R/W

レジスターMONTHのミラーです。詳細は“0x05: MONTH (Month Data)”を参照してください。

0x18: YEAR_MIR (Mirrored Year Data, = 0x06) [BCDモード]
Bit No.

Bit 7

Bit 6

Bit name

Bit 5

Bit 4

Bit 3

Bit 2

YEAR_H[3:0]

Initial value

x

x

R/W

Bit 1

Bit 0

x

x

YEAR_L[3:0]
x

x

x

x

R/W

R/W

レジスターYEARのミラーです。詳細は“0x06: YEAR (Year Data)”を参照してください。

0x12: SEC_BIN0 (Second Binary Data 0)0x13: SEC_BIN1 (Second Binary Data 1)
0x14: SEC_BIN2 (Second Binary Data 2)
0x15: SEC_BIN3 (Second Binary Data 3)
0x16: SEC_BIN4 (Second Binary Data 4)[BINモード][BINモード][BINモード][BINモード][BINモード]

Second Binary Data 0
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name
Initial value

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

x

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

SEC_BIN[7:0]
x

x

x

x

R/W

R/W

Second Binary Data 1
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name
Initial value

SEC_BIN[15:8]
x

R/W

x

x

x

x
R/W

RA4000CE/RA8000CE
ETM64J-02

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80

4

レジスター

Second Binary Data 2
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

x

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

x

SEC_BIN[23:16]

Initial value

x

x

x

x

R/W

R/W

Second Binary Data 3
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

SEC_BIN[31:24]

Initial value

x

x

x

x

R/W

R/W

Second Binary Data 4
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

–

–

–

–

–

–

–

SEC_BIN[32]Initial value

0

0

0

0

0

0

0

x

R/W

R

R

R

R

R

R

R

R/W

Bits 7–0: SEC_BIN[7:0](Second Binary Data 0)
SEC_BIN[15:8] (Second Binary Data 1)
SEC_BIN[23:16] (Second Binary Data 2)
SEC_BIN[31:24] (Second Binary Data 3)
Bit 0:
SEC_BIN[32](Second Binary Data 4)
BINカウンターの設定と読み出しを行います。
これらのレジスターへの秒データの書き込みでは、レジスターSUBSEC_LおよびSUBSEC_Hは0クリ
アされません。
これらのレジスターはレジスターCNTSEL = 0x3もしくは0x2の場合にアクセス可能です。
*1

時計/カレンダーの詳細については、“3.2 時計/カレンダー機能”を参照してください。

0x19: OFS_SUBSEC_H (Offset Sub-Second Data High)
0x1A: OFS_SUBSEC_L (Offset Sub-Second Data Low)
Offset Sub-Second Data HighBit No.

Bit 7

Bit 6

Bit 5

Bit name

OFS_SUBSEC[10]

(GP)

(GP)

Initial value
R/W

0

0

0

R/W

R/W

R/W

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

0

0

OFS_SUBSEC[9:5]
0

0

0
R/W

Offset Sub-Second Data Low
Bit No.

Bit 7

Bit 6

Bit name

Bit 5

Bit 4

Bit 3

OFS_SUBSEC[4:0]

Initial value

0

0

R/W

0

0

0

R/W

Bit 2

Bit 1

Bit 0

–

OFSFIN

OFSEN

0

1

0

R

R

W

Bit 7:OFS_SUBSEC[10] (Offset Sub-Second Data High)
Bits 4–0: OFS_SUBSEC[9:5] (Offset Sub-Second Data High)
Bits 7–3: OFS_SUBSEC[4:0] (Offset Sub-Second Data Low)
1/1024秒の時刻合わせのためのオフセット値をこれらのビットに設定します。オフセット値は秒以下の1/1024秒カウンターに直接加算されるため、データ長11ビットの2の補数で算出し、ビット10を
OFS_SUBSEC[10]ビットに、ビット9 ～ 0をOFS_SUBSEC[9:0]ビットに設定します。
Bit 1

OFSFIN (Offset Sub-Second Data Low)
このビットは、1/1024秒のオフセット補正動作状態を示します。
1 (R):
0 (R):

Bit 0

オフセット補正完了/オフセット補正可能
オフセット補正動作中

OFSEN (Offset Sub-Second Data Low)
このビットは、1/1024秒のオフセット補正動作を開始します。

RA4000CE/RA8000CE
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1 (W):
0 (W):

レジスター

オフセット補正開始
無効

この書き込み直後の秒カウンター更新時に、オフセット値が1/1024秒カウンターに反映されます。この処理は1度のみ行われ、これ以降の秒カウンター更新時は行われません。
*1

1/1024秒のオフセット補正手順については、3.2節内の“1/1024秒のオフセット時刻合わせ”を参照してください。

0x1B: DIG_TRIM_H (Digital Trimming Data High)
0x1C: DIG_TRIM_L (Digital Trimming Data Low)
Digital Trimming Data HighBit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

0

DTRIM[8:1]

Initial value

0

0

0

0

R/W

R/W

Digital Trimming Data Low
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

DTRIM[0]

–

–

–

–

–

–

DTRIMEN

Initial value
R/W

0

0

0

0

0

0

0

0

R/W

R

R

R

R

R

R

R/W

Bits 7–0: DTRIM[8:1] (Digital Trimming Data High)Bit 7:DTRIM[0] (Digital Trimming Data Low)
論理緩急を行う場合に、補正量を2の補数でこれらのビットに設定します。
Bit 0

DTRIMEN(Digital Trimming Data Low)

このビットは、論理緩急機能の動作を許可/禁止します。
1 (R/W): 論理緩急機能イネーブル
0 (R/W): 論理緩急機能ディスエーブル*1

論理緩急機能の詳細については、“3.4 論理緩急機能”を参照してください。

0x1D: TCTL_MIR (Mirrored Timer Control, = 0x0D)
Bit No.

Bit 7

Bit name

Bit 6
FSEL[1:0]

Initial value

0

R/W

0
R/W

Bit 5

Bit 4

Bit 3

Bit 2

USEL0

TE

WADA

–

0

0

0

0

R/W

R/W

R/W

R

Bit 1

Bit 0
TSEL[1:0]

1

0
R/W

レジスターTCTLのミラーです。詳細は“0x0D: TCTL (Timer Control)”を参照してください。

0x1E: INTF_MIR (Mirrored Status Flag, = 0x0E)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

PORF

OSCSTPF

UF

TF

AF

EVF

VLF

VTMPLF

Initial value
R/W

1

1

x

x

x

0

1

1

R/W

R/W

R/W

R/W

R/W

R/W

R/W

R/W

レジスターINTFのミラーです。詳細は“0x0E: INTF (Status Flag)”を参照してください。

0x1F: CNTSEL (Counter Select)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

–

–

–

–

–

ACCBCDBINCNTENBCDCNTEN

Initial value

0

0

0

0

0

1

1

1

R/W

R

R

R

R

R

R/W

R/W

R/W

Bit 2:ACCBCD

RA4000CE/RA8000CE
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4

レジスター

このビットは、時計/カレンダーカウンターのアクセスモード (BCDカウンター[レジスターSEC〜
YEAR]とBINカウンター[レジスターSEC_BINn]のどちらにリード/ライトアクセスするか) を選択します。
1 (R/W): BCDモード (BCDカウンターをリード/ライト)
0 (R/W): BINモード(BINカウンターをリード/ライト)Bit 1:

BINCNTEN
このビットは、時計/カレンダーのBINカウンターの動作を許可/禁止します。
1 (R/W): BINカウンターイネーブル
0 (R/W): BINカウンターディスエーブル

Bit 0:BCDCNTEN
このビットは、時計/カレンダーのBCDカウンターの動作を許可/禁止します。
1 (R/W): BCDカウンターイネーブル
0 (R/W): BCDカウンターディスエーブル*1

カウンターのアクセスモードについては、“3.2 時計/カレンダー機能”を参照してください。

0x20: EVIN_EN (Event Input Enable)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name–––

EVIN2CPEN

EVIN1CPEN–

EVIN2EN

EVIN1EN

Initial value

0

0

0

0

0

0

0

0

R/W

R

R

R

R/W

R/W

R

R/W

R/W

Bit 4
Bit 3

EVIN2CPEN
EVIN1CPEN
これらのビットは、EVINn端子からの外部イベントトリガー入力によるタイムスタンプキャプ
チャー (バッファーへのタイムスタンプデータの取得) を許可/禁止します。
1 (R/W): EVINnタイムスタンプキャプチャーイネーブル
0 (R/W): EVINnタイムスタンプキャプチャーディスエーブル
EVINnCPENビットの設定は、下記のEVINnENビット = 1の場合に有効となります。

Bit 1
Bit 0

EVIN2EN
EVIN1EN
これらのビットは、EVINn端子からの外部イベントトリガー入力を許可/禁止します。
1 (R/W): EVINnイベントトリガー入力イネーブル
0 (R/W): EVINnイベントトリガー入力ディスエーブル*1

タイムスタンプ機能の詳細については、“3.11 タイムスタンプ機能”を参照してください。

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4

レジスター

0x21: EVIN1_CFG (EVIN1 Configuration)
0x23: EVIN2_CFG (EVIN2 Configuration)
Bit No.

Bit 7

Bit 6

Bit 5

Bit name–––

Initial value

0

0

0

R/W

R

R

R

Bit 4

Bit 3

Bit 2

Bit 1

PUPD[2:0]0

Bit 0
POL[1:0]

1

0

0

R/W

0
R/W

Bits 4–2: PUPD[2:0]
これらのビットは、EVINn端子のプルアップ/ダウン抵抗を選択します。
表 4.6

EVINn端子のプルアップ/ダウン

EVINn_CFG.PUPD[2:0]

プルアップ/ダウン抵抗

0b000
0b001
0b010
0b011
0b100
その他

プルアップ/ダウンなし
プルアップ 500 kΩ
プルアップ
1 MΩ (デフォルト)
プルアップ 10 MΩ
プルダウン 500 kΩ
プルアップ/ダウンなし

Bits 1–0: POL[1:0]
これらのビットは、タイムスタンプデータを取得するEVINn入力信号を取り込むための検出エッジの極性を選択します。
表 4.7

*1

EVINn入力検出エッジ極性

EVINn_CFG.POL[1:0]検出エッジ極性

0b00
0b01
0b10
0b11

立ち下がりエッジ (デフォルト)立ち上がりエッジ
立ち下がりおよび立ち上がりエッジ

タイムスタンプ機能の詳細については、“3.11 タイムスタンプ機能”を参照してください。

0x22: EVIN1_FLT (EVIN1 Noise Filter)
0x24: EVIN2_FLT (EVIN2 Noise Filter)
Bit No.

Bit 7

Bit 6

Bit name––

Initial value

0

0

R/W

R

R

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

FLT[5:0]
0

0

0
R/W

Bits 5–0: FLT[5:0]
これらのビットは、EVINn入力信号のノイズフィルター時間を設定します (FLT[5:0] × 125ms)。
表 4.8

*1

EVINn端子の入力有効パルス幅

EVINn_FLT. FLT[5:0]

入力信号のエッジと125msごとのサンプリングタイミ
ングとの前後関係によって、エッジ入力が検出される場合とされない場合が生じるEVINnのパルス幅

常にエッジ入力が検出される
EVINnのパルス幅

0x00
0x01 (設定禁止)
0x02
0x03
:
0x27
0x28
0x29以上 (設定禁止)––
125 ms以上、250 ms未満
250 ms以上、375 ms未満:
4750 ms以上、4875 ms未満
4875 ms以上、5000 ms未満–

1 ms以上–250 ms以上
375 ms以上:
4875 ms以上
5000 ms以上–

タイムスタンプ機能の詳細については、“3.11 タイムスタンプ機能”を参照してください。

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84

4

レジスター

0x27: BUF1_CFG1 (BUF1 Configuration 1)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

BINSEL

OVWEN

–

–

–

FULLIENEMPTIENOVWIEN

Initial value

0

0

0

0

0

0

0

0

R/W

R/W

R/W

R

R

R

R/W

R/W

R/W

Bit 7:BINSEL
このビットは、イベント発生時にバッファーに記録する日時データとしてBCDカウンターとBINカ
ウンターのどちらのデータを取得するか選択します。
1 (R/W): BINカウンターデータを取得
0 (R/W): BCDカウンターデータを取得

Bit 6:

OVWEN
このビットは、バッファーが満杯になった後 (Bank 7への書き込み後) の書き込みモードを設定します。
1 (R/W): オーバーライトモード (Bank 7を上書き)
0 (R/W): オーバーライト禁止モード (バッファーフル時は記録を停止、取得データは破棄)

Bit 2:FULLIEN
これらのビットは、バッファーフル割り込みを許可/禁止します。
1 (R/W): バッファーフル割り込みイネーブル
0 (R/W): バッファーフル割り込みディスエーブル
このビットが1の場合、バッファーフル状態が発生すると割り込みフラグ (BUF1_STAT.FULLFビット) が1にセットされます。

Bit 1:EMPTIEN
これらのビットは、バッファーエンプティ解消割り込みを許可/禁止します。
1 (R/W): バッファーエンプティ解消割り込みイネーブル
0 (R/W): バッファーエンプティ解消割り込みディスエーブル
このビットが1の場合、エンプティ状態のバッファーにデータが書き込まれると割り込みフラグ(BUF1_STAT. EMPTFビット) が1にセットされます。

Bit 0:OVWIEN
これらのビットは、バッファーオーバーライト割り込みを許可/禁止します。
1 (R/W): バッファーオーバーライト割り込みイネーブル
0 (R/W): バッファーオーバーライト割り込みディスエーブル
このビットが1の場合、バッファーフル状態で新たなタイムスタンプが取得されると割り込みフラグ(BUF1_STAT.OVWFビット) が1にセットされます。

*1

タイムスタンプ機能の詳細については、“3.11 タイムスタンプ機能”を参照してください。

RA4000CE/RA8000CE
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85

4

レジスター

0x28: BUF1_STAT (BUF1 Status)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

FULLF

EMPTF

–

–

–

–

–

OVWF

Initial value

0

1

0

0

0

0

0

0

R/W

R

R

R

R

R

R

R

R

Bit 7:

FULLF
このフラグは、バッファーがフル状態か否かを示します。
1 (R):
0 (R):

バッファーフル状態
バッファーに空きがある

このフラグは、Bank 6バッファーにのみデータが書き込まれている状態で新たに取得されたタイム
スタンプデータがBank 7バッファーに書き込まれると1にセットされます。
Bit 6:

EMPTF
このフラグは、バッファーがエンプティ状態か否かを示します。
1 (R):
0 (R):

バッファーエンプティ状態
バッファーにデータがある

このフラグは初期状態で1にセットされ、最初に取得したタイムスタンプデータがBank 6に書き込まれると0にクリアされます。
Bit 0:

OVWF
このフラグは、バッファーフル状態で新たなタイムスタンプデータを取得したか否かを示します。
オーバーライト禁止モード
1 (R):
バッファーフル後のデータ取得あり (最新データは破棄)
0 (R):
バッファーフル後のデータ取得なし
オーバーライトモード
1 (R):
オーバーライトあり (Bank 7は最新データで上書き)
0 (R):
オーバーライトなし
このフラグは、バッファーフル状態で新たなタイムスタンプデータを取得すると1にセットされます。

注: このレジスターのフラグはバッファーの読み出しによってリセットすることはできません。リセットするには 、 WRCMD_CFG. BUF1FCLREN ビ ッ ト を 1 に 設 定 し て コ マ ン ド ト リ ガ ー を 発 行 す る ( レ ジ ス タ ー
WRCMD_TRGへの書き込みを行う) 必要があります。

*1

タイムスタンプ機能の詳細については、“3.11 タイムスタンプ機能”を参照してください。

0x29: BUF1_CFG2 (BUF1 Configuration 2)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name–

SRAMMOD

–

–

–

–

–

–

Initial value

0

0

0

0

0

0

0

0

R/W

R

R/W

R

R

R

R

R

R

Bit 6:SRAMMOD
このビットは、SRAMモードでのバッファーの読み出し/書き込みを許可/禁止します。
1 (R/W): SRAMモードイネーブル
0 (R/W): SRAMモードディスエーブル*1

タイムスタンプ機能の詳細、SRAM/バッファーの読み出し/書き込み方法については、“3.11 タイムスタン
プ機能”を参照してください。

RA4000CE/RA8000CE
ETM64J-02

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86

4

レジスター

0x30: ALM_SEC (Second Alarm)
Bit No.

Bit 7

Bit name

XSAE

Initial value

0

R/W

Bit 6
0

R/W

Bit 7:

Bit 5

Bit 4

Bit 3

Bit 2

SALM_H[2:0]

Bit 1

Bit 0

0

0

SALM_L[3:0]

0

0

0

0

R/W

R/W

XSAE
このビットは秒アラームの設定を有効/無効にします。
1 (R/W): 秒アラーム無効
0 (R/W): 秒アラーム有効1に設定すると本レジスターの設定が無効となり、秒カウンターの内容はアラームの発生に影響を与えません。
0に設定すると本レジスターの設定が有効となり、秒カウンターの値とSALM_H[2:0]/SALM_L[3:0]
ビット設定値の一致がアラーム発生条件となります。

Bits 6–4: SALM_H[2:0]
Bits 3–0: SALM_L[3:0]
アラームの秒条件をBCDコードで設定します。
SALM_H[2:0]ビットでアラームの10秒桁 (0–5) を、SALM_L[3:0]ビットで1秒桁 (0–9) を設定します。
*1

アラーム機能の詳細については、“3.6 アラーム機能”を参照してください。

*2

アラーム機能を使用しない場合、本レジスターをリード/ライト可能な汎用レジスターとして使用することができます。ただし、不要な割り込みが発生することのないように、TSTP_INTE.AIEビットを0 (アラーム割り込みディスエーブル) に設定してください。

0x31: ALM_MIN_MIR (Mirrored Minute Alarm, = 0x07)
Bit No.

Bit 7

Bit name

XMAE

Initial value

1

R/W

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

MALM_H[2:0]
x

R/W

Bit 1

Bit 0

x

x

MALM_L[3:0]

x

x

x

x

R/W

R/W

レジスターALM_MINのミラーです。詳細は“0x07: ALM_MIN (Minute Alarm)”を参照してください。

0x32: ALM_HOUR_MIR (Mirrored Hour Alarm, = 0x08)
Bit No.

Bit 7

Bit 6

Bit name

XHAE

(GP)

Initial value
R/W

1

x

R/W

R/W

Bit 5

Bit 4

Bit 3

Bit 2

HALM_H[1:0]
x

Bit 1

Bit 0

x

x

HALM_L[3:0]
x

x

x

R/W

R/W

レジスターALM_HOURのミラーです。詳細は“0x08: ALM_HOUR (Hour Alarm)”を参照してください。

0x33: ALM_WEEKDAY_MIR (Mirrored Day-of-Week Alarm / Day Alarm, = 0x09)
Mirrored Day-of-Week Alarm Register
Bit No.

Bit 7

Bit name

XWAE

Initial value

1

R/W

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

x

x

x

Bit 1

Bit 0

x

x

WKALM[6:0]
x

x

x

R/W

x
R/W

Mirrored Day Alarm Register
Bit No.

Bit 7

Bit 6

Bit name

XWAE

(GP)

Initial value
R/W

1

x

R/W

R/W

Bit 5

Bit 4

Bit 3

Bit 2

DALM_H[1:0]xDALM_L[3:0]
x

x

R/W

x
R/W

レジスターALM_WEEKDAYのミラーです。詳細は“0x09: ALM_WEEKDAY (Day-of-Week Alarm / Day
Alarm)”を参照してください。

RA4000CE/RA8000CE
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87

4

レジスター

0x34: UPDISEL (Time Update Interrupt Select)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

–

–

–

–

–

–

USEL1

–

Initial value

0

0

0

0

0

0

0

0

R/W

R

R

R

R

R

R

R/W

R

Bit 1:

USEL1
このビットは、TCTL.USEL0ビットと共に時刻更新割り込みイベントの種類を選択します。(表 4.2
参照)

0x38: WTICFG (Wakeup Timer Interrupt Configuration)
Bit No.

Bit 7

Bit name

Bit 6

Bit 5

PINMUX[1:0]

Initial value

0/1

R/W

0/1
R/W

Bit 4
RSTOPT[1:0]

0

0
R/W

Bit 3

Bit 2

Bit 1

Bit 0

WTONETIM

TSEL2WTIOUT

UPDOWNMOD

0

0

0

0

R/W

R/W

R/W

R/W

Bits 7–6: PINMUX[1:0]
これらのビットの値を初期値から変更することを、禁止します。初期値と異なる値が設定された場
合、意図しない端子機能割り当てになる可能性があります。
各機種オプションの初期値は、表 4.9のとおりです。

RA4000CE/RA8000CE
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4
表 4.9

レジスター

各製品のWTICFG.PINMUX[1:0]ビット初期値

製品名称

インターフェイス

WTICFG.PINMUX[1:0]初期値

RA4000CE Option A YB
RA4000CE Option B YB
RA4000CE Option C YB
RA4000CE Option D YB
RA4000CE Option E YB
RA8000CE Option A YB
RA8000CE Option B YB
RA8000CE Option C YB
RA8000CE Option D YB

3線SPI

0b01
0b01
0b00
0b00
0b00
0b01
0b01
0b00
0b10

4線SPI
I2C-Bus

Bits 5–4: RSTOPT[1:0]
これらのビットは、リセット (/RST) 出力時に入出力を無効にするか否かを選択します。
入力端子が無効の時は、入力端子をHi-Zにすることが可能です。
出力端子が無効の時は、Hi-Z出力になります。
ディスエーブル: /RST = L (電源電圧低下検出時) に入力/出力を無効にする。
イネーブル:/RST = L (電源電圧低下検出時) に入力/出力を無効にしない。
本設定は、/RST端子機能が使用可能な機種のみ有効です。
表 4.10

リセット出力オプションの選択

WTICFG. RSTOPT[1:0]

FOE, CE, CLK, DI (DIO), SCL, SDA 端子入力
DO 端子出力

FOUT, /INT, SOUT 端子出力

0b00
0b01
0b10
0b11

ディスエーブル (デフォルト)
ディスエーブル
イネーブル
イネーブル

ディスエーブル (デフォルト)
イネーブル
ディスエーブルイネーブル

Bit 3:WTONETIM
このビットは、ウェイクアップタイマー割り込み発生時に/INT出力を自動解除するか否かを選択します。
1 (R/W): 自動解除しない (LOW出力)
0 (R/W): 自動解除する (7.812 ms幅のLOWパルス出力)

Bit 2:

TSEL2
このビットは、ウェイクアップタイマーのソースクロックとして外部クロックを選択します。
1 (R/W): EVIN2端子入力クロック
0 (R/W): TCTL.TSEL[1:0]ビットで選択された内部クロック

Bit 1:WTIOUT
このビットは、ウェイクアップタイマー割り込み信号の出力端子を選択します。
1 (R/W): FOUT端子から出力 (CMOSバッファー出力)
0 (R/W): /INT端子から出力 (N-chオープンドレイン出力)
注: ウェイクアップタイマー割り込み信号の出力端子にFOUT端子を選択した場合、FOUT端子からはウェイ
クアップタイマー割り込み信号とFOUT信号がNORされた信号が出力されます。したがって、FOUT端子
からウェイクアップタイマー割り込み信号だけを出力させる場合は、TCTL.FSEL[1:0]ビットを0b11に設定して、FOUT信号の出力を停止してください。

Bit 0:*1

UPDOWNMOD
このビットは、ウェイクアップタイマーのカウントモードを設定します。
1 (R/W): カウントアップモード
0 (R/W): カウントダウンモード

ウェイクアップタイマーの詳細については、“3.7 ウェイクアップタイマー機能”を参照してください。

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4

レジスター

0x39: WTCTL (Wakeup Timer Control)
Bit No.

Bit 7

Bit 6

Bit name

WTRST

EXWTRSTEN

Initial value

0

0

R/W

W

R/W

Bit 7:

Bit 5

Bit 4

WTRSTWIN[1:0]
0

0
R/W

Bit 3

Bit 2

Bit 1

Bit 0

WTMODSELWTSTOPCTL–

WTSTOP

0

0

0

0

R/W

R/W

R

R/W

WTRST
このビットは、ウェイクアップタイマーにプリセット値をリロードします。
1 (W):
0 (W):

タイマープリセット
無効

本ビットへの1書き込みにより、ウェイクアップタイマーのカウンターにカウントダウンモード時はプリセット値が、カウントアップモード時は1がリロードされカウント動作を再スタートします。こ
れにより、ウェイクアップタイマーをウォッチドッグタイマーのように使用することができます。
本ビットからは、1書き込み後も常時0が読み出されます。
Bit 6:

EXWTRSTEN
このビットは、外部入力信号によるウェイクアップタイマーのリセットを許可/禁止します。
1 (W):
0 (W):

外部入力リセットをイネーブル
外部入力リセットディスエーブル

EXWTRSTENビットを1にすると、EVIN2端子からの977 µs以上の幅のHIGHパルス入力によって、ウェイクアップタイマーがリセットされます。この外部入力リセットは、WTRSTビットによるリセットと併用可能です。
Bits 5–4: WTRSTWIN[1:0]
これらのビットは、カウントダウンモードにおけるウェイクアップタイマーのリセット受付期間(リセットウィンドウ) を指定します。このリセットウィンドウによるリセット受付期間の制限は、
WTRSTビットによるリセット、および外部入力リセットの両方に適用されます。
表 4.11

リセットウィンドウの設定

WTCTL.WTRSTWIN[1:0]

リセット受付期間 (カウントダウンモード)

0b00
0b01
0b10
0b11

全期間 (デフォルト)
カウンター値 = 2 〜 1
カウンター値 = 16 〜 1
カウンター値 = 64 〜 1

ウェイクアップタイマーのプリセット値は、リセット受付期間より大きい値に設定する必要があります。
Bit 3:WTMODSEL
このビットは、ウェイクアップタイマーの動作をノーマルモード (リセット出力解除中) またはセー
フモード (リセット出力中) の一方のみに制限します。
1 (R/W): ノーマルモード時はカウンターを停止
0 (R/W): セーフモード時はカウンターを停止

Bit 2:WTSTOPCTL
このビットは、WTMODSELビット、WTSTOPビットの機能を有効/無効に設定します。
1 (R/W): WTMODSEL有効、WTSTOP無効
0 (R/W): WTMODSEL無効、WTSTOP有効RA4000CE/RA8000CE
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Bit 0:

レジスター

WTSTOP
このビットは、ウェイクアップタイマーを一時停止します。
1 (R/W): ウェイクアップタイマーを一時停止
0 (R/W): ウェイクアップタイマーの一時停止を解除*1

ウェイクアップタイマーの詳細については、“3.7 ウェイクアップタイマー機能”を参照してください。

0x3A: WTCNT_L_MIR (Mirrored Wakeup Timer Counter Low, = 0x0A)
0x3B: WTCNT_M_MIR (Mirrored Wakeup Timer Counter Middle, = 0x0B)
0x3C: WTCNT_H_MIR (Mirrored Wakeup Timer Counter High, = 0x0C)
Mirrored Wakeup Timer Counter Low
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

1

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

0

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

WTCNT[7:0]

Initial value

0

0

0

0

R/W

R/W

Mirrored Wakeup Timer Counter Middle
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

WTCNT[15:8]

Initial value

0

0

0

0

R/W

R/W

Mirrored Wakeup Timer Counter HighBit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

WTCNT[23:16]

Initial value

0

0

0

0

R/W

0
R/W

レ ジ ス タ ー WTCNT_L 、WTCNT_M 、 WTCNT_Hの ミ ラ ー で す 。 詳 細 は “0x0A–0x0C: WTCNT_L/
WTCNT_M/WTCNT_H (Wakeup Timer Counter Low/Middle/High)”を参照してください。

0x3D: TCTL_MIR (Mirrored Timer Control, = 0x0D)
Bit No.

Bit 7

Bit name

Bit 6
FSEL[1:0]

Initial value

0

0

R/W

R/W

Bit 5

Bit 4

Bit 3

Bit 2

USEL0

TE

WADA

–

0

0

0

0

R/W

R/W

R/W

R

Bit 1

Bit 0
TSEL[1:0]

1

0
R/W

レジスターTCTLのミラーです。詳細は“0x0D: TCTL (Timer Control)”を参照してください。

0x3E: INTF_MIR (Mirrored Status Flag, = 0x0E)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

PORF

OSCSTPF

UF

TF

AF

EVF

VLF

VTMPLF

Initial value
R/W

1

1

x

x

x

0

1

1

R/W

R/W

R/W

R/W

R/W

R/W

R/W

R/W

レジスターINTFのミラーです。詳細は“0x0E: INTF (Status Flag)”を参照してください。

0x3F: TSTP_INTE_MIR (Mirrored Timer Stop and Interrupt Enable, = 0x0F)
Bit No.

Bit 7

Bit name

Bit 6
CSEL[1:0]

Initial value

0

R/W

1
R/W

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

UIE

TIE

AIE

EIE

–

STOP

0

0

0

0

0

0

R/W

R/W

R/W

R/W

R

R/W

レジスターTSTP_INTEのミラーです。詳細は“0x0F: TSTP_INTE (Timer Stop and Interrupt Enable)”を参照してください。

0x41: WRCMD_CFG (Write Command Configuration)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

EVCNTCLREN––

BUF1FCLREN

–

–

–

CMDTRGEN

Initial value
R/W

0

0

0

0

0

0

0

0

R/W

R

R

R/W

R

R

R

R/W

注: 本レジスターはレジスターWRCMD_TRG (アドレス0x42) への書き込み時に実行される機能を指定します。
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Bit 7:

レジスター

EVCNTCLREN
このビットは、コマンドトリガー実行時 (レジスターWRCMD_TRGへの書き込み時) にイベントカ
ウンターを初期化するか否かを指定します。
1 (R/W): イベントカウンターを初期化
0 (R/W): イベントカウンターを初期化しない
このビットを1に設定してコマンドトリガーを実行すると、以下のEVIN1 〜 2のイベント入力回数
カウンターがすべて初期化されて0になります。
EVIN1_EVCNT.EVCNT[5:0]ビット (EVIN1イベントカウンター)
EVIN2_EVCNT.EVCNT[5:0]ビット (EVIN2イベントカウンター)

Bit 4:

BUF1FCLREN
このビットは、コマンドトリガー実行時にバッファーステータスフラグを初期化するか否かを指定します。
1 (R/W): バッファーステータスフラグを初期化
0 (R/W): バッファーステータスフラグを初期化しない
このビットを1に設定してコマンドトリガーを実行すると、以下のバッファーステータスフラグがす
べて初期化され、バッファーはエンプティ状態になります。
BUF1_STAT.FULLFビット (バッファーフルフラグ)
BUF1_STAT.EMPTFビット (バッファーエンプティフラグ)BUF1_STAT. OVWFビット (バッファーオーバーライトフラグ)

Bit 0:CMDTRGEN
このビットは、コマンドトリガー実行時にタイムスタンプトリガーを発行するか否かを指定します。
1 (R/W): タイムスタンプトリガーが発行される
0 (R/W): タイムスタンプトリガーが発行されない
このビットを1に設定してコマンドトリガーを実行すると、タイムスタンプトリガーが発行されます。
このタイムスタンプトリガーを連続して発行する場合は、トリガーの間に5 ms以上のインターバルが必要です。タイムスタンプトリガーが受け付けられたかは、BUF_INTF.BUF1Fビットが1にセットされたことで確認できます。

0x42: WRCMD_TRG (Write Command Trigger)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit name

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

0

WRTRG[7:0]

Initial value

0

R/W

0

0

0
R/W

Bits 7–0: WRTRG[7:0]
このアドレスに任意の値を書き込むことにより、コマンドトリガーが発行されるとともに、レジス
ターWRCMD_CFG (アドレス0x41) に設定された動作が行われます (レジスターライトのタイミン
グで発行されます。タイミングの詳細は、3.11節内の“コマンドトリガーの発行”を参照してください)。
コマンドトリガー発行から、次のコマンドトリガー発行やタイムスタンプデータを読み込み可能になるまでの間は、本レジスターは0x00以外の値を保持します。タイムスタンプトリガー発行直後にスタンプデータを読み出す場合や、次のコマンドトリガーを発行する場合は、その前に本レジスターを読み出し、0x00に戻っていることを確認してください。

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4

レジスター

0x43: EVNT_INTE (Event Interrupt Enable)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name–

EVIN2IEN

EVIN1IEN

RSTOIEN–

VTMPLIEN–

OSCSTPIEN

Initial value

0

0

0

0

0

0

0

0

R/W

R

R/W

R/W

R/W

R

R/W

R

R/W

Bit 6:
Bit 5:

EVIN2IEN
EVIN1IEN
これらのビットは、EVINnイベント入力による割り込みの発生を許可/禁止します。
1 (R/W): EVINnイベント入力割り込みイネーブル
0 (R/W): EVINnイベント入力割り込みディスエーブル

Bit 4:RSTOIEN
このビットは、リセット出力 (VDD電圧がVDD低下検出電圧を下回ったことを検出) によるイベント
トリガーの発生を許可/禁止します。このビットは、/RST端子を持つ機種のみ有効です。
1 (R/W): リセット出力イベントトリガーイネーブル
0 (R/W): リセット出力イベントトリガーディスエーブル
このビットが1の場合、リセット出力を開始 (VDD電圧がVDD低下検出電圧 (-VDET1n) まで低下したことを検出) すると、イベントフラグ (EVNT_INTF.RSTOEVFビット) が1にセットされます。

Bit 2:VTMPLIEN
このビットは、VDET2電圧低下検出 (VDD電圧が発振回路の温度調整動作下限電圧を下回ったことを検出) によるイベントトリガーの発生を許可/禁止します。
1 (R/W): VDET2電圧低下検出イベントトリガーイネーブル
0 (R/W): VDET2電圧低下検出イベントトリガーディスエーブル
このビットが1の場合、VDET2電圧低下を検出するとイベントフラグ (EVNT_INTF.VTMPLEVFビット) が1にセットされます。

Bit 0:OSCSTPIEN
このビットは、発振停止検出によるイベントトリガーの発生を許可/禁止します。
1 (R/W): 発振停止検出イベントトリガーイネーブル
0 (R/W): 発振停止検出イベントトリガーディスエーブル
このビットが1の場合、発振停止を検出するとイベントフラグ (EVNT_INTF.OSCSTPEVFビット) が1にセットされます。

0x44: CAP_EN (Capture Enable)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name–––

RSTOCPEN–VTMPLCPEN–

OSCSTPCPEN

Initial value

0

0

0

0

0

0

0

0

R/W

R

R

R

R/W

R

R/W

R

R/W

Bit 4:RSTOCPEN
このビットは、リセット出力 (VDD電圧がVDD低下検出電圧を下回ったことを検出) のイベントトリ
ガーによるタイムスタンプキャプチャーを許可/禁止します。
1 (R/W): リセット出力タイムスタンプキャプチャーイネーブル
0 (R/W): リセット出力タイムスタンプキャプチャーディスエーブル

RA4000CE/RA8000CE
ETM64J-02

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4
Bit 2:

レジスター

VTMPLCPEN
このビットは、VDET2電圧低下検出 (VDD電圧が発振回路の温度調整動作下限電圧を下回ったことを検出) のイベントトリガーによるタイムスタンプキャプチャーを許可/禁止します。
1 (R/W): VDET2電圧低下検出タイムスタンプキャプチャーイネーブル
0 (R/W): VDET2電圧低下検出タイムスタンプキャプチャーディスエーブル

Bit 0:OSCSTPCPEN
このビットは、発振停止検出のイベントトリガーによるタイムスタンプキャプチャーを許可/禁止します。
1 (R/W): 発振停止検出タイムスタンプキャプチャーイネーブル
0 (R/W): 発振停止検出タイムスタンプキャプチャーディスエーブル

注: 実際に各イベントトリガーでタイムスタンプキャプチャーを実行させるためには、レジスターEVNT_INTE内の対応する***IENビットを1に設定してレジスターEVNT_INTFのイベントフラグ (***EVFビット) がセットされるようにしておく必要があります。

0x45: INTF_MIR (Mirrored Status Flag, = 0x0E)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

PORF

OSCSTPF

UF

TF

AF

EVF

VLF

VTMPLF

Initial value
R/W

1

1

x

x

x

0

1

1

R/W

R/W

R/W

R/W

R/W

R

R/W

R/W

レジスターINTFのミラーです。詳細は“0x0E: INTF (Status Flag)”を参照してください。

0x46: BUF_INTF (Buffer Interrupt Factor)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name

–

–

BUF1F

RSTOF

–

–

–

–

Initial value

0

0

0

1

0

0

0

0

R/W

R

R

R

R/W

R

R

R

R

Bit 5:

BUF1F
このフラグは、タイムスタンプバッファーにイベントトリガー入力割り込み要因が発生したことを示します。
1 (R):
0 (R):

イベントトリガー入力発生
イベントトリガー入力なし

このフラグは、バッファーフル (BUF1_STAT.FULLFビット = 1)、バッファーエンプティ解消(BUF1_STAT.EMPTFビット = 0)、またはバッファーオーバーライト (BUF1_STAT.OVWFビット = 1)が発生した時点で1にセットされます。
コ マ ン ド ト リ ガ ー に よ っ て こ れ ら の フ ラ グ を リ セ ッ ト (BUF1_STAT.FULLF ビ ッ ト = 0 、
BUF1_STAT.EMPTFビット = 1、BUF1_STAT.OVWFビット = 0) すると、BUF1Fビットは0にクリアされます。
次のイベント発生を受け付けて割り込みを出力するには、フラグがクリアされている必要があります。
Bit 4:

RSTOF
このフラグは、リセット出力を開始 (VDD電圧がVDD低下検出電圧を下回ったことを検出) した場合にセットされます。
1 (R):
0 (R):
1 (W):
0 (W):

リセット出力開始 (VDD電圧が-VDET1nを下回ったことを検出)
リセット出力なし (VDD電圧低下検出なし)
無効
フラグをクリア (VDD電圧復帰後)

RA4000CE/RA8000CE
ETM64J-02

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94

4

レジスター

VDD電圧低下の状態が継続している場合、0書き込みによってフラグをクリアすることはできません。
次のイベント発生を受け付けて割り込みを出力するには、フラグがクリアされている必要があります。

0x47: EVNT_INTF (Event Interrupt Factor)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name–

EVIN2F

EVIN1FRSTOEVF–VTMPLEVF–

OSCSTPEVF

Initial value

0

0

0

0

0

0

0

0

R/W

R

R/W

R/W

R/W

R

R/W

R

R/W

Bit 6:
Bit 5:

EVIN2F
EVIN1F
これらのフラグは、EVINnにイベント入力が発生したことを示します。
1 (R):
0 (R):
1 (W):
0 (W):

Bit 4:

EVINnイベント入力発生
EVINnイベント入力なし
無効
フラグをクリア

RSTOEVF
このフラグは、リセット出力 (VDD電圧がVDD低下検出電圧を下回ったことを検出) イベントが発生したことを示します。
1 (R):
0 (R):
1 (W):
0 (W):

Bit 2:

リセット出力イベント発生
リセット出力イベント入力なし
無効
フラグをクリア

VTMPLEVF
このフラグは、VDET2電圧低下検出 (VDD電圧が発振回路の温度調整動作下限電圧を下回ったことを検出) イベントが発生したことを示します。
1 (R):
0 (R):
1 (W):
0 (W):

Bit 0:

VDET2電圧低下検出イベント発生
VDET2電圧低下検出イベント入力なし
無効
フラグをクリア

OSCSTPEVF
このフラグは、発振停止検出イベントが発生したことを示します。
1 (R):
0 (R):
1 (W):
0 (W):

発振停止検出イベント発生
発振停止検出イベント入力なし
無効
フラグをクリア

発振停止検出イベントトリガーが発生した場合、発振再開後にタイムスタンプを取得します。
注: 本レジスターのフラグは、レジスターEVNT_INTEの対応する****IENビットが0の場合はイベントが発生してもセットされません。

RA4000CE/RA8000CE
ETM64J-02

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95

4

レジスター

0x51: EVIN1_EVCNT (EVIN1 Event Counter)
0x52: EVIN2_EVCNT (EVIN2 Event Counter)
Bit No.

Bit 7

Bit 6

Bit name––

Initial value

0

0

R/W

R

R

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

0

0

0

EVCNT[5:0]
0

0

0
R

Bits 5–0: EVCNT[5:0]
これらのビットは、EVINn端子からのイベント入力回数 (0 〜 63回) を示します。
入力回数が63回を超えた場合は、0に戻りカウントを継続します。
なお、EVIN_EN.EVINnENビット = 0の場合、EVINnイベント入力回数はカウントされません。

0x54: EVINMON (EVIN Monitor)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit 2

Bit 1

Bit 0

Bit name–

EVIN2MON

EVIN1MON

–

–

–

–

–

Initial value

0

x

x

0

0

0

0

0

R/W

R

R

R

R

R

R

R

R

Bit 6:
Bit 5:

EVIN2MON
EVIN1MON

Bit 1

Bit 0

これらのビットは、現在のEVINn端子入力レベルを示します。
1 (R):
0 (R):HIGHレベル
LOWレベル

0x55: SOUTCTL (SOUT Control)
Bit No.

Bit 7

Bit 6

Bit 5

Bit 4

Bit 3

Bit name

DCE

DC

–

–

SIGINV

Initial value
R/W

Bit 7:

0

0

0

0

0

R/W

R/W

R

R

R/W

Bit 2

SOUT[2:0]
0

0

0

R/W

DCE
このビットは、SOUT端子からのDC出力をON/OFFします。
1 (R/W): DC出力ON
0 (R/W): DC出力OFF (ステータスフラグ出力またはHi-Z状態)

Bit 6:

DC
このビットは、DCEビット = 1の場合にSOUT端子から出力するDCレベルを設定します。
1 (R/W): Highレベル
0 (R/W): Lowレベル
DCEとDCの2ビットの組み合わせにより、下表のとおりSOUT出力状態を選択可能です。
表 4.12
SOUTCTL.DCE

SOUTCTL.DC

0b0
0b0
0b1
0b1

0b0
0b1
0b0
0b1

SOUT出力の選択
SOUT 端子の出力状態

Hi-Z
SIGINVとSOUT[2:0]ビットの設定に従う
LOW出力
HIGH出力RA4000CE/RA8000CE
ETM64J-02

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4
Bit 3:

レジスター

SIGINV
このビットは、SOUT端子からステータスフラグを出力する場合に出力レベルを反転するか否か選択します。
1 (R/W): 反転出力 (フラグ = 1の場合: Lowレベル出力、フラグ = 0の場合: Highレベル出力)
0 (R/W): 非反転出力 (フラグ = 1の場合: Highレベル出力、フラグ = 0の場合: Lowレベル出力)
DCEビット = 1の場合、本ビットによる反転の設定は無効です。

Bits 2–0: SOUT[2:0]
これらのビットは、SOUT端子から出力するステータスフラグを選択します。DCEビット = 0の場合に有効です。
表 4.13

SOUT出力可能な内部ステータスフラグ

SOUTCTL.SOUT[2:0]

ステータスフラグ

0b000
0b001
0b010
0b011
0b100
0b101
0b110–0b111

INTF.TFビット (ウェイクアップタイマー割り込みフラグ)
INTF.AFビット (アラーム割り込みフラグ)
INFF.UFビット (時刻更新割り込みフラグ)
INTF.EFビット (イベント検出割り込みフラグ)
INTF.VTMPLFビット (温度補償動作停止検出フラグ)
INTF.VLFビット (日時データ無効警告フラグ)
Reserved

RA4000CE/RA8000CE
ETM64J-02

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5

電気的特性

5 電気的特性
5.1 絶対最大定格
表 5.1
項 目

記号

電源電圧
入力電圧
出力電圧

VDD
VIN
VOUT

保存温度

TSTG

絶対最大定格条 件–
FOE, CE, SCL, CLK, SDA, DIO, DI, EVIN1, EVIN2/INT, /RST, SDA, FOUT, SOUT, DIO, DO
梱包状態を除く、単品での保存

定格値

GND = 0 V
単位

-0.3 〜 +6.5
-0.3 〜 +6.5
-0.3 〜 +6.5

VVV

-55 〜 +125

C(注) • 電圧はすべて VSS = 0 V を基準とした値です。
• 上記、絶対最大定格を超えて使用した場合、永久破壊となることがあります。また、通常動作では推奨動作条件の範囲内で使用することが望ましく、この条件を越えると誤動作の原因になるとともに、信頼性に悪影響を及ぼすことがあります。
• 電圧は常に VDD ≧ VSS の条件を保持してください。
• 動作は電気的特性の範囲内で保証されます。

5.2 推奨動作条件
表 5.2
項 目
動作電源電圧*1
インターフェイス電源電圧
温度補償電圧計時電源電圧
動作温度範囲

記号
VDD
VACC
VTMP
VCLK
Ta

推奨動作条件条 件
主電源 VDD端子
VDD端子電圧（I2C-Bus IF、SPI IF 3wire/4wire）
温度補償動作が継続するVDD電源電圧
計時動作が継続するVDD電源電圧
結露無きこと

Min.

Typ.

Max.

GND = 0 V
単位

1.6
1.6
1.6 2VVLF 3
-40

3.0
3.0
3.0
3.0
+25

5.5
5.5
5.5
5.5
+125

V
V
V
V
C

Min.

Typ.

Max.

単位

–
–
–

32.768
–
–
–

–
40

–
–

–
–
–
–

0.5
–
–

1 電源端子近傍にノイズ対策用のバイパスコンデンサを必ず挿入してください。
2 温度補償電圧のMin.値未満では、温度に対応した周波数補正値更新機能が停止します。
3 VVLFは、VDD ≧ VACC (Min.)で初期設定後の計時保持下限値です。

5.3 周波数特性
表 5.3

周波数特性

特記無き場合: GND = 0 V, VDD = 3.0 V, Ta = -40 C 〜 +125 C
項 目

記号

出力周波数
周波数安定度fo∆f/f

周波数電圧特性
FOUTデューティ

f/V
Duty

水晶発振開始時間

tSTA

エージング
リフロー

fa
∆fref

条 件
Ta = +25 C
YB
Ta = 0 C 〜 +50 C
Ta = -40 C 〜 +85 C
Ta = +85 C 〜 +105 C
Ta = +105 C 〜 +125 C
Ta = +25 C, VDD = 1.6 V 〜 5.5 V
Vth = 50% VDD, Ta = -40 C 〜 +125 C,
VDD = 1.6 V 〜 5.5 V
Ta = +25 C, VDD = 1.6 V 〜 5.5 V
Ta = -40 C 〜 +125 C, VDD = 1.6 V 〜 5.5 V
Ta = +25 C, 電源電圧 = 3.0 V, 初年度
リフロー処理: 260 C Max., 2回±3.8 1±5.0 2±8.0 3±50.0 4
±1
60
1.0
3.0
±3
±3 5

kHz
×10-6

×10-6/V%s
×10-6/year
×10-6

1 月差10秒以内 2 月差13.2秒以内 3 月差21秒以内  4 月差132秒以内
5 リフロー実装前後の周波数変化率で、常温放置24時間経過後に常温環境で測定した値

RA4000CE/RA8000CE
ETM64J-02

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98

5

電気的特性

5.4 DC特性
DC特性
表 5.4

DC特性

特記無き場合: GND = 0 V, VDD = 1.6 V 〜 5.5 V, Ta = -40 C 〜 +125 C
項 目
記号
条 件
VPOR 電圧
VPOR
POR アサート電圧
温度補償更新停止検出電圧 VDET2
検出電源系 = VDD
VLF 検出電圧
VVLF
VDD 電源低下検出電圧
消費電流1
IDD1
/INT = Hi-Z,
VDD = 5 V
FOUT: 出力OFF (Hi-Z)
温度補償間隔 2.0 s
消費電流2
IDD2
VDD = 3 V
/RST端子なし, SCL, SDA = H, CE = L
消費電流3
IDD3
/INT = Hi-Z
VDD = 5 V
FOUT: 32 kHz出力, CL = 0 pF
温度補償間隔 2.0 s
消費電流4
IDD4
VDD = 3 V
/RST端子なし, SCL, SDA = H, CE = L
消費電流5
IDD5
/INT= Hi-Z
VDD = 5 V
FOUT: 32 kHz出力, CL= 30 pF
温度補償間隔 2.0 s
消費電流6
IDD6
VDD = 3 V
/RST端子なし, SCL, SDA = H, CE = L
消費電流7
IDD7
/INT = Hi-Z
VDD = 5 V
FOUT: 出力OFF (Hi-Z)
温度補償回路非動作時
消費電流8
IDD8
VDD = 3 V
/RST端子なし, SCL, SDA = H, CE = L
消費電流9
IDD9
/INT = Hi-Z
VDD = 5 V
FOUT: 出力OFF (Hi-Z)
温度補償回路動作ピーク時
消費電流10IDD10VDD = 3 V
/RST端子なし, SCL, SDA = H, CE = L
消費電流11
IDD11/INT = Hi-Z,
VDD = 5 V
FOUT: 出力OFF (Hi-Z)
温度補償間隔 2.0 s/RST端子あり, 出力解除時 (Hi-Z)
SCL, SDA = H, CE = L
消費電流12IDD12/INT = Hi-Z,
VDD = 2 V
FOUT: 出力OFF (Hi-Z)
温度補償間隔 2.0 s/RST端子あり, 出力時 (Low)
SCL, SDA = H, CE = L
消費電流13
IDD13/INT = Hi-Z,
VDD = 5 V
FOUT: 出力OFF (Hi-Z)
温度補償間隔 2.0 s
消費電流14
IDD14
VDD = 3 V
/RST端子あり, VDD電圧検出動作ピーク時
SCL, SDA = H, CE = L“H”入力電圧
VIH
SCL, SDA, CE, CLK, DIO, DI, EVINn, FOE“L”入力電圧VIL
SCL, SDA, CE, CLK, DIO, DI, EVINn, FOE“H”出力電圧VOH1
DIO, DO,VDD = 5.0 V, IOH = -1 mA
FOUT, SOUT VDD = 3.0 V, IOH = -1 mA
VOH2
VOH3
VDD = 3.0 V, IOH = -100 µA“L”出力電圧
VOL1
FOUT, SOUT VDD = 5.0 V, IOL = 1 mA
VOL2
VDD = 3.0 V, IOL = 1 mA
VOL3
VDD = 3.0 V, IOL = 100 µA
VOL4
DIO, DO,VDD = 5.0 V, IOL = 1 mA
/INT, /RSTVOL5
VDD = 3.0 V, IOL = 1 mA
VOL6SDA
VDD ≧ 2.0 V, IOL = 3 mA
入力リーク電流ILK
入力端子, 入力電圧 = VDD or GND
出力リーク電流IOZ
出力端子, 出力電圧 = VDD or GND
オープンドレイン出力端子 VPUP1/INT
プルアップ電圧
VPUP2/RST, SDA
EVINn入力プルアップ抵抗 RUP1
EVIN1/EVIN2端子, VDD = 3 V, 500 kΩ設定
RUP2
EVIN1/EVIN2端子, VDD = 3 V, 1 MΩ設定
RUP3
EVIN1/EVIN2端子, VDD = 3 V, 10 MΩ設定
EVINn入力プルダウン抵抗 RDWN3
EVIN1/EVIN2端子, VDD = 3 V, 500 kΩ設定
CE入力プルダウン抵抗
RDWN1
CE端子, N.C.端子 (Option C), VDD = 5 V
Option CにおけるN.C.端子
R
CE端子, N.C.端子 (Option C), VDD = 3 V
プルダウン抵抗 (Pin 1, 5, 6) DWN2

RA4000CE/RA8000CE
ETM64J-02

Min.
1.00
1.51
1.00
–

Typ.
1.20
1.55
1.20
0.35

Max.
1.30
1.59
1.30
1.8

–

0.30

1.7

–

1.20

3.1

–

0.80

3.0

–

6.10

8.1

–

4.00

6.0

–

0.33

1.75

–

0.28

1.65

–

60

100

–

55

95

–

1.50

3.7

–

0.60

2.25

–

12

20

–

11

19

0.8 x VDD
GND - 0.3
4.5
2.2
2.9
GND
GND
GND
GND
GND
GND
-0.5
-0.5
–
VDD
100
0.20
2.00
100
75

–
–
–
–
–
–
–
–
–
–
–
–
–
–
–
500
1.00
10.00
500
150

5.5
0.2 x VDD
5.0
3.0
3.0
GND + 0.5
GND + 0.8
GND + 0.1
GND + 0.25
GND + 0.4
GND + 0.4
0.5
0.5
5.5
5.5
2000
4.00
40.00
2000
300

V
µA
µA
V
V
kΩ
MΩ
MΩ
kΩ
kΩ

150

300

600

kΩ

単位
V
V
V
µA

µA

µA

µA

µA

µA

µA

V
V
V

V

V

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99

5

電気的特性

温度補償回路動作と消費電流
本機種は温度補償間隔ごとに温度センサーを動作させ、温度補償値の更新を行っているため、その期間は消費電流が増加します。IDD1、IDD2は、温度センサー測定動作の実行間隔2.0 s時の平均消費電流となります。
温度センサー測定動作期間(約 0.52 ms) 温度センサー測定動作停止期間
IDD9, 10

平均消費電流IDD1, 2

IDD7, 8温度補償間隔 (2.0 s)

図 5.1

温度補償回路動作と消費電流/RST出力端子ありの場合の消費電流/RST出力端子を持つ製品では、VDD電圧低下検出回路の消費電流が図 5.2のように周期的に変化します。IDD11、
IDD12は平均消費電流値です。
約 3 ms

平均消費電流IDD13, 14

IDD11, 12VDD電圧低下検出動作間隔(/RST = “H”出力時: 32 ms)(/RST = “L”出力時: 128 ms)

図 5.2/RST出力端子ありの場合の消費電流

状態遷移と自己監視機能の検出電圧
RA4000CE/RA8000CEの動作状態/モード (2.3節) の状態遷移、リセット出力機能 (3.9節)および自己監視機能(3.10節) のフラグのセットを判定する電圧値を図 5.3に示します。
5.5 V

ノーマルモード
ノーマルモード[/RST出力端子あり]+VDET1 = 2.50 V to 4.35 V-VDET1 = 2.40 V to 4.20 V(表5.8参照)

2.5 V
2.0 V

セーフモードMax. 1.59 V

1.5 V
Max. 1.30 V

1.0 V

VACC (Min.)/V TMP (Min.) = 1.6 V

Min. 1.51 V

VCLK (Min.) = 1.3 V

Max. 1.30 V

Min. 1.00 V

VDD上昇時Min. 0.60 V

0.5 V

POR有効

POR有効
VDD下降時GND

PORF = 1

VLF = 1VTMPLF = 1

動作状態[/RST出力端子なし]

自己監視フラグ

図 5.3

動作状態
[/RST出力端子あり]

自己監視電圧-フラグ・状態相関図

RA4000CE/RA8000CE
ETM64J-02

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100

5

電気的特性

5.5 AC特性
RA4000CE AC特性
表 5.5

RA4000CE AC特性

特記無き場合: GND = 0 V, VDD = 1.6 V 〜 5.5 V, Ta = -40 C 〜 +125 °C
項 目

記号

条 件

VDD = 1.8 V ± 0.2 V VDD = 3.0 V ± 10 % VDD = 5.0 V ± 10 %
Min.

Max.

Min.

Max.

Min.

Max.

単位

CLKクロック周期

tCLK

500

–

332

–

250

–

ns

CLK “H”パルス幅

tWH

250

–

166

–

125

–

ns

CLK “L”パルス幅

tWL

250

–

166

–

125

–

ns

CLK立ち上がり･立ち下り時間

tRF

–

100

–

50

–

40

ns

CLKセットアップ時間

tCLKS

50

–

30

–

30

–

ns

CEセットアップ時間

tCS

200

–

150

–

130

–

ns

CE保持時間

tCH

200

–

150

–

130

–

ns

CEリカバリー時間

tCR

300

–

200

–

150

–

ns

CE立ち上がり･立ち下り時間

tCERF

–

100

–

50

–

40

ns

書き込みデータセットアップ時間

tDS

100

–

50

–

40

–

ns

書き込みデータ保持時間

tDH

100

–

50

–

40

–

ns

読み出しデータ遅延時間

tRD

CL = 50 pF

–

200

–

150

–

150

ns

DO (DIO) 出力ディセーブル時間

tRZ

CL = 50 pF, RL = 10 kΩ

–

200

–

120

–

110

ns

1 VDD = 2.0 V 〜 2.7 VまではVDD = 1.8 V ± 0.2 V規格を、VDD = 3.3 V 〜 4.5 VまではVDD = 3.0 V ± 10%規格を使用してください。

CE
tCERF
tCLKS

tCS
tRF

tDH

M3

M2

A0
tRD

Hi-Z

DO

DIO

tCR

20%

tDS

DI

tCERF
tCH

80%

CLK
READ

tCLK
tWL tWH

tRF

tRZ
D7

D6

D0

M3

M2

A0

D7

D6

D0

M3

M2

A0

D7

D6

D0

A0

D7

D6

D0

WRITE
DI

Hi-Z

DO

DIO

M3

M2

* CLKおよびDI、DIOは、ノーマルモードでは、フローティング状態にならないようにしてください。

図 5.4

RA4000CE AC特性 (SPIタイミングチャート)

RA4000CE/RA8000CE
ETM64J-02

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101

5

電気的特性

RA8000CE AC特性
表 5.6

RA8000CE AC特性

特記無き場合: GND = 0 V, VDD = 1.6 V 〜 5.5 V, Ta = -40 C 〜 +125 °C
項 目

100 kHz アクセス
(Standard mode)

記号400 kHz アクセス
(Fast mode)

単位

Min.

Max.

Min.

Max.

SCLクロック周波数

fSCL

–

100

–

400

kHz

スタートコンディションセットアップ時間

tSU;STA

4.7

–

0.6

–

µs

スタートコンディションホールド時間

tHD;STA

4.0

–

0.6

–

µs

データセットアップ時間

tSU;DAT

250

–

100

–

ns

データホールド時間

tHD;DAT

0

–

0

–

ns

ストップコンディションセットアップ時間

tSU;STO

4.0

–

0.6

–

µs

ストップ-スタートコンディション間のバスフリー時間 tBUF

4.7

–

1.3

–

µs

SCL “L”時間

tLOW

4.7

–

1.3

–

µs

SCL “H”時間

tHIGH

4.0

–

0.6

–

µs

SCL,SDA立ち上がり時間

tr

–

1.0

–

0.3

µs

SCL,SDA立ち下がり時間

tf

–

0.3

–

0.3

µs

バス上の許容スパイク時間

tSP

–

50

–

50

ns

ProtocolSTART
condition(S)
tSU;STA

Bit 7
MSB
(A7)
tLOW

Bit 6
(A6)

tHIGH

Bit 0
LSB
(R/W)

ACK
(A)

STOP
condition(P)

1/fSCL

START
condition(S)
tSU;STA

SCL
(S)

tr

(P)

tf

SDA

tBUF

(S)

(A)

tHD;STAtSU;DAT

図 5.5

tHD;DATtSPtSU;STO

tHD;STA

RA8000CE AC特性 (I2C-Busタイミングチャート)

1 スレーブアドレス確定後、内部1 Hzクロック2カウントでI2C-BusインターフェイスがリセットされてSDAがHi-Zになります。このため、I2CBus通信はスレーブアドレス送信からストップコンディションの生成までを1秒以内に完了してください。
2 データ書き込み時は8ビットデータ送信後のACKビットのSCL立ち上りで8ビットデータを取り込みます。8ビットデータ取込み前に通信が遮断された場合、8ビット未達のデータは書き込まれません。

RA4000CE/RA8000CE
ETM64J-02

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102

5

電気的特性

5.6 電源投入特性
表 5.7

電源投入特性

特記無き場合: GND = 0 V, VDD =1.6 V 〜 5.5 V, Ta = -40 C 〜 +125 C
記号

条 件

Min.

Typ.

Max.

単位

電源立ち上げ時間1 1

tR1

電源投入後、VDD電圧がGNDから上昇する電圧スロープ、
電源電圧変動率（GND–VACC (Min.) 間）

1

–

10

ms/V

電源投入後アクセス待機時間 *2

tCL

VDD = VACC (Min.) 到達後、アクセス開始可能となる時間

40

–

–

ms

電源降下前アクセス終了保持時間 tCD

アクセス終了からVDD電圧をtFのスロープで降下させるまでの待機時間

0

–

–

µs

項 目

電源立ち下げ時間tF

VDD電圧が下降する電圧スロープ、電源電圧変動率

1

–

–

ms/V

電源立ち上げ時間2tR2

電源再上昇の際の電圧スロープ、電源電圧変動率

1

–

–

ms/V

1 パワーオンリセットを確実に実行させるため、初期電源投入時は電源立ち上げ時間を満足させると共に、必ずGNDレベルから電源を立ち上げてください。確実にパワーオンリセットを有効とするためには、電源OFF後、VDD がGNDレベルの状態を100ms以上確保してください。
*2 /RST出力機能未搭載機種の規格値です。すべてのレジスターアクセスが可能となるためには、水晶発振が開始され、内部にクロックが供給される必要があります。tCL経過後、VLFビットへのアクセスが可能となります。VLFビットへの0書き込みにより、フラグクリアが確認された時点か
ら、すべてのレジスター設定が有効となります。/RST出力機能ありの場合は、tSTA経過後に/RSTがH出力している場合にアクセス開始可能となります。

(1) /RST出力非搭載機種の場合
tR1

tF

tR2

VDD
電源VDD

VACC (Min.)VPOR (Max.)
GND+VDET1n

GND+VDET1n(VDD ≧ +VDET1n)VPOR (Min.)

内部 Vreg
内部POR-VDET1n

解除

解除

アサート

tSTA

インターフェイス

影響なし

t_int
tDELAY
128 ms 60 ms(Max.)

tCD
レジスターアクセス可能

レジスターアクセス可能
tDELAYS
188 ms(Max.)/RST

外部プルアップ (VDD)

tDELAYF

ノーマルモード期間

セーフモード期間

ノーマルモード期間(2) /RST出力機能搭載機種の場合
図 5.6

電源投入シーケンス

RA4000CE/RA8000CE
ETM64J-02

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103

5

電気的特性

5.7 リセット出力特性
表 5.8

リセット出力特性

特記無き場合: GND = 0 V, VDD = 1.6 V 〜 5.5 V, Ta = -40 C 〜 +125 C
項 目

記号

Min.

Typ.

Max.

単位

VDD立ち上がり時検出電圧1 1+VDET11

4.25

4.35

4.45

V

VDD立ち下がり時検出電圧1 2-VDET11

4.12

4.20

4.28

V

VDD立ち上がり時検出電圧2 1+VDET12

4.15

4.25

4.35

V

2

-VDET12

4.02

4.10

4.18

V

VDD立ち上がり時検出電圧3 1+VDET13

4.05

4.15

4.25

V

VDD立ち下がり時検出電圧3 2-VDET13

3.92

4.00

4.08

V

VDD立ち上がり時検出電圧41+VDET14

3.95

4.05

4.15

V

VDD立ち下がり時検出電圧4 2-VDET14

3.82

3.90

3.98

V

VDD立ち上がり時検出電圧5 1+VDET15

2.75

2.85

2.95

V

2

-VDET15

2.67

2.75

2.83

V

VDD立ち上がり時検出電圧6 1+VDET16

2.70

2.80

2.90

V

VDD立ち下がり時検出電圧6 2-VDET16

2.62

2.70

2.78

V

VDD立ち上がり時検出電圧7 1+VDET17

2.45

2.55

2.65

V

VDD立ち下がり時検出電圧7 2-VDET17

2.37

2.45

2.53

V

1

+VDET18

2.40

2.50

2.60

V

VDD立ち下がり時検出電圧8 2-VDET18

2.32

2.40

2.48

V

tDELAY

–

60

–

ms

tDELAYF

560

tSTA

–

ms

VDD立ち下がり時検出電圧2

VDD立ち下がり時検出電圧5VDD立ち上がり時検出電圧8/RST出力内部遅延時間/RST出力遅延時間(初期電源投入時)

3

条 件

3

/RST 出 力 解 除 電 圧 検 出 時 間 t_int
3(セーフモード解除時)

セーフモード時のVDD電圧低下検出間欠動作 (128 ms間隔) タイミングにより変化

0

–

128

ms

/RST出力遅延時間(セーフモード解除時)

初期電源起動時以降のセーフモードからノーマルモードに復帰するときの出力遅延時間－

188t_int + tDELAY－

ms

tDELAYS
3

1 リセット出力 (セーフモード) 解除電圧
2 リセット出力 (セーフモード) 開始電圧
3 タイミングパラメータと/RST出力信号の関係については図 5.6の(2)を参照してください。

RA4000CE/RA8000CE
ETM64J-02

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104

6

パッケージ

6 パッケージ
6.1 外形寸法図• 外形寸法図• 推奨はんだ付けパターン図

0.9
1.1

*1

0.2 Min.

1.0 Max.

2.5 ± 0.2 (Typ. 2.54)

3.2 ± 0.2 (Typ. 3.24)

0.7

0.7

0.4

0.3

0.3

0.62

Unit: mm

0.42

0.4

0.35

1 パッケージの1ピンと10ピン側の短辺側面の金属パッドは、水晶振動子の検査用パッドです。
安定した発振のために、結露やほこりなどによるリーク電流がこのパッド間に生じないよう、
ご配慮ください。
5ピンと6ピン側の短辺側面の金属パッドは、RTC内部で接続されていません。

図 6.1

外形寸法図

6.2 マーキングレイアウト
(1)

(2)

(1) ロゴ(2) 形式A→ RA
4000 → RA4000CE
8000 → RA8000CE(3) 精度、/RST仕様(4) 1番ピンマーク(5) 製品オプション(6) 製造ロット(3)

A####B
A123A
(4)

(5)

(6)

1

1 表示内容は捺印と表示の大略を示すもので、字形、大きさ、および位置の詳細を規定するもの
ではありません。

図 6.2

マーキングレイアウト

RA4000CE/RA8000CE
ETM64J-02

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7

実装上の注意事項

7 実装上の注意事項
本モジュールは水晶振動子を内蔵していますので、過大な衝撃や振動を与えないようにしてください。また、
低消費電力実現のためにCMOSプロセスを採用していますので、実装作業時には静電気対策を実施してください。

静電気
本モジュールは静電気破壊保護回路を内蔵していますが、過大な静電気が加わると内部回路が破壊される
おそれがありますので、梱包および運搬容器には導電性素材を使用してください。
はんだごてや測定回路などは高電圧リークのないものを使用し、実装時や作業時も静電気対策をお願いします。

ノイズ
電源および入出力端子に過大な外来ノイズが印加されると、誤動作やラッチアップ等により内部回路が破壊されることがあります。安定動作のため本モジュールの電源端子のできるだけ近い場所に0.1 µF以上のセ
ラミックキャパシタを接続してください。また、本モジュールの近くには大きなノイズを発生するデバイスを配置しないでください。

入力端子の電圧
入力端子に許容範囲外の電圧が定常的に入力されると貫通電流が発生し、消費電流の増加やラッチアップなどの原因となり内部回路が破壊されることがあります。入力端子には入力電圧仕様に従い、VIL Max.以下
VIH Min.以上の電圧を入力してください。

未使用入力端子の処理
入力端子の開放状態 = オープンでの使用は消費電流の増加や品質劣化の原因になります。内蔵のプルアッ
プ、またはプルダウン機能が適用されていない未使用の入力端子は、VDDまたはGNDに固定してください。

はんだ付け温度パッケージ内部が+260 °Cを超えるような半田付けは、水晶振動子の特性劣化や内部回路の破壊につながります。弊社が提供するはんだ耐熱性評価プロファイルの範囲内となるように、実装前に温度や時間などの実装条件を確認してください。

実装機
汎用実装機を使用する場合、その動作条件等によっては実装時の衝撃で内蔵水晶振動子が破壊される可能性がありますので事前に確認してください。動作条件を変更した場合も同様に確認してください。また、実装作業におきましては十分な静電気対策をお願いします。

超音波洗浄
超音波洗浄は、使用条件によっては内蔵水晶振動子が共振破壊される場合があります。洗浄機の種類 / パ
ワー / 時間 / 槽内の状態等の使用条件はお客様ごとに異なりますので、超音波洗浄に対する本モジュールの保証はいたしかねます。

実装方向逆向きの実装はモジュールの破壊の原因となります。方向を確認した上で実装を行ってください。

RA4000CE/RA8000CE
ETM64J-02

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106

7

実装上の注意事項

端子間リーク
製品が汚れている、または結露している状態での電源投入は端子間に電流リークの原因になります。洗浄後は乾燥させてから電源を投入してください。

はんだ耐熱性評価プロファイル (参考)Temperature [°C]300
; +260 °C OVER

TP+255 °C

250

200

150

TL
; +217 °C
Ts Max. ; +200 °C

Ts Min. ; +150 °C

Ramp-up rate
+3 °C/s Max.

tp: at least 30 s
tL
60 s to 150 s

Ramp-down rate
-6 °C/s Max.

(+217 °C over)ts
60 s to 120 s(+150 °C to +200 °C)

100

50Time from +25 °C to Peak0

60

120 180 240 300 360 420 480 540 600 660 720 780
Time [s]図 7.1

はんだ耐熱性評価プロファイル (参考)RA4000CE/RA8000CE
ETM64J-02

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107

8

耐湿/静電耐圧特性

8 耐湿/静電耐圧特性
8.1 吸湿耐性水準 (MSL)
項 目

レベル

条 件

JEDEC J-STD-020D.1に従う* 梱包開封後は温度 +30 °C以下、湿度85%以下の環境にて保管し、6ヶ月以内に実装してください。
MSL

LEVEL18.2 静電耐圧
項 目

値

ESD電圧 (HBM)

2000 V (Min.)

ESD電圧 (MM)2000 V (Min.)条 件

EIAJ ED-4701-1 C111Aに従う
EIAJ ED-4701-1 C111に従う

RA4000CE/RA8000CE
ETM64J-02

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9

参考回路例

9 参考回路例
VDD

VDD

1

MCU

RA4000CE
VDD

VDD

0.1 µF
SDIO

DIO

SCLK

CLK

SS

CE

IRQ

/INT

/RESET

/RST

SLEEP
CLOCK

FOUT

GPIO

EVINn

GND

2

Option B

Option A/B

GND*1 /INTのプルアップ抵抗は出力ドライブ能力と出力立ち上がり時間を加味して調整してください。
*2 バイパスコンデンサはRA4000CE端子の直近に設置してください。

図 9.1

一般的なMCUとの接続回路例 (RA4000CE Option A/B/C)
VDD

VDD

1

MCU

RA4000CE

VDD

VDD
0.1 µF

MISO

DO

MOSI

DI

SCLK

CLK

SS

CE

IRQ1

/INT

IRQ2

SOUT

/RESET

/RST

GPIO
GND

2

Option E

EVIN2
GND

*1 /INTのプルアップ抵抗は出力ドライブ能力と出力立ち上がり時間を加味して調整してください。
*2 バイパスコンデンサはRA4000CE端子の直近に設置してください。

図 9.2

一般的なMCUとの接続回路例 (RA4000CE Option D/E)

RA4000CE/RA8000CE
ETM64J-02

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109

9
VDD

VDD

1

MCU

参考回路例

RA8000CE
VDD

VDD

0.1 µF
SDA

SDA

SCL

SCL

IRQ1

/INT

IRQ2

SOUT

SLEEP
CLOCK

FOUT

/RESET

/RST

GPIO

EVINn

GND

2

Option A/B

Option B
Option A/B

GND

Other
I2C-Bus Device*1 /INTのプルアップ抵抗は出力ドライブ能力と出力立ち上がり時間を加味して調整してください。
*2 バイパスコンデンサはRA8000CE端子の直近に設置してください。

図 9.3

一般的なMCUとの接続回路例 (RA8000CE Option A/B/C)
VDD

VDD

MCU

RA8000CE
VDD

VDD

0.1 µF

3

SDA
SCL
/INT
Open

SOUT
EVIN2

SLEEP
CLOCK
GPIO

FOUT
2
1

FOE

GND

GND

*1 FOE端子機能を使用する場合*2 FOE端子機能を使用しない場合*3 バイパスコンデンサはRA8000CE端子の直近に設置してください。
RA8000CE Option Dは、高精度な温度補償水晶発振器 (32.768 kHz DTCXO) としての使用も可能です。

図 9.4

発振器 (32.768 kHz DTCXO) として使用 (RA8000CE Option D)

RA4000CE/RA8000CE
ETM64J-02

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110

10

10

梱包情報 (参考)

梱包情報 (参考)

テーピング仕様 (TE0804L)
キャリアテープ材質: PS
トップテープ材質: PET + PE
(単位: mm)

ø1.0 ±0.1

4.0 ±0.1

0.25 ±0.05

3.5 ±0.1

4.0 ±0.1

3.5 ±0.1

2.0 ±0.1

8.0 ±0.2+0.1

ø1.55 -01.75 ±0.1

10P: 40 ±0.1

1.4 ±0.1

2.8 ±0.1

図 10.1

テープ寸法

リール仕様
リール材質: PS(単位: mm)+0ø180 -3.0

11.4 ±1.0

ø60 -0+1

9 ±0.3

2 ±0.5

ø13 ±0.2

ø10

6-R0.5
ø21 ±0.8

リール窓の形状は代表例を掲載

図 10.2

リール寸法

RA4000CE/RA8000CE
ETM64J-02

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図表一覧

図表一覧
図
図 1.1 RA4000CE Option A/B/Cブロック図 ............................................................................................................ 2
図 1.2 RA4000CE Option D/Eブロック図 ............................................................................................................... 3
図 1.3 RA8000CE Option A/B/C/Dブロック図 ........................................................................................................ 4
図 1.4 RA4000CE端子配置図 ............................................................................................................................... 5
図 1.5 RA8000CE端子配置図 ............................................................................................................................... 5
図 2.1 電源投入シーケンス..................................................................................................................................... 8
図 2.2 発振開始シーケンス................................................................................................................................... 10
図 2.3 状態遷移図 ............................................................................................................................................... 13
図 3.1 SPIデータフォーマット ................................................................................................................................ 15
図 3.2 SPIホストとRA4000CEの接続例 ............................................................................................................... 16
図 3.3 SPIデータライトアドレスデータ .................................................................................................................... 16
図 3.4 SPIレジスターライト.................................................................................................................................... 16
図 3.5 SPIデータリードアドレスデータ ................................................................................................................... 17
図 3.6 SPIレジスターリード ................................................................................................................................... 17
図 3.7 I2C-BusホストとRA8000CEの接続例 ......................................................................................................... 18
図 3.8 RA8000CEのI2C-Busスレーブアドレス ...................................................................................................... 18
図 3.9 I2C-Busを介したレジスターライト ................................................................................................................ 19
図 3.10 I2C-Busを介したレジスターリード .............................................................................................................. 19
図 3.11 時計/カレンダーカウンターの構成 ............................................................................................................. 20
図 3.12 SPIインターフェイス 計時/カレンダーカウンターアクセスタイミング ............................................................ 23
図 3.13 I2C-Busインターフェース 計時/カレンダーカウンターアクセスタイミング ..................................................... 23
図 3.14 オフセット処理タイミング ........................................................................................................................... 28
図 3.15 うるう秒挿入タイミング .............................................................................................................................. 29
図 3.16 時刻更新割り込み回路の構成 ................................................................................................................. 33
図 3.17 時刻更新割り込みタイミングチャート ......................................................................................................... 34
図 3.18 アラーム回路の構成 ................................................................................................................................ 35
図 3.19 アラーム割り込み回路の構成 ................................................................................................................... 37
図 3.20 アラーム割り込みタイミングチャート .......................................................................................................... 37
図 3.21 ウェイクアップタイマーの構成 ................................................................................................................... 38
図 3.22 ウェイクアップタイマーカウントアップ動作 .................................................................................................. 40
図 3.23 ウェイクアップタイマーカウントダウン動作 ................................................................................................. 41
図 3.24 ウェイクアップタイマーカウント開始タイミング ............................................................................................ 41
図 3.25 リセットウィンドウ設定時のタイマーリセットタイミング (非同期リセットタイミング) ........................................ 43
図 3.26 ウェイクアップタイマー割り込み回路の構成 .............................................................................................. 43
図 3.27 ウェイクアップタイマー割り込みタイミングチャート...................................................................................... 44
図 3.28 FOUT出力回路の構成 ............................................................................................................................ 45
図 3.29 FOE制御によるFOUT出力 ...................................................................................................................... 46
図 3.30 リセット出力タイミング............................................................................................................................... 47
図 3.31 タイムスタンプ回路の構成 ........................................................................................................................ 49
図 3.32 EVINnのノイズフィルター機能 .................................................................................................................. 50
図 3.33 タイムスタンプデータと読み出しアドレス.................................................................................................... 52
図 3.34 SRAMモード時のメモリーアクセス ............................................................................................................ 53
図 3.35 タイムスタンプキャプチャー動作 (オーバーライト禁止モード) .................................................................... 56
図 3.36 タイムスタンプキャプチャー動作 (オーバーライトモード)............................................................................ 57
図 3.37 コマンドトリガータイミング ......................................................................................................................... 59
図 3.38 タイムスタンプ割り込み回路の構成 .......................................................................................................... 62
図 5.1 温度補償回路動作と消費電流 ................................................................................................................. 100
図 5.2 /RST出力端子ありの場合の消費電流 ...................................................................................................... 100
図 5.3 自己監視電圧-フラグ・状態相関図 ........................................................................................................... 100
図 5.4 RA4000CE AC特性 (SPIタイミングチャート) ........................................................................................... 101
図 5.5 RA8000CE AC特性 (I2C-Busタイミングチャート) ..................................................................................... 102
図 5.6 電源投入シーケンス ............................................................................................................................... 103
RA4000CE/RA8000CE
ETM64J-02

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112

図表一覧
図 6.1 外形寸法図 ............................................................................................................................................. 105
図 6.2 マーキングレイアウト ................................................................................................................................ 105
図 7.1 はんだ耐熱性評価プロファイル (参考) ..................................................................................................... 107
図 9.1 一般的なMCUとの接続回路例 (RA4000CE Option A/B/C) .................................................................... 109
図 9.2 一般的なMCUとの接続回路例 (RA4000CE Option D/E)........................................................................ 109
図 9.3 一般的なMCUとの接続回路例 (RA8000CE Option A/B/C) .................................................................... 110
図 9.4 発振器 (32.768 kHz DTCXO) として使用 (RA8000CE Option D) ......................................................... 110
図 10.1 テープ寸法 ............................................................................................................................................ 111
図 10.2 リール寸法 ............................................................................................................................................ 111

表
表 1.1 製品ラインナップ .......................................................................................................................................... 1
表 1.2 特長 ............................................................................................................................................................ 1
表 1.3 端子説明 ..................................................................................................................................................... 6
表 2.1 電源端子一覧 .............................................................................................................................................. 8
表 3.1 RA4000CE Option A/B/C SPIインターフェイス端子 ................................................................................... 15
表 3.2 RA4000CE Option D/E SPIインターフェイス端子 ...................................................................................... 15
表 3.3 I2C-Busインターフェイス端子 ...................................................................................................................... 18
表 3.4 曜日の割り付け例 ...................................................................................................................................... 21
表 3.5 SUBSEC[9:0]ビット ................................................................................................................................... 27
表 3.6 オフセット値と補正量 .................................................................................................................................. 28
表 3.7 温度補償データの更新間隔 ....................................................................................................................... 30
表 3.8 DIG_TRIM_H/L.DTRIM[8:0]ビット設定値と補正量 .................................................................................... 32
表 3.9 時刻更新割り込みイベントの選択 ............................................................................................................... 33
表 3.10 ウェイクアップタイマーソースクロックの選択 .............................................................................................. 38
表 3.11 ウェイクアップタイマー割り込み周期 ......................................................................................................... 39
表 3.12 ノーマルモード/セーフモードにおけるウェイクアップタイマーのカウンターの動作条件設定 ......................... 39
表 3.13 ウェイクアップタイマーの動作制御 ............................................................................................................ 42
表 3.14 リセットウィンドウの設定 ........................................................................................................................... 43
表 3.15 FOUT出力の選択.................................................................................................................................... 45
表 3.16 EVINn端子のプルアップ/ダウン ............................................................................................................... 50
表 3.17 EVINn入力有効パルス幅 ........................................................................................................................ 51
表 3.18 EVINn入力検出エッジ ............................................................................................................................. 51
表 3.19 イベント検出割り込み要因と制御ビット ..................................................................................................... 62
表 3.20 SOUT端子から出力される内部ステータスフラグ ...................................................................................... 64
表 4.1 FOUT出力の選択...................................................................................................................................... 75
表 4.2 時刻更新割り込みイベントの選択 ............................................................................................................... 75
表 4.3 ウェイクアップタイマーソースクロックの選択 ................................................................................................ 75
表 4.4 温度センサー測定動作の実行間隔 ............................................................................................................ 77
表 4.5 SUBSEC[9:0]ビット ................................................................................................................................... 78
表 4.6 EVINn端子のプルアップ/ダウン ................................................................................................................. 84
表 4.7 EVINn入力検出エッジ極性 ........................................................................................................................ 84
表 4.8 EVINn端子の入力有効パルス幅................................................................................................................ 84
表 4.9 各製品のWTICFG.PINMUX[1:0]ビット初期値 ............................................................................................ 89
表 4.10 リセット出力オプションの選択 ................................................................................................................... 89
表 4.11 リセットウィンドウの設定 ........................................................................................................................... 90
表 4.12 SOUT出力の選択 ................................................................................................................................... 96
表 4.13 SOUT出力可能な内部ステータスフラグ ................................................................................................... 97
表 5.1 絶対最大定格 ............................................................................................................................................ 98
表 5.2 推奨動作条件 ............................................................................................................................................ 98
表 5.3 周波数特性 ............................................................................................................................................... 98
表 5.4 DC特性 ..................................................................................................................................................... 99
表 5.5 RA4000CE AC特性 ................................................................................................................................ 101
表 5.6 RA8000CE AC特性 ................................................................................................................................ 102
表 5.7 電源投入特性 .......................................................................................................................................... 103
表 5.8 リセット出力特性 ...................................................................................................................................... 104
RA4000CE/RA8000CE
ETM64J-02

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Seiko Epson Corporation113アプリケーションマニュアル
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