ETM30J-02

アプリケーションマニュアル
Real Time Clock Module

RX-8571SA

● 本マニュアルのご使用につきましては、次の点にご留意願います。
1）
2）
3）

4）
5）

6）

7）

本マニュアルの内容については、予告なく変更することがあります。量産設計の際は最新情報をご確認ください。
本マニュアルの一部、または全部を弊社に無断で転載、または、複製など他の目的に使用することは堅くお断りいたします。
本マニュアルに記載された応用回路、プログラム、使用方法等はあくまでも参考情報であり、これらに起因する第三者の権利（工業所有権を含む）侵害あるいは損害の発生に対し、弊社は如何なる保証を行うものではありません。
また、本カタログによって第三者または弊社の工業所有権の実施権の許諾を行うものではありません。
特性表の数値の大小は、数値線上の大小関係で表します。
輸出管理について(1) 製品および弊社が提供する技術を輸出等するにあたっては「外国為替および外国貿易法」を遵守し、当該法令の定める必要な手続をおとりください。
(2) 大量破壊兵器の開発等およびその他の軍事用途に使用する目的をもって製品および弊社が提供する技術を輸出等しないでください。また、これらに使用するおそれのある第三者に提供しないでください。
製品は一般電子機器に使用されることを意図し設計されたものです。
特別に高信頼性を必要とする以下の特定用途に使用する場合は、弊社の事前承諾を必ず得て下さい。
承諾無き場合は如何なる責任も負いかねることがあります。
1 宇宙機器（人工衛星・ロケット等）2 輸送車両並びにその制御機器（自動車・航空機・列車・船舶等）
3 生命維持を目的とした医療機器4 海底中継機器5 発電所制御機器6 防災・防犯装置7 交通用機器
8 その他；1 ～7 と同等の信頼性を必要とする用途
製品呼称、識別マークにつきましては順次統合していく予定ですが本マニュアルにおきましては統合前に両社が使用していた呼称、識別マークを継承しています。正式型番、識別マーク等詳細につきましては仕様書等でご確認いただけます様お願いいたします。
本マニュアルに記載されているブランド名または製品名は、それらの所有者の商標もしくは登録商標です。

RX − 8571 SA
目 次
1. 概 要 ...............................................................................................................................1
2. ブロック図 ...................................................................................................................... 1
3. 端子説明 ( 端子配置 / 端子機能 ) .................................................................................... 24. 外形寸法図 / マーキングレイアウト............................................................................... 3
5. 絶対最大定格.................................................................................................................. 4
6. 推奨動作条件.................................................................................................................. 47. 周波数特性 ...................................................................................................................... 48. 電気的特性 ..................................................................................................................... 5
9. 使用上の注意事項 ........................................................................................................... 7
9.1.通信途中でアクセス中断された時のデータについて ........................................................................7
9.2. 初期電源投入時およびバックアップ移行・復帰条件.......................................................................7
9.3. 電源初期投入時 および バックアップ復帰時における アクセス動作の制限 .................................810. 参考資料 ....................................................................................................................... 910.1. 参考データ .....................................................................................................................................910.2. 外部接続例 .....................................................................................................................................911. 取り扱い上の注意事項................................................................................................ 10
12. 機能概要 および レジスターテーブル........................................................................ 1112.1. 機能概要.......................................................................................................................................1112.2. レジスターテーブル.....................................................................................................................1212.3. レジスター概要............................................................................................................................13

13. 使用方法 ..................................................................................................................... 14
13.1. 時計カレンダー説明.....................................................................................................................1413.2. 定周期タイマー割り込み機能 ......................................................................................................15
13.3. アラーム割り込み機能 .................................................................................................................18
13.4. 時刻更新割り込み機能 .................................................................................................................20
13.5. 割り込み機能動作時の /IRQ " L " 割り込み出力に関して ............................................................21
13.6. 電圧低下検出機能 ........................................................................................................................21
13.7. FOUT 機能 ( クロック出力機能 ) ..............................................................................................22
13.8. フローチャート............................................................................................................................23
13.9. データの リード/ライト ..............................................................................................................27

RX − 8571 SA
低電圧計時保持シリアルインターフェース リアルタイムクロックモジュール

RX − 8571 SA• リアルタイムクロック：時計･カレンダー, 自動うるう年補正, 時刻更新割り込み, アラーム割り込み等の豊富な機能：128bit の RAM として利用できるユーザーレジスター内蔵：255μs ∼ 65535h までの割り込み出力機能付きプログラマブル･タイマー内蔵：OE 機能付き C-MOS 出力：I2C インターフェース：1.6 V ∼ 5.5 V：1.3 V ∼ 5.5 V：0.20 μA / 3 VTyp• ユーザーレジスター• タイマー割り込み• 32.768 kHz 出力• インターフェース方式• インターフェース電圧範囲• 計時 ( 保持 ) 電圧範囲
• バックアップ時消費電流

2

I C-Bus は､NXP Semiconductors の商標です。

1. 概 要本 IC は､I2C インターフェース方式のリアルタイムクロック IC です。
リアルタイムクロック部は、秒から年までの自動うるう年補正 Clock＆Calendar 回路, 時刻アラーム,
インターバルタイマー, 時刻更新割り込み, 32.768 kHz 出力, ユーザーレジスター 等の豊富な機能を備えています。
デバイスは C-MOS プロセスによる低消費電流となっておりますので､ 長期間におけるバッテリーバック
アップが必要とされる 各種携帯電話, ハンディターミナル, その他の小型電子機器等の用途に最適です。

2. ブロック図( 32.768 kHz )

XG

XD
OSC

FOE
FOUT

DIVIDER

CLOCK
andCALENDAR

FOUT
CONTROLLER

TIMER REGISTER/ IRQ

INTERRUPTSCONTROLLER
ALARM REGISTER
BAK-UP MODE

/BM

DAS
SDA
SCL

CONTROLREGISTERCONTROLLER

and
BUS

SYSTEMCONTROLLER

INTERFACECIRCUIT

USER REGISTER
8 Byte ( 128 bit )Page − 1

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RX − 8571 SA
3. 端子説明 ( 端子配置 / 端子機能 )3.1. 端子配置
RX − 8571 SA
1. G ND

14. FO UT

2. N.C.

13. N.C.

3. DAS

12. N.C.

4. SCL

11. N.C.

5. SDA

10. /IRQ

6. /BM

9. N.C.

7. FOE

8. V DD
SOP − 14pin

3.2. 端子機能
端子名

入出力

機

能

2

SDA

双方向

SCL

入力

DAS

入力

/BM

入力

FOUT

出力

I C 通信用データ入出力端子。SCL 信号に同期して､アドレス, データなどを入出力します。
この端子は出力時オープンドレインですので､信号線の容量により 適切なプルアップ
抵抗を接続してください。
VDD の印加電圧に関係なく 5.5V まで入力することが可能です。
I2C 通信用のシリアルクロック入力端子です。
VDD の印加電圧に関係なく 5.5V まで入力することが可能です。
デバイス･アドレス･セレクト入力端子です。
この端子は、I2C の 7bit 構成によるデバイスアドレスを選択します。
VDD の印加電圧に関係なく 5.5V まで入力することが可能です。
DAS pin"H"

0110010"L "1010001

バックアップモード切り替え端子です。
“L”にするとバックアップモードへ移行し、消費電流を最小限に抑えることができます。
その場合、FOUT出力が停止し、アクセスが無効になります。
VDDの印加電圧に関係なく5.5Vまで入力することが可能です。
FOUT 端子は､ 出力制御付きのクロック出力端子 ( C-MOS 出力 ) です。
FOE 入力端子, FSEL1 ビット, FSEL0 ビットの組み合わせにより､ FOUT 出力端子から
32.768 kHz, 1024 Hz, 1 Hz を選択出力する または 出力を停止させることができます。
出力停止時の FOUT 出力端子は ハイインピーダンスになります。
ただし、バックアップモード中(/BM=”L”)は、出力停止になります。
FOE 端子は、VDD の印加電圧に関係なく 5.5V まで入力することが可能です。
/BM pin
input

FOE

入力

スレーブアドレス

FOE pin
input

FSEL1
bit

FSEL0
bit

0

0

32768 Hz Output( C-MOS output )

"H"

0

1

1024 Hz Output( C-MOS output )10

1 Hz Output( C-MOS output )

"L"

Χ

Χ

OFF

( high impedance )

Χ

1

1

OFF

( high impedance )

Χ

Χ

Χ

OFF

( high impedance )

"H"

"L"

FOUT pin
output∗Χ : don't care

/IRQ

出力

アラーム, インターバルタイマー, 時刻更新などの割り込み信号 ( " L " レベル ) を出力します。
この端子は､ N-ch オープンドレイン出力です。
割り込み出力を使用しない場合は OPEN にしてください。

VDD－

電源のプラス側に接続します。

GND−

グランドに接続します。

N.C.

−

内部 IC と結線されていません。
OPEN もしくは､ GND または VDD と接続してください。

注) VDD − GND 間 直近に 0.1 μF 以上のパスコンを必ず接続してください。

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RX − 8571 SA
4. 外形寸法図 / マーキングレイアウト
4.1. 外形寸法図
RX − 8571 SA ( SOP − 14 pin )• 外形寸法図• 推奨はんだ付けパターン図

10.1 ± 0.2#140° - 10°

#8

1.4

5.0

7.4 ± 0.2

5.4

0.6
#1

#7

0.05
Min.

0.35

∗ 点線

1.27

1.4

0.15
1.27
0.7
1.27 × 6 = 7.62

3.2 ± 0.1

1.2

Unit : mm

内(表)の一部に 内蔵水晶振動子の金属ケースが見えることがありますが、デバイスの特性に 影響はありません。

4.2. マーキングレイアウト
RX − 8571 SA ( SOP − 14 pin )型式

R 8571E A123B
ロゴ

製造ロット∗ 表示内容は、捺印と表示の大略を示すもので、字形･大きさ および 位置の詳細を規定するものではありません。

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RX − 8571 SA
5. 絶対最大定格

GND = 0 V

項 目

記 号

条 件

定挌値

単 位

電源電圧

VDD

VDD − GND間

−0.3 ∼ +6.5

V

入力電圧

VIN

DAS, SCL, SDA, /BM , FOE 端子−0.3 ∼ +6.5V

出力電圧 1VOUT1FOUT 端子−0.3 ∼ VDD+0.3

V

出力電圧 2VOUT2SDA, /IRQ端子−0.3 ∼ +6.5

V

保存温度

TSTG

梱包状態を除く 単品での保存−55 ∼ +125

°C

6. 推奨動作条件

GND = 0 V

項 目

記 号

条 件

Min.

Typ.

Max.

単位

動作電源電圧

VACC

−

1.6

3.0

5.5

V

計時電源電圧

VCLK

−

VLOW

3.0

5.5

V

電源電圧低下検出電圧

VLOW

1.1

1.3

オフ時印加電圧

VPUP

SDA, /IRQ 端子

動作温度範囲TOPR

結露無きこと

−40

+25

5.5

V

+85

°C

∗ 計時電源電圧 VLOW の Min.値は､ 動作電源電圧 VACC にて初期設定した後での 計時保持下限値。

7. 周波数特性
項 目

記 号

出力周波数

fo

周波数偏差

Δf/f

周波数電圧特性f/V

周波数温度特性Top

発振開始時間

tSTA

エージング
∗1 )

※特記無き場合､ GND = 0 V , Ta = +25 °C , VDD = 3.0 V

fa

条 件

Min.

Typ.
32.768Max.
( Typ. )Unit
kHz

Ta = +25 °C
VDD = 3.0 V
Ta = +25 °C
VDD = 2.0 V ∼ 5.0 V
Ta = −20 °C ∼ +70 °C
VDD = 3.0 V ; +25 °C 基準
Ta = +25 °C
VDD = 1.6 V
Ta = −40 °C ∼ +85 °C
VDD = 1.6 V−2+2

× 10−6 / V

−120

+10

× 10−6

1.0

s

3.0

s

Ta = +25 °C , VDD = 3.0 V ; 初年度−5+5

× 10−6/ year5 ± 230.3(∗1)

× 10−6

月差 1 分相当。 ( オフセット値を除く )Page − 4

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RX − 8571 SA
8. 電気的特性
8.1. DC 電気的特性
8.1.1. DC 電気的特性 (1)※特記無き場合､ GND = 0 V , VDD = 1.6 V∼ 5.5 V , Ta = −40 °C ∼ +85 °C

項 目

記 号

条 件

消費電流(1)IDD1/BM=FOE=”L”, /IRQ = OFF
fSCL =0Hz, Ta = +25 °CMin.
VDD = 3 V

Typ.

Max.

200

400

単位

nA
消費電流(2)IDD2消費電流(3)IDD3消費電流(4)IDD4消費電流(5)IDD5消費電流(6)IDD6消費電流(7)IDD7消費電流(8)IDD8VDD = 5 V

600

VDD = 3 V

550

nA

VDD = 5 V

360

800
nA

VDD = 3 V

340

700

VDD = 5 V

1.6

3.3

6.5

V

VIH2

SCL, SDA 端子

0.8 × VDD

6.5

V

VIL

入力端子

GND − 0.3

0.2 × VDDV

VDD=5 V, IOH=−1 mA

4.5

5.0

VDD=3 V, IOH=−0.5 mA

2.7

3.0

VOH3

VDD=3 V, IOH=−100 μA

2.9

3.0

VOL1

VDD=5 V, IOL=1 mA

GND

GND+0.5

VDD=3 V, IOL=0.5 mA

GND

GND+0.3

VDD=3 V, IOL=100 μA

GND

GND+0.1

VDD=5 V, IOL=1 mA

GND

GND+0.25

VDD=3 V, IOL=1 mA

GND

GND+0.4

VDD ≥2 V, IOL=3 mA

GND

GND+0.4

V

VOH2

FOUT 端子

FOUT 端子VOL3
VOL4/IRQ 端子

VOL5

出力

420

0.8 × VDD

VOL2

入力

200

nA

/BM=H, FOE=”L”/IRQ = OFF
fSCL = 0 Hz
Ta = -40 °C to +85 °C

VOH1"L" 出力電圧

VDD = 3 V

FOE, DAS, /BM 端子

IDD10"H" 出力電圧

500

VIH1

消費電流(10)"L" 入力電圧

220

IDD11

IDD9

"H" 入力電圧/BM=FOE=”L”/IRQ = OFF
fSCL = 0 Hz
Ta = -40 °C to +85 °C

VDD = 5 V

/BM=FOE=”H”, /IRQ = OFF
fSCL = 0 Hz
FOUT : 32.768 kHz ON,
CL = 0 pF
Ta = -40 °C to +85 °C/BM=FOE=”H”, /IRQ = OFF
fSCL = 0 Hz
FOUT : 32.768 kHz ON,
CL = 15 pF
Ta = -40 °C to +85 °C

消費電流(9)消費電流(11)/BM=FOE=”L”/IRQ = OFF
fSCL = 0 Hz
Ta = ±0 °C to +50 °C

μA
VDD = 3 V

1.0

2.1

VDD = 5 V

4.0

7.0
μA

VDD = 3 V

2.5

4.0

V

V

V

VOL6

SDA 端子

ILK

入力端子, VIN = VDD or GND

−0.1

0.1

μA

IOZ

出力端子, VOUT = VDD or GND

−0.1

0.1

μA

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RX − 8571 SA
8.2. AC 電気的特性
7.2.1. AC 電気的特性(1)※特記無き場合､GND = 0 V , VDD = 1.6 V ∼ 5.5 V , Ta = −40 °C ∼ +85 °C

記号

100 kHz アクセス
( Standard-Mode )
Min.
Max.

400 kHz アクセス
( Fast-Mode )
Min.
Max.

単位

SCL クロック周波数

fSCL

100

400

kHz

開始条件 セットアップ時間

tSU;STA

開始条件 ホールド時間

tHD;STA

データ セットアップ時間

tSU;DAT

データ ホールド時間

tHD;DAT

停止条件 セットアップ時間
開始条件と停止条件の間のバスフリー時間

項目

0.6

μs

4.0

0.6

μs

250

100

ns

0

0

ns

tSU;STO

4.0

0.6

μs

tBUF

4.7

1.3

μs

SCL " L " 時間

tLOW

4.7

1.3

μs

SCL " H " 時間

tHIGH

4.0

0.6

4.7

μs

SCL, SDA 立ち上がり時間

tr

1.0

0.3

μs

SCL, SDA 立ち下がり時間

tf

0.3

0.3

μs

バス上の許容スパイク時間

tSP

50

50

ns

※特記無き場合､GND = 0 V , Ta = −40 °C ∼ +85 °C

7.2.2. AC 電気的特性(2)項目※特記無き場合､GND=0 V , VDD=1.6 V ∼ 5.5 V , Ta= −40 °C ∼ +85 °C

FOUT デューティ

記号

条件

Min.

Typ.

Max.

単位

Duty

50% VDD レベル

40

50

60

%

• タイミングチャート

ProtocolSTART
CONDITION(S)tSU ; STA

BIT 7
MSB
(A7)

tLOW

BIT 6

BIT 0
LSB
(R/W)

(A6)

tHIGH

ACK
(A)

STOP
CONDITION(P)

1 / fSCLSTARTCONDITION(S)tSU ; STA

SCL
(S)

(P)

(S)

tBUF
tr

tf

SDA
(A)

tHD ; STA

注意：

tSU ; DATtHD ; DATtSPtSU ; STO

tHD ; STA

本デバイスへのアクセスは､START コンディションの送信からアクセス終了後の STOP コンディション送信までの一連の通信を 0.95 秒以内に終了してください。
2
1 秒以上の時間がかかった場合は､内部の監視タイマーにより I C バスインターフェースがリセットされます。

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9. 使用上の注意事項
9.1.通信途中でアクセス中断された時のデータについて(1 ) アクノリッジ信号の送信中、及び確認中 以外でのタイミング（ 下記図 (1),(2) ）で、アクセス中断があった場合は、その直前のアクノリッジ信号を送出、確認したデータまでは有効となります。
(2) アクノリッジ信号の送信中、及び確認中 でのタイミング（ 下記図 (3),(4) ）で、アクセス中断があった場合は、その前のアクノリッジ信号を送出、確認したデータまでは有効となります。

（１）のタイミングで通信中断があった
場合のデータ有効範囲（２）のタイミングで通信中断があった
場合のデータ有効範囲（３）のタイミングで通信中断があった
場合のデータ有効範囲

S

スレーブアドレス

0

（３）

（４）

アドレス

0

（２）

（１）

（４）のタイミングで通信中断があった
場合のデータ有効範囲

0S

スレーブアドレス

R/W

1

0

データ

0

データ

1

P

R/W
アクノリッジ ( from 8571 )アクノリッジ ( from CPU )9.2. 初期電源投入時およびバックアップ移行・復帰条件

VDD

VCLK

0V

t R1

項目

tF

記号

t R2

条

件

Min.

Typ.

Max.

単位

電源降下時間tF−

2

μs / V

電源立上時間tR1−

1μs / V

計時保持電源立上時間

t R2

−

1

μs / V

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RX − 8571 SA
9.3. 電源初期投入時 および バックアップ復帰時における アクセス動作の制限• RTC レジスター ( Reg - 01[h] ∼ 0F[h] )の動作の多くは内蔵水晶振動子の発振クロックに連動していますので､[ 内部発振が無い状態 = 発振停止状態 ] では､ 正しい動作ができません。
そのため､ 電源初期投入時 および バックアップ復帰異常時 ( 電圧低下などが原因で､ 発振が停止していた状態
からの電源電圧復帰時 ) の初期設定は､ [ 内部発振が 開始してから → 発振開始時間 ( tSTA 規定参照 ) 経過以降 ]に行うことを推奨しています。
• 電源初期投入時 および バックアップ状態からの電源電圧復帰時 ( 以降､ [ 動作電圧移行時 ] とする ) の アクセス
動作は､ 次の点に注意してください。
1) 動作電圧移行時は､ 最初に VLF-bit ( レジスターの異常状態を示すビット ) を読み出してください。
2) VLF-bit の読み出し結果が VLF = " 1 ( 異常状態 ) " のときは､ 初期設定が必要です。
VLF = " 1 " のときの初期設定は､ 内部発振が安定してから ( = 発振開始時間 ( tSTA 規定参照 ) 経過以降に ) 行う
ことを推奨しています。
VLF-bit を " 1 " として読み出したときの状態は次のとおりで､ いずれの場合も初期設定が必要です。
状態 1) 電源初期投入時
状態 2) バックアップ中の電圧低下等により､ 計時内容が有効ではないとき∗ 電源初期投入時 および 計時保持電圧以下から電源電圧復帰したときのアクセス可能タイミング

発振開始電圧 [ V ]VDD

計時保持下限電圧 VCLK ( Min. ) [ V ]電源初期投入 および計時保持電圧以下からの電源復帰

内部発振 ( イメージ )tSTA [ s ]発振開始時間( 内部発振待ち時間 )• 通常アクセス可能• 通常動作可能

30 [ ms ]注 ) 30 [ ms ] 経過後に アクセスが可能になります。
但し､アクセス保証範囲は、アドレス 07h、10h∼1Fhの RAM エリアです

3) VLF-bit の読み出し結果が VLF = " 0 ( 正常状態 ) " のときのみ､ 発振開始時間を待たずに アクセス可能です。
VLF-bit を " 0 " として読み出したときの状態は次のとおりで､通常動作が可能です。
状態 1) 正しい動作が可能なとき ( 使用時の誤設定時は除く )状態 2) バックアップ状態からの動作電圧移行時､ 正常にデータ保持されていたとき

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RX − 8571 SA
10. 参考資料
10.1. 参考データ[ 周波数安定度の求め方 ]周波数温度特性例× 10-6

θT = +25 °C Typ.
-6
Typ.
α = -0.035 × 10

1. 周波数温度特性は､以下の式で近似できます。
ΔfT = α ( θT − θX ) 2

Frequency ΔfT

0

y ΔfT
y α [ 1 / °C2 ]-50

y θT [ °C ]y θX [ °C ]

-100

-150
-50

0

50

：任意の温度における周波数偏差：2 次温度係数( −0.035 ± 0.005 ) × 10−6 / °C2：頂点温度 ( +25 ± 5 °C )：任意の温度

2. 時計精度を求めるためには､
更に周波数精度と電圧特性を加えます。

100

Temperature [°C]Δf/f = Δf/fo + ΔfT + ΔfV
y Δf/f：任意の温度,電圧における時計精度 ( 周波数安定度 )：周波数精度：任意の温度における周波数偏差：任意の電圧における周波数偏差y Δf/fo
y ΔfT
y ΔfV
3. 日差の求め方

日差 = Δf/f × 86400[秒]∗ たとえば､ Δf/f = 11.574 × 10−6 で
約 1 秒/日 の誤差になります。

10.2. 外部接続例
VDD

D1: Schottky Barrier
Diode

SCL

Note

2

I C-BUS
Master
VDD

SDA
VDD
SCL
/BM

RX-8571
SLAVE ADRS = 1010001

DAS

VDD
SDA

GND

Pull up Registor

R=

tr
C BUS

SCL SDA2( I C Bus )Page − 9

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RX − 8571 SA
11. 取り扱い上の注意事項
1) 取り扱い上の注意事項□ 本モジュールは 水晶振動子を内蔵していますので､ 過大な衝撃･振動を与えないようにしてください。
また､ 低消費電力実現のために C-MOS IC を用いておりますので､ 以下に注意して 使用してください。
(1) 静電気
耐静電気破壊保護回路は内蔵しておりますが､ 過大な静電気が加わると IC が破壊されるおそれがありますので､ 梱包 および運搬容器には 導電性の物を使用してください。
はんだごてや測定回路などは 高電圧リークの無いものを使用し､ また､ 実装時･作業時にも静電気対策をお願いいたします。
(2) ノイズ
電源 および 入出力端子に過大な外来ノイズが印加されますと､ 誤動作やラッチアップ現象等による 破壊の原因となることがあります。
安定動作のため､ 本モジュールの電源端子 ( VDD − GND 間 ) の 極力近い場所に､ 0.1 μF 以上のパスコン(セラミックを推奨)を使用してください。 また､ 本モジュールの近くには､ 高ノイズを発生するデバイスを 配置しないようにしてください。
※図1の() 部の部品面は、信号線を接近させず､ 可能であれば GND パターンで埋めてください。
※図1の() 部の部品面は、いかなるパターンも レイアウトしないでください。
(3) 入力端子の電位入力端子が中間レベルの電位になることは､ 消費電力の増加, ノイズマージンの減少, 素子の破壊等につながりますので､ できるだけ VDD または GND の電位に近い電位に 設定してください。
(4) 未使用入力端子の処理
入力端子の入力インピーダンスは非常に高く､ 開放状態での使用は 不定電位やノイズによる誤動作の原因につながります。
未使用の入力端子は､ プルアップ または プルダウン抵抗による処理を 必ず施してください。

2) 実装上の注意事項(1) はんだ付け温度
パッケージ内部が +260 °C を越えますと､ 水晶振動子の特性劣化 および 破壊を招く場合がありますので､ 弊社はんだ耐熱性
評価プロファイルを越えない領域でのご使用を推奨します。ご実装前に 必ず実装条件 ( 温度・時間 )をご確認ください。また、
条件変更時も同様の確認をしていただいた後にご使用ください。
※ 図 2 に､ 弊社 はんだ耐熱性評価プロファイルを 参考掲載します。
(2) 実装機
汎用実装機の使用が可能ですが､ 使用機器, 条件等によっては 実装時の衝撃力により内蔵の水晶振動子の破壊を招く場合がありますので､ご使用の前には 必ず貴社にてご確認ください。 条件変更時も同様の確認をしていただいた後にご使用ください。
実装時･作業時には､静電気対策をお願いいたします。
(3) 超音波洗浄
超音波洗浄は､ 使用条件によっては内蔵の水晶振動子が共振破壊される場合があります。 貴社での使用条件 ( 洗浄機の種類,
パワー, 時間, 槽内の状態等 ) を弊社にて特定できませんので､ 超音波洗浄の保証は いたしかねます。
(4) 実装方向
逆向きに実装しますと破壊の原因となります。 方向を確認した上で実装を行なってください。
(5) 端子間リーク
製品が汚れていたり結露している状態などで電源投入しますと 端子間リークを招く場合がありますので､ 洗浄し さらに乾燥させた後に電源投入を行なってください。

図 1：GND パターン例
RX − 8571 SA( SOP − 14pin )

図 2：弊社 はんだ耐熱性評価プロファイル ( 参考 )Temperature [ °C ]300

TP; +260 °C+255 °C

250
200
150
※網掛部分()には信号線を接近させず､ 可能であれば GND パター
ンで埋めてください。

TL; +217 °C
Ts max ; +200 °C
Ts min ; +150 °C

Avg. Ramp-up+3 °C / s Max.

tp ; 20 s to 40 s
tL
60 s to 150 s−6 °C / s Max.

( +217 °C over )ts
60 s to 180 s( +150 °C to +200 °C )100
50Time +25 °C to Peak0

60

120 180 240 300 360 420 480 540 600 660 720 780
Time [ s ]Page − 10

ETM30J-02

RX − 8571 SA
12. 機能概要 および レジスターテーブル
12.1. 機能概要
時計機能のみ使用される場合や、初期設定、各種機能の設定方法など、例を「項 13.8. フローチャート」に示してありますのでご参照ください。
1) 時計機能
西暦の下二桁の年･月･日, 曜, 時･分･秒までのデータの設定 / 計時 / 読み出しが可能です。
西暦の下二桁が 4 の倍数のときは自動的にうるう年と認識し､2099 年までを自動判別します。
通信開始時に､ 時刻データは固定され(桁上げホールド)、通信終了時に自動で時刻補正されます。
2) 定周期タイマー割り込み機能
244.14 μs ∼ 65535 h までの任意の周期にて定期的な割り込みイベントを発生させる機能です。
割り込みイベント発生時には TF ビット = " 1 " かつ /IRQ 端子 = " L " になるなど､ イベントの発生を知ることができます。
3) 長時間タイマー機能
定周期タイマー割り込み機能を、約 7.5 年まで対応可能な積算タイマーとしても利用することができます。
4) アラーム割り込み機能[日], [曜], [時], [分]などに対する割り込みイベントを発生させる機能です。
割り込みイベント発生時には AF ビット = " 1 " かつ /IRQ 端子 = " L " になるなど､ イベントの発生を知ることができます。
5) 時刻更新割り込み機能
1 秒毎または 1 分毎に内部計時に連動したタイミングで割り込みイベントを発生させる機能です。
6) 電圧低下検出機能
電源電圧の低下を検出する機能です。
初期電源投入時、電源電圧の低下などによって計時内容が有効かを判定することができます。
7) FOUT 機能 ( クロック出力機能 )FOUT 出力端子から､ 32.768 kHz などのクロック出力 ( C-MOS 出力 ) を得ることができます。
8) ユーザーRAM
任意データの Read/Writ が可能な RAM レジスターを内蔵しております。
最大で 176bit まで拡張可能です。
9) ブロック図( 32.768 kHz )

OSC

FOE
FOUT

DIVIDER

CLOCK
andCALENDAR

FOUT
CONTROLLER

TIMER REGISTER/ IRQ

INTERRUPTSCONTROLLER
ALARM REGISTER
BAK-UP MODE

/BM

DAS
SDA
SCL

CONTROLREGISTERCONTROLLER

and
BUS

SYSTEMCONTROLLER

INTERFACECIRCUIT

USER REGISTER
8 Byte ( 128 bit )Page − 11

ETM30J-02

RX − 8571 SA
12.2. レジスターテーブル
Address [h]Function

bit 7

bit 6

bit 5

bit 4

bit 3

bit 2

bit 1

bit 0

00

SEC

{

40

20

10

8

4

2

1

∗2

01

MIN

{

40

20

10

8

4

2

1

∗2

02

HOUR

{

{

20

10

8

4

2

1

∗2

03

WEEK

{

6

5

4

3

2

1

0

∗2

04

DAY

{

{

20

10

8

4

2

1

∗2

05

MONTH

{

{

{

10

8

4

2

1

∗2

06

YEAR

80

40

20

10

8

4

2

1

07

RAM

•

•

•

•

•

•

•

•

08

MIN Alarm

AE

40

20

10

8

4

2

1

09

HOUR Alarm

AE

•

20

10

8

4

2

1

6

5

4

3

2

1

0

•

20

10

8

4

2

1

64

32

16

8

4

2

1

1024

512

256

0A

WEEK AlarmAE

DAY Alarmnote∗3, ∗4∗3∗30B

Timer Counter 0

128

0C

Timer Counter 1

32768 16384

8192

4096

2048

0D

Extension Register

FSEL1 FSEL0 USELTEWADA TSEL2 TSEL1 TSEL0

0E

Flag Register

UF

TF

AF

TEST3

VLF

{

∗1, ∗20F

Control Register

{

{

UIE

TIE

AIE

TSTP STOP{∗2

Address [h]Function

bit 7

bit 6

bit 5

bit 4

bit 3

bit 2

TEST1 TEST2

bit 1

bit 0

Note

10
|

RAM

User Register
128 bit ( 16 word x 8 bit )∗3, ∗4, ∗5

1F

注)

0V からの初期電源投入時、および VLF ビット読み出し時の結果が VLF="1"のときは､ 必ずレジスターの初期化を行ってから使用してください。
その際､ 日付･時間として正しくないデータの設定はしないでください。 その場合の計時動作は保証できません。

∗1.

TEST1∼TEST3 までの 3 つの TEST ビットは弊社テスト用ビットです。
∗ 初期化の際に必ず” 0 ”に設定し、以降、必ず " 0 " にて使用してください。

∗2.

' { ' マークは､初期設定以降 " 0 " にてご使用ください。
∗ ” 1 ”を書き込むことはできません。 読み出し時は常時 " 0 " が 読み出せます。

∗3.

' • ' マークは､ 任意データを Write / Read することができる RAM bit です。

∗4.

Address 07[h] および User Register は 0V からの初期電源投入時 VDD 電圧が動作電圧範囲に到達後 30ms 以降
Read / Write が可能になります。

∗5.

User Register は、任意データを Write / Read することができます。

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RX − 8571 SA
12.3. レジスター概要
12.3.1. 計時･カレンダーレジスター ( Reg - 00[h] ∼ 06[h] )秒∼ 年までを計時するカウンターレジスターです。
∗ 詳細は [ 項 13.1. 時計カレンダー説明 ] を参照してください。

12.3.2. RAM レジスター ( Reg - 07[h] ) および ( Reg - 10[h] ∼ 1F[h] )00 h ∼ FF h までの任意データを Write / Read することができる RAM レジスターです。
0 V からの初期電源投入時 VDD 電圧が動作電圧範囲に到達後 30ms 以降 R/W が可能です。
12.3.3. アラームレジスター ( Reg - 08[h] ∼ 0A[h] )アラーム割り込み機能を使用して [日], [曜], [時], [分] などに対する割り込みイベントを得たいときに､
AIE, AF ビット および WADA ビットと共に設定し使用します。
当機能を使用しない場合は、AIE = ”0”とすることでデータの内容は任意です。
∗ 詳細は [ 項 13.3. アラーム割り込み機能 ] を参照してください。

12.3.4. 定周期タイマー用ダウンカウンター ( Reg - 0B[h] ∼ 0C[h] )定周期タイマー割り込み機能の､カウントダウン初期値 ( プリセット値 ) を設定するレジスターです。
当機能を使用するには､ TE, TF, TIE, TSEL1, TSEL0 ビットと共に使用します。
当機能を使用しない場合は、TIE = TE= ”0”とすることでデータの内容は任意です。
∗ 詳細は [ 項 13.2. 定周期タイマー割り込み機能 ] を参照してください。

12.3.5. 機能関連レジスター( Reg - 0D[h] ∼ 0F[h] )Address [h]Function

bit 7

bit 6

bit 5

bit 4

bit 3

bit 2

bit 1

bit 0

0D

Extension Register

FSEL1

FSEL0

USEL

TE

WADA

TSEL2

TSEL1

TSEL0

0E

Flag Register

TEST1

TEST2

UF

TF

AF

TEST3

VLF

{

0F

Control Register

{

{

UIE

TIE

AIE

TSTP

STOP

{

1) FSEL1, FSEL0 ビット
FOUT 機能を使用するときに､ FOUT 出力端子の出力周波数、ON/OFF を設定するビットです。
FOUT 機能 を使用しない場合の設定例（FOE 端子を”L”固定, FESL1,FSEL0 は”0”）∗ 詳細は [ 項 13.7. FOUT 機能 ( クロック出力機能 ) ] を参照してください。

2) USEL , UF, UIE ビット
時刻更新割り込み機能の動作を制御するビットです。
当機能を使用しない場合の設定例 (USEL , UIE は “0”, UF は不問)
∗ 詳細は [ 項 13.4. 時刻更新割り込み機能 ] を参照してください。

3) TE, TF, TIE, TSEL2, TSEL1, TSEL0, TSTP ビット
定周期タイマー割り込み機能の動作を制御するビットです。
当機能を使用しない場合の設定例 (TE,TIE,TSTP, TSEL1,TSEL0 は=“0”, TSEL2 は”1”, TF は不問)
4) WADA, AF, AIE ビット
アラーム割り込み機能の動作を制御するビットです。
当機能を使用しない場合の設定例 (WADA,AIE は=“0”, AF は不問)
5) TEST ビット
弊社テスト用のビットです。初期化の際に必ず” 0 ”に設定し、以降、 " 0 " にて使用してください。
6) VLF ビット
本製品の状態を検出して､ 結果を保持するフラグビットです。
初期電源投入時、電源電圧の低下などによって計時内容が有効でないとき､ " 0 " → " 1 " に変化します。
∗ 詳細は [ 項 13.6. 電圧低下検出機能 ] を参照してください。

7) STOP ビット
計時動作を停止させるためのビットです。STOP ビットが " 1 " の場合は機能動作が以下のようになります。
∗ 停止 1) 年,月,日,曜,時,分,秒 の更新が停止• 計時,カレンダー動作の更新が全て停止します。
それに伴い､アラーム割り込み, 時刻更新割り込みイベントが発生しなくなります。
∗ 停止 2) 定周期タイマー割り込み機能の一部が停止• 定周期タイマーのソースクロック設定が 64 Hz, 1 Hz, 1min, 1h のときは､カウントが停止します。( ソースクロック設定が 4096 Hz 時のみ､ 動作可能 )∗ 停止 3) FOUT は､ 選択周波数によっては 出力が停止します。
• 32.768kHz、1024Hz を選択出力しているときは、継続出力します。
• 1Hz を選択出力しているときは、FOUT 出力が停止します。

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RX − 8571 SA
13. 使用方法
13.1. 時計カレンダー説明
通信開始時に､ 時刻データは固定され(桁上げホールド)、通信終了時に自動で時刻補正されますので時計カレンダーにアクセスする場合は、オートインクリメント機能を利用した連続アクセスを行うことを2
推奨します。「詳細は 13.8.7. I C−BUS プロトコル」
現在時刻を読み出す時は、STOP ビットは使用しない(STOP=“0”)でください。
設定／表示例：88 年 2 月 29 日(日曜日)17 時 39 分 45 秒(うるう年)
Function
bit 7
bit 6
bit 5
bit 4
Address [h]

bit 3

bit 2

bit 1

bit 0

00
01

SEC
MIN

0
0

1
0

0
1

0
1

0
1

1
0

0
0

1
1

02

HOUR

0

0

0

1

0

1

1

1

03

WEEK

0

0

0

0

0

0

0

1

04

DAY

0

0

1

0

1

0

0

1

05

MONTH

0

0

0

0

0

0

1

0

06

YEAR

1

0

0

0

1

0

0

0

∗ 存在しない時刻データが書き込まれた場合は 正常な動作ができない原因になります。
∗ 時刻設定時に STOP ビットを併用すると任意のタイミングで計時スタートできます。「13.8. フローチャート」
13.1.1. 時計カウンター ( Reg - 00[h] ∼ 02[h] )1) [ SEC ] [ MIN ] レジスター
00∼59 までの 60 進 BCD カウンターです。下位レジスターからの桁上げタイミングでインクリメントされ､59→00 のタイミングで上位レジスターに桁上げが発生します。
∗ [SEC]レジスターに書き込みを行うと､ 1 秒未満の内部カウンター ( 512Hz ∼ 1 Hz ) が 0 リセットされます。
2) [ HOUR ] レジスター
24 進 BCD カウンター(24 時間制)です。下位レジスターからの桁上げでインクリメントされます。
13.1.2. 曜日カウンター ( Reg - 03[h] )• [ 曜 ( 曜日 ) ] を bit 0 ∼ bit 6 までの 7 ビットにて示します。
01h 曜 → 02h 曜 → 04h 曜 → 08h 曜 → 10h 曜 → 20h 曜 → 40h 曜 ( → 01h 曜 → 02h 曜 ∼ ) の順に更新します。
このレジスターは上位のレジスターへ桁上げ動作はしません。 また､年･月･日と連動していませんので､これらのレジスターを変更した場合は､対応した曜データをセットする必要があります。
• 曜日と値は次のように対応しています。
曜日

bit 7

bit 6

bit 5

bit 4

bit 3

bit 2

bit 1

bit 0

Data [h]

0
0
0
0
0
0
0
日
0
0
0
0
0
0
月
1
0
0
0
0
0
0
火
1
0
0
0
0
0
0
水
1
0
0
0
0
0
0
木
1
0
0
0
0
0
0
金
1
0
0
0
0
0
0
土
1
∗ 複数の曜日を " 1 " に設定するなど上記以外の設定はしないでください。

1
0
0
0
0
0
0

01 h
02 h
04 h
08 h
10 h
20 h
40 h

13.1.3. カレンダーカウンター ( Reg - 04[h] ∼ 06[h] )1) [ DAY ], [ MONTH ] レジスター[ DAY ] レジスターは､月･うるう年に連動した可変型の[日]を表す 28 ∼ 31 進 BCD カウンターで、[MONTH]レジス
ターは、12 進の[月]を表す BCD カウンターです。下位レジスターからの桁上げでインクリメントされます。

日

通常年
うるう年

1月

2月

3月

4月

5月

6月

7月

8月

9月

10 月

11 月

12 月

31

28
29

31

30

31

30

31

31

30

31

30

31

2) [ YEAR ] レジスター• 00∼99 年までの BCD カウンターです。下位レジスターからの桁上げでインクリメントされます。
• 2001 年 ∼ 2099 年までを自動でうるう年判定し[DAY[レジスターに反映させます。

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RX − 8571 SA
13.2. 定周期タイマー割り込み機能
244.14 μs ∼ 65535 h までの任意の周期で定期的な割り込みイベントを発生させる機能です。
一時停止することが可能で積算タイマーとしても利用できます。
∗ 割り込みイベント発生時の /IRQ " L " 出力は､ 7.813 ms ( Max. ) で自動解除 されます。
13.2.2. 定周期タイマー割り込み機能 関連レジスター
Address [h]Function

bit 7

bit 6

bit 5

bit 4

bit 3

bit 2

bit 1

bit 0

0B
0C

Timer Counter 0
Timer Counter 1

128
32768

64
16384

32
8192

16
4096

8
2048

4
1024

2
512

1
256

0D

Extension Register

FSEL1

FSEL0

USEL

TE

WADA

TSEL2

TSEL1

TSEL0

0E

Flag Register

TEST1

TEST2

UF

TF

AF

TEST3

VLF

{

0F

Control Register

{

{

UIE

TIE

AIE

TSTP

STOP

{

∗ 動作設定は､TE ビットを " 0 " クリアしてから始めてください。
∗ 機能を使用しないときは､Reg - B, C [ h ] を RAM ジスターとして使用できます。 その場合は TE, TIE = " 0 " に設定して機能を停止させてください。
1) 定周期タイマー用ダウンカウンター ( Reg - 0B[h] ∼ 0C[h] )・プリセッタブル･ダウンカウンターの初期値 ( プリセット値 ) を設定するレジスターで､ カウント値は
1 ∼ 65535 までの任意の値を設定できます。
∗ プリセット値の書き込みは､必ず TE ビットが " 0 " の状態で行ってください。
・本レジスターを読み出すとき､TE ビットが " 0 " のときは カウントダウン初期値(プリセット値)が読み出せます。
TE ビットが " 1 " のときは カウントダウン中のカウント値が読み出せます。
( 但し､ 読み出されるデータはホールドされていませんので ( データ変化中の場合がありますので ) ､ 正しいデータを得るためには 2 度読み比較などをしてください。)
2) TSEL2, TSEL1, TESL0 ビット
カウントダウン周期 ( ソースクロック ) を選択するビットです。
∗ ソースクロックの設定は､必ず TE ビットを一旦 " 0 " にしてから行ってください。
TSEL2 TSEL1 TSEL0( bit 2 ) ( bit 1 ) ( bit 0 )ソース クロック自動復帰時間(tRTN)STOP ビットの影響
−

0

0

0

4096 Hz／ 244.14 μs 周期

122 μs

0

0

1

64 Hz

／ 15.625 ms 周期

7.813 ms

0

1

0

1 Hz

／ 1 秒周期7.813 ms

0

1

1

1/60 Hz／ 1 分周期7.813 ms1001/3600 Hz／ 1 時間周期

7.813 ms

∗ STOP ビットが " 1 " のときは動作しません∗1) /IRQ 端子の自動復帰時間 tRTN は､ソースクロックによって上記の様に異なります。
∗2) 初回のカウントダウンは、選択したソースクロックより短い時間になります。
例えば ソースクロック 1 / 3600 Hz を選択した時､ 内部計時の[時]更新に 連動しているため、
時計レジスターが 50 分の時点でタイマー動作を開始した場合に､ 10 分後に 1 回目のカウントダウンが発生します。( 2 回目以降は正しい 1 時間周期で行われます )初回カウントダウンの誤差：プリセット値を”0004h” に設定した場合
TE
内部ソースクロック
初回周期誤差ダウンカウンター

4

正しい周期

3

2

TF

1

4
TF フ ラグ”0”

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RX − 8571 SA
3) TE ビット ( Timer Enable )定周期タイマー割り込み機能の動作を 開始させるためのビットです。
データ

TE

内 容

0

定周期タイマー割り込み機能を停止∗ /IRQ 出力は､ 直ちに解除されます(Hi-z になります )。

1

定周期タイマー割り込み機能が動作を開始∗ カウントダウンのスタート値は､ 常にプリセット値より開始します。

Write4) TF ビット ( Timer Flag )定周期タイマー割り込みイベントを検出して､ 結果を保持するフラグビットです。
データ

TF

内 容

0

/IRQ が”L”出力中の場合は解除されます。( Hi-z になります )1" 1 " は 書き込めません。

0

−

1

定周期タイマー割り込みイベント発生の検出あり∗ 結果は､ 0 クリアするまで保持されます。

Write

Read

5) TIE ビット ( Timer Interrupt Enable )定周期タイマー割り込みイベント発生時 ( TF, " 0 " → " 1 " ) の､ /IRQ 割り込み信号の動作を設定します。
データ

TIE

内 容

0

1 ) 割り込み信号は出力しない ( /IRQ = Hi-z 継続 )2 ) 割り込み信号を解除 ( /IRQ､ " L " → Hi-z ) する。

1

割り込み信号を出力する。 ( /IRQ = Hi-z → " L " )Write

6) TSTP ビット ( Timer Stop )ダウンカウンターを一時停止させるためのビットです。
計時カウンターと同期しているため、ソースクロックより短い期間での停止は、反映されない場合があります。
∗ 例えば ソースクロック 1 / 3600 Hz 選択し、計時カウンターの 3 時 5 分 ∼ 3 時 55 分までカウントダウ
ンを一時停止した場合でも、一時停止を行わなかった場合と同じ 5 分後の 4 時 0 分にカウントダウンが発生します。
データ

TSTP

内 容

0

ダウンカウンターを開始 ( 停止を解除 ) します。
∗ カウントダウンの再開値は、停止値から開始します。

1

ダウンカウンターを停止させます。
∗ /IRQ 出力は変化しません。
∗割り込み発生中に一時停止しても、規定時間で自動復帰します。

Write

13.2.3. タイマー スタートタイミング
カウントダウンが始まるタイミングは､ Address 0D の TE bit に " 0 " → " 1 " への書き込み終了時

SCLの立ち上がりエッジ(ACK出力時)から開始します。
Address D

SCL 端子SDA 端子TE

WADA TSEL2 TSEL1 TSEL0 ACK

内部タイマー/ IRQ 端子タイマー動作

Page − 16

ETM30J-02

RX − 8571 SA
13.2.4. 定周期タイマー割り込み周期
ソースクロック設定 と ダウンカウンター設定 の組み合わせによる割り込み周期の例を示します。
ソースクロック

Timer Counter
設定値

4096 Hz

64 Hz

TSEL2 = 0
TSEL1, 0 = 0, 0

TSEL2 = 0
TSEL1, 0 = 0, 1

1 Hz
( 1 秒桁 更新時 )TSEL2 = 0
TSEL1, 0 = 1, 0

0

−

1

244.14 μs−
15.625 ms

−
1s

−
1 min

1h

2

488.28 μs

31.250 ms

2s

2 min

2h

•
•

•
•

•
•

•
•

1 ∼ 65535

•
•

•
•

1 / 60 Hz
1 / 3600 Hz( 1 分桁 更新時 ) ( 1 時間桁 更新時 )TSEL2 = 0
TSEL2 = 1
TSEL1, 0 = 1, 1
TSEL1, 0 = 0, 0－41

10.010 ms

640.63 ms

41 s

41 min41 h

12831.250 ms

2.000 s128 s

128 min

128 h

320

78.125 ms

5.000 s

320 s

320 min

320 h

410

100.10 ms

6.406 s410 s

410 min

410 h

•
•

•
•

3840

•
•

0.9375 s••

60.000 s

•
•

4096
65535

15.9998 s••

4096 min••1023.984 s

3840 h••4096 s••••3840 min••64.000 s••••

3840 s••1.0000 s••••

4096 h••65535 s••65535 min

65535 h13.2.5. 定周期タイマー割り込み機能図
定周期タイマ 動作開始

定周期タイマ 動作停止

"1"

TE bit(7)

定周期タイマ 動作中

"0"

(9)

"1"

TIE bit"0"/ IRQ 出力
tRTN

tRTN

∗ TF bit を" 0 " クリアす
ると、tRTN を
を待たずに/IRQ は解除する

tRTN∗ TIE や TE bit を" 0 " クリアす
ると、tRTN を
を待たずに/IRQ は解除する

Hi - z
"L"
tRTN

"1"

TF bit"0"periodperiodperiodperiodイベント
発生
RTC の内部動作
Write 動作∗ ダウンカウンターが 0001h → 0000h になり、割り込みイベントが発生した後は､プリセット値を自動的に再ロードし､ 再びプリセット値よりカウントダウンを開始します。( 繰り返し動作 )∗ TE, " 0 " → " 1 " により、定周期タイマー割り込み機能が動作を開始します。
カウントダウンは､ TE, " 0 " → " 1 " に限り必ずカウンタプリセット値から開始します。

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13.3. アラーム割り込み機能[日], [曜], [時], [分]などに対する割り込みイベントを発生させる機能です。
割り込みイベント発生時には AF ビット = " 1 " かつ /IRQ 端子 = " L " になるなど､ イベントの発生を知ることができます。
∗ 割り込みイベント発生時の /IRQ " L " 出力は､ 意図的な解除を行わない限り自動解除されず､ /IRQ " L " が保持されます。

13.3.1. アラーム割り込み機能 関連レジスター
Address [h]Function

bit 7

bit 6

bit 5

bit 4

bit 3

bit 2

bit 1

bit 0

08
09

MIN Alarm
HOUR Alarm

AE

40
•

20
20

10
10

8
8

4
4

2
2

1
1

6

5

4

3

2

1

0

•

20

10

8

4

2

1

AE

WEEK Alarm

0A

AE

DAY Alarm

0D

Extension Register

FSEL1

FSEL0

USEL

TE

WADA

TSEL2

TSEL1

TSEL0

0E

Flag Register

TEST1

TEST2

UF

TF

AF

TEST3

VLF

{

Control Register

{

{

UIE

TIE

AIE

TSTP

STOP

{

0F

∗ 動作設定は､ 設定時の不用意なハードウェア割り込みを避けるために､ 最初に AIE ビットを " 0 " にすることを推奨します。
∗ STOP ビットが " 1 " のときは､ アラーム割り込みイベントは発生しません。
∗ アラーム割り込み機能を使用しないときは､ アラームレジスター ( Reg - 08 ∼ 0A ) を RAM レジスターとして使用できます。その場合は､AIE ビットを必ず " 0 " にしてください。

1) アラームレジスター ( Reg - 08[h] ∼ 0A[h] )Reg − 0A は､ WADA ビットで選択した状況に応じて [週]データ もしくは [日]データを設定できます。
[週]を選択したときは､ 曜日設定を(例えば)月･水･金･土のような複数曜日の同時設定が可能です。
∗1) アラーム発生の対象としたくない項目については､ 対象としたくない項目のレジスターの AE ビットを
" 1 " にしてください。 AE = " 1 " のとき､ その項目については データ不問でアラーム比較対象外となります。
例 ) WEEK Alarm / DAY Alarm レジスター ( Reg − 0A ) )に 80h ( AE = " 1 " ) を書き込む→ [時],[分]のみがアラーム比較対象となる。 [週/日]はアラーム比較対象外。
∗2) 3 つの AE ビット ( Reg − 08,09,0A ) の全てを " 1 " にしたときは､ 例外的に [ 1 分毎にアラーム割り込みイベントが発生 ] します。 ( この結果も､ AF ビットに反映されます )∗3) 現時刻と同じ状況を設定してもアラームは発生しません。 次回の時刻一致時に発生します。

2) WADA ビット ( Week Alarm / Day Alarm Select )アラーム割り込み機能の対象を選択指定するビットです。
WADA

データ

内 容

0

Reg - 0A が WEEK Alarm(週)で動作します。

1

Reg - 0A が DAY Alarm(日)で動作します。

Write

3) AF ビット ( Alarm Flag )アラーム割り込みイベントを検出して､ 結果を保持するフラグビットです。
AF

データ

内 容

0

/IRQ が”L”出力中の場合は解除されます。( Hi-z になります )1" 1 " の書き込みは無効です。

0

−

1

アラーム割り込みイベント発生有り∗ 結果は､ 0 クリアするまで保持されます。

Write

Read

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4) AIE ビット ( Alarm Interrupt Enable )アラーム割り込みイベント発生時の､ /IRQ 割り込み信号の動作を設定します。
データ

AIE

内 容

0

1 ) 割り込み信号は出力しない ( /IRQ = Hi-z 継続 )2 ) 割り込み信号を解除 ( /IRQ､ " L " → Hi-z ) する。

1

割り込み信号を出力する( /IRQ = Hi-z → " L " )Write∗ AIE ビットは /IRQ 端子の出力制御のみです。アラームを解除するには AF フラグを”0”クリアする必要があります。

13.3.2. アラーム設定例
1) [ 曜 ] 指定時 の アラーム設定例 ／ WADA ビット = " 0 "Reg − 0A

[ 曜 ] 指定時
WADA ビット" 0 "

bit
7

bit
6

bit
5

bit
4

bit
3

bit
2

bit
1

bit
0

AE

土

金

木

水

火

月

日

Reg −09

Reg − 08

HOUR
Alarm

MIN
Alarm

毎週 月 ∼ 金,

午前 7 時∗ [分]不問

0

0

1

1

1

1

1

0

07 h

AE bit " 1 "毎週 日, 土,毎時 30 分∗ [時]不問

0

1

0

0

0

0

0

1

AE bit " 1 "

30 h

0

1

1

1

1

1

1

1

Χ

Χ

Χ

Χ

Χ

Χ

Χ

18 h

59 h

1

Reg − 09

Reg − 08

HOUR
Alarm

MIN
Alarm

毎日,

午後 6 時 59 分

Χ : don't care2) [ 日 ] 指定時 の アラーム設定例 ／ WADA ビット = " 1 "Reg − 0A

[ 日 ] 指定時
WADA ビット" 1 "

bit
7

bit
6

bit
5

bit
4

bit
3

bit
2

bit
1

bit
0

AE

•

20

10

08

04

02

01

毎月 01 日,

午前 7 時∗ [分]不問

0

0

0

0

0

0

0

1

07 h

AE bit " 1 "毎月 15 日,

毎時 30 分∗ [時]不問

0

0

0

1

0

1

0

1

AE bit " 1 "

30 h

毎日,

午後 6 時 59 分

1

Χ

Χ

Χ

Χ

Χ

Χ

Χ

18 h

59 h

Χ : don't care

13.3.3. アラーム割り込み機能図"1"

AIE bit"0"

Hi - z/ INT 出力"L"

"1"

AF bit

"0"

イベント
発生

RTC の内部動作
Write 動作

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13.4. 時刻更新割り込み機能
時刻更新割り込み機能は､1 秒更新または 1 分更新にて内部計時に連動したタイミングで割り込みイベントを発生させる機能です。
通信中に内部桁上げが発生した場合は、通信終了後にイベントが発生しますが、その時の”L”出力時間(tRTN)は、
7.813ms より短くなる場合があります。/IRQ 割り込み出力を使用する場合は、時刻更新割り込み発生後に通信開始し、割り込み発生後から 0.95 秒以内で通信終了するなど、通信中の内部桁上げを避けることを推奨します。

13.4.1. 時刻更新割り込み機能 関連レジスター
Address

Function

bit 7

bit 6

bit 5

bit 4

bit 3

bit 2

bit 1

bit 0

FESL1
FSEL0
TE
WADA
TSEL2
TSEL1
TSEL0
D
Extension Register
USEL
{
TEST1
TEST2
TF
AF
TEST3
VLF
E
Flag Register
UF
{
{
{
TIE
AIE
TSTP
STOP
F
Control Register
UIE∗ 動作設定を行うときは､ 設定中の不用意なハードウェア割り込みを避けるために､ 最初に UIE ビットを " 0 " にすることを推奨します。
∗ STOP ビットが " 1 " のときは､ 時刻更新割り込みは発生しません。
∗ 時刻更新割り込み機能は停止できません。時刻更新割り込み機能による/IRQ 出力を禁止することは可能です。

1) USEL ビット ( Update Interrupt Select )時刻更新割り込みイベントの発生タイミングを[秒]更新か[分]更新に設定するビットです。
データ
内 容
USEL
Write / Read

0[秒]更新時( 1 秒毎に繰り返し) にする。

1[分]更新時( 1 分毎に繰り返し) にする。

2) UF ビット ( Update Flag )時刻更新割り込みイベントを検出して､ 結果を保持するフラグビットです。
データ
内 容
UF
Write

0

0 クリアしても､ /IRQ " L " 出力を解除する(Hi-z にする)ことはできません。

1" 1 " の書き込みは無効です。

0

−

1

時刻更新割り込みイベント発生有り( 結果は､ 0 クリアするまでホールドします )Read3) UIE ビット ( Update Interrupt Enable )時刻更新割り込みイベント発生時の､ /IRQ 端子への割り込み信号の動作を設定します。
データ
内 容
UIE
0

1 ) 割り込み信号をディセーブルにする。( /IRQ = Hi-z 継続 )2 ) 割り込み信号を解除する。( /IRQ､ " L " → Hi-z )する。

1

割り込み信号をイネーブルにする。( /IRQ = Hi-z → " L " )∗ 割り込み出力は 7.813 ms で自動解除( /IRQ = " L " → Hi-z )します。

Write / Read

13.4.2. 時刻更新割り込み機能図"1"

UIE bit"0"∗ UIE bit を" 0 " クリアす
ると、tRTN を
を待たずに/IRQ は解除する/ IRQ 出力tRTN
∗ UF bit を " 0 "クリアしても/IRQ 状態は不変

UF bitperiodperiodperiodHi - z"L""1""0"
period

桁上げ
発生
RTC の内部動作
Write 動作

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13.5. 割り込み機能動作時の /IRQ " L " 割り込み出力に関して
1) /IRQ " L " 割り込み出力発生時の 割り込みイベント特定方法/IRQ 割り込み出力端子は､ 定周期タイマー割り込み機能, アラーム割り込み機能, 時刻更新割り込みの 3 種類の割り込みイベントの共通出力端子になっています。
割り込みが発生したときは TF, AF, UF フラグを読み出して､ どの種類の割り込みイベントが発生したのかを確認してください。

2) /IRQ 出力を使用しない場合の処理方法
・/IRQ 出力を使用しない場合は、端子は OPEN で使用してください。
・TIE, AIE, UIE ビットの全てのビットを " 0 " にしてください。
・割り込みイベントの発生を検出したい場合は､ TF, AF, UF フラグを監視して､対象となる割り込みイベントが発生を確認してください。

13.6. 電圧低下検出機能
本製品の状態を検出して､ 結果を保持するフラグビットです。
初期電源投入時、電源電圧の低下などによって計時内容が有効でないとき､ " 0 " → " 1 " に変化します。
読み出し時 " 1 " のときの本製品の内容は無効ですので､ その場合は､ 必ず全てのレジスターを初期設定してから使用してください。
∗ バックアップ状態からの復帰時などに読み出し､ バックアップ動作中の異常の有無について確認することを推奨し
ます。
VLF

Write

データ

内 容

0

VLF ビットを 0 クリアし､ また､ 次回検出に備える。

1" 1 " の書き込みは無効です。

0

動作異常の検出なし。

1

動作異常の検出あり。 本製品の内容は無効。
∗ 結果は､ 0 クリアするまで保持されます。

Read

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13.7. FOUT 機能 ( クロック出力機能 )FOUT 出力端子から､ 32.768 kHz などのクロック出力 ( C-MOS 出力 ) を得ることができます。
出力を停止させたときは､ FOUT 端子は ハイインピーダンスになります。
13.7.1. FOUT 機能 ( クロック出力機能 ) 関連レジスター
Address [h]Function

bit 7

bit 6

bit 5

bit 4

bit 3

bit 2

bit 1

bit 0

0D

Extension Register

FSEL1

FSEL0

USEL

TE

WADA

TSEL2

TSEL1

TSEL0

• FSEL1 ビット, FSEL0 ビットと FOE 入力端子の組み合わせにより､ FOUT 出力端子から 32.768 kHz, 1024 Hz,
1 Hz を選択出力する または 出力を停止させることができます。

13.7.2. FOUT 機能 機能動作表/BM pin

FOE pin

FSEL1

FSEL0

0

0

32768 Hz Output( C-MOS output )

"H"

0
1

1
0

"L"

Χ

Χ

1024 Hz Output
1 Hz Output
OFF( C-MOS output )( C-MOS output )( high impedance )

Χ

1

1

OFF

( high impedance )

Χ

Χ

Χ

OFF

( high impedance )

"H"

"L"

FOUT pin output

∗1
∗2
∗3

Χ: don’t care
∗1 FOE = " L " の場合は、FSEL1,0 ビットの設定に関わらず出力停止します。
∗2 FSEL0=1, FSEL1=1 の場合は、FOE の設定に関わらず出力停止します。
∗3 /BM 端子= “L” の場合は、FOE 端子,FSEL1,0 ビットの設定に関わらず出力停止します。
∗4 FOUT 出力の ON/OFF 切り替えをソフトのみで制御する ( FSEL1, 0 ビットのみで制御する )場合は､
FOE 入力端子を " H " にしてください。
∗5 初期電源投入時 ( 0 V からの電源投入時 ) に FOE 入力端子 = " H " であったときは､パワーオンリセット機能により 32.768 kHz が選択出力されます。

13.7.3. FOUT 機能使用時の注意事項
注 1 ) FOUT 機能が有効な電源電圧範囲

FOUT 機能が有効な電源電圧範囲は 1.6 V ∼ 5.5 V です。 ( 1.6V 以下でも出力は停止しません。)
注 2 ) 電源を急峻に変動させたときの FOUT 出力動作

FOUT 機能は、電源電圧が急峻に変動した直後（バックアップ移行直後・バックアップからの復帰直後、など）では、その影響により、数 ms の間、出力が停止することがありますのでご注意ください。

V DD
FOUT 機能 有効 電圧範囲

1.6 V
tFFOUTtRFOUT

FOUT 機能 を使用 する場 合は、
4 ms / V 以上の 緩やか な電源 降下になるよ うにご 配慮くだ さい。

FOUT 機能 を使用 する場 合は、
1 ms / V 以上の 緩やか な電源 上昇になるよ うにご 配慮くだ さい。

注 3) STOP ビットが " 1 " のときの FOUT 出力動作

STOP " 1 " のときの FOUT は､ 選択周波数によっては 出力が停止します。
(1) 32.768kHz、1024Hz を選択出力させているときは、継続出力します。
(2) 1Hz では、FOUT 出力が停止します。

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13.8. フローチャート• 以下のフローチャートは 一例です。
∗ わかりやすさを優先した記載にしていますので､ 実際の処理の際には 非効率な部分があります。
∗ より効率的な処理を行いたいときは､ いくつかの処理を同時にしたり､操作手順を入れ替えても問題無い部分などを確認調整ください。( 記載内容の中には､ 使用状況によっては 必要のない処理もあります )∗ 期待通りの動作を行うためには､ 必ず 使用条件 ( 使用環境 ) に合わせた調整をお願いいたします。

1) 初期化例
例1
初期化

Reg − 0D[h] の初期化

• TE ビット ( bit − 4 ) を､ " 0 " に してください 。
• FSEL1, 0 ビット ( bit − 7, 6 ) を､ 任意に設定して ください。

Reg − 0E[h] の初期化

• TEST1, TEST2, TEST3 ビ ットを､ 必ず " 0 " に設定して ください。
• VLF ビット ( bit − 1 ) を､ " 0 " クリアしてください。

Reg − 0F[h] の初 期化• AIE, TIE,UIE ビットを " 0 " に 設定し､ 不 用意な割り 込み出力を 事前防止します。

( Reg − 00[h] ∼ 06[h] )• [ 年 / 月 / 日 [曜] 時:分:秒 ] を設定します。( Reg − 00[h] ∼ 06[h] )∗ 現在時刻の設定に ついて は､ [ 時 計･カレ ンダーの書き込み ] の項 を参照
くださ い。

アラ ーム割込設定• アラー ム割り込み機 能を設定しま す。( Reg − 08[h] ∼ 0A[h] )現 在時刻設定( Reg −0 8[h] ∼ 0A[h] )( アラー ム割り込み 機能を使 用しないと きは､ Reg − 8[h] ∼ A[h]を RAM レ ジスターとして使用できます。 その場合は AIE ビット を 必ず " 0 " に してください。 )タイ マー割込設定• タイマ ー割り込み機 能を設定しま す。( Reg − 0B[h] ∼ 0F[h] )( Reg − 0B[h] ∼ 0F[h] )( タ イマー割り込み機能を使用しないとき は､ Reg − B[h] ∼ C[h]を RAM レジスターとして使用いただけます。 その場合は TE, TIE ビットを 必ず " 0 " にし てください。)

時刻 更新割込設定• 時刻更 新割り込み機 能を設定しま す。( Reg − 0D[h] ∼ 0F[h] )( Reg − 0D[h] ∼ 0F[h] )次の処理へ∗ 初 期化終了 時には 必ず STOP ビッ トが " 0 ( = 計時 スタート ) " になるよ
うにしてく ださい。

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RX − 8571 SA
例2

時計機能のみ使用する場合の初期化例
初期化

Reg − 0D[h] の初期化

Reg − 0E[h] の初期化

Reg − 0F[h] の初期 化

現 在時刻設定• Write 04[h]• Write 00[h]• Write 02[h]STOP ビットを " 1 " にし、時 刻設定するま で計時を停止 させます。
• [ 年 / 月 / 日 [曜] 時:分:秒 ] を設定します。

( Reg − 00[h] ∼ 06[h] )アラー ム割込設定( Reg −0 8[h] ∼ 0A[h] )タイマ ー割込設定( Reg − 0B[h] ∼ 0F[h] )計 時停止の解除( Reg − 0 F[h] )計 時開始• Reg − 0F[h] の初 期化にてアラー ム機能は停止 していますの で、任意のデー タを R/W が可能な RAM として利用できます。
• Reg − 0E[h] , Reg − 0F[h] の 初期化 にて アラ ーム 機能は停止し てい ま すので、任意の データを R/W が可 能な RAM として利用できます。
• Write 00[h]STOP ビットを " 0 " にするこ とで時刻更新 がスタートし ます。
∗ 初 期化終了時 には 必ず STOP ビッ トが " 0 ( = 計時 スタート ) " になるよ
うにしてく ださい。

2) 電源投入時の処理例
電源投入時の処理

Wait• 内部の水晶振動子が発振するまでの時間を待ってください。
( 待ち時間の目安は発振開始時間 ( tSTA [ s ] ) の規定を参照ください )初期化• 必ず､ 全てのレジスターを初期化してください。
( 初期化については [ 初期化 ] の項を参照ください )次の処理へ

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RX − 8571 SA3) バックアップ状態から復帰したときの処理例

バックアップ復帰処理∗1

No ( VLF = " 1 " ) ∗2

∗1) VLF ビットをチェックします。

VLF = " 0 " ?
Yes( VLF = " 0 " )

∗3
Wait

∗4
初期化

∗2) VLF ビットが " 1 " の ときは、バックアッ プ中に 異常が あった ( 電 圧低 下などに より、 計時デー タやレジスタ ー設定を 消失し ている ) 可 能性が あり ますの
で 、必ず初期化 をしてくださ い。
∗3) 電源電圧が低下 してい た場合 は､ 内部の 水晶振 動子が再 び安定発振す るまでの 待ち時間が必 要です。
( 待ち時間の目安は発振開始時間( tSTA [ s ] ) の規定を参照 ください ) )∗4) 初期化は 、必ず 全ての レジ スタ ーを初期 設定し てくだ さい。 ( 初 期化 について は、[ 初期化 ] の項 を参照くださ い )次の処理へ

4) 時計・カレンダーの 書き込み例
現在時刻設定 ( 例 )STOP ← " 1 "現在時刻の書き込み• STOP ビットを " 1 " にし､ 時刻設定中の計時更新を事前防止します。

• [ 年 / 月 / 日 [曜] 時:分:秒 ] のうち､ 設定 ( または 再設定 ) が必要な情報を書き込みます。
∗ 初期化のときは､ 全てのデータを初期設定してください。

STOP ← " 0 "• STOP ビットを " 0 " に解除し､ 計時動作を開始 ( 再開 ) します。
∗ STOP ビットを " 0 " にした時点から､ 計時が開始します。

次の処理へ∗ STOP ビットを併用しなくても､ 時刻設定可能です。
STOP ビットを使用しない場合は､ [ [ 秒 ] を書き込んだ時点から､ 計時が開始する ] 点に ご注意ください。

5) 時計・カレンダーの 読み出し例
現在時刻読み出し

現在時刻の読み出し

次の処理へ• 0.95 秒以内に[年 / 月 / 日 [曜] 時:分:秒] より､必要な情報を読み出します。
読み出し時は､ STOPビットが ” 0” のままで 読み出しをしてください。
(STOPビットを ”1” にして読み出すと､ 時刻遅れの原因になります)• 読み出されるデータは､ I2C-BUS 通信開始時の時刻情報です。
I2C-BUS 通信開始時に､ 時刻データは固定され(桁上げホールド)、
I2C-BUS 通信終了時に、自動で時刻補正されます。
• 現在時刻の読み出しにおいては､ アドレスオートインクリメント機能を使用して Reg00[h]∼06[h]までを連続して読み出すことを推奨しています。

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RX − 8571 SA
6) タイマー割り込み機能の設定例
例1

タイマー割込機能設定

Reg-0D[h] 設定• TE ビットを " 0 " クリアして､ タイマー割り込み機能を停止させます。
• TSEL2, TSEL1, TSEL0 ビットの組み合わせでタイマーのカウントダウン周
期 ( = ソースクロック ) を設定します。

Reg-0E[h] 設定• TF ビットを " 0 " クリアして､ 前回のタイマー割り込み出力 ( /IRQ 出力 )を解除します。

Reg-0F[h] 設定• TIE ビット設定の設定でイベント発生時の /IRQ 出力 ( " L " レベル割り込み
出力を 出力させるか または 出力させないか ) を選択設定します。
1) " L " レベル割り込みを出力させる場合は、TIE ビットを " 1 " に設定
2) " L " レベル割り込みを出力させない場合は、TIE ビットを " 0 " に設定

Reg − 0B[h], 0C[h] 設定

カウント開始次の処理へ• ダウンカウンターの初期値を設定します。

• TE ビットを " 1 " にして､ タイマー割り込み機能をスタートさせます。
注 ) タイマ割り込み機能をスタートさせるときは､必ず事前に､
ダウンカウンターの初期値を設定してください。
∗1 カウンタを一時停止させるときは、Reg-0F[h] TSOP ビットを” 1 " にしてください。TSOP ビットを” 0 "で再スタートします。
∗2 プリセット値から再開したい場合は、TE ビットを " 0 " クリアして再度 TE ビットを”1”にしてください。

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RX − 8571 SA
13.9. データの リード/ライト
13.9.1. I2C−BUS の特性
I2C -BUS は 2 線式の双方向通信です。信号線は､SDA（データライン）と SCL（クロックライン）とで構成されており､両ラインとも､プルアップ抵抗を介して VDD ラインに接続します。
複数のデバイスの AND 接続を実行するために､ I2C-BUS につながる全てのポートは オープンドレイン あるいはオープンコレクターでなければなりません。

13.9.2. ビット転送
SCL ラインの 1 クロックパルス毎に 1 ビットのデータ転送を行います。送信時､SDA ライン上のデータ変更は SCL
ラインが LOW の区間で行います。受信側では､SCL ラインが HIGH の区間でデータを取り込みます。

13.9.3. 開始条件と停止条件
I2C-BUS が非通信状態の時､2 本のラインは HIGH を保っています。この時､SDA が HIGH から LOW に変化した状
態を､通信の"開始条件"と定義します。この後､実際のデータ転送を行います。さらに､SCL が HIGH の時､SDA が LOWから HIGH に変化した状態を､通信の"停止条件"と定義します。

SDA

SCL

S

P

開始条件

停止条件

13.9.4. スレーブアドレス
I2C-BUS デバイスは、通常のロジックデバイスが有するチップセレクト端子を持ちません。全ての I2C-BUS デバ
2
イスは、機種ごとにユニークなデバイスナンバーが内部にあらかじめ固定記憶されています。 I C -BUS デバイス
2のチップセレクトは、通信開始時にこのデバイスナンバーを I C-BUS によりスレーブアドレスとして送信することによって行います。受信デバイスは、スレーブアドレスが一致した場合のみ、その後の通信に反応します。
スレーブアドレスは、7 ビットで構成されており、RX-8571 では DAS 端子の論理状態でスレーブアドレスが異なります。

RX-8571 スレーブアドレス
スレーブアドレスDAS pin
"H"

0

1

1

0

0

1

0

"L"

1

0

1

0

0

0

1

実際の通信時には、スレーブアドレスと共に、R/W（リードライト）ビットを付加した 8 ビットデータを送信します。

R/W
bit

スレーブアドレス
bit 7

bit 6

bit 5

bit 4

bit 3

bit 2

bit 1

bit 0

∗

∗

∗

∗

∗

∗

∗

R/W

0 ; 書き込みモード
1 ; 読み出しモード

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RX − 8571 SA
13.9.5. システム構成
メッセージの送受信を制御するデバイスを"マスター"､マスターによって制御されるデバイスを"スレーブ"と定義します。また､メッセージを送信するデバイスを､"トランスミッター"､メッセージを受信するデバイスを"レシーバー"と定義します。

RX-8571 の場合､CPU 等のコントローラがマスター､RX-8571 がスレーブとなります。トランスミッター､レシー
バーには双方とも成り得ます。

SDA
SCL
マスタ

スレーブ

マスタ

スレーブ

トランスミッター／ レシーバー

トランスミッター／ レシーバー

トランスミッター／ レシーバー

トランスミッター／ レシーバー

CPU 等

RX - 8571

他の I2C-BUS デバイス

13.9.6. アクノリッジ
開始条件と停止条件との間で転送するデータのバイト数に制限は有りません。
この時､1 バイトの転送毎に､レシーバー(受信側)は､トランスミッター(送信側)に対し､アクノリッジビットというデータの受信確認のビットを生成します。 アクノリッジビットは LOW アクティブですから､トランスミッターはSDA ラインを HIGH にし､アクノリッジビット用のクロックを送出します。
レシーバーは､それまでにトランスミッターから送られた 8 ビットのデータを正しく受け取っていれば､最終ビッ
2
ト用のクロックが終了した時点で SDA ラインを LOW にします。 I C -BUS ラインはプルアップされているので､ト
ランスミッター側の SDA ラインも LOW になります。ここで､トランスミッターはアクノリッジが返って来たことを確認し､次のデータを送信します。 レシーバーは､アクノリッジビット用のクロックが終了した時点で､SDA ライン
を HIGH（開放）にして次のデータ受信に備えます。
マスターがトランスミッターの時は､レシーバーからのアクノリッジ確認後､次のデータ送受信をせずに停止条件を生成すれば､通信を正常終了することができます。 マスターがレシーバーの時は､アクノリッジビットを"1"として送出した後､停止条件を生成すれば通信を正常終了することができます。

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ETM30J-02

RX − 8571 SA
13.9.7. I2C−BUS プロトコル
以下に､マスターを CPU､スレーブを RX-8571 と想定して通信手順を記します。
① アドレス指定の書き込み手順

RX-8571 はアドレスのオートインクリメント機能がありますので､最初にアドレス指定した後､データだ
けを送り続ければ､8571 の受け取りアドレスは 1 バイト毎に加算されます。
オートインクリメントは、Address 1F[h]まで来ると 00[h]に循環します。
(1)
(2)
(3)
(4)
(5)
(6)
(7)
(8)
(9)

CPU が開始条件を送信
CPU が 8571 のスレーブアドレス､及び R/W ビットを書き込みモードで送出
8571 からのアクノリッジ確認
CPU が 8571 へ書き込むアドレスを送出
8571 からのアクノリッジ確認
CPU が(4)で指定したアドレスへ書き込むデータを送出
8571 からのアクノリッジ確認
必要に応じ(6)(7)のくり返し。アドレスは 8571 内部でオートインクリメント。
CPU が停止条件を送出

(1)

(2)

S

スレーブアドレス

0

(3)

(4)

(5)

(6)

(7)

(8)

0

アドレス

0

データ

0

データ

(9)
0

P

R/W
8571 からのアクノリッジ② アドレス指定の読みだし手順
書き込みモードによって､リードするアドレスをライトした後､読みだしモードを設定して､実際のデータをリードします。

(1) CPU が開始条件を送出(2) CPU が 8571 のスレーブアドレス､及び R/W ビットを書き込みモードで送出(3) 8571 からのアクノリッジ確認(4) CPU が 8571 から読みだすアドレスを送出(5) 8571 からのアクノリッジ確認(6) CPU が開始条件を送信 ( 停止条件は送信しない )(7) CPU が 8571 のスレーブアドレス､及び R/W ビットを読み出しモードで送出(8) 8571 からのアクノリッジ確認（ここから､CPU がレシーバー､8571 がトランスミッターとなる）(9) 8571 から(4)で指定したアドレスのデータが出る(10) CPU が 8571 へアクノリッジ送出(11) 必要に応じ､(9)(10)のくり返し。読みだしアドレスは 8571 内部でオートインクリメント。
(12) CPU が"1"のアクノリッジを出す(13) CPU が停止条件を送出。
(1)

(2)

S

スレーブアドレス

0

(3)

(4)

(5)

(6)

(7)

0

アドレス

0

S

スレーブアドレス

R/W

1

(8)

(9)

(10)

(11)

(12) (13)

0

データ

0

データ

1

P

R/W
8571 からのアクノリッジ

CPU からのアクノリッジ③ アドレス指定しない読み出し手順
最初に読みだしモードを設定することで､その後すぐにデータをリードできます。この場合のアドレスは､
前回のアクセスで終了したアドレス+1 となります。

(1)
(2)
(3)
(4)
(5)
(6)
(7)
(8)

CPU が開始条件を送出
CPU が 8571 のスレーブアドレス､及び R/W ビットを読み出しモードで送出
8571 からのアクノリッジ確認 ( 以降､CPU がレシーバー､8571 がトランスミッターとなる )8571 から､前回のアクセスにおける最終アドレス+1 のデータが出る
CPU が 8571 へアクノリッジ送出
必要に応じ､(4)(5)のくり返し。読みだしアドレスは 8571 内部でオートインクリメント。
CPU が"1"のアクノリッジを出す
CPU が停止条件を送出。

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ETM30J-02

RX − 8571 SA
13.9.8. I2C−BUS 通信波形例① アドレス指定の読みだし波形例
アドレス 10h に A5h を書き込む場合
SCL

SDA

開始条件 スレーブアドレス(A2h)＋0(Write)

アド レス(10h)

ライトデータA5h を書き込む場合

停止条件

RX8571 からのアクノリッジ※CPU は SDA ラインを開放② アドレス指定の読みだし波形
アドレス 10h から A5h を読み出す場合

SCL

SDA

開始条件 スレーブアドレス(A2h)＋0(Write)

アド レス(10h)開始条件 スレーブアドレス(A2h)＋1(Read)

RX8571 からのアクノリッジ※CPU は SDA ラインを開放

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アドレス(10h)の データ
A5h が読み出された 場合

停止条件

CPU からのアクノリッジ“1”を送 信ETM30J-02

Application Manual

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