2018年

2月 15日
第 34 号◆ 平成30 年度チップ試作日程予定◆ VDEC デザインアワードについて◆ 春の CAD 講習会のお知らせ同じ内容はhttp://www.vdec.u-tokyo.ac.jp/Tayori/にも掲載されています。

VDECからの大事なお知らせです。

◆ 平成30 年度チップ試作日程予定
http://www.vdec.u-tokyo.ac.jp/CHIP/ChipApply.html

設計締切2018/2/20
2018/2/23
2018/3/24
2018/6/25
2018/?/??
2018/9/10
2018/10/1

試作完了
2018/6/16
2018/7/??
2018/6/20
2018/10/12????/??/??
2018/12/28
2018/12/24

2018/11/5

2019/2/22

2018/2/25
2019/3/25

2019/6/14
2019/6/24

試作ラン
Rohm 0.18um
Renesas 65nm SOTB
OnsemiSanyo 0.8um
Rohm 0.18um: 第１回
Renesas 65nm SOTB
Rohm 0.18um: 第2回
OnsemiSanyo 0.8um

Rohm 0.18um: 第３回**

Rohm 0.18um: 第4回**
OnsemiSanyo 0.8um

日程は仮のもので、変更となる場合がありますことをご了承下さい。
**Rohm 0.18um: 第３回、第4回の実施は第１回、第2回後に決定

平成29年度分の各種報告書のお願いについて皆様におかれましては益々ご清栄のこととお慶び申し上げます。例年、CAD 利用状況
アンケート、チップ試作レポート、論文リストの提出を年度末にお願いさせて頂いておりますが、今年度分について WEB での提出受付を開始しております。詳細については以下のページをご参照ください。
☆ 2017 年度 CAD 利用状況アンケート提出ページ

http://www.vdec.u-tokyo.ac.jp/cadenq.html☆ 2017 年度チップ試作レポート提出ページ

http://www.vdec.u-tokyo.ac.jp/nenpo.html☆ 2017 年度 VDEC 関連論文リスト提出ページ

http://www.vdec.u-tokyo.ac.jp/ronbun.html

提出期限：2018 年 4 月 23 日（月）◆ VDEC デザインアワードについて
http://www.vdec.u-tokyo.ac.jp/designAward/welcome.html

毎年好評の VDEC デザインアワードですが、を提出いただきます。既発表 / 未発表は問い
今年も「デザインアワード部門」と「アイディアコ ま せ ん。ま た、試 作 の 時 期 も 問 い ま せ ん。
ンテスト部門」の 2 部門制で継続いたします。 VDEC 協力教員が選考委員となって 1 次審
「デザインアワード」は、VDEC を通じて優秀 査を行い、かつ、今年も 1 次選考通過者は 8なチップを設計した学生を表彰します。
「アイ or 9 月に開催予定 ( 詳細は追って連絡いたしディアコンテスト部門」では、IP のシミュレー ます ) のデザイナーズフォーラムにてポスターション等、実際にチップを設計していなくても応 セッションもしくは口頭で発表していただき、募が可能です。
また、昨年同様、「デザインア フォーラム参加者および選考委員による投票ワード」
では賞金を授与、「アイディアコンテスト によって優秀賞、奨励賞を決定し、そのまま部 門」で は、ロ ー ム 0.18um 2.5mm x フォーラム内で表彰いたします。
多数の応募をお待ちしております。
2.5mm の無料試作権を賞品として授与する予定です。
各部門ともに応募は主に指導教員による推薦（名倉 徹）とし、内容を A4 1 ページ程度でまとめたもの

デザインアワード・アイデアコンテスト部門授賞式◆ 春の CAD 講習会のお知らせ
http://www.vdec.u-tokyo.ac.jp/CAD/CADTraining.html

今年も 3 月に入ってから春の CAD 講習会 Premier (FPGA 設 計 向 け ), XA+VCS,を開催いたします。好評いただいております Milkyway となっております。開催日程は以下
VDEC 拠点校 ( 北大・東北大・金沢大・東工大・ となっております。
名大・京大・阪大・広大・九大 ) へのストリー
ぜひ CAD 講習会を有効にご活用いただき、ミング配信を今回も実施し、拠点校での受講が 設計力向上にご利用いただければ幸いです。
可能となっております。
今 回 の 開 催 項 目 は Cadence は Allegro（名倉 徹）PCB と Innovus, Synopsys は Synplify
3月 8日(木), 3月 9日(金)Cadence Innovus 講習会
3月13日(火)Synopsys XA+VCS 講習会
3月14日(水)Synopsys Synplify Premier 講習会
3月19日(月), 3月20日(火) Cadence Allegro PCB Editor Basic Techniques抜粋+ Sigrityのインピーダンス解析 講習会

研究室便りVDECユーザの研究室をご紹介するコーナーです。

東京電機大学 小松研究室
工学部電子システム工学科 集積回路研究室

http://www.epi.dendai.ac.jp/04.html

小松研究室 ( 集積回路研究室 ) では集積回路設計とその設計自動化技術やテスト技術を中心に研究に取り組んでいます．特に，自動合成を意識したディジタル・アナログ混載システ
ムの回路設計と設計自動化に力を入れています．
研究室の構成は，教員 1 名，修士 2 年 3 名，修士 1 年 5 名，学部 4 年 11 名，学部 3 年
8 名と大所帯となっていますが，和気あいあいと回路設計や研究活動に勤しんでいます．
2014 年に研究室を立ち上げてから今年で 4 年目となり，ようやく研究室としても軌道に乗ってきたと感じています．当初は研究室の設計環境，測定環境ともにゼロからの構築でしたが，そのようなハード面だけでなく設計ノウハウなどのソフト面も充実してきたため，学生だけで問題を解決できる場面も増えてきています．
また，最近では回路だけではなく武 田 先 端 知 ビ ル に おじゃましてMEMS センサの作製も行っており，近い将来には集積化 MEMS システムの研究にも力を入れていこうと考えています．
VDEC では教員として 13 年間お世話になりましたが，現在は VDEC のサービスを利用させて頂き，また，ユーザの立場から VDEC の活動を盛り上げていけるように，よりアクティブに活動を行っていきたいと思います．
VDECスタッフより…

「ばらつき」を切り口に1 月から研究支援職員に採用されました山口です．
「ばらつき」
や「雑音」を切り口として，みなさまとコミュニケーションしたいとおもいます．
アドバンテスト研究所における研究活動を紹介します．
理論．解析信号理論をタイミングゆらぎ測定に適用することにより，位相雑音とタイミングジッタと周期ジッタ間 の 関 係を定式化できることを示した[T-CAS, pp.288-298, 2003]．
ア ル ゴリズ ム が 先 行．解 析 信 号 処 理 を 高 速
Fourier 変換で実現し，オシロスコープで離散化した波形からそのタイミング揺らぎを測定できるようにした．米国の有名な測定器メーカと直接ベンチマーキングした．彼らは，解析信号法が高速・高精度であることを認めた．
ハードウェアがつづく．解析信号処理をハードウェアにマッピングした．2 年かけて，自己遅延方式の測定回路を再発見した．従来のオンチップの測定回路ができなかったリアルタイムのタイミングジッタ測定を可能とした [M. Ishida, ISSCC2005,

K.Ichiyama T-MTTS2008, pp. 1278 1285]．
ひとつの回路でも，遅延時間を変えることにより，タイミングジッタと周期ジッタを測定できる
こ と を 明 ら か に し た [K. Niitsu, JSSC, pp.
2701- 2710, 2012]．
（山口 隆弘）