(57)【特許請求の範囲】
【請求項１】
映像信号発生装置からの入力映像情報を液晶パネルに表示する液晶表示装置において、
前記液晶パネルと、
データドライバと、
ゲートドライバと、
過去の入力映像情報の１フレームの垂直方向のライン数と現行の入力映像情報の１フレームの垂直方向のライン数を比較し、１フレームの垂直方向のライン数の相違の有無を判断する比較回路と、
前記液晶パネルに対する直流電圧の印加を防止するため第１の周期の交流化信号を出力する第１の駆動回路と、
前記第１の駆動回路とは異なる第２の周期の交流化信号を出力する第２の駆動回路とを有し、
前記比較回路の比較結果に従って、前記第１の駆動回路及び第２の駆動回路からそれぞれ出力される前記第１の周期の交流化信号と前記第２の周期の交流化信号とのいずれかを選択して出力する選択回路を備えたことを特徴とする液晶表示装置。
【請求項２】
請求項１記載の液晶表示装置において、
前記液晶表示装置は、更に前記入力映像情報から前記液晶パネルに表示される際の各フレームの垂直方向のライン数を検出するライン数検出回路とを有し、
前記比較回路は、前記ライン数検出回路にて検出されたライン数を任意間隔フレーム間で比較するものであり、
前記選択回路は、前記比較回路の比較により比較されるフレーム間でライン数が一致の場合には、前記第１の駆動回路の出力を、不一致の場合には前記第２の駆動回路の出力を選択することを特徴とする液晶表示装置。
【請求項３】
請求項２記載の液晶表示装置において、
前記比較回路は、前記ライン数検出回路によって検出された１フレーム前のライン数を保持する保持回路を有し、
前記比較回路は、前記保持回路に保持されたライン数と前記ライン数検出回路によって検出される前記入力映像情報信号の現行ライン数とを比較することを特徴とする液晶表示装置。
【請求項４】
請求項１記載の液晶表示装置において、
前記第１の駆動回路は、前記第１の周期の交流化信号として、前記液晶パネルの各画素の電圧極性を毎フレーム正極性、負極性を繰り返し、更に、水平及び、垂直方向共に隣接画素間で電圧極性を反転させる信号を出力することを特徴とする液晶表示装置。
【請求項５】
請求項１記載の液晶表示装置において、
前記第２の駆動回路は、前記第２の周期の交流化信号として、前記液晶パネルの各画素の電圧極性を２フレーム周期で反転し、４フレームで完結する動作を繰り返し、更に、水平方向については隣接画素間で電圧極性が反転し、垂直方向については２画素毎に電圧極性が反転させる信号を出力することを特徴とする液晶表示装置。
【請求項６】
請求項２記載の液晶表示装置において、
前記比較回路は、比較される前記入力映像情報のフレーム間隔を指示する信号を入力する入力端子と、
前記入力端子から入力された信号が指示するフレーム間隔に従い、該フレーム間隔を構成する各フレームにおいて前記ライン数検出回路によって検出されたライン数を保持する第１の保持回路と第２の保持回路とを有し、
前記比較回路は、前記第１の保持回路に保持されたライン数と前記第２の保持回路に保持されたライン数とを比較することを特徴とする液晶表示装置。
【請求項７】
請求項１記載の液晶表示装置において、
前記映像信号発生装置からの入力映像情報は、ノン・インターレス形式であることを特徴とする液晶表示装置。
【請求項８】
請求項１記載の液晶表示装置において、
前記映像信号発生装置からの入力映像情報は、インターレス形式であることを特徴とする液晶表示装置。
【請求項９】
映像信号発生装置からの入力映像情報を液晶パネルに表示する液晶表示装置において、
前記液晶パネルと、
データドライバと、
ゲートドライバと、
前記入力映像情報から前記液晶パネルに表示される際の各フレームの垂直方向のライン数を検出するライン数検出回路と、
前記ライン数検出回路によって検出された１フレーム前のライン数を保持する保持回路を有し、前記保持回路に保持されたライン数と前記ライン数検出回路によって検出される前記入力映像情報映像信号の現行のライン数とを比較する比較回路と、
前記液晶パネルに対する直流電圧の印加を防止するため、前記液晶パネルの各画素の電圧極性を毎フレーム正極性、負極性を繰り返し、更に、水平及び、垂直方向共に隣接画素間で電圧極性を反転させる第１の周期の交流化信号を出力する第１の駆動回路と、
前記液晶パネルの各画素の電圧極性を２フレーム周期で反転し、４フレームで完結する動作を繰り返し、更に、水平方向については隣接画素間で電圧極性が反転し、垂直方向については２画素毎に電圧極性が反転させる第２の周期の交流化信号を出力する第２の駆動回路とを有し、
前記比較回路の比較により比較されるフレーム間でライン数が一致の場合には、前記第１の駆動回路の出力を、不一致の場合には前記第２の駆動回路の出力を選択する選択回路を備えたことを特徴とする液晶表示装置。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、液晶表示素子を用いた液晶表示装置に係り、定常的な直流電圧の印加を防ぎ、焼き付き（残像）の無い良好な表示を得るための液晶表示装置に関するものである。
【０００２】
【従来の技術】
従来、映像信号発生装置からの入力映像情報を表示する液晶表示装置において、液晶パネルへの直流電圧印加を除去し、液晶パネルの焼き付きすなわち、残像表示を防止する方法としては、例えば、特開平０９−２７９３４号公報に開示されているように、入力された映像信号を、ガンマ補正回路により液晶パネルの表示特性に合わせてガンマ補正した後、両極性映像信号発生回路に供給していた。両極性映像信号発生回路では、所定振幅の正極性の第１映像信号と負極性の第２映像信号を発生し、この第１、第２映像信号をゲート回路に供給する。ゲート回路では、反転制御信号により一定周期で第１、第２映像信号を切り換え、この選択された第１、若しくは第２映像信号をリミッタ回路へ供給する。リミッタ回路では、選択された第１、第２映像信号の振幅を制限し、リミッタ回路により振幅制限された第１、若しくは第２映像信号はバッファ回路を介して液晶パネルに供給する。
【０００３】
図２２は、特開平０９−２７９３４号公報に開示されている液晶パネルの焼き付き防止を可能とする映像信号処理回路の一構成例である。図中、2201は入力映像信号、2202はクランプ回路部、2203はガンマ補正回路部、2204は両極性映像信号発生部、2205はゲート回路部、2206は極性反転制御信号、2207はリミッタ回路部、2208はバッファ回路部である。通常映像処理回路は、各原色信号にそれぞれ１個ずつ必要であるため、合計３回路が必要となるが、説明上１回路にて説明を行う。
【０００４】
原色信号は、クランプ回路 2202により所定の電位でペデスタルクランプされる。次に、ペデスタル電位が所定の電位に揃えられた各原色信号は、ガンマ補正回路 2203に入力される。そして、ガンマ補正された映像信号は、両極性映像信号発生回路 2204に出力され、ここで正極性、負極性の映像信号が作成される。尚、両極性映像信号発生回路 2204には、各原色信号の振幅を同時に調整するゲイン調整回路、各原色信号の正負のペデスタルレベルの相対電圧を変化させるブライト調整回路、更に回路間のばらつきや液晶パネルのホワイトバランスを調整するために、例えば原色信号のＧ信号に対して、Ｒ、Ｂ信号のゲイン、及びブライトを個々に調整する調整回路等が内蔵されている。正、負極性の映像信号はゲート回路 2205に供給され、ゲート回路 2205では、極性反転制御信号 2206によりフィールド毎、あるいは水平周期の整数倍の周期で正、または負の映像信号として交互に取り出される。ゲート回路 2205からの出力映像信号は、リミッタ回路 2207でリミッタ制御され、このリミッタ制御された出力映像信号は、負荷回路を十分駆動できるようにバッファ回路 2208を介して低インピーダンスで出力される。
【０００５】
これにより、交流反転した映像信号の平均電圧を基準として最終出力部でリミッタをかけることにより、映像信号処理回路部の電源電圧に依存することなく、映像信号中心電圧を電源電圧の１／２電位の制約を受けることなく、また各種ゲイン、ブライト調整範囲を制限することなく、映像信号の平均電圧を中心に正負の映像信号を対称にリミッタをかけることで、液晶パネルのコントラストの低下や焼き付き（残像）のない理想的なリミッタ動作が可能となる。
【０００６】
【発明が解決しようとする課題】
しかしながら、従来技術では、一定周期間隔（例えばフレーム周期）での映像信号が近い場合にはその平均電圧もほぼ等しくなり、リミット値を越える部分をスライスして正、負の映像信号を対称としても入力映像信号をほぼ忠実に再現できるが、極端に階調の異なるような場合（例えば白データと黒データ）には、入力映像信号を再現できないという問題がある。
【０００７】
更に、一定周期間隔（例えばフレーム周期）の画素単位で、正、負の映像信号に対する平均電圧を求める必要があり、高速動作可能な回路を必要とするという問題がある。
【０００８】
本発明の目的は、液晶表示装置において、特に毎フレーム異なる映像データが入力されるような環境において、液晶パネルに定常的な直流電圧が印加されないようにして残像（焼き付き）のない良好な表示状態を得るための液晶表示装置を提供することにある。
【０００９】
本発明の他の目的は、液晶表示装置において、高価な部品を用いることなく残像を発生させない液晶表示装置を提供することにある。
【００１０】
本発明の他の目的は、液晶表示装置において、特にＶＴＲ等の外部装置から供給される動画データの再生中にポーズした場合にも残像を発生することなく、良好な表示を得られる液晶表示装置を提供することにある。
【００１１】
【課題を解決するための手段】
すなわち、本発明は液晶表示装置において、テレビ放送、ビデオ再生、パソコンなど映像信号源から入力される映像情報の状態を検出し、任意の間隔に対する該映像情報の比較結果を求め、液晶パネルに定常的な直流電圧が印加されると判断される該比較結果を得た場合には、この定常的な直流電圧を分散し、液晶パネルの残像（焼き付き）発生を防止するような交流化駆動信号制御を行うようにしたものである。
【００１２】
比較する該入力映像情報としては例えば、毎フレームのライン数などが一例として考えられる。すなわち、ＶＴＲ等から供給される動画データを表示中にポーズ機能を動作させると、映像情報の長さが各フレーム毎に長短を繰り返すことが知られているが、このような毎フレームのフレーム内ライン数が異なる場合、特定ラインの表示データが隣接フレーム間で異なり、２フレーム毎に一致するようになる。これに対し、液晶の交流化をドット反転フレーム交流駆動とした場合、定常的な直流電圧を液晶パネルに印加することになるため、これを防ぐために定常的な直流電圧を分散するような交流化駆動制御を行うものである。
【００１３】
即ち、映像信号発生装置からの入力映像情報を液晶パネルに表示する液晶表示装置において、過去の入力映像情報の１フレームの垂直方向のライン数と現行の入力映像情報の１フレームの垂直方向のライン数を比較しその相違の有無を判断する比較回路と、前記液晶パネルに対する直流電圧の印加を防止するため第１の周期の交流化信号を出力する第１の駆動回路と、前記第１の駆動回路とは異なる第２の周期の交流化信号を出力する第２の駆動回路とを有し、前記比較回路の比較結果に従って、前記第１の駆動回路及び第２の駆動回路からそれぞれ出力される前記第１の周期の交流化信号と前記第２の周期の交流化信号とのいずれかを選択して出力する選択回路を備えて構成した。
【００１４】
【発明の実施の形態】
以下、本発明の一実施例を図面を用いて詳細に説明する。
【００１５】
図１において、0101はパソコン（以下、ＰＣと称す）、テレビ放送（以下、ＴＶと称す）、ビデオ・テープ・レコーダー（以下、ＶＴＲと称す）などからの入力映像信号、0102は入力映像信号 0101を表示するための液晶表示装置、0103は前記入力映像信号 0101を取り込んで、映像フォーマット変換、コントラスト、輝度などの画質調整、アナログ−デジタル変換、色数変換及び、表示サイズ変換などを行う映像処理回路、0104は映像処理回路 0103により各種処理を施されたデジタル映像信号、0105はデジタル映像信号を入力とした液晶モジュール、0106は液晶モジュール 0105内に設けられ、表示タイミングを生成するドライバー制御回路部、0107はドライバー制御回路 0106内に設けられ、液晶パネル 0112の交流化を行う交流化制御回路部、0108は交流化制御回路部 0107より出力される交流化駆動信号、0109は交流化駆動信号 0108を除く液晶ドライバー制御信号、0110はデータ・ドライバー、0111はゲート・ドライバー、0112は液晶パネルを各々示す。
【００１６】
以下、図１を用いて本発明による第1の実施例についての全体動作を説明する。
【００１７】
まず、液晶表示装置 0102内部の映像処理回路部 0103は、ＰＣ、ＴＶ、ＶＴＲなどからの入力映像信号 0101を取り込む。映像処理回路部 0103では取り込んだ入力映像信号 0101に対し各種処理を施す。処理内容の一例としては、まず、アナログ入力映像信号をデジタル映像信号に変換、インターレース形式の映像信号をノン・インターレース形式に変換、液晶パネル 0112の表示サイズに合わせた拡大処理、コントラスト比向上を行うための階調補正、更には、多階調表示を行うための色数変換処理などが考えられる。映像処理されたデジタル映像信号 0104は液晶モジュール 0105内部のドライバー制御回路 0106に入力され、データ・ドライバー 0110及び、ゲート・ドライバー 0111に必要なタイミングに変換及び、制御信号を生成し出力する。ドライバー制御回路部 0106内部は、液晶パネル 0112の交流化に必要な交流化制御回路部 0107と、それ以外の制御部より構成する。データ・ドライバー 0110には表示データ、タイミング信号 0109を出力し、ゲート・ドライバー 0111には交流化制御回路部 0107より出力される交流化駆動信号 0108を含む制御信号が出力される。ここで、交流化駆動信号 0108はデジタル映像信号 0104の状態を検出し、液晶パネル 0112に定常的な直流電圧が印加して、残像（焼き付き）が発生しないような駆動信号を出力する。
【００１８】
図２にデジタル映像信号 0104の状態を検出し、交流化駆動信号 0108の動作を制御するための構成を示す。つまり、交流化制御回路部0107は、入力される１フレーム内のライン数を常時検出し、隣接フレーム間での比較結果に従って液晶パネル 0112に定常的な直流電圧が印加されないように、交流化駆動信号 0108を制御するものである。
【００１９】
図２において、0201はデジタル映像信号 0101に含まれる垂直同期信号、0202は同じく水平同期信号、0203は隣接フレーム間における垂直同期信号のライン数を検出し、その一致、不一致を判定するフレームライン数比較制御部、0204はフレームライン数検出制御部 0203に内包するフレームライン数検出制御部、0205はフレームライン数検出制御部 0204から出力されるフレームライン数検出結果、0206はフレームライン数検出結果 0205を保持するラッチ回路部、0207はラッチ回路部 0206の出力である１フレーム前フレームライン数、0208はフレームライン数検出結果 0205と、１フレーム前フレームライン数 0207との比較回路部、0209は比較回路部 0208による比較結果である。
【００２０】
0210は交流化駆動信号 0108を生成する交流駆動信号生成部、0211は交流駆動信号生成部 0210内に設けられ、駆動信号 0108の１つ目のタイミング信号を生成する駆動回路Ａ部、0212はその出力である駆動回路Ａ出力、0213はもう１つのタイミング信号を生成する駆動回路Ｂ部、0214はその出力である駆動回路Ｂ出力、0215は比較結果 0209に従って、駆動回路Ａ出力 0212もしくは、駆動回路Ｂ出力 0214のいずれかを選択するセレクタ回路部（選択回路）を各々示す。
【００２１】
フレームライン数検出制御部（ライン数検出回路）0204は水平同期信号 0202をクロックとして、隣接する垂直同期信号 0201間のクロック数をカウントする。１フレーム期間の水平同期信号 0202のカウント結果 0205は比較回路部 0208に出力すると共に、１フレーム遅延させてラッチ回路 0206で保持する。従って、フレームライン数比較回路部 0208では、現行フレームに対するフレームライン数検出結果 0205と、現行フレームに対し、１フレーム前のフレームライン数であるラッチ回路部 0206の出力データ 0207を比較する。比較の結果、現行フレームと1フレーム前のフレームライン数が一致と判断された場合には、駆動回路Ａ 0211からの出力交流駆動信号 0211を、不一致と判断された場合には、駆動回路Ｂ 0213からの出力交流駆動信号 0214をセレクタ回路部 0215は選択し、交流化駆動信号 0108として液晶パネル 0112に出力する。本実施例では、フレームライン数の比較結果において、一致の場合には液晶パネル 0112への定常的な直流電圧の印加はなく、通常の交流化駆動信号である駆動回路Ａ 0211の出力 0212を選択し、不一致の場合には定常的な直流電圧が印加される可能性があるため、これを分散するような交流化駆動信号である駆動回路Ｂ 0213の出力 0214を選択するものである。
【００２２】
次に、交流駆動回路Ａ 0211及び、交流化駆動回路Ｂ 0213の一実施例について、液晶パネルへの直流電圧印加原因と共に説明する。図３は入力映像信号と交流化駆動信号による液晶パネル印加電圧の概略図である。図３では説明を容易にするために、デジタル映像信号 0104はフレーム毎の特定の画素に注目したのもと見なす。
【００２３】
フレーム毎（ここではフレーム１〜フレーム４）のデジタル映像信号 0104が同じ場合（図３では高階調データ（白））、このデジタル映像信号 0104にフレーム毎に正、負極性を反転する交流化駆動信号 0108を重畳すると、絶対値が等しく、フレーム毎に正、負極性が反転する電圧が液晶パネルに印加されるため、お互いが打ち消し合い定常的な直流電圧の印加は発生しない。従って、残像（焼き付き）の無い良好な表示が行われる。
【００２４】
図４は同じく、入力映像信号と交流化駆動信号による液晶パネル印加電圧の概略図である。この場合、入力されるデジタル映像信号 0104は１フレーム毎に異なり、２フレーム毎に同じとなるようなものである（フレーム１、３→高階調データ（白）／フレーム２、４→低階調データ（黒））。このようなディジタル映像信号は特にＶＴＲ等から供給される映像データが各フレーム毎に長短を繰り返すこと、より具体的にはポーズ動作の際に、このデジタル映像信号 0104にフレーム毎に正、負極性を反転する交流化駆動信号 0108を重畳すると、正極性側の実効値が負極性側の実効値に比べ一定のレベルで大きいため、定常的な直流電圧が印加されることになり、残像（焼き付き）の発生を引き起こす。
【００２５】
図５に、図４に示したようなデジタル映像信号の発生により残像（焼き付き）が発生する液晶表示システムの一例を示す。図５において、0501は映像信号源の１つであるＶＴＲ、0502はＶＴＲ 0501より出力される同期信号を含む映像信号情報、0503はＶＴＲ 0501からの映像信号情報 0502を液晶パネルに表示するためにマルチスキャン処理制御などを行う液晶インターフェース制御部、0504は液晶インターフェース制御部より出力される液晶モジュール用映像信号情報を各々示す。
【００２６】
図５において、ＶＴＲ 0501はその機種により出力する映像信号情報が若干異なる。例えば、ＶＴＲ 0501は一旦停止状態にすると、出力する映像信号情報 0502は垂直方向にぶれを生じることがある。このぶれが１フレーム毎に１ライン間隔で発生すると、隣接ライン間の映像データのコントラスト比が大きい場合（例えば水平方向に対する白色と、黒色の境界部分）、その境界部分での特定画素に注目すると、フレーム毎に高階調（白色）、低階調（黒色）を繰り返す。この情報が液晶インターフェース制御部 0503に入力される。液晶インターフェース制御部 0503では、アナログ／デジタル変換（以下、Ａ／Ｄ変換と称す）、マルチスキャンなどの処理を行うが、この処理にフレームメモリを使用しない場合、ＶＴＲ 0501からの１フレーム毎に１ライン間隔で発生するぶれを有する映像情報は、そのままぶれた状態で液晶モジュール用映像信号情報 0504として出力され、液晶モジュール 0105に与えられる。すなわち、図４に示すようなデジタル映像信号 0104が液晶モジュール 0105に与えられることになる。
【００２７】
図６に交流駆動信号生成部 0210内部の駆動回路Ａ 0211の一例に対する動作説明図を示す。本駆動方式は、水平、垂直方向共に隣接画素間で電圧極性が反転し、更にそれらが全て隣接フレーム間で反転する“ドット反転＋フレーム交流（２フレーム完結）駆動方式”である。この駆動方式において、図５に示すような液晶表示システムによる映像信号情報が入力されると、図４に示すように定常的な直流電圧が印加され、液晶パネル 0112の残像（焼き付き）を引き起こすことになる。
【００２８】
図７に交流駆動信号生成部 0210内部の駆動回路Ｂ 0213の一例に対する動作説明図を示す。本方式は、垂直方向については２ライン毎に極性反転させ、水平方向については毎ドット極性反転させる。更にフレーム毎に垂直方向に１ラインシフトさせるため、４フレーム毎に同じ極性となる“２ラインドット反転＋２フレーム交流（４フレーム完結）駆動方式”である。
【００２９】
図８に本駆動方式において、図５に示すような液晶表示システムによる映像信号情報が入力された場合に対する液晶パネル 0112への印加電圧の様子を示す。
【００３０】
本駆動方式によれば、入力されるデジタル映像信号 0104に対し、２フレーム毎に交流化駆動信号の極性を反転するため、４フレーム周期で見た場合に液晶パネル印加電圧はお互いが打ち消し合い、定常的な直流電圧の印加は発生しない。従って、残像（焼き付き）の無い良好な表示が行われる。ここで、図５に示したような液晶表示システムにおいて、垂直方向にぶれがあり、図４に示したようなデジタル映像信号 0104が入力された場合に、図７に示す駆動方式Ｂで駆動すれば液晶パネル 0112は残像（焼き付き）のない良好な表示を実現することができる。すなわち、図２に示す交流化制御回路 0107において、図５に示すタイミング図のような垂直同期信号のぶれに伴うフレームライン数の一致、不一致を検出し、一致した場合には入力されている映像情報は図３の状態にあるものと判断し、駆動回路Ａ 0211による図６に示した“ドット反転＋フレーム交流（２フレーム完結）駆動方式”で制御する。一方、不一致の場合には入力されている映像情報は図４の状態にあるものと判断し、駆動回路Ｂ 0214による図７に示した“２ラインドット反転＋２フレーム交流（４フレーム完結）駆動方式”で制御することで常時残像（焼き付き）の無い良好な表示状態を得ることができる。
【００３１】
次に、同じく第１の実施例の図５に示す液晶表示システムの液晶インターフェース制御部 0503の構成として、フレームメモリを搭載した場合の動作について説明する。図９にフレームメモリを用いた液晶インターフェース制御部を搭載した液晶表示システムの一例を示す。
【００３２】
図９において、ＶＴＲ 0501とその出力である映像信号情報 0502及び、液晶モジュール 0105は図５と同一である。0901はＶＴＲ 0501からの映像信号情報 0502を液晶パネルに表示するためのマルチスキャン処理制御などをフレームメモリを用いて行う液晶インターフェース制御部、0902は液晶インターフェース制御部より出力される液晶モジュール用映像信号情報を各々示す。
【００３３】
図９において、ＶＴＲ 0501がポーズ状態などにより、その出力である映像信号情報 0502にぶれを生じているような場合、液晶インターフェース制御部 0901にはぶれた状態での映像信号情報 0502が入力される。しかし、液晶インターフェース制御部 0901はフレームメモリを搭載しており、ぶれた状態の映像信号情報 0502は一旦1画面分全てフレームメモリに格納されるため、この液晶インターフェース制御部 0901の入出力間を完全非同期の状態で制御する。この場合出力である液晶モジュール用映像信号情報 0902の垂直同期信号は図９のタイミング図に示すように、ぶれの無い安定した状態となる。すなわち、交流化制御回路 0107でのフレーム周波数検出結果は常に安定した状態となり、交流駆動信号 0108としては、駆動回路Ａ 0211の出力である“ドット反転＋フレーム交流（２フレーム完結）駆動方式”が選択された状態となる。従って、液晶パネルに与えられる映像信号が、ＶＴＲ 0501からの出力そのままであると、図４に示すように定常的な直流電圧が印加され、残像（焼き付き）を発生することになる。しかし、フレームメモリを用い、一旦1画面分の映像信号を格納し、入出力を非同期制御する液晶表示システムでは、液晶パネルに印加する直流電圧は分散され、残像（焼き付き）は発生しない。
【００３４】
図１０にフレームメモリを用いた液晶表示システムでの直流電圧分散の原理を示す。図１０において、フレームメモリとしては、２フレーム分（フレームメモリＡ、Ｂ）備え、片方のメモリにＶＴＲ 0501からの映像信号を書き込んでいる間は、もう片方のメモリから映像信号を読み出して、液晶モジュール 0105へ出力する。一般的にフレームメモリは安定した表示を行うために、液晶モジュール 0105への読出し動作を優先する。従って、図１０に示すように、ＶＴＲ 0501からの入力映像データは読出しのタイミングに合わせて書き込むメモリＡ、Ｂを切替えるため、1画面分の映像データが２つのメモリに分割して格納される。また、この分割して格納される1画面分の表示データは、入出力フレーム周波数の差によって毎フレーム格納位置がずれる。
【００３５】
図１１に図９及び、図１０に示すフレームメモリを用いた液晶表示システムによる液晶パネル 0112への印加電圧の様子を示す。図１１に示すように、交流駆動信号 0108はフレーム周波数検出結果が常に安定状態であるため、駆動回路Ａ 0211の出力である“ドット反転＋フレーム交流（２フレーム完結）駆動方式”が選択される。しかし、この交流駆動信号 0108が印加されるデジタル映像信号 0104は、図１０に示すように、特定位置の画素に注目すると、毎フレーム異なるため（すなわち、残像（焼き付き）が発生する状態である隣接フレーム間で異なり、２フレーム毎に同一データとなる状態が発生しない）、定常的な直流電圧の印加が発生せず分散された状態となるため、残像（焼き付き）は発生しない。
【００３６】
上記実施例では、ＶＴＲ 0501のポーズ状態において、１ラインのぶれが毎フレーム発生した際の残像（焼き付き）回避方法について述べた。しかし、実際のぶれは毎フレーム発生するとは限らず、２フレーム、３フレーム、Ｎフレーム毎に発生することが考えられる。
【００３７】
図１２に２フレーム毎にぶれが発生した際の液晶パネル 0112への印加電圧の様子を示す。図１２に示すように、２フレーム毎にぶれが発生する場合においても、２フレーム毎に直流電圧はキャンセルされ、定常的な直流電圧の印加は発生しない。本例の場合、図８の１ラインのぶれが発生する例に対し、４フレーム毎の第２フレームと、第３フレームの液晶パネル印加信号が逆転した状態である。
【００３８】
図１３に図１２に示した２フレーム毎にぶれが発生する場合に“ドット反転＋フレーム交流（２フレーム完結）駆動方式”を適用した際の液晶パネル 0112への印加電圧の様子を示す。図１３において、液晶パネルに印加される電圧は、２フレーム完結でキャンセルされ定常的な直流電圧の印加は発生しない。すなわち、２フレーム毎にぶれが発生するような場合には、図１２に示したような“２ラインドット反転＋２フレーム交流（４フレーム完結）駆動方式”、または、図１３に示したような“ドット反転＋フレーム交流（２フレーム完結）駆動方式”のいずれの方式においても、定常的な直流電圧の印加を回避でき、残像（焼き付き）の無い良好な表示を実現可能である。通常液晶にとって交流駆動は、毎フレーム極性を反転させるのが望ましく、同極性を連続させることはフリッカーなどの原因となるため、“ドット反転＋フレーム交流（2フレーム完結）駆動方式”を採用する。
【００３９】
従って、本例の場合、いずれの交流化駆動方式においても、残像（焼き付き）は回避可能であるが、その他の表示性能への影響を考慮した場合、“ドット反転＋フレーム交流（２フレーム完結）駆動方式”での駆動が望ましい。この制御を実現するためには、図２に示したフレーム内ライン数比較制御部 0203において、隣接する２つのフレーム間のライン数を比較するだけでなく、離れたフレームに対する比較判定を行うことで実現可能である。
【００４０】
図１４に本制御を実現する交流化制御回路の概略構成図を示す。図１４において、1401は垂直同期信号 0201任意フレーム間のフレームライン数を検出し、その一致、不一致を判定するフレームライン数比較制御部、1402はフレームライン数検出制御部 1401に内包するフレームライン数検出制御部、1403はフレームライン数検出制御部 1402から出力されるフレームライン数検出結果、1404はフレームライン数の検出周期を決めるフレームライン数検出周期設定値、1405はフレームライン数検出周期設定値 1404に対応したフレームライン数検出周期を求めるライン数検出周期制御部、1406はライン数検出周期制御部 1405より出力される、フレームライン数検出周期毎のフレームライン数取り込み信号、1407はフレームライン数検出結果 1403をフレームライン数検出周期毎に取り込み保持するラッチ回路部１、1408はラッチ回路部１ 1407により保持されたフレームライン数検出結果、1409は保持されたフレームライン数検出結果 1408をフレームライン数検出周期だけ遅延させて保持するラッチ回路部２、1410はラッチ回路部２ 1409により保持されたフレームライン数検出結果、1411は２つのフレームライン数検出結果 1408、1410の比較を行う比較回路部、1412は比較回路部 1411による比較結果を各々示す。また、その他の機能については、図２に示したものと同一である。
【００４１】
まず、ライン数検出周期設定値 1404によってラッチ回路部１ 1407及び、ラッチ回路部２ 1409に取り込むフレームライン数検出結果 1403、1408のフレーム周期を設定する。ライン数検出周期制御部 1405では、このライン数検出周期設定値 1404に従ったフレーム周期毎に検出ライン数取り込み信号 1406を出力する。従って、ラッチ回路部１ 1407はライン数検出周期設定値 1404毎の周期でフレームライン数 1403を取り込み、ラッチ回路部２ 1409は同じくライン数検出周期設定値 1404毎の周期でフレームライン数 1408を取り込む。すなわち、２つのフレームライン数検出結果 1408、1410の間は、フレームライン数検出周期設定値 1404に従った間隔となる。この周期間隔でのフレームライン数の比較を比較回路部 1409で行う。
【００４２】
【表１】
0003760743.tif 000002
【００４３】
に図１４の交流化制御回路によるアルゴリズムの一例を示す。表１では、入力映像信号のぶれ発生周期が１フレーム毎及び、２フレーム毎について示したものである。まず１フレーム毎のぶれ発生の場合、フレームライン数検出周期設定値が“１”の場合において、いずれの隣接フレーム間においても入力映像データに対するフレームライン数が不一致（ＡｔｏＢもしくは、ＢｔｏＡ）となる。従って、この時点で入力映像信号のぶれが１フレーム毎（毎フレーム）に発生していると判断可能である。次に、２フレーム毎のぶれ発生の場合、まずフレームライン数検出周期設定値が“１”の場合において、隣接フレーム間で入力映像データに対するフレームライン数が一致の場合（ＡｔｏＡもしくは、ＢｔｏＢ）と、不一致の場合（ＡｔｏＢもしくは、ＢｔｏＡ）の両ケースがある。このように、一致と不一致が混在の場合にはぶれ周期が更に大きいものと判断し、ライン数検出周期設定値 1404の値を＋１加算する。すなわち、ライン数検出周期設定値が“２”となり、１フレームおきの比較となる。この場合、いずれの比較においても不一致（ＡｔｏＢもしくは、ＢｔｏＡ）となり、この時点で入力映像信号のぶれが２フレーム毎に発生していると判断可能である。これにより、入力映像信号のぶれ周期に合わせて、最適な交流化駆動を行うことが可能である。表１では、映像信号のぶれ発生周期として１及び、２フレームのみについて記述したが、本方式によれば任意のＮフレーム毎のぶれに対し、ライン数検出周期設定値を順次加算しながら比較することでその周期を検出し、最適な交流化駆動を行うことが可能である。
【００４４】
更に、ぶれは１ラインとは限らず、Ｎラインのぶれが発生する場合、また、常にランダムなぶれが発生する場合などが考えられる。Ｎラインのぶれに対しては、比較する２フレームの各ライン数の時間的な隔たりだけであり、特定の位置の画素に注目すれば上記実施例と同じ状態となるため、同じ処理で対処可能である。
【００４５】
一方、常にランダムなぶれに対しても、図９に示したフレームメモリを用いたシステムの場合と同様、液晶パネルに印加される直流電圧は分散されることとなるため、定常的な直流電圧の印加は無く、残像（焼き付き）は発生しない。
【００４６】
図１５は本発明技術による液晶駆動制御方法を用いた液晶表示システムの第２の実施例を示す構成図である。本実施例では入力映像信号として、第１の実施例に示したＶＴＲ、ＴＶ放送などのインターレース形式の信号を想定したものである。ドライバー制御回路部 0106を有する液晶モジュール 0105は第1の実施例で説明したものと同じである。インターレース形式の映像信号を液晶パネル 0112に表示するために、映像処理回路部 0103内部で、ノンインターレース化処理が必要となる。
【００４７】
図１５において、1501は入力されたアナログ映像信号をデジタル映像信号に変換するＡ／Ｄ変換処理回路部、1502はＡ／Ｄ変換処理回路部 1501でのサンプリングクロックを生成するＰＬＬ回路部、1503はサンプリングクロック、1504はデジタル化されたインターレース形式映像信号、1505はインターレース形式の映像信号をノンインターレース形式に変換する２ライン走査処理回路、1506は１ライン遅延した映像信号を生成するラインメモリ、1507はラインメモリ 1506に対するライト／リードデータ、1508は２ライン走査処理回路 1505より出力されるノンインターレース形式映像信号、1509は液晶パネル 0112の表示エリアに合わせて映像信号の拡大・縮小処理を行うマルチスキャン処理回路部、1510はマルチスキャン処理に必要なフレームメモリ、1511はフレームメモリ 1510に対するライト／リードデータを各々示す。
【００４８】
まず、入力される映像信号 0101はインターレース形式であり、一例として１フレームが５２５ラインである形式（以下、５２５Ｉ形式と称す）について述べる。
【００４９】
入力される映像信号 0101は偶数フィールドと、奇数フィールドが交互に入力される。各フィールドデータは各々、偶数ライン、奇数ラインのデータに分離されている。これをＡ／Ｄ変換処理回路部 1501で、ＰＬＬ回路部 1502からのサンプリングクロック 1503を用いて、デジタル映像信号 1504に変換し、２ライン走査処理回路 1505に入力する。２ライン走査処理回路 1505ではラインメモリ 1506との間でライト／リードデータ 1507により、ノンインターレース形式の映像信号 1508を次段のマルチスキャン処理回路 1509に出力する。マルチスキャン処理回路 1509ではフレームメモリ 1510との間でライト／リードデータ 1511により、拡大もしくは縮小されたデジタル映像信号 0104を出力する。ここで、２ライン走査処理回路 1505より出力されるノンインターレース形式の映像信号 1508について詳細に述べる。
【００５０】
図１６はインターレース形式映像信号 1504と、２ライン走査処理回路 1505及び、ラインメモリ 1506によって変換されるノンインターレース形式映像信号 1508のタイミング図を示す。図１６では一例として、奇数フィールドの入力映像信号 1504の処理について示した。
【００５１】
１ライン毎の入力映像信号 1504は入力と同時にラインメモリ 1506に書き込まれる。入力映像信号 1504の休止期間である偶数ラインにおいて、ラインメモリ 1506より前ラインで書き込んだ映像信号を読み出す。書き込みと読出しは１ライン交互に行えばよいため、ラインメモリの搭載容量は１ライン分でよい。出力映像信号 1508は入力映像信号 1504と、ラインメモリからの読出しデータ 1507を交互に出力することで、ノンインターレース形式とすることができる。偶数フィールドについても同じ処理が適用可能である。
【００５２】
図１７は図１５及び、図１６に示した２ライン走査処理回路によるノンインターレース化の表示一例を示す。図１７では説明を簡素化するために、一画面を５ライン構成とし、ライン１からライン３が低階調データ（黒データ）、ライン４、ライン５が高階調データ（白データ）の場合を示す。
【００５３】
この原映像信号（図１７左側の図）がＴＶ映像信号としてインターレース形式で図１５に示す映像処理回路 0103に入力されると（図１７中央の図）、図１６のタイミング図に従って、２ライン走査処理回路 1505でノンインターレス形式の映像信号に変換される（図１７右側の図）。この変換後偶数フレーム及び、奇数フレーム各映像信号の４ライン目に着目すると高階調データ（白データ）と、低階調データ（黒データ）がフレーム毎に繰り返される。これは、図４に示した入力映像信号と同じ状態であり、同図４に示す“ドット反転＋フレーム交流（２フレーム完結）駆動”での制御を行うと定常的な直流電圧が印加され、残像（焼き付き）が発生することになる。図１７の例では、４ライン目に横筋の残像が発生する。
【００５４】
しかし、図１５に示す本発明による交流化制御回路 0107を搭載した場合、図１７に示すような映像信号 0104が入力されると、１フレーム内のライン数は偶数フィールドで２ライン、奇数フィールドで３ラインと計測され、ライン数が異なるとの判断により、交流化駆動方式を“２ラインドット反転＋２フレーム交流（４フレーム完結）駆動”に切替える。すなわち、図８に示した入力映像信号と交流化駆動信号による液晶パネル印加電圧と同じ状態となり、定常的な直流電圧は印加されず、残像（焼き付き）の無い良好な表示が可能である。
【００５５】
つまり、ＴＶ、ＶＴＲなどの５２５Ｉ形式の映像信号も同様に、総ライン数が奇数であるため、偶数フィールド、奇数フィールドのいずれかが１ライン多く検出され、“２ラインドット反転＋２フレーム交流（４フレーム完結）駆動”に切替わり、残像（焼き付き）の無い良好な表示が可能である。
【００５６】
図１８に一般に知られているインターレス形式のＴＶ映像信号を、ノンインターレース形式に変換する際に用いられる３次元Ｉ−Ｐ変換機能を搭載した液晶表示システムの一例を示す。図１８において、1801は偶数、奇数フィールド間及び、同一フィールド内のライン間映像データを用いてインターレース形式の映像信号を、ノンインターレース形式の映像信号に変換する3次元Ｉ−Ｐ変換処理回路部、1802は3次元Ｉ−Ｐ変換処理回路部 1801に対し、映像の動き検出量などの各種パラメータ制御を行うマイコン、1803は3次元Ｉ−Ｐ変換処理回路部 1801及び、マイコン 1802間を接続するマイコンバス、1804は入力される偶数及び、奇数フィールド・インターレース形式の映像信号を格納するフィールドメモリ、1805は3次元Ｉ−Ｐ変換処理回路部 1801及び、フィールドメモリ 1804間で読み書きされる偶数及び、奇数フィールド・インターレース形式の映像信号を各々示す。
【００５７】
図１９に3次元Ｉ−Ｐ変換処理回路の基本動作図を示す。図１８、図１９において、奇数フレーム、偶数フレーム共に制御は同じであり、例えば奇数フレームの処理においては、３フィールド分のフィールドメモリ 1804に旧奇数フィールド映像信号、偶数フィールド映像信号、新奇数フィールド映像信号を各々格納する。各々は記述の順番で隣接しているフィールドである。この３フィールド分の映像信号において、表示映像の奇数ラインは、新旧奇数フィールド間で比較を行い、一致と判断した場合には新奇数フィールドの該当奇数ラインの映像信号を表示する映像信号として出力する（ライン１及び、ライン５）。不一致と判断した場合には間の偶数フィールド内の上下ラインの映像信号を演算して該当奇数ラインの映像信号として出力する（偶数フィールドのライン２及び、ライン４より表示映像のライン３を生成）。表示映像の偶数ラインは、偶数フィールドの該当する偶数ラインの映像信号を表示映像として出力する。偶数フレームについても同様の制御を施す。ここで、一致／不一致の判定は、マイコン 1802により設定される動き検出量に依存する。奇数及び、偶数フレームのノンインターレス形式の表示映像信号において、一致と判断されたラインは同じデータとなるため、交流化駆動方式が“ドット反転＋フレーム交流（２フレーム完結）駆動”においても、図３に示す状態となるため、残像（焼き付き）は発生しない（ライン１、ライン２、ライン５）。不一致と判断された場合には、フレーム間で映像信号が異なるが、動画の場合フィールド毎に映像信号が異なるため、表示映像も毎フレーム異なった映像信号となり、図１１に示す直流電圧が分散された状態と同じため、一致の際同様に交流化駆動方式が“ドット反転＋フレーム交流（２フレーム完結）駆動”においても、残像（焼き付き）は発生しない（ライン３、ライン４）。但し、第１の実施例ＶＴＲポーズ時のぶれように、規則的な動きをする映像信号に対しては、図１９に示す奇数フレーム表示映像と、偶数フレーム表示映像が交互に液晶パネルに与えられるため、動き検出量の設定値によっては、原映像信号と、上下ライン間で演算により生成される映像信号の階調差が大きくなり、図４に示す状態となり残像（焼き付き）が発生することになる（ライン３、ライン４）。
【００５８】
従って、３次元Ｉ−Ｐ変換処理回路を搭載した場合、通常の映像信号（インターレース形式、ノンインターレース形式、静止画、動画を問わず）では、図６に示す“ドット反転＋フレーム交流（２フレーム完結）駆動”で残像（焼き付き）は発生しないが、第１の実施例ＶＴＲポーズ時のぶれように、規則的な動きをする映像信号に対しては残像（焼き付き）が発生するため、図７に示す“２ラインドット反転＋２フレーム交流（４フレーム完結）駆動”に切替える必要がある。
【００５９】
【表２】
0003760743.tif 000003
【００６０】
に図１５に示した２ライン走査処理回路部と、図１８に示した３次元Ｉ−Ｐ変換回路部の部材コスト概算値を示す。３次元Ｉ−Ｐ変換回路方式では、不規則な動きをするインターレース形式の映像信号を、図６に示す“ドット反転＋フレーム交流（２フレーム完結）駆動”を用いて残像（焼き付き）の無い良好な表示が行えるという利点はあるが、部材コストでは、２ライン走査処理回路方式の約３倍を必要とする。
【００６１】
図２０は本発明技術による液晶駆動制御方法を用いた液晶表示システムの第３の実施例を示す構成図である。本実施例では図２に示す２つの駆動方式（駆動回路Ａ 0211及び、駆動回路Ｂ 0213）の切換え方法について、更に拡張したものである。
【００６２】
図２０において、2001はVSYNCより成る制御信号Ｂ 0202を有効とするか、無効とするかを制御する制御Ｂ信号イネーブル制御部、2002は制御Ｂ信号イネーブル制御部 2001より出力される制御Ｂイネーブル信号、2003はフレームライン数検出制御部 0203より出力される制御信号Ａもしくは、制御信号Ｂを選択するセレクタ回路、2004はセレクタ回路2003より出力される駆動回路Ａ 0211もしくは、駆動回路Ｂ 0213の選択信号を各々示す。
【００６３】
制御Ｂ信号イネーブル制御部 2001は入力垂直同期信号（ＶＳＹＮＣ） 0201及び、入力水平同期信号（ＨＳＹＮＣ） 0202の状態によって、入力垂直同期信号（ＶＳＹＮＣ） 0201からなる制御信号Ｂの選択を決定する制御Ｂイネーブル信号 2002の状態を決める。すなわち、正常に入力垂直同期信号（ＶＳＹＮＣ） 0201及び、入力水平同期信号（ＨＳＹＮＣ） 0202が入力されている場合には、制御信号Ａ 0209を選択し、そうでない場合には制御信号Ｂ 0201を選択する。
【００６４】
図２１に制御Ｂイネーブル信号 2002の動作タイミング図を示す。図２１において、入力垂直同期信号（ＶＳＹＮＣ） 0201のパルスを起点として、入力水平同期信号（ＨＳＹＮＣ） 0202をカウンタでカウントし、入力垂直同期信号（ＶＳＹＮＣ） 0201の立下り時のカウンタ値をチェックし、カウンタ値が規定範囲内であれば通常の同期信号が入力されているものと判断し、制御信号Ａ 0209を選択し、第1の実施例で述べたフレームライン数検出制御による交流駆動切換え制御を行う。規定範囲外であれば、通常の同期信号は入力されてなく、入力垂直同期信号（ＶＳＹＮＣ） 0201より成る制御信号Ｂ 0201は駆動回路Ａ 0211もしくは、駆動回路Ｂ 0213いずれかの選択信号として機能する。
【００６５】
【表３】
0003760743.tif 000004
【００６６】
に規定範囲の一例を示す。表3では、解像度がＸＧＡもしくはＳＸＧＡについて示してあり、各々のライン数が約８００ライン及び、約１１００ラインである。そこで、制御信号Ｂ 0201のイネーブル条件としてはこれらを十分満足する範囲を外れた場合として、５００ライン〜２０００ラインを外れた場合に有効となるようにした。
【００６７】
従って、図２１においてパターン１では、入力垂直同期信号（ＶＳＹＮＣ） 0201の立下り時のカウント値ｎがこの規定範囲内となり、通常の同期信号が入力されているものと判断し、制御信号Ａ 0209を選択して第1の実施例に示したフレームライン比較制御による交流化駆動切換え制御を行う。パターン２では入力垂直同期信号（ＶＳＹＮＣ） 0201が常時“Ｌ”レベルの場合である。この場合カウンタは常時クリア状態となる。更に、カウンタ値をチェックする入力垂直同期信号（ＶＳＹＮＣ） 0201の立下りエッジが無いため、チェック結果は常時初期値のゼロである（ここで、カウンタのチェック値の初期値はゼロと規定する）。従って、表３の条件範囲外となり、制御Ｂイネーブル信号 2002は記入力垂直同期信号（ＶＳＹＮＣ） 0201から成る制御信号Ｂを選択する。この信号が“Ｌ”レベルであるため、駆動回路Ａ 0211を選択することになる。
【００６８】
同様にパターン３ではカウンタはクリアされずフリーラン状態となりまた、カウンタ値をチェックする入力垂直同期信号（ＶＳＹＮＣ） 0201の立下りエッジが無いため、チェック結果は常時初期値のゼロである。従って、表３の条件範囲外となり、制御Ｂイネーブル信号 2002は記入力垂直同期信号（ＶＳＹＮＣ） 0201から成る制御信号Ｂを選択する。この信号が“Ｈ”レベルであるため、駆動回路Ｂ 0213を選択することになる。
【００６９】
以上のように本実施例によれば、入力垂直同期信号（ＶＳＹＮＣ） 0201及び、入力水平同期信号（ＨＳＹＮＣ） 0202の機能を兼用化することにより、2種類の交流化切換え制御を持たせることが可能である。
【００７０】
本実施例を適用した液晶表示システムの一例としては、図１、図１５及び、図１８に示した液晶表示システム 0102の映像処理回路 0103と液晶モジュール 0105間のデジタル映像信号 0104のインターフェース仕様として、汎用性のあるＬＶＤＳを採用することが可能である。この場合、入力垂直同期信号（ＶＳＹＮＣ） 0201及び、入力水平同期信号（ＨＳＹＮＣ） 0202が通常の同期信号として動作する場合には、交流化駆動はフレームライン数比較制御による液晶モジュール側の自動制御となる。
【００７１】
また、液晶モジュール 0105内のドライバー制御回路 0106を入力垂直同期信号（ＶＳＹＮＣ） 0201及び、入力水平同期信号（ＨＳＹＮＣ） 0202を用いず、表示有効期間信号のみで制御可能とすれば、入力垂直同期信号（ＶＳＹＮＣ） 0201及び、入力水平同期信号（ＨＳＹＮＣ） 0202は交流化駆動選択信号とすることができ、交流化駆動を表示システム側から任意に制御することが可能である。
【００７２】
以上、本発明によれば、あらゆる形態の映像信号に対し、入力される映像データを加工することなくまた、3次元Ｉ−Ｐ変換などの高価な機能を搭載することなく残像（焼き付き）の無い良好な表示を実現することが可能である。また、残像（焼き付き）の無い良好な表示を実現するための交流化駆動切換え制御手段を、液晶モジュール側単独での制御もしくは、システム全体での制御を併設することができ、その際のシステムがわ映像処理回路部と、液晶モジュールのインターフェースを汎用性のあるものとすることが可能である。
【００７３】
【発明の効果】
本願において開示される発明のうち、代表的なものによって得られる効果を簡単に説明すれば、以下の通りである。
【００７４】
すなわち、入力される映像信号の形態がインターレス形式、ノンインターレース形式また、動画、静止画に係わらず、あらゆる形態の入力映像信号に対し、その映像信号自体を加工するなどして再現性を損ねることなく、残像（焼き付き）の無い良好な表示状態を得ることができるという効果が得られる。
【００７５】
更に、インターレース形式の映像信号をノンインターレース形式の映像信号に変換する際に、3次元Ｉ−Ｐ変換機能など高価な部品を必要とする回路を必要とせず、偶数、奇数の各フィールド内でラインの2度読みを行う単純な回路に対し、、残像（焼き付き）の無い良好な表示状態を得ることができるため、コストが大幅に低減できるという効果が得られる。
【００７６】
更に、本発明による交流化駆動方式の切換え手段として、液晶モジュール単体での制御に加え、映像処理装置側であるシステムによる制御の併用を、ＬＶＤＳなど汎用性のあるインターフェースのみで実現できるため、製品毎の要求仕様に合わせて広い製品範囲に対する適用ができるという効果が得られる。
【図面の簡単な説明】
【図１】本発明技術を用いた液晶表示システム第１の実施例を示す構成図である。
【図２】本発明による第１の実施例に示す構成図中の交流化制御回路部の構成図である。
【図３】本発明による第１の実施例に対する映像信号が同じ場合の“ドット反転＋フレーム交流（２フレーム完結）”での液晶パネル印加電圧の概略図である。
【図４】本発明による第１の実施例に対する映像信号が１フレーム毎に異なる場合の“ドット反転＋フレーム交流（２フレーム完結）”での液晶パネル印加電圧の概略図である。
【図５】本発明による第１の実施例に対するＶＴＲを用いたシステム構成の一例を示す概略構成図である。
【図６】本発明による第１の実施例に対する“ドット反転＋フレーム交流（２フレーム完結）”の動作説明図である。
【図７】本発明による第１の実施例に対する“２ラインドット反転＋２フレーム交流（４フレーム完結）”の動作説明図である。
【図８】本発明による第１の実施例に対する映像信号が１フレーム毎に異なる場合の“２ラインドット反転＋２フレーム交流（４フレーム完結）”での液晶パネル印加電圧の概略図である。
【図９】本発明による第１の実施例に対するＶＴＲを用いたシステム構成の一例において、インターフェース制御部にフレームメモリを用いて入出力非同期化した際の概略構成図である。
【図１０】本発明による第１の実施例に対するフレームメモリを用いた液晶表示システムでの直流電圧分散動作原理図である。
【図１１】本発明による第１の実施例に対する映像信号がランダムに異なる場合の“ドット反転＋フレーム交流（２フレーム完結）”での液晶パネル印加電圧の概略図である。
【図１２】本発明による第１の実施例に対する映像信号が２フレーム毎にぶれる場合の“２ラインドット反転＋２フレーム交流（４フレーム完結）”での液晶パネル印加電圧の概略図である。
【図１３】本発明による第１の実施例に対する映像信号が２フレーム毎にぶれる場合の“ドット反転＋フレーム交流（２フレーム完結）”での液晶パネル印加電圧の概略図である。
【図１４】本発明による第１の実施例に示す構成図中の映像信号のぶれ周期を考慮した交流化制御回路部の構成図である。
【図１５】本発明技術を用いた液晶表示システム第２の実施例を示す構成図である。
【図１６】本発明による第２の実施例に対する２ライン走査処理回路により制御されるラインメモリのタイミング図である。
【図１７】本発明による第２の実施例に対する２ライン走査処理回路によるノンインターレース化表示の一例を示す。
【図１８】本発明による第２の実施例に対する一般的な３次元Ｉ−Ｐ変換機能を搭載した液晶表示システムの一構成例である。
【図１９】本発明による第２の実施例に対する一般的な３次元Ｉ−Ｐ変換機能の基本動作図である。
【図２０】本発明技術を用いた液晶表示システム第３の実施例を示す構成図である。
【図２１】本発明による第３の実施例に対する制御Ｂイネーブル信号の動作タイミング図である。
【図２２】従来技術による残像（焼き付き）防止を可能とする映像信号処理回路の一構成例である。
【符号の説明】
0101…入力映像信号  0102…液晶表示装置  0103…映像処理回路  0104…デジタル映像信号  0105…液晶モジュール  0106…ドライバー制御回路  0107…交流化制御回路部  0108…交流化駆動信号  0109…液晶ドライバー制御信号  0110…データ・ドライバー  0111…ゲート・ドライバー  0112…液晶パネル  0201…垂直同期信号  0202…水平同期信号  0203…フレームライン数比較制御部  0204…フレームライン数検出制御部  0205…フレームライン数検出結果  0206…ラッチ回路部  0207…１フレーム前フレームライン数  0208…比較回路部  0209…比較結果  0210…交流駆動信号生成部  0211…駆動回路Ａ部  0212…駆動回路Ａ出力
0213…駆動回路Ｂ部  0214…駆動回路Ｂ出力  0215…セレクタ回路部
【図１】
0003760743.tif 000005
【図２】
0003760743.tif 000006
【図３】
0003760743.tif 000007
【図４】
0003760743.tif 000008
【図５】
0003760743.tif 000009
【図６】
0003760743.tif 000010
【図７】
0003760743.tif 000011
【図８】
0003760743.tif 000012
【図９】
0003760743.tif 000013
【図１０】
0003760743.tif 000014
【図１１】
0003760743.tif 000015
【図１２】
0003760743.tif 000016
【図１３】
0003760743.tif 000017
【図１４】
0003760743.tif 000018
【図１５】
0003760743.tif 000019
【図１６】
0003760743.tif 000020
【図１７】
0003760743.tif 000021
【図１８】
0003760743.tif 000022
【図１９】
0003760743.tif 000023
【図２０】
0003760743.tif 000024
【図２１】
0003760743.tif 000025
【図２２】
0003760743.tif 000026