(57)【特許請求の範囲】
【請求項１】
クロック毎に０と１の間の小数値を有するＭ個の小数間隔を入力し、前記小数間隔からアドレスを生成して出力するアドレス生成部と、
前記Ｍ個の小数間隔に応じるＭ個のサイン関数値を格納し、前記アドレス生成部から出力されるアドレスに当たるサイン関数値を出力するメモリ手段と、
フィルターインデックス、前記小数間隔及び前記メモリ手段から出力されるサイン関数値を入力してタップ係数を計算して出力するタップ係数計算部と、
Ｌ＋１個のタップを有し、入力信号を前記計算されたタップ係数にてフィルタリングして出力するディジタルフィルターとを備え、
前記タップ係数計算部は、
前記メモリ手段から出力されたサイン関数値、前記小数間隔とフィルターインデックスを入力して、タップ係数の絶対値を生成して出力する絶対値生成部と、
前記フィルターインデックスを入力して前記タップ係数の符号を決定して出力する符号決定部とからなることを特徴とするディジタル復調器におけるタイミング補間器。
【請求項２】
前記絶対値生成部は、前記メモリ手段から読出されたサイン関数値を一時的にラッチするサインラッチ部と、
前記小数間隔とフィルターインデックスを入力して、前記二つの値を加算する加算器と、
前記加算器から出力された値にπ値を乗算する乗算器と、
前記サインバッファー部から出力されたサイン関数値を前記乗算器から出力された値で除算してタップ係数の絶対値を出力する除算器とからなることを特徴とする請求項１に記載のディジタル復調器におけるタイミング補間器。
【請求項３】
前記符号決定部では前記フィルターインデックスが０であるか、正数で偶数であるか、負数で奇数であると、"＋"符号を出力し、正数で奇数であるか、負数で偶数であると、"−"符号を出力することを特徴とする請求項１に記載のディジタル復調器におけるタイミング補間器。
【請求項４】
前記ディジタルフィルターは、
前記タップ係数の絶対値とタップ係数の符号及び前記アドレス信号を入力し、タップ係数を生成して出力するタップ係数バッファー部と、前記入力信号と前記タップ係数バッファー部から出力されたタップ係数を乗算して出力する乗算器とから構成される基本フィルタリング部と、
それぞれ入力信号に対して１乃至Ｌクロック遅延させた信号を出力するＬ個の遅延ラッチ部と、前記タップ係数の絶対値とタップ係数の符号及びアドレス信号を入力し、タップ係数を生成して格納するＬ個のタップ係数レジスタ部と、前記Ｌ個の遅延ラッチ部の出力と前記Ｌ個のタップ係数レジスタ部の出力をそれぞれ乗算し、乗算されたＬ個の値を出力するＬ個の乗算器とからなる補助フィルタリング部と、
前記補助フィルタリング部のＬ個の乗算器からそれぞれ出力された値を加算し、加算された値を前記入力信号をフィルタリングした補間信号に出力する加算器とから構成されることを特徴とする請求項１に記載のディジタル復調器におけるタイミング補間器。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は受信された変調信号をディジタル方式で復調するディジタル復調器においてシンボルタイミングを復元するタイミング復元回路に係り、特にフィルターのタップ数が(Ｌ＋１)個であり、用いられる位相値がＭ個である場合、メモリに(Ｌ＋１)×Ｍ個のタップ係数を格納する代りにＭ個のサイン関数値を格納した後、クロック毎にサイン関数値を読出して直接タップ係数を計算するタイミング補間器に関する。
【０００２】
【従来の技術】
ディジタル通信システムにおいて、受信器はチャンネルを通して伝送された変調信号を受信し、所定のサンプリングクロックにてサンプリングしてディジタル信号に変換させる。その後、送信器で用いられた変調形態に応じて該周波数及び位相を有するキャリアー信号を前記ディジタル信号から復元し、前記復元されたキャリアー信号を用いて復調を行い元の情報信号を復元する。受信器が備えるタイミング復元回路は受信器の性能に大きな影響を及ぼす正確なサンプリングクロックを決定する役割を果たす。
【０００３】
受信器の種類のうちディジタルモデムにおいて、サンプリングがデータシンボルに同期され行われる場合には、アナログモデムの場合と同様に、ローカルクロックの位相を調節してサンプリングクロックを調整するフィードバックループ(feedback loop)又は、受信された変調信号からタイミング波形を再生成してサンプリングクロックを調整するフィードフォワードループ(feedforward loop)を用いる。一方、サンプリングがデータシンボルに同期され行われない場合、すなわちサンプリングクロックがシンボルタイミングと無関係な場合には、補間(interpolation)によりタイミングを調整しなければならない。すなわち、非同期されたサンプルの間を補間して、モデムで正確なストローブ値、言い換えればサンプリングがシンボルに同期された場合に生成されるものと同一なストローブ値を生成する。ここで、補間とはローカルクロックやタイミング波形ではなく、信号に対するタイミング調整動作のことを示し、高速のディジタル信号処理を可能にする。
【０００４】
図１は一般的なディジタルタイミング復元回路を示したブロック図であり、フィードバックループを用いてタイミング復元を行う例を示したものである。前記ディジタルタイミング復元回路はサンプリングクロック発生器11と、第１サンプラ12と、補間器13と、データフィルター14と、タイミングエラー検出器15と、ループフィルター16と、制御部17とから構成される。
【０００５】
図１において、サンプリングクロック発生器11ではエイリアシング(aliasing)が発生しないＴs周期でサンプリングクロックを発生する。第１サンプラ12では帯域制限された受信信号(X(t))をサンプリングクロックに応じてサンプリングした信号(X(mTs))を生成して出力する。補間器13ではサンプリングされた信号(X(mTs))を補間間隔(Ｔi)で補間した補間信号(y(kTi))を生成して出力する。データフィルター14は補間信号(y(kTi))をフィルタリング処理して最終ストローブデータを生成して出力する。タイミングエラー検出器15はストローブデータからタイミングエラーを検出し、ループフィルター16は検出されたタイミングエラーからノイズ成分を取り除く。制御部17はフィルタリングされたタイミングエラーを用いて補間器13の動作を制御することにより、高精度のタイミング復元を行う。
【０００６】
次は、補間器13をディジタル回路で具体化するための過程を図２に基づき詳細に説明することにする。
【０００７】
図２は図１に示された補間器13の動作を説明するためのブロック図であり、補間器13はディジタル/アナログ変換器21(以下、Ｄ/Ａ変換器という)と補間フィルター22及び第２サンプラ23から構成される。図２において、第１サンプラ12(図１参照)からのサンプリングされた信号(X(mTs))はＤ/Ａ変換器21を通して再びアナログ信号(x(t))に変換された後、補間フィルター22を通してフィルタリングされ補間された信号(y(t))として出力され、再び第２サンプラ23で再サンプリングされ補間信号(y(kTi))として出力される。ここで、第２サンプラ23のサンプリング間隔、すなわち補間信号の間の間隔(Ｔi)は制御部17(図１参照)から供給される。
【０００８】
補間フィルター22のインパルス応答をｈI(t)とすると、補間フィルター22の出力ｙ(t)は下記の式１のように示される。
【０００９】
【数１】
0003858160.tif 000002
【００１０】
ここで、第２サンプラ23を通してｔ=ｋＴｉの時点でｙ(t)を再サンプリングして得られた新たなサンプル、すなわち補間信号(y(kTi))は下記の式２のように示される。
【００１１】
【数２】
0003858160.tif 000003
【００１２】
前記式２において、入力信号(x(m))と補間フィルター22のインパルス応答(hI(t))、第１サンプラ12のサンプリング間隔(Ts)及び、第２サンプラ23のサンプリング間隔(Ti)が分かっていると、式２で示される補間信号を完全にディジタル的に計算することができる。
【００１３】
次に、前記式２で用いられた変数を定義するために、ｍを信号インデックスとする場合、フィルターインデックス(Ｉ)、基準ポイントインデックス(ｍk)、小数間隔(μk)はそれぞれ下記の式３のように示される。
【００１４】
【数３】
0003858160.tif 000004
【００１５】
前記式３において、int[z]はｚを超えない最大の整数のことを示し、０≦μk <１である。ここで、小数間隔(μk )は実際の補間器13の再サンプリング間隔を調整するにおいて大事であり、制御部17から計算されて第２サンプラ23に供給される。
【００１６】
一方、第１サンプラ12の周期(Ts)と第２サンプラ23の周期(Ti)の関係からμk の変化を説明すると次の通りである。第１、TsとTiが相互約分されないと、μk は無理数になり、それぞれの補間信号を求める度に変化する。第２、TsとTiが類似な値を有しながらサンプリングがほとんど同期化されたら、μk は非常にゆっくりと変化して、量子化させると定数を有するようになる。第３、TsとTiが約分されるが相互同一でないと、μkは周期的に変動する。
【００１７】
一方、前記式２は前記式３の変数置換を通して下記の式４のように示される。
【００１８】
【数４】
0003858160.tif 000005
【００１９】
前記式４によりモデムでのディジタル補間が可能になる。式４において、補間フィルター22のインパルス応答ｈI[(i+μk)Ts] 値はフィルターのタップ係数になる。
【００２０】
一方、補間器13は遅延シフトレジスタ、乗算器及び加算器等から構成された有限インパルス応答(以下、ＦＩＲという)フィルターにより簡単に具体化される。この際、高速で動作するシステムに適用される補間器は計算されたフィルタータップ係数を別途のメモリ、例えばＲＯＭに格納し、単位時間、すなわち単位クロック毎にＲＯＭからフィルタータップ係数を読出して補間を行う。ここで、補間器のタップ係数は多項(polynomial)フィルター又は多相(polyphase)フィルターから求められるが、もし(Ｌ＋１)個のタップを有する多相フィルターを例に挙げると、一つのタップ毎にＭ個の位相値が用いられるので、全部で(Ｌ＋１)×Ｍ個のタップ係数が計算される。従って、インパルス応答の変数であるフィルターインデックス(I)、すなわちタップ数が(Ｌ＋１)個であり、小数間隔(μk)値がＭ個である場合、ＲＯＭに格納されるタップ係数の数は(Ｌ＋１)×Ｍ個になる。
【００２１】
このような補間フィルターのタップ数は信号の伝送速度又はシステムの動作速度に比例して増加するので、高速で動作するシステムの場合には計算されたフィルタータップ係数の数が増加し、従ってタップ係数を格納するためのメモリの容量が増加するという問題点がある。
【００２２】
【発明が解決しょうとする課題】
本発明は前記問題点を解決するために案出されたものであり、ディジタル復調器において、フィルターのタップ数が(Ｌ+１)個であり、用いられる位相値がＭ個である場合、メモリに(Ｌ＋１)×Ｍ個のタップ係数を格納する代りにＭ個のサイン関数値を格納した後、クロック毎にサイン関数値を読出して直接タップ係数を計算するタイミング補間器を提供するにその目的がある。
【００２３】
【課題を解決するための手段】
前記目的を達成するためにディジタル復調器における本発明のタイミング補間器は、クロック毎に０と１の間の小数値を有するＭ個の小数間隔を入力し、前記小数間隔からアドレスを生成して出力するアドレス生成部と、前記Ｍ個の小数間隔に応じるＭ個のサイン関数値を格納し、前記アドレス生成部から出力されるアドレスに当たるサイン関数値を出力するメモリ手段と、フィルターインデックス、前記小数間隔及び前記メモリ手段から出力されるサイン関数値を入力してタップ係数を計算して出力するタップ係数計算部と、Ｌ＋１個のタップを有し、入力信号を前記計算されたタップ係数にてフィルタリングして出力するディジタルフィルターとを備え、前記タップ係数計算部は、前記メモリ手段から出力されたサイン関数値、前記小数間隔とフィルターインデックスを入力して、タップ係数の絶対値を生成して出力する絶対値生成部と、前記フィルターインデックスを入力して前記タップ係数の符号を決定して出力する符号決定部とからなることを特徴とする。
【００２４】
かかる構成により本発明のタイミング補間器では、フィルターインデックスの変化及び小数間隔の変化に応じる(Ｌ+１)×Ｍ個のタップ係数を格納する代りに、小数間隔(μk)の変化に応じるＭ個のサイン関数値をメモリに格納し、前記値を用いてタップ係数を直接計算するので、メモリの容量を従来に比べて１/(Ｌ+１)倍ほど減少させることができる。
【００２５】
【発明の実施の形態】
以下、本発明の実施形態を添付した図面に基づき更に詳細に説明する。
【００２６】
図３は本発明によるタイミング補間器を示したブロック図であり、アドレス生成部32と、メモリ、例えばＲＯＭ34と、タップ係数計算部36と、ディジタルフィルター、例えばＦＩＲフィルター39とから構成される。アドレス生成部32はクロック毎に小数間隔31(μk)を入力してアドレス信号33を生成して出力する。ＲＯＭ34は小数間隔値(μk)に応じるＭ個のサイン関数値を格納し、アドレス信号33に当たるサイン関数値35を出力する。タップ係数計算部36はＲＯＭ34から出力されたサイン関数値35と小数間隔(μk)及びフィルターインデックス(Ｉ)を入力してタップ係数38を計算して出力する。ＦＩＲフィルター39はタップ係数38とアドレス信号 33を入力して入力信号30をフィルタリングした補間信号40を生成して出力する。
【００２７】
図４は図３に示されたタイミング補間器の細部ブロック図であり、特にＲＯＭ34とタップ係数計算部36及びＦＩＲフィルター39を示したものである。ここで、タップ係数計算部36はＲＯＭ34から出力されたサイン関数値35を一時的にラッチするサインバッファー部36-1と、小数間隔31(μk)とフィルターインデックス37(Ｉ)を加算する加算器36-2と、加算器36-2から出力された値にメモリ、例えばＲＯＭ36-3に格納されたπ値を乗算する乗算器36-4と、サインバッファー部36-1から出力されたサイン関数値35を乗算器36-4から出力された値で除算してタップ係数の絶対値38-1を出力する除算器36-5と、フィルターインデックス37(Ｉ)を入力してタップ係数の符号38-2を決定する符号決定部36-6とから構成される。かつ、ＦＩＲフィルター39は基本フィルタリング部39-1と、補助フィルタリング部39-2と、各乗算器(3,3-1〜3-L)から出力された値を加算して入力信号30をフィルタリングした補間信号40を出力する加算器39-3とからなる。基本フィルタリング部39-1はタップ係数の絶対値38-1とタップ係数の符号38-2及びアドレス信号33を入力してタップ係数38を出力するタップ係数バッファー部2と、入力信号30とタップ係数バッファー部2から出力されたタップ係数38を乗算して出力する乗算器3とから構成され、補助フィルタリング部39-2は入力信号30を１クロック遅延させる第１遅延ラッチ部1-1と、タップ係数の絶対値38-1とタップ係数の符号38-2及びアドレス信号33を入力してタップ係数38を出力する第１タップ係数レジスタ部2-1と、第１遅延ラッチ部1-1の出力値と第１タップ係数レジスタ部2-1の出力値を乗算する第１乗算器3-1を一組にして複数個(Ｌ)が並列で連結される。
【００２８】
それでは、本発明によるタイミング補間器の動作を図３及び図４に基づき更に詳細に説明する。
【００２９】
まず、インパルス応答
【００３０】
【数５】
0003858160.tif 000006
【００３１】
を有する補間フィルター22(図２参照)はインパルス応答
【００３２】
【数６】
0003858160.tif 000007
【００３３】
を有するＦＩＲフィルターにより具体化される。ここで、フィルターインデックス(I)値は０、負数又は正数の定数であり、ＦＩＲフィルターのタップ数(ここでは、Ｌ+１と設定する)に応じて決定され、小数間隔(μk)は図１で説明した通りサンプリング間隔を再調整するために制御部17から出力される０と１の間の値を有する小数である。例えば、フィルターインデックス(I)値として -４,-３,-２,-１,０,１,２,３の値を有し、小数間隔(μk)値が同一であれば、サイン関数は奇関数なので、下記の式５と式６が成り立つ。
【００３４】
【数７】
0003858160.tif 000008
【００３５】
【数８】
0003858160.tif 000009
【００３６】
前記式５と式６を比較すると、両式から得られる値の符号は相互反対であるが、両式の絶対値は同一である。すなわち、式５のサイン関数値は正数で、式６のサイン関数値は負数である。従って、フィルターインデックス(Ｉ)の変化はタップ係数の符号のみに影響を及ぼし、実際のタップ係数の絶対値は小数間隔(μk)の変化に応じて変わる。すなわち、本発明では小数間隔(μk)に対するサイン関数値をＲＯＭ34に格納した後、ＲＯＭ34から読出されるサイン関数値を用いて計算されたインパルス応答値、すなわちタップ係数の絶対値と、これと別途に決定された該絶対値の符号をＦＩＲフィルター39に供給する。
【００３７】
一方、アドレス生成部32はクロック毎に０と１の間に存在するＭ個の小数値を有する小数間隔31(μk)を制御部17(図１参照)から供給され、これを量子化してアドレス信号33として出力する。ここで、小数間隔31(μk)はフィルター係数サンプル値を決定するためのものである。
【００３８】
ＲＯＭ34は小数間隔(μk)値に応じるＭ個のサイン関数値(ＳＩＮ(1)〜ＳＩＮ(Ｍ))を格納し、Ｍ個のサイン関数値のうちアドレス生成部32から出力されるアドレス信号33に当たるサイン関数値35を出力する。ＲＯＭ34から読出されたサイン関数値35はタップ係数計算部36のサインバッファー部36-1に出力される。
【００３９】
タップ係数計算部36はＲＯＭ34から出力されたサイン関数値35と小数間隔(μk )及びフィルターインデックス(Ｉ)を入力して、タップ係数38を計算して出力する。これを更に詳細に説明する。
【００４０】
タップ係数計算部36において、加算器36-2では小数間隔31(μk)とフィルターインデックス値(Ｉ)37を入力して、前記二つの値を加算した後、乗算器36-4に出力する。乗算器36-4ではＲＯＭ36-3に格納されたπ値を読出して加算器36-2から出力された値と乗算して除算器36-5に出力する。除算器36-5ではサインバッファー部36-1から出力された値を乗算器36-4から出力された値で除算した結果値をタップ係数の絶対値38-1として出力する。
【００４１】
符号決定部36-6はフィルターインデックス値37を入力してタップ係数の符号38-2を決定する。タップ係数はサイン関数値(sin(I+μk)π)を(I+μk)πで除算した値、すなわち同期関数である。この際、フィルターインデックス値(Ｉ)が負数である場合、タップ係数は該サイン関数値が有する符号と反対の符号に決定し、フィルターインデックス値(Ｉ)が正数である場合、タップ係数は該サイン関数値が有する符号と同一な符号に決定する。他の符号決定条件としては、フィルターインデックス値が０であると、"＋"符号を出力し、正数で偶数であると、"＋"符号を出力し、正数で奇数であると、"−"符号を出力し、負数で偶数であると、"−"符号を出力し、負数で奇数であると、"−"符号を出力する。
【００４２】
次いで、ＦＩＲフィルター39はタップ係数計算部36から供給されるタップ係数38とアドレス信号33を入力して、入力信号30をフィルタリングした補間信号40を生成して出力する。前記補間信号40はデータフィルター14(図１参照)でデータ及びタイミングの復元に必要なストローブデータを計算するに用いられる。
【００４３】
ＦＩＲフィルター39の基本フィルタリング部39-1において、タップ係数バッファー部2はタップ係数の絶対値38-1とタップ係数の符号38-2及びアドレス信号33を入力して、タップ係数38を生成して格納させる。乗算器3では入力信号30とタップ係数バッファー部2から出力されたタップ係数38を乗算して加算器39-3に出力する。
【００４４】
補助フィルタリング部39-2において、Ｌ個の遅延ラッチ部(1-1〜1-L)は直列で連結され、それぞれ入力信号30に対して１乃至Ｌクロック遅延させた信号を出力する。Ｌ個のタップ係数レジスタ部(2-1〜2-L)はタップ係数の絶対値38-1とタップ係数の符号38-2及びアドレス信号33を入力して、タップ係数38を生成して格納させる。
【００４５】
Ｌ個の乗算器(3-1〜3-L)はＬ個の遅延ラッチ部(1-1〜1-L)の出力とＬ個のタップ係数レジスタ部(2-1〜2-L)の出力をそれぞれ乗算し、乗算されたＬ個の値を加算器39-3に供給する。すなわち、第１乗算器3-1では入力信号(X(mTs))30を第１遅延レジスタ部1-1で１クロック遅延させた信号と第１タップ係数レジスタ部2-1から出力されるタップ係数を乗算し、乗算された値を加算器39-3に出力する。同様に、第Ｌ乗算器3-Lでは入力信号(X(mTs))30を第Ｌ遅延レジスタ部1-LでＬクロック遅延させた信号と第Ｌタップ係数レジスタ部2-Lから出力されるタップ係数を乗算し、乗算された値を加算器39-3に出力する。
【００４６】
加算器39-3では各乗算器(3,3-1〜3-L)からの出力を加算し、加算された値を補間信号(y(kTi))40に出力する。
【００４７】
【発明の効果】
以上、本発明によるタイミング補間器は、フィルターインデックス(Ｉ)の変化と小数間隔(μk)の変化に応じる(Ｌ＋１)×Ｍ個のタップ係数をメモリに格納した従来の技術とは異なり、メモリにクロック毎に入力される小数間隔(μk)に応じるＭ個のサイン関数値を格納し、これを用いて直接(Ｌ+１)個のタップ係数を計算することにより、メモリの容量を１/(Ｌ+１)倍ほど減少させることができる。よって、回路を簡略化することができる。
【図面の簡単な説明】
【図１】ディジタル復調器において一般的なタイミング復元回路を示したブロック図である。
【図２】図１に示された補間器を示したブロック図である。
【図３】本発明によるタイミング補間器の一実施形態を示したブロック図である。
【図４】図３に示されたタイミング補間器の細部ブロック図である。
【符号の説明】
１１  サンプリングクロック発生器
１２  第１サンプラ
１３  補間器
１４  データフィルター
１５  タイミングエラー検出器
１６  ループフィルター
１７  制御部
２１  ディジタル／アナログ変換器
２２  補間フィルター
２３  第２サンプラ
３２  アドレス生成部
３４  メモリ
３６  タップ係数計算部
３９  ディジタルフィルター
【図１】
0003858160.tif 000010
【図２】
0003858160.tif 000011
【図３】
0003858160.tif 000012
【図４】
0003858160.tif 000013