(57)【特許請求の範囲】
【請求項１】
水平走査信号の１周期の長さを計測する第１計測手段と、
画像信号の有効期間を示すイネーブル信号のアクティブ期間の長さを計測する第２計測手段と、
前記第２計測手段の計測値の１／２の値を次回のイネーブル信号のアクティブ期間の終わりまで保持する保持手段と、
前記イネーブル信号のアクティブ期間の始まりからの長さが前記保持手段に保持された値に一致したときに該アクティブ期間の中心位置を示すパルス信号を発生する第１信号発生手段と、
前記パルス信号の発生に応答して長さ計測を開始する第３計測手段と、
該第３計測手段の計測値が前記第１計測手段の計測値から表示領域の物理的な水平方向長の１／２の値を減じた長さに達したときに水平方向の表示開始位置を示す水平スタート信号を発生する第２信号発生手段と、を備えたことを特徴とする表示位置制御装置。
【請求項２】
垂直走査信号の１周期の長さを計測する第１計測手段と、
画像信号の有効期間を示すイネーブル信号の１垂直走査期間内におけるトータルの周期長を計測する第２計測手段と、
前記第２計測手段の計測値の１／２の値を次回の垂直走査期間における最後のイネーブル信号の周期の終わりまで保持する保持手段と、
１垂直期間内におけるイネーブル信号の最初のアクティブ期間の始まりからの長さが前記保持手段に保持された値に一致したときに１垂直走査期間内におけるイネーブル信号のトータルの周期長の中心位置を示すパルス信号を発生する第１信号発生手段と、
前記パルス信号の発生に応答して長さ計測を開始する第３計測手段と、
該第３計測手段の計測値が前記第１計測手段の計測値から表示領域の物理的な垂直方向長の１／２の値を減じた長さに達したときに垂直方向の表示開始位置を示す垂直スタート信号を発生する第２信号発生手段と、を備えたことを特徴とする表示位置制御装置。
【請求項３】
請求項１に記載の各手段及び請求項２に記載の各手段を備えたことを特徴とする表示位置制御装置。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、表示位置制御装置、詳しくは、線順次駆動方式………１走査線分の信号を同時に一行分の表示画素に送り込み、この動作を走査線毎に繰り返して１画面を表示する方式………を採用する表示装置の表示位置制御装置に関する。
【０００２】
【背景の説明】
冷陰極管（ＣＲＴ）を用いた表示装置では、点順次駆動すなわち画面の左上から右下に走査して１画面を表示する。１走査点（画素）あたりの走査時間は、たとえばテレビの場合でおよそ 100ｎｓ（但し１水平走査期間がＮＴＳＣ方式の約60μｓとする）であり、この時間は、蛍光体に電子ビームを照射するだけの単純な表示装置（ＣＲＴを用いたもの）であれば十分であるが、液晶パネルのように容量性の表示画素を持つものやプラズマディスプレイのようにきめ細かなタイミング制御を必要とするものにあっては短かすぎる時間である。
【０００３】
そこで、液晶パネルやプラズマディスプレイ等の表示装置においては、データドライバにラインメモリを組み込み、このラインメモリに１走査線分の画像信号を順次に書き込むと共に、水平走査信号に同期させてラインメモリ内の信号をまとめて一行分の画素に送り込むという線順次駆動方式を採用している。１画素あたりの走査時間を最大で１水平走査期間程度まで延長できる。
【０００４】
線順次駆動方式の１画面の表示位置は、水平走査信号（以下、Ｈsync）と垂直走査信号（以下、Ｖsync）から決められる。
図７において、Ｈsyncの後縁（図では立ち上がりエッジ）から一定時間Ｔαを経過した後の時点Ｔａｓが水平スタートパルスＨSTR の発生位置、すなわち水平方向の表示開始位置（画面の左端位置）である。また、Ｖsyncの後縁から一定時間Ｔβを経過した後の時点Ｔｂｓが垂直スタートパルスＶSTR の発生位置、すなわち垂直方向の表示開始位置（画面の上端位置）である。Ｔａｅは水平方向の表示終了位置（画面の右端位置）であり、Ｔｂｅは垂直方向の表示終了位置（画面の下端位置）である。なお、画像信号のハッチングは画像信号の有効部分を示している。
【０００５】
図８は、上記四つの時点Ｔａｓ、Ｔａｅ、Ｔｂｓ、Ｔｂｅと表示パネルの表示領域１の関係を示す図である。今、四つの時点が適正な場合には、図示のようにＴａｓが表示領域１の左端と一致し、且つ、Ｔｂｓが表示領域１の上端と一致すると共に、Ｔａｅ及びＴｂｅもそれぞれ右端及び下端と一致するから、表示領域１の全体に満遍なく画像信号の有効部分が表示される。
【０００６】
しかしながら、たとえば、Ｔａｓが適正位置よりも前であった場合（Ｔα過小）には、表示領域１の左端から有効部分がはみ出して表示領域１の右端に無効部分が表示され、または、Ｔａｓが適正位置よりも後ろであった場合（Ｔα過大）には、表示領域１の右端から有効部分がはみ出して表示領域１の左端に無効部分が表示され、または、Ｔｂｓが適正位置よりも前であった場合（Ｔβ過小）には、表示領域１の上端から有効部分がはみ出して表示領域１の下端に無効部分が表示され、または、Ｔｂｓが適正位置よりも後ろであった場合（Ｔβ過大）には、表示領域１の下端から有効部分がはみ出して表示領域１の上端に無効部分が表示される。いずれの場合も見た目の表示品質を損なう。特に、このような不都合は、画素数の多い高精細な画像信号の場合に顕在化する。
【０００７】
【従来の技術】
そこで、水平・垂直同期信号と一緒に、画像信号の有効部分を示す信号（以下、Ｅnable と言う）を送る、いわゆる“イネーブルモード”と称される方式が採用されている（図９参照）。表示装置は、Ｅnable の前縁を検出してＨSTR 、ＶSTR を発生し表示開始位置（Ｔａｓ、Ｔｂｓ）を決定する。Ｅnable のアクティブ期間と画像信号の有効部分とが一対一に対応するため、表示位置を適正化できる。
【０００８】
【発明が解決しようとする課題】
ところで、近時の表示要求は多様化をきわめており、たとえば、特殊な例ではあるが、Ｅnable のアクティブ期間を“規定の長さ”よりも短くしたいという要求がある。ここで、規定の長さとは、表示領域１の表示容量（画素数）によって決まる長さであり、たとえば、ＳＶＧＡの表示容量は８００×６００画素であるから、この場合の規定の長さは、水平方向で８００画素相当長となり、また、垂直方向では６００画素相当長となる。
【０００９】
今、ＳＶＧＡ規格の表示領域１に、規定の長さよりも１０％（言うまでもなく便宜値）短いＥnable を持つ画像信号を表示する場合を考える。この場合のＥnable の水平方向の長さは８００×０．９＝７２０画素相当長、水平方向の長さは６００×０．９＝５４０画素相当長である。
図１０はその表示状態図である。既述のとおり、イネーブルモード方式では、Ｅnable の前縁を検出してＨSTR 、ＶSTR を発生するのであるから、画面の表示開始位置（Ｔａｓ、Ｔｂｓ）が表示領域１の左上隅になる。したがって、表示領域１よりも少ない表示容量を持つ画像信号２が画面の左上方に片寄って表示されてしまい、見苦しいという問題点があった。
【００１０】
そこで、本発明は、表示装置の表示容量よりも少ない容量の画像信号を表示する際に画面の水平方向または垂直方向の中央部に画像信号を表示することを目的とする。
【００１１】
【課題を解決するための手段】
請求項１に係る発明は、水平走査信号の１周期の長さを計測する第１計測手段と、画像信号の有効期間を示すイネーブル信号のアクティブ期間の長さを計測する第２計測手段と、前記第２計測手段の計測値の１／２の値を次回のイネーブル信号のアクティブ期間の終わりまで保持する保持手段と、前記イネーブル信号のアクティブ期間の始まりからの長さが前記保持手段に保持された値に一致したときに該アクティブ期間の中心位置を示すパルス信号を発生する第１信号発生手段と、前記パルス信号の発生に応答して長さ計測を開始する第３計測手段と、該第３計測手段の計測値が前記第１計測手段の計測値から表示領域の物理的な水平方向長の１／２の値を減じた長さに達したときに水平方向の表示開始位置を示す水平スタート信号を発生する第２信号発生手段と、を備えたことを特徴とする。
【００１２】
請求項２に掛かる発明は、垂直走査信号の１周期の長さを計測する第１計測手段と、画像信号の有効期間を示すイネーブル信号の１垂直走査期間内におけるトータルの周期長（１周期長は１アクティブ期間の２倍）を計測する第２計測手段と、前記第２計測手段の計測値の１／２の値を次回の垂直走査期間における最後のイネーブル信号の周期の終わりまで保持する保持手段と、１垂直期間内におけるイネーブル信号の最初のアクティブ期間の始まりからの長さが前記保持手段に保持された値に一致したときに１垂直走査期間内におけるイネーブル信号のトータルの周期長の中心位置を示すパルス信号を発生する第１信号発生手段と、前記パルス信号の発生に応答して長さ計測を開始する第３計測手段と、該第３計測手段の計測値が前記第１計測手段の計測値から表示領域の物理的な垂直方向長の１／２の値を減じた長さに達したときに垂直方向の表示開始位置を示す垂直スタート信号を発生する第２信号発生手段と、を備えたことを特徴とする。
【００１３】
請求項３に係る発明は、請求項１記載の各手段及び請求項２記載の各手段を備えたことを特徴とする。
請求項１に係る発明では、イネーブル信号のアクティブ期間の中心位置でパルス信号が発生し、このパルス信号を起点にして水平スタート信号の発生位置が決定される。詳しくは、同起点から（１水平走査期間長）−（表示領域の物理的な水平方向長の１／２）の位置に決定される。したがって、イネーブル信号の長さが規定の長さより短い場合であっても、表示領域の“水平方向”の中央部に画像信号が表示される。
【００１４】
請求項２に係る発明では、イネーブル信号の１垂直走査期間内におけるトータルの周期長の中心位置でパルス信号が発生し、このパルス信号を起点にして垂直スタート信号の発生位置が決定される。詳しくは、同起点から（１垂直走査期間長）−（表示領域の物理的な垂直方向長の１／２）の位置に決定される。したがって、イネーブル信号の１垂直走査期間内におけるトータルの周期長が規定の長さより短い場合であっても、表示領域の“垂直方向”の中央部に画像信号が表示される。
【００１５】
請求項３に係る発明では、請求項１に係る発明と請求項２に係る発明の両方の作用を有するから、イネーブル信号の長さが規定の長さより短く、且つ、イネーブル信号の１垂直走査期間内におけるトータルの周期長が規定の長さより短い場合であっても、表示領域の“水平方向”及び“垂直方向”の中央部に画像信号が表示される。
【００１６】
【発明の実施の形態】
以下、本発明の実施例を図面に基づいて説明する。
図１〜図６は、本発明に係る表示位置制御装置の一実施例を示す図であり、特に限定しないが、ＳＶＧＡ規格（８００×６００画素）のＴＦＴ型液晶表示装置への適用例である。
【００１７】
図１において、１０はインターフェース部であり、このインターフェース部１０を介して、図外の画像信号発生源（典型的にはパーソナルコンピュータ）から表示に必要な各種信号（画像信号、Ｅnable 、Ｈsync、Ｖsync及び画素クロックＤCLK 等）が取り込まれるほか、図外の電源部からの直流の電源電圧ＶCCが取り込まれ、上記表示に必要な各種信号はケーブル１１を介して制御部１２に、また、電源電圧ＶCCはケーブル１３を介して電源部１４に入力される。
【００１８】
制御部１２は入力された各種信号に対して所要の前処理（典型的には波形整形やタイミング調節等の処理）を施すと共に、各種信号に基づいて、データドライバ１５やゲートドライバ１６の動作に必要な各種制御信号、特に、データドライバ１５のシフト動作の開始タイミングを規定する信号（すなわち水平方向の表示開始位置を規定する信号；以下、水平スタートパルスＨSTR と言う）や、ゲートドライバ１６のシフト動作の開始タイミングを規定する信号（すなわち垂直方向の表示開始位置を規定する信号；以下、垂直スタートパルスＶSTR と言う）並びにデータドライバ１５の出力タイミングを規定する信号（以下、ロードパルスＬＰと言う）等を生成するもので、これらの信号はケーブル１７〜１９を介してデータドライバ１５やゲートドライバ１６に出力される。なお、１７は画像信号の出力ケーブル、１８はデータドライバ１５のための各種制御信号（ＬＰ、ＨSTR 等）の出力ケーブル、１９はゲートドライバ１６のための各種制御信号（ＶSTR 等）の出力ケーブルである。
【００１９】
電源部１４は表示に必要な各種電源電圧（階調電圧含む）を発生するもので、これらの電圧はケーブル２０、２１（図ではそれぞれ１本の線で示しているが電圧の数に応じた線数になることは言うまでもない）を介してデータドライバ２０やゲートドライバ２１に出力される。
データドライバ１５及びゲートドライバ１６の働きを簡単に説明すると、データドライバ１５は冒頭でも述べたようにラインメモリを有している。このラインメモリは、シリアルに入力する画像信号を１行（本実施例はＳＶＧＡであるから８００画素分）単位に取り込み、それをまとめて液晶パネル２２の多数本（８００本；カラーであればその３倍）のデータバスライン２２ａに出力するというもので、いわゆるシリアル／パラレル変換を行うための要素であり、ラインメモリへの取込み開始のタイミングはＨSTR で規定され、また、出力のタイミングはＬＰで規定される。一方、ゲートドライバ１６は、液晶パネル２２の多数本（６００本）のゲートバスライン２２ｂを水平走査の周期で線順次に選択（具体的には選択ラインにＴＦＴオン電圧と呼ばれる電圧を印加する）するというものであり、選択開始のタイミングはＨSTR で規定される。
【００２０】
したがって、ＴＦＴ型の液晶パネル２２は、周知のとおり、選択ゲートバスラインにつながる１行分のＴＦＴを同時にオンさせ、それぞれのデータバスライン上の表示電圧を液晶に書き込むことによって、画像信号に応じた階調表示を行うものであるから、液晶パネル２２の左上隅（すなわち画面の表示開始位置）の画素に対する書込タイミングは、ＨSTR 、ＬＰ及びＶSTR によって規定されることになる。
【００２１】
本実施例の特徴的な構成は、これらＨSTR 、ＬＰ及びＶSTR を生成する部分にあり、制御部１２の中にハッチングで示した部分１２ａがそれに相当する。
以下、簡単化のために、水平走査に関する部分（ＨSTR とＬＰを生成する部分）と、垂直走査に関する部分（ＶSTR の生成部分）に分けて説明する。
『水平走査部分の説明』
図２は水平走査に関係する部分の概略ブロック図である。この図において、３０は水平第１カウンタ、３１は割り算回路、３２は水平第１レジスタ、３３は水平第１比較回路、３４は水平第２カウンタ、３５は水平第１定数発生回路、３６は水平第２比較回路、３７は水平第２レジスタ、３８は水平第２定数発生回路、３９は水平減算回路、４０は水平第４比較回路である。
【００２２】
各回路の動作及び機能を説明する。まず、水平第１カウンタ３０は、ＲＳＴ端子の論理をＬレベルからＨレベルに立ち上げたときにカウント値Ｓａを０（以下、初期状態）とし、以降、ＣＫ端子にクロック（画素クロックＤCLK ；簡単化のために１周期／１画素とする。以下同様）が入力される度にＳａを＋１ずつアップするというものであり、ＲＳＴ端子にはイネーブル信号Ｅnable が入力されている。ここで、Ｅnable のアクティブ期間（画像信号の有効期間を示す部分）の論理はＨレベルである。したがって、水平第１カウンタ３０は、Ｅnable のアクティブ期間の前縁で初期状態（Ｓａ＝０）となり、以降、Ｅnable の次回のアクティブ期間の前縁までＤCLK の数をカウントし続け、Ｓａの最大値で、Ｅnable のアクティブ期間の１周期長（言い換えれば水平走査信号の１周期長）を表わすから、この水平第１カウンタ３０は、請求項１に係る発明に記載されの「第１計測手段」を具現化したものである。
【００２３】
次に、割り算回路３１は、Ｓａの１／２の値Ｓｂを生成・出力するものであり、また、水平第１レジスタ３２は、Ｅnable のアクティブ期間の後縁の“時点”におけるＳｂ（注１）を取り込んで、次回の同後縁の時点まで保持するものである。注１：上記時点におけるＳｂはＥnable のアクティブ期間の半分の長さを表わす。なぜならば、上記時点におけるＳａは同アクティブ期間の前縁から後縁までの長さを表わすからであり、上記時点におけるＳｂはこのＳａを１／２した値であるからである。したがって、割り算回路３１と水平第１レジスタ３２は、請求項１に係る発明に記載された「保持手段」及び「第２計測手段」（Ｅnable のアクティブ期間の長さを計測するもの）を具現化したものでもある。以下、水平第１レジスタ３２に保持されたＳｂ（すなわちＥnable のアクティブ期間の半分の長さを表わすＳｂ）のことを、特にＳｂ′として識別する。
【００２４】
次に、水平第１比較回路３３は、Ａ端子とＢ端子の値を比較して両端子の値が一致（Ａ＝Ｂ）したときにＨレベルの信号を出力するものである。Ａ端子にはＳｂ′が、また、Ｂ端子には水平第１カウンタ３０のカウント値（Ｓａ）が入力されており、Ｓｂ′はＥnable のアクティブ期間の半分の長さを表し、Ｓａは同アクティブ期間の前縁からの長さを表わすから、水平第１比較回路３３は、Ｅnable のアクティブ期間の長さが丁度、半分になったときにＤCLK の１周期に相当する幅を有するＨレベルのパルス信号Ｓｃを出力する。したがって、この水平第１比較回路３３は、請求項１に係る発明に記載された「第１信号発生手段」を具現化したものである。
【００２５】
次に、水平第２カウンタ３４は、ＲＳＴ端子の論理をＬレベルからＨレベルに立ち上げたときにカウント値Ｓｄを０（以下、初期状態）とし、以降、ＣＫ端子にクロック（画素クロックＤCLK ）が入力される度にＳｄを＋１ずつアップするというものであり、ＲＳＴ端子には、Ｅnable のアクティブ期間の長さが丁度、半分になったときに発生するパルス信号Ｓｃが入力されている。したがって、水平第２カウンタ３４は、Ｅnable のアクティブ期間の長さが丁度半分になったときに初期状態（Ｓｄ＝０）となり、以降、次回のＥnable のアクティブ期間の長さが丁度半分になるまでの間、ＤCLK の数をカウントして“長さ計測”を行うものであるから、請求項１に係る発明に記載された「第３計測手段」を具現化したものである。
【００２６】
次に、水平第１定数発生回路３５は、所定の第１定数ＣＯＮＳＴ１を発生するものであり、水平第２比較回路３６は、Ａ端子とＢ端子の値を比較して両端子の値が一致（Ａ＝Ｂ）したときにＨレベルの信号（ロードパルスＬＰ）を出力するものである。Ａ端子にはＳｄが、また、Ｂ端子にはＣＯＮＳＴ１が入力されており、ロードパルスＬＰは、Ｓｄ＝ＣＯＮＳＴ１となったときに出力される。したがって、Ｓｄは、Ｅnable のアクティブ期間の長さが丁度半分になったときを０とする長さ計測値であるから、ＣＯＮＳＴ１に、データドライバ１５や液晶パネル２２の特性に見合った適切な値を設定することにより、Ｅnable のアクティブ期間の長さにかかわらず、常に最適なタイミングでロードパルスＬＰを発生できる。
【００２７】
次に、水平第２レジスタ３７は、Ｅnable のアクティブ期間の前縁の“時点”におけるＳａ（注２）を取り込んで次回の同前縁の時点まで保持するものである。注２：上記時点におけるＳａは最大値を示し、この最大値は水平走査信号の１周期長を表わす（上記水平第１カウンタ３０の説明参照）。以下、水平第２レジスタ３７に保持されたＳａ（すなわち水平走査信号の１周期長を表わすＳａ）のことを、特にＳａ′として識別する。
【００２８】
次に、水平第２定数発生回路３８は、所定の第２定数ＣＯＮＳＴ２を発生するものであり、水平減算回路３９は、Ａ端子の入力値（Ｓａ′）からＢ端子の入力値（ＣＯＮＳＴ２）を減算し、その減算結果Ｓｅ（Ｓｅ＝Ｓａ′−ＣＯＮＳＴ２）を出力するものである。ここで、ＣＯＮＳＴ２は、液晶パネル２２の１行の半分の長さに相当する値に設定される。したがって、Ｓｅは、水平走査信号の１周期長から液晶パネル２２の１行の半分の長さを引いた値になる。
【００２９】
次に、水平第４比較回路４０は、Ａ端子とＢ端子の値を比較して両端子の値が一致（Ａ＝Ｂ）したときにＨレベルの信号（水平スタート信号ＨSTR ）を出力するものである。Ａ端子にはＳｄが、また、Ｂ端子にはＳｅが入力されており、水平スタート信号ＨSTR は、Ｓｄ＝Ｓｅとなったときに出力される。したがって、Ｓｄは、Ｅnable のアクティブ期間の長さが丁度半分になったときを０とする長さ計測値であり、Ｓｅは、水平走査信号の１周期長から液晶パネル２２の１行の半分の長さを引いた値であるから、以下に説明するように、Ｅnable のアクティブ期間の長さにかかわらず、常に最適なタイミングで水平スタート信号ＨSTR を発生することができる。
【００３０】
図３は図２のタイミングチャートである。この図において、画像信号とＥnable は二組示されている。符号▲１▼を付した組は、液晶パネル２２の横方向画素数と同一の画素数を持つ画像信号（以下、便宜的にフル画像信号という）及びその有効期間を示すＥnable であり、符号▲２▼を付した組は、液晶パネル２２の横方向画素数よりも少ない画素数を持つ画像信号（以下、便宜的にハーフ画像信号という）及びその有効期間を示すＥnable である。
水平／フル画像信号の場合
ＳａはＥnable の立ち上がりのタイミング（イ）で初期状態となった後、右肩上がりの直線で示すように最大値まで変化（但し、カウンタ値の変化は説明のしやすさからアナログ的に表現したが、実際はデジタルカウンタを用いてデジタル的に変化している。以後のカウンタの値Ｓａ、Ｓｄ、Ｓｈ、Ｓｋも同様である。）するが、このＳａの変化に追随してＳｂ（Ｓｂ＝１／２×Ｓａ）の値も変化し、Ｅnable の立ち下がりのタイミング（ロ）でそのときのＳｂがＳｂ′となって保持される。そして、このＳｂ′とＳａが一致したとき（ニ）にＳｃが発生する。
【００３１】
一方、ＳｄはＳｃに応答して初期状態となった後、右肩上がりの直線で示すように最大値まで変化し、その変化過程の第１のタイミング（ホ）でロードパルスＬＰが発生し、第２のタイミング（ヘ）で水平スタート信号ＨSTR が発生する。第１のタイミングは、Ｓｃの発生時点からＣＯＮＳＴ１を経過した時点であり、また、第２のタイミングは、Ｓｃの発生時点からＳｅ（Ｓｅ＝Ｓａ′−ＣＯＮＳＴ２）を経過した時点である。いずれも、Ｓｃの発生時点、すなわちＥnable のアクティブ期間の長さが丁度半分になったときを起点としている。
水平／ハーフ画像信号の場合
フル画像信号に比べて、Ｅnable の立ち上がりタイミング（イ′）が右にずれ、立ち下がりタイミング（ロ′）が左にずれている。このため、Ｓａ、Ｓｂ′、Ｓａ′に違いがでているが、他の波形、特にＬＰ及びＨSTR はまったく変化していない。Ｅnable のアクティブ期間の１／２の長さを起点としているからである。
『垂直走査部分の説明』
図４は垂直走査に関係する部分の概略ブロック図である。この図において、６０は先頭検出及び周期判定回路、６１は垂直第１カウンタ、６２は割り算回路、６３は垂直第１レジスタ、６４は垂直第１比較回路、６５は垂直第２カウンタ、６６は垂直第２レジスタ、６７は垂直定数発生回路、６８は垂直第２比較回路、６９は垂直第３比較回路である。
【００３２】
各回路の動作及び機能を説明すると、先頭検出及び周期判定回路６０は、１垂直走査期間内の最初と最後のＥnable を検出すると共に、Enable の１アクティブ期間長（図２のＳｂ′を２倍した値でもよい）を検出し、最初のＥnable の立ち上がりに応答してＨレベルになる信号Ｓｆを出力し、最後のＥnable の立ち下がりから上記１アクティブ期間長の経過後にＬレベルになる信号Ｓｇを出力するものである。 
【００３３】
次に、垂直第１カウンタ６１は、ＲＳＴ端子の論理をＬレベルからＨレベルに立ち上げたときにカウント値Ｓｈを０とし、以降、ＣＫ端子にＨsyncが入力される度にＳｈを＋１ずつアップするというものであり、ＲＳＴ端子にはＳｆが入力されている。したがって、垂直第１カウンタ６１は、１垂直走査期間内の最初のＥnable の立ち上がり（アクティブ期間の前縁）で初期状態（Ｓａ＝０）となり、以降、次回の垂直走査期間の最初のＥenable の前縁まで、Ｈsyncの数をカウントし続ける。ここで、Ｓｈの最大値は、垂直走査期間の１周期長を表わすから、この垂直第１カウンタ６１と、先頭検出及び周期判定回路６０は、請求項２に係る発明に記載の「第１計測手段」を具現化したものである。
【００３４】
次に、割り算回路６２は、Ｓｈの１／２の値Ｓｉを生成・出力するものであり、また、垂直第１レジスタ６３は、信号Ｓｇの発生時点におけるＳｉ（Ｅnable の１垂直走査期間内におけるトータルの周期長を１／２したもの）を取り込んで、次回のＳｇ発生時まで保持するものである。したがって、割り算回路６２と垂直第１レジスタ６３は、請求項２に係る発明に記載された「保持手段」及び「第２計測手段」（Ｅnable の１垂直走査期間内におけるトータルの周期長）を具現化したものでもある。以下、垂直第１レジスタ６３に保持されたＳｉ（すなわちＥnable の１垂直走査期間内におけるトータルの周期長を１／２した長さ）のことを、特にＳｉ′として識別する。
【００３５】
次に、垂直第１比較回路６４は、Ａ端子とＢ端子の値を比較して両端子の値が一致（Ａ＝Ｂ）したときにＨレベルの信号を出力するものである。Ａ端子にはＳｉ′が、また、Ｂ端子には垂直第１カウンタ６１のカウント値（Ｓｈ）が入力されており、Ｓｉ′はＥnable の１垂直走査期間内におけるトータルの周期長の半分の長さを表し、Ｓｈは１垂直走査期間内における最初のＥnable の前縁からの長さを表わすから、垂直第１比較回路６４は、同周期長が丁度半分になったときにＨsyncの１周期に相当する幅を有するＨレベルのパルス信号Ｓｊを出力する。したがって、この垂直第１比較回路６４は、請求項２に係る発明に記載された「第１信号発生手段」を具現化したものである。
【００３６】
次に、垂直第２カウンタ６５は、ＲＳＴ端子の論理をＬレベルからＨレベルに立ち上げたときにカウント値Ｓｋを０（以下、初期状態）とし、以降、ＣＫ端子にＨsyncが入力される度にＳｋを＋１ずつアップするというものであり、ＲＳＴ端子には、Ｅnable の１垂直走査期間内におけるトータルの周期長が丁度半分になったときに発生するパルス信号Ｓｊが入力されている。したがって、垂直第２カウンタ６５は、Ｅnable の１垂直走査期間内におけるトータルの周期長が丁度半分になったときに初期状態（Ｓｋ＝０）となり、以降、次回のＥnable の１垂直走査期間内におけるトータルの周期長が丁度半分になるまでの間、Ｈsyncの数をカウントして“長さ計測”を行うものであるから、請求項２に係る発明に記載された「第３計測手段」を具現化したものである。
【００３７】
次に、垂直第２レジスタ６６は、１垂直期間内における最初のＥnable の立ち上がりタイミングでＳｈ（注３）を取り込んで次回の同タイミングまで保持するものである。注３：上記タイミングにおけるＳｈは最大値を示し、この最大値は垂直走査信号の１周期長を表わす（上記垂直第１カウンタ６１の説明参照）。以下、垂直第２レジスタ３７に保持されたＳｈ（すなわち垂直走査信号の１周期長を表わすＳｈ）のことを、特にＳｈ′として識別する。
【００３８】
次に、垂直第１定数発生回路６７は、所定の第１定数ＣＯＮＳＴ３を発生するものであり、垂直減算回路６８は、Ａ端子の入力値（Ｓｈ′）からＢ端子の入力値（ＣＯＮＳＴ３）を減算し、その減算結果Ｓｍ（Ｓｍ＝Ｓｈ′−ＣＯＮＳＴ３）を出力するものである。ここで、ＣＯＮＳＴ３は、液晶パネル２２の縦方向の半分の長さに相当する値（たとえば総ライン数の半分の値）に設定される。したがって、Ｓｍは、垂直走査信号の１周期長から液晶パネル２２の縦方向の半分の長さを引いた値になる。
【００３９】
次に、垂直第２比較回路６９は、Ａ端子とＢ端子の値を比較して両端子の値が一致（Ａ＝Ｂ）したときにＨレベルの信号（垂直スタート信号ＶSTR ）を出力するものである。Ａ端子にはＳｋが、また、Ｂ端子にはＳｍが入力されており、垂直スタート信号ＶSTR は、Ｓｋ＝Ｓｍとなったときに出力される。したがって、Ｓｋは、Ｅnable の１垂直走査期間内におけるトータルの周期長が丁度半分になったときを０とする長さ計測値であり、Ｓｍは、垂直走査信号の１周期長から液晶パネル２２の縦方向の半分の長さを引いた値であるから、以下に説明するように、１垂直走査期間内のＥnable 数にかかわらず、常に最適なタイミングで垂直スタート信号ＶSTR を発生することができる。
【００４０】
図５は図４のタイミングチャートである。図５において、画像信号とＥnable は二組示されている。符号▲１▼を付した組は、液晶パネル２２の行数と同一の繰返し数を持つフル画像信号及びその有効期間を示すＥnable であり、符号▲２▼を付した組は、液晶パネル２２の行数よりも少ない繰返し数を持つハーフ画像信号及びその有効期間を示すＥnable である。
垂直／フル画像信号の場合
Ｓｈは１垂直走査期間の最初のＥnable の立ち上がりタイミング（イ）で初期状態となった後、右肩上がりの直線で示すように最大値まで変化するが、このＳｈの変化に追随してＳｉ（Ｓｉ＝１／２×Ｓｈ）の値も変化し、１垂直走査期間内の最後のＥnable の立ち下がりから１Ｅnable 期間の経過後のタイミング（ロ）でそのときのＳｉがＳｉ′となって保持される。そして、このＳｉ′とＳｈが一致したとき（ニ）にＳｊが発生する。
【００４１】
一方、ＳｋはＳｊに応答して初期状態となった後、右肩上がりの直線で示すように最大値まで変化し、その変化過程の第１のタイミング（ホ）で垂直スタート信号ＶSTR が発生する。
第１のタイミングは、Ｓｊの発生時点からＳｍ（Ｓｍ＝Ｓｉ′−ＣＯＮＳＴ３）を経過した時点であり、その起点は、Ｅnable の１垂直走査期間内におけるトータルの周期長が丁度半分になったときである。
垂直／ハーフ画像信号の場合
フル画像信号に比べて、最初のＥnable が右にずれ、最後のＥnable が左にずれている。このため、Ｓｈ、Ｓｉ′、Ｓｈ′に違いがでているが、他の波形、特にＶSTR の位置はまったく変化していない。Ｅnable の１垂直走査期間内におけるトータルの周期長の１／２の長さを起点としているからである。
【００４２】
以上のとおり、本実施例では、水平走査方向においては、Ｅnable の長さの半分の位置を起点にして水平スタート信号ＨSTR を発生でき、垂直走査方向においては、Ｅnable の１垂直走査期間内におけるトータルの周期長の半分の位置を起点にして垂直スタート信号ＶSTR を発生できるため、表示装置の表示容量よりも少ない容量の画像信号を表示する際でも、図６に示すように、表示領域１の中央に画像信号２を表示でき、冒頭で述べたイネーブル方式の欠点（表示装置の表示容量よりも少ない容量の画像信号を表示する際に、画面の左上方に片寄って表示されてしまい見苦しい）を解消することができる。
【００４３】
【発明の効果】
本発明によれば、表示装置の表示容量よりも少ない容量の画像信号を表示する際に画面上の適正な位置に画像信号を表示することができる。
【図面の簡単な説明】
【図１】一実施例のブロック図である。
【図２】一実施例の水平走査関連のブロック図である。
【図３】図２の動作タイミングチャートである。
【図４】一実施例の垂直走査関連のブロック図である。
【図５】図４の動作タイミングチャートである。
【図６】一実施例の画面表示状態図である。
【図７】従来のタイムチャート（非イネーブルモード方式）である。
【図８】従来の画面表示状態図である。
【図９】従来のタイムチャート（イネーブルモード方式）である。
【図１０】イネーブル方式の不都合を示す表示状態図である。
【符号の説明】
Ｈsync：水平同期信号（同期信号）
Ｖsync：垂直同期信号（同期信号）
Ｅnable ：イネーブル信号
３０：水平第１カウンタ（第１計測手段）
３１：割り算回路（第２計測手段、保持手段）
３２：水平第１レジスタ（第２計測手段、保持手段）
３３：水平第１比較回路（第１信号発生手段）
３４：水平第２カウンタ（第３計測手段）
４０：水平第４比較回路（第２信号発生手段）
６０：先頭検出及び周期判定回路（第１計測手段）
６１：垂直第１カウンタ（第１計測手段）
６２：割り算回路（第２計測手段、保持手段）
６３：垂直第１レジスタ（第２計測手段、保持手段）
６４：垂直第１比較回路（第１信号発生手段）
６５：垂直第２カウンタ（第３計測手段）
６９：垂直第２比較回路（第２信号発生手段）
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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