(57)【特許請求の範囲】
【請求項１】
シーケンスをなすデータ符号における符号間干渉を低減するための信号処理チャネルにおいて、
チャネル入力と、
前記チャネル入力に接続されて、前記チャネル入力において受信したデータ符号の前縁における振幅遷移時間を減少させ、前記データ符号の後縁における振幅遷移時間を増加させることによって、整形出力内におけるデータ符号の前記前縁を鮮鋭化するための事前整形回路と、
前記事前整形回路に接続されて、前記データ符号に応答し、２レベル出力を発生する判定回路と、
前記判定回路への前記データ符号の入力前に、前記整形出力内において前記データ符号の前記後縁における指数減衰をキャンセルするための指数減衰フィードバック・フィルタであって、該フィードバック・フィルタは、前記２レベル出力を受信するように接続された入力と、前記事前整形回路と前記判定回路との間に接続されて、キャンセル出力と前記整形出力とを組み合わせるキャンセル出力とを有し、前記フィードバック・フィルタは、前記指数減衰キャンセルを決める抵抗・容量回路と、前記事前整形回路の前記整形出力に前記指数減衰キャンセルを導入するタイミングを決める遅延とを有する指数減衰フィードバック・フィルタと、
を備えて成る信号処理チャネル。
【請求項２】
前記事前整形回路が、前記チャネル入力に接続されて連続時間フィードフォワード等化を行う全域通過フィルタであることを特徴とする、請求項１に記載のチャネル。
【請求項３】
前記事前整形回路に、入力信号から該入力信号の導関数を引くための回路要素が含まれており、該回路要素が、前記導関数を引く連続時間が得られるように接続されていることを特徴とする、請求項１に記載のチャネル。
【請求項４】
前記事前整形回路が、インパルス応答を生じることによって、前記データ符号の前記後縁が減衰指数曲線に近似するように整形され、前記フィードバック・フィルタ（６０）の前記抵抗・容量回路のＲＣ時定数が前記減衰指数曲線に近似するように選択されていることを特徴とする、請求項１、２、または、３に記載のチャネル。
【請求項５】
前記ＲＣ時定数を適応するように調整するための回路をさらに備えて成る、請求項４に記載のチャネル。
【請求項６】
前記回路が、前記事前整形回路に適応調整を施して、前記前縁及び後縁における前記振幅遷移時間を変化させるように接続されていることを特徴とする、請求項５に記載のチャネル。
【請求項７】
前記チャネル入力が、磁気記録装置の読み取りヘッドから読み取り信号を受信するように接続されていることを特徴とする、請求項１、２、３、４、５、または、６に記載のチャネル。
【請求項８】
デジタル磁気記録読み取り信号における符号間干渉を低減する方法において、
磁気記録媒体からデータを読み取って、シーケンスをなすデータ符号を形成するステップと、
前記データ符号の前縁に再整形を施して勾配が増すようにすること、及び、前記後縁に再整形を施して勾配が減衰指数曲線に近似するようにすることを含む、前記シーケンスをなすデータ符号にフィルタリングを施して、符号間干渉が主として前記データ符号の後縁にシフトするようにするステップと、
前記シーケンスをなすデータ符号に少なくとも部分的に応答する２レベル出力に判定フィードバック・フィルタリングを施すことを含んでおり、前記判定フィードバック・フィルタリングには、前記再整形データ符号に応答を示す抵抗・容量回路の設定を行い、前記応答が、前記後縁の前記減衰指数曲線をキャンセルするための信号に近似するようにすることと、さらに、前記抵抗・容量回路の前記応答と前記シーケンスをなす再整形データ符号との間の一致を決定するように選択された遅延を導入することとが含まれる、再整形データ符号の前記シーケンスにキャンセル信号を導入して、前記後縁における前記符号間干渉を低減させるステップと、
を備えて成る方法。
【請求項９】
前記キャンセル信号と前記シーケンスをなす再整形データ符号との組み合わせをスライサに入力し、前記抵抗・容量回路によってフィルタリングを施される判定フィードバックである、前記２レベル出力を形成するステップをさらに備えて成る、請求項８に記載の方法。
【請求項１０】
エラー信号に応答して、前記抵抗・容量回路のＲＣ時定数を適応するように調整し、これによって、前記抵抗・容量回路の前記応答を変更するステップをさらに備えて成る、請求項８または９に記載の方法。
【発明の詳細な説明】
【０００１】
【産業上の利用分野】
本発明は、一般に、信号処理チャネル及び方法に関するものであり、とりわけ、符号間干渉を低減し、磁気記録媒体からのデジタル・データの読み取り時におけるノイズの影響を最小限に抑えることに関するものである。
【０００２】
【従来の技術】
磁気記録装置に用いられるような信号処理システムの場合、デジタル・データは、一連の符号に符号化される。デジタル磁気記録の場合、読み取り符号は、例えば、−１、０、＋１といった限られた数の振幅を備えるのが理想である。しかし、全チャネルが、さまざまな形の歪みを生じる非理想特性を備えている。あるタイプの歪みは、「符号間干渉」（ＩＳＩ）と呼ばれる。ＩＳＩは、データ符号を先行及び／または後続符号間に拡張するものである。
【０００３】
磁気記録媒体における磁気転移の間隔を十分にあけることによって、ＩＳＩによるエラーを防ぐことが可能である。しかし、傾向として、媒体における線形データ密度は明らかに増す方向にある。結果として、読み取りチャネルの、限られた高周波応答によって、かなりの量のＩＳＩが生じる可能性がある。
【０００４】
ＩＳＩを補償する方法がある。こうした方法の１つは、所望の信号の高周波成分を復元する等化器に読み取り信号を通すことである。しかし、高周波成分を復元すると、一般に、高周波ノイズが増幅されるので、エラー・レートが増すことになる。ＩＳＩを許容可能レベルまで低減するもう１つの方法は、判定フィードバック等化（ＤＦＥ）を利用することである。読み取りチャネル応答を整形することによって、リーディング(leading)ＩＳＩが許容可能レベルまで低減し、特定のデータ符号の後、該データ符号によって生じるＩＳＩが、主となるようにすることが可能である。結果として、従来の等化に対して高周波ノイズの増幅を低減することが可能になる。トレーリング(trailing)ＩＳＩが既知の場合、入力信号からそれを取り除くことが可能である。従って、このＩＳＩを低減するアプローチは、かなりの回路構成を必要とする。例えば、パーシャル・レスポンス最尤（ＰＲＭＬ）回路には、一般に、複数の極及びゼロを備えた、精密に調整された連続時間フィルタ、アナログ・デジタル変換器、及び、入力信号のデジタル化サンプルに操作を加えるデジタル信号プロセッサが含まれる。このアプローチの利用は、より速いデータ転送速度、より少ない電力消費、及び、集積回路チップのリアル・エステートのより効率の高い利用が要求されるので、しだいに困難になる。
【０００５】
Ｈｕｂｅｒに対する米国特許第４，９５３，０４１号には、既知のアプローチに関する説明においてより詳細な記載がある。該特許の主張によれば、最も「一般的な」デジタル磁気記録システムは、波形振幅のピークを零交差に変換するため、読み取り信号の微分を行っている。微分器ベースのピーク検出チャネルには、ローレンツ入力パルスの前縁と後縁の両方を狭くするパルス・スリム化フィルタを含む第１の等化器を含むことが可能である。パルス・スリム化は、信号から導き出される補償パルスの加算及び減算によって実現する。等化の後、読み取り信号は、微分され、制限され、さらに、代表的なデジタル・データを完全に復元するため反転される。Ｈｕｂｅｒの特許において、対称パルス・スリム化の難点は、それによって読み取りパルスの帯域幅が増し、対応する読み取りシステムの帯域幅の拡大が必要になるということであると主張されている。帯域幅が広くなるほどシステムに入り込むノイズが増すので、チャネルのＳ／Ｎ比が劣化する。システムのノイズが増すと、ＩＳＩによる多量のピーク・ジッタに変換されることが多く、磁気媒体記憶システムにおいて実現可能なウインドウのマージンが大幅に減少する。
【０００６】
Ｈｕｂｅｒシステムは、スリム化された立ち上がりエッジと滑らかな立ち下がりエッジを特徴とする、孤立された(isolated)読み取りパルスを発生するフォワード・フィルタを利用して、「従来の」デジタル磁気記録システムの難点を克服するように設計されている。整形パルスは、パルスのスリム化された立ち上がりエッジが入力しきい値を超えるとステップ応答を発生する比較器に入力される。量子化フィードバック・フィルタは、比較器のステップ応答出力を受信し、フォワード・フィルタの滑らかな立ち下がりエッジに対してほぼ相補形の補償波形を送り出す。量子化フィードバック・フィルタの出力は、フォワード・フィルタの出力と合計され、実質的にステップ関数である等化信号が生じる。
【０００７】
Ｈｕｂｅｒシステムによれば、先行システムに対していくつかの改良がもたらされるが、デジタル磁気記録システムの等化回路構成によって電力消費を減少させるという重要問題に十分に取り組んだものではない。さらに、チップのリアル・エステートのより効率の優れた利用が望ましい。
【０００８】
【発明が解決しようとする課題】
本発明の目的は、複雑さを軽減して、電力及びチップのリアル・エステートの消費を減少させることができるやり方で、符号間干渉を低減するための信号処理チャネル及び方法を提供することにある。
【０００９】
【課題を解決するための手段】
符号間干渉を低減するための信号処理チャネル及び方法には、チャネル入力で受信するデータ符号に事前整形を施して、符号の前縁が鮮鋭化し、後縁は、減衰指数曲線に近似した振幅遷移時間の増加を示すようにすることが含まれる。さらに、そのインパルス応答が遅延指数減衰である低複雑度の判定フィードバック・フィルタを用いることによって、トレーリング符号間干渉を大幅に低減させるやり方で、データ符号の後縁と組み合わせられるパルス応答を発生することが可能である。従って、パルスの事前整形によって、ＩＳＩが主として後縁に位置決めされ、遅延素子と抵抗・容量回路から構成されるフィードバック・フィルタが、ＩＳＩのかなりの部分を取り除く。
【００１０】
望ましい実施例の場合、事前整形は、全域通過フィルタによって実施される。全域通過フィルタは、入力信号の高周波成分を強調することなく、データ符号の前縁を鮮鋭化する、すなわち、エッジを強調するフォワード等化器である。全域通過フィルタには、連続時間適応性が含まれる。
【００１１】
全域通過フィルタの代替案の１つとして、事前整形は、入力信号の導関数の一部を入力信号自体から引くことによって実施することが可能である。導関数を引くと、データ符号の前縁における振幅遷移時間が減少し、後縁における振幅遷移時間が増大する。しかし、全域通過フィルタとは異なり、導関数の減算によって、高周波ノイズが強調される。
【００１２】
整形符号信号は、次に、総和接合を介してスライサのような判定素子に送られ、整形データ符号に応答して、２レベル出力が発生する。２レベル出力は、下流の処理回路要素に伝送されるが、判定フィードバック・フィルタに対する遅延指数減衰応答を発生するための入力も提供する。遅延の長さは、整形符号信号のトレーリングＩＳＩと判定フィードバック・フィルタの指数減衰応答を一致させることができるように選択される。例えば、１、７コードの読み取りには、１コード・ビット時間の固定遅延が必要になる可能性がある。
【００１３】
判定フィードバック・フィルタには、指数遅延応答を決めるＲＣ時定数を備えた抵抗・容量（ＲＣ）回路も含まれている。その最も単純な形態の場合、ＲＣ時定数は、単一固定抵抗器及び単一固定コンデンサによって設定される。しかし、望ましい実施例は、ＲＣ回路は適応形である。ＲＣ回路は、トレーリング符号間干渉の整合をとるための一次応答を設定する。二次応答は、トレーリングＩＳＩとのより有効な整合がとれるように、インダクタンスまたは追加ＲＣ回路を含めることによって実施可能である。
【００１４】
ＲＣ回路からの遅延応答は、事前整形フィルタから出力される整形符号と組み合わせられる。２つのフィルタからの出力によるこの組み合わせは、判定素子への入力前に、総和接合において行われる。
【００１５】
信号処理チャネル及び方法の実施は、判定フィードバック・フィルタからのキャンセル出力の振幅及び形状が、第１のフィルタからの整形符号出力との相補整合をなす場合に最適化される。従って、少なくとも３つの調整が利用可能であることが望ましい。第１に、総和接合における符号振幅は、適応形であることが望ましい。第２に、事前整形フィルタにおける増幅が、適応形であることが望ましい。さらに、判定フィードバック・フィルタの抵抗・容量回路は、指数遅延応答の形状を制御するため、調整可能であることが望ましい。もう１つの可能性は、適応するように調整可能な遅延を利用することである。調整は、干渉しないことが理想である。しかし、個々の調整間において部分的干渉が生じる場合、エラー検出が他の調整可能パラメータによる影響を最も受けずに済む時間に、各調整を行うのが望ましい。
【００１６】
本発明の利点は、電力及びチップのリアル・エステートの消費が大幅に減少することにある。信号処理チャネルのコンピュータ・シミュレーションが示すように、符号間干渉がかなりの程度に除去される。結果として、磁気読み取り操作に関して、高データ密度を得ることが可能になる。もう１つの利点は、複雑さが低下しても、自動同調を利用する妨げにならないということである。
【００１７】
【実施例】
図１を参照すると、磁気ディスク１０にデータの読み取り及び書き込みを行うための磁気記録装置が示されている。該装置には、誘導ヘッド１４に接続された標準読み取り／書き込み集積回路チップ１２が含まれている。書き込みモードの場合、スクランブラ１６が、磁気ディスクのセクタに書き込まれるべきスクランブリングを施したデータを出力するため、顧客データ入力１８、書き込みクロック入力２０、及び、リセット２２を受信する。スクランブラは、ディスクにユーザ情報データを書き込む前に、顧客データに擬似ランダム・シーケンスによる処理を施すことが可能である。
【００１８】
スクランブリングが済むと、後続のデスクランブリングにおけるエラー伝搬を防ぐため、エラー補正コード（ＥＣＣ）符号化が実施される。磁気ディスク１０に対するデータ書き込みのため、ブロック２６において事前符号化が行われる。例えば、書き込み電流の極性は、プリ・コーダ２６の出力に「１」と「０」のいずれが生じるかに基づくようにすることも可能である。
【００１９】
読み取り操作において、ディスク１０における磁気転移によって、読み取り／書き込みヘッド１４がデータ符号すなわち転移応答を発生し、これが、さらに、増幅器２８に入力される。増幅後、アンチ・エイリアシング・フィルタ３０において、シーケンスをなすデータ符号を受信する。読み取り／書き込みチップ１２、増幅器２８、及び、アンチエイリアシング・フィルタ３０の動作は、当該技術において周知のところである。図１に構成要素１２、２８、及び、３０で表した回路要素は、本発明の働きに影響を及ぼすことなく、変更することも、また、ある程度は、除去することも可能である。
【００２０】
図１の読み取り信号処理チャネルには、ＩＳＩキャンセル及びパルス判定回路３２も含まれている。回路の素子は、図２において識別される。通常は対称性のローレンツ応答３４が、適応利得回路３６に対する孤立入力として示されている。利得回路には、可変抵抗３８及び増幅器４０が含まれている。図２の実施例の場合、利得は、孤立された正に向かうデータ符号と負に向かうデータ符号のピークが、事前整形フィルタ４２からの出力（ｗ）の後、＋２Ｖ及び−２Ｖになるように調整することが望ましい。以下では、利得回路３６の適応調整について詳述する。
【００２１】
事前整形フィルタ４２の目的は、ＩＳＩが主としてトレーリング現象になるように、読み取り信号を整形することにある。これは、データ符号の前縁を鮮鋭化し、後縁の遷移時間を長くすることによって実施される。「鮮鋭化」は、この場合、データ符号の振幅遷移時間の短縮、すなわち、エッジの強調と説明される。データ符号の前縁を鮮鋭化することによって、判定装置４４は、前縁の遷移をより確実に検出することになる。
【００２２】
フィルタ４２における事前整形は、いくつかの方法で実施することが可能である。望ましい実施例の場合、事前整形フィルタは、図３に示すようにセンタ・タップ付きの二次側を備える変圧器を含む適応形全域通過フィルタである。全域通過フィルタは、下記の複素周波数応答を示す：
Ｈa(f) ＝ (1−j・2・π・τa・f)／(1＋j・2・π・τａ・f)
ここで、τａ＝ＲＣ。フィルタは、下記によって求められる周波数依存移相を生じる：
φ(f) ＝ −2・arctan(2・π・τａ・f)
従って、全域通過フィルタは、時間的にデータ符号のフーリエ成分のピークをシフトさせ、データ符号の前縁が鮮鋭化し、同時に、後縁は勾配が穏やかになるようにする。データ符号のピークも時間シフトされる。全域通過フィルタの利点は、その動作によってあまりノイズの強調が生じないということである。すなわち、代替事前整形フィルタに比べて、高周波ノイズが強調されない。許容可能な全域通過フィルタについては、P. McEwenおよびJ. Kenneyによる、「判定フィードバック等化用全域通過フォワード等化器 (Allpass Forward Equalizer for Decision Feedback Equalization)」、IEEE Transactions on Magnetics、Vol. 31、No.6、1995年11月、に記述されている。全域通過フィルタは、事前整形の実施にとって望ましい実施例であるが、他の等化技法を用いることも可能である。電力及びチップのリアル・エステートが有効に利用され、複雑さが必要とされない実施例が得られるようにするため、連続時間等化が望ましい。
【００２３】
図４には、事前整形フィルタ４２のもう１つの許容可能実施例が示されている。この実施例の場合、適応利得回路３６からの線路４６に沿った信号によって、総和接合４８及びその信号の導関数を求めるための回路要素５０に対する入力が得られる。微分回路５０の出力は、可変抵抗５２に伝達される。抵抗の調整によって、総和接合４８において引かれる導関数の量が決まる。さらに詳細に後述するように、可変抵抗５２は、適応増幅に相当する。
【００２４】
図２の事前整形フィルタ４２からの出力（ｗ）は、線路５４に沿って総和接合５６に伝達される。総和接合５６に対する第２の入力５８は、判定フィードバック・フィルタ６０からの出力（ｙ）である。判定フィードバック・フィルタは、事前整形読み取り信号からトレーリングＩＳＩをキャンセルするために用いられる。総和接合５６からの信号の総和（ｘ）は、線路６２に沿った２レベル出力（Ｘ）を形成する判定装置４４に対する入力である。２レベル出力は、判定装置に入力されるデータ符号に応答する。判定装置の動作は、当該技術において周知のところである。該装置の実施例の１つは、スライサまた零交差回路と呼ばれる。図２の線路６２における出力の値は、＋１Ｖ及び−１Ｖとすることが可能であるが、他の出力を発生して、同時に、本発明の範囲内にとどまることも可能である。
【００２５】
図２の判定フィードバック・フィルタ６０には、遅延素子６４、可変抵抗６６、及び、容量６８が含まれる。遅延素子６４は、線路５８のフィードバック・フィルタ出力が線路５４に沿った読み取り信号と適正に一致するという保証が得られるように選択されるデジタル遅延素子である。フィードバック・フィルタの抵抗及び容量は、ＩＳＩのキャンセルに関して所望の指数遅延曲線が得られるように選択される。第１のフィルタ４２による整形後におけるデータ符号の後縁の形状は、減衰指数に近似する。従って、少数の素子を利用して、トレーリングＩＳＩの補数であるキャンセル出力（ｙ）を発生する判定フィードバック・フィルタ６０を設けることによって、複雑さは低下するが、それに応じて性能が低下することはない。さらに、先行技術による判定フィードバック・フィルタに比べると、集積回路チップのリアル・エステートに対する要求が大幅に減少する。
【００２６】
図５には、判定フィルタ６０の実施例が示されている。該回路は、１、７コードを利用し、０．７５メートル／秒の従来の１／４インチ・カートリッジ（ＱＩＣ）、すなわち、ＱＩＣ８０カートリッジの誘導ヘッドによってユーザ情報の書き込みを行うシステムにおいて利用することが可能である。ＰＷ５０は、書き込み等化なしで、３μｓｅｃとすることが可能である。従って、コード・ビット時間は、１μｓｅｃになり、２×３／４＝３／２μｓｅｃのデータ符号時間と２．０の密度比が得られる。図５のデジタル遅延素子７０は、１μｓｅｃである。抵抗器部材７２、コンデンサ部材７４、及び、インダクタ部材７６の値は、時定数Ｑ＝０．４が得られるように選択される。その最も単純な形態において、判定フィードバック・フィルタ６０には、インダクタ部材７６が含まれていない。しかし、インダクタンスの場合には、抵抗・容量回路の一次応答に比較すると、トレーリングＩＳＩに対する、より優れた整合を実現する二次応答が得られる。
【００２７】
図６には、二次応答が得られる判定フィードバック・フィルタ７５の代替実施例が示されている。デジタル素子７７によって、ほぼ１ビット時間の遅延が生じる。単位利得部材７９は、連動可変抵抗８１及び８３を有する２つのＲＣ低域通過回路をリンクする。二次応答は、タンデムＲＣ回路の動作によって設定される。
【００２８】
図７における１対のデータ符号７８及び８０に関連して、図２のチャネルの動作を説明することにする。これらの符号は、図２の入力８２において受信される。符号は、適応利得回路３６において増幅可能であり、フィルタ４２で整形を施されて、整形データ符号８４及び８６が生じる。線形等化フィルタ４２によって、対称性ローレンツ符号がトレーリングＩＳＩの顕著な符号に変換される。符号の後縁は、減衰指数によってうまく整合する。判定フィードバック・フィルタ６０は、減衰指数に対するトレーリングＩＳＩの近似を利用するように設計されている。
【００２９】
判定装置４４に対する入力（ｘ）は、線路５４における整形読み取り信号（ｗ）と線路５８からのキャンセル出力（ｙ）との組み合わせである。図７のキャンセル出力８８が整形データ符号８４及び８６と組み合わせられると、判定入力９０が生じる。結果として、判定出力（Ｘ）９２は、ＩＳＩによって誘導されるエラーの影響を受けにくくなる。図７に示す遅延Ｔｄは、図２におけるデジタル遅延素子６４による結果である。この遅延は、総和接合５６における符号８４及び８６の到着とキャンセル出力８８の到着との間に一時的な所望の関係を確立するのに重要な役割を果たす。判定フィードバック・フィルタ６０の抵抗・容量回路の充電及び放電によって、図７のキャンセル出力８８の立ち上がり勾配及び立ち下がり勾配が形成される。
【００３０】
図８は、抵抗・容量回路によって確立される減衰指数曲線に対するトレーリングＩＳＩの整合を示すものである。実線９４は、孤立された正に向かうデータ符号を表している。交番ライン９６は、ＲＣ回路の放電である。放電は、トレーリングＩＳＩに極めて近似している。ＲＣ時定数は、実験によって設定することが可能であるが、さらに詳細に後述するように、適応するように決定される。判定フィードバック・フィルタの遅延は、１μｓｅｃに設定される。遅延は、コード、データ転送速度、及び、図７のフィルタリングを施されていないパルス７８及び８０の幅を含む、いくつかの要素によって決まる。
【００３１】
図９には、間隔が密なデータ符号から構成される場合に発生するさまざまな信号が示されている。入力信号９８は、図２の線路８２で受信される。入力信号９８は、適応利得回路３６で増幅され、データ符号は、ＩＳＩが主としてトレーリングＩＳＩになるように等化フィルタ４２で整形される。整形された出力（ｗ）は、総和接合５６に入力される出力である。もう１つの入力（ｙ）は、判定フィードバック・フィルタ６０からのキャンセル出力１０２である。判定フィードバック・フィルタのＲＣ時定数によって、キャンセル出力の充電及び放電パラメータが決まる。
【００３２】
整形出力１００とキャンセル出力１０２の組み合わせによって、判定装置４４に対する入力信号（ｘ）１０４が得られる。トレーリングＩＳＩが、このキャンセルによってほぼキャンセルされる点に留意されたい。従って、２レベル出力（Ｘ）１０６は、ＩＳＩによって生じるエラーの影響を受けにくくなる。
【００３３】
遅延論理レベル信号しか生じない図２のデジタル遅延素子６４は、一連のＩＣバッファのような単純な非同期遅延とすることが可能である。代替案として、例えば、クロック及びＤフリップ・フロップによって、同期して遅延を生じさせることが可能である。非同期遅延を用いる利点は、適正な動作のためにクロック再生位相ロック式ループを必要としなくなるので、回路の堅牢性が増すことにある。一方、位相が数ビット時間にわたって平均化されたクロックに基づくものであるため、同期遅延に含まれるジッタが減少することになる。回路の性能は、初期ロック・アップのために非同期遅延を加え、データ・フィールドには同期遅延を加えることによって向上させることが可能である。
【００３４】
上述の技法と同様の技法を用いて、ヨーク・ヘッドによって発生する信号におけるＩＳＩをキャンセルすることが可能である。主たる相違は、判定フィードバック・フィルタ６０が、低域通過フィルタではなく、高域通過フィルタであるという点である。この実施例の場合、遅延素子は、除去することが可能である。
【００３５】
前述のように、読み取りチャネルには、利得回路３６、事前整形フィルタ４２、判定フィードバック・フィルタ６０のＲＣ時定数に関する適応調整を含むことが望ましい。該調整は、干渉しないことが理想であるが、部分的干渉は許容可能である。利得回路の調整は、エラー信号の発生がフィードバック・フィルタ６０のパルス応答及びフィルタ４２において行われる事前整形による影響を最も受けずに済む時間に行うことが可能である。調整を実施するタイミングの選択は、事前整形フィルタ４２及びフィードバック・フィルタ６０に等しく適合する。
【００３６】
エラー検出は、図１０に示す単純な方法で実施することが可能である。判定装置４４に対する入力信号（ｘ）は、総和接合１０８において２レベル出力（Ｘ）と比較することが可能である。この比較によって、線路１１０にエラー信号（ｅ）が発生する。選択された利得調整時間において、信号（ｘ−Ｘ）間の差が予測を超える場合、線路１１０のエラー信号を利用して、利得回路要素３６における増幅を減少させることが可能である。一方、信号差（ｘ−Ｘ）が所望の差未満の場合、エラー信号によって、利得回路における増幅の増大が開始される。
【００３７】
利得調整は、データ符号のピークと一致するように実施することが可能である。一方、判定フィードバック・フィルタ６０の時定数は、データ符号のピーク後に実施することが可能である。図７に簡単に言及すると、信号ｘ及びＸは高状態が一致しているのが理想である。キャンセル出力８８を発生するＲＣ回路の充電時間中に、総和接合１０８に対する２つの信号入力間の差をサンプリングすることによって、ＲＣ時定数が適正に設定されているか否かを判定することが可能である。ＲＣ時定数は、線路１１０に沿ったエラー信号の極性及び大きさに応答して、上下に調整することが可能である。
【００３８】
事前整形フィルタ４２の調整は、図７の符号８４のような正に向かうデータ符号の立ち上がり時間に行うことが可能である。事前整形フィルタによって、データ符号の前縁が鮮鋭化される。従って、事前整形フィルタによって、信号９０のパルスの立ち上がり時間が決まる。立ち上がり時間中に信号ｘ及びＸを比較することによって、エラー信号を発生し、事前整形調整を決定することが可能である。
【００３９】
図１１には、回路３６における利得、フォワード・フィルタ４２における増幅、及び、フィードバック・フィルタ６０におけるＲＣ時定数の動的調整を可能にする回路が示されている。図１０に関して既述のように、信号Ｘ及びｘが、総和接合１０８に入力される。２つの信号間の相違は、１対のフリップ・フロップ１１８及び１２２と遅延素子１２４に入力されるエラー信号（ｅ）である。遅延素子１２４からの遅延エラー信号は、第３のフリップ・フロップ１２６に入力される。
【００４０】
判定素子４４からの２レベル出力Ｘは、１対の遅延素子１１６及び１２０に接続されている。遅延２レベル信号は、第１と第２のフリップ・フロップ１１８及び１２２に入力される。判定装置４４の出力から第３のフリップ・フロップ１２６に直接接続が行われる。
【００４１】
３つのフリップ・フロップ１１８、１２２、及び、１２６の出力によって、関連回路を上下いずれにインクリメントさせるべきかの判定が行われる。素子１１８からの出力は、利得回路３６に接続される。この出力に命じられて、利得回路は上下いずれかにインクリメントする。同様に、素子１２２によって、判定フィードバック・フィルタ６０のＲＣ回路の調整が可能になり、この結果、フィルタの時定数がインクリメンタルに調整されることになる。事前整形フィルタ４２の適応回路要素は、エラー検出に応答してインクリメンタルな変更を可能にするため、素子１２６の出力に接続される。
【００４２】
図１〜１１の発明は、主として磁気記録産業における利用に関して解説し、例示したものである。しかし、例えば、デジタル通信といった、信号処理チャネルの他の用途も意図されている。
【００４３】
以上、本発明の実施例について詳述したが、以下、本発明の各実施態様の例を示す。
【００４４】
[実施態様１]
シーケンスをなすデータ符号における符号間干渉を低減するための信号処理チャネルにおいて、
チャネル入力（８２）と、
前記チャネル入力に接続されて、前記チャネル入力において受信したデータ符号（７０及び８０）の前縁における振幅遷移時間を減少させ、前記データ符号の後縁における振幅遷移時間を増加させることによって、整形出力（５４）内におけるデータ符号の前記前縁を鮮鋭化するための事前整形回路（４２）と、
前記事前整形回路に接続されて、前記データ符号に応答し、２レベル出力（９２）を発生する判定回路（４４）と、
前記判定回路への前記データ符号の入力前に、前記整形出力内において前記データ符号の前記後縁における指数減衰をキャンセルするための指数減衰フィードバック・フィルタ（６０）であって、該フィードバック・フィルタは、前記２レベル出力を受信するように接続された入力（６２）と、前記事前整形回路と前記判定回路との間に接続されて、キャンセル出力と前記整形出力とを組み合わせるキャンセル出力（５８；１０２）とを有し、前記フィードバック・フィルタは、前記指数減衰キャンセルを決める抵抗・容量回路（６６及び６８；７２及び７４；８１及び８３）と、前記事前整形回路の前記整形出力に前記指数減衰キャンセルを導入するタイミングを決める遅延（６４；７０；７７）とを有する指数減衰フィードバック・フィルタ（６０）と、
を備える成る信号処理チャネル。
【００４５】
[実施態様２]
前記事前整形回路（４２）が、前記チャネル入力（８２）に接続されて連続時間フィードフォワード等化を行う全域通過フィルタであることを特徴とする、実施態様１に記載のチャネル。
【００４６】
[実施態様３]
前記事前整形回路（４２）に、入力信号（７８及び８０）から該入力信号の導関数を引くための回路要素（５０及び５２）が含まれており、該回路要素が、前記導関数を引く連続時間が得られるように接続されていることを特徴とする、実施態様１に記載のチャネル。
【００４７】
[実施態様４]
前記事前整形回路（４２）が、インパルス応答を生じることによって、前記データ符号（７８及び８０）の前記後縁が減衰指数曲線に近似するように整形され、前記フィードバック・フィルタ（６０）の前記抵抗・容量回路（６６及び６８；７２及び７４；８１及び８３）のＲＣ時定数が前記減衰指数曲線に近似するように選択されていることを特徴とする、実施態様１、２、または、３に記載のチャネル。
【００４８】
[実施態様５]
前記ＲＣ時定数を適応するように調整するための回路（１２０及び１２２）をさらに備えて成る、実施態様４に記載のチャネル。
【００４９】
[実施態様６]
前記回路が、前記事前整形回路（４２）に適応調整（１２４及び１２６）を施して、前記前縁及び後縁における前記振幅遷移時間を変化させるように接続されていることを特徴とする、実施態様５に記載のチャネル。
【００５０】
[実施態様７]
前記チャネル入力（８２）が、磁気記録装置（１０及び１４）の読み取りヘッドから読み取り信号を受信するように接続されていることを特徴とする、実施態様１、２、３、４、５、または、６に記載のチャネル。
【００５１】
[実施態様８]
デジタル磁気記録読み取り信号（９８）における符号間干渉を低減する方法において、
磁気記録媒体（１０）からデータを読み取って、シーケンスをなすデータ符号（７８及び８０）を形成するステップと、
前記データ符号の前縁に再整形を施して、勾配が増すようにすること、及び、前記後縁に再整形を施して、勾配が減衰指数曲線に近似するようにすることを含む、前記シーケンスをなすデータ符号にフィルタリング（６０）を施し、符号間干渉が主として前記データ符号の後縁にシフトするようにするステップと、
前記シーケンスをなすデータ符号に少なくとも部分的に応答する２レベル出力（１０６）に判定フィードバック・フィルタリングを施すことを含んでおり、前記判定フィードバック・フィルタリングには、前記再整形データ符号に応答（１０４）を示す抵抗・容量回路（６６及び６８；７２及び７４；８１及び８３）の設定を行い、前記応答が、前記後縁の前記減衰指数曲線をキャンセルするための信号に近似するようにすることと、さらに、前記抵抗・容量回路の前記応答と前記シーケンスをなす再整形データ符号との間の一致を決定するように選択された遅延（６４；７０；７７）を導入することとが含まれる、再整形データ符号（８４及び８６）の前記シーケンス（１００）にキャンセル信号（８８；１０２）を導入して、前記後縁における前記符号間干渉を低減させるステップと、
を備えて成る方法。
【００５２】
[実施態様９]
前記キャンセル信号（８８；１０２）と前記シーケンス（１００）をなす再整形データ符号（８４及び８６）との組み合わせをスライサ（４４）に入力し、前記抵抗・容量回路（６６及び６８；７２及び７４；８１及び８３）によってフィルタリングを施される判定フィードバックである、前記２レベル出力（１０６）を形成するステップをさらに備えて成る、実施態様８に記載の方法。
【００５３】
[実施態様１０]
エラー信号（１１０）に応答して、前記抵抗・容量回路（６６及び６８；７２及び７４；８１及び８３）のＲＣ時定数を適応するように調整し、これによって、前記抵抗・容量回路の前記応答を変更するステップをさらに備えて成る、実施態様８または９に記載の方法。
【００５４】
【発明の効果】
以上説明したように、本発明を用いることにより、複雑さを軽減して、電力及びチップのリアル・エステートの消費を減少させつつ、符号間干渉を低減することができる。
【図面の簡単な説明】
【図１】本発明によるＩＳＩキャンセルを可能にする磁気ディスク読み取り／書き込みアセンブリのブロック図である。
【図２】本発明によるＩＳＩキャンセルを行うためのパルス・イン及びステップ・アウト回路構成のブロック図である。
【図３】図２の事前整形フィルタの第１の実施例として全域通過フィルタの概要を表した図である。
【図４】図２の事前整形フィルタの第２の実施例として微分・減算回路の概要を表した図である。
【図５】図２の判定フィードバック・フィルタの第１の実施例の概要を表した図である。
【図６】図２の判定フィードバック・フィルタの第２の実施例の概要を表した図である。
【図７】データ符号の間隔が十分にあいている場合の、図２の回路構成の個々のノードにおける波形を示す図である。
【図８】データ符号のトレーリングＩＳＩと図２の判定フィードバック・フィルタの遅延パルス応答との間における整合を示す図である。
【図９】データ符号の間隔が密な場合の、図２の回路構成の個々のノードにおける波形を示す図である。
【図１０】図２の回路構成の個々の素子を調整ためのエラー検出の概要を表した図である。
【図１１】図２の可調整素子に関する動的エラー補正を可能にする回路構成の概要を表した図である。
【符号の説明】
１０：磁気ディスク
１２：読み取り／書き込みチップ
１４：薄膜ヘッド
１６：スクランブラ
１８：顧客データ入力
２０：書き込みクロック入力
２２：リセット
２４：エンコーダ
２６：プリ・コーダ
２８：増幅器
３０：アンチエイリアシング・フィルタ
３２：ＩＳＩキャンセル
３４：ローレンツ応答
３６：適応利得回路
３８：可変抵抗
４０：増幅器
４２：事前整形フィルタ
４４：判定素子
４５：インダクタンス
４６：線路
４７：インダクタンス
４８：総和接合
４９：インダクタンス
５０：回路要素
５１：容量
５２：可変抵抗
５３：抵抗
５４：線路
５６：総和接合
５８：入力
６０：判定フィードバック・フィルタ
６２：パルス化出力
６４：遅延
６６：可変抵抗
６８：容量
７０：固定遅延
７２：抵抗部材
７４：コンデンサ部材
７５：フィードバック・フィルタ
７６：インダクタ部材
７７：デジタル素子
７８：正に向かうデータ符号
７９：利得１の部材
８０：負に向かうデータ符号
８１：可変抵抗
８２：入力
８３：可変抵抗
８４：整形データ符号
８６：整形データ符号
８８：キャンセル出力
９０：判定入力
９２：判定出力
９４：実線
９６：交番線
９８：信号
１００：整形出力
１０２：キャンセル出力
１０４：入力
１０６：パルス化出力
１０８：総和接合
１１０：線路
１１２：判定装置
１１４：パルス化出力
１１６：遅延素子
１１８：フリップ・フロップ
１２０：遅延素子
１２２：フリップ・フロップ
１２４：遅延素子
１２６：フリップ・フロップ
【図１】
0003806219.tif 000002
【図２】
0003806219.tif 000003
【図３】
0003806219.tif 000004
【図４】
0003806219.tif 000005
【図５】
0003806219.tif 000006
【図６】
0003806219.tif 000007
【図７】
0003806219.tif 000008
【図８】
0003806219.tif 000009
【図９】
0003806219.tif 000010
【図１０】
0003806219.tif 000011
【図１１】
0003806219.tif 000012