(57)【特許請求の範囲】
【請求項１】
置換位置整数Ｉ(k)（ｋは１乃至Ｎ）の少なくとも一つのＮビット入力ビット集合を符号化するターボ符号符号化装置（１７）であって、
第１の源および共通の源に接続した第１の入力と２ｍの状態をとり得る多状態レジスタとを備えるメモリサイズｍの第１の符号化装置（２１）であって、前記入力ビット集合を前記第１の源として受け前記入力ビット集合を符号化して符号化ずみの入力ビット集合を第１の出力に生ずる第１の符号化装置（２１）と、
前記入力ビット集合を受けるとともに、前記入力ビット集合の中のビットを配列変換して配列変換ずみの入力ビット集合を生ずるハイブリッドＳランダムインタリービング装置（１９）と（Ｓは任意の所定値）、
第２の源および前記共通の源に接続した第２の入力と２ｍの状態をとり得る多状態レジスタとを備えるメモリサイズｍの第２の符号化装置（２３）であって、前記配列変換ずみの入力ビット集合を前記第２の源として受け前記配列変換ずみの入力ビット集合を符号化して配列変換ずみの符号化ずみ入力ビット集合を第２の出力に生ずる第２の符号化装置（２３）と、
前記第１の符号化装置を前記第１の源から前記共通の源へ切り換えるとともに、前記第２の符号化装置を前記第２の源から前記共通の源に切り換えるスイッチ（ＳＷ）と
を含み、
前記インタリービング装置（１９）が前記整数Ｉ(k)の配列変換を、配列変換後は｜Ｉ(k)−Ｉ(k-nL)｜の値（ここでＬ＝２ｍ−１、ｎはｋ−ｎＬ＞０およびｎＬ＜Ｓで与えられる正の整数である）がＬで割り切れないように行うこと
を特徴とするターボ符号符号化装置（１７）。
【請求項２】
前記レジスタの両方をリセットする符号化ずみ入力ビット集合について末尾ビットの集合を発生する末尾ビット発生器をさらに含む請求項１記載の符号化装置。
【請求項３】
前記末尾ビット発生器が前記第１および第２の符号化装置による前記符号化の完結時に前記第１の符号化装置のレジスタを用いて前記末尾ビット集合を発生する請求項２記載の符号化装置。
【請求項４】
前記インタリービング装置（１９）が前記整数Ｉ(k)のランダムな配列変換を、次の条件、すなわち
｜Ｉ(k)−Ｉ(k-j)｜＞Ｓ（ここで、ｊは０＜ｊ＜Ｓおよびｋ−ｊ＞０で定義される正の整数）
を満足するように行う請求項１記載の符号化装置。
【請求項５】
前記配列変換ずみの整数Ｉ(k)の系列の検証を、次の条件、すなわち
kmod２ｍ−１＝Ｉ(k)mod２ｍ−１
を用いて行う請求項４記載の符号化装置。
【請求項６】
ｄｋが前記Ｎビット入力ビット集合の入力ビットである請求項１記載の符号化装置であって（ここでｄｋ＝±１である）、
Ｍ状態ターボ符号符号化装置への前記入力ビット集合をｐ個のサイズｂの直和部分集合Ｓｉ（ここで、ｐ＝Ｍ−１、Ｉは０乃至（ｐ−１）の整数、ｂはＮ／ｐ以上の最小整数値）、すなわち
Ｓｉ＝｛ｄｋ｜，kmod p＝i｜｝
になるように配列する手段と、
部分集合Ｓｉを合成してｂ行ｐ列のブロックを形成して一つの部分集合の各素子が同じ列に含まれるようにする合成手段と、
前記列の中の入力ビットの集合を配列変換する手段と、
前記列の配列変換のあと前記行を出力してインタリーブ処理により配列変換した入力ビット集合を生ずる手段と
をさらに含む請求項１記載のターボ符号符号化装置。
【請求項７】
置換位置整数Ｉ(k)（ｋは１乃至Ｎ）の少なくとも一つのＮビット入力ビット集合を符号化する方法であって、
ａ．前記入力ビット集合を２ｍの状態をとり得る多状態レジスタ付きの第１の符号化装置（２１）を用いて符号化し第１の出力を生ずる過程と、
ｂ．前記入力ビット集合をハイブリッドＳランダムインタリービング装置（１９）、すなわち前記整数Ｉ(k)の配列変換を、配列変換後は｜Ｉ(k)−Ｉ(k-nL)｜の値がＬで割り切れないように行う（ここでＬ＝２ｍ−１、ｎはｋ−ｎＬ＞０およびｎＬ＜Ｓで定義される正の整数、Ｓは任意に予め定めた値）ハイブリッドＳランダムインターリービング装置（１９）を用いて選択的に配列変換し配列変換ずみの入力ビット集合を生ずる過程と、
ｃ．前記配列変換ずみの入力ビット集合を２ｍの状態をとり得る多状態レジスタ付きの第２の符号化装置を用いて符号化し第２の出力を生ずる過程と、
ｄ．前記第１の符号化装置（２１）を第１の源から共通の源に切り換えるとともに前記第２の符号化装置（２３）を第２の源から前記共通の源に切り換え、前記第１の出力が前記共通の源をもたらすようにする過程と
を含む符号化方法。
【請求項８】
前記入力ビット集合の各々について末尾ビットの集合を発生する過程と、
前記末尾ビットの集合を前記第１および第２の符号化装置の両方のレジスタをリセットするように加える過程と
をさらに含む請求項７記載のターボ符号化方法。
【請求項９】
請求項７記載のターボ符号化方法であって、前記選択的に配列変換する過程が、
(a)Ｎ個の情報ビット（Ｎは正の整数）を受ける過程と、
(b)ハイブリッドインタリービング装置フレームサイズＮを区画する過程と、
(c)１乃至Ｎの値をとるｋについてランダム整数Ｉ(k)の発生を次の条件、すなわち
(1)｜Ｉ(k)−Ｉ(k-j)｜＞Ｓ（ここで、Ｓは任意の値であり、ｊは０＜ｊ＜Ｓおよびｋ−ｊ＞０で定義される正の整数）、
(2)ｎ・Ｌ＞Ｓ（ここで、Ｌは符号化装置レジスタ状態の数マイナス１に等しく、ｎはｋ−ｎ・Ｌ＞０で定義される正の整数であり、その条件を満たさない場合ステップ(4)に進む）、
(3)｜Ｉ(k)−Ｉ(k-n・L)｜≠ｊ・Ｌ（不成立の場合ステップ１−３を繰り返し、成立の場合はステップ(4)に進む）、
(4) ランダム整数Ｉ(k)の各々についてkmod２ｍ−１＝Ｉ(k)mod２ｍ−１（ここで２ｍは前記符号化装置の一つのレジスタのとり得る状態の数、不成立の場合ステップ(1)−(4)を繰り返す）、
を満足するように行う過程と、
(d)置換ずみのインタリーバデータ系列を符号化用に出力する過程と
を含む請求項７記載の符号化方法。
【請求項１０】
請求項８記載の符号化方法であって、
(a)第１の符号化装置および第２の符号化装置による符号化が完結したことを確認する過程と、
(b)情報ビットストリームおよび置換ずみのビットストリームから前記第１および第２の符号化装置への入力を前記第１の符号化装置最終段からの共通帰還に切り換える過程と、
(c)前記第１の符号化装置の中のレジスタの数よりも大きい数になるまで前記帰還からの末尾ビットの数を増加させ、それ以外の場合に過程(b)−(c)を繰り返す過程と
を含む請求項８記載のターボ符号化方法。
【請求項１１】
請求項７記載の符号化方法であって、ｄｋが前記Ｎビット入力ビット集合の入力ビットであり、（ここで、ｄ＝±１）、前記選択的配置変換が、
Ｍ状態ターボ符号符号化装置への前記入力ビット集合をｐ個のサイズｂの直和部分集合Ｓｉ（ここで、ｐ＝Ｍ−１、Ｉは０乃至（ｐ−１）の整数、ｂはＮ／ｐ以上の最小整数値）、すなわち
Ｓｉ＝｛ｄｋ｜，kmod p＝i｜｝
になるように配列する過程と、
部分集合Ｓｉを合成してｂ行ｐ列のブロックを形成して一つの部分集合の各素子が同じ列に含まれるようにする過程と、
前記列の中の前記部分集合の要素を配列変換する過程と、
前記列の配列変換のあと前記行を出力してインタリーブ処理により配列変換した入力ビット集合を生ずる過程と
をさらに含む請求項７記載のターボ符号化方法。
【発明の詳細な説明】
【０００１】
【発明の分野】
この発明は概括的には処理利得の大きいシステムにおいて時間ダイバーシティを形成する信号処理に関する。より詳細にいうと、この発明はターボ符号インターリービングマッピングのシステムおよび方法、すなわち構成要素符号化装置の各々の蓄積用レジスタを全部零の状態に一斉駆動するのに必要な末尾ビットの数を減らしたシステムおよび方法に関する。
【０００２】
【従来技術の説明】
音声データか非音声データかの区別なく、多くの種類のデータ通信システムにおいて、情報伝送の際の信号ダイバーシティまたは冗長度が、データ伝送システム性能の他側面を犠牲にすることなく性能を改善することが判明している。時間ダイバーシティを加える手法としてインタリービング符号化および前向き訂正（ＦＥＣ）符号化の二つが周知である。
【０００３】
インタリービングの処理は入力データ系列を他の系列に置換または配列変換する処理である。例えば、
0003837023.tif 000002
ここで、演算子ＩＮ［Ｊ］は有限入力系列の各ビットまたはシンボルの原位置をインタリーバＩＮの作用により新たな位置Ｊに転置する。時間ダイバーシティを達成するこの配列変換処理をインタリービングと呼び、この処理は多様な方法で行うことができる。通常のインタリービングの方法として、ブロックインタリービングとランダムインタリービングの二つの方法が知られている。
【０００４】
伝送目的地側において信号を再び配列変換し、データ系列をもとの配列に戻す。この逆処理をインタリービング解除と呼ぶ。
【０００５】
最良の性能を発揮する最新の符号化技術はターボ符号である。ターボ符号用インタリービング装置には多様な設計が可能であり、復号化の際の複雑さを軽減する。もっとも有用なものは三種類、すなわち(1)ブロックインタリービング装置、(2)擬似ランダムインタリービング装置、および(3)Ｓ−ランダムインタリービング装置である。
【０００６】
もっとも性能の高いものはＳ−ランダムインタリービング装置である。このＳ−ランダムインタリービング装置は、特定の系列長の範囲内の互いに相隣る位置を同一系列長発揮の互いに隣接する位置にマッピングしない性質を利用する。これによって系列長をできるだけ大きくする。インタリービング装置設計には、入力系列の大きさと置換とを記述した特定の規則セットが必要である。
【０００７】
インタリービング処理と協働してＦＥＣ符号化はコヒーレント復調向け信号に対する性能を改善する。ＦＥＣ符号化は原データ系列に追加の冗長度を加える。スペクトラム拡散無線インタフェース経由で交信する通信システムでは、共用の伝送周波数チャネルに冗長度がすでに存在する。ＦＥＣ符号化装置は、ノードまたは状態および遅延レジスタによる有限状態マシンである。レジスタ相互間の予め定めた遷移が経路を定義し、その経路から所与のデータ入力が出力を生ずる。畳込み符号化データ用の符号化および復号化技術を図解する一般的な方法はトレリス図を用いるやり方であり、これはこの技術分野に詳しい技術者に周知である。トレリス図は状態マシン図の有限の複製であり、図１に示すとおりである。
【０００８】
復号化は、トレリス構成と各レベルおよび各被選択ノードまたは状態についての経路状態または距離とに基づく最尤度復号アルゴリズムを用いて通常行う。畳込み符号の符号ワードはすべてトレリス図中の経路沿いのシンボルに対応する。各状態およびトレリスの各レベルにおいて、加算−比較−選択動作を行って最良の経路および状態を選択する。多数の受信シンボルに対してトレリスを構成する。所定数のシンボルを累積したのち、最小誤差のトレリス経路を判定により決める。トレリス中の全ビットについての最終決定は、符号化装置を全部０の初期状態に強制的に戻すことによって符号化装置から行う。この操作は、符号化のあと有限ビットストリームの末尾に末尾ビット０を挿入することによって行う。この処理を「末尾オフ」と呼ぶ。
【０００９】
最後のノードを起点として「チェイニングバック」処理を行い、最後の判定から最初の判定に向かって判定経路をトレースする。この復号化方法により、原送信シンボルを判定する。トレリス構成は冗長度を導入し、それまでの履歴に累積する。
【００１０】
従来技術のターボ符号化装置を図２に示す。この符号化装置は、第２の再帰型畳込み符号化装置の前段に配置したターボ符号インタリービング装置と並列に接続した第１および第２の系統的再帰型畳込み符号（ＲＣＳ）符号化装置を備える。各符号化装置で用いる二つの再帰型畳込み符号は構成要素符号として周知である。第１の符号化装置は第１の情報ビットＮを原配列に再配列し、第２の符号化装置はターボ符号インタリーバＩＮで置換した入力ビットを再配列する。入力情報系列Ｎは常にチャネル経由で送信される。データ伝送速度によって、両符号化装置からの出力に送信Ｎ前に「鑚孔」する。この鑽孔は、下位タップ（第１および第２の符号化装置１Ｎ，２Ｎ）の交互の出力を出力から消去する処理である。この処理により符号速度が確定する。
【００１１】
ターボ符号インタリーバは系列長の反復なし置換によって定義されるスクランブラである。一系列全体をインタリービング装置に入力し、所定の配列順で出力する。
【００１２】
従来技術による末尾オフ処理を図３および図４に図解する。各符号化装置の末尾ビットを、図３に示すとおり、それぞれの符号化装置のレジスタ帰還から得る。各構成要素符号化装置のレジスタの内容は末尾オフ動作の初めには互いに異なるので、各符号化装置は、個別に一斉駆動しなければならない。図４に図解したとおり、各符号化装置（図３）は情報ビットの符号化後は、互いに独立に排他的に一斉駆動される。各符号化装置は各自の末尾ビットを抽出し受ける。したがって、状態数、または符号化装置のレジスタメモリの数をｍとすると、一つの符号装置でｍ個の末尾ビットを要し、両符号化装置で２ｍ個の末尾ビットを要する。
【００１３】
従来技術によるターボ符号復号装置を図５に示す。復調ずみのソフト値信号Ｎを受けると、第１の構成要素符号化装置からの系統的（情報）ビットとパリティビット１Ｎについてのソフト判定情報が第１の構成要素復号装置に入力される。この第１の構成要素復号装置は、情報ビットとともに復号装置インタリービング装置に入力された情報ビットについて、交信ずみのソフト判定尤度値ｅ１（Ｎ）を発生する。第２の構成要素復号装置への入力は第２の構成要素符号化装置からのインタリービング処理ずみのソフト値系列ＩＮおよびＩｅ１（Ｎ）並びにパリティビット２Ｎを含む。この第２の構成要素復号装置の出力は第１の構成要素復号装置の出力から抽出したソフト判定尤度値を改善し、ターボ復号装置インタリービング装置に従った収束型処理としての再配列ののち第１の構成要素復号装置に帰還される。第２の構成要素復号装置からの出力ｅは復号動作の完結ののちに得られる。
【００１４】
上述のとおり、ターボ符号インタリービング装置を用いると符号化を有限系列長で行う必要が生ずる。そのような有限情報系列を符号化するには、ターボ符号化装置の両構成要素ＲＳＣ符号化装置がトレリスターミネーションで全部零の状態で開始し終了しなければならない。しかし、ターボインタリーバがあるので、二つの構成要素符号化装置を強制的に同時に同じトレリスビットで全部零の状態にターミネートさせることは難しい。従来技術によるターボ符号化装置の大半は情報系列を複数の末尾ビットでターミネートさせる。末尾ビットはターボ符号化系列に不都合でありオーバーヘッドと考えられている。
ターボ符号符号化装置を一斉駆動してそれら装置のトレリスを初期状態に戻すことに伴う難しさは従来技術でも認識されてきた。例えば Blackert ほか著の論文「ターボ符号ターミネーションおよびインタリービング装置条件」、Divsalar ほか著の論文「ＰＳＣ用のターボ符号」、および Barbulescu ほか著の論文「ターボ符号のトレリスを同じ状態でターミネートすること」は、複数の符号化装置のトレリスをそれらの初期状態に戻すことに伴う問題を認識している。しかし、これら従来技術の手法はいずれも符号化装置の効率の低下なしに複数の符号化装置のトレリスを初期状態に戻す適切な方法を提供していない。
【００１５】
したがって、構成要素符号化装置の各々を強制的に全部零の状態にする複数の末尾ビットを必要としないターボ符号インタリービング装置が必要になっている。
【００１６】
【発明の概要】
この発明は再帰型の系統的構成要素符号化装置を有するターボ符号ハイブリッドインタリービング装置に関する。このシステムは各符号化装置のレジスタを全部零の状態に一斉駆動するための複数の末尾ビットを要することなく有限のビットのフレームを符号化する。このハイブリッドインタリービング装置は、両構成要素符号化装置に同じ末尾ビットを用いることによってターボ符号オーバーヘッドを減らし、最良のターボインタリービング装置の性能を改善する。
【００１７】
したがって、この発明の目的は、複数の末尾ビットを符号化処理の一部とする必要のないインタリービングのシステムおよび方法を提供することである。
【００１８】
この発明のもう一つの目的は、ターボ符号符号化系列における不必要なオーバーヘッドを解消し、符号化処理を全部零の状態でターミネートする末尾ビットの数を単一のｍビット末尾に限定することである。ここで、ｍは各構成要素符号化装置における蓄積用レジスタの数である。
【００１９】
このシステムおよび方法の上記以外の目的および利点は、好ましい実施例の詳細な説明を見れば当業者には明らかになろう。
【００２０】
【詳細な説明】
図６に示したこの発明によるハイブリッドインタリービング装置１９付きのターボ符号符号化装置１７は単一の末尾オフビット動作２５を用いて第１および第２のＲＣＳ構成要素符号化装置２１および２３を全部零の状態にターミネートする。この発明の装置１７は最良のターボインタリービング装置の性能の保持と協働して構成要素符号化装置２１および２３の各のトレリスターミネーションに必要な追加の末尾ビットを減らす。
【００２１】
図６および図７はハイブリッドターボ符号インタリービング装置１９のシステムおよび信号処理を図解する。信号処理５１は入力データ系列２７を符号化のために受けることによって開始する（ステップ５３）。符号化系列フレーム長Ｎを選択する（ステップ５５）。状態サイズおよび鑚孔速度（符号速度）はハイブリッドインタリーバとは独立である。ハイブリッドインタリーバ１９は置換用にランダム整数Ｉ(k)を発生する（ステップ５７）。
【００２２】
図８および図９に示すとおり、ランダム整数系列の発生は各フレーム２９の位置３１１−Ｎの各々についてビットごとに行われる。記号Ｉ(k)で示したランダム整数の発生（ステップ５７）は、次式すなわち、
１＜Ｉ(k)＜Ｎ          式（１）
で表される。ここで、インタリーバ系列の中のマップ３３の位置３５１−Ｎの各々につき、ｋ＝１，２，…，Ｎである。この段階の選択では、Ｉ(k)は次の条件Ａ（ステップ５９）、条件Ｂ（ステップ６３）、および条件Ｃ（ステップ６５）を充たさなければならない。すなわち、
条件Ａ：｜Ｉ(k)−Ｉ(k-j)｜＞Ｓ        式（２）
ここで、
０＜ｊ＜Ｓ              式（３）
および
ｋ−ｊ＞０              式（４）
である。条件Ａの式（２）はＳ−ランダムインタリーバの特性を表す。Ｓは任意の値である。
【００２３】
条件Ｂ：｜Ｉ(k)−Ｉ(k-n・L)｜≠ｊ・Ｌ      式（５）
（ステップ６３）。ここで、ｎおよびｊは下記条件、すなわち
ｋ−ｎ・Ｌ＞０          式（６）
および
ｎ・Ｌ＞Ｓ              式（７）
の下での正の整数である（ステップ６１）。Ｌはターボ符号符号化装置に用いられている構成要素符号化装置で定まる。例えば、Ｌ＝７は八状態ターボ符号化装置で用いられる。
【００２４】
条件Ｃ：kmod２ｍ−１＝Ｉ(k)mod２ｍ−１∀ｋ      式（９）
（ステップ６５）。ここで、ｍは構成要素符号化装置の中のメモリの大きさである。四状態符号化装置および八状態符号化装置については、ｍは２および３にそれぞれ等しい。上述のステップを、ハイブリッドインタリーバ１９についてｋ＝１，２，…，ＮのＩ(k)（ステップ６６）が選択され（ステップ６７）出力される（ステップ６９）まで繰り返す。
【００２５】
上述のシステムおよび方法の例を図８，図９および図１０に示す。Ｓを２に等しくＬを４に等しくしたハイブリッドインタリービング装置１９付きの四状態ターボ符号符号化装置１７を用いた系列フレームサイズ１６の系列をこの発明により置換した状態で示す。このハイブリッドインタリービング装置１９は上記条件ＡおよびＢを満足する。ハイブリッドインタリービング装置１９の出力３７を、図１０に示すとおり条件Ｃを用いて、入力２７の情報系列のインデックスの２ｍ−１による除算ののち出力の残余の系列３９Ａがインタリービングマッピングインデックス３３により対応の残余系列３９Ｂに等しくなるように検証する。ターボ符号ハイブリッドインタリービング装置１９が５１の形に特定されると、情報ビット２７は、第２の構成要素符号化装置が出力３７を受けるようにハイブリッドインタリービング装置１９に従って置換される。
【００２６】
第１および第２の構成要素符号化装置２１および２３に同じ末尾ビットを用いてトレリスをターミネートする本発明の処理を図６および図１１に図解する。上述のとおり、情報ビットを両符号化装置により符号化する。第１の構成要素符号化装置２１は原配列の情報ビット２７を処理する。第２の構成要素符号化装置２３はハイブリッドインタリービング装置１９により置換ずみの情報ビット３７を処理する。これら第１および第２の構成要素符号化装置２１および２３の出力を鑽孔し多重化して出力を生ずる（図２参照）。
【００２７】
両符号化装置に同一の末尾ビットを用いたトレリスターミネーション処理８１は、すべての情報ビットが第１および第２の構成要素符号化装置２１および２３により符号化ずみであることを確認して開始される（ステップ８３）。符号化処理のこの時点において、両符号化装置のレジスタの内容は同じである。これら第１および第２の符号化装置２１および２３は原情報ビットストリーム２７と置換ずみビットストリームからの入力を第１の符号化装置２１からの帰還信号４１に切り換える。第１の符号化装置の出力１Ｎおよび第２の符号化装置の出力２Ｎを末尾オフ処理のために情報出力Ｎで鑽孔する操作は情報ビット２７および３７の符号化装置２１および２３における符号化期間の操作と同じである。両スイッチ４３および４５の遷移のあと第１の符号化装置２１はそれ自身のレジスタから帰還経路４１経由で末尾ビットを受ける（ステップ８５）。第２の符号化装置２３への末尾ビットはハイブリッドインタリービング装置１９によるインタリービング処理をまだ受けておらず、第１の符号化装置におけるトレリスターミネーション用の末尾ビット４１と同じである（ステップ８７）。
【００２８】
Ｍ状態符号化装置については、第１および第２の符号化装置２１および２３内のすべてのレジスタを全部零の状態に一斉駆動するのにlog２Ｍ個の末尾ビットが要る。Ｌ＝Log２Ｍとして表１は四状態および八状態符号化装置についての所用末尾ビット数および末尾符号化シンボル総数を示す。
【表１】
0003837023.tif 000003
四状態構成要素符号化装置つきの1/2速度および1/3速度ターボ符号符号化装置については、この発明の装置１７は末尾ビット４個および６個をそれぞれ不要にする。八状態構成要素符号化装置付きの1/2速度および1/3速度ターボ符号符号化装置については、この発明の装置１７は従来技術における所用数に対比して末尾ビット６個および９個をそれぞれ不要にする。
【００２９】
ハイブリッドインタリービング装置付きのターボ符号符号化装置は従来技術によるＳ−ランダムインタリービング装置よりも優れた性能を発揮する。すなわち、上記条件Ｂ記載の規則がターボ符号の重み分布の最悪状態を回避する一方、条件Ａが最良の特性を保持するからである。ハイブリッドインタリービング装置１９は第１および第２の構成要素復号装置２１および２３の両方について末尾部分の初めに同じトレリス状態系列に導くので、これら第１および第２の符号化装置２１および２３の両方を全部零の状態に一斉駆動するのに単一のｍビット末尾系列を用いることは受入れ可能である。第１の構成要素復号装置の発生した末尾ビットなどの付帯的情報Ｉｅ１は第２の構成要素復号器に伝達され、これによって総合特性に向上させる（図５参照）。
【００３０】
例えば、原情報系列が
Ｎ＝｛１０１１０１０００１１１０１０１｝
である場合は、ハイブリッドインタリービング装置１９により置換した情報は
ＩＮ＝｛０００１０１１１１０１０１０１１｝
である。
【００３１】
この情報系列を第１および第２の構成要素符号化装置２１および２３により符号化する。第１の構成要素符号化装置２１は入力を原系列のまま処理し、第２の構成要素符号化装置はインターリービング装置１９からの置換ずみ出力Ｉを処理する。
【００３２】
第１の符号化装置２１から得られるトレリス状態系列は
｛２３３３１００００２１００２３３１０｝
である。
【００３３】
上に示したとおり、各トレリス状態系列からの最後の二つの状態（４ビット）はハイブリッドインターリービング装置によって同じになる。これによって、これら第１および第２の符号化装置２１および２３が同じ末尾ビットを受けることが可能になり、ターボ符号化処理のオーバーヘッドを減らす。
【００３４】
条件Ｃは上記二つの構成要素符号化装置のトレリス状態を情報ビットの符号化ののち同じにする。これによって両構成要素符号化装置につき末尾ビットが同じになり、末尾ビットに起因するターボ符号オーバーヘッドが減る。また、同じ末尾ビットを用いると、インターリービング装置の設計がＳ−ランダムインターリービング装置に基づいている上述の相互作用型復号装置には望ましい。この発明はターボ符号性能を改善するが、そのメモリに対する要求はインターリービング装置の大きさに比例した所要メモリ容量を備えるＳ−ランダムインターリービング装置の場合と同じである。
【００３５】
代替の実施例を図１２に示す。
【００３６】
ブロックの大きさＮの２進情報ビット系列をＤ、すなわち
Ｄ＝｛ｄ１，ｄ２，…，ｄＮ｝、ただしｄｋ＝±１      式（１０）
で表す。
【００３７】
Ｍを４または８としたＭ状態ターボ符号化装置が与えられたとすると、情報系列Ｄをｐ個の直和部分集合Ｓ、すなわちｐ＝Ｍ−１としたとき
0003837023.tif 000004
に区画できる。ここで、ｐは四状態および八状態ターボ符号について３および７にそれぞれ設定する。上述の区画方法は同時設定区画と同様である。状態ターボ符号の各々についてｐの値を特定する。
【００３８】
各部分集合のブロックサイズ［Ｎ／ｐ］である。ここで、［Ｎ／ｐ］はＮ／ｐ以上の値の最小整数を示す。各部分集合をインタリーバマッピングの利用により置換する。次に、個々の部分集合全部を合成して、下にＩで示すインターリービング装置出力を得る。すなわち、
0003837023.tif 000005
ここで、Ｓｉ(k)は部分集合Ｓｉのｋ番目のインタリービングずみ出力ビットであり、Ｓ０(k)は部分集合Ｓ０のｋ番目のインタリービングずみ出力ビットである。部分集合の区画および合成を含む上述の処理は［Ｎ／ｐ］行ｐ列のブロックインタリービング装置を用いて次のとおり図解できる。すなわち、
（１）情報ビットをブロックインタリービング装置で行方向に次のとおり蓄積する：
書込み→
0003837023.tif 000006
（２）各列ブロックの中のビットを、与えられたインタリーバの種類、すなわち原則的に任意の候補インタリーバの一つにできる種類に従って置換する。例えば、条件ＡおよびＢを各列ブロックに適用し、条件Ｃはこの場合に不要である。
（３）上述のマトリクスを下に述べる順序で行ごとに読み出し、インタリービング処理ずみの出力を入力に受ける第２の構成要素符号化装置に加えて原情報系列インタリービング処理なしの場合と同じ状態に駆動する。
読出し→
0003837023.tif 000007
この発明を好ましい実施例について上に述べてきたが、特許請求の範囲の各請求項に記載した発明の範囲内にある上記以外の諸変形が当業者には自明であろう。
【図面の簡単な説明】
【図１】四状態ＲＳＣ符号化装置についての従来技術のトレリス図。
【図２】従来技術によるターボ符号符号化装置のシステム図。
【図３】従来技術による四状態符号化装置のシステム図であり末尾オフを示す。
【図４】従来技術による末尾オフの方法の流れ図。
【図５】従来技術によるターボ符号復号装置のシステム図。
【図６】この発明のシステムおよび方法を用いたハイブリッドインタリービング装置を備えるターボ符号符号化装置のシステム図。
【図７】この発明を実施したインタリービング装置方法の流れ図。
【図８】Ｓを２としＬを４とした四状態ターボ符号符号化装置についてこの発明の発生した１６フレーム長インタリービング系列。
【図９】図８のインタリービング系列のマッピング。
【図１０】図８の１６フレームサイズインタリーブ系列の検証ずみのもの。
【図１１】この発明を実施した末尾オフの方法の流れ図。
【図１２】代替の実施例の流れ図。
【符号の説明】
１７          ターボ符号符号化装置
１９          ハイブリッドインタリービング装置
２１          第１の構成要素符号化装置
２３          第２の構成要素符号化装置
２５          トレリスターミネーション用末尾ビット源
２７          原配列の情報ビット
３７          インタリービング処理ずみの情報ビット
４３，４５    スイッチ
５１          信号処理
５３          開始
５５          ハイブリッドインタリーバフレームサイズＮを区画する
５７          マッピング用のランダム整数Ｉ(k)を発生する
５９          Ｉ(k)は条件｜Ｉ(k)−Ｉ(k-j)｜＞Ｓを満足？
６１          ｎ・Ｌ＞Ｓが成立？
６３          Ｉ(k)は条件｜Ｉ(k)−Ｉ(k-ｎ・L)｜≠j・Lを満足？
６５          kmod2ｍ-1はＩ(k)mod2ｍ-1に等しい？
６６          ｋだけ増加させる
６７          ｋはn+1に等しい？
６９          終了
８３          情報ビット符号化ののち末尾ビットオフを開始
８５          第１の符号化装置が同装置内部のレジスタから帰還路経由で末尾ビットを受ける
８７          第２の符号化装置への末尾ビットはインタリービング処理されてなく第１の符号化装置への末尾ビットと同じ
８９          末尾ビットの数は＞ｍ？
９１          終了
【図１】
0003837023.tif 000008
【図２】
0003837023.tif 000009
【図３】
0003837023.tif 000010
【図４】
0003837023.tif 000011
【図５】
0003837023.tif 000012
【図６】
0003837023.tif 000013
【図７】
0003837023.tif 000014
【図８】
0003837023.tif 000015
【図９】
0003837023.tif 000016
【図１０】
0003837023.tif 000017
【図１１】
0003837023.tif 000018
【図１２】
0003837023.tif 000019