(57)【特許請求の範囲】
【請求項１】
隣接層間のみを接続するヴィアで配線設計が行われる多層配線基板の設計を行う多層配線基板設計方法において、
ビルドアップヴィア種をキーとして、設計対象の多層配線基板に関する層毎のヴィアサイズ，シフト方向，およびヴィアピッチが定義されているパラメータを、複数のビルドアップヴィア種分読み込み、当該各パラメータの情報をコンピュータが有するメモリに格納するパラメータ読み込みステップと、
前記パラメータ読み込みステップにおいてメモリに格納されたパラメータの情報と、打ち始め層および到達層のコンピュータへの指示とに基づき、ビルドアップヴィアを有する多層配線基板の配線設計をコンピュータにより行う配線設計ステップとを備え、
前記配線設計ステップが、
設計者からのコンピュータへの指示に基づき、信号ネットを選択する信号ネット選択ステップと、
設計者からのコンピュータへの打ち始め層および到達層の指示に基づき、配線層をコンピュータが選択する配線層選択ステップと、
設計者からのコンピュータへの指示に基づき、メモリに格納されている複数のビルドアップ種のうちから、該当するビルドアップヴィア種を選択するビルドアップヴィア種選択ステップと、
前記ビルドアップヴィア種選択ステップで選択されたビルドアップヴィア種毎に、各配線層について定義される形式のパラメータの情報であって、前記パラメータの情報の中で前記配線層選択ステップで選択された配線層に必要なパラメータ情報をメモリからコンピュータに読み込むパラメータ情報読み込みステップと、
前記パラメータ情報読み込みステップで読み込まれたパラメータの情報に基づいて、前記信号ネット選択ステップで選択された信号ネットに対する設計上のヴィア打ちおよび配線をコンピュータにより行うヴィア打ち・配線ステップと、
前記ヴィア打ち・配線ステップによるヴィア打ちおよび配線により設計ルール上エラーが生じていないかどうかをコンピュータによりチェックし、設計ルール上エラーが生じている場合にはコンピュータ上で前記ビルドアップヴィア種選択ステップに制御を戻す設計ルール上エラー有無判定ステップと、
設計対象の多層配線基板の全信号ネットの配線設計が完了したか否かを判定する設計完了判定ステップとを有する、
ことを特徴とする多層配線基板設計方法。
【請求項２】
パラメータ読み込みステップが、設計対象の多層配線基板に関する各ビルドアップヴィア種毎に、各配線層について定義される形式のパラメータを格納するパラメータファイルの読み込みを開始するパラメータファイル読み込み開始ステップと、
前記パラメータファイル読み込み開始ステップで読み込みが開始されたパラメータファイル中のビルドアップヴィア種毎の各パラメータの情報をメモリに格納するパラメータ情報メモリ格納ステップと、
前記パラメータ情報メモリ格納ステップによる処理が終了する毎に、パラメータファイルのＥＯＦをチェックし、
パラメータファイルの読み込みの終了を判定・制御するパラメータファイル読み込み終了制御ステップとからなることを特徴とする請求項１記載の多層配線基板設計方法。
【請求項３】
前記パラメータ情報読み込みステップは、選択したビルドアップヴィア種が用意しているパラメータのうち、必要な層のパラメータを読み込み、
前記設計完了判定ステップは、読み込んだパラメータに基づいて、全信号ネットの配線
設計が完了したか否かを判定する、
ことを特徴とする請求項１または請求項２記載の多層配線基板設計方法。
【請求項４】
多層配線基板がビルドアップ基板であることを特徴とする請求項１，請求項２，または請求項３に記載の多層配線基板設計方法。
【請求項５】
隣接層間のみを接続するヴィアで配線設計が行われる多層配線基板の設計を行う多層配線基板設計装置において、
ビルドアップヴィア種をキーとして、設計対象の多層配線基板に関する層毎のヴィアサイズ，シフト方向，およびヴィアピッチが定義されているパラメータを、複数のビルトアップヴィア種分読み込み、当該各パラメータの情報をメモリに格納するパラメータ読み込み手段と、
前記パラメータ読み込み手段によりメモリに格納されたパラメータの情報と、
打ち始め層および到達層の指示とに基づき、ビルドアップヴィアを有する多層配線基板の配線設計を行う配線設計手段とを備え、
配線設計手段が、
設計者からの指示に基づき、信号ネットを選択する信号ネット選択手段と、
設計者からのコンピュータへの打ち始め層および到達層の指示に基づき、配線層をコンピュータが選択する配線層選択手段と、
設計者からのコンピュータへの指示に基づき、メモリに格納されている複数のビルドアップ種のうちから、該当するビルドアップヴィア種を選択するビルドアップヴィア種選択手段と、
前記ビルドアップヴィア種選択手段で選択されたビルドアップヴィア種毎に、各配線層について定義される形式のパラメータの情報であって、前記パラメータ情報の中で前記配線層選択手段により選択された配線層に必要なパラメータ情報をメモリからコンピュータに読み込むパラメータ情報読み込み手段と、
前記パラメータ情報読み込み手段で読み込まれたパラメータの情報に基づいて、前記信号ネット選択手段により選択された信号ネットに対する設計上のヴィア打ちおよび配線をコンピュータにより行うヴィア打ち・配線手段と、
前記ヴィア打ち・配線手段によるヴィア打ちおよび配線により設計ルール上エラーが生じていないかどうかをコンピュータによりチェックし、設計ルール上エラーが生じている場合には前記ビルドアップヴィア種選択手段によるビルドアップヴィア種の選択に制御を戻す設計ルール上エラー有無判定手段と、
設計対象の多層配線基板の全信号ネットの配線設計が完了したか否かを判定する設計完了判定手段とを有することを特徴とする多層配線基板設計装置。
【請求項６】
隣接層間のみを接続するヴィアで配線設計が行われる多層配線基板の設計を行う多層配線基板設計方法の処理を実行するコンピュータに、
ビルドアップヴィア種をキーとして、設計対象の多層配線基板に関する層毎のヴィアサイズ，シフト方向，およびヴィアピッチが定義されているパラメータを、複数のビルトアップヴィア種分読み込み、当該各パラメータの情報をメモリに格納するパラメータ読み込みステップ、
設計者からの指示に基づき、信号ネットを選択する信号ネット選択ステップと、設計者からの打ち始め層および到達層の指示に基づき、配線層をコンピュータが選択する配線層選択ステップと、設計者からの指示に基づき、メモリに格納されている複数のビルドアップ種のうちから、該当するビルドアップヴィア種を選択するビルドアップヴィア種選択ステップ、
前記ビルドアップヴィア種選択ステップで選択されたビルドアップヴィア種毎に、各配線層について定義される形式のパラメータの情報であって、前記パラメータの情報の中で前記配線層選択ステップで選択された配線層に必要なパラメータ情報をメモリからコンピュータに読み込むパラメータ情報読み込みステップと、前記パラメータ情報読み込みステップで読み込まれたパラメータの情報に基づいて、前記信号ネット選択ステップで選択された信号ネットに対する設計上のヴィア打ちおよび配線を行うヴィア打ち・配線ステップと、前記ヴィア打ち・配線ステップによるヴィア打ちおよび配線により設計ルール上エラーが生じていないかどうかをチェックし、設計ルール上エラーが生じている場合には前記ビルドアップヴィア種選択ステップに制御を戻す設計ルール上エラー有無判定ステップと、設計対象の多層配線基板の全信号ネットの配線設計が完了したか否かを判定する設計完了判定ステップ、を備える配線設計ステップ、
を実行させるためのプログラム。
【請求項７】
前記パラメータ情報読み込みステップは、選択したビルドアップヴィア種が用意しているパラメータのうち、必要な層のパラメータを読み込み、
前記設計完了判定ステップは、読み込んだパラメータに基づいて、全信号ネットの配線設計が完了したか否かを判定する、
ことを特徴とする請求項６に記載のプログラム。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、以下のａおよびｂに示すような特徴を有する多層配線基板（「多層配線基板」とは、表面にＬＳＩ（Ｌａｒｇｅ  Ｓｃａｌｅ  Ｉｎｔｅｇｒａｔｉｏｎ）等の電子部品を搭載し、内層に少なくとも２層以上の信号層を有する配線基板をいう）、すなわち隣接層間のみを接続するヴィアで配線設計が行われる多層配線基板の設計を行う多層配線基板設計方法に関する。
【０００２】
ａ．「貫通スルーホールで層間を接続する配線基板」（一般的なプリント基板）ではなく、隣接層間を接続するヴィアの組み合わせにより内部接続を実現している多層配線基板
【０００３】
ｂ．ヴィアが重なること（スタックヴィア）が許容されない多層配線基板
【０００４】
ここで、本発明の適用対象の多層配線基板としては、例えば、ビルドアップ基板や、ポリイミド薄膜基板が考えられる。なお、「ポリイミド薄膜基板」とは、セラミック基板をベースとして表層にポリイミド薄膜を有している配線基板（絶縁材料に感光性のポリイミド樹脂を使用し、この樹脂層にヴィアホールを形成し、フォトリソグラフィ，真空蒸着，またはスパッタリングおよびメッキ法を使用して配線層を形成し、かつこの一連の工程を繰り返して逐次絶縁層および配線層を形成する多層配線基板）をいう。
【０００５】
【従来の技術】
図９は、上記のような多層配線基板の代表例であるビルドアップ基板の具体例（片側４層ビルドアップ基板）の構造を示す図である。
【０００６】
ビルドアップ基板は、通常、コア基板（ベース基板）とビルドアップ層部分とから構成されている。
【０００７】
コア基板には、一般的なプリント配線基板で用いられるガラスエポキシ積層の配線基板が使用され、表裏を接続するために貫通スルーホールが設けられている。コア基板は、配線基板全体の構造上のベースとなって全体を支持する役割と、電源層や接地（グランド）層等の密度の低い層を受け持つ役割とを有している。
【０００８】
一方、ビルドアップ層部分は、コア基板上に、銅メッキによる配線と絶縁層としてのエポキシ樹脂層とを逐次積層して必要な層数を積み上げて形成される。その際に、ビルドアップ層を接続するヴィアを形成する手段として、フォトリソグラフィによりエッチングで形成する方法とレーザを用いて直接ヴィアを形成する方法とが一般的である。
【０００９】
さて、図９に示すビルドアップ基板は、以下のａおよびｂに示すようにして形成されており、ＬＳＩ端子の高密度化に対応した配線基板となっている。
【００１０】
ａ．通常のエポキシ樹脂をガラスクロスに含浸させたシートを絶縁材料とし、貫通ヴィアによって電気的に内外層を接続したプリント配線基板をコア基板とし、そのコア基板上に感光性樹脂の絶縁層を形成する。
【００１１】
ｂ．フォトリソグラフィやレーザによって極小径のビルドアップヴィアホールを開け、下層との接続とパターン形成とをメッキで行いながら、順次ビルドアップ層（図９中のＢ１層〜Ｂ４層）を積み上げてビルドアップ層部分を形成する。
【００１２】
このようなビルドアップ基板において、層間を接続するヴィアは、隣接層間のみしか認められていない。
【００１３】
したがって、図１０中の（ａ）の斜視図に示すように、Ｂ３層とＢ１層との間にＢ２層を挟んで接続する信号配線（ヴィア群を使用する信号配線）は、Ｂ３層とＢ２層とを接続する第１のヴィアと、Ｂ２層とＢ１層とを接続する第２のヴィアと、第１のヴィアのボトムランドと第２のヴィアのトップランドとを接続する短い配線とで構成される。なお、このようなヴィア群と短い配線とからなる信号配線を、本明細書では「ビルドアップヴィア」と表現する。
【００１４】
図１０中の（ｂ）に、同図の（ａ）の斜視図に対応する断面図を示す。ここで、第１のヴィアのボトムランドと第２のヴィアのトップランドとのヴィアピッチは、配線収容性を上げる観点から、製造上可能な最小値で定義することが好ましい。
【００１５】
このようなビルドアップ基板では、例えば、炭酸ガスレーザでφ５０μｍのヴィアがφ７５μｍのランド（トップ／ボトムとも）上に形成され、トップランド／ボトムランドが１００μｍピッチで配置され、それを接続する配線の配線幅は５０μｍに設定される。
【００１６】
なお、一般のビルドアップ基板の製造工法においては、図１１に示すスタックヴィアのように、ヴィアが重なることは製造上禁止されている。先に述べたように、本発明における適用対象（設計対象）の多層配線基板にも、このような禁止条件が存在している。
【００１７】
したがって、例えば、図１２の（ａ）および（ｂ）（斜視図および断面図）に示すように、Ｂ４層からＣ１層まで接続するビルドアップヴィアは、スタガ（ｓｔａｇｇｅｒ）状（千鳥状）に配列させることとなる（本発明でも、このようなスタガ状の配列が行われることが前提となっている）。
【００１８】
このように、ビルドアップ基板やポリイミド薄膜基板において、層間を接続するヴィアは隣接層間しか接続することしかできない。よって、少なくとも１層以上の配線層を間に挟んで信号配線を到達させたい場合には、到達層まで順次隣接層を表示してヴィアを打ち、次にシフトさせるために短い配線を設け、またヴィアを打つ工程を繰り返さなければならなかった。
【００１９】
次に、図１３〜図２０を参照して、従来技術における「ビルドアップヴィアを用いて多層配線基板の配線設計を行う場合」の動作（従来の多層配線基板設計方法における動作）を説明する。
【００２０】
ここでは、Ｂ４層で信号配線を行い、その信号配線をＣ１層に接続させたい場合を考える。
【００２１】
この場合には、まず最初に、図１３に示すように、信号配線Ａを行い、図１４に示すように、Ｂ４層−Ｂ３層を選択し、所望の位置にヴィアＢを打ち、Ｂ３層に移動する。
【００２２】
次に、図１５に示すように、Ｂ３層上で例えば１００μｍの短い配線Ｃを行う。
【００２３】
さらに、図１６に示すように、Ｂ３層−Ｂ２層を選択し、配線Ｃの終了地点にヴィアＤを打ち、Ｂ２層に移動する。
【００２４】
同様な処理を、図１７〜図２０に示すように、Ｃ１層まで繰り返し、配線Ｅ，ヴィアＦ，配線Ｇ，およびヴィアＨを設定する。
【００２５】
このように、従来の多層配線基板設計方法では、ビルドアップヴィアを設ける場合に、「到達層まで順次隣接層を表示してヴィアを打ち、次にシフトさせるために短い配線を設け、またヴィアを打つ」という工程を繰り返さなければならなかった。
【００２６】
【発明が解決しようとする課題】
上述した従来の多層配線基板設計方法では、上記のように、層間を接続するヴィアは隣接層間しか接続することができないので、少なくとも１層以上の配線層を間に挟んでヴィアを到達させたい場合（ビルドアップヴィアを設ける場合）には、「到達層まで順次隣接層を表示してヴィアを打ち、次にシフトさせるために短い配線を設け、またヴィアを打つ」という工程を繰り返さなければならず、設計効率が非常に悪くなるという問題点があった。
【００２７】
本発明の目的は、上述の点に鑑み、上記の問題点を解決するために、あらかじめパラメータとして各ビルドアップヴィア種のヴィアサイズ（各層間のヴィアの径），シフト方向（各層においてヴィアを接続する短い配線をシフトさせる方向），およびヴィアピッチ（各層における短い配線の長さ。図１０参照）を定義しておき、ビルドアップヴィアの打ち始め層および到達層（例えば、図２１中のＢ４層およびＣ１層）を選択した後にビルドアップヴィアを設定するように指示するだけで、パラメータ値（パラメータの情報）に沿って自動的に通過層や到達層のヴィアおよび配線を発生させることができ（図２１の（ａ）の状態から自動的に同図（ｂ）に示すようなヴィア打ち・配線が可能となる）、設計効率の向上を図ることができる多層配線基板設計方法を提供することにある。
【００２８】
なお、本発明の多層配線基板設計方法に対する従来技術に関する特許公報としては、多層配線基板の構造や設計を考察している点で本発明と類似している「特開平０５−２４３７３１号公報」が存在する。
【００２９】
しかし、上記の特開平０５−２４３７３１号公報に記載された技術（「多層薄膜配線基板」）は、全てのペア層のヴィア・ホールを含む配線端子の座標を同一にして、従来の汎用的な多層配線基板の配線設計ツールを利用できるようにすることを目的とする技術であり、各ビルドアップヴィア種のパラメータをあらかじめ定義することによって多層配線基板の設計効率の向上を図る本発明とは本質的に相違している。
【００３０】
【課題を解決するための手段】
本発明の多層配線基板設計方法は、隣接層間のみを接続するヴィアで配線設計が行われる多層配線基板の設計を行う多層配線基板設計方法において、ビルドアップヴィア種をキーとして、設計対象の多層配線基板に関する層毎のヴィアサイズ，シフト方向，およびヴィアピッチが定義されているパラメータを、複数のビルドアップヴィア種分読み込み、当該各パラメータの情報をコンピュータが有するメモリに格納するパラメータ読み込みステップと、前記パラメータ読み込みステップにおいてメモリに格納されたパラメータの情報と、打ち始め層および到達層のコンピュータへの指示とに基づき、ビルドアップヴィアを有する多層配線基板の配線設計をコンピュータにより行う配線設計ステップとを備え、
前記配線設計ステップが、設計者からのコンピュータへの指示に基づき、信号ネットを選択する信号ネット選択ステップと、設計者からのコンピュータへの打ち始め層および到達層の指示に基づき、配線層をコンピュータが選択する配線層選択ステップと、設計者からのコンピュータへの指示に基づき、メモリに格納されている複数のビルドアップ種のうちから、該当するビルドアップヴィア種を選択するビルドアップヴィア種選択ステップと、前記ビルドアップヴィア種選択ステップで選択されたビルドアップヴィア種に対するパラメータの情報であって前記配線層選択ステップで選択された配線層に該当する情報をメモリからコンピュータに読み込むパラメータ情報読み込みステップと、前記パラメータ情報読み込みステップで読み込まれたパラメータの情報に基づいて、前記信号ネット選択ステップで選択された信号ネットに対する設計上のヴィア打ちおよび配線をコンピュータにより行うヴィア打ち・配線ステップと、前記ヴィア打ち・配線ステップによるヴィア打ちおよび配線により設計ルール上エラーが生じていないかどうかをコンピュータによりチェックし、設計ルール上エラーが生じている場合にはコンピュータ上で前記ビルドアップヴィア種選択ステップに制御を戻す設計ルール上エラー有無判定ステップと、設計対象の多層配線基板の全信号ネットの配線設計が完了したか否かを判定する設計完了判定ステップと、を備える。
【００３１】
ここで、上記のパラメータ読み込みステップは、設計対象の多層配線基板に関する各ビルドアップヴィア種に対するパラメータを格納するパラメータファイルの読み込みを開始するパラメータファイル読み込み開始ステップと、前記パラメータファイル読み込み開始ステップで読み込みが開始されたパラメータファイル中のビルドアップヴィア種毎の各パラメータの情報をメモリに格納するパラメータ情報メモリ格納ステップと、前記パラメータ情報メモリ格納ステップによる処理が終了する毎に、パラメータファイルのＥＯＦ（Ｅｎｄ  Ｏｆ  Ｆｉｌｅ）をチェックし、パラメータファイルの読み込みの終了を判定・制御するパラメータファイル読み込み終了制御ステップとからなるようにすることが考えられる。
【００３２】
例えば、パラメータ情報読み込みステップは、選択したビルドアップヴィア種が用意しているパラメータのうち、必要な層のパラメータを読み込み、設計完了判定ステップは、読み込んだパラメータに基づいて、全信号ネットの配線設計が完了したか否かを判定する。
【００３３】
また、この発明の第２の観点に係る、隣接層間のみを接続するヴィアで配線設計が行われる多層配線基板の設計を行う多層配線基板設計装置は、ビルドアップヴィア種をキーとして、設計対象の多層配線基板に関する層毎のヴィアサイズ，シフト方向，およびヴィアピッチが定義されているパラメータを、複数のビルトアップヴィア種分読み込み、当該各パラメータの情報をメモリに格納するパラメータ読み込み手段と、前記パラメータ読み込み手段によりメモリに格納されたパラメータの情報と、打ち始め層および到達層の指示とに基づき、ビルドアップヴィアを有する多層配線基板の配線設計を行う配線設計手段と、を備え、
配線設計手段が、設計者からの指示に基づき、信号ネットを選択する信号ネット選択手段と、設計者からのコンピュータへの打ち始め層および到達層の指示に基づき、配線層をコンピュータが選択する配線層選択手段と、設計者からのコンピュータへの指示に基づき、メモリに格納されている複数のビルドアップ種のうちから、該当するビルドアップヴィア種を選択するビルドアップヴィア種選択手段と、前記ビルドアップヴィア種選択手段で選択されたビルドアップヴィア種に対するパラメータの情報であって前記配線層選択手段により選択された配線層に該当する情報をメモリからコンピュータに読み込むパラメータ情報読み込み手段と、前記パラメータ情報読み込み手段で読み込まれたパラメータの情報に基づいて、前記信号ネット選択手段により選択された信号ネットに対する設計上のヴィア打ちおよび配線をコンピュータにより行うヴィア打ち・配線手段と、前記ヴィア打ち・配線手段によるヴィア打ちおよび配線により設計ルール上エラーが生じていないかどうかをコンピュータによりチェックし、設計ルール上エラーが生じている場合には前記ビルドアップヴィア種選択手段によるビルドアップヴィア種の選択に制御を戻す設計ルール上エラー有無判定手段と、設計対象の多層配線基板の全信号ネットの配線設計が完了したか否かを判定する設計完了判定手段と、を有する。
例えば、パラメータ情報読み込みステップは、選択したビルドアップヴィア種が用意しているパラメータのうち、必要な層のパラメータを読み込み、前記設計完了判定ステップは、読み込んだパラメータに基づいて、全信号ネットの配線設計が完了したか否かを判定する。
【００３４】
【発明の実施の形態】
次に、本発明について図面を参照して詳細に説明する。
【００３５】
（１）  第１の実施の形態
【００３６】
図１は、本発明の第１の実施の形態に係る多層配線基板設計方法の処理手順を示す流れ図である。この処理は、パラメータ読み込みステップ１０１と、配線設計ステップ１０２とからなる。
【００３７】
図２は、図１中のパラメータ読み込みステップ１０１の詳細な処理を示す流れ図である。この処理は、パラメータファイル読み込み開始ステップ２０１と、パラメータ情報メモリ格納ステップ２０２と、パラメータファイル終了判定ステップ２０３と、パラメータファイル読み込み終了ステップ２０４とからなる（パラメータファイル終了判定ステップ２０３およびパラメータファイル読み込み終了ステップ２０４によってパラメータファイル読み込み終了制御ステップが形成される）。
【００３８】
図３は、図１中の配線設計ステップ１０２の詳細な処理を示す流れ図である。この処理は、信号ネット選択ステップ３０１と、配線層選択ステップ３０２と、ビルドアップヴィア種選択ステップ３０３と、パラメータ情報読み込みステップ３０４と、ヴィア打ち・配線ステップ３０５と、設計ルール上エラー有無判定ステップ３０６と、設計完了判定ステップ３０７とからなる。
【００３９】
図４〜図６は、本実施の形態に係る多層配線基板設計方法で採用されるビルドアップヴィアのシフト方向に関する種類を説明するための図である。
【００４０】
図４〜図６における多層配線基板において、Ｂ４層とＢ２層とを接続するビルドアップヴィアを設けたいときに、Ｂ２層に別の信号配線（信号配線Ｂ２Ｓとする）が存在したとする。
【００４１】
Ｂ４層−Ｂ３層ヴィア（Ｂ４層とＢ３層との間を接続するヴィア）を設けた場合に、当該ヴィアの直下層であるＢ３層に設けられるボトムランドの位置に対し、Ｎ，Ｓ，Ｗ，およびＥの４方向の何れかに（図４参照）、Ｂ３層−Ｂ２層ヴィアのトップランドを設けることができる。
【００４２】
図５に示すように、仮にＥ方向に当該トップランド（トップランドＢ３Ｔとする）を設けた場合には、Ｂ２層のボトムランドと信号配線Ｂ２Ｓとが干渉してしまう。したがって、この場合には、図６に示すように、例えばＷ方向に当該トップランドＢ３Ｔを設けるべきである（Ｎ方向やＳ方向に当該トップランドＢ３Ｔを設けてもよい）。
【００４３】
このように、本実施の形態では、ヴィアは当該ヴィアを打つ直下層におけるボトムランドから次の層間のヴィアのトップランドの存在する方向（「シフト方向」という）の如何により４種類に区別できる。
【００４４】
ここで、このシフト方向は配線チャネルに整合を取った方が配線収容性を上げることができる。すなわち、信号配線チャネルが図４中のＸＹ方向であれば、シフト方向は図４に示すＮ，Ｓ，Ｗ，およびＥの４方向が妥当と考えられる（ただし、より一般的には、シフト方向は、複数種類の任意の方向を考えることができる）。
【００４５】
図７は、本実施の形態に係る多層配線基板設計方法で採用されるパラメータの具体例を示す図である。
【００４６】
パラメータ（ビルドアップヴィア種毎に定義されるパラメータ）においては、少なくとも、各層間のヴィアサイズと、各層のシフト方向（Ｎ，Ｓ，Ｗ，およびＥの４方向が存在する（図４参照））と、各層のヴィアピッチ（図１０参照）とが定義されている。
【００４７】
ここで、図７を例としてパラメータの定義内容を具体的に説明する。
【００４８】
図７に示すパラメータは、以下のａ〜ｊに示す各行を有している（図７中のａ〜ｊの符号は以下の説明の便宜上のためのものであり、パラメータ中の本来の情報ではない）。
【００４９】
ａ．注釈行である。
【００５０】
ｂ．３行（ｃの行）目以降で定義しているビルドアップヴィア種の名称（識別情報）を示す行である。ここでは、この名称を「ＢＵＩＬＤＵＰ７５−Ｅ」としている。
【００５１】
ｃ．「ｂｕｉｌｄｕｐ」はヴィアを打つ（設定する）ことを示すコマンドのコマンド名である。この行のコマンドは、「ＶＩＡ７５」というヴィア（φ７５μｍのヴィア）をＢ４層−Ｂ３層間に打つことを指示している。
【００５２】
ｄ．「ｍｏｖｅｔｏ」は各層におけるシフトを示すコマンドのコマンド名である。この行のコマンドは、上記のｃの行のコマンドによってヴィアが打たれた地点から、Ｅ方向に＋７５μｍだけ、「ＬＩＮＥ７５」の配線（線幅７５μｍの配線）でシフトすること（Ｂ４層から見た場合に、Ｂ３層でＥ方向に７５μｍシフトすること）を指示している。なお、＋７５の後の「０」は「Ｎ／Ｓ方向についてはシフトしないこと」を意味している。
【００５３】
ｅ．ｃと同様に、Ｂ３層−Ｂ２層間に「ＶＩＡ７５」というヴィアを打つことを意味している。
【００５４】
ｆ．ｄと同様に、Ｂ２層で、上記のｅのヴィアの位置からＥ方向に−７５μｍ（Ｗ方向に＋７５μｍ）だけシフトすることを意味している。
【００５５】
ｇ．ｃおよびｅと同様に、Ｂ２層−Ｂ１層間に「ＶＩＡ７５」というヴィアを打つことを意味している。
【００５６】
ｈ．ｄおよびｆと同様に、Ｂ１層で、上記のｇのヴィアの位置からＥ方向に＋７５μｍだけシフトすることを意味している。
【００５７】
ｉ．ｃ，ｅ，およびｇと同様に、Ｂ１層−Ｃ１層間に「ＶＩＡ７５」というヴィアを打つことを意味している。
【００５８】
ｊ．Ｃ１層で、上記のｉのヴィアの位置からＥ方向に−３５０μｍだけ「ＬＩＮＥ１２０」の配線でシフトすることを意味している。
【００５９】
なお、このパラメータによって定義されるシフト方向は、Ｂ３層ではＥ方向であり、Ｂ２層ではＷ方向であり、Ｂ１層ではＥ方向である。ここで、最初の通過層であるＢ３層でのシフト方向で当該パラメータのシフト方向が識別される（したがって、このパラメータで定義されるビルドアップヴィア種の名称は「ＢＵＩＬＤＵＰ７５−Ｅ」と「Ｅ」が付されている）。
【００６０】
次に、図１〜図７を参照して、本実施の形態に係る多層配線基板設計方法の全体の動作について詳細に説明する。
【００６１】
本実施の形態に係る多層配線基板設計方法の処理は、図１に示すように、設計対象の多層配線基板に関する各ビルドアップヴィア種の層毎のヴィアサイズ，シフト方向，およびヴィアピッチが定義されている各パラメータを読み込み当該各パラメータの情報（パラメータ値）をメモリに格納するパラメータ読み込みステップ１０１（パラメータを読み込む工程）と、パラメータ読み込みステップ１０１においてメモリに格納されたパラメータの情報と打ち始め層（ヴィアを打ち始める層）および到達層（ヴィアが最終的に到達する層）の指示とに基づきビルドアップヴィアを有する多層配線基板の配線設計を行う配線設計ステップ１０２（配線設計を行う工程）とからなる。
【００６２】
これらの２つの工程（ステップ）は、詳細には、以下に説明するようになる。
【００６３】
第１に、パラメータを読み込む工程における詳細な処理を、図２を用いて説明する。
【００６４】
まず、各ビルドアップヴィア種について、各層間のヴィアサイズと、各層のシフト方向およびヴィアピッチとをあらかじめコンピュータシステムに定義しておくために、設計対象の多層配線基板に対するパラメータファイルの読み込みが開始され（ステップ２０１）、当該パラメータファイル内の各パラメータが順次読み込まれていく。
【００６５】
パラメータは、先に述べたように、ビルドアップヴィア種毎に、各層（配線層）について（各層は配線層名により識別される）、ヴィアサイズ，シフト方向，およびヴィアピッチが定義されている形式である。
【００６６】
次に、上記で読み込まれた各パラメータのビルドアップヴィア種をキーにして、層間毎のヴィアサイズ，層毎のシフト方向，および層毎のヴィアピッチ等を示すパラメータの情報（パラメータ値）が、メモリに格納される（ステップ２０２）。
【００６７】
各パラメータについてステップ２０２の処理が終了する毎に、ＥＯＦが検出されたか否かがチェックされ、設計対象の多層配線基板に対するパラメータファイルが完了したか否かが判定される（ステップ２０３）。
【００６８】
ステップ２０３で「ＥＯＦが検出された（パラメータファイルが完了した）」と判定された場合には、当該パラメータファイルの読み込み（取り込み）が終了する（ステップ２０４）。
【００６９】
第２に、配線設計を行う工程における詳細な処理を、図３を用いて説明する。
【００７０】
まず、設計者（ユーザ）の指示に基づき、設計対象の多層配線基板上の所望の信号ネットの選択が行われる（ステップ３０１）。
【００７１】
ここで、「信号ネット」（シグナルネット）とは、電子部品間の接続情報を意味する。これに対して、「信号配線」とは、信号ネットに基づき実際に配線されているその配線（パターン）を意味している（信号ネットを実現する電子部品間の実際の配線である）。
【００７２】
ビルドアップヴィアを設けたい場合には、設計者からの指示に基づき、打ち始め層と到達層とが指定される（ステップ３０２）。具体的には、表示装置上の画面において、当該打ち始め層および当該到達層が選択され、表示される。
【００７３】
次に、設計者の指示により、通過層や到達層におけるヴィアの阻害要因がないか否かということや配線制約の考慮に基づき、ビルドアップヴィア種が選択される（ステップ３０３）。
【００７４】
ここで、「阻害要因」とは、通過層や到達層に異ネット（他の信号ネット）の配線パターンが存在する場合や、異ネットのヴィアが存在する場合のことをいう（例えば、図５参照）。ステップ３０４の選択処理では、このような阻害要因を避けるようにビルドアップヴィア種が選択される。
【００７５】
また、「配線制約」とは、主に配線長に起因する制約のことをいう。ステップ３０４の選択処理では、通過層や到達層で、配線長が遵守できなくなるようなビルドアップヴィア種を選択しないよう気を付けなくてはならない（例えば、目的方向と異なる方向にシフトすれば配線長は長くなる）。
【００７６】
次に、ステップ３０３で選択されたビルドアップヴィア種およびステップ３０２で選択された打ち始め層と到達層とによって決まる各配線層をキーとして、メモリから、パラメータの情報（ヴィアサイズ，シフト方向，およびヴィアピッチ等）がメモリから読み出される（ステップ３０４）。
【００７７】
続いて、ステップ３０４で読み込まれたパラメータの情報に基づいて、各層間のヴィアの設定（ヴィア打ち）および各層の配線が行われる（ステップ３０５）。
【００７８】
ステップ３０５の処理が終了した場合には、コンピュータシステム側で、そのヴィア打ちおよび配線を行うことに起因して、到達層や通過層で異ネットとのスペーシング等の設計ルールに抵触しないかどうか（設計ルール上エラーが生じていないかどうか）がチェックされる（ステップ３０６）。
【００７９】
ステップ３０６で「設計ルールに抵触する（設計ルール上エラーが生じている）」と判定された場合には、ステップ３０３に制御が戻され、ビルドアップヴィア種の選択がやり直される。
【００８０】
一方、ステップ３０６で「設計ルールに抵触しない（設計ルール上エラーが生じていない）」と判定された場合には、設計対象の多層配線基板における全信号ネットの配線設計（結線）が完了したか否かのチェックが行われる（ステップ３０７）。
【００８１】
ステップ３０７で「全信号ネットの配線設計が完了していない」と判定された場合には、ステップ３０１に制御が戻され、図３に示す一連の処理が繰り返される。
【００８２】
一方、ステップ３０７で「全信号ネットの配線設計が完了した」と判定された場合には、処理が終了する。
【００８３】
なお、「何層から何層までのビルドアップヴィアであるか」ということでビルドアップヴィア種が異なることはない。本実施の形態、ひいては本発明では、ヴィアを打ち始めたい層（打ち始め層）と到達させたい層（到達層）とを指定することであらかじめ定められているパラメータ中の必要な配線層の情報が読み出されることになる。
【００８４】
例えば、Ｂ４層からＢ２層にビルドアップヴィアを打ちたい場合には、Ｂ４層とＢ２層とが打ち始め層および到達層として選択され、Ｂ４層からＣ１層まで定義されているビルドアップヴィア種のパラメータが選択された上で、Ｂ２層までヴィアが打たれて止まる。
【００８５】
（２）  第１の実施の形態の変形／拡張形態
【００８６】
上記の第１の実施の形態では、設計対象の多層配線基板としてビルドアップ基板を例としたが、本発明における設計対象の多層配線基板はこれに限られるものではない。
【００８７】
他の設計対象の多層配線基板としては、例えば、ポリイミド薄膜基板（絶縁材料に感光性のポリイミド樹脂を使用し、この樹脂層にヴィアホールを形成し、フォトリソグラフィ，真空蒸着，またはスパッタリングおよびメッキ法を使用して配線層を形成し、かつこの一連の工程を繰り返して逐次絶縁層および配線層を形成する多層配線基板）が考えられる。
【００８８】
（３）  第２の実施の形態
【００８９】
図８は、本発明の第２の実施の形態の構成（コンピュータシステム構成）を示すブロック図である。
【００９０】
このコンピュータシステム８０は、コンピュータ８１と、メモリ８２と、表示装置８３と、多層配線基板設計処理プログラム８００とを含んで構成されている。
【００９１】
図８を参照すると、本発明の第２の実施の形態は、図１に示した第１の実施の形態に係る多層配線基板設計方法の処理を実行するための多層配線基板設計処理プログラム８００として実現される。
【００９２】
多層配線基板設計処理プログラム８００は、コンピュータシステム８０におけるコンピュータ８１に読み込まれ、当該コンピュータ８１に第１の実施の形態に係る多層配線基板設計方法の処理（図１〜図３参照）を実行させるように制御する。多層配線基板設計処理プログラム８００の制御によるコンピュータシステム８０の動作は、第１の実施の形態に係る多層配線基板設計方法の処理内容（動作）と全く同様になるので、その詳しい説明を割愛する。
【００９３】
【発明の効果】
以上説明したように、本発明によると、打ち始め層と到達層とを指定するだけで、当該両層およびその間の層（配線層）におけるビルドアップヴィアを自動的に発生させることを可能にすることにより、ビルドアップ基板のような「隣接層間のヴィアだけで接続される多層配線基板」の配線設計において、設計効率が高くなるという効果が生じる。
【図面の簡単な説明】
【図１】本発明の第１の実施の形態に係る多層配線基板設計方法の処理手順を示す流れ図である。
【図２】図１中のパラメータ読み込みステップの詳細な処理手順を示す流れ図である。
【図３】図１中の配線設計ステップの詳細な処理手順を示す流れ図である。
【図４】本発明の第１の実施の形態に係る多層配線基板設計方法で採用されるビルドアップヴィアのシフト方向の種類を説明するための図である。
【図５】本発明の第１の実施の形態に係る多層配線基板設計方法で採用されるビルドアップヴィアのシフト方向の種類を説明するための図である。
【図６】本発明の第１の実施の形態に係る多層配線基板設計方法で採用されるビルドアップヴィアのシフト方向に関する種類を説明するための図である。
【図７】本発明の第１の実施の形態に係る多層配線基板設計方法で採用されるパラメータの具体例を示す図である。
【図８】本発明の第２の実施の形態の構成を示すブロック図である。
【図９】ビルドアップ基板の具体例の構造を示す図である。
【図１０】ビルドアップヴィアを説明するための図である。
【図１１】スタックヴィアを説明するための図である。
【図１２】ビルドアップヴィアを説明するための図である。
【図１３】従来の多層配線基板設計方法における動作を説明するための図である。
【図１４】従来の多層配線基板設計方法における動作を説明するための図である。
【図１５】従来の多層配線基板設計方法における動作を説明するための図である。
【図１６】従来の多層配線基板設計方法における動作を説明するための図である。
【図１７】従来の多層配線基板設計方法における動作を説明するための図である。
【図１８】従来の多層配線基板設計方法における動作を説明するための図である。
【図１９】従来の多層配線基板設計方法における動作を説明するための図である。
【図２０】従来の多層配線基板設計方法における動作を説明するための図である。
【図２１】本発明の多層配線基板設計方法が従来技術と異なる点を説明するための図である。
【符号の説明】
８０  コンピュータシステム
８１  コンピュータ
８２  メモリ
８３  表示装置
１０１  パラメータ読み込みステップ
１０２  配線設計ステップ
２０１  パラメータファイル読み込み開始ステップ
２０２  パラメータ情報メモリ格納ステップ
２０３  パラメータファイル終了判定ステップ
２０４  パラメータファイル読み込み終了ステップ
３０１  信号ネット選択ステップ
３０２  配線層選択ステップ
３０３  ビルドアップヴィア種選択ステップ
３０４  パラメータ情報読み込みステップ
３０５  ヴィア打ち・配線ステップ
３０６  設計ルール上エラー有無判定ステップ
３０７  設計完了判定ステップ
８００  多層配線基板設計処理プログラム
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【図１６】
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【図１７】
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【図１８】
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【図１９】
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【図２０】
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【図２１】
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