(57)【特許請求の範囲】
【請求項１】
カソードとアノードとの間に、電流計、交流電流源、及び直流電流源をこの順に直列に接続し、前記交流電流源及び前記直流電流源の双方を動作させることにより前記カソード上にめっき膜を形成する工程を有し、
前記交流電流源は、電圧を１０ｋＨｚ以上の周波数で変化させ、
前記めっき膜を形成する工程は、
前記電流計の検出値と、前記直流電流源による直流電流の値との差分である変位電流を検出する検出工程と、
前記変位電流の電流値、及び前記変位電流と前記交流電流源による電圧の位相差に基づき、前記めっき膜の表面積の変化を算出する算出工程と、
前記めっき膜の表面積の変化に基づき、前記めっき膜に対する電流密度が変化しないように、前記直流電流源を制御する制御工程と、
を含むめっき方法。
【請求項２】
請求項１に記載のめっき方法において、
前記制御工程の後、所定時間は、次の制御工程を行わないめっき方法。
【請求項３】
請求項１または２に記載のめっき方法において、
前記算出工程において、前記めっき膜の表面積の変化が所定の基準値を超えた場合に、前記制御工程において前記直流電流源における直流電流の値を変化させるめっき方法。
【請求項４】
請求項１から３いずれかに記載のめっき方法において、
前記算出工程において、所定の時間幅における前記位相差の平均値に基づき、前記めっき膜の表面積の変化を算出するめっき方法。
【請求項５】
基板上に形成された絶縁膜に設けられた複数の凹部をめっき処理により導電材料で埋め込むめっき工程を含み、
当該めっき工程は、
前記凹部表面に形成された導電材料をカソードとして、当該カソードとアノードとの間に、電流計、交流電流源、及び直流電流源をこの順に直列に接続し、前記交流電流源及び前記直流電流源の双方を動作させることにより前記導電材料上にめっき膜を形成する工程であり、
前記交流電流源は、電圧を１０ｋＨｚ以上の周波数で変化させ、
前記電流計の検出値と、前記直流電流源による直流電流の値との差分である変位電流を検出する検出工程と、
前記変位電流の電流値、及び前記変位電流と前記交流電流源による電圧の位相差に基づき、前記めっき膜の表面積の変化を算出する算出工程と、
前記めっき膜の表面積の変化に基づき、前記めっき膜に対する電流密度が変化しないように、前記直流電流源を制御する制御工程と、
を含む半導体装置の製造方法。
【請求項６】
請求項５に記載の半導体装置の製造方法において、
前記制御工程の後、所定時間は、次の前記制御工程を行わないようタイミングを制御する半導体装置の製造方法。
【請求項７】
請求項５または６に記載の半導体装置の製造方法において、
前記算出工程において、前記めっき膜の表面積の変化が、所定の基準値を超えた場合に、前記制御工程において前記直流電流源における直流電流の値を変化させる半導体装置の製造方法。
【請求項８】
請求項５から７いずれかに記載の半導体装置の製造方法において、
前記算出工程において、所定の時間幅における前記位相差の平均値に基づき、前記めっき膜の表面積の変化を算出する半導体装置の製造方法。
【請求項９】
カソード上にめっき膜を形成するために、前記カソードとアノードとの間に直流電流を流す直流電流源と、
前記直流電源と前記カソードの間に設けられ、周波数１０ｋＨｚ以上で動作する交流電流源と、
前記交流電流源と前記カソードの間に設けられた電流計と、
前記電流計の検出値と、前記直流電流源による直流電流の値との差分である変位電流を検出して、当該変位電流の電流値、及び前記変位電流と前記交流電流源による電圧の位相差に基づき、めっき処理中の前記めっき膜の表面積の変化を算出する表面積算出部と、
前記めっき膜の表面積の変化に基づき、前記めっき処理中の前記めっき膜に対する電流密度が変化しないように前記直流電流源を制御する電流制御部と、
を含むめっき処理システム。
【請求項１０】
請求項９に記載のめっき処理システムにおいて、
前記電流制御部は、前記直流電流源における直流電流値を変化させた後、所定時間は、次に前記直流電流値を変化させる処理を行わないめっき処理システム。
【請求項１１】
請求項９または１０に記載のめっき処理システムにおいて、
前記電流制御部は、前記表面積算出部が算出した前記めっき膜の表面積の変化が、所定の基準値を超えた場合に、前記直流電流値を変化させるめっき処理システム。
【請求項１２】
請求項９から１１いずれかに記載のめっき処理システムにおいて、
前記表面積算出部が、所定の時間幅における前記位相差の平均値に基づき、前記めっき膜の表面積の変化を算出するめっき処理システム。
【請求項１３】
請求項９から１２いずれかに記載のめっき処理システムにおいて、
前記カソードは、基板上に形成された絶縁膜に設けられた複数の凹部表面に形成された導電材料であるめっき処理システム。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、めっき方法、半導体装置の製造方法およびめっき処理システムに関する。
【背景技術】
【０００２】
銅配線を用いる半導体装置において、設計ルールの縮小に伴う配線パターン微細化が進むにつれ、銅めっきプロセスにおけるビアやトレンチへの埋設性能の向上が要求されている。銅配線は、ダマシン（ｄａｍａｓｃｅｎｅ）法で形成される。ダマシン法は、層間絶縁膜等の絶縁膜に配線溝やビアホール等の凹部を形成し、当該凹部内にバリアメタル膜を形成し、バリアメタル膜上に銅を含む薄膜をシード膜として形成し、当該シード膜を電解めっきのカソード電極として凹部内に銅膜をめっき法で埋め込み、凹部外に露出したバリアメタル膜、シード膜およびめっき銅膜を化学機械研磨（Chemical Mechanical Polishing：ＣＭＰ）により除去することにより形成される。
【０００３】
特許文献１（特開２００５−２６４２７１号公報）には、複数の凹部が形成された層における第１の基準幅以下の幅を有する微細凹部が当該層に占める割合を取得する工程と、その割合に応じて、導電性材料で凹部を埋め込む際の積算電流量を決定する工程と、その積算電流量に基づき、電解めっき法により、導電性パターンを形成する工程とを含む半導体装置の製造方法が記載されている。これにより、適切な膜厚の電解めっき膜を形成することができるとされている。
【０００４】
特許文献２（特開２００６−２８３１５１号公報）には、溝パターンと溝パターン内部に金属層が形成された絶縁膜を備えた半導体基板に、直流電界に周波数１００Ｈｚ以上の交流電界を重畳して印加し、金属層上に金属膜を形成する工程が記載されている。
【０００５】
特許文献３（特開２００７−２３３６８号公報）には、フィルドビア形成に際して、該フィルドビアの軸に垂直な面内の大きさが変化する領域であってかつ該領域の導体結晶粒の大きさを略均一としたい領域を形成する際に、形成途中における導体表面であってめっき液中に露出する露出面に供給する電流を該露出面面積の拡大に応ずる所定の条件に従って増加させ、露出面に供給される電流の電流密度を一定に保つようにする技術が記載されている。
【０００６】
特許文献４（特開２００１−１２３２９８号公報）には、被めっき対象物と同じ材料からなる電極を用い、電極電位と電流密度の関係式を予め求めておく一方、めっき浴中にて被めっき対象物を任意の電位または電流値で分極させ、そのときの電流値および電位値を求め、上記関係式と前記電流値および電位値から被めっき対象部分の面積を算出し、この算出した面積に基づいて所定の膜厚のめっきを行うことのできる電流値で電界めっきを行う技術が記載されている。
【特許文献１】特開２００５−２６４２７１号公報
【特許文献２】特開２００６−２８３１５１号公報
【特許文献３】特開２００７−２３３６８号公報
【特許文献４】特開２００１−１２３２９８号公報
【発明の開示】
【発明が解決しようとする課題】
【０００７】
ところで、微細化に伴い、多数の微細な凹部が形成されるので、とくにめっき初期のめっき膜の表面積は凹凸のある分だけ増加することになる。表面積が大きくなると、シード膜表面での電流密度は減少する。めっき成膜速度は電流密度に比例するため、表面積が大きい場合に、成膜速度が減少してしまい、ボイド形成等をはじめとした膜質の劣化等の問題が生じる可能性がある。また、めっき成膜中に表面積が減少していくことで埋め込み性や膜質が劣化することも問題であった。そのため、表面積に応じた電流密度の制御が必要である。しかし、従来、めっき膜の表面積の変化に応じて略リアルタイムで電流密度を制御することができなかった。
【課題を解決するための手段】
【０００８】
本発明によれば、
カソードとアノードとの間に直流電流を流して前記カソード上にめっき膜を形成する工程と、
前記直流電流とともに、前記カソードと前記アノードとの間に交流成分を重畳させて、前記カソードと前記アノードとの間に流れる変位電流を検出する工程と、
前記変位電流に基づき、前記めっき膜の表面積の変化を算出する工程と、
前記めっき膜の表面積の変化に基づき、前記めっき膜を形成する工程において前記めっき膜に対する電流密度が変化しないように、前記直流電流の値を制御する工程と、
を含むめっき方法が提供される。
【０００９】
本発明によれば、
基板上に形成された絶縁膜に設けられた複数の凹部をめっき処理により導電材料で埋め込むめっき工程を含み、
当該めっき工程は、
前記凹部表面に形成された導電材料をカソードとして、当該カソードとアノードとの間に直流電流を流して前記導電材料上にめっき膜を形成する工程と、
前記直流電流とともに、前記カソードと前記アノードとの間に交流成分を重畳させて、前記カソードと前記アノードとの間に流れる変位電流を検出する工程と、
前記変位電流に基づき、前記めっき膜の表面積の変化を算出する工程と、
前記めっき膜の表面積の変化に基づき、前記めっき膜を形成する工程において前記めっき膜に対する電流密度が変化しないように、前記直流電流の値を制御する工程と、
を含む半導体装置の製造方法が提供される。
【００１０】
本発明によれば、
カソード上にめっき膜を形成するために、前記カソードとアノードとの間に直流電流を流す直流電流源と、
前記カソードと前記アノードとの間に交流成分を重畳させる交流電流源と、
前記交流成分に基づき前記カソードと前記アノードとの間に流れる変位電流を検出して、当該変位電流に基づき、めっき処理中の前記めっき膜の表面積の変化を算出する表面積算出部と、
前記めっき膜の表面積の変化に基づき、前記めっき処理中の前記めっき膜に対する電流密度が変化しないように前記直流電流の電流値を制御する電流制御部と、
を含むめっき処理システムが提供される。
【００１１】
本発明のめっき方法、半導体装置の製造方法、およびめっき処理システムによれば、めっき処理中のめっき膜の表面積の変化に基づき、めっき処理中に、めっき処理のための直流電流を変化させる構成となっているため、略リアルタイムで電流密度が一定となるように制御することができる。これにより、成膜されるめっき膜のたとえば粒径や配向等の性質も一定にすることができ、膜特性を良好にすることができる。ここで、交流成分は、正弦波や三角波とすることができる。
【００１２】
なお、以上の構成要素の任意の組合せ、本発明の表現を方法、装置、システム、記録媒体、コンピュータプログラムなどの間で変換したものもまた、本発明の態様として有効である。
【発明の効果】
【００１３】
本発明によれば、めっき膜の膜特性を良好にすることができる。
【発明を実施するための最良の形態】
【００１４】
以下、本発明の実施の形態について、図面を用いて説明する。なお、すべての図面において、同様な構成要素には同様の符号を付し、適宜説明を省略する。
【００１５】
図１は、本実施の形態における半導体装置２００の製造手順を示す工程断面図である。
本実施の形態において、ダマシン法により層間絶縁膜２０６に配線を形成する工程を説明する。
【００１６】
半導体装置２００は、トランジスタ等が形成された半導体基板（基板）２０２と、半導体基板２０２上に形成された層間絶縁膜２０４と、その上に形成された層間絶縁膜２０６（絶縁膜）とを含む。層間絶縁膜２０４および層間絶縁膜２０６中には、配線やビアが形成されている。
【００１７】
このように構成された半導体装置２００において、まず、層間絶縁膜２０６に配線溝２０８を形成する。ここで、図示したように、層間絶縁膜２０６には、配線幅が異なる複数の配線溝２０８（凹部）が形成される。
【００１８】
このような配線溝２０８を配線材料で埋め込む手順は、以下のようになる。まず、層間絶縁膜２０６の配線溝２０８内にバリアメタル膜を形成する。バリアメタル膜は、たとえばＴａＮ／Ｔａ等、通常の銅配線のバリアメタル膜として用いられるものとすることができる。つづいて、バリア膜上にめっきのシード膜（導電材料）を形成する。ここで、シード膜は、ＣＶＤ法等により形成された銅膜等とすることができる。
【００１９】
その後、めっき処理を行う。本実施の形態において、めっき液は、通常の銅配線形成時のめっき膜を形成するのに用いるものと同様とすることができる。本実施の形態において、めっき処理は、微細パターンを埋設するための第１のステップと、第１のステップよりも高いめっき電流値で行う第２のステップとで行う。
【００２０】
本実施の形態において、めっき膜の表面積の変化を算出しつつめっき処理を行う。そして、めっき膜の表面積の変化に応じてめっき膜を形成するための直流電流の電流値を変化させ、第１のステップおよび第２のステップのそれぞれにおいて、平坦なウェハ表面に対する被めっき面の面積比で除した値である局所電流密度（Ａ／ｗｆ）が略一定となるようにしてめっき処理を行う。この点が、通常の手順と異なる。
【００２１】
なお、たとえば、ウェハ直径が３００ｍｍの場合、第１のステップでは、局所電流密度が１〜１０Ａ／ｗｆとなるようにすることができる。また、第２のステップでは、局所電流密度が２０〜５０Ａ／ｗｆとなるようにすることができる。局所電流密度は、ウェハのサイズ等に応じて適宜変更することができる。
【００２２】
図２は、本実施の形態におけるめっき装置１００の構成を示す模式図である。
めっき装置１００は、めっき槽１０１と、めっき槽１０１中に配置されたアノード１０２とを含む。また、めっき槽１０１には、めっき液１０４が収容されている。めっき液１０４は、たとえば硫酸銅水溶液等により構成される。めっき液１０４は、添加剤としてレベラ、アクセラレータ（促進剤）、およびサプレッサ（抑制剤）等を含むことができる。また、図示していないが、めっき装置１００は、被処理基板である半導体装置２００を載置する載置台を有し、当該載置台上に半導体装置２００が配置されている。ここで、半導体装置２００の銅膜２１０（シード膜）がカソード１０６として機能する。また、図示していないが、アノード１０２とカソード１０６との間には、イオン交換膜等を設けた構成とすることができる。
【００２３】
さらに、めっき装置１００は、アノード１０２とカソード１０６との間に直流電流を流す直流電流源１５０と、直流電流に重畳させる交流電流を流す交流電流源１５２と、アノード１０２とカソード１０６との間に流れる電流を測定する電流計１５４とを含む。
【００２４】
図３は、このようなめっき装置１００において、アノード１０２とカソード１０６との間に電流を流した状態を示す図である。まず、アノード１０２とカソード１０６との間に直流電流を流すと、図３（ａ）に示すように、カソード１０６の表面には、めっき液１０４中の銅イオン等の陽イオンが付着し、電気二重層が形成される。この電気二重層は、カソード１０６の表面に形成されるので、カソード１０６の表面積に応じて容量値が変化する。つまり、めっきの進行とともに、凹部が埋め込まれ、めっき膜の表面積が変化すると、電気二重層の容量値も変化する。そのため、電気二重層の容量値を算出することにより、容量値に基づきめっき膜の表面積を把握することができる。
【００２５】
図３（ｂ）は、アノード１０２とカソード１０６との間に、電流値Ｉ０の直流電流および電圧値Ｖの交流電流を重畳させた場合の電流経路を示す図である。
ここで、アノード１０２の抵抗をＲＡ、配線溝２０８の抵抗をＲＣ、めっき液１０４の抵抗をＲＥ、カソード１０６表面の電気二重層の容量をＣ、容量Ｃに並列な抵抗成分をｒとする。交流電流が重畳されることにより、カソード１０６表面の電気二重層の容量による変位電流（電流値Ｉ）が発生する。交流電流源１５２から印加する交流電流は、たとえば０．００５〜５Ｖの正弦波とすることができる。また、交流電流の周波数は、１０ｋＨｚ以上とすることができ、より好ましくは、１００ｋＨｚ〜１ＭＨｚ程度とすることができる。このように交流成分を高周波とすることにより、めっき処理中に直流電流の電流値を変化させることにより生じる変位電流の影響を低減することができる。
【００２６】
このとき、以下の式（１）および（２）が成り立つ。
【００２７】
【数１】
0004989541.tif 000002
【００２８】
【数２】
0004989541.tif 000003
【００２９】
変位電流の電流値Ｉは、電流計１５４が検出する電流値からＩ０を減じることにより算出することができる。また、Ｒ＝ＲＡ＋ＲＥ＋ＲＣである。Ｒは、ＲＥの値に近似することができ、めっき処理中、略一定であるとすることができる。ω＝２πｆであるので、重畳させる交流電流の周波数ｆからωの値が算出される。
【００３０】
図４は、交流電流源１５２から印加する交流電流の電圧値Ｖと変位電流の電流値Ｉとを模式的に示す図である。ここで、交流電流の電圧値Ｖと変位電流の電流値Ｉとの位相差から、φの値が算出される。ここで、時間が経つほどφの値は大きくなっており、φ１＜φ２＜φ３となっている。上記式（１）および（２）にＶ、Ｉ、Ｒ、およびφの値を代入することにより、容量Ｃの値と抵抗ｒの値が算出される。なお、φの値としては、所定の時間幅における複数のφの値（たとえばφ１〜φ３）の平均値を用いることもできる。ここで、所定の時間幅は、たとえば交流電流の周波数と配線溝等の凹部の埋め込み時間に応じて適宜設定することができる。所定の時間幅は、たとえば交流電流の周波数の逆数（周期）の２〜１００倍程度とすることができる。凹部の埋め込み時間に対して周期が充分に短い場合は、１００倍以上とすることもできる。
【００３１】
ここで、たとえば予め凹部のないウェハの表面積をＳ０として同様の測定を行い、その場合の容量Ｃ０を測定しておき、表面積Ｓ０と容量Ｃ０との関係を取得しておくことができる。凹部のないウェハの表面積Ｓ０の値は、設計データを用いても実測データを用いてもいずれでもよい。この値を、上記で測定した容量Ｃと比較することにより、その時点でのめっき膜の表面積Ｓを算出することができる。これにより、表面積Ｓに応じて、直流電流源１５０から流す直流電流の電流値Ｉ０を変化させ、各ステップにおける局所電流密度がそれぞれ一定となるようにする。これにより、成膜されるめっき膜のたとえば粒径や配向等の性質も一定にすることができ、膜特性を良好にすることができる。
【００３２】
なお、以上の処理は、たとえば、表面積Ｓの変化が大きい第１のステップが終了するまで行うようにすることができる。また、めっき膜の表面積の変化が、所定の基準値を超えた場合にのみ、直流電流の値を変化させるようにすることもできる。さらに、めっき膜の表面積の変化は、凹部が埋め込まれた後は徐々に小さくなるため、めっき膜の表面積の変化が所定の基準値以下となった場合に、処理を終了するようにすることもできる。
【００３３】
図５は、この処理手順を示すフローチャートである。
まず、直流電流源１５０から直流電流を印加する（Ｓ１０）。つづいて、交流電流源１５２から交流成分を印加する（Ｓ１２）。この状態で、電流計１５４により、電流値を測定する（Ｓ１４）。測定した電流値を直流電流源１５０から流している電流値Ｉ０で補正して、電流値Ｉを算出し、電流値Ｉと交流電流源１５２から印加している交流成分との位相差φを検出する（Ｓ１６）。つづいて、位相差φに基づき、容量値Ｃを算出する（Ｓ１８）。その後、容量値Ｃに基づき、表面積Ｓを算出する（Ｓ２０）。つづいて、表面積Ｓの変化に応じて、直流電流源１５０から流す新たな直流電流の電流値Ｉ０を決定し（Ｓ２２）、直流電流源１５０から流す電流値をステップＳ２２で決定した新たな電流値Ｉ０に変更して、直流電流を流す（Ｓ２４）。以上の処理を繰り返すことにより、電流密度を一定にしつつ、めっき膜を形成することができる。
【００３４】
なお、ステップＳ２４の処理の後、直流電流値を変えたことによって発生する変位電流がなくなるまで、次の表面積比計算による電流値補正は停止する。これにより変位電流が表面積比の計算に反映されることを防止することができる。なお、重畳させる交流電流の周波数を上述したような１０ｋＨｚ以上、より好ましくは、１００ｋＨｚ〜１ＭＨｚ程度とすることにより、直流電流値を変えたことによって発生する変位電流の影響を低減することができ、電流値補正処理を停止することなく、連続的に行うこともできる。
【００３５】
図６は、めっき装置１００と、以上の処理を行う制御システム１６０とを含むめっき処理システム１８０の構成を示す図である。
めっき処理システム１８０は、上述しためっき装置１００に加えて、制御システム１６０をさらに含む。制御システム１６０は、めっき膜の表面積に応じて局所電流密度を一定するための電流値を算出し、算出した電流値を直流電流源１５０にフィードバックするフィードバック回路を有する。具体的には、制御システム１６０は、表面積算出部１６２と、電流値算出部１６４と、電流制御部１６６と、設定記憶部１７０とを含む。
【００３６】
設定記憶部１７０には、たとえば直流電流源１５０から印加している直流電流の電流値Ｉ０、交流電流源１５２から印加している交流電流の電圧値Ｖおよび周波数、予め凹部のないウェハを用いて同様の測定を行って取得した容量Ｃ０と表面積Ｓ０との関係等の設定情報を記憶する。また、設定記憶部１７０には、各種計算式等も記憶される。
【００３７】
表面積算出部１６２は、電流計１５４の測定値から変位電流の電流値Ｉを算出する。また、設定記憶部１７０を参照して、変位電流の電流値Ｉから、めっき膜の表面積Ｓを算出する。
【００３８】
電流値算出部１６４は、表面積算出部１６２が算出しためっき膜の表面積Ｓに基づき、局所電流密度が一定となるように、直流電流源１５０から印加する直流電流の電流値を決定する。電流値算出部１６４が新たな電流値を決定すると、その情報は設定記憶部１７０に記憶される。
【００３９】
電流制御部１６６は、実際に直流電流源１５０を制御して、電流値算出部１６４が決定した電流値の直流電流が直流電流源１５０から印加されるようにする。
【００４０】
図７は、図６に示しためっき処理システム１８０の構成の他の例を示す図である。制御システム１６０は、図６に示した構成に加えて、タイミング制御部１６８をさらに含む。
タイミング制御部１６８は、直流電流源１５０へのフィードバックを行うタイミングを制御する。
【００４１】
図８は、タイミング制御部１６８が行うタイミング制御を示す図である。図８（ａ）は、交流電流源１５２から印加する交流電流の電圧値Ｖ、図８（ｂ）は、変位電流の電流値Ｉ、図８（ｃ）は、直流電流源１５０から流す直流電流Ｉ０を変化させるタイミングを示す図である。
【００４２】
図８（ｂ）および図８（ｃ）に示すように、直流電流源１５０から流す直流電流Ｉ０を変化させた直後は、変位電流の電流値Ｉに直流電流Ｉ０の変化に基づく変位電流が生じている。そのため、この期間の変位電流の電流値Ｉを測定しても、正しい位相差φを得ることができない。そのため、本実施の形態においては、タイミング制御部１６８が、直流電流Ｉ０を変化させてから、所定時間を経過するまでは、位相差φを検出するためのモニタは行わないよう制御する。ここで、モニタを行わないとは、この所定時間における変位電流の電流値Ｉは、位相差φを算出するための根拠としないということである。ここで、所定時間は、各系の抵抗値や電気二重層の容量値等に応じて変化するが、０．１〜１０００ミリ秒（ｍｓｅｃ）程度である。
【００４３】
図９は、図７に示しためっき処理システム１８０の処理手順を示すフローチャートである。
まず、直流電流源１５０から直流電流を印加する（Ｓ１００）。つづいて、交流電流源１５２から交流成分を印加する（Ｓ１０２）。この状態で、電流計１５４により、電流値を測定する（Ｓ１０４）。表面積算出部１６２は、電流計１５４が測定した電流値を直流電流源１５０から流している電流値Ｉ０で補正して、電流値Ｉを算出し、電流値Ｉと交流電流源１５２から印加している交流成分との位相差φを検出する（Ｓ１０６）。つづいて、表面積算出部１６２は、位相差φに基づき、容量値Ｃを算出する（Ｓ１０８）。その後、表面積算出部１６２は、容量値Ｃに基づき、表面積Ｓを算出する（Ｓ１１０）。この後、電流制御部１６６は、直流電流値を変更するか否かを判断する（Ｓ１１２）。この判断は、たとえば、第１のステップのめっき処理が終了したか否か、めっき膜の表面積の変化が、所定の基準値を超えたか否か等に基づき行うことができる。
【００４４】
直流電流値を変更する場合（Ｓ１１２のＹＥＳ）、電流値算出部１６４は、表面積Ｓの変化に応じて、直流電流源１５０から流す新たな直流電流の電流値Ｉ０を決定し（Ｓ１１４）、電流制御部１６６は、直流電流源１５０を制御して、直流電流源１５０から流す電流値をステップＳ１１４で決定した新たな電流値Ｉ０に変更して、電流値Ｉ０の直流電流を流す（Ｓ１１６）。
【００４５】
この後、処理を終了するか否かを判断し（Ｓ１１８）、処理を終了しない場合（Ｓ１１８のＮＯ）は、タイミング制御部１６８が、直流電流値を変更してから所定時間が経過したか否かを判断し（Ｓ１２０）、所定時間が経過していた場合に（Ｓ１２０のＹＥＳ）、ステップＳ１０４に戻り、同様の処理を繰り返す。
【００４６】
一方、ステップＳ１１２で、直流電流値を変更しない場合（Ｓ１１２のＮＯ）、処理を終了するか否かを判断し（Ｓ１２２）、処理を終了しない場合（Ｓ１２２のＮＯ）は、ステップＳ１０４に戻り、同様の処理を繰り返す。以上の処理を繰り返すことにより、電流密度を一定にしつつ、めっき膜を形成することができる。
【００４７】
なお、図６および図７に示した制御システム１６０の各構成要素は、ハードウエア単位の構成ではなく、機能単位のブロックを示している。制御システム１６０の各構成要素は、任意のコンピュータのＣＰＵ、メモリ、メモリにロードされた本図の構成要素を実現するプログラム、そのプログラムを格納するハードディスクなどの記憶ユニット、ネットワーク接続用インタフェースを中心にハードウエアとソフトウエアの任意の組合せによって実現される。そして、その実現方法、装置にはいろいろな変形例があることは、当業者には理解されるところである。
【００４８】
次に、本実施の形態におけるめっき方法、半導体装置の製造方法、およびめっき処理システムの効果を説明する。
特許文献２には、めっき初期の位相差を測定することにより、めっき膜の形成状況をモニタして、これらを支配する添加剤の含有状態についての知見を得ることが記載されている。しかし、このようにして得られた知見は、次回のめっき処理に用いられるだけであって、そのめっき処理中に、局所電流密度を一定にするための処理に用いる構成とはなっていない。
一方、本実施の形態におけるめっき方法、半導体装置の製造方法、およびめっき処理システムによれば、めっき処理中のめっき膜の表面積の変化に基づき、めっき処理中に、めっき処理のための直流電流を変化させる構成となっている。そのため、略リアルタイムで電流密度が一定となるように制御することができる。これにより、成膜されるめっき膜のたとえば粒径や配向等の性質も一定にすることができ、膜特性を良好にすることができる。
【００４９】
以上、図面を参照して本発明の実施形態について述べたが、これらは本発明の例示であり、上記以外の様々な構成を採用することもできる。
【００５０】
以上の実施の形態においては、交流成分として、正弦波を例として示したが、交流成分は三角波等とすることもできる。
【００５１】
以上の実施の形態においては、半導体基板上に形成された絶縁膜に設けられた複数の凹部をめっき処理により導電材料で埋め込む手順を例として説明したが、本発明のめっき方法およびめっき処理システムは、半導体装置以外のめっき処理に適用することもできる。なお上記した実施形態によれば、以下の発明が開示されている。
（付記１）
カソードとアノードとの間に直流電流を流して前記カソード上にめっき膜を形成する工程と、
前記直流電流とともに、前記カソードと前記アノードとの間に交流成分を重畳させて、前記カソードと前記アノードとの間に流れる変位電流を検出する工程と、
前記変位電流に基づき、前記めっき膜の表面積の変化を算出する工程と、
前記めっき膜の表面積の変化に基づき、前記めっき膜を形成する工程において前記めっき膜に対する電流密度が変化しないように、前記直流電流の値を制御する工程と、
を含むめっき方法。
（付記２）
付記１に記載のめっき方法において、
前記直流電流の値を制御する工程において、前記直流電流を変化させた後、所定時間は、前記直流電流を変化させるための次の処理を行わないようタイミングを制御するめっき方法。
（付記３）
付記１または２に記載のめっき方法において、
前記めっき膜の表面積の変化を算出する工程において、前記めっき膜の表面積の変化が、所定の基準値を超えた場合に、前記直流電流の値を制御する工程において前記直流電流の値を変化させるめっき方法。
（付記４）
付記１から３いずれかに記載のめっき方法において、
前記めっき膜の表面積の変化を算出する工程において、所定の時間幅における前記変位電流の変化量の平均値に基づき、前記めっき膜の表面積の変化を算出するめっき方法。
（付記５）
付記１から４いずれかに記載のめっき方法において、
前記交流成分の周波数が、１０ｋＨｚ以上であるめっき方法。
（付記６）
基板上に形成された絶縁膜に設けられた複数の凹部をめっき処理により導電材料で埋め込むめっき工程を含み、
当該めっき工程は、
前記凹部表面に形成された導電材料をカソードとして、当該カソードとアノードとの間に直流電流を流して前記導電材料上にめっき膜を形成する工程と、
前記直流電流とともに、前記カソードと前記アノードとの間に交流成分を重畳させて、前記カソードと前記アノードとの間に流れる変位電流を検出する工程と、
前記変位電流に基づき、前記めっき膜の表面積の変化を算出する工程と、
前記めっき膜の表面積の変化に基づき、前記めっき膜を形成する工程において前記めっき膜に対する電流密度が変化しないように、前記直流電流の値を制御する工程と、
を含む半導体装置の製造方法。
（付記７）
付記６に記載の半導体装置の製造方法において、
前記直流電流の値を制御する工程において、前記直流電流を変化させた後、所定時間は、前記直流電流を変化させるための次の処理を行わないようタイミングを制御する半導体装置の製造方法。
（付記８）
付記６または７に記載の半導体装置の製造方法において、
前記めっき膜の表面積の変化を算出する工程において、前記めっき膜の表面積の変化が、所定の基準値を超えた場合に、前記直流電流の値を制御する工程において前記直流電流の値を変化させる半導体装置の製造方法。
（付記９）
付記６から８いずれかに記載の半導体装置の製造方法において、
前記めっき膜の表面積の変化を算出する工程において、所定の時間幅における前記変位電流の変化量の平均値に基づき、前記めっき膜の表面積の変化を算出する半導体装置の製造方法。
（付記１０）
付記６から９いずれかに記載の半導体装置の製造方法において、
前記交流成分の周波数が、１０ｋＨｚ以上である半導体装置の製造方法。
（付記１１）
カソード上にめっき膜を形成するために、前記カソードとアノードとの間に直流電流を流す直流電流源と、
前記カソードと前記アノードとの間に交流成分を重畳させる交流電流源と、
前記交流成分に基づき前記カソードと前記アノードとの間に流れる変位電流を検出して、当該変位電流に基づき、めっき処理中の前記めっき膜の表面積の変化を算出する表面積算出部と、
前記めっき膜の表面積の変化に基づき、前記めっき処理中の前記めっき膜に対する電流密度が変化しないように前記直流電流の電流値を制御する電流制御部と、
を含むめっき処理システム。
（付記１２）
付記１１に記載のめっき処理システムにおいて、
前記電流制御部が前記直流電流を変化させた後、次に前記直流電流を変化させる処理を行うタイミングを制御するタイミング制御部をさらに含むめっき処理システム。
（付記１３）
付記１１または１２に記載のめっき処理システムにおいて、
前記電流制御部は、前記表面積算出部が算出した前記めっき膜の表面積の変化が、所定の基準値を超えた場合に、前記直流電流の値を変化させるめっき処理システム。
（付記１４）
付記１１から１３いずれかに記載のめっき処理システムにおいて、
前記表面積算出部が、所定の時間幅における前記変位電流の変化量の平均値に基づき、前記めっき膜の表面積の変化を算出するめっき処理システム。
（付記１５）
付記１１から１４いずれかに記載のめっき処理システムにおいて、
前記交流電流源が重畳する前記交流成分の周波数が、１０ｋＨｚ以上であるめっき処理システム。
（付記１６）
付記１１から１５いずれかに記載のめっき処理システムにおいて、
前記カソードは、基板上に形成された絶縁膜に設けられた複数の凹部表面に形成された導電材料であるめっき処理システム。
【図面の簡単な説明】
【００５２】
【図１】本発明の実施の形態における半導体装置の製造手順を示す工程断面図である。
【図２】本発明の実施の形態におけるめっき装置の構成を示す模式図である。
【図３】図２のめっき装置において、アノードとカソードとの間に電流を流した状態を示す図である。
【図４】交流電流源から印加する交流電流の電圧値Ｖと変位電流の電流値Ｉとを模式的に示す図である。
【図５】本発明の実施の形態におけるめっき処理の処理手順を示すフローチャートである。
【図６】本発明の実施の形態において、めっき装置と、制御システムとを含むめっき処理システムの構成の一例を示す図である。
【図７】本発明の実施の形態において、めっき装置と、制御システムとを含むめっき処理システムの構成の他の例を示す図である。
【図８】図７に示したタイミング制御部が直流電流源から印加する電流の電流値を変更するタイミングを制御する様子を示す図である。
【図９】本発明の実施の形態におけるめっき処理システムの処理手順を示すフローチャートである。
【符号の説明】
【００５３】
１００ めっき装置
１０１ めっき槽
１０２ アノード
１０４ めっき液
１０６ カソード
１５０ 直流電流源
１５２ 交流電流源
１５４ 電流計
１６０ 制御システム
１６２ 表面積算出部
１６４ 電流値算出部
１６６ 電流制御部
１６８ タイミング制御部
１７０ 設定記憶部
１８０ めっき処理システム
２００ 半導体装置
２０２ 半導体基板
２０４ 層間絶縁膜
２０６ 層間絶縁膜
２０８ 配線溝
２１０ 銅膜
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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