(57)【特許請求の範囲】
【請求項１】
第１ソース信号線駆動回路と、
第２ソース信号線駆動回路と、
第１ゲート信号線駆動回路と、
第２ゲート信号線駆動回路と、
画素部と、
前記第１ソース信号線駆動回路に接続された複数の第１ソース信号線と、
前記第２ソース信号線駆動回路に接続された複数の第２ソース信号線と、
前記第１ゲート信号線駆動回路に接続された複数の第１ゲート信号線と、
前記第２ゲート信号線駆動回路に接続された複数の第２ゲート信号線と、
複数の電源供給線とを有する発光装置であって、
前記画素部は、複数の発光素子、複数の電流制御用ＴＦＴ、複数の第１スイッチング用ＴＦＴ及び複数の第２スイッチング用ＴＦＴを含む複数の画素を有しており、
前記複数の第１スイッチング用ＴＦＴが有するゲート電極は、前記複数の第１ゲート信号線と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するゲート電極は、前記複数の第２ゲート信号線と接続されており、
前記複数の第１スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第１ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第２ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の電流制御用ＴＦＴが有するソース領域とドレイン領域は、一方は前記複数の電源供給線に、もう一方は前記複数の発光素子に接続されており、
１フレーム期間内にｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎが順に出現し、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎのうち最後に出現する書き込み期間Ｔａｎの次に出現する書き込み期間は、前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎのうち最初に出現する書き込み期間Ｔａ１であり、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎのそれぞれが出現してから、前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎのそれぞれの次の書き込み期間が出現するまでの期間が、ｎ個の表示期間Ｔｄ１、Ｔｄ２、・・・、Ｔｄｎであり、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎにおいて、前記第１ソース信号線駆動回路から前記複数の第１ソース信号線を介して、若しくは前記第２ソース信号線駆動回路から前記複数の第２ソース信号線を介して、デジタル信号が前記複数の画素に入力され、
前記デジタル信号によって、前記ｎ個の表示期間Ｔｄ１、Ｔｄ２、・・・、Ｔｄｎにおいて前記複数の発光素子が発光状態になるか非発光状態になるかが選択されることを特徴とする発光装置。
【請求項２】
第１ソース信号線駆動回路と、
第２ソース信号線駆動回路と、
第１ゲート信号線駆動回路と、
第２ゲート信号線駆動回路と、
画素部と、
前記第１ソース信号線駆動回路に接続された複数の第１ソース信号線と、
前記第２ソース信号線駆動回路に接続された複数の第２ソース信号線と、
前記第１ゲート信号線駆動回路に接続された複数の第１ゲート信号線と、
前記第２ゲート信号線駆動回路に接続された複数の第２ゲート信号線と、
一定の電位に保たれた複数の電源供給線とを有する発光装置であって、
前記画素部は、複数の発光素子、複数の電流制御用ＴＦＴ、複数の第１スイッチング用ＴＦＴ及び複数の第２スイッチング用ＴＦＴを含む複数の画素を有しており、
前記複数の発光素子は、画素電極と、一定の電位に保たれた対向電極と、前記画素電極と前記対向電極の間に設けられた有機化合物層とをそれぞれ有しており、
前記複数の第１スイッチング用ＴＦＴが有するゲート電極は、前記複数の第１ゲート信号線と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するゲート電極は、前記複数の第２ゲート信号線と接続されており、
前記複数の第１スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第１ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第２ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の電流制御用ＴＦＴが有するソース領域とドレイン領域は、一方は前記複数の電源供給線に、もう一方は前記画素電極に接続されており、
１フレーム期間内にｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎが順に出現し、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎのうち最後に出現する書き込み期間Ｔａｎの次に出現する書き込み期間は、前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎのうち最初に出現する書き込み期間Ｔａ１であり、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎのそれぞれが出現してから、前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎのそれぞれの次の書き込み期間が出現するまでの期間が、ｎ個の表示期間Ｔｄ１、Ｔｄ２、・・・、Ｔｄｎであり、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎにおいて、前記第１ソース信号線駆動回路から前記複数の第１ソース信号線を介して、若しくは前記第２ソース信号線駆動回路から前記複数の第２ソース信号線を介して、デジタル信号が前記複数の画素に入力され、
前記デジタル信号によって、前記ｎ個の表示期間Ｔｄ１、Ｔｄ２、・・・、Ｔｄｎにおいて前記複数の発光素子が発光状態になるか非発光状態になるかが選択されることを特徴とする発光装置。
【請求項３】
請求項２において、
前記有機化合物層は低分子系有機物質であることを特徴とする発光装置。
【請求項４】
請求項３において、
前記低分子系有機物質は、Ａｌｑ３（トリス−８−キノリライト−アルミニウム）またはＴＰＤ（トリフェニルアミン誘導体）からなることを特徴とする発光装置。
【請求項５】
請求項２において、
前記有機化合物層はポリマー系有機物質であることを特徴とする発光装置。
【請求項６】
請求項５において、
前記ポリマー系有機物質は、ＰＰＶ（ポリフェニレンビニレン）、ＰＶＫ（ポリビニルカルバゾール）またはポリカーボネートからなることを特徴とする発光装置。
【請求項７】
請求項１乃至請求項６のいずれか一項において、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎのうち、いくつかの隣り合う書き込み期間は互いに一部重なっていることを特徴とする発光装置。
【請求項８】
請求項７において、
互いに一部重なっている前記隣り合う書き込み期間は、一方の書き込み期間において前記第１ソース信号線駆動回路から前記複数の第１ソース信号線を介して前記デジタル信号が前記複数の画素に入力され、もう一方の書き込み期間において前記第２ソース信号線駆動回路から前記複数の第２ソース信号線を介して前記デジタル信号が前記複数の画素に入力されていることを特徴とする発光装置。
【請求項９】
請求項１乃至請求項８のいずれか１項において、
前記ｎ個の表示期間Ｔｄ１、Ｔｄ２、・・・、Ｔｄｎのうちのｊ個の表示期間（ｊは０以上ｎ以下の整数）は、前記複数の発光素子の全てが非発光状態になる黒表示期間であることを特徴とする発光装置。
【請求項１０】
請求項９において、
前記ｎ個の表示期間Ｔｄ１、Ｔｄ２、・・・、Ｔｄｎのうち、前記黒表示期間ではない（ｎ−ｊ）個の表示期間を短い順に並べたときの長さの比は、２０：２１：・・・：２（ｎ−ｊ−１）であることを特徴とする発光装置。
【請求項１１】
請求項９又は請求項１０において、
前記１フレーム期間中において最後に出現する表示期間は、前記１フレーム期間中において、前記黒表示期間のうちの最も長い黒表示期間であることを特徴とする発光装置。
【請求項１２】
請求項１乃至請求項１１のいずれか１項において、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、・・・、Ｔａｎの長さが全て同じであることを特徴とする発光装置。
【請求項１３】
請求項１乃至請求項１２のいずれか１項において、
前記複数の第１スイッチング用ＴＦＴ及び前記複数の第２スイッチング用ＴＦＴの極性が同じであることを特徴とする発光装置。
【請求項１４】
請求項１乃至請求項１３のいずれか１項に記載の前記発光装置を用いたことを特徴とする電子機器。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、基板上に形成された発光素子を、該基板とカバー材の間に封入した表示用パネルに関する。また、該表示用パネルにＩＣを実装した表示用モジュールに関する。なお本明細書において、表示用パネル及び表示用モジュールを発光装置と総称する。本発明はさらに、該発光装置を用いた電子機器に関する。
【０００２】
【従来の技術】
近年、基板上にＴＦＴを形成する技術が大幅に進歩し、アクティブマトリクス型の電子ディスプレイへの応用開発が進められている。特に、ポリシリコン膜を用いたＴＦＴは、従来のアモルファスシリコン膜を用いたＴＦＴよりも電界効果移動度（モビリティともいう）が高いので、高速動作が可能である。そのため、従来、基板外の駆動回路で行っていた画素の制御を、画素と同一の基板上に形成した駆動回路で行うことが可能となっている。
【０００３】
このようなアクティブマトリクス型の電子ディスプレイは、同一基板上に様々な回路や素子を作り込むことで製造コストの低減、電子ディスプレイを表示媒体として有する表示装置の小型化、歩留まりの上昇、スループットの上昇など、様々な利点が得られる。
【０００４】
そしてさらに、電子ディスプレイの中でも、自発光型素子として発光素子（ＥＬ素子）を有したアクティブマトリクス型の発光装置の研究が活発化している。発光装置は有機発光装置（ＯＥＬＤ：Organic EL Display）又は有機ライトエミッティングダイオード（ＯＬＥＤ：Organic Light Emitting Diode）とも呼ばれている。
【０００５】
発光装置は、液晶表示装置と異なり自発光型である。発光素子は一対の電極（陽極と陰極）間に電場を加えることでルミネッセンスが発生する有機化合物を含む層（以下、有機化合物層またはＥＬ層と記す）が挟まれた構造となっているが、有機化合物層は通常、積層構造となっている。代表的には、コダック・イーストマン・カンパニーのTangらが提案した「正孔輸送層／発光層／電子輸送層」という積層構造が挙げられる。この構造は非常に発光効率が高く、現在、研究開発が進められている発光装置は殆どこの構造を採用している。
【０００６】
発光素子は、電場を加えることで発生するルミネッセンス（Electro Luminescence）が得られると、陽極層と、有機化合物層と、陰極層とを有する。有機化合物におけるルミネッセンスには、一重項励起状態から基底状態に戻る際の発光（蛍光）と三重項励起状態から基底状態に戻る際の発光（リン光）とがあるが、本発明の発光装置は、どちらの発光を用いていても良い。
【０００７】
また他にも、陽極上に正孔注入層／正孔輸送層／発光層／電子輸送層、または正孔注入層／正孔輸送層／発光層／電子輸送層／電子注入層の順に積層する構造でも良い。発光層に対して蛍光性色素等をドーピングしても良い。
【０００８】
本明細書において陰極と陽極の間に設けられる全ての層を総称して有機化合物層と呼ぶ。よって上述した正孔注入層、正孔輸送層、発光層、電子輸送層、電子注入層等は、全て有機化合物層に含まれる。なお本明細書中では、陽極、有機化合物層及び陰極で形成される素子を発光素子と呼ぶ。
【０００９】
発光装置の駆動方法として、アナログ方式の駆動方法（アナログ駆動）が挙げられる。発光装置のアナログ駆動について、図２４及び図２５を用いて説明する。
【００１０】
図２４にアナログ駆動の発光装置の画素部の構造を示す。ゲート信号線駆動回路からの選択信号を入力するゲート信号線（Ｇ１〜Ｇｙ）は、各画素が有するスイッチング用ＴＦＴ１８０１のゲート電極に接続されている。また各画素が有するスイッチング用ＴＦＴ１８０１のソース領域とドレイン領域は、一方がアナログのビデオ信号を入力するソース信号線（Ｓ１〜Ｓｘ）に、もう一方が各画素が有する電流制御用ＴＦＴ１８０４のゲート電極及び各画素が有するコンデンサ１８０８にそれぞれ接続されている。
【００１１】
各画素が有する電流制御用ＴＦＴ１８０４のソース領域とドレイン領域は、一方は電源供給線（Ｖ１〜Ｖｘ）に、もう一方は発光素子１８０６にそれぞれ接続されている。電源供給線（Ｖ１〜Ｖｘ）の電位を電源電位と呼ぶ。また電源供給線（Ｖ１〜Ｖｘ）は、各画素が有するコンデンサ１８０８に接続されている。
【００１２】
発光素子１８０６は陽極と、陰極と、陽極と陰極との間に設けられた有機化合物層とを有する。本明細書では、発光素子１８０６の陽極が電流制御用ＴＦＴ１８０４のソース領域またはドレイン領域と接続している場合、発光素子１８０６の陽極を画素電極、陰極を対向電極と呼ぶ。逆に発光素子１８０６の陰極が電流制御用ＴＦＴ１８０４のソース領域またはドレイン領域と接続している場合、発光素子１８０６の陽極を対向電極、陰極を画素電極と呼ぶ。
【００１３】
なお本明細書において、対向電極の電位を対向電位と呼ぶ。画素電極の電位と対向電極の電位の電位差が発光素子駆動電圧であり、この発光素子駆動電圧が有機化合物層にかかる。
【００１４】
図２４で示した発光装置を、アナログ方式で駆動させた場合のタイミングチャートを図２５に示す。１つのゲート信号線が選択されてから、その次に別のゲート信号線が選択されるまでの期間を１ライン期間（Ｌ）と呼ぶ。
【００１５】
なお本明細書において信号線（ゲート信号線、第１ゲート信号線、第２ゲート信号線）が選択されるというのは、該信号線にゲート電極が接続されている全てのＴＦＴがオンの状態になることを意味する。
【００１６】
また１つの画像が表示されてから次の画像が表示されるまでの期間が１フレーム期間（Ｆ）に相当する。図２４に示す発光装置の場合、ゲート信号線はｙ本あるので、１フレーム期間中にｙ個のライン期間（Ｌ１〜Ｌｙ）が設けられている。
【００１７】
解像度が高くなるにつれて１フレーム期間中のライン期間の数も増え、駆動回路を高い周波数で駆動しなければならなくなる。
【００１８】
まず電源供給線（Ｖ１〜Ｖｘ）の電源電位は一定に保たれている。そして対向電極の対向電位も一定に保たれている。対向電位は、電源電位が発光素子の画素電極に与えられたときに発光素子が発光する程度に、電源電位との間に電位差を有している。
【００１９】
第１のライン期間（Ｌ１）において、ゲート信号線駆動回路から出力される選択信号によってゲート信号線Ｇ１が選択され、ゲート信号線Ｇ１に接続されている全てのスイッチング用ＴＦＴ１８０１がオンの状態になる。そして、ソース信号線（Ｓ１〜Ｓｘ）に順にアナログのビデオ信号が入力される。ソース信号線に入力されたアナログのビデオ信号は、スイッチング用ＴＦＴ１８０１を介して電流制御用ＴＦＴ１８０４のゲート電極に入力される。
【００２０】
電流制御用ＴＦＴ１８０４のチャネル形成領域を流れる電流の量は、電流制御用ＴＦＴ１８０４のゲート電極とソース領域の電位差であるゲート電圧ＶGSによって制御される。よって、発光素子１８０６の画素電極に与えられる電位は、電流制御用ＴＦＴ１８０４のゲート電極に入力されたアナログのビデオ信号の電位の高さによって決まる。したがって、発光素子１８０６はアナログのビデオ信号の電位に制御されて発光する。
【００２１】
上述した動作を繰り返し、ソース信号線（Ｓ１〜Ｓｘ）へのアナログのビデオ信号の入力が終了すると、第１のライン期間（Ｌ１）が終了する。なお、ソース信号線（Ｓ１〜Ｓｘ）へのアナログのビデオ信号の入力が終了するまでの期間と水平帰線期間とを合わせて１つのライン期間としても良い。そして次に第２のライン期間（Ｌ２）が開始され、選択信号によってゲート信号線Ｇ２が選択され、第１のライン期間（Ｌ１）と同様にソース信号線（Ｓ１〜Ｓｘ）に順にアナログのビデオ信号が入力される。
【００２２】
そして全てのゲート信号線（Ｇ１〜Ｇｙ）が選択されると、全てのライン期間（Ｌ１〜Ｌｙ）が終了する。全てのライン期間（Ｌ１〜Ｌｙ）が終了すると、１フレーム期間が終了する。１フレーム期間中において全ての画素が表示を行い、１つの画像が形成される。なお全てのライン期間（Ｌ１〜Ｌｙ）と垂直帰線期間とを合わせて１フレーム期間としても良い。
【００２３】
以上のように、アナログのビデオ信号の電位によって発光素子１８０６の発光量が制御され、その発光量の制御によって階調表示がなされる。
【００２４】
【発明が解決しようとする課題】
発光素子に供給される電流量が電流制御用ＴＦＴのゲート電極とソース領域の間の電圧によって制御される様子を図２６を用いて詳しく説明する。
【００２５】
図２６（Ａ）はＴＦＴのトランジスタ特性を示すグラフであり、４０１はＩD−ＶGS特性（又はＩD−ＶGS曲線）と呼ばれている。ここでＩDはドレイン電流であり、ＶGSはゲート電極とソース領域の電位差（ゲート電圧）である。このグラフにより任意のゲート電圧に対して流れる電流量を知ることができる。
【００２６】
通常、発光素子を駆動するにあたって、上記ＩD−ＶGS特性の点線４０２で示した領域を用いる。４０２で囲んだ領域の拡大図を図２６（Ｂ）に示す。
【００２７】
図２６（Ｂ）において、斜線で示す領域は飽和領域と呼ばれている。実際にはしきい値電圧（ＶTH）近傍からそれ以上のゲート電圧である領域を指し、この領域ではゲート電圧の変化に対して指数関数的にドレイン電流が変化する。アナログ駆動の場合、この領域を使ってゲート電圧による電流制御を行う。
【００２８】
スイッチング用ＴＦＴがオンの状態となって画素内に入力されたアナログのビデオ信号によって電流制御用ＴＦＴのゲート電圧が決まる。このとき、図２６（Ａ）に示したＩD−ＶGS特性に従って、ゲート電圧に対するドレイン電流が１対１で定まる。即ち、電流制御用ＴＦＴのゲート電極に入力されるアナログのビデオ信号の電圧によって、ドレイン領域の電位が定まり、所定のドレイン電流が発光素子に流れ、その電流量に対応した発光量で前記発光素子が発光する。
【００２９】
以上のように、アナログのビデオ信号によって発光素子の発光量が制御され、その発光量の制御によって階調表示がなされる。
【００３０】
しかしながら、上記アナログ駆動はＴＦＴの特性バラツキに非常に弱いという欠点がある。例えばスイッチング用ＴＦＴのＩD−ＶGS特性が同じ階調を表示する隣接画素のスイッチング用ＴＦＴと異なる場合（全体的にプラス又はマイナス側へシフトした場合）を想定する。
【００３１】
その場合、各スイッチング用ＴＦＴのドレイン電流はバラツキの程度にもよるが異なるものとなり、各画素の電流制御用ＴＦＴには異なるゲート電圧がかかることになる。即ち、各発光素子に対して異なる電流が流れ、結果として発光素子の発光量は異なり、同じ階調表示を行えなくなる。
【００３２】
また、仮に各画素の電流制御用ＴＦＴに等しいゲート電圧がかかったとしても、電流制御用ＴＦＴのＩD−ＶGS特性にバラツキがあれば、同じドレイン電流を出力することはできない。さらに、図２６（Ａ）からも明らかなようにゲート電圧の変化に対して指数関数的にドレイン電流が変化するような領域を使っているため、ＩD−ＶGS特性が僅かでもずれれば、等しいゲート電圧がかかっても出力される電流量は大きく異なるといった事態が生じうる。こうなってしまうと、僅かなＩD−ＶGS特性のバラツキによって、同じ電圧の信号を入力しても発光素子の発光量が隣接画素で大きく異なってしまう。
【００３３】
実際には、スイッチング用ＴＦＴと電流制御用ＴＦＴとの、両者のバラツキの相乗効果となるので条件的にはさらに厳しい。このように、アナログ駆動はＴＦＴの特性バラツキに対して極めて敏感であり、その点が従来のアクティブマトリクス型の発光装置の階調表示における問題となっていた。
【００３４】
本発明は上記問題点を鑑みてなされたものであり、鮮明な多階調カラー表示の可能なアクティブマトリクス型の発光装置を提供することを課題とする。そして、そのようなアクティブマトリクス型発光装置を表示部に具備する高性能な発光装置（電子機器）を提供することを課題とする。
【００３５】
【課題を解決するための手段】
本発明者は、アナログ駆動の問題は、ゲート電圧の変化に対してドレイン電流が指数関数的に変化するためにＩD−ＶGS特性のばらつきの影響を受けやすい飽和領域を用いて発光素子に流れる電流量を制御していることに起因すると考えた。
【００３６】
即ち、ＩD−ＶGS特性のばらつきがあった場合に、飽和領域はゲート電圧の変化に対してドレイン電流が指数関数的に変化するため、等しいゲート電圧がかかっても、異なる電流（ドレイン電流）が出力されてしまい、その結果所望の階調が得られないという不具合が生じるのである。
【００３７】
そこで本発明人は、発光素子の発する光の量の制御を、飽和領域を用いた電流の制御により行うのではなく、主に発光素子の発光する時間の制御によって行うことを考えた。つまり本発明では発光素子の発する光の量を時間で制御し、階調表示を行う。発光素子の発光時間を制御することで階調表示を行う駆動方法を、時分割方式の駆動方法（以下、デジタル駆動という）と呼ぶ。なお時分割方式の駆動方法によって行われる階調表示を時分割階調表示と呼ぶ。
【００３８】
本発明は上記構成によって、ＴＦＴによるＩD−ＶGS特性のバラツキのために、所望の階調表示が得られないという事態を避けることが可能になる。
【００３９】
以下に、本発明の構成を示す。
【００４０】
本発明によって、
第１ソース信号線駆動回路と、第２ソース信号線駆動回路と、第１ゲート信号線駆動回路と、第２ゲート信号線駆動回路と、画素部とを有する発光装置であって、
前記画素部は複数の画素を有しており、
前記複数の画素は、発光素子と、前記発光素子の発光を制御する電流制御用ＴＦＴと、前記電流制御用ＴＦＴの駆動を制御する第１スイッチング用ＴＦＴ及び第２スイッチング用ＴＦＴとを有し、
前記第１ソース信号線駆動回路及び前記第１ゲート信号線駆動回路によって前記第１スイッチング用ＴＦＴの駆動が制御され、
前記第２ソース信号線駆動回路及び前記第２ゲート信号線駆動回路によって前記第２スイッチング用ＴＦＴの駆動が制御され、
前記発光素子の発光する期間の長さを制御することで階調表示を行うことを特徴とする発光装置が提供される。
【００４１】
本発明によって、
第１ソース信号線駆動回路と、第２ソース信号線駆動回路と、第１ゲート信号線駆動回路と、第２ゲート信号線駆動回路と、画素部と、前記第１ソース信号線駆動回路に接続された複数の第１ソース信号線と、前記第２ソース信号線駆動回路に接続された複数の第２ソース信号線と、前記第１ゲート信号線駆動回路に接続された複数の第１ゲート信号線と、前記第２ゲート信号線駆動回路に接続された複数の第２ゲート信号線と、複数の電源供給線とを有する発光装置であって、
前記画素部は、複数の発光素子、複数の電流制御用ＴＦＴ、複数の第１スイッチング用ＴＦＴ及び複数の第２スイッチング用ＴＦＴを含む複数の画素を有しており、
前記複数の第１スイッチング用ＴＦＴが有するゲート電極は、前記複数の第１ゲート信号線と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するゲート電極は、前記複数の第２ゲート信号線と接続されており、
前記複数の第１スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第１ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第２ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の電流制御用ＴＦＴが有するソース領域とドレイン領域は、一方は前記複数の電源供給線に、もう一方は前記複数の発光素子に接続されていることを特徴とする発光装置が提供される。
【００４２】
本発明によって、
第１ソース信号線駆動回路と、第２ソース信号線駆動回路と、第１ゲート信号線駆動回路と、第２ゲート信号線駆動回路と、画素部と、前記第１ソース信号線駆動回路に接続された複数の第１ソース信号線と、前記第２ソース信号線駆動回路に接続された複数の第２ソース信号線と、前記第１ゲート信号線駆動回路に接続された複数の第１ゲート信号線と、前記第２ゲート信号線駆動回路に接続された複数の第２ゲート信号線と、一定の電位に保たれた複数の電源供給線とを有する発光装置であって、
前記画素部は、複数の発光素子、複数の電流制御用ＴＦＴ、複数の第１スイッチング用ＴＦＴ及び複数の第２スイッチング用ＴＦＴを含む複数の画素を有しており、
前記複数の発光素子は、画素電極と、一定の電位に保たれた対向電極と、前記画素電極と前記対向電極の間に設けられた有機化合物層とをそれぞれ有しており、
前記複数の第１スイッチング用ＴＦＴが有するゲート電極は、前記複数の第１ゲート信号線と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するゲート電極は、前記複数の第２ゲート信号線と接続されており、
前記複数の第１スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第１ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第２ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の電流制御用ＴＦＴが有するソース領域とドレイン領域は、一方は前記複数の電源供給線に、もう一方は前記画素電極に接続されていることを特徴とする発光装置が提供される。
【００４３】
本発明によって、
第１ソース信号線駆動回路と、第２ソース信号線駆動回路と、第１ゲート信号線駆動回路と、第２ゲート信号線駆動回路と、画素部と、前記第１ソース信号線駆動回路に接続された複数の第１ソース信号線と、前記第２ソース信号線駆動回路に接続された複数の第２ソース信号線と、前記第１ゲート信号線駆動回路に接続された複数の第１ゲート信号線と、前記第２ゲート信号線駆動回路に接続された複数の第２ゲート信号線と、複数の電源供給線とを有する発光装置であって、
前記画素部は、複数の発光素子、複数の電流制御用ＴＦＴ、複数の第１スイッチング用ＴＦＴ及び複数の第２スイッチング用ＴＦＴを含む複数の画素を有しており、
前記複数の第１スイッチング用ＴＦＴが有するゲート電極は、前記複数の第１ゲート信号線と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するゲート電極は、前記複数の第２ゲート信号線と接続されており、
前記複数の第１スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第１ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第２ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の電流制御用ＴＦＴが有するソース領域とドレイン領域は、一方は前記複数の電源供給線に、もう一方は前記複数の発光素子に接続されており、
１フレーム期間内にｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎが順に出現し、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのうち最後に出現する書き込み期間Ｔａｎの次に出現する書き込み期間は、前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのうち最初に出現する書き込み期間Ｔａ１であり、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのそれぞれが出現してから、前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのそれぞれの次の書き込み期間が出現するまでの期間が、ｎ個の表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄｎであり、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎにおいて、前記第１ソース信号線駆動回路から前記複数の第１ソース信号線を介して、若しくは前記第２ソース信号線駆動回路から前記複数の第２ソース信号線を介して、デジタル信号が前記複数の画素に入力され、
前記デジタル信号によって、前記ｎ個の表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄｎにおいて前記複数の発光素子が発光状態になるか非発光状態になるかが選択されることを特徴とする発光装置が提供される。
【００４４】
本発明によって、
第１ソース信号線駆動回路と、第２ソース信号線駆動回路と、第１ゲート信号線駆動回路と、第２ゲート信号線駆動回路と、画素部と、前記第１ソース信号線駆動回路に接続された複数の第１ソース信号線と、前記第２ソース信号線駆動回路に接続された複数の第２ソース信号線と、前記第１ゲート信号線駆動回路に接続された複数の第１ゲート信号線と、前記第２ゲート信号線駆動回路に接続された複数の第２ゲート信号線と、一定の電位に保たれた複数の電源供給線とを有する発光装置であって、
前記画素部は、複数の発光素子、複数の電流制御用ＴＦＴ、複数の第１スイッチング用ＴＦＴ及び複数の第２スイッチング用ＴＦＴを含む複数の画素を有しており、
前記複数の発光素子は、画素電極と、一定の電位に保たれた対向電極と、前記画素電極と前記対向電極の間に設けられた有機化合物層とをそれぞれ有しており、
前記複数の第１スイッチング用ＴＦＴが有するゲート電極は、前記複数の第１ゲート信号線と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するゲート電極は、前記複数の第２ゲート信号線と接続されており、
前記複数の第１スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第１ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第２ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の電流制御用ＴＦＴが有するソース領域とドレイン領域は、一方は前記複数の電源供給線に、もう一方は前記画素電極に接続されており、
１フレーム期間内にｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎが順に出現し、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのうち最後に出現する書き込み期間Ｔａｎの次に出現する書き込み期間は、前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのうち最初に出現する書き込み期間Ｔａ１であり、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのそれぞれが出現してから、前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのそれぞれの次の書き込み期間が出現するまでの期間が、ｎ個の表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄｎであり、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎにおいて、前記第１ソース信号線駆動回路から前記複数の第１ソース信号線を介して、若しくは前記第２ソース信号線駆動回路から前記複数の第２ソース信号線を介して、デジタル信号が前記複数の画素に入力され、
前記デジタル信号によって、前記ｎ個の表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄｎにおいて前記複数の発光素子が発光状態になるか非発光状態になるかが選択されることを特徴とする発光装置が提供される。
【００４５】
本発明によって、
第１ソース信号線駆動回路と、第２ソース信号線駆動回路と、第１ゲート信号線駆動回路と、第２ゲート信号線駆動回路と、画素部と、前記第１ソース信号線駆動回路に接続された複数の第１ソース信号線と、前記第２ソース信号線駆動回路に接続された複数の第２ソース信号線と、前記第１ゲート信号線駆動回路に接続された複数の第１ゲート信号線と、前記第２ゲート信号線駆動回路に接続された複数の第２ゲート信号線と、複数の電源供給線とを有する発光装置であって、
前記画素部は、複数の発光素子、複数の電流制御用ＴＦＴ、複数の第１スイッチング用ＴＦＴ及び複数の第２スイッチング用ＴＦＴを含む複数の画素を有しており、
前記複数の第１スイッチング用ＴＦＴが有するゲート電極は、前記複数の第１ゲート信号線と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するゲート電極は、前記複数の第２ゲート信号線と接続されており、
前記複数の第１スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第１ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第２ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の電流制御用ＴＦＴが有するソース領域とドレイン領域は、一方は前記複数の電源供給線に、もう一方は前記複数の発光素子に接続されており、
１フレーム期間内にｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎが順に出現し、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのうち最後に出現する書き込み期間Ｔａｎの次に出現する書き込み期間は、前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのうち最初に出現する書き込み期間Ｔａ１であり、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのそれぞれが出現してから、前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのそれぞれの次の書き込み期間が出現するまでの期間が、ｎ個の表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄｎであり、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎにおいて、前記第１ソース信号線駆動回路から前記複数の第１ソース信号線を介して、若しくは前記第２ソース信号線駆動回路から前記複数の第２ソース信号線を介して、デジタル信号が前記複数の画素に入力され、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのうち、いくつかの隣り合う書き込み期間は互いに一部重なっており、
前記デジタル信号によって、前記ｎ個の表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄｎにおいて前記複数の発光素子が発光状態になるか非発光状態になるかが選択されることを特徴とする発光装置が提供される。
【００４６】
本発明によって、
第１ソース信号線駆動回路と、第２ソース信号線駆動回路と、第１ゲート信号線駆動回路と、第２ゲート信号線駆動回路と、画素部と、前記第１ソース信号線駆動回路に接続された複数の第１ソース信号線と、前記第２ソース信号線駆動回路に接続された複数の第２ソース信号線と、前記第１ゲート信号線駆動回路に接続された複数の第１ゲート信号線と、前記第２ゲート信号線駆動回路に接続された複数の第２ゲート信号線と、一定の電位に保たれた複数の電源供給線とを有する発光装置であって、
前記画素部は、複数の発光素子、複数の電流制御用ＴＦＴ、複数の第１スイッチング用ＴＦＴ及び複数の第２スイッチング用ＴＦＴを含む複数の画素を有しており、
前記複数の発光素子は、画素電極と、一定の電位に保たれた対向電極と、前記画素電極と前記対向電極の間に設けられた有機化合物層とをそれぞれ有しており、
前記複数の第１スイッチング用ＴＦＴが有するゲート電極は、前記複数の第１ゲート信号線と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するゲート電極は、前記複数の第２ゲート信号線と接続されており、
前記複数の第１スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第１ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の第２スイッチング用ＴＦＴが有するソース領域とドレイン領域とは、一方は前記複数の第２ソース信号線と、もう一方は前記複数の電流制御用ＴＦＴが有するゲート電極と接続されており、
前記複数の電流制御用ＴＦＴが有するソース領域とドレイン領域は、一方は前記複数の電源供給線に、もう一方は前記画素電極に接続されており、
１フレーム期間内にｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎが順に出現し、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのうち最後に出現する書き込み期間Ｔａｎの次に出現する書き込み期間は、前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのうち最初に出現する書き込み期間Ｔａ１であり、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのそれぞれが出現してから、前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのそれぞれの次の書き込み期間が出現するまでの期間が、ｎ個の表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄｎであり、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎにおいて、前記第１ソース信号線駆動回路から前記複数の第１ソース信号線を介して、若しくは前記第２ソース信号線駆動回路から前記複数の第２ソース信号線を介して、デジタル信号が前記複数の画素に入力され、
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎのうち、いくつかの隣り合う書き込み期間は互いに一部重なっており、
前記デジタル信号によって、前記ｎ個の表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄｎにおいて前記複数の発光素子が発光状態になるか非発光状態になるかが選択されることを特徴とする発光装置が提供される。
【００４７】
前記互いに一部重なっている隣り合う書き込み期間が、一方の書き込み期間において前記第１ソース信号線駆動回路から前記複数の第１ソース信号線を介してデジタル信号が前記複数の画素に入力され、もう一方の書き込み期間において前記第２ソース信号線駆動回路から前記複数の第２ソース信号線を介してデジタル信号が前記複数の画素に入力されていることを特徴としていても良い。
【００４８】
前記ｎ個の表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄｎのうちのｊ個の表示期間（ｊは０以上ｎ以下の整数）において、前記複数の発光素子の全てが非発光状態になる黒表示期間であることを特徴としていても良い。
【００４９】
前記ｎ個の書き込み期間Ｔａ１、Ｔａ２、…、Ｔａｎの長さが全て同じであることを特徴としていても良い。
【００５０】
前記ｎ個の表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄｎのうち、黒表示期間ではない（ｎ−ｊ）個の表示期間を短い順に並べたときの長さの比は、２0：２1：…：２(n-j-1)であることを特徴としていても良い。
【００５１】
前記第１スイッチング用ＴＦＴ及び前記第２スイッチング用ＴＦＴの極性が同じであることを特徴としていても良い。
【００５２】
１フレーム期間中において最後に出現する表示期間は、前記１フレーム期間中において最も長い黒表示期間であることを特徴としていても良い。
【００５３】
本発明によって、
第１ソース信号線駆動回路と、第２ソース信号線駆動回路と、第１ゲート信号線駆動回路と、第２ゲート信号線駆動回路と、画素部とを有する発光装置であって、
前記画素部は複数の画素を有し、
前記複数の画素は複数の発光素子を有し、
第１ソース信号線駆動回路及び第２ソース信号線駆動回路から出力されるデジタル信号、前記第１ゲート信号線駆動回路及び前記第２ゲート信号線駆動回路から出力される選択信号によって、前記複数の発光素子の駆動がそれぞれ制御されることを特徴とする発光装置が提供される。
【００５４】
本発明によって、
第１ソース信号線駆動回路と、第２ソース信号線駆動回路と、第１ゲート信号線駆動回路と、第２ゲート信号線駆動回路と、画素部とを有する発光装置であって、
前記画素部は複数の画素を有し、
前記複数の画素は複数の発光素子を有し、
第１ソース信号線駆動回路及び第２ソース信号線駆動回路から出力されるデジタル信号、前記第１ゲート信号線駆動回路及び前記第２ゲート信号線駆動回路から出力される選択信号によって前記発光素子の発光する時間が制御されることで階調表示が行われることを特徴とする発光装置が提供される。
【００５５】
前記有機化合物層は低分子系有機物質またはポリマー系有機物質であることを特徴としていても良い。
【００５６】
前記低分子系有機物質は、Ａｌｑ3（トリス−８−キノリライト−アルミニウム）またはＴＰＤ（トリフェニルアミン誘導体）からなることを特徴としていても良い。
【００５７】
前記ポリマー系有機物質は、ＰＰＶ（ポリフェニレンビニレン）、ＰＶＫ（ポリビニルカルバゾール）またはポリカーボネートからなることを特徴としていても良い。
【００５８】
前記発光装置とは、コンピュータ、ビデオカメラまたはＤＶＤプレーヤーであることを特徴としていても良い。
【００５９】
【発明の実施の形態】
以下に、本発明の発光装置の構造及びその駆動方法について説明する。ここではｎビットのデジタルビデオ信号により２n階調の表示を行う場合について説明する。
【００６０】
図１に本発明の発光装置のブロック図の一例を示す。図１の発光装置は、基板上に形成されたＴＦＴによって画素部１０１、画素部の周辺に配置された第１ソース信号線駆動回路１０２ａ、第２ソース信号線駆動回路１０２ｂ、第１ゲート信号線駆動回路１０３ａ、第２ゲート信号線駆動回路１０３ｂを有している。
【００６１】
なお、第１ソース信号線駆動回路１０２ａ、第２ソース信号線駆動回路１０２ｂ、第１ゲート信号線駆動回路１０３ａ、第２ゲート信号線駆動回路１０３ｂは、画素部１０１と同じ基板上に形成されていても良いし、ＩＣチップ上に設けてＦＰＣ等で画素部１０１と接続しても良い。
【００６２】
第１及び第２ソース信号線駆動回路１０２ａ、１０２ｂは、基本的にシフトレジスタ１０５、ラッチ（Ａ）１０６、ラッチ（Ｂ）１０７をそれぞれ有している。
【００６３】
一方、第１ゲート信号線駆動回路１０３ａ及び第２ゲート信号線駆動回路１０３ｂは、それぞれシフトレジスタ、バッファ（いずれも図示せず）を有している。また場合によっては、第１及び第２ゲート信号線駆動回路１０３ａ、１０３ｂが、シフトレジスタ、バッファの他にレベルシフトを有していても良い。
【００６４】
なお、本発明の発光装置が有する駆動回路は、図１に示した構成に限定されない。
【００６５】
画素部１０１の拡大図を図２に示す。第１ソース信号線駆動回路１０２ａのラッチ（Ｂ）１０７に接続された第１ソース信号線（ＳＬ１〜ＳＬｘ）、第２ソース信号線駆動回路１０２ｂのラッチ（Ｂ）１０７に接続された第２ソース信号線（ＳＲ１〜ＳＲｘ）、ＦＰＣを介して発光装置の外部の電源に接続された電源供給線（Ｖ１〜Ｖｘ）、第１ゲート信号線駆動回路１０３ａに接続された第１ゲート信号線（ＧＬ１〜ＧＬｙ）、第２ゲート信号線駆動回路１０３ｂに接続された第２ゲート信号線（ＧＲ１〜ＧＲｙ）が画素部１０１に設けられている。
【００６６】
なお本明細書において、第１ソース信号線駆動回路１０２ａと第１ゲート信号線駆動回路１０３ａとを合わせて第１駆動回路群（Ｄｒ＿Ｌ）と呼ぶ。また第２ソース信号線駆動回路１０２ｂと第２ゲート信号線駆動回路１０３ｂとを合わせて第２駆動回路群（Ｄｒ＿Ｒ）と呼ぶ。
【００６７】
第１ソース信号線（ＳＬ１〜ＳＬｘ）の１つと、第２ソース信号線（ＳＲ１〜ＳＲｘ）の１つと、電源供給線（Ｖ１〜Ｖｘ）の１つと、第１ゲート信号線（ＧＬ１〜ＧＬｙ）の１つと、第２ゲート信号線（ＧＲ１〜ＧＲｙ）の１つとを備えた領域が画素１０４である。画素部１０１にはマトリクス状に複数の画素１０４が配列されることになる。
【００６８】
画素１０４の拡大図を図３に示す。図３において、２０１ａは第１スイッチング用ＴＦＴ、２０１ｂは第２スイッチング用ＴＦＴである。第１スイッチング用ＴＦＴ２０１ａのゲート電極は、第１ゲート信号線ＧＬ（ＧＬ１〜ＧＬｙのいずれか１つ）に接続されている。第２スイッチング用ＴＦＴ２０１ｂのゲート電極は、第２ゲート信号線ＧＲ（ＧＲ１〜ＧＲｙのいずれか１つ）に接続されている。
【００６９】
第１スイッチング用ＴＦＴ２０１ａのソース領域とドレイン領域は、一方が第１ソース信号線ＳＬ（ＳＬ１〜ＳＬｘのいずれか１つ）に、もう一方が電流制御用ＴＦＴ２０２のゲート電極及び各画素が有するコンデンサ２０４に接続されている。また第２スイッチング用ＴＦＴ２０１ｂのソース領域とドレイン領域は、一方が第２ソース信号線ＳＲ（ＳＲ１〜ＳＲｘのいずれか１つ）に、もう一方が電流制御用ＴＦＴ２０２のゲート電極及び各画素が有するコンデンサ２０４に接続されている。
【００７０】
コンデンサ２０４は第１及び第２スイッチング用ＴＦＴ２０１ａ、２０１ｂがオフの状態（非選択状態）にある時、電流制御用ＴＦＴ２０２のゲート電圧を保持するために設けられている。なお本実施の形態ではコンデンサ２０４を設ける構成を示したが、本発明はこの構成に限定されず、コンデンサ２０４を設けない構成にしても良い。
【００７１】
また、電流制御用ＴＦＴ２０２のソース領域とドレイン領域は、一方が電源供給線Ｖ（Ｖ１〜Ｖｘのいずれか１つ）に接続され、もう一方は発光素子２０３に接続される。電源供給線Ｖはコンデンサ２０４に接続されている。
【００７２】
発光素子２０３は陽極と陰極と、陽極と陰極との間に設けられた有機化合物層とからなる。陽極が電流制御用ＴＦＴ２０２のソース領域またはドレイン領域と接続している場合、陽極が画素電極、陰極が対向電極となる。逆に陰極が電流制御用ＴＦＴ２０２のソース領域またはドレイン領域と接続している場合、陰極が画素電極、陽極が対向電極となる。
【００７３】
発光素子２０３の対向電極には対向電位が与えられている。また電源供給線Ｖには電源電位が与えられている。そして対向電位と電源電位の電位差は、電源電位が画素電極に与えられたときに発光素子が発光する程度の電位差に常に保たれている。電源電位と対向電位は、本発明の発光装置に、外付けのＩＣ等により設けられた電源によって与えられる。
【００７４】
現在の典型的な発光装置には、画素の発光する面積あたりの発光量が２００ｃｄ／ｍ2の場合、画素部の面積あたりの電流が数ｍＡ／ｃｍ2程度必要となる。そのため特に画面サイズが大きくなると、ＩＣに設けられた電源から与えられる電位の高さをスイッチで制御することが難しくなる。本発明においては、電源電位と対向電位は常に一定に保たれており、ＩＣに設けられた電源から与えられる電位の高さをスイッチで制御する必要がないので、より大きな画面サイズのパネルの実現に有用である。
【００７５】
第１及び第２スイッチング用ＴＦＴ２０１ａ、２０１ｂ、電流制御用ＴＦＴ２０２は、ｎチャネル型ＴＦＴでもｐチャネル型ＴＦＴでもどちらでも用いることができる。また第１及び第２スイッチング用ＴＦＴ２０１ａ、２０１ｂ、電流制御用ＴＦＴ２０２は、シングルゲート構造の他に、ダブルゲート構造、やトリプルゲート構造などのマルチゲート構造を有していても良い。
【００７６】
また本発明において、電流制御用ＴＦＴ２０２はｎチャネル型ＴＦＴでもｐチャネル型ＴＦＴでもどちらでも用いることが可能であるが、発光素子２０３の陽極が画素電極で陰極が対向電極の場合、電流制御用ＴＦＴ２０２はｐチャネル型ＴＦＴであることが好ましい。また逆に発光素子２０３の陽極が対向電極で陰極が画素電極の場合、電流制御用ＴＦＴ２０２はｎチャネル型ＴＦＴであることが好ましい。
【００７７】
次に上述した構成を有する本発明の発光装置の駆動方法について、実施の形態１及び実施の形態２に示す。
【００７８】
（実施の形態１）
本実施の形態の駆動方法を、図４を用いて説明する。
【００７９】
はじめに、第１ゲート信号線駆動回路１０３ａから出力される選択信号によって第１ゲート信号線ＧＬ１が選択され、第１ゲート信号線ＧＬ１に接続されている全ての画素（１ライン目の画素）の第１スイッチング用ＴＦＴ２０１ａがオンの状態になる。なお本明細書において、ＴＦＴがオン状態になることを、ＴＦＴが駆動すると呼ぶ。
【００８０】
そして、第１ソース信号線駆動回路１０２ａのラッチ（Ｂ）１０７から１ライン目の画素に、第１ソース信号線（ＳＬ１〜ＳＬｘ）を介して１ビット目のデジタルビデオ信号が入力される。１ライン目の画素に入力された１ビット目のデジタルビデオ信号は、オンの状態の第１スイッチング用ＴＦＴ２０１ａを介して電流制御用ＴＦＴ２０２のゲート電極に入力される。
【００８１】
デジタルビデオ信号は「０」または「１」の情報を有しており、「０」と「１」のデジタルビデオ信号は、一方がＨｉ、一方がＬｏの電圧を有する信号である。
【００８２】
本実施の形態では、デジタルビデオ信号が「０」の情報を有していた場合、電流制御用ＴＦＴ２０２はオフの状態となる。よって発光素子２０３の画素電極には電源電位は与えられない。その結果、「０」の情報を有するデジタルビデオ信号が入力された画素が有する発光素子２０３は発光しない。
【００８３】
逆に、「１」の情報を有していた場合、電流制御用ＴＦＴ２０２はオン状態となる。よって発光素子２０３の画素電極には電源電位が与えられる。対向電位と電源電位の電位差は、電源電位が画素電極に与えられたときに発光素子が発光する程度の電位差に常に保たれている。そのため、「１」の情報を有するデジタルビデオ信号が入力された画素が有する発光素子２０３は発光する。
【００８４】
なお本実施の形態ではデジタルビデオ信号が「０」の情報を有していた場合、電流制御用ＴＦＴ２０２はオフの状態となり、「１」の情報を有していた場合電流制御用ＴＦＴ２０２はオン状態となるが、本発明はこの構成に限定されない。デジタルビデオ信号が「０」の情報を有していた場合、電流制御用ＴＦＴ２０２がオンの状態となり、「１」の情報を有していた場合電流制御用ＴＦＴ２０２オフの状態となっても良い。
【００８５】
また本明細書において、発光素子が発光している状態を発光状態、逆に発光素子が発光していない状態を非発光状態と呼ぶ。
【００８６】
このように、１ライン目の画素に１ビット目のデジタルビデオ信号が入力されると同時に、発光素子２０３が発光状態、または非発光状態になり、１ライン目の画素は表示を行う。画素が表示を行っている期間を表示期間Ｔｄと呼ぶ。特に１ビット目のデジタルビデオ信号が画素に入力されたことで開始する表示期間をＴｄ１と呼ぶ。図４では説明を簡便にするために、特に１ライン目（1st. row）、ｙライン目（last. row）の画素の表示期間についてのみ示す。各ラインの表示期間が開始されるタイミングはそれぞれ時間差を有している。
【００８７】
次に、第１ゲート信号線ＧＬ１に接続されている全ての画素（１ライン目の画素）の第１スイッチング用ＴＦＴ２０１ａがオフの状態になる。そして、第１ゲート信号線駆動回路１０３ａから出力される選択信号によって第１ゲート信号線ＧＬ２が選択され、第１ゲート信号線ＧＬ２に接続されている全ての画素（２ライン目の画素）の第１スイッチング用ＴＦＴ２０１ａがオンの状態になる。そして第１ソース信号線駆動回路１０２ａから２ライン目の画素に、ソース信号線（ＳＬ１〜ＳＬｘ）を介して１ビット目のデジタルビデオ信号が入力される。
【００８８】
そして上述した動作を順に繰り返し、全ての第１ゲート信号線（ＧＬ１〜ＧＬｙ）が選択され、全てのラインの画素に１ビット目のデジタルビデオ信号が入力される。１ビット目のデジタルビデオ信号が全ての画素に入力されるまでの期間が、書き込み期間Ｔａ１である。
【００８９】
一方、全てのラインの画素に１ビット目のデジタルビデオ信号が入力される前若しくは入力された後、言い換えると書き込み期間Ｔａ１が終了する前若しくは終了した後に、書き込み期間Ｔａ２が開始される。本実施の形態では、書き込み期間Ｔａ１が終了する前に、書き込み期間Ｔａ２が開始される例を示している。
【００９０】
書き込み期間Ｔａ２が開始されると、第２ゲート信号線駆動回路１０３ｂから出力される選択信号によって第２ゲート信号線ＧＲ１が選択され、第２ゲート信号線ＧＲ１に接続されている全ての画素（１ライン目の画素）の第２スイッチング用ＴＦＴ２０１ｂがオンの状態になる。
【００９１】
そして、第２ソース信号線駆動回路１０２ａのラッチ（Ｂ）１０７から１ライン目の画素に、第２ソース信号線（ＳＲ１〜ＳＲｘ）を介して２ビット目のデジタルビデオ信号が入力される。１ライン目の画素に入力された２ビット目のデジタルビデオ信号は、第２スイッチング用ＴＦＴ２０１ｂを介して電流制御用ＴＦＴ２０２のゲート電極に入力される。
【００９２】
このように書き込み期間Ｔａ２では、画素への１ビット目のデジタルビデオ信号の入力と並行して、１ライン目の画素に２ビット目のデジタルビデオ信号を入力することができる。よって、書き込み期間Ｔａ１において画素に入力された１ビット目のデジタルビデオ信号は、２ビット目のデジタルビデオ信号に書き換えられる。
【００９３】
１ライン目の画素に２ビット目のデジタルビデオ信号が入力されると同時に、発光素子２０３が２ビット目のデジタルビデオ信号に基づいて発光状態、または非発光状態になり、１ライン目の画素は表示を行う。２ビット目のデジタルビデオ信号が画素に入力されたことで、表示期間Ｔｄ１は終了し、表示期間Ｔｄ２が開始される。
【００９４】
次に、第２ゲート信号線ＧＲ１に接続されている全ての画素（１ライン目の画素）の第２スイッチング用ＴＦＴ２０１ｂがオフの状態になる。そして第２ゲート信号線駆動回路１０３ｂから出力される選択信号によって第２ゲート信号線ＧＲ２が選択され、第２ゲート信号線ＧＲ２に接続されている全ての画素（２ライン目の画素）の第２スイッチング用ＴＦＴ２０１ｂがオンの状態になる。そして第２ソース信号線駆動回路１０２ｂから２ライン目の画素に、ソース信号線（ＳＲ１〜ＳＲｘ）を介して２ビット目のデジタルビデオ信号が入力される。
【００９５】
そして上述した動作を順に繰り返し、全ての第２ゲート信号線（ＧＲ１〜ＧＲｙ）が選択され、全てのラインの画素に２ビット目のデジタルビデオ信号が入力される。２ビット目のデジタルビデオ信号が全ての画素に入力されるまでの期間が、書き込み期間Ｔａ２である。
【００９６】
一方、全てのラインの画素に２ビット目のデジタルビデオ信号が入力される前若しくは入力された後、言い換えると書き込み期間Ｔａ２が終了する前若しくは終了した後に書き込み期間Ｔａ３が開始される。本実施の形態では、書き込み期間Ｔａ２が終了する前に、書き込み期間Ｔａ３が開始される例を示している。
【００９７】
書き込み期間Ｔａ３が開始されると、第１ゲート信号線駆動回路１０３ａから出力される選択信号によって第１ゲート信号線ＧＬ１が選択され、第１ゲート信号線ＧＬ１に接続されている全ての画素（１ライン目の画素）の第１スイッチング用ＴＦＴ２０１ａがオンの状態になる。そして１ライン目の画素に３ビット目のデジタルビデオ信号が入力され、表示期間Ｔｄ２が終了し、表示期間Ｔｄ３が開始する。
【００９８】
そして、順に全ての第１ゲート信号線（ＧＬ１〜ＧＬｙ）が選択され、３ビット目のデジタルビデオ信号が全ての画素に入力される。全てのラインの画素に３ビット目のデジタルビデオ信号が入力し終わるまでの期間を、書き込み期間Ｔａ３と呼ぶ。
【００９９】
上述した動作はｎビット目のデジタルビデオ信号が画素に入力されるまで行われ、表示期間Ｔｄ１〜Ｔｄｎが全て出現する（図４）。
【０１００】
全ての表示期間Ｔｄ１〜Ｔｄｎが終了すると１フレーム期間が終了し、１つの画像を表示することができる。本発明の駆動方法において、１つの画像を表示する期間を１フレーム期間（Ｆ）と呼ぶ。
【０１０１】
通常の発光装置では１秒間に６０以上のフレーム期間を設けることが好ましい。１秒間に表示される画像の数が６０より少なくなると、視覚的に画像のちらつきが目立ち始めることがある。
【０１０２】
そして１フレーム期間終了後は、再び１ビット目のデジタルビデオ信号が画素に入力され表示期間Ｔｄ１となる。そして上述した動作を繰り返す。なお本実施の形態では、１フレーム期間終了後の次のフレーム期間において、再び第１駆動回路群（Ｄｒ＿Ｌ）によって、１ビット目のデジタルビデオ信号が画素に入力されている。しかし本発明はこの構成に限定されない。１フレーム期間終了後の次のフレーム期間において、１ビット目のデジタルビデオ信号が第２駆動回路群（Ｄｒ＿Ｒ）によって画素に入力されても良い。
【０１０３】
なお本明細書において画素にデジタルビデオ信号が入力されるとは、デジタルビデオ信号が画素の有するスイッチング用ＴＦＴを介して電流制御用ＴＦＴのゲート電極に入力されることを意味する。
【０１０４】
また本実施の形態において、第１駆動回路群（Ｄｒ＿Ｌ）によってデジタルビデオ信号が画素に入力される書き込み期間と、第２駆動回路群（Ｄｒ＿Ｒ）によってデジタルビデオ信号が画素に入力される書き込み期間とが交互に出現していた。しかし本発明はこの構成に限定されない。隣り合う書き込み期間どうしが重なっていない場合、隣り合う２つの書き込み期間においてデジタルビデオ信号を画素に入力するための駆動回路群は、共に第１駆動回路群（Ｄｒ＿Ｌ）でも良いし、または共に第２駆動回路群（Ｄｒ＿Ｒ）でも良い。
【０１０５】
第１駆動回路群（Ｄｒ＿Ｌ）によってデジタルビデオ信号が画素に入力される書き込み期間どうしは互いに重ならないことが重要である。また第２駆動回路群（Ｄｒ＿Ｒ）によってデジタルビデオ信号が画素に入力される書き込み期間どうしも互いに重ならないことが重要である。
【０１０６】
表示期間Ｔｄ１は、書き込み期間Ｔａ１が開始されてから書き込み期間Ｔａ２が開始されるまでの期間である。また表示期間Ｔｄ２は、書き込み期間Ｔａ２が開始されてから表示期間Ｔａ３が開始されるまでの期間である。そして表示期間Ｔｄ３、Ｔｄ４、…、Ｔｄ（ｎ−１）、Ｔｄｎも表示期間Ｔｄ１及びＴｄ２と同様に、それぞれ書き込み期間Ｔａ３、Ｔａ４、…、Ｔａ（ｎ−１）、Ｔａｎが開始されてから、その次の書き込み期間Ｔａ４、Ｔａ５、…Ｔａｎ、Ｔａ１が開始されるまでの期間である。
【０１０７】
また本実施の形態では、表示期間Ｔｄ１〜Ｔｄｎを短い順に並べた場合、それぞれの長さの比が、２0：２1：２2：…：２(n-2)：２(n-1)となるようにする。
【０１０８】
なお本実施の形態において、書き込み期間の長さは、Ｔａ１＝Ｔａ２＝…＝Ｔａｎであって、全て同じ長さになる。しかし本発明はこれに限定されず、書き込み期間の長さは全て同じでなくても良い。
【０１０９】
本発明では、表示期間Ｔｄ１〜Ｔｄｎの組み合わせで２n階調のうち所望の階調表示を行うことができる。
【０１１０】
１フレーム期間中に発光素子が発光した表示期間の長さの総和を求めることによって、当該フレーム期間におけるその画素の表示した階調がきまる。
【０１１１】
なお本実施の形態では、１フレーム期間における表示期間の長さの総和の割合（デューティー比）が１００であるので、高い輝度の表示を行うことができる。
【０１１２】
（実施の形態２）
本実施の形態では、発光素子が発光を行わない表示期間（黒表示期間）を設ける例について、図５を用いて説明する。
【０１１３】
はじめに書き込み期間Ｔａ１において、１ビット目のデジタルビデオ信号が第１駆動回路群（Ｄｒ＿Ｌ）によって各画素（詳しくは、各画素の電流制御用ＴＦＴ２０２のゲート電極）に入力される。なお、本実施の形態におけるデジタルビデオ信号の画素への入力は、実施の形態１の場合と同様に行われるので、ここでは第１及び第２駆動回路群の詳しい動作の仕方について説明を省略する。
【０１１４】
１ビット目のデジタルビデオ信号が各画素に入力されると、デジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ１が開始されると同時に画素が表示を行い、表示期間Ｔｄ１となる。
【０１１５】
次に書き込み期間Ｔａ１が終了する前に書き込み期間Ｔａ２が開始される。書き込み期間Ｔａ２が開始されると同時に、表示期間Ｔｄ１が終了して表示期間Ｔｄ２が開始される。
【０１１６】
書き込み期間Ｔａ２において、常に「０」の情報を有するデジタルの信号（非表示信号）が、第２駆動回路群（Ｄｒ＿Ｒ）によって各画素（詳しくは、各画素の電流制御用ＴＦＴ２０２のゲート電極）に入力される。この非表示信号はデジタルビデオ信号とは異なり画像情報を有しておらず、常に「０」の情報を有している。
【０１１７】
なお本明細書において、画像情報を有するデジタルビデオ信号と画像情報を有さない非表示信号とをデジタル信号と総称する。
【０１１８】
非表示信号が各画素に入力されると、非表示信号が有する「０」の情報によって、全ての画素の有する発光素子が非発光状態となる。よって表示期間Ｔｄ２において画素は表示を行わない。
【０１１９】
なお本実施の形態ではデジタル信号が「０」の情報を有していた場合、電流制御用ＴＦＴ２０２はオフの状態となり、「１」の情報を有していた場合電流制御用ＴＦＴ２０２はオン状態となるが、本発明はこの構成に限定されない。デジタル信号が「０」の情報を有していた場合、電流制御用ＴＦＴ２０２がオンの状態となり、「１」の情報を有していた場合電流制御用ＴＦＴ２０２オフの状態となっても良い。この場合常に「１」の情報を有するデジタル信号が非表示信号となる。
【０１２０】
なお本明細書において、画像情報を有さない非表示信号によって画素が非発光状態となっている表示期間を、黒表示期間と呼ぶ。
【０１２１】
次に書き込み期間Ｔａ２が終了する前若しくは後に書き込み期間Ｔａ３が開始される。本実施の形態では書き込み期間Ｔａ２が終了する前に書き込み期間Ｔａ３が開始される。書き込み期間Ｔａ３において、２ビット目のデジタルビデオ信号が、第１駆動回路群（Ｄｒ＿Ｌ）によって各画素に入力される。
【０１２２】
２ビット目のデジタルビデオ信号が各画素に入力されると、２ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ３が開始されると同時に画素が表示を行い、表示期間Ｔｄ２が終了して表示期間Ｔｄ３となる。
【０１２３】
次に書き込み期間Ｔａ３が終了する前若しくは後に書き込み期間Ｔａ４が開始される。本実施の形態では書き込み期間Ｔａ３が終了する前に書き込み期間Ｔａ４が開始される。書き込み期間Ｔａ４において、３ビット目のデジタルビデオ信号が、第２駆動回路群（Ｄｒ＿Ｒ）によって各画素に入力される。
【０１２４】
３ビット目のデジタルビデオ信号が各画素に入力されると、３ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ４が開始されると同時に表示期間Ｔｄ３が終了し、表示期間Ｔｄ４となる。
【０１２５】
次に書き込み期間Ｔａ４が終了する前若しくは後に書き込み期間Ｔａ５が開始される。本実施の形態では書き込み期間Ｔａ４が終了する前に書き込み期間Ｔａ５が開始される。書き込み期間Ｔａ５が開始されると同時に、表示期間Ｔｄ４が終了して表示期間Ｔｄ５が開始される。
【０１２６】
書き込み期間Ｔａ５において、常に「０」の情報を有するデジタルの信号（非表示信号）が、第１駆動回路群（Ｄｒ＿Ｌ）によって各画素に入力される。
【０１２７】
非表示信号が各画素に入力されると、非表示信号が有する「０」の情報によって、全ての画素の有する発光素子が非発光状態となる。よって表示期間Ｔｄ５において画素は表示を行わず、Ｔｄ５は黒表示期間となる。
【０１２８】
上述した動作は書き込み期間Ｔａ（ｍ＋ｊ’）が開始されるまで行われる。なおｊ’は１フレーム期間内において、書き込み期間Ｔａ（ｍ＋ｊ’）が開始されるまでに出現した黒表示期間の数である。
【０１２９】
書き込み期間Ｔａ（ｍ−１＋ｊ’）が終了する前に書き込み期間Ｔａ（ｍ＋ｊ’）が開始される。なお図５では説明を簡便にするために、ｍ＝ｎ−２の場合について示したが、本発明はこれに限定されない。
【０１３０】
書き込み期間Ｔａ（ｍ＋ｊ’）〔Ｔａ（ｎ−２＋ｊ’）〕において、ｍビット目〔（ｎ−２）ビット目〕のデジタルビデオ信号が、第１駆動回路群（Ｄｒ＿Ｌ）によって各画素に入力される。
【０１３１】
ｍビット目〔（ｎ−２）ビット目〕のデジタルビデオ信号が各画素に入力されると、ｍビット目〔（ｎ−２）ビット目〕のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ（ｍ＋ｊ’）〔Ｔａ（ｎ−２＋ｊ’）〕が開始されると同時に画素が表示を行い、表示期間Ｔｄ（ｍ−１＋ｊ’）〔Ｔｄ（ｎ−３＋ｊ’）〕が終了して表示期間Ｔｄ（ｍ＋ｊ’）〔Ｔｄ（ｎ−２＋ｊ’）〕となる。
【０１３２】
この表示期間Ｔｄ（ｍ＋ｊ’）〔Ｔｄ（ｎ−２＋ｊ’）〕は書き込み期間Ｔａ（ｍ＋ｊ’）〔Ｔａ（ｎ−２＋ｊ’）〕、次の書き込み期間Ｔａ（ｍ＋１＋ｊ’）〔Ｔａ（ｎ−１＋ｊ’）〕が開始されるまで続く。
【０１３３】
書き込み期間Ｔａ（ｍ＋１＋ｊ’）〔Ｔａ（ｎ−１＋ｊ’）〕が開始されると、（ｍ＋１）ビット目〔（ｎ−１）ビット目〕のデジタルビデオ信号が、第１駆動回路群（Ｄｒ＿Ｌ）によって各画素に入力される。
【０１３４】
なお本実施の形態では書き込み期間Ｔａ（ｍ＋１＋ｊ’）〔Ｔａ（ｎ−１＋ｊ’）〕において、第１駆動回路群（Ｄｒ＿Ｌ）によってデジタルビデオ信号を画素に入力していたが、本発明はこれに限定されない。隣り合う書き込み期間どうしが重なっていない場合、隣り合う２つの書き込み期間においてデジタルビデオ信号を画素に入力するための駆動回路群は、共に第１駆動回路群（Ｄｒ＿Ｌ）でも良いし、または共に第２駆動回路群（Ｄｒ＿Ｒ）でも良い。
【０１３５】
（ｍ＋１）ビット目〔（ｎ−１）ビット目〕のデジタルビデオ信号が各画素に入力されると、（ｍ＋１）ビット目〔（ｎ−１）ビット目〕のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ（ｍ＋１＋ｊ’）〔Ｔａ（ｎ−１＋ｊ’）〕が開始されると同時に画素が表示を行い、表示期間Ｔｄ（ｍ＋ｊ’）〔Ｔｄ（ｎ−２＋ｊ’）〕が終了し表示期間Ｔｄ（ｍ＋ｊ’＋１）〔Ｔｄ（ｎ−１＋ｊ’）〕となる。
【０１３６】
この表示期間Ｔｄ（ｍ＋ｊ’＋１）〔Ｔｄ（ｎ−１＋ｊ’）〕は書き込み期間Ｔａ（ｍ＋１＋ｊ’）〔Ｔａ（ｎ−１＋ｊ’）〕が終了し、次の書き込み期間Ｔａ（ｍ＋２＋ｊ）〔Ｔａ（ｎ＋ｊ）〕が開始されるまで続く。書き込み期間Ｔａ（ｍ＋２＋ｊ）〔Ｔａ（ｎ＋ｊ）〕が開始されると同時に表示期間Ｔｄ（ｍ＋２＋ｊ）〔Ｔｄ（ｎ＋ｊ）〕となる。そして次のフレーム期間の書き込み期間Ｔａ１が開始されると同時に表示期間Ｔｄ（ｍ＋２＋ｊ）〔Ｔｄ（ｎ＋ｊ）〕は終了する。なおｊは１フレーム期間内における黒表示期間の数である。本実施の形態の場合、書き込み期間Ｔａ（ｍ＋ｊ’）〔Ｔａ（ｎ−２＋ｊ’）〕が開始されてから黒表示期間は出現していないので、ｊ’＝ｊである。
【０１３７】
全ての表示期間Ｔｄ１〜Ｔｄ（ｎ＋ｊ）が終了すると１フレーム期間が終了し、１つの画像を表示することができる。
【０１３８】
そして１フレーム期間終了後は、再び１ビット目のデジタルビデオ信号が画素に入力され表示期間Ｔｄ１となる。そして上述した動作を繰り返す。なお１フレーム期間終了後の次のフレーム期間において、１ビット目のデジタルビデオ信号が画素へ入力される際、第１駆動回路群（Ｄｒ＿Ｌ）と第２駆動回路群（Ｄｒ＿Ｒ）のどちらを用いても良い。
【０１３９】
表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄ（ｎ＋ｊ−１）、Ｔｄ（ｎ＋ｊ）は、それぞれ書き込み期間Ｔａ１、Ｔａ２、…、Ｔａ（ｎ＋ｊ−１）、Ｔａ（ｎ＋ｊ）が開始されてから、その次の書き込み期間Ｔａ２、Ｔａ３、…、Ｔａ（ｎ＋ｊ）、Ｔａ１が開始されるまでの期間である。
【０１４０】
また表示期間Ｔｄ１〜Ｔｄｎのうち黒表示期間以外の表示期間を短い順に並べた場合に、表示期間の長さの比は、２0：２1：２2：…：２(n-2)：２(n-1)となる。
【０１４１】
この黒表示期間以外の表示期間の組み合わせで、２n階調のうち所望の階調表示を行うことができる。１フレーム期間中に発光素子が発光した表示期間の長さの総和を求めることによって、当該フレーム期間におけるその画素の表示した階調がきまる。なお本実施の形態では、黒表示期間以外の全ての表示期間で発光素子が発光した場合、画素の輝度が１００％となる。
【０１４２】
本実施の形態では、表示を行わない黒表示期間を設けることで、発光素子が常に発光するのを防ぎ、有機化合物層の劣化を抑えることができる。
【０１４３】
また本実施の形態において、表示期間Ｔｄ１〜Ｔｄ（ｎ＋ｊ）のうち、１フレーム期間中で１番長い黒表示期間である表示期間を１フレーム期間の最後に設けると、１番長い黒表示期間と、その次に出現する表示期間との間にフレーム期間の区切れがあるように人間の目に認識させることができる。これによって、中間表示を行ったときに隣り合うフレーム期間同士で表示期間が隣接することによって起きていた表示むらを、人間の目に認識させずらくすることができる。
【０１４４】
実施の形態１及び２において上述したように、本発明は表示期間の組み合わせによって階調表示を行う。そのためアナログ方式の駆動方法に比べて、階調表示を行う際の画面の明るさが、ＴＦＴのＩD−ＶGS特性のばらつきに左右されにくい。
【０１４５】
また本発明においては、表示期間と書き込み期間とが一部重なっている。言い換えると書き込み期間においても画素を表示させることが可能である。そのため、１フレーム期間における表示期間の長さの総和の割合（デューティー比）が、書き込み期間の長さによってのみ決定されない。
【０１４６】
なお、上述した本発明の駆動方法は発光装置への適用だけに限らず、他の受動学素子を用いた装置に適用することも可能である。また応答時間が数１０μｓｅｃ程度以下の、高速応答する液晶が開発された場合には、液晶表示装置に適用することも可能である。
【０１４７】
【実施例】
以下に、本発明の実施例を説明する。
【０１４８】
（実施例１）
本実施例では、本発明の発光装置において、６ビットのデジタルビデオ信号により２6階調の表示を行う場合について、図６を用いて説明する。なお本実施例の発光装置は、図１〜図３に示した構造を有する。
【０１４９】
はじめに書き込み期間Ｔａ１において、１ビット目のデジタルビデオ信号が第１駆動回路群（Ｄｒ＿Ｌ）によって各画素（詳しくは、各画素の電流制御用ＴＦＴ２０２のゲート電極）に入力される。なお、本実施例におけるデジタルビデオ信号の画素への入力は、実施の形態と同様に行われるので、ここでは第１及び第２駆動回路群の詳しい動作の仕方について説明を省略する。
【０１５０】
１ビット目のデジタルビデオ信号が各画素に入力されると、デジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ１が開始されると同時に画素が表示を行い、表示期間Ｔｄ１となる。
【０１５１】
次に書き込み期間Ｔａ１が終了する前に書き込み期間Ｔａ２が開始される。書き込み期間Ｔａ２において、２ビット目のデジタルビデオ信号が、第２駆動回路群（Ｄｒ＿Ｒ）によって各画素に入力される。
【０１５２】
２ビット目のデジタルビデオ信号が各画素に入力されると、２ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ２が開始されると同時に画素が表示を行い、表示期間Ｔｄ１が終了して表示期間Ｔｄ２となる。
【０１５３】
上述した動作はｎビット目のデジタルビデオ信号が画素に入力されるまで行われ、表示期間Ｔｄ１〜Ｔｄ６が全て出現する（図６）。全ての表示期間Ｔｄ１〜Ｔｄ６が終了すると１フレーム期間が終了し、１つの画像を表示することができる。
【０１５４】
そして１フレーム期間終了後は、再び１ビット目のデジタルビデオ信号が画素に入力され表示期間Ｔｄ１となる。そして上述した動作を繰り返す。
【０１５５】
表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄ５、Ｔｄ６は、それぞれ書き込み期間Ｔａ１、Ｔａ２、…、Ｔａ５、Ｔａ６が開始されてから、その次の書き込み期間Ｔａ２、Ｔａ３、…Ｔａ６、Ｔａ１が開始されるまでの期間である。
【０１５６】
また本実施例では、表示期間Ｔｄ１〜Ｔｄ６のそれぞれの長さの比を、Ｔｄ１：Ｔｄ２：Ｔｄ３：Ｔｄ４：Ｔｄ５：Ｔｄ６＝２2：２3：２1：２4：２0：２5とする。なお表示期間の長さの比はこの順序に限られない。表示期間Ｔｄ１〜Ｔｄ６を短い順に並べた場合に、それぞれの長さの比が２0：２1：…：２4：２5となっていれば良い。
【０１５７】
本実施例では、表示期間Ｔｄ１〜Ｔｄ６の組み合わせで２6階調のうち所望の階調表示を行うことができる。
【０１５８】
１フレーム期間中に発光素子が発光した表示期間の長さの総和を求めることによって、当該フレーム期間におけるその画素の表示した階調がきまる。例えば、全部の表示期間で画素が発光した場合の輝度を１００％とすると、Ｔｄ１とＴｄ２において画素が発光した場合には１９％の輝度が表現でき、Ｔｄ３とＴｄ５とＴｄ６を選択した場合には５６％の輝度が表現できる。
【０１５９】
１フレーム期間における表示期間の長さの総和の割合（デューティー比）が１００であるので、高い輝度の表示を行うことができる。
【０１６０】
（実施例２）
本実施例では、１０個の表示期間を用いて８ビットのデジタルビデオ信号により２8階調の表示を行う場合について説明する。なお本実施例の発光装置は、図１〜図３に示した構造を有する。
【０１６１】
図７を参照する。はじめに書き込み期間Ｔａ１において、１ビット目のデジタルビデオ信号が第１駆動回路群（Ｄｒ＿Ｌ）によって各画素（詳しくは、各画素の電流制御用ＴＦＴ２０２のゲート電極）に入力される。なお、本実施例におけるデジタルビデオ信号の画素への入力は、実施の形態と同様に行われるので、ここでは第１及び第２駆動回路群の詳しい動作の仕方について説明を省略する。
【０１６２】
１ビット目のデジタルビデオ信号が各画素に入力されると、デジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ１が開始されると同時に画素が表示を行い、表示期間Ｔｄ１となる。
【０１６３】
次に書き込み期間Ｔａ１が終了する前に書き込み期間Ｔａ２が開始される。書き込み期間Ｔａ２において、２ビット目のデジタルビデオ信号が、第２駆動回路群（Ｄｒ＿Ｒ）によって各画素に入力される。
【０１６４】
２ビット目のデジタルビデオ信号が各画素に入力されると、２ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ２が開始されると同時に画素が表示を行い、表示期間Ｔｄ１が終了して表示期間Ｔｄ２となる。
【０１６５】
次に書き込み期間Ｔａ２が終了した後に書き込み期間Ｔａ３が開始される。書き込み期間Ｔａ３において、３ビット目のデジタルビデオ信号が、第１駆動回路群（Ｄｒ＿Ｌ）によって各画素に入力される。そして書き込み期間Ｔａ３が開始されると同時に画素が表示を行い、表示期間Ｔｄ２が終了して表示期間Ｔｄ３となる。
【０１６６】
次に書き込み期間Ｔａ３が終了する前に書き込み期間Ｔａ４が開始される。書き込み期間Ｔａ４において、４ビット目のデジタルビデオ信号が、第２駆動回路群（Ｄｒ＿Ｒ）によって各画素に入力される。そして書き込み期間Ｔａ４が開始されると同時に画素が表示を行い、表示期間Ｔｄ３が終了して表示期間Ｔｄ４となる。
【０１６７】
次に書き込み期間Ｔａ４が終了した後に、書き込み期間Ｔａ５が開始される。
書き込み期間Ｔａ５において、５ビット目のデジタルビデオ信号が、第１駆動回路群（Ｄｒ＿Ｌ）によって各画素に入力される。そして書き込み期間Ｔａ５が開始されると同時に画素が表示を行い、表示期間Ｔｄ４が終了して表示期間Ｔｄ５となる。
【０１６８】
上述した動作が繰り返し行われることで、表示期間Ｔｄ１〜Ｔｄ１０が全て出現する（図７）。全ての表示期間Ｔｄ１〜Ｔｄ１０が終了すると１フレーム期間が終了し、１つの画像を表示することができる。
【０１６９】
そして１フレーム期間終了後は、書き込み期間Ｔａ１が開始され再び１ビット目のデジタルビデオ信号が画素に入力され表示期間Ｔｄ１となる。そして上述した動作を繰り返す。
【０１７０】
表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄ９、Ｔｄ１０は、それぞれ書き込み期間Ｔａ１、Ｔａ２、…、Ｔａ９、Ｔａ１０が開始されてから、その次の書き込み期間Ｔａ２、Ｔａ３、…Ｔａ１０、Ｔａ１が開始されるまでの期間である。
【０１７１】
なお本実施例において、書き込み期間Ｔａ６、Ｔａ８、Ｔａ１０において画素には、同じビット数のデジタルビデオ信号が入力される。本実施例では６ビット目のデジタルビデオ信号が、書き込み期間Ｔａ６、Ｔａ８、Ｔａ１０において画素に入力されている。
【０１７２】
また本実施例では、表示期間Ｔｄ１〜Ｔｄ１０のそれぞれの長さの比を、Ｔｄ９：Ｔｄ７：Ｔｄ５：Ｔｄ３：Ｔｄ１：Ｔｄ２：Ｔｄ４：（Ｔｄ６＋Ｔｄ８＋Ｔｄ１０）＝２0：２1：２2：２3：２4：２5：２6：２7とする。なお表示期間の長さの比はこの順序に限られない。表示期間Ｔｄ１〜Ｔｄｎを短い順に並べた場合に、それぞれの長さの比が２0：２1：…：２4：２7となっていれば良い。
【０１７３】
よって本実施例では、Ｔｄ６、Ｔｄ８、Ｔｄ１０の３つの表示期間が１つの表示期間として機能することで、２8階調の表示を行う。そして表示期間Ｔｄ１〜Ｔｄ１０の組み合わせで２8階調のうち所望の階調表示を行うことができる。
【０１７４】
１フレーム期間中に発光素子が発光した表示期間の長さの総和を求めることによって、当該フレーム期間におけるその画素の表示した階調がきまる。例えば、全部の表示期間で画素が発光した場合の輝度を１００％とすると、Ｔｄ１とＴｄ２において画素が発光した場合には１９％の輝度が表現でき、Ｔｄ３とＴｄ５とＴｄ６とＴｄ８とＴｄ１０とを選択した場合には５５％の輝度が表現できる。
【０１７５】
また本実施例では、１フレーム期間における表示期間の長さの総和の割合（デューティー比）が１００であるので、高い輝度の表示を行うことができる。
【０１７６】
（実施例３）
本実施例では、１０個の表示期間を用いて６ビットのデジタルビデオ信号により２6階調の表示を行う場合について説明する。なお本実施例の発光装置は、図１〜図３に示した構造を有する。
【０１７７】
図８を参照する。はじめに書き込み期間Ｔａ１において、１ビット目のデジタルビデオ信号が第１駆動回路群（Ｄｒ＿Ｌ）によって各画素（詳しくは、各画素の電流制御用ＴＦＴ２０２のゲート電極）に入力される。なお、本実施例におけるデジタルビデオ信号の画素への入力は、実施の形態と同様に行われるので、ここでは第１及び第２駆動回路群の詳しい動作の仕方について説明を省略する。
【０１７８】
１ビット目のデジタルビデオ信号が各画素に入力されると、１ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ１が開始されると同時に画素が表示を行い、表示期間Ｔｄ１となる。
【０１７９】
次に書き込み期間Ｔａ１が終了する前に書き込み期間Ｔａ２が開始される。書き込み期間Ｔａ２において、常に「０」の情報を有するデジタルの信号（非表示信号）が、第２駆動回路群（Ｄｒ＿Ｒ）によって各画素（詳しくは、各画素の電流制御用ＴＦＴ２０２のゲート電極）に入力される。なお本実施例ではデジタル信号が「０」の情報を有していた場合、電流制御用ＴＦＴ２０２はオフの状態となり、「１」の情報を有していた場合電流制御用ＴＦＴ２０２はオンの状態となるが、本発明はこの構成に限定されない。デジタル信号が「０」の情報を有していた場合、電流制御用ＴＦＴ２０２がオンの状態となり、「１」の情報を有していた場合電流制御用ＴＦＴ２０２オフの状態となっても良い。この場合常に「１」の情報を有するデジタル信号が非表示信号となる。
【０１８０】
非表示信号が各画素に入力されると、非表示信号が有する「０」の情報によって、全ての画素の有する発光素子が非発光状態となる。したがって、書き込み期間Ｔａ２が開始されると同時に画素が表示を行わなくなり、表示期間Ｔｄ１が終了し、黒表示期間である表示期間Ｔｄ２となる。
【０１８１】
次に書き込み期間Ｔａ２が終了した後に書き込み期間Ｔａ３が開始される。書き込み期間Ｔａ３において、２ビット目のデジタルビデオ信号が第１駆動回路群（Ｄｒ＿Ｌ）によって各画素に入力される。そして２ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ３が開始されると同時に画素が表示を行い、表示期間Ｔｄ２が終了して表示期間Ｔｄ３となる。
【０１８２】
上述した動作は、書き込み期間Ｔａ９において５ビット目のデジタルビデオ信号が画素に入力されるまで行われる。書き込み期間Ｔａ９が終了した後、書き込み期間Ｔａ１０が開始される。
【０１８３】
書き込み期間Ｔａ１０において、６ビット目のデジタルビデオ信号が画素に入力される。そして６ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ１０が開始されると同時に画素が表示を行い、表示期間Ｔｄ９が終了して表示期間Ｔｄ１０となる。
【０１８４】
全ての表示期間Ｔｄ１〜Ｔｄ１０が終了すると１フレーム期間が終了し、１つの画像を表示することができる。
【０１８５】
そして１フレーム期間終了後は、再び１ビット目のデジタルビデオ信号が画素に入力され表示期間Ｔｄ１となる。そして上述した動作を繰り返す。
【０１８６】
表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄ９、Ｔｄ１０は、それぞれ書き込み期間Ｔａ１、Ｔａ２、…、Ｔａ９、Ｔａ１０が開始されてから、その次の書き込み期間Ｔａ２、Ｔａ３、…Ｔａ１０、Ｔａ１が開始されるまでの期間である。
【０１８７】
また本実施例では、表示期間Ｔｄ１〜Ｔｄ１０のうち、表示期間Ｔｄ２、Ｔｄ４、Ｔｄ６、Ｔｄ８は黒表示期間である。よって、６つの表示期間Ｔｄ１、Ｔｄ３、Ｔｄ５、Ｔｄ７、Ｔｄ９、Ｔｄ１０によって２6階調の階調表示が行われる。
【０１８８】
本実施例では、黒表示期間以外の６つの表示期間Ｔｄ１、Ｔｄ３、Ｔｄ５、Ｔｄ７、Ｔｄ９、Ｔｄ１０のそれぞれの長さの比を、Ｔｄ１：Ｔｄ３：Ｔｄ５：Ｔｄ７：Ｔｄ９：Ｔｄ１０＝２0：２1：２2：２3：２4：２5とする。なお表示期間の長さの比はこの順序に限られない。表示期間Ｔｄ１、Ｔｄ３、Ｔｄ５、Ｔｄ７、Ｔｄ９、Ｔｄ１０を短い順に並べた場合に、それぞれの長さの比が２0：２1：…：２4：２5となっていれば良い。
【０１８９】
１フレーム期間中に発光素子が発光した表示期間の長さの総和を求めることによって、当該フレーム期間におけるその画素の表示した階調がきまる。例えば、全部の表示期間で画素が発光した場合の輝度を１００％とすると、Ｔｄ１とＴｄ５において画素が発光した場合には８％の輝度が表現でき、Ｔｄ３とＴｄ５とＴｄ１０を選択した場合には６０％の輝度が表現できる。
【０１９０】
本実施例では、表示を行わない黒表示期間を設けることで、発光素子が常に発光するのを防ぎ、有機化合物層の劣化を抑えることができる。
【０１９１】
（実施例４）
本実施例では、７個の表示期間を用いて６ビットのデジタルビデオ信号により２6階調の表示を行う場合について説明する。なお本実施例の発光装置は、図１〜図３に示した構造を有する。
【０１９２】
図９を参照する。はじめに書き込み期間Ｔａ１において、１ビット目のデジタルビデオ信号が第１駆動回路群（Ｄｒ＿Ｌ）によって各画素（詳しくは、各画素の電流制御用ＴＦＴ２０２のゲート電極）に入力される。なお、本実施例におけるデジタルビデオ信号の画素への入力は、実施の形態と同様に行われるので、ここでは第１及び第２駆動回路群の詳しい動作の仕方について説明を省略する。
【０１９３】
１ビット目のデジタルビデオ信号が各画素に入力されると、１ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ１が開始されると同時に画素が表示を行い、表示期間Ｔｄ１となる。
【０１９４】
次に書き込み期間Ｔａ１が終了した後に書き込み期間Ｔａ２が開始される。書き込み期間Ｔａ２において、２ビット目のデジタルビデオ信号が第２駆動回路群（Ｄｒ＿Ｒ）によって各画素に入力される。
【０１９５】
２ビット目のデジタルビデオ信号が各画素に入力されると、２ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ２が開始されると同時に画素が表示を行い、表示期間Ｔｄ１が終了し、表示期間Ｔｄ２となる。
【０１９６】
次に書き込み期間Ｔａ２が終了した後に書き込み期間Ｔａ３が開始される。書き込み期間Ｔａ３において、３ビット目のデジタルビデオ信号が第１駆動回路群（Ｄｒ＿Ｌ）によって各画素に入力される。そして３ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ３が開始されると同時に画素が表示を行い、表示期間Ｔｄ２が終了して表示期間Ｔｄ３となる。
【０１９７】
次に書き込み期間Ｔａ３が終了する前に書き込み期間Ｔａ４が開始される。書き込み期間Ｔａ４において、常に「０」の情報を有するデジタルの信号（非表示信号）が、第２駆動回路群（Ｄｒ＿Ｒ）によって各画素に入力される。非表示信号が各画素に入力されると、非表示信号が有する「０」の情報によって、全ての画素の有する発光素子が非発光状態となる。したがって、書き込み期間Ｔａ４が開始されると同時に画素が表示を行わなくなり、表示期間Ｔｄ３が終了し、黒表示期間である表示期間Ｔｄ４となる。
【０１９８】
次に書き込み期間Ｔａ４が終了すると同時に書き込み期間Ｔａ５が開始される。書き込み期間Ｔａ５において、４ビット目のデジタルビデオ信号が第１駆動回路群（Ｄｒ＿Ｌ）によって各画素に入力される。そして４ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ５が開始されると同時に画素が表示を行い、表示期間Ｔｄ４が終了して表示期間Ｔｄ５となる。
【０１９９】
次に書き込み期間Ｔａ５が終了する前に書き込み期間Ｔａ６が開始される。書き込み期間Ｔａ６において、５ビット目のデジタルビデオ信号が第２駆動回路群（Ｄｒ＿Ｒ）によって各画素に入力される。そして５ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ６が開始されると同時に画素が表示を行い、表示期間Ｔｄ５が終了して表示期間Ｔｄ６となる。
【０２００】
次に書き込み期間Ｔａ６が終了した後に書き込み期間Ｔａ７が開始される。書き込み期間Ｔａ７において、６ビット目のデジタルビデオ信号が第１駆動回路群（Ｄｒ＿Ｌ）によって各画素に入力される。そして６ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ７が開始されると同時に画素が表示を行い、表示期間Ｔｄ６が終了して表示期間Ｔｄ７となる。
【０２０１】
次に書き込み期間Ｔａ７が終了する前に、書き込み期間Ｔａ８が開始される。書き込み期間Ｔａ８において、常に「０」の情報を有するデジタルの信号（非表示信号）が、第２駆動回路群（Ｄｒ＿Ｒ）によって各画素に入力される。非表示信号が各画素に入力されると、非表示信号が有する「０」の情報によって、全ての画素の有する発光素子が非発光状態となる。したがって、書き込み期間Ｔａ８が開始されると同時に画素が表示を行わなくなり、表示期間Ｔｄ７が終了し、黒表示期間である表示期間Ｔｄ８となる。
【０２０２】
全ての表示期間Ｔｄ１〜Ｔｄ８が終了すると１フレーム期間が終了し、１つの画像を表示することができる。
【０２０３】
そして１フレーム期間終了後は、再び１ビット目のデジタルビデオ信号が画素に入力され表示期間Ｔｄ１となる。そして上述した動作を繰り返す。
【０２０４】
なお表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄ７、Ｔｄ８は、それぞれ書き込み期間Ｔａ１、Ｔａ２、…、Ｔａ７、Ｔａ８が開始されてから、その次の書き込み期間Ｔａ２、Ｔａ３、…Ｔａ８、Ｔａ１が開始されるまでの期間である。
【０２０５】
また本実施例では、表示期間Ｔｄ１〜Ｔｄ８のうち、表示期間Ｔｄ４、Ｔｄ８は黒表示期間である。よって、６つの表示期間Ｔｄ１、Ｔｄ２、Ｔｄ３、Ｔｄ５、Ｔｄ６、Ｔｄ７によって２6階調の階調表示が行われる。
【０２０６】
本実施例では、黒表示期間以外の６つの表示期間Ｔｄ１、Ｔｄ２、Ｔｄ３、Ｔｄ５、Ｔｄ６、Ｔｄ７のそれぞれの長さの比を、Ｔｄ７：Ｔｄ５：Ｔｄ３：Ｔｄ１：Ｔｄ２：Ｔｄ６＝２0：２1：２2：２3：２4：２5とする。なお表示期間の長さの比はこの順序に限られない。表示期間Ｔｄ１、Ｔｄ２、Ｔｄ３、Ｔｄ５、Ｔｄ６、Ｔｄ７を短い順に並べた場合に、それぞれの長さの比が２0：２1：…：２4：２5となっていれば良い。
【０２０７】
１フレーム期間中に発光素子が発光した表示期間の長さの総和を求めることによって、当該フレーム期間におけるその画素の表示した階調がきまる。例えば、全部の表示期間で画素が発光した場合の輝度を１００％とすると、Ｔｄ１において画素が発光した場合には１３％の輝度が表現でき、Ｔｄ３とＴｄ６を選択した場合には５６％の輝度が表現できる。
【０２０８】
本実施例では、表示を行わない黒表示期間を設けることで、発光素子が常に発光するのを防ぎ、有機化合物層の劣化を抑えることができる。
【０２０９】
（実施例５）
本実施例では、８個の表示期間を用いて６ビットのデジタルビデオ信号により２6階調の表示を行う場合について説明する。なお本実施例の発光装置は、図１〜図３に示した構造を有する。
【０２１０】
図１０を参照する。はじめに書き込み期間Ｔａ１において、１ビット目のデジタルビデオ信号が第１駆動回路群（Ｄｒ＿Ｌ）によって各画素（詳しくは、各画素の電流制御用ＴＦＴ２０２のゲート電極）に入力される。なお、本実施例におけるデジタルビデオ信号の画素への入力は、実施の形態と同様に行われるので、ここでは第１及び第２駆動回路群の詳しい動作の仕方について説明を省略する。
【０２１１】
１ビット目のデジタルビデオ信号が各画素に入力されると、１ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ１が開始されると同時に画素が表示を行い、表示期間Ｔｄ１となる。
【０２１２】
次に書き込み期間Ｔａ１が終了した後に書き込み期間Ｔａ２が開始される。書き込み期間Ｔａ２において、２ビット目のデジタルビデオ信号が第２駆動回路群（Ｄｒ＿Ｒ）によって各画素に入力される。
【０２１３】
２ビット目のデジタルビデオ信号が各画素に入力されると、２ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ２が開始されると同時に画素が表示を行い、表示期間Ｔｄ１が終了し、表示期間Ｔｄ２となる。
【０２１４】
次に書き込み期間Ｔａ２が終了する前に書き込み期間Ｔａ３が開始される。書き込み期間Ｔａ３において、３ビット目のデジタルビデオ信号が第１駆動回路群（Ｄｒ＿Ｌ）によって各画素に入力される。そして３ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ３が開始されると同時に画素が表示を行い、表示期間Ｔｄ２が終了して表示期間Ｔｄ３となる。
【０２１５】
次に書き込み期間Ｔａ３が終了した後に書き込み期間Ｔａ４が開始される。書き込み期間Ｔａ４において、４ビット目のデジタルビデオ信号が第２駆動回路群（Ｄｒ＿Ｒ）によって各画素に入力される。そして４ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ４が開始されると同時に画素が表示を行い、表示期間Ｔｄ３が終了して表示期間Ｔｄ４となる。
【０２１６】
次に書き込み期間Ｔａ４が終了する前に書き込み期間Ｔａ５が開始される。書き込み期間Ｔａ５において、５ビット目のデジタルビデオ信号が第１駆動回路群（Ｄｒ＿Ｌ）によって各画素に入力される。そして５ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ５が開始されると同時に画素が表示を行い、表示期間Ｔｄ４が終了して表示期間Ｔｄ５となる。
【０２１７】
次に書き込み期間Ｔａ５が終了した後に書き込み期間Ｔａ６が開始される。書き込み期間Ｔａ６において、６ビット目のデジタルビデオ信号が第２駆動回路群（Ｄｒ＿Ｒ）によって各画素に入力される。そして６ビット目のデジタルビデオ信号が有する「０」又は「１」の情報によって、画素の有する発光素子が発光状態になるか又は非発光状態になるかが選択される。よって書き込み期間Ｔａ６が開始されると同時に画素が表示を行い、表示期間Ｔｄ５が終了して表示期間Ｔｄ６となる。
【０２１８】
次に書き込み期間Ｔａ６が終了する前に書き込み期間Ｔａ７が開始される。書き込み期間Ｔａ７において、常に「０」の情報を有するデジタルの信号（非表示信号）が、第１駆動回路群（Ｄｒ＿Ｌ）によって各画素に入力される。非表示信号が各画素に入力されると、非表示信号が有する「０」の情報によって、全ての画素の有する発光素子が非発光状態となる。したがって、書き込み期間Ｔａ７が開始されると同時に画素が表示を行わなくなり、表示期間Ｔｄ６が終了し、黒表示期間である表示期間Ｔｄ７となる。
【０２１９】
全ての表示期間Ｔｄ１〜Ｔｄ８が終了すると１フレーム期間が終了し、１つの画像を表示することができる。
【０２２０】
そして１フレーム期間終了後は、再び１ビット目のデジタルビデオ信号が画素に入力され表示期間Ｔｄ１となる。そして上述した動作を繰り返す。
【０２２１】
表示期間Ｔｄ１、Ｔｄ２、…、Ｔｄ６、Ｔｄ７は、それぞれ書き込み期間Ｔａ１、Ｔａ２、…、Ｔａ６、Ｔａ７が開始されてから、その次の書き込み期間Ｔａ２、Ｔａ３、…Ｔａ７、Ｔａ１が開始されるまでの期間である。
【０２２２】
また本実施例では、表示期間Ｔｄ１〜Ｔｄ７のうち、表示期間Ｔｄ７は黒表示期間である。よって、６つの表示期間Ｔｄ１〜Ｔｄ６によって２6階調の階調表示が行われる。
【０２２３】
本実施例では、黒表示期間以外の６つの表示期間Ｔｄ１〜Ｔｄ６のそれぞれの長さの比を、Ｔｄ６：Ｔｄ４：Ｔｄ２：Ｔｄ１：Ｔｄ３：Ｔｄ５＝２0：２1：２2：２3：２4：２5とする。なお表示期間の長さの比はこの順序に限られない。黒表示期間以外の表示期間Ｔｄ１〜Ｔｄ６を短い順に並べた場合に、それぞれの長さの比が２0：２1：…：２4：２5となっていれば良い。
【０２２４】
１フレーム期間中に発光素子が発光した表示期間の長さの総和を求めることによって、当該フレーム期間におけるその画素の表示した階調がきまる。例えば、全部の表示期間で画素が発光した場合の輝度を１００％とすると、Ｔｄ１において画素が発光した場合には１３％の輝度が表現でき、Ｔｄ３とＴｄ５とＴｄ６を選択した場合には７８％の輝度が表現できる。
【０２２５】
本実施例では、表示を行わない黒表示期間を設けることで、発光素子が常に発光するのを防ぎ、有機化合物層の劣化を抑えることができる。
【０２２６】
（実施例６）
本実施例では、図１に示した本発明の発光装置において、第１及び第２ソース信号線駆動回路１０２ａ、１０２ｂと、第１及び第２ゲート信号線駆動回路１０３ａ、１０３ｂの駆動方法について、詳しく説明する。なお本実施例では説明をわかりやすくするために第１駆動回路群（Ｄｒ＿Ｌ）の駆動方法についてのみ説明するが、第２駆動回路群（Ｄｒ＿Ｒ）も第１駆動回路群（Ｄｒ＿Ｌ）と同様に駆動させることができる。
【０２２７】
第１ソース信号線駆動回路１０２ａにおいて、シフトレジスタ１０５にクロック信号（ＣＬＫ）およびスタートパルス（ＳＰ）が入力される。シフトレジスタ１０５は、これらのクロック信号（ＣＬＫ）およびスタートパルス（ＳＰ）に基づきタイミング信号を順に発生させ、後段の回路へタイミング信号を順次供給する。
【０２２８】
なおシフトレジスタ１０５からのタイミング信号を、バッファ等（図示せず）によって緩衝増幅し、後段の回路へ緩衝増幅したタイミング信号を順次供給しても良い。タイミング信号が供給される配線には、多くの回路あるいは素子が接続されているために負荷容量（寄生容量）が大きい。この負荷容量が大きいために生ずるタイミング信号の立ち上がりまたは立ち下がりの”鈍り”を防ぐために、このバッファが設けられる。
【０２２９】
シフトレジスタ１０５からのタイミング信号は、ラッチ（Ａ）１０６に入力される。ラッチ（Ａ）１０６は、デジタル信号（digital signals）を処理する複数のステージのラッチを有している。前記タイミング信号が入力されると同時に、デジタル信号はラッチ（Ａ）１０６に順次入力され、保持される。
【０２３０】
なお本実施例では、ラッチ（Ａ）１０６が有する複数のステージのラッチに、順にデジタル信号を入力している。しかし本発明はこの構成に限定されない。ラッチ（Ａ）１０６が有する複数のステージのラッチをいくつかのグループに分け、各グループごとに並行して同時にデジタル信号を入力する、いわゆる分割駆動を行っても良い。なおこのときのグループの数を分割数と呼ぶ。例えば４つのステージごとにラッチをグループに分けた場合、４分割で分割駆動すると言う。
【０２３１】
ラッチ（Ａ）１０６の全てのステージのラッチへのデジタル信号の入力が一通り終了するまでの時間を、ライン期間と呼ぶ。すなわち、ラッチ（Ａ）１０６中で一番左側のステージのラッチにデジタル信号の入力が開始される時点から、一番右側のステージのラッチにデジタル信号の入力が終了する時点までの時間間隔がライン期間である。実際には、上記ライン期間に水平帰線期間が加えられた期間をライン期間に含むことがある。
【０２３２】
１ライン期間が終了すると、ラッチ（Ｂ）１０７にラッチシグナル（Latch Signal）が供給される。この瞬間、ラッチ（Ａ）１０６に入力され保持されているデジタル信号は、ラッチ（Ｂ）１０７に一斉に送出され、ラッチ（Ｂ）１０７の全ステージのラッチに入力され、保持される。
【０２３３】
デジタル信号をラッチ（Ｂ）１０７に送出し終えたラッチ（Ａ）１０６には、シフトレジスタ１０５からのタイミング信号に基づき、再びデジタル信号が順次入力される。
【０２３４】
この２順目の１ライン期間中には、ラッチ（Ｂ）１０２ｂに入力され、保持されているデジタル信号が第１ソース信号線に入力される。
【０２３５】
一方、第１ゲート信号線駆動回路１０３ａにおいて、シフトレジスタ（図示せず）からのタイミング信号がバッファ（図示せず）に入力され、対応するゲート信号線（ＧＬ１〜ＧＬｙ）に入力される。ゲート信号線（ＧＬ１〜ＧＬｙ）には、それぞれ１ライン分の画素の第１スイッチング用ＴＦＴ２０１ａのゲート電極が接続されており、１ライン分全ての画素の第１スイッチング用ＴＦＴ２０１ａを一斉に駆動しなくてはならないので、バッファは大きな電流を流すことが可能なものが用いられる。
【０２３６】
本発明では、画素部１０１、第１ソース信号線駆動回路１０２ａ、第２ソース信号線駆動回路１０２ｂ、第１ゲート信号線駆動回路１０３ａ、第２ゲート信号線駆動回路１０３ｂとを同一の基板上にＴＦＴを用いて形成ししても良い。またこの場合、本発明の発光装置をディスプレイとして有する電子機器の小型化を図ることが可能である。
【０２３７】
なお本実施例は、実施例１〜実施例５と自由に組み合わせて実施することが可能である。
【０２３８】
（実施例７）
本発明を用いた発光装置の作製方法について、図１１〜図１３を用いて説明する。ここでは、画素部とその周辺に設けられる駆動回路部のＴＦＴを同時に作製する方法について説明する。但し、説明を簡単にするために、駆動回路に関しては基本回路であるＣＭＯＳ回路を図示することとする。また、各画素に設けられている第１スイッチング用ＴＦＴと第２スイッチング用ＴＦＴは同じ作製方法を用いて作製することが可能であるので、ここでは画素部のＴＦＴとして、第１スイッチング用ＴＦＴ及び電流制御用ＴＦＴを１つずつ図示することにする。
【０２３９】
まず、図１１（Ａ）に示すように、コーニング社の＃７０５９ガラスや＃１７３７ガラスなどに代表されるバリウムホウケイ酸ガラス、アルミノホウケイ酸ガラスなどのガラス、または石英基板から成る基板４００上に酸化シリコン膜、窒化シリコン膜または酸化窒化シリコン膜などの絶縁膜から成る下地膜４０１を形成する。例えば、プラズマＣＶＤ法でＳｉＨ4、ＮＨ3、Ｎ2Ｏから作製される酸化窒化シリコン膜を１０〜２００nm（好ましくは５０〜１００nm）形成し、同様にＳｉＨ4、Ｎ2Ｏから作製される酸化窒化水素化シリコン膜を５０〜２００ｎｍ（好ましくは１００〜１５０nm）の厚さに積層形成する。なお図１１（Ａ）では２層構造の下地膜を１つの層で示した。本実施例では下地膜４０１を２層構造として示したが、前記絶縁膜の単層膜または２層以上積層させた構造として形成しても良い。
【０２４０】
半導体層４０２〜４０５は、非晶質構造を有する半導体膜をレーザー結晶化法や公知の熱結晶化法を用いて作製した結晶質半導体膜で形成する。この半導体層４０２〜４０５の厚さは２５〜８０ｎｍ（好ましくは３０〜６０ｎｍ）の厚さで形成する。結晶質半導体膜の材料に限定はないが、好ましくはシリコンまたはシリコンゲルマニウム（ＳｉＧｅ）合金などで形成すると良い。
【０２４１】
公知の結晶化方法としては、電熱炉を使用した熱結晶化方法、レーザー光を用いたレーザーアニール結晶化法、赤外光を用いたランプアニール結晶化法、触媒金属を用いた結晶化法がある。
【０２４２】
レーザー結晶化法で結晶質半導体膜を作製するには、パルス発振型または連続発光型のエキシマレーザーやＹＡＧレーザー、ＹＶＯ4レーザーを用いる。これらのレーザーを用いる場合には、レーザー発振器から放射されたレーザー光を光学系で線状に集光し半導体膜に照射する方法を用いると良い。結晶化の条件は実施者が適宣選択するものであるが、エキシマレーザーを用いる場合はパルス発振周波数３００Ｈｚとし、レーザーエネルギー密度を１００〜４００mJ/cm2(代表的には２００〜３００mJ/cm2)とする。また、ＹＡＧレーザーを用いる場合にはその第２高調波を用いパルス発振周波数３０〜３００ｋＨｚとし、レーザーエネルギー密度を３００〜６００mJ/cm2(代表的には３５０〜５００mJ/cm2)とすると良い。そして幅１００〜１０００μｍ、例えば４００μｍで線状に集光したレーザー光を基板全面に渡って照射し、この時の線状レーザー光の重ね合わせ率（オーバーラップ率）を５０〜９０％として行う。
【０２４３】
次いで、半導体層４０２〜４０５を覆うゲート絶縁膜４０６を形成する。ゲート絶縁膜４０６はプラズマＣＶＤ法またはスパッタ法を用い、厚さを４０〜１５０ｎｍとしてシリコンを含む絶縁膜で形成する。本実施例では、１２０ｎｍの厚さで酸化窒化シリコン膜で形成する。勿論、ゲート絶縁膜４０６はこのような酸化窒化シリコン膜に限定されるものでなく、他のシリコンを含む絶縁膜を単層または積層構造として用いても良い。例えば、酸化シリコン膜を用いる場合には、プラズマＣＶＤ法でＴＥＯＳ（Tetraethyl Orthosilicate）とＯ2とを混合し、反応圧力４０Pa、基板温度３００〜４００℃とし、高周波（１３．５６MHz）電力密度０．５〜０．８W/cm2で放電させて形成することができる。このようにして作製される酸化シリコン膜は、その後４００〜５００℃の熱アニールによりゲート絶縁膜として良好な特性を得ることができる。
【０２４４】
そして、ゲート絶縁膜４０６上にゲート電極を形成するための第１の導電膜４０７と第２の導電膜４０８とを形成する。本実施例では、第１の導電膜４０７をＴａで５０〜１００ｎｍの厚さに形成し、第２の導電膜４０８をＷで１００〜３００ｎｍの厚さに形成する。
【０２４５】
Ｔａ膜はスパッタ法で形成し、ＴａのターゲットをＡｒでスパッタする。この場合、Ａｒに適量のＸｅやＫｒを加えると、Ｔａ膜の内部応力を緩和して膜の剥離を防止することができる。また、α相のＴａ膜の抵抗率は２０μΩcm程度でありゲート電極に使用することができるが、β相のＴａ膜の抵抗率は１８０μΩcm程度でありゲート電極とするには不向きである。α相のＴａ膜を形成するために、Ｔａのα相に近い結晶構造をもつ窒化タンタルを１０〜５０ｎｍ程度の厚さでＴａの下地に形成しておくとα相のＴａ膜を容易に得ることができる。
【０２４６】
Ｗ膜を形成する場合には、Ｗをターゲットとしたスパッタ法で形成する。その他に６フッ化タングステン（ＷＦ6）を用いる熱ＣＶＤ法で形成することもできる。いずれにしてもゲート電極として使用するためには低抵抗化を図る必要があり、Ｗ膜の抵抗率は２０μΩｃｍ以下にすることが望ましい。Ｗ膜は結晶粒を大きくすることで低抵抗率化を図ることができるが、Ｗ中に酸素などの不純物元素が多い場合には結晶化が阻害され高抵抗化する。このことより、スパッタ法による場合、純度９９．９９９９％または９９．９９％のＷターゲットを用い、さらに成膜時に気相中からの不純物の混入がないように十分配慮してＷ膜を形成することにより、抵抗率９〜２０μΩｃｍを実現することができる。
【０２４７】
なお、本実施例では、第１の導電膜４０７をＴａ、第２の導電膜４０８をＷとしたが、特に限定されず、いずれもＴａ、Ｗ、Ｔｉ、Ｍｏ、Ａｌ、Ｃｕから選ばれた元素、または前記元素を主成分とする合金材料若しくは化合物材料で形成してもよい。また、リン等の不純物元素をドーピングした多結晶シリコン膜に代表される半導体膜を用いてもよい。本実施例以外の他の組み合わせの一例は、第１の導電膜を窒化タンタル（ＴａＮ）で形成し、第２の導電膜をＷとする組み合わせ、第１の導電膜を窒化タンタル（ＴａＮ）で形成し、第２の導電膜をＡｌとする組み合わせ、第１の導電膜を窒化タンタル（ＴａＮ）で形成し、第２の導電膜をＣｕとする組み合わせで形成することが好ましい。（図１１（Ｂ））
【０２４８】
次に、レジストによるマスク４０９〜４１２を形成し、電極及び配線を形成するための第１のエッチング処理を行う。本実施例ではＩＣＰ（Inductively Coupled Plasma：誘導結合型プラズマ）エッチング法を用い、エッチング用ガスにＣＦ4とＣｌ2を混合し、１Paの圧力でコイル型の電極に５００WのＲＦ（13.56MHz）電力を投入してプラズマを生成して行う。基板側（試料ステージ）にも１００WのＲＦ（13.56MHz）電力を投入し、実質的に負の自己バイアス電圧を印加する。ＣＦ4とＣｌ2を混合した場合にはＷ膜及びＴａ膜とも同程度にエッチングされる。
【０２４９】
なお図１１（Ｃ）では図示しなかったが、上記エッチング条件では、レジストによるマスクの形状を適したものとすることにより、基板側に印加するバイアス電圧の効果により第１の導電層及び第２の導電層の端部がテーパー形状となる。テーパー部の角度は１５〜４５°となる。ゲート絶縁膜上に残渣を残すことなくエッチングするためには、１０〜２０％程度の割合でエッチング時間を増加させると良い。Ｗ膜に対する酸化窒化シリコン膜の選択比は２〜４（代表的には３）であるので、オーバーエッチング処理により、酸化窒化シリコン膜が露出した面は２０〜５０nm程度エッチングされることになる。また図１１（Ｃ）では図示しなかったが、ゲート絶縁膜４０６は、上記エッチングによって第１の形状の導電層４１４〜４１７で覆われない領域が２０〜５０nm程度エッチングされ薄くなった。
【０２５０】
こうして、第１のエッチング処理により第１の導電層と第２の導電層から成る第１の形状の導電層４１４〜４１７（第１の導電層４１４ａ〜４１７ａと第２の導電層４１４ｂ〜４１７ｂ）を形成する。
【０２５１】
次に、図１１（Ｄ）に示すように第２のエッチング処理を行う。同様にＩＣＰエッチング法を用い、エッチングガスにＣＦ4とＣｌ2とＯ2を混合して、１Paの圧力でコイル型の電極に５００ＷのＲＦ電力(13.56MHz)を供給し、プラズマを生成して行う。基板側（試料ステージ）には５０WのＲＦ（13.56MHz）電力を投入し、第１のエッチング処理に比べ低い自己バイアス電圧を印加する。このような条件によりＷ膜を異方性エッチングし、かつ、それより遅いエッチング速度で第１の導電層であるＴａを異方性エッチングして第２の形状の導電層４１９〜４２２（第１の導電層４１９ａ〜４２２ａと第２の導電層４１９ｂ〜４２２ｂ）を形成する。また図１１（Ｄ）では図示しなかったが、ゲート絶縁膜４０６は、上記エッチングによって第２の形状の導電層４１９〜４２２で覆われない領域がさらに２０〜５０nm程度エッチングされ薄くなった。
【０２５２】
Ｗ膜やＴａ膜のＣＦ4とＣｌ2の混合ガスによるエッチング反応は、生成されるラジカルまたはイオン種と反応生成物の蒸気圧から推測することができる。ＷとＴａのフッ化物と塩化物の蒸気圧を比較すると、Ｗのフッ化物であるＷＦ6が極端に高く、その他のＷＣｌ5、ＴａＦ5、ＴａＣｌ5は同程度である。従って、ＣＦ4とＣｌ2の混合ガスではＷ膜及びＴａ膜共にエッチングされる。しかし、この混合ガスに適量のＯ2を添加するとＣＦ4とＯ2が反応してＣＯとＦになり、ＦラジカルまたはＦイオンが多量に発生する。その結果、フッ化物の蒸気圧が高いＷ膜のエッチング速度が増大する。一方、ＴａはＦが増大しても相対的にエッチング速度の増加は少ない。また、ＴａはＷに比較して酸化されやすいので、Ｏ2を添加することでＴａの表面が酸化される。Ｔａの酸化物はフッ素や塩素と反応しないためさらにＴａ膜のエッチング速度は低下する。従って、Ｗ膜とＴａ膜とのエッチング速度に差を作ることが可能となりＷ膜のエッチング速度をＴａ膜よりも大きくすることが可能となる。
【０２５３】
そして、マスク４０９ａ〜マスク４１２ａを除去し、図１２（Ａ）に示すように第１のドーピング処理を行い、ｎ型を付与する不純物元素を添加する。例えば、加速電圧を７０〜１２０ｋｅＶとし、１×１０13/cm2のドーズ量で行う。ドーピングは、第２の形状の導電層４１９〜４２２を不純物元素に対するマスクとして用い、第２の導電層４１９ａ〜４２２ａの下側の領域にも不純物元素が添加されるようにドーピングする。こうして、第２の導電層４１９ａ〜４２２ａと重なる第１の不純物領域４２５〜４２８と、第１の不純物領域よりも不純物の濃度が高い第２の不純物領域４２９〜４３２とが形成される。なお本実施例ではマスク４０９ａ〜４１２ａを除去してからｎ型を付与する不純物元素を添加したが、本発明はこれに限定されない。図１２（Ａ）の工程においてｎ型を付与する不純物元素を添加してからマスク４０９ａ〜マスク４１２ａを除去しても良い。
【０２５４】
次に第２の導電層４２１ａ、４２１ｂを覆うように半導体層４０４上にレジストからなるマスク４３３を形成する。マスク４３３はゲート絶縁膜４０６を間に挟んで第２の不純物領域４３１と一部重なっている。そして第２のドーピング処理を行いｎ型を付与する不純物元素を添加する。この場合、第１のドーピング処理よりもドーズ量を上げて低い加速電圧の条件としてｎ型を付与する不純物元素をドーピングする（図１２（Ｂ））。ドーピングの方法はイオンドープ法若しくはイオン注入法で行えば良い。イオンドープ法の条件はドーズ量を１×１０13〜５×１０14atoms/cm2とし、加速電圧を６０〜１００ｋｅＶとして行う。ｎ型を付与する不純物元素として１５族に属する元素、典型的にはリン（Ｐ）または砒素（Ａｓ）を用いるが、ここではリン（Ｐ）を用いる。この場合、第２の形状の導電層４１９〜４２２がｎ型を付与する不純物元素に対するマスクとなり、自己整合的にソース領域４３４〜４３７、ドレイン領域４３８〜４４１、Ｌｏｖ領域４４２〜４４５が形成される。またマスク４３３によってＬｏｆｆ領域４４６が形成される。ソース領域４３４〜４３７、ドレイン領域４３８〜４４１には１×１０20〜１×１０21atomic/cm3の濃度範囲でｎ型を付与する不純物元素を添加する。
【０２５５】
本実施例はマスク４３３のサイズを制御することで、Ｌｏｆｆ領域４４６の長さを自由に設定することが可能である。
【０２５６】
なお本明細書において、ゲート絶縁膜を介してゲート電極と重なるＬＤＤ領域をＬｏｖ領域と呼ぶ。またゲート絶縁膜を介してゲート電極と重ならないＬＤＤ領域をＬｏｆｆ領域と呼ぶ。
【０２５７】
ｎ型を付与する不純物元素は、Ｌｏｆｆ領域で１×１０17〜１×１０19atoms/cm3の濃度となるようにし、Ｌｏｖ領域で１×１０16〜１×１０18atoms/cm3の濃度となるようにする。
【０２５８】
なお図１２（Ｂ）において、上述したような条件でｎ型を付与する不純物元素をドーピングする前または後に、半導体層４０４上にマスク４３３を形成した状態で加速電圧を７０〜１２０ｋｅＶとしｎ型を付与する不純物元素をドーピングしても良い。上記工程によって、スイッチング用ＴＦＴのＬｏｆｆ領域となる部分４４６のｎ型を付与する不純物元素の濃度を抑えつつ、駆動回路に用いられるｎチャネル型ＴＦＴのＬｏｖ領域となる部分４４３のｎ型を付与する不純物元素の濃度を高めることができる。スイッチング用ＴＦＴのＬｏｆｆ領域となる部分４４６のｎ型を付与する不純物元素の濃度を抑えることで、スイッチング用ＴＦＴのオフ電流を低減することが可能である。また駆動回路に用いられるｎチャネル型ＴＦＴのＬｏｖ領域となる部分４４３のｎ型を付与する不純物元素の濃度を高めることで、ホットキャリア効果による、ドレイン近傍の高電界によって発生したホットキャリアが劣化現象を引き起こすのを防ぐことができる。この工程において、駆動回路に用いられるｎチャネル型ＴＦＴのＬｏｖ領域となる部分４４３の、ｎ型を付与する不純物元素の濃度は、５×１０17〜５×１０19atoms/cm3であることが望ましい。
【０２５９】
そして、マスク４５３を除去した後、図１２（Ｃ）に示すように、ｐチャネル型ＴＦＴを形成する半導体層４０２、４０５に一導電型とは逆の導電型のソース領域４４７、４４８と、ドレイン領域４４９、４５０と、Ｌｏｖ領域４５１、４５２を形成する。第２の形状を有する導電層４１９、４２２を不純物元素に対するマスクとして用い、自己整合的に不純物領域を形成する。このとき、ｎチャネル型ＴＦＴを形成する半導体層４０２、４０３はレジストマスク４５３で全面を被覆しておく。ソース領域４４７、４４８及びドレイン領域４４９、４５０と、Ｌｏｖ領域４５１、４５２とにはそれぞれ異なる濃度でリンが添加されているが、ジボラン（Ｂ2Ｈ6）を用いたイオンドープ法で形成し、そのいずれの領域においても不純物濃度を２×１０20〜２×１０21atoms/cm3となるようにする。
【０２６０】
以上までの工程でそれぞれの半導体層４０２〜４０５に不純物領域（ソース領域、ドレイン領域、Ｌｏｖ領域、Ｌｏｆｆ領域）が形成される。半導体層と重なる第２の導電層４１９〜４２２がゲート電極として機能する。
【０２６１】
こうして導電型の制御を目的として、それぞれの半導体層に添加された不純物元素を活性化する工程を行う。この工程はファーネスアニール炉を用いる熱アニール法で行う。その他に、レーザーアニール法、またはラピッドサーマルアニール法（ＲＴＡ法）を適用することができる。熱アニール法では酸素濃度が１ｐｐｍ以下、好ましくは０．１ｐｐｍ以下の窒素雰囲気中で４００〜７００℃、代表的には５００〜６００℃で行うものであり、本実施例では５００℃で４時間の熱処理を行う。ただし、４１９〜４２２に用いた配線材料が熱に弱い場合には、配線等を保護するため層間絶縁膜（シリコンを主成分とする）を形成した後で活性化を行うことが好ましい。
【０２６２】
さらに、３〜１００％の水素を含む雰囲気中で、３００〜４５０℃で１〜１２時間の熱処理を行い、半導体層を水素化する工程を行う。この工程は熱的に励起された水素により半導体層のダングリングボンドを終端する工程である。水素化の他の手段として、プラズマ水素化（プラズマにより励起された水素を用いる）を行っても良い。
【０２６３】
次いで、第１の層間絶縁膜４５５は酸化窒化シリコン膜から１００〜２００ｎｍの厚さで形成する。（図１３（Ａ））その上に有機絶縁物材料から成る第２の層間絶縁膜４５８を形成する。
【０２６４】
そして、ゲート絶縁膜４０６、第１の層間絶縁膜４５５、第２の層間絶縁膜４５８にコンタクトホールを形成し、該コンタクトホールを介して、ソース領域４４７、４３５、４３６、４４８と接するようにソース配線４５９〜４６２を形成した。また同様に、ドレイン領域４４９、４３９、４４０、４５０と接するドレイン配線４６３〜４６５を形成する（図１３（Ｂ））。
【０２６５】
なお、ゲート絶縁膜４０６、第１の層間絶縁膜４５５、第２の層間絶縁膜４５８がＳｉＯ2膜またはＳｉＯＮ膜の場合、ＣＦ4とＯ2とを用いたドライエッチングでコンタクトホールを形成するのが好ましい。またゲート絶縁膜４０６、第１の層間絶縁膜４５５、第２の層間絶縁膜４５８が有機樹脂膜の場合、ＣＨＦ3を用いたドライエッチング、またはＢＨＦ（緩衝フッ酸：ＨＦ＋ＮＨ4Ｆ）でコンタクトホールを形成するのが好ましい。またゲート絶縁膜４０６、第１の層間絶縁膜４５５、第２の層間絶縁膜４５８が異なる材料で形成されている場合、膜ごとにエッチングの方法及び用いるエッチャントやエッチングガスの種類を変えることが好ましいが、エッチングの方法及び用いるエッチャントやエッチングガスを全て同じにしてコンタクトホールを形成しても良い。
【０２６６】
次に、有機樹脂からなる第３層間絶縁膜４６７を形成する。有機樹脂としてはポリイミド、ポリアミド、アクリル、ＢＣＢ（ベンゾシクロブテン）等を使用することができる。特に、第３層間絶縁膜４６７は平坦化の意味合いが強いので、平坦性に優れたアクリルが好ましい。本実施例ではＴＦＴによって形成される段差を十分に平坦化しうる膜厚でアクリル膜を形成する。好ましくは１〜５μm（さらに好ましくは２〜４μm）とすれば良い。
【０２６７】
次に第３層間絶縁膜４６７に、ドレイン配線４６５に達するコンタクトホールを形成し、画素電極４６８を形成する。本実施例では酸化インジウム・スズ（ＩＴＯ）膜を１１０ｎｍの厚さに形成し、パターニングを行って画素電極４６８を形成する。また、酸化インジウムに２〜２０％の酸化亜鉛（ＺｎＯ）を混合した透明導電膜を用いても良い。この画素電極４６８が発光素子の陽極となる。（図１３（Ｃ））
【０２６８】
次に、樹脂材料でなる第１バンク４６９及び第２バンク４７０を形成する。第１バンク４６９及び第２バンク４７０は後に形成される有機化合物層及び陰極を隣り合う画素間で分離するために設けられる。よって第１バンク４６９よりも第２バンク４７０の方が横に張り出している構成にすることが望ましい。なお第１バンク４６９と第２バンク４７０とを合わせた厚さは１〜２μm程度であることが好ましいが、後に形成される有機化合物層及び陰極を隣り合う画素間で分離することができるならこの厚さに限らない。また第１バンク４６９及び第２バンク４７０は絶縁膜で形成されることが必要であり、例えば酸化物、樹脂等で形成することが可能である。そして第１バンク４６９と第２バンク４７０は互いに同じ材料で形成されていても、異なる材料で形成されていてもどちらでも良い。第１バンク４６９及び第２バンク４７０は画素と画素との間にストライプ状に形成される。第１バンク４６９及び第２バンク４７０はソース配線（ソース信号線）上に沿って形成しても良いし、ゲート配線（ゲート信号線）上に沿って形成しても良い。なお第１バンク４６９及び第２バンク４７０を樹脂に顔料等を混ぜたもので形成しても良い。（図１４（Ａ））
【０２６９】
次に、有機化合物層４７１及び陰極（ＭｇＡｇ電極）４７２を、真空蒸着法を用いて大気解放しないで連続形成する。なお、有機化合物層４７１の膜厚は８００〜２００ｎｍ（典型的には１００〜１２０ｎｍ）、陰極４７２の厚さは１８０〜３００ｎｍ（典型的には２００〜２５０ｎｍ）とすれば良い。なお、本実施例では一画素しか図示されていないが、このとき同時に赤色に発光する有機化合物層、緑色に発光する有機化合物層及び青色に発光する有機化合物層が形成される。なおバンク４７０上に有機化合物層と陰極を形成する材料が一部積層されるが、本明細書ではこれらを有機化合物層４７１と陰極４７２に含めない。
【０２７０】
この工程では、赤色に対応する画素、緑色に対応する画素及び青色に対応する画素に対して順次有機化合物層４７１及び陰極４７２を形成する。但し、有機化合物層４７１は溶液に対する耐性に乏しいためフォトリソグラフィ技術を用いずに各色個別に形成しなくてはならない。そこでメタルマスクを用いて所望の画素以外を隠し、必要箇所だけ選択的に有機化合物層４７１を形成するのが好ましい。
【０２７１】
即ち、まず赤色に対応する画素以外を全て隠すマスクをセットし、そのマスクを用いて赤色発光の有機化合物層を選択的に形成する。次いで、緑色に対応する画素以外を全て隠すマスクをセットし、そのマスクを用いて緑色発光の有機化合物層を選択的に形成する。次いで、同様に青色に対応する画素以外を全て隠すマスクをセットし、そのマスクを用いて青色発光の有機化合物層を選択的に形成する。なお、ここでは全て異なるマスクを用いるように記載しているが、同じマスクを使いまわしても構わない。また、全画素に有機化合物層及び陰極を形成するまで真空を破らずに処理することが好ましい。
【０２７２】
なお、本実施例では有機化合物層４７１を発光層のみからなる単層構造とするが、有機化合物層は発光層の他に正孔輸送層、正孔注入層、電子輸送層、電子注入層等を有していても構わない。このように組み合わせは既に様々な例が報告されており、そのいずれの構成を用いても構わない。有機化合物層４７１としては公知の材料を用いることができる。公知の材料としては、発光素子駆動電圧を考慮すると有機材料を用いるのが好ましい。
【０２７３】
次に陰極４７２を形成する。本実施例では陰極４７２としてＭｇＡｇ電極を用いた例を示すが、公知の他の材料を用いることが可能である。
【０２７４】
こうして図１４（Ｂ）に示すような構造のアクティブマトリクス基板が完成する。なお、第１バンク４６９と第２バンク４７０を形成した後、陰極４７２を形成するまでの工程をマルチチャンバー方式（またはインライン方式）の薄膜形成装置を用いて、大気解放せずに連続的に処理することは有効である。
【０２７５】
本実施例において、スイッチング用ＴＦＴ５０１の半導体層は、ソース領域５０４、ドレイン領域５０５、Ｌｏｆｆ領域５０６、Ｌｏｖ領域５０７、チャネル形成領域５０８を含んでいる。Ｌｏｆｆ領域５０６はゲート絶縁膜４０６を介してゲート電極４２１と重ならないように設けられている。またＬｏｖ領域５０７はゲート絶縁膜４０６を介してゲート電極４２１と重なるように設けられている。このような構造はオフ電流を低減する上で非常に効果的である。
【０２７６】
また、本実施例ではスイッチング用ＴＦＴ５０１はシングルゲート構造としているが、本発明ではスイッチング用ＴＦＴはダブルゲート構造やその他のマルチゲート構造を有していても良い。ダブルゲート構造とすることで実質的に二つのＴＦＴが直列された構造となり、オフ電流をさらに低減することができるという利点がある。
【０２７７】
また本実施例ではスイッチング用ＴＦＴ５０１はｎチャネル型ＴＦＴであるが、ｐチャネル型ＴＦＴであってもかまわない。
【０２７８】
電流制御用ＴＦＴ５０２の半導体層は、ソース領域５１０、ドレイン領域５１１、Ｌｏｖ領域５１２、チャネル形成領域５１３を含んでいる。Ｌｏｖ領域５１２はゲート絶縁膜４０６を介してゲート電極４２２と重なるように設けられている。なお本実施例において電流制御用ＴＦＴ５０２はＬｏｆｆ領域を有していないが、Ｌｏｆｆ領域を有する構成にしても良い。
【０２７９】
また本実施例では電流制御用ＴＦＴ５０２はｐチャネル型ＴＦＴであるが、ｎチャネル型ＴＦＴであってもかまわない。
【０２８０】
なお、本実施例のアクティブマトリクス基板は、表示部だけでなく駆動回路部にも最適な構造のＴＦＴを配置することにより、非常に高い信頼性を示し、動作特性も向上しうる。
【０２８１】
まず、極力動作速度を落とさないようにホットキャリア注入を低減させる構造を有するＴＦＴを、駆動回路部を形成するＣＭＯＳ回路のｎチャネル型ＴＦＴ５０３として用いる。なお、ここでいう駆動回路としては、シフトレジスタ、バッファ、レベルシフタ、サンプリング回路（サンプル及びホールド回路）などが含まれる。デジタル駆動を行う場合には、Ｄ／Ａコンバータなどの信号変換回路も含まれ得る。
【０２８２】
本実施例の場合、ＣＭＯＳ回路のｎチャネル型ＴＦＴ５０３の半導体層は、ソース領域５２１、ドレイン領域５２２、Ｌｏｖ領域５２３及びチャネル形成領域５２４を含んでいる。
【０２８３】
また本実施例の場合、ＣＭＯＳ回路のｐチャネル型ＴＦＴ５０４の半導体層は、ソース領域５３１、ドレイン領域５３２、Ｌｏｖ領域５３３及びチャネル形成領域５３４を含んでいる。
【０２８４】
なお、実際には図１４（Ｂ）まで完成したら、さらに外気に曝されないように気密性が高く、脱ガスの少ない保護フィルム（ラミネートフィルム、紫外線硬化樹脂フィルム等）や透光性のシーリング材でパッケージング（封入）することが好ましい。その際、シーリング材の内部を不活性雰囲気にしたり、内部に吸湿性材料（例えば酸化バリウム）を配置したりすると発光素子の信頼性が向上する。
【０２８５】
また、パッケージング等の処理により気密性を高めたら、基板上に形成された素子又は回路から引き回された端子と外部信号端子とを接続するためのコネクター（フレキシブルプリントサーキット：ＦＰＣ）を取り付けて製品として完成する。このような出荷できるまでした状態を本明細書中では発光装置という。
【０２８６】
上述したように本実施例の作製行程では、ゲート電極のチャネル長方向の長さ（以下単にゲート電極の幅と呼ぶ）が異なっているため、ゲート電極をマスクとしてイオン注入を行うことにより、ゲート電極の厚さが異なることによるイオンの侵入深さの違いを利用して、第１のゲート電極の下に位置する半導体層中のイオン濃度を、第１のゲート電極の下に位置しない半導体層中のイオン濃度より低くすることが可能である。
【０２８７】
またマスクを用いてＬｏｆｆ領域を形成するために、エッチングで制御しなくてはならないのはＬｏｖ領域の幅のみであり、Ｌｏｆｆ領域とＬｏｖ領域の位置の制御が容易である。
【０２８８】
なお本実施例では有機化合物層から発せられる光が基板側に向いている例について説明したが、本発明はこれに限定されず、有機化合物層から発せられる光が基板の上に向いているような構成であっても良い。この場合発光素子の陰極が画素電極となり、電流制御用ＴＦＴはｎチャネル型ＴＦＴであることが望ましい。
【０２８９】
本発明の発光装置の作製方法は、本実施例において示した作製方法に限定されることはなく、他のあらゆる作製方法を用いることが可能である。
【０２９０】
なお本実施例は、実施例１〜６と自由に組み合わせることが可能である。
【０２９１】
（実施例８）
図１５（Ａ）は本発明を用いた発光装置の上面図である。図１５（Ａ）において、４０１０は基板、４０１１は画素部、４０１２ａ及び４０１２ｂは第１及び第２ソース信号線駆動回路、４０１３ａ及び４０１３ｂは第１及び第２ゲート信号線駆動回路である。また、それぞれの駆動回路及び電源供給線は配線４０１６ａ、４０１６ｂ、４０１４ａ、４０１４ｂ及び４０１５を経てＦＰＣ４０１７に至り、外部機器へと接続される。
【０２９２】
このとき、少なくとも画素部４０１１、好ましくは駆動回路（４０１２ａ、４０１２ｂ、４０１３ａ、４０１３ｂ）及び画素部４０１１を囲むようにしてカバー材６０００、シーリング材（ハウジング材ともいう）７０００、密封材（第２のシーリング材）７００１が設けられている。
【０２９３】
また、図１５（Ｂ）は本実施例の発光装置の断面構造であり、図１５（Ａ）をＡ-Ａ’で切断した断面図である。図１５（Ｂ）において、基板４０１０、下地膜４０２１の上に駆動回路用ＴＦＴ（但し、ここではｎチャネル型ＴＦＴとｐチャネル型ＴＦＴを組み合わせたＣＭＯＳ回路を図示している）４０２２ａ、４０２２ｂ及び画素部のＴＦＴ４０２３（但し、ここでは発光素子への電流を制御する電流制御用ＴＦＴだけ図示している）が形成されている。これらのＴＦＴは公知の構造（トップゲート構造またはボトムゲート構造）を用いれば良い。
【０２９４】
駆動回路用ＴＦＴ４０２２ａ、４０２２ｂ及び電流制御用ＴＦＴ４０２３が完成したら、樹脂材料でなる層間絶縁膜（平坦化膜）４０２６の上に電流制御用ＴＦＴ４０２３のドレインと電気的に接続する透明導電膜でなる画素電極４０２７を形成する。透明導電膜としては、酸化インジウムと酸化スズとの化合物（ＩＴＯと呼ばれる）または酸化インジウムと酸化亜鉛との化合物を用いることができる。そして、画素電極４０２７を形成したら、絶縁膜４０２８を形成し、画素電極４０２７上に開口部を形成する。
【０２９５】
次に、有機化合物層４０２９を形成する。有機化合物層４０２９は公知の有機材料（正孔注入層、正孔輸送層、発光層、電子輸送層または電子注入層）を自由に組み合わせて積層構造または単層構造とすれば良い。どのような構造とするかは公知の技術を用いれば良い。また、有機材料には低分子系材料と高分子系（ポリマー系）材料がある。低分子系材料を用いる場合は蒸着法を用いるが、高分子系材料を用いる場合には、スピンコート法、印刷法またはインクジェット法等の簡易な方法を用いることが可能である。
【０２９６】
本実施例では、シャドーマスクを用いて蒸着法により有機化合物層４０２９を形成する。シャドーマスクを用いて画素毎に波長の異なる発光が可能な発光層（赤色発光層、緑色発光層及び青色発光層）を形成することで、カラー表示が可能となる。その他にも、色変換層（ＣＣＭ）とカラーフィルターを組み合わせた方式、白色発光層とカラーフィルターを組み合わせた方式があるがいずれの方法を用いても良い。勿論、単色発光の発光装置とすることもできる。
【０２９７】
有機化合物層４０２９を形成したら、その上に陰極４０３０を形成する。陰極４０３０と有機化合物層４０２９の界面に存在する水分や酸素は極力排除しておくことが望ましい。従って、真空中で有機化合物層４０２９と陰極４０３０を連続成膜するか、有機化合物層４０２９を不活性雰囲気で形成し、大気解放しないで陰極４０３０を形成するといった工夫が必要である。本実施例ではマルチチャンバー方式（クラスターツール方式）の成膜装置を用いることで上述のような成膜を可能とする。
【０２９８】
なお、本実施例では陰極４０３０として、ＬｉＦ（フッ化リチウム）膜とＡｌ（アルミニウム）膜の積層構造を用いる。具体的には有機化合物層４０２９上に蒸着法で１ｎｍ厚のＬｉＦ（フッ化リチウム）膜を形成し、その上に３００ｎｍ厚のアルミニウム膜を形成する。勿論、公知の陰極材料であるＭｇＡｇ電極を用いても良い。そして陰極４０３０は４０３１で示される領域において配線４０１６に接続される。配線４０１６は陰極４０３０に所定の電圧を与えるための電源線であり、導電性ペースト材料４０３２を介してＦＰＣ４０１７に接続される。
【０２９９】
４０３１に示された領域において陰極４０３０と配線４０１６とを電気的に接続するために、層間絶縁膜４０２６及び絶縁膜４０２８にコンタクトホールを形成する必要がある。これらは層間絶縁膜４０２６のエッチング時（画素電極用コンタクトホールの形成時）や絶縁膜４０２８のエッチング時（有機化合物層形成前の開口部の形成時）に形成しておけば良い。また、絶縁膜４０２８をエッチングする際に、層間絶縁膜４０２６まで一括でエッチングしても良い。この場合、層間絶縁膜４０２６と絶縁膜４０２８が同じ樹脂材料であれば、コンタクトホールの形状を良好なものとすることができる。
【０３００】
このようにして形成された発光素子の表面を覆って、パッシベーション膜６００３、充填材６００４、カバー材６０００が形成される。
【０３０１】
さらに、発光素子部を囲むようにして、カバー材６０００と基板４０１０の内側にシーリング材７０００が設けられ、さらにシーリング材７０００の外側には密封材（第２のシーリング材）７００１が形成される。
【０３０２】
このとき、この充填材６００４は、カバー材６０００を接着するための接着剤としても機能する。充填材６００４としては、ＰＶＣ（ポリビニルクロライド）、エポキシ樹脂、シリコーン樹脂、ＰＶＢ（ポリビニルブチラル）またはＥＶＡ（エチレンビニルアセテート）を用いることができる。この充填材６００４の内部に乾燥剤を設けておくと、吸湿効果を保持できるので好ましい。
【０３０３】
また、充填材６００４の中にスペーサーを含有させてもよい。このとき、スペーサーをＢａＯなどからなる粒状物質とし、スペーサー自体に吸湿性をもたせてもよい。
【０３０４】
スペーサーを設けた場合、パッシベーション膜６００３はスペーサー圧を緩和することができる。また、パッシベーション膜６００３とは別に、スペーサー圧を緩和する樹脂膜などを設けてもよい。
【０３０５】
また、カバー材６０００としては、ガラス板、アルミニウム板、ステンレス板、ＦＲＰ（Fiberglass-Reinforced Plastics）板、ＰＶＦ（ポリビニルフルオライド）フィルム、マイラーフィルム、ポリエステルフィルムまたはアクリルフィルムを用いることができる。なお、充填材６００４としてＰＶＢやＥＶＡを用いる場合、数十μｍのアルミニウムホイルをＰＶＦフィルムやマイラーフィルムで挟んだ構造のシートを用いることが好ましい。
【０３０６】
但し、発光素子からの発光方向（光の放射方向）によっては、カバー材６０００が透光性を有する必要がある。
【０３０７】
また、配線４０１５はシーリング材７０００および密封材７００１と基板４０１０との隙間を通ってＦＰＣ４０１７に電気的に接続される。なお、ここでは配線４０１５について説明したが、他の配線４０１４ａ、４０１４ｂ、４０１６ａ、４０１６ｂも同様にしてシーリング材７０００および密封材７００１と基板４０１０との隙間を通ってＦＰＣ４０１７に電気的に接続される。
【０３０８】
なお本実施例では、充填材６００４を設けてからカバー材６０００を接着し、充填材６００４の側面（露呈面）を覆うようにシーリング材７０００を取り付けているが、カバー材６０００及びシーリング材７０００を取り付けてから、充填材６００４を設けても良い。この場合、基板４０１０、カバー材６０００及びシーリング材７０００で形成されている空隙に通じる充填材の注入口を設ける。そして前記空隙を真空状態（１０-2Ｔｏｒｒ以下）にし、充填材の入っている水槽に注入口を浸してから、空隙の外の気圧を空隙の中の気圧よりも高くして、充填材を空隙の中に充填する。
【０３０９】
なお、本実施例は、実施例１〜６のいずれの実施例とも組み合わせることが可能である。
【０３１０】
（実施例９）
本実施例では、本発明を用いて実施例８とは異なる形態の発光装置を作製した例について、図１６（Ａ）、１６（Ｂ）を用いて説明する。図１５（Ａ）、１４（Ｂ）と同じ番号のものは同じ部分を指しているので説明は省略する。
【０３１１】
図１６（Ａ）は本実施例の発光装置の上面図であり、図１６（Ａ）をＡ―Ａ’で切断した断面図を図１６（Ｂ）に示す。
【０３１２】
実施例８に従って、発光素子の表面を覆ってパッシベーション膜６００３までを形成する。
【０３１３】
さらに、発光素子を覆うようにして充填材６００４を設ける。この充填材６００４は、カバー材６０００を接着するための接着剤としても機能する。充填材６００４としては、ＰＶＣ（ポリビニルクロライド）、エポキシ樹脂、シリコーン樹脂、ＰＶＢ（ポリビニルブチラル）またはＥＶＡ（エチレンビニルアセテート）を用いることができる。この充填材６００４の内部に乾燥剤を設けておくと、吸湿効果を保持できるので好ましい。
【０３１４】
また、充填材６００４の中にスペーサーを含有させてもよい。このとき、スペーサーをＢａＯなどからなる粒状物質とし、スペーサー自体に吸湿性をもたせてもよい。
【０３１５】
スペーサーを設けた場合、パッシベーション膜６００３はスペーサー圧を緩和することができる。また、パッシベーション膜６００３とは別に、スペーサー圧を緩和する樹脂膜などを設けてもよい。
【０３１６】
また、カバー材６０００としては、ガラス板、アルミニウム板、ステンレス板、ＦＲＰ（Fiberglass-Reinforced Plastics）板、ＰＶＦ（ポリビニルフルオライド）フィルム、マイラーフィルム、ポリエステルフィルムまたはアクリルフィルムを用いることができる。なお、充填材６００４としてＰＶＢやＥＶＡを用いる場合、数十μｍのアルミニウムホイルをＰＶＦフィルムやマイラーフィルムで挟んだ構造のシートを用いることが好ましい。
【０３１７】
但し、発光素子からの発光方向（光の放射方向）によっては、カバー材６０００が透光性を有する必要がある。
【０３１８】
次に、充填材６００４を用いてカバー材６０００を接着した後、充填材６００４の側面（露呈面）を覆うようにフレーム材６００１を取り付ける。フレーム材６００１はシーリング材（接着剤として機能する）６００２によって接着される。このとき、シーリング材６００２としては、光硬化性樹脂を用いるのが好ましいが、有機化合物層の耐熱性が許せば熱硬化性樹脂を用いても良い。なお、シーリング材６００２はできるだけ水分や酸素を透過しない材料であることが望ましい。また、シーリング材６００２の内部に乾燥剤を添加してあっても良い。
【０３１９】
また、配線４０１５はシーリング材６００２と基板４０１０との隙間を通ってＦＰＣ４０１７に電気的に接続される。なお、ここでは配線４０１５について説明したが、他の配線４０１６ａ、４０１６ｂ、４０１４ａ、４０１４ｂも同様にしてシーリング材６００２と基板４０１０との隙間を通ってＦＰＣ４０１７に電気的に接続される。
【０３２０】
なお本実施例では、充填材６００４を設けてからカバー材６０００を接着し、充填材６００４の側面（露呈面）を覆うようにフレーム材６００１を取り付けているが、カバー材６０００及びフレーム材６００１を取り付けてから、充填材６００４を設けても良い。この場合、基板４０１０、カバー材６０００及びフレーム材６００１で形成されている空隙に通じる充填材の注入口を設ける。そして前記空隙を真空状態（１０-2Ｔｏｒｒ以下）にし、充填材の入っている水槽に注入口を浸してから、空隙の外の気圧を空隙の中の気圧よりも高くして、充填材を空隙の中に充填する。
【０３２１】
なお、本実施例は、実施例１〜６のいずれの実施例とも組み合わせることが可能である。
【０３２２】
（実施例１０）
ここで発光装置における画素部のさらに詳細な断面構造を図１７に示す。
【０３２３】
図１７において、基板３５０１上に設けられた第１スイッチング用ＴＦＴ３５０２、第２スイッチング用ＴＦＴ３５０４は公知の方法を用いて形成されたｎチャネル型ＴＦＴを用いる。本実施例ではダブルゲート構造としている。ダブルゲート構造とすることで実質的に二つのＴＦＴが直列された構造となり、オフ電流値を低減することができるという利点がある。なお、本実施例ではダブルゲート構造としているが、シングルゲート構造でも構わないし、トリプルゲート構造やそれ以上のゲート本数を持つ、いわゆるマルチゲート構造でも構わない。
【０３２４】
また、電流制御用ＴＦＴ３５０３は公知の方法を用いて形成されたｎチャネル型ＴＦＴを用いる。
【０３２５】
第２スイッチング用ＴＦＴ３５０４のドレイン配線３１は配線３６によって、第１スイッチング用ＴＦＴ３５０２のドレイン配線３５と、電流制御用ＴＦＴ３５０３のゲート電極３７とに電気的に接続されている。
【０３２６】
第１スイッチング用ＴＦＴ３５０２、第２スイッチング用ＴＦＴ３５０４及び電流制御用ＴＦＴ３５０３は、公知の方法を用いて形成されたｐチャネル型ＴＦＴを用いても構わない。なお、第１スイッチング用ＴＦＴ３５０２及び第２スイッチング用ＴＦＴ３５０４は同じ極性のＴＦＴを用いることが好ましい。
【０３２７】
また、電流制御用ＴＦＴ３５０３は公知の方法を用いて形成されたｎチャネル型ＴＦＴを用いる。電流制御用ＴＦＴのゲート電極３７は配線３６によって、第１スイッチング用ＴＦＴ３５０２のドレイン配線３５と、第２スイッチング用ＴＦＴ３５０４のドレイン配線３１とに電気的に接続されている。
【０３２８】
電流制御用ＴＦＴ３５０３は発光素子を流れる電流量を制御するための素子であるため、多くの電流が流れ、熱による劣化やホットキャリアによる劣化の危険性が高い素子でもある。そのため、電流制御用ＴＦＴ３５０３のドレイン領域側に、ゲート絶縁膜を介してゲート電極に重なるようにＬＤＤ領域を設ける本実施例の構造は極めて有効である。しかし本発明はこの構成に限定されない。電流制御用ＴＦＴ３５０３のドレイン領域側に、ゲート絶縁膜を介してゲート電極に重ならないようにＬＤＤ領域を設けても良いし、ＬＤＤ領域を設けなくとも良い。なおこれらの場合、発光素子駆動電圧が１０Ｖ以下、典型的には５Ｖ以下であることが望ましい。
【０３２９】
また、本実施例では電流制御用ＴＦＴ３５０３をシングルゲート構造で図示しているが、複数のＴＦＴを直列につなげることで、ダブルゲート構造やそれ以上のゲート本数を持つ、いわゆるマルチゲート構造としても良い。さらに、複数のＴＦＴを並列につなげて実質的にチャネル形成領域を複数に分割し、熱の放射を高い効率で行えるようにした構造としても良い。このような構造は熱による劣化対策として有効である。
【０３３０】
また、ソース配線４０は電源供給線３８に接続され、常に一定の電位に保たれている。
【０３３１】
第１スイッチング用ＴＦＴ３５０２、第２スイッチング用ＴＦＴ３５０４及び電流制御用ＴＦＴ３５０３の上には第１パッシベーション膜４１が設けられ、その上に樹脂絶縁膜でなる平坦化膜４２が形成される。平坦化膜４２を用いてＴＦＴによる段差を平坦化することは非常に重要である。後に形成される有機化合物層は非常に薄いため、段差が存在することによって発光不良を起こす場合がある。従って、有機化合物層をできるだけ平坦面に形成しうるように画素電極を形成する前に平坦化しておくことが望ましい。
【０３３２】
また、４３は反射性の高い導電膜でなる画素電極（この場合発光素子の陰極）であり、電流制御用ＴＦＴ３５０３のドレイン領域に電気的に接続される。画素電極４３としてはアルミニウム合金膜、銅合金膜または銀合金膜など低抵抗な導電膜またはそれらの積層膜を用いることが好ましい。勿論、他の導電膜との積層構造としても良い。
【０３３３】
また、絶縁膜（好ましくは樹脂）で形成されたバンク４４ａ、４４ｂにより形成された溝（画素に相当する）の中に発光層４５が形成される。なお、ここでは一画素しか図示していないが、Ｒ（赤）、Ｇ（緑）、Ｂ（青）の各色に対応した発光層を作り分けても良い。発光層とする有機材料としてはπ共役ポリマー系材料を用いる。代表的なポリマー系材料としては、ポリパラフェニレンビニレン（ＰＰＶ）系、ポリビニルカルバゾール（ＰＶＫ）系、ポリフルオレン系などが挙げられる。
【０３３４】
なお、ＰＰＶ系有機材料としては様々な型のものがあるが、例えば「H. Shenk,H.Becker,O.Gelsen,E.Kluge,W.Kreuder,and H.Spreitzer,“Polymers for Light Emitting Diodes”,Euro Display,Proceedings,1999,p.33-37」や特開平１０−９２５７６号公報に記載されたような材料を用いれば良い。
【０３３５】
具体的な発光層としては、赤色に発光する発光層にはシアノポリフェニレンビニレン、緑色に発光する発光層にはポリフェニレンビニレン、青色に発光する発光層にはポリフェニレンビニレン若しくはポリアルキルフェニレンを用いれば良い。膜厚は３０〜１５０ｎｍ（好ましくは４０〜１００ｎｍ）とすれば良い。
【０３３６】
但し、以上の例は発光層として用いることのできる有機材料の一例であって、これに限定する必要はまったくない。発光層、電荷輸送層または電荷注入層を自由に組み合わせて有機化合物層（発光及びそのためのキャリアの移動を行わせるための層）を形成すれば良い。
【０３３７】
例えば、本実施例ではポリマー系材料を発光層として用いる例を示したが、低分子系有機材料を用いても良い。また、電荷輸送層や電荷注入層として炭化珪素等の無機材料を用いることも可能である。これらの有機材料や無機材料は公知の材料を用いることができる。
【０３３８】
本実施例では発光層４５の上にＰＥＤＯＴ（ポリチオフェン）またはＰＡｎｉ（ポリアニリン）でなる正孔注入層４６を設けた積層構造の有機化合物層としている。そして、正孔注入層４６の上には透明導電膜でなる陽極４７が設けられる。本実施例の場合、発光層４５で生成された光は上面側に向かって（ＴＦＴの上方に向かって）放射されるため、陽極は透光性でなければならない。透明導電膜としては酸化インジウムと酸化スズとの化合物や酸化インジウムと酸化亜鉛との化合物を用いることができるが、耐熱性の低い発光層や正孔注入層を形成した後で形成するため、可能な限り低温で成膜できるものが好ましい。
【０３３９】
陽極４７まで形成された時点で発光素子３５０５が完成する。なお、ここでいう発光素子３５０５は、画素電極（陰極）４３、発光層４５、正孔注入層４６及び陽極４７で形成された素子を指す。画素電極４３は画素の面積にほぼ一致させているため、画素全体が発光素子として機能する。従って、発光の利用効率が非常に高く、明るい画像表示が可能となる。
【０３４０】
また本実施例では、陽極４７の上にさらに第２パッシベーション膜４８を設けている。第２パッシベーション膜４８としては窒化珪素膜または窒化酸化珪素膜が好ましい。第２パッシベーション膜４８は必ずしも設けなくとも良いが、第２パッシベーション膜４８によって外部と発光素子とを遮断することができ、有機材料の酸化による劣化を防ぎ、有機材料からの脱ガスを抑えることができる。これにより発光装置の信頼性が高められる。
【０３４１】
以上のように本発明の発光装置は図１７のような構造の画素からなる画素部を有し、オフ電流値の十分に低い第１及び第２スイッチング用ＴＦＴとホットキャリア注入に強い電流制御用ＴＦＴを有する。従って、高い信頼性を有し、且つ、良好な画像表示が可能な発光装置が得られる。
【０３４２】
なお、本実施例は、実施例１〜６のいずれの実施例とも組み合わせることが可能である。
【０３４３】
（実施例１１）
本実施例では、実施例１０に示した画素部において、発光素子３５０５の構造を反転させた構造について説明する。説明には図１８を用いる。なお、図１７の構造と異なる点は発光素子の部分と電流制御用ＴＦＴだけであるので、その他の説明は省略することとする。
【０３４４】
図１８において、電流制御用ＴＦＴ３５０３は公知の方法を用いて形成されたｐチャネル型ＴＦＴを用いる。
【０３４５】
本実施例では、画素電極（陽極）５０として透明導電膜を用いる。具体的には酸化インジウムと酸化亜鉛との化合物でなる導電膜を用いる。勿論、酸化インジウムと酸化スズとの化合物でなる導電膜を用いても良い。
【０３４６】
そして、絶縁膜でなるバンク５１ａ、５１ｂが形成された後、溶液塗布によりポリビニルカルバゾールでなる発光層５２が形成される。その上にはカリウムアセチルアセトネート（ａｃａｃＫと表記される）でなる電子注入層５３、アルミニウム合金でなる陰極５４が形成される。この場合、陰極５４がパッシベーション膜としても機能する。こうして発光素子３７０１が形成される。
【０３４７】
本実施例の場合、発光層５２で発生した光は、矢印で示されるようにＴＦＴが形成された基板の方に向かって放射される。
【０３４８】
なお、本実施例は、実施例１〜６のいずれの実施例とも組み合わせることが可能である。
【０３４９】
（実施例１２）
本実施例では、図３とは異なる構造を有する画素の回路図について、図１９（Ａ）、（Ｂ）に示す。なお、本実施例において、３８０１、３８０１ａ、３８０１ｂは第１ゲート信号線、３８０２、３８０２ａ、３８０２ｂは第２ゲート信号線、３８０３は第１ソース信号線、３８０４は第２ソース信号線、３８０５は第１スイッチング用ＴＦＴ、３８０６は第２スイッチング用ＴＦＴ、３８０７は電流制御用ＴＦＴ３８０７、３８０８は発光素子、３８０９は電源供給線、３８１０はコンデンサである。
【０３５０】
図１９（Ａ）は、電源供給線３８０９を第１及び第２ゲート信号線３８０１、３８０２と平行に設けた場合の例である。なお、図１９（Ａ）では電源供給線３８０９と第１及び第２ゲート信号線３８０１、３８０２とが重ならないような構造になっているが、両者が異なる層に形成される配線であれば、絶縁膜を介して第１及び第２ゲート信号線３８０１、３８０２のいずれか一方と電源供給線３８０９とを重なるように設けることもできる。この場合、電源供給線３８０９と第１及若しくは第２ゲート信号線３８０１、３８０２とで専有面積を共有させることができるため、画素部をさらに高精細化することができる。
【０３５１】
また、図１９（Ｂ）は、図１９（Ａ）の構造と同様に電源供給線３８０９を第１及び第２ゲート信号線３８０１ａ、３８０１ｂ、３８０２ａ、３８０２ｂと平行に設け、さらに、二つの画素を電源供給線３８０９を中心に線対称となるように形成する点に特徴がある。また、電源供給線３８０９を第１及び第２ゲート信号線線３８０１ａ、３８０１ｂ、３８０２ａ、３８０２ｂのいずれか１つと重なるように設けることも有効である。この場合、電源供給線の本数を減らすことができるため、画素部をさらに高精細化することができる。
【０３５２】
なお、本実施例の構成は、実施例１〜１１の構成と自由に組み合わせて実施することが可能である。
【０３５３】
（実施例１３）
本実施例では、図１で示した第１ソース信号線駆動回路１０２ａ及び第２ソース信号線駆動回路１０２ｂの詳しい構成について説明する。なお、第１ソース信号線駆動回路１０２ａと第２ソース信号線駆動回路１０２ｂの構造はほぼ同じであるため、本実施例では第１ソース信号線駆動回路１０２ａの構成を例にとって説明する。図２０に本発明で用いられる第１ソース信号線駆動回路の一例を、回路図で示す。
【０３５４】
シフトレジスタ８０１、ラッチ（Ａ）（８０２）、ラッチ（Ｂ）（８０３）、が図に示すように配置されている。なお本実施例では、１組のラッチ（Ａ）（８０２）と１組のラッチ（Ｂ）（８０３）が、４本の第１ソース信号線ＧＬ＿ａ〜ＧＬ＿ｄに対応している。また本実施例では信号が有する電圧の振幅の幅を変えるレベルシフトを設けなかったが、設計者が適宜設けるようにしても良い。
【０３５５】
クロック信号ＣＬＫ、ＣＬＫの極性が反転したクロック信号ＣＬＫＢ、スタートパルス信号ＳＰ、駆動方向切り替え信号ＳＬ／Ｒはそれぞれ図に示した配線からシフトレジスタ８０１に入力される。また外部から入力されるデジタルビデオ信号は図に示した配線ＶＤからラッチ（Ａ）（８０２）に入力される。ラッチ信号Ｓ＿ＬＡＴ、Ｓ＿ＬＡＴの極性が反転した信号Ｓ＿ＬＡＴｂはそれぞれ図に示した配線からラッチ（Ｂ）（８０３）に入力される。
【０３５６】
ラッチ（Ａ）（８０２）の詳しい構成について、ソース信号線ＧＬ＿ａに対応するラッチ（Ａ）（８０２）の一部８０４を例にとって説明する。ラッチ（Ａ）（８０２）の一部８０４は２つのクロックドインバータと２つのインバータを有している。
【０３５７】
ラッチ（Ａ）（８０２）の一部８０４の上面図を図２１に示す。８３１ａ、８３１ｂはそれぞれ、ラッチ（Ａ）（８０２）の一部８０４が有するインバータの１つを形成するＴＦＴの活性層であり、８３６は該インバータの１つを形成するＴＦＴの共通のゲート電極である。また８３２ａ、８３２ｂはそれぞれ、ラッチ（Ａ）（８０２）の一部８０４が有するもう１つのインバータを形成するＴＦＴの活性層であり、８３７ａ、８３７ｂは活性層８３２ａ、８３２ｂ上にそれぞれ設けられたゲート電極である。なおゲート電極８３７ａ、８３７ｂは電気的に接続されている。
【０３５８】
８３３ａ、８３３ｂはそれぞれ、ラッチ（Ａ）（８０２）の一部８０４が有するクロックドインバータの１つを形成するＴＦＴの活性層である。活性層８３３ａ上にはゲート電極８３８ａ、８３８ｂが設けられており、ダブルゲート構造となっている。また活性層８３３ｂ上にはゲート電極８３８ｂ、８３９が設けられており、ダブルゲート構造となっている。
【０３５９】
８３４ａ、８３４ｂはそれぞれ、ラッチ（Ａ）（８０２）の一部８０４が有するもう１つのクロックドインバータを形成するＴＦＴの活性層である。活性層８３４ａ上にはゲート電極８３９、８４０が設けられており、ダブルゲート構造となっている。また活性層８３４ｂ上にはゲート電極８４０、８４１が設けられており、ダブルゲート構造となっている。
【０３６０】
（実施例１４）
本発明を実施して形成された発光装置は、自発光型であるため液晶表示装置に比べて明るい場所での視認性に優れ、しかも視野角が広い。従って、様々な電子機器の表示部に用いることができる。例えば、ＴＶ放送等を大画面で鑑賞するには対角３０インチ以上（典型的には４０インチ以上）のエレクトロルミネッセンス表示装置（発光装置を筐体に組み込んだ発光装置）の表示部として本発明の発光装置を用いるとよい。
【０３６１】
なお、発光装置には、パソコン用ディスプレイ、ＴＶ放送受信用ディスプレイ、広告表示用ディスプレイ等の全ての情報表示用ディスプレイが含まれる。また、その他にも様々な電子機器の表示部として本発明の発光装置を用いることができる。
【０３６２】
その様な本発明の電子機器としては、ビデオカメラ、デジタルカメラ、ゴーグル型ディスプレイ（ヘッドマウントディスプレイ）、ナビゲーションシステム、音響再生装置（カーオーディオ、オーディオコンポ等）、ノート型パーソナルコンピュータ、ゲーム機器、携帯情報端末（モバイルコンピュータ、携帯電話、携帯型ゲーム機または電子書籍等）、記録媒体を備えた画像再生装置（具体的にはデジタルバーサタイルディスク（ＤＶＤ）等の記録媒体を再生し、その画像を表示しうるディスプレイを備えた装置）などが挙げられる。特に、斜め方向から見ることの多い携帯情報端末は視野角の広さが重要視されるため、発光装置を用いることが望ましい。それら電子機器の具体例を図２２、図２３に示す。
【０３６３】
図２２（Ａ）はエレクトロルミネッセンス表示装置であり、筐体２００１、支持台２００２、表示部２００３等を含む。本発明の発光装置は表示部２００３に用いることができる。発光装置は自発光型であるためバックライトが必要なく、液晶表示装置よりも薄い表示部とすることができる。
【０３６４】
図２２（Ｂ）はビデオカメラであり、本体２１０１、表示部２１０２、音声入力部２１０３、操作スイッチ２１０４、バッテリー２１０５、受像部２１０６等を含む。本発明の発光装置は表示部２１０２に用いることができる。
【０３６５】
図２２（Ｃ）は頭部取り付け型の発光装置の一部（右片側）であり、本体２２０１、信号ケーブル２２０２、頭部固定バンド２２０３、スクリーン部２２０４、光学系２２０５、表示部２２０６等を含む。本発明の発光装置は表示部２２０６に用いることができる。
【０３６６】
図２２（Ｄ）は記録媒体を備えた画像再生装置（具体的にはＤＶＤ再生装置）であり、本体２３０１、記録媒体（ＤＶＤ等）２３０２、操作スイッチ２３０３、表示部（ａ）２３０４、表示部（ｂ）２３０５等を含む。表示部（ａ）２３０４は主として画像情報を表示し、表示部（ｂ）２３０５は主として文字情報を表示するが、本発明の発光装置はこれら表示部（ａ）、（ｂ）２３０４、２３０５に用いることができる。なお、記録媒体を備えた画像再生装置には家庭用ゲーム機器なども含まれる。
【０３６７】
図２２（Ｅ）はゴーグル型ディスプレイ（ヘッドマウントディスプレイ）であり、本体２４０１、表示部２４０２、アーム部２４０３を含む。本発明の発光装置は表示部２４０２に用いることができる。
【０３６８】
図２２（Ｆ）はパーソナルコンピュータであり、本体２５０１、筐体２５０２、表示部２５０３、キーボード２５０４等を含む。本発明の発光装置は表示部２５０３に用いることができる。
【０３６９】
なお、将来的に有機化合物層の発光輝度が高くなれば、出力した画像情報を含む光をレンズ等で拡大投影してフロント型若しくはリア型のプロジェクターに用いることも可能となる。
【０３７０】
また、上記電子機器はインターネットやＣＡＴＶ（ケーブルテレビ）などの電子通信回線を通じて配信された情報を表示することが多くなり、特に動画情報を表示する機会が増してきている。有機化合物層の応答速度は非常に高いため、発光装置は動画表示に好ましい。
【０３７１】
また、発光装置は発光している部分が電力を消費するため、発光部分が極力少なくなるように情報を表示することが望ましい。従って、携帯情報端末、特に携帯電話や音響再生装置のような文字情報を主とする表示部に発光装置を用いる場合には、非発光部分を背景として文字情報を発光部分で形成するように駆動することが望ましい。
【０３７２】
ここで図２３（Ａ）は携帯電話であり、本体２６０１、音声出力部２６０２、音声入力部２６０３、表示部２６０４、操作スイッチ２６０５、アンテナ２６０６を含む。本発明の発光装置は表示部２６０４に用いることができる。なお、表示部２６０４は黒色の背景に白色の文字を表示することで携帯電話の消費電力を抑えることができる。
【０３７３】
また、図２３（Ｂ）は音響再生装置、具体的にはカーオーディオであり、本体２７０１、表示部２７０２、操作スイッチ２７０３、２７０４を含む。本発明の発光装置は表示部２７０２に用いることができる。また、本実施例では車載用オーディオを示すが、携帯型や家庭用の音響再生装置に用いても良い。なお、表示部２７０２は黒色の背景に白色の文字を表示することで消費電力を抑えられる。
これは携帯型の音響再生装置において特に有効である。
【０３７４】
以上の様に、本発明の適用範囲は極めて広く、あらゆる分野の電子機器に用いることが可能である。また、本実施例の電子機器は実施例１〜１３に示したいずれの構成の発光装置を用いても良い。
【０３７５】
（実施例１５）
【０３７６】
本実施例では、本発明の発光装置の駆動方法を用いた場合、どの様な電圧電流特性を有する領域で電流制御用ＴＦＴを駆動させるかについて説明する。
【０３７７】
発光素子は、印加される電圧が少しでも変化すると、それに対して発光素子に流れる電流が指数関数的に大きく変化する。別の見方をすると、発光素子に流れる電流の大きさが変化しても、発光素子に印加される電圧値はあまり変化しない。そして、発光素子の輝度は、発光素子に流れる電流にほぼ正比例して大きくなる。よって、発光素子に印加される電圧の大きさ（電圧値）を制御することにより発光素子の輝度を制御するよりも、発光素子を流れる電流の大きさ（電流値）を制御することにより発光素子の輝度を制御する方が、ＴＦＴの特性に左右されずらく、発光素子の輝度の制御が容易である。
【０３７８】
図２７を参照する。図２７（Ａ）は、図３に示した本発明の発光装置の画素において、電流制御用ＴＦＴ１０８および発光素子１１０の構成部分のみを図示したものである。図２７（Ｂ）には、図２７（Ａ）で示した電流制御用ＴＦＴ１０８および発光素子１１０の電圧電流特性を示す。なお図２７で示す電流制御用ＴＦＴ１０８の電圧電流特性のグラフは、ソース領域とドレイン領域の間の電圧であるＶDSに対する、電流制御用ＴＦＴ１０８のドレインに流れる電流の大きさを示しており、図２７には電流制御用ＴＦＴ１０８のソース領域とゲート電極の間の電圧であるＶGSの値の異なる複数のグラフを示している。
【０３７９】
図２７（Ａ）に示したように、発光素子１１０の画素電極と対向電極１１１の間にかかる電圧をＶEL、電源供給線に接続される端子２６０１と発光素子１１０の対向電極１１１の間にかかる電圧をＶTとする。なおＶTは電源供給線の電位によってその値が固定される。また電流制御用ＴＦＴ１０８のソース領域・ドレイン領域間の電圧をＶDS、電流制御用ＴＦＴ１０８のゲート電極に接続される配線２６０２とソース領域との間の電圧、つまり電流制御用ＴＦＴ１０８のゲート電極とソース領域の間の電圧をＶGSとする。
【０３８０】
電流制御用ＴＦＴ１０８はｎチャネル型ＴＦＴでもｐチャネル型ＴＦＴでもどちらでも良い。
【０３８１】
また、電流制御用ＴＦＴ１０８と発光素子１１０とは直列に接続されている。
よって、両素子（電流制御用ＴＦＴ１０８と発光素子１１０）を流れる電流値は同じである。従って、図２７（Ａ）に示した電流制御用ＴＦＴ１０８と発光素子１１０とは、両素子の電圧電流特性を示すグラフの交点（動作点）において駆動する。図２７（Ｂ）において、ＶELは、対向電極１１１の電位と動作点での電位との間の電圧になる。ＶDSは、電流制御用ＴＦＴ１０８の端子２６０１での電位と動作点での電位との間の電圧になる。つまり、ＶTは、ＶELとＶDSの和に等しい。
【０３８２】
ここで、ＶGSを変化させた場合について考える。図２７（Ｂ）から分かるように、電流制御用ＴＦＴ１０８の｜ＶGS−ＶTH｜が大きくなるにつれて、言い換えると｜ＶGS｜が大きくなるにつれて、電流制御用ＴＦＴ１０８に流れる電流値が大きくなる。なお、ＶTHは電流制御用ＴＦＴ１０８のしきい値電圧である。よって図２７（Ｂ）から分かるように、｜ＶGS｜が大きくなると、動作点において発光素子１１０を流れる電流値も当然大きくなる。発光素子１１０の輝度は、発光素子１１０を流れる電流値に比例して高くなる。
【０３８３】
｜ＶGS｜が大きくなることによって発光素子１１０を流れる電流値が大きくなると、電流値に応じてＶELの値も大きくなる。そしてＶTの大きさは電源供給線の電位によって定まっているので、ＶELが大きくなると、その分ＶDSが小さくなる。
【０３８４】
また図２７（Ｂ）に示したように、電流制御用ＴＦＴの電圧電流特性は、ＶGSとＶDSの値によって２つの領域に分けられる。｜ＶGS−ＶTH｜＜｜ＶDS｜である領域が飽和領域、｜ＶGS−ＶTH｜＞｜ＶDS｜である領域が線形領域である。
【０３８５】
飽和領域においては以下の式１が成り立つ。なおＩDは電流制御用ＴＦＴ１０８のチャネル形成領域を流れる電流値である。またβ＝μＣ0Ｗ／Ｌであり、μは電流制御用ＴＦＴ１０８の移動度、Ｃ0は単位面積あたりのゲート容量、Ｗ／Ｌはチャネル形成領域のチャネル幅Ｗとチャネル長Ｌの比である。
【０３８６】
【式１】
ＩD＝β（ＶGS−ＶTH）2／２
【０３８７】
また線形領域においては以下の式２が成り立つ。
【０３８８】
【式２】
ＩD＝β｛（ＶGS−ＶTH）ＶDS−ＶDS2／２｝
【０３８９】
式１からわかるように、飽和領域において電流値はＶDSによってほとんど変化せず、ＶGSのみによって電流値が定まる。
【０３９０】
一方、式２からわかるように、線形領域は、ＶDSとＶGSとにより電流値が定まる。｜ＶGS｜を大きくしていくと、電流制御用ＴＦＴ１０８は線形領域で動作するようになる。そして、ＶELも徐々に大きくなっていく。よって、ＶELが大きくなった分だけ、ＶDSが小さくなっていく。線形領域では、ＶDSが小さくなると電流量も小さくなる。そのため、|ＶGS|を大きくしていっても、電流値は増加しにくくなってくる。｜ＶGS｜＝∞になった時、電流値＝ＩMAXとなる。つまり、｜ＶGS｜をいくら大きくしても、ＩMAX以上の電流は流れない。ここで、ＩMAXは、ＶEL＝ＶTの時に、発光素子１１０を流れる電流値である。
【０３９１】
このように｜ＶGS｜の大きさを制御することによって、動作点を飽和領域にしたり、線形領域にしたりすることができる。
【０３９２】
ところで、全ての電流制御用ＴＦＴの特性は理想的には全て同じであることが望ましいが、実際には個々の電流制御用ＴＦＴでしきい値ＶTHと移動度μとが異なっていることが多い。そして個々の電流制御用ＴＦＴのしきい値ＶTHと移動度μとが互いに異なると、式１及び式２からわかるように、ＶGSの値が同じでも電流制御用ＴＦＴ１０８のチャネル形成領域を流れる電流値が異なってしまう。
【０３９３】
図２８にしきい値ＶTHと移動度μとがずれた電流制御用ＴＦＴの電流電圧特性を示す。実線２７０１が理想の電流電圧特性のグラフであり、２７０２、２７０３がそれぞれしきい値ＶTHと移動度μとが理想とする値と異なってしまった場合の電流制御用ＴＦＴの電流電圧特性である。電流電圧特性のグラフ２７０２、２７０３は飽和領域においては同じ電流値ΔＩ1だけ、理想の特性を有する電流電圧特性のグラフ２７０１からずれていて、電流電圧特性のグラフ２７０２の動作点２７０５は飽和領域にあり、電流電圧特性のグラフ２７０３の動作点２７０６は線形領域にあったとする。その場合、理想の特性を有する電流電圧特性のグラフ２７０１の動作点２７０４における電流値と、動作点２７０５及び動作点２７０６における電流値のずれをそれぞれΔＩ2、ΔＩ3とすると、飽和領域における動作点２７０５よりも線形領域における動作点２７０６の方が小さい。
【０３９４】
よって本発明で示したデジタル方式の駆動方法を用いる場合、動作点が線形領域に存在するように電流制御用ＴＦＴと発光素子を駆動させることで、電流制御用ＴＦＴの特性のずれによる発光素子の輝度むらを抑えた階調表示を行うことができる。
【０３９５】
また従来のアナログ駆動の場合は、｜ＶGS｜のみによって電流値を制御することが可能な飽和領域に動作点が存在するように電流制御用ＴＦＴと発光素子を駆動させる方が好ましい。
【０３９６】
以上の動作分析のまとめとして、電流制御用ＴＦＴのゲート電圧｜ＶGS｜に対する電流値のグラフを図２９に示す。｜ＶGS｜を大きくしていき、電流制御用ＴＦＴのしきい値電圧の絶対値｜ＶTH｜よりも大きくなると、電流制御用ＴＦＴが導通状態となり、電流が流れ始める。本明細書ではこの時の｜ＶGS｜を点灯開始電圧と呼ぶことにする。そして、さらに｜ＶGS｜を大きくしていくと、｜ＶGS｜が｜ＶGS−ＶTH｜＝｜ＶDS｜を満たすような値（ここでは仮にＡとする）となり、飽和領域２８０１から線形領域２８０２になる。さらに｜ＶGS｜を大きくしていくと、電流値が大きくなり、遂には、電流値が飽和してくる。その時｜ＶGS｜＝∞となる。
【０３９７】
図２９から分かる通り、｜ＶGS｜≦｜ＶTH｜の領域では、電流がほとんど流れない。｜ＶTH｜≦｜ＶGS｜≦Ａの領域は飽和領域であり、｜ＶGS｜によって電流値が変化する。そして、Ａ≦｜ＶGS｜の領域は線形領域であり、発光素子に流れる電流値は｜ＶGS｜及び｜ＶDS｜よって電流値が変化する。
【０３９８】
本発明のデジタル駆動では、｜ＶGS｜≦｜ＶTH｜の領域及びＡ≦｜ＶGS｜の線形領域を用いることが好ましい。
【０３９９】
なお本実施例は他の全ての実施例と自由に組み合わせることが可能である。
【０４００】
（実施例１６）
本発明において、三重項励起子からの燐光を発光に利用できる有機材料を用いることで、外部発光量子効率を飛躍的に向上させることができる。これにより、発光素子の低消費電力化、長寿命化、および軽量化が可能になる。
【０４０１】
ここで、三重項励起子を利用し、外部発光量子効率を向上させた報告を示す。 (T.Tsutsui, C.Adachi, S.Saito, Photochemical Processes in Organized Molecular Systems, ed.K.Honda, (Elsevier Sci.Pub., Tokyo,1991) p.437.)
【０４０２】
上記の論文により報告された有機材料（クマリン色素）の分子式を以下に示す。
【０４０３】
【化１】
0004869491.tif 000002
【０４０４】
(M.A.Baldo, D.F.O'Brien, Y.You, A.Shoustikov, S.Sibley, M.E.Thompson, S.R.Forrest, Nature 395 (1998) p.151.)
【０４０５】
上記の論文により報告された有機材料（Ｐｔ錯体）の分子式を以下に示す。
【０４０６】
【化２】
0004869491.tif 000003
【０４０７】
(M.A.Baldo, S.Lamansky, P.E.Burrrows, M.E.Thompson, S.R.Forrest, Appl.Phys.Lett.,75 (1999) p.4.) (T.Tsutsui, M.-J.Yang, M.Yahiro, K.Nakamura, T.Watanabe, T.tsuji, Y.Fukuda, T.Wakimoto, S.Mayaguchi, Jpn.Appl.Phys., 38 (12B) (1999) L1502.)
【０４０８】
上記の論文により報告された有機材料（Ｉｒ錯体）の分子式を以下に示す。
【０４０９】
【化３】
0004869491.tif 000004
【０４１０】
以上のように三重項励起子からの燐光発光を利用できれば原理的には一重項励起子からの蛍光発光を用いる場合より３〜４倍の高い外部発光量子効率の実現が可能となる。
【０４１１】
なお、本実施例の構成は、実施例１〜実施例１５のいずれの構成とも自由に組み合わせて実施することが可能である。
【０４１２】
【発明の効果】
本発明は表示期間の組み合わせによって階調表示を行う。そのためアナログ方式の駆動方法に比べて、階調表示を行う際の画面の明るさが、ＴＦＴのＩD−ＶGS特性のばらつきに左右されにくい。
【０４１３】
また本発明においては、表示期間と書き込み期間とを一部重ねることが可能である。言い換えると書き込み期間においても画素を表示させることが可能である。そのため、１フレーム期間における表示期間の長さの総和の割合（デューティー比）が、書き込み期間の長さによってのみ決定されない。本発明では、デューティー比を自由に設定することが可能である。
【０４１４】
なお書き込み期間どうしが重なるか否かは、書き込み期間の長さを制御することによって決めることができる。書き込み期間を短くしていくと書き込み期間どうしが重ならなくなるし、書き込み期間を長くしていくと書き込み期間どうしが重なる。よって本明細書の実施例１〜５において示した駆動方法は本発明の一実施例を示したにすぎず、各実施例においてどの書き込み期間同士が重なるかということは、書き込み期間の長さを制御することで自由に決めることができる。
【０４１５】
また隣り合う書き込み期間どうしが重なっていない場合、隣り合う２つの書き込み期間においてデジタルビデオ信号を画素に入力するための駆動回路群は、第１駆動回路群（Ｄｒ＿Ｌ）と第２駆動回路群（Ｄｒ＿Ｒ）のどちらでも良い。よって本明細書の実施例１〜５において示した駆動方法は本発明の一実施例を示したにすぎず、互いに重なっていない隣り合う２つの書き込み期間は共に第１駆動回路群（Ｄｒ＿Ｌ）によって書き込みが行われていても良いし、または共に第２駆動回路群（Ｄｒ＿Ｒ）によって書き込みが行われていても良い。
【０４１６】
また本発明の構成を用いることでデューティー比を１００にすることができ、高い輝度の表示を行うことができる。
【０４１７】
逆に表示を行わない黒表示期間を設けた場合、発光素子が常に発光するのを防ぎ、有機化合物層の劣化を抑えることができる。
【図面の簡単な説明】
【図１】  本発明の発光装置の上面ブロック図。
【図２】  本発明の発光装置の画素部の回路図。
【図３】  本発明の発光装置の画素の回路図。
【図４】  本発明の発光装置の駆動方法を示すタイミングチャート図。
【図５】  本発明の発光装置の駆動方法を示すタイミングチャート図。
【図６】  本発明の発光装置の駆動方法を示すタイミングチャート図。
【図７】  本発明の発光装置の駆動方法を示すタイミングチャート図。
【図８】  本発明の発光装置の駆動方法を示すタイミングチャート図。
【図９】  本発明の発光装置の駆動方法を示すタイミングチャート図。
【図１０】  本発明の発光装置の駆動方法を示すタイミングチャート図。
【図１１】  発光装置の作製行程を示す図。
【図１２】  発光装置の作製行程を示す図。
【図１３】  発光装置の作製行程を示す図。
【図１４】  発光装置の作製行程を示す図。
【図１５】  本発明の発光装置の上面図及び断面図。
【図１６】  本発明の発光装置の上面図及び断面図。
【図１７】  本発明の発光装置の画素の断面図。
【図１８】  本発明の発光装置の画素の断面図。
【図１９】  本発明の発光装置の画素の回路図。
【図２０】  ソース信号線駆動回路の回路図。
【図２１】  ソース信号線駆動回路のラッチの上面図。
【図２２】  本発明の発光装置を用いた電子機器の図。
【図２３】  本発明の発光装置を用いた電子機器の図。
【図２４】  従来の発光装置の画素部の回路図。
【図２５】  従来の発光装置の駆動方法を示すタイミングチャート。
【図２６】  ＴＦＴのＩD−ＶGS特性を示す図。
【図２７】    発光素子と電流制御用ＴＦＴの接続の構成を示す図と、発光素子と電流制御用ＴＦＴの電圧電流特性を示す図。
【図２８】    発光素子と電流制御用ＴＦＴの電圧電流特性を示す図。
【図２９】    電流制御用ＴＦＴのゲート電圧とドレイン電流の関係を示す図。
【符号の説明】
１０１  画素部
１０２ａ  第１ソース信号線駆動回路
１０２ｂ  第２ソース信号線駆動回路
１０３ａ  第１ゲート信号線駆動回路
１０３ｂ  第２ゲート信号線駆動回路
１０４  画素
１０５    シフトレジスタ
１０６    ラッチ（Ａ）
１０７    ラッチ（Ｂ）
２０１ａ  第１スイッチング用ＴＦＴ
２０１ｂ  第２スイッチング用ＴＦＴ
２０２  電流制御用ＴＦＴ
２０３  発光素子
２０４  コンデンサ
【図１】
0004869491.tif 000005
【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【図１６】
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【図１７】
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【図１８】
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【図１９】
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【図２０】
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【図２１】
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【図２２】
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【図２３】
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【図２４】
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【図２５】
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【図２６】
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【図２７】
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【図２８】
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【図２９】
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