【手続補正書】
【提出日】平成30年9月11日(2018.9.11)
【手続補正１】
【補正対象書類名】特許請求の範囲
【補正対象項目名】全文
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
ブーストコンバータのデューティサイクルを調整するための制御回路であって、
前記ブーストコンバータに提供される入力電圧を受信することと、前記入力電圧に応答して、前記ブースターコンバータの前記出力電圧を制御するように前記ブーストコンバータの前記デューティサイクルを調整するための前記ブーストコンバータに提供されるべき制御信号を生成することとを行うように構成されたデューティサイクルリミッタジェネレータ
を備え、
ここにおいて、前記最大デューティサイクルリミットジェネレータは、
前記ブーストコンバータの前記入力電圧および出力電圧に応答して、電流を生成するための電圧電流コンバータと、
前記電流を時間測定するためのアナログタイマと、
前記時間測定された電流に応答して、最大デューティサイクル信号を生成するためのデューティサイクルリミットジェネレータと
を備える、制御回路。
【請求項２】
前記デューティサイクルリミッタジェネレータは、
前記ブーストコンバータの入力電圧に応答して、デジタル化された信号を生成するためのアナログデジタルコンバータと、
前記アナログデジタルコンバータによって生成された前記デジタル化された信号に応答して、前記ブーストコンバータの前記デューティサイクルを制限するために最大デューティサイクル信号を生成するためのデューティサイクルリミットジェネレータと
を備える、請求項１に記載の制御回路。
【請求項３】
前記最大デューティサイクルリミットジェネレータは、
前記ブーストコンバータを制御するために提供されるスイッチング信号に応答して、電流を供給するための電流枯渇型バッファと、
前記電流枯渇型バッファの前記出力と接地との間に結合されたキャパシタと、
前記デジタル化された信号に応答して、基準電圧を生成するための基準電圧選択回路と、
前記キャパシタの両端の電圧および前記基準電圧に応答して、最大デューティサイクル信号を生成するためのコンパレータと
を備える、請求項２に記載の制御回路。
【請求項４】
前記最大デューティサイクルリミットジェネレータは、前記ブーストコンバータの出力電圧に応答して、前記最大デューティサイクル信号をさらに生成する、請求項１に記載の制御回路。
【請求項５】
前記アナログタイマは、前記電流を蓄積するために前記電圧電流ジェネレータの出力に結合されたキャパシタである、請求項１に記載の制御回路。
【請求項６】
前記最大デューティサイクルリミットジェネレータは、
前記電圧電流コンバータからの前記電流に応答して、バイアス電流を生成するための可変電流源と、
前記ブーストコンバータを制御するために提供されるスイッチング信号および前記バイアス電流に応答して、バッファ電流を供給するためのバッファと、
前記電流枯渇型バッファの前記出力と接地との間に結合されたキャパシタと、
前記キャパシタの両端の電圧および基準電圧に応答して、最大デューティサイクル信号を生成するためのコンパレータと
を備える、請求項１に記載の制御回路。
【請求項７】
ブーストコンバータのデューティサイクルを調整するための方法であって、
前記ブーストコンバータに提供される入力電圧を受信することと、
前記入力電圧に応答して、前記ブースターコンバータの前記出力電圧を制御するように前記ブーストコンバータの前記デューティサイクルを調整するための前記ブーストコンバータに提供すべき制御信号を生成することと
を備え、
ここにおいて、前記制御信号を生成することは、
前記ブーストコンバータの前記入力電圧および出力電圧に応答して、電流を生成することと、
前記電流を時間測定することと、
前記時間測定された電流に応答して、最大デューティサイクル信号を生成することと
を備える、方法。
【請求項８】
制御信号を生成することは、
前記ブーストコンバータの前記入力電圧に応答して、デジタル化された信号を生成することと、
前記デジタル化された信号に応答して、前記ブーストコンバータの前記デューティサイクルを制限するために最大デューティサイクル信号を生成することと
を備える、請求項７に記載の方法。
【請求項９】
前記最大デューティサイクル信号を生成することは、
前記ブーストコンバータを制御するために提供されるスイッチング信号に応答して、電流を生成することと、
前記電流を蓄積することと、
前記デジタル化された信号に応答して、基準電圧を生成することと、
最大デューティサイクル信号を生成するために前記蓄積されたバッファ電流と前記基準電圧を比較することと
を備える、請求項９に記載の方法。
【請求項１０】
前記制御信号を生成することは、前記ブーストコンバータの前記入力電圧および出力電圧に応答して、前記制御信号を生成することをさらに備える、請求項７に記載の方法。
【請求項１１】
前記生成された電流を時間測定することは、前記生成された電流の電荷を蓄積することを備える、請求項７に記載の方法。
【請求項１２】
最大デューティサイクル信号を生成することは、
前記生成された電流に応答して、バイアス電流を生成することと、
前記ブーストコンバータを制御するために提供されるスイッチング信号および前記バイアス電流に応答してバッファ電流を生成することと、
前記バッファ電流を蓄積することと、
前記蓄積されたバッファ電流を示す電圧および基準電圧に応答して、最大デューティサイクル信号を生成するために前記蓄積されたバッファ電流および基準電圧を比較することと
を備える、請求項７に記載の方法。
【手続補正２】
【補正対象書類名】明細書
【補正対象項目名】００６１
【補正方法】変更
【補正の内容】
【００６１】
[0073]  上記の説明は、どのように特定の実施形態の態様が実現され得るかの例と共に、本開示の様々な実施形態を例示する。上記の例は、唯一の実施形態であるように見なされるべきではなく、以下の特許請求の範囲によって定義される特定の実施形態の柔軟性および利点を例示するために提示されている。上記の開示および以下の特許請求の範囲に基づいて、他の配置、実施形態、実現および同等物が、特許請求の範囲によって定義される本開示の範囲から逸脱することなく用いられ得る。
以下に本願発明の当初の特許請求の範囲に記載された発明を付記する。
［Ｃ１］
ブーストコンバータのデューティサイクルを調整するための制御回路であって、
前記ブーストコンバータに提供される入力電圧を受信することと、前記入力電圧に応答して、前記ブースターコンバータの前記出力電圧を制御するように前記ブーストコンバータの前記デューティサイクルを調整するための前記ブーストコンバータに提供されるべき制御信号を生成することとを行うように構成されたデューティサイクルリミッタジェネレータ
を備える、制御回路。
［Ｃ２］
前記デューティサイクルリミッタジェネレータは、
前記ブーストコンバータの入力電圧に応答して、デジタル化された信号を生成するためのアナログデジタルコンバータと、
前記アナログデジタルコンバータによって生成された前記デジタル化された信号に応答して、前記ブーストコンバータの前記デューティサイクルを制限するために最大デューティサイクル信号を生成するためのデューティサイクルリミットジェネレータと
を備える、Ｃ１に記載の制御回路。
［Ｃ３］
前記最大デューティサイクルリミットジェネレータは、
前記ブーストコンバータを制御するために提供されるスイッチング信号に応答して、電流を供給するための電流枯渇型バッファと、
前記電流枯渇型バッファの前記出力と接地との間に結合されたキャパシタと、
前記デジタル化された信号に応答して、基準電圧を生成するための基準電圧選択回路と、
前記キャパシタの両端の電圧および前記基準電圧に応答して、最大デューティサイクル信号を生成するためのコンパレータと
を備える、Ｃ２に記載の制御回路。
［Ｃ４］
前記最大デューティサイクルリミットジェネレータは、前記ブーストコンバータの出力電圧に応答して、前記最大デューティサイクル信号をさらに生成する、Ｃ１に記載の制御回路。
［Ｃ５］
前記最大デューティサイクルリミットジェネレータは、
前記ブーストコンバータの前記入力電圧および出力電圧に応答して、電流を生成するための電圧電流コンバータと、
前記電流を時間測定するためのアナログタイマと、
前記時間測定された電流に応答して、最大デューティサイクル信号を生成するためのデューティサイクルリミットジェネレータと
を備える、Ｃ１に記載の制御回路。
［Ｃ６］
前記アナログタイマは、前記電流を蓄積するために前記電圧電流ジェネレータの出力に結合されたキャパシタである、Ｃ５に記載の制御回路。
［Ｃ７］
前記最大デューティサイクルリミットジェネレータは、
前記電圧電流コンバータからの前記電流に応答して、バイアス電流を生成するための可変電流源と、
前記ブーストコンバータを制御するために提供されるスイッチング信号および前記バイアス電流に応答して、バッファ電流を供給するためのバッファと、
前記電流枯渇型バッファの前記出力と接地との間に結合されたキャパシタと、
前記キャパシタの両端の電圧および基準電圧に応答して、最大デューティサイクル信号を生成するためのコンパレータと
を備える、Ｃ５に記載の制御回路。
［Ｃ８］
ブーストコンバータのデューティサイクルを調整するための方法であって、
前記ブーストコンバータに提供される入力電圧を受信することと、
前記入力電圧に応答して、前記ブースターコンバータの前記出力電圧を制御するように前記ブーストコンバータの前記デューティサイクルを調整するための前記ブーストコンバータに提供すべき制御信号を生成することと
を備える、方法。
［Ｃ９］
制御信号を生成することは、
前記ブーストコンバータの前記入力電圧に応答して、デジタル化された信号を生成することと、
前記デジタル化された信号に応答して、前記ブーストコンバータの前記デューティサイクルを制限するために最大デューティサイクル信号を生成することと
を備える、Ｃ８に記載の方法。
［Ｃ１０］
前記最大デューティサイクル信号を生成することは、
前記ブーストコンバータを制御するために提供されるスイッチング信号に応答して、電流を生成することと、
前記電流を蓄積することと、
前記デジタル化された信号に応答して、基準電圧を生成することと、
最大デューティサイクル信号を生成するために前記蓄積されたバッファ電流と前記基準電圧を比較することと
を備える、Ｃ９に記載の方法。
［Ｃ１１］
前記制御信号を生成することは、前記ブーストコンバータの前記入力電圧および出力電圧に応答して、前記制御信号を生成することをさらに備える、Ｃ８に記載の方法。
［Ｃ１２］
前記制御信号を生成することは、
前記ブーストコンバータの前記入力電圧および出力電圧に応答して、電流を生成することと、
前記生成された電流を時間測定することと、
前記時間測定された電流に応答して、最大デューティサイクル信号を生成することと を備える、Ｃ８に記載の方法。
［Ｃ１３］
前記生成された電流を時間測定することは、前記生成された電流の電荷を蓄積することを備える、Ｃ１２に記載の方法。
［Ｃ１４］
最大デューティサイクル信号を生成することは、
前記生成された電流に応答して、バイアス電流を生成することと、
前記ブーストコンバータを制御するために提供されるスイッチング信号および前記バイアス電流に応答してバッファ電流を生成することと、
前記バッファ電流を蓄積することと、
前記蓄積されたバッファ電流を示す電圧および基準電圧に応答して、最大デューティサイクル信号を生成するために前記蓄積されたバッファ電流および基準電圧を比較することと
を備える、Ｃ１２に記載の方法。
［Ｃ１５］
ブーストコンバータのデューティサイクルを調整するための制御回路であって、
前記ブーストコンバータに提供される入力電圧を受信するための手段と、
前記入力電圧に応答して、前記ブースターコンバータの前記出力電圧を制御するように前記ブーストコンバータの前記デューティサイクルを調整するための前記ブーストコンバータに提供すべき制御信号を生成するための手段と
を備える、制御回路。
［Ｃ１６］
制御信号を生成するための前記手段は、
前記ブーストコンバータの前記入力電圧に応答して、デジタル化された信号を生成するための手段と、
前記デジタル化された信号に応答して、前記ブーストコンバータの前記デューティサイクルを制限するために最大デューティサイクル信号を生成するための手段と
を備える、Ｃ１５に記載の制御回路。
［Ｃ１７］
前記最大デューティサイクル信号を生成するための前記手段は、
前記ブーストコンバータを制御するために提供されるスイッチング信号に応答して、電流を生成するための手段と、
前記電流を蓄積するための手段と、
前記デジタル化された信号に応答して、基準電圧を生成するための手段と、
最大デューティサイクル信号を生成するために前記蓄積されたバッファ電流と前記基準電圧を比較するための手段と
を備える、Ｃ１６に記載の制御回路。
［Ｃ１８］
前記制御信号を生成するための前記手段は、前記ブーストコンバータの前記入力電圧および出力電圧に応答して、前記制御信号を生成するための手段をさらに備える、Ｃ１５に記載の制御回路。
［Ｃ１９］
前記制御信号を生成するための前記手段は、 
前記ブーストコンバータの前記入力電圧および出力電圧に応答して、電流を生成するための手段と、
前記生成された電流を時間測定するための手段と、 
前記時間測定された電流に応答して、最大デューティサイクル信号を生成するための手段と
を備える、Ｃ１５に記載の制御回路。
［Ｃ２０］
前記生成された電流を時間測定するための前記手段は、前記生成された電流の電荷を蓄積するための手段を備える、Ｃ１９に記載の制御回路。