(57)【特許請求の範囲】
【請求項１】
入力された信号を濾波して出力するフィルタと、
一定周期の基準信号を生成して出力するテスト信号生成部と、
外部から与える信号と前記テスト信号とを与えて選択信号によって選択した信号を前記フィルタに与える信号選択部と、
前記テスト信号を前記フィルタに与えたこのフィルタの出力信号と前記テスト信号とを与えて位相比較した結果に応じて、前記フィルタの周波数特性を異ならせる制御信号を出力する制御信号生成部と、
を備え、
前記フィルタは、４次関数のフィルタ特性を用いて、入力信号に対する出力信号の位相差が前記テスト信号の周波数において１８０度となる特性を有するものであり、
前記制御信号生成部は、
前記フィルタから出力されるフィルタ出力信号を与えて２値信号にして出力する第１のコンパレータと、
前記テスト信号を与えて２値信号にして出力する第２のコンパレータと、
前記第１，第２のコンパレータそれぞれから出力される２値信号の位相比較を行う位相比較器と、
前記位相比較器からの出力と前記第２のコンパレータからの出力とを用いて、前記制御信号を生成するロジック部と、を備えたものであり、
前記ロジック部は、
前記位相比較器からの出力と、前記第２のコンパレータの出力とを入力とし、該第２のコンパレータの出力の立ち上がりあるいは立ち下りのタイミングで、前記位相比較器からの出力を二分岐探索する二分岐探索処理部と、
該二分岐探索処理部において得た値に基づいて前記制御信号を生成する制御信号決定部と、を備えたものである、
ことを特徴とするフィルタの特性調整装置。
【請求項２】
請求項１に記載のフィルタの特性調整装置において、
前記テスト信号はパルス信号である、
ことを特徴とするフィルタの特性調整装置。
【請求項３】
請求項１に記載のフィルタの特性調整装置において、
前記テスト信号は、前記フィルタのカットオフ周波数と同一の周波数の信号である、
ことを特徴とするフィルタの特性調整装置。
【請求項４】
請求項１に記載のフィルタの特性調整装置において、
特性調整対象のフィルタは、４次バタワースフィルタの周波数特性を有するものである、
ことを特徴とするフィルタの特性調整装置。
【請求項５】
フィルタの特性周波数を制御するフィルタの特性調整方法において、
入力された信号を濾波して出力するフィルタステップと、
一定周期の基準信号を生成して出力するテスト信号生成ステップと、
外部から与える信号と前記テスト信号とを与えて選択信号によって選択した信号を前記フィルタステップに与える信号選択ステップと、
前記テスト信号を前記フィルタステップに与えたこのフィルタステップの出力信号と前記テスト信号とを与えて位相比較した結果に応じて、前記フィルタの周波数特性を異ならせる制御信号を出力する制御信号生成ステップと、
を含み、
前記フィルタステップは、４次関数のフィルタ特性を用いて、入力信号に対する出力信号の位相差が前記テスト信号の周波数において１８０度となる特性を有するものであり、
前記制御信号生成ステップは、
前記フィルタステップから出力されるフィルタ出力信号を与えて２値信号にして出力する第１のコンパレータステップと、
前記テスト信号を与えて２値信号にして出力する第２のコンパレータステップと、
前記第１，第２のコンパレータステップそれぞれから出力される２値信号の位相比較を行う位相比較ステップと、
前記位相比較ステップからの出力と前記第２のコンパレータからの出力とを用いて、前記制御信号を生成するロジックステップと、を有するものであり、
前記ロジックステップは、
前記位相比較ステップからの出力と、前記第２のコンパレータステップの出力とを入力とし、該第２のコンパレータステップの出力の立ち上がりあるいは立ち下りのタイミングで、前記位相比較ステップからの出力を二分岐探索する二分岐探索処理ステップと、
該二分岐探索処理ステップにおいて得た値に基づいて前記制御信号を生成する制御信号決定ステップと、を有するものである、
ことを特徴とするフィルタの特性調整方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、フィルタの特性周波数を調整する特性調整装置、及びその特性調整方法に関する。
【背景技術】
【０００２】
フィルタは、MOSFET-CフィルタやGm-Cフィルタで構成されることが多い。これは、MOSFET-CフィルタやGm-Cフィルタが演算増幅器を用いないフィルタであるため、高速化が可能であるという利点があるからである。
【０００３】
しかし、前述したようなアナログフィルタでは、該フィルタを構成する素子値のばらつきや、温度変動に起因して、フィルタ特性の劣化を起こす問題が存在する。例えば、低域通過型のフィルタの場合、該フィルタの特性周波数であるカットオフ周波数がその設計値と実際の値との間に誤差を生ずる。この誤差を解消するため、従来では、フィルタを有する装置内に、フィルタとは別にVoltage Controlled Oscillator（以下、「ＶＣＯ」と称す。）を含むＰＬＬ回路を設け、該ＰＬＬ回路を用いてマスタ／スレーブ方式と呼ばれる方式で前記フィルタ特性を調整したり（例えば非特許文献１参照）、あるいは、実動作で使用するフィルタそのものを用いて該フィルタの特性を調整したりする手法が用いられてきた（例えば特許文献１参照）。
【０００４】
以下に、従来のフィルタの特性調整方法について詳述する。
【０００５】
従来のマスタ／スレーブ方式のフィルタ特性調整装置３００は、図１５に示すように、フィルタ１０をスレーブ側とし、ＰＬＬ回路６０に含まれるＶＣＯ６１をマスタ側とする。マスタ側であるＰＬＬ回路６０は、基準クロックｓ６２に基づいて発振するＶＣＯ６１と、該ＶＣＯ６１から出力される発振信号ｓ６４の周波数を測定する発振周波数測定部６２と、該発振周波数測定部６２からの出力信号に基づいてフィルタ１０を制御する制御信号ｓ６１を生成する制御部６３とを備える。但し、ＶＣＯ６１の発振周波数とフィルタ１０の特性周波数とは比例関係にあるものとする。このような構成を有するフィルタ特性調整装置３００は、マスタ側であるＰＬＬ回路６０内において、ＶＣＯ６１の発振波形ｓ６４を発振周波数測定部６２に入力し、そこで測定された周波数の情報を元に、制御部６３でフィルタ１０の特性周波数を制御する制御信号ｓ６１を生成し、ＶＣＯ６１及びフィルタ１０のＧｍ値を制御することで、フィルタ１０の周波数特性を自動的に調整することを実現している（例えば、非特許文献１参照）。
【０００６】
また従来の、通常動作で使用するフィルタそのものを用いたフィルタ特性調整装置４００は、図１６に示すように、フィルタ１０のチューニング動作時に使用するステップ信号ｓ７４を生成するステップ信号生成部７７と、前記フィルタ１０に入力する信号を選択信号ｓ７２に基づいて選択する信号選択部７１と、フィルタ１０から出力されるフィルタ出力信号ｓ７６をカウントすることでその周波数を測定する応答波形周期測定部７４と、該応答波形周期測定部７４から出力される測定信号ｓ７８が基準の周波数の範囲内に収まるように制御する特性周波数制御信号ｓ７１を生成する制御部７８とを備える。このフィルタ１０は、通常動作とチューニング動作の両方に使用されるため、フィルタ特性調整装置４００は、フィルタ１０の通常動作時には、入力信号として通常信号ｓ７３を信号選択部７１にて選択して、フィルタ１０にこれを入力し、フィルタ１０は、該フィルタ入力信号ｓ７５に対する応答波形であるフィルタ出力信号ｓ７６を出力する。一方、フィルタ１０のチューニング動作時には、フィルタ１０に対してステップ信号ｓ７４を直接入力し、該ステップ信号ｓ７４に対するフィルタ１０の応答波形の周期を応答波形周期測定部７４で測定し、制御部７８によりフィルタ１０の特性周波数を所望の周波数に自動的に調整することを実現している（例えば、特許文献１参照)。
【非特許文献１】ケー．タン  アンドピー．アール．グレイ（K.Tan and P.R.Gray）:「フルリー  インテグレイテッド  アナログ  フィルターズ  ユージング  ビポラー−ジェイエフイーティー  テクノロジィ（Fully Integrated Analog Filters Using Bipolar-JFET Technology）」，アイイーイーイー  ジェイエスエスシー（IEEE JSSC），１９７８年１２月
【特許文献１】特開２０００−５９１６２号公報（第４−７頁、第１図）
【発明の開示】
【発明が解決しようとする課題】
【０００７】
しかしながら、前述したマスタ／スレーブ方式の場合、通常使用するＶＣＯ６１の次数は２次で、一方の制御対象であるフィルタ１０の次数はそれ以上であることが多い。図１７は、互いに次数が異なる低域通過型フィルタ及びＶＣＯの周波数特性を示す図である。図１７に示すように、ＶＣＯも低域通過型フィルタとしての特性を持つ。次数の低いＶＣＯ６１は次数の高い低域通過型フィルタに比べてカットオフ周波数付近でゲインの立ち下がりが鈍く、また次数の低いフィルタの位相特性は次数の高いフィルタに比べてゆっくりと変化する。
【０００８】
従って、例えば、マスタ／スレーブ方式の特性調整装置３００でフィルタ１０のチューニングを行った後に、フィルタの特性周波数を制御する制御信号ｓ６１が多少なりとも最適点から外れて、ＶＣＯ６１で位相誤差ΔＰ１が生じた場合、図１８に示すように、フィルタ１０では、前記位相誤差ΔＰ１よりも大きな位相誤差ΔＰ２が生じ、この結果フィルタの特性周波数がずれてしまうという問題がある。
【０００９】
そのため、マスタ／スレーブ方式においては、フィルタ１０とＶＣＯ６１との間の相対ばらつきに起因する、最適なチューニング状態からのフィルタ特性のズレを抑えるために、別途、前記誤差を修正するための回路が必要となり、これにより、回路規模が大きくなっているという問題もある。
【００１０】
また、マスタ／スレーブ方式では、フィルタ１０の特性周波数とＶＣＯ６１の発振周波数の設計上設定された相関と、実際の相関が異なるという問題もある。
【００１１】
一方、前述した従来のフィルタ１０を直接チューニングに用いる手法では、応答波形周期測定部７４において、フィルタ１０の周波数測定時に、前記フィルタ１０の特性周波数よりも高いサンプリング周波数が必要である。
【００１２】
また、応答波形周期測定部７４におけるフィルタ１０の周波数測定は、ステップ信号ｓ７４に対するフィルタ１０からの応答波形と基準レベルとを図示しないコンパレータで比較し、該コンパレータの出力波形の立ち上がり遷移もしくは立ち下がり遷移の周期を測定するのであるが、特性調整対象のフィルタ１０の次数によっては通過帯域のゲイン特性が大きく変動するために、コンパレータにて正しく比較できず、これにより調整誤差が生じる問題もある。そして、このような調整誤差を防ぐためには、別途、誤差を調整するための調整手段が必要となり、回路規模が大きくなってしまう。
【００１３】
さらに、従来の方法では、フィルタ１０の特性周波数が所望の周波数の誤差範囲となるまで、制御信号の値を変更しながら何度もステップ信号ｓ７４を生成してフィルタ１０に入力し、応答波形周期測定部７４において該フィルタ１０からのフィルタ出力信号ｓ７６を測定して誤差の判定を行うことを繰り返すものであるため、フィルタの調整に時間がかかるという問題もある。
【００１４】
本発明は、前記課題を解決するためになされたものであり、フィルタの特性調整装置の回路規模の増大、すなわち回路面積の増大を防止し、且つより高速にフィルタの特性周波数を所望の周波数に調整できる、フィルタの特性調整装置、及びその特性調整方法を提供することを目的とする。
【課題を解決するための手段】
【００１５】
前記課題を解決するため、本発明の請求項１に記載のフィルタの特性調整装置は、入力された信号を濾波して出力するフィルタと、一定周期の基準信号を生成して出力するテスト信号生成部と、外部から与える信号と前記テスト信号とを与えて選択信号によって選択した信号を前記フィルタに与える信号選択部と、前記テスト信号を前記フィルタに与えたこのフィルタの出力信号と前記テスト信号とを与えて位相比較した結果に応じて、前記フィルタの周波数特性を異ならせる制御信号を出力する制御信号生成部と、を備え、前記フィルタは、４次関数のフィルタ特性を用いて、入力信号に対する出力信号の位相差が前記テスト信号の周波数において１８０度となる特性を有するものであり、前記制御信号生成部は、前記フィルタから出力されるフィルタ出力信号を与えて２値信号にして出力する第１のコンパレータと、前記テスト信号を与えて２値信号にして出力する第２のコンパレータと、前記第１，第２のコンパレータそれぞれから出力される２値信号の位相比較を行う位相比較器と、前記位相比較器からの出力と前記第２のコンパレータからの出力とを用いて、前記制御信号を生成するロジック部と、を備えたものであり、前記ロジック部は、前記位相比較器からの出力と、前記第２のコンパレータの出力とを入力とし、該第２のコンパレータの出力の立ち上がりあるいは立ち下りのタイミングで、前記位相比較器からの出力を二分岐探索する二分岐探索処理部と、該二分岐探索処理部において得た値に基づいて前記制御信号を生成する制御信号決定部と、を備えたものである、ことを特徴とするものである。
【００１６】
これにより、前記フィルタの特性調整時に、テスト信号生成部にて生成されたテスト信号の位相をシフトさせた信号の立ち上がりあるいは立ち下がりのタイミングで、フィルタ出力信号を検知し、その結果に基づいてフィルタの周波数特性を制御する制御信号を生成することが可能となるため、例えば、テスト信号から位相をシフトされた信号と、前記フィルタからのフィルタ出力信号との位相比較結果に基づいて、フィルタの周波数特性を制御する制御信号を生成することが可能となるため、フィルタの特性調整を短時間で行なうことができ、且つ当該フィルタの特性調整装置の構成をシンプルなものとし、且つその回路面積も小さくすることができるとともに、フィルタの特性周波数を制御する制御信号を二分岐探索により検出することが可能となり、前記フィルタの特性調整処理を短時間で行なうことができるとともに、前記フィルタの通常動作時とチューニング動作時に同じフィルタを用いることができるとともに、別途、ＶＣＯやＰＬＬといった調整手段を必要とせず、当該装置の面積を小さくすることができ、位相シフト部を設ける必要がなくなり、特性調整装置の回路面積をさらに小さくすることができる。
【００１９】
また、本発明の請求項２に記載のフィルタの特性調整装置は、請求項１に記載のフィルタの特性調整装置において、前記テスト信号はパルス信号である、ことを特徴とするものである。
【００２０】
これにより、フィルタの位相差を連続して計測できるため、該特性調整処理を短時間で行なうことができる。
【００２１】
また、本発明の請求項３に記載のフィルタの特性調整装置は、請求項１に記載のフィルタの特性調整装置において、前記テスト信号は、前記フィルタのカットオフ周波数と同一の周波数の信号であることを特徴とするものである。
【００２２】
これにより、フィルタの位相シフト量の設定がしやすい効果がある。
【００２３】
また、本発明の請求項４に記載のフィルタの特性調整装置は、請求項１に記載のフィルタの特性調整装置において、前記フィルタは、４次バタワースフィルタの周波数特性を有するものであることを特徴するものである。
【００２４】
これにより、位相シフト部を設ける必要がなくなり、特性調整装置の回路面積をさらに小さくすることができる。
【００２５】
また、本発明の請求項５に記載のフィルタの特性調整方法は、入力された信号を濾波して出力するフィルタステップと、一定周期の基準信号を生成して出力するテスト信号生成ステップと、外部から与える信号と前記テスト信号とを与えて選択信号によって選択した信号を前記フィルタステップに与える信号選択ステップと、前記テスト信号を前記フィルタステップに与えたこのフィルタステップの出力信号と前記テスト信号とを与えて位相比較した結果に応じて、前記フィルタの周波数特性を異ならせる制御信号を出力する制御信号生成ステップと、を含み、前記フィルタステップは、４次関数のフィルタ特性を用いて、入力信号に対する出力信号の位相差が前記テスト信号の周波数において１８０度となる特性を有するものであり、前記制御信号生成ステップは、前記フィルタステップから出力されるフィルタ出力信号を与えて２値信号にして出力する第１のコンパレータステップと、前記テスト信号を与えて２値信号にして出力する第２のコンパレータステップと、前記第１，第２のコンパレータステップそれぞれから出力される２値信号の位相比較を行う位相比較ステップと、前記位相比較ステップからの出力と前記第２のコンパレータからの出力とを用いて、前記制御信号を生成するロジックステップと、を有するものであり、前記ロジックステップは、前記位相比較ステップからの出力と、前記第２のコンパレータステップの出力とを入力とし、該第２のコンパレータステップの出力の立ち上がりあるいは立ち下りのタイミングで、前記位相比較ステップからの出力を二分岐探索する二分岐探索処理ステップと、該二分岐探索処理ステップにおいて得た値に基づいて前記制御信号を生成する制御信号決定ステップと、を有することを特徴とするものである。
【００２６】
これにより、前記フィルタの特性調整時に、テスト信号生成ステップにて生成されたテスト信号の位相をシフトさせた信号の立ち上がりあるいは立ち下がりのタイミングで、フィルタ出力信号を検知し、その結果に基づいてフィルタの周波数特性を制御する制御信号を生成することが可能となるため、例えば、テスト信号から位相をシフトされた信号と、前記フィルタからのフィルタ出力信号との位相比較結果に基づいて、フィルタの周波数特性を制御する制御信号を生成することが可能となるため、前記フィルタの通常動作時とチューニング動作時に同じフィルタを用いることができるとともに、フィルタの特性調整を短時間で行なうことができる。
【発明の効果】
【００３５】
本発明のフィルタの特性調整装置によれば、前記フィルタの特性調整時に前記テスト信号の位相を所定量シフトする位相シフト部を備え、前記フィルタからの出力と前記位相シフト部の出力との位相差に基づいて、制御信号を生成するようにしたので、フィルタの特性調整処理を高速化することができる。
【００３６】
また、本発明のフィルタの特性調整装置によれば、特にフィルタの特性周波数を最適な状態とするために、フィルタの通常動作時とチューニング動作時に、同じフィルタを用いるようにしたので、別途、ＰＬＬ回路、あるいはＶＣＯなどを必要としないために、その回路面積の増大を防ぐことが可能となる。
【００３７】
また、本発明のフィルタの特性調整装置によれば、前記フィルタの制御信号生成部は、位相シフト部において、テスト信号と、特性調整後の最適な状態にあるフィルタにテスト信号を入力した際に得られる理想のフィルタ出力信号との位相差が１８０°となるように、前記テスト信号の位相をシフトさせ、該位相をシフトされたテスト信号とフィルタ出力信号との位相差を二分岐探索を用いたデジタル処理によって生成するようにしたので、短時間で制御信号を生成できると共に、当該フィルタの特性調整装置の構成をシンプルなものとし、且つ小面積で実現することが可能となる。
【００３８】
また、本発明のフィルタの特性調整装置によれば、フィルタが特に４次バタワース低域通過型フィルタ、あるいは４次バタワース高域通過型フィルタであれば、該フィルタに入力される信号の周波数がその特性周波数と同じ周波数のとき、位相特性は理論上１８０°回転するので、位相シフト部を設ける必要がなくなる。このため、特性調整装置の構成をよりシンプルで、且つ小面積にすることができる。
【発明を実施するための最良の形態】
【００３９】
（実施の形態１）
以下、図面を用いて、本発明の実施の形態１について説明する。
【００４０】
図１は、本実施の形態１にかかるフィルタの特性調整装置の構成を示す図である。図１において、フィルタの特性調整装置１００は、フィルタ１０と、選択信号ｓ１２に基づいて前記フィルタ１０に入力するフィルタ入力信号ｓ１５を選択する信号選択部２０と、基準信号ｓ１７に基づいて前記フィルタ１０の特性を調整する制御信号ｓ１１を出力するフィルタ特性制御部３０とを備える。前記信号選択部２０には、当該フィルタの特性調整装置１００が通常動作時（以下、「通常モード時」と称す。）である場合に処理対象となる通常入力信号ｓ１３と、前記フィルタ特性制御部３０で生成されたテスト信号ｓ１４とが入力され、選択信号ｓ１２に基づいて、前記通常入力信号ｓ１３と、テスト信号ｓ１４とのいずれか一方が前記フィルタ入力信号ｓ１５として選択されて、フィルタ１０に入力される。具体的に述べると、フィルタの特性調整装置１００が通常モード時である場合は、前記信号選択部２０は、前記通常入力信号ｓ１３を選択してフィルタ１０に入力し、一方当該フィルタ特性調整装置１００が特性調整時（以下、「チューニングモード時」と称す。）である場合は、前記テスト信号ｓ１４を選択してフィルタ１０に入力する。この選択信号ｓ１２は、当該装置１００外部で独立に調整されて入力されるものであってもよいし、前記フィルタ特性制御部３０から出力されるものであってもよい。
【００４１】
図２は、本実施の形態１の特性調整装置１００におけるフィルタ特性制御部３０の詳細な構成を示す図である。なお、図２は、チューニングモード時に必要な構成のみを示している。図２において、フィルタ特性制御部３０は、基準信号ｓ１７からテスト信号ｓ１４を生成するテスト信号生成部３１と、前記テスト信号ｓ１４の位相をフィルタ１０の位相特性に応じてシフトさせる位相シフト部３２と、該位相シフト部３２から出力される位相シフトテスト信号ｓ１４’と、前記フィルタ１０から出力されるフィルタ出力信号ｓ１６とを入力とし、フィルタ１０の周波数特性の制御を行なう制御信号ｓ１１を生成する制御信号生成部３３とからなる。
【００４２】
さらに、図３は、前記フィルタ特性制御部３０内の制御信号生成部３３の詳細な構成を示す図である。図３において、制御信号生成部３３は、前記フィルタ出力信号ｓ１６を、前記テスト信号ｓ１４の中心値を基準として２値化した第１の２値信号ｓ３４を生成する第１のコンパレータ３４と、前記位相シフトテスト信号ｓ１４’を前記テスト信号ｓ１４の中心値を基準として２値化した第２の２値信号ｓ３５を生成する第２のコンパレータ３５と、前記第１の２値信号ｓ３４と第２の２値信号ｓ３５とを位相比較し、該位相比較結果ｓ３６を出力する位相比較器３６と、該比較結果ｓ３６と前記第２の２値信号ｓ３５とを用いて前記制御信号ｓ１１を生成するロジック部３７とを備えるものである。
【００４３】
なお、ここでは、前記テスト信号ｓ１４の中心値が、前記第１，第２のコンパレータ３４，３５での比較で用いられるしきい値としての基準信号となっている。また、前記位相シフトテスト信号ｓ１４’がすでに２値化信号であるにもかかわらず、第２のコンパレータ３５を設けている理由は、前記第１の２値信号ｓ３４と第２の２値信号ｓ３５とを同じタイミングで後段の位相比較器３６に入力させるためである。
【００４４】
次に、動作について説明する。
【００４５】
まず、図４を用いて、フィルタ１０の通常動作について説明する。図４は、本実施の形態１のフィルタの通常モード時と等価な構成を示す図である。
【００４６】
前記フィルタ１０は、後述するフィルタの特性調整動作によって、該フィルタ１０の制御信号ｓ１１が生成された後に、通常モードの状態となる。このとき、前述したように、信号選択部２０では、前記選択信号ｓ１２に基づいて前記通常入力信号ｓ１３が選択され、フィルタ１０に入力される。
【００４７】
そして、図４に示すように、通常モード時には、その特性周波数が制御され固定されたフィルタ１０に通常入力信号ｓ１３が入力され、その応答波形がフィルタ出力信号ｓ１６として出力される。
【００４８】
次に、図２、図５、図６を参照しながら、フィルタ１０の特性調整動作について説明する。図５は、本実施の形態１におけるフィルタの特性調整装置のチューニングモード時のフローチャートであり、図６は、本実施の形態１のフィルタの特性調整装置における制御信号生成部の信号波形図である。
【００４９】
まず、フィルタの特性調整装置１００をチューニングモードにする（ステップＳ１）。具体的には、図１に示す信号選択部２０において、選択信号ｓ１２によりテスト信号ｓ１４が選択されるように設定し、ロジック部３７に初期値Ｃ０を設定する。なお、ロジック部３７の構成及びその具体的な処理については後述する。
【００５０】
そして、前記テスト信号ｓ１４を生成する（ステップＳ２）。前記テスト信号ｓ１４は、前記フィルタ特性制御部３０内のテスト信号生成部３１において、基準信号ｓ１７に基づいて生成される。ここでは、前記テスト信号ｓ１４が、図６（ａ）に示されるようなパルス信号で、フィルタ１０の特性周波数と同じ周波数の信号であるものとする。なお、この時テスト信号ｓ１４は、フィルタ１０のダイナミックレンジに収まるようにその振幅を制限される。
【００５１】
そして、前記テスト信号ｓ１４はフィルタ１０へ出力されるとともに、位相シフト部３２へ出力される（ステップＳ３）。
【００５２】
前記フィルタ１０は、テスト信号ｓ１４を入力とし、フィルタ出力信号ｓ１６を出力する。
【００５３】
一方、位相シフト部３２は、テスト信号ｓ１４を入力とし、その位相をシフトさせて位相シフトテスト信号ｓ１４’を出力する。ここで、前記位相シフト部３２における位相シフト量は、次のように設定される。すなわち、周波数特性を調整済みのフィルタ１０に前記テスト信号ｓ１４を入力した際に、該フィルタ１０から出力される理想のフィルタ出力信号ｓ１６と、前記位相シフト部３２から出力される位相シフトテスト信号ｓ１４’との位相差が１８０°となるように、位相シフト量が設定される。この位相シフト量の設定は、図１７に示したように、フィルタ１０の位相特性により、入力されるテスト信号の周波数が決定していれば、前記理想のフィルタ出力信号の位相シフト量が予め分かるため、該位相シフト量に基づいて、テスト信号ｓ１４をシフトさせる位相量を設定すればよい。
【００５４】
例えば、前記フィルタ１０が２次バタワース低域通過型フィルタである場合を例に挙げて説明する。図７は、２次バタワース低域通過型フィルタのゲイン特性、及び周波数特性を示す。
【００５５】
２次バタワース低域通過型フィルタの場合、図７に示されるように、該フィルタに入力される信号の周波数がその特性周波数ｆｃに一致するとすれば、該フィルタから出力される応答波形の位相は入力信号より９０°だけシフトする（図６（ａ），（ｂ）参照）。従って、フィルタ１０に対して、特性周波数ｆｃと同じ周波数のテスト信号ｓ１４が入力されると、該フィルタ１０から出力されるフィルタ出力信号ｓ１６は、フィルタ１０の特性が最適であった場合、テスト信号ｓ１４より位相が９０°シフトされて出力される、理想のフィルタ出力となるはずであるから、位相シフト部３２でシフトさせる位相シフト量として−９０°を設定する。
【００５６】
そして、前記フィルタ１０から出力されたフィルタ出力信号ｓ１６と、前記位相シフト部３２にて位相シフトされた位相シフトテスト信号ｓ１４’は、制御信号生成部３３に入力され、該フィルタ出力信号ｓ１６と位相シフトテスト信号ｓ１４’とを位相比較し（ステップＳ５）、該位相比較された結果に基づいて、該フィルタ１０の周波数特性を制御する制御信号ｓ１１を生成する（ステップＳ６）。
【００５７】
以下、制御信号生成部３３について詳細に述べる。
【００５８】
まず、前記フィルタ出力信号ｓ１６は、第１のコンパレータ３４に、また前記位相シフトテスト信号ｓ１４’は第２のコンパレータ３５に入力される。前記第１，第２のコンパレータ３４、３５は、テスト信号ｓ１４の中心値を基準に、前記フィルタ出力信号ｓ１６及び位相シフトテスト信号ｓ１４’を２値化し、それぞれ第１，第２の２値信号ｓ３４，ｓ３５として出力する（図６（ｂ），（ｃ）参照）。ここでは、前記各コンパレータ３４、３５は、各信号のレベルがテスト信号の中心値よりも低い場合は“Ｌ”レベル、高い場合は“Ｈ”レベルを出力するものとする。
【００５９】
そして、位相比較器３６において、前記第１，第２の２値信号ｓ３４，ｓ３５の位相を比較し、位相比較結果ｓ３６を出力する。前記位相比較器３６は、例えばフリップフロップによって実現され、前記第２の２値信号ｓ３５をクロックとして、該第２の２値信号ｓ３５の立ち上がりエッジあるいは立ち下りエッジ（図６では立ち上がりエッジ）で、前記第１の２値信号ｓ３４をラッチし、その際、第１の２値信号ｓ３４のレベルが“Ｈ”レベルであれば“Ｈ”レベルを、“Ｌ”レベルであれば“Ｌ”レベルを出力する（図６（ｅ）参照）。
【００６０】
図６の関係では、フィルタ１０が最適な状態にある場合、第１の２値信号ｓ３４（フィルタ出力信号のデジタル値）と、第２の２値信号ｓ３５（位相シフトテスト信号のデジタル値）とは、図６（ｂ），（ｄ）に示す関係と同様の関係になるはずであるため、該理想とする第１の２値信号（図６（ｄ））に比べて第１の２値信号ｓ３４の位相が進んでいる場合は“Ｈ”レベル、位相が遅れている場合は“Ｌ”レベルとする信号ｓ３６を出力する。
【００６１】
そして、ロジック部３７において、前記位相比較結果ｓ３６の状態をもとに、ステップＳ１において初期値Ｃ０に設定された制御信号ｓ１１を微調整する。
【００６２】
ここでは、位相比較結果ｓ３６が“Ｈ”レベルの場合に制御信号ｓ１１の値を下げる方向へ、位相比較結果ｓ３６が“Ｌ”レベルの場合に制御信号ｓ１１の値を上げる方向に微調整する。微調整する期間は、前記第２の２値信号ｓ３５がｎ回（ｎは１以上の整数）カウントされる所定の期間とする。つまり、前記カウント数ｎが多ければ、フィルタの調整に長時間がかかるが、フィルタの特性調整の精度は向上し、一方カウント数ｎが少なければ、フィルタの調整は短時間ですむが、フィルタの特性調整の精度は下がる。
【００６３】
ロジック部３７は、例えば、図８に示すような構成で実現できる。図８は、ロジック部の詳細な構成の一例を示す図であり、図９は、ロジック部の二分岐探索処理部の処理を説明する図であり、図１０は、ロジック部の制御信号決定部の処理を説明する図である。
【００６４】
図８に示すように、ロジック部３７は、位相比較結果ｓ３６を、第２の２値信号ｓ３５をクロックとして二分岐探索処理する二分岐探索処理部３８と、該二分岐探索処理部３８で生成されたｎビットの制御レジスタ値Ｃｎに応じて、制御信号ｓ１１の値を決定する制御信号決定部３９とからなる。
【００６５】
二分岐探索処理部３８には、前述したように図５のステップＳ１において初期値Ｃ０が設定される。初期値Ｃ０は、最上位の１ビットのみ“１”で、他の下位ビットは全て“０”となっている（図９のStep0）。
【００６６】
この後、前記第２の２値信号ｓ３５の立ち上がりエッジもしくは立ち下がりのエッジのタイミング毎（図６では立ち上がりエッジタイミング）に、位相比較結果ｓ３６の情報をモニタしていく。具体的には、前記第２の２値信号ｓ３５の立ち上がりエッジのタイミング時に、制御レジスタ値Ｃ０の最上位ビットを、位相比較結果ｓ３６の状態が“Ｈ”レベルなら“１”を、“Ｌ”レベルなら“０”に設定し、最上位ビットの１つ下位のビットを“１”とした制御レジスタＣ１を生成する（図９のStep1）。
【００６７】
そして、第２の２値信号ｓ３５の次の立ち上がりエッジのタイミング時に、制御レジスタ値Ｃ１の最上位ビットの１つ下位のビットを、位相比較結果ｓ３６が“Ｈ”レベルなら“１”に、“Ｌ”レベルなら“０”に設定し、最上位ビットの２つ下位のビットを“１”とした制御レジスタＣ２を生成する（図９のStep2）。
【００６８】
以下、同様に、ｎビットの制御レジスタ値Ｃｎの第（ｎ−ｉ＋１）ビット（但し、ｉはStepの回数を示し、１≦ｉ≦ｎを満たす整数である。）の値の二分岐探索動作、すなわち、制御レジスタ値Ｃｎの第（ｎ−ｉ＋１）ビットを位相比較結果ｓ３６の状態に応じて“１”あるいは“０”に決定する動作、をｎ回目まで順次続けることにより、制御レジスタ値Ｃｎを得る（図９のStep(n)）。なお、図９中の“＊”は、そのビットが“１”あるいは“０”のいずれかの値であることを示す。
【００６９】
以上の動作を行うことにより、例えば、図６の関係では、制御レジスタ値Ｃ７＝“１１１１１０１”が得られる。
【００７０】
そして、前述のようにして得られた制御レジスタ値Ｃｎは、制御信号決定部３９に入力される。そして該制御信号決定部３９において、前記制御レジスタ値Ｃｎに対応する制御信号ｓ１１の値が決定される。制御信号ｓ１１と制御レジスタ値Ｃｎとは、図１０に示されるように、１対１の関係となっており、制御レジスタ値Ｃｎが“０００…００”で最小の時は制御信号ｓ１１の値も最小となり、制御レジスタ信号Ｃｎが“１１１…１１”で最大の時は制御信号ｓ１１の値も最大となる。なお、通常、図１０に示されるように、制御レジスタ値の初期値Ｃ０は、制御信号ｓ１１の値のセンター値に対応する。また、制御レジスタ値Ｃｎのビット数によって、前記二分岐探索処理部３８でのStep数が変化するため、フィルタ１０の周波数特性の調整時間は制約されることがわかる。
【００７１】
このようにして決定された制御信号ｓ１１により、フィルタ１０の特性周波数を制御し、フィルタ１０の特性周波数は決定される。
【００７２】
チューニング動作が終了すると、フィルタの特性調整装置１００は通常モード状態となり、信号選択部２０にて選択信号ｓ１２に基づいて通常入力信号ｓ１３が選択され、フィルタ１０前後の信号の流れは、前述した図４に示す通りとなる。
【００７３】
なおフィルタ１０が差動構成の場合であっても、前述と同様のチューニング動作が適用できる。この場合、前記第１,第２のコンパレータ３４，３５には差動信号が入力される構成となり、差動信号の一方を基準として同様に処理することができる。
【００７４】
以上のように、本実施の形態１によれば、通常動作時に使用するフィルタ１０に、周波数特性を調整済みとなった状態での該フィルタの特性周波数と等しい周波数のテスト信号ｓ１４を直接入力し、該フィルタ１０の特性周波数が設計値と等しくなるように調整するようにしたので、別途ＶＣＯやＰＬＬ回路を設ける必要がなくなり、フィルタの特性調整装置１００の回路規模をかなり小さくすることができる。
【００７５】
また、本実施の形態１によれば、フィルタ１０の特性を調整するフィルタ特性制御部３０に、テスト信号ｓ１４の位相を所定量シフトさせる位相シフト部３２を設け、該位相シフト部３２で位相をシフトさせた位相シフトテスト信号ｓ１４’と、前記テスト信号ｓ１４をフィルタ１０に入力して得たフィルタ出力信号ｓ１６とから、該フィルタ１０の周波数特性を制御する制御信号ｓ１１を生成するようにしたので、フィルタ１０の周波数を測定する際に、別途該フィルタ１０の特性周波数より高いサンプリング周波数を発生させてクロックとして使用する必要がなく、フィルタの特性調整装置１００の回路規模をさらに小さくできる効果がある。
【００７６】
また、本実施の形態１によれば、前記位相シフト部３２において、フィルタ１０の周波数特性が最適な状態にあるとした際に、前記テスト信号ｓ１４を位相シフトさせた位相シフトテスト信号ｓ１４’と、前記フィルタ出力信号ｓ１６との位相差が１８０°となるように、前記テスト信号ｓ１４を所定量シフトさせ、該位相シフトテスト信号ｓ１４’と前記フィルタ出力信号ｓ１６との位相差からフィルタ１０の周波数特性を制御する制御信号ｓ１１を得るようにしたので、前記制御信号ｓ１１を二分岐探索処理によって得ることが可能となるため、フィルタ１０の特性周波数を短時間で調整することができる。また、このような構成にすることで、位相シフト部３２に設定する位相シフト量を変更すれば、すべてのフィルタに対応できる。
【００７７】
なお、本実施の形態１では、テスト信号ｓ１４の周波数をフィルタの特性周波数に一致させる場合について説明したが、異なる周波数であってもよい。この場合、フィルタ１０の位相特性から、テスト信号ｓ１４の周波数に対応する位相量を確認しておき、位相シフト部３２が該位相量と１８０°位相差が生じるような位相シフトテスト信号ｓ１４’を生成するようにすればよい。
【００７８】
また、本実施の形態１では、第１，第２のコンパレータ３４，３５は、テスト信号ｓ１４の中心値を基準信号として２値化を行っているが、実際に前記コンパレータで用いる基準信号はこの値に限るものではない。また、前記コンパレータは、例えばヒステリシス型のように２つの基準信号を元に、入力された信号を２値化するものであってもよい。
【００７９】
（実施の形態２）
本実施の形態２では、フィルタが４次バタワース低域通過型フィルタ（以下、「４次バタワースＬＰＦ」と称す）、あるいは４次バタワース高域通過型フィルタの場合について説明する。
【００８０】
図１１は、本実施の形態２にかかるフィルタの特性調整装置の構成を示す図であり、図１２は、本実施の形態２により周波数特性が調整される４次バタワース低域通過型フィルタの構成を示す図であり、図１３は、図１２に示す４次バタワース低域通過型フィルタの周波数特性を示す図であり、図１４は、本実施の形態２のフィルタの特性調整装置におけるフィルタ特性制御部５０の構成を詳細に示す図である。なお、図１４は、チューニングモード時に必要な構成のみを示している。
【００８１】
図１１に示すように、本実施の形態２のフィルタの特性調整装置の構成は、前記実施の形態１と同様、フィルタ４０と、選択信号ｓ１２に基づいて前記フィルタ４０に入力するフィルタ入力信号ｓ１５を選択する信号選択部２０と、基準信号ｓ１７に基づいて前記フィルタ４０の特性を調整する制御信号ｓ１１を出力するフィルタ特性制御部５０とを備える。そして、前記信号選択部２０には、前記実施の形態１と同様、当該フィルタの特性調整装置２００が通常モード時に処理対象となる通常入力信号ｓ１３と、前記フィルタ特性制御部５０で生成されたテスト信号ｓ１４とが入力され、選択信号ｓ１２に応じて、前記通常入力信号ｓ１３と、テスト信号ｓ１４のいずれかが前記フィルタ入力信号ｓ１５として選択されて、フィルタ４０に入力される。前記選択信号ｓ１２は、当該装置２００外部で独立に調製されて入力されるものでもよく、前記フィルタ特性制御部５０から出力されるものでもよい。
【００８２】
本実施の形態２が特性調整の対象とするフィルタ４０である４次バタワースＬＰＦは、図１２に示すように、Ｇｍ回路４１〜４４およびＣ回路４５〜４８からなるＧｍ−Ｃフィルタで構成されているとする。このような４次バタワースＬＰＦ４０は、Ｇｍ回路４１〜４４のＧｍ値が制御信号ｓ１１によって調整されることで、その特性周波数であるカットオフ周波数が制御される。
【００８３】
このように、特性調整の対象となるフィルタ４０が、前述したような４次バタワースＬＰＦであると、図１４に示すように、フィルタの特性調整装置２００のフィルタ特性制御部５０内に、位相シフト部が不要となる。この理由は、図１３に示すように、４次のバタワースＬＰＦ４０の位相特性が、理論上、カットオフ周波数ｆｃにおいて位相が１８０°シフトするものとなるからである。よって、特に特性調整対象のフィルタが４次バタワース低域通過型ＬＰＦ４０の場合は、図１３に示すように、位相特性が特性周波数ｆｃの位置で１８０°シフトされるため、テスト信号ｓ１４の位相を、理想のフィルタ出力信号ｓ１６との位相差が１８０°になるように、シフトさせる必要が無く、位相シフト部３２が不要となる。もちろん、４次バタワース高域通過型フィルタの場合も同様である。
【００８４】
次に、動作について説明する。なお、本実施の形態２におけるフィルタ４０の通常動作は前記実施の形態１と同様であるため、ここでは、フィルタ４０のチューニング動作を図１４を用いて説明する。
【００８５】
本実施の形態２の特性調整装置２００におけるフィルタ特性制御部５０において、テスト信号生成部５１で生成されたテスト信号ｓ１４は、４次バタワースＬＰＦ４０を介して制御信号生成部５３に入力されるとともに、位相シフト部を介することなく直接、制御信号生成部５３に入力される。そして、制御信号生成部５３において、直接入力された該テスト信号ｓ１４と、４次バタワースＬＰＦ４０のフィルタ出力信号ｓ１６との位相比較が行われた後、前記実施の形態１と同様、該位相比較結果を二分岐探索処理して制御レジスタ値Ｃｎを得、該制御レジスタ値Ｃｎに相当する制御信号ｓ１１を検出する。そして、該制御信号ｓ１１によって図１２のＧｍ回路４１〜４４のＧｍ値を制御し、この結果、フィルタ４０のカットオフ周波数が所望の周波数に調整される。
【００８６】
以上のことから、本実施の形態２によれば、フィルタの特性調整装置２００は、図１４に示すように、テスト信号ｓ１４を直接制御信号生成回路５３に入力すればよいため、テスト信号ｓ１４の位相を所定量シフトさせる位相シフト部が必要なくなり、装置規模をさらに小さくすることができる。
【産業上の利用可能性】
【００８７】
本発明にかかるフィルタの特性調整装置は、フィルタの周波数特性を調整するために、フィルタに入力するテスト信号を生成するテスト信号生成部と、テスト信号の位相をシフトする位相シフト部と、フィルタの出力信号とテスト信号の位相差を比較しデジタル処理にて制御信号を生成する制御信号生成部とを有し、フィルタの特性周波数を高精度に調整するとともに、その回路面積の増加を防ぐうえで有用である。
【図面の簡単な説明】
【００８８】
【図１】図１は、本発明の実施の形態１におけるフィルタの特性調整装置の構成を示す図である。
【図２】図２は、本発明の実施の形態１におけるフィルタの特性調整装置の、特性調整動作時に必要な構成を示す図である。
【図３】図３は、本発明の実施の形態１のフィルタ特性制御部内の制御信号生成部の構成を詳細に示す図である。
【図４】図４は、本発明の実施の形態１におけるフィルタの特性調整装置の、通常動作時に必要な構成を示す図である。
【図５】図５は、本発明の実施の形態１におけるフィルタの特性調整装置の、特性調整動作時の一連の流れを示す図である。
【図６】図６は、本発明の実施の形態１における、フィルタ特性制御部内の各部からの信号波形図である。
【図７】図７は、二次バタワース低域通過型フィルタの周波数特性を示す図である。
【図８】図８は、本発明の実施の形態１における、フィルタ特性制御部内のロジック部の一構成例を示す図である。
【図９】図９は、本発明の実施の形態１のロジック部内での二分岐探索処理を説明する図である。
【図１０】図１０は、本発明の実施の形態１におけるロジック部内の制御信号決定部の処理を説明する図である。
【図１１】図１１は、本実施の形態２におけるフィルタの特性調整装置の構成を示す図である。
【図１２】図１２は、Ｇｍ・Ｃ回路で構成された４次のバタワース低域通過型フィルタを示した図である。
【図１３】図１３は、４次低域通過型バタワースフィルタの周波数特性を示した図である。
【図１４】図１４は、本実施の形態２にかかるフィルタの特性調整装置の、特性調整動作時に必要な構成を示す図である。
【図１５】図１５は、従来における、ＰＬＬを用いたマスタ／スレーブ方式によるフィルタの特性調整装置を示す図である。
【図１６】図１６は、従来における、通常動作時に使用するフィルタそのものを用いた特性調整装置の構成を示す図である。
【図１７】図１７は、次数の異なる２つの低域通過型フィルタの周波数特性を示す図である。
【図１８】図１８は、次数の異なる２つの低域通過型フィルタの位相特性を示す図である。
【符号の説明】
【００８９】
１０  フィルタ
２０，６１  信号選択部
３０，５０  フィルタ特性調整部
３１，５１  テスト信号生成部
３２  位相シフト部
３３，５３  制御信号生成部
３４  第１のコンパレータ
３５  第２のコンパレータ
３６  位相比較器
３７  ロジック部
３８  二分岐探索処理部
３９  制御信号決定部
４０  ４次バタワース低域通過型フィルタ
４１〜４４  Ｇｍ回路
４５〜４８  Ｃ回路
６０  ＰＬＬ回路
６１  ＶＣＯ
６２  発振周波数測定部
６３  制御部
７４  応答波形周期測定部
７７  ステップ信号生成部
７８  制御部
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【図１６】
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【図１７】
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【図１８】
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