(57)【特許請求の範囲】
【請求項１】
ＣＰＵとメモリコントローラその他の各モジュール間がバスで接続されており、各モジュール間で情報のＤＭＡ転送が可能な情報処理装置において、入力手段が入力した当該情報処理装置の処理モードに応じた前記各モジュールごとのＤＭＡ転送のバースト幅を前記各モジュールに指示するとともにＤＭＡ許可手段に対して前記入力した処理モードに応じた各モジュールのＤＭＡ転送の順番とＤＭＡ要求をバースト幅設定手段が出力し、ＤＭＡ許可手段は前記バースト幅設定手段から入力したＤＭＡ転送の順番とＤＭＡ要求とに基づいてＤＭＡ転送の開始を前記各モジュールに指示することを特徴とする情報処理装置。
【請求項２】
ＣＰＵとメモリコントローラその他の各モジュール間がバスで接続されており、各モジュール間で情報のＤＭＡ転送が可能な情報処理装置において、前記各モジュールからＤＭＡ要求を取得し、入力手段が入力した当該情報処理装置の処理モードに応じた前記各モジュールごとのバースト幅を有するＤＭＡ転送の開始を、前記入力した処理モードに応じた順番で前記ＤＭＡ要求を行った各モジュールに指示するＤＭＡ許可手段を備えたことを特徴とする情報処理装置。
【請求項３】
前記ＤＭＡ許可手段は、当該情報処理装置に設けられているシステムコントローラ、ＤＭＡコントローラ、ＣＰＵ、又はメモリコントローラが当該機能を兼用することを特徴とする請求項１又は２の情報処理装置。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、情報処理装置に係り、特にＣＰＵとメモリコントローラその他の各モジュール間がバスで接続されており、各モジュール間で情報のＤＭＡ転送が可能な情報処理装置に関する。
【０００２】
【従来の技術】
Ｉ／Ｏ−メモリ間、メモリ−メモリ間のデータ転送において、ＣＰＵを介在した直接的なアクセス方法をとることにより高速にデータ転送を行い、資源を専有せずに別タスクからも資源の利用が可能なバス制御方式が、特開平７−１４１２８７号の公報に示されている。
【０００３】
また、ＬＳＩと外部メモリとの間で、また、ＬＳＩ内部のデータ処理ユニット相互間で、データの転送を高速に行いうる高速データ転送制御装置が、特開平１０−２７１５５号の公報に示されている。
【０００４】
該発明は、ＬＳＩの内部のデータ処理ユニット間でのデータ転送には基本動作クロックのＨｉｇｈ区間を使用し、前述した外部メモリとのデータ転送に基本動作クロックのＬｏｗ区間を使用する構成となっているため、外部のメモリとのデータ転送中にも内部のデータ転送を一本のバスで転送でき、データの高速転送、高速処理が可能となっている。
【０００５】
また、複数のバスマスタとなりうるプロセッサやＤＭＡＣ等がシステムバスにアクセスするバス制御装置に関し、アクセスタイムが高速で高価なデバイスを用いず、遅いアクセスタイムのデバイスに影響されることなく、最小限の時間でシステムバスにアクセスすることによって、システムバスを効率的に利用することが可能なバス制御装置が特開平１１−２７２６０６号の公報に示されている。
【０００６】
図５に、従来の電子カメラやコンピュータ等の情報処理装置においてＤＭＡ転送を実施する場合のデータバスの使用例のタイムチャートを示す。
【０００７】
同図に示す実施例では、モジュール１のバスの使用に関する優先順位が一番高く、次にモジュール２、ＣＰＵの順であるとする。
【０００８】
たとえば、電子カメラにおける撮像部等のモジュール１が撮像した画像データをメモリ等のモジュールにデータを転送する際には、バスを制御しているＤＭＡコントローラに対して(1)のタイミングにてＤＭＡ要求を出力する。また、ＣＰＵが同時に(1)のタイミングにてＤＭＡ転送の要求をＤＭＡコントローラに出力した場合には、ＤＭＡコントローラは優先順位が高く設定してあるモジュール１のＤＭＡ転送を、(2)から(5)の間許可する。するとＤＭＡコントローラからＤＭＡ許可を受けたモジュール１は、(2)から(5)までの間データのＤＭＡ転送を必要なバースト幅の全てを占有して実施する。
【０００９】
モジュール１がＤＭＡ転送を実施している間は、例えば撮像した画像データに対してホワイトバランス処理等の画像信号を処理するモジュール２が、メモリ等に処理後の画像を転送するために(3)のタイミングにてＤＭＡ要求をＤＭＡコントローラに対して出力しても、優先順位の高いモジュール１のＤＭＡ転送が終了するまで待たされることになる。
【００１０】
次に、(4)のタイミングにて再びモジュール１からＤＭＡ要求がなされた場合には、ＤＭＡコントローラは優先順位の高いモジュール１からのＤＭＡ要求を受けたことから、次の(6)のタイミングにて再びモジュール１に対してＤＭＡ転送を許可する。
【００１１】
(7)のタイミングにて、全てのバースト幅についてのモジュール１のＤＭＡ転送が終了すると、ＤＭＡコントローラは次に優先順位の高いモジュール２に対して、(8)のタイミングにてＤＭＡ転送を許可する。モジュール２が必要なバースト幅全てについてＤＭＡ転送を実施している(8)から(10)の間の(9)のタイミングにて、再びモジュール２がＤＭＡ要求をＤＭＡコントローラに対して出力すると、一旦(10)のタイミングにてモジュール２のＤＭＡ転送が終了しても、再びＣＰＵよりも優先順位の高いモジュール２のＤＭＡ転送が優先されて、(11)から(12)の間では再びモジュール２がＤＭＡ転送を実施する。したがって、(1)のタイミングでＤＭＡコントローラに対してＤＭＡ要求を出力したＣＰＵが実際にＤＭＡ転送を開始できるのは、(13)のタイミングからとなる。
【００１２】
【発明が解決しようとする課題】
上記の特開平７−１４１２８７号の公報その他に示されているバス制御方式では、複数のモジュールが接続されているデータバスにおいてＤＭＡ転送を行う場合には、ＤＭＡコントローラが各モジュールに対して優先順位に応じたバスの使用許可を与えてＤＭＡ転送を行ってデータバスの競合を回避していた。この制御方式においては、早くデータバスの使用を要求したモジュール又は、優先順位が高位に設定されているモジュールがデータバスを連続で専有し、他の優先順位の低いモジュールはＤＭＡ転送が当面不可能となるという不具合を生じていた。
【００１３】
例えば図５のデータバスの使用例に示されるように、各モジュール毎に優先順位を決めておいて、個々のモジュールが主張するバースト幅全てについてＤＭＡ転送を実施する従来のＤＭＡ転送では、優先順位の高いモジュールがバスを独占する可能性が高く、優先順位の低いモジュールは他のモジュールが使用していない場合にのみデータバスの使用が許可されるため、各タスク間で情報処理量のバランスが著しく不揃いとなり、情報処理装置全体では情報処理速度が低下するという状況を生じていた。
【００１４】
本発明は、このような事情に鑑みてなされたもので、情報処理装置のＣＰＵやメモリコントローラその他の各モジュールのうち、ＤＭＡ転送の優先順位が低いモジュールであっても必ず所定の時間データバスを使用することが可能となり、ＤＭＡ転送の効率を向上させ、システムの整合性を保ち、各モジュール間における並列処理が効率よく実施され、情報処理装置全体の情報処理性能の向上を図ることが可能な情報処理装置を提供することを目的としている。
【００１５】
【課題を解決するための手段】
本発明は前記目的を達成するために、ＣＰＵとメモリコントローラその他の各モジュール間がバスで接続されており各モジュール間で情報のＤＭＡ転送が可能な情報処理装置において、当該情報処理装置の処理モードを入力する入力手段と、前記入力した処理モードに応じたＤＭＡ転送のバースト幅を各モジュールに指示するとともにＤＭＡ許可手段に対して前記入力した処理モードに応じた各モジュールのＤＭＡ転送の順番とＤＭＡ開始信号を出力するバースト幅設定手段と、前記バースト幅設定手段から入力したＤＭＡ転送の順番とＤＭＡ開始信号とに基づいてＤＭＡ転送の開始を前記各モジュールに指示するＤＭＡ許可手段とを備えたことを特徴としている。
【００１６】
本発明によれば情報処理装置は、入力手段が入力した当該情報処理装置の処理モードに応じたＤＭＡ転送のバースト幅をＣＰＵ、メモリコントローラその他の各モジュールに指示するとともにＤＭＡ許可手段に対して前記入力した処理モードに応じた各モジュールのＤＭＡ転送の順番とＤＭＡ開始信号をバースト幅設定手段が出力し、ＤＭＡ許可手段は前記バースト幅設定手段から入力したＤＭＡ転送の順番とＤＭＡ開始信号とに基づいてＤＭＡ転送の開始を前記各モジュールに指示するようにしたので、情報処理装置のＣＰＵやメモリコントローラその他の各モジュールのうち、ＤＭＡ転送の優先順位が低いモジュールであっても必ず所定の時間データバスを使用することが可能となり、ＤＭＡ転送の効率を向上させ、システムの整合性を保ち、各モジュール間における並列処理が効率よく実施され、情報処理装置全体の情報処理性能の向上を図ることが可能となる。
【００１７】
また本発明は前記目的を達成するために、ＣＰＵとメモリコントローラその他の各モジュール間がバスで接続されており各モジュール間で情報のＤＭＡ転送が可能な情報処理装置において、当該情報処理装置の処理モードを入力する入力手段と、前記入力した処理モードに応じたバースト幅を有するＤＭＡ転送の開始を、前記入力した処理モードに応じた順番で各モジュールに指示するＤＭＡ許可手段とを備えたことを特徴としている。
【００１８】
本発明によれば情報処理装置において、入力手段が入力した当該情報処理装置の処理モードに応じたバースト幅を有するＤＭＡ転送の開始を、前記入力した処理モードに応じた順番で各モジュールに指示するＤＭＡ許可手段を備えたので、情報処理装置のＣＰＵやメモリコントローラその他の各モジュールのうち、ＤＭＡ転送の優先順位が低いモジュールであっても必ず所定の時間データバスを使用することが可能となり、ＤＭＡ転送の効率を向上させ、システムの整合性を保ち、各モジュール間における並列処理が効率よく実施され、情報処理装置全体の情報処理性能の向上を図ることが可能となる。
【００１９】
また本発明は前記目的を達成するために、前記のＤＭＡ許可手段は、情報処理装置に設けられているシステムコントローラ、ＤＭＡコントローラ、ＣＰＵ、又はメモリコントローラが当該機能を兼用することを特徴としている。
【００２０】
本発明によれば前記のＤＭＡ許可手段を、情報処理装置に設けられているシステムコントローラ、ＤＭＡコントローラ、ＣＰＵ、又はメモリコントローラが当該機能を兼用するようにしたので、簡易な構成でＤＭＡ転送の効率を向上させることが可能となる。
【００２１】
【発明の実施の形態】
以下添付図面に従って、本発明に係る情報処理装置の好ましい実施の形態について詳説する。
【００２２】
図１は、本発明に係る電子カメラ等の情報処理装置の信号処理系ブロック図である。
【００２３】
同図に示すように情報処理装置には、被写体像を撮像して画像データを取得する撮像部等のモジュール１と、撮像した画像データに対してホワイトバランス処理を実施したり、ＹＣ変換処理、ガンマ変換、画素数の変換処理、電子ズーム処理、トリミング処理等の画像処理を実施する画像信号処理部等のモジュール２と、撮像した画像データを表示用の画像信号に変換したり表示画像と記号や文字等の情報を合成する処理を実施するエンコーダや表示部等のモジュール３と、Ｉ／Ｏや通信インターフェース等で構成される外部デバイスコントローラ５７とが設けられている。
【００２４】
また、情報処理装置には、バス９９の使用状態を管理するバスインターフェース（ＤＭＡコントローラ）７０と、バス９９を介してＤＭＡ転送を実施する場合にバースト長を固定する指示を出力するシステムコントローラ７２と、撮像モードや再生モード、通信モード等の電子カメラとしての処理モードを利用者が指示入力する入力手段７４とが設けられている。
【００２５】
また、情報処理装置には、当該情報処理装置全体の制御を実施するＣＰＵ８０と、ＣＰＵが各種の情報処理を実施する際のワークエリアとなるＤＲＡＭ等で構成されているメモリ８１と、ＤＲＡＭ等で構成されているメモリ８１が記録する情報の入出力を制御するメモリコントローラ８２とが設けられている。
【００２６】
システムコントローラ７２は、入力手段７４から当該情報処理装置が実施する処理モードを入力して設定することが可能となっている。情報処理装置が電子カメラである場合には処理モードとして、被写体像を撮像して記録媒体に記録する「撮像モード」や、記録媒体に記録されている画像を表示手段に表示する「再生モード」、電子カメラにおける各処理機能の設定を実施する「セットアップモード」、パソコン等の他の通信機器と情報の送受信を実施する「通信モード」などの各種処理モードが存在する。なお、入力手段７４は、利用者が操作するボタンやスイッチ等の入力手段であってもよいし、ＣＰＵ８０からＩ／Ｏ等を介して当該情報処理装置の処理モードを入力する手段であってもよい。
【００２７】
システムコントローラ７２は、前記入力手段７４を介して入力したモードに応じて、各モジュールがバスを占有するバースト幅（データ量）とその優先順位をそれぞれ決定する。そして、決定したバースト幅（ＢＵＲＳＴ）をそれぞれのモジュールに出力することが可能となっている。
【００２８】
またシステムコントローラ７２は、各モードに応じたＤＭＡ要求（ＤＭＡＲＥＱ）をバスインターフェース７０に対して出力することが可能となっている。バスインターフェース７０がシステムコントローラ７２からＤＭＡ要求を取得すると、バスインターフェース７０はシステムコントローラ７２から取得した各モードに応じたＤＭＡ要求（及び優先順位に関する情報）に基づいて、各モジュールに対してモジュール有効信号（ＥＮＡＢＬＥ）を逐次出力してゆく。またバスインターフェース７０は、ＤＭＡ転送を実施している間はシステムコントローラ７２に対してＤＭＡ許可（ＤＭＡＡＣＫ）信号を出力し続けて、ＤＭＡ転送中であることをシステムコントローラ７２に対して通知している。
【００２９】
そして前記モジュール有効信号を取得したモジュールは、他の所定のモジュールとバス９９を占有して、システムコントローラ７２から取得した所定のバースト幅のＤＭＡ転送を実施する。
【００３０】
システムコントローラ７２等のバースト幅設定手段は、入力手段７４又はＣＰＵ８０等から入力した処理モードに応じたＤＭＡ転送のバースト幅を、ＣＰＵ８０やメモリコントローラ８２その他の各モジュールに指示することが可能となっている。
【００３１】
また、システムコントローラ７２等のバースト幅設定手段は、入力手段７４又はＣＰＵ８０等から入力した処理モードに応じた各モジュールのＤＭＡ転送の順番とＤＭＡ開始信号（ＤＭＡ要求）を、バスインターフェース７０等のＤＭＡ許可手段に出力することが可能となっている。
【００３２】
バスインターフェース７０等のＤＭＡ許可手段は、システムコントローラ７２等のバースト幅設定手段から入力した各モジュールのＤＭＡ転送の順番とＤＭＡ開始信号（ＤＭＡ要求）に基づいて、ＤＭＡ転送の開始（モジュール有効信号）をＣＰＵ８０やメモリコントローラ８２等の各モジュールに出力して指示することが可能となっている。
【００３３】
また、他の発明の形態では、バスインターフェース７０等のＤＭＡ許可手段は、入力手段７４又はＣＰＵ８０等から入力した処理モードに応じたバースト幅のＤＭＡ転送の開始（モジュール有効信号）を、該処理モードに応じた順番でＣＰＵ８０やメモリコントローラ８２等の各モジュールに指示することが可能となっている。
【００３４】
なお、前記のＤＭＡ許可手段は、バスインターフェース７０（ＤＭＡコントローラ）に限定されるものではなく、システムコントローラ７２等、ＣＰＵ８０、又はメモリコントローラ８２等の周辺装置が当該機能を兼用するように構成しても本発明の目的を達成することが可能となる。
【００３５】
図２に、本発明に係る電子カメラやコンピュータ等の情報処理装置においてＤＭＡ転送を実施する場合のデータバスの使用例のタイムチャートを示す。
【００３６】
同図に示す実施例でもモジュール１のバスの使用に関する優先順位が一番高く、次にモジュール２、ＣＰＵ８０の順であるとする。
【００３７】
例えば電子カメラが撮像モードに設定されている場合には、撮像部等のモジュール１が撮像した画像データをメモリ等のモジュールにデータを転送するために、システムコントローラ７２はバスインターフェース７０に対して(1)のタイミングにて各モードに応じたＤＭＡ要求（ＤＭＡＲＥＱ）を出力する。
【００３８】
バスインターフェース７０がシステムコントローラ７２から各モードに応じたＤＭＡ要求を入力すると、(2)のタイミングにて所定のモジュールに対してモジュール有効信号（ＥＮＡＢＬＥ）を逐次出力してゆく。またバスインターフェース７０は、ＤＭＡ転送を実施している間はシステムコントローラ７２に対してＤＭＡ許可（ＤＭＡＡＣＫ）信号を出力し続けて、ＤＭＡ転送中であることをシステムコントローラ７２に対して通知している。
【００３９】
前記(2)のタイミングにてモジュール１有効信号を取得した、優先順位が最高位に設定されているモジュール１は、他の所定のモジュールとバス９９を占有して、システムコントローラ７２から取得した所定のバースト幅のＤＭＡ転送を実施する。
【００４０】
次に所定のバースト幅にてモジュール１のＤＭＡ転送が終了すると、次にバスインターフェース７０は、次に優先順位の高いモジュール２に対してモジュール２有効信号（ＥＮＡＢＬＥ）を出力する。するとモジュール２は、他の所定のモジュールとバス９９を占有して、システムコントローラ７２から取得した所定のバースト幅のＤＭＡ転送を実施する。
【００４１】
次に所定のバースト幅にてモジュール２のＤＭＡ転送が終了すると、次にバスインターフェース７０は、次に優先順位の高いＣＰＵ８０に対してＣＰＵ有効信号（ＥＮＡＢＬＥ）を出力する。するとＣＰＵ８０は、他の所定のモジュールとバス９９を占有して、システムコントローラ７２から取得した所定のバースト幅のＤＭＡ転送を実施する。
【００４２】
ＣＰＵ８０がＤＭＡ転送を実施している(3)のタイミングでシステムコントローラ７２からＤＭＡ要求信号を入力した場合であっても、バスインターフェース７０はＣＰＵ８０のＤＭＡ転送が(4)のタイミングにて終了して、ＤＭＡ許可をシステムコントローラ７２に対して出力してから、次の(5)のタイミングにてモジュール１に対してモジュール１有効信号を出力する。すると再び優先順位の高い順で一連のＤＭＡ転送が実施される。
【００４３】
なお、モジュール１がＤＭＡ転送を実施する相手のモジュールが、ＤＲＡＭのメモリコントローラ８２等である場合には、モジュール１有効信号を一旦中断してメモリコントローラ８２内でＤＲＡＭのためのバッファリングの作業を実施するようにしてもよい。また、このバッファリング処理中は、まだ所定のバースト幅のＤＭＡ転送が終了していないので、他のモジュールに対してはバスを利用させないように制御する。
【００４４】
なお、システムコントローラ７２が、各モジュールからＤＭＡ要求（ＤＭＡＲＥＱ）を取得して、そのＤＭＡ要求があったモジュールの優先順位に応じたバースト幅を有するＤＭＡ要求（ＤＭＡＲＥＱ）をバスインターフェース７０に出力し、バスインターフェース７０がそのＤＭＡ要求に基づいて所定のモジュールに所定のバースト幅のモジュール有効信号（ＥＮＡＢＬＥ）を出力するように構成しても、本発明の目的を達成することが可能てある。
【００４５】
図３に、本発明に係る情報処理装置の信号処理系ブロック図の他の実施の形態を示す。
【００４６】
同図が図１の情報処理装置と異なる点は、図３の情報処理装置ではシステムコントローラ７２Ａが各モジュールに各処理モードに応じたバースト幅を指定することが可能となっている点と、システムコントローラ７２Ａが各モジュールに対してモジュール有効信号を出力することが可能となっている点である。図３に示す例のように、バスインターフェース７２Ａが当該情報処理装置の処理モードに応じたバースト幅や、モジュールの有効信号を各モジュールに出力するようにしても、本発明の目的を達成することが可能となる。
【００４７】
図４に、本発明に係る情報処理装置の信号処理系ブロック図の他の実施の形態を示す。
【００４８】
同図が図１の情報処理装置と異なる点は、図４の情報処理装置ではシステムコントローラが存在せずに、バスインターフェース７０Ｂが各モジュールに各処理モードに応じたバースト幅を指定することが可能となっている点と、バスインターフェース７０Ｂが入力手段７４又はＣＰＵ８０から処理モードの信号を入力することが可能となっている点である。
【００４９】
図４に示す例のように、バスインターフェース７０Ｂが当該情報処理装置の処理モードに応じたバースト幅の情報や、モジュールの有効信号を各モジュールに出力するようにしても、本発明の目的を達成することが可能となる。
【００５０】
また、図４に示すようにバスインターフェース７０Ｂが各モジュールにモジュール有効信号を出力する代わりに、メモリーコントローラ８２が各モジュールにモジュール有効信号を出力するようにしても本発明の目的を達成することが可能となる。
【００５１】
【発明の効果】
以上説明したように本発明に係る情報処理装置によれば、入力手段が入力した当該情報処理装置の処理モードに応じたＤＭＡ転送のバースト幅をＣＰＵ、メモリコントローラその他の各モジュールに指示するとともにＤＭＡ許可手段に対して前記入力した処理モードに応じた各モジュールのＤＭＡ転送の順番とＤＭＡ開始信号をバースト幅設定手段が出力し、ＤＭＡ許可手段は前記バースト幅設定手段から入力したＤＭＡ転送の順番とＤＭＡ開始信号とに基づいてＤＭＡ転送の開始を前記各モジュールに指示するようにしたので、情報処理装置のＣＰＵやメモリコントローラその他の各モジュールのうち、ＤＭＡ転送の優先順位が低いモジュールであっても必ず所定の時間データバスを使用することが可能となり、ＤＭＡ転送の効率を向上させ、システムの整合性を保ち、各モジュール間における並列処理が効率よく実施され、情報処理装置全体の情報処理性能の向上を図ることが可能となる。
【００５２】
また、他の発明の形態によれば情報処理装置において、入力手段が入力した当該情報処理装置の処理モードに応じたバースト幅を有するＤＭＡ転送の開始を、前記入力した処理モードに応じた順番で各モジュールに指示するＤＭＡ許可手段を備えたので、情報処理装置のＣＰＵやメモリコントローラその他の各モジュールのうち、ＤＭＡ転送の優先順位が低いモジュールであっても必ず所定の時間データバスを使用することが可能となり、ＤＭＡ転送の効率を向上させ、システムの整合性を保ち、各モジュール間における並列処理が効率よく実施され、情報処理装置全体の情報処理性能の向上を図ることが可能となる。
【００５３】
また、他の発明の形態によれば情報処理装置のＤＭＡ許可手段を、当該情報処理装置に設けられているシステムコントローラ、ＤＭＡコントローラ、ＣＰＵ、又はメモリコントローラが当該機能を兼用するようにしたので、簡易な構成でＤＭＡ転送の効率を向上させることが可能となる。
【００５４】
また本発明によれば、データバスに接続されたＤＭＡ要求を行う各モジュールに対し、システムコントローラ又はＣＰＵ等がデータバスのタイミングのデータを使用するか否かの設定を行うことによって、各モジュールは常に読み出しと書き込みを繰り返すＤＭＡ転送に対し、データバスの特定のタイミングでアクセスすることにより、常にデータアクセスが可能となり、システム全体の性能を向上することが可能となる。
【００５５】
また本発明によれば、予め設定されたＤＭＡ転送中のデータバス上のデータタイミングの範囲に対して常に処理が可能となり、ＤＭＡ転送の優先順位が低いモジュールも必ずデータバスを使用することが可能となり、システムの整合性を保ち、全体の情報処理性能を図ることが可能となる。
【００５６】
また本発明によれば、ＤＭＡ転送を行う場合にバースト長を固定し、ＤＭＡ転送の読み出しと書き込みを常に繰り返す構成とすることが可能となり、各モジュールはＤＭＡ転送中のデータバスに対して予め設定されたタイミングのデータに対してアクセスを行うことにより、データバスの使用効率を向上させることが可能となる。
【００５７】
また本発明によれば、複数のモジュールが同じタイミングでデータバスを共有し、かつ効率よくＤＭＡ転送を行うことが可能となり、各モジュールの並列動作により、システム全体の処理を高速化することが可能となる。
【００５８】
本発明によれば、複数のＤＭＡモジュールで構成されるシステムにおいて、特定のモジュールがデータバスを占有することによって起こるシステムの不整合や、ＤＭＡの調停に要する時間を回避することが可能となる。
【００５９】
また本発明によれば複数のモジュールでデータバスを共有するシステムにおいて、ＤＭＡ転送中のデータバス上のデータタイミングをシステムコントローラ又はＣＰＵ等が管理し、バスレートを順次効率的に使用することが可能となる。
【図面の簡単な説明】
【図１】本発明に係る情報処理装置の信号処理系ブロック図
【図２】本発明に係る情報処理装置におけるＤＭＡ転送のタイムチャート
【図３】本発明に係る情報処理装置の信号処理系ブロック図の他の実施例を示す図
【図４】本発明に係る情報処理装置の信号処理系ブロック図の他の実施例を示す図
【図５】従来の情報処理装置においてＤＭＡ転送を実施する場合のデータバスの使用例を示タイムチャート
【符号の説明】
５７…外部デバイスコントローラ、７０、７０Ａ、７０Ｂ…バスインターフェース、７２、７２Ａ…システムコントローラ、７４…入力手段、８０…ＣＰＵ、８１…メモリ、８２…メモリコントローラ、９９…バス
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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