【手続補正書】
【提出日】平成17年7月29日(2005.7.29)
【手続補正１】
【補正対象書類名】特許請求の範囲
【補正対象項目名】全文
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
コンテント・アドレサブル・メモリ（ＣＡＭ）・デバイスであって、
コンフィギュレーション値に従って決定される幅を有するデータ・ワードを格納するＣＡＭセルのアレイをそれぞれが有する複数のＣＡＭブロックと、
クラス・コードを受け取る入力と、前記複数のＣＡＭブロックへ複数の選択信号を出力する回路とを有するブロック選択回路であって、それぞれの選択信号が、前記クラス・コードに従って前記複数のＣＡＭブロックのそれぞれのものが比較動作に参加することを選択的にディスエーブルにする、ブロック選択回路と
を備えるコンテント・アドレサブル・メモリ・デバイス。
【請求項２】
請求項１に記載のコンテント・アドレサブル・メモリ・デバイスであって、前記複数のＣＡＭブロックへ複数の選択信号を出力する前記回路が、複数の比較回路を含み、それぞれの比較回路が、前記クラス・コードと、前記複数のＣＡＭブロックの１つに対応するそれぞれの格納されたコードとを比較し、前記複数の選択信号のそれぞれのものを、前記クラス・コードが前記格納されたコードと一致するかどうかに従って、第１状態または第２状態の何れかで出力するように適合される、コンテント・アドレサブル・メモリ・デバイス。
【請求項３】
請求項２に記載のコンテント・アドレサブル・メモリ・デバイスであって、前記格納されたコードが前記コンフィギュレーション値を示す、コンテント・アドレサブル・メモリ・デバイス。
【請求項４】
請求項１に記載のコンテント・アドレサブル・メモリ・デバイスであって、複数のブロック一致回路を更に備え、それぞれのブロック一致回路が、複数の一致信号線を介して前記複数のＣＡＭブロックの個々のＣＡＭブロックに結合され、前記ＣＡＭブロックが前記比較動作への参加をディスエーブルにされない場合、かつ前記比較動作中に前記一致信号線の少なくとも１つに一致信号がアサートされる場合に、ブロック一致信号を生成するように適合される、コンテント・アドレサブル・メモリ・デバイス。
【請求項５】
請求項１に記載のコンテント・アドレサブル・メモリ・デバイスであって、複数のブロック複数一致回路を更に含み、それぞれのブロック複数一致回路が、複数の一致信号線を介して前記複数のＣＡＭブロックの個々のＣＡＭブロックに結合され、前記ＣＡＭブロックが前記比較動作への参加をディスエーブルにされない場合、かつ前記比較動作中に前記一致信号線の少なくとも２つに一致信号がアサートされる場合に、ブロック一致信号を生成するように適合される、コンテント・アドレサブル・メモリ・デバイス。
【請求項６】
請求項１に記載のコンテント・アドレサブル・メモリ・デバイスであって、前記ブロック選択回路は、コンパランド値が前記複数のＣＡＭブロックの前記１つへ入力されないようにすることによって、前記複数のＣＡＭブロックの前記１つが前記比較動作に参加することを選択的にディスエーブルにするように適合される、コンテント・アドレサブル・メモリ・デバイス。
【請求項７】
請求項６に記載のコンテント・アドレサブル・メモリ・デバイスであって、前記ブロック選択回路が、前記コンパランド値内の複数のビットをリセット状態にセットすることによって、前記コンパランド値が前記複数のＣＡＭブロックの前記１つへ入力されないようにする回路を含む、コンテント・アドレサブル・メモリ・デバイス。
【請求項８】
請求項１に記載のコンテント・アドレサブル・メモリ・デバイスであって、複数のブロック・フラグ回路を更に含み、それぞれのブロック・フラグ回路は、前記複数のＣＡＭブロックの対応する１つに結合され、対応する前記ＣＡＭブロックに格納される複数のデータ・ワードの何れかがコンパランド値と一致する場合に一致フラグ信号をアサートするように適合され、前記ブロック選択回路は、前記複数のＣＡＭブロックの前記１つが前記比較動作に参加することを、前記対応するブロック・フラグ回路が前記一致フラグ信号をアサートしないようにすることによって、選択的にディスエーブルにするように適合される、コンテント・アドレサブル・メモリ・デバイス。
【請求項９】
請求項１に記載のコンテント・アドレサブル・メモリ・デバイスであって、前記複数のＣＡＭブロックへ複数の選択信号を出力する前記回路がＣＡＭセルの複数の組を含み、ＣＡＭセルの各組が、前記複数のＣＡＭブロックの１つに対応するクラス値を格納するメモリ・エレメントと、格納された前記クラス値と前記クラス・コードとを比較し、前記クラス・コードが格納された前記クラス値と一致するかどうかに従って、第１状態または第２状態の何れかで前記複数の選択信号のそれぞれの１つを出力する比較回路とを含む、コンテント・アドレサブル・メモリ・デバイス。
【請求項１０】
請求項９に記載のコンテント・アドレサブル・メモリ・デバイスであって、前記ＣＡＭセルの複数の組の各ＣＡＭセルが、格納されたクラス値が１つより多くのクラス・コードと一致することを可能にするためにマスク状態を格納することができる３値ＣＡＭセルである、コンテント・アドレサブル・メモリ・デバイス。
【請求項１１】
請求項１に記載のコンテント・アドレサブル・メモリ・デバイスであって、前記複数のＣＡＭブロックのうちの前記比較動作への参加をディスエーブルにされていない１つの中の記憶位置を示すインデックスを生成するための優先順位エンコーダ回路を更に含む、コンテント・アドレサブル・メモリ・デバイス。
【請求項１２】
コンテント・アドレサブル・メモリ（ＣＡＭ）・デバイス内の動作の方法であって、
クラス・コードを受け取るステップと、
前記クラス・コードを複数のブロック・コンフィギュレーション値のそれぞれと比較するステップであって、各ブロック・コンフィギュレーション値が、前記コンテント・アドレサブル・メモリ・デバイス内の複数の記憶ブロックの対応する１つのものの幅および深さコンフィギュレーションを示すものである、比較するステップと、
前記複数の記憶ブロックのうちの、前記対応するコンフィギュレーション値が前記クラス・コードと一致しない記憶ブロックが比較動作に参加することをディスエーブルにするステップと
を含む方法。
【請求項１３】
請求項１２に記載の方法であって、複数の前記ブロック・コンフィギュレーション値を前記コンテント・アドレサブル・メモリ・デバイス内に格納するステップを更に備える、方法。
【請求項１４】
請求項１３に記載の方法であって、前記複数の記憶ブロックのうちの１つより多くのブロックについて、同じブロック・コンフィギュレーション値を前記コンテント・アドレサブル・メモリ・デバイス内に格納するステップを更に含む、方法。
【請求項１５】
請求項１２に記載の方法であって、前記複数の記憶ブロックのうちの、前記対応するコンフィギュレーション値が前記クラス・コードと一致しない記憶ブロックが比較動作に参加することをディスエーブルにする前記ステップが、複数の選択信号を生成するステップを含み、それぞれの選択信号が、前記複数の記憶ブロックのそれぞれのものに結合され、それぞれの選択信号は、対応する前記コンフィギュレーション値が前記クラス・コードと一致しない場合に、前記複数の記憶ブロックのそれぞれのものが前記比較動作へ参加することをディスエーブルにするために、第１状態にセットされる、方法。
【請求項１６】
コンテント・アドレサブル・メモリ（ＣＡＭ）・デバイスであって、
データ・ワードを格納する複数の記憶手段であって、それぞれの記憶手段が、コンフィギュレーション値に従って決定される記憶幅を有する、記憶手段と、
クラス・コードに従って、前記複数の記憶手段の選択されたものが比較動作に参加すようにイネーブルにする選択手段と
を備えるコンテント・アドレサブル・メモリ・デバイス。
【請求項１７】
請求項１６に記載のコンテント・アドレサブル・メモリ・デバイスであって、前記選択手段が、
前記クラス・コードと、それぞれ前記複数の記憶手段に対応する複数の格納されたクラス値とを比較する比較手段と、
対応する前記格納されたクラス値が前記クラス・コードと一致するそれぞれの記憶手段が前記比較動作に参加するようにイネーブルにするイネーブル手段と
を備えるコンテント・アドレサブル・メモリ・デバイス。
【請求項１８】
請求項１７に記載のコンテント・アドレサブル・メモリ・デバイスであって、前記イネーブル手段が、コンパランド値を所定の状態にセットして、対応する前記格納されたクラス値と前記クラス・コードとが一致しない記憶手段が前記比較動作に参加しないようにするためのコンパランド・ディスエーブル手段を備える、コンテント・アドレサブル・メモリ・デバイス。
【請求項１９】
請求項１７に記載のコンテント・アドレサブル・メモリ・デバイスであって、前記イネーブル手段が、対応する前記格納されたクラス値と前記クラス・コードとが一致しない記憶手段に対応する一致信号がアサートされないようにする一致ディスエーブル手段を備える、コンテント・アドレサブル・メモリ・デバイス。