(57)【特許請求の範囲】
【請求項１】
スイッチング手段を結合した液晶表示素子を具える画像素子の行列アレイと、前記画像素子の行列にそれぞれ結合した行アドレスライン及び列アドレスラインのセットと、データ信号を前記列アドレスラインに供給するとともに前記行アドレスラインを走査して、前記画像素子の各行を順次選択し、関連の列アドレスラインに供給されるデータ信号に従って選択した行の表示素子を駆動する駆動回路とを有する能動マトリックス表示装置において、前記駆動回路は、クロストーク補償値に従って前記列アドレスラインに供給される前に入力データ信号を調整するとともに前記表示素子に対する漂遊容量性結合が原因のクロストークの影響を補償するために前記表示素子を駆動するのに用いる前記列アドレスに対して調整したデータ信号を供給するデータ信号調整回路を有し、このデータ信号調整回路が、所定の画像素子に対するクロストーク補償値を、当該画像素子が存在する画像素子の列に接続した前記列アドレスライン及び画像素子の隣接する列に接続した列アドレスラインのうちの少なくとも一つに対して画像素子を選択するまでの周期中に供給されるデータ信号から取り出すことを特徴とする能動マトリックス表示装置。
【請求項２】
前記データ信号調整回路は、同一の列アドレスライン及び隣接する列アドレスラインの少なくとも一つに結合した他の画像素子の少なくとも一部に対する前記入力データ信号の値及び前記画像素子に対する容量性結合係数に従って前記所定の画像素子に対する入力データ信号の補償値を決定し、前記容量性結合係数の値は、少なくとも前記表示素子とこれら行アドレスラインとの間の漂遊キャパシタンスに依存するようにしたことを特徴とする請求の範囲１記載の能動マトリックス表示装置。
【請求項３】
前記データ信号調整回路を、同一列における他の画像素子の全てに対するデータ信号及び隣接する列の少なくとも一つのうちの画像素子の全てに対するデータ信号から画像素子データ信号に対するクロストーク補償値を取り出すように配置したことを特徴とする請求の範囲１又は２記載の能動マトリックス表示装置。
【請求項４】
前記データ信号調整回路は、入力信号がフィールド周期中に保持されるとともにデータ信号が読み出される記憶装置を有し、前記データ信号は、当該フィールド周期中に前記記憶装置に保持された前記列の画像素子に対する入力信号の値から決定されたクロストーク補償値に従って調整されるようにしたことを特徴とする請求の範囲１から３のうちのいずれかに記載の能動マトリックス表示装置。
【請求項５】
前記データ信号調整回路は、直前のフィールド周期中に入力データ信号の値から取り出されたクロストーク補償値に従って入力データ信号を調整するようにしたことを特徴とする請求の範囲１から３のうちのいずれかに記載の能動マトリックス表示装置。
【請求項６】
前記データ信号調整回路を、前記列に対する入力データ信号によって決定された値が連続的なフィールド周期中に予め設定された量相違する場合には、画像素子の列に対して入力データ信号の調整を中止し、前記列に対する入力データ信号を、調整することなく当該列の画像素子に供給するように配置したことを特徴とする請求の範囲５記載の能動マトリックス表示装置。
【請求項７】
前記スイッチング手段は薄膜トランジスタを具え、前記クロストーク補償値を、前期所定の画像素子と同一列の画像素子に対するデータ信号及び前記所定の画像素子に沿って延在する列アドレスに接続した隣接する列の画像素子に対するデータ信号に従って取り出すようにしたことを特徴とする請求の範囲１から６のうちのいずれかに記載の能動マトリックス表示装置。
【請求項８】
前記スイッチング手段がプラズマチャネルを具え、画像素子に対する前記クロストーク補償値を、前記所定の画像素子と同一の列の画像素子に対するデータ信号及び当該列の一方の側の隣接する列の画像素子に対するデータ信号に従って取り出すようにしたことを特徴とする請求の範囲１から６のうちのいずれかに記載の能動マトリックス表示装置。
【発明の詳細な説明】
本発明は、スイッチング手段を結合した液晶表示素子を具える画像素子の行列アレイと、前記画像素子の行列にそれぞれ結合した行アドレスライン及び列アドレスラインのセットと、データ信号を前記列アドレスラインに供給するとともに前記行アドレスラインを走査して、前記画像素子の各行を順次選択し、関連の列アドレスラインに供給されるデータ信号に従って選択した行の表示素子を駆動する駆動回路とを有する能動マトリックス表示装置に関するものである。
上記種類の表示装置は十分既知である。通常、このような表示装置に用いられるスイッチング手段は、ＴＦＴ（薄膜トランジスタ）を具える。ＴＦＴタイプの表示装置の一例は、米国特許出願明細書第４８４５４８２号に記載されている。このような表示装置において、行アドレスライン及び列アドレスラインのセットを、表示素子電極及びアドレスラインのセット間の各交差部に隣接するＴＦＴとともに二つの離間した基板のうちの一方に支持し、それに対して他方の基板は共通電極を支持する。各ＴＦＴを、その関連の表示素子電極並びに各行アドレスライン及び列アドレスラインに接続する。行アドレスライン及び列アドレスラインに接続した駆動回路は、選択信号を各行ラインに順に供給するとともに、データ信号を列ラインに供給し、これによって、選択した行の表示素子を、各スイッチング装置を通じて、関連の列ラインのデータ信号の値に依存ずるレベルまで充電して、要求される表示出力の発生させる。画像素子の行は、１フィールド周期全体に亘って表示画像が確立されるように各行アドレス周期中に順次個別に駆動され、この際、画像素子は、連続的なフィールド周期中同様にして繰り返しアドレス指定される。このような表示装置は、データグラフ表示又はビデオ画像に好適であり、この際、データ信号は、入力ビデオ、例えば、ＴＶ信号をサンプリングすることによって取り出される。
これら表示装置の問題は、列アドレスラインと当該列ラインに関連する表示素子の表示素子電極との間の各画像素子回路の寄生すなわち漂遊容量性の影響によって生じるとともにソース端子及びドレイン端子を列ライン及び表示素子電極にそれぞれ接続したＴＦＴの自己キャパシタンスの結果としての垂直クロストークである。このようなキャパシタンスの結果、選択の際に列ライン上に存在するとともに列ラインに関連した画像素子を駆動する際に用いるためのデータ電圧信号を、垂直クロストークが生じるとともに絶縁したと仮定した表示素子の出力に悪影響を及ぼす列の選択されていない画像素子に結合する。この垂直クロストークを、同一行の他の表示素子に対するデータ信号に応答して所定の表示素子のＲＭＳ電圧に依存するものと考えることができる。このようなクロストークの問題は米国特許出願明細書第４８４５４８２号に記載されており、これには、標準的な行アドレス周期より短い時間中ゲーティング信号を行ラインに供給し、周期の残りの時間中に補償信号を列ラインに供給することによって影響を減少させる方法が記載されており、補償信号は全データ信号の一部となり、その結果、当該データ信号の結果として列ラインに接続した他の画像素子に生じた任意のクロストークを減少させる。しかしながら、行アドレス周期が短縮されるので、表示素子を通常より短い時間で充電する必要があり、これは、より高いゲーティング電圧を用いる必要があり、したがって、ＴＦＴに対するエージングの増大及び比較的高い電圧の行駆動回路の必要を含む多数の不都合を有する。これによってゲーティング信号が低下するので、行ラインの抵抗も更に著しくなる。
垂直クロストークの影響の程度は、表示装置を駆動する方法に依存する。フィールド反転を用いる場合、この影響は相当なものとなるおそれがある。フリッカーを除去するためにライン反転駆動形態を用いることによって、この影響をある程度軽減することができ、この際、列ラインに供給されるデータ信号は行ごとに反転され、その結果、結合された列電圧は、交互に正の値及び負の値を交互に有するようになり、これによって、全体に亘って結合されたＲＭＳ電圧は零に近づくとともに垂直クロストークの量を減少させる。しかしながら、デルタカラーフィルタパターンを用いるカラー表示装置で単一ライン反転を用いる際に問題が生じ、この場合、各列ラインは、二つの色のみを有する画像素子に接続される。この場合、赤のような原色の大領域に対するデータ信号は、フィールド反転を有する平坦な黒又は白領域に対するものと同一であり、多量のクロストークが発生するおそれがある。また、コンピュータデータグラフ表示において、あるビデオパターンの性質は反転手順を相殺するおそれがあり、これによって垂直クロストークは一層顕著になる。
国際特許出願公開明細書第９６／１６３９３号には、上記種類の能動マトリックス表示装置が記載されており、この場合、駆動回路は、表示素子とこれに関連する列アドレスラインとの間の容量性結合が原因の表示パネルの垂直クロストークの影響を補償するデータ信号調整回路を有し、この調整回路は、データ信号が供給される入力部を有し、画像素子が次にアドレス指定されるまで周期中に当該画像素子と同一の列アドレスラインに接続した他の画像素子に対するデータ信号から取り出されるクロストーク補償値に従う画像素子に対する入力データ信号を調整し、この際、調整されたデータ信号を、画像素子を駆動するに当たり列アドレスラインに供給する。したがって、単に列アドレスラインのデータ信号が原因の垂直クロストークの量を減少させることを試みるよりは、列結合現象を通じた垂直クロストークの影響を、画像素子に対するデータ信号が原因の予測される列結合を許容することができるようにデータ信号がこれら画像素子に供給される前に画像素子の列に対するデータ信号を変更し、その結果、これらデータ信号を適切な画像素子に供給した後、個々の画像素子の垂直クロストークの影響によって、ほぼ意図された正確な電圧を有する表示素子となり、その結果、このような調整前にデータ信号の値によって決定されるような意図した出力に近くなる出力を発生させる表示素子となる。調整回路は、実際、このようなクロストークが原因のＲＭＳ表示素子電圧の誤差を予測し、予測した誤差とほぼ同一の大きさで符号が逆のデータ信号を発生させることによって調整を行う。この技術を用いると、画像素子アドレス周期は減少されず、したがって、アドレス周期の減少を必要とする上記アプローチによって生じる問題は回避される。それは、他の重大な利点も提供する。従来、垂直クロストークの結果は、画像素子サイズに制限を課していた。例えば、高密度アレイを提供するために画像素子サイズを減少させると、列結合係数が増大し、垂直クロストークは悪化する。既知の方法はクロストークを十分減少させることができないという制限がある。しかしながら、この技術を用いると、このような画像素子サイズの制限を克服することができる。
本発明の目的は、クロストークが原因の不所望な表示の影響を減少させることができる更に向上した能動マトリックス表示装置を提供することである。
本発明によれば、冒頭で説明した種類の能動マトリックス表示装置は、前記駆動回路は、クロストーク補償値に従って前記列アドレスラインに供給される前に入力データ信号を調整するとともに前記表示素子に対する漂遊容量性結合が原因のクロストークの影響を補償するために前記表示素子を駆動するのに用いる前記列アドレスに対して調整したデータ信号を供給するデータ信号調整回路を有し、このデータ信号調整回路が、所定の画像素子に対するクロストーク補償値を、当該画像素子が存在する画像素子の列に接続した前記列アドレスライン及び画像素子の隣接する列に接続した列アドレスラインのうちの少なくとも一つに対して画像素子を選択するまでの周期中に供給されるデータ信号から取り出すことを特徴とするものである。
この表示装置を用いると、予測される垂直クロストークの影響が考慮されるだけでなく、表示素子と画像素子の隣接する列を駆動するために用いられる列ラインの一方又は両方との間の不所望な結合が原因のクロストークの水平形態も考慮される。ＴＦＴを用いるような能動マトリックス表示装置において、行アドレスライン及び列アドレスラインのセットを、表示素子電極の隣接する行間のギャップ及び隣接する列間のギャップに延在するように、ＴＦＴ及び表示素子電極とともに一つのプレート上に配置する。その結果、所定の列の画像素子に対して、表示素子電極及び列アドレスラインの物理的なレイアウトによって、表示素子電極と画像素子に関連する列アドレスラインの次の列アドレスラインとの間に容量性結合が生じる。この隣接する列アドレスラインに対するデータ信号及び関連の列アドレスラインのデータ信号を考慮することによって、関連の列アドレスラインのデータ信号の影響に加えて、これらデータ信号の予測される影響は、調整回路で計算されるとともに両列アドレスラインからの予測される影響を無効にするために所定の画像素子に対するデータ信号を調整するために用いられる補償値で併合される。その結果、クロストークの影響は更に減少される。
所定の種類の表示用途に対して、上記列アドレス導体に関連する全てでない一部の画像素子に対するデータ信号の値によってデータ信号を補償することによって十分な向上を得ることかできるが、好適には、データ信号の変更を、最適な結果を得るためにこれらアドレスラインに関連する他のほぼ全ての画像素子に対するデータ信号を考慮する。本発明の結果としてのクロストークの減少は、考慮される列導体に供給すべき複数のデータ信号の電圧とともにほぼ線形的に変動するために理解することができる。
大抵の表示状況で有効に補償を行うために、入力データ信号に行う調整を、好適には、同一列の他の画像素子及び当該入力データ信号による特定の画像素子のアドレス指定に続くフィールド周期中に隣接する列の少なくとも一つの対応する画像素子に対する入力データ信号の値によって行う。したがって、好適な実施の形態において、入力データ信号を、１フィールド周期中に調整回路の記憶装置に保持し、その後、同一列及び当該フィールド周期中に記憶装置に保持された隣接する一つ以上の列の画像素子に対する入力データ信号の値から決定された補償値によって調整する。関連の入力データ信号による画像素子のアドレス指定の前のこれら他の画像素子に対する、供給されるビデオ信号によって決定されるような実際のデータ信号を知る必要があるので、記憶装置が必要とされる。この際、補償値を導き出す際に用いられる意図されたデータ信号は、使用すべき供給されたビデオ信号による実際のデータ信号となる。実際には、フィールド記憶装置を用いてデータ信号を保持する。
所定の状況、特に、静止画像すなわち静止部を含む画像を原則的に表示するために表示装置を大幅に用いる場合、より簡単なアプローチが可能である。したがって、他の実施の形態において、データ信号調整回路は、直前のフィールド周期中にデータ信号入力の値から導き出されるクロストーク補償値によって入力データ信号を調整する。したがって、補償値を誘導する際に用いられる意図したデータ信号は、同一及び隣接する列の他の画像素子に対する実際の入力データ信号でなく、仮定されたデータ信号であり、例えばフィールド反転の場合に符号の変化が用いられることを除いて次のフィールド周期のデータ信号が静止画像に対して同一であるということに基づいて予測される。換言すれば、実際の、将来のデータ信号電圧を、単に現在のデータ信号電圧の逆であると仮定することができる。現在のデータ信号電圧を用いて、将来のデータ信号電圧を予測することができる。この場合、フィールド記憶装置を設ける必要がなくなる。当然、データ信号予測は、相違する表示画像を提供するために入力データ信号を変化させる場合には不正確である。しかしながら、データ信号調整前の二つの表示画像感のこのような変化の影響を、気付くことのできないような二つのフィールドに制限することができる。しかしながら、好適には、連続的な動作を表示すべき状況に適応するために、データ信号調整回路を配置して、連続的なフィールド中の列に対する入力データ信号に依存する値を比較するとともに、連続的なフィールド中の値が予め決定された量相違する場合に列に対する入力データ信号の調整を中止する。したがって、入力データ信号を用いて、クロストーク補償に対して調整することなく関連の列の画像素子をアドレス指定することができる。この際にクロストークの影響が存在しても、不正確な、予測されるデータ信号に基づく調整が連続的である場合に生じる影響に比べて目に見えにくい。
好適には、データ信号を、同一又は一つ以上の隣接する列アドレスラインに接続した他の画像素子に対するデータ信号によって決定された補償係数、意図した表示素子電圧、及び画像素子回路に対する容量性結合係数によってほぼ調整する。結合係数は、例えば、表示素子キャパシタンス及び表示素子とアドレスラインとの間の漂遊キャパシタンスに依存する。連続的なフィールドがフィールドブランキング間隔によって分離される供給されたビデオ、例えば、ＴＶ信号から導き出されたデータ信号の場合、ブランキング間隔はフィールド周期の顕著な部分となるおそれがあるので、調整されたデータ信号の誘導を考慮する。
ＴＦＴタイプの表示装置の場合、補償値を、好適には、関連の画像素子と同一列の画像素子に対するデータ信号及び関連のアドレスラインが当該画像素子に沿って延在する隣接する列の画像素子に対するデータ信号によって導き出す。
スイッチング手段としてＴＦＴを用いる表示装置に加えて、本発明を、表示素子の行に対する有効なスイッチング手段としてプラズマチャネルを用いるプラズマアドレス指定表示装置（ＰＡＬＣ表示装置）にも同様に適用することができる。この場合、画像素子に対するクロストーク補償値を、好適には、関連の画像素子と同一列の画像素子に対するデータ信号及び隣接する二つの列、すなわち、当該列の両側の画像素子に対するデータ信号によって誘導することができる。本発明を、スイッチング手段が薄膜ダイオードのような２端子の非線形スイッチング装置を具える能動マトリックス表示装置に適用することもできる。他のタイプの表示装置において、例えば、２端子スイッチング装置を用いる表示装置に関連する上記国際特許出願公開明細書第９６／１６３９３号に記載された、列ラインに関連した表示素子に対する列ライン上に存在するデータ信号の結合が原因でクロストークが発生するおそれがある。しかしながら、それに加えて、表示タイプの形態に依存する中間キャパシタンスを通じて直接的に又は間接的に表示素子と隣接する列ラインとの間の漂遊容量性結合の結果表示素子に関連する隣接する列ラインのデータ信号が原因で、水平タイプのクロストークが生じるおそれがある。したがって、本発明を、これら結合が原因の不所望なクロストークの大きさを有効に減少させるのに用いることができる。
本発明による能動マトリックス表示装置の実施の形態を、添付図面を参照して例示して説明する。
図面中、同一又は同様な部材に同一参照符号を付すものと理解されたい。
図１を参照すると、ビデオ表示用、例えば、ＴＶ、画像又はグラフ情報表示用の能動マトリックス表示装置は、液晶表示パネル１０を具え、この液晶表示パネル１０は、ｎ行ｍ列の行列アレイを画像素子１２を有し、その各々を、導体１４及び１６を具える行アドレスライン及び列アドレスラインのセット間の各交差部に隣接して配置し、これら導体１４及び１６に対して、駆動信号を行駆動回路２０及び列駆動回路２１から供給する。パネル１０を、既知の種類のものとし、画像素子に対するスイッチング装置としてＴＦＴを用いるタイプとする。図２は、パネルの代表的な画像素子の回路形態を示す。ＴＦＴ２５のゲートを行アドレス導体１４に接続し、そのソース端子及びドレイン端子を、アドレス導体１６及び表示素子３０の電極にそれぞれ接続する。パネルの導体１４及び１６のセット、ＴＦＴ並びに表示素子電極の全てを、パネルの、例えば、ガラス製の第１透明基板上に支持し、この基板を第２透明基板から離間し、これら基板間に液晶材料、例えば、捩じれネマチックＬＣ材料を配置する。第２基板上に支持された連続的な透明電極の各部分は、表示素子の第２電極を構成し、これによって、各表示素子３０は、ＬＣ材料を挟んだ離間電極の対から成る。同一行の全ての画像素子を、行アドレス導体１４のセットの一つにそれぞれ接続し、同一列の全ての画像素子を、列アドレス導体１６のセットの一つにそれぞれ接続する。これら基板は、通常の方法で外側表面及び内側表面上に、偏光層、ＬＣ配向層及び保護層をそれぞれ支持する。
表示装置の行駆動回路２０及び列駆動回路２１も、それぞれ通常の種類のものとする。行駆動回路２０、例えば、デジタルシフトレジスタ回路は、列導体１４を周期的に走査し、選択信号を各行アドレス周期中に各行導体に順次供給する。この動作は、同期分離回路２７からの同期信号が供給されるタイミング及び制御回路２２からのタイミング信号によって制御され、タイミング信号は、入力部２８に供給される入力ビデオ、例えば、ＴＶ信号から得られる。列駆動回路２１は、一つ以上のシフトレジスタ／サンプル−ホールド回路を具え、そのシフトレジスタ／サンプル−ホールド回路に対して、供給されたビデオ信号から得られるデータ（ビデオ情報）信号が、ビデオ信号処理回路２４から供給される。回路２１は、タイミング及び制御回路２２の制御下でこれら信号をサンプルするように作動し、このタイミング及び制御回路２２は、列走査に対して同期をとって、パネルのアドレス指定時に行に対して適切な並列変換を順次行う。各行ライン導体１４を、選択信号を用いて走査するので、画像素子の関連の列のＴＦＴ２５をターンオンして、その行の表示素子３０を、関連の列ライン導体１６の各々に存在するデータ信号のレベルに従って、所望の表示素子電圧まで充電する。表示素子電圧はデータ信号電圧に比例する。選択信号が終了すると、画像素子のＴＦＴはターンオフし、これによって、表示素子は、これらが次のフィールド周期でアドレス指定されるまで表示素子を列導体から絶縁する。パネルの表示素子の各行をこのようにアドレス指定して、表示画像をフィールド周期中に確立し、その動作を、連続的なフィールド周期中に繰り返して、一連の表示画像フィールドを発生させる。例えば、ＴＶ表示の場合、表示素子の各行に、ＴＶライン周期又はそれ以下に対応する選択信号の持続時間を有するＴＶラインの画像情報、データを設けて、半解像度のＰＡＬ規格に対して、ＴＶ表示は６４ｕｓのライン周期を有し、各行アドレス導体に、２０ｍｓの間隔で選択信号を供給する。
ＬＣ材料の電気機械的な低下を回避するために、駆動信号の極性を、例えば、各フィールドの後に周期的に反転させる（フィールド反転）。極反転を、通常ライン（行）反転及び二重ライン（行）反転と称する１行ごと又は２行ごとに実行して、フリッカの影響を低減させることもできる。
以上説明したように、動作中、各列アドレス導体１６が、一連のデータ信号電圧レベルからなる電圧波形を搬送し、データ信号電圧レベルの各々が、列導体に接続した画像素子の列の画像素子の各々に対するものであることは明らかである。理想的には、列の各表示素子は、その関連の列導体を選択したときにアクセスされ、表示サイクルの残りに対しては電気的に絶縁された状態である。しかしながら、列導体電圧波形を隣接する表示素子に結合する漂遊容量が存在し、この結合によってクロストークが生じる。この結果は、表示素子電圧、したがって選択されていない表示素子の伝播に悪影響を及ぼす。表示解像度を増大させることによって、漂遊結合容量がより顕著になるので、悪影響がより顕著になる。ＴＦＴタイプの表示装置において、不所望な結合の主要な原因は、列アドレス導体と表示素子電極との間の漂遊容量である。図３は、表示装置の能動基板上の素子に対する代表的な物理的なレイアウトを線形的に示す。表示素子電極３５をＴＦＴ２５のドレインに接続し、ＴＦＴ２５のソースを、列アドレス導体１６、この場合導体ｄに接続し、この導体を通じてデータ信号が電極に供給される。この列導体は、電極３５の一方の側に沿って近接するように続き、画像素子の隣接する列に対する列導体であるｄ＋１列導体は、その反対の側に近接するように延在する。行アドレス導体ｇ及びｇ＋１は、電極の各々の上端及び下端に沿って延在する。記憶キャパシタ３６は、表示素子に並列して本例の画像素子回路に有効に含まれる。図４は、この回路形態に存在する種々のキャパシタンスを示す等価回路図である。Ｐｘは、表示素子電極３５を表し、ＣLC，Ｃｓ及びＣｇは、表示素子キャパシタンス、記憶キャパシタのキャパシタンス及び電極３５と行導体との間の全漂遊キャパシタンスをそれぞれ表す。容量性結合は、表示素子電極と表示素子が配置された二つの列導体１６との間の寄生キャパシタンスＣｄｐ及びＣｄｐ'を通じて発生する。所定の結合は、Ｃｄｐに並列なＴＦＴのソース／ドレインキャパシタンスに起因するが、これは比較的小さい傾向にある。列導体ｄ及びｄ＋１は、図４にＶCOL(c,r)で示した電圧波形として一連のデータ信号を搬送する。この場合、ｃ及びｒは、接続した列及び行を表す。
ｘ行目の表示素子を考察すると、次の表示フィールドの表示素子１〜ｘ−１に対する列電圧に続く電流フィールドの関連の表示素子ｘ＋１〜ｎに対する列導体ｄ及びｄ＋１の電圧をｘ番目の表示素子に結合する。換言すれば、ｘ行目の表示素子のアドレス指定の後、当該表示素子としての同一列の他のｎ−１表示素子に対する全てのデータ電圧信号及び当該表示素子を再びアドレス指定する前にフィールド周期に対応する周期中に関連の列導体ｄ及びｄ＋１に現れる隣接する列の他のｎ−１表示素子に対する全てのデータ電圧信号を、結合する。したがって、任意の表示素子に対して結合された列電圧は、同時刻の次のｎ−１表示素子に対する列電圧に対応する列波形の一部となる。実際には、表示装置をある手段の反転（フィールド、ライン、２重ライン）で走査しているので、結合された電圧は、列信号の極の変化によって影響を及ぼされる。
クロストークの影響を減少させるために、表示装置は、その駆動回路に、デジタル信号処理回路を具えるデータ信号調整回路４０（図１）を有し、そのデータ信号調整回路４０は、表示素子から所望の出力を発生させるために、列導体に供給する前に、供給されるデータ信号を調整するように動作して、このクロストークの予測される影響を補償し、その結果、表示素子が、調整されたデータ信号を用いて駆動される前に、クロストークがない場合に意図される表示出力に接近する表示出力を発生させるように表示素子にクロストークの影響を及ぼすことができる。このために、列導体を通じて画像素子に供給するための入力ビデオ信号からの入力データ信号の値は、画像素子が次にアドレス指定されるまで、（画像素子の最終列は別にして、）列導体を通じて次にアドレス指定された他の画像素子のうちの少なくとも一部に対して又は隣接する列導体によってアドレス指定された隣接する列の画像素子に対して用いようとするビデオ信号からの入力データ信号の値に関連して調整される。これら列導体に接続した他の画像素子に対するデータ信号から得られる、したがってそのデータ信号によって決定されるクロストーク補償値の形態で各データ信号に対して行われる調整は、容量性結合によって生じたクロストークが原因の表示素子電圧に及ぼされる影響をほぼ補償する。
列導体ｄ及びｄ＋１（図３）から表示素子にそれぞれ結合される列データ信号の比は、以下の式によって決定される。
0003884080.tif 000002
これら結合係数Ｆ及びＦ'は、高解像度表示では、表示素子が小さくなるとともに寄生キャパシタンスがＣLC及びＣｓに対して増大するので顕著になる。
１フィールド周期に亘るＲＭＳ表示素子電圧は、ブランキングラインを含む入力信号のビデオラインの数によって除算された各ライン周期に亘る表示素子電圧の２乗の和の平方根によって与えられる。したがって、以下の式を、列導体からの容量性結合を考慮する列導体ｄとｄ＋１との間に配置された列ｃ及び行ｒの表示素子のＲＭＳ電圧に対して得ることができる。
0003884080.tif 000003
この場合、
ａ）
0003884080.tif 000004
を、表示素子（ｃ、ｒ）を再び選択する直前のライン周期まで表示素子（ｃ，ｒ）を選択する際のライン周期から１フィールド周期に亘るＲＭＳ表示素子電圧である（包含的）。
ｂ）Ｖcolを、アドレス指定後に表示素子電圧（Ｖpix）を決定するデータ信号の値とする。
ｃ）Ｖ0(c,r)＝Ｖcol(c,r)−Ｆ．Ｖcol(c,r)−Ｆ．Ｖcol(c+1,r)及びｄ）Ｎを、ビデオフィールド中のライン数とし、０□ｒ□（Ｎ−１）とする。
その結果、フィールドブランキングの影響が考慮される。ここで用いられるＶcolは、共通電極電圧からの寄与を含む必要がある。
新たな電圧に対して意図した値からの表示素子電圧のシフトは、表示素子の伝播に悪影響を及ぼす。例えば、フィールド変換中に動作し、表示装置を考慮し、反転信号の極性は全ての行に対して同一であり、３０％の伝送背景で中央の黒い四角形を表示するのに用いられる表示装置を考慮する場合、列結合によって生じた垂直クロストークの目に見えるアーティファクトは、背景の残りと異なる伝送レベルを有する中央の黒い四角形の上下の表示領域となる。表示装置がフィールド反転中に動作するので、結合された電圧が黒の方向に領域の表示要素をシフトする際に黒い中央の四角形は、より暗くなって現れるが、四角形の真下の領域はより明るくなって現れる。その理由は、（次のフィールドから）結合された電圧は逆極性となり、したがって、その領域の表示素子電圧を他の方向にシフトする。
このようなクロストークは、フィールド反転中に動作する表示素子上で特に顕著である。ライン反転は、これまでの問題を減少させることができるが、表示された画像の性質が、反転パターンを相殺する傾向（例えば、黒ラインが白ラインと交互に存在する。）にあるような性質である場合、クロストークは再び顕著に見えるようになる。この種のパターンは通常、コンピュータ上で発生した画像に見られる。上記記載は簡単なモノクロ表示に関するものである。いわゆるデルタ−ナブラカラー表示素子形態を用いるカラー表示装置は、原色のブロックを含む表示画像中でこれら表示装置の行反転の影響が同様に相殺されるおそれがあるので、クロストークを被害を被る。
式３を次のように展開することができる。
0003884080.tif 000005
この場合、総和は行＝ｒ＋１から行＝ｒ＋Ｎ−１となる。
列駆動信号を力学的に変形して、既に説明したように表示素子上のＲＭＳ電圧を計算することによってクロストークを無効にし、この場合、良好な近似に対して、各表示素子上の誤差電圧に等しく符号が逆の量によって各表示素子に対するデータ信号を調整することによって、クロストークを除去する。クロストークが原因の誤差電圧は、式（３）とＶpix(c,r)との間の差によって与えられる。この訂正電圧Ｖcorは、
0003884080.tif 000006
によって与えられる。
クロストークは、式
0003884080.tif 000007
に従う表示素子に対するデータ信号を適切に修正することによって表示装置中で補償される。この場合、Ｖcol'を、調整されたデータ信号とし、この調整されたデータ信号を列導体に供給する。この際、列結合が生じた後、このような結合の影響はほとんど補償され、表示素子上の電圧は、要求される電圧に近くなり、その結果、表示素子から得られる表示出力は、意図したものに近づく。例えば、所定の表示素子に対して５Ｖ ｒｍｓの電圧が要求される場合、式（３）を適用した後、実電圧は５．２Ｖ ｒｍｓとなることが分かり、この場合、追加の０．２Ｖ ｒｍｓは、代わりに約４．８Ｖを最初に表示素子に供給することによって接続した列導体に接続された他の表示素子に対するデータ電圧の列結合が原因の結合電圧であり、列結合の影響を大幅に除去することができ、実際のｒｍｓ表示素子電圧は、５Ｖの意図した値に非常に近くなる。当然、この補償は正確でなく、この補償は、信号が過度に調整される前に二つの列の他の表示素子に対して最初に意図したデータ信号から得られることを気に留めておくべきである。これらデータ信号が同様に補償される場合、列導体に供給される実データ信号レベルは、当然、調整されたデータ信号の補償に用いられるものと異なる。正確な補償は、静止画像及び周期的な動画に対してのみ容易となる。しかしながら、上記アプローチが非常に有効であり、目に見えるクロストークの影響を除去し又は少なくとも著しく低減することができることがわかる。
他の既知のクロストーク訂正法と異なり、このアプローチは、行オン／行オフパターンのような通常非常に相違するタイプの表示パターンを有する任意の種類の静止画像又は動画成分を用いて有効に作用し、駆動信号に余分なタイミング要求を課さない。表示素子上のクロストーク誤差電圧が次のフィールド周期全体に亘るデータ信号に依存するので、信号の記憶及び処理が必要とされる。個別のクロストーク訂正を、式（４）及び（５）を解くことによって各表示素子に対して計算する必要がある。このために、図５に示すようなルックアップテーブル４３（ＬＵＴ）を用いて訂正を計算する。この際、ＶＤＡＴをビデオ処理回路２４からデジタル形態で供給される入力ビデオデータとし、ＶＤＡＴ'を、訂正された出力ビデオデータとし、４２を訂正加算器とする。明らかに、式（４）及び（５）を解くために、表示素子（ｃ，ｒ）に対する表示素子電圧Ｖpixを含む変数の数の値、次のフィールド周期全体に亘って列ｃ及びｃ＋１に供給される列電圧の和ΣＶcol及びこれら列電圧の平方の和ΣＶ2colを知る必要がある。Ｎ，Ｆ及びＦ'に対する適切な固定値をＬＵＴ４３にプログラムする。
訂正の計算をある程度簡単にすることができる。１次Ｆ及びＦ'項が式（４）を支配する。高次の項は無視することができ、かつ、Ｆ＝Ｆ'＝Ｆ"であると仮定すると、式（４）を簡単にして、
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にすることができる。この簡単化された式に基づく訂正は完全でないが、それにもかかわらず、クロストークのレベルの影響を有効に減少させる。式（７）に基づく訂正を、図６に図示したようなＬＵＴを用いて実行することができる。見てわかるように、ＬＵＴ４３'は、この場合少数のアドレスラインを必要とする。
図５及び６の装置に関して、必要とされる和、例えば、ΣＶcol及びΣＶ2colを連続的な和から得ることができる。このような誘導方法を、一般に、国際特許出願公開明細書９６／１６３９３号に記載されたようにすることができ、これには、より詳細な方法が記載されており、適切な場合には回路を好適に変更してこの方法を実行することができる。簡単な説明を、図７を用いて１列に対するΣＶcolの誘導に関して与える。隣接する列に対するΣＶcolの誘導を、同様にして行うことができる。図７は、ＬＵＴ４３及び訂正加算器４２を有するデータ信号調整回路の一部を示す線形図である。連続的な和を用いて、各列に対するΣＶcol値を記憶する。ラインメモリ５１は、各列に対する連続的な和を有する。同様に、連続的な和を用いて、他に要求される和を記憶する。これら連続的な和を、次のようにして維持する。デジタル形態の入力ビデオデータ信号をフィールド遅延線５０に供給する。これは、古い記憶が消去されると表示素子の新たな行の値が入力するので、有効な循環フィールド記憶装置となる。列ｃの表示素子に対するデータ信号がフィールド遅延線に入力する度に、この表示素子に対する列電圧データが列ｃ和に加算される。列ｃ表示素子に対するデータ信号がフィールド遅延線から現れる度に、この表示素子に対する列電圧データは、列ｃ和から取り出される。個別の和は、表示アレイの全ての列（１〜ｍ）に対して維持される。このようにして、所定の表示素子に対するビデオデータがフィールド遅延線から現れるまで、次のフィールド周期に対するΣＶcolは、この表示素子に対するクロストーク訂正の計算に用いるために準備される。和ΣＶ2col及び和ΣＶcol(c,r)・ΣＶcol(c+1,r)は、ラインメモリに供給される前にＬＵＴを用いてデータ信号の平方値及び乗算値をそれぞれ発生させる点を除いて、同様に処理される。訂正されたデータ信号は、Ｄ−Ａコンバータを通じて列駆動回路２１に供給され、この場合、これら信号は、サンプルされて並列変換を順次行い、適切な列導体１６に供給されて画像素子を駆動する。
上記技術は、完全な解像度のフィールド遅延線を必要とする。しかしながら、既に説明した力学的な訂正形態より簡単であり、かつ、フィールド遅延線を必要としない相違するアプローチを用いることができる。表示画像が静止している場合、１フィールド周期前の列電圧は、フィールド又はライン反転駆動が行われると仮定すると現在の電流列電圧と符号が逆になる。したがって、列電圧が１フィールド周期全体に亘って零から加算される場合、この列の各表示素子に対するデータ信号が現在のＶcolを用いることによって将来のＶcolを予測するようになるので、ΣＶcolを更新することができる。したがって、連続的なΣＶcol予測を、フィールド遅延線を要求することなく行うことができる。当然、画像が変化すると、この予測は不正確になる。連続的な和、したがってクロストーク訂正も不正確になる。画像間の突然の変化は、２フィールド上の訂正が誤りであるがそれが非常に顕著である可能性が低いことを意味する。誤った訂正は、２フィールド周期中にのみ存在する（６０Ｈｚ表示に対して約３３ｍｓ）。連続的な変化を意味する連続的な動作を表現する際に、複雑な事態が生じる。これらの状況下で、「誤った」訂正は、それが連続的に存在するので表示画像中に見えるようになるおそれがある。このようなおそれを回避するために、特定の列に対する訂正を、各フィールド周期の終了時のデータ信号値に依存してターンオフする。顕著に変化しない列は、次のフィールド中に訂正を行うことができ、それに対して顕著に変化した列を訂正から除外することができる。この種の技術も、更に詳細に説明するためにここに開示した国際特許出願公開明細書第９６／１６３９３号に記載されている。
既に説明したように、上記クロストーク訂正形態は多数の顕著な利点を有することがわかる。例えば、行オン行オフパターンからのクロストークを、除去し又は少なくとも著しく減少させる。全ビデオライン時間は、表示素子アドレス指定及び充電の際に利用できる状態である。さらに、この形態は、列駆動回路のデータ速度を増大させる必要がなく、すなわち、行又は列ドライバＩＣを形成するように変化させる。
本発明は、大きな結合係数を有する表示装置、特に小型で高解像度のＴＦＴ表示装置に対して特に重要である。大きな容量性結合係数を有するプラズマアドレス指定液晶表示装置（ＰＡＬＣ装置）のような他の種類の能動マトリックス表示装置に対しても同様に好適に使用することができる。例えば、ここに参照することによって開示した欧州特許出願公開明細書第０６２８９４４号に記載したＰＡＬＣでは、ＴＦＴ表示装置に存在する個々のＴＦＴの行を、行の長さ方向に延在するイオン化ガスを充填したプラズマチャネルに置換する。プラズマチャネルは、マイクロシートと称する肉薄のガラスシートによってＬＣ層から分離される。行を、行のチャネルにプラズマを衝突させることによってアドレス指定することができる。このために、列ラインを通じて供給される電圧をサンプルするとともに、行の表示素子に保持することができる。
典型的なＰＡＬＣ表示装置の一部の部分的な線形断面図を図８に示す。下側ガラス基板６０に、行方向に延在するとともに電極６５が延在する方向に沿った複数の並列なガス充填チャネル６２を設ける。これらチャネルは、絶縁材料のマイクロシート６４によって被覆される。透明導電材料の平行ストリップ６７のセットを支持するとともに列ライン１６を構成する第２ガラス基板６６を、マイクロシート６４から離間し、これらの間に介在するスペースに、ＬＣ材料の層６８を充填する。ストリップ６７が交差する領域に、チャネル６２の各画像素子を規定する。
訂正を計算するために用いられる式がある程度相違しても、上記クロストーク形態を、このような装置に容易に適用することができる。
ホールド状態（すなわち、プラズマオフ）の際の三つの垂直方向に隣接するＰＡＬＣ画像素子１２の等価回路を図９に示す。この図において、ＬＣ，ＭＳ及びＰＣは、ＬＣ層６８の厚さ、マイクロシート６４及びプラズマチャネルをそれぞれ示し、ＶＥは仮想電極を示す。ＣLCを単−ＬＣ表示素子３０のキャパシタンスとし、Ｃmを、マイクロシートキャパシタンスとし、Ｃswを、マイクロシートの背面からアノード電極及びカソード電極までのプラズマチャネルのオフ状態キャパシタンスとする。Ｖa,cを、アノード電極及びカソード電極６５をホールド周期中に保持する電圧とする。Ｃssを、マイクロシートの背面上の垂直方向に隣接する仮想電極間の側面間キャパシタンスとする。Ｃdを、ＬＣ層及びマイクロシートを通じて対角線方向に対向する電極間のキャパシタンスとする。
マイクロシートは、ＬＣキャパシタンスＣLCに直列な小キャパシタンスＣmとして現れる。したがって、列ライン１６に供給される任意の電圧は、ＣmとＣLCとの間で分割される。正味の影響は、ＣLCの両端間に現れる有効な電圧が供給される列電圧の数分の１（１／α）のみであることである。これは、最高最低列電圧範囲Ｖcol_ppをα倍増大させてＬＣ表示素子ＣLCの要求される電圧範囲を達成する必要があることを意味する。したがって、第１に、要求されるＶcol_ppを減少させ、第２に、全画像素子キャパシタンスＣpを増大させることによって不所望な容量性結合係数を減少させるので、大きなＣm（肉薄のマイクロシート）が好適である。しかしながら、増大したＶcol_ppは、不所望な容量性結合が原因のＣLCの誤差電圧に直接悪影響を及ぼさない。その理由は、結合された電圧もαによって減少させられるからである。
所定の表示サイズ及び解像度に対して、不所望な容量性結合は、ＴＦＴ表示装置に対する場合に比べてＰＡＬＣ表示装置に対して顕著な影響を及ぼす。これには複数の理由がある。マイクロシートキャパシタンスによって全体に亘る表示素子キャパシタンスが減少し、これによって、列結合係数を増大させするとともにクロストークを悪化させる。側面間結合キャパシタンスは、ＰＡＬＣ表示装置構造においてより顕著になる。ＴＦＴ表示装置において、ホールド状態の表示素子は、列ｃ及びｃ＋１の電圧のみによって影響が及ぼされる。ＰＡＬＣ表示装置において、ホールド状態の列ｃ表示素子は、列ｃ−１，ｃ及びｃ＋１の電圧によって影響が及ぼされる。所定の状況において、これら三つの列から結合された電圧を加算して、より大きな誤差電流を発生させるおそれがある。ＰＡＬＣ表示装置における不所望な容量性結合によって生じた主に２種類のクロストークの影響がある。第１のものは、時々データ拡散と称される列キックバックとして既知である。この影響によって、表示コントラストが減少し、この影響は、関連の列ライン及び表示素子を選択した直後に生じる二つの隣接する列ラインの電圧の遷移の列の所定に表示素子への容量性結合によって生じる。この特殊なクロストークの影響を、互いに隣接する列ラインに供給されるデータ信号間の差の大きさを適切に強調することによってある程度克服することができる。ここでは、垂直クロストークに関連する第２の種類のクロストークの影響は、時々「前後クロストーク」として既知である。これは、拡張した色のブロック及び所定の交互のドットパターンが上下に見えるシェーディングの影響を発生させる。この影響は、列ｃの選択されていない表示素子に対する列ラインｃ−１，ｃ及びｃ＋１からの電圧の不所望な容量性結合によって生じる。この影響を、上記ＴＦＴ表示装置の例と同様な形態を用いて訂正することができる。
１フィールド周期に亘って、列ラインｃ−１，ｃ及びｃ＋１からの不所望な容量性結合の影響を考慮すると、以下の式を用いて、列ｃの行ｒの表示素子のＬＣ表示素子キャパシタンス（ＣLC）のＲＭＳ電圧を計算することができる。
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この場合、
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を、表示素子（ｃ，ｒ）が再び選択される前のラインまで表示素子（ｃ，ｒ）が選択される際のライン周期からの１フィールド周期全体に亘るＲＭＳ表示素子（ｃ，ｒ）電圧とする（包含的）。
ＶLC(c,r)を、表示素子が選択される際にセットされる初期電圧とする。
Ｖo(c,r)＝ＶLC(c,r)−ＦＶcol(c,r)＋Ｆ'（Ｖcol(c-1,r)+Ｖcol(c+1,r)）。
これは、列キックバックが生じた後の表示素子の電圧を付与する。Ｖcol(c,r)を、行ｒを選択した際に列ラインｃに供給される列電圧とする。１／α＝Ｃm／（Ｃm＋ＣLC）とする。これは、ＣLCとＣLCの両端間に現れるＣmとの間の全電圧の数分の１である。
Ｆを、列ラインｃと表示素子（ｃ，ｒ）との間の結合係数とし、Ｆ'を、列ラインｃ−１又はｃ＋１と表示素子（ｃ，ｒ）との間の結合係数と間の結合係数とする。
Ｎ＝ビデオフィールドの全ライン数であり、０□ｒ□Ｎ−１とする。フィールドブランキング周期中に供給される電圧はこの計算に含まれる。
式（８）を拡張して、
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を与えることができる。この場合、全ての和を、行＝ｒ＋１から行＝ｒ＋Ｎ−１とする。垂直クロストークが原因の誤差電圧は、誤差＝式（９）によって付与される。この誤差を、誤差と大きさが同一で符号が逆の訂正を（列キックバックの影響に対する任意の調整後）表示素子電圧Ｖoに加えにことによって除去することができる。この訂正を、図５に図示したＴＦＴ表示素子に対する配置と比較すると、図１０に示したルックアップテーブルを用いて計算することができる。既に説明したように、デジタル形態の入力ビデオデータＶＤＡＴを、ルックアップテーブルからのクロストーク訂正値とともに訂正加算器４２に供給して、訂正された出力ビデオデータＶＤＡＴ'を得る。
各変数を表すために用いられるビット数を、ルックアップテーブルのサイズを減少させるために最小にする必要がある。訂正ハードウェアを簡単にすることができる他の方法は次の通りである。
「行」の全ての値に対してＶcol(c-1,row)＝Ｖcol(c1,row)＝Ｖcol(c+1,row)である場合、隣接列ライン上の信号は同相であり、式（８）を、
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と書くことができる。この場合、Ｆ"＝Ｆ−２Ｆ'である。これらの状況下で、垂直クロストークが原因の誤差電圧は最小になる。
同様に、「行」の全ての値に対して−Ｖcol(c-1,row)＝Ｖcol(c1,row)＝−Ｖcol(c+1,row)である場合、隣接する列ライン上の信号は同相でなく、式（８）を式（１０）のように書くことができるが、Ｆ"＝Ｆ＋２Ｆ'である。この場合、垂直ストロークが原因の誤差電圧は最大になる。
任意の所定の画像に対して、式（１０）を用いて正確なＶLCmsを計算することができるＦ"の値が存在する。このＦ"の値は、Ｆ"＝Ｆ−２Ｆ'とＦ"＝Ｆ＋２Ｆ'の二つの境界間のいずれかにある。所定のフィールドの位置（ｃ，ｒ）の表示素子に対する理想的なＦ"値の良好な近似を、来るべきフィールド周期全体（又は静止垂直クロストーク訂正形態の場合の先行するフィールド周期全体）に亘る隣接列に供給される列電圧の和を比較することによって得ることができる。表示を単一行反転モードで駆動すると仮定すると、以下の式を適用する。
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この場合、ΣＶcocoを、表示素子（ｃ，ｒ）が選択される際の列ｃに対する「列オン列オフ」すなわち“ＣＯＣＯ”形態とする。ΣＶcoco＝０のとき、隣接する列の信号が同相であり、Ｆ"＝Ｆ−２Ｆ'であると仮定することができる。ΣＶcocoが最大値であるとき、隣接する列の信号が同相でなく、Ｆ"＝Ｆ＋２Ｆ'である。ΣＶcocoがある中間値を有する際に用いる線形補間を用いてＦ"の最適値を決定する。
したがって、式（１０）及び（１１）を用いて、図１１に示すような著しく小さいルックアップテーブルでＲＭＳを計算する。ΣＶcoco，ΣＶcol及びΣＶ2colを、国際特許出願公開明細書の９６／１６３９３号に記載したように連続的な和から得ることができる。
ＴＦＴを用いる表示装置及びＰＡＬＣ表示装置とともに、本発明を、２端子の非線形スイッチング装置を用いるマトリックス表示装置にも適用することができる。これら表示装置において、薄膜ダイオード装置ＴＦＤのようなスイッチング装置、例えば、ＭＩＭを、行アドレス導体と列アドレス導体との間の表示素子に直列接続し、行アドレス導体及び列アドレス導体のセットを、離間された基板上にそれぞれ支持し、これら基板間にＬＣ材料を配置する。ある形態において、行アドレス導体を、一方の基板上に支持されたストリップ電極のセットとして設けるとともに、列導体のセットを、表示素子電極の行列アレイ及びＴＦＤとともに他方の基板上に支持し、この際、ＴＦＤを表示素子電極と関連の列導体との間に接続し、列導体は、表示素子電極の隣接する列間のギャップに垂直に延在する。その結果、容量性結合が、表示素子電極と表示素子に誤差電極を発生させる表示素子の隣接する列に関連する列アドレス導体との間に存在する。他の形態において、表示素子電極を、行導体のセット及びＴＦＤと同一基板上に支持し、この際、各表示素子電極を、ＴＦＤを通じて関連の行導体に接続し、行導体は、表示素子電極の隣接する行間のギャップ中に水平に延在する。列導体のセットを、他方の基板上に支持するとともにストリップ電極のセットとして設け、ストリップ電極の各々は、表示素子電極の各列を被覆する。この場合、誤差信号を、表示素子電極及び隣接する列の表示素子電極によって形成された中間キャパシタンスを通じて表示素子に関連して隣接する列導体からの表示素子電極に間接的に結合することができる。
両形態において、上記データ信号調整回路を用いて、このような結合が原因の不所望なクロストークの影響をある程度減少させることができる。
上記実施の形態において、各画像素子に対する行われる調整は、関連の列の他の全ての画像素子に対するデータ信号レベルに基づくものである。両実施の形態及びその動作方法の性質によって、これを理想的に直接行うことができる。しかしながら、例えば、他の種類の調整回路を用いると、画像素子に対するデータ信号電圧の調整を、画像素子のアドレス指定及びその次のアドレス指定に続く周期中に列導体に供給しようとする全てのデータ信号より少ないデータ信号を用いて行うことができる。他の画像素子の割合に対してデータ信号を用いることによって、クロストークの減少は少なくなるが、所定の状況では許容することができ、かつ、十分な結果を与える。
調整してデータ信号を取り出すに当たり、国際特許出願公開明細書第９６／１６３９３号に記載されているように、データ信号を調整するのに用いられる回路４０の訂正値を発生させる際に、例えば、固有の動作又は感光特性、すなわち、キックバックの影響が原因のＴＦＴ又はＴＦＤの漏れ電流の影響を考慮することができる。
表示素子に関連する列導体及び表示素子の一つ又は両隣の列に関連する一つ以上の隣接する列導体のデータ信号の影響が最も重要である間、直接又は間接の別の結合が存在して、離間した列導体、すなわち、関連の表示素子に直接隣接しない列導体のデータ信号が原因の不所望なクロストークの影響が生じる。これら別の結合の影響がさほど重要でないように思われる間、所望の場合には回路４０の調整されたデータ信号の誘導を考慮することができる。
したがって、要約すれば、関連のスイッチング手段を持つＬＣ表示素子のアレイを有する能動マトリックス表示装置を開示し、そのスイッチング手段は、行アドレスライン及び列アドレスラインのセットを通じて行方向に順次アドレス指定し、この能動マトリックス表示装置は、駆動回路中にデータ信号調整回路を有し、このデータ信号調整回路は、列ラインに供給する前にデータ信号を調整して、画像素子アレイの漂遊容量性結合が原因のクロストーク垂直及び水平方向の不所望な影響を補償する。画像素子データ信号に対する訂正値は、同一列及び一つ又は両方の隣接列の他の画像素子に対する次のフィールド周期全体に亘って意図したデータ信号の値及び関連の容量性結合係数に従って、調整回路中で得られる。
本開示を読むと、他の変形は当業者には明らかである。このような変形は、液晶表示装置の分野で既に既知であるとともに既にここに開示した形態の代わりに又はその形態に加えて用いることができる他の形態を意味する。
【図面の簡単な説明】
図１は、本発明による能動マトリックス表示装置の簡単化した線形ブロック図である。
図２は、表示装置の第１の実施の形態の代表的な画像素子の回路を示す。
図３は、表示装置の第１の実施の形態の画像素子アレイの一部の物理的なレイアウトを線形的に示す。
図４は、第１の実施の形態の代表的な素子の等価回路である。
図５及び６は、表示装置の第１の実施の形態の駆動回路に用いられる訂正回路の他の形態の一部の回路形態を線図的に示す。
図７は、訂正回路の動作を線形的に示す。
図８は、表示装置の第２の実施の形態の表示パネルの一部を線形的な断面図である。
図９は、表示装置の第２の実施の形態の画像素子の代表的なグループの等価回路を示す。
図１０及び１１は、表示装置の第２の実施の形態の駆動回路で用いられる訂正回路の他の形態の一部の回路形態を線図的に示す。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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