(57)【特許請求の範囲】
【請求項１】
金属材料から構成される第１及び第２電極と、キャパシタ絶縁膜と、前記キャパシタ絶縁膜と前記第１電極の間に配置され、前記金属材料を構成する原子の拡散を防止する第１拡散防止膜と、前記キャパシタ絶縁膜と前記第２電極の間に配置され、前記金属材料を構成する原子の拡散を防止する第２拡散防止膜とを具備し、
前記キャパシタ絶縁膜と前記第１拡散防止膜との界面、及び、前記キャパシタ絶縁膜と前記第２拡散防止膜との界面は、それぞれ平坦であり、
前記第１電極は、第１トレンチ内に満たされ、かつ、その表面が平坦化され、
前記第２電極は、第２トレンチ内に満たされ、かつ、その表面が平坦化される
ことを特徴とするＭＩＭキャパシタ。
【請求項２】
前記第１及び第２電極の形状は、四角以外の格子状、すのこ状、櫛状を含む形状のうちの１つであることを特徴とする請求項１記載のＭＩＭキャパシタ。
【請求項３】
前記第１トレンチは、半導体基板内に形成され、前記第２トレンチは、前記半導体基板上の絶縁膜内に形成されることを特徴とする請求項１記載のＭＩＭキャパシタ。
【請求項４】
前記第１及び第２拡散防止膜は、窒化金属膜であることを特徴とする請求項１記載のＭＩＭキャパシタ。
【請求項５】
前記第１及び第２拡散防止膜は、Ｔｉ、ＴｉＮ、ＴｉＳｉＮ、Ｔａ、ＴａＮ、ＴａＣ、ＴａＳｉＮ、ＴａＣｅＯ２、Ｉｒ４６Ｔａ５４、Ｗ、ＷＮ、Ｗ２Ｎ、Ｗ６４Ｂ２０Ｎ１６、Ｗ２３Ｂ４９Ｎ２８ and Ｗ４７Ｓｉ９Ｎ４４ のグループのうちから選択される１つであることを特徴とする請求項１記載のＭＩＭキャパシタ。
【請求項６】
前記金属材料は、Ｃｕであることを特徴とする請求項１記載のＭＩＭキャパシタ。
【請求項７】
請求項１記載のＭＩＭキャパシタにおいて、
さらに、前記第１電極上に開口を有する絶縁層を具備し、
前記第１拡散防止膜は、前記絶縁層の開口に満たされ、前記キャパシタ絶縁膜及び前記第２拡散防止膜は、前記第１拡散防止膜上に形成されることを特徴とするＭＩＭキャパシタ。
【請求項８】
前記キャパシタ絶縁膜及び前記第２拡散防止膜の端部は、それぞれ、前記絶縁層にオーバーラップしていることを特徴とする請求項７記載のＭＩＭキャパシタ。
【請求項９】
請求項８記載のＭＩＭキャパシタにおいて、
さらに、前記第２拡散防止膜上に形成される窒化シリコン膜を具備することを特徴とするＭＩＭキャパシタ。
【請求項１０】
前記第１拡散防止膜は、前記第１電極上に形成され、前記キャパシタ絶縁膜は、前記第１拡散防止膜上に形成され、前記第２拡散防止膜は、前記キャパシタ絶縁膜上に形成され、
前記第１及び第２拡散防止膜及び前記キャパシタ絶縁膜は、窒化シリコン膜に覆われていることを特徴とする請求項１記載のＭＩＭキャパシタ。
【請求項１１】
請求項１記載のＭＩＭキャパシタにおいて、
さらに、前記第１電極上に開口を有する絶縁層を具備し、
前記第１及び第２拡散防止膜及び前記キャパシタ絶縁膜は、それぞれ、前記絶縁層の開口内に形成されることを特徴とするＭＩＭキャパシタ。
【請求項１２】
前記第１及び第２拡散防止膜及び前記キャパシタ絶縁膜の端部は、それぞれ、前記絶縁層にオーバーラップしていることを特徴とする請求項１１記載のＭＩＭキャパシタ。
【請求項１３】
請求項１２記載のＭＩＭキャパシタにおいて、
さらに、前記第２拡散防止膜上に形成される窒化シリコン膜を具備することを特徴とするＭＩＭキャパシタ。
【請求項１４】
請求項１記載のＭＩＭキャパシタにおいて、
さらに、前記第１電極上に開口を有する絶縁層を具備し、
前記第１及び第２拡散防止膜及び前記キャパシタ絶縁膜は、それぞれ、前記絶縁層の開口内に形成され、かつ、前記絶縁層から離れていることを特徴とするＭＩＭキャパシタ。
【請求項１５】
請求項１４記載のＭＩＭキャパシタにおいて、
さらに、前記第２拡散防止膜上に形成される窒化シリコン膜を具備することを特徴とするＭＩＭキャパシタ。
【請求項１６】
請求項１記載のＭＩＭキャパシタにおいて、
さらに、前記第１及び第２拡散防止膜の少なくとも１つを構成する材料と同じ材料から構成される抵抗素子を具備することを特徴とするＭＩＭキャパシタ。
【請求項１７】
前記抵抗素子は、ＣＭＯＳロジックエリア内に形成されることを特徴とする請求項１６記載のＭＩＭキャパシタ。
【請求項１８】
前記第１トレンチは、半導体基板上の第１絶縁膜内に形成され、第２トレンチは、前記第１絶縁膜上の第２絶縁膜内に形成され、前記第１及び第２絶縁膜の表面は、平坦化されていることを特徴とする請求項１記載のＭＩＭキャパシタ。
【請求項１９】
請求項１８記載のＭＩＭキャパシタにおいて、
さらに、前記第１電極の直下に形成されるＭＯＳトランジスタを具備することを特徴とするＭＩＭキャパシタ。
【請求項２０】
前記第１及び第２電極に与えられる信号の周波数と前記ＭＯＳトランジスタに与えられる信号の周波数との差が５０倍未満であることを特徴とする請求項１９記載のＭＩＭキャパシタ。
【請求項２１】
請求項１９記載のＭＩＭキャパシタにおいて、
さらに、前記第１電極と前記ＭＯＳトランジスタとの間に形成され、一定電位に設定されているシールド線を具備することを特徴とするＭＩＭキャパシタ。
【請求項２２】
前記一定電位は、接地電位であることを特徴とする請求項２１記載のＭＩＭキャパシタ。
【請求項２３】
前記第１及び第２電極に与えられる信号の周波数と前記ＭＯＳトランジスタに与えられる信号の周波数との差が５０倍以上であることを特徴とする請求項２１記載のＭＩＭキャパシタ。
【請求項２４】
金属材料から構成される第１及び第２電極と、前記第１及び第２電極の間に配置され、前記金属材料の拡散を防止する機能を有するキャパシタ絶縁膜とを具備し、
前記キャパシタ絶縁膜と前記第１電極との界面、及び、前記キャパシタ絶縁膜と前記第２電極との界面は、それぞれ平坦であり、
前記第１電極は、第１トレンチ内に満たされ、かつ、その表面が平坦化され、
前記第２電極は、第２トレンチ内に満たされ、かつ、その表面が平坦化される
ことを特徴とするＭＩＭキャパシタ。
【請求項２５】
前記第１トレンチは、半導体基板内に形成され、前記第２トレンチは、前記半導体基板上の絶縁膜内に形成されることを特徴とする請求項２４記載のＭＩＭキャパシタ。
【請求項２６】
前記第１トレンチは、半導体基板上の第１絶縁膜内に形成され、第２トレンチは、前記第１絶縁膜上の第２絶縁膜内に形成され、前記第１及び第２絶縁膜の表面は、平坦化されていることを特徴とする請求項２４記載のＭＩＭキャパシタ。
【請求項２７】
前記金属材料は、Ｃｕであることを特徴とする請求項２４記載のＭＩＭキャパシタ。
【請求項２８】
ダマシンプロセスにより金属材料からなる第１電極を形成し、
前記第１電極上に前記金属材料の拡散を防止する機能を有する第１絶縁膜を形成し、
前記第１絶縁膜の一部を除去し、この部分をキャパシタ形成予定領域とし、
前記キャパシタ形成予定領域内に前記金属材料の拡散を防止する機能を有する第１拡散防止膜を形成し、
前記第１拡散防止膜上に、キャパシタ絶縁膜、前記金属材料の拡散を防止する機能を有する第２拡散防止膜、及び、前記第１絶縁膜と同じ機能を有する第２絶縁膜をそれぞれ形成し、
前記第１及び第２絶縁膜上に層間絶縁膜を形成し、
前記ダマシンプロセスを用いて、前記層間絶縁膜並びに前記第１及び第２絶縁膜に、前記第１電極及び前記前記第２拡散防止膜に達するトレンチを形成し、
前記トレンチ内に前記金属材料を満たし、前記第１電極に接続する配線及び前記第２拡散防止膜に接続する第２電極をそれぞれ形成する
ことを特徴とするＭＩＭキャパシタの製造方法。
【請求項２９】
前記第１拡散防止膜は、窒化金属膜をスパッタした後、前記窒化金属膜をＣＭＰにより研磨することにより形成され、前記キャパシタ絶縁膜、前記第２拡散防止膜及び前記第２絶縁膜は、ＰＥＰとＲＩＥにより、それぞれ連続して加工されることを特徴とする請求項２８記載のＭＩＭキャパシタの製造方法。
【請求項３０】
前記第１拡散防止膜、前記キャパシタ絶縁膜、前記第２拡散防止膜及び前記第２絶縁膜は、ＰＥＰとＲＩＥにより、それぞれ連続して加工され、その端部は、前記第１絶縁膜にオーバーラップしていることを特徴とする請求項２８記載のＭＩＭキャパシタの製造方法。
【請求項３１】
前記第１拡散防止膜、前記キャパシタ絶縁膜、前記第２拡散防止膜及び前記第２絶縁膜は、ＰＥＰとＲＩＥにより、それぞれ連続して加工され、その端部は、前記キャパシタ形成予定領域内に収まっていることを特徴とする請求項２８記載のＭＩＭキャパシタの製造方法。
【請求項３２】
ダマシンプロセスにより金属材料からなる第１電極を形成し、
キャパシタ形成予定領域内の前記第１電極上に、前記金属材料の拡散を防止する機能を有する第１拡散防止膜、キャパシタ絶縁膜、及び、前記金属材料の拡散を防止する機能を有する第２拡散防止膜をそれぞれ形成し、
前記第２拡散防止膜上及び前記第１電極上に、前記金属材料の拡散を防止する機能を有する拡散防止絶縁膜を形成し、
前記拡散防止絶縁膜上に層間絶縁膜を形成し、
前記ダマシンプロセスを用いて、前記層間絶縁膜及び前記拡散防止絶縁膜に、前記第１電極及び前記前記第２拡散防止膜に達するトレンチを形成し、
前記トレンチ内に前記金属材料を満たし、前記第１電極に接続する配線及び前記第２拡散防止膜に接続する第２電極をそれぞれ形成する
ことを特徴とするＭＩＭキャパシタの製造方法。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、ＭＩＭ（Metal-Insulator-Metal）キャパシタに関する。
【０００２】
【従来の技術】
近年、例えば、ＲＦアナログデバイスとＣＭＯＳロジックデバイスをワンチップ内に形成することが検討されている。ＲＦアナログデバイスは、抵抗、コイル、キャパシタなどを含み、ＣＭＯＳロジックデバイスは、ＭＯＳトランジスタから構成される。
【０００３】
一方、ＲＦアナログデバイスとＣＭＯＳロジックデバイスをワンチップ化するためには、両デバイスの製造プロセスの統合を図る必要がある。例えば、ＣＭＯＳロジックプロセスをベースにし、これにＲＦアナログデバイスのプロセスを統合して、新規なＲＦ−ＣＭＯＳプロセスを開発する。
【０００４】
プロセスの統合を図るに当たって、最初に問題となるのは、ＭＩＭキャパシタの構造及びプロセスである。例えば、ＭＯＳトランジスタのゲート長が０．１μｍ以下になると、配線抵抗の低減などのため、配線材料として、Ｃｕ（銅）を使用することが検討されている。
【０００５】
しかし、Ｃｕは、大きな拡散係数を有する。従って、Ｃｕを電極とするＭＩＭキャパシタを形成する場合、Ｃｕがキャパシタ絶縁膜中に拡散し、リーク電流が増大するという問題がある。
【０００６】
また、配線材料にＣｕを使用する場合、Ｃｕ配線は、加工精度や平坦化などの理由から、いわゆるダマシンプロセス（Damascene process）により形成される。この時、ＭＩＭキャパシタの電極も、当然に、ダマシンプロセスにより形成されるため、ダマシンプロセスに起因する問題、例えば、ディッシング（dishing）の問題や、ディッシングを回避する場合の電極面積の縮小の問題が生じる。
【０００７】
【発明が解決しようとする課題】
本発明は、上記欠点を解決すべくなされたもので、その目的は、ＭＩＭキャパシタの電極がＣｕなどの大きな拡散係数を有する材料から構成される場合にも十分にリーク電流を防止すること、及び、ダマシンプロセス（ＣＭＰプロセス）を採用してもディッシングや電極面積の縮小などが生じない製造プロセスを提供することにある。
【０００８】
【課題を解決するための手段】
本発明のＭＩＭキャパシタは、金属材料から構成される第１及び第２電極と、キャパシタ絶縁膜と、前記キャパシタ絶縁膜と前記第１電極の間に配置され、前記金属材料を構成する原子の拡散を防止する第１拡散防止膜と、前記キャパシタ絶縁膜と前記第２電極の間に配置され、前記金属材料を構成する原子の拡散を防止する第２拡散防止膜とを備える。
【０００９】
前記第１及び第２電極の形状は、四角以外の格子状、すのこ状、櫛状を含む形状のうちの１つである。
【００１０】
前記第１電極は、半導体基板内のトレンチ内に満たされ、かつ、その表面が平坦化され、前記第２電極は、前記半導体基板上の絶縁膜内のトレンチ内に満たされ、かつ、その表面が平坦化されている。
【００１１】
前記第１及び第２拡散防止膜は、窒化金属膜である。前記第１及び第２拡散防止膜は、Ｔｉ、ＴｉＮ、ＴｉＳｉＮ、Ｔａ、ＴａＮ、ＴａＣ、ＴａＳｉＮ、ＴａＣｅＯ２、Ｉｒ４６Ｔａ５４、Ｗ、ＷＮ、Ｗ２Ｎ、Ｗ６４Ｂ２０Ｎ１６、Ｗ２３Ｂ４９Ｎ２８ and Ｗ４７Ｓｉ９Ｎ４４ のグループのうちから選択される１つである。
【００１２】
前記金属材料は、Ｃｕである。
【００１３】
本発明のＭＩＭキャパシタは、さらに、前記第１電極上に開口を有する絶縁層を備え、前記第１拡散防止膜は、前記絶縁層の開口に満たされ、前記キャパシタ絶縁膜及び前記第２拡散防止膜は、前記第１拡散防止膜上に形成される。前記キャパシタ絶縁膜及び前記第２拡散防止膜の端部は、それぞれ、前記絶縁層にオーバーラップしている。
【００１４】
本発明のＭＩＭキャパシタは、さらに、前記第２拡散防止膜上に形成される窒化シリコン膜を備える。
【００１５】
前記第１拡散防止膜は、前記第１電極上に形成され、前記キャパシタ絶縁膜は、前記第１拡散防止膜上に形成され、前記第２拡散防止膜は、前記キャパシタ絶縁膜上に形成され、前記第１及び第２拡散防止膜及び前記キャパシタ絶縁膜は、窒化シリコン膜に覆われている。
【００１６】
本発明のＭＩＭキャパシタは、さらに、前記第１電極上に開口を有する絶縁層を備え、前記第１及び第２拡散防止膜及び前記キャパシタ絶縁膜は、それぞれ、前記絶縁層の開口内に形成される。前記第１及び第２拡散防止膜及び前記キャパシタ絶縁膜の端部は、それぞれ、前記絶縁層にオーバーラップしている。
【００１７】
本発明のＭＩＭキャパシタは、さらに、前記第１電極上に開口を有する絶縁層を備え、前記第１及び第２拡散防止膜及び前記キャパシタ絶縁膜は、それぞれ、前記絶縁層の開口内に形成され、かつ、前記絶縁層から離れている。
【００１８】
本発明のＭＩＭキャパシタは、さらに、前記第１及び第２拡散防止膜の少なくとも１つを構成する材料と同じ材料から構成される抵抗素子を備える。前記抵抗素子は、ＣＭＯＳロジックエリア内に形成される。
【００１９】
前記第１電極は、半導体基板上の第１絶縁層内のトレンチ内に満たされ、前記第２電極は、前記第１絶縁層上の第２絶縁層内のトレンチ内に満たされ、前記第１及び第２絶縁層の表面は、平坦化されている。
【００２０】
本発明のＭＩＭキャパシタは、さらに、前記第１電極の直下に形成されるＭＯＳトランジスタを備える。前記第１及び第２電極に与えられる信号の周波数と前記ＭＯＳトランジスタに与えられる信号の周波数との差が５０倍未満である。
【００２１】
本発明のＭＩＭキャパシタは、さらに、前記第１電極と前記ＭＯＳトランジスタとの間に形成され、一定電位に設定されているシールド線を備える。前記一定電位は、接地電位である。
【００２２】
前記第１及び第２電極に与えられる信号の周波数と前記ＭＯＳトランジスタに与えられる信号の周波数との差が５０倍以上である。
【００２３】
本発明のＭＩＭキャパシタは、金属材料から構成される第１及び第２電極と、前記第１及び第２電極の間に配置され、前記金属材料の拡散を防止する機能を有するキャパシタ絶縁膜とを備える。
【００２４】
前記第２電極は、層間絶縁膜に設けられたトレンチ内に配置され、かつ、前記キャパシタ絶縁膜は、前記層間絶縁膜に対してエッチング選択比を有する。前記第１電極は、半導体基板内のトレンチ内に満たされ、かつ、その表面が平坦化され、前記第２電極は、層間絶縁膜内のトレンチ内に満たされ、かつ、その表面が平坦化されている。
【００２５】
前記金属材料は、Ｃｕである。
【００２６】
本発明のＭＩＭキャパシタの製造方法は、ダマシンプロセスにより金属材料からなる第１電極を形成し、前記第１電極上に前記金属材料の拡散を防止する機能を有する第１絶縁膜を形成し、前記第１絶縁膜の一部を除去し、この部分をキャパシタ形成予定領域とし、前記キャパシタ形成予定領域内に前記金属材料の拡散を防止する機能を有する第１拡散防止膜を形成し、前記第１拡散防止膜上に、キャパシタ絶縁膜、前記金属材料の拡散を防止する機能を有する第２拡散防止膜、及び、前記第１絶縁膜と同じ機能を有する第２絶縁膜をそれぞれ形成し、前記第１及び第２絶縁膜上に層間絶縁膜を形成し、前記ダマシンプロセスを用いて、前記層間絶縁膜並びに前記第１及び第２絶縁膜に、前記第１電極及び前記前記第２拡散防止膜に達するトレンチを形成し、前記トレンチ内に前記金属材料を満たし、前記第１電極に接続する配線及び前記第２拡散防止膜に接続する第２電極をそれぞれ形成する、という一連のステップから構成される。
【００２７】
前記第１拡散防止膜は、窒化金属膜をスパッタした後、前記窒化金属膜をＣＭＰにより研磨することにより形成され、前記キャパシタ絶縁膜、前記第２拡散防止膜及び前記第２絶縁膜は、ＰＥＰとＲＩＥにより、それぞれ連続して加工される。
【００２８】
前記第１拡散防止膜、前記キャパシタ絶縁膜、前記第２拡散防止膜及び前記第２絶縁膜は、ＰＥＰとＲＩＥにより、それぞれ連続して加工され、その端部は、前記第１絶縁膜にオーバーラップしている。
【００２９】
前記第１拡散防止膜、前記キャパシタ絶縁膜、前記第２拡散防止膜及び前記第２絶縁膜は、ＰＥＰとＲＩＥにより、それぞれ連続して加工され、その端部は、前記キャパシタ形成予定領域内に収まっている。
【００３０】
本発明のＭＩＭキャパシタの製造方法は、ダマシンプロセスにより金属材料からなる第１電極を形成し、キャパシタ形成予定領域内の前記第１電極上に、前記金属材料の拡散を防止する機能を有する第１拡散防止膜、キャパシタ絶縁膜、及び、前記金属材料の拡散を防止する機能を有する第２拡散防止膜をそれぞれ形成し、前記第２拡散防止膜上及び前記第１電極上に、前記金属材料の拡散を防止する機能を有する拡散防止絶縁膜を形成し、前記拡散防止絶縁膜上に層間絶縁膜を形成し、前記ダマシンプロセスを用いて、前記層間絶縁膜及び前記拡散防止絶縁膜に、前記第１電極及び前記前記第２拡散防止膜に達するトレンチを形成し、前記トレンチ内に前記金属材料を満たし、前記第１電極に接続する配線及び前記第２拡散防止膜に接続する第２電極をそれぞれ形成する、という一連のステップから構成される。
【００３１】
【発明の実施の形態】
以下、図面を参照しながら、本発明のＭＩＭキャパシタについて詳細に説明する。
【００３２】
図１は、本発明の第１実施の形態に関わるＭＩＭキャパシタの平面図を示している。図２は、図１のＩＩ−ＩＩ線に沿う断面図である。
【００３３】
半導体基板（例えば、シリコン基板）１１内には、例えば、格子状のトレンチが形成される。このトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料１２、例えば、Ｃｕ（銅）が満たされる。半導体基板１１内のトレンチ内に満たされた金属材料１２は、ＭＩＭキャパシタの第１電極となる。
【００３４】
本例では、ＭＩＭキャパシタの第１電極のレイアウトを格子状としているが、これは、ダマシンプロセス（ＣＭＰプロセス）においてディッシング現象（トレンチ内の金属材料が皿状に研磨される現象）を防止するためである。よって、ディッシング現象を防止できる構造であれば、トレンチの形状は、格子状に限られず、例えば、すのこ状（又は梯子状）、櫛状などであってもよい。
【００３５】
半導体基板１１上には、ＭＩＭキャパシタのキャパシタ形成予定領域を除き、窒化シリコン膜（ＳｉＮ）１３が形成される。ＭＩＭキャパシタのキャパシタ形成予定領域は、窒化シリコン膜１３の壁に取り囲まれた溝となっている。そして、キャパシタ形成予定領域には、窒化タングステン膜（ＷＮ）１４が形成される。窒化タングステン膜１４は、金属材料（例えば、Ｃｕ）１２の拡散防止膜として機能すると共に、格子状の第１電極上に配置されることによりキャパシタ面積を増加させる機能を有する。
【００３６】
窒化タングステン膜１４上には、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５が形成される。
【００３７】
キャパシタ絶縁膜１５上には、窒化タングステン膜（ＷＮ）１６が形成される。窒化タングステン膜１６は、後述するＭＩＭキャパシタの第２電極としての金属材料（例えば、Ｃｕ）の拡散防止膜として機能すると共に、後述する格子状の第２電極下に配置されることによりキャパシタ面積を増加させる機能を有する。
【００３８】
窒化タングステン膜１６上には、窒化シリコン膜（ＳｉＮ）１７が形成される。窒化シリコン膜１７は、窒化シリコン膜１３と共に、エッチング時（即ち、トレンチ形成時）のストッパとして機能する（詳細については、製造方法の説明で述べる。）。
【００３９】
窒化シリコン膜１３，１７上には、酸化シリコン膜（ＳｉＯ２）１８が形成され、酸化シリコン膜１８上には、窒化シリコン膜１９が形成される。窒化シリコン膜１９は、デュアルダマシンプロセスにおけるトレンチ形成時のストッパとして機能する。窒化シリコン膜１９上には、酸化シリコン膜（ＳｉＯ２）２０が形成され、酸化シリコン膜２０上には、窒化シリコン膜２１が形成される。窒化シリコン膜２１は、ＣＭＰ（Chemical Mechanical Polishing）プロセスにおけるストッパとして機能する。
【００４０】
酸化シリコン膜２０内（窒化シリコン膜１９よりも上の部分）には、例えば、格子状トレンチや、配線・パッド部のためのトレンチが形成される。また、酸化シリコン膜１８及び窒化シリコン膜１３には、窒化タングステン膜１６や金属材料（例えばＣｕ）１２まで達するトレンチ（ヴィアホール（via hole））が形成される。これらトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料２２Ａ，２２Ｂ、例えば、Ｃｕ（銅）が満たされる。トレンチ内に満たされた金属材料２２Ａは、ＭＩＭキャパシタの第２電極となる。
【００４１】
本例では、ＭＩＭキャパシタの第２電極のレイアウトを格子状としているが、これは、ダマシンプロセス（ＣＭＰプロセス）におけるディッシング現象を防止するためである。よって、ディッシング現象を防止できる構造であれば、トレンチの形状は、格子状に限られず、例えば、すのこ状（又は梯子状）、櫛状などであってもよい。
【００４２】
以上のようなデバイス構造によれば、まず、ＭＩＭキャパシタの第１及び第２電極がそれぞれ格子状、すのこ状、櫛状などのディッシング現象が発生し難い形状となっている。
【００４３】
また、ＭＩＭキャパシタの第１及び第２電極が大きな拡散係数を有する金属材料（例えば、Ｃｕ）から構成される場合に、第１電極に接触する板状の拡散防止膜（例えば、窒化タングステン膜１４）と第２電極に接触する板状の拡散防止膜（例えば、窒化タングステン膜１６）を設けている。これら拡散防止膜は、ＭＩＭキャパシタのキャパシタ面積を増加させる機能も有する。
【００４４】
そして、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５は、２つの拡散防止膜に挟まれ、大きな拡散係数を有する金属材料（例えば、Ｃｕ）に直接接触することがない。
【００４５】
従って、ＭＩＭキャパシタの電極を構成する大きな拡散係数を有する金属材料により、キャパシタ絶縁膜が汚染されることがなく、リーク電流を低減でき、高性能なＭＩＭキャパシタを提供できる。
【００４６】
次に、図１及び図２のＭＩＭキャパシタの製造方法について説明する。
【００４７】
まず、図３及び図４に示すように、ダマシンプロセスにより、半導体基板１１内にＭＩＭキャパシタの第１電極を形成する。
【００４８】
例えば、ＰＥＰ（Photo Engraving Process）及びＲＩＥ（Reactive Ion Etching）を用いて、半導体基板１１内に格子状トレンチを形成する。また、ＣＶＤ（Chemical Vapour Deposition）法を用いて、格子状トレンチを完全に満たす金属材料（例えば、Ｃｕ）１２を形成する。この後、ＣＭＰ（Chemical Mechanical Polishing）法を用いて、金属材料１２を研磨し、この金属材料１２を格子状トレンチ内のみに残存させれば、ＭＩＭキャパシタの第１電極が完成する。
【００４９】
なお、トレンチ（第１電極）の形状としては、格子状の他、例えば、図５に示すようなすのこ状、図６及び図７に示すような櫛状などであってもよい。
【００５０】
この後、ＣＶＤ法を用いて、半導体基板１１上に、ＭＩＭキャパシタの第１電極を覆う窒化シリコン膜（拡散防止絶縁膜）１３を形成する。
【００５１】
次に、図８及び図９に示すように、ＰＥＰ及びＲＩＥを用いて、キャパシタ形成予定領域内に存在する窒化シリコン膜１３を除去する。また、スパッタ法を用いて、拡散防止膜としての窒化タングステン膜（ＷＮ）１４を、窒化シリコン膜１３上及びキャパシタ形成予定領域上に形成する。この後、ＣＭＰ法を用いて、窒化タングステン膜１４を研磨し、キャパシタ形成予定領域のみに窒化タングステン膜１４を残存させる。
【００５２】
なお、本例では、拡散防止膜（バリアメタル）として、窒化タングステン膜を使用しているが、金属原子の拡散防止機能を有する膜であれば、窒化タングステン膜以外の膜であってもよい。拡散防止機能を有する導電膜としては、例えば、表１に示すような材料が知られている。
【００５３】
【表１】
0003967544.tif 000002
【００５４】
次に、図１０に示すように、スパッタ法を用いて、窒化シリコン膜１３上及び窒化タングステン膜１４上に、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５を形成する。続けて、スパッタ法を用いて、キャパシタ絶縁膜１５上に、拡散防止膜（バリアメタル）としての窒化タングステン膜１６を形成する。拡散防止膜としては、窒化タングステン膜の他、上記表１に示すような導電膜を用いることができる。
【００５５】
また、ＣＶＤ法を用いて、窒化タングステン膜１６上に、窒化シリコン膜（拡散防止絶縁膜）１７を形成する。この後、ＰＥＰ及びＲＩＥを用いて、窒化シリコン膜１７、窒化タングステン膜１６及びキャパシタ絶縁膜１５を順次エッチングする。このエッチングは、少なくともキャパシタ形成予定領域内の窒化タングステン膜１４上に、キャパシタ絶縁膜１５、窒化タングステン膜１６及び窒化シリコン膜１７が残存するようにして行われる。
【００５６】
次に、図１１及び図１２に示すように、ＣＶＤ法を用いて、窒化シリコン膜１３，１７上に、酸化シリコン膜（層間絶縁膜）１８を形成する。続けて、ＣＶＤ法を用いて、酸化シリコン膜１８上に、エッチングストッパとしての窒化シリコン膜１９を形成する。また、ＣＶＤ法を用いて、窒化シリコン膜１９上に、酸化シリコン膜（配線間絶縁膜）２０を形成する。続けて、ＣＶＤ法を用いて、酸化シリコン膜２０上に、ＣＭＰのストッパとしての窒化シリコン膜２１を形成する。
【００５７】
この後、デュアルダマシンプロセスにより、ＭＩＭキャパシタの第２電極を形成する。
【００５８】
例えば、まず、ＰＥＰ及びＲＩＥを用いて、窒化シリコン膜２１及び酸化シリコン膜２０に、配線溝としてのトレンチを形成する。酸化シリコン膜２０のエッチング時、窒化シリコン膜１９は、ＲＩＥのエッチングストッパとして機能する。このトレンチは、配線・パッド部、キャパシタ電極部を含み、キャパシタ電極部は、例えば、格子状のレイアウトを有する。
【００５９】
さらに、続けて、ＰＥＰ及びＲＩＥを用いて、窒化シリコン膜１９及び酸化シリコン膜１８に、ヴィアホール（via hole）としてのトレンチを形成する。酸化シリコン膜１８のエッチング時、窒化シリコン膜１３，１７は、ＲＩＥのエッチングストッパとして機能する。
【００６０】
なお、キャパシタ電極部におけるトレンチの形状は、格子状に限られず、例えば、図１３に示すように、すのこ状であってもよく、また、図１４及び図１５に示すように、櫛状であってもよい。
【００６１】
また、トレンチ底部の窒化シリコン膜１３，１７をエッチングし、金属材料１２の一部及び窒化タングステン膜１６の一部を剥き出しにする。
【００６２】
この後、メッキ法により、トレンチを完全に満たす金属材料（例えば、Ｃｕ）２２Ａ，２２Ｂを形成する。なお、金属材料２２Ａ，２２Ｂを形成する前に、トレンチ内面に、ＴａＮなどのバリアメタルを形成しておいてもよい。
【００６３】
そして、ＣＭＰ法を用いて、金属材料２２Ａ，２２Ｂを研磨し、金属材料２２Ａ，２２Ｂをトレンチ内に残存させる。この時、窒化シリコン膜２１は、ＣＭＰのストッパとして機能する。
【００６４】
以上の工程により、図１及び図２のＭＩＭキャパシタが完成する。
【００６５】
このような製造方法によれば、ダマシンプロセス（ＣＭＰプロセス）を採用し、かつ、Ｃｕ（銅）のような大きな拡散係数を有する金属材料を配線材料として用いる場合に、第一に、金属材料（キャパシタ電極）の形状を、例えば、格子状とすることで、ディッシング現象を防止できる。また、第二に、キャパシタ絶縁膜を拡散防止膜により直接挟み込むことで、製造工程中に、金属原子がキャパシタ絶縁膜に拡散することを防止できる。第三に、拡散防止膜を、キャパシタ電極として機能させることにより、ディッシング現象の防止のために金属材料を格子状にしても、キャパシタ面積が小さくなることがない（配線ルールによらず、キャパシタ容量を大きくできる）。第四に、キャパシタのパターニング時に、金属材料（例えば、Ｃｕ）が露出することがないので、金属原子による汚染をなくすことができる。第五に、キャパシタ構造が平坦であり、高信頼性、高性能を達成できる。
【００６６】
図１６は、本発明の第２実施の形態に関わるＭＩＭキャパシタの断面図を示している。
【００６７】
本例のデバイス構造は、図１及び図２の例と比べると、図１及び図２の窒化シリコン膜１３を省略した点に特徴を有する。つまり、本例では、窒化シリコン膜１７は、窒化タングステン膜１６上の他、半導体基板１１上及び金属材料１２上にも形成される。
【００６８】
以下、具体的な構造について説明する。
【００６９】
半導体基板（例えば、シリコン基板）１１内には、例えば、格子状のトレンチが形成される。このトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料１２、例えば、Ｃｕ（銅）が満たされる。半導体基板１１内のトレンチ内に満たされた金属材料１２は、ＭＩＭキャパシタの第１電極となる。
【００７０】
なお、ＭＩＭキャパシタの第１電極の形状は、格子状、すのこ状（又は梯子状）、櫛状などに設定される。
【００７１】
ＭＩＭキャパシタのキャパシタ形成予定領域には、窒化タングステン膜（ＷＮ）１４が形成される。窒化タングステン膜１４は、金属材料（例えば、Ｃｕ）１２の拡散防止膜として機能すると共に、格子状の第１電極上に配置されることによりキャパシタ面積を増加させる機能を有する。窒化タングステン膜１４上には、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５が形成される。
【００７２】
キャパシタ絶縁膜１５上には、窒化タングステン膜（ＷＮ）１６が形成される。窒化タングステン膜１６は、後述するＭＩＭキャパシタの第２電極としての金属材料（例えば、Ｃｕ）の拡散防止膜として機能すると共に、後述する格子状の第２電極下に配置されることによりキャパシタ面積を増加させる機能を有する。
【００７３】
半導体基板１１上、金属材料１２上及び窒化タングステン膜１６上には、窒化シリコン膜（ＳｉＮ）１７が形成される。窒化シリコン膜１７は、エッチング時（即ち、トレンチ形成時）のストッパとして機能する（詳細については、製造方法の説明で述べる。）。
【００７４】
窒化シリコン膜１７上には、酸化シリコン膜（ＳｉＯ２）１８が形成され、酸化シリコン膜１８上には、窒化シリコン膜１９が形成される。窒化シリコン膜１９は、デュアルダマシンプロセスにおけるトレンチ形成時のストッパとして機能する。窒化シリコン膜１９上には、酸化シリコン膜（ＳｉＯ２）２０が形成され、酸化シリコン膜２０上には、窒化シリコン膜２１が形成される。窒化シリコン膜２１は、ＣＭＰ（Chemical Mechanical Polishing）プロセスにおけるストッパとして機能する。
【００７５】
酸化シリコン膜２０内（窒化シリコン膜１９よりも上の部分）には、例えば、格子状トレンチや、配線・パッド部のためのトレンチが形成される。また、酸化シリコン膜１８及び窒化シリコン膜１７には、窒化タングステン膜１６や金属材料（例えばＣｕ）１２まで達するヴィアホール（via hole）としてのトレンチが形成される。これらトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料２２Ａ，２２Ｂ、例えば、Ｃｕ（銅）が満たされる。トレンチ内に満たされた金属材料２２Ａは、ＭＩＭキャパシタの第２電極となる。
【００７６】
なお、ＭＩＭキャパシタの第２電極の形状は、格子状、すのこ状（又は梯子状）、櫛状などに設定される。
【００７７】
以上のようなデバイス構造によれば、まず、ＭＩＭキャパシタの第１及び第２電極がそれぞれ格子状、すのこ状、櫛状などのディッシング現象が発生し難い形状となっている。
【００７８】
また、ＭＩＭキャパシタの第１及び第２電極が大きな拡散係数を有する金属材料（例えば、Ｃｕ）から構成される場合に、第１電極に接触する板状の拡散防止膜（例えば、窒化タングステン膜１４）と第２電極に接触する板状の拡散防止膜（例えば、窒化タングステン膜１６）を設けている。これら拡散防止膜は、ＭＩＭキャパシタのキャパシタ面積を増加させる機能も有する。
【００７９】
そして、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５は、２つの拡散防止膜に挟まれ、大きな拡散係数を有する金属材料（例えば、Ｃｕ）に直接接触することがない。
【００８０】
従って、ＭＩＭキャパシタの電極を構成する大きな拡散係数を有する金属材料により、キャパシタ絶縁膜が汚染されることがなく、リーク電流を低減でき、高性能なＭＩＭキャパシタを提供できる。
【００８１】
また、本例では、酸化シリコン膜１８にトレンチ（ヴィアホール）を形成するときのエッチングストッパとして、窒化シリコン膜１７のみを用い、図１及び図２のデバイスに示されるような窒化シリコン膜１３を省略している。このため、本例では、図１及び図２の例に比べて、▲１▼  窒化シリコン膜１３を加工する工程、及び、▲２▼  窒化タングステン膜１４を窒化シリコン膜１３の溝に埋め込む工程（ＣＭＰ）を省略でき、ＰＥＰ数の削減、コストの低下などを図ることができる。
【００８２】
次に、図１６のＭＩＭキャパシタの製造方法について説明する。
【００８３】
まず、図１７に示すように、ダマシンプロセスにより、半導体基板１１内にＭＩＭキャパシタの第１電極を形成する。
【００８４】
例えば、ＰＥＰ及びＲＩＥを用いて、半導体基板１１内に格子状のトレンチを形成する。また、ＣＶＤ法を用いて、格子状のトレンチを完全に満たす金属材料（例えば、Ｃｕ）１２を形成する。この後、ＣＭＰ法を用いて、金属材料１２を研磨し、この金属材料１２を格子状のトレンチ内のみに残存させれば、ＭＩＭキャパシタの第１電極が完成する。
【００８５】
なお、トレンチ（第１電極）の形状としては、図３に示すような格子状の他、例えば、すのこ状（図５）、櫛状（図６及び図７）などであってもよい。
【００８６】
また、スパッタ法を用いて、拡散防止膜としての窒化タングステン膜（ＷＮ）１４を、半導体基板１１上及び金属材料１２上に形成する。なお、本例では、拡散防止膜（バリアメタル）として、窒化タングステン膜を使用しているが、金属原子の拡散防止機能を有する膜であれば、窒化タングステン膜以外の膜であってもよい（表１参照）。
【００８７】
また、スパッタ法を用いて、窒化タングステン膜１４上に、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５を形成する。続けて、スパッタ法を用いて、キャパシタ絶縁膜１５上に、拡散防止膜（バリアメタル）としての窒化タングステン膜１６を形成する。
【００８８】
次に、図１８に示すように、ＰＥＰ及びＲＩＥを用いて、窒化タングステン膜１６、キャパシタ絶縁膜１５及び窒化タングステン膜１４を順次エッチングする。そして、キャパシタ形成予定領域のみに、窒化タングステン膜１４、キャパシタ絶縁膜１５及び窒化タングステン膜１６を残存させる。
【００８９】
次に、図１９に示すように、ＣＶＤ法を用いて、半導体基板１１上、金属材料１２上及び窒化タングステン膜１６上に、窒化シリコン膜（拡散防止絶縁膜）１７を形成する。窒化シリコン膜１７は、後述するヴィアホールとしてのトレンチ形成時のストッパとして機能する。
【００９０】
次に、図２０に示すように、ＣＶＤ法を用いて、窒化シリコン膜１７上に、酸化シリコン膜（層間絶縁膜）１８を形成する。続けて、ＣＶＤ法を用いて、酸化シリコン膜１８上に、エッチングストッパとしての窒化シリコン膜１９を形成する。また、ＣＶＤ法を用いて、窒化シリコン膜１９上に、酸化シリコン膜（配線間絶縁膜）２０を形成する。続けて、ＣＶＤ法を用いて、酸化シリコン膜２０上に、ＣＭＰのストッパとしての窒化シリコン膜２１を形成する。
【００９１】
この後、デュアルダマシンプロセスにより、ＭＩＭキャパシタの第２電極を形成する。
【００９２】
例えば、まず、ＰＥＰ及びＲＩＥを用いて、窒化シリコン膜２１及び酸化シリコン膜２０に、配線溝としてのトレンチを形成する。酸化シリコン膜２０のエッチング時、窒化シリコン膜１９は、ＲＩＥのエッチングストッパとして機能する。このトレンチは、配線・パッド部、キャパシタ電極部を含み、キャパシタ電極部は、例えば、格子状のレイアウトを有する。
【００９３】
さらに、続けて、ＰＥＰ及びＲＩＥを用いて、窒化シリコン膜１９及び酸化シリコン膜１８に、ヴィアホール（via hole）としてのトレンチを形成する。酸化シリコン膜１８のエッチング時、窒化シリコン膜１７は、ＲＩＥのエッチングストッパとして機能する。
【００９４】
なお、キャパシタ電極部におけるトレンチの形状は、格子状に限られず、例えば、図１３に示すように、すのこ状であってもよく、また、図１４及び図１５に示すように、櫛状であってもよい。
【００９５】
また、トレンチ底部の窒化シリコン膜１７をエッチングし、金属材料１２の一部及び窒化タングステン膜１６の一部を剥き出しにする。
【００９６】
この後、メッキ法により、トレンチを完全に満たす金属材料（例えば、Ｃｕ）２２Ａ，２２Ｂを形成する。なお、金属材料２２Ａ，２２Ｂを形成する前に、トレンチ内面に、ＴａＮなどのバリアメタルを形成しておいてもよい。
【００９７】
そして、ＣＭＰ法を用いて、金属材料２２Ａ，２２Ｂを研磨し、金属材料２２Ａ，２２Ｂをトレンチ内のみに残存させる。この時、窒化シリコン膜２１は、ＣＭＰのストッパとして機能する。
【００９８】
以上の工程により、図１６のＭＩＭキャパシタが完成する。
【００９９】
このような製造方法によれば、ダマシンプロセス（ＣＭＰプロセス）を採用し、かつ、Ｃｕ（銅）のような大きな拡散係数を有する金属材料を配線材料として用いる場合に、第一に、金属材料（キャパシタ電極）の形状を、例えば、格子状とすることで、ディッシング現象を防止できる。また、第二に、キャパシタ絶縁膜を直接挟み込む拡散防止膜を設けることで、製造工程中に、金属原子がキャパシタ絶縁膜に拡散することを防止できる。第三に、拡散防止膜を、キャパシタ電極として機能させることにより、ディッシング現象の防止のために金属材料を格子状にしても、キャパシタ面積が小さくなることがない（配線ルールによらず、キャパシタ容量を大きくできる）。第四に、ヴィアホールとしてのトレンチを形成するときのストッパとして１つの窒化シリコン膜のみを使用しているため、工程数（ＰＥＰ数）が減り、コストの低減に貢献できる。
【０１００】
図２１は、本発明の第３実施の形態に関わるＭＩＭキャパシタの断面図を示している。
【０１０１】
本例のデバイス構造は、図１及び図２の例と比べると、拡散防止膜としての窒化タングステン膜１４のレイアウトに特徴がある。即ち、本例では、拡散防止膜としての窒化タングステン膜１４のエッチングを、窒化シリコン膜１７、窒化タングステン膜１６及びキャパシタ絶縁膜１５のエッチングに続けて行っている。また、本例のデバイス構造では、窒化タングステン膜１４，１６及びキャパシタ絶縁膜１５の端部が窒化シリコン膜１３にオーバーラップするようなレイアウトを有している。
【０１０２】
従って、本例では、図１及び図２の例に示す窒化シリコン膜１３の溝内に窒化タングステン膜１４を満たす工程（ＣＭＰ）が不要となる。
【０１０３】
以下、具体的なデバイス構造について説明する。
【０１０４】
半導体基板（例えば、シリコン基板）１１内には、例えば、格子状のトレンチが形成される。このトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料１２、例えば、Ｃｕ（銅）が満たされる。半導体基板１１内のトレンチ内に満たされた金属材料１２は、ＭＩＭキャパシタの第１電極となる。
【０１０５】
ＭＩＭキャパシタの第１電極の形状としては、例えば、格子状、すのこ状（又は梯子状）、櫛状などに設定される。
【０１０６】
半導体基板１１上には、ＭＩＭキャパシタのキャパシタ形成予定領域を除き、窒化シリコン膜（ＳｉＮ）１３が形成される。ＭＩＭキャパシタのキャパシタ形成予定領域は、窒化シリコン膜１３の壁に取り囲まれた溝となっている。キャパシタ形成予定領域には、窒化タングステン膜（ＷＮ）１４が形成される。窒化タングステン膜１４の端部は、窒化シリコン膜１３にオーバーラップしている。
【０１０７】
窒化タングステン膜１４は、金属材料（例えば、Ｃｕ）１２の拡散防止膜として機能すると共に、格子状の第１電極上に配置されることによりキャパシタ面積を増加させる機能を有する。窒化タングステン膜１４上には、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５が形成される。
【０１０８】
キャパシタ絶縁膜１５上には、窒化タングステン膜（ＷＮ）１６が形成される。窒化タングステン膜１６は、後述するＭＩＭキャパシタの第２電極としての金属材料（例えば、Ｃｕ）の拡散防止膜として機能すると共に、後述する格子状の第２電極下に配置されることによりキャパシタ面積を増加させる機能を有する。
【０１０９】
窒化タングステン膜１６上には、窒化シリコン膜（ＳｉＮ）１７が形成される。窒化シリコン膜１７は、窒化シリコン膜１３と共に、エッチング時（即ち、トレンチ形成時）のストッパとして機能する（詳細については、製造方法の説明で述べる。）。
【０１１０】
窒化シリコン膜１３，１７上には、酸化シリコン膜（ＳｉＯ２）１８が形成され、酸化シリコン膜１８上には、窒化シリコン膜１９が形成される。窒化シリコン膜１９は、デュアルダマシンプロセスにおけるトレンチ形成時のストッパとして機能する。窒化シリコン膜１９上には、酸化シリコン膜（ＳｉＯ２）２０が形成され、酸化シリコン膜２０上には、窒化シリコン膜２１が形成される。窒化シリコン膜２１は、ＣＭＰ（Chemical Mechanical Polishing）プロセスにおけるストッパとして機能する。
【０１１１】
酸化シリコン膜２０内（窒化シリコン膜１９よりも上の部分）には、例えば、格子状トレンチや、配線・パッド部のためのトレンチなどが形成される。また、酸化シリコン膜１８及び窒化シリコン膜１３には、窒化タングステン膜１６や金属材料（例えばＣｕ）１２まで達するヴィアホールとしてのトレンチが形成される。これらトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料２２Ａ，２２Ｂ、例えば、Ｃｕ（銅）が満たされる。トレンチ内に満たされた金属材料２２Ａは、ＭＩＭキャパシタの第２電極となる。
【０１１２】
ＭＩＭキャパシタの第２電極の形状としては、例えば、図２７に示すような形状とすることができる。但し、ＭＩＭキャパシタの第２電極に関しては、ダマシンプロセス（ＣＭＰプロセス）におけるディッシング現象を防止できれば、どのような形状であってもよい。
【０１１３】
以上のような構造によれば、まず、ＭＩＭキャパシタの第１及び第２電極がそれぞれ格子状、すのこ状（又は梯子状）、櫛状などのディッシング現象が発生し難い形状となっている。
【０１１４】
また、ＭＩＭキャパシタの第１及び第２電極が大きな拡散係数を有する金属材料（例えば、Ｃｕ）から構成される場合に、第１電極に接触する板状の拡散防止膜（例えば、窒化タングステン膜１４）と第２電極に接触する板状の拡散防止膜（例えば、窒化タングステン膜１６）を設けている。これら拡散防止膜は、ＭＩＭキャパシタのキャパシタ面積を増加させる機能も有する。
【０１１５】
そして、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５は、２つの拡散防止膜に挟まれ、大きな拡散係数を有する金属材料（例えば、Ｃｕ）に直接接触することがない。
【０１１６】
従って、ＭＩＭキャパシタの電極を構成する大きな拡散係数を有する金属材料により、キャパシタ絶縁膜が汚染されることがなく、リーク電流を低減でき、高性能なＭＩＭキャパシタを提供できる。
【０１１７】
次に、図２１のＭＩＭキャパシタの製造方法について説明する。
【０１１８】
まず、図２２に示すように、ダマシンプロセスにより、半導体基板１１内にＭＩＭキャパシタの第１電極を形成する。
【０１１９】
例えば、ＰＥＰ（Photo Engraving Process）及びＲＩＥ（Reactive Ion Etching）を用いて、半導体基板１１内に格子状のトレンチを形成する。また、ＣＶＤ法を用いて、格子状のトレンチを完全に満たす金属材料（例えば、Ｃｕ）１２を形成する。この後、ＣＭＰ法を用いて、金属材料１２を研磨し、この金属材料１２を格子状のトレンチ内のみに残存させれば、ＭＩＭキャパシタの第１電極が完成する。
【０１２０】
なお、トレンチ（第１電極）の形状は、格子状（図３）、すのこ状（図５）、櫛状（図６及び図７）などに設定される。
【０１２１】
この後、ＣＶＤ法を用いて、半導体基板１１上に、ＭＩＭキャパシタの第１電極を覆う窒化シリコン膜（拡散防止絶縁膜）１３を形成する。
【０１２２】
次に、図２３に示すように、ＰＥＰ及びＲＩＥを用いて、キャパシタ形成予定領域内に存在する窒化シリコン膜１３を除去する。
【０１２３】
次に、図２４に示すように、スパッタ法を用いて、拡散防止膜（バリアメタル）としての窒化タングステン膜（ＷＮ）１４を、窒化シリコン膜１３上及びキャパシタ形成予定領域上に形成する。また、スパッタ法を用いて、窒化タングステン膜１４上に、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５を形成する。続けて、スパッタ法を用いて、キャパシタ絶縁膜１５上に、拡散防止膜（バリアメタル）としての窒化タングステン膜１６を形成する。
【０１２４】
また、ＣＶＤ法を用いて、窒化タングステン膜１６上に、窒化シリコン膜１７を形成する。この後、ＰＥＰ及びＲＩＥを用いて、窒化シリコン膜１７、窒化タングステン膜１６、キャパシタ絶縁膜１５及び窒化タングステン膜１４を順次エッチングする。このエッチングは、少なくともキャパシタ形成予定領域に、窒化タングステン膜１４、キャパシタ絶縁膜１５、窒化タングステン膜１６及び窒化シリコン膜１７が残存するように行われる。
【０１２５】
次に、図２６に示すように、ＣＶＤ法を用いて、窒化シリコン膜１３，１７上に、酸化シリコン膜（層間絶縁膜）１８を形成する。続けて、ＣＶＤ法を用いて、酸化シリコン膜１８上に、エッチングストッパとしての窒化シリコン膜１９を形成する。また、ＣＶＤ法を用いて、窒化シリコン膜１９上に、酸化シリコン膜（配線間絶縁膜）２０を形成する。続けて、ＣＶＤ法を用いて、酸化シリコン膜２０上に、ＣＭＰのストッパとしての窒化シリコン膜２１を形成する。
【０１２６】
この後、デュアルダマシンプロセスにより、ＭＩＭキャパシタの第２電極を形成する。
【０１２７】
例えば、まず、ＰＥＰ及びＲＩＥを用いて、窒化シリコン膜２１及び酸化シリコン膜２０に、配線溝としてのトレンチを形成する。酸化シリコン膜２０のエッチング時、窒化シリコン膜１９は、ＲＩＥのエッチングストッパとして機能する。このトレンチは、配線・パッド部、キャパシタ電極部を含み、キャパシタ電極部は、例えば、格子状のレイアウトを有する。
【０１２８】
さらに、続けて、ＰＥＰ及びＲＩＥを用いて、窒化シリコン膜１９及び酸化シリコン膜１８に、ヴィアホール（via hole）としてのトレンチを形成する。酸化シリコン膜１８のエッチング時、窒化シリコン膜１３，１７は、ＲＩＥのエッチングストッパとして機能する。
【０１２９】
なお、キャパシタ電極部におけるトレンチの形状は、格子状に限られず、例えば、図１３に示すように、すのこ状（又は梯子状）であってもよく、また、図１４及び図１５に示すように、櫛状であってもよい。
【０１３０】
また、トレンチ底部の窒化シリコン膜１３，１７をエッチングし、金属材料１２の一部及び窒化タングステン膜１６の一部を剥き出しにする。
【０１３１】
この後、メッキ法により、トレンチを完全に満たす金属材料（例えば、Ｃｕ）２２Ａ，２２Ｂを形成する。なお、金属材料２２Ａ，２２Ｂを形成する前に、トレンチ内面に、ＴａＮなどのバリアメタルを形成しておいてもよい。
【０１３２】
そして、ＣＭＰ法を用いて、金属材料２２Ａ，２２Ｂを研磨し、金属材料２２Ａ，２２Ｂをトレンチ内に残存させる。この時、窒化シリコン膜２１は、ＣＭＰのストッパとして機能する。
【０１３３】
以上の工程により、図１及び図２のＭＩＭキャパシタが完成する。
【０１３４】
このような製造方法によれば、ダマシンプロセス（ＣＭＰプロセス）を採用し、かつ、Ｃｕ（銅）のような大きな拡散係数を有する金属材料を配線材料として用いる場合に、第一に、金属材料（キャパシタ電極）の形状を、例えば、格子状とすることで、ディッシング現象を防止できる。また、第二に、キャパシタ絶縁膜を直接挟み込む拡散防止膜を設けることで、製造工程中に、金属原子がキャパシタ絶縁膜に拡散することを防止できる。第三に、拡散防止膜を、キャパシタ電極として機能させることにより、ディッシング現象の防止のために金属材料を格子状にしても、キャパシタ面積が小さくなることがない（配線ルールによらず、キャパシタ容量を大きくできる）。第四に、窒化タングステン膜１４を、窒化シリコン膜１７、窒化タングステン膜１６及びキャパシタ絶縁膜１５と共に、ＲＩＥにより加工しているため、製造工程が簡略化される。第五に、キャパシタのパターニング時に、金属材料（例えば、Ｃｕ）が露出することがないので、金属原子による汚染をなくすことができる。
【０１３５】
図２８は、本発明の第４実施の形態に関わるＭＩＭキャパシタの断面図を示している。
【０１３６】
本例のデバイス構造は、図２１の例と比べると、窒化タングステン膜１４、キャパシタ絶縁膜１５、窒化タングステン膜１６及び窒化シリコン膜１７が、それぞれ窒化シリコン膜１３の溝内に収まっている点にある。
【０１３７】
以下、具体的なデバイス構造について説明する。
【０１３８】
半導体基板（例えば、シリコン基板）１１内には、例えば、格子状のトレンチが形成される。このトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料１２、例えば、Ｃｕ（銅）が満たされる。半導体基板１１内のトレンチ内に満たされた金属材料１２は、ＭＩＭキャパシタの第１電極となる。
【０１３９】
ＭＩＭキャパシタの第１電極の形状としては、例えば、格子状、すのこ状（又は梯子状）、櫛状などに設定される。
【０１４０】
半導体基板１１上には、ＭＩＭキャパシタのキャパシタ形成予定領域を除き、窒化シリコン膜（ＳｉＮ）１３が形成される。このキャパシタ形成予定領域は、窒化シリコン膜１３の壁に取り囲まれた溝となっている。キャパシタ形成予定領域には、窒化タングステン膜（ＷＮ）１４が形成される。窒化タングステン膜１４は、キャパシタ形成予定領域内に完全に収まっている。
【０１４１】
窒化タングステン膜１４は、金属材料（例えば、Ｃｕ）１２の拡散防止膜として機能すると共に、格子状の第１電極上に配置されることによりキャパシタ面積を増加させる機能を有する。窒化タングステン膜１４上には、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５が形成される。
【０１４２】
キャパシタ絶縁膜１５上には、窒化タングステン膜（ＷＮ）１６が形成される。窒化タングステン膜１６は、後述するＭＩＭキャパシタの第２電極としての金属材料（例えば、Ｃｕ）の拡散防止膜として機能すると共に、後述する格子状の第２電極下に配置されることによりキャパシタ面積を増加させる機能を有する。
【０１４３】
窒化タングステン膜１６上には、窒化シリコン膜（ＳｉＮ）１７が形成される。窒化シリコン膜１７は、窒化シリコン膜１３と共に、エッチング時（即ち、トレンチ形成時）のストッパとして機能する（詳細については、製造方法の説明で述べる。）。
【０１４４】
なお、窒化タングステン膜１４，１６及びキャパシタ絶縁膜１５は、同じパターンを有している。
【０１４５】
窒化シリコン膜１３，１７上には、酸化シリコン膜（ＳｉＯ２）１８が形成され、酸化シリコン膜１８上には、窒化シリコン膜１９が形成される。窒化シリコン膜１９は、デュアルダマシンプロセスにおけるトレンチ形成時のストッパとして機能する。窒化シリコン膜１９上には、酸化シリコン膜（ＳｉＯ２）２０が形成され、酸化シリコン膜２０上には、窒化シリコン膜２１が形成される。窒化シリコン膜２１は、ＣＭＰ（Chemical Mechanical Polishing）プロセスにおけるストッパとして機能する。
【０１４６】
酸化シリコン膜２０内（窒化シリコン膜１９よりも上の部分）には、例えば、格子状トレンチや、配線・パッド部のためのトレンチが形成される。また、酸化シリコン膜１８及び窒化シリコン膜１３には、窒化タングステン膜１６や金属材料（例えばＣｕ）１２まで達するヴィアホールとしてのトレンチが形成される。これらトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料２２Ａ，２２Ｂ、例えば、Ｃｕ（銅）が満たされる。トレンチ内に満たされた金属材料２２Ａは、ＭＩＭキャパシタの第２電極となる。
【０１４７】
以上のような構造によれば、まず、ＭＩＭキャパシタの第１及び第２電極がそれぞれ格子状、すのこ状（又は梯子状）、櫛状などのディッシング現象が発生し難い形状となっている。
【０１４８】
また、ＭＩＭキャパシタの第１及び第２電極が大きな拡散係数を有する金属材料（例えば、Ｃｕ）から構成される場合に、第１電極に接触する板状の拡散防止膜（例えば、窒化タングステン膜１４）と第２電極に接触する板状の拡散防止膜（例えば、窒化タングステン膜１６）を設けている。これら拡散防止膜は、ＭＩＭキャパシタのキャパシタ面積を増加させる機能も有する。
【０１４９】
そして、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５は、２つの拡散防止膜に挟まれ、大きな拡散係数を有する金属材料（例えば、Ｃｕ）に直接接触することがない。
【０１５０】
従って、ＭＩＭキャパシタの電極を構成する大きな拡散係数を有する金属材料により、キャパシタ絶縁膜が汚染されることがなく、リーク電流を低減でき、高性能なＭＩＭキャパシタを提供できる。
【０１５１】
次に、図２８のＭＩＭキャパシタの製造方法について説明する。
【０１５２】
まず、図２９に示すように、ダマシンプロセスにより、半導体基板１１内にＭＩＭキャパシタの第１電極を形成する。
【０１５３】
例えば、ＰＥＰ（Photo Engraving Process）及びＲＩＥ（Reactive Ion Etching）を用いて、半導体基板１１内に格子状のトレンチを形成する。また、ＣＶＤ法を用いて、格子状のトレンチを完全に満たす金属材料（例えば、Ｃｕ）１２を形成する。この後、ＣＭＰ法を用いて、金属材料１２を研磨し、この金属材料１２を格子状のトレンチ内のみに残存させれば、ＭＩＭキャパシタの第１電極が完成する。
【０１５４】
なお、トレンチ（第１電極）の形状は、格子状（図３）、すのこ状（図５）、櫛状（図６及び図７）などに設定される。
【０１５５】
この後、ＣＶＤ法を用いて、半導体基板１１上に、ＭＩＭキャパシタの第１電極を覆う窒化シリコン膜（拡散防止絶縁膜）１３を形成する。
【０１５６】
次に、図３０に示すように、ＰＥＰ及びＲＩＥを用いて、キャパシタ形成予定領域内に存在する窒化シリコン膜１３を除去する。
【０１５７】
次に、図３１に示すように、スパッタ法を用いて、拡散防止膜（バリアメタル）としての窒化タングステン膜（ＷＮ）１４を、窒化シリコン膜１３上及びキャパシタ形成予定領域上に形成する。また、スパッタ法を用いて、窒化タングステン膜１４上に、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５を形成する。続けて、スパッタ法を用いて、キャパシタ絶縁膜１５上に、拡散防止膜（バリアメタル）としての窒化タングステン膜１６を形成する。また、ＣＶＤ法を用いて、窒化タングステン膜１６上に、窒化シリコン膜（拡散防止絶縁膜）１７を形成する。
【０１５８】
次に、図３２に示すように、ＰＥＰ及びＲＩＥを用いて、窒化シリコン膜１７、窒化タングステン膜１６、キャパシタ絶縁膜１５及び窒化タングステン膜１４を順次エッチングする。このエッチングは、キャパシタ形成予定領域内に、窒化タングステン膜１４、キャパシタ絶縁膜１５、窒化タングステン膜１６及び窒化シリコン膜１７が残存するように行われる。
【０１５９】
本例では、窒化タングステン膜１４、キャパシタ絶縁膜１５、窒化タングステン膜１６及び窒化シリコン膜１７は、キャパシタ形成予定領域内、即ち、窒化シリコン膜１３の溝内に完全に収まっている。
【０１６０】
次に、図３３に示すように、ＣＶＤ法を用いて、窒化シリコン膜１３，１７上に、酸化シリコン膜（層間絶縁膜）１８を形成する。続けて、ＣＶＤ法を用いて、酸化シリコン膜１８上に、エッチングストッパとしての窒化シリコン膜１９を形成する。また、ＣＶＤ法を用いて、窒化シリコン膜１９上に、酸化シリコン膜（配線間絶縁膜）２０を形成する。続けて、ＣＶＤ法を用いて、酸化シリコン膜２０上に、ＣＭＰのストッパとしての窒化シリコン膜２１を形成する。
【０１６１】
この後、デュアルダマシンプロセスにより、ＭＩＭキャパシタの第２電極を形成する。
【０１６２】
例えば、まず、ＰＥＰ及びＲＩＥを用いて、窒化シリコン膜２１及び酸化シリコン膜２０に、配線溝としてのトレンチを形成する。酸化シリコン膜２０のエッチング時、窒化シリコン膜１９は、ＲＩＥのエッチングストッパとして機能する。このトレンチは、配線・パッド部、キャパシタ電極部を含み、キャパシタ電極部は、例えば、格子状のレイアウトを有する。
【０１６３】
さらに、続けて、ＰＥＰ及びＲＩＥを用いて、窒化シリコン膜１９及び酸化シリコン膜１８に、ヴィアホール（via hole）としてのトレンチを形成する。酸化シリコン膜１８のエッチング時、窒化シリコン膜１３，１７は、ＲＩＥのエッチングストッパとして機能する。
【０１６４】
なお、キャパシタ電極部におけるトレンチの形状は、格子状に限られず、例えば、図１３に示すように、すのこ状（又は梯子状）であってもよく、また、図１４及び図１５に示すように、櫛状であってもよい。
【０１６５】
また、トレンチ底部の窒化シリコン膜１３，１７をエッチングし、金属材料１２の一部及び窒化タングステン膜１６の一部を剥き出しにする。
【０１６６】
この後、メッキ法により、トレンチを完全に満たす金属材料（例えば、Ｃｕ）２２Ａ，２２Ｂを形成する。なお、金属材料２２Ａ，２２Ｂを形成する前に、トレンチ内面に、ＴａＮなどのバリアメタルを形成しておいてもよい。
【０１６７】
そして、ＣＭＰ法を用いて、金属材料２２Ａ，２２Ｂを研磨し、金属材料２２Ａ，２２Ｂをトレンチ内に残存させる。この時、窒化シリコン膜２１は、ＣＭＰのストッパとして機能する。
【０１６８】
以上の工程により、図２８のＭＩＭキャパシタが完成する。
【０１６９】
このような製造方法によれば、ダマシンプロセス（ＣＭＰプロセス）を採用し、かつ、Ｃｕ（銅）のような大きな拡散係数を有する金属材料を配線材料として用いる場合に、第一に、金属材料（キャパシタ電極）の形状を、例えば、格子状とすることで、ディッシング現象を防止できる。また、第二に、キャパシタ絶縁膜を直接挟み込む拡散防止膜を設けることで、製造工程中に、金属原子がキャパシタ絶縁膜に拡散することを防止できる。第三に、拡散防止膜を、キャパシタ電極として機能させることにより、ディッシング現象の防止のために金属材料を格子状にしても、キャパシタ面積が小さくなることがない（配線ルールによらず、キャパシタ容量を大きくできる）。第四に、窒化タングステン膜１４を、窒化シリコン膜１７、窒化タングステン膜１６及びキャパシタ絶縁膜１５と共に、ＲＩＥにより加工しているため、製造工程が簡略化される。
【０１７０】
図３４は、本発明の第５実施の形態に関わるＭＩＭキャパシタの断面図を示している。
【０１７１】
本例のデバイス構造は、上述してきた第１−第４実施の形態とは異なり、拡散防止膜を用いることなく、キャパシタ絶縁膜自体に拡散防止機能を持たせる点に特徴を有する。
【０１７２】
以下、具体的なデバイス構造について説明する。
【０１７３】
半導体基板（例えば、シリコン基板）１１内には、トレンチが形成される。このトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料１２、例えば、Ｃｕ（銅）が満たされる。半導体基板１１内のトレンチ内に満たされた金属材料１２は、ＭＩＭキャパシタの第１電極となる。
【０１７４】
キャパシタ形成予定領域に形成された金属材料１２の形状は、板状になっており、その他の領域に形成された金属材料は、例えば、格子状、すのこ状（又は梯子状）、櫛状などに設定される。
【０１７５】
半導体基板１１上には、キャパシタ絶縁膜１５が形成される。本例では、キャパシタ絶縁膜１５は、金属原子（例えば、Ｃｕ）の拡散防止機能を有する材料から構成される。また、後述する層間絶縁膜（窒化シリコン膜１７、酸化シリコン膜１８，２０など）に対してエッチング選択比を有する材料から構成される。
【０１７６】
キャパシタ絶縁膜１５上には、窒化シリコン膜（ＳｉＮ）１７が形成される。窒化シリコン膜１７は、エッチング時（即ち、トレンチ形成時）のストッパとして機能する（詳細については、製造方法の説明で述べる。）。
【０１７７】
窒化シリコン膜１７上には、酸化シリコン膜（ＳｉＯ２）１８が形成され、酸化シリコン膜１８上には、窒化シリコン膜１９が形成される。窒化シリコン膜１９は、デュアルダマシンプロセスにおける溝形成時のストッパとして機能する。窒化シリコン膜１９上には、酸化シリコン膜（ＳｉＯ２）２０が形成され、酸化シリコン膜２０上には、窒化シリコン膜２１が形成される。窒化シリコン膜２１は、ＣＭＰ（Chemical Mechanical Polishing）プロセスにおけるストッパとして機能する。
【０１７８】
酸化シリコン膜２０内（窒化シリコン膜１９よりも上の部分）には、配線溝としてのトレンチが形成される。また、酸化シリコン膜１８及び窒化シリコン膜１７には、キャパシタ絶縁膜１５や金属材料（例えばＣｕ）１２まで達するヴィアホールとしてのトレンチが形成される。これらトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料２２Ａ，２２Ｂ、例えば、Ｃｕ（銅）が満たされる。トレンチ内に満たされた金属材料のうち、キャパシタ形成予定領域内のＭＩＭキャパシタの第２電極となる金属材料２２Ａの形状は、板状となっている。
【０１７９】
以上のような構造によれば、ＭＩＭキャパシタの第１及び第２電極が大きな拡散係数を有する金属材料（例えば、Ｃｕ）から構成される場合でも、キャパシタ絶縁膜１５自体が拡散防止機能を有するため、キャパシタ絶縁膜が汚染されることがなく、リーク電流を低減でき、高性能なＭＩＭキャパシタを提供できる。
【０１８０】
次に、図３４のＭＩＭキャパシタの製造方法について説明する。
【０１８１】
まず、図３５及び図３６に示すように、ダマシンプロセスにより、半導体基板１１内にＭＩＭキャパシタの第１電極を形成する。
【０１８２】
例えば、ＰＥＰ（Photo Engraving Process）及びＲＩＥ（Reactive Ion Etching）を用いて、半導体基板１１内にトレンチを形成する。また、ＣＶＤ法を用いて、トレンチを完全に満たす金属材料（例えば、Ｃｕ）１２を形成する。この後、ＣＭＰ法を用いて、金属材料１２を研磨し、この金属材料１２をトレンチ内のみに残存させれば、ＭＩＭキャパシタの第１電極が完成する。
【０１８３】
この後、スパッタ法を用いて、半導体基板１１上に、ＭＩＭキャパシタのキャパシタ絶縁膜１５を形成する。また、ＣＶＤ法を用いて、キャパシタ絶縁膜１５上に、窒化シリコン膜１７を形成する。
【０１８４】
次に、図３７に示すように、ＣＶＤ法を用いて、窒化シリコン膜１７上に、酸化シリコン膜（層間絶縁膜）１８を形成する。
【０１８５】
次に、図３８に示すように、ＣＶＤ法を用いて、酸化シリコン膜１８上に、エッチングストッパとしての窒化シリコン膜１９を形成する。ＣＶＤ法を用いて、窒化シリコン膜１９上に、酸化シリコン膜（配線間絶縁膜）２０を形成する。続けて、ＣＶＤ法を用いて、酸化シリコン膜２０上に、ＣＭＰのストッパとしての窒化シリコン膜２１を形成する。
【０１８６】
そして、この後、デュアルダマシンプロセスにより、ＭＩＭキャパシタの第２電極を形成する。
【０１８７】
例えば、まず、ＰＥＰ及びＲＩＥを用いて、窒化シリコン膜２１及び酸化シリコン膜２０に、配線溝としてのトレンチを形成する。酸化シリコン膜２０のエッチング時、窒化シリコン膜１９は、ＲＩＥのエッチングストッパとして機能する。このトレンチは、配線・パッド部、キャパシタ電極部を含み、キャパシタ電極部は、例えば、板状となる。
【０１８８】
さらに、続けて、ＰＥＰ及びＲＩＥを用いて、窒化シリコン膜１９及び酸化シリコン膜１８に、ヴィアホール（via hole）としてのトレンチを形成する。酸化シリコン膜１８のエッチング時、窒化シリコン膜１７は、ＲＩＥのエッチングストッパとして機能する。
【０１８９】
また、トレンチ底部の窒化シリコン膜１７をエッチングし、キャパシタ絶縁膜１５を露出させる。さらに、トレンチ底部に露出したキャパシタ絶縁膜１５のうち、キャパシタ形成予定領域のキャパシタ絶縁膜１５を残し、その他の部分のキャパシタ絶縁膜１５を選択的に除去する。
【０１９０】
その結果、キャパシタ形成予定領域では、キャパシタ絶縁膜１５が露出し、その他の領域では、金属材料１２の一部が剥き出しになる。
【０１９１】
この後、メッキ法により、トレンチを完全に満たす金属材料（例えば、Ｃｕ）２２Ａ，２２Ｂを形成する。なお、金属材料２２Ａ，２２Ｂを形成する前に、トレンチ内面に、ＴａＮなどのバリアメタルを形成しておいてもよい。
【０１９２】
次に、図３９に示すように、ＣＭＰ法を用いて、金属材料２２Ａ，２２Ｂを研磨し、金属材料２２Ａ，２２Ｂをトレンチ内に残存させる。この時、窒化シリコン膜２１は、ＣＭＰのストッパとして機能する。なお、ＭＩＭキャパシタの第２電極の形状の一例としては、例えば図４０に示すようなものが考えられる。
【０１９３】
以上の工程により、図３４のＭＩＭキャパシタが完成する。
【０１９４】
このような製造方法によれば、ダマシンプロセス（ＣＭＰプロセス）とＣｕ（銅）のような大きな拡散係数を有する金属材料を用いる場合に、キャパシタ絶縁膜１５自体が拡散防止機能を有しているため、キャパシタ絶縁膜１５の汚染（リーク電流）を有効に防止できる。また、キャパシタ形成予定領域では、電極が板状になっているため、キャパシタ面積の増大（大きなキャパシタ容量）を確保できる。また、キャパシタ形成予定領域以外の領域では、電極が格子状、すのこ状、櫛状などになっているため、ディッシング現象を防止できる。さらに、キャパシタ絶縁膜１５を、酸化シリコン膜や窒化シリコン膜に対してエッチング選択比を有するものから構成することで、製造工程が簡略化される。
【０１９５】
図４１は、本発明の第６実施の形態に関わるＭＩＭキャパシタの断面図を示している。
【０１９６】
本例は、ＲＦ−アナログデバイスとＣＭＯＳロジックデバイスを１チップ内に混載したＲＦ−ＣＭＯＳデバイスに関する。
【０１９７】
本例に関わるのデバイスは、ＲＦ−アナログエリア内のＭＩＭキャパシタに使用する拡散防止膜を、ＣＭＯＳロジックエリア内の素子（又はその一部）として用いる点に特徴を有する。
【０１９８】
半導体基板１１内には、例えば、格子状のトレンチが形成される。このトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料１２、例えば、Ｃｕ（銅）が満たされる。半導体基板１１内のトレンチ内に満たされた金属材料１２は、ＭＩＭキャパシタの第１電極となる。
【０１９９】
半導体基板１１上には、ＭＩＭキャパシタのキャパシタ形成予定領域を除き、窒化シリコン膜（ＳｉＮ）１３が形成される。ＭＩＭキャパシタのキャパシタ形成予定領域は、窒化シリコン膜１３の壁に取り囲まれた溝となっている。
【０２００】
そして、キャパシタ形成予定領域には、窒化タングステン膜（ＷＮ）１４が形成される。窒化タングステン膜１４は、金属材料（例えば、Ｃｕ）１２の拡散防止膜として機能すると共に、格子状の第１電極上に配置されることによりキャパシタ面積を増加させる機能を有する。
【０２０１】
また、本例では、ＣＭＯＳロジック領域において、窒化タングステン膜１４Ａを用いて抵抗素子を形成している。窒化タングステン膜１４Ａは、例えば、窒化タングステン膜１４と同時に形成され、窒化タングステン膜１４の厚さと同じ厚さを有している。
【０２０２】
つまり、拡散防止膜として機能する窒化タングステン膜１４を形成するステップを、ＣＭＯＳロジック領域内の抵抗素子（窒化タングステン膜１４Ａ）を形成するステップと併用することができる。その結果、本発明に係わるデバイスを製造するに当たって、従来に比べて、ステップ数の増加が実質的になくなり、製造コストの増加を防ぐことができる。
【０２０３】
なお、本例では、窒化タングステン膜１４Ａと窒化タングステン膜１４が同時に形成され、同じ厚さを有しているが、例えば、窒化タングステン膜１４Ａは、窒化タングステン膜１４，１６の積層から構成されるようにしてもよい。
【０２０４】
窒化タングステン膜１４上には、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５が形成される。キャパシタ絶縁膜１５上には、窒化タングステン膜（ＷＮ）１６が形成される。窒化タングステン膜１６は、後述するＭＩＭキャパシタの第２電極としての金属材料（例えば、Ｃｕ）の拡散防止膜として機能すると共に、後述する格子状の第２電極下に配置されることによりキャパシタ面積を増加させる機能を有する。
【０２０５】
窒化タングステン膜１６上には、窒化シリコン膜（ＳｉＮ）１７が形成される。窒化シリコン膜１７は、窒化シリコン膜１３と共に、エッチング時（即ち、トレンチ形成時）のストッパとして機能する。
【０２０６】
窒化シリコン膜１３，１７上には、酸化シリコン膜（ＳｉＯ２）１８が形成され、酸化シリコン膜１８上には、窒化シリコン膜１９が形成される。窒化シリコン膜１９は、デュアルダマシンプロセスにおけるトレンチ形成時のストッパとして機能する。窒化シリコン膜１９上には、酸化シリコン膜（ＳｉＯ２）２０が形成され、酸化シリコン膜２０上には、窒化シリコン膜２１が形成される。窒化シリコン膜２１は、ＣＭＰ（Chemical Mechanical Polishing）プロセスにおけるストッパとして機能する。
【０２０７】
酸化シリコン膜２０内（窒化シリコン膜１９よりも上の部分）には、例えば、格子状トレンチや、配線・パッド部のためのトレンチが形成される。また、酸化シリコン膜１８及び窒化シリコン膜１３には、窒化タングステン膜１４Ａ，１６や金属材料（例えばＣｕ）１２まで達するトレンチ（ヴィアホール（via hole））が形成される。これらトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料２２Ａ，２２Ｂ，２２Ｃ，２２Ｄ、例えば、Ｃｕ（銅）が満たされる。
【０２０８】
トレンチ内に満たされた金属材料２２Ａは、ＭＩＭキャパシタの第２電極となる。また、ＣＭＯＳロジック領域内においてトレンチ内に満たされた金属材料２２Ｃ，２２Ｄは、抵抗素子（窒化タングステン膜）１４Ａの電極となる。
【０２０９】
なお、本例では、ＭＩＭキャパシタの第１及び第２電極のレイアウトを格子状としているが、これは、ダマシンプロセス（ＣＭＰプロセス）においてディッシング現象を防止するためである。よって、ディッシング現象を防止できる構造であれば、トレンチの形状は、格子状に限られず、例えば、すのこ状（又は梯子状）、櫛状などであってもよい。
【０２１０】
以上のようなデバイス構造によれば、ＭＩＭキャパシタの第１及び第２電極が大きな拡散係数を有する金属材料（例えば、Ｃｕ）から構成される場合に、第１電極に接触する板状の拡散防止膜（例えば、窒化タングステン膜１４）と第２電極に接触する板状の拡散防止膜（例えば、窒化タングステン膜１６）を設けている。これら拡散防止膜は、ＭＩＭキャパシタのキャパシタ面積を増加させる機能も有する。
【０２１１】
そして、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５は、２つの拡散防止膜に挟まれ、大きな拡散係数を有する金属材料（例えば、Ｃｕ）に直接接触することがない。
【０２１２】
従って、ＭＩＭキャパシタの電極を構成する大きな拡散係数を有する金属材料により、キャパシタ絶縁膜が汚染されることがなく、リーク電流を低減でき、高性能なＭＩＭキャパシタを提供できる。
【０２１３】
また、本例では、ＲＦ−アナログエリア内のＭＩＭキャパシタに使用する拡散防止膜１４，１６の少なくとも１つを、ＣＭＯＳロジックエリア内の素子（本例では、抵抗素子）として使用している。このため、拡散防止膜として機能する窒化タングステン膜１４，１６を形成するステップを、ＣＭＯＳロジック領域内の素子（本例では、抵抗素子）を形成するステップと併用することができる。その結果、製造ステップ数の増加なく、本発明に係わるデバイスを製造することができ、製造コストの増加を抑えることができる。
【０２１４】
図４２は、本発明の第７実施の形態に関わるＭＩＭキャパシタの平面図を示している。図４３は、図４２のＸＬＩＩＩ−ＸＬＩＩＩ線に沿う断面図である。
【０２１５】
本例のＭＩＭキャパシタは、上述の第１実施の形態のＭＩＭキャパシタ変形例である。本例のＭＩＭキャパシタが上述の第１実施の形態のＭＩＭキャパシタと異なる点は、ＭＩＭキャパシタの第１電極（第１電極１２）が、半導体基板１１内ではなく、半導体基板１１上の絶縁膜（例えば、層間絶縁膜）２３内に形成されている点にある。
【０２１６】
このように、ＭＩＭキャパシタを、半導体基板１１上の絶縁膜２３上に形成することにより、例えば、絶縁膜２３の直下には、ＭＩＭキャパシタ以外の素子（例えば、ＭＯＳトランジスタなど）を形成することができる。つまり、１チップ内に、素子を３次元的に配置することで、１チップ内に、素子を高密度に配置することができる。
【０２１７】
図４４は、本発明の第８実施の形態に関わるＭＩＭキャパシタの断面図を示している。
【０２１８】
本例は、上述の第７実施の形態に関わるＭＩＭキャパシタの応用例である。
【０２１９】
本例に関わるのデバイスの特徴は、ＭＩＭキャパシタの第１電極が層間絶縁膜内に形成され、かつ、その層間絶縁膜の直下には、ＭＯＳトランジスタが形成される点にある。
【０２２０】
半導体基板１１の表面領域には、ＭＯＳトランジスタのソース／ドレイン領域２４が形成される。ソース／ドレイン領域２４の間のチャネル領域上には、ゲート絶縁膜２５を介してゲート電極２６が形成される。ＭＯＳトランジスタ上には、ＭＯＳトランジスタを完全に覆う絶縁膜２７が形成される。
【０２２１】
絶縁膜２７上には、エッチングストッパとしての窒化シリコン膜２８が形成される。窒化シリコン膜２８上には、層間絶縁膜２３が形成される。層間絶縁膜２３上には、マスク材又はエッチングストッパとしての窒化シリコン膜１３が形成される。
【０２２２】
層間絶縁膜２３内には、例えば、格子状のトレンチが形成される。このトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料１２、例えば、Ｃｕ（銅）が満たされる。層間絶縁膜２３内のトレンチ内に満たされた金属材料１２は、ＭＩＭキャパシタの第１電極となる。
【０２２３】
また、層間絶縁膜２３内には、例えば、配線のためのトレンチが形成される。このトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料２９、例えば、Ｃｕ（銅）が満たされる。
【０２２４】
層間絶縁膜２３上には、ＭＩＭキャパシタのキャパシタ形成予定領域を除き、窒化シリコン膜（ＳｉＮ）１３が形成される。ＭＩＭキャパシタのキャパシタ形成予定領域は、窒化シリコン膜１３の壁に取り囲まれた溝となっている。
【０２２５】
そして、キャパシタ形成予定領域には、窒化タングステン膜（ＷＮ）１４が形成される。窒化タングステン膜１４は、金属材料（例えば、Ｃｕ）１２の拡散防止膜として機能すると共に、格子状の第１電極上に配置されることによりキャパシタ面積を増加させる機能を有する。
【０２２６】
窒化タングステン膜１４上には、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５が形成される。キャパシタ絶縁膜１５上には、窒化タングステン膜（ＷＮ）１６が形成される。窒化タングステン膜１６は、後述するＭＩＭキャパシタの第２電極としての金属材料（例えば、Ｃｕ）の拡散防止膜として機能すると共に、後述する格子状の第２電極下に配置されることによりキャパシタ面積を増加させる機能を有する。
【０２２７】
窒化タングステン膜１６上には、窒化シリコン膜（ＳｉＮ）１７が形成される。窒化シリコン膜１７は、窒化シリコン膜１３と共に、エッチング時（即ち、トレンチ形成時）のストッパとして機能する。
【０２２８】
窒化シリコン膜１３，１７上には、酸化シリコン膜（ＳｉＯ２）１８が形成され、酸化シリコン膜１８上には、窒化シリコン膜１９が形成される。窒化シリコン膜１９は、デュアルダマシンプロセスにおけるトレンチ形成時のストッパとして機能する。窒化シリコン膜１９上には、酸化シリコン膜（ＳｉＯ２）２０が形成され、酸化シリコン膜２０上には、窒化シリコン膜２１が形成される。窒化シリコン膜２１は、ＣＭＰ（Chemical Mechanical Polishing）プロセスにおけるストッパとして機能する。
【０２２９】
酸化シリコン膜２０内（窒化シリコン膜１９よりも上の部分）には、例えば、格子状トレンチや、配線・パッド部のためのトレンチが形成される。また、酸化シリコン膜１８及び窒化シリコン膜１３には、窒化タングステン膜１６や金属材料（例えばＣｕ）１２まで達するトレンチ（ヴィアホール（via hole））が形成される。これらトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料２２Ａ，２２Ｂ、例えば、Ｃｕ（銅）が満たされる。トレンチ内に満たされた金属材料２２Ａは、ＭＩＭキャパシタの第２電極となる。
【０２３０】
以上のようなデバイス構造によれば、ＭＩＭキャパシタの第１及び第２電極が大きな拡散係数を有する金属材料から構成される場合に、第１電極に接触する板状の拡散防止膜と第２電極に接触する板状の拡散防止膜を設けている。このため、ＭＩＭキャパシタの電極を構成する金属材料により、キャパシタ絶縁膜が汚染されることがなく、リーク電流を低減でき、高性能なＭＩＭキャパシタを提供できる。
【０２３１】
また、本例では、ＭＩＭキャパシタの直下に、ＭＯＳトランジスタを形成している。このように、ＭＩＭキャパシタを半導体基板１１上の層間絶縁膜上に形成し、かつ、この層間絶縁膜の直下には、ＭＩＭキャパシタ以外の素子（例えば、ＭＯＳトランジスタなど）を形成すれば、１チップ内に、素子を３次元的に配置することができ、素子の高密度化に貢献できる。
【０２３２】
また、層間絶縁膜２３内には、ＭＩＭキャパシタの電極に加えて、通常の配線が形成される。即ち、ＭＩＭキャパシタの電極及び通常の配線は、共に、同一の金属材料（例えば、Ｃｕ）から構成される。従って、本発明は、多層配線構造を有するデバイスに最適である。
【０２３３】
ところで、本例では、ＭＩＭキャパシタとＭＯＳトランジスタが非常に近接して配置される。従って、ＭＩＭキャパシタの電極に与えられる信号とＭＯＳトランジスタのゲート電極に与えられる信号が互いに干渉し合わないようにするための対策が必要である。
【０２３４】
例えば、ＭＩＭキャパシタの電極に与えられる信号の周波数とＭＯＳトランジスタのゲート電極に与えられる信号の周波数との差が５０倍未満である、という条件を満たせば、両信号が互いに干渉し合わなくなるため、本例のデバイス構造は、非常に有効なものとなる。
【０２３５】
一方、ＭＩＭキャパシタの電極に与えられる信号の周波数とＭＯＳトランジスタのゲート電極に与えられる信号の周波数との差が５０倍以上である場合には、両信号は、互いに干渉し合うようになるため、本例のデバイス構造を改良する必要がある。
【０２３６】
図４５は、本発明の第９実施の形態に関わるＭＩＭキャパシタの断面図を示している。
【０２３７】
本例は、上述の第８実施の形態に関わるＭＩＭキャパシタの改良例であり、ＭＩＭキャパシタの電極に与えられる信号の周波数とＭＯＳトランジスタのゲート電極に与えられる信号の周波数との差が５０倍以上である場合においても、両信号が互いに干渉し合わないようなデバイス構造を有するものである。
【０２３８】
本例に関わるのデバイスの特徴を簡単に述べると、互いに上下方向に隣接して配置されるＭＩＭキャパシタとＭＯＳトランジスタの間に、シールド線を設けた点にある。シールド線は、一定電位（例えば、接地電位）に固定されているため、ＭＩＭキャパシタの電極に与えられる信号とＭＯＳトランジスタのゲート電極に与えられる信号が互いに干渉し合わなくなるものである。
【０２３９】
以下、具体的なデバイス構造について説明する。
【０２４０】
半導体基板１１の表面領域には、上述の第８実施の形態のデバイスと同様に、ＭＯＳトランジスタが形成される。ＭＯＳトランジスタ上には、ＭＯＳトランジスタを完全に覆う絶縁膜２７が形成される。絶縁膜２７上には、絶縁膜３１及び窒化シリコン膜３２が形成される。
【０２４１】
絶縁膜３１に設けられるトレンチ内には、シールド線３０Ａが形成される。同様に、絶縁膜３１に設けられるトレンチ内には、通常の配線（信号線、電源線など）３０Ｂも形成される。
【０２４２】
シールド線３０Ａ及び通常の配線３０Ｂ上には、層間絶縁膜３３が形成される。層間絶縁膜３３上には、エッチングストッパとしての窒化シリコン膜２８が形成される。窒化シリコン膜２８上には、層間絶縁膜２３が形成される。層間絶縁膜２３上には、マスク材又はエッチングストッパとしての窒化シリコン膜１３が形成される。
【０２４３】
層間絶縁膜２３内には、例えば、格子状のトレンチが形成される。このトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料１２、例えば、Ｃｕ（銅）が満たされる。層間絶縁膜２３内のトレンチ内に満たされた金属材料１２は、ＭＩＭキャパシタの第１電極となる。
【０２４４】
また、層間絶縁膜２３内には、例えば、通常の配線のためのトレンチが形成される。このトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料２９、例えば、Ｃｕ（銅）が満たされる。
【０２４５】
層間絶縁膜２３上には、ＭＩＭキャパシタのキャパシタ形成予定領域を除き、窒化シリコン膜（ＳｉＮ）１３が形成される。ＭＩＭキャパシタのキャパシタ形成予定領域は、窒化シリコン膜１３の壁に取り囲まれた溝となっている。
【０２４６】
そして、キャパシタ形成予定領域には、窒化タングステン膜（ＷＮ）１４が形成される。窒化タングステン膜１４は、金属材料（例えば、Ｃｕ）１２の拡散防止膜として機能すると共に、格子状の第１電極上に配置されることによりキャパシタ面積を増加させる機能を有する。
【０２４７】
窒化タングステン膜１４上には、キャパシタ絶縁膜（例えば、Ｔａ２Ｏ５）１５が形成される。キャパシタ絶縁膜１５上には、窒化タングステン膜（ＷＮ）１６が形成される。窒化タングステン膜１６は、後述するＭＩＭキャパシタの第２電極としての金属材料（例えば、Ｃｕ）の拡散防止膜として機能すると共に、後述する格子状の第２電極下に配置されることによりキャパシタ面積を増加させる機能を有する。
【０２４８】
窒化タングステン膜１６上には、窒化シリコン膜（ＳｉＮ）１７が形成される。窒化シリコン膜１７は、窒化シリコン膜１３と共に、エッチング時（即ち、トレンチ形成時）のストッパとして機能する。
【０２４９】
窒化シリコン膜１３，１７上には、酸化シリコン膜（ＳｉＯ２）１８が形成され、酸化シリコン膜１８上には、窒化シリコン膜１９が形成される。窒化シリコン膜１９は、デュアルダマシンプロセスにおけるトレンチ形成時のストッパとして機能する。窒化シリコン膜１９上には、酸化シリコン膜（ＳｉＯ２）２０が形成され、酸化シリコン膜２０上には、窒化シリコン膜２１が形成される。窒化シリコン膜２１は、ＣＭＰ（Chemical Mechanical Polishing）プロセスにおけるストッパとして機能する。
【０２５０】
酸化シリコン膜２０内（窒化シリコン膜１９よりも上の部分）には、例えば、格子状トレンチや、配線・パッド部のためのトレンチが形成される。また、酸化シリコン膜１８及び窒化シリコン膜１３には、窒化タングステン膜１６や金属材料（例えばＣｕ）１２まで達するトレンチ（ヴィアホール（via hole））が形成される。これらトレンチ内には、低抵抗で、大きな拡散係数を有する金属材料２２Ａ，２２Ｂ、例えば、Ｃｕ（銅）が満たされる。トレンチ内に満たされた金属材料２２Ａは、ＭＩＭキャパシタの第２電極となる。
【０２５１】
以上のようなデバイス構造によれば、ＭＩＭキャパシタの第１及び第２電極が大きな拡散係数を有する金属材料から構成される場合に、第１電極に接触する板状の拡散防止膜と第２電極に接触する板状の拡散防止膜を設けている。このため、ＭＩＭキャパシタの電極を構成する金属材料により、キャパシタ絶縁膜が汚染されることがなく、リーク電流を低減でき、高性能なＭＩＭキャパシタを提供できる。
【０２５２】
また、本例では、ＭＩＭキャパシタの直下に、ＭＯＳトランジスタを形成している。このように、ＭＩＭキャパシタを半導体基板１１上の層間絶縁膜上に形成し、かつ、この層間絶縁膜の直下には、ＭＩＭキャパシタ以外の素子（例えば、ＭＯＳトランジスタなど）を形成すれば、１チップ内に、素子を３次元的に配置することができ、素子の高密度化に貢献できる。
【０２５３】
また、層間絶縁膜２３内には、ＭＩＭキャパシタの電極に加えて、通常の配線が形成される。即ち、ＭＩＭキャパシタの電極及び通常の配線は、共に、同一の金属材料（例えば、Ｃｕ）から構成される。従って、本発明は、多層配線構造を有するデバイスに最適である。
【０２５４】
さらに、本例では、ＭＩＭキャパシタとＭＯＳトランジスタの間には、シールド線が配置される。シールド線は、一定電位（例えば、接地電位）に固定されているため、ＭＩＭキャパシタの電極に与えられる信号とＭＯＳトランジスタのゲート電極に与えられる信号とが互いに干渉し合うことがない。
【０２５５】
従って、本例によれば、ＭＩＭキャパシタの電極に与えられる信号の周波数とＭＯＳトランジスタのゲート電極に与えられる信号の周波数との差が５０倍以上であっても、正常動作が可能である。
【０２５６】
【発明の効果】
以上、説明したように、本発明によれば、ダマシンプロセス（ＣＭＰプロセス）を採用し、かつ、Ｃｕ（銅）のような大きな拡散係数を有する金属材料を配線材料として用いる場合に、金属材料（キャパシタ電極）の形状を、例えば、格子状とすることで、ディッシング現象を防止できる。また、キャパシタ絶縁膜を直接挟み込む拡散防止膜を設けるか又はキャパシタ絶縁膜自体に拡散防止機能を持たせることで、製造工程中に、金属原子がキャパシタ絶縁膜に拡散することを防止できる。また、拡散防止膜を、キャパシタ電極として機能させれば、例えば、ディッシング現象の防止のために金属材料を格子状にしても、キャパシタ面積が小さくなることがない（配線ルールによらず、キャパシタ容量を大きくできる）。また、キャパシタのパターニング時に、金属材料（例えば、Ｃｕ）が露出することがないので、金属原子による汚染をなくすことができる。また、キャパシタ構造が平坦であり、高信頼性を得るのに有利である。
【図面の簡単な説明】
【図１】本発明の第１実施の形態であるＭＩＭキャパシタを示す平面図。
【図２】図１のＩＩ−ＩＩ線に沿う断面図。
【図３】図１及び図２のデバイスの製造方法の一工程を示す平面図。
【図４】図３のＩＶ−ＩＶ線に沿う断面図。
【図５】キャパシタの第１電極のレイアウトの例を示す平面図。
【図６】キャパシタの第１電極のレイアウトの例を示す平面図。
【図７】キャパシタの第１電極のレイアウトの例を示す平面図。
【図８】図１及び図２のデバイスの製造方法の一工程を示す平面図。
【図９】図８のＩＸ−ＩＸ線に沿う断面図。
【図１０】図１及び図２のデバイスの製造方法の一工程を示す平面図。
【図１１】図１及び図２のデバイスの製造方法の一工程を示す平面図。
【図１２】図１１のＸＩＩ−ＸＩＩ線に沿う断面図。
【図１３】キャパシタの第２電極のレイアウトの例を示す平面図。
【図１４】キャパシタの第２電極のレイアウトの例を示す平面図。
【図１５】キャパシタの第２電極のレイアウトの例を示す平面図。
【図１６】本発明の第２実施の形態であるＭＩＭキャパシタを示す断面図。
【図１７】図１６のデバイスの製造方法の一工程を示す断面図。
【図１８】図１６のデバイスの製造方法の一工程を示す断面図。
【図１９】図１６のデバイスの製造方法の一工程を示す断面図。
【図２０】図１６のデバイスの製造方法の一工程を示す断面図。
【図２１】本発明の第３実施の形態であるＭＩＭキャパシタを示す断面図。
【図２２】図２１のデバイスの製造方法の一工程を示す断面図。
【図２３】図２１のデバイスの製造方法の一工程を示す断面図。
【図２４】図２１のデバイスの製造方法の一工程を示す断面図。
【図２５】図２１のデバイスの製造方法の一工程を示す断面図。
【図２６】図２１のデバイスの製造方法の一工程を示す断面図。
【図２７】キャパシタの第２電極のレイアウトの例を示す平面図。
【図２８】本発明の第４実施の形態であるＭＩＭキャパシタを示す断面図。
【図２９】図２８のデバイスの製造方法の一工程を示す断面図。
【図３０】図２８のデバイスの製造方法の一工程を示す断面図。
【図３１】図２８のデバイスの製造方法の一工程を示す断面図。
【図３２】図２８のデバイスの製造方法の一工程を示す断面図。
【図３３】図２８のデバイスの製造方法の一工程を示す断面図。
【図３４】本発明の第５実施の形態であるＭＩＭキャパシタを示す断面図。
【図３５】図３４のデバイスの製造方法の一工程を示す平面図。
【図３６】図３５のＸＸＸＶＩ−ＸＸＸＶＩ線に沿う断面図。
【図３７】図３４のデバイスの製造方法の一工程を示す断面図。
【図３８】図３４のデバイスの製造方法の一工程を示す断面図。
【図３９】図３４のデバイスの製造方法の一工程を示す断面図。
【図４０】キャパシタの第２電極のレイアウトの例を示す平面図。
【図４１】本発明の第６実施の形態であるＭＩＭキャパシタを示す断面図。
【図４２】本発明の第７実施の形態であるＭＩＭキャパシタを示す平面図。
【図４３】図４２のＸＬＩＩＩ−ＸＬＩＩＩ線に沿う断面図。
【図４４】本発明の第８実施の形態であるＭＩＭキャパシタを示す断面図。
【図４５】本発明の第９実施の形態であるＭＩＭキャパシタを示す断面図。
【符号の説明】
１１                          ：半導体基板、
１２，２２Ａ，２２Ｂ          ：金属材料（例えば、Ｃｕ）、
１３，１７，１９，２１        ：窒化シリコン膜、
１４，１６                    ：窒化タングステン膜（拡散防止膜）、
１５                          ：キャパシタ絶縁膜、
１８，２０                    ：酸化シリコン膜（層間絶縁膜）。
【図１】
0003967544.tif 000003
【図２】
0003967544.tif 000004
【図３】
0003967544.tif 000005
【図４】
0003967544.tif 000006
【図５】
0003967544.tif 000007
【図６】
0003967544.tif 000008
【図７】
0003967544.tif 000009
【図８】
0003967544.tif 000010
【図９】
0003967544.tif 000011
【図１０】
0003967544.tif 000012
【図１１】
0003967544.tif 000013
【図１２】
0003967544.tif 000014
【図１３】
0003967544.tif 000015
【図１４】
0003967544.tif 000016
【図１５】
0003967544.tif 000017
【図１６】
0003967544.tif 000018
【図１７】
0003967544.tif 000019
【図１８】
0003967544.tif 000020
【図１９】
0003967544.tif 000021
【図２０】
0003967544.tif 000022
【図２１】
0003967544.tif 000023
【図２２】
0003967544.tif 000024
【図２３】
0003967544.tif 000025
【図２４】
0003967544.tif 000026
【図２５】
0003967544.tif 000027
【図２６】
0003967544.tif 000028
【図２７】
0003967544.tif 000029
【図２８】
0003967544.tif 000030
【図２９】
0003967544.tif 000031
【図３０】
0003967544.tif 000032
【図３１】
0003967544.tif 000033
【図３２】
0003967544.tif 000034
【図３３】
0003967544.tif 000035
【図３４】
0003967544.tif 000036
【図３５】
0003967544.tif 000037
【図３６】
0003967544.tif 000038
【図３７】
0003967544.tif 000039
【図３８】
0003967544.tif 000040
【図３９】
0003967544.tif 000041
【図４０】
0003967544.tif 000042
【図４１】
0003967544.tif 000043
【図４２】
0003967544.tif 000044
【図４３】
0003967544.tif 000045
【図４４】
0003967544.tif 000046
【図４５】
0003967544.tif 000047