(57)【特許請求の範囲】
【請求項１】
直流電圧を入力し、複数個を並列に接続して並列運転装置を構成する電源回路であって、これら電源回路は入力電圧の印加と同時に任意のＨｉｇｈレベルを送出し、動作開始すると開放電位又は任意のＬｏｗレベル以下となる第一端子及び任意のＨｉｇｈレベルを入力すると動作停止し、開放又は任意のＬｏｗレベル以下を入力すると動作開始できる第二端子を備えてあり、ｎ番目に備えた前記電源回路の前記第一端子と、（ｎ＋１）番目に備えた前記電源回路の前記第二端子とを整流素子を介して接続し、この整流素子と前記（ｎ＋１）番目の電源回路に備えた前記第二端子の間に接続部を設けて、この接続部と入力直流電圧のマイナス側とをコンデンサを介して接続し得るように構成してあることを特徴とする電源回路。
【請求項２】
前記請求項1記載の電源回路において、前記整流素子はダイオードであり、このダイオードのカソードの向きが、前記（ｎ＋１）番目の電源回路側になるように接続し得るように構成してあることを特徴とする電源回路。
【請求項３】
前記請求項1記載の電源回路において、前記整流素子はＰチャネルＭＯＳＦＥＴであり、前記ｎ番目の電源回路に備えた第一端子と、前記（ｎ＋１）番目の電源回路に備えた第二端子との間に、前記ＰチャネルＭＯＳＦＥＴのドメイン・ソースを接続し、このＰチャネルＭＯＳＦＥＴのゲートと前記入力直流電圧のマイナス側とを抵抗を介して接続し得るように構成してあることを特徴とする電源回路。
【請求項４】
前記請求項1，2又は3記載の電源回路において、前記ｎ番目の電源回路に備えた第一端子と前記入力直流電圧のマイナス側との間に、単数若しくは複数の抵抗を直列に接続し得るように構成してあることを特徴とする電源回路。
【請求項５】
前記請求項1，2，3又は4記載の電源回路において、前記整流素子又は／及び前記コンデンサに、単数若しくは複数の抵抗を並列に接続し得るように構成してあることを特徴とする電源回路。
【請求項６】
前記請求項1，2，3，4又は5記載の電源回路において、前記接続部と前記（ｎ＋１）番目の電源回路に備えた第二端子との間に抵抗を接続し得るように構成してあることを特徴とする電源回路。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、直流電圧を入力し、複数個を並列に接続して並列運転装置を構成し得る電源回路に関するものである。
【０００２】
【従来の技術】
従来の電源回路Ａ，Ｂを並列に接続して構成した並列運転装置の回路図を図１に示す。また、この並列運転装置の各主要部における時間と電圧の関係を示した図を図２に示す。
１は直流電圧、１ａは入力電圧プラス側端子、１ｂは入力電圧マイナス側端子、２は第一端子である。
【０００３】
従来の当該電源回路Ａ，Ｂは、図１に示すように、入力電圧プラス側端子１ａ、入力電圧マイナス側端子１ｂ及び電源の動作状態で任意のＨｉｇｈレベルを送出する第一端子２を備えてある。隣接する電源装置Ａ，Ｂの第一端子２同士を接続して、並列運転装置を構成し、直流電圧1を入力とする本装置の一部に本電源が動作開始するまでは開放又は任意のＬｏｗレベルを送出し、動作開始に追従する形で任意のＨｉｇｈレベルを送出するようにしてある。
【０００４】
この従来例は、上記のように構成することにより、複数個を並列に接続して並列運転装置を構成した場合に、出力電圧の一斉起動が実現できる。しかし、この回路では一番目の電源装置Ａと二番目の電源装置Ｂの出力電圧を順次に起動することができないという課題が生じた。
【０００５】
【発明が解決しようとする課題】
本発明は、上記課題に鑑みてなされたものであり、複数個を並列に接続して並列運転装置を構成した場合に、出力電圧を順次に起動し得る電源回路を提供するものである。
【０００６】
【課題を解決するための手段】
請求項1の発明は、複数個を並列に接続した場合に、これら電源装置に入力される出力電圧を順次に起動することを可能とし、出力電圧を順次に起動するための回路を、これら電源回路に内蔵することを不要とし、外付けのコンデンサを選定することで順次の遅延時間を任意に設定することを可能とした。
【０００７】
請求項2及び3の発明は、複数の電源回路に入力される出力電圧を順次に起動する並列運転装置のバリエーション展開を可能とした。
【０００８】
請求項4,5及び6の発明は、各電源回路の順次に起動する遅延時間を任意に調整することを可能とした。
【０００９】
【発明の実施の形態】
以下、本発明に係る電源回路を備えた並列運転装置の好ましい実施の形態を図面に基づいて説明する。
図３は本発明に係る電源回路を備えた並列運転装置の好ましい実施の形態を示す回路図である。また、図３図示の並列運転装置の各主要部における時間と電圧の関係を示した図である。なお、本実施例は、2個の電源回路Ａ、Ｂを備えてある。
図において、１は直流電圧、１ａは入力電圧プラス側端子、１ｂは入力電圧マイナス側端子、３は第一端子、４は第二端子、５はダイオード、６はコンデンサである。
【００１０】
本実施例の並列運転装置は、２個の電源回路Ａ，Ｂを備え、これら電源回路Ａ，Ｂは入力電圧プラス側端子１ａ、入力電圧マイナス側端子１ｂ、第一端子３及び第二端子４を備え、出力側に負荷（図示しない）を接続してある。
第一端子３は、直流電圧１を入力とする本装置の一部にある任意の時間Ｈｉｇｈレベルを送出し、この動作に追従する形で、一番目の電源回路Ａに備えた第一端子３の電位が開放又はＬｏｗレベルとなるように構成してあり、第二端子４は、Ｈｉｇｈレベルを入力すると、本電源の動作を停止し、開放又は任意のＬｏｗレベル以下を入力すると、本電源の動作を開始することができるように構成してある。また、一番目の電源回路Ａに備えた第一端子３と、二番目の電源回路Ｂに備えた第二端子４との間に、整流素子であるダイオード５を備え、このダイオード５のカソードの向きが、二番目の電源回路Ｂ側になるように接続してある。また、このダイオード５と二番目の電源回路Ｂとの間に接続部を設け、この接続部と入力直流電圧のマイナス側との間にコンデンサ６を接続してある。
【００１１】
上記構成より、以下のような作用をする。先ず、直流電圧１を入力とする本装置の一部にある任意の時間Ｈｉｇｈレベルを送出する。この状態では電源回路Ｂの第二端子４がＨｉｇｈレベルであるため、電源回路Ｂは停止状態にある。その状態から一番目の電源回路Ａが動作し、出力電圧が立ち上がる。この動作に追従する形で、一番目の電源回路Ａに備えた第一端子３からの電力供給がなくなり又はＬｏｗレベルとなり、第一端子３の電位が下がるため、コンデンサ６の放電が開始される。このコンデンサ６の放電が進み、ある任意のＬｏｗレベルになった際に、二番目の電源回路Ｂの動作が開始され、出力電圧が立ち上がる。即ち、一番目の電源回路Ａ、二番目の電源回路Ｂの順番に動作が開始される。
【００１２】
なお、本発明電源回路を3個以上備えた並列運転装置においても、図３図示の実施例と同様な回路を構成することができる。この場合、ｎ番目（ｎは自然数）の電源回路に備えた第一端子３と、（ｎ＋１）番目の電源回路に備えた第二端子４とをダイオード５を介して接続し、これらダイオード５のカソードの向きが、（ｎ＋１）番目の電源回路側になるように接続する。さらに、これらダイオード５と（ｎ＋１）番目の電源回路に備えた第二端子４の間に接続部を設け、この接続部と入力直流電圧のマイナス側とをコンデンサ６を介して接続する。
【００１３】
上記構成より、以下のような作用をする。先ず、直流電圧１を入力とする本装置の一部にある任意の時間Ｈｉｇｈレベルを送出する。この状態では電源回路Ｂの第二端子４がＨｉｇｈレベルであるため、電源回路Ｂは停止状態にある。その状態から一番目の電源回路Ａが動作し、出力電圧が立ち上がる。この動作に追従する形で、一番目の電源回路Ａに備えた第一端子３からの電力供給がなくなり又はＬｏｗレベルとなり、第一端子３の電位が下がるため、コンデンサ６の放電が開始される。このコンデンサ６の放電が進み、ある任意のＬｏｗレベルになった際に、二番目の電源回路Ｂの動作が開始され、出力電圧が立ち上がる。さらに、この動作に追従する形で、二番目の電源回路Ｂに備えた第一端子３の電位がＬｏｗレベルとなり、二番目のコンデンサ６の放電が開始される。このコンデンサ６の放電が進み、ある任意のＬｏｗレベルになった際に、三番目の電源回路の動作が開始され、出力電圧が立ち上がる。従って、3個以上電源回路を有する並列運転装置においても、それぞれの電源回路が順番に動作を開始することができる。
【００１４】
図５は、図３図示の実施例に基づいたバリエーションの回路図であり、図５（ａ）の実施例は、前記接続部とコンデンサ６との間に抵抗７を設けた実施例であり、図５（ｂ）の実施例はコンデンサ６と並列に抵抗８を設けた実施例であり、図５（ｃ）及び図５（ｄ）の実施例は図５（ａ）並びに図５（ｂ）の実施例に、前記接続部と二番目の電源回路Ｂに備えた第二端子４との間に抵抗９を接続してある。このようなバリエーションにより、一番目の電源回路Ａが動作してから、二番目の電源回路Ｂが動作開始するまでの遅延時間を任意に調整することができる。
【００１５】
図５に図示した実施例は、一例に過ぎず、例えば、2個の電源回路Ａ，Ｂを備えた並列運転装置においては、一番目の電源回路Ａに備えた第一端子１ａと入力直流電圧のマイナス側との間に、単数若しくは複数の抵抗７を直列に接続したり、ダイオード５又は／及びコンデンサ６に、単数若しくは複数の抵抗８を並列に接続したり、前記接続部と二番目の電源回路Ｂに備えた第二端子１ｂとの間に抵抗９を接続することも可能である。また、これらの組み合わせも可能である。また、電源回路を3個以上備えた場合においても、同様である。
【００１６】
上記実施例では、整流素子がコンデンサ６である場合を示したが、ＭＯＳＦＥＴその他整流素子でも応用できる。例えば、図６は整流素子がＰチャネルＭＯＳＦＥＴである場合の一実施例を示してある。本実施例の電源回路は、前記実施例と同様の電源回路Ａ，Ｂを２個備え、一番目の電源回路Ａに備えた第一端子３と、二番目の電源回路Ｂに備えた第二端子４との間に、ＰチャネルＭＯＳＦＥＴ１０のドメイン・ソースを接続し、このＰチャネルＭＯＳＦＥＴ１０のゲートと入力直流電圧のマイナス側とを抵抗１２を介して接続してある。また、このＰチャネルＭＯＳＦＥＴ１０のソースと二番目の電源回路Ｂとの間に接続部を設け、この接続部と入力直流電圧のマイナス側との間にコンデンサ６を接続してある。なお、本実施例では、一番目の電源回路Ａに備えた第一端子３と、ＰチャネルＭＯＳＦＥＴ１０のゲートとを抵抗１１を介して接続してある。
【００１７】
上記構成より、以下のような作用をする。先ず、直流電圧１を入力とする本装置の一部にある任意の時間Ｈｉｇｈレベルを送出する。この状態では電源回路Ｂの第二端子４がＨｉｇｈレベルであるため、電源回路Ｂは停止状態にある。その状態から一番目の電源回路Ａが動作し、出力電圧が立ち上がる。この動作に追従する形で、一番目の電源回路Ａに備えた第一端子３からの電力供給がなくなり又はＬｏｗレベルとなり、第一端子３の電位が下がるため、コンデンサ６の放電が開始される。このコンデンサ６の放電が進み、ある任意のＬｏｗレベルになった際に、二番目の電源回路Ｂの動作が開始され、出力電圧が立ち上がる。即ち、一番目の電源回路Ａ、二番目の電源回路Ｂの順番に動作が開始される。
【００１８】
なお、電源回路を3個以上備えた並列運転装置においても、図６図示の実施例と同様な回路を構成することができる。この場合、ｎ番目の電源回路に備えた第一端子３と、（ｎ＋１）番目の電源回路に備えた第二端子４とを、ＰチャネルＭＯＳＦＥＴ１０のドメイン・ソースを接続し、これらＰチャネルＭＯＳＦＥＴ１０のゲートと入力直流電圧のマイナス側とを抵抗１２を介して接続する。さらに、これらＰチャネルＭＯＳＦＥＴ１０のソースと（ｎ＋１）番目の電源回路との間に接続部を設け、この接続部と入力直流電圧のマイナス側との間にコンデンサ６を接続する。以上のように構成した回路は、整流素子として、ダイオードを用いた場合とほぼ同様に動作する。
【００１９】
また、整流素子がＰチャネルＭＯＳＦＥＴである場合においても、前記図５の実施例に応用することができる。さらに、2個の電源回路Ａ，Ｂを備えた電源回路においては、一番目の電源回路Ａに備えた第一端子１ａと入力直流電圧のマイナス側との間に、単数若しくは複数の抵抗７を直列に接続したり、ＰチャネルＭＯＳＦＥＴ１０又は／及びコンデンサ６に、単数若しくは複数の抵抗８を並列に接続したり、前記接続部と二番目の電源回路Ｂに備えた第二端子１ｂとの間に抵抗９を接続し、一番目の電源回路Ａに備えた第一端子３と、ＰチャネルＭＯＳＦＥＴ１０のゲートとを抵抗１１を介して接続することも可能である。また、これらの組み合わせも可能である。さらに、電源回路を3個以上備えた場合においても、同様である。
【００２０】
【発明の効果】
本発明の効果としては、
請求項1の発明により、複数個を並列に接続した場合に、これら電源装置に入力される出力電圧を順次に起動することを可能とし、出力電圧を順次に起動するための回路を、これら電源回路に内蔵することを不要とし、外付けのコンデンサを選定することで順次の遅延時間を任意に設定することを可能とした。
【００２１】
請求項2及び3の発明により、複数の電源回路に入力される出力電圧を順次に起動する並列運転装置のバリエーション展開を可能とした。
【００２２】
請求項4,5及び6の発明により、各電源回路の順次に起動する遅延時間を任意に調整することを可能とした。
【図面の簡単な説明】
【図１】従来の電源回路を備えた並列運転装置の回路図
【図２】従来の電源回路を備えた並列運転装置での各部の波形を示す図
【図３】本発明電源回路を備えた並列運転装置の一実施例を示す回路図
【図４】図３図示装置での各部の波形を示す図
【図５】図３図示装置のバリエーションを示す回路図
【図６】別の実施例を示す回路図
【符号の説明】
１．直流電圧
１ａ．入力電圧プラス側端子
１ｂ．入力電圧マイナス側端子、
２．第一端子
３．第一端子
４．第二端子
５．ダイオード
６．コンデンサ
７．抵抗
８．抵抗
９．抵抗
１０．ＰチャネルＭＯＳＦＥＴ
１１．抵抗
１２．抵抗
Ａ．一番目の電源回路
Ｂ．二番目の電源回路
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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