(57)【特許請求の範囲】
【請求項１】
液晶パネルと、
該液晶パネルを照射しかつ第１の発光輝度と第２の発光輝度からなる周期を有する光源と、
前記第１の発光輝度と第２の発光輝度の開始時間を外部から供給される表示データに基づいて変える制御回路とを有し、
前記制御回路は、前記周期の前記第１の発光輝度を有する時間に第１の電流値の電流を前記光源に供給し、前記周期の前記第２の発光輝度を有する時間に前記第１の電流値よりも小さい第２の電流値の電流を前記光源に供給し、
前記制御回路は、前記表示データが動画であり現フレームの前記表示データと前フレームの前記表示データとの不一致の画素数が多い場合の前記光源の周期における前記第１の発光輝度の時間を、前記表示データが動画であり前記現フレームの前記表示データと前記前フレームの前記表示データとの不一致の画素数が少ない場合の前記光源の周期における前記第１の発光輝度の時間に比較して、短くし、
前記制御回路は、前記表示データを少なくとも１フレーム分記憶するデータ格納部と、前記データ格納部に格納された表示データと入力される表示データとで対応する画素を比較するデータ比較部と、前記データ比較部による比較結果に応じて、前記複数の光源に対応する表示領域のどの領域に動画表示が多いかを判定するモード判定部と、前記モード判定部の判定結果に基づき前記複数の光源のそれぞれに対して周期における前記第１の発光輝度及び第２の発光輝度の開始時間を制御する信号を出力するパルス制御部とを有する液晶表示装置。
【請求項２】
液晶パネルと、
該液晶パネルを照射しかつ第１の発光輝度と第２の発光輝度からなる周期を有する光源と、
前記第１の発光輝度と第２の発光輝度の開始時間を外部から供給される表示データに基づいて変える制御回路とを有し、
前記制御回路は、前記周期の前記第１の発光輝度を有する時間に第１の電流値の電流を前記光源に供給し、前記周期の前記第２の発光輝度を有する時間に前記第１の電流値よりも小さい第２の電流値の電流を前記光源に供給し、
前記制御回路は、前記表示データが動画であり現フレームの前記表示データと前フレームの前記表示データとの不一致の画素数が多い場合の前記光源の周期における前記第１の発光輝度の時間を、前記表示データが動画であり前記現フレームの前記表示データと前記前フレームの前記表示データとの不一致の画素数が少ない場合の前記光源の周期における前記第１の発光輝度の時間に比較して、短くし、
前記制御回路は、前記複数の光源に対応するそれぞれの前記液晶パネルの領域のうち、前記表示データの最も変化する領域の表示データの書き込みが終了した直後に前記第２の発光輝度の期間が開始されるように前記第１の発光輝度の開始時間と期間を示す信号を出力する液晶表示装置。
【請求項３】
請求項１に記載の液晶表示装置において、
前記第２の発光輝度は、実質的に０である液晶表示装置。
【請求項４】
請求項１に記載の液晶表示装置において、
前記外部から供給される表示データに基づいて、前記第１の電流値及び前記第２の電流値を制御する液晶表示装置。
【請求項５】
請求項１に記載の液晶表示装置において、
前記制御回路は、前記外部から供給される表示データの輝度やコントラストが小さい場合に、前記第１の電流値を小さくする液晶表示装置。
【請求項６】
請求項１に記載の液晶表示装置において、
前記制御回路は、前記表示データの動きが速い場合の前記光源の周期における前記第１の発光輝度の時間を、前記表示データの動きが遅い場合の前記光源の周期における前記第１の発光輝度の時間に比較して、短くする液晶表示装置。
【請求項７】
液晶パネルと、
該液晶パネルを照射しかつ第１の発光輝度と第２の発光輝度からなる周期を有する光源と、
前記第１の発光輝度と第２の発光輝度の開始時間を外部から供給される表示データに基づいて変える制御回路と、
前記表示データを一時的に格納するメモリとを有し、
前記制御回路は、前記周期の前記第１の発光輝度を有する時間に第１の電流値の電流を前記光源に供給し、前記周期の前記第２の発光輝度を有する時間に前記第１の電流値よりも小さい第２の電流値の電流を前記光源に供給し、
前記制御回路は、前記表示データが動画であり現フレームの前記表示データと前フレームの前記表示データとの不一致の画素数が多い場合の前記光源の周期における前記第１の発光輝度の時間を、前記表示データが動画であり前記現フレームの前記表示データと前記前フレームの前記表示データとの不一致の画素数が少ない場合の前記光源の周期における前記第１の発光輝度の時間に比較して、短くし、
前記制御回路は、前記表示データの動きが速い場合の前記光源の周期における前記第１の発光輝度の時間を、前記表示データの動きが遅い場合の前記光源の周期における前記第１の発光輝度の時間に比較して、短くし、
前記制御回路は、前記表示データの動きが速い場合に、前記表示データの前記メモリからの出力周波数を入力周波数に対してN（Nは２以上の整数）倍化し、前記入力周波数に対する前記出力周波数の差分期間にダミーデータを挿入して、前記光源の周期における前記第１の発光輝度の時間を制御する液晶表示装置。
【請求項８】
請求項１に記載の液晶表示装置において、
前記制御回路は、前記第１の発光輝度と第２の発光輝度の開始時間を、前記液晶パネルにおいて前記表示データが到達すべき階調データに到達したタイミングに合わせる液晶表示装置。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、液晶表示素子やエレクトロルミネセンス素子（Electroluminescence Device）等を用いた表示装置に係り、その表示画面の輝度を効率良く高め、該表示画面にて均一化させるために好適な光源を有する表示装置に関する。
【０００２】
【従来の技術】
液晶表示素子（液晶表示パネルとも呼ばれる）やエレクトロルミネセンス素子（用いる蛍光材料により有機系、無機系に別れる、以下、ＥＬ素子と呼ぶ）、電界放出素子（Field Emission Device、以下、ＦＥ素子と呼ぶ）等を用いた表示装置は、ブラウン管（以下、ＣＲＴ：Cathode Ray Tubeと呼ぶ）のように表示画面の裏側に電子線を２次元的に走査するための空間を設けることなく画像表示を行う。従って、これらの表示装置は、ＣＲＴに比べて、薄く軽量であること、消費電力が低いこと等の特徴を持つ。これらの表示装置は、その外観上の特徴からフラット・パネル・ディスプレイ（Flat Panel Display）と呼ばれることがある。
【０００３】
液晶表示素子、ＥＬ素子、ＦＥ素子等を用いた表示装置は、ＣＲＴに対する上述の利点から、各種用途においてＣＲＴを用いた表示装置に代わり広く普及しつつある。この背景には、液晶表示素子やＥＬ素子等の画質向上といった技術革新もある。一方で、近年、マルチメディアやインターネットの普及により、動画表示への要求が強くなってきており、液晶表示素子を用いた表示装置においては、動画表示を実現するために液晶材料や駆動方法による改善がなされている。しかしながら、液晶表示装置に限らず、フラット・パネル・ディスプレイと呼ばれる表示装置において、従来のＣＲＴと同等の画像を表示するための高輝度化も重要な課題となっている。
【０００４】
ＣＲＴと同等の動画表示を得るためには、電子銃から輻射される電子線を各画素に走査し、夫々の画素の蛍光体を発光させるインパルス型発光が必須である。
【０００５】
これに対して、例えば液晶表示装置は蛍光灯による光源ユニットを用いたホールド型発光のため、完全な動画表示が困難とされてきた。
【０００６】
液晶表示装置に係る上記課題を解決する手法として、液晶セル（基板間に封入された液晶層）の液晶材料あるいは表示モードの改良と、光源に直下型光源ユニット（液晶表示素子の表示画面に対向させて複数の蛍光灯を配置する光源構造）を用いる方法が報告されている。図１６は、動画表示向けに提案された直下型光源ユニットの点灯動作方法の一例を示した図であり、表示画面（破線枠）に対向させて管状ランプ８本を配置した直下型光源ユニットのレイアウトと、夫々のランプの各点灯開始時間のタイミングを輝度波形として示す。図１６に示す輝度波形は、図の上側に凸となるとき輝度が高まることを表している。図１６から明らかなように、夫々の蛍光管の点灯開始時間は、上側に配置されたものから下に配置されたものへと順次ずらされている。この一連の点灯動作は、画像表示信号の走査周期に同期され、１フレームの画像表示期間（表示画面の全画素に表示信号を送る期間）毎に繰り返されていた。（「液晶」誌，Vol. 3, No. 2 (1999)，p99-p106参照）
一方、液晶表示装置に伝送される動画信号の場面に応じて光源の輝度を変調する技術がある。この技術は、動画信号を構成する画像毎に液晶表示装置に伝送される表示信号の最大輝度データ、最小輝度データ、並びに平均輝度データを読み出し、これらのデータに応じて光源に供給される電流（以下、ランプ電流）を制御する。通常ランプ電流を基準電流（例えば、４．５ｍＡ）とすると、全体的に明るい画像の場合にはランプ電流をある期間において基準電流より高く（例えば、８ｍＡ）設定し、その後基準電流に戻す。逆に全体的に暗い画像の場合にはランプ電流を基準電流より低く（例えば、１．５ｍＡ）設定する。（「日経エレクトロニクス」誌，1999.11.15，no. 757, 1999, p139-p146参照）
この設定により、前者（全体的に明るい画像）の場合、基準電流より高い電流を光源に供給する分、光源の温度上昇も大きい。蛍光灯の場合、その温度上昇により蛍光灯内の水銀（Ｈｇ）蒸気圧が上昇し、当該蛍光灯内にて水銀原子（水銀蒸気量）が増加する。一方、蛍光灯内に余剰の水銀原子が存在すると、水銀原子と電子との衝突により蛍光灯内で生じた紫外線が水銀原子に吸収される確率が高くなり、蛍光灯自体の輝度は低下する。この影響を避けるため、上記期間にてランプ電流を上記基準電流より大きく設定した後、蛍光灯内の水銀蒸気圧が変化する前にランプ電流を基準電流に戻す。このようにランプ電流を変化させることにより、蛍光灯の輝度をこれに基準電流を供給したときのそれより高くする。また、後者（全体的に暗い画像）の場合、光源の輝度が高いと黒又はこれに近い色を表示する画素からのわずかな光の漏れを抑えることが必要となる。全体的に暗い画面では、画面内で最も光透過率を高く設定した画素においても透過させるべき光の絶対量は小さい。このため、ランプ電流を基準電流より低く設定し、光源の輝度を抑えて黒又はこれに近い色を表示する画素からの光の漏れを絞るとともに、光源における消費電力を低減させる。
【０００７】
この２つの技術の組合せから、動画全体でみた映像における輝度のダイナミックレンジ（最大輝度／最小輝度の比）は従来の２.８倍に、そのコントラスト比は４００〜５００：１と従来の液晶表示装置の２倍以上に夫々広がる。
【０００８】
【発明が解決しようとする課題】
液晶表示装置において上述の直下型光源ユニットの点灯動作を順繰りに行う技術を実施する場合、例えば直下型光源ユニットに搭載する蛍光灯の本数を増やすと、１周期（１フレーム分に相当）の点灯動作期間中に占める各蛍光灯の発光時間が短くなってしまう。このため、直下型光源ユニット全体での輝度効率が低下した。
【０００９】
また、表示画像の輝度を上げるために各蛍光灯に印加する電力を増やすと蛍光灯の発熱により液晶セルが局所的に熱せられ均一性も低下した。
【００１０】
液晶表示装置における画像表示は、これに搭載される液晶表示素子の液晶セルに封止された液晶分子を当該画像情報（液晶セルに印加される電界）に対応する方向に配向させ、液晶セルの光透過率を所望の値に設定して行う。このため液晶セルにおける液晶分子が画像情報に応じた方向へ確実に配向させる上で、液晶セル内の粘度を適正な値に保つことが望ましく、該液晶セルに増粘剤又は減粘剤を液晶分子とともに封入することがある。しかし、液晶セルの温度が局所的に上昇すると、この部分において粘度が下がり、液晶分子の一部の向きがランダムになる（液晶層の等方相化）。
【００１１】
従って、この部分の液晶セルだけ、液晶分子に印加される電界に対応しない光透過率を示し、このため、横電界型の液晶表示装置での表示輝度を３００ｃｄ／ｍ２より高くすることは事実上不可能である。
【００１２】
また、上述の動画信号を構成する画像毎に光源の輝度を調整する技術を、液晶表示装置に実施した場合、全体的に明るい画像を表示するときの光源に供給されるランプ電流を上記基準電流より高い値から当該基準電流に下げるタイミングの設定が実用上困難である。上述のとおり、光源の輝度をこれに基準電流を供給したときの値より高めるには、一旦上記基準電流より大きく設定したランプ電流を蛍光灯内の水銀蒸気圧が変化する前に基準電流に戻さなければならないが、このようにランプ電流を切替えるタイミングは、例えば光源（蛍光灯）の温度変化の測定データと光源輝度との相関に基づき経験的に設定せざるを得ない。また、表示装置の使用条件、例えば、室温などの相違まで考慮するとなると、ランプ電流を切り替えるタイミングの設定は極めて困難である。更に、この技術では各々の画像の明るさに応じ、夫々の画像表示時刻の光源輝度を変化させるため、画像毎のコントラスト比は従来の液晶表示装置で達成し得る程度に留まる。これを言い換えれば、この技術を液晶表示装置に適用しても、静止画像のような一定期間（複数フレームの画像データが液晶表示装置に伝送される期間）にわたり画像の明るさがほとんど変動しない映像を表示する場合、そのコントラスト比を向上させることはできない。
【００１３】
本発明の目的は、表示画像の輝度を効率よく向上すると共に、光源の発熱を抑制した液晶表示装置及びその制御方法を提供することにある。
【００１４】
又は、本発明の目的は、動画でのボケを改善した液晶表示装置及びその制御方法を提供することにある。
【００１５】
又は、本発明の目的は、コントラストを向上した液晶表示装置及びその制御方法を提供することにある。
【００１６】
【課題を解決するための手段】
上記目的を達成するために、液晶パネルと、該液晶パネルに設けられこれを照射する光源が備えられた液晶表示装置において、光源は第１の発光輝度と第２の発光輝度からなる周期を有し，該周期中の第１の発光輝度と第２の発光輝度の時間比率を外部から供給される表示データに基づいて変えるようにした。ここで、第１の発光輝度は第２の発光輝度よりも高く、一例として前記周期における前記第１の発光輝度の時間比率を、前記表示データが動画の場合には６０％より小さく、前記表示データが静止画の場合には６０％以上とする。また、第２の発光輝度は、第１の発光輝度の残像、輝度が低い場合の再現性を向上させるため実質的に０とする。
【００１７】
また、制御回路構成の一例としては、表示データを少なくとも１フレーム分記憶するデータ格納部と、データ格納部に格納された表示データと入力される表示データとで対応する画素を比較するデータ比較部と、データ比較部による比較結果に応じて、周期における前記第１の発光輝度の時間比率を制御する信号を出力するパルス制御部とにより構成した。
【００１８】
データ比較部により比較される比較画素は、その分布を前記液晶パネルの表示部中央近傍に集中させたものであることを特徴とする液晶表示装置。
【００１９】
また、複数の光源に対応させるべく、制御回路は、各光源に対応させて表示パネルの領域を定義し、各領域毎に表示データに基づいて、前記第１の発光輝度と第２の発光輝度の開始時間を外部から供給される表示データに基づいて変えるように構成した。
【００２０】
制御回路構成の別の一例としては、Ｒ、Ｇ、Ｂ各映像データから輝度データを生成する輝度データ生成制御部と、生成した輝度データから1画面分の入力映像データに対する輝度分布状態を検出する輝度分布検出制御部と、輝度分布検出結果に従って階調特性を制御する折線ポイント階調制御部と、前記輝度分布検出結果に従ってバックライトの調光制御を行うバックライト調光制御部と、１画面の表示データに対しバックライトの発光タイミングを制御するブリンク・バックライト制御部とにより構成構成した。
【００２１】
また、制御回路構成例としては、上記２つの例に示す構成の双方を兼ね備えた構成においても何ら問題はない。
【００２２】
【発明の実施の形態】
本発明は、複数の画素が配置されたパネルと、これら複数の画素に表示される画像を可視化する光源と、この光源を制御する制御回路を備え、その制御回路は、第１の期間には第１の強度を有する電流を光源に供給し、第２の期間には第２の強度を有する（第１の強度とは異なる）電流を光源に供給し、この第1の期間と第2の期間とを周期的に繰り返し、かつその周期において上記光源から輻射される光の強度（その周期の間の光の輝度の積分値）は、同一期間における上記光源が定格電流で点灯させた場合の輝度の積分値より高くなるように制御する。なお、定格電流で点灯させたときの輝度の積分値は、点灯後約３０分後の輝度が安定した状態のものを積分対象とした。
【００２３】
また、表示装置が液晶表示装置の場合、パネルは夫々が対向するように配置された一対の基板（少なくとも一方は光源からの光を透過させるに十分な光透過率を有する）と、この一対の基板間に封入された液晶層（液晶分子又はこれと減粘剤等の添加物を含む）を備え、一対の基板の少なくとも一方には、画素を構成する電極とこれに画像情報を伝送する信号線が設けられる。このように構成されたパネルは、液晶表示パネル（Liquid Crystal Display Panel）又は液晶表示素子（Liquid Crystal Display Element）と呼ばれる。光源は、パネルの少なくとも一方の面に蛍光灯、又はこの蛍光灯と光学的に結合された光学素子（例えば、導光板）を対向させて配置される。近年では、蛍光灯に代えて複数の発光素子をパネルに沿って配置した発光素子アレイを用いるものも提案されている。
【００２４】
本発明による表示装置において、光源に供給される第１の電流と上記第２の電流の大小関係は、特に限定されない。しかし、この表示装置を従来と同様、連続的に光源を点灯させて利用する場合をも考慮すると、第１の電流に対し第２の電流を小さく設定することが望ましい。
【００２５】
なお、液晶表示素子おいて、第１の電流値並びに第２の電流値、及び第１の期間並びに第２の期間における時間配分を、表示装置へ伝送される映像信号から表示すべき画像の輝度を算出し、それに合せて調整してもよい（観点１’）。特に、輝度やコントラストを高くする必要のない画像データに対しては、第１及び第２の電流の特に大きい方の値を押さえ、消費電力を節約する。この場合、周期において上記光源から輻射される光の強度（その周期の間の光の輝度の積分値）は、同一期間における上記光源が定格電流で点灯させた場合の輝度の積分値より低くなってもかまわない。
【００２６】
以下、本発明の具体的な実施形態をこれに関連する図面を参照して説明する。
【００２７】
以下の説明にて参照する図面で、同一機能を有するものは同一符号を付け、その繰り返しの説明は省略する。
【００２８】
図１は本発明による液晶表示モジュールを搭載した液晶表示装置の概略構成図である。図１において、８は蛍光灯、２０は直流電圧源入力端子、２１はインバータ回路、２３は調光回路、２５はスイッチング制御回路、２７は液晶パネル、２８は液晶表示モジュール、２９はテレビ入力端子、３０はビデオ入力端子、３１はＳ入力端子、３２はアナログＰＣ入力端子、３３はデジタルＰＣ入力端子、３４はアナログ映像処理制御部、３５はデジタル映像処理制御部、３６は液晶表示装置を各々示す。
【００２９】
図１において液晶表示装置３６は、映像入力としてテレビ入力端子２９、ビデオ入力端子３０、Ｓ入力端子３１などからの主に動画及び、アナログＰＣ入力端子３２ 、デジタルＰＣ入力端子３３などからの主に静止画を可能とする。入力されたアナログ映像データはアナログ映像処理制御部 ３４において、輝度−色信号分離処理、アナログ−デジタル変換処理などを施し、デジタル映像データとしてデジタル映像処理制御部３５に出力する。デジタル映像処理制御部３５ではインターレース−ノン・インターレース変換処理、拡大処理などを施して液晶表示モジュール２８に出力する。液晶表示モジュール２８では、入力されたデジタル映像データ(DATA)を液晶パネル２７に入力すると共に、スイッチング制御回路２５に入力する。スイッチング制御回路２５では、この入力されたデジタル映像データ(DATA)の状態を検出し、検出信号を調光回路２３に出力する。調光回路２３はこの検出信号の状態に従って、良好な表示状態を得るための調光制御信号をインバータ回路２１に出力することで蛍光灯 ８の光源制御を行うものである。
【００３０】
以下、各部の詳細について順次説明する。
【００３１】
図３及び図４は、各々、（ａ）液晶パネルの構造を概念的に描いた断面図と（ｂ）液晶表示装置に据え付けられる光源ユニットの斜視図を示したものである。いずれの図においても、液晶パネルは各々の主面が対向するように配置された一対の基板３とこれらの間に挟持された液晶層（液晶分子、又はこれと減粘剤等との混合物が封入される）２からなる液晶表示素子と蛍光灯８が搭載された光源ユニット１０を備える。図３（ａ）及び図４（ａ）においても、基板３における液晶層２とは反対側の主面に偏光板１が設けられる。また、一対の基板３のうち少なくとも一つは、液晶層２側の主面に複数の画素（図示せず）が２次元的に配置される。図３（ａ）及び図４（ａ）のいずれに示した液晶パネルにおいても、使用者は図の上側から基板３の主面を通して画像を見ることができる。
【００３２】
図３に示す液晶パネルは、その光源ユニット１０における蛍光灯８の配置からサイドライト型（又はエッジライト型）と呼ばれる。この光源ユニット１０は、上記液晶表示素子の下面に対向するように配置された四辺形の上面を有する導光板１１と、この導光板の少なくとも一側面（四辺形の一辺）に沿って配置された管状の蛍光灯８と、この蛍光灯８から導光板の反対側へ輻射される光を導光板の側面に入射させる反射器７と、導光板内をその下面に向けて伝播していく光をその上面に向けて反射させ且つ液晶表示素子の下面に照射させる反射フィルム９とを備える。導光板１１の上面と液晶表示素子の下面の間には、例えば一対の拡散フィルム６とこれに挟まれたプリズムシート５を含む光学シート群４が配置される。サイドライト型の液晶パネルでは、液晶表示素子の下面は蛍光灯８と対向せず、図３（ｂ）に示す導光板１１の上面に対向するように配置される。
【００３３】
これに対し、図４に示す液晶パネルは、光源ユニット１０における複数の蛍光灯８が液晶表示素子の下面に対向するように（図４（ａ）に示すように液晶パネルの直下に）配置されることから直下型と呼ばれる。直下型の液晶パネルに用いられる光源ユニット１０では、蛍光灯８から図の下側に輻射される光を反射させて図の上側（液晶表示素子の下面）に照射するように反射器７が配置され、複数の蛍光灯８とこれらの間隙とにおける光強度のバラツキを解消するための起伏が形成されている。光源ユニット１０と液晶表示素子との間には、サイドライト型と同様に光学シート群４が配置されているが、サイドライト型の光学シート群４で光学ユニット１０側に配置される拡散シート６は拡散板６ａに置換えられている。この拡散板６ａには、上述の複数の蛍光灯８とこれらの間隙とにおける光強度のバラツキを解消するための光学的なパターンが形成されている。
【００３４】
なお、サイドライト型の液晶パネルの詳細な解説は例えば特開平７−２８１１８５号公報に、直下型の液晶パネルの詳細な解説は例えば特開平５−２５７１４２号公報に夫々記載されている。
【００３５】
上述の液晶パネルでは、液晶層２への印加電界の増減により、その光透過率を設定して画像を表示する。例えば、液晶層２において、液晶分子をねじれ角が９０゜前後で配向させたＴＮ型や垂直配向型のＴＦＴ（Thin Film Transistor）駆動の液晶表示装置（アクティブ・マトリクス型）や、ねじれ角が２００から２６０゜で配向させたＳＴＮ型の時分割駆動の液晶パネル（パッシブ・マトリクス型）では、液晶層２への印加電界の増加に従って、その光透過率は最大値（白画像）から最小値（黒画像）に変化する。
【００３６】
一方、液晶層２に印加する電界を基板面に沿った方向に印加する横電界型と呼ばれるＴＦＴ駆動の液晶パネルでは、液晶層２への印加電界の増加に従って、その光透過率は最小値（黒画像）から最大値（白画像）に変化する。
【００３７】
ＴＮ型や垂直配向型のＴＦＴ駆動の液晶パネルの場合、液晶層２の屈折率異方性Δｎとセルギャップ（液晶層２の厚み）ｄの積Δｎｄは０．２から０．６μｍの範囲がコントラスト比と明るさを両立させる上で望ましく、ＳＴＮ型液晶パネルのΔｎｄは０．５から１．２μｍの範囲が、横電界型のＴＦＴ液晶パネルのΔｎｄは０．２から０．５μｍの範囲が好ましい。
【００３８】
このように構成された液晶パネルにおける本発明の実施態様の概要を、上述の観点に沿って説明する。
【００３９】
図２は、観点１に基づく本発明を液晶表示装置に実施したときの同期信号（画像情報の伝送タイミング）、画像表示信号、光源の点灯信号、及び光源ユニットから輻射される光の輝度波形を示す図である。光源の点灯信号は、第１電流ｉIをΔｔIの時間（第１の期間）に光源に供給し、次いでこの第１電流より小さい第２電流ｉIIをΔｔIIの時間（第２の期間）に光源に供給し、この時間の和であるΔｔI＋ΔｔIIの動作周期を繰り返す波形として示される。この例では、ΔｔIとΔｔIIとを等しく設定した、すなわち５０％のデュティで電流を光源に供給し、第２電流ｉIIの値は略０ｍＡに抑えることにする。従って、上記動作周期にて光源が消費する電力で一定の電流を光源に供給することを想定すると、その電流値は第１電流と第２電流の中間値ｉCONSTとして図示される。
【００４０】
そして、光源の輝度波形からｉCONSTに相当する輝度は、第１電流に相当する輝度（所定時間の第１電流の供給により輝度が到達する値）ＩIと第２電流に相当する輝度（所定時間の第２電流の供給により輝度が到達する値）ＩIIとの中間値ＩCONST（破線）に相当すると予測される。しかし、動作周期の複数分の時間においてｉCONSTの電流を連続的に流すと光源の温度が次第に上昇するため、光源内部における光の損失が徐々に増加する。このため、光源の輝度は実際にはＩCONST（破線）より低いＩCONST'（実線）の値を示す。また、時間経過による光源の温度上昇により、ＩCONST（破線）とＩCONST'（実線）との差はΔI１からΔI２に徐々に広がる。
【００４１】
これに対し、第１電流ｉIを光源に供給する時間ΔｔIを、第１電流ｉIによる光源の温度上昇がある値に到達する所要時間より短く設定すると、第１電流ｉIに対応した輝度の光を光源内で損失することなく取り出すことができる。図５は、光源の一つとして用いられる冷陰極管に関し、（ａ）管内温度（管内における水銀蒸気圧でも等価できる）と輝度の関係、及び（ｂ）冷陰極管に設けられた一対の電極に供給される電流と輝度の関係を示す。冷陰極管の輝度は、その管内の水銀蒸気圧、言い換えれば管内に存在する水銀ガスの量に依存し、この水銀ガス量がある値（この例では水銀蒸気圧にして４．７Ｐａ）以下の場合、水銀ガス量の増加に応じて管内における温度も増加し、冷陰極管自体の輝度も上昇する。しかし、水銀ガス量がこのある値を越えると管内で生じた光が徐々に水銀ガスにより吸収され、その結果、冷陰極管の輝度も減少する。このような傾向は、冷陰極管や水銀ガスに限らず、管球がその内部に励起材料を含む限りにおいて認められるものである。例えば、キセノンランプでも冷陰極管と同様な現象が生じる。
【００４２】
また、冷陰極管内の水銀蒸気圧は、冷陰極管内の温度にも等価でき、更に冷陰極管内の温度は冷陰極管に設けられた一対の電極間に供給する電流に応じて上昇する。従って、冷陰極管に電流を連続的に供給する場合、その電流値の上昇に応じて輝度の上昇は飽和し、ある値で飽和する。（図５（ｂ）参照）。
【００４３】
しかしながら、図２の第１期間ΔｔIにおける光源の輝度波形が示すように、電流ｉIを冷陰極管に供給すると、その輝度は徐々に上昇する。このことから、所定の電流を冷陰極管に供給したときの管内温度の上昇は、電流ｉIの供給開始時刻に対してある遅延を伴って生じることは明らかである。さらに、液晶表示装置での画像データ信号の書き換え周期、例えば６０Ｈｚでの１６．７ｍｓ（ｍｓ＝ミリ秒）、１２０Ｈｚでの８．４ｍｓ（これらの値は動画表示に好適）を考慮すると、上記光源の動作周期をこの周期以下に設定することが望ましいが、この動作周期に対応させて上記第１及び第２期間の時間配分及び上記第１及び第２電流を設定すると、上記温度上昇の影響を低減することができる。先に参照した各冷陰極管のカタログから、冷陰極管の定格電流（その値の一例：６ｍA）で連続的に点灯した場合、冷陰極管の周囲温度に応じて次の知見が得られる。
【００４４】
（１）４０℃の周囲温度では点灯開始から約１５０秒で輝度は飽和２００秒経過後も輝度減少が認められない。
【００４５】
（２）６０℃の周囲温度では点灯開始から約１５秒で輝度は最大値を示し、その後輝度は緩やかに減少し、２００秒経過後には最大値の９０％に到る。
【００４６】
（３）８０℃の周囲温度では点灯開始から約１０秒で輝度は最大値を示し、その後の約１０秒間で輝度は最大値の８０％まで急激に減少し、以降、点灯開始から２００秒経過後に掛けて輝度は緩やかに減少する。
【００４７】
これらの知見に基づき、本発明者等は冷陰極管の定格電流の２倍程度に第１電流を設定したとしても、その第１電流に対して小さく設定される第２電流の値及びその供給時間（第２の期間）を調整することにより冷陰極管の温度上昇を抑止できることを着想し、その効果を確認した。
【００４８】
一方、上記第２の期間では第１電流より小さい第２電流を光源に供給するため、光源の輝度が低下する。しかしながら、第２の期間における輝度低下は液晶表示素子を透過する光の輝度（以下、パネル輝度）で見ると、その影響は予想外に小さい。第２電流を０ｍAに設定したときの上記ΔｔI＋ΔｔII分の動作周期（デュティ：５０％）におけるパネル輝度の積分値で比較すると、第２の期間に生じる光源の残光に関して次の知見が実験的に得られた。（図６参照）
（４）液晶表示素子の画素を白表示した（この画素に光透過率を最大とする映像信号を送った）とき、その画素を透過する光の減衰は予想以上に小さく、その表示輝度の積分値は、上記動作周期において同じ電力で光源を連続点灯させたときの値より大きくなった。
【００４９】
（５）液晶表示素子の画素を黒表示した（この画素に光透過率を最小とする映像信号を送った）とき、その画素を透過する光の減衰は十分に大きく、その表示輝度の積分値は、上記動作周期において同じ電力で光源を連続点灯させたときの値の半分程度に抑えられた。
【００５０】
液晶表示装置に限らず、表示装置に要求される最大輝度は、複数画素のうちの最も明るく（白く）表示される画素の輝度となる。その他の画素、特に最も暗く（黒く）表示される画素や、これに近い階調（暗い灰色）で表示される画素において、これらの表示輝度が上がると表示画面全体が白けた映像となり、液晶表示装置の使用者にはＣＲＴに対して見劣りのするものと受け取られる。
【００５１】
しかし、本発明者等が実験的に得た上記（４）及び（５）の知見は、上述のように所定のデュティで光源に供給する電流を変調すれば、電流を連続的に供給してきた従来の手法に比べ、表示画面において最も明るく表示される画素の輝度を高め、逆に最も暗く表示される画素の輝度を抑えられることを証明した。さらに、知見（４）及び（５）は上記デュティにおける消費電力を等しくした場合、光源を連続点灯したときに比べて上記最大輝度が格段に向上することを証明した。
【００５２】
この現象の根拠は完全に解明されていないが、電流値を抑えた期間（上記第２の期間）における光源の残光が、光透過率を一定の高さ以上に設定した画素において、予想以上にその輝度を保持したことは実験結果から明らかである。以上の考察により、本発明は既に述べたその目的及び他の目的を達成することは明らかである。
【００５３】
なお、知見（４）及び（５）は、液晶表示装置のパネル輝度をＥＩＡＪ（日本電子機械工業会規格）のＥＤ−２５２２に規定される条件に準拠して測定し、可視光領域（３８０ｎｍ〜７８０ｎｍ）における波長毎のスペクトル強度を視感度補正（人間の目が実際に感じる光の量に換算）して得られた結果から導いた。この測定は、液晶表示装置を暗室に置き、輝度計を液晶表示素子から５０ｃｍ離し且つその表示領域に対して垂直に配置して実施する。このような測定を行うに好適な輝度計としては、例えばフォトリサーチ社製のＰＲ７０４型があり、この装置により輝度を単位立体角あたりの光束の値を測定距離や測定面積に依存しない値として求めることができる。また、例えば上記ΔｔI＋ΔｔII分の動作周期といった所望の時間における輝度の積分値、その時間における輝度の変動、及び液晶表示素子の表示画面内の輝度分布を夫々測定することができる。なお、先述のコントラスト比は一般的には、「表示画面全体を白表示したときの輝度／表示画面全体を黒表示したときの輝度」の比で求められる。この一般的な手法に代えて、表示画面（画像を形成する画素）の一部を白表示させ（その画素部にこれらの光透過率を最大にする映像信号を送り）、かつ表示画面（画像を形成する画素）の他の一部を黒表示させる（その画素部にこれらの光透過率を最小にする映像信号を送る）テストパターンを液晶表示素子に表示し、白表示部の輝度と黒表示部の輝度とを算出し（この時算出する各表示領域サイズは同数とする）、その輝度比としてコントラスト比を求めてもよい。
【００５４】
観点１に基づく本発明の液晶表示装置への適用に際し、上述のように液晶表示装置での画像データ信号の書き換え周期（６０Ｈｚで１６．７ｍｓ、１２０Ｈｚで８．４ｍｓ）に対し、上記光源の動作周期をこの周期以下に設定する場合、これに用いられる液晶材料（液晶層）の応答時間をデータ信号の書換え周期（上記１６．７ｍｓ又は８．４ｍｓ）以下に抑えるよう、その材料の調合を行うことが望ましい。しかし、液晶材料の応答時間がデータ信号の書き換え周期に比べて著しく遅い場合は、ゴースト現象（多重輪郭）が発生する。このためデータ信号の書き換え周期と上述した光源の動作周期とのタイミングをずらす方が好ましい。
【００５５】
従って、図２に示した第１期間ΔｔIと第２期間ΔｔIIとからなる周期と表示画像信号の書き換え周期（図２における同期信号Ｖsyncの周期）との間に、所定の位相差を設定することにより、異ならせるとよい。
【００５６】
以上、本発明の実施の形態を説明したが、更なる詳細に関し、以下の実施例により説明を加える。
【００５７】
＜実施例１＞
本実施例では、図３に示すサイドライト型液晶表示装置を夫々の厚みが０．７ｍｍの一対のガラス基板３を用いて構成し、その一方の基板にはＴＦＴ駆動のための薄膜トランジスタを画素毎に形成した。この一対の基板３間に挟持される液晶層２は、誘電率異方性Δｎεが正で、Δｎｄは０．４１μｍとした。また、液晶層２に封入された液晶分子のツイスト角は９０度としたが、より液晶の応答速度を速くするためには７０度等の低ツイスト角化が望ましい。ツイスト角を抑える場合、これに適したΔｎｄはさらに小さくなるため（例えば、０．３５μｍ）、セルギャップを縮めることが必要である。
【００５８】
本実施例にて用いる光源ユニット１０は、図３（ｂ）の斜視図に示すような外径４ｍｍφの蛍光灯（冷陰極管）８を導光板１１の長辺方向に各１本、計２本配置した構造を有する。ここでは図に示さないが、輝度向上のための拡散シート、再帰偏光反射フィルムや、出射光の角度依存性を制御するレンズシートを配置してもよい。
【００５９】
本実施例では、上述の第１電流を１０ｍＡ、第２電流を０ｍＡとして、デュティ５０％で蛍光灯８に供給した。蛍光灯８の表面温度は、図７（ａ）に示すように時間とともに上昇する。一方、輝度は、図７（ａ）に示すように時間ととともに上昇し、その後一時的に減衰し、まもなく飽和した。この実施例では、デュティを６０％に設定した上述の観点３の例に比べて輝度の減衰は低い。
【００６０】
このようにデュティを５０％以下に設定すると、蛍光灯８の中央部の温度上昇が７０℃以下に抑えられ、また液晶表示素子（液晶表示パネル）の表示領域（有効表示領域）の輝度の最大値と最小値の差がその平均値の２０％以上となる。また、デュティを５０％以下に抑えても輝度の最大値を２００ｃｄ／ｍ２以上とすることができ、輝度の最小値を２ｃｄ／ｍ２以下に抑えることができる。
【００６１】
ところで、光源ユニットに用いられる蛍光灯のランプ直径は通常２．６ｍｍ程度であるが、ガラス肉厚を厚くした直径３ｍｍタイプや、さらに内径を太くしガス、水銀含有量を増した直径４ｍｍ以上のタイプの使用も可能である。一般にランプ直径を大きくすると、表面積が大きくなるため放熱に有利である。さらに点灯電圧の低下や、ランプ寿命（輝度半減値）の延長といった作用もある。また、直径（外径）２．６ｍｍの冷陰極管（蛍光灯）を用いた場合、その長さによらず管電流６ｍＡ以上印加すると発熱により、発光効率（輝度）が低下する。これに対し、本実施例では蛍光灯８の外径を大きくすることで、その発熱の影響を抑えた。このため、供給電流による蛍光灯内での放電効率も上がり、デュティを５０％に抑えても十分な輝度を得ることができた。
【００６２】
本実施例において、図８に示した調光回路により、光源の点灯周期における上記第１期間（点灯期間）又は上記第２期間（休止期間）の比率の変化、光源のランプを点灯させる印加電力の変化を設定し、あるいはこれらの設定を併わせて行ってもよい。点灯周期における調光（図９の輝度波形信号に示すように点灯期間あるいは休止期間の比率の変化による調光）では、上記点灯周期を点灯期間あるいは休止期間のいずれか一方のみに設定することも可能である。従って図９に示すように前記光源の点灯周期において、ランプを全点灯することなく、常に休止期間を設けることで発光効率を改善することもできる。また図１０のように高輝度を得るときのみ、ランプを点滅させてもよい。
【００６３】
尚、図９において、輝度高の範囲としては３００ｃｄ／ｍ２以上、輝度中の範囲としては、２００〜２５０ｃｄ／ｍ２を含む２００〜２９９ｃｄ／ｍ２、輝度低は１００ｃｄ／ｍ２を含む１９９ｃｄ／ｍ２以下と定義する。
【００６４】
＜実施例２＞
次に、この実施例では、動画表示に適した光源の変調点灯に関して説明する。
【００６５】
液晶表示装置においてブラウン管と同等の動画表示特性を得るためには、光源を常時点灯から、点灯と休止期間をそれぞれ有する点滅点灯にすることで、ＣＲＴのようなインパルス型発光が可能である。この時、図９の夫々に示すようにデータ書き換え周期（ここではVsyncの周期）は一定に保ち、点滅の周期を変えることもできる。
【００６６】
このようにして、点滅点灯する光源ユニットを用いる液晶表示装置においてもＣＲＴと同等のインパルス型発光が実現でき、動画表示が可能となる。従来の光源ユニットは、画像信号が明表示、暗表示によらず、蛍光灯が常に点灯（連続点灯）しているためエネルギー効率が悪かった。これに対し画像信号の情報量に合わせて、光源の照射量を制御することで、蛍光管の発光効率が向上し、消費電力の節約、ランプ温度の上昇抑制によるさらなる輝度向上を図ることが可能となる。すなわち、画像が暗い時には光源の照射量を減らし、画像が明るい時には照射量を増加させ、これにより輝度と階調特性の関係、いわゆるトーンカーブ特性も背景の明るさや、画像信号に合わせて制御することが可能となる。このように画像信号の明暗の情報によって、上記第１期間（点灯期間）と上記第２期間（第２電流を０ｍＡとする場合、休止期間）の時間比率を変えることで光源の照射光量を制御する。
【００６７】
また、画像信号の動きの情報量により点灯期間と休止期間の時間比率を変えることで、動きの速い場合は点灯時間を短くすることでより美しい動画表示が可能である。すなわち、映像信号の状態に合わせ、動きの遅い場合には液晶の応答速度の遅さは問題とならないため、入出力のフレーム周波数は一致させ、この出力フレーム周波数に対応させて前記光源の点灯期間と休止期間も出力フレーム周期で制御する（図１１(a)）。次に、上記に対し映像信号の動きが速い場合には、液晶の応答速度を改善（高速化）するために、入力フレーム周波数に対し出力フレーム周波数を２倍速化し、ダミーデータを挿入する。これに対応させて前記光源の点灯期間と休止期間も出力フレーム周期で制御する（図１１（ｂ））。
【００６８】
さらに、上記に対し映像信号の動きが速い場合には、入力フレーム周波数に対し出力フレーム周波数を３倍速化し、より多くのダミーデータを挿入することで応答速度を改善する。これに対応させて前記光源の点灯期間と休止期間も出力フレーム周期で制御する。（図１１（ｃ））
この時、前記光源の点灯期間と休止期間の比率によらず、各点灯周期間における該光源を発光させるためのランプに印加される電流実効値が概ね一定となるように制御するとよい。また、前記電流実効値を変化させることにより光源の照射光量を変化させることもできる。また、上記休止期間の輝度を図１２に示すように完全に０とするのではなく、ある一定の輝度とすることで、画面全体が高い輝度の場合であっても、十分な輝度を確保することができる。もちろん、休止期間の輝度を高める期間はある程度短くすることが望ましい。
【００６９】
さらに完全な動画表示を行うためには、光源ユニットをインパルス型発光するだけではなく、図１６に示すように画像信号のデータ走査タイミングと光源の点滅のタイミングを同期させる必要がある。一般に画像信号のデータ走査タイミングとして、垂直あるいは水平同期信号、フレーム信号、走査ライン信号等があり、これらの走査周期と点滅周期を等しくし、走査タイミングを同期させる。このような場合は直下型の光源ユニットの利用が望ましく効果が大きいが、サイドライト型の光源ユニットにおいても上下分割により可能である。
【００７０】
上下分割したサイドライト型では、前記光源における点灯期間と休止期間からなる周期が表示画像信号の書き換え周期と等しく、かつ前記表示装置の信号走査線がｎ本からなる時に、ｎ／２本目の信号走査の開始時間が該光源の点灯開始時間と同期させてもよい。すなわち画面の中央で画像信号と光源の点滅を同期させることで動画表示が可能となる。さらに前記光源における点灯期間と休止期間からなる周期と表示画像信号の書き換え周期とが等しく、かつ前記表示装置の信号走査線がｎ本からなる時に、ｎ＝１本目の信号周期の開始時間が該光源の点灯開始時間から一定時間遅延させてもよい。ここで、この遅延時間をｎ／２本目の信号走査の開始時間とした場合、前記方法と同じ結果となる。
【００７１】
また、前記光源の休止期間が点灯時間の１／２０以上、休止期間中の輝度が点灯時間中の輝度の９０％以下とすることが動画表示には有効である。
【００７２】
さらに美しい動画表示を得るには、対向配置された少なくとも一方が電極を有した一対の基板及び該基板間に挟持された液晶層からなる液晶パネルと、上記電極に表示画像信号に応じた電圧を印加するための制御手段と、液晶パネルを照射する光源が備えられた液晶表示装置であって、上記光源がランプとランプの出射光を反射する反射器と反射された光を液晶層に導く導光板からなり、該導光板の側面の少なくとも１辺の長さ方向にランプが配置され、該光源が点灯期間と休止期間からなる周期を有し、かつ該周期中の点灯期間と休止期間の時間比率と該光源を発光させるための電力値により、光源の照射光量を変化させることが必要である。この表示装置の光源ユニットはいわゆるサイドライト型と呼ばれ、使用するランプは厚み方向に１，２，あるいは３本配置する。また導光板の４辺のどの位置にランプを配置するかは表示装置の輝度、液晶セルの透過率によって決まる。
【００７３】
透過率が高いＴＮタイプ液晶などでは、導光板の長辺に１本のランプを配置するが、より高輝度を得るには長辺２辺に各１本、あるいは短辺に各１本配置してもよい、さらにランプは線状の直線タイプでなく、屈曲点を有するＬ字タイプやコの字タイプのランプでもよい。透過率の低いＩＰＳモードではランプを長辺２辺に各２ないし３本配置してもよい。
【００７４】
さらに対向配置された少なくとも一方が電極を有した一対の基板及び該基板間に挟持された液晶層からなる液晶パネルと、上記電極に表示画像信号に応じた電圧を印加するための制御手段と、液晶パネルを照射する光源が備えられた液晶表示装置であって、上記光源は液晶パネルの有効表示領域の直下に配置された複数のランプと各ランプの光を反射する複数の反射器とからなり、該光源が点灯期間と休止期間からなる周期を有し、かつ該周期中の点灯期間と休止期間の時間比率と該光源を発光させるための電力値により、光源の照射光量を変化させることも必要とする。この光源ユニットは直下型タイプであり、ランプ本数は長辺方向に４から１２本程度、あるいは短辺方向に４から２０本程度と輝度と画面サイズに応じて配置する。
【００７５】
光源ユニットにおいて、従来、ランプは液晶パネルの有効表示領域の外側に配置されてきた。これはランプの発熱により液晶セルが熱せられるのを防ぐためである。液晶は温度変化により屈折率の値が変化し、透過率が変化する性質を有する。そのため局所的に熱せられた場合、その部分透過率すなわち輝度や明るさが変化し、表示ムラとなる。しかし、本発明の光源ユニットは発熱が少ないためこのような表示ムラが起きにくく、光源におけるランプ配置を例えば直下型のように表示領域の内側にすることが可能であり、これにより表示装置の外形サイズ軽減も可能となる。
【００７６】
以上説明してきた光源ユニットにおいて使用するランプは、冷陰極蛍光灯、あるいは熱陰極蛍光灯、あるいはキセノンランプ、真空蛍光表示菅が使用可能である。冷陰極蛍光灯は発熱が少ないことが特徴であるが、より放熱を効果的に行うためにはランプ表面積を大きくする必要があり、前記光源のランプ直径を３ｍｍ以上にするとよい。また熱比重を大きくするため、前記光源のランプのガラス厚が１ｍｍ以上とするとより放熱が効果的である。光源のランプは直径を太くすることも可能であり、ランプ中の含有ガスをキセノンに置換えることも可能である。
【００７７】
以上の説明に基づき、本発明による液晶モジュールの具体的な構成を以下に示す。
【００７８】
図１３は、導光板１１の長辺２辺に対して蛍光灯８を各１本配置した光源ユニットの例である。図１３（ａ）はトランス１個でランプ１本を点灯するインバータ配置を示すが、これを図１３（ｂ）に示すようにトランス１個でランプ２本の点灯も可能である。この場合、部品数削減によりコストの節約となる。ここでインバータとは、ランプを点灯するための回路を総称しており、直流電圧を交流電圧への変換回路、電流制御回路、周波数偏重回路、トランスによる昇圧回路等を含む。またトランスの他に圧電素子の使用も可能である。
【００７９】
図１４は、液晶層２がΔｎｄ＝０．２８μｍであり且つツイスト角０度で平行配向され、基板面に平行な電界が印加される横電界モードの液晶表示素子を備える液晶パネルの一例を示したものである。図１４（ａ）にその液晶表示装置の断面図を示す。また、これに搭載される光源ユニット１０の斜視図を図１４（ｂ）に示す。光源ユニット１０は、冷陰極管として直径４ｍｍφを長辺方向に２本×２の計４本配置したサイドライト型の構造を有する。ここでインバータ配置は図１５に示すようにトランス１個で２本の蛍光灯８を点灯する構成が望ましい。
【００８０】
＜実施例３＞
この実施例では、動画表示に適した光源の点滅点灯の制御を動き量の検出に対応して行うシステムに関して説明する。
【００８１】
上記のように、液晶表示装置においてＣＲＴと同等の動画表示特性を得るためには、光源を常時点灯から、点灯期間と休止期間をそれぞれ有する点滅点灯にすることで、ＣＲＴのようなインパルス型発光が可能である。この点滅制御について以下、説明する。
【００８２】
まず、液晶表示装置の表示領域に対して、全領域を同時に点滅点灯させる場合について考える。ここでは、表示領域の長辺２辺に対し各１本の蛍光灯８を配置したサイドライト型の光源を用いたシステムを例にして説明する。図１７はサイドライト型の光源の制御回路の構成を示している。２０は液晶表示装置本体またはこれが搭載されるテレビジョン装置等から直流電源電圧を供給する入力端子であり、２３は光源に印加すべき電圧に応じた直流電圧に変換する調光回路であり、２１は交流電圧に変換するインバータ回路であり、２５は上記第１の期間（点灯期間）と上記第２の期間（第２電流を０ｍAとした時、休止期間）の時間比率を制御するスイッチング制御回路である。
【００８３】
上記のように、画像信号の動きの情報量により第１の点灯輝度（点灯期間）と第２の点灯輝度（本例では休止期間）の時間比率を変えることで、より美しい動画表示が可能となる。つまり、図１１のように動きの速い場合は点灯時間を短く、動きの少ない場合は点灯時間を長くしたり、また表示領域全面にわたり動く情報量（画素数）が多い場合は点灯時間を短く、動く情報量が少ない場合は点灯時間を長くしたりすることで、より美しい動画表示が可能となる。この時、前記光源の点灯期間と休止期間の比率に応じて、各点灯周期間における該光源を発光させるためのランプに印加される電流実効値を変化させることにより、光源の照射光量を変化させ、動画表示輝度レベルを安定することができる。例えば、動く画素数が表示データによる全表示領域画面を構成する画素数に占める割合に応じて、第１の点灯輝度と第２の点灯輝度の周期に占める第１の点灯輝度の期間を変化させる。例えば、動く画素数が表示データによる全画面を構成する画素数に占める割合が３フレームに渡って１０％以上であれば表示データは動画であると判断し、第１の点灯輝度の割合を５０％より小さくし、上記以外の場合には静止画と判断し、第１の点灯輝度の割合を５０％以上とする。
【００８４】
スイッチング制御回路２５の一例を図１８に示し説明する。図１８はスイッチング制御回路２５の構成を示しており、図中の５０は表示情報（Data）を１フレーム分格納し、次の１フレームで読み出しを行うデータ格納部（この場合、フレームメモリである）であり、５２は現フレームの表示データ（Data）とデータ格納部５０から読み出した前フレームの表示データ（Data'）を対応する画素毎に比較するデータ比較部である。５３はデータ比較部５２の出力を１表示領域分（１フレーム分）毎に取り込み光源点灯信号ＢＬの第１期間（点灯期間）の開始時間ｐｓ及び第１期間の時間ｐｗ（ｐｓ及びｐｗの単位はHsyncの１周期である水平期間とする）を生成するパルス制御部であり、５１は垂直同期信号Vsyncにより初期化し水平同期信号Hsyncをカウントするラインカウント部であり、５４はラインカウント部５１の出力するラインカウント値とパルス制御部５３の出力するｐｓ及びｐｗとにより光源点灯信号ＢＬを生成するパルス生成部である。ここで、データ比較部５２では、現フレームの表示データ（Data）とデータ格納部５０から読み出した前フレームの表示データ（Data'）を表示１画素（Dotckの１クロックに同期している）毎に比較しているが、この結果、両者が異なっている場合は、動画であると判断し、その表示１画素に対して動画判定信号を出力する。
【００８５】
パルス制御部５３では、データ比較部５２の該動画判定信号を表示領域の１画面分を加算し、その加算結果を段階的に切り分けることにより、該表示領域の動画像の動き情報量を判別し、第１期間の開始時間ｐｓ及び第１期間の時間ｐｗを設定する。隣接フレーム間のデータ比較において、実際に映像データを表示している全領域に対する一定割合以上（５０％以上）のデータが不一致の場合には動く情報量は多いと定義し、一定割合以下の場合には動く情報量は少ないと定義する。更に、データの一致／不一致の定義は、各画素の比較において、一定の階調データ以上（例えば全２５６階調の場合１２８階調以上）の場合に不一致と判断し、一定の階調データ以下の場合には一致と判断するようにする。以上のように構成するスイッチング制御回路２５により生成される光源点灯信号ＢＬのタイミング図を図１９に示す。図１９（ａ）はデータ比較部５２による比較の結果、ほとんど変化が無いと判断した場合（静止画像に近い表示、後述するように１フレーム前の画素と入力データの対応画素を比較し、不一致分が１０％以下）の光源点灯信号ＢＬであり、同図（ｂ）は動画像の少ない場合（１フレーム前の画素と入力データの対応画素を比較し、不一致分が１０％以上５０％未満）（（ａ）と比較した時、（ｂ）の方が動き情報量が多い）のＢＬであり、同図（ｃ）は動画像が多い場合（１フレーム前の画素と入力データの対応画素を比較し、不一致分が５０％以上）のＢＬである。
【００８６】
液晶の応答速度は遅く、一般的には１フレーム周期以上を要する。従って、図２０に示すように従来のホールド型による光源の常時点灯では、目的とする到達段階値に至るまで遷移階調が表示ボケとなって現れる。これを改善するために、前記光源のパルス幅及び、位相による点灯タイミングを到達すべき階調データに達したタイミングに合わせることで、遷移階調の表示を抑止することを可能とし、ボケの少ない良好な動画表示を可能とする。
【００８７】
また、前記データ格納部５０を複数フレーム分備えることで、隣接前後のフレームデータの比較に止まらず、複数フレーム期間に対する動画検出が可能となる。これにより動きの傾向を把握することができ、より忠実な動画判定を可能とする。
【００８８】
以上説明したスイッチング制御回路２５では、データ格納部５０としてフレームメモリを設け、任意フレーム分の表示データを格納することにより、任意フレーム分の表示データについてデータ比較を行い、該比較結果に応じて光源点灯信号ＢＬを生成した。しかし、液晶表示装置の表示領域拡大（ここでは、表示解像度を意味する）に伴い、データ格納部５０のメモリ容量が増大する。これによりスイッチング制御回路２５は、液晶表示領域が小さい場合には１チップの制御回路（ＬＳＩ）で実現できていたが、液晶表示領域が拡大するにつれてデータ格納部５０を外付けする２チップ以上の制御回路構成なり、制御回路のコスト面だけでなく基板部品実装の面からも問題となる。そこで、データ格納部５０を、上記のような表示領域全ての表示データを１フレーム分格納する方法ではなく、表示領域内において予めデータ比較画素（検出ポイント）を決定しておき、この画素の表示データのみを格納するレジスタ構成にしても良い。但し、比較を行う画素の総数は、制御回路の規模の制約から決定することになるが、フレームメモリを用いた場合とレジスタ構成とした場合とでほぼ同じ結果となるように決定する必要がある。ここで、データ比較を行うため画素（検出ポイント）の１例を図２１に示す。図２１（ａ）は検出ポイントを表示画面の表示領域に対し一様に設定した場合を示し、図２１（ｂ）は検出ポイントを画面中央に集中して設定した場合を示す。一様に分布させる図２１（ａ）の場合、実際に表示データを表示している全領域に対し、一定の割合となるようなポイント数（例えば一定の割合を１０％とした場合、実際に表示領域が水平１０２４画素、垂直７６８画素の全７８６４３２画素であれば、その１０％の７８６４３画素となる）を実際の表示領域に対し均等に分布させる。一方中央分布の図２１（ｂ）では、一定の割合のポイント数（７８６４３画素）を実際に表示領域中央部を周辺部より多く分布させることをいう。
【００８９】
近年のパーソナルコンピュータはウインドウシステムを採用しているＯＳ（Operating System）が主流となっており、画面上に複数のウインドウを表示することができる。そして、現在使用中のウインドウは画面中央に表示する場合が多いと考えられることから、図２１（ｂ）の検出ポイントの設定は有効となる。
【００９０】
さらに完全な動画表示を行うためには、光源ユニットをインパルス型発光するだけではなく、画像信号のデータ走査タイミングと光源の点滅のタイミングを同期させると良い。上記実施例では、画面の中央で画像信号のデータ走査タイミングと光源の点滅を同期させていたが、これに限らず、表示領域全体の画像情報に応じて、点灯開始時間を決定しても良い。これを実現するためのスイッチング制御回路２５の一例を図２２に示し説明する。
【００９１】
表示領域を複数の領域に分割し（例えば図２３に示すように４つの領域に分割）、どの領域に動画表示が多いかを判定するモード判定部５５を配置した以外、図１８で説明した回路と同様である。データ比較部５２では、現フレームの表示データ（Data）とデータ格納部５０から読み出した前フレームの表示データ（Data'）を表示１画素（Dotckの１クロックに同期している）毎に比較しているが、この結果、両者が異なっている場合は、動画であると判断し、その表示１画素に対して動画判定信号を出力する。モード判定部５５は、図２３に示すように表示画面を４つの領域に分け、各領域毎の動画判定信号を加算していき、この結果から最も動画判定信号が多い領域を指示するモード信号を出力する。次にパルス制御部５３では、該モード信号に従い、第１期間の開始時間ｐｓ及び第１期間の時間ｐｗを設定する。以上のように構成するスイッチング制御回路２５により生成される光源点灯信号ＢＬのタイミング図の一例を図２４に示す。図２７（ａ）は図３４に示す分割した表示領域の最上部Ｙ１が他の３領域と比較して最も動画表示が多いと判断したモードＹ１の時の光源点灯信号ＢＬを示している。つまり、この領域Ｙ１の表示データの書き込みが終了した直後（表示装置の信号走査線がｎ本からなる時に、ｎ／４本目の信号走査の開始時間）、第２の期間（休止期間）になるように、第１期間の開始時間ｐｓ及び第１期間の時間ｐｗを設定している。
【００９２】
以下同様に、図２７（ｂ）は第２の表示領域Ｙ２がモードの場合、図２７（ｃ）は第３の表示領域Ｙ３がモードの場合、図２７（ｄ）は第４の表示領域Ｙ４がモードの場合を示している。
【００９３】
次に、液晶表示装置の表示領域に対して、複数領域に分割して各々領域を個別に点滅点灯させる場合について考える。ここでは、直下型の光源を用いたシステムが容易に実現可能なことから、これを例にして説明する。図２５は直下型の光源の制御回路の構成を示している。蛍光灯８は４本とし、これを制御するインバータ２１は各々の蛍光灯８に対して計４ケ用意されている。２０は直流電源電圧を供給する入力端子であり、２３は光源に印加すべき電圧に応じた直流電圧に変換する調光回路であり、２５は上記第１の期間（点灯期間）と上記第２の期間（第２電流を０ｍAとした時、休止期間）の時間比率を制御するスイッチング制御回路である。このスイッチング制御回路２５は図２６に示す構成となっている。
【００９４】
直下型の光源を４本の蛍光灯８で構成したため、表示領域を図２３に示した時と同様に４つの領域に分割しており、各蛍光灯８の点滅点灯の制御を行うための光源点灯信号ＢＬ１〜ＢＬ４を生成し出力する。データ比較部５２では、現フレームの表示データ（Data）とデータ格納部５０から読み出した前フレームの表示データ（Data'）を表示１画素（Dotckの１クロックに同期している）毎に比較しているが、この結果、両者が異なっている場合は、動画であると判断し、その表示１画素に対して動画判定信号を出力する。モード判定部５５は、図２３に示すように表示画面を４つの領域に分け、各領域毎の動画判定信号を加算していき、この結果から動画判定信号が多い領域を指示するモード信号を出力する。このモード信号は単に動画判定信号が最も多い領域を一つ選び出して指示するだけでなく、表示によっては２つ以上を指示しても良い。また、２つ以上を指示する場合、この２つの領域は隣接領域、分散領域のいずれでも問題なく、前記モード判定部５５より出力する各領域毎の動画判定信号加算結果の大小関係より容易に制御することが可能である。
【００９５】
次にパルス制御部５３では、該モード信号に従い、各表示領域に対する光源点灯信号における第１期間の開始時間（ｐｓ１〜ｐｓ４）及び第１期間の時間（ｐｗ１〜ｐｗ４）を設定する。次にパルス生成部５４はラインカウント部５１の出力するラインカウント値とパルス制御部５３の出力するｐｓ１〜ｐｓ４及びｐｗ１〜ｐｗ４とにより光源点灯信号ＢＬ１〜ＢＬ４を生成する。以上のように構成するスイッチング制御回路２５により生成される光源点灯信号ＢＬ１〜ＢＬ４のタイミング図の一例を図２７に示す。図２７（ａ）は動画表示が少ない時（静止画像の場合も当然含まれる）や動画像がある程度あってもその総数の差が領域毎では検出できない（モード無し）場合のＢＬ１〜ＢＬ４を示す。モードが無いため、各々の領域毎に最適な設定を行う。つまり、領域Ｙ１においてはこの領域Ｙ１の表示データの書き込みが終了した直後（表示装置の信号走査線がｎ本からなる時に、ｎ／４本目の信号走査の開始時間）に第２の期間になるように、第１期間の開始時間ｐｓ１及び第１期間の時間ｐｗ１を設定し、光源点灯信号ＢＬ１を生成する。以下同様に、領域Ｙ２においてはこの領域Ｙ２の表示データの書き込みが終了した直後（表示装置の信号走査線がｎ本からなる時に、２ｎ／４本目の信号走査の開始時間）に第２の期間になるように、ｐｓ２及びｐｗ２を設定しＢＬ２を生成し、領域Ｙ３においてはこの領域Ｙ３の表示データの書き込みが終了した直後（表示装置の信号走査線がｎ本からなる時に、３ｎ／４本目の信号走査の開始時間）に第２の期間になるように、ｐｓ３及びｐｗ３を設定しＢＬ３を生成し、領域Ｙ４においてはこの領域Ｙ４の表示データの書き込みが終了した直後（表示装置の信号走査線がｎ本からなる時に、ｎ本目の信号走査の終了直後）に第２の期間になるように、ｐｓ４及びｐｗ４を設定しＢＬ４を生成する。図２７（ｂ）は動画判定信号が領域Ｙ１で最も多い場合（モードＹ１）のＢＬ１〜ＢＬ４を示す。領域Ｙ１の動画表示の最適化を図るため、これ以外の領域Ｙ２〜Ｙ４も領域Ｙ１に同期させて光源の点灯制御を行う。つまり、領域Ｙ１の表示データの書き込みが終了した直後（表示装置の信号走査線がｎ本からなる時に、ｎ／４本目の信号走査の開始時間）に第２の期間になるように、第１期間の開始時間ｐｓ１〜ｐｓ４及び第１期間の時間ｐｗ１〜ｐｗ４を同じ値に設定し、光源点灯信号ＢＬ１〜ＢＬ４を生成している。また図２７（ｃ）は動画判定信号が領域Ｙ１と領域Ｙ２で多い場合（モードＹ１、Ｙ２）のＢＬ１〜ＢＬ４を示す。領域Ｙ１及びＹ２の動画表示の最適化を図るため、この領域に対しては各々の最適設定を行い、これ以外の領域Ｙ３、Ｙ４も領域Ｙ１、Ｙ２に同期させて（ここでは、Ｙ１とＹ２の最適設定の平均値を取る）、光源の点灯制御を行う。つまり、領域Ｙ１においては領域Ｙ１の表示データの書き込みが終了した直後（表示装置の信号走査線がｎ本からなる時に、ｎ／４本目の信号走査の開始時間）に第２の期間になるように、ｐｓ１及びｐｗ１を設定し、光源点灯信号ＢＬ１を生成し、領域Ｙ２においてはこの領域Ｙ２の表示データの書き込みが終了した直後（表示装置の信号走査線がｎ本からなる時に、２ｎ／４本目の信号走査の開始時間）に第２の期間になるように、ｐｓ２及びｐｗ２を設定しＢＬ２を生成し、領域Ｙ３および領域Ｙ４は領域Ｙ２の中間行表示データの書き込みが終了した直後（表示装置の信号走査線がｎ本からなる時に、５ｎ／８本目の信号走査の開始時間）に第２の期間になるように、ｐｓ３、ｐｓ４及びｐｗ３、ｐｗ４を設定しＢＬ３、ＢＬ４を生成する。さらに図２７（ｄ）は動画判定信号が領域Ｙ１と領域Ｙ３で多い場合（モードＹ１、Ｙ３）のＢＬ１〜ＢＬ４を示す。領域Ｙ１及びＹ３の動画表示の最適化を図るため、この領域に対しては各々の最適設定を行い、これ以外の領域Ｙ２は領域Ｙ１に同期させ、また領域Ｙ４は領域Ｙ３に同期させ、光源の点灯制御を行う。つまり、領域Ｙ１及びＹ２においては領域Ｙ１の表示データの書き込みが終了した直後（表示装置の信号走査線がｎ本からなる時に、ｎ／４本目の信号走査の開始時間）に第２の期間になるように、ｐｓ１、ｐｓ２及びｐｗ１、ｐｗ２を設定し、光源点灯信号ＢＬ１、ＢＬ２を生成し、領域Ｙ３、領域Ｙ４においては領域Ｙ３の表示データの書き込みが終了した直後（表示装置の信号走査線がｎ本からなる時に、３ｎ／４本目の信号走査の開始時間）に第２の期間になるように、ｐｓ３、ｐｓ４及びｐｗ３、ｐｗ４を設定しＢＬ３、ＢＬ４を生成する。
【００９６】
尚、図２７に動画表示のモード判定結果に応じた光源点灯信号を示したが、これに限らず動画表示が最適になるように設定しても何ら問題はない。またここではモード判定でのみ制御する方法を述べたが、先の図１９でも述べたように動画像の総数に応じて各々の領域で第１期間の開始時間（ｐｓ１〜ｐｓ４）及び第１期間の時間（ｐｗ１〜ｐｗ４）を設定しても何ら問題はない。
【００９７】
次に表示画像の表示輝度に応じた光源点灯制御について述べる。
【００９８】
従来の光源ユニットは、画像信号が明表示、暗表示によらず、蛍光灯が常に点灯しているためエネルギー効率が悪かった。これに対し画像信号の情報量（輝度情報など）に合わせて、光源の照射量を制御することで、蛍光管の発光効率が向上し、消費電力の節約、ランプ温度の上昇抑制によるさらなる輝度向上が図れる。すなわち画像が暗い時には光源の照射量を減らし、画像が明るい時には照射量を増加させる。このように画像信号の明暗の情報によって、上記第１期間（点灯期間）と上記第２期間（第２電流を０ｍＡとする場合、休止期間）の時間比率を変えることで光源の照射光量を制御できる。図２８はこの点灯制御を行うためのスイッチング制御回路２５を示した図である。同図において、５６は入力する表示データから輝度情報を１フレーム分蓄積していき、表示領域の全面にわたる表示輝度（平均輝度）のレベルを検出する表示輝度検出部である。また５７は表示輝度検出部５６の結果を一定の期間保持するフレームラッチ部である。５３は、５７の出力である表示輝度検出結果に従い、各表示領域に対する光源点灯信号における第１期間の開始時間ｐｓ及び第１期間の時間ｐｗを設定するパルス制御部であり、５４はラインカウント部５１の出力するラインカウント値とパルス制御部５３の出力するｐｓ及びｐｗとにより光源点灯信号ＢＬを生成する。以上のように構成するスイッチング制御回路２５により生成される光源点灯信号ＢＬのタイミング図を図２９に示す。
【００９９】
図２９（ａ）は表示輝度検出部５６による結果、画面の平均輝度が高い（明るい）とした場合の光源点灯信号ＢＬであり、同図（ｂ）は画面の平均輝度が中間とした場合のＢＬであり、同図（ｃ）は平均輝度が低い（暗い）場合のＢＬである。尚、表示輝度が高い表示データと低い表示データが高速に切り替わった場合、これに同期して光源の照射光量も高速に切り替わると、この切り替わりが表示のちらつき（フリッカ）として可視されるため、問題となる。そこで、本制御回路では表示輝度情報保持部５７を設けることで、光源の照射光量の高速切り替わりを緩和させている。
【０１００】
また、液晶表示装置に表示する画像により、あるいはその利用者の都合により、本発明による光源の点滅点灯ではなく、通常の連続点灯で利用する場合がある。このため、上記スイッチング制御回路には外部から点灯メニュー選択信号を入力するセクションを設けることが望ましい。この一例を図３０に示す。図３０は点灯方式指示回路６０の構成を示す図であり、６１は表示画像信号に入力手段を判別する入力手段判別部であり、６２は利用者が上記した光源の点滅点灯を使用するか（メニュー選択）を決定する点灯選択部であり、６３は６１及び６２の出力結果により点滅点灯を可能にする点灯指示信号を出力する点灯指示信号生成部である。現在、液晶表示装置を搭載したディスプレイ装置として、液晶モニターや液晶テレビがあり、これら装置の表示画像信号の入力手段として、パーソナルコンピュータ用途のアナログＲＧＢ入力、ビデオモニター用途のコンポジット入力やＳ映像端子入力、ＤＶＤプレイヤー用途の色差入力、テレビ用途のアンテナ入力などがある。このため、入力手段判別部６１は、入力手段が何であるかをそれらの入力手段とディスプレイ装置との接続状態により判別する。点灯指示信号生成部６３は、入力手段判別部６１の結果、入力手段が例えばパーソナルコンピュータ用途のアナログＲＧＢ入力であったとすると、動画像が少ないと判断し光源の点滅点灯を行わないと指示する。一方、ビデオモニター用途やテレビ用途と判定した場合には、動画像が殆どであると判断し光源の点滅点灯を行うと指示する。尚、これらは自動設定されるとした場合、利用者はメニュー選択により、光源の点滅点灯を自由に選択できるものとする。
【０１０１】
＜実施例４＞
この実施例では、動画表示に適した階調制御及び、光源の点滅点灯の制御を入力映像データの階調特性検出に対応して行うシステムに関して説明する。なお、本実施例は発明者が、実際にその効果を確認するために８灯直下型バックライト搭載ＴＦＴモジュールを用いて試作した表示システムを一構成例として述べたものである。
【０１０２】
図３１は本発明による液晶表示モジュールの概略構成図である。
【０１０３】
図３１において、3101は液晶モジュール、3102は液晶駆動制御基板（以下、ＴＣＯＮ基板と称す）、3103はインバータ基板、3104はゲート用フラットケーブル（以下、ゲートＦＰＣと称す）、3105はドレイン用フラットケーブル（以下、ドレインＦＰＣと称す）、3106はインバータ制御用ケーブル（以下、インバータケーブルと称す）、3107はランプ高圧側ケーブル、3108はランプ低圧側ケーブルを各々示す。
【０１０４】
図３１に示すように、ＴＣＯＮ基板 3102、インバータ基板 3107は液晶モジュール 3101の背面に実装する。まず、システム側より映像信号、電源をＴＣＯＮ基板 3102に供給する。ＴＣＯＮ基板 3102は映像処理、タイミング処理などを行いゲートＦＰＣ 3104及び、ドレインＦＰＣ 3105を介して液晶モジュール 3101に映像信号及び、タイイング信号を出力する。同時に、インバータケーブル 3106を介してインバータ基板 3103を制御し、ランプ高圧側ケーブル 3107より供給する管電流量によりランプを点灯し、インバータ基板への戻り電流はランプ低圧側ケーブル 3108を介する。なお、本例ではランプは液晶モジュール背面に均等配置する直下型液晶モジュールについて示している。
【０１０５】
図３２は本発明による液晶表示モジュール背面に実装するＴＣＯＮ基板の概略構成図である。
【０１０６】
図３２において、3201は低電圧差動デジタル映像信号入力コネクタ部（以下、映像信号入力コネクタ部と称す）、3202は映像データ変換（低電圧差動→ＴＴＬ）ＬＳＩ１、3203はＦＰＧＡ論理データ設定コネクタ、3204はＦＰＧＡ論理データ設定ＲＯＭ、3205は液晶パネル制御ＦＰＧＡもしくはＬＳＩ、3206はＦＰＧＡ（もしくはＬＳＩ）3205の動作モード設定ＳＷ、3207はフレームメモリ、3208は発振器、3209は階調電圧制御用コンパレータ、3210はゲート信号用コネクタ、3211はドレイン信号用コネクタ、3212はドレイン信号用コネクタ、3213は映像データ変換（ＴＴＬ→低電圧差動）ＬＳＩ２、3214は低電圧差動デジタル映像信号出力コネクタ部（以下、映像信号出力コネクタ部と称す）、3215はＤ／Ａ変換コンバータ、3216はインバータ制御コネクタ部、3217は電源回路部を各々示す。
【０１０７】
まず、システムからの低電圧差動デジタル映像信号を映像信号入力コネクタ部 3201に入力する。入力された映像信号を、映像データ変換（低電圧差動→ＴＴＬ）ＬＳＩ１ 3202によりＴＴＬ形式の映像信号に変換する。変換後の映像信号はＦＰＧＡもしくはＬＳＩ 3205に入力する。ここでＦＰＧＡ搭載時には、予めＦＰＧＡ論理データ設定コネクタ 3203を介してＦＰＧＡ論理データ設定ＲＯＭ 3204に設定しておいた論理情報を、起動と同時に前記ＦＰＧＡ 3205に読み込む。ＬＳＩ搭載時にはＬＳＩ 3205には予め論理回路が内蔵されているため、前記ＦＰＧＡ論理データ設定コネクタ 3203及び、ＦＰＧＡ論理データ設定ＲＯＭ 204は不要となる（以下、本実施例ではＬＳＩを例に説明する）。前記ＬＳＩ 205の有する各種機能は動作モード設定ＳＷ 3206の設定により制御する。前記ＬＳＩ3205は外部にフレームメモリ 3207の接続を可能とする。このフレームメモリ 3207を用いることで入出力非同期な映像処理を可能とする。この場合、出力側（液晶表示側）映像処理には発振器 3208による独自クロックを利用することも可能である。前記ＬＳＩ 3205からは2系統の映像データ出力形式を有する。第1の系統は液晶パネル 3101に出力し、内蔵するドライバーＩＣを直接駆動するものである。この場合、前記ＬＳＩ 3205からの映像出力は、ドレイン信号用コネクタ 3211を介して液晶パネル 3101に出力する。同時に前記ＬＳＩ 3205はゲート信号をゲート信号用コネクタ 3210を介して液晶パネル 3101に出力する。この際、前記ドレイン信号用コネクタ 3211を介して出力される映像出力に対応する階調データと表示輝度の関係であるＶ−Ｂ特性は、階調電圧制御用コンパレータ 3209と、これに付随する抵抗値により決まる。また、液晶を交流駆動するための基準電圧となるコモン電圧は、コモン電圧調整ＶＲ 3212により調整する。第2の系統は、前記ＬＳＩ 3205より出力する映像データを、映像データ変換（ＴＴＬ→低電圧差動）ＬＳＩ２ 3213によって変換し、映像信号出力コネクタ部 3214を介して出力するものである。２つの映像信号形式において、第2の系統を搭載せず、第1の系統のみで表示可能なことは明白である。また、前記ＬＳＩ 3205はＤ／Ａコンバータ 3215を制御し、Ｄ／Ａコンバータ 3215の出力をインバータ制御コネクタ部 3216を介して前記インバータ基板 3103に与え、ランプの明るさ制御を行う。電源回路 3217は本ＴＣＯＮ基板 102内部で必要な電源電圧の生成を行い、一例として＋５Ｖの電圧を入力とし、ＤＣ−ＤＣコンバータにより、−４Ｖ、＋２．５Ｖ、＋３．３Ｖ、＋５Ｖ、＋１５Ｖ、＋２０Ｖの電源電圧を各々生成するものである。
【０１０８】
図３３は本発明によるＴＣＯＮ基板に搭載するＬＳＩの内部機能概略構成図である。
【０１０９】
図３３において、3301は低電圧差動デジタル映像信号、3302は前記映像データ変換（低電圧差動→ＴＴＬ）ＬＳＩ１ 3202によりＴＴＬ形式に変換したデジタル映像信号、3303は前記デジタル映像信号を前記ＬＳＩ 3205内部の基準タイミング変換するタイミング制御部、304は前記タイミング制御部 3303より出力されるＲ、Ｇ、Ｂ映像データ、3305は同じく前記タイミング制御部 3303より出力されるＬＳＩ内部の基準タイミング信号、3306はＲ、Ｇ、Ｂ映像データより輝度データを生成する輝度データ生成制御部、3307は前記輝度データ生成制御部 3306より出力される輝度データ、3308は前記輝度データ 3307を入力して1画面中の輝度分布状態を検出する輝度分布検出制御部、3309は前記輝度分布検出制御部 3308より出力される輝度分布データ、3310は前記Ｒ、Ｇ、Ｂ映像データ 3304、輝度分布データ 3309を入力として出力階調特性制御を行う折線ポイント階調制御部、3311は前記折線ポイント階調制御部 3310より出力される出力階調データ、3312は前記フレームメモリ 3207を制御するフレームメモリ制御部、3313は前記フレームメモリ制御部 3312により制御されるフレームメモリ・インターフェース信号、3314は前記フレームメモリ 3207から読み出したフレームメモリ・リードデータ、3315は前記出力階調データ 3311及び、フレームメモリ・リードデータ 3314の比較結果に従って前記出力階調データ 3311の補正値を制御するオーバードライブ制御部、3316は前記オーバードライブ制御 3315より出力される補正後の出力階調データ、3317は前記補正後の出力階調データ  3316より擬似的に階調数を増加させるＦＲＣ制御部、3318は前記ＦＲＣ制御部 3317より出力される擬似階調表示データ、3319は液晶モジュール 3101内のドライバーＩＣを直接駆動するためのドライバー・インターフェース制御部、3320は前記ドライバー・インターフェース制御部 3319より出力されるゲートドライバー制御信号、3321は同じく前記ドライバー・インターフェース制御部 3319より出力されるドレインドライバー制御信号、3322は前記映像データ変換（ＴＴＬ→低電圧差動）ＬＳＩ２ 3213より出力される低電圧差動映像信号、3323は前記輝度分布データ 3309を基準にバックライトの明るさを制御するバックライト調光制御部、3324は同じく前記輝度分布データ 3309及び、前記ＬＳＩ内部の基準タイミング信号 3305を基準にバックライトの点灯、非点灯期間を制御するブリンク制御部、3325は前記バックライト調光制御部 323より出力されるデジタル・バックライト調光信号、3326は前記ブリンク制御部 3324より出力されるバックライトＯＮ／ＯＦＦ信号、3327は前記Ｄ／Ａコンバータ 3215より出力されるアナログ・バックライト調光信号、328は前記インバータ制御コネクタ部 3216を介して前記インバータ基板に出力されるインバータ制御信号を各々示す。
【０１１０】
まず、低電圧差動デジタル映像信号 3301をＴＴＬ形式に変換したデジタル映像信号 3302はタイミング制御部 3303に入力され、遅延調整されたＲ、Ｇ、Ｂ映像データ 304及び、ＬＳＩ 3205内部の基準となる基準タイミング信号 3305を出力する。出力された前記Ｒ、Ｇ、Ｂ映像データ 3304は輝度データ生成制御部 3306及び、折線ポイント階調制御部 3310に入力する。輝度データ生成制御部 3306では入力された前記Ｒ、Ｇ、Ｂ映像データ 3304より輝度データ 3307を生成出力する。この輝度データは次段の輝度分布検出制御部 3308に入力され、ここでは１フレーム分の輝度データを累積した輝度分布データ 3309を出力する。輝度分布データ 3309は前記折線ポイント階調制御部 3310及び、バックライト調光制御部 3323に出力する。バックライト調光制御部 3323では、この輝度分布情報よりフレーム毎の映像データの特徴を判断し、良好な表示を得るためのデジタル・バックライト調光信号 325を出力する。この調光信号 3325はＤ／Ａコンバータ 3215に入力されアナログ・バックライト調光信号327に変換され、インバータ制御コネクタ部 3216に出力される。一方、バックライトのＯＮ／ＯＦＦ制御は前記基準タイミング信号 3305をブリンク制御部 3324が取り込んで、１フレーム期間中の点灯期間及び、非点灯期間を制御して、バックライトＯＮ／ＯＦＦ信号 3326として前記インバータ制御コネクタ部 3216に出力する。前記インバータ制御コネクタ部 3216からは前記アナログ・バックライト調光信号 3327及び、バックライトＯＮ／ＯＦＦ信号 3326を独立に前記インバータ制御基板 3103へ出力する。一方映像データ処理は、前記Ｒ、Ｇ、Ｂ映像データ 3304及び、輝度分布データ 3309を前記折線ポイント階調制御部 3310に入力する。折線ポイント階調制御部 3310では前記輝度分布データ 3309よりバックライト制御同様、フレーム毎の映像データの特徴を判断し、良好な表示を得るための階調特性（Ｖ−Ｂ特性）設定をフレーム毎に行う。階調制御された出力階調データ 3311は、オーバードライブ制御部 3315に入力されると共に、フレームメモリ制御部 3312を介して前記フレームメモリ 3207にフレームメモリ・インターフェース信号 3313として書き込まれる。前記フレームメモリ 3207に保持された階調データは、同じくフレームメモリ制御部 3312により読み出され、フレームメモリ・リードデータ 3314として前記オーバードライブ制御部 3315に入力する。ここで前記出力階調データ 3311は、前記フレームメモリ・リードデータ 3314に対し１フレーム後の階調データとなる。前記オーバードライブ制御部 3315では、これら隣接するフレーム間の階調データの差分を検出し、この差分から映像データの動き量を判断する。この動き量から応答速度や、輝度に最適な映像データ補正値を毎フレーム求め、前記出力階調データ 3311に対し補正を行う。これにより出力された補正後の出力階調データ 3316はＦＲＣ制御部 3317に入力される。ＦＲＣ制御部では、階調数の少ない液晶パネルにおいて擬似的に多階調表示を行うための擬似階調表示データ 3318を生成する。擬似階調表示データ 3318は、前記基準タイミング信号 3305と共にドライバー・インターフェース制御部 3319に入力され、ゲートドライバー制御信号 3320及び、ドレインドライバー制御信号 3321に変換後、前記ゲート信号用コネクタ 3210及び、ドレ��ン信号用コネクタ 3211を介して前記液晶パネル 3101に出力される。また、前記擬似階調表示データ 3318は第2の系統として直接ＬＳＩ 3205より出力され、前記映像データ変換（ＴＴＬ→低電圧差動）ＬＳＩ２ 3213を介して低電圧差動映像信号 3322として出力される。ここで、前記図３１に示す構成で表示可能な液晶モジュールを実現する場合には、前記第2の系統は不要である。
【０１１１】
【表１】
0003971892.tif 000002
【０１１２】
表1は前記動作モード設定ＳＷ 3206による前記図３３に示すＬＳＩ 3205に搭載する各種機能設定一覧の一例を示す。本例では前記バックライト制御部 3323、オーバードライブ制御部 3315、ＦＲＣ制御部 3317、ブリンク制御部 3324各機能の有効／無効設定、前期ブリンク制御部 3324有効時の１フレーム内点灯期間の比率設定、同じく点灯期間の１フレーム内における位相設定及び、前記オーバードライブ制御部 3315の液晶パネル毎に合わせた最適オーバードライブ特性設定について示したものである。このように前記ＬＳＩ 3205に搭載した各種機能は、各々独立に設定可能としたものである。
【０１１３】
【表２】
0003971892.tif 000003
【０１１４】
表２に前記映像データ変換（低電圧差動→ＴＴＬ）ＬＳＩ１ 3202及び、映像データ変換（ＴＴＬ→低電圧差動）ＬＳＩ２ 3213の入出力信号仕様を示す。映像データ変換（低電圧差動→ＴＴＬ）ＬＳＩ１ 202では入力がＬＶＤＳ映像信号、出力がＴＴＬ映像信号となり、映像データ変換（ＴＴＬ→低電圧差動）ＬＳＩ２ 3213ではその逆となる。ＴＴＬ映像信号はＲ、Ｇ、Ｂ各８ビット、有効表示期間信号、垂直同期信号、水平同期信号で構成する。ＬＶＤＳ映像信号は５対の低電圧差動信号で構成する。
【０１１５】
図３４に前記表２に示した信号仕様に対するタイミング図を示す。
【０１１６】
図３４において、クロックは単独で一対の低電圧差動信号(Y3+/Y3-)を構成し、その動作周波数は入力クロック(CLKIN)と同じである。その他4対の低電圧差動信号(Y0+/Y0-〜Y3+/Y3-)は前記入力クロック(CLKIN)周波数を７逓倍で駆動し、ＴＴＬ映像信号はＲ、Ｇ、Ｂ各８ビット、有効表示期間信号、垂直同期信号及び、水平同期信号を転送する。なお、前記映像データ変換（低電圧差動→ＴＴＬ）ＬＳＩ１ 3202としては、ＴＩ製”SN75LVDS84”、Thine製”THC63LVDF84”などが使用可能であり、映像データ変換（ＴＴＬ→低電圧差動）ＬＳＩ２ 3213としては同じく、ＴＩ製”SN75LVDS83”、Thine製”THC63LVDF83”などが使用可能である。
【０１１７】
図３５に前記フレームメモリ 3207に対する前記フレームメモリ制御部 3312の動作概略タイミング図を示す。フレームメモリとしては液晶パネルの解像度をＸＧＡサイズとした場合、１６Ｍビット品のＳＤ＿ＲＡＭを用いることが可能である。１６Ｍビット品のＳＤ＿ＲＡＭの構成は、５１２ｋ×１６ｂｉｔ×２バンクである。従ってデータバス幅は１６ｂｉｔであるため、Ｒ、Ｇ、Ｂ各８ｂｉｔの２４ｂｉｔ構成とした場合、書き込み、読出し用に各々２個、合計４個のメモリを用いる。Ｒ、Ｇ、Ｂを５−６−５ｂｉｔの１６ｂｉｔ構成とした場合、書き込み、読出し用に各々１個、合計２個のメモリを用いる。映像データ１水平期間をスタート部、内部、エンド部に分けコマンド制御を行う。アクセスはフルページのバーストモードを用い、コマンド設定後はクロックに同期して、画素毎の書き込み、読出し制御を連続で行う。水平スタート部はモード設定を行うＭＲＳ、ロウアドレス・ラッチ及びバンク・セレクトを行うＡＣＴＶ、リードもしくはライトを設定する・ＲＥＡＤ／ＷＲＩＴの順にコマンドを生成する。水平内部はロウアドレス・ラッチ及びバンク・セレクトを行うＡＣＴＶ、リードもしくはライトを設定する・ＲＥＡＤ／ＷＲＩＴ、アドレスで選択されるバンクのプリチャージ処理を行うＰＲＥの順にコマンドを生成する。水平エンド部はライトもしくはリードのフルページ・バースト処理を停止するＷＢＳＴ／ＲＢＳＴ、全てのバンクのプリチャージ処理を行うＰＡＬＬ、自動的にリフレッシュ動作を行うＲＥＦの順にコマンドを生成する。以上のコマンド生成により1水平期間の処理を行い、垂直方向については、表示有効期間信号が有効な期間同じ処理を繰返すことで１フレーム分の映像データ処理を行う。
【０１１８】
【表３】
0003971892.tif 000004
【０１１９】
表３に前記ゲートドライバー制御信号 3320、ドレインドライバー制御信号 3321の機能一覧を示す。ゲートドライバー制御信号 3320としてシフトデータ取り込み信号(FLM)及び、データシフトクロック(CL3)、ドレインドライバー制御信号 321として、データ（１ライン分）ラッチ及び出力信号(CL1)、データ取り込みクロック(CL2)、データ取り込みスタート信号(STH)及び、交流化信号(M)を各々有する。
【０１２０】
【表４】
0003971892.tif 000005
【０１２１】
表４及び、図３６に前記表３に示したドライバー・インターフェース・タイミング設定仕様の一例を示す。各インターフェース信号は、ＬＳＩ 3205内部の基準信号であるドットクロック(CK)、水平スタートパルス(HCLK)及び、水平表示有効期間信号(HDTMG)より生成する。
【０１２２】
【表５】
0003971892.tif 000006
【０１２３】
表５に前記デジタル・バックライト調光信号 3325の機能一覧を示す。デジタル・バックライト調光信号 3325はD/Aコンバータ制御クロック(DACLK)、D/Aコンバータ制御チップセレクト信号(DACSN)及び、D/Aコンバータ入力デジタルデータ(DADATA)を有する。この機能に合致したD/Aコンバータとして例えば、AD5300（アナログ・デバイス製）などが適用可能である。
【０１２４】
【表６】
0003971892.tif 000007
【０１２５】
表６及び、図３７に前記AD5300（アナログ・デバイス製）に適合したデジタル・バックライト調光信号タイミング仕様の一例を示す。D/Aコンバータ入力デジタルデータ(DADATA)は直列に転送し、先頭２ビット(D[15]-D[14])は不定、続く２ビット(D[13]-D[12])はモード設定、続く８ビット(D[11]-D[04])はデータ、残る４ビット(D[03]-D[00])は不定を意味する。ここで、(D[13]-D[12])のモード設定はノーマル動作の設定である“ａｌｌ０”、８ビット(D[11]-D[04])のデータは前記図３３において、輝度分布データ 3309に従ったバックライト調光制御部 3323からのデジタル・バックライト調光信号 325である。
【０１２６】
以上、図３１から図３７及び、表１から表６に示すように、本発明による液晶表示装置の制御回路は、機能の主を成すＬＳＩ、フレームメモリ、低電圧差動転送ＬＳＩ、Ｄ／Ａコンバータにより構成する。
【０１２７】
以下、前記ＬＳＩ 205に搭載した本発明の主目的である入力映像データに合わせた階調制御及び、バックライト制御機能について詳細に説明する。
【０１２８】
図３８は前記輝度データ生成制御部 3306の動作概念図を示す。
【０１２９】
図３８において、Ｒ，Ｇ，Ｂ映像データから輝度データ（Ｙ）を生成する場合の各色の割合は下式（数１）である。
【０１３０】
【数１】
輝度データ（Ｙ）＝０.２９９×Ｒ（赤）＋０.５８７×Ｇ（緑）＋０.１４４×Ｂ（青）
これをハードウェアで正確に処理することは回路規模の増大，処理速度低下などにより困難である。また，ここで生成された輝度データは，それ自身が表示データとなるものではなく，表示データの特性を得るためのものであることを考慮し，ハードウェアで実現可能なように近似処理を行う。画素単位での処理が必要なため，シフトと加算処理によりこれを実現することにした。図３８では，Ｒ，Ｇ，Ｂが各々８ビットのデジタル映像データであるとし，Ｒ色は各々２ビットと５ビット右方向にシフト（右方向に１ビットシフトすることで２での除算となり，ｎビットシフトすることで，２のｎ乗の除算となる）し，Ｇ色は各々１ビットと４ビット右方向にシフトし，Ｂ色は３ビットシフトし，各シフトデータを全て足し合わせることで上式（数１）に対する下記近似処理を可能とする。
【０１３１】
【数２】
輝度データ（Ｙ）＝０.２８１×Ｒ（赤）＋０.５６３×Ｇ（緑）＋０.１２５×Ｂ（青）
図３９は前記輝度分布検出制御部 308の概略構成図を示す。
図３９において，3901は1回の検出期間を設定する検出期間設定部，3902は入力全階調領域の分割数を設定する入力階調分割数設定部，3903は入力映像データが前記入力階調分割数設定部 3902で設定した各分割領域のいずれに該当するかを検出する入力映像データ階調領域検出部，3904は階調の最も低い領域のデータをカウントする第１階調領域カウンタ，3905は同じく２番目に低い領域のデータをカウントする第２階調領域カウンタ，3906は同じく最も高い領域のデータをカウントする第ｎ階調領域カウンタ，3907は1回の検出期間において階調の最も低い領域のデータ総数を保持する第1データホールドラッチ，3908は同じく２番目の領域のデータ総数を保持する第2データホールドラッチ，3909は同じく最も高い領域のデータ総数を保持する第ｎデータホールドラッチ，3910は前記第1階調領域カウンタ 3904のカウント値をｍ倍するｍ倍乗算回路，3911は同じく前記第２階調領域カウンタ 3905のカウント値を２＊ｍ倍する２＊ｍ倍乗算回路，3912は同じく前記第ｎ階調領域カウンタ 3906のカウント値をｎ＊ｍ倍するｎ＊ｍ倍乗算回路，3913は前記各乗算回路の出力データを加算する加算回路，3914は前記加算回路 3913の出力をｎ＊ｍで除算するｎ＊ｍ除算回路，3915は前記除算回路 3914の出力を平均輝度値として保持する平均輝度データ・ホールドラッチを各々示す。
【０１３２】
まず，検出期間設定部 3901に1回の検出期間を設定する。本設定部の出力は各検出機能部の最終段データ・ホールドラッチ用のラッチクロックとなる。また、入力階調分割数設定部 3902に入力全領域に対する分割数を設定する。ここでは一例として入力全領域を２５６階調（８ビット），分割数を８分割に設定するものとする。本設定部からの出力は入力映像データ階調領域検出部 3903に入力する。ここでは入力映像データの階調値が，前記入力階調分割数設定部 3902からの分割領域のいずれに該当するかを判断し，その領域に対応する領域カウンタ用クロックを出力する。ここで，各領域の階調範囲は入力全階調領域が２５６階調，分割数が８であることより３２階調毎の領域となる。従って，入力映像信号の特性検出精度を向上するためには，分割数を大きくし，各分割領域の階調数を少なくすればいいが，精度を向上することは回路の増大にもなるので，用途によって精度を変更できるようにした。前記入力映像データ階調領域検出部 3903からのクロックにより第1階調領域カウンタ 3904，第２階調領域カウンタ 3905及び，第ｎ階調領域カウンタ 3906で各階調領域毎のデータ数をカウントし，前記検出期間設定部 3901による設定期間の間，第1データ・ホールドラッチ 3907，第２データ・ホールドラッチ 3908及び，第ｎデータ・ホールドラッチ 3909で輝度分布データとして保持することで輝度分布の検出を行う。輝度平均値の検出は，前記第1階調領域カウンタ 3904，第２階調領域カウンタ 3905及び，第ｎ階調領域カウンタ 3906の各出力を各々，ｍ倍乗算回路 3910，２＊ｍ倍乗算回路 3911，ｎ＊ｍ倍乗算回路 3912で乗算し，各出力を加算回路 3913で加算，その出力をｎ＊ｍ除算回路 3914で除算し，その出力を前記検出期間設定部 3901による設定期間の間，平均輝度データ・ホールドラッチ 3915で平均輝度データとして保持することで平均輝度の検出を行う。ここでｍは各分割領域内の階調数を意味し，本例では３２となる。従って，各乗算回路  3910-3912及び，加算回路  3913を１６ビット構成とすれば，除算回路 3914はｎ＊ｍ＝８＊３２＝２５６での除算となり，これは右方向８ビットのシフト処理（上位８ビットを選択）という簡易論理で実現できる。
【０１３３】
図４０に前記図３９に示す輝度分布検出制御部概略構成図中の輝度分布検出部の動作を示す状態遷移図で示す。図４０では前記図３９での説明の一例として用いた入力全領域を２５６階調（８ビット），分割数を８分割に設定及び、入力映像データの解像度としてＸＧＡ（１０２４ドット×７６８ライン）とした場合について示す。
【０１３４】
図４０において、検出期間設定部 901は垂直同期信号(inVsync)及び、表示有効期間信号(inDtmg)より構成され、有効な表示データは表示有効期間信号(inDtmg)が有効時のもとし、輝度分布結果は１フレーム毎に更新するため垂直同期信号(inVsync)のタイミングで更新する。各領域の輝度データ数を累積するカウンタ(elemCntr)は分割領域が８分割であるため８個用意し(elemCntr00〜elemCntr07)、８ビット階調データの上位３ビットをデコードした結果に対応したカウンタの値を加算する。累積した１フレーム分の輝度分布結果は、垂直同期信号(inVsync)のタイミングで更新する(hist00-hist07)。ここで各カウンタの規模は同一階調データが１フレーム分存在することを想定したものにする必要がある。すなわち本例ではＸＧＡ解像度であるため１０２４×７６８＝７８６４３２画素、すなわち２０ビットのカウンタが必要となる。
【０１３５】
図４１に前記図３９、図４０による輝度分布検出制御部による輝度分布検出結果概略図及び、検出結果からの輝度平均値算出演算式を示す。
【０１３６】
図４１に示すように、輝度分布状態により映像データのフレーム毎濃淡状態また、輝度平均値によりフレーム毎の画面明るさを抽出することができる。
【０１３７】
図４２に前記図４０に示した入力全領域を２５６階調（８ビット），分割数を８分割に設定した状態遷移図の別な一例として、入力全領域を２５６階調（８ビット）、分割数を２０分割に設定し、下位側及び、上位側各8分割領域の階調領域は8階調毎の分割、中間階調の４分割領域は３２階調毎の分割に設定した際の状態遷移図を示す。
【０１３８】
図４２において、各領域の輝度データ数を累積するカウンタ(elemCntr)は分割領域が２０分割であるため２０個用意し(elemCntr00〜elemCntr19)、下位側及び、上位側各8分割領域の階調領域は、８ビット階調データの上位５ビットをデコードした結果に対応したカウンタの値を加算する(elemCntr00〜elemCntr07、elemCntr12〜elemCntr19)。中間階調の４分割領域は、８ビット階調データの上位３ビットをデコードした結果に対応したカウンタの値を加算する(elemCntr08〜elemCntr11)。その他の制御については、前記図４０に示した８分割領域の場合と同様に、累積した１フレーム分の輝度分布結果は、垂直同期信号(inVsync)のタイミングで更新する(hist00-hist19)。また、各カウンタの規模は前記同様、同一階調データが１フレーム分存在することを想定したものにする必要がある。すなわち本例ではＸＧＡ解像度であるため１０２４×７６８＝７８６４３２画素、すなわち２０ビットのカウンタが必要となる。
【０１３９】
図４３に前記図４２による階調分割制御を行った場合の輝度分布検出結果概略図及び、検出結果からの輝度平均値算出演算式を示す。
【０１４０】
図４３に示すように、前記図４１に示した８分割した場合に比べ、輝度分布状態において下位及び、上位階調部分の分布状態をより詳細に検出することができる。また、輝度平均値については前記図４１に示した８分割した場合同様フレーム毎の画面明るさを抽出することができる。
【０１４１】
図４４に前記図４０及び図４２に示した階調領域を８分割化した際の輝度分布検出結果を用いた前記折線ポイント階調制御部 3310による階調制御の一例を示す。
【０１４２】
図４４において、折線ポイント方式による階調制御では、９箇所の折れ線ポイントをフレーム毎に設定し、隣接ポイント間は直線化した演算式に従って、ドットクロック毎に入力される入力階調データを出力階調データに変換することでリアルタイムに実現する。ここで隣接ポイント間の直線化演算式は均等な８分割領域の場合、下記数３の演算式を用いることができる。
【０１４３】
【数３】
出力階調データ＝（ｒｋｉｎｊｉ（ｎ）−ｒｋｉｎｊｉ（ｎ−１））×Ｍ／３２
ｒｋｉｎｊｉ（ｎ）：上位側折線ポイント設定値
ｒｋｉｎｊｉ（ｎ−１）：下位側折線ポイント設定値
Ｍ：入力階調データ下位５ビット
従って、前記図４１に示す輝度分布データを反映させて高画質化する例として、各領域の輝度分布累積数に対応して、折線ポイントを設定する。従って、１フレーム内の輝度分布数平均値ｍ（本例の場合、１フレーム分の画素数を分割領域数８で除算した値）に対し、検出した各領域の分布数が多い場合にはその階調領域の分布は平均値以上であると判断し、上位側折線ポイントをリニア特性時（図中○のポイント）に比べ大きくする。これにより、その階調領域のダイナミックレンジが大きくなり良好な画質を得ることができる。逆に平均値ｍに対し、検出した各領域の分布数が少ない場合にはその階調領域の分布は平均値以下であると判断し、上位側折線ポイントをリニア特性時（図中○のポイント）に比べ小さくする。これによりその階調領域のダイナミックレンジは小さくなるが、これにより前記平均値ｍを上回った階調領域のダイナミックレンジを大きくできるため、画面全体としては分布の大勢を占める領域のコントラストを向上し、良好な画質を得ることができる。
【０１４４】
図４５に前記図４４に示した階調領域を８分割化した際の輝度分布検出結果を用いた前記折線ポイント階調制御部 3310による階調制御部概略構成図を示す。
【０１４５】
4501は入力映像データのラッチ回路１、4502はラッチ回路１ 4501の出力映像データの内上位３ビットによる１ｔｏ８デコーダ回路、1503は上位階調側折線ポイント設定レジスタ・セレクタ回路、4504は下位階調側折線ポイント設定レジスタ・セレクタ回路、4505は前記上位階調側折線ポイント設定レジスタ・セレクタ回路 4503選択値から、下位階調側折線ポイント設定レジスタ・セレクタ回路 4504選択値を減算する減算回路、4506は前記減算回路 4505の出力結果と前記ラッチ回路１ 4501の出力をラッチ回路２〜５ 4508〜4511を用いて遅延した値を乗算する乗算回路、4507は前記乗算回路 4506の出力結果と、前記下位階調側折線ポイント設定レジスタ・セレクタ回路 4504の出力をラッチ回路６、７ 4512、4513を用いて遅延した値を加算する加算回路を各々示す。
【０１４６】
図４５に示す制御回路は前記図４４に示す各折線ポイント間の直線式を実現するものであり、前記上位階調側折線ポイント設定レジスタ・セレクタ回路 4503及び、下位階調側折線ポイント設定レジスタ・セレクタ回路 4504には、輝度分布状態に対応した折線ポイント設定値(rkinji00〜rkinji08)を毎フレーム更新しながら設定する。従って、画素毎の映像データ(ridata[7:0])が入力されると、隣接する２つの折線ポイント設定値を選択し、選択した２つの階調間を演算して映像データ(rodata[7:0])を出力する。入力映像データ(ridata[7:0])が与えられてから、出力映像データ(rodata[7:0])を得るまでの遅延は８クロックである。従って本制御によれば、フレーム毎の映像データの特徴に合わせて最適は階調制御を行うことを可能としている。
【０１４７】
図４６に前記図４３に示した階調領域を２０分割化した際の輝度分布検出結果を用いた前記折線ポイント階調制御部 3310による階調制御の一例を示す。
【０１４８】
図４６において、折線ポイント方式による階調制御では、２０箇所の折れ線ポイントをフレーム毎に設定し、隣接ポイント間は直線化した演算式に従って、ドットクロック毎に入力される入力階調データを出力階調データに変換することでリアルタイムに実現する。ここで隣接ポイント間の直線化演算式は均等な下位及び、上位階調部分である８階調毎分割領域(hist00-hist08、hist12-hist19)の場合と、中間階調部分である３２階調毎分割領域(hist08-hist11)の場合で異なり、各々下記数４、数５の演算式を用いることができる。
【０１４９】
【数４】
出力階調データ＝（ｒｋｉｎｊｉ（ｎ）−ｒｋｉｎｊｉ（ｎ−１））×Ｍ／８
ｒｋｉｎｊｉ（ｎ）：上位側折線ポイント設定値
ｒｋｉｎｊｉ（ｎ−１）：下位側折線ポイント設定値
Ｍ：入力階調データ下位３ビット
【０１５０】
【数５】
出力階調データ＝（ｒｋｉｎｊｉ（ｎ）−ｒｋｉｎｊｉ（ｎ−１））×Ｍ／３２ｒｋｉｎｊｉ（ｎ）：上位側折線ポイント設定値
ｒｋｉｎｊｉ（ｎ−１）：下位側折線ポイント設定値
Ｍ：入力階調データ下位５ビット
従って、前記図４３に示す輝度分布データを反映させて高画質化する例として、2段階の制御を施すことで実現することができる。第1段階は８階調毎に分割した下位及び、上位階調領域に対し、各々外側の領域（下位階調であればhist00、上位階調であればhist19）、よりフレーム毎の使用頻度を確認し、潰せる階調領域を求める。すなわち、予め設定しておいた階調累積数の閾値と各階調領域の外側より累積値を比較し、閾値を越えた領域までの階調を潰すようにする。図４６では下位階調領域はhist04が閾値ｎを越えているため、これ以前の階調は分布頻度が少ないと判断し、下位から5個の折線ポイント(rkinji00-rkinji04)を“０階調”に設定する。同様に、上位階調領域はhist17が閾値ｎを越えているため、これ以前の階調は分布頻度が少ないと判断し、上位から４個の折線ポイント(rkinji17-rkinji20)を“２５５階調”に設定する。この第1段階の階調制御により階調両端の累積数の少ない部分を潰す代わりに、残りの階調領域のダイナミックレンジを拡大することが可能である。また、潰す階調領域の判断基準として本例では各階調領域独立に閾値ｎとの比較を行ったが、両端の階調領域からの累積と閾値ｎとの比較というように、階調を潰すアルゴリズムはソフトウェア処理との組合せにより多種多様に対応可能である。第２段階は、第１段階で全階調領域のダイナミックレンジを拡大したのに加え、前記図４４で述べた分布領域毎に輝度分布平均値ｍとの比較を行い、比較結果が大きい場合にはその階調領域のダイナミックレンジがさらに拡大するよう上位側の折線ポイント設定値をリニア特性時の値（図中○のポイント）より大きな値、また、比較結果が小さい場合にはその階調領域のダイナミックレンジが縮小するようリニア特性時の値より小さな値を設定するようにする。図４６はこれを中間階調領域である３２階調分割領域(rkinji09-rkinji12)に適用した一例である。図４６では第1段階によるダイナミックレンジの拡大制御領域をヒストグラム伸長制御領域、第２段階によるダイナミックレンジの拡大制御領域をイコライズ制御領域として示してある。
【０１５１】
また、題段階によるダイナミックレンジの拡大適用範囲は、中間階調領域である３２階調分割領域(rkinji09-rkinji12)に限らず、下位、上位階調領域である８階調分割領域に適用しても良い（図４６では(rkinji04-rkinji17)）。
【０１５２】
以上、前記図４６に示した階調制御方式では、前記図４４に示した階調制御方式をカバーした上で更にダイナミックレンジを拡張した良好な表示を得ることができる。
【０１５３】
図４７は前記図４６に示した階調領域を２０分割化した際の輝度分布検出結果を用いた前記折線ポイント階調制御部 3310による階調制御部概略構成図を示す。
【０１５４】
4701は入力映像データのラッチ回路１、4702はラッチ回路１ 4701の出力映像データの内上位３ビットによる１ｔｏ８デコーダ回路、4703は下位階調、中間階調、上位階調の各分割領域に対する上位階調側折線ポイント設定レジスタ・セレクタ回路、4704は下位階調、中間階調、上位階調の各分割領域に対する下位階調側折線ポイント設定レジスタ・セレクタ回路、4705は前記３つの領域に分かれた下位階調、中間階調、上位階調の各分割領域に対する上位階調側折線ポイント設定レジスタ・セレクタ回路 1703出力のうち１つを選択する３ｔｏ１セレクタ回路、4706は同じく前記３つの領域に分かれた下位階調、中間階調、上位階調の各分割領域に対する下位階調側折線ポイント設定レジスタ・セレクタ回路 4704出力のうち１つを選択する３ｔｏ１セレクタ回路、4707は前記上位階調側３ｔｏ１セレクタ回路 4705選択値から、下位階調側３ｔｏ１セレクタ回路 4706選択値を減算する減算回路、4708は前記減算回路 4707の出力結果と前記ラッチ回路１ 4701の出力をラッチ回路２〜６ 4711〜4714を用いて遅延した値を乗算する下位、上位階調と中間階調の２系統に分かれた乗算回路、4709は前記２系統の乗算回路 4708の出力結果のいずれかを選択する２ｔｏ１セレクタ回路、4710は前記２ｔｏ１セレクタ回路 4709の出力と、前記下位階調側３ｔｏ１セレクタ回路 4706の出力をラッチ回路７〜９ 4716〜4718を用いて遅延した値を加算する加算回路を各々示す。
【０１５５】
図４７に示す制御回路は前記図４５に示す制御回路同様、前記図４６に示す各折線ポイント間の直線式を実現するものであり、前記上位階調側折線ポイント設定レジスタ・セレクタ回路 4703及び、下位階調側折線ポイント設定レジスタ・セレクタ回路 4704には、輝度分布状態に対応した折線ポイント設定値(rkinji00〜rkinji20)を毎フレーム更新しながら設定する。従って、画素毎の映像データ(ridata[7:0])が入力されると、隣接する２つの折線ポイント設定値を選択し、選択した２つの階調間を演算して映像データ(rodata[7:0])を出力する。入力映像データ(ridata[7:0])が与えられてから、出力映像データ(rodata[7:0])を得るまでの遅延は１０クロックである。従って本制御においても、フレーム毎の映像データの特徴に合わせて最適は階調制御を行うことを可能としている。
【０１５６】
次に、前記図３３に示したデジタル・バックライト調光信号 3325及び、バックライトＯＮ／ＯＦＦ信号 3326制御による輝度制御及び、動画ぼけ改善制御について説明する。
【０１５７】
図４８は前記インバータ基板 103における調光特性図の一例である。入力として電圧を０Ｖ〜３．３Ｖまで可変し、これに対応して出力パルスのデユーティ比が変化するものである。すなわち入力電圧が低い程パルス幅デューティ比は大きくなり、逆に入力電圧が高い程パルス幅デューティは小さくなる。このデユーティ比はバックライトのＯＮ／ＯＦＦに対応しているため、電圧レベルが低い程明るく、逆に電圧レベルが高い程暗くなる。従って、前記バックライト調光制御部 3323からのデジタル・バックライト調光信号 3325を前記表５、６及び図３７に示した形式で制御し、前記Ｄ／Ａコンバータ 3215に与えることで、Ｄ／Ａコンバータ 3215から出力されるアナログ・バックライト調光信号 3327により、前記図４８に示したインバータ基板の特性で調光制御を行う。
【０１５８】
図４９に前記バックライト調光制御部 3323及び、ブリンク制御部 3324による輝度制御及び、動画ぼけ改善制御の一例を示す。本例では調光制御と、ブリンク制御を独立した制御信号で行う場合について示したものである。
【０１５９】
図４９では、連続する各フレーム映像データは前記輝度分布検出制御部 3308からの輝度分布データが、明るい映像→明るい映像→暗い映像の順に転送される場合である。
【０１６０】
一般に液晶表示装置で動画を表示する場合、明るい映像であれば１フレームを越える応答速度に伴う動画ぼけ現象は、暗い映像の場合に比べ気にならなくなる。逆に明るい映像に対し動画ぼけを考慮してブリンク・パルス幅を小さくすることで、暗い映像となることが主観的には気になるものである。従って、明るい映像に対しては前記アナログ・バックライト調光信号 3327の電圧レベルを低くして、バックライトに対する調光波形のパルス幅デューティ比を大きくする。逆に暗い映像に対しては、前記アナログ・バックライト調光信号 3327の電圧レベルを高くして、バックライトに対する調光波形のパルス幅デューティ比を小さくする。また、本制御は輝度分布データを検出した次のフレームに対し反映させる。図４９では輝度分布検出データと、調光波形の関係がこれを示す。さらに、応答速度に１フレーム以上の時間を要することによる動画ぼけ現象を改善するためにブリンク制御を行う。図４９では、表示画面の下画面部分に照準を合わせ、１フレームの後半にブリンク波形がＯＮするように制御する。すなわち、図４９において１フレーム期間に要する時間を“ａ”とし、１フレームの後半にブリンク波形をＯＮする時間を“ｂ”とした際のブリンク波形デユーティ比は“ｂ：ａ”となり、この比は固定とする。本制御には前記図３３のブリンク制御部 3324において、タイミング制御部 3303からの垂直基準タイミング信号 3305を用いて制御する。実際のバックライトＯＮ／ＯＦＦ波形は、前記調光制御のための調光波形と、動画ぼけ改善制御のためのブリンク波形を合わせた波形となり、これによる液晶輝度波形は図４９の斜線部分になる。これより、輝度分布検出データが明るい映像と判断した場合には、輝度波形の発光時間は長くなり（逆に、輝度分布検出データが暗い映像と判断した場合には、輝度波形の発光時間は短くなり）かつ、液晶応答波形の定常タイミングでの発光（過渡タイミングでは発光せず）となるため、動画ぼけのない良好な表示状態を得ることができる。
【０１６１】
図５０に前記図４９に示す一例において、輝度分布検出データによる映像判定の一例を示す。図５０において輝度分布検出データとしては、前記図４１に示した全階調領域を均等8分割、入力映像データの解像度としてＸＧＡ(1024×768)とした場合を示す。この場合、１フレーム分の画素数は下式（数６）となる。
【０１６２】
【数６】
１フレーム総画素数＝１０２４ドット×７６８ライン
＝７８６４３２＝Ｃ００００ｈ
ここで回路規模を抑えるために、検出データの上位のみを用いて判定を行う。図５０の場合、上位８ビットを用いる。上位８ビットは１６進数で“Ｃ０ｈ”であり、１０進数では“１９２”となる。従って、均等に８分割した際の各領域平均ポイント数は２４ポイントとなる。本例では図５０に示すように映像判定条件として、ｅ、ｆ、ｇ、ｈの各階調領域(128-159、160-191、192-223、224-255階調)のポイント数がそれぞれ、４８、４０、３２、２４ポイントのいずれかより大きい場合に明るい映像と判断し、上記以外の場合を全て暗い映像と判断するようにした。
【０１６３】
図５１に前記図５０に示した映像判定条件例に従った、調光制御状態遷移図の一例を示す。
【０１６４】
図５１において調光範囲は本例の場合、最大輝度から最大輝度に対して８５％の輝度を最小輝度とした範囲で制御するものとする。この間を前記図５０に示した映像判定条件に従って毎フレーム遷移する。最大輝度から最小輝度もしくは、最小輝度から最大輝度までの遷移時間は最小４０フレーム（１フレーム６０Ｈｚの場合、約０.６７秒）要するようにした。これは、明るい映像と暗い映像が毎フレーム交互に入力されるような場合、１フレームで最大〜最小輝度間を遷移するような制御とするとフリッカーが発生するため、これを抑止するためである。従って、遷移途中で映像判定条件が反転した場合、その時点で遷移は逆方向に向かうことになる。
【０１６５】
以上、前記図５０、５１で説明した調光制御アルゴリズムに従って、前記図４９に示した調光波形の制御を行う。
【０１６６】
図５２に前記図４９に示した前記バックライト調光制御部 3323及び、ブリンク制御部 3324による輝度制御及び、動画ぼけ改善制御例とは別の一例を示す。
【０１６７】
前記図４９に示す一例では、最終的な液晶輝度波形は前記バックライト調光制御部 3323による調光波形と、前記ブリンク制御部 3324によるブリンク波形を重ね合わせたものとなっていた。これに対し本例では、前記バックライト調光制御部 3323による調光波形の制御は行わず、常時最大輝度状態としておき、前記ブリンク制御部 3324によって、輝度-分布検出データに対応した調光制御をブリンク制御と合わせて行うものである。すなわち、前記バックライト調光制御部 3323からの制御信号は、前記図４８に示したインバータ基板 3103における調光特性図より、常時出力パルスデューティが１００％となるように制御する。次に前記ブリンク制御部 3324は動画ぼけの改善例として、表示画面の下画面部分に照準を合わせ、１フレームの後半にブリンク波形がＯＮするように制御する。さらに輝度分布検出データの状態に対応して、前記ブリンク波形のパルス幅を変更する。図５２の例では映像データが、“明るい映像→暗い映像→明るい映像”の順に入力されるため、明るい映像に対しては次のフレームで前記ブリンク波形のパルス幅を大きくし、暗い映像に対しては次のフレームで前記ブリンク波形のパルス幅を小さくするようにした。更に図５２に示した一例ではブリンクパルス幅デューティの変更を、パルスの後縁は固定し、前縁で行うようにしたものである。従って、１フレーム期間に要する時間を“ａ”とし、１フレームの後半にブリンク波形をＯＮする時間を“ｂ”とした際のブリンク波形デユーティ比は“ｂ：ａ”となり、この比は輝度分布検出データに対応して変動する。また、本例によれば、前記インバータ基板 3103のインターフェースとしてバックライトのＯＮ／ＯＦＦ制御のみで済むため、汎用性のある制御機能であるといえる。
【０１６８】
図５３に前記図４９、図５２に示した前記バックライト調光制御部 3323及び、ブリンク制御部 3324による輝度制御及び、動画ぼけ改善制御例とは別の一例を示す。
【０１６９】
図５３の例では、前記図５２に示した一例に対し、輝度分布検出データに従って制御するブリンク波形に対するブリンクパルス幅デューティの変更を、パルスの前縁は固定し、後縁で行うようにしたものである。すなわち図５３において、前記ブリンク制御部 3324は動画ぼけの改善例として、表示画面の上画面部分に照準を合わせ、１フレームの前半にブリンク波形がＯＮするように制御する。さらに輝度分布検出データの状態に対応して、前記ブリンク波形のパルス幅を変更する。ブリンクパルス幅デューティの変更を、パルスの前縁は固定し、後縁で行うようにしたものである。従って前記図５２に示した例同様、１フレーム期間に要する時間を“ａ”とし、１フレームの後半にブリンク波形をＯＮする時間を“ｂ”とした際のブリンク波形デユーティ比は“ｂ：ａ”となり、この比は輝度分布検出データに対応して変動する。また、本例においても、前記インバータ基板 5103のインターフェースとしてバックライトのＯＮ／ＯＦＦ制御のみで済むため、汎用性のある制御機能であるといえる。
【０１７０】
図５４に前記図４９、図５２、図５３に示した前記バックライト調光制御部 323及び、ブリンク制御部 3324による輝度制御及び、動画ぼけ改善制御例とは別の一例を示す。
【０１７１】
本例は、前記図５２、図５３に示した一例の双方を兼ね備えたものである。すなわち、図５４において、前記ブリンク制御部 3324は動画ぼけの改善例として、表示画面の中央画面部分に照準を合わせ、１フレームの中間にブリンク波形がＯＮするように制御する。さらに輝度分布検出データの状態に対応して、前記ブリンク波形のパルス幅を変更する。ブリンクパルス幅デューティの変更を、パルスの前縁及び、後縁の双方で行うようにしたものである。従って前記図５２、図５３に示した例同様、１フレーム期間に要する時間を“ａ”とし、１フレームの後半にブリンク波形をＯＮする時間を“ｂ”とした際のブリンク波形デユーティ比は“ｂ：ａ”となり、この比は輝度分布検出データに対応して変動する。また、本例においても、前記インバータ基板 3103のインターフェースとしてバックライトのＯＮ／ＯＦＦ制御のみで済むため、汎用性のある制御機能であるといえる。
【０１７２】
図５５に前記図４９、図５２、図５３、図５４に示した前記バックライト調光制御部 3323及び、ブリンク制御部 3324による輝度制御及び、動画ぼけ改善制御例とは別の一例を示す。前記各実施例では動画ぼけ改善に着眼した際に、液晶輝度波形は調光制御が加わることでブリンク波形と異なることになる。例えば、前記図４９に示した一例では、ブリンク波形のＯＮパルスの中で調光制御に伴うＯＦＦ期間が存在することになり、前記図５２〜図５４に示した例では、動画ぼけ改善のために1画面中の特定位置に設定したブリンク波形のＯＮパルスが調光制御に伴い変更することになる。
【０１７３】
図５５に示す一例は、これらを改善したものであり、調光制御としてバックライトの管電流を制御するものである。すなわち、動画ぼけ改善に対しては前記図４９に示した一例同様、表示画面の下画面部分に照準を合わせ、１フレームの後半にブリンク波形がＯＮするように制御する。すなわち、図５５において１フレーム期間に要する時間を“ａ”とし、１フレームの後半にブリンク波形をＯＮする時間を“ｂ”とした際のブリンク波形デユーティ比は“ｂ：ａ”となり、この比は固定とする。調光制御に関しては、輝度分布検出データに従って、明るい映像信号と判断した際には次フレームでバックライトに対する管電流量を増大することで輝度を上げ逆に、暗い映像信号と判断した際には次フレームでバックライトに対する管電流量を減少することで輝度を下げる。本制御に従えば、輝度分布検出データに従ったバックライト管電流量による調光制御が如何なる場合においても、動画ぼけ改善のためのブリンク波形は固定化できるため、表示画面の特定領域に対し常時安定した動画ぼけ改善効果を得ることができる。
【０１７４】
本発明の実施例によれば、画像データの移動速度に応じてランプの高輝度で発光効率並びに均一性の優れた表示品質の良好な動画表示を可能とすることができる。
【０１７５】
更に本発明の実施例によれば、画像データの階調特性に応じてリアルタイムにダイナミックレンジを変更することができ、高輝度で発光効率並びに均一性の優れた表示品質の良好な動画表示を可能とすることができる。
【０１７６】
【発明の効果】
本発明によれば、表示画像の動き量又は輝度に応じて光源の発光時点又は発光時間を制御することにより、表示画像の輝度を効率よく向上すると共に、光源の発熱を抑制するという効果を奏する。
【０１７７】
又は、本発明によれば、表示画像の輝度と液晶部の応答特性に応じて光源の発光時点又は発光時間を制御することにより、動画でのボケを改善するという効果を奏する。
【０１７８】
又は、本発明によれば、表示画像の輝度に応じて入出力階調特性を制御することにより、コントラストを向上するという効果を奏する。
【図面の簡単な説明】
【図１】本発明の液晶表示モジュールを搭載した液晶表示装置の概略構成図である。
【図２】本発明の液晶表示装置の光源等の輝度波形を示す図である。
【図３】サイドライト型光源ユニットを用いた液晶表示装置の構造を示す図である。
【図４】直下型光源ユニットを用いた液晶表示装置の構造を示す図である。
【図５】冷陰極管の管内温度及び供給電流に対する輝度特性を示す図である。
【図６】本発明の光源ユニットによる輝度応答を示す図である。
【図７】光源に冷陰極管を用いた液晶表示装置の表示輝度及び冷陰極管温度の経時変化を示す図である。
【図８】本発明による光源の点滅点灯を実施する制御回路の一例を示す図である。
【図９】本発明による光源の点滅点灯比率の設定の一例を示す図である。
【図１０】本発明による光源の点滅点灯比率の設定の一例を示す図である。
【図１１】本発明による光源の点滅点灯周期の設定の一例を示す図である。
【図１２】本発明による光源の点滅点灯における休止期間の設定の一例を示す図である。
【図１３】本発明によるサイドライト型光源ユニットの一例を示す図である。
【図１４】本発明によるサイドライト型光源ユニットを用いた液晶表示装置（横電界モード液晶表示装置）の構造を示す図である。
【図１５】図１３の液晶表示装置に用いるインバータ装置の配置を示す図である。
【図１６】従来技術である直下型の光源ユニットの点灯動作方法を示す図である。
【図１７】本発明によるサイドライト型光源ユニットの制御回路の構成を示す図である。
【図１８】図１７内のスイッチング制御回路２５の一例を示す図である。
【図１９】図１８のスイッチング制御回路２５により生成される光源点灯信号ＢＬのタイミング図である。
【図２０】従来のホールド型発光と本発明のインパルス型発光の比較図である。
【図２１】本発明におけるデータ比較の検出ポイントの一例を示す図である。
【図２２】図１７内のスイッチング制御回路２５の一例を示す図である。
【図２３】図２２のスイッチング制御回路２５を説明するための表示画面の分割方式を示す図である。
【図２４】図２２スイッチング制御回路２５で生成される光源点灯信号BLタイミング図である。
【図２５】本発明による直下型光源ユニットの制御回路の構成を示す図である。
【図２６】図２５内のスイッチング制御回路２５の一例を示す図である。
【図２７】図２６のスイッチング制御回路２５により生成される光源点灯信号ＢＬ１〜ＢＬ４のタイミング図である
【図２８】本発明による表示画像の表示輝度に応じた光源点灯制御を実現するためのスイッチング制御回路２５を示す図である。
【図２９】図２８のスイッチング制御回路２５により生成される光源点灯信号ＢＬのタイミング図である。
【図３０】本発明による点灯方式指示回路６０の構成を示す図である。
【図３１】本発明の別な一例による液晶表示モジュールの概略構成図である。
【図３２】本発明による液晶表示モジュール背面に実装するＴＣＯＮ基板の概略構成図である。
【図３３】本発明によるＴＣＯＮ基板に搭載するＬＳＩの内部機能概略構成図である。
【図３４】本発明による映像データ変換（低電圧差動→ＴＴＬ及び、ＴＴＬ→低電圧差動）入出力信号仕様図である。
【図３５】本発明によるフレームメモリ制御部動作概略タイミング図である。
【図３６】本発明によるドライバー・インターフェース・タイミング図である。
【図３７】本発明によるデジタル・バックライト調光信号タイミング図である。
【図３８】本発明による輝度データ生成制御部動作概念図である。
【図３９】本発明による輝度分布検出制御部概略構成図である。
【図４０】本発明による輝度分布検出部の動作を示す状態遷移図である。
【図４１】本発明による輝度分布検出制御部による輝度分布検出結果概略図及び、検出結果からの輝度平均値算出演算式である。
【図４２】本発明による輝度分布検出部の一例である図４０とは別の一例に対する動作を示す状態遷移図である。
【図４３】本発明の図４１に示す一例とは別の一例による輝度分布検出制御部による輝度分布検出結果概略図及び、検出結果からの輝度平均値算出演算式である。
【図４４】本発明による折線ポイント階調制御部による階調制御の一例である。
【図４５】本発明による折線ポイント階調制御部による階調制御部概略構成図である。
【図４６】本発明の図４４に示す一例とは別の一例による折線ポイント階調制御部による階調制御の一例である。
【図４７】本発明の図４５に示す一例とは別の一例による折線ポイント階調制御部による階調制御部概略構成図である。
【図４８】本発明によるインバータ基板における調光特性図の一例である。
【図４９】本発明によるバックライト調光制御部及び、ブリンク制御部による輝度制御及び、動画ぼけ改善制御の一例である。
【図５０】本発明による輝度分布検出データによる映像判定の一例である。
【図５１】本発明による映像判定条件例に従った、調光制御状態遷移図の一例である。
【図５２】本発明の図４９に示す一例とは別の一例によるバックライト調光制御部及び、ブリンク制御部による輝度制御及び、動画ぼけ改善制御の一例である。
【図５３】本発明の図４９及び、図５２に示す一例とは別の一例によるバックライト調光制御部及び、ブリンク制御部による輝度制御及び、動画ぼけ改善制御の一例である。
【図５４】本発明の図４９、図５２及び、図５３に示す一例とは別の一例によるバックライト調光制御部及び、ブリンク制御部による輝度制御及び、動画ぼけ改善制御の一例である。
【図５５】本発明の図４９、図５２、図５３及び、図５４に示す一例とは別の一例によるバックライト調光制御部及び、ブリンク制御部による輝度制御及び、動画ぼけ改善制御の一例である。
【符号の説明】
１…偏向板、２…液晶層、３…基板、４…光学シート群、５…プリズムシート、６…拡散フィルム、７…反射器、８…蛍光灯、９…反射フィルム、１０…光学ユニット、１１…導光板、２０…直流電圧源入力端子、２１…インバータ回路、２２…変圧器、２３…調光回路、２４…スイッチング素子、２５…スイッチング制御回路、２７…液晶パネル、２８…液晶表示モジュール、２９…テレビ入力端子、３０…ビデオ入力端子、３１…Ｓ入力端子、３２…アナログＰＣ入力端子、３３…デジタルＰＣ入力端子、３４…アナログ映像処理制御部、３５…デジタル映像処理制御部、３６…液晶表示装置、５０…データ格納部、５１…ラインカウント部、５２…データ比較部、５３…パルス制御部、５４…パルス生成部、５５…モード判定部、５６…表示輝度検出部、５７…表示輝度情報保持部、６０…点灯方式指示回路、６１…入力手段判定部、６２…点灯選択部、６３…点灯指示信号生成部、３１０１…液晶モジュール（２８…液晶表示モジュールと同一）、３１０２…液晶駆動制御基板（３５…デジタル映像処理制御部と同一）、３１０３…インバータ基板（２１…インバータ回路と同一）、３１０４…ゲート用フラットケーブル、３１０５…ドレイン用フラットケーブル、３１０６…インバータ制御用ケーブル、３１０７…ランプ高圧側ケーブル、３１０８…ランプ低圧側ケーブル、３２０１…低電圧差動デジタル映像信号入力コネクタ部、３２０２…映像データ変換（低電圧差動→ＴＴＬ）ＬＳＩ１、３２０３…ＦＰＧＡ論理データ設定コネクタ、３２０４…ＦＰＧＡ論理データ設定ＲＯＭ、３２０５…液晶パネル制御ＦＰＧＡもしくはＬＳＩ（２５…スイッチング制御回路、６０…点灯方式指示回路は一部分）、３２０６…ＦＰＧＡ（もしくはＬＳＩ）3205の動作モード設定ＳＷ、３２０７…フレームメモリ、３２０８…発振器、３２０９…階調電圧制御用コンパレータ、３２１０…ゲート信号用コネクタ、３２１１…ドレイン信号用コネクタ、３２１２…ドレイン信号用コネクタ、３２１３…映像データ変換（ＴＴＬ→低電圧差動）ＬＳＩ２、３２１４…低電圧差動デジタル映像信号出力コネクタ部、３２１５…Ｄ／Ａ変換コンバータ、３２１６…インバータ制御コネクタ部、３２１７…電源回路部、３３０１…低電圧差動デジタル映像信号、３３０２…ＴＴＬ形式に変換したデジタル映像信号、３３０３…タイミング制御部、３３０４…Ｒ、Ｇ、Ｂ映像データ、３３０５…ＬＳＩ内部の基準タイミング信号、３３０６…輝度データ生成制御部、３３０７…輝度データ、３３０８…輝度分布検出制御部、３３０９…輝度分布データ、３３１０…折線ポイント階調制御部、３３１１…出力階調データ、３３１２…フレームメモリ制御部、３３１３…フレームメモリ・インターフェース信号、３３１４…フレームメモリ・リードデータ、３３１５…オーバードライブ制御部、３３１６…オーバードライブ補正後の出力階調データ、３３１７…ＦＲＣ制御部、３３１８…擬似階調表示データ、３３１９…ドライバー・インターフェース制御部、３３２０…ゲートドライバー制御信号、３３２１…ドレインドライバー制御信号、３３２２…低電圧差動映像信号、３３２３…バックライト調光制御部、３３２４…ブリンク制御部、３３２��…デジタル・バックライト調光信号、３３２６…バックライトＯＮ／ＯＦＦ信号、３３２７…アナログ・バックライト調光信号、３３２８…インバータ制御信号、３９０１…検出期間設定部、３９０２…入力階調分割数設定部、３９０３…入力映像データ階調領域検出部、３９０４…第１階調領域カウンタ、３９０５…第２階調領域カウンタ、３９０６…第ｎ階調領域カウンタ、３９０７…第1データホールドラッチ、３９０８…第2データホールドラッチ、３９０９…第ｎデータホールドラッチ、３９１０…ｍ倍乗算回路、３９１１…２＊ｍ倍乗算回路、３９１２…ｎ＊ｍ倍乗算回路、３９１３…加算回路、３９１４…ｎ＊ｍ除算回路、３９１５…平均輝度データ・ホールドラッチ、４５０１…ラッチ回路１、４５０２…１ｔｏ８デコーダ回路、４５０３…上位階調側折線ポイント設定レジスタ・セレクタ回路、４５０４…下位階調側折線ポイント設定レジスタ・セレクタ回路、４５０５…減算回路、４５０６…乗算回路、４５０７…加算回路、４７０１…ラッチ回路１、４７０２…１ｔｏ８デコーダ回路、４７０３…上位階調側折線ポイント設定レジスタ・セレクタ回路、４７０４…下位階調側折線ポイント設定レジスタ・セレクタ回路、４７０５…３ｔｏ１セレクタ回路、４７０６…３ｔｏ１セレクタ回路、４７０７…減算回路、４７０８…乗算回路、４７０９…２ｔｏ１セレクタ回路、４７１０…加算回路
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【図１６】
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【図１７】
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【図１８】
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【図１９】
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【図２０】
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【図２１】
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【図２２】
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【図２３】
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【図２４】
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【図２５】
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【図２６】
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【図２７】
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【図２８】
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【図２９】
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【図３０】
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【図３１】
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【図３２】
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【図３３】
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【図３４】
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【図３５】
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【図３６】
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【図３７】
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【図３８】
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【図３９】
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【図４０】
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【図４１】
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【図４２】
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【図４３】
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【図４４】
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【図４５】
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【図４６】
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【図４７】
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【図４８】
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【図４９】
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【図５０】
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【図５１】
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【図５２】
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【図５３】
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【図５４】
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【図５５】
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