【手続補正書】
【提出日】平成28年10月28日(2016.10.28)
【手続補正１】
【補正対象書類名】特許請求の範囲
【補正対象項目名】全文
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
ＲＦ受信機の２次入力インターセプトポイント（ＩＩＰ２）を較正するための装置であって、前記装置は、
変調データを備える被変調入力信号を生成するように構成された信号生成器と、
ミキサ出力を生成するために、前記被変調入力信号から導出された信号を局部発振器信号と混合するように構成されたミキサを備える１次受信機と、
前記ミキサ出力に結合されたアナログ相関器と
を備え、前記アナログ相関器が、
前記アナログ相関器への入力信号に前記変調データを乗算するように構成されたアナログ乗算器と、
アナログ相関器出力信号を生成するために前記アナログ乗算器の出力を積分するように構成されたアナログ積分器と
を備え、
ここにおいて、前記受信機の調整可能入力が前記アナログ相関器出力信号に結合される、装置。
【請求項２】
前記受信機の前記調整可能入力が前記ミキサのバイアス電圧を備える、請求項１に記載の装置。
【請求項３】
前記被変調入力信号から導出された前記信号が、前記ミキサの入力に直接結合された前記被変調入力信号である、または、
前記被変調入力信号から導出された前記信号が、前記ミキサの入力に結合された出力を有する低雑音増幅器の入力に結合された前記被変調入力信号である、請求項１に記載の装置。
【請求項４】
前記アナログ乗算器が、差動出力を有する増幅器と、第１のスイッチに結合された前記差動出力の第１の端子と、第２のスイッチに結合された前記差動出力の第２の端子とを備え、前記第１のスイッチが、前記変調データに基づいてオンおよびオフに交互に切り替えられ、前記第２のスイッチが、前記第１のスイッチとは逆の様式でオンおよびオフに交互に切り替えられる、請求項１に記載の装置。
【請求項５】
前記第１および第２のスイッチが前記アナログ積分器の入力にさらに結合され、ここにおいて、前記アナログ積分器が、少なくとも１つのフィードバック結合積分キャパシタを有する演算増幅器を備える、請求項４に記載の装置。
【請求項６】
前記アナログ積分器が、正端子と負端子とを備える差動入力を備え、前記正端子が前記第１のスイッチの出力に結合され、前記負端子が前記第２のスイッチの出力に結合され、ここにおいて、前記アナログ乗算器の増幅器の前記差動出力の前記第１の端子が第３のスイッチによって前記負端子に結合され、前記アナログ乗算器の増幅器の前記差動出力の前記第２の端子が第４のスイッチによって前記正端子に結合され、ここにおいて、前記第３のスイッチが前記第２のスイッチと同相でオンおよびオフに切り替えられ、前記第４のスイッチが前記第１のスイッチと同相でオンおよびオフに切り替えられる、請求項５に記載の装置。
【請求項７】
前記アナログ積分器が差動出力をさらに備え、ここにおいて、前記アナログ相関器出力信号が前記アナログ積分器の前記差動出力を備え、ここにおいて、前記受信機の前記調整可能入力が前記ミキサの差動バイアス電圧を備え、ここにおいて、前記アナログ積分器の前記差動出力が前記ミキサの前記差動バイアス電圧に結合される、または、
前記アナログ積分器が差動出力をさらに備え、ここにおいて、前記アナログ相関器出力信号が前記アナログ積分器の前記差動出力を備え、ここにおいて、前記受信機の前記調整可能入力が低雑音増幅器の差動バイアス電圧を備え、ここにおいて、前記アナログ積分器の前記差動出力が前記低雑音増幅器の前記差動バイアス電圧に結合される、または、
前記アナログ積分器の前記出力が前記低雑音増幅器のバイアス電圧に結合される、請求項６に記載の装置。
【請求項８】
前記被変調入力信号が振幅変調された入力信号を備え、前記振幅変調が、前記変調データを使用してシングルトーンキャリアをオンオフキーイングすることを備え、前記変調データが交互ビットのシーケンスを備え、ここにおいて、前記アナログ乗算器がアイドルモードで無効にされ得、ここにおいて、前記アナログ乗算器は、前記変調データが前記シングルトーンキャリアをオフにしたときに前記アイドルモードになるように構成された、請求項４に記載の装置。
【請求項９】
前記被変調入力信号が振幅変調された入力信号を備え、前記振幅変調が、前記変調データを使用してシングルトーンキャリアをオンオフキーイングすることを備え、前記変調データが交互ビットのシーケンスを備える、請求項１に記載の装置。
【請求項１０】
前記受信機が同相（Ｉ）ミキサを備え、前記１次受信機が直交（Ｑ）ミキサをさらに備え、ここにおいて、前記受信機の前記調整可能入力が前記ＩおよびＱミキサのゲートバイアス電圧を備え、ここにおいて、前記アナログ相関器出力信号が、時間的に連続的に前記Ｉミキサおよび前記Ｑミキサの前記ゲートバイアス電圧に交互に結合される、請求項１に記載の装置。
【請求項１１】
前記ミキサが同相（Ｉ）ミキサを備え、前記１次受信機が直交（Ｑ）ミキサをさらに備え、前記アナログ相関器が第１のアナログ相関器を備え、前記装置が、前記変調データを、前記Ｑミキサの出力に結合された信号と相関させるように構成された第２のアナログ相関器をさらに備え、ここにおいて、前記第１のアナログ相関器の出力が前記Ｉミキサのゲートバイアス電圧に結合され、ここにおいて、前記第２のアナログ相関器の出力が前記Ｑミキサの前記ゲートバイアス電圧に結合される、請求項１に記載の装置。
【請求項１２】
前記アナログ相関器出力信号をデジタル信号に変換するためのアナログデジタル変換器と、
前記アナログデジタル変換器の出力を記憶するためのメモリと、
前記メモリ中の記憶された値をアナログ値に変換するためのデジタルアナログ変換器と、ここにおいて、前記アナログ値が、前記アナログ相関器出力信号の代わりに前記受信機の前記調整可能入力に結合されるように構成可能である、
をさらに備える、請求項１に記載の装置。
【請求項１３】
少なくとも１つのバランと、
シングルエンド信号を差動信号に変換するために前記少なくとも１つのバランに結合された出力を有する複数の低雑音増幅器（ＬＮＡ）と
をさらに備え、
ここにおいて、前記ミキサへの入力が、前記被変調入力信号と、前記少なくとも１つのバランの差動出力信号の両方に結合され、前記複数のＬＮＡが、選択的に無効にされるように構成可能であり、ここにおいて、
前記少なくとも１つのバランが複数のバランを備え、各バランが、対応する複数の低雑音増幅器に結合され、
前記装置が、前記複数のバランの各々に関連付けられたミキサをさらに備え、前記ミキサへの前記入力の各々が、前記被変調入力信号、または前記関連付けられたバランの差動出力信号から選択可能である、
請求項１に記載の装置。
【請求項１４】
２次受信機をさらに備え、前記２次受信機が、無線周波数信号をダウンコンバートするための受信処理チェーンを備え、前記受信処理チェーンが低域フィルタを備え、ここにおいて、
前記１次受信機の較正モードでは、前記アナログ相関器の前記アナログ乗算器および積分器が前記２次受信機の前記低域フィルタ中の構成要素を利用し、前記２次受信機の前記低域フィルタは、
並列に結合された構成可能な抵抗と構成可能なキャパシタンスとを有するフィードバック経路を備える第１の増幅器直列セクションと、ここにおいて、前記第１の増幅器直列セクションが、前記構成可能なキャパシタンスを無効にするように構成可能であり、前記第１の増幅器直列セクションが、前記構成可能な抵抗を無効にするようにさらに構成可能である、
並列に結合された構成可能な抵抗と構成可能なキャパシタンスとを有するフィードバック経路を備える第２の増幅器直列セクションと、ここにおいて、前記第２の増幅器直列セクションが、前記構成可能なキャパシタンスを無効にするように構成可能であり、前記第２の増幅器直列セクションが、前記構成可能な抵抗を無効にするようにさらに構成可能である、
を備え、
ここにおいて、前記１次受信機が前記較正モードにあるとき、前記第１の増幅器直列セクションは、前記アナログ乗算器を実装するために前記構成可能なキャパシタンスを無効にするように構成され、前記第２の増幅器直列セクションが、前記アナログ積分器を実装するために前記構成可能な抵抗を無効にするように構成された、
請求項１に記載の装置。
【請求項１５】
ＲＦ受信機の２次入力インターセプトポイント（ＩＩＰ２）を較正するための方法であって、前記方法は、
変調データを使用して被変調信号を生成することと、
ダウンコンバートされた信号を生成するために前記被変調信号を受信機入力に結合することと、
前記ダウンコンバートされた信号を前記変調データと相関させることと、前記相関させることが、アナログ相関ブロックを使用することを備える、
前記相関の出力を前記受信機の調整可能入力に結合することと、
前記受信機のパラメータを最適化させる、前記受信機の前記調整可能入力の少なくとも１つの値を記憶することと
を備える方法。
【手続補正２】
【補正対象書類名】明細書
【補正対象項目名】００８９
【補正方法】変更
【補正の内容】
【００８９】
[0097]開示した例示的な態様の前述の説明は、当業者が本発明を実施または使用することができるように与えたものである。これらの例示的な態様への様々な修正は当業者には容易に明らかであり、本明細書で定義した一般原理は、本発明の趣旨または範囲から逸脱することなく他の例示的な態様に適用され得る。したがって、本開示は、本明細書で示した例示的な態様に限定されるものではなく、本明細書で開示した原理および新規の特徴に一致する最も広い範囲を与えられるべきである。
以下に、本願出願の当初の特許請求の範囲に記載された発明を付記する。
［Ｃ１］
装置であって、
変調データを備える被変調入力信号を生成するように構成された信号生成器と、
ミキサ出力を生成するために、前記被変調入力信号から導出された信号を局部発振器信号と混合するように構成されたミキサを備える１次受信機と、
前記ミキサ出力に結合されたアナログ相関器と
を備え、前記アナログ相関器が、
前記アナログ相関器への入力信号に前記変調データを乗算するように構成されたアナログ乗算器と、
アナログ相関器出力信号を生成するために前記アナログ乗算器の出力を積分するように構成されたアナログ積分器と
を備え、
ここにおいて、前記受信機の調整可能入力が前記アナログ相関器出力信号に結合される、装置。
［Ｃ２］
前記受信機の前記調整可能入力が前記ミキサのバイアス電圧を備える、Ｃ１に記載の装置。
［Ｃ３］
前記被変調入力信号から導出された前記信号が、前記ミキサの入力に直接結合された前記被変調入力信号である、Ｃ１に記載の装置。
［Ｃ４］
前記被変調入力信号から導出された前記信号が、前記ミキサの入力に結合された出力を有する低雑音増幅器の入力に結合された前記被変調入力信号である、Ｃ１に記載の装置。
［Ｃ５］
前記アナログ乗算器が、差動出力を有する増幅器と、第１のスイッチに結合された前記差動出力の第１の端子と、第２のスイッチに結合された前記差動出力の第２の端子とを備え、前記第１のスイッチが、前記変調データに基づいてオンおよびオフに交互に切り替えられ、前記第２のスイッチが、前記第１のスイッチとは逆の様式でオンおよびオフに交互に切り替えられる、Ｃ１に記載の装置。
［Ｃ６］
前記第１および第２のスイッチが前記アナログ積分器の入力にさらに結合され、ここにおいて、前記アナログ積分器が、少なくとも１つのフィードバック結合積分キャパシタを有する演算増幅器を備える、Ｃ５に記載の装置。
［Ｃ７］
前記アナログ積分器が、正端子と負端子とを備える差動入力を備え、前記正端子が前記第１のスイッチの出力に結合され、前記負端子が前記第２のスイッチの出力に結合され、ここにおいて、前記アナログ乗算器の増幅器の前記差動出力の前記第１の端子が第３のスイッチによって前記負端子に結合され、前記アナログ乗算器の増幅器の前記差動出力の前記第２の端子が第４のスイッチによって前記正端子に結合され、ここにおいて、前記第３のスイッチが前記第２のスイッチと同相でオンおよびオフに切り替えられ、前記第４のスイッチが前記第１のスイッチと同相でオンおよびオフに切り替えられる、Ｃ６に記載の装置。
［Ｃ８］
前記アナログ積分器が差動出力をさらに備え、ここにおいて、前記アナログ相関器出力信号が前記アナログ積分器の前記差動出力を備え、ここにおいて、前記受信機の前記調整可能入力が前記ミキサの差動バイアス電圧を備え、ここにおいて、前記アナログ積分器の前記差動出力が前記ミキサの前記差動バイアス電圧に結合される、Ｃ７に記載の装置。
［Ｃ９］
前記アナログ積分器が差動出力をさらに備え、ここにおいて、前記アナログ相関器出力信号が前記アナログ積分器の前記差動出力を備え、ここにおいて、前記受信機の前記調整可能入力が低雑音増幅器の差動バイアス電圧を備え、ここにおいて、前記アナログ積分器の前記差動出力が前記低雑音増幅器の前記差動バイアス電圧に結合される、Ｃ７に記載の装置。
［Ｃ１０］
前記アナログ積分器の前記出力が低雑音増幅器のバイアス電圧に結合される、Ｃ７に記載の装置。
［Ｃ１１］
前記被変調入力信号が振幅変調された入力信号を備え、振幅変調が、前記変調データを使用してシングルトーンキャリアをオンオフキーイングすることを備え、前記変調データが交互ビットのシーケンスを備え、ここにおいて、前記アナログ乗算器がアイドルモードで無効にされ得、ここにおいて、前記アナログ乗算器は、前記変調データが前記シングルトーンキャリアをオフにしたときに前記アイドルモードになるように構成された、Ｃ５に記載の装置。
［Ｃ１２］
前記被変調入力信号が振幅変調された入力信号を備え、振幅変調が、前記変調データを使用してシングルトーンキャリアをオンオフキーイングすることを備え、前記変調データが交互ビットのシーケンスを備える、Ｃ１に記載の装置。
［Ｃ１３］
前記１次受信機が同相（Ｉ）ミキサを備え、前記１次受信機が直交（Ｑ）ミキサをさらに備え、ここにおいて、前記受信機の前記調整可能入力が前記ＩおよびＱミキサのゲートバイアス電圧を備え、ここにおいて、前記アナログ相関器出力信号が、時間的に連続的に前記Ｉミキサおよび前記Ｑミキサの前記ゲートバイアス電圧に交互に結合される、Ｃ１に記載の装置。
［Ｃ１４］
前記ミキサが同相（Ｉ）ミキサを備え、前記１次受信機が直交（Ｑ）ミキサをさらに備え、前記アナログ相関器が第１のアナログ相関器を備え、前記装置が、前記変調データを、前記Ｑミキサの出力に結合された信号と相関させるように構成された第２のアナログ相関器をさらに備え、ここにおいて、前記第１のアナログ相関器の出力が前記Ｉミキサのゲートバイアス電圧に結合され、ここにおいて、前記第２のアナログ相関器の出力が前記Ｑミキサの前記ゲートバイアス電圧に結合される、Ｃ１に記載の装置。
［Ｃ１５］
前記アナログ相関器出力信号をデジタル信号に変換するためのアナログデジタル変換器と、
前記アナログデジタル変換器の出力を記憶するためのメモリと、
前記メモリ中の記憶された値をアナログ値に変換するためのデジタルアナログ変換器と、ここにおいて、前記アナログ値が、前記アナログ相関器出力信号の代わりに前記受信機の前記調整可能入力に結合されるように構成可能である、
をさらに備える、Ｃ１に記載の装置。
［Ｃ１６］
少なくとも１つのバランと、
シングルエンド信号を差動信号に変換するために前記少なくとも１つのバランに結合された出力を有する複数の低雑音増幅器（ＬＮＡ）と
をさらに備え、
ここにおいて、前記ミキサへの入力が、前記被変調入力信号と、前記少なくとも１つのバランの差動出力信号の両方に結合され、前記複数のＬＮＡが、選択的に無効にされるように構成可能である、
Ｃ１に記載の装置。
［Ｃ１７］
前記少なくとも１つのバランが複数のバランを備え、各バランが、対応する複数の低雑音増幅器に結合され、
前記装置が、前記複数のバランの各々に関連付けられたミキサをさらに備え、前記ミキサへの前記入力の各々が、前記被変調入力信号、または前記関連付けられたバランの差動出力信号から選択可能である、
Ｃ１６に記載の装置。
［Ｃ１８］
２次受信機をさらに備え、前記２次受信機が、無線周波数信号をダウンコンバートするための受信処理チェーンを備え、前記受信処理チェーンが低域フィルタを備え、ここにおいて、
前記１次受信機の較正モードでは、前記アナログ相関器の前記アナログ乗算器および積分器が前記２次受信機の前記低域フィルタ中の構成要素を利用する、
Ｃ１に記載の装置。
［Ｃ１９］
前記２次受信機の前記低域フィルタは、
並列に結合された構成可能な抵抗と構成可能なキャパシタンスとを有するフィードバック経路を備える第１の増幅器直列セクションと、ここにおいて、前記第１の増幅器直列セクションが、前記構成可能なキャパシタンスを無効にするように構成可能であり、前記第１の増幅器直列セクションが、前記構成可能な抵抗を無効にするようにさらに構成可能である、
並列に結合された構成可能な抵抗と構成可能なキャパシタンスとを有するフィードバック経路を備える第２の増幅器直列セクションと、ここにおいて、前記第２の増幅器直列セクションが、前記構成可能なキャパシタンスを無効にするように構成可能であり、前記第２の増幅器直列セクションが、前記構成可能な抵抗を無効にするようにさらに構成可能である、
を備え、
ここにおいて、前記１次受信機が前記較正モードにあるとき、前記第１の増幅器直列セクションは、前記アナログ乗算器を実装するために前記構成可能なキャパシタンスを無効にするように構成され、前記第２の増幅器直列セクションが、前記アナログ積分器を実装するために前記構成可能な抵抗を無効にするように構成された、
Ｃ１８に記載の装置。
［Ｃ２０］
変調データを使用して被変調信号を生成することと、
ダウンコンバートされた信号を生成するために前記被変調信号を受信機入力に結合することと、
前記ダウンコンバートされた信号を前記変調データと相関させることと、前記相関させることが、アナログ相関ブロックを使用することを備える、
前記相関の出力を前記受信機の調整可能入力に結合することと、
前記受信機のパラメータを最適化させる、前記受信機の前記調整可能入力の少なくとも１つの値を記憶することと
を備える方法。
［Ｃ２１］
前記受信機の前記調整可能入力が前記受信機のミキサのゲートバイアス電圧を備え、前記受信機の前記パラメータが２次インターセプトポイント（ＩＩＰ２）を備え、前記被変調信号を前記生成することが、前記変調データを使用してオンオフキーイング（ＯＯＫ）を用いて変調することを備え、前記被変調信号を前記受信機入力に前記結合することが、前記被変調信号を前記受信機の前記ミキサの入力に直接結合することを備える、Ｃ２０に記載の方法。
［Ｃ２２］
変調データを使用して被変調信号を生成するための手段と、
ダウンコンバートされた信号を生成するために前記被変調信号を受信機入力に結合するための手段と、
前記ダウンコンバートされた信号を前記変調データと相関させるための手段と、
前記相関の出力を前記受信機の調整可能入力に結合するための手段と、
前記受信機のパラメータを最適化させる、前記受信機の前記調整可能入力の少なくとも１つの値を記憶するための手段と
を備える装置。