(57)【要約】【課題】何らかの要因で、プログラムの書き込み途中でエラーが発生した場合や、書込みが完了した後、新プログラムに異常があり、正常に動作ができなかった場合は旧プログラムに戻ることの可能な冗長多重系情報処理装置、冗長多重系鉄道信号処理装置及びメモリ内容更新方法を提供すること。【手段】冗長多重系を構成する第１系１１及び第２系１２のそれぞれは、互いに接続されたメモリ１１２、１２２と演算処理部１１１、１２１とを含んでいる。第１系１１の演算処理部１１１は、第２系１２のメモリ１２２に接続されており、第２系１２の演算処理部１２１は、第１系１１のメモリ１１２に接続されている。【選択図】図１
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【特許請求の範囲】
【請求項１】
冗長多重系情報処理装置であって、
冗長多重系を構成する系のそれぞれは、互いに接続されたメモリと演算処理部とを含んでおり、
前記冗長多重系のうちの少なくとも２つの系において、一方の系の演算処理部は、他方の系のメモリに接続されており、前記他方の系の演算処理部は、前記一方の系の前記メモリに接続されている、
冗長多重系情報処理装置。
【請求項２】
冗長多重系情報処理装置を含む鉄道信号処理装置であって、前記冗長多重系情報処理装置は、請求項１に記載されたものでなる、鉄道信号処理装置。
【請求項３】
冗長多重系情報処理装置のメモリ内容更新方法であって、
前記冗長多重系情報処理装置は、請求項１に記載されたものであり、
一方の系の演算処理部を用いて、他方の系のメモリ内容を更新し、前記他方の系の演算処理部を用いて、前記一方の系の前記メモリ内容を更新するステップを含む、
メモリ内容更新方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、冗長多重系情報処理装置、鉄道信号処理装置及びメモリ内容更新方法に関する。
【背景技術】
【０００２】
例えば、鉄道信号システム等のように、システム・ダウンにより、甚大な障害を生じるシステムでは、そのような事態を回避する手段として、冗長多重系（通常は２重系）を採用し、一方の系に異常が発生したときに直ちに他方の系に切り替えて制御を継続する冗長多重系システムを採用する。
【０００３】
しかしながら、冗長多重系システムでは、何らかの要因で、プログラムの書き込み途中でエラーが発生した場合や、書込みが完了した後、新プログラムに異常があり、正常に動作ができなかった場合は、新プログラムでは動作できず、しかも、書込み更新ステップに伴う上書きによって、旧プログラムが破壊されてしまっているから、旧プログラムに戻ることもできないという事態に陥る。
【０００４】
特許文献１には、冗長系メモリを用いたシステムにおいて、何らかの要因で、プログラムの書き込み途中のプログラムメモリ部に対して系切替が発生した場合、既に途中まで書き込まれている場合には、その続きからデータの再書き込みを行い、これにより、プログラムの再書き込みに必要なデータの転送時間を短縮する技術が記載されている。
【０００５】
しかし、この先行技術によっては、プログラムの書き込み途中でエラーが発生した場合や、書込みが完了した後、新プログラムに異常があり、正常に動作ができなかった場合に生じる上記問題点を解決することができない。
【先行技術文献】
【特許文献】
【０００６】
【特許文献１】特開２００５−４６１９
【発明の概要】
【発明が解決しようとする課題】
【０００７】
本発明の課題は、何らかの要因で、プログラムの書き込み途中でエラーが発生した場合や、書込みが完了した後、新プログラムに異常があり、正常に動作ができなかった場合は旧プログラムに戻ることの可能な冗長多重系情報処理装置、冗長多重系鉄道信号処理装置及びメモリ内容更新方法を提供することである。
【課題を解決するための手段】
【０００８】
上述した課題を解決するため、本発明に係る冗長多重系情報処理装置では、冗長多重系を構成する系のそれぞれは、互いに接続されたメモリと演算処理部とを含んでおり、前記冗長多重系のうちの少なくとも２つの系において、一方の系の演算処理部は、他方の系のメモリに接続されており、前記他方の系の演算処理部は、前記一方の系の前記メモリに接続されている。
【０００９】
上述したように、本発明に係る冗長多重系情報処理装置では、冗長多重系を構成する系のそれぞれは、互いに接続されたメモリと演算処理部とを含んでいるから、演算処理部は、自系のメモリに記憶されているプログラムをコピーし、必要な信号処理を行うことができる。
【００１０】
しかも、一方の系の演算処理部を用いて、他方の系のメモリ内容を更新し、他方の系の演算処理部を用いて、一方の系のメモリ内容を更新することができるから、一方の系の演算処理部を用いて、他の系のメモリのプログラム書き込み途中でエラーが発生し、他の系のメモリのデータが破壊された場合でも、健全な一方の系のメモリの旧プログラムを、一方の演算処理部を用いて、他の系のメモリに移すことができる。一方の系の演算処理部を用いて、他の系のメモリへのプログラム書込みが完了した後、新プログラムに異常があり、正常に動作ができなかった場合も同様である。
【００１１】
本発明に係る冗長多重系情報処理装置は、冗長多重系を必要とする各種の情報処理に適用することができる。そのうちの代表例は、冗長多重系の鉄道信号処理装置である。
【発明の効果】
【００１２】
以上述べたように、本発明によれば、何らかの要因で、プログラムの書き込み途中でエラーが発生した場合や、書込みが完了した後、新プログラムに異常があり、正常に動作ができなかった場合は、旧プログラムに戻ることが可能な冗長多重系情報処理装置、冗長多重系鉄道信号処理装置及びメモリ内容更新方法を提供することができる。
【図面の簡単な説明】
【００１３】
【図１】本発明に係る冗長多重系情報処理装置のブロック図である。
【図２】図１に示した本発明に係る冗長多重系情報処理装置のメモリ内容更新方法を示す図である。
【図３】図２に示した更新ステップの後の更新ステップを示す図である。
【図４】図３に示した更新ステップの後の更新ステップを示す図である。
【図５】図４に示した更新ステップの後の更新ステップを示す図である。
【図６】図５に示した更新ステップの後の更新ステップを示す図である。
【図７】本発明に係る冗長多重系情報処理装置において、第１系の演算処理部による第２系のメモリへのプログラム書き込み途中で、エラーが発生した場合を示す図である。
【図８】図７に示すエラー発生の場合の復元ステップを示す図である。
【図９】図８に示した復元ステップにより、第２系のメモリの内容が、旧プログラムに復元したことを示す図である。
【図１０】第２系の演算処理部による、第１系のメモリへのプログラム書き込み途中で、エラーが発生した場合を示す図である。
【図１１】図１０に示すエラー発生の場合の復元ステップを示す図である。
【図１２】図１１に示した復元ステップにより、第１系のメモリの内容が、旧プログラムに復元したことを示す図である。
【図１３】本発明に係る冗長多重系情報処理装置の他の実施の形態を示すブロック図である。
【発明を実施するための形態】
【００１４】
図１を参照すると、本発明に係る情報処理装置１において、冗長多重系を構成する第１系１１及び第２系１２のそれぞれは、互いに接続されたメモリ１１２、１２２と演算処理部１１１、１２１とを含んでいる。実施の形態では、第１系１１及び第２系１２の２重系となっているが、より多重の冗長多重系であってもよい。このような冗長多重系情報処理装置の代表例は、冗長多重系の鉄道信号処理装置である。
【００１５】
演算処理部１１１、１２１は、例えば、ターゲットボード等と称されるもので、基本的には、ＣＰＵで構成されている。演算処理部１１１、１２１は、パソコン２などを通して、必要なプログラムをダウンロードし、これをメモリ１１２、１２２に記憶する。そして、メモリ１１２、１２２に記憶されているプログラムを、例えば、配線Ｗ１、Ｗ２を介してコピーし、コピーされたプログラムに従って演算処理を行う。
【００１６】
特徴的な構成として、第１系１１の演算処理部１１１は、自系のメモリ１１２のみならず、第２系１２のメモリ１２２にも配線Ｗ１２を介して接続されている。第２系１２の演算処理部１２１も、自系のメモリ１２２のみならず、第１系１１のメモリ１１２に配線Ｗ２１を介して接続されている。
【００１７】
上述したように、本発明に係る冗長多重系情報処理装置１では、冗長多重系を構成する第１系１１及び第２系１２のそれぞれは、互いに接続されたメモリ１１２、１２２と演算処理部１１１、１２１とを含んでいるから、それぞれの演算処理部１１１、１２１により、自系のメモリ１１２、１２２に記憶されているプログラムをコピーし、必要な信号処理を行うことができる。
【００１８】
しかも、第１系１１の演算処理部１１１を用いて、第２系１２のメモリ１２２の内容を更新し、第２系１２の演算処理部１２１を用いて、第１系１１のメモリ１１２の内容を更新することができるから、第１系１１の演算処理部１１１を用いて、第２系１２のメモリ１２２のプログラム書き込み途中でエラーが発生し、第２系１２のメモリ１２２のデータが破壊された場合でも、健全な第１系１１のメモリ１１２の旧プログラムを、第１系１１の演算処理部１１１を用いて、第２系１２のメモリ１２２に移すことができる。第１系１１の演算処理部１１１を用いて、第２系１２のメモリ１２２へのプログラム書込みが完了した後、新プログラムに異常があり、正常に動作ができなかった場合も同様である。
【００１９】
第２系１２の演算処理部１２１を用いて、第１系１１のメモリ１１２の内容を更新し、第１系１１の演算処理部１１１を用いて、第２系１２のメモリ１２２の内容を更新することができるから、第２系１２の演算処理部１２１を用いて、第１系１１のメモリ１１２のプログラム書き込み途中でエラーが発生し、第１系１１のメモリ１１２のデータが破壊された場合でも、健全な第２系１２のメモリ１２２の旧プログラムを、第２系１２の演算処理部１２１を用いて、第１系１１のメモリ１１２に移すことができる。第２系１２の演算処理部１２１を用いて、第１系１１のメモリ１１２へのプログラム書込みが完了した後、新プログラムに異常があり、正常に動作ができなかった場合も同様である。
【００２０】
この点について、図２〜図１３を参照し、更に具体的に説明する。図２〜図１２は、本発明に係る冗長多重系情報処理装置、及び、その具体的適用例としての冗長多重系鉄道信号処理装置の構成とともに、そのメモリ内容更新方法について開示するものでもある。
【００２１】
まず、第２系１２のメモリ１２２に記憶されているプログラムを、新プログラムに更新する場合、図２に図示するように、新プログラムを格納する媒体３から、パソコン２を用いてダウンロードし、第１系１１の演算処理装置１１１にコピーする。そして、図３に図示するように、第１系１１の演算処理部１１１を用いて、第２系１２のメモリ１２２の内容を、新プログラムに更新する。
【００２２】
次に、図４に図示するように、新プログラムを格納する媒体３から、パソコン２を用いてダウンロードし、第２系１２の演算処理装置１２１にコピーする。そして、図５に図示するように、第２系１２の演算処理部１２１を用いて、第１系１１のメモリ１１２の内容を、新プログラムに更新する。
【００２３】
第１系１１の演算処理部１１１及び第２系１２の演算処理部１２１のそれぞれは、自系のメモリ１１２、１２２から、新プログラムをコピーし、その更新された新プログラムに基づいて、必要な演算処理を行うことができる。
【００２４】
第１系１１の演算処理部１１１を用いて、第２系１２のメモリ１２２のプログラム書き込み途中でエラーが発生した場合、図７に図示するように、第２系１２のメモリ１２２のデータが破壊される。この場合、図８に図示するように、健全な第１系１１のメモリ１１２の旧プログラムを、第１系１１の演算処理部１１１を用いてコピーし、更に、第２系１２のメモリ１２２に移す。これにより、図９に図示するように、第２系１２のメモリ１２２の内容が、旧プログラムに復元する。
【００２５】
第１系１１の演算処理部１１１を用いて第２系１２のメモリ１２２の内容を新プログラムに更新(図３)した後、第２系１２の演算処理部１２１を用いた第１系１１のメモリ１１２のプログラム書き込み途中で、エラーが発生した場合、図１０に図示するように、第１系１１のメモリ１１２の旧プログラムのデータが破壊される。この場合、図１１に図示するように、健全な第２系１２のメモリ１２２の新プログラムを、第２系１２の演算処理部１２１を用いてコピーし、更に、第１系１１のメモリ１１２に移す。これにより、図１２に図示するように、第１系１１のメモリ１１２の内容が、新プログラムになる。
【００２６】
図１３に図示するように、データの健全性を判定し、異常時なメモリ１１２、１２２への書き換えを中止させる判定部１３を付加してもよい。図１３の例では、配線Ｗ１２、Ｗ２１に判定部１３を接続し、演算処理部１１１、１２１に書き換え中止命令を与えるようになっている。これとは異なって、演算処理部１１１、１２１に、上述した判定の機能をもたせてもよい。
【符号の説明】
【００２７】
１              冗長多重系情報処理装置
１１              第１系
１２              第２系
１１１              第１系の演算処理部
１１２              第１系のメモリ
１２１              第２系の演算処理部
１２２              第２系のメモリ
【図１】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図２】
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