(57)【要約】【課題】配線数や回路規模の増大を招くことなく、入力画像を確実に分割処理することのできる技術を提供する。【解決手段】本発明の画像処理装置は、複数の画像処理プロセッサを有し、画像処理プロセッサは、自プロセッサへ元画像が入力された場合に、複数の画像処理プロセッサのうち、自プロセッサをマスタ、他プロセッサをスレーブに設定する設定手段と、自プロセッサがマスタに設定された場合に、自プロセッサに入力された元画像を複数の分割画像に分割する分割手段と、自プロセッサがマスタに設定された場合に、複数の画像処理プロセッサにより複数の分割画像に対する画像処理が並列に行われるように、分割手段で得られた分割画像を他プロセッサへ送信する送信手段と、分割画像に画像処理を施す画像処理手段と、を有する。【選択図】図３
2013182504.tif 000002
【特許請求の範囲】
【請求項１】
１枚の元画像を分割して得られる複数の分割画像に画像処理を施す画像処理装置であって、
複数の画像処理プロセッサを有し、
前記画像処理プロセッサは、
自プロセッサへ元画像が入力された場合に、前記複数の画像処理プロセッサのうち、自プロセッサをマスタ、他プロセッサをスレーブに設定する設定手段と、
前記設定手段で自プロセッサがマスタに設定された場合に、自プロセッサに入力された元画像を複数の分割画像に分割する分割手段と、
前記設定手段で自プロセッサがマスタに設定された場合に、前記複数の画像処理プロセッサにより前記複数の分割画像に対する画像処理が並列に行われるように、前記分割手段で得られた分割画像を他プロセッサへ送信する送信手段と、
前記設定手段で自プロセッサがマスタに設定された場合に、前記分割手段で得られた複数の分割画像のうち、処理対象の分割画像に画像処理を施し、他の画像処理プロセッサの設定手段により自プロセッサがスレーブに設定された場合に、マスタに設定された他プロセッサから受信した分割画像に画像処理を施す画像処理手段と、
を有することを特徴とする画像処理装置。
【請求項２】
前記分割画像は、元画像の領域を分割して得られる分割領域と、その周囲の所定画素数分の領域とを含むサイズの画像である
ことを特徴とする請求項１に記載の画像処理装置。
【請求項３】
前記画像処理手段は、画像処理が施された分割画像から前記所定画素数分の領域の画像を切り取る
ことを特徴とする請求項２に記載の画像処理装置。
【請求項４】
前記分割手段は、前記設定手段で自プロセッサがマスタに設定された場合に、自プロセッサに入力された元画像を、サイズが互いに等しい複数の分割画像に分割する
ことを特徴とする請求項１〜３のいずれか１項に記載の画像処理装置。
【請求項５】
前記画像処理プロセッサは、
自プロセッサに入力された元画像のサイズを検出する検出手段
をさらに有し、
前記分割手段は、前記設定手段で自プロセッサがマスタに設定された場合に、前記検出手段の検出結果に基づいて、前記元画像を、サイズが互いに等しい複数の分割画像に分割する
ことを特徴とする請求項４に記載の画像処理装置。
【請求項６】
１枚の元画像を分割して得られる複数の分割画像に画像処理を施す複数の画像処理プロセッサを有する画像処理装置の制御方法であって、
前記画像処理プロセッサが、自プロセッサへ元画像が入力された場合に、前記複数の画像処理プロセッサのうち、自プロセッサをマスタ、他プロセッサをスレーブに設定する設定ステップと、
前記画像処理プロセッサが、前記設定ステップで自プロセッサがマスタに設定された場合に、自プロセッサに入力された元画像を複数の分割画像に分割する分割ステップと、
前記画像処理プロセッサが、前記設定ステップで自プロセッサがマスタに設定された場合に、前記複数の画像処理プロセッサにより前記複数の分割画像に対する画像処理が並列に行われるように、前記分割ステップで得られた分割画像を他プロセッサへ送信する送信ステップと、
前記画像処理プロセッサが、前記設定ステップで自プロセッサがマスタに設定された場合に、前記分割ステップで得られた複数の分割画像のうち、処理対象の分割画像に画像処理を施し、他の画像処理プロセッサにより自プロセッサがスレーブに設定された場合に、マスタに設定された他プロセッサから受信した分割画像に画像処理を施す画像処理ステップと、
を有することを特徴とする画像処理装置の制御方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、画像処理装置及びその制御方法に関する。
【背景技術】
【０００２】
ＨＤ（High definition）サイズ程度の画像に拡大処理を施して高解像度画像を生成し
、生成した高解像度画像を高解像度ディスプレイ（表示解像度が3840×2160画素のディスプレイ）に表示する技術が開発されている。
従来、ＨＤサイズ程度の画像を処理する場合には、１つの画像処理ＬＳＩ（Large Scale Integration）で画像処理を行うことができた。しかし、高解像度画像を処理する場合
は、１つの画像処理ＬＳＩでは処理性能が不足してしまう。そこで、複数の画像処理ＬＳＩで画像を分割処理する技術が提案されている（特許文献１，２）。
【先行技術文献】
【特許文献】
【０００３】
【特許文献１】特開２０００−２０４８１号公報
【特許文献２】特開２０００−１４８９９７号公報
【発明の概要】
【発明が解決しようとする課題】
【０００４】
上述した特許文献１に記載の技術は、マスタの画像処理ＬＳＩ（マスタＬＳＩ）が１枚分の画像を保持し、マスタＬＳＩが端部画像が付加された分割画像を生成して、スレーブの画像処理ＬＳＩ（スレーブＬＳＩ）に転送するものである。しかし、特許文献１に記載の技術では、マスタＬＳＩとスレーブＬＳＩが固定であるため、スレーブＬＳＩに入力された画像を分割処理することができない。
特許文献２に記載の技術は、入力画像を全ての画像処理ＬＳＩに入力し、入力画像を分割処理するものである。特許文献２に記載の技術では、入力画像を全ての画像処理ＬＳＩに入力するために、１枚の入力画像が入力される１つの入力端子を全ての画像処理ＬＳＩに接続する配線が必要となる。そのため、特許文献２に記載の技術を用いた場合には、配線数が増大し、ひいては回路規模が増大してしまう。
【０００５】
本発明は、配線数や回路規模の増大を招くことなく、入力画像を確実に分割処理することのできる技術を提供することを目的とする。
【課題を解決するための手段】
【０００６】
本発明の画像処理装置は、
１枚の元画像を分割して得られる複数の分割画像に画像処理を施す画像処理装置であって、
複数の画像処理プロセッサを有し、
前記画像処理プロセッサは、
自プロセッサへ元画像が入力された場合に、前記複数の画像処理プロセッサのうち、自プロセッサをマスタ、他プロセッサをスレーブに設定する設定手段と、
前記設定手段で自プロセッサがマスタに設定された場合に、自プロセッサに入力された元画像を複数の分割画像に分割する分割手段と、
前記設定手段で自プロセッサがマスタに設定された場合に、前記複数の画像処理プロセッサにより前記複数の分割画像に対する画像処理が並列に行われるように、前記分割手段で得られた分割画像を他プロセッサへ送信する送信手段と、
前記設定手段で自プロセッサがマスタに設定された場合に、前記分割手段で得られた
複数の分割画像のうち、処理対象の分割画像に画像処理を施し、他の画像処理プロセッサの設定手段により自プロセッサがスレーブに設定された場合に、マスタに設定された他プロセッサから受信した分割画像に画像処理を施す画像処理手段と、
を有することを特徴とする。
【０００７】
本発明の画像処理装置の制御方法は、
１枚の元画像を分割して得られる複数の分割画像に画像処理を施す複数の画像処理プロセッサを有する画像処理装置の制御方法であって、
前記画像処理プロセッサが、自プロセッサへ元画像が入力された場合に、前記複数の画像処理プロセッサのうち、自プロセッサをマスタ、他プロセッサをスレーブに設定する設定ステップと、
前記画像処理プロセッサが、前記設定ステップで自プロセッサがマスタに設定された場合に、自プロセッサに入力された元画像を複数の分割画像に分割する分割ステップと、
前記画像処理プロセッサが、前記設定ステップで自プロセッサがマスタに設定された場合に、前記複数の画像処理プロセッサにより前記複数の分割画像に対する画像処理が並列に行われるように、前記分割ステップで得られた分割画像を他プロセッサへ送信する送信ステップと、
前記画像処理プロセッサが、前記設定ステップで自プロセッサがマスタに設定された場合に、前記分割ステップで得られた複数の分割画像のうち、処理対象の分割画像に画像処理を施し、他の画像処理プロセッサにより自プロセッサがスレーブに設定された場合に、マスタに設定された他プロセッサから受信した分割画像に画像処理を施す画像処理ステップと、
を有することを特徴とする。
【発明の効果】
【０００８】
本発明によれば、配線数や回路規模の増大を招くことなく、入力画像を確実に分割処理することができる。
【図面の簡単な説明】
【０００９】
【図１】実施例１に係る画像処理装置を用いた画像処理システムの構成の一例
【図２】実施例１に係る元画像と分割画像の一例
【図３】実施例１に係る画像処理ＬＳＩの構成の一例
【図４】実施例１に係る画像処理装置の処理フローの一例
【図５】書き込みアドレスと読み出しアドレスの計算方法の一例
【図６】実施例２に係る画像処理装置の処理フローの一例
【発明を実施するための形態】
【００１０】
＜実施例１＞
以下、本発明の実施例１に係る画像処理装置及びその制御方法について説明する。本実施例に係る画像処理装置は、１枚の元画像を分割して得られる複数の分割画像に画像処理を施す。
【００１１】
図１は、本実施例に係る画像処理装置を用いた画像処理システムの構成の一例を示す図である。
画像再生装置１００は、元画像（元画像信号）を出力する機器であり、例えば、パーソナルコンピュータ、ブルーレイディスクレコーダなどである。画像再生装置１００は、本実施例に係る画像処理装置（画像表示装置１０９）に、接続ケーブル１０１を用いて接続される。具体的には、画像再生装置１００は、画像表示装置１０９が有する複数の画像処理プロセッサ（画像処理ＬＳＩ（Large Scale Integration））のうちの１つに、接続ケ
ーブル１０１を用いて接続される。そして、画像再生装置１００は、接続ケーブル１０１
を介して、元画像を画像表示装置１０９に出力する。即ち、画像表示装置１０９が有する複数の画像処理ＬＳＩのうちのいずれか１つに元画像が入力される。本実施例では、画像再生装置１００は、ＨＤサイズ以下の元画像を出力する。図１の例では、画像再生装置１００は、接続ケーブル１０１を用いて、画像処理ＬＳＩ１０２に接続されている。具体的には、画像表示装置１０９は画像処理ＬＳＩ１０２に接続された入力端子１１０を有しており、画像再生装置１００は接続ケーブル１０１を用いて入力端子１１０に接続されている。そのため、画像再生装置１００から出力された元画像は、入力端子１１０を介して画像処理ＬＳＩ１０２に入力される。なお、接続ケーブル１０１を用いて、画像再生装置１００を画像処理ＬＳＩ１０３へ接続することもできる。具体的には、画像表示装置１０９は画像処理ＬＳＩ１０３に接続された入力端子１１１を有している。そして、接続ケーブル１０１を用いて、画像再生装置１００を入力端子１１１に接続することができる。画像再生装置１００を入力端子１１１に接続した場合には、画像再生装置１００から出力された元画像は、入力端子１１１を介して画像処理ＬＳＩ１０３に入力される。
なお、本実施例では、複数の画像処理ＬＳＩのうちの１つに画像（元画像）が入力される場合について説明するが、複数の画像処理ＬＳＩに複数の画像（例えば複数の分割画像）を入力することもできる。
【００１２】
本実施例に係る画像処理装置（画像表示装置１０９）は、画像処理ＬＳＩ１０２，１０３、表示パネル１０８などを有する。
画像処理ＬＳＩ１０２，１０３は、１枚の元画像を分割して得られる分割画像に画像処理を施す。画像処理は、例えば、画像の拡大、縮小、ノイズリダクション、エンハンサ、変形、フレームレート変換等を行うフィルタ処理である。但し、画像処理はこれに限らない。画像処理はフィルタ処理でなくてもよい。
【００１３】
画像処理ＬＳＩ１０２と画像処理ＬＳＩ１０３は、接続ケーブル１０４と接続ケーブル１０５を用いて互いに接続されている。接続ケーブル１０４は、ＰＣＩのようなバスで構成され、画像処理ＬＳＩ１０２と画像処理ＬＳＩ１０３の間で、主に制御コマンドを送受信するために使用される。接続ケーブル１０５は、ＰＣＩＥｘｐｒｅｓｓのような高速伝送バスで構成され、画像処理ＬＳＩ１０２と画像処理ＬＳＩ１０３の間で分割画像（分割画像信号）を送受信するために使用される。
【００１４】
本実施例では、画像表示装置１０９が有する複数の画像処理ＬＳＩのうち、元画像が入力された画像処理ＬＳＩがマスタ、元画像が入力されない画像処理ＬＳＩがスレーブとなる。そして、マスタの画像処理ＬＳＩがスレーブの画像処理ＬＳＩを制御する。図１の例では画像処理ＬＳＩ１０２に元画像が入力されるため、画像処理ＬＳＩ１０２がマスタ、画像処理ＬＳＩ１０３がスレーブとなる。マスタの画像処理ＬＳＩは、例えば、スレーブの画像処理ＬＳＩが有するフレームメモリに対する分割画像の読み書きで使用するアドレスを設定する。また、マスタの画像処理ＬＳＩは、入力される元画像信号を監視し、異常信号を検出した場合に、異常信号に基づく画像を表示しないようにスレーブの画像処理ＬＳＩを制御する。詳細は後述する。
【００１５】
マスタの画像処理ＬＳＩは、入力された元画像を、各々のサイズ（画像サイズ）が画像処理ＬＳＩで処理可能なサイズである複数の分割画像に分割する。例えば、マスタの画像処理ＬＳＩは、入力された元画像を、画像表示装置１０９が有する画像処理ＬＳＩの数と同じ数の分割画像に分割する。図１の例では、マスタの画像処理ＬＳＩ１０２が、元画像を２つの分割画像に分割する。
なお、本実施例では、元画像の領域を分割して得られる分割領域と、その周囲の所定画素数分の領域とを含むサイズの画像を分割画像とする。上記周囲の領域（端部）は、例えば、画像処理ＬＳＩが分割領域に画像処理（例えばフィルタ処理）を施す際に参照される領域である。画像処理がフィルタ処理である場合、端部のサイズ（上記所定画素数）は、
例えば、該フィルタ処理で使用されるフィルタのタップ数等により決定される。そのような構成にすることにより、画像処理後の分割領域間の境界が不連続となることを抑制することができる。分割画像の取得方法の詳細は後述する。
【００１６】
マスタの画像処理ＬＳＩは、複数の画像処理ＬＳＩにより複数の分割画像に対する処理が並列に行われるように、分割画像をスレーブの画像処理ＬＳＩへ送信する。図１の例では、マスタの画像処理ＬＳＩ１０２が、２つの分割画像のうちの一方を、自プロセッサ（画像処理ＬＳＩ１０２）の処理対象とし、他方を他プロセッサ（画像処理ＬＳＩ１０３）の処理対象とする。そして、画像処理ＬＳＩ１０２は、画像処理ＬＳＩ１０３の処理対象である分割画像を接続ケーブル１０５を用いて画像処理ＬＳＩ１０３へ送信する。
【００１７】
そして、各画像処理ＬＳＩは、処理対象の分割画像に対して画像処理を施す。その後、各画像処理ＬＳＩは、画像処理が施された分割画像から端部の画像（端部画像）を切り取り、該端部の画像が切り取られた画像を表示パネル１０８に出力する。図１の例では、画像処理ＬＳＩ１０２は、接続ケーブル１０６を介して、端部画像が切り取られた画像を表示パネル１０８に出力する。画像処理ＬＳＩ１０３は、接続ケーブル１０７を介して、端部画像が切り取られた画像を表示パネル１０８に出力する。
画像処理ＬＳＩ１０２，１０３の構成の詳細については後述する。
【００１８】
表示パネル１０８は、各画像処理ＬＳＩから入力された画像（端部画像が切り取られた画像；画像処理が施された分割領域の画像）を合成することにより、画像処理が施された元画像を生成する。そして、表示パネル１０８は、画像処理が施された元画像を表示する。表示パネル１０８は、例えば、液晶ディスプレイパネル、プラズマディスプレイパネル、有機ＥＬディスプレイパネルなどである。
なお、本実施例では、画像処理装置が表示パネル１０８を有する場合（画像処理装置が画像表示装置である場合）を例示したが、表示パネル１０８は画像処理装置とは別体の装置であってもよい。
【００１９】
図２を用いて、実施例１に係る入力画像（元画像）と分割画像の一例を説明する。
元画像２００は、画像再生装置１００から出力され画像表示装置１０９に入力される画像であり、ＨＤ以下のサイズの画像である。
符号２０１，２０２は、元画像２００を分割することにより得られる分割画像を示す。
マスタの画像処理ＬＳＩ（本実施例では画像処理ＬＳＩ１０２）は、元画像２００を、元画像２００の水平方向の中心位置Ｃから右側へ所定画素数分（端部画像２０３の水平方向の画素数分）ずらした位置で、左右に分割することにより、分割画像２０１を得る。元画像２００を、中心位置Ｃで左右に分割することにより得られる２つの画像（左画像２０５、右画像２０６）は、上述した分割領域の画像である。そのため、分割画像２０１は、左画像２０５に端部画像２０３が付加された画像となる。画像処理ＬＳＩ１０２は、表示パネル１０８の同期信号に同期して、分割画像２０１に画像処理を施す。ここで、表示パネル１０８の同期信号とは、例えば、表示パネル１０８のリフレッシュレート（表示パネル１０８が表示する画像を切り替えるタイミングを表す垂直同期信号）に同期した信号である。
画像処理ＬＳＩ１０２は、元画像２００を、中心位置Ｃから左側へ所定画素数分（端部画像２０４の水平方向の画素数分）ずらした位置で、左右に分割することにより、分割画像２０２を得る。分割画像２０２は、右画像２０６に端部画像２０４が付加された画像となる。画像処理ＬＳＩ１０２は、接続ケーブル１０５を介して分割画像２０２を画像処理ＬＳＩ１０３に転送する。その後、画像処理ＬＳＩ１０３は、表示パネル１０８の同期信号に同期して、分割画像２０１に画像処理を施す。
【００２０】
図３を用いて、画像処理ＬＳＩ１０２，１０３の構成の詳細を説明する。
画像処理ＬＳＩ１０２は、入力部３００、画像処理部３０１、出力部３０２、同期信号生成部３０３、フレームメモリ３０４、プロセッサ部３０５などを有する。
画像処理ＬＳＩ１０３は、画像処理ＬＳＩ１０２と同様に、入力部３２０、画像処理部３２１、出力部３２２、同期信号生成部３２３、フレームメモリ３２４、プロセッサ部３２５などを有する。
画像処理ＬＳＩ１０３の機能は、画像処理ＬＳＩ１０２の機能と同様のため、以下では、画像処理ＬＳＩ１０２の機能について説明し、画像処理ＬＳＩ１０３の機能については説明を省略する。
【００２１】
プロセッサ部３０５は、入力部３００への元画像の入力を検出する。プロセッサ部３０５は、入力部３００へ元画像が入力された場合に、自プロセッサ（画像処理ＬＳＩ１０２）をマスタ、他プロセッサ（画像処理ＬＳＩ１０３）をスレーブに設定する。
具体的には、プロセッサ部３０５は、ＰＣＩのＩ／Ｆを有しており、入力部３００へ画像が入力された場合に、接続ケーブル１０４を介してプロセッサ部３２５へスレーブ要求を出力する。プロセッサ部３２５は、入力部３２０へ画像が入力されていなければ、入力されたスレーブ要求を許可するＡＣＫ信号をプロセッサ部３０５へ出力する。プロセッサ部３０５は、ＡＣＫ信号を受信すると、元画像が入力部３００にのみ入力されていると判断し、画像処理ＬＳＩ１０２をマスタ、画像処理ＬＳＩ１０３をスレーブに設定する。
なお、両方の画像処理ＬＳＩに画像が入力されている場合には、例えば、マスタ、スレーブの設定は行われずに、各画像処理ＬＳＩが、それぞれ、入力された画像に対して画像処理を施す。
【００２２】
また、画像処理ＬＳＩ１０２がマスタに設定された場合に、プロセッサ部３０５は、画像処理ＬＳＩ１０２，１０３の各部のパラメータを設定する。プロセッサ部３０５は、例えば、元画像の垂直同期信号に同期して、パラメータを設定する。パラメータは、例えば、フレームメモリに対する分割画像の読み書きで使用するアドレスや、乱れた画像が入力された場合に、該乱れた画像を表示しないようにするためのパラメータなどである。プロセッサ部３０５は、接続ケーブル１０４を介して画像処理ＬＳＩ１０３の各部へパラメータを出力する。
【００２３】
入力部３００は、画像処理ＬＳＩ１０２がマスタに設定された場合に、入力部３００に入力された元画像を複数の分割画像に分割する。ここでは、図２に示す元画像２００が入力され、分割画像２０１，２０２が得られたとする。また、画像処理ＬＳＩ１０２の処理対象が分割画像２０１であり、画像処理ＬＳＩ１０３の処理対象が分割画像２０２であるものとする。
【００２４】
また、入力部３００は、ＰＣＩＥｘｐｒｅｓｓのＩ／Ｆを有する。そして、入力部３００は、画像処理ＬＳＩ１０２がマスタに設定された場合に、画像処理ＬＳＩ１０２，１０３で分割画像２０１，２０２の処理が並列に行われるように、接続ケーブル１０５を介して入力部３２０に分割画像２０２を出力する。
【００２５】
また、入力部３００は、ＤＭＡ（Direct Memory Access）機能を有する。そして、入力部３００は、画像処理ＬＳＩ１０２がマスタに設定された場合に、入力部３００が分割して得られた処理対象の分割画像２０１を、フレームメモリ３０４へ書き込む。具体的には、入力部３００は、フレームメモリ３０４内の、プロセッサ部３０５により設定された書き込みアドレスに、分割画像２０１を書き込む。
なお、画像処理ＬＳＩ１０３がマスタ、画像処理ＬＳＩ１０２がスレーブに設定された場合には、入力部３００は、入力部３２０から受信した分割画像を処理対象とし、処理対象の分割画像を、フレームメモリ３０４へ書き込む。このとき、分割画像を書き込むフレームメモリ３０４内のアドレス（書き込みアドレス）は、マスタである画像処理ＬＳＩ１
０３のプロセッサ部３２５により設定される。
【００２６】
そして、入力部３００は、表示パネル１０８の同期信号に同期してフレームメモリ３０４から処理対象の分割画像を読み出し、画像処理部３０１に出力する。具体的には、入力部３００は、フレームメモリ３０４内の、設定された読み出しアドレスから、処理対象の分割画像（本実施例では分割画像２０１）を読み出す。読み出しアドレスは、画像処理ＬＳＩ１０２がマスタに設定された場合には、プロセッサ部３０５により設定され、画像処理ＬＳＩ１０３がマスタ、画像処理ＬＳＩ１０２がスレーブに設定された場合には、プロセッサ部３２５により設定される。
なお、本実施例では、所定サイズ（例えばＨＤサイズ）の元画像が入力され、所定サイズの分割画像に分割されるものとする。そして、分割画像の書き込み及び読み出しに使用するデータ転送長は予め定められているものとする。
【００２７】
表示パネル１０８の同期信号は、同期信号生成部３０３または同期信号生成部３２３により生成される。例えば、画像処理ＬＳＩ１０２と画像処理ＬＳＩ１０３とに同じ同期信号に同期して処理を行わせるために、マスタの画像処理ＬＳＩの同期信号生成部が同期信号を生成する。そして、マスタの画像処理ＬＳＩの同期信号生成部は、同期信号線３３０を介して、スレーブの画像処理ＬＳＩの同期信号生成部へ生成した同期信号を出力する。
【００２８】
画像処理部３０１は、処理対象の分割画像に対して画像処理を施す。本実施例では、画像処理部３０１は、分割画像２０１に対して拡大処理を施す。そして、拡大処理が施された分割画像から端部画像（拡大処理が施された端部画像２０３）を切り取り、該端部画像が切り取られた画像を出力部３０２へ出力する。
出力部３０２は、画像処理部３０１から出力された画像（拡大処理が施された左画像２０５）を表示パネル１０８へ出力する。
【００２９】
図４を用いて、実施例１に係る画像処理装置（画像表示装置１０９）の、各種パラメータ（アドレス等）を設定するまでの処理フローの一例を説明する。なお、以下の処理は、常に行われてもよいし、ユーザ等により、入力された画像を分割処理するモードが設定されている場合にのみ行われてもよい。以下では、画像処理ＬＳＩ１０２に元画像が入力され、画像処理ＬＳＩ１０３には画像が入力されていない場合について説明する。
【００３０】
まず、プロセッサ部３０５は、入力部３００への画像の入力を検出すると、プロセッサ部３２５に対してスレーブ要求を送信する。
そして、プロセッサ部３２５は、入力部３２０への画像の入力が無いことを確認すると、プロセッサ部３０５にＡＣＫ信号を送信する。
次に、プロセッサ部３０５は、スレーブ要求に対するＡＣＫ信号を受信すると、入力された画像が分割処理対象の元画像であると判断する。そして、プロセッサ部３０５は、自プロセッサ（画像処理ＬＳＩ１０２）をマスタ、他プロセッサ（画像処理ＬＳＩ１０３）をスレーブに設定し、スレーブの画像処理ＬＳＩ１０３を制御する。
そして、マスタとなった画像処理ＬＳＩ１０２のプロセッサ部３０５は、入力部３００に元画像と共に入力される垂直同期信号を検出する毎に、分割画像２０１、分割画像２０２の書き込みアドレスと読み出しアドレスを入力部３００と入力部３２０に設定する。
また、マスタとなった画像処理ＬＳＩ１０２のプロセッサ部３０５は、元画像として乱れた画像（例えば、ノイズを所定量以上含んでいる画像）が入力されたことを検出した場合に、出力部３０２と出力部３２２に画像の出力を禁止するパラメータを設定する。それにより、表示パネル１０８に乱れた画像が表示されることが抑制される。
また、画像再生装置１００と画像表示装置１０９の接続の変更などにより、画像処理ＬＳＩ１０３に元画像が入力され、画像処理ＬＳＩ１０２に画像が入力されなくなることがある。その場合には、同様の処理により、画像処理ＬＳＩ１０３がマスタ、画像処理ＬＳ
Ｉ１０２がスレーブに設定される。
【００３１】
図５を用いて、書き込みアドレスと読み出しアドレスの計算方法について説明する。以下では、画像処理ＬＳＩ１０２がマスタ、画像処理ＬＳＩ１０３がスレーブに設定された場合について説明する。なお、画像処理ＬＳＩ１０３がマスタ、画像処理ＬＳＩ１０２がスレーブに設定された場合の処理は、画像処理ＬＳＩ１０２がマスタ、画像処理ＬＳＩ１０３がスレーブに設定された場合と同様のため、その説明は省略する。
【００３２】
まず、プロセッサ部３０５が、入力部３００に元画像と共に入力される垂直同期信号（入力ＶＳ）を検出する（Ｓ１）。元画像の垂直同期信号が検出されると、Ｓ２へ処理が進められる。
【００３３】
Ｓ２では、プロセッサ部３０５が、分割画像２０１と分割画像２０２をフレームメモリ３０４とフレームメモリ３２４にそれぞれ書き込むための書き込みアドレスを算出する際に使用するライトポインタＷｐに１を加算する。
ポインタは、特定のメモリ領域を表現する論理的位置情報である。ライトポインタは、画像の書き込み領域を表現する論理的位置情報である。
フレームメモリには、フレームメモリの格納領域のデータサイズを１フレーム当たりの分割画像のデータサイズで分割した数の分割画像を格納することができる。そのため、ライトポインタの値は、フレームメモリに格納可能な数と等しい値となると、その次には０にリセットされる。例えば、フレームメモリに格納できる分割画像の数が４の場合には、ライトポインタは０から３まで１ずつ増やされた後に、０にリセットされる。
【００３４】
次に、プロセッサ部３０５が、分割画像２０１と分割画像２０２をフレームメモリ３０４とフレームメモリ３２４からそれぞれ読み出すための読み出しアドレスを算出する際に使用するリードポインタＲｐに１を加算する（Ｓ３）。
リードポインタは画像の読み出し領域を表現する論理的位置情報である。
リードポインタの値は、ライトポインタの値と同様に、フレームメモリに格納可能な数と等しい値となると、その次には０にリセットされる。
なお、Ｓ３の処理の後にＳ２の処理が行われてもよい。
【００３５】
そして、プロセッサ部３０５は、ライトポインタとリードポインタを用いて、入力部３００と入力部３２０に設定する書き込みアドレスと読み出しアドレスを算出する（Ｓ４）。
書き込みアドレス（ＤＭＡＷｒ）は、フレームメモリのデータ格納位置（分割画像を格納する位置）の基準となるベースアドレス（ＤＭＡｂ）、１フレーム分の記憶領域（１フレーム分の分割画像のデータサイズ；ＤＭＡ＿ＡＬＩＧＮ）、ライトポインタ（Ｗｐ）を用いて以下の式により算出することができる。
ＤＭＡＷｒ  ＝  ＤＭＡｂ  ＋  Ｗｐ  ×  ＤＭＡ＿ＡＬＩＧＮ
読み出しアドレス（ＤＭＡＲｄ）も同様に、ＤＭＡｂ、ＤＭＡ＿ＡＬＩＧＮ、リードポインタ（Ｒｐ）を用いて以下の式により算出することができる。
ＤＭＡＲｄ  ＝  ＤＭＡｂ  ＋  Ｒｐ  ×  ＤＭＡ＿ＡＬＩＧＮ
【００３６】
次に、プロセッサ部３０５は、画像処理ＬＳＩ１０２の入力部３００にＳ４で算出したＤＭＡＷｒとＤＭＡＲｄを設定する（Ｓ５）。
そして、プロセッサ部３０５は、接続ケーブル１０４を介して、画像処理ＬＳＩ１０３
の入力部３２０にＳ４で算出したＤＭＡＷｒとＤＭＡＲｄを設定する（Ｓ６）。
なお、Ｓ６の処理の後にＳ５の処理が行われてもよい。
【００３７】
次に、プロセッサ部３０５は、処理を終了するか否かを判断する（Ｓ７）。処理を続ける場合には、Ｓ１へ処理が戻され、処理を終了する場合には本フローが終了される。Ｓ７では、例えば、画像処理装置の電源がオフされた場合や、ユーザにより元画像の分割処理の中断が指示された場合などに、処理を終了すると判断される。
【００３８】
以上述べたように、本実施例によれば、マスタの画像処理プロセッサが複数の分割画像の生成し、複数の分割画像を複数の画像処理プロセッサに振り分ける。その後、複数の画像処理プロセッサで複数の分割画像に対する画像処理が並列に行われる。このように、スレーブの画像処理プロセッサには元画像は入力されないため、元画像が入力される１つの入力端子をスレーブの画像処理ＬＳＩに接続する配線を設ける必要はない。そのため、配線数や回路規模の増大を招くことなく元画像を分割処理することが可能となる。
また、本実施例によれば、複数の画像処理プロセッサのうち、元画像が入力された画像処理プロセッサがマスタ、それ以外の画像処理プロセッサがスレーブに設定される。このように、マスタとなる画像処理プロセッサは固定ではないため、元画像を確実に分割処理することが可能となる。
【００３９】
なお、本実施例では、元画像を、サイズが互いに等しい複数の分割画像に分割する場合の例を示したが、複数の分割画像のサイズは互いに異なっていてもよい。但し、複数の分割画像のサイズを互いに等しくすれば、複数の画像処理プロセッサの処理負荷を均一にすることができ、効率的に元画像を分割処理することができる。
なお、本実施例では、画像処理プロセッサの数が２つの場合の例を示したが、画像処理プロセッサの数は２つに限らない。画像処理プロセッサの数は２つより多くてもよい（例えば、３つ、４つなど）。
なお、本実施例では、元画像を左右に分割する場合の例を示したが、元画像の分割方法はこれに限らない。例えば、元画像は上下に分割されてもよいし、マトリクス状に分割されてもよい。
なお、本実施例では、元画像の分割と、他の画像処理ＬＳＩへの分割画像の出力とを１つの機能（入力部）が行うものとしたが、それぞれの処理は互いに異なる機能部により行われてもよい。
なお、本実施例では、元画像のサイズがＨＤサイズ以下の場合の例を説明したが、元画像のサイズはＨＤサイズより大きくてもよい。
なお、本実施例では、元画像を画像処理プロセッサの数と同じ数の分割画像に分割する場合の例を示したが、画像処理プロセッサの数と分割画像の数は同じでなくてもよい。分割画像の数は画像処理プロセッサの数より少なくてもよいし、多くてもよい。元画像を画像処理プロセッサの数より少ない数の分割画像に分割する場合には、一部の画像処理プロセッサを用いて元画像を分割処理すればよい。また、元画像を画像処理プロセッサの数より多い数の分割画像に分割した場合には、１つの画像処理プロセッサに複数の分割画像を処理させればよい。例えば、画像処理プロセッサの数が２、分割画像の数が３の場合には、一方の画像処理プロセッサに２つの分割画像を処理させ、他方の画像処理プロセッサに１つの分割画像を処理させればよい。分割画像の数は、元画像のサイズに応じて変更されてもよい。例えば、分割画像のサイズが、画像処理プロセッサで処理可能なサイズの最大値となるように、元画像を複数の分割画像に分割してもよい。その場合、大まかには、分割画像の数は、元画像のサイズを上記最大値で割った数となる。
【００４０】
＜実施例２＞
以下、本発明の実施例２に係る画像処理装置及びその制御方法について説明する。実施例１で述べたように、元画像を、サイズが互いに等しい複数の分割画像に分割することが
好ましい。入力される元画像のサイズが常に一定であれば、所定の位置で元画像を分割することにより、元画像を、サイズが互いに等しい複数の分割画像に分割することができる。しかし、入力される元画像のサイズは一定とは限らない。例えば、元画像として、ＨＤサイズの画像が入力されることもあれば、ＶＧＡ（Video Graphics Array）などＨＤサイズよりも小さいサイズの画像が入力されることもある。本実施例では、どのようなサイズの元画像が入力された場合にも、元画像を、サイズが互いに等しい複数の分割画像に分割することのできる構成について説明する。なお、実施例１と同様の構成等については、説明を省略する。
【００４１】
本実施例では、画像処理ＬＳＩにおいて、自プロセッサ（自ＬＳＩ）に入力された元画像のサイズを検出する検出処理が行われる。そして、入力部は、自ＬＳＩがマスタに設定された場合に、上記検出処理の検出結果に基づいて、元画像を、サイズが互いに等しい複数の分割画像に分割する。
なお、本実施例では、上記検出処理を入力部が行うものとするが、上記検出処理は入力部以外の機能部が行ってもよい。画像処理ＬＳＩは、図３に示す機能部以外に、上記検出処理を行う機能部を更に有していてもよい。
【００４２】
図６を用いて、実施例２に係る画像処理装置（画像表示装置１０９）の、各種パラメータ（アドレス等）を設定するまでの処理フローの一例を説明する。なお、以下の処理は、常に行われてもよいし、ユーザ等により、入力された画像を分割処理するモードが設定されている場合にのみ行われてもよい。以下では、図３の画像処理ＬＳＩ１０３に元画像が入力され、画像処理ＬＳＩ１０２には画像が入力されていない場合について説明する。
【００４３】
まず、入力部３２０は、入力部３２０への画像の入力を検出すると、当該入力された画像のサイズを検出する。具体的には、入力部３２０は、入力された画像の水平方向の画素数と、ライン数（垂直方向の画素数）とをカウントする。入力部３２０は、サイズの検出結果（検出した水平方向の画素数とライン数）を、プロセッサ部３２５へ出力する。そして、プロセッサ部３２５は、複数の分割画像のサイズが互いに等しくなるように、各分割画像を得るための画像の分割位置を決定する。例えば、入力された画像を左右２つの分割画像に分割する場合には、プロセッサ部３２５は、上記検出結果から、入力された画像の水平方向の中心位置Ｃを検出する。プロセッサ部３２５は、中心位置Ｃから所定画素数（端部画像の水平方向の画素数）だけ右側の位置を、左側の分割画像（図２の分割画像２０１）を得るための分割位置とする。そして、プロセッサ部３２５は、中心位置Ｃから所定画素数だけ左側の位置を、右側の分割画像（図２の分割画像２０２）を得るための分割位置とする。なお、端部画像を付加しない場合（分割領域の画像を分割画像として得る場合）には、上記中心位置Ｃを左右２つの分割画像を得るための分割位置とすればよい。
【００４４】
次に、プロセッサ部３２５は、プロセッサ部３０５に対してスレーブ要求を送信する。
そして、プロセッサ部３０５は、入力部３００への画像の入力が無いことを確認すると、プロセッサ部３２５にＡＣＫ信号を送信する。
次に、プロセッサ部３２５は、スレーブ要求に対するＡＣＫ信号を受信すると、入力された画像が分割処理対象の元画像であると判断する。そして、プロセッサ部３２５は、自プロセッサ（画像処理ＬＳＩ１０３）をマスタ、他プロセッサ（画像処理ＬＳＩ１０２）をスレーブに設定し、スレーブの画像処理ＬＳＩ１０２を制御する。
そして、マスタとなった画像処理ＬＳＩ１０３のプロセッサ部３２５は、元画像のサイズと、決定した分割位置とに基づいて、フレームメモリに対する分割画像の読み書きで使用するデータ転送長を入力部３００と入力部３２０に設定する。例えば、プロセッサ部３２５は、元画像のサイズと、決定した分割位置とから、分割画像のサイズを判断する。そして、プロセッサ部３２５は、判断結果に基づいてデータ転送長を決定し、決定したデータ転送長を入力部３００と入力部３２０に設定する。
次に、マスタとなった画像処理ＬＳＩ１０３のプロセッサ部３２５は、入力部３２０に元画像と共に入力される垂直同期信号を検出する毎に、分割画像２０１、分割画像２０２の書き込みアドレスと読み出しアドレスを入力部３００と入力部３２０に設定する。
また、マスタとなった画像処理ＬＳＩ１０３のプロセッサ部３２５は、元画像として乱れた画像（例えば、ノイズを所定量以上含んでいる画像）が入力されたことを検出した場合に、出力部３０２と出力部３２２に画像の出力を禁止するパラメータを設定する。それにより、表示パネル１０８に乱れた画像が表示されることが抑制される。
また、画像再生装置１００と画像表示装置１０９の接続の変更などにより、画像処理ＬＳＩ１０２に元画像が入力され、画像処理ＬＳＩ１０３に画像が入力されなくなることがある。その場合には、同様の処理により、画像処理ＬＳＩ１０２がマスタ、画像処理ＬＳＩ１０３がスレーブに設定される。
【００４５】
以上述べたように、本実施例によれば、入力された元画像のサイズが検出され、検出されたサイズを用いて元画像が複数の分割画像に分割される。それにより、どのようなサイズの元画像が入力される場合であっても、元画像を、サイズが互いに等しい複数の分割画像に分割することができる。
なお、上記検出処理は、自ＬＳＩがマスタに設定された場合にのみ行われてもよい。
なお、画像のサイズを示す情報が、画像のメタデータとして入力される場合には、該メタデータを使用して分割位置が決定されてもよい。
【符号の説明】
【００４６】
１０２，１０３  画像処理ＬＳＩ
１０９  画像表示装置
３００，３２０  入力部
３０１，３２１  画像処理部
３０５，３２５  プロセッサ部
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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