(57)【要約】【課題】低出力信号レベル時のキャリアリークを抑制し、高出力信号レベル時の消費電流を抑えるキャリアリーク抑圧回路を提供する。【解決手段】本発明のキャリアリーク抑圧回路は、分周器回路(DIV回路)と分周器回路の出力信号が入力されるローカルバッファアンプ(LoAmp)とローカルバッファアンプの出力信号が入力される直交変調器で構成される直交変調ブロックと、前記直交変調ブロックの出力信号が入力されるGCA回路、およびGCA回路から出力される信号レベルを検出する検出回路を備える。前記検出回路で検出された出力信号レベルに応じて、DIV回路およびLoAmp回路の利得を制御することにより、キャリアリークの抑圧を行う。【選択図】図１
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【特許請求の範囲】
【請求項１】
分周器回路(DIV回路)とDIV回路の出力信号が入力されるローカルバッファアンプ回路(LoAmp回路)とLoAmp回路の出力信号が入力される直交変調器で構成される直交変調ブロックと、前記直交変調ブロックの出力信号が入力されるGCA回路、およびGCA回路から出力される信号レベルを検出する検出回路を備え、前記検出回路で検出された出力信号レベルが、あらかじめ設定しておいた所定値P2以上であるとき、前記直交変調ブロックを構成するDIV回路およびLoAmp回路の利得を調整する制御回路に、前記検出回路より一定の制御信号を出力し、また、前記検出回路で検出された出力信号レベルが、あらかじめ設定しておいた所定値P1以下で前記検出回路より一定の制御信号を前記制御回路に出力し、また、前記検出回路で検出された出力信号レベルが、あらかじめ設定しておいた所定値P1以上P2以下であるときに、前記検出回路より一定の傾きを持つ制御信号を前記制御回路に出力することで、前記直交変調ブロックを構成するDIV回路およびLoAmp回路の利得を制御することを特徴とするキャリアリーク抑圧回路。
【請求項２】
請求項１に記載の直交変調ブロックを構成する分周器回路の利得のみを調整する制御回路を有することを特徴とするキャリアリーク抑圧回路。
【請求項３】
請求項１に記載の直交変調ブロックを構成するローカルバッファアンプ回路の利得のみを調整する制御回路を有することを特徴とするキャリアリーク抑圧回路。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、ベースバンド信号を直接送信信号へ変換するダイレクトコンバージョン送信装置に関し、特にキャリアリーク抑圧回路に関するものである。
【背景技術】
【０００２】
近年、移動体通信の分野において、通信品質の向上が重要となっている。この通信品質の確保のためにはキャリアリークの抑圧は必須の課題である。
【０００３】
図５は従来のキャリアリーク抑圧機能を備えたダイレクトコンバージョン送信装置を説明する図である。
【０００４】
DIV回路１１１には、所定周波数の信号がLoinより入力される。
【０００５】
DIV回路１１１では、利得制御信号Vcntにより、制御回路２（１１６）において生成される利得制御電圧Vcnt2が入力される。図６にDIV回路の利得G1を示す。DIV回路の利得は、利得制御電圧Vcnt2に基づいて変化する。
【０００６】
DIV回路１１１より出力されるキャリア信号は、MOD回路１１３においてベースバンド信号であるIQ信号とミキシングされ、GCA回路１１４へ出力される。
【０００７】
GCA回路では、利得制御信号Vcntにより、制御回路１（１１５）において生成される利得制御電圧Vcnt1が入力される。図６にGCA回路の利得G2を示す。GCA回路の利得は、利得制御電圧Vcnt1に基づいて変化する。
【０００８】
図６に示すように、TXoutに出力される総合利得は、G1とG2を足し合わせたG3となる。
【０００９】
DIV回路から出力される出力周波数成分がキャリアリーク成分として一定レベル、出力信号TXoutに漏れこむが、DIV回路の利得を制御回路２において生成される利得制御電圧Vcnt2で調整することで、低出力信号レベル時にキャリアリーク成分と出力信号レベルの差を一定としている。
【特許文献１】特開２００２−１８５５４７号公報
【発明の開示】
【発明が解決しようとする課題】
【００１０】
従来例では、利得制御信号Vcntが高くなった場合に、利得制御電圧Vcnt2も高くなる。キャリアリークの抑圧に関しては、特に出力信号レベルが低い時に、キャリアリーク成分と出力信号レベルとの差が小さくなることが問題となることから、ある一定の値以上の出力信号レベル時にはDIV回路の利得は一定でよく、DIV電流を一定とすることで低消費電流化を図ることができる。
【００１１】
よって、本発明の目的は、所定の出力信号レベル時を越えた時点でDIV回路の利得を一定とすることで、低出力信号レベル時のキャリアリークを抑制し、高出力信号レベル時の消費電流を抑えることである。
【課題を解決するための手段】
【００１２】
前記の目的を達成するための本発明のキャリアリーク抑圧回路は、図１に示すように、分周器回路(DIV回路)とDIV回路の出力信号が入力されるローカルバッファアンプ回路(LoAmp回路) とLoAmp回路の出力信号が入力される直交変調器で構成される直交変調ブロックと、前記直交変調ブロックの出力信号が入力されるGCA回路、およびGCA回路から出力される信号レベルを検出する検出回路を備える。
【００１３】
前記検出回路で検出された出力信号レベルが、あらかじめ設定しておいた所定値P2以上であるとき、前記直交変調ブロックを構成するDIV回路およびLoAmp回路の利得を調整する制御回路に、前記検出回路より一定の制御信号を出力し、また、前記検出回路で検出された出力信号レベルが、あらかじめ設定しておいた所定値P1以下で前記検出回路より一定の制御信号を前記制御回路に出力し、また、前記検出回路で検出された出力信号レベルが、あらかじめ設定しておいた所定値P1以上P2以下であるときに、前記検出回路より一定の傾きを持つ制御信号を前記制御回路に出力することで、前記直交変調ブロックを構成するDIV回路およびLoAmp回路の利得を制御する。
【発明の効果】
【００１４】
本発明によれば、出力信号レベルを検出することで、一定のレベル以下においてDIV回路の利得を下げることにより、キャリアリークの抑圧が可能となり、一定のレベル以上でDIV回路の利得を一定にすることにより、消費電流の削減を行うことが可能となる。
【発明を実施するための最良の形態】
【００１５】
（第１の実施形態）
以下、本発明の第１の実施形態に係るキャリアリーク抑圧回路について図を参照しながら説明する。
【００１６】
図１は出力信号レベルを検出する検出回路および制御回路を含むブロック構成図である。この実施形態は、DIV回路１１１およびLoAmp回路１１２の出力振幅を制御回路１０１により調整するもので、制御回路１０１は検出回路１００により制御される。
【００１７】
検出回路１００はGCA回路１１４から出力される出力信号レベルにより、制御信号Vdを生成し、制御回路１０１では、制御信号Vdに基づいた制御信号VcntをDIV回路１１１およびLoAmp回路１１２に出力する。
【００１８】
DIV回路１１１の具体的構成を図２に従って説明する。DIV回路１１１の回路はマスター段のラッチ回路と、スレーブ段のラッチ回路とからなるフリップフロップ回路で構成され、各ラッチ回路は、電流源１２１を介してGNDに接地される。
【００１９】
電流源回路１２１には、制御回路１０１で生成された制御信号Vcntが入力される。この制御信号Vcntに基づいて電流源１２１の電流を制御することにより、DIV回路１１１の出力I,IX,Q,QXの信号レベルを制御可能としている。
【００２０】
次に、LoAmp回路１１２の具体的構成を図３に従って説明する。LoAmp回路１１２の回路は２組の差動回路で構成され、それぞれ電流源１３１を介してGNDに接地している。電流源１３１には、制御回路１０１で生成された制御信号Vcntが入力される。この制御信号Vcntに基づいて電流源１３１の電流を制御することにより、LoAmp回路１１２の出力Iout,IXout,Qout,QXoutの信号レベルを制御可能としている。
【００２１】
上記の構成において、検出回路１００から出力される制御信号Vdは図４に示すように、前記検出回路１００が検出する出力信号レベルがP2以上で一定値となり、またPo1以下で一定値となりPo1以上、Po2以下で一定の傾きを持つ制御信号を出力する。
【００２２】
（第２の実施形態）
本発明の第２の実施形態では、前記制御回路から出力される制御信号VcntをDIV回路のみに出力すること以外は第１の実施形態と同様の構成である。
【００２３】
（第３の実施形態）
本発明の第３の実施形態では、前記制御回路から出力される制御信号VcntをLoAmp回路のみに出力すること以外は第１の実施形態と同様の構成である。
【図面の簡単な説明】
【００２４】
【図１】第１の実施形態を示すブロック構成図
【図２】DIV回路を示す回路図
【図３】LoAmp回路を示す回路図
【図４】検出回路から出力される制御信号を説明する図
【図５】従来例を示す回路図
【図６】従来例の出力信号レベルと利得を説明する図
【符号の説明】
【００２５】
１００  検出回路
１０１、１１５、１１６  制御回路
１１１  分周器
１１２  ローカルバッファアンプ
１１３  直交変調器
１１４  ゲインコントロールアンプ
１２１、１３１  電流源
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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