(57)【要約】【課題】画像信号等から発生するノイズによるロジック制御信号への影響を除去し、誤動作による画質の低下を防止可能な反射型液晶表示装置を提供する。【解決手段】水平走査シフトレジスタ回路１或いは垂直走査シフトレジスタ回路２のロジック制御信号の入力段にノイズ除去回路１２を搭載し、ノイズ除去回路１２を介して水平走査シフトレジスタ回路１或いは垂直装置シフトレジスタ回路２にロジック制御信号を入力する。ノイズ除去回路１２には、トランジスタで構成されたシュミットバッファ回路を用いる。【選択図】図１
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【特許請求の範囲】
【請求項１】
同一半導体基板上に、行及び列方向に配置された複数の画素領域と、前記画素領域に接続された走査回路とが設けられ、前記画素領域を構成する画素は反射電極と前記反射電極に接続されたスイッチング素子を含む反射型液晶表示装置において、
前記同一半導体基板上のロジック制御信号の入力部と前記走査回路の間にノイズ除去回路を搭載し、前記ノイズ除去回路を介して前記ロジック制御信号を前記走査回路に入力することを特徴とする反射型液晶表示装置。
【請求項２】
前記ノイズ除去回路は、シュミットバッファ回路であることを特徴とする請求項１に記載の反射型液晶表示装置。
【請求項３】
前記半導体基板は、シリコン基板であることを特徴とする請求項１に記載の反射型液晶表示装置。
【請求項４】
前記走査回路は、前記行方向のスイッチング素子の制御端子に出力信号を入力するため垂直走査回路と、前記列方向のスイッチング素子の入力端子に画像信号が入力するため水平走査回路と、を含み、前記ノイズ除去回路を介して前記ロジック制御信号を前記垂直走査回路及び前記水平走査回路に入力することを特徴とする請求項１から３のいずれか１項に記載の反射型液晶表示装置。
【請求項５】
前記画像信号はサンプリング回路によって画像信号線からサンプリングされ、前記サンプリング回路の制御端子には前記水平走査回路の出力信号が入力されることを特徴とする請求項４に記載の反射型液晶表示装置。
【請求項６】
前記入力部は、前記半導体基板の一部に集中して設けられ、画像信号及び前記ロジック制御信号を伝送するためのフレキシブル配線と接続されている請求項１から５のいずれか１項に記載の反射型液晶表示装置。
【請求項７】
前記画像信号は、反転駆動用の画像信号であることを特徴とする請求項６に記載の反射型液晶表示装置。
【請求項８】
同一半導体基板上に、行及び列方向に配置された複数の画素領域と、前記画素領域に接続された走査回路とが設けられ、前記画素領域を構成する画素は反射電極と前記反射電極に接続されたスイッチング素子を含む反射型液晶表示装置用のアクティブマトリクス基板において、
前記同一半導体基板上のロジック制御信号の入力部と前記走査回路の間にノイズ除去回路を搭載し、前記ノイズ除去回路を介して前記ロジック制御信号を走査回路に入力することを特徴とするアクティブマトリクス基板。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、プロジェクタ等に用いるアクティブマトリックス型の反射型液晶表示装置、特に、同一基板上に駆動回路と表示部とを有する駆動回路一体型の液晶表示装置に好適な技術に関するものである。
【背景技術】
【０００２】
近年、液晶を用いた表示装置は、小型表示装置としてＯＡ機器等の表示端末用として広く普及している。特に、５０インチ以上の画像表示に液晶を使用する場合、直接液晶画面を用いることは困難であり、小型軽量の特徴を利用しながら液晶画面を拡大投影する液晶表示装置（プロジェクタ）が有利である。かかる液晶画面の駆動方式には、マトリックス配線だけを使って駆動する単純マトリックス方式と、画素毎にスイッチングトランジスタを設けたアクティブマトリックス方式がある。
【０００３】
液晶プロジェクタは、光源からの照明光を液晶パネルに照射し、液晶パネルの画像をスクリーンに投影するものである。液晶プロジェクタには、透過型と反射型があるが、液晶パネルに反射型を用いた場合、画素電極を反射電極とし、画素電極の下部に配線や素子を配置することができる。そのため、表示部のほぼ全域を有効な反射面として用いることができるので、液晶パネルの小型化、高精細化、高輝度化において透過型に対して比較的有利である。
【０００４】
更に、走査回路等の駆動回路と画素電極が同一の半導体基板上に形成された駆動回路一体型の反射型液晶表示装置（Ｌｉｑｕｉｄ  Ｃｒｙｓｔａｌ  ｏｎ  Ｓｉｌｉｃｏｎ、以下ＬＣＯＳと呼ぶ）が知られている。
【０００５】
また、液晶表示装置において、液晶層に印加する電圧の極性を周期的に反転させる交流化駆動が行われている。交流化駆動を行う目的は、直流電圧が液晶に印加され続け、焼きつき等による画質の劣化を防止する為である。画素電極と基準電極（共通電極）との間に電圧を印加するアクティブマトリックス型液晶表示装置において、交流化駆動を行う一つの方法として、基準電極に定電圧を印加し、画素電極に正極性、負極性の画像信号電圧を交互に印加する方法がある。特に、フィールド毎にその極性を反転させて駆動することをフィールド反転駆動とも呼ぶ。
【０００６】
図６は従来例のアクティブマトリックス型液晶表示装置の回路図を示す。垂直走査シフトレジスタ回路２（ＶＳＲ）には、ＶＳＲ用転送クロックＶＣＫと、ＶＳＲ用スタートパルスＶＳＴが入力され、ＶＳＲ２の出力により所望のゲート線７がＨｉレベルとなり、各画素３のスイッチングトランジスタ８がＯＮ状態になる。
【０００７】
画像信号はＶＤ端子よりビデオ線５に入力される。水平走査シフトレジスタ回路１（ＨＳＲ）には、ＨＳＲ用転送クロックＨＣＫとＨＳＲ用スタートパルスＨＳＴが入力される。そして、ＨＳＲ１の出力タイミングで転送スイッチ４を順次ＯＮ状態にし、画像信号をサンプリングして信号線６に伝送し、各画素のスイッチングトランジスタ８を介して画像信号電圧を保持容量９に書き込む。保持容量９の対向電極は、定電位ＶｃｏｍＣＰに接続されているが、ＧＮＤレベルであっても構わない。
【０００８】
保持容量９に書き込まれた電圧と基準電極（共通電極）電圧ＶｃｏｍＬＣとの間に液晶１０を配置し、電位差を印加することで液晶の光学的特性（配向）を変化させて画像を表現することができる。なお、基準電極電圧ＶｃｏｍＬＣを印加する電極は駆動回路を形成する同一半導体基板上には存在せず、液晶を挟む透明電極で構成されていることが殆どで、この透明電極より電圧が供給される。
【０００９】
なお、以上のような反射型液晶表示装置は、例えば、特許文献１に記載されている。
【特許文献１】特開２００３−３４４８２４号公報
【発明の開示】
【発明が解決しようとする課題】
【００１０】
液晶表示装置において、先述した通り、焼きつき等による画質の劣化を防止する為に反転駆動することが行われている。図７はフィールド反転駆動した場合の画像信号の一例を示す。横軸は時間、縦軸は電圧である。
【００１１】
図７に示すように基準電圧ＶｃｏｍＬＣを中心に、ａ期間ではＶｃｏｍＬＣ電圧より大きい画像信号電圧になり、この期間を正フィールドとする。また、ｂ期間ではＶｃｏｍ電圧より小さい画像信号電圧になり、この期間を負フィールドとすると、フィールド毎に基準電圧ＶｃｏｍＬＣを中心に上下線対称の形を取る。
【００１２】
ここで、画像信号電圧について考えると、液晶の光学的特性（配向）を十分変化させる為には、基準電圧ＶｃｏｍＬＣと画像信号電圧の電位差は、一般的に５Ｖ程度必要になる。従って、基準電圧ＶｃｏｍＬＣを６Ｖとすると画像信号の電圧範囲は１〜１１Ｖとなる。特に、図７に示す波形の場合、各フィールドの最初と最後に、液晶に印加する電圧が最大になるような画像があると、正フィールドから負フィールド或いは負フィールドから正フィールドに切り換える時には１０Ｖの電位変動が起こる。
【００１３】
また、近年のロジック系ＩＣの電源電圧は、５Ｖから３Ｖ、更に３Ｖから２．５Ｖと言うように低電圧化が進んでいる。そのため、液晶パネルに入力される制御信号（ロジック制御信号）も低電圧化に対応することが、システムでの信号伝送経路上にレベル変換回路を不要とし、システム構成の簡略化、コストダウン化に繋がる。
【００１４】
従って、同一半導体基板上でロジック系の３Ｖ信号に対し、画像信号が１〜１１Ｖの範囲で激しく変動すると、これがノイズ源となってロジック制御信号にノイズが重畳され、液晶パネルの誤動作を招き、画質を著しく低下させる要因ともなりうる。
【００１５】
即ち、このことは、ロジック制御信号の電圧が小さくなればなるほど画像信号からの影響を受けやすくなることを意味する。ノイズが重畳する要因として、フレキシブル配線上で画像信号線と制御信号線との間の結合容量や、シリコン基板内の入力部のロジック系電源配線と画像信号配線との間の結合容量等が考えられる。
【００１６】
従来の駆動回路の入力部はインバータ等のロジックゲートで受けているので、ノイズが重畳された制御信号が入力されると、本来の信号と同時にノイズも波形成形されるため、チャタリングのある制御信号に基づいて駆動回路が動作する。
【００１７】
図８はノイズが重畳されたロジック制御信号の一例を示す。入力信号にロジック回路のしきい値電圧（例えばＶｄｄ／２の電圧）を超えるノイズが重畳されると、液晶パネル内部のロジック回路は図８の内部信号１で示すように波形成形する。そのため、ノイズ分も正規の信号の一部であるかのように基板内部の駆動回路部に伝送してしまう。
【００１８】
例えば、図６のＨＣＫ信号にノイズが加わると、転送スイッチのＯＮタイミングが外れる、即ち、違う画素の画像信号をサンプリングすることになる。また、ＨＳＴ信号にノイズが加わると、複数の転送スイッチが同時にＯＮすることになる。更に、ＶＣＫ信号にノイズが加わると、水平走査途中で次の行の画素に電圧を書き込むことになる等、何れも画質を著しく低下させる原因になる。
【００１９】
なお、画素部がＮＭＯＳトランジスタで構成されている場合、１１Ｖの画像信号を保持電極に書き込む為には、画素部のＮＭＯＳトランジスタのゲート電圧はバックゲート効果を考えて１５Ｖ程度の電圧を印加する必要がある。故に、画素部のＮＭＯＳトランジスタのゲートを駆動するバッファ回路の電源電圧は１５Ｖ程度必要になる。
【００２０】
ＬＣＯＳのような反射型液晶パネルにおいては、同一シリコン基板上及び基板に接続されたフレキシブル配線にロジック制御信号のように低電圧振幅（約３Ｖ或いはそれ以下）で信号を伝送する系がある。また、画像信号のように高電圧振幅（１０Ｖ以上）で信号を伝送する系が共存しており、その電圧差が約１０Ｖ以上にもなる半導体デバイスにおいては、高電圧の信号変化が及ぼす影響を無視することはできない。そのため、等価回路だけでは説明できない寄生素子にも注意して、信号配線や画像信号線及び電源配線のレイアウトを行った上でノイズ対策を施す必要がある。
【００２１】
本発明の目的は、画像信号等から発生するノイズによるロジック制御信号への影響を除去し、誤動作による画質の著しい低下を防止することが可能な反射型液晶表示装置を提供することにある。
【課題を解決するための手段】
【００２２】
本発明は、同一半導体基板上に、行及び列方向に配置された複数の画素領域と、前記画素領域に接続された走査回路とが設けられ、前記画素領域を構成する画素は反射電極と前記反射電極に接続されたスイッチング素子を含む反射型液晶表示装置において、前記同一半導体基板上のロジック制御信号の入力部と前記走査回路の間にノイズ除去回路を搭載し、前記ノイズ除去回路を介して前記ロジック制御信号を走査回路に入力することを特徴とする。ノイズ除去回路には、例えば、トランジスタで構成されたシュミットバッファ回路を用いる。
【発明の効果】
【００２３】
本発明によれば、ロジック制御信号の入力部にノイズ除去回路を搭載することにより、画像信号の電圧変動等によって発生するノイズによって駆動回路の誤動作を防止することができ、著しい画質の低下を防ぐことができる。また、ノイズ除去回路としてトランジスタで構成されたシュミットバッファ回路を用いることにより、シュミットバッファ回路を同一半導体基板上に形成できるため、コスト高に繋がらず、効果的にノイズを除去することが可能となる。
【発明を実施するための最良の形態】
【００２４】
図１は本発明に係る反射型液晶表示装置の一実施形態を示す回路図である。図１では図６の従来装置と同一部分には同一符号を付している。図６との違いは水平走査シフトレジスタ回路１（ＨＳＲ）の信号の入力段及び垂直走査シフトレジスタ回路２（ＶＳＲ）の信号の入力段にそれぞれノイズ除去回路を設けた点である。ノイズ除去回路には、例えば、シュミットバッファ回路１２を用いている。
【００２５】
図中１は水平走査シフトレジスタ回路、２は垂直走査シフトレジスタ回路、３は画素回路である。４は転送スイッチであり、水平走査シフトレジスタ回路１の出力信号に従ってＶＤ端子から入力される画像信号を伝送するビデオ線５から画像信号をサンプリングし、信号線６への画像信号の伝送を制御する。
【００２６】
７ａ、７ｂは垂直走査シフトレジスタ回路２の出力（以下ゲート線と呼ぶ）であり、同行の画素回路３を構成するＮＭＯＳトランジスタ８の全てのゲートに接続されている。同列の画素回路３を構成するＮＭＯＳトランジスタ８のソース（或いはドレイン）は、信号線６に接続されており画像信号の入力端子として機能する。また、ＮＭＯＳトランジスタ８のドレイン（或いはソース）は、画像信号電圧を保持する保持容量９の一端と液晶１０に電圧を印加する為の反射電極に接続されている。
【００２７】
保持容量９の他端は、定電圧ＶｃｏｍＣＰに接続されている。液晶１０の他端は全画素共通の基準電圧ＶｃｏｍＬＣに接続されているが、基準電圧ＶｃｏｍＬＣの電極はシリコン基板上に形成されるものではなく、液晶１０を挟む透明電極に形成されている。
【００２８】
また、１２はシュミットバッファ回路であり、ノイズ除去回路として設けられている。ＨＣＫ（水平走査シフトレジスタ用転送クロック信号）、ＨＳＴ（水平走査シフトレジスタ用スタート信号）は、シュミットバッファ回路１２を介して水平走査シフトレジスタ回路１に入力される。
【００２９】
また、ＶＣＫ（垂直走査シフトレジスタ用転送クロック信号）、ＶＳＴ（垂直走査シフトレジスタ用スタート信号）は、同様にシュミットバッファ回路１２を介して垂直走査シフトレジスタ回路２に入力される。
【００３０】
なお、図１では全画素共通の定電圧ＶｃｏｍＣＰになっているが、ＧＮＤであっても構わないし、或いは各行毎或いは各列毎に分離して接続し、所望の電位を与えても構わない。これら水平走査シフトレジスタ回路１、垂直シフトレジスタ回路２、行方向及び列方向に複数設けられた画素回路３、シュミットバッファ回路１２等が同一シリコン基板上に形成されている。
【００３１】
また、図１では、便宜上、画素回路３を２×２の配列としているが、更に多数の画素回路を行方向と列方向に配列してもよい。
【００３２】
図３は図１に示す画素回路３の断面構造の一例を模式的に示す。図中２００はフィールド酸化膜（ＬＯＣＯＳ）、２０１は画素スイッチングトランジスタのゲートであり、所望のＶＳＲの出力信号が入力される。
【００３３】
２０２は画素スイッチングトランジスタのソース（ドレイン）で、２０５は信号線であり第１のメタルレイヤー（例えばＡＬ１）で形成されており、２０２と２０５はスルーホール２１２を介して接続されている。
【００３４】
２０３は画素スイッチングトランジスタのドレイン（ソース）で、保持容量９は２０３のドレインが延長された拡散領域と対向電極２０４で形成されている。対向電極２０４はスルーホール２１５を介して第１のメタルレイヤーで形成されたＶｃｏｍＣＰ電位２０６に接続されている。
【００３５】
画素スイッチングトランジスタのドレイン２０３はスルーホール２１３を介して第１のメタルレイヤーで形成されたパターン２１４に接続されている。また、そのパターン２１４はスルーホール２１１を介して第２のメタルレイヤー（例えばＡＬ２）で形成されたパターン２０７に接続され、更に、スルーホール２０８を介して反射電極２１０に接続されている。
【００３６】
２０９は遮光層であり、第３のメタルレイヤーで形成されている。スルーホール２０８は、遮光層２０９の一部にプロセスデザインルールの最小サイズの穴をあけて貫通していることが多い。この構造より、反射電極２１０は第４のメタルレイヤーで形成されていることになる。パターン２０７、２１４は画素中心にスルーホール２０８を配置できるようにする為にある。
【００３７】
なお、液晶は反射電極２１０の上に配置される。図３に示す様に画素部の回路（スイッチングトランジスタと保持容量）は、反射電極２１０の下に形成され、画素のほぼ全面を反射面として使用することができる。
【００３８】
図４は走査回路等の駆動回路と画素電極が同一の半導体基板上に形成された駆動回路一体型の反射型液晶表示装置ＬＣＯＳにおいて、基板上に画素領域及び駆動回路等を配置した場合の一例を示す。
【００３９】
図中、３０１は画素領域であり、３０２は水平走査シフトレジスタ、３０３は垂直走査シフトレジスタ、３０４はＰＡＤ及びＩ／Ｏ部の領域を示す。これら３０１、３０２、３０３、３０４はシリコン基板３００上に一体形成されている。全ての電源や制御信号、画像信号は、基板の一辺に集められたＩ／Ｏ部から供給される。
【００４０】
その場合、図１のシュミットバッファ回路１２は、図４の基板上において、例えば、ＰＡＤ及びＩ／Ｏ部の領域３０４中に配置する。また、シュミットバッファ回路１２は、ＰＡＤ及びＩ／Ｏ部の領域３０４と水平走査シフトレジスタ３０２との間の領域、またはＰＡＤ及びＩ／Ｏ部の領域３０４と垂直走査シフトレジスタ３０３との間の領域に配置しても良い。
【００４１】
本実施形態では、図４に示すように水平走査シフトレジスタ回路は画素領域３０１の一辺側にのみ位置している。近年は表示領域の拡大化に伴い、ビデオ信号線を複数用意し、更に水平走査シフトレジスタ回路を画素領域の一辺だけでなく、両側に配置する構成が採られている。そして、１回のサンプリング期間に複数の転送スイッチをＯＮ状態にして同時に画像信号を書き込むことで、サンプリング時間を長く確保する回路構成が採用されている。従って、そのような場合には、水平走査シフトレジスタ回路は画素領域３０１の両側に配置しても良い。
【００４２】
次に、動作を簡単に説明する。まず、垂直走査シフトレジスタ回路２（ＶＳＲ）にＶＳＴとＶＣＫが入力され、ＶＳＲ２の出力であるゲート線７ａがＨｉ状態になり、画素回路３のＮＭＯＳトランジスタ８をＯＮ状態にする。
【００４３】
続いて、水平走査シフトレジスタ回路２（ＨＳＲ）にＨＳＴ、ＨＣＫが入力され、ＨＳＲ２の出力により転送スイッチ４を順次ＯＮさせて、ＶＤ端子より入力された画像信号をサンプリングし、信号線６に画像信号を伝送する。信号線６に伝送された画像信号は画素回路３のＮＭＯＳトランジスタ８を介して保持容量９に書き込まれる。
【００４４】
水平走査シフトレジスタ回路１の動作によって転送スイッチ４がすべて動作し、１行目の画像信号を各画素に書き込むと、垂直走査シフトレジスタ回路２はＶＣＫに従って１行目のゲート線７ａをＬｏ状態とする。その後、２行目のゲート線７ｂをＨｉ状態にし、以降１行目と同じ動作を繰り返す。なお、ゲート線がＨｉからＬｏ状態に変わることで、画像信号は保持容量９に次のゲート線がＨｉ状態になるまで保持される。
【００４５】
本実施形態では、従来と同様に液晶パネルを動作させたときの画像信号は、画質劣化防止の為の反転駆動をしており、図７に示すように電圧変化の大きい信号が入力される場合がある。そのため、図２に示すようにＨＣＫ等のロジック制御信号にノイズが加わることがある。
【００４６】
図２は水平走査シフトレジスタ回路１に入力される入力信号（ＨＣＫ、ＨＳＫ等のロジック制御信号）と、内部信号２を示す。本実施形態では、図２に示すように、例えば、ＨＣＫ、ＨＳＫ等のロジック制御信号にノイズが加わったとしても、シュミットバッファ回路１２を介して信号を水平走査シフトレジスタ回路１に信号を供給する。
【００４７】
そのため、ノイズの振幅がシュミットバッファ回路のしきい値を超えていなければ出力は変化しないので、シュミットバッファ回路１２の出力は図２に内部信号２で示す波形となる。よって、水平走査シフトレジスタ回路１が誤動作することはなく、画質を著しく低下させることはない。
【００４８】
また、垂直走査シフトレジスタ回路２においても、ＶＣＫ、ＶＳＫ等のロジック制御信号にノイズ重畳したとしても、同様にシュミットバッファ回路１２でノイズを除去することができる。そのため、同様に垂直走査シフトレジスタ回路２が誤動作することはなく、画質を著しく低下させることはない。なお、図２に示す波形は説明を簡単にするため、入力信号に対する遅延時間を表していない。
【００４９】
また、ビデオ線が複数用意された近年の回路構成の場合においては、制御信号線とビデオ線との結合状態が更に強くなり、同時刻で複数のビデオ線の画像信号が一斉に電圧変化すると、上述したノイズの影響は顕著に現れやすい。その場合でも、本発明は制御信号線にノイズ除去回路を搭載することで画質低下を防ぐことができる。
【００５０】
本実施形態において、ノイズ除去回路としてシュミットバッファ回路を用いているが、これは、トランジスタを用いた回路なので、同一シリコン基板上に形成することが可能であり、コストアップにつながらない。
【００５１】
もちろん、ノイズ除去回路として抵抗と容量で構成されたローパスフィルタ回路を用いることも考えられる。その場合、同一シリコン基板上に形成することも可能であるが、回路が必要とするレイアウト面積とノイズ除去効果を考慮すると、シュミットバッファ回路を用いるのが望ましい。
【００５２】
図５は本発明に係る反射型液晶表示装置（以下液晶パネルと呼ぶ）の外観の一例を模式的に示す。図中１０１は駆動回路及び画素部が一体に形成されたシリコン基板であり、１０３は透明電極で液晶を反転駆動する際の基準電極となる。１０５は表示領域となり、この領域１０５を囲むようにシール材１０２が配置されている。
【００５３】
従って、液晶はシリコン基板１０１とシール材１０２と透明電極１０３で囲まれた空間に封止されている。更に、電源や各信号のＰＡＤはシリコン基板の一辺に集められ、フレキシブル配線１０４に接続されている。電源や各信号はこの１つのフレキシブル配線１０４を介して入力される。基板の一辺に全ての信号及び電源を集めるのは、実装上及びコスト上の有利性を考慮してのことである。
【００５４】
図５のような形態では、シリコン基板の一辺に集められてフレキシブル配線１０４が実装されている。そのため、フレキシブル配線１０４での制御信号線とビデオ線との結合状態が更に強くなり、同時刻で複数のビデオ線の画像信号が一斉に電圧変化すると、ノイズの影響は顕著に現れやすい。
【００５５】
本発明では、シュミットバッファ回路１２を同一シリコン基板上で且つ、外部から信号を入力する入力端子と走査回路との間に配置することにより、ノイズの影響を低減し画質低下を防止することが可能となる。
【図面の簡単な説明】
【００５６】
【図１】本発明に係る反射型液晶表示装置の一実施形態の構成を示す回路図である。
【図２】図１の実施形態のノイズ除去回路の入力と出力を示す信号波形図である。
【図３】本発明に係る画素回路の断面構造の一例を示す図である。
【図４】本発明に係る駆動回路一体型の反射型液晶表示装置の基板上における画素領域と駆動回路の配置の一例を示す図である。
【図５】本発明に係る反射型液晶表示装置の外観の一例を示す斜視図である。
【図６】従来例の液晶表示装置を示す回路図である。
【図７】フィールド反転駆動における画像信号の一例を示す図である。
【図８】従来のロジック制御信号及びその信号の装置内部の変化を説明する図である。
【符号の説明】
【００５７】
１  水平走査シフトレジスタ回路（ＨＳＲ）
２  垂直走査シフトレジスタ回路（ＶＳＲ）
３  画素回路
４  転送スイッチ
５  ビデオ線
６  信号線
７ａ、７ｂ  ゲート線
８  ＮＭＯＳトランジスタ
９  保持容量
１０  液晶
１２  シュミットバッファ回路
【図１】
2007286488.tif 000003
【図２】
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【図３】
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【図４】
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【図５】
2007286488.tif 000007
【図６】
2007286488.tif 000008
【図７】
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【図８】
2007286488.tif 000010