(57)【要約】【課題】形状精度が良好でかつ良質な結晶粒を規則的に配列させることが可能な半導体薄膜の結晶化方法を提供する。【解決手段】半導体薄膜３に対してレーザ光Ｌｈ（エネルギービーム）を所定速度で走査させながら連続照射することにより、半導体薄膜３をレーザ光Ｌｈの走査にともなって結晶化させる半導体薄膜３の結晶化方法において、半導体薄膜３を完全溶融させると共に、レーザ光Ｌｈの走査中心がレーザ光Ｌｈの走査に伴って最後に結晶化されるようにレーザ光Ｌｈの照射条件を設定することを特徴としている。【選択図】図３
2007281420.tif 000002
【特許請求の範囲】
【請求項１】
半導体薄膜に対してエネルギービームを所定速度で走査させながら連続照射することにより、当該半導体薄膜を結晶化させる半導体薄膜の結晶化方法において、
前記半導体薄膜を完全溶融させると共に、前記エネルギービームの走査中心が当該エネルギービームの走査に伴って最後に結晶化されるように、当該エネルギービームの照射条件を設定する
ことを特徴とする半導体薄膜の結晶化方法。
【請求項２】
請求項１記載の半導体薄膜の結晶化方法において、
前記走査中心に、前記走査方向に沿った一連の結晶粒界を設ける
ことを特徴とする半導体薄膜の結晶化方法。
【請求項３】
請求項１記載の半導体薄膜の結晶化方法において、
前記走査中心に重ならない所定ピッチを保って前記エネルギービームを平行に走査させる
ことを特徴とする半導体薄膜の結晶化方法。
【請求項４】
請求項３記載の半導体薄膜の結晶化方法において、
前記所定ピッチは、隣接する前記エネルギービームの走査位置に形成された結晶粒の結晶性が引き継がれる範囲に設定される
ことを特徴とする半導体薄膜の結晶化方法。
【請求項５】
請求項４記載の半導体薄膜の結晶化方法において、
前記走査中心に、前記走査方向に沿った一連の結晶粒界を設けると共に、当該結晶粒界の間に前記エネルギービームの走査方向と逆方向に凸となる三日月形状の結晶粒を配列する
ことを特徴とする半導体薄膜の結晶化方法。
【請求項６】
請求項１記載の半導体薄膜の結晶化方法において、
前記エネルギービームのビームプロファイルをガウシアンカーブにする
ことを特徴とする半導体薄膜の結晶化方法。
【請求項７】
請求項１記載の半導体薄膜の結晶化方法において、
前記エネルギービームをスポットビームとして用いる
ことを特徴とする半導体薄膜の結晶化方法。
【請求項８】
請求項１記載の半導体薄膜の結晶化方法において、
前記エネルギービームは、半導体レーザ発振器から発振されるレーザ光である
ことを特徴とする半導体薄膜の結晶化方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、エネルギービームの照射によって半導体薄膜を結晶化させる方法に関する。
【背景技術】
【０００２】
液晶表示装置や有機電界発光素子を用いた有機ＥＬ表示装置のようなフラット型の表示装置においては、複数画素のアクティブマトリックス表示を行うためのスイッチング素子として、薄膜トランジスタ（thin film transistor：ＴＦＴ）を用いている。薄膜トランジスタには、多結晶シリコン（poly-Si）を活性領域に用いたＴＦＴ（多結晶シリコンＴＦＴ）と、非晶質シリコン（アモルファスＳｉ）を活性領域に用いたＴＦＴ（非晶質シリコンＴＦＴ）とがある。
【０００３】
このうち、多結晶シリコンＴＦＴは、非晶質シリコンＴＦＴと比較してキャリアの移動度が１０倍から１００倍程度大きく、オン電流の劣化も小さいという特徴がある。このため、多結晶シリコンＴＦＴは、上記表示装置のスイッチング素子として非常に優れた特性を有しているだけではなく、各種論理回路（例えば、ドミノ論理回路、ＣＭＯＳトランスミッションゲート回路）やこれらを用いたマルチプレクサ、ＥＰＲＯＭ、ＥＥＰＲＯＭ、ＣＣＤ、ＲＡＭを構成するスイッチング素子としても注目されている。
【０００４】
このような多結晶シリコンＴＦＴの製造技術として、おおむね６００℃以下の低温プロセスのみを用いる、いわゆる低温ポリシリコンプロセスが開発され、基板の低コスト化が実現されている。低温ポリシリコンプロセスにおいては、発振時間が極短時間のパルスレーザーを用いて非晶質シリコン膜の結晶化を行うパルスレーザー結晶化技術が広く使われている。パルスレーザー結晶化技術とは、基板上のシリコン薄膜に高出力のパルスレーザー光を照射することによって瞬時に溶融させ、これが凝固する過程で結晶化する性質を利用する技術である。
【０００５】
例えば、エキシマレーザを用いた低温ポリシリコンプロセスにおいては、ライン状に整形されたレーザ光を、わずかずつ移動させて大部分を重複させながら非晶質シリコン膜に対してパルス照射し、同一箇所に１０〜２０回のレーザ光照射を行う。これにより、活性領域の全面において結晶粒径が均一化された多結晶が得られるようにしている。また、ＳＬＳ（Sequential Lasteral solidification）方式の結晶化により結晶粒の位置の制御を行う方法が提案されている。例えば、位相シフトマスクを介してエキシマレーザ光の位相を空間的に変調することで、照射するレーザ光にエネルギー密度勾配をもたせ、これによって結晶粒の位置の制御を行う方法も提案されている（下記非特許文献１参照）。
【０００６】
さらに、以上のようなライン状のレーザ光を用いた方法以外にも、Ａｒガスなどのスポットビームレーザを用いて、爆発的結晶化させることにより、比較的小さな粒径の結晶を配列させる方法も提案されている。
【０００７】
【非特許文献１】「表面科学２１」、2000年、vol.１、No.５、p.278-287
【発明の開示】
【発明が解決しようとする課題】
【０００８】
近年、上述したフラットパネル型の表示装置においては、さらなる動画特性やコントラスト特性の向上を目的としてハイフレームレートの液晶ディスプレイの開発が進められ、また有機ＥＬディスプレイ等の自発光型のディスプレイなどの新しい表示装置の開発も進められている。これにともない、このような表示装置に対応可能なスイッチング素子として、急激に大きな電流を流しても特性劣化が無く、また各スイッチング素子の特性バラツキが小さいＴＦＴの開発が求められている。
【０００９】
ところが、上述した従来の低温ポリシリコンプロセスによって得られた多結晶シリコンＴＦＴは、比較的大きな電流を流しやすい特性であってキャリアの移動度も大きく特性劣化も小さいことが非常に有利である反面、非晶質シリコンＴＦＴと比較して素子間の特性、特に初期の閾値電圧やオン電流のばらつきが大きい。そして、このような多結晶シリコンＴＦＴにおける素子間の特性ばらつきは、多結晶シリコンＴＦＴをスイッチング素子とした表示装置においての輝度ムラの発生要因となる。
【００１０】
ここで、以上のような多結晶シリコンＴＦＴにおける素子間の特性ばらつきは、多結晶シリコンＴＦＴのチャネル部において、チャネル方向（電子が流れる方向）に存在する結晶粒界の数のばらつきに依存する。このため、結晶粒界の数が少ない範囲では、結晶粒界のわずかな数の違いでも大きなＴＦＴ素子のバラつきを生む。一方、結晶粒界の数が増えていくにつれて、チャネル部の結晶粒界数が多少異なってもＴＦＴ素子のバラつきは小さく抑えられる。したがって、多結晶シリコンＴＦＴにおける特性ばらつきを小さく抑えるためには、形状の揃った比較的小さなサイズの結晶を規則的に配置した多結晶シリコン膜を形成することが重要となる。
【００１１】
しかしながら、上述したパルスレーザー結晶化技術に広く使われているエキシマレーザは、ガスレーザーであるためパルス間のエネルギー安定性が低い。このため、上述したように同一箇所に１０〜２０回のレーザ光照射を行うことで、結晶粒径が均一化された多結晶が得られるようにしているものの、得られる結晶粒径の均一性は不十分である。さらにエキシマレーザは装置単価が高く、レーザーチューブ（発振器）の交換によるランニングコストも高い。さらに、上述したように数十回程度の繰り返し照射が必要なため、スループットも低いので、製品の製造コストを下げられないという問題を抱えている。
【００１２】
また、結晶粒径の均一化が不十分であるという問題は、上記特許文献１に記載の位相シフトマスクを用いた方法であっても同様である。しかも、このような方法であれば、位相シフトマスクの作製にも高いコストを要し、基板の大型化が困難という問題も加わる。
【００１３】
さらに、Ａｒガスなどのスポットビームレーザを用いた爆発的結晶化方法は、固相転移による再結晶化法であるため、形成された結晶の質が悪く、充分なキャリアの移動度を得ることができない。
【００１４】
そこで本発明は、形状精度が良好でかつ良質な結晶粒を規則的に配列させることにより、精度良好な高いキャリア移動度を示す結晶領域を形成することが可能な半導体薄膜の結晶化方法を提供することを目的とする。
【課題を解決するための手段】
【００１５】
このような目的を達成するための本発明は、半導体薄膜に対してエネルギービームを所定速度で走査させながら連続照射することにより、半導体薄膜を結晶化させる半導体薄膜の結晶化方法である。この際、半導体薄膜を完全溶融させると共に、エネルギービームの中心位置が当該エネルギービームの走査に伴って最後に結晶化されるように、当該エネルギービームの照射条件を設定することを特徴としている。
【００１６】
このような半導体薄膜の結晶化方法では、エネルギービームの走査方向に向かって走査中心側に引っ張られる状態で凸となる形状の結晶粒が当該走査方向に規則的に配列された多結晶化が行われる。この結晶粒の形状や配列間隔は、エネルギービームの走査速度や照射エネルギー等の照射条件によって良好に制御される。しかも、エネルギービームの照射によって半導体薄膜を完全溶融させ、液相成長によって再結晶化させて得られた結晶粒であるため、結晶の質も良好である。
【発明の効果】
【００１７】
以上説明したように本発明の半導体薄膜の結晶化方法によれば、形状精度が良好でかつ良質な結晶粒が規則的に配列されることにより、高いキャリア移動度が高精度に制御された多結晶性領域を半導体薄膜に形成することが可能である。したがって、このようにして得られた多結晶性領域を用いることにより、特性ばらつきが効果的に抑えられた画素スイッチング素子に適する薄膜トランジスタを得ることが可能になる。
【発明を実施するための最良の形態】
【００１８】
以下、本発明の実施の形態を図面に基づいて詳細に説明する。尚、以下の実施形態においては、半導体薄膜の結晶化方法、この結晶化方法を用いた薄膜半導体装置の製造方法をこの順に説明する。
【００１９】
＜半導体薄膜の結晶化方法＞
先ず、図１に示すように、薄膜半導体装置を形成する基板１を用意する。この基板１としては、シリコン基板をはじめ、非晶質基板のガラスやプラスチック基板などの低融点基板、石英、サファイア基板、さらにはアルミニウムやステンレス等の金属基板等を用いる。尚、この基板１の一主面上には、ここでの図示は省略した、酸化膜や窒化膜など絶縁膜を基板１への熱伝導を防止するためのバッファー層として設けても良く、また各種金属膜などを設けても良い。
【００２０】
次に、この基板１上に、非晶質の半導体薄膜３を形成する。ここでは、一例としてＰＥ−ＣＶＤ（plasma enhancement-chemical vapor deposition）法による非晶質シリコンからなる半導体薄膜３の形成を行う。このようにして得られた半導体薄膜３は、多量の水素が含有された、いわゆる水素化非晶質シリコン（ａ−Ｓｉ：Ｈ）からなる。また、ここで形成する半導体薄膜３の膜厚は、例えば膜厚２０ｎｍ〜１００ｎｍであることとする。
【００２１】
尚、半導体薄膜３の形成は、成膜温度を低く抑えられる方法であれば上述したＰＥ−ＣＶＤ法に限定されることはなく、塗布法によって行っても良い。この場合、ポリシラン化合物を溶媒に混ぜた混合物を、基板１上に塗布成膜し、その後、乾燥、アニールを施すことにより半導体薄膜３を形成する。そして、先のＰＥ−ＣＶＤ法や、ここで示した塗布法などの成膜温度が低く抑えられた成膜方法では、いずれの場合にも成膜条件により多少の変動はあるが、０．５atoms％〜１５atoms％程度の水素を含有した水素化非晶質シリコン（ａ−Ｓｉ：Ｈ）からなる半導体薄膜３が得られる。
【００２２】
その後、必要に応じて半導体薄膜３中の過剰水素イオンを脱離させるための、いわゆる水素抜きアニール処理を行う。このような水素抜きアニール処理としては、例えば４００℃から６００℃の炉アニールを行う。ただし、次に行う結晶化のためのアニール処理が、半導体薄膜３中において水素イオンをガス化膨張させることなくレーザ光の照射部から余剰水素を除去するように、照射エネルギーを調整して行われる場合には、水素抜きアニール処理を省略しても良い。
【００２３】
以上の後、半導体薄膜３に設定した活性領域に、エネルギービームとしてレーザ光Ｌｈを照射する結晶化工程を行う。
【００２４】
レーザ光Ｌｈとしては、例えば、Ｇａ-Ｎレーザ(波長４０５ｎｍ）、Ｋｒレーザ（波長４１３ｎｍ）、Ａｒレーザ（波長４８８ｎｍ、５１４．５ｎｍ）、Ｎｄ：ＹＡＧレーザ（波長１．０６μｍ）の第２高調波（５３２ｎｍ）や第３高調波（３５５ｎｍ）、Ｎｄ：ＹＬＦレーザ（波長１．０５μｍ）の第２高調波（５２４ｎｍ）や第３高調波（３４９ｎｍ）、あるいはＹｂ：ＹＡＧレーザ（波長１．０３μｍ）の第２高調波（５１５ｎｍ）や第３高調波（３４４ｎｍ）等を用いることができる。この他にも、Ｔｉ：Ｓａｐｐｈｉｒｅレーザの基本波（７９２ｎｍ）または第２高調波（３９６ｎｍ）を用いてもよい。
【００２５】
ここでは、半導体薄膜３に対して所定の速度で一方の走査方向ｙにレーザ光Ｌｈを走査させながら照射する。そして特に、レーザ光Ｌｈの照射によって半導体薄膜３がその深さ方向において完全溶融されるように、半導体薄膜３の膜厚に合わせてレーザ光Ｌｈの照射条件を設定することが重要である。
【００２６】
このため、半導体薄膜３に照射するレーザ光Ｌｈの波長は、半導体薄膜３の膜厚とその吸収係数に基づき、半導体薄膜３の表面層のみで吸収されずに深さ方向全域にわたって吸収される程度に、比較的吸収係数が小さくなる波長が選択される。すなわち、厚さ５０ｎｍの非晶質シリコンからなる半導体薄膜３を例にとると、波長３５０ｎｍ〜４７０ｎｍのレーザ光が好ましく用いられる。このような波長のレーザ光Ｌｈの発振源としては、例えばＧａＮ系の化合物半導体レーザ発振器、さらにはＹＡＧレーザ発振器が対応する。
【００２７】
以上のようなレーザ光Ｌｈの波長以外の照射条件として、レーザ光Ｌｈを照射する対物レンズの開口数ＮＡ、レーザ光Ｌｈの走査速度や照射エネルギー等を調整することによっても、半導体薄膜３を深さ方向において完全溶融させた結晶化が行われるようにすることができる。そして、非晶質の半導体薄膜３に一定強度以上のレーザ光Ｌｈを照射することにより半導体薄膜３を完全に溶融させるのである。
【００２８】
またこの結晶化工程においては、以上のように選択された波長のレーザ光Ｌｈを、ビームプロファイルがガウシアン形状のスポットビームとして用いることとする。これにより、図２（１）に示すように、レーザ光Ｌｈの照射部分の温度は、レーザ光Ｌｈのビームプロファイル（Beam Profile）のガウシアン形状に対応し、レーザ光Ｌｈの走査中心φで最も高く、両端で最も低くなる。
【００２９】
そのため、図２（２）に示すように、レーザ光Ｌｈを走査方向ｙに走査しながら照射することにより、半導体薄膜３が完全溶融した走査路Ｒにおいて、走査中心φと離れた遠い位置（レーザ光の走査路Ｒの両側端）から結晶凝固が開始され、走査路Ｒの両側端に一定数の結晶の種Ｂが発生する。
【００３０】
そして、図２（３）に示すように、さらにレーザ光Ｌｈの走査を進めることにより、結晶の種Ｂが走査方向ｙに向かって走査中心φ側に引っ張られる状態で凝固が進み、走査中心φが最後に結晶化される。この際、走査中心φにおいて凝固が会合するように、上述した照射条件の範囲でさらにレーザ光Ｌｈの走査速度および出力を調整しても良い。これにより、走査中心φから走査路Ｒの両側に向かって末広がりに広がる半三日月状、つまり三日月を線対称となる線で２分割した形状の結晶粒ｂを得る。また凝固が会合する走査中心φには、走査方向ｙに沿った一連の結晶粒界ａを形成する。
【００３１】
さらに図３に示すように、この結晶化工程においては、基板１上の半導体薄膜３に対して、レーザ光Ｌｈを所定のピッチｐを保って平行に走査させる。この際、各走査においての走査方向ｙは、一定方向であることとする。
【００３２】
レーザ光Ｌｈを走査させるピッチｐは、走査中心φが隣接するレーザ光Ｌｈの走査路Ｒに重なることなく、また隣接するレーザ光Ｌｈの走査位置に形成された結晶粒ｂの結晶性を引き継いで凝固が進む範囲に設定されることとする。このため、ピッチｐは、おおむねレーザ光Ｌｈの直径ｒとした場合、おおむね［ｒ／２］＜p≦［１．５×ｒ］の範囲であり、レーザ光Ｌｈの直径ｒと同程度のピッチｐで一定の走査方向ｙにレーザ光Ｌｈを走査させることが好ましい。
【００３３】
これにより、先のレーザ光Ｌｈの走査で形成された半三日月状の結晶粒ｂが種となり、この走査に隣接させたレーザ光Ｌｈの走査においての結晶化が進められる。また、所定のピッチｐで結晶粒界ａが設けられるように半導体薄膜３の多結晶化が進められる。そして、結晶粒界ａ−ａ間には、半三日月状の結晶粒ｂを合体させた三日月形状の結晶粒ｂ’が結晶粒界ａの延設方向に沿って配列形成される。この結晶粒ｂ’は、レーザ光Ｌｈの走査方向ｙと逆方向に凸となる三日月形状となる。
【００３４】
ここで、レーザ光Ｌｈを平行に走査させるピッチｐ（すなわち結晶粒界ａのピッチであり周期）は、次に説明する薄膜半導体装置のチャネル部に設けられる結晶粒界aの本数を規定する重要なファクターになる。つまり、以降に詳しく説明するように、薄膜半導体装置のチャネル部に設けられる結晶粒界aの本数（周期数）は、キャリア移動度を保てる範囲でトランジスタ特性のバラツキを均一化できる程度に多く設定されることが好ましいが、さらにここではプロセスのタクトタイムを損なわない範囲でより多くの本数の結晶粒界aがチャネル部に設けられるように、薄膜半導体装置の設計に合わせてピッチｐが設定されていることとする。そして、このピッチｐに合わせて、ピッチｐ方向（走査方向ｙと垂直な方向）におけるレーザ光Ｌｈのスポット径ｒが設定されることとする。
【００３５】
具体的には、後の実施例でも説明するように、チャネル部には、チャネル幅方向に延設された結晶粒界ａが２５本程度設けられるように、チャネル長に合わせてピッチｐが設定されることが好ましい。
【００３６】
また、上述した結晶化工程においては、レーザ光Ｌｈの照射によって形成される結晶粒界aの特性を一定化させることが極めて重要である。結晶粒界aの特性を一定化する要因としては、各照射位置においてのレーザの照射エネルギー密度が一定であること、走査速度が一定であること、レーザ光Ｌｈのピッチｐが一定であること、半導体薄膜３の膜厚が均一であること等が求められる。
【００３７】
さらに、レーザ光Ｌｈの照射エネルギー密度を一定とするために、少なくとも活性領域に対してレーザ光Ｌｈを照射している間においては、レーザ光Ｌｈが連続発振された状態となっていることが望ましい。ここで、連続発振とは、半導体薄膜３の温度が低下しない範囲の休止（例えば５０ｎｓ以下の休止）がある場合も含むこととする。また、レーザ光Ｌｈの照射エネルギー密度を一定として上述の照射を行うためには、エネルギーのフィードバック機能やフォーカスサーボ機能を備えたレーザ光の照射装置を用いることが望ましい。エネルギーのフィードバック機能やフォーカスサーボ機能は光ディスク等のカッティングマシーン等で使われる公知の技術で構築されることが可能である。
【００３８】
また、半導体薄膜３に対するレーザ光Ｌｈの照射は、レーザ照射の走査速度が一定になる領域で設定する。
【００３９】
そして、半導体薄膜３に対するレーザ光Ｌｈの照射位置の移動は相対的でよく、固定されたレーザ光の照射位置に対して半導体薄膜が形成された基板側を移動させても良いし、固定された基板に対してレーザ光の照射位置を移動させても良い。また、基板１とレーザ光の照射位置との両方を移動させても良い。
【００４０】
さらに、上述した結晶化工程におけるレーザ光Ｌｈの平行な走査は、１つのレーザ発振器を用いて順次行っても良いし、複数のレーザ発振器を用いて行っても良い。また、表示装置を駆動するための薄膜トランジスタの作製を考えた場合、複数の活性領域に対して同時に行われることが好ましい。つまり、基板１の表面側に設定配列された複数の活性領域に対してレーザ光Ｌａを同時に多点照射することにより、複数の活性領域に対して結晶化工程を同時に行えることが、生産性を考慮した場合には好ましい方法である。
【００４１】
このようなレーザ光Ｌｈの多点照射を実現するためには、レーザ光の発振源として半導体レーザ発振器が好適に用いられる。半導体レーザ発振器は、エキシマレーザやＹＡＧレーザなどの他のレーザ発振器と比較して非常に小型であるため、１つの装置内に複数配置が可能であり、かつ連続照射で定格２００ｍＷの出力が可能である。
【００４２】
半導体レーザ発振器を用いることにより、大面積化に対応して半導体レーザの個数を増やすことで基板サイズに対して柔軟に装置設計が対応することが可能となる。このため、大型基板上に同じ性能のトランジスタを多数並べた構造を得ることができ、研究レベルで報告があるようなマスクを用いて粒界を制御する方法に比べて大面積で均一な特性のトランジスタを形成することに有利である。
【００４３】
また、以上の結晶化工程は、不活性ガス雰囲気中に限らず、大気雰囲気中において行われても良い。大気雰囲気中で行うことにより、装置全体の大型化が防止される。
【００４４】
以上説明した結晶化方法によれば、レーザ光Ｌｈの走査方向ｙに向かって走査中心φ側に引っ張られる状態で凸となる形状の結晶粒ｂが、当該走査方向ｙに規則的に配列された多結晶化が行われる。この結晶粒ｂの形状や配列間隔は、レーザ光Ｌｈの波長、走査速度、照射エネルギー等の照射条件によって良好に制御することができる。しかも、結晶粒ｂは、レーザ光Ｌｈの照射によって半導体薄膜３を完全溶融させ、液相成長によって再結晶化させて得られた結晶粒であるため、結晶の質も良好である。
【００４５】
また、レーザ光Ｌｈを走査させるピッチｐを調整することにより、隣接するレーザ光Ｌｈの走査位置に形成された結晶粒ｂの結晶性を引き継いで凝固を進め、ピッチｐで配置された結晶粒界ａ−ａ間に半三日月状の結晶粒ｂを合体させた三日月形状の結晶粒ｂ’を形成することができる。これにより、走査方向ｙと略垂直な方向にも規則正しく結晶粒ｂ’を配列させることが可能である。
【００４６】
したがって、形状精度が良好でかつ良質な結晶粒が規則的に配列されることにより、高いキャリア移動度が高精度に制御された多結晶性領域を半導体薄膜に形成することが可能である。
【００４７】
＜薄膜半導体装置の製造方法＞
次に、以上のような結晶化方法に続けて行われる薄膜半導体装置の製造方法を説明する。ここでは、同一の基板１上に複数の薄膜トランジスタＴＦＴを設けてなる半導体装置の製造方法を説明する。尚、図面においては、主に1つの薄膜トランジスタ形成部分のみを図示する。
【００４８】
先ず、図４（１）に示すように、基板１上の半導体薄膜３に設定した各活性領域３ａの全面を、上述した結晶化方法によって選択的に結晶化する。そして、それぞれの活性領域３ａ内に、活性領域３ａを横切る状態で結晶粒界ａを平行に配列させる。この結晶粒界ａは、上述したように所定のピッチｐで配列される。
【００４９】
次に、図４（２）に示すように、結晶化させた活性領域３ａを残すような所定形状に半導体薄膜３をパターンエッチングし、各活性領域３ａを所定形状の島状に分割して素子分離する。この場合、図示したように、活性領域３ａの周囲に結晶化させていない半導体薄膜３部分が残らない様に、半導体薄膜３をパターンエッチングしても良い。また、活性領域３ａの周囲に結晶化させていない半導体薄膜３部分が残る様に、半導体薄膜３をパターンエッチングしても良い。この場合、島状にパターニングされた領域内の結晶化された領域の全てが活性領域となり、その周囲に残された非結晶の領域は分離領域となる。尚、このような半導体薄膜３のパターンエッチングは、上述した結晶化工程の前に行っても良い。この場合、活性領域３ａの予定となる領域を含む島状にパターニングされた各半導体薄膜３に対して、上述した結晶化工程が施されることになる。
【００５０】
次に、パターニングされた活性領域３ａを覆う状態で基板１の上部にゲート絶縁膜(図示省略）を形成する。このゲート絶縁膜は、酸化シリコンや窒化シリコンからなるもので良く、通常のＰＥ−ＣＶＤによる公知の方法で成膜可能であり、この他にも塗布型の絶縁層として公知のＳＯＧ等の成膜を行っても良い。尚、このゲート絶縁膜の形成は、半導体薄膜３をパターンエッチングする前に行っても良い。
【００５１】
次に、図５に示すように、島状に分割した各活性領域３ａの中央部を横切る形状のゲート電極５を、ゲート絶縁膜上に形成する。ここでは、結晶粒界ａの延設方向に沿って、ゲート電極５を形成することが重要である。図５におけるＡ部の拡大図を図６に示す。
【００５２】
これらの図に示すように、ゲート電極５は、活性領域３ａにおいて所定の幅Ｗに設計された部分を横切るように設けられており、ゲート電極５が横切る部分の活性領域３ａの幅がチャネル幅Ｗとなる。つまり、結晶粒界ａは、ゲート電極５下方のチャネル部Ｃを、チャネル幅Ｗの方向に横切る状態で設けられることになる。
【００５３】
また、ゲート電極５の線幅（すなわちチャネル長Ｌに対応する）は、ここで形成する薄膜トランジスタの規格に基づいて設計されており、その下方に所定本数の結晶粒界ａがチャネル部Ｃをチャネル幅Ｗ方向に横切るように配置されるよう設定されていることとする。そして、同一特性の薄膜トランジスタであれば、チャネル部Ｃには、略同一本数の結晶粒界ａが設けられていることが重要である。ここで略同一本数とは、所定本数に対して±１本の範囲であることが好ましい。
【００５４】
チャネル部Ｃに設けられる結晶粒界ａの数は、所定本数に対する実際の本数の割合のバラツキが小さいほど、薄膜トランジスタの特性バラツキを均一化できる。このため、チャネル部Ｃに設けられる結晶粒界ａの本数は２本以上で多いほうが良い。具体的には、後の実施例でも説明するように、チャネル部Ｃには、チャネル幅Ｗ方向に延設された結晶粒界ａが２５本程度設けられるように、チャネル長Ｌに合わせてピッチｐが設定されることが好ましい。ただし、チャネル部Ｃにおいてチャネル長Ｌ方向を横切る結晶粒界ａが多いほど、チャネル長Ｌ方向におけるキャリア移動度が低くなるため、キャリア移動度がある程度高く保たれる範囲で結晶粒界ａの本数が多いほど良い。
【００５５】
また以上のように、各活性領域３ａに設けられた結晶粒界ａに対して所定状態としてゲート電極５を形成することが重要である。このため、先の結晶化工程においては、図７に示すように、ゲート電極５の配線方向に合わせてそれぞれの活性領域３ａにおけるレーザ光Ｌｈの走査方向を設定し、結晶粒界ａの延設方向をゲート電極５の配線方向に一致させることとする。
【００５６】
以上のゲート電極５を形成する際には、先ず、スパッタ法または蒸着法により、例えばアルミニウムからなる電極材料層を成膜し、次にリソグラフィー法によってこの電極材料層上にレジストパターンを形成する。その後、このレジストパターンをマスクに用いて電極材料層をエッチングすることにより、ゲート電極５をパターン形成する。
【００５７】
尚、ゲート電極５の形成は、このような手順に限定されることはなく、例えば金属微粒子を塗布して印刷する手法であっても良い。また、ゲート電極５を形成する際の電極材料層のエッチングにおいては、続けてゲート絶縁膜をエッチングしても良い。
【００５８】
次に、図８の断面図に示すように、ゲート電極５をマスクに用いたイオンインプランテーションとその後のアニール処理により、活性領域３ａに自己整合的に不純物が導入されたソース・ドレイン７を形成する。尚、図８は、図５におけるＸ−Ｘ’方向の断面に対応している。
【００５９】
これにより、ゲート電極５の下方には結晶化された活性領域３ａにおいて不純物が導入されない部分からなるチャネル部Ｃが形成される。これらのソース・ドレイン７およびゲート電極５の下方のチャネル部Ｃは、半導体薄膜３を結晶化させた多結晶シリコンで構成されるため、以上によって多結晶シリコン薄膜を用いたトップゲート型の薄膜トランジスタＴＦＴ（すなわち多結晶シリコンＴＦＴ）が同一基板１上に複数設けられた薄膜半導体装置１０が得られる。
【００６０】
そして、このような薄膜トランジスタＴＦＴをスイッチング素子として用いた表示装置として、例えば液晶表示装置を作製する場合には、さらに以下の工程を行う。
【００６１】
先ず、図９（１）に示すように、薄膜半導体装置１０の基板１上に、薄膜トランジスタＴＦＴを覆う状態で層間絶縁膜２１を形成する。次に、この層間絶縁膜２１に薄膜トランジスタＴＦＴのソース・ドレイン７に達する接続孔２１ａを形成する。そして、この接続孔２１ａを介してソース・ドレイン７に接続された配線２３を、層間絶縁膜２１上に形成する。
【００６２】
次いで、配線２３を覆う状態で平坦化絶縁膜２５を形成し、配線２３に達する接続孔２５ａを平坦化絶縁膜２５に形成する。次に、この接続孔２５ａと配線２３を介してソース・ドレイン７に接続された画素電極２７を、平坦化絶縁膜２５上に形成する。この画素電極２７は、液晶表示装置の表示タイプによって透明電極または反射電極として形成する。尚、図面は１画素の要部断面となっている。
【００６３】
その後、ここでの図示は省略したが、画素電極２７を覆う配向膜を平坦化絶縁膜上に形成し、駆動基板２９を完成させる。
【００６４】
一方、図９（２）に示すように、駆動基板２９に対向配置させる対向基板３１を用意する。この対向基板３１は、透明基板３３上に共通電極３５を設け、さらにここでの図示を省略した配向膜で共通電極３５を覆ってなる。尚、共通電極３５は透明電極からなることとする。
【００６５】
そして、駆動基板２９と対向基板３１とを、画素電極２７と共通電極３５とを向かい合わせた状態で、スペーサ３７を介して対向配置する。そして、スペーサ３７によって所定間隔に保たれた基板２９，３１間に液晶相ＬＣを充填封止し、液晶表示装置４１を完成させる。
【００６６】
尚、上記構成の駆動基板２９を用いて有機ＥＬ表示装置を作製する場合には、駆動基板２９に設けられた画素電極を陽極（または陰極）とし、この画素電極上に正孔注入層、発光層、電子輸送層などの必要機能を有する有機層を積層させ、さらに有機層上に共通電極を陰極（または陽極）として形成することとする。
【００６７】
以上説明した本実施形態の結晶化方法を用いて得られた薄膜半導体装置１０は、図５および図６を参照すると、ゲート電極５に沿って延設された結晶粒界ａが、チャネル部Ｃを横切るとともにチャネル長Ｌ方向に周期的に配置された構成とすることで、チャネル部Ｃを通過するキャリアは、必ず所定ピッチｐで配置された結晶粒界ａを横切って移動することになる。このため、このピッチｐを制御することにより、薄膜半導体装置１における薄膜トランジスタＴＦＴのトランジスタ特性（キャリア移動度）を精度良好に制御することが可能になる。そして、ピッチｐの大きさやチャネル部Ｃに配置される結晶粒界ａの数を一致させることで、複数の素子においてのキャリア移動度のバラツキが抑えられる。つまり、この薄膜半導体装置１０においては、図３に示すように、キャリアは移動方向Ｘｃに結晶粒界ａを横切るように移動するのである。そして、この結晶粒界ａは、結晶化の際に最後に凝固する部分であり不純物が集中しているため、半三日月状の結晶粒ｂの走査方向ｙ間の結晶粒界よりも明確な粒界になっている。このため、このような明確な結晶粒界ａを所定本数だけ横切るようにキャリアが移動することにより、移動方向Ｘｃと垂直な方向（すなわち走査方向ｙ）をチャネル長Ｌ方向として設計されたトランジスタと比較して、薄膜トランジスタＴＦＴのトランジスタ特性（キャリア移動度）が精度良好に制御されるのである。
【００６８】
しかも、結晶粒界ａ−ａ間の結晶状態は、結晶粒界ａ−ａ間にわたる大きさの結晶粒ｂ’が結晶粒界ａに沿って配列されている。このため、非晶質の領域を含まず、素子特性の劣化が抑えられる。また、結晶粒界ａ−ａ間においては、キャリアが結晶粒ｂ’−ｂ’間の粒界を通過することがないため、チャネル長Ｌ方向のキャリア移動度が高く維持される。
【００６９】
したがって、このような薄膜半導体装置に形成された各薄膜トランジスタＴＦＴを画素のスイッチング素子として用いて表示装置を構成することにより、表示部での輝度ムラや色ムラを防止することが可能になる。
【００７０】
尚、上述した実施形態においては、図３を用いて説明したように、レーザ光Ｌｈを走査させるピッチｐを、走査中心φが隣接するレーザ光Ｌｈの走査路Ｒに重なることなく、また隣接するレーザ光Ｌｈの走査位置に形成された結晶粒ｂの結晶性を引き継いで凝固が進む範囲に設定することで、ピッチｐで配置された結晶粒界ａ−ａ間にわたる粒径の結晶粒ｂ’が結晶粒界ａの延設方向に配列されるように半導体薄膜を多結晶化させる方法を説明した。しかしながら本発明としては、隣接するレーザ光Ｌｈの走査位置に形成された結晶粒ｂの結晶性を引き継がずに凝固が進むように、レーザ光Ｌｈを走査させるピッチｐを設定しても良い。この場合には、所定ピッチｐで設けられた結晶粒界ａ−ａ間に、結晶粒ｂ、非晶質部、結晶粒ｂがこの順で周期的に設けられるように、半導体薄膜３の多結晶化が行われる。このような結晶化であっても、所定ピッチｐの結晶粒界ａ−ａ間に、規則的に結晶粒界ｂを配列した結晶化が行われる。また、半導体薄膜を完全溶融させて液相成長させて得られた結晶粒ｂであるため、結晶の質も良好である。
【００７１】
そして、このような非晶質部を残して結晶化された活性領域であっても、上述した実施形態と同様に結晶粒界ａに沿ってゲート電極を設けた構成とすることにより、結晶粒界ａのピッチｐによってトランジスタ特性の精度を高精度に制御し、特性バラツキの小さい薄膜トランジスタＴＦＴを得ることが可能である。
【００７２】
また、上述した実施形態においては、本発明の多結晶化方法を適用して薄膜トランジスタを備えた薄膜半導体装置を作製する方法を説明した。しかしながら、本発明の多結晶化方法は薄膜トランジスタの製造方法への適用に限定されることはなく、他の電子素子の製造方法にも適用可能である。どの場合であっても、結晶粒界ａを横切る方向に電流を流すように設定することにより、特性精度の良好な電子素子を得ることができる。
【００７３】
さらに、以上の実施形態で例示した材料、原料、プロセス、および数値などはあくまでも一例に過ぎず、必要に応じてこれらと異なる材料、原料、プロセス、および数値を用いても良い。
【実施例】
【００７４】
以下、本発明の実施例を図３に基づいて説明する。
【００７５】
＜実施例１＞
先ず、石英ガラス基板上に、プラズマＣＶＤ法によって膜厚１２０ｎｍの酸化シリコン膜を成膜してこれを基板１とした。この基板１上に、プラズマＣＶＤ法によって膜厚５０ｎｍの非晶質シリコンからなる半導体薄膜３を成膜した。次に、半導体薄膜３中の過剰水素イオンを脱離させるため、真空中において５００℃、１時間のアニール処理(水素抜きアニール処理）を施した。
【００７６】
その後、この半導体薄膜３に対して、直径ｒ＝約５００ｎｍ、基板面での照射エネルギー(板面照射エネルギー）１２ｍＷ、対物レンズの実効ＮＡ＝０．８のＧａＮスポットビームレーザ光Ｌｈを、一定の走査方向ｙに平行に走査させながら照射した。この際、実施例１においては、このレーザ光Ｌｈを、ピッチｐ＝４００ｎｍの間隔をおいて走査方向ｙに走査速度ｖ＝１ｍ／ｓで平行に走査させながら照射した。尚、半導体薄膜３に対するレーザ光Ｌｈの照射は、常にフォーカスサーボをかけ、走査時に焦点が外れないようにした。また照射エネルギーが一定になるように照射ビームの一部をモニターしてエネルギーの変動がないようにした。
【００７７】
このようなレーザ光Ｌｈの照射による結晶化を行った領域を、走査型電子顕微鏡（ＳＥＭ）で観察したところ、ピッチ（周期）ｐ＝４００ｎｍで設けられた一連の結晶粒界ａ−ａ間に、走査方向ｙと逆方向に凸となる均一な三日月形状の結晶粒ｂ’が規則正しく配列された多結晶領域が得られていることが確認された。
【００７８】
＜実施例２＞
実施例１におけるレーザ光Ｌｈの照射条件を、対物レンズの実効ＮＡ＝０．４、ピッチｐ＝６００ｎｍ、走査方向ｙへの走査速度ｖ＝３ｍ／ｓに変更したこと以外は、実施例１と同様に行った。
【００７９】
このようなレーザ光Ｌｈの照射による結晶化を行った領域を、走査型電子顕微鏡（ＳＥＭ）で観察したところ、ピッチ（周期）ｐ＝６００ｎｍで設けられた一連の結晶粒界ａ−ａ間に、走査方向ｙと逆方向に凸となる均一な三日月形状の結晶粒ｂ’が規則正しく配列された多結晶領域が得られていることが確認された。
【００８０】
＜実施例３-1，実施例３-2＞
実施例１のようにして多結晶化した領域を用いて、下記表１に示すように、チャネル長（ゲート線幅）Ｌ＝１０μｍ，２０μｍ、チャネル幅Ｗ＝５０μｍの各薄膜トランジスタを作製した。本実施例３の各薄膜トランジスタにおいては、図５に示したように、結晶粒界ａと平行にゲート配線５を設けている。これにより、図３に示したように、結晶化の際に最後に凝固する部分であり不純物が集中している結晶粒界ａを横切る移動方向Ｘｃにキャリアを移動させる構成とした。また、実施例３-1，実施例３-2の各薄膜トランジスタにおけるチャネル部の結晶粒界ａの本数は、約２５本、約５０本となる。
【００８１】
【表１】
2007281420.tif 000003
【００８２】
作製した各薄膜トランジスタについてのオン電流のバラツキを測定した。その結果を上記表１に合わせて示す。表１に示すように、実施例３-1ではオン電流バラツキ±σ＝±１．９％、実施例３-2ではオン電流バラツキ±σ＝±１．３％に抑えられていた。また、しきい値Ｖｔｈのバラツキσも、実施例３-1では０．０８Ｖ、実施例３-2では０．０６Ｖに抑えられていた。これにより、本発明を適用して多結晶化させた半導体薄膜でチャネル部を構成することにより、トランジスタ特性を高精度に制御することが可能であることが確認された。特にオン電流バラツキ±σ＝３％以内に抑えられることから、有機電界発光素子を用いた表示装置における画素電極のスイッチング素子として、この薄膜トランジスタを用いた場合であっても、輝度バラツキが視認されない程度に充分に抑えられることが確認された。さらに、実施例３-1と実施例3-2との比較によれば、結晶粒界ａの本数が多いほど、オン電流およびしきい値のバラツキが小さく、特性精度の良好な薄膜トランジスタが得られることが確認された。またこのときのＦＥＴ移動度(キャリアの移動度）は、実施例３-1，３-2ともに２６ｃｍ2／Ｖｓであり、画素スイッチとして十分良好なトランジスタ特性が得られることも確認された。
【００８３】
＜実施例４-1，実施例４-2＞
実施例２のようにして多結晶化した領域を用いて、下記表２に示すように、チャネル長（ゲート線幅）Ｌ＝１０μｍ，２０μｍ、チャネル幅Ｗ＝５０μｍの各薄膜トランジスタを作製した。本実施例４の各薄膜トランジスタにおいても、図５に示したように、結晶粒界ａと平行にゲート配線５を設け、図３に示したように結晶化の際に最後に凝固する部分であり不純物が集中している結晶粒界ａを横切る移動方向Ｘｃにキャリアを移動させる構成としたことは、実施例３と同様である。また、実施例４-1，実施例４-2の各薄膜トランジスタにおけるチャネル部の結晶粒界ａの本数は、約１７本、約３３本となる。尚、オンオフ特性向上やバラつきを低く抑えるために、本第４実施例においてはプロセスに変更を加えている。
【００８４】
【表２】
2007281420.tif 000004
【００８５】
作製した各薄膜トランジスタについてのオン電流のバラツキを測定した。その結果を上記表２に合わせて示す。表２に示すように、実施例４-1ではオン電流バラツキ±σ＝±０．９４％、実施例４-2ではオン電流バラツキ±σ＝±０．５６％に抑えられていた。また、しきい値Ｖｔｈのバラツキσも、実施例４-1では０．１０Ｖ、実施例４-2では０．０６Ｖに抑えられていた。これにより、ＮＡ＝０．４でも同様に、本発明を適用して多結晶化させた半導体薄膜でチャネル部を構成することにより、トランジスタ特性を高精度に制御することが可能であることが確認された。特にオン電流バラツキ±σ＝３％以内に抑えられることから、有機電界発光素子を用いた表示装置における画素電極のスイッチング素子として、この薄膜トランジスタを用いた場合であっても、輝度バラツキが視認されない程度に充分に抑えられることも確認された。さらに、実施例４-1と実施例４-2との比較により、結晶粒界ａの本数が多いほど、オン電流のバラツキが小さい、すなわち特性精度の良好な薄膜トランジスタが得られることが確認された。またこのときのＦＥＴ移動度(キャリアの移動度）は、実施例４-1，４-2ともに１８ｃｍ2／Ｖｓであり、画素スイッチとして十分良好なトランジスタ特性が得られることも確認された。
【００８６】
＜比較例＞
従来構成のエキシマレーザーを用いた結晶化工程を適用して複数の薄膜トランジスタを形成した。
【００８７】
先ず、実施例１と同様の半導体薄膜３を成膜した後、ＫｒＦのエキシマレーザーを、光学的に短軸方向の幅４００μｍ、長軸方向の長さ１００ｍｍのラインビームに加工し、1パルス毎に短軸方向に８μｍのピッチで照射位置をずらし、残りの領域は重なるようにレーザーを照射した。このときに短軸に平行な断面で評価したエネルギープロファイルは、トップハット型（台形型）に調整してある。上記条件で照射を行った場合、同じ領域には約５０ショットのパルスレーザーが照射されることになる。照射レーザーは１パルスが２５ｎｓで、３１０ｍＪ／ｃｍ2相当のエネルギー密度となるようにアッテネーターを用いて調整した。
【００８８】
このようなレーザ光Ｌｈの照射による結晶化を行った領域を、走査型電子顕微鏡（ＳＥＭ）で観察したところ、一辺が約２５０ｎｍの四角形状の結晶粒が格子状に規則正しく配列された多結晶領域が得られていることが確認された。
【００８９】
上記多結晶化した領域を用いて、下記表３に示すチャネル長（ゲート線幅）Ｌ＝２０μｍの薄膜トランジスタを作製した。尚、各薄膜トランジスタのチャネル幅Ｗ＝５０μｍとした。
【００９０】
【表３】
2007281420.tif 000005
【００９１】
作製した各薄膜トランジスタについてのオン電流のバラツキ等を測定した。その結果を上記表３に合わせて示す。尚、表３には、比較例と同一規格（チャネル長Ｌ＝２０μｍ、チャネル幅Ｗ＝５０μｍ）の各実施例についての結果を合わせて示した。
【００９２】
この結果から、本発明を適用して結晶化させた半導体薄膜を用いた実施例３，４の薄膜トランジスタのオン電流やしきい値Ｖｔのバラツキは、本発明を適用せずにエキシマレーザによって結晶化させた半導体薄膜を用いた比較例よりも、はるかに小さいことが確認された。尚、ＦＥＴ移動度については、比較例の薄膜トランジスタの方が高い値を示しているが、本発明を適用した実施例３，４の値であっても画素スイッチとして十分良好な値である。
【図面の簡単な説明】
【００９３】
【図１】本発明の結晶化方法を説明する平面図（その１）である。
【図２】本発明の結晶化方法による結晶成長を説明する図である。
【図３】本発明の結晶化方法を説明する平面図（その２）である。
【図４】本発明の結晶化方法を用いた薄膜半導体装置の製造方法を説明する平面工程図（その１）である。
【図５】本発明の結晶化方法を用いた薄膜半導体装置の製造方法を説明する平面工程図（その２）である。
【図６】図５におけるＡ部の拡大平面図である。
【図７】複数の活性領域の結晶化を説明する平面図である。
【図８】図５におけるＸ−Ｘ’断面図である。
【図９】薄膜半導体装置を用いた液晶表示装置の製造工程図である。
【符号の説明】
【００９４】
３…半導体薄膜、ａ…結晶粒界、ｂ…結晶粒、ｂ’…三日月形状の結晶粒、Ｌｈ…レーザ光（エネルギービーム）、ｐ…ピッチ、ｙ…走査方向
【図１】
2007281420.tif 000006
【図２】
2007281420.tif 000007
【図３】
2007281420.tif 000008
【図４】
2007281420.tif 000009
【図５】
2007281420.tif 000010
【図６】
2007281420.tif 000011
【図７】
2007281420.tif 000012
【図８】
2007281420.tif 000013
【図９】
2007281420.tif 000014