(57)【要約】      （修正有）【課題】  本発明は狭帯域周波数で複数チャンネルが出来又その為の時分割用フラッグビットを作った、この為搬送波方式のＰＣＭ送受信機を得るにある。【解決手段】フラッグビットと搬送波方式ＰＣＭ装置で構成され、スイッチ素子を用い、シリアル出力を制御し、バイト毎に搬送波を４ビットのコードの前又は後ろに入れ時分割の回周回路とし、狭帯域周波数で複数チャンネルの搬送波方式ＰＣＭ装置としている。【選択図】図１
2007150771.tif 000002
【特許請求の範囲】
【請求項１】
一周波数、一波を３６０°とする正弦波の高周波の９０°の最高電圧に成った時、その電圧を高周波電圧検出回路にて検出し、１波若しくは２波後でスイッチ素子にて発信高周波を切る、そして一波の９０°の時の高周波電圧の高い部分当たりで、高周波電圧を検出して、時分割カウンタ回周回路にて、ビット又はパルスを作り、同時に回周回路、即クロックでもある、ここでタイミングパルスを５分周或いは６分周のパルスを作り発振する。ここで１ビット目即ちフラッグビットとし時分割用のビットでもある、そして１ビットマシン、プラス４ビットマシンにて構成し、１ビットマシンは機器にスイッチの入っている時、定常的に１ビット即ちフラッグビットを発振する。そして４ビットにて音、画像、文字等を表現する、そして５ビットマシンにてパラレル出力する、そしてパラレルシリアルコンバータにてシリアル出力に変換してスイッチ素子にて、ＣＷ、従って搬送波通信と同様に電波１波或いは２波毎、高周波を切、高周波増幅し、更に電力増幅してアンテナより発射する、そして受信機側で高周波３６０°正弦波を高周波増幅後従来のＡＭ検波にて高周波３６０°の正弦波を正電圧正弦波１８０°にし、これを一つのパルス又はトリガパルスとしパルス整形して、シリアルに連続して来る信号又はパルスをシリアル・パラレルコンバータ等に依ってフラッグビットを除き０から８迄の数値として認識する、そして音、画像、文字等として表現する、ここでフラッグビットは時分割と複数チャンネルの分割用マーカでもある。
【請求項２】
スイッチ素子で例えば１００ＭＨｚを４波又は１２波を初めの一波長３６０°高周波正弦波３６０°の最初の９０°の高周波電圧を検出して、４波毎又は１２波毎の時間等を予め決めておき、送信機変調部でスイッチ素子にて搬送波方式ＰＣＭとする、そしてフラッグビットを１つ作り時分割マーカとして、音、画像、文字等の信号は４ビットで０から８迄の数で表現し、１バイトを１ビットプラス４ビットで１ユニットとし５ビット毎送信する、更に受信機では受信した搬送波を増幅して４波毎又は１２波の内の１波の数倍の高周波を別回路で発振させておき、混合、重畳合成しても良いし、又位相変化回路で位相変化し重畳合成しても良い、そして平滑コンデンサ、抵抗、コイルなどで平滑して、ＡＭ検波方式で高周波正電圧のみにし、これを１波トリガパルスとして認識し、更にパルス整形回路で整形し、１つのパルスとして、時分割用フラッグビットと４ビット毎のバイトとして０から８の数を認識して音、画像、文字を表現できる、フラッグビットで回周回路で時間即ちタイミングパルスにてスイッチ素子にて時分割し、複数チャンネルを搬送波１周波数で送受信出来る。
【請求項３】
例えば１００ＭＨｚの高周波と送信機側でＦＭ変調波を行い、受信機で受信して、高周波増幅して高周波フィルターでＦＭ波を特定の例えば１００ＭＨｚの基準波のみをフィルターで通過させ、ＦＭ変調周波数変化分は捨て、搬送波のみにし、搬送波、高周波の数倍の高周波を混合、重畳合成回路にて重畳して、平滑コンデンサ、コイルなどのインピーダンス等で平滑してＡＭ検波方式で高周波正電圧のみにし、これを１波トリガパルスとして認識し、更にパルス整形回路で整形し、１つのパルスとして、時分割用マーカとしてのフラッグビットと４ビット毎のバイトで０から８迄数又は符号とし、フラッグビットを１ビット、バイトの４ビットでプラスして５ビットを１つのユニットとして送受信して、時分割用マーカフラッグビットでカウントして同時に回周回路で時間即ちタイミングパルスにてスイッチ素子にて時分割し、複数チャンネルを、ＦＭであるが、１高周波周波数で受信出来る、一種のＦＭ搬送電波方式ＰＣＭである。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、搬送波方式ＰＣＭに関する。
【背景技術】
【０００２】
従来のディジタル無線通信はある種のフリケシーモジュレーション即ちＦＭ変調で、音声波形の変わりにパルス又はＰＣＭそして方形波パルス又はパルス表現してフィルター又はリミッターを用い方形波パルス又はパルスとしてディジタル符号として認識していた、そして文字、音声、画像として表現していた、これはある種ＡＭ／ＰＭ法としていた、更にスペクトル拡散通信などを用いディジタル変調としていた。したがって、ＡＭ／ＰＭ法やスペクトル拡散通信では、幅の広い周波数帯を用い多くの情報を無線通信等で行っていた、初期のＰＣＭ通信は電鍵で手動でモールス符号又は数を使った暗号であった。
【発明の開示】
【発明が解決しようとする課題】
【０００３】
本発明は以上のような欠点に鑑み、搬送波を用い搬送波を電けんの変わりにスイッチ素子を用い、コンピュータのシリアル出力を制御し更にバイト毎にしフラッグビット搬送波を４ビットのコードの前又は後ろに入れ時分割の為の回周回路とし、狭帯域で一周波数で複数チャンネルの搬送波方式ＰＣＭ送受信機装置を提供することを目的としている、更に
【０００４】
本発明は以上のような従来の欠点に鑑み、搬送波方式ＰＣＭ送受信装置では従来の一種ＦＭ波を用いたＰＣＭ通信方式に比べて、更に多くの情報を送受信通信を行える物を提供出来る。
【課題を解決するための手段】
【０００５】
上記目的を達成するために、本発明請求項１で述べた通りで搬送波方式ＰＣＭ装置で構成している。
【０００６】
搬送波方式を実現させる為には、最近の速度の速いスイッチングトランジスタが出来た事と、ディジタルＩＣが高速に成った事で、搬送波即ち高周波の一波の正弦波の高周波電圧が検出できる様に成った為である、一つには高周波一波長の１／４λ９０°ところの高周波電圧を検出する為には、高速の増幅素子と高速のスイッチング素子で構成される、変調部を必要とし又パラレル、シリアル・コンバータ又はパラレル、シリアル・コンバータを用いコード変調する、これはシリアル出力とし変調部スイッチング素子に逐次入力する、又高速のビットマシンでクロック又はタイミングパルスを出し、更にフラッグビットを出しこれを時分割用マーカとクロックとし受信側の時分割のタイミングパルスとしクロックとし回周回路を作動させる。
【０００７】
搬送方式ＰＣＭ通信機には、アンテナで受信し高周波増幅とＩＦＴ又はフィルターで構成して高周波を増幅する、そして一種のＡＭ検波の方式で１波長３６０°正弦波の高周波の内、正電圧の正弦波分ＡＭ検波する、そしてプラス側の１波１／２λ１８０°の高周波を増幅し、１波長１／２λの高周波をトリガパルスとしパルス整形回路でパルスとし。フラッグビットは時分割の為と回周回路のクロックの周期信号でもあり４ビット毎とプラス１ビットのフラッグビットの時分割の為の信号を出力する、そしてシリアル・パラレルコンバータ又はシフトレジスタに入力してある検波又は４ビット毎の並列認識とし、時分割の為のパラレルパルス信号をフラッグビットをカウンター回路でカウントし更にタイミングパルスとして認識して、４ビット毎に認識したパルスをスイッチング素子に入力して、時分割する。
【０００８】
上記目的を達成する為に、本発明請求項２で述べた通りで搬送波方式ＰＣＭ装置を構成している。
【０００９】
更に第２の最良の形として例えば１００ＭＨｚを例えば４波又は８波を時間で認識して高速スイッチ回路でスイッチして、高周波をスイッチ素子で切り、例えば４波又は８波を１つのビットとし、時分割の為のフラッグビットを入れ、更に４ビットマシーンで音、絵、文字を変調する為、４ビットマシンからのパラレル出力をパラレルシリアルコンバータでシリアル出力して、更に時間又はクロック回路から時分割の為のフラッグビットを挿入して、５ビット毎の逐次高周波増幅、電力増幅そしてアンテナから発射、送信する。
【００１０】
受信機ではアンテナで受信し高周波増幅して一種のダイオードでＡＭ検波して例えば１００ＭＨｚの例えば４波又は１２波によって構成される１ビットの１波３６０°のサインカーブの電波又は高周波の下側のマイナス分を検波ダイオードでカットし１種ＡＭ成分を例えば４波、４λ又は１２波１２λでもある、しかしＡＭ成分であるこれを例えば４波又は８波を１ビットとして認識する為に一つの方法として位相を１波１λの９０°毎にずらして重畳合成回路に入力して、１ビットする信号の成分をランダムにして、次の合成平滑回路で一つのパルスとし１ビットにする方法と、更に例えば４波４λ又は１２波１２λを逓倍回路を用いて、例えば１０倍の高周波１０００ＭＨｚを重畳合成回路にて、一つのパルスに合成変化させ１ビットとして、５ビット毎送信した信号内１ビットは時分割の為のフラッグビット又はカウンター回路にて時分割の為の１ビット信号とし、残り４ビットで音、絵、文字認識をする。
【００１１】
前記段落００１０で述べた時分割する為には重畳合成回路、平滑回路、パルス整形回路を経たシリアル出力である、シリアル・パラレルコンバータにてパラレル出力として、フラッグビットにてカウンター回路でクロック又はタイミングパルスを出力して、同期信号でもありフラッグビット信号を、シリアル・パラレルコンバータ回路の出力後４ビット毎の並列一括のスイッチ素子で時分割して多チャンネル又は複数チャンネルとする事が出来るが、その為にフラッグビットをカウンター回路にて検出して、４ビット毎のパラレル、４ビットとし並列スイッチ素子に一括並列入力し、フラッグビットに依る信号により並列スイッチを動作させＯＮ、ＯＦＦし複数チャンネルを実現させる事が出来る。
【００１２】
上記目的を達成する為に、本発明請求項３で述べた通り第２の方式として、搬送波方式ＰＣＭ装置を本構成している。
【００１３】
更に第３の最良の形として、送信側でＦＭ変調を行い、受信機側でアンテナで受信後、高周波増幅して、更に高周波フィルターで例えば５０Ｈｚ程度、電波周波数をずらして、例えば１００ＭＨｚのＦＭ変調してＦＭ変調した高周波を高周波増幅、電力増幅した電波をアンテナから送信してアンテナで受信して高周波増幅後、高周波フィルターにて送信側の発信部出力高周波を基準周波数として高周波フィルターにて取り除き、基準周波数のみを一つの搬送波方式ＰＣＭとしてもよい、又逆に発振、送信周波数の内例えば５０Ｈｚ程度ＦＭ変調した部分を高周波フィルタで通し、この高周波数を搬送波方式ＰＣＭとしても同様に出来る。
【００１４】
第３の発明のＦＭ変調搬送波ＰＣＭ装置ではアンテナで受信後、高周波増幅後帯域フィルターでＦＭ変調前とＦＭ変調後いずれかの同一周波数を搬送波ＰＣＭとする事が出来る。
【００１５】
段落００１４で述べたよＦＭ変調後の受信側高周波増幅後帯域フィルターで同一周波数を一種の搬送波ととらえ、請求項４で述べた復調方式で復調して段落００１０、００１１で述べた復調で行い、フラッグビットで複数チャンネルの送受信が行える。
【発明の効果】
【００１６】
以上の説明から明らかなような、本発明にあっては次ぎに列挙する効果が得られる。
【００１７】
請求項５の構成要件とで構成されているので、搬送波方式ＰＣＭの変調はシリアル又は直列に変調素子に符号又は信号をスイッチ素子に送り込む必要がある、これはＡＭ変調、ＦＭ変調、ＣＷモールス式で同様である、これは電波の性質上逐次電波を発信送り出している為である、時分割用フラッグビットを作り、送り出す事により従来なかったビットであるが、４ビット毎の符号の認識が簡易に成る、フラッグビットと４ビットの０，０，０，０,の４つの０とフラッグビット１ビットと合わせ５ビット１ユニットとし送る事により複数チャンネルの最初のスタート地点を認識する
【００１８】
フラッグビットをカウントする時分割カウンタ回周回路により、フラッグビット何番目により、例えば２個目、２番目にチャンネルセレクターでスイッチ素子に指令して開閉を行い、目的のチャンネルを拾う、ここで時分割カウンタ回周回路の内１回周回路ではフラッグビットを受信して、時計又はタイミングパルスを送り出す、目的のチャンネルを拾う為のスイッチ素子は４ビットづつ並列に認識する為、パラレル、シリアルコンバータを必要とする、同時に電波は直列に入力受信する為にチャンネルセレクターからのスイッチ素子２２ａ、２２ｂ、２２ｃ、２２ｄに入力し出力する為、シリアル・パラレルコンバータを必要とする、音、画像、文字を表現部で表現する。
【００１９】
請求項６の構成要件とで構成されているので、搬送波方式ＰＣＭの変調は直列に符号又は信号等のディジタル信号を変調素子又はスイッチ素子に送出するに際して高周波３６０°の内９０°当たりの最も高い電圧を検出するが、この電圧は平均的に出る電圧を予め決めておき、時分割カウンタ回周回路にて時計又はタイミングパルスを発生して、フラッグビットを作り出す、そして例えば４波長又は１２波長毎の時間を予め決めておき、フラッグビットを作り、１ビットマシン、プラス４ビットマシン即ち５ビットマシン１５の内１ビットマシンにタイミングパルスと同時にフラッグビットを定常的に出し、同時に５ビットマシンの４ビットマシンに同期又はタイミングパルスとする、４ビットマシンにはバイトにて音、画像、文字等の数値符号が入力され、タイミングパルス即ち同期信号としてパラレル、シリアルコンバータ１４にて逐次スイッチ素子１０にＯＮ、ＯＦＦ信号を出力し、スイッチ素子１０にてＯＮ、ＯＦＦ信号例えば４波又は１２波毎に高周波増幅部１１から電力増幅部１２を経てアンテナ１３により電波を送信する、これは複数チャンネルに対応する為のもので、特にフラッグビットを設け時分割を簡易にした。
【００２０】
受信機側にては前述の段落００１８に述べたような形で一周波数又は搬送方式ＰＣＭで送信してきた電波をアンテナ１３で受信して高周波増幅部１７で増幅して４波又は数波毎到来着信した、電波即ち高周波に対して逓倍発振部２５にて察知して、既に発振している例えば１０倍の高周波を重畳合成回路２４にて、重畳合成してダイオード１８でＡＭ検波して、パルス整形回路１９にて４波若しくは数波毎に付き図７の２９ａから２９ｂの型ち即ち重畳合成波に成り、パルス整形部にて１つのパルスに成り、逐次シリアル・パラレルコンバータに入力すると同時図５の時分割カウンタ回周回路２１、チャンネルセレクター回路２３よりスイッチ素子郡２２ａ、２２ｂ、２２ｃ、２２ｄに同時信号を送り並列処理若しくは並列選択してパラレル又はシリアルに変換して音、画像、文字、表現部１６ａにて音、画像、文字等に表現する。
【００２１】
請求項７の構成要件とで構成されているので、ＦＭ変調、搬送波方式ＰＣＭでは、送信機側で従来のＦＭでも搬送波方式ＰＣＭでは発振部変調前の周波数若しくは変調後周波数でも搬送波方式ＰＣＭでは使用を出来る、これはＦＭ変調した周波数の変化分をフィルターで取り除き搬送波のみにする為である、受信機側ではＦＭ変調した、高周波変調分を高周波フィルタで取り除き、搬送波のみにして、ＡＭ検波し、重畳合成波にて、１つのパルスとして認識する。
【発明を実施するための最良の形態】
【００２２】
以下、図面に示す発明を実施するための最良の形態により、本発明を詳細に説明する。
【実施例１】
【００２３】
図１ないし図５の本発明を実施するための最良の形態において図１はフラッグビット又は一種のカウンタビットに依る時分割の為と４ビット毎の情報用の数値１又は０を示し、バイト毎に送信する０を４ビットづつ２つとフラッグビット２つで０地点でパルスコードの初めの地点を表し、そこからパルスコード通信の始まりを示した、更にフラッグビット１は４ビット毎即ちバイト毎の１から８迄の数を表し、更に時分割カウンタ回周回路７の、ある意味での時計とタイミングパルスでもある、図２では高周波の特性の正弦波３６０°を示し、更に高周波検波後の正電圧高周波正弦波１８０°５を示した、図３では発振部７と水晶振動子６とで高周波発振を行い、例えば１００ＭＨｚの水晶振動子６を使用した、発振部７では常に発振しており、この発信周波数例えば１００ＭＨｚの搬送方式ＰＣＭでは音、画像、文字１６ａではこれらの入力部であり、これを従来の４ビットマシンと１ビットプラス４ビットマシンの組合せ、足した５ビットマシン１５で音、画像、文字のＡ／Ｄ変換した後のディジタル符号を１６ａ部から５ビットマシン１５に送出し、更に発振部７からの発振の１００ＭＨｚのある種１波とする為に任意の高周波の中から、一波の高周波電圧検出部８で検出して、図２の高周波３６０°正弦波４ａの９０°４ｂの当たりを高周波電圧を検出する為の回路、高周波電圧検出部８にて検出して、時分割カウンタにて、時分割の為のカウンタビット即ちフラッグビットの発振させ、更に回周回路にてクロック又はタイミングパルスを定常的に発振させ、１ビットマシン＋４ビットマシンにて成立する５ビットマシンにて１ビットマシン部では定常的に発振し、発振部７からの高周波９０°４ｂからの信号を５ビットマシンで成立する１ビットマシンに送り１ビットは定常的に１ビット認識発生させ、５ビットマシン１５の内４ビットマシンについては、音、画像、文字等の数値価符号を４ビット即ちバイト毎に認識して、５ビットマシン１５にて１ビットと４ビットで成り立つ符号をパラレル、シリアルコンバータ１４にてパラレル信号をシリアル信号に変換して、スイッチ素子１０にて、高周波のうち０°から９０°当たりで検出した高周波信号を、図３の高周波電圧検出部８、時分割カウンタ回周回路９，５ビットマシン１５、パラレル、シリアルコンバータ１４と経過すると時間遅れが発生する為に、スイッチ素子１０でのスイッチは高周波サインカーブ３６０°４の高周波正弦波３６０°４の後の例えば１波又は２波遅れてスイッチして搬送方式ＰＣＭの第１波即ち１λとする、図１のフラッグビット１と４ビット毎の５ビット毎の高周波を高周波増幅部１２にて電力増幅してアンテナ１３より送信する。
【００２４】
４図ないし５図の本発明を実施するための最良の第一の形態において図４の搬送波方式ＰＣＭ受信部を示し更にＡ鎖線内ではＡＭ検波後図２の高周波検波後５の１／２λの高周波正電圧、正弦波をパルス整形部にてのパルスを認識する拡大図である。
【００２５】
図４から本発明を図面に従って詳細に説明する。図４のアンテナ１３で受信する、この時、送信は少なくとも１λ以上必要とする、そしてこの１λの高周波、例えば１００ＭＨｚとして、この１λの高周波を高周波増幅部１７に増幅して検波ダイオード１８にて検波して、図２の高周波正電圧５ａのみとし高周波負電圧５ｂは切り捨てる、そしてこれにて正電圧高周波にてトリガパルスを作る図２の高周波検波後５ａによりパルス整形部１９でパルスを整形して認識し易くする、更にシリアル・パラレルコンバータ２０に入力する、更にパルス整形部１９から同時に時分割カウンタ回周回路２１にて、フラッグビット１を受信、カウントして時分割の為のクロック周波数を時分割カウンタ回周回路２１にてタイミングパルスを発生させバイト毎、４ビット毎の信号を時分割する。
【００２６】
前記段落００２５に述べた時分割と１／２λ毎の信号認識する為に、図４の鎖線内Ａ内を図５として拡大して説明を解り易くした、矢印Ｂから進行して来る高周波を検波ダイオード８でＡＭ検波して、高周波正弦波３６０°図２の４を高周波検波後５で高周波成分中、高周波正電圧５ａのみにして、これをトリガパルスとして図５のパルス整形部１９にて、パルスとして、図１の時分割の為のフラッグビット１として時分割カウンタ回周回路２１にて、カウントして同時に回周回路でクロック即ち、簡易に説明すると例えば５分周の時間即ちパルスタイミング用のパルスを作る、そしてチャンネルセレクタ１ｂで、フラッグビット１をカウントして、何番目のフラッグビット１を時分割カウンタ回周回路２１にてフラッグビット１の数を数え、何番目かのフラッグビット１に従ってスイッチ素子２２ａ、２１ｂ、２２ｃ、２２ｄ迄のスイッチ素子に指令して、ＯＮ、ＯＦＦとしてフラッグビット１に従って複数番目かの４ビット２毎、即ちバイト２毎に認識する、ここでパルス整形部１９からのパルス信号はシリアル信号又は符号なのでシリアル・パラレルコンバータに入力して、フラッグビット１は定常的に入力して来、そのフラッグビット１はシリアル・パラレルコンバータが出力して来るので、時分割カウンタ回周回路２１で常にカウントしている、更にフラッグビット１にてカウントして何番目づつの４ビット２毎の符号を音、画像、文字表現部１６ａにて表現する、上記に基づいて複数チャンネルを実現させる為、更に時分割カウンタ回周回路２１にて、フラッグビット１をタイミングパルスとして出力する、これをチャンネルセレクタ２３にてカウントとして複数チャンネルの内、何番目をカウントして、何番目かのカウントしたチャンネルをタイミングパルスを出力しスイッチ素子２２ａ、２２ｂ、２２ｃ、２２ｄにてスイッチを入れ、複数番目かのチャンネルを選択して、音、画像、文字表現部１６ａにて表現する、又送信は１λ１波長としても良いが送信時、高周波電圧検出８、時分割カウンタ回周回路９にての各回路に時間遅れが発生する為、１／４λで高周波電圧は検出するが、次の１λ又は２λ即２波長遅らして、フラッグビット１又は４ビット２のそれぞれのビットを１ビット図２の１λ１波長の内１／４λ９０°４ｂを、パルスとして扱い、受信側でトリガパルス発生として用いる為１波長１λ又は２波長２λ毎を使用せず、  １波長１λのみを送信して、１波毎の間隔を長くして図３の受信側の認識も簡易に成る。
【００２７】
先に述べた第１の最良の形態を実現する為には、図３の発信部７を高周波電圧検出部８にて検出して時分割カウンタ回周回路９にて１ビットマシンにて定常的に１ビット即ち１パルスを発生させる、これをフラッグビット１とし更にクロックとする、そして音、画像、文字１６等を４ビット即ち０から８迄の数値価符号を１ビットマシンプラス４ビットマシン即ち恰も５ビットマシンとして成立するコンピュータ１５にて出力し、４ビットマシンのクロック即ち同期信号として時分割カウンタ回周回路にて時分割用フラッグビット１とする、そしてフラッグビットを５ビットマシン１５の同期信号即ちタイミングパルス又はクロックとする。
【実施例２】
【００２８】
図３と図６、図７の本発明を実施するための異なる形態を図面に従って説明する、図３の送信機若しくは搬送電波方式ＰＣＭでは、発明を実施する為の最良の第１の形態と同様に搬送波方式ＰＣＭ送信機は使用できる、これを図１の例えば２波又は１２波毎として複数波を１波１パルスとして使用するために、図３の水晶振動子６と発信部７とで例えば１００ＭＨｚで発信し、例えば２波、２λ又は１２波、１２λでも使用できる、これは図３の発信部７で発信し、図２の１／４波、１／４λの当たりで高周波電圧を、高周波電圧検出８で検出して、図１のフラッグビット１と４ビット２を送信する、フラッグビット１は時分割の為のもので、時分割カウンタ回周回路９でフラッグビット１の為のタイミングパルス又はクロック１ビットマシンプラス４ビットマシンにて成り立つ５ビットマシン１５に送出して、１ビットマシンプラス４ビットマシンの内１ビットマシン部で時分割の為のフラッグビット１を定常的に送り出し、音、画像、文字１６ａを１ビットマシンプラス４ビットマシンの内、４ビットマシンにて、音、画像、文字等を１ビットプラス５ビットマシン１５のパラレル出力パラレルシリアルコンバータ１４からスイッチ素子１０にて搬送波方式ＰＣＭとし高周波増幅部１１を経て電力増幅部１２を経てアンテナ１３より発信する。
【００２９】
図６の搬送波方式ＰＣＭではアンテナ１３で電波を受信して高周波増幅部１７で高周波を充分増幅してこの高周波を重畳合成回路２４に入力し、同時に逓倍発信部２５にて例えば数倍位の高調高周波を作り、重畳合成部２４に入力して、アンテナから受信して高周波増幅部１７で増幅した高周波と逓倍発信部２５にて例えば数倍の高周波を重畳合成部２４入力して重畳合成する、この際、高周波増幅部１７から出力した高周波と逓倍発信部２５からの出力高調高周波の高周波電圧をなるべく揃える、この際基準高周波電圧は逓倍発信部の発信部の定常的に発信させておき、基準高周波電圧とし、合成部１７にフィードバックした、高周波増幅部１７からの出力高周波電圧と高調高周波を揃える為一種の自動高周波電圧制御を行う、逓倍発信部で定常的に発信し、搬送波方式ＰＣＭではモールス符号通信と同様に高周波電波を１種、切り、接続するが、搬送波方式ＰＣＭでは送信機側からの電波を受信して高周波増幅する、そして高周波増幅部１７からの高周波出力を逓倍発信部２５にて、定常的に発信している高調高周波をスイッチ素子にて一種の搬送波が受信又は高周波増幅部１７から出力した、高周波を重畳合成回路２４にて逓倍波を合成して、正弦波重畳合成パルスを作り、ダイオード１８にＡＭ検波して、正電圧重畳高周波を一種のトリガパルスとして、パルス整形部１９にてパルスとして予め時分割用フラッグビット１と４ビット２で成るパルス符号をシリアル・パラレルコンバータ２０に入力し、更に同時に時分割カウンタ回周回路２１に入力し、更にフラッグビットをカウントし、フラッグビットの複数番目の数にてチャンネルセレクタ２３にて４ビット２即ちバイトとして成るパルス符号を弁別する、そして音、画像、文字に変換する。
【００３０】
図６の鎖線内Ａで、前述したチャンネルセレクタ２３に依る切換は図５のブロック図と同様に成る、即ち図６の鎖線内Ａの拡大図に伝える図５に依って説明する、Ｂ矢印から入力する重畳合成した正弦波２９ａの、信号をダイオード１８にＡＭ検波し、正弦波は正電圧高周波２９ｂに成る、そしてこの正電圧高周波は数波プラスその数倍の正電圧高周波２９ｂと成る、この重畳合成高周波２９ａからＡＭ検波後の正電圧重畳波高周波２９ｂに成り、これをパルス整形部１９に依って正電圧高周波は一つのパルスとして出力してシリアル・パラレルコンバータ２０に入力し、フラッグビット１と４ビット２として成る、１ユニット、５ビット内フラッグビット１を時分割カウンタ回周回路２１からチャンネルセレクタ２３にてスイッチ素子２２ａ、２２ｂ、２２ｃ、２２ｄにて複数チャンネルとして成る搬送波方式ＰＣＭは例えばフラッグビット１と４ビット２として５ビットで構成された一つの信号又は符号は４ビット３の０，０，０，０，を数列で成る部分で最初のスタート地点として、時分割カウンタ回周回路２１にてカウントして何番目の特定をしてチャンネルセレクタ２３からスイッチ素子２２ａ、２２ｂ、２２ｃ、２２ｄにて切り換え出力し、音、画像、文字表現部１６の機器にて表示する。
【実施例３】
【００３１】
図８と図９の本発明を実施するための第２の異なる形態を図面に従って説明する、図８の送信機、ある種ＦＭ方式ＰＣＭで、請求項２と同様の効果が出来る、以下図８に従って説明する、図８の水晶発振子６と発信部７からなる発信部７、そして図１のフラッグビット１と４ビット２毎の１の数値を示す符号２と４ビット毎０を示す符号３で時分割の為のフラッグビット１を使い、前記実施例の時分割をフリケンシーモジュレーション（以下ＦＭ変調部３０とする）、ここで発信部７から出力してくる、例えば１００ＭＨｚの高周波の正弦波３６０°の内、９０°当たりで高周波電圧を検出する為の高周波電圧検出部８から、正弦波３６０°の内の９０°当たりの電圧をパルスとし時分割カウンタ回周回路８に入力し、この時点でこの高周電圧はパルスとし時計としタイミングパルスとして時分割用フラッグビット１とする、そして１ビットマシンプラス４ビットマシン即ち５ビットマシン１５とし１ビットマシンは送信中定常的に１ビットを発生させフラッグビット１と４ビットマシンには音、画像、文字入力部１６ａを４ビットマシンに入力する、即ち５ビットマシン１５に入力する、これを５ビットマシン１５からシリアル入力し、ＦＭ変調部２７にフラッグビット１と４ビット４をシリアルに電圧変化分をＦＭ変調させ、さらに高周波増幅部１１で増幅して電力増幅部に電力増幅して、さらにアンテナ１３から送信する。
【００３２】
図９にて受信部を説明する、アンテナ１３にて受信し、高周波増幅フィルター部２６にて周波数変調された部分と無変調部分の内、無変調周波数のみを高周波増幅フィルター部でフィルタ効果に従って無変調のみ、又は周波数変化させた部分のみでもよいが、無変調周波数のみを拾う、そしてこれが搬送波方式ＰＣＭと同様と成る、この充分に高周波増幅された、搬送波即ち高周波を逓倍発信部２５にて数倍の高周波を重畳合成回部２４にて図７の４ｂの無変調高周波と重畳合成された２８ａとなりダイオード１８にＡＭ検波し図２の無変調高周波５ｂと重畳合成された２８ｂの正電圧のみの高周波となる、この基本高周波数正電圧を一つのトリガパルスとしパルス整形部１９にて、通常のパルスと成る、これを図１のフラッグビット１と４ビット２の４ビット３との数とし、この内フラッグビットを時分割カウンタ回周回路２１に入力し、このフラッグビット１と図１の０の数を示す４ビット３を例えば、フラッグビット１を２回、４ビット３の０を示す４ビットを例えば２回受調して初めのスタート地点として複数チャンネルのスタート地点とする、これをチャンネルセレクタ２３に複数番目のフラッグビット１を、又はパルスとし、図５のスイッチ素子２２ａ、２２ｂ、２２ｃ、２２ｄにてチャンネル選択して、音、画像、文字表現部１６ｂにて表現する。
【産業上の利用可能性】
【００３３】
放送機やテレビ、ラジオ、無線通信等通信機を製造する産業で利用される。
【図面の簡単な説明】
【００３４】
【図１】本発明を実施するための最良の第１の形態の時分割の為フラッグビット図
【図２】本発明を実施するための最良の第１の形態の高周の検波の図
【図３】本発明を実施するための最良の第１の形態の搬送波方式ＰＣＭ送信機のブロック図
【図４】本発明を実施するための最良の第１の形態の搬送波方式ＰＣＭ受信機の図
【図５】本発明を実施するための最良の第１の形態の図４一部拡大図
【図６】本発明を実施するための第２の形態の搬送波方式ＰＣＭ受信機図
【図７】本発明を実施するための第２の形態の重畳合成波と検波の図
【図８】本発明を実施するための第３の形態の受信機の図
【図９】本発明を実施するための第３の形態の受信機の図
【符号の説明】
【００３５】
１  フラッグビット
２  ４ビット２進法で８、１０進法では１７
３  ４ビット全て０
４ａ正弦波
４ｂ正弦波９０°
５  高周波検波後
５ａ正弦波９０°
５ｂ負電圧正弦波
６  水晶発振子
７  発信部
８  高周波電圧検出部
９  時分割カウンタ回周回路
10  搬送波ＯＮ、ＯＦＦスイッチ素子
11  高周波増幅部 
12  電力増幅部
13  アンテナ
14  パラレルシリアルコンバータ
15  ５ビットマシン
16ａ音、画像、文字表現部
16ｂ音、画像、文字表現入力部
17  高周波増幅部
18  検波ダイオード
19  パルス整形部
20  シリアル・パラレルコンバータ
22ａスイッチ素子
22ｂスイッチ素子
22ｃスイッチ素子
22ｄスイッチ素子
23  チャンネルセレクタ
24  重畳合成回路
25  逓倍発信部
26  高周増幅フィルター
27  ＦＭ変調部
Ａ  図４鎖線
Ｂ  矢印入力
【図１】
2007150771.tif 000003
【図２】
2007150771.tif 000004
【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【手続補正書】
【提出日】平成18年1月19日(2006.1.19)
【手続補正１】
【補正対象書類名】特許請求の範囲
【補正対象項目名】請求項１
【補正方法】変更
【補正の内容】
【請求項１】
一周波数、一波を３６０°とする正弦波の高周波の９０°の最高電圧に成った時、その電圧を高周波電圧検出回路にて検出し、１波若しくは２波後でスイッチ素子にて発信高周波を切る、そして一波の９０°の時の高周波電圧の高い部分当たりで、高周波電圧を検出して、時分割カウンタ回周回路にて、ビット又はパルスを作り、同時に回周回路、即クロックでもある、ここでタイミングパルスを５分周或いは６分周のパルスを作り発振する。ここで１ビット目即ちフラッグビットとし時分割用のビットでもある、そして１ビットマシン、プラス４ビットマシンにて構成し、１ビットマシンは機器にスイッチの入っている時、定常的に１ビット即ちフラッグビットを発振する。そして４ビットにて音、画像、文字等を表現する、そして５ビットマシンにてパラレル出力する、そしてパラレルシリアルコンバータにてシリアル出力に変換してスイッチ素子にて、ＣＷ、従って搬送波通信と同様に電波一波長１λ毎には抜く即ち一波長λを無くし、二波長間隔毎にして一波長１λ３６０°は必要であり１／４λ９０°の所で高周波電圧を検出して、増幅してスイッチ素子で切り一波長１λ３６０°毎に高周波を増幅して、一波長１λ毎又は二波長間隔毎に一波長１λを高周波増幅して、更に電力増幅してアンテナより発射する、そして受信機側で高周波３６０°正弦波を高周波増幅後従来のＡＭ検波にて高周波３６０°の正弦波を正電圧正弦波１８０°にし、これを一つのパルス又はトリガパルスとしパルス整形して、シリアルに連続して来る信号又はパルスをシリアル・パラレルコンバータ等に依ってフラッグビットを除き０から８迄の数値として認識する、そして音、画像、文字等として表現する、ここでフラッグビットは時分割と複数チャンネルの分割用マーカでもある。