(57)【要約】本発明は、複数セットの多重チャネルデジタル画像を組み合わせる方法及びバスインタフェース技術に関する。本発明は、主要構成要素として、ｍ個のチャネルのサブ画面画像処理ユニット、ｎセットのコンビネーション画面画像処理ユニット、ｎセットのビデオデータバス、アドレス・コントロールバス、及び画素データ読取制御・バス切換ロジックモジュールを含む。ｍ個のチャネルのサブ画面画素データの出力バスストローブ信号により、ｍ個のサブ画面チャネルの画素データを、所定のタイミングでｎセットのビデオデータバス中の所定の１セットに出力するよう制御し、ｎセットの画像コンビネーションモジュールにより、ｎセットのビデオデータバス上のサブ画面画素データコンビネーションを個別に合成してｎセットのコンビネーション画面とし、ｎセットのコンビネーション画面チャネルから完全なビデオデータを出力する。本発明はマルチメディア画像通信システムや画像編集システムに応用され、システムのマルチ画面画像処理能力を向上させる。
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【特許請求の範囲】
【請求項１】
Ａ．オリジナルビデオチャネルからのｍチャネルの完全なビデオデータをｍ個のサブ画面チャネルに対応させて入力し、画素モードでそれぞれ圧縮してｍ個のサブ画面画素データとし、前記画素データをｍ個の先入れ先出し（ＦＩＦＯ）サブ画像フレームメモリに対応させて一時記憶させるステップと、
Ｂ．前記ｍチャネルのサブ画面画素データの出力バスストローブ信号により、前記ｍチャネルのサブ画面画素データを、所定のタイミングでｎセットのビデオデータバス中のうち所定の１セットに出力するよう制御するステップと、
Ｃ．ｎセットの画像コンビネーションモジュールにより、前記ｎセットのビデオデータバス上のサブ画面画素データを個別に組み合わせてｎセットのコンビネーション画面とし、前記ｎセットのコンビネーション画面チャネルから完全なビデオデータを出力するステップと、
を含む、複数セットの多重チャネルデジタル画像を組み合わせる方法。
【請求項２】
前記ステップＡは、オリジナル画像のサブ画面に比べ行画素及び列画素数は少ないがオリジナルビデオデータと同一の走査シーケンスを生成することを含み、前記サブ画面のビデオデータは、前記サブ画面の先入れ先出し（ＦＩＦＯ）フレームメモリの低位アドレスターミナルに記憶される、請求項１に記載の方法。
【請求項３】
前記ステップＢは、所与のタイミングにおいて各ビデオデータバスセットに１チャネルのサブ画面画素データのみが出力されるステップ、及び前記ｍチャネルのサブ画面画素データが前記バスストローブ信号により制御され、前記ｎセットのビデオデータバス上に選択的に切り換えられるステップを更に含む、請求項１に記載の方法。
【請求項４】
前記ステップＢにおけるバスストローブ信号の生成は、
１フィールド又は１フレームのコンビネーション画面の各画素に対応するサブ画面チャネルアドレスを計算するステップと、
計算された１フィールド又は１フレームの画素アドレスを、画像走査シーケンスに基づいてメモリに書き込み、画素アドレステーブルを作成するステップと、
ビデオ同期信号の制御下で該画素アドレステーブルから画素アドレスを読み出し、１セットのビデオデータバスを選択し、第ｎセットのコンビネーション画面画像処理ユニットにより第ｍ番目のサブ画面画素データを読み出すステップと、
を更に含む
請求項１又は３に記載の方法。
【請求項５】
奇数・偶数フィールドモード時、２セットのメモリに奇数フィールド及び偶数フィールドの画素アドレステーブルをそれぞれ記憶させ、フレーム処理モード時、１セットのメモリに共通フレームの画素アドレステーブルを記憶させる、請求項４に記載の方法。
【請求項６】
画面コンビネーションモードが安定して動作している間に、１フィールド又は１フレームのコンビネーション画面の各画素に対応するサブ画面アドレスを一度計算、記憶しておき、フィールド又はフレーム毎に繰り返し読み出す、請求項４に記載の方法。
【請求項７】
ｍチャネルのサブ画面画像処理ユニット、ｎセットのコンビネーション画面画像処理ユニット、ｎセットのビデオデータバス、アドレス・コントロールバス、画素データ読取制御・バス切換ロジックモジュール、及びクロック・同期信号生成モジュールと、
ｎセットのビデオデータバスと同時接続されたｍチャネルのサブ画面画像処理ユニットのｍ個のサブ画面チャネルの出力端と、
ｎセットのコンビネーション画面の画像処理ユニットのサブ画面ビデオデータ入力端と同時接続された、或いはｎより少ない数のコンビネーション画面画像処理ユニットのサブ画面ビデオデータ入力端と固定接続された、ｎセットのビデオデータバスと、を含み、
前記アドレス・コントロールバスはｎセットの前記コンビネーション画面画像処理ユニット、前記画素データ読取制御・バス切換ロジックモジュール、及び前記クロック・同期信号生成モジュールと同時接続されている、
複数セットの多重チャネルデジタル画像を組み合わせるバスインタフェース。
【請求項８】
前記ｍチャネルのサブ画面画像処理ユニット中の各サブ画面画像処理ユニットチャネルは、サブ画面生成モジュール、サブ画面の先入れ先出し（ＦＩＦＯ）フレームメモリモジュール、及びサブ画面画素データ切換・分配モジュールを連続的に接続して構成され、前記ｎセットのコンビネーション画面画像処理ユニット中の各コンビネーション画面画像処理ユニットセットは、コンビネーション画面の画素アドレス制御モジュールと、コンビネーション画面合成制御ロジックモジュールとを接続して構成され、ｎ個のコンビネーション画面画素アドレス制御モジュール及び前記画素データ読取制御・バス切換ロジックモジュールは、前記アドレス・コントロールバスに接続され、前記画素データ読取制御・バス切換ロジックモジュールは前記ｍ個のサブ画面画素データ切換・分配モジュールと接続され、前記ｍ個のサブ画面画素データ切換・分配モジュールと、前記ｎ個のコンビネーション画面合成制御ロジックモジュールは、ｎセットのビデオデータバスに同時に接続されている、
複数セットの多重チャネルデジタル画像を組み合わせるバスインタフェース。
【請求項９】
前記画素データ読取制御・バス切換ロジックモジュールはデコーダを接続して構成され、関連するコンビネーション画面の画素アドレス制御モジュールにより出力される画素アドレス信号及びビデオ同期信号をデコードし、バスストローブ信号を出力し、１つのサブ画面画素データが１つのビデオデータバスセットに出力されるよう制御する、請求項８に記載のバスインタフェース。
【請求項１０】
前記コンビネーション画面の画素アドレス制御モジュールは、中央処理装置（ＣＰＵ）又はデジタル信号処理装置（ＤＳＰ）と、メモリとを接続して構成され、前記ＣＰＵ又は前記ＤＳＰは、１フィールド又は１フレームのコンビネーション画面の各画素に対応する各サブ画面アドレスを計算し、該アドレスをメモリに記憶し、１フィールド又は１フレームのコンビネーション画面の画素アドレステーブルを作成する、請求項８に記載のバスインタフェース。
【請求項１１】
前記アドレス・コントロールバスはアドレスバス、クロック・同期信号バス、及びコントロールバスを含み、前記アドレスバスは、前記コンビネーション画面の画素アドレス制御モジュール、及び画素読取制御・バス切換ロジックモジュールに接続され、前記クロック・同期信号バスは、ｍチャネルのサブ画面画像処理ユニット、及びｎセットのコンビネーション画面画像処理ユニットに接続され、前記コントロールバスは、ｍ個のサブ画面の画像データ切換・分配モジュール、及び画素読取制御・バス切換ロジックモジュールに接続される、請求項８に記載のバスインタフェース。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、任意のコンビネーション画像を伝送・再現する画像通信技術に関し、より詳しくは、複数セットの多重チャネルデジタル画像を組み合わせる方法及びバスインタフェース技術に関する。当該技術は、マルチ画面ビデオバス及びそのインタフェース技術により実施される。本発明は、テレビ会議システムのマルチポイント制御ユニット（ＭＣＵ）、画像編集装置等に応用できる。
【背景技術】
【０００２】
テレビ会議や画像編集においては、通常、多重チャネルデジタルビデオ動画画像（サブ画像）信号を組み合わせ、リアルタイムで単一チャネル（１つ又は１セットのチャネル）のデジタルビデオ画像信号とする必要がある。組み合わされたデジタルビデオ画像信号は、オリジナルの多重チャネルデジタルビデオ画像信号の内容を含み、そのロジックフォーマット及び物理的インタフェースは単一チャネルのビデオ画像と同一でなくてはならない。多重チャネルビデオ動画画像の制御、多重チャネル画像データのフレキシブルな切り換え及びコンビネーションモードの更新を、同一ハードウェアデバイス上でソフトウェアにより実施する必要がある。例えば、多重チャネル画像のセット化をフレキシブルに行い、各セットに異なるモードの画像コンビネーションを同時に行う。
【発明の開示】
【発明が解決しようとする課題】
【０００３】
従来の画面ディバイダ（例えば、アメリカ合衆国ＡＤ社の製品）の多くは上述の機能を有するが、ビデオ画像のコンビネーションに関しては、固定的なコンビネーションモードか、限られた数種のコンビネーションモードしかないのが実情である。出願人の知る限り、中国においてかかる機器は開発されていない。
【０００４】
従来の多重チャネル画像コンビネーション機能を有するデバイスには以下の問題がある。
１．モードの切り換えが主にハードウェア回路で行われるため、多重チャネルビデオ画像のコンビネーションモードがフレキシブルでない。
２．ハードウェアのインタフェース形状やパフォーマンスに制約があり、コンビネーションモードが複雑である場合、組み合わされるオリジナルサブ画面のオリジナルフレームレートが維持されず、コンビネーション画像の品質低下、フレームレート低下等を招いている。
【０００５】
本発明の目的は、複数セットの多重チャネルデジタル画像を組み合わせる方法、及びバスインタフェース技術を提供することにある。本発明はデジタルビデオバス構造及び対応するインタフェース処理モードを含む。本発明は、多重チャネルデジタルビデオ画像信号のフレキシブルな切り換え及びコンビネーションモードの更新を行うハードウェア機構である。本発明により、多重チャネル画像（サブ画面）をフレキシブルにセット化し、各セットに異なるモードの画像コンビネーションを同時に実施できる。
【課題を解決するための手段】
【０００６】
上記目的は、複数セットの多重チャネルデジタル画像を組み合わせる方法により達成される。該方法は、
Ａ．オリジナルビデオチャネルからのｍチャネルの完全なビデオデータをｍ個のサブ画面チャネルに対応させて入力し、画素モードでそれぞれ圧縮してｍ個のサブ画面画素データとし、該画素データをｍ個の先入れ先出し（ＦＩＦＯ）サブ画像フレームメモリに対応させて一時記憶させるステップと、
Ｂ．ｍチャネルのサブ画面画素データの出力バスストローブ信号により、ｍチャネルのサブ画面画素データを、所定のタイミングでｎセットのビデオデータバス中のうち所定の１セットに出力するよう制御するステップと、
Ｃ．ｎセットの画像コンビネーションモジュールにより、ｎセットのビデオデータバス上のサブ画面画素データを個別に組み合わせてｎセットのコンビネーション画面とし、該ｎセットのコンビネーション画面チャネルから完全なビデオデータを出力するステップと、を含む。
【０００７】
上記ステップＡは、オリジナル画像のサブ画面に比べ行画素及び列画素数は少ないがオリジナルビデオデータと同一の走査シーケンスを生成することを含む。サブ画面のビデオデータは、サブ画面の先入れ先出し（ＦＩＦＯ）フレームメモリの低位アドレスターミナルに記憶される。
【０００８】
上記ステップＢは、所与のタイミングにおいて各ビデオデータバスセットに１チャネルのサブ画面画素データのみが出力されるステップ、及びｍチャネルのサブ画面画素データが上記バスストローブ信号により制御され、ｎセットのビデオデータバス上に選択的に切り換えられるステップを更に含む。
【０００９】
上記ステップＢにおけるバスストローブ信号の生成は、１フィールド又は１フレームのコンビネーション画面の各画素に対応するサブ画面チャネルアドレスを計算するステップと、計算された１フィールド又は１フレームの画素アドレスを、画像走査シーケンスに基づいてメモリに書き込み、画素アドレステーブルを作成するステップと、ビデオ同期信号の制御下で該画素アドレステーブルから画素アドレスを読み出し、１セットのビデオデータバスを選択し、第ｎセットのコンビネーション画面画像処理ユニットにより第ｍ番目のサブ画面画素データを読み出すステップと、を更に含む。
【００１０】
奇数・偶数フィールドモードでは、２セットのメモリに奇数フィールド及び偶数フィールドの画素アドレステーブルをそれぞれ記憶させる。フレーム処理モードでは、１セットのメモリに共通フレームの画素アドレステーブルを記憶させる。
【００１１】
画面コンビネーションモードが安定して動作している間に、１フィールド又は１フレームのコンビネーション画面の各画素に対応するサブ画面アドレスを一度計算、記憶しておき、フィールド又はフレーム毎に繰り返し読み出す。
【００１２】
また、上記目的は、複数セットの多重チャネルデジタル画像を組み合わせるバスインタフェースにより達成される。該バスインタフェースは、ｍチャネルのサブ画面画像処理ユニット、ｎセットのコンビネーション画面画像処理ユニット、ｎセットのビデオデータバス、アドレス・コントロールバス、画素データ読取制御・バス切換ロジックモジュール、及びクロック・同期信号生成モジュールと、ｎセットのビデオデータバスと同時接続されたｍチャネルのサブ画面画像処理ユニットのｍ個のサブ画面チャネルの出力端と、ｎセットのコンビネーション画面の画像処理ユニットのサブ画面ビデオデータ入力端と同時接続された、或いはｎより少ない数のコンビネーション画面画像処理ユニットのサブ画面ビデオデータ入力端と固定接続された、ｎセットのビデオデータバスと、を含み、該アドレス・コントロールバスはｎセットのコンビネーション画面画像処理ユニット、画素データ読取制御・バス切換ロジックモジュール、及びクロック・同期信号生成モジュールと同時接続されている。
【００１３】
上記ｍチャネルのサブ画面画像処理ユニット中の各サブ画面画像処理ユニットチャネルは、サブ画面生成モジュール、サブ画面の先入れ先出し（ＦＩＦＯ）フレームメモリモジュール、及びサブ画面画素データ切換・分配モジュールを連続的に接続して構成される。上記ｎセットのコンビネーション画面画像処理ユニット中の各コンビネーション画面画像処理ユニットセットは、コンビネーション画面の画素アドレス制御モジュールと、コンビネーション画面合成制御ロジックモジュールとを接続して構成される。ｎ個のコンビネーション画面画素アドレス制御モジュール及び上記画素データ読取制御・バス切換ロジックモジュールは、上記アドレス・コントロールバスに接続される。上記画素データ読取制御・バス切換ロジックモジュールは上記ｍ個のサブ画面画素データ切換・分配モジュールと接続され、上記ｍ個のサブ画面画素データ切換・分配モジュールと、上記ｎ個のコンビネーション画面合成制御ロジックモジュールは、ｎセットのビデオデータバスに同時に接続されている。
【００１４】
上記画素データ読取制御・バス切換ロジックモジュールはデコーダを接続して構成され、関連するコンビネーション画面の画素アドレス制御モジュールにより出力される画素アドレス信号及びビデオ同期信号をデコードし、バスストローブ信号を出力し、１つのサブ画面画素データが１つのビデオデータバスセットに出力されるよう制御する。
【００１５】
上記コンビネーション画面の画素アドレス制御モジュールは、中央処理装置（ＣＰＵ）又はデジタル信号処理装置（ＤＳＰ）と、メモリとを接続して構成される。ＣＰＵ又はＤＳＰは、１フィールド又は１フレームのコンビネーション画面の各画素に対応する各サブ画面アドレスを計算し、該アドレスをメモリに記憶し、１フィールド又は１フレームのコンビネーション画面の画素アドレステーブルを作成する。
【００１６】
上記アドレス・コントロールバスはアドレスバス、クロック・同期信号バス、及びコントロールバスを含む。上記アドレスバスは、上記コンビネーション画面の画素アドレス制御モジュール、及び画素読取制御・バス切換ロジックモジュールに接続される。上記クロック・同期信号バスは、ｍチャネルのサブ画面画像処理ユニット、及びｎセットのコンビネーション画面画像処理ユニットに接続される。上記コントロールバスは、ｍ個のサブ画面の画像データ切換・分配モジュール、及び画素読取制御・バス切換ロジックモジュールに接続される。
【００１７】
本発明の複数セットの多重チャネルデジタル画像を組み合わせる方法及びバスインタフェース技術は以下の諸利点を有する。
１）ハードウェアを信号処理プラットフォームとし、該プラットフォーム機能はソフトウェアにより実施される。ソフトウェアの更新・変更は容易であるため、コンビネーションモードがフレキシブルになる。実際のシステムでは、ソフトウェア制御により、数百に及ぶコンビネーションモードを随時迅速に切り換えられる。
２）セット化をフレキシブルに行い、各サブ画面画像チャネルのセット関係及びコンビネーションモードを要求に応じて随時切り換えられ、システムの画像処理能力を大幅に向上させ、マルチメディア画像通信システムや他の画像編集システム等における要求を満たす。
【発明を実施するための最良の形態】
【００１８】
実施形態及び添付の図面を参照しながら以下に本発明を詳細に説明する。
【００１９】
まず、ビデオ画像コンビネーション原理からのみ画像システムの処理能力を捉えるならば、画面コンビネーションに関与するオリジナルサブ画面の画像数に制限はない。しかし、バスインタフェースチップの駆動能力及び信号品質上の制約があるため、通常オリジナル画像（サブ画面）数は１６を超えてはならない。信号駆動及びバス整合に特殊処理を施せば、サブ画面の画像チャネル数を２５以上とすることができる。
【００２０】
理論上、ソフトウェアはフレキシブルであるため、多くのサブ画面を組み合わせた各々のコンビネーション画像モードにも概ね制約はなく、数多くのコンビネーションモードが可能である。図１は典型的な１０のコンビネーション画像モードを示す。図１ａは２つのサブ画面からなる画像コンビネーションモデル、図１ｂは３つのサブ画面からなる画像コンビネーションモデル、図１ｃは４つのサブ画面からなる画像コンビネーションモデル、図１ｄは９つのサブ画面からなる画像コンビネーションモデル、図１ｅは６つのサブ画面からなる画像コンビネーションモデル、図１ｆは４つのサブ画面からなる別の画像コンビネーションモデル、図１ｇは１６のサブ画面からなる画像コンビネーションモデル、図１ｈは８つのサブ画面からなる画像コンビネーションモデル、図１ｉは１３のサブ画面からなる画像コンビネーションモデル、図１ｊは１３のサブ画面からなる別の画像コンビネーションモデルを示す。
【００２１】
実施形態では１６のサブ画面からなるコンビネーションを例示する。実現可能な画像画面コンビネーションモードは、１６（ｍ＝１６）のオリジナル画像（１６のサブ画面）を分割してｎ個のセット（ｎは通常１〜４）とする。サブ画面の各セットは１セットのビデオバスを使用し、ｎセットのサブ画面はｎセットのビデオバスを通じて各々合成され、ｎ個のコンビネーション画像を形成する。但し、組み合わせ過程には、各オリジナル画像（物理的な１つのサブ画面処理チャネルから出力されるデータ）は同時に複数のコンビネーション画像処理に関与できないという制約がある。この条件に適っていれば、多様なモードで各チャネルからのオリジナル画像をセット化し、組み合わせることができる。例えば、第一、第二、第三チャネルのオリジナル画像を組み合わせて第一のセットとし、第四、第五、第六、第七チャネルのオリジナル画像を組み合わせて第二のセットとし、第八乃至第十六チャネルのオリジナル画像を組み合わせて第三のセットとすることが可能である。
【００２２】
図２は、ｍ（ｍ＝１６）個のサブ画像をｎ（ｎ＝４）セットのコンビネーションとするハードウェア構造を示す。このハードウェア構造は、多重チャネルサブ画面画像処理ユニット１０、マルチ画面ビデオデータバス２０（ｎセットのビデオデータバスの総称）、アドレス・コントロールバス３０、複数セットのコンビネーション画面画像処理ユニット４０、画素データ読取制御・バス切換ロジックモジュール５０、及びクロック・同期信号生成モジュール６０を含む。ｍ個のオリジナルビデオチャネルからのｍ個の完全なビデオデータは、ｍ個のサブ画面チャネルに対応させて入力され、組み合わされてｎセットのコンビネーション画面を形成し、ｎセットのコンビネーション画面チャネルから完全なビデオデータが出力される。
【００２３】
多重チャネルサブ画面画像処理ユニット１０中の各サブ画面チャネルは、サブ画面生成モジュール１１、サブ画面の先入れ先出し（ＦＩＦＯ）フレームメモリ（フレームバッファメモリ）モジュール１２、及びサブ画面画素データ切換・分配モジュール１３を含む。モジュール１１、１２、１３は連続して接続される。
【００２４】
サブ画面生成モジュール１１は、対応するオリジナルビデオチャネルからの１つの完全なデジタル画像データチャネルを画素モードで圧縮し、サブ画面のデジタル画像データを生成する。オリジナルの完全なデジタル画像データのフォーマットとして、標準デジタルビデオフォーマット（ＣＣＩＲ−６０１、ＣＣＩＲ−６５６等）、及び明示的な走査シーケンスと同様の、奇数・偶数フィールドを区別しない共通中間フォーマット（ＣＩＦ等）の２種がある。いずれのフォーマットを用いても、ＤＳＰを使用してオリジナル画像の画素を圧縮し、オリジナル画像に比べ行画素及び列画素数は少ないがオリジナル走査シーケンスと同一のサブ画面を生成できる。前者のフォーマットの場合、画像圧縮用の特殊なチップを用いれば同様の処理が可能である。
【００２５】
サブ画面のＦＩＦＯフレームメモリ（フレームバッファメモリ）モジュール１２は、画素圧縮後のオリジナル画像データの一時保存に利用される。各フィールド又は各フレームのオリジナル画像データ圧縮後にサイズの異なるサブ画面を同期させることは困難であるため、圧縮画像をまずＦＩＦＯフレームバッファメモリに一時保存する。ＦＩＦＯフレームバッファメモリは各フィールド又は各フレームにより更新され得る。圧縮後のサブ画面データはＦＩＦＯフレームバッファメモリの低位アドレスに記憶される。
【００２６】
サブ画面画素データ切換・分配モジュール１３は２つの機能を有する。任意のタイミングに１つのサブ画像の画素データのみを同一セットのトライステート出力マルチ画面ビデオデータバス２０に確実に出力させる機能、及び、データバスが複数（例えば、４）セット存在する場合、各サブ画像チャネルを異なるセットのデータバス（例えば４セットのうち任意の１セットのデータバス）に選択的に切り換える機能である。ある期間（数分間から数時間）におけるｍ個のサブ画像のセット関係は明確である。従ってマルチ画面ビデオデータバス２０の分配関係も比較的安定している。このような分配関係は、システムＣＰＵにより制御される。上記２つの制御機能は複数セットのコンビネーション画面画像処理ユニット４０からのコントロール信号もしくはアドレス信号と、システムＣＰＵとにより実施される。
【００２７】
画素データ読取制御・バス切換ロジックモジュール５０は、複数のデコーダで構成される。モジュール５０の入力信号はアドレス・コントロールバス３０から出力され、該入力信号には複数セットのコンビネーション画面画像処理ユニット４０中の関連画像コンビネーションモジュールから出力される画素アドレス信号及びビデオ同期信号が含まれる。モジュール５０の出力信号は各サブ画面チャネルの画素データの出力ストローブ信号であり、この信号は各サブ画面チャネルの画素データが所定のタイミングにおいて所定セットのビデオデータバスに出力されるよう制御するために使用される。モジュール５０は、図２に示すように多重チャネルサブ画面画像処理ユニット１０側に配置してもよいし、図３に示すように複数セットのコンビネーション画面画像処理ユニット４０側に配置してもよい。
【００２８】
図２及び図３を参照すると、マルチ画面ビデオデータバス２０は４セットのビデオデータバス２０１、２０２、２０３、２０４の総称である。図３に該４セットのバスと、関連するインタフェースモジュールとの典型的な接続関係を示す。
【００２９】
システム設計にあたり、マルチ画面ビデオデータバス２０は、必要に応じて１セット又は複数セット（一般的には４セット以下、図中の実施形態では４セット）のビデオデータバスとして設けることができる。各ビデオデータバスセット２０１、２０２、２０３、２０４は同時に多重チャネルサブ画面画像処理ユニット１０側の全て（１６）のサブ画面チャネルの出力端、すなわちサブ画面画素データ切換・分配モジュール２３の全チャネルの出力端に接続される。また、複数セットのコンビネーション画面画像処理ユニット４０側の全ての画像コンビネーションユニット、すなわち全ての画面合成制御ロジックモジュールに同時に接続できる。また、当然ながら図３に示すように１つの画像コンビネーションユニットに個別に接続してもよい。ビデオデータバスセット２０１、２０２、２０３、２０４は、色差、輝度信号等のＹＵＶデータを伝送するための１６本又は８本のビデオデータバスをそれぞれ含む。
【００３０】
マルチ画面ビデオデータバス２０は、１セット又は複数セットのビデオデータバスを含む構成とすることができる。複数セットのコンビネーション画面画像処理ユニット４０における複数のビデオデータバスセットの入力選択は必須ではなく、所与の１セットのデータバスに固定的に接続してもよい。画素データ読取制御・バス切換ロジックモジュール５０は多重チャネルサブ画面画像処理ユニット１０内（図２参照）、或いは複数セットのコンビネーション画面画像処理ユニット４０内（図３参照）に配置できる。
【００３１】
バスの信号品質を保証するため、各ビデオ信号に適切なインピーダンス整合処理を施す必要がある。一般に、バス駆動はＡＢＴ型（バス駆動チップの一種）のインタフェースチップを使用して行われる。
【００３２】
図２のアドレス・コントロールバス３０は、図３のコントロールバス３０１及びクロック・同期信号３０２の総称であり、ビデオ同期信号、ビデオ画素アドレス信号／サブ画面画像ストローブ信号を含む。このうちビデオ同期信号は２７ＭＨｚのビデオデバイスメインクロック、１３．５ＭＨｚ又は６．７５ＭＨｚの画素クロック、フィールド同期信号、行同期信号、複合ブランキング指示信号を含む。このタイプのビデオ同期信号は、多重チャネルサブ画面画像処理ユニット１０及び複数セットのコンビネーション画面画像処理ユニット４０に供給される。ビデオ画素アドレス信号／サブ画面画像ストローブ信号の信号タイプは、画素データ読取・バス切換ロジックモジュール５０がバスのどの位置に配置されるかにより決定される。コンビネーション画面画像処理ユニット４０のコンビネーション画面画素アドレス制御モジュール４２の各セットは、画素クロックの各タイミングにおいて、該タイミングで読み取られるべき画素に対応する画像チャネル番号（アドレス）を出力する。該画像チャネル番号（アドレス）が画素データ読取制御・バス切換ロジックモジュール５０によりデコードされた後、モジュール５０は第ｍチャネルのサブ画面画像データが第ｎセットのコンビネーション画面により読み取られるためのストローブ信号を生成する。第ｍチャネルのサブ画面のＦＩＦＯフレームバッファメモリ（１２）からビデオデータを読み取ってもよい。
【００３３】
本発明のマルチ画面ビデオデータバスは多重チャネルビデオデータバス２０、コントロールバス３０１及びクロック・同期信号３０２の総称としてもよい。図３の実施形態では、画素データ読取制御・バス切換ロジックモジュール５０は、マルチ画面ビデオデータバスはコンビネーション画面画像処理ユニット４０側に配置されている。
【００３４】
コンビネーション画面画素アドレス制御モジュール４２はＣＰＵ又はＤＳＰと、メモリとから構成される。将来的な操作要求に基づき、ＣＰＵ又はＤＳＰにより１フィールド又は１フレームのコンビネーション画面の各画素に対応するサブ画面の番号（アドレス）を計算し、続いて１フィールド又は１フレームの画素アドレスを、画像走査シーケンスに基づいてメモリに記憶させる。奇数・偶数フィールドモードでは、両フィールドの画素アドレステーブルをそれぞれ格納するため２セットのメモリを使用する必要がある。フレーム処理モードでは、共通フレームの画素アドレステーブルを格納すればよい。
【００３５】
メモリはＦＩＦＯもしくはＳＲＡＭフレームバッファメモリとすることができる。ある期間（数分間から数時間）における複数画面のコンビネーションモードは比較的安定的であり、頻繁に切り換える必要はない。よって、フィールド又はフレーム毎に画素アドレスを計算する必要がない。このため、所与のモードに対し、画素アドレスを一度計算し、画素アドレステーブルをメモリに格納すればよい。この後ビデオ同期信号の制御の下、フィールド又はフレーム毎にメモリから繰り返し読み出す。これはハードウェアのクロックオペレーションである。この他、画素アドレステーブルの計算は演算量が多く、フィールド又はフレーム毎にリアルタイムで計算するとしたら高速ＤＳＰを採用せねばならず、コストが高くなる。従って、コスト面を考慮してもフィールド又はフレーム毎に画素アドレスを計算する必要はない。
【００３６】
画面合成制御ロジックモジュール４１と、コンビネーション画面画素アドレス制御モジュール４２とで、画像コンビネーションサブモジュールを構成する。各サブ画面のビデオデータが所定のシーケンスに従いマルチ画面ビデオデータバス２０に出力された後、実際にはコンビネーション画像のデータフォーマット及びシーケンスはすでに形成されているが、システム機能の増強を図るため、各画像コンビネーションサブモジュールは以下の２つの機能を有する必要がある。複数のビデオデータバスセットから１セット（固定接続であってもよい）を選択する機能、及び、主にコンビネーション画像中の空白のサブ画面領域に固定色をあてがい、囲み線や字幕を付すための、画素置換及び字幕や囲み線を重ねる機能である。固定色をあてがう機能は、直接ビデオデータバス上でプッシュアップ又はプッシュダウンモードで実施してもよく、或いはその他の処理サブモジュール及び字幕により実施してもよい。囲み線や字幕を付す方法については本特許の討論範囲を超えているため詳細は割愛する。
【００３７】
クロック・ビデオ同期信号生成モジュール６０は専用のビデオデバイスにより構成してもよく、ロジック回路で構成してもよい。
【００３８】
本発明の複数セットの多重チャネルデジタル画像を組み合わせる技術及びバスインタフェース技術をテレビ会議のＭＣＵシステムの視覚通信交換プラットフォーム上で試験したところ、所期の目的が達せられ、その極めて高いマルチ画面処理能力と優れたパフォーマンスにより、マルチメディア画像通信設備に応用できることが証明された。
【図面の簡単な説明】
【００３９】
【図１】図１ａ乃至図１ｊは、マルチ画面画像コンビネーションの典型的な１０のモードを示す。
【図２】本発明の複数セットの多重チャネルデジタル画像コンビネーションを実施するためのハードウェア構造の原理ブロック図である。
【図３】本発明の複数セットの多重チャネルデジタル画像コンビネーションを実施するバス及び関連するインタフェースモジュールの接続関係を示す図である。
【図２】
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【図３】
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【国際公開パンフレット】
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【国際調査報告】
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