(57)【要約】マスクステップを追加することなく、金属ゲート電極（３１）を活性領域中の導電性の多結晶シリコン層（１４）に接続することができるパワーＭＯＳＦＥＴを形成するための方法である。この方法によれば、活性領域マスクステップの間に、フィールド酸化膜（１１）中に溝（１２）が形成される。次に、活性領域上および溝（１２）中に導電性の多結晶シリコン層（１４）が形成される。少なくとも１つのウィンドウ（１７、１８、１９及び２０）が、チャネル打込みウィンドウ及びソース打込みウィンドウ（１７、１８、１９及び２０）を形成するためのマスクウィンドウと共に溝（１２）の上方に形成され、多結晶シリコンゲート層（１４）が、活性領域中のシリコンダイ（１０）の表面までエッチングされ、溝（１２）には条片が残される。金属蒸着時に、この条片と金属ゲートコンタクト（３１）が接触し、それにより、マスクステップを追加することなく、金属ゲートコンタクト（３１）が多結晶シリコン条片（５０）に接続される。
2004537160.tif 000002
【特許請求の範囲】
【請求項１】
シリコン基板の表面にフィールド酸化膜を形成するステップと、
該フィールド酸化膜中に活性領域である活性ゲート酸化膜を形成するとともに、共通のマスクステップにおいて、残余のフィールド酸化膜の一部に少なくとも１つの溝を形成するステップと、
前記活性ゲート酸化膜の上部表面及び前記溝に多結晶シリコン層を形成するステップと、
前記共通マスクステップにおいて、さらに、間隔を隔てた複数のウィンドウを前記活性領域上に、または前記少なくとも１つのウィンドウを前記溝の上方に形成し、かつ、前記活性領域中の前記ウィンドウによって露出した前記多結晶シリコン層及び前記溝中の前記多結晶シリコン層の一部のみをエッチング除去し、前記溝の底部に、前記活性領域に残留している前記多結晶シリコン層に接続される多結晶シリコン条片を残留させるステップと、
前記溝の底部の前記多結晶シリコン条片と接触する金属ゲートコンタクトを形成するステップと
を備えたことを特徴とするＭＯＳゲート半導体デバイスを製造するためのマスク工程削減方法。
【請求項２】
前記複数のウィンドウを形成するステップの前段に、前記多結晶シリコン層の表面に多結晶酸化膜を形成するステップを備えたことを特徴とする請求項１に記載のＭＯＳゲート半導体デバイスを製造するためのマスク工程削減方法。
【請求項３】
前記活性領域中の前記多結晶シリコン層をエッチングすることによって露出したシリコン層中に、前記複数のウィンドウを介してチャネル不純物及びソース不純物を注入し、かつ、拡散させるステップを備えたことを特徴とする請求項１に記載のＭＯＳゲート半導体デバイスを製造するためのマスク工程削減方法。
【請求項４】
前記活性領域中の前記多結晶シリコン層をエッチングすることによって露出したシリコン層中に、前記複数のウィンドウを介してチャネル不純物及びソース不純物を注入し、かつ、拡散させるステップを備えたことを特徴とする請求項２に記載のＭＯＳゲート半導体デバイスを製造するためのマスク工程削減方法。
【請求項５】
ＭＯＳゲート半導体デバイスにおける、金属ゲートコンタクトを導電性の多結晶シリコン層のゲート電極に接続する方法であって、
前記多結晶シリコン層の表面の頂部の一部である酸化膜層中に溝を形成するステップと、
前記酸化膜上で、前記溝中及び前記多結晶シリコン層の表面の前記酸化膜が除去された部分に多結晶シリコン層のゲート電極層を蒸着させるステップと、
前記多結晶シリコン層の表面の選択部分を貫通して開口をエッチングするとともに、前記溝に配置された前記多結晶シリコン層の一部のみをエッチング除去し、前記溝の底部に、前記活性領域に残留している前記多結晶シリコン層に接続される前記多結晶シリコン条片を残留させるステップと、
前記他結晶シリコン条片と前記金属ゲートコンタクトを接触させるステップと
を備えたことを特徴とする方法。
【請求項６】
前記金属ゲートコンタクトは、余計なマスクステップを必要とすることなく、前記多結晶シリコン層に接続されることを特徴とする請求項５に記載の方法。
【請求項７】
拡張多結晶シリコンゲート層を含んだ活性シリコン領域を有し、
該活性シリコン領域が、フィールド酸化膜層を有する領域を有し、
前記フィールド酸化膜層が、該フィールド酸化膜層中に溝を有し、
多結晶シリコン条片が前記溝の底部に配置されているとともに、前記拡張多結晶シリコンゲート層に接続され、
金属ゲートコンタクトが前記溝内に配置されているとともに、前記多結晶シリコン条片と接触している
ことを特徴とするＭＯＳゲート半導体デバイス。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、ＭＯＳゲート半導体デバイスの製造プロセス技術に関し、より詳細には、ＭＯＳゲート半導体デバイスを製造するためのマスク工程削減方法及びその方法によって得られるＭＯＳゲート半導体デバイスに関する。
【背景技術】
【０００２】
本出願は、２００１年３月２１日出願の米国仮出願第６０／２７７，６３７号の利益を主張するものである。
【０００３】
パワーＭＯＳＦＥＴおよびパワーＩＧＢＴなどのＭＯＳゲートデバイスについては、極めて良く知られており、一般的には、導電性多結晶シリコン製のゲート電極を有するとともに、ソース電極（すなわちエミッタ電極）から電気絶縁しなければならず、さらに、一般的にはアルミニウム製の外部金属ゲート導体すなわちゲートパッドに電気接続しなければならないゲート電極を有している。自己整列接触型（self aligned contact）パワーＭＯＳＦＥＴの場合、スペーサ技術を使用して、活性領域中でソースに接触させているが、ゲート金属とゲート多結晶シリコンをゲートパッド部分で接触させるためには、個別のフォトマスクステップを使用しなければならなかった。
【０００４】
そこで、コストを低減し、かつウェハからのデバイスの歩留りを向上させるためには、製造プロセスで必要なフォトマスクステップの数を少なくすることが望まれている。
【発明の開示】
【発明が解決しようとする課題】
【０００５】
本発明は、このような状況に鑑みてなされたもので、その目的とするところは、製造プロセスにおいて、ゲート多結晶シリコンとゲート金属を接続するための個別のマスクを使用する必要のないＭＯＳゲート半導体デバイスを製造するためのマスク工程削減方法及びその方法によって得られるＭＯＳゲート半導体デバイスを提供することにある。
【課題を解決するための手段】
【０００６】
本発明によれば、フィールド酸化膜層をエッチングすることによって活性領域を形成することになる溝が、活性マスクステップの間にＰ＋フィールド酸化膜中に形成される。したがって、この溝を形成するために、引き続いてマスクを追加する必要がない。次に、多結晶シリコンの蒸着時に、フィールド酸化膜の頂部への多結晶シリコンの蒸着に応じて溝が充填される。
【０００７】
多結晶シリコンマスクエッチングステップ時に、酸化膜中および多結晶シリコンと金属が接触する領域中の溝の上側の多結晶シリコン層中に、追加ウィンドウが形成される。この場合も、この追加ウィンドウのための追加マスクを使用する必要がなく、必要な多結晶シリコンマスクが単純に修正される。
【０００８】
次に、従来の多結晶酸化膜（polyoxide）エッチングステップ、多結晶シリコンエッチングステップ、および絶縁スペーサステップが実施され、溝の底部に残留している多結晶シリコンが露出される。
【０００９】
次に、導電性の金属コンタクトが多結晶酸化膜の頂部に蒸着され、予め形成されている１つまたは複数のウィンドウに金属コンタクトを充填し、溝中の、多結晶シリコン層のボディに接続される多結晶シリコンと接触する。したがって、余計なマスクを必要とすることなく、金属コンタクトが形成される。
【発明を実施するための最良の形態】
【００１０】
以下、図面を参照して本発明の実施の態様について説明する。
【００１１】
図１〜図３Ｃは、本発明のＭＯＳゲート半導体デバイスの製造方法を説明するための工程図である。
【００１２】
まず、図１において、従来構造のＮ＋基板（図示せず）の頂部に成長したＮ−エピタキシャル層を有するシリコンダイ（基板）１０が示されている。本発明は、Ｐ型基板を備えたデバイスにも等しく適用することができる。基板１０の頂部に、フィールド酸化膜層１１が従来の方法で蒸着あるいは形成され、活性領域マスクステップで、広範囲にわたる活性領域からフィールド酸化膜層１１が除去され、後続する活性領域中への接合パターンの形成を可能にしている。本発明によれば、活性領域マスク中のさらに１つまたは複数のウィンドウにより、１つまたは複数の溝１２を形成することができ、それにより、後述するように、マスクステップを追加することなく、ゲート金属（金属ゲートコンタクト）を活性領域中の多結晶シリコン（ゲート）層に接触させることができる。
【００１３】
次に、図２に示すように、図１で露出した活性シリコン領域の頂部にゲート酸化膜層１３を熱成長させ、このゲート酸化膜層１３の頂部、および溝１２および残りのフィールド酸化膜層１１を覆って、導電性の多結晶シリコン層１４が形成される。
【００１４】
続いて、図３、図３Ａ、図３Ｂ及び図３Ｃに示すように、多結晶シリコン層１４の頂部に、多結晶酸化膜層１５が従来の方法で形成される。次に、フォトレジスト層１６が多結晶酸化膜層１５の頂部に形成され、ウィンドウ１７、１８、１９、２０および他の類似ウィンドウを形成するべく、マスクステップでパターン化される。マスクウィンドウ１８、１９および２０は、縦型伝導ＭＯＳＦＥＴのチャネル拡散領域２１およびソース拡散領域２２の形成に使用される従来の打込みウィンドウである（ドレインコンタクトは、基板１０の底部に形成されることになる）。これらのチャネル拡散領域２１およびソース拡散領域２２は、多孔性（cellular）、すなわち条片形態にすることができ、また、所望する任意のサイズ、深さおよびトポロジーにすることができる。マスクウィンドウ１７（図３、図３Ａ、図３Ｂ及び図３Ｃ）もこれと同じマスクステップで形成され、溝１２と整列して露出される。任意の数のウィンドウ１７を使用することができる。
【００１５】
次に、エッチングプロセスを使用して、多結晶酸化膜層１５、多結晶シリコン層１４およびゲート酸化膜層１３の部分が除去され、ウィンドウ１７乃至２０によって露出される。多結晶シリコン層１４の底部ライン部分５０は、このエッチングプロセスの後、溝１２の底部を維持していることに留意されたい（図４、図４Ａ及び図４Ｂ）。また、多結晶シリコン層（ゲート電極）１４に統合接続される多結晶シリコンライン（条片）５０を形成するために、マスクステップを追加する必要がないことに留意されたい。
【００１６】
続いて、アルミニウム製の導電コンタクト層３１がスパッタリングによって蒸着され、多結晶シリコンライン５０、ソース拡散領域２２およびチャネル拡散領域２１と接触する。次に、コンタクトマスクステップにより、ギャップ３３（図４）中の金属が除去され、図４に示すように、ゲート金属とソース金属が分離される。図４、図４Ａ及び図４Ｂに示すように、ゲート金属は、多結晶シリコン条片５０、したがって、活性領域上の反転可能チャネル領域を覆っている多結晶シリコン層１４に直接接続されている。重要なことは、新規なプロセスにはマスクを追加する必要がないことである。
【００１７】
以上、本発明について、特定の実施形態に関連して説明したが、当分野技術者には、他の多くの変形形態、改変および他の用途が明らかになることと思われる。したがって、本発明は、本明細書における特定の開示に限定されないことが好ましい。
【図面の簡単な説明】
【００１８】
【図１】活性領域表面、および活性領域中に引き続いて形成される多結晶シリコンと接触するコンタクト金属を受け入れることができる溝を露出させるべくパターン化されたフィールド酸化膜を備えた半導体基板の一部断面図である。
【図２】多結晶シリコン蒸着後の図１の断面図である。
【図３】多結晶シリコンの頂部への多結晶酸化膜層の形成、および多結晶酸化膜層の頂部へのフォトレジスト層（パターン化されている）の形成後における図２の構成図である。
【図３Ａ】フィールド酸化膜中の溝の頂部のフォトレジスト中にパターン化されたウィンドウの１つを示す、図３の一部の概略等角図である。
【図３Ｂ】図３Ａの断面線３ｂ−３ｂに沿った図３Ａの断面図である。
【図３Ｃ】図３Ａの断面線３ｃ−３ｃに沿った図３Ａの断面図である。
【図４】フォトレジスト中のウィンドウによって露出した多結晶酸化膜領域および多結晶シリコン領域のエッチング、多結晶シリコン層の露出縁上への絶縁スペーサの形成、およびコンタクト金属の蒸着後における図３の構成図である。
【図４Ａ】図４のプロセスステップ実施後における図３Ｂの構成図である。
【図４Ｂ】図４のプロセスステップ実施後における図３Ｃの構成図である。
【図１】
2004537160.tif 000003
【図２】
2004537160.tif 000004
【図３】
2004537160.tif 000005
【図３Ａ】
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【図３Ｂ】
2004537160.tif 000007
【図３Ｃ】
2004537160.tif 000008
【図４】
2004537160.tif 000009
【図４Ａ】
2004537160.tif 000010
【図４Ｂ】
2004537160.tif 000011
【国際公開パンフレット】
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2004537160.tif 000014
2004537160.tif 000015
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2004537160.tif 000017
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2004537160.tif 000019
2004537160.tif 000020
2004537160.tif 000021
2004537160.tif 000022
【手続補正書】
【提出日】平成15年5月5日(2003.5.5)
【手続補正１】
【補正対象書類名】特許請求の範囲
【補正対象項目名】請求項１
【補正方法】変更
【補正の内容】
【請求項１】
シリコン基板の表面にフィールド酸化膜を形成するステップと、
前記シリコン基板中の活性領域上に前記フィールド酸化膜を形成するとともに、共通のマスクステップにおいて、前記シリコン基板中の前記非活性領域上に残留している前記フィールド酸化膜の一部に少なくとも１つの溝を形成するステップと、
前記活性領域上及び前記溝の底部にゲート酸化膜層を成長させるステップと、
該ゲート酸化膜層の上部表面及び前記少なくとも１つの溝に多結晶シリコン層を形成するステップと、
前記共通マスクステップにおいて、さらに、間隔を隔てた複数のウィンドウを活性領域上に、または、少なくとも１つのウィンドウを前記少なくとも１つの溝の上方に形成し、かつ、前記活性領域中の前記ウィンドウによって露出した前記多結晶シリコン層及び前記少なくとも１つの溝中の前記多結晶シリコン層の一部のみをエッチング除去し、前記溝の底部に、前記活性領域に残留している前記多結晶シリコンに接続される多結晶シリコン条片を残留させるステップと、
前記溝の底部に、前記多結晶シリコン条片と接触する金属ゲートコンタクトを形成するステップと
を備えたことを特徴とするＭＯＳゲート半導体デバイスを製造するためのマスク工程削減方法。
【手続補正２】
【補正対象書類名】特許請求の範囲
【補正対象項目名】請求項５
【補正方法】変更
【補正の内容】
【請求項５】
ＭＯＳゲート半導体デバイスにおける、金属ゲートコンタクトを導電性の多結晶シリコンゲート電極に接続する方法であって、
前記ＭＯＳゲート半導体デバイスの非活性領域の頂部である酸化膜層中に溝を形成するステップと、
前記酸化膜上で、前記溝中に多結晶シリコンゲート電極層を蒸着させるステップと、
前記多結晶シリコン層の表面の選択部分を貫通して開口をエッチングするとともに、前記溝に配置された前記多結晶シリコン層の一部のみをエッチング除去し、前記溝の底部に、前記活性領域に残留している前記多結晶シリコン層に接続される前記多結晶シリコン条片を残留させるステップと
前記多結晶シリコン条片と金属ゲートコンタクトを接触させるステップと
を備えたことを特徴とする方法。
【手続補正３】
【補正対象書類名】特許請求の範囲
【補正対象項目名】請求項７
【補正方法】変更
【補正の内容】
【請求項７】
拡張多結晶シリコンゲート層を含んだ活性シリコン領域を有し、
該活性シリコン領域が、フィールド酸化膜層を有する前記デバイスの非活性領域上に領域を有し、
前記フィールド酸化膜層が、該フィールド酸化膜層中に溝を有し、
多結晶シリコン条片が前記溝の底部に配置されているとともに、前記拡張多結晶シリコンゲート層に接続され、
金属ゲートコンタクトが前記溝中に配置されているとともに、前記多結晶シリコン条片と接触している
ことを特徴とするＭＯＳゲート半導体デバイス。
【国際調査報告】
2004537160.tif 000023