(57)【特許請求の範囲】
【請求項１】
基板上に、複数のデータ線と、複数の走査線と、前記複数のデータ線と前記複数の走査線の交差に対応してそれぞれが画素毎に形成された複数の駆動素子と、を備える電気光学装置の製造方法であって、
前記基板の所定の位置に遮光膜を形成する工程と、
前記基板及び前記遮光膜上に第１絶縁膜を形成する工程と、
前記第１絶縁膜上に、ポリシリコン層を形成し、所定形状にパターニングすることにより、
複数の前記駆動素子の半導体層となる第１半導体膜と、
平面視において前記遮光膜と重なる位置に、エッチング停止層となる第２半導体膜と、
を形成する工程と、
前記第２半導体膜の上方に、
前記複数の走査線と、
前記複数の走査線を相互に短絡すると共に、少なくとも一部が平面視において前記遮光膜と重なるように配置された共通配線と、
を形成する工程と、
前記複数の走査線及び前記共通配線上に第２絶縁膜を形成する工程と、
前記第２絶縁膜に、前記第１半導体膜を前記第２絶縁膜から露出させるコンタクトホールを形成する工程と、
前記第２絶縁膜の表面及び前記コンタクトホールの底部及び側面に、連続的に導電膜を形成する工程と、
前記導電膜上に第１レジストを形成し、所定形状にパターニングする工程と、
パターニングされた前記第１レジストを介して、前記導電膜をパターニングすることで、前記複数のデータ線を形成する工程と、
前記第１レジストを剥離する工程と、
前記第１レジストを剥離する工程の後に、パターニングされた前記導電膜上及び前記第１絶縁膜上に、第２レジストを形成し、所定形状にパターニングする工程と、
前記第２レジストを介して、前記第２絶縁膜の前記共通配線を切断可能な位置に、前記共通配線を切断可能な大きさの切断用孔を複数形成する工程と、
複数の前記切断用孔を介して、前記共通配線をエッチングによって切断することにより、前記複数の走査線をそれぞれ電気的に分離する工程と、
前記第２レジストを剥離する工程と、
を含むことを特徴とする電気光学装置の製造方法。
【請求項２】
前記共通配線と前記複数の走査線とを形成する工程は、前記複数の駆動素子を構成するゲート電極を形成する工程と同時に行われることを特徴する請求項１に記載の電気光学装置の製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、電気光学装置の製造方法に関し、特に基板上に、複数のデータ線と複数の走査線と複数の駆動素子とを備えた電気光学装置の製造方法に関する。
【背景技術】
【０００２】
一般に、絶縁性の基板上に、複数のデータ線及び複数の走査線と、複数のデータ線及び複数の走査線の各交差に対応して画素毎に形成された複数の駆動素子と、駆動素子毎に対応して設けられた画素電極とを備える電気光学装置として、アクティブマトリクス駆動方式の液晶装置が知られている。
【０００３】
アクティブマトリクス駆動方式の液晶装置を製造する際、絶縁性の基板上に、半導体層や各種導電膜を、ドライエッチング法やプラズマＣＶＤ法により形成することで、画素電極やデータ線、走査線、走査線及びデータ線と電気的に接続された画素スイッチング用の薄膜トランジスタ（Thin Film Transistor； 以下、ＴＦＴと称する。）等が形成される。この際、プラズマＣＶＤ法による成膜等により基板表面に蓄積された電荷や、静電気に起因して、走査線等に突発的な過剰電流が発生することがある。このような過剰電流により、走査線の破損や、特に走査線に接続された又は走査線の一部からなるＴＦＴのゲートとソース・ドレインとの間において絶縁破壊が生じる虞がある。
【０００４】
そのため、特許第３３９５５９８号公報には、過剰な電流の発生を防止するために、複数の走査線のそれぞれに電気的に接続する短絡用配線を形成しておき、短絡用配線を介して、電荷や静電気を基板外周側に拡散させる技術が開示されている。特許第３３９５５９８号公報においては、ＴＦＴ等を形成した後に、短絡用配線を切断し、各走査線を電気的に分離させている。
【０００５】
短絡用配線の切断方法は、以下の通りである。ＴＦＴと画素電極とを層間絶縁する層間絶縁膜に、画素電極とＴＦＴとを電気的に接続するためのコンタクトホールを形成する際に、層間絶縁膜の表面から短絡用配線に至る、短絡部分切断用孔を同時に形成する。そして、画素電極を形成する導電膜を形成した後に、フォトリソグラフィ法及びエッチング法を用いて、この導電膜をパターニングする際に、同時に切断用孔を介して走査線の短絡部分を切断する。
【特許文献１】特許第３３９５５９８号公報
【発明の開示】
【発明が解決しようとする課題】
【０００６】
しかしながら、従来においては、短絡用配線を切断するための切断用孔を形成した後に導電膜を形成しているため、切断用孔の底部及び側壁部にも導電膜が形成される。また、さらに導電膜をパターニングすることで画素電極を形成するためのレジストが切断用孔内に積層される。このレジストをフォトリソグラフィ法によりパターニングする際、切断用孔のアスペクト比が大きいことから、露光精度を高めても切断用孔内にレジストが残存してしまい、短絡用配線を切断できない虞がある。したがって、短絡用配線を確実に電気的に切断するためには、切断用孔内のレジスト及び導電膜を完全に除去せねばならない。よって、短絡用配線を切断する際には、切断用孔内の導電膜及びレジストを同時に除去するために、過剰なエッチングを施さねばならない。
【０００７】
短絡用配線の下層には、層間絶縁膜である下地絶縁膜が形成されており、さらに下層には下側遮光膜が形成されている。切断用孔内に過剰なエッチングを施した場合、切断用孔の下部において、下地絶縁膜が薄くなる、もしくはエッチングが下側遮光膜にまで到達してしまう可能性がある。これにより、切断用孔の近傍の下側遮光膜にクラックが発生し、当該箇所からの光漏れによる表示不具合が発生し、液晶装置の製造の歩留りを低下させてしまう虞があった。
【０００８】
本発明は、上記問題点に鑑みてなされたものであり、高品位な表示を安定して得ることのできる電気光学装置の製造プロセスを実現することが可能な電気光学装置の製造方法を提供することを目的とする。
【課題を解決するための手段】
【０００９】
本発明の一実施形態に係る電気光学装置の製造方法は、基板上に、複数のデータ線と、複数の走査線と、前記複数のデータ線と前記複数の走査線の交差に対応してそれぞれが画素毎に形成された複数の駆動素子と、を備える電気光学装置の製造方法であって、前記基板の所定の位置に遮光膜を形成する工程と、前記基板及び前記遮光膜上に第１絶縁膜を形成する工程と、前記第１絶縁膜上に、ポリシリコン層を形成し、所定形状にパターニングすることにより、複数の前記駆動素子の半導体層となる第１半導体膜と、平面視において前記遮光膜と重なる位置に、エッチング停止層となる第２半導体膜と、を形成する工程と、前記第２半導体膜の上方に、前記複数の走査線と、前記複数の走査線を相互に短絡すると共に、少なくとも一部が平面視において前記遮光膜と重なるように配置された共通配線と、を形成する工程と、前記複数の走査線及び前記共通配線上に第２絶縁膜を形成する工程と、前記第２絶縁膜に、前記第１半導体膜を前記第２絶縁膜から露出させるコンタクトホールを形成する工程と、前記第２絶縁膜の表面及び前記コンタクトホールの底部及び側面に、連続的に導電膜を形成する工程と、前記導電膜上に第１レジストを形成し、所定形状にパターニングする工程と、パターニングされた前記第１レジストを介して、前記導電膜をパターニングすることで、前記複数のデータ線を形成する工程と、前記第１レジストを剥離する工程と、前記第１レジストを剥離する工程の後に、パターニングされた前記導電膜上及び前記第１絶縁膜上に、第２レジストを形成し、所定形状にパターニングする工程と、前記第２レジストを介して、前記第２絶縁膜の前記共通配線を切断可能な位置に、前記共通配線を切断可能な大きさの切断用孔を複数形成する工程と、複数の前記切断用孔を介して、前記共通配線をエッチングによって切断することにより、前記複数の走査線をそれぞれ電気的に分離する工程と、前記第２レジストを剥離する工程と、を含むことを特徴とする。
また、本発明の一実施形態に係る電気光学装置の製造方法は、前記共通配線と前記複数の走査線とを形成する工程は、前記複数の駆動素子を構成するゲート電極を形成する工程と同時に行われることを特徴する。
また、本発明の一実施形態に係る電気光学装置の製造方法は、基板上に、複数のデータ線と、複数の走査線と、前記複数のデータ線と前記複数の走査線の交差に対応してそれぞれが画素毎に形成された複数の駆動素子と、該駆動素子毎に対応してそれぞれ設けられた複数の画素電極とを備える電気光学装置の製造方法であって、エッチング停止層を形成する工程と、前記エッチング停止層の上方に前記複数の走査線と、前記複数の走査線を相互に短絡する共通配線とを形成する工程と、前記複数のデータ線と前記複数の画素電極を、前記複数の走査線と前記複数の駆動素子に対して層間絶縁する第１層間絶縁膜を形成する工程と、前記第１層間絶縁膜に、前記複数のデータ線と前記複数の画素電極とを、それぞれ前記複数の駆動素子に電気的に接続するためのコンタクトホールを形成する工程と、前記複数のデータ線を形成する工程と、前記第１層間絶縁膜にエッチングにより切断用孔を形成することによって前記共通配線を切断する工程とを含むことを特徴とする。
【００１０】
本発明のこのような構成によれば、複数の駆動素子や複数のデータ線が、静電気等に起因して突発的に発生する過剰電流により破損することを防止するために設けられた複数の走査線を相互に短絡する共通配線を、切断用孔を通してエッチングにより切断する際に、エッチング処理は共通配線の下方に形成されたエッチング停止層によって停止する。このため、例えばエッチング停止層の下方に形成された遮光膜にエッチングの影響が及ぶことがなく、遮光膜にクラックが発生することによる表示不具合が発生しない電気光学装置を製造することができるという効果を有する。
【００１１】
また本発明は、前記エッチング停止層を形成する工程は、前記複数の駆動素子を構成する半導体膜を形成する工程と同時に行われることが好ましい。
【００１２】
また本発明は、前記エッチング停止層を形成する工程は、前記複数の駆動素子を構成する半導体膜を形成する工程もしくは前記複数の駆動素子を構成するゲート電極を形成する工程と同時に行われることが好ましい。
【００１３】
このような構成によれば、エッチング停止層を、工程を増やすことなく形成することが可能となるという効果を有する。
【００１４】
また本発明は、前記エッチング停止層を形成する工程は、平面視において前記エッチング停止層を前記切断用孔を包含するように前記切断用孔より広く形成することが好ましい。
【００１５】
このような構成によれば、共通配線を切断するためのエッチングは、エッチング停止層が形成された範囲上において行われるため、確実にエッチングをエッチング停止層において停止させることが可能となるという効果を有する。
【００１６】
また本発明は、前記共通配線を形成する工程及び前記複数の走査線を形成する工程は、前記複数の駆動素子を構成するゲート電極を形成する工程と同時に行われることが好ましい。
【００１７】
このような構成によれば、複数の走査線及び共通配線を、駆動素子を形成する工程の一部と同時に形成することが可能となるため、静電気等に起因して突発的に発生する過剰電流に対する対策を施しながら、製造の工程は複雑化することがないという効果を有する。
【００１８】
また本発明は、前記共通配線を形成する工程及び前記複数の走査線を形成する工程は、前記複数の駆動素子を構成するゲート電極を形成する工程の後に行われ、かつ前記共通配線を形成する工程及び前記複数の走査線を形成する工程は同時に行われることが好ましい。
【発明を実施するための最良の形態】
【００１９】
以下、図面を参照して本発明の実施の形態について説明する。以下の実施形態は、本発明の電気光学装置を液晶装置に適用したものである。  
本発明の電気光学装置に係る実施形態について、図１から図９を参照して説明する。まず、本実施形態の電気光学装置の全体構成について、図１及び図２を参照して説明する。ここで、図１はＴＦＴアレイ基板を、その上に構成された各構成要素と共に対向基板の側から見た電気光学装置の平面図である。図２は、図１のＨ−Ｈ’断面図である。ここでは、電気光学装置の一例である駆動回路内蔵型のＴＦＴアクティブマトリクス駆動方式の液晶装置を例にとる。
【００２０】
図１及び図２において、本実施形態に係る電気光学装置では、ＴＦＴアレイ基板１０と対向基板２０とが対向配置されている。ＴＦＴアレイ基板１０と対向基板２０とは、画像表示領域１０ａの周囲に位置するシール領域に設けられたシール材５２により相互に接着されており、ＴＦＴアレイ基板１０と対向基板２０との間には液晶層５０が封入されている。また、シール材５２中には、ＴＦＴアレイ基板１０と対向基板２０との間隔を所定値とするためのグラスファイバあるいはガラスビーズ等のギャップ材が散らばって配設されている。
【００２１】
シール材５２が配置されたシール領域の内側に並行して、画像表示領域１０ａの額縁領域を規定する遮光性の額縁遮光膜５３が、対向基板２０側に設けられている。なお、このような額縁遮光膜５３の一部又は全部は、ＴＦＴアレイ基板１０側に内蔵遮光膜として設けられてもよい。また、本実施形態においては、前記の画像表示領域１０ａの周辺に位置する周辺領域が存在する。言い換えれば、本実施形態においては特に、ＴＦＴアレイ基板１０の中心から見て、この額縁遮光膜５３より以遠が周辺領域として規定されている。
【００２２】
周辺領域のうち、シール材５２が配置されたシール領域の外側に位置する領域には、データ線駆動回路１０１及び外部回路接続端子１０２がＴＦＴアレイ基板１０の一辺に沿って設けられている。また、走査線駆動回路１０４は、データ線駆動回路１０１及び外部回路接続端子１０２が設けられたＴＦＴアレイ基板１０の一辺に隣接する２辺に沿い、かつ額縁遮光膜５３に覆われるように設けられている。また、ＴＦＴアレイ基板１０の残る一辺、すなわちデータ線駆動回路１０１及び外部回路接続端子１０２が設けられたＴＦＴアレイ基板１０の一辺に対向する辺に沿って設けられ、額縁遮光膜５３に覆われるように設けられた複数の配線１０５によって、二つの走査線駆動回路１０４は互いに接続されている。
【００２３】
また、対向基板２０の４つのコーナー部には、ＴＦＴアレイ基板１０との電気的接続を行う上下導通端子として機能する上下導通材１０６が配置されている。他方、ＴＦＴアレイ基板１０にはこれらの上下導通材１０６に対応する領域において上下導通端子が設けられている。上下導通材１０６と上下導通端子を介して、ＴＦＴアレイ基板１０と対向基板２０との間で電気的な接続が行われる。
【００２４】
図２において、ＴＦＴアレイ基板１０上には、画素スイッチング用のＴＦＴや走査線、データ線等の配線が形成された後の画素電極９ａ上に、配向膜１６が形成されている。他方、対向基板２０上には、対向電極２１の他、格子状又はストライプ状の遮光膜２３、更には最上層部分に配向膜２２が形成されている。また、液晶層５０は、例えば一種又は数種類のネマティック液晶を混合した液晶からなり、これら一対の配向膜１６及び２２の間で、所定の配向状態をとる。
【００２５】
なお、図１及び図２に示したＴＦＴアレイ基板１０上には、これらのデータ線駆動回路１０１、走査線駆動回路１０４等に加えて、画像信号線上の画像信号をサンプリングしてデータ線に供給するサンプリング回路、複数のデータ線に所定電圧レベルのプリチャージ信号を画像信号に先行して各々供給するプリチャージ回路、製造途中や出荷時の当該電気光学装置の品質、欠陥等を検査するための検査回路等を形成してもよい。
【００２６】
次に、図３を参照して、上述した電気光学装置の電気的な構成について説明する。図３は、電気光学装置の画像表示領域を構成するマトリクス状に形成された複数の画素における各種素子、配線等の等価回路である。
【００２７】
図３に示すように、本実施形態における電気光学装置の画像表示領域を構成するマトリクス状に形成された複数の画素には、それぞれ、画素電極９ａと当該画素電極９ａをスイッチング制御するためのＴＦＴ３０とが形成されており、画像信号が供給されるデータ線６ａが当該ＴＦＴ３０のソースに電気的に接続されている。データ線６ａに書き込む画像信号Ｓ１、Ｓ２、…、Ｓｎは、この順に線順次に供給しても構わないし、相隣接する複数のデータ線６ａ同士に対して、グループ毎に供給するようにしてもよい。
【００２８】
また、ＴＦＴ３０のゲートにゲート電極３ａが電気的に接続されており、所定のタイミングで、走査線１１ａ及びゲート電極３ａにパルス的に走査信号Ｇ１、Ｇ２、…、Ｇｍを、この順に線順次で印加するように構成されている。画素電極９ａは、ＴＦＴ３０のドレインに電気的に接続されており、スイッチング素子であるＴＦＴ３０を一定期間だけそのスイッチを閉じることにより、データ線６ａから供給される画像信号Ｓ１、Ｓ２、…、Ｓｎが所定のタイミングで選択された走査線１１ａの画素に書き込まれる。
【００２９】
画素に書き込まれた所定レベルの画像信号Ｓ１、Ｓ２、…、Ｓｎは、対向基板に形成された対向電極との間で一定期間保持される。液晶は、印加される電圧レベルにより分子集合の配向や秩序が変化することにより、光を変調し、階調表示を可能とする。ノーマリーホワイトモードであれば、各画素の単位で印加された電圧に応じて入射光に対する透過率が減少し、ノーマリーブラックモードであれば、各画素の単位で印加された電圧に応じて入射光に対する透過率が増加され、全体として電気光学装置からは画像信号に応じたコントラストをもつ光が出射する。
【００３０】
ここで保持された画像信号がリークするのを防ぐために、画素電極９ａと対向電極との間に形成される液晶容量と並列に蓄積容量７０を付加する。この蓄積容量７０は、走査線１１ａに並んで設けられ、固定電位側容量電極が、定電位に固定された容量配線４００に接続されている。
【００３１】
本実施形態においては、例えばプラズマＣＶＤ法等による、ＴＦＴアレイ基板１０の形成過程におけるＴＦＴアレイ基板１０への電荷の蓄積を防止するために、各走査線１１ａは、ＴＦＴアレイ基板１０上に短絡されて形成され、ＴＦＴ３０等が形成された後に短絡部分が切断される。
【００３２】
図４は、走査線１１ａの短絡部分に係る構成の一例を概略的に示す概略構成図である。ＴＦＴアレイ基板１０上に、複数の走査線１１ａは、後述する複数のデータ線６ａより下層側に配置されて形成される。そして、ＴＦＴアレイ基板１０上の周辺領域において、走査線１１ａと同一層には、走査線１１ａを短絡させるための共通配線１３が、走査線１１ａを形成する導電膜と同一膜によって形成されている。各走査線１１ａは、共通配線１３に電気的に接続されることにより、互いに短絡されて形成されている。そして、本実施形態においては、各走査線１１ａを形成した後、短絡部分Ｃが切断される。なお、各走査線１１ａの形成や、走査線１１ａの短絡部分Ｃの切断についてのより詳細な説明は後述するものとする。
【００３３】
次に、本実施形態に係る電気光学装置のＴＦＴアレイ基板１０の構造について図５を参照して説明する。図５（ａ）は、ＴＦＴアレイ基板１０の画素部のＡ−Ａ’線に沿った断面図であり、図５（ｂ）は、切断された状態の走査線１１ａの短絡部分ＣにおけるＢ−Ｂ’線に沿った断面図である。図５に示すように、ＴＦＴアレイ基板１０上には、前記の画素電極９ａの他、各種の構成要素が積層構造をなして配置されている。なお、図５においては、各層及び各構成要素を図面上で認識可能な程度の大きさとするため、該各層及び各構成要素ごとに縮尺を異ならしめてある。
【００３４】
図５（ａ）及び図５（ｂ）に示すように、例えば、石英基板、ガラス基板、シリコン基板からなるＴＦＴアレイ基板１０には、下地絶縁膜５２０が形成されている。この下地絶縁膜５２０上には、例えば導電性ポリシリコン膜からなる図示しない複数の走査線１１ａが形成されると共に、走査線１１ａと同一膜により形成されるゲート電極３ａを含むＴＦＴ３０が設けられている。また、図５（ｂ）に示すように、走査線１１ａの短絡部分Ｃの下地絶縁膜５２０の下層には、タングステン等の金属膜等からなる下側遮光膜５５１が形成されている。
【００３５】
複数の走査線１１ａは、図４を参照して説明したように、同一層の共通配線１３に電気的に接続されることにより互いに短絡されて形成され、その後、共通配線１３は各短絡部分Ｃにおいて切断されるものである。ここで、走査線１１ａと共通配線１３は、駆動素子であるＴＦＴ３０を構成するゲート電極３ａと同一層である導電層により構成されている。
【００３６】
ＴＦＴ３０は、例えばＬＤＤ（Lightly Doped Drain）構造を有しており、上述したゲート電極３ａと、半導体膜１ａと、ゲート電極３ａと半導体膜１ａとを絶縁するゲート絶縁膜２とを有して構成される。半導体膜１ａは、例えばポリシリコンからなり、ゲート電極３ａからの電界によりチャネルが形成されるチャネル領域１ａ’と、低濃度ソース領域１ｂと、高濃度ソース領域１ｄと、低濃度ドレイン領域１ｃ及び高濃度ドレイン領域１ｅにより構成されている。
【００３７】
そして、走査線１１ａ及びＴＦＴ３０の上には、例えばＢＰＳＧ膜からなる第１層間絶縁膜５２１が形成されている。第１層間絶縁膜５２１には、第１層間絶縁膜５２１の表面から、第１層間絶縁膜５２１及びゲート絶縁膜２を貫通して、半導体膜１ａにおける高濃度ドレイン領域１ｅ及び高濃度ソース領域１ｄの表面にそれぞれ至るコンタクトホール５０１及び５０２が形成されている。そして、コンタクトホール５０１及び５０２の底部から側壁及び第１層間絶縁膜５２１の表面に連続的に、例えばアルミニウムを含む導電性材料からなる導電膜が形成されている。この導電膜の一部を用いて、第１層間絶縁膜５２１上には、ドレイン電極５１０とデータ線６ａが形成されている。ドレイン電極５１０は、コンタクトホール５０１を介してＴＦＴ３０の高濃度ドレイン領域１ｅと電気的に接続されている。また、データ線６ａは、コンタクトホール５０２を介してＴＦＴ３０の高濃度ソース領域１ｄに接続されている。第１層間絶縁膜５２１は、ＴＦＴ３０が形成されている層とデータ線６ａが形成されている層とを絶縁している。
【００３８】
また、図５（ｂ）に示すように、走査線１１ａの短絡部分Ｃにおいて、共通配線１３は、第１層間絶縁膜５２１を貫通して形成された切断用孔５０７によって切断されている。この切断用孔５０７は、第１層間絶縁膜５２１を貫通し、さらに共通配線１３を切断するように走査線１１ａを構成する導電層を貫通するように形成されている。そして、この切断用孔５０７の下方には、エッチング停止層５５０が形成されている。エッチング停止層５５０は、平面視、すなわちＴＦＴアレイ基板１０表面に直交する方向から見て切断用孔５０７と同位置において、切断用孔５０７の外形よりも大きい外形を有して共通配線１３の下層に形成されている。エッチング停止層５５０は、ＴＦＴ３０の半導体膜１ａと同層のポリシリコン膜で形成されており、絶縁性を有する。
【００３９】
また、第１層間絶縁膜５２１上には、例えばＢＰＳＧ膜からなる第２層間絶縁膜５２２が形成されている。そして、第２層間絶縁膜５２２には、第２層間絶縁膜５２２の表面から、第２層間絶縁膜５２２を貫通してドレイン電極５１０の表面に至るコンタクトホール５０５が形成されている。コンタクトホール５０５の底部から側壁及び第２層間絶縁膜５２２の表面に連続的に形成された、例えば透明な導電膜であるＩＴＯ膜によって構成される画素電極９ａが形成されている。
【００４０】
上述の構造を有する、本実施形態に係る電気光学装置の製造方法について、図６から図８を参照して、以下に説明する。図６から図８は、製造プロセスの各工程におけるＴＦＴアレイ基板１０の構成を、図５（ａ）及び図５（ｂ）の断面図に関して、順を追って示す工程断面図である。図６から図８においては、左方にＴＦＴアレイ基板１０の画素部における構成を示す断面図を示し、右方に走査線１１ａの短絡部分Ｃにおける構成を示す断面図を示す。なお、図６から図８においては、各層及び各構成要素を図面上で認識可能な程度の大きさとするため、該各層及び各構成要素ごとに縮尺を異ならしめてある。
【００４１】
以下では、図５（ａ）及び図５（ｂ）に示すＴＦＴアレイ基板１０の画素部及び走査線１１ａの短絡部分Ｃにおける共通配線１３についての製造工程について特に詳しく説明し、図１から図３に示す他の構成要素に係る製造工程の説明に関しては省略するものとする。
【００４２】
まず、図６（ａ）に示す工程では、画素部において、ＴＦＴアレイ基板１０の下地絶縁膜５２０上に、駆動素子であるＴＦＴ３０を形成する。より具体的には、ポリシリコン層を所定の形状にパターニングすることによりＴＦＴ３０の半導体膜１ａを形成した後、ゲート絶縁膜２を形成する。その後、ゲート絶縁膜２上に導電層であるゲート電極３ａを形成する。さらにその後、ＴＦＴ３０の半導体膜１ａに対し、低濃度及び高濃度の二段階で不純物イオンをドープすることにより、半導体膜１ａにおいて、低濃度ソース領域１ｂ及び低濃度ドレイン領域１ｃ、高濃度ソース領域１ｄ及び高濃度ドレイン領域１ｅを形成する。
【００４３】
またこの図６（ａ）に示す工程では、走査線１１ａの短絡部分Ｃにおいて、下地絶縁膜５２０上に、上述の半導体膜１ａを形成するのと同一のプロセスによって、ポリシリコン層からなるエッチング停止層５５０が形成される。エッチング停止層５５０は、ＴＦＴアレイ基板１０表面に直交する方向から見て後に形成する切断用孔５０７に対応する位置において形成され、かつ切断用孔５０７の底面の外形よりも大きな範囲において形成される。例えば、エッチング停止層５５０は、ＴＦＴアレイ基板１０表面に直交する方向から見て切断用孔５０７の底面の外形から約２５０ｎｍの距離を有する線で囲った領域内において形成される。また、エッチング停止層５５０を構成するポリシリコン層には不純物イオンのドープは行わず、このため、エッチング停止層５５０は絶縁性を有する。
【００４４】
さらに、エッチング停止層５５０の形成後、駆動素子であるＴＦＴ３０のゲート電極３ａとなる導電層を形成するのと同一のプロセスによって、下地絶縁膜５２０及びエッチング停止層５５０上に、ゲート電極３ａと同一層の導電層により構成される複数の走査線１１ａ及び共通配線１３を形成する。この際、複数の走査線１１ａを、共通配線１３により電気的に接続することにより互いに短絡して形成する。共通配線１３は、走査線１１ａの短絡部分Ｃにおいて、ＴＦＴアレイ基板１０表面に直交する方向から見て、後に形成する切断用孔５０７の略中心を通過する位置において形成され、かつ切断用孔５０７の底面の外形よりも細い線幅において形成される。
【００４５】
次に、図６（ｂ）に示す工程において、例えば常圧ＣＶＤ法により、ＢＰＳＧ膜からなる第１層間絶縁膜５２１を形成する。  
次に、図６（ｃ）に示す工程において、第１層間絶縁膜５２１に、ＴＦＴ３０の高濃度ドレイン領域１ｅ及び高濃度ソース領域１ｄの表面までそれぞれ第１層間絶縁膜５２１を貫通するコンタクトホール５０１及び５０２を形成する。  
次に、図６（ｄ）に示す工程において、第１層間絶縁膜５２１上全面に、スパッタリング法等により、例えばアルミニウムを含む導電性材料からなる導電膜６０を形成する。このとき、導電膜６０は、コンタクトホール５０１及び５０２の底部から側壁及び第１層間絶縁膜５２１の表面に連続的に形成されている。  
次に、図７（ｅ）に示す工程において、導電膜６０上にレジスト６５を形成する。この際、走査線１１ａの短絡部分Ｃ上には第１層間絶縁膜５２１が形成され、さらに第１層間絶縁膜５２１上に導電膜６０及びレジスト６５が形成された状態となっている。  
次に、図７（ｆ）に示す工程において、フォトリソグラフィ法によりレジスト６５をパターニングする。この際、画素部においては、データ線６ａ及びドレイン電極５１０に対応するパターンで、レジスト６５をパターニングする。これにより、走査線１１ａの短絡部分Ｃにおいては、導電膜６０上のレジスト６５が除去された状態となる。  
次に、図７（ｇ）に示す工程において、レジスト６５を介して、導電膜６０に対して、例えばＣｌ２ガスを用いたドライエッチングを施すことで、レジスト６５に対応するパターンとして、データ線６ａ及びドレイン電極５１０を形成する。この際、走査線１１ａの短絡部分Ｃにおいては、第１層間絶縁膜５２１上の導電膜６０が除去された状態となる。エッチングによりデータ線６ａ及びドレイン電極５１０を形成した後、レジスト６５を剥離する。
【００４６】
次に、図７（ｈ）に示す工程において、第１層間絶縁膜５２１上であって、データ線６ａ及びドレイン電極５１０より上層側に、新たにレジスト６６を、切断用孔５０７を規定するパターンとして形成する。
【００４７】
次に、図８（ｉ）に示す工程において、このレジスト６６を介して、例えばドライエッチング法により、第１層間絶縁膜５２１に、第１層間絶縁膜５２１を貫通し、走査線１１ａの短絡部分Ｃにおける共通配線１３を切断するように、切断用孔５０７を形成する。より具体的には、共通配線１３の表面に達するまでの、第１層間絶縁膜５２１を除去するためのドライエッチングは、ＣＨＦ３及びＣＦ４の混合ガスをエッチャントとして用いて実施される。その後、共通配線１３を除去するためのドライエッチングは、ＨＢｒ等をエッチャントとして用いて実施される。
【００４８】
この際、走査線１１ａの短絡部分Ｃにおける共通配線１３の下層には、エッチング停止層５５０が形成されているため、図８（ｉ）に示す工程による、共通配線１３へのドライエッチングが、エッチング停止層５５０よりも下層の下地絶縁膜５２０へ到達することが無い。エッチングにより切断用孔５０７を形成した後に、レジスト６６を剥離する。
【００４９】
次に、図８（ｊ）に示す工程において、データ線６ａ及びドレイン電極５１０より上層側に第２層間絶縁膜５２２を、例えば常圧又は減圧ＣＶＤ法によりＢＰＳＧ膜として形成する。  
次に、図８（ｋ）に示す工程において、第２層間絶縁膜５２２に、ドレイン電極５１０の表面まで貫通するコンタクトホール５０５を形成する。その後、コンタクトホール５０５の底部から側壁及び第２層間絶縁膜５２２の表面に連続的に、ＩＴＯ膜を形成し、このＩＴＯ膜をフォトリソグラフィ法及びエッチング法によりパターニングすることによって画素電極９ａを形成する。  
以上の工程により、図５に示す構造を有する本実施形態に係る電気光学装置が製造される。
【００５０】
本実施形態においては、複数の走査線１１ａを互いに短絡させて形成した後に、ＴＦＴ３０の半導体膜１ａに対する不純物イオンのドーピングや、データ線６ａを構成する導電膜６０を形成を実施する。よって、プラズマＣＶＤ法等による導電膜６０の成膜時や、不純物イオンのドーピング時に、ＴＦＴアレイ基板１０表面に蓄積される電荷を、複数の走査線１１ａを電気的に接続して互いに短絡させている共通配線１３を介してＴＦＴアレイ基板１０の表面外に拡散させることができる。したがって、画素電極９ａを駆動するための主要な構成要素であるデータ線６ａやＴＦＴ３０が、ＴＦＴアレイ基板１０表面における静電気等に起因して突発的に発生する過剰電流により破損することを防止することが可能となる。
【００５１】
また、本実施形態によれば、第１層間絶縁膜５２１におけるコンタクトホール５０１及び５０２の形成と、第１層間絶縁膜５２１における切断用孔５０７の形成とを別工程において実施している。よって、切断用孔５０７の内部に導電膜６０やレジスト６５が形成されることが無い。したがって、走査線１１ａの短絡部分Ｃにおける共通配線１３の切断時に、切断用孔５０７内に対して過剰なエッチングを施す必要が無い。さらには、本実施形態によれば、走査線１１ａの短絡部分Ｃにおける共通配線１３の下層において、エッチング停止層５５０が、切断用孔５０７の底面の外形よりも大きな範囲において形成されている。このため、共通配線１３を切断するために行われるエッチングによって共通配線１３は確実に切断され、かつこのエッチングはエッチング停止層５５０の層において確実に停止するのである。したがって、本実施形態によれば、走査線１１ａの短絡部分Ｃにおいて、共通配線１３を切断するためのエッチングによって下地絶縁膜５２０が薄くなる、もしくはエッチングが下側遮光膜５５１にまで到達してしまうことがない。このため、走査線１１ａの短絡部分Ｃの近傍の下側遮光膜５５１にクラックが発生し、当該箇所からの光漏れが発生することが無い。
【００５２】
よって、本実施形態に係る電気光学装置の製造方法によれば、製造過程におけるＴＦＴアレイ基板１０への電荷の蓄積によるＴＦＴ３０の破損や、走査線１１ａの短絡部分Ｃの切断工程により近傍の下側遮光膜５５１にクラックが発生し当該箇所からの光漏れによる表示不具合が発生することのない、高い表示品位を有する電気光学装置を安定して製造することができる。
【００５３】
また、エッチング停止層５５０は、ＴＦＴ３０の半導体膜１ａの形成プロセスと同時に形成される。このため、従来の電気光学装置の製造工程に対して工程を複雑化することなくエッチング停止層５５０を形成することができる。
【００５４】
なお、上述した本実施形態に係る電気光学装置の製造方法においては、走査線１１ａ及び共通配線１３をＴＦＴ３０のゲート電極３ａと同時に形成しているが、走査線１１ａ及び共通配線１３は、ＴＦＴ３０のゲート電極３ａを形成する工程とは別工程において形成されてもよい。例えば、図９に示すように、エッチング停止層５５０ａを、ＴＦＴ３０の半導体膜１ａ又はゲート電極３ａと同時に形成する。ゲート電極３ａの形成後、別工程において走査線１１ａ及び共通配線１３ａを形成する。走査線１１ａ及び共通配線１３ａの形成後の工程は上述した実施形態と同様である。
【００５５】
また、本発明は、本実施形態に係るアクティブマトリクス駆動方式の液晶装置の他に、電子ペーパなどの電気泳動装置、ＥＬ（Electro-Luminescence）表示装置、電子放出回路素子を備えた装置（Field Emission Display及びSurface-Conduction Electron-Emitter Display）等の電気光学装置の技術分野に属するものである。
【００５６】
本発明は、上述した実施形態に限られるものではなく、請求の範囲及び明細書全体から読み取れる発明の要旨或いは思想に反しない範囲で適宜変更可能であり、そのような変更を伴う電気光学装置の製造方法もまた本発明の技術的範囲に含まれるものである。
【図面の簡単な説明】
【００５７】
【図１】本発明の実施形態に係る電気光学装置の全体構成を示す平面図である。
【図２】図１のＨ−Ｈ’断面図である。
【図３】電気光学装置の画像表示領域を構成するマトリクス状に形成された複数の画素における各種素子、配線等の等価回路図である。
【図４】走査線の短絡部分に係る構成を示す概略構成図である。
【図５】図５（ａ）は、ＴＦＴアレイ基板の画素部のＡ−Ａ’線に沿った断面図であり、図５（ｂ）は、切断された状態の走査線の短絡部分ＣにおけるＢ−Ｂ’線に沿った断面図である。
【図６】製造プロセスの各工程におけるＴＦＴアレイ基板の構成を、順を追って示す工程断面図（その１）である。
【図７】製造プロセスの各工程におけるＴＦＴアレイ基板の構成を、順を追って示す工程断面図（その２）である。
【図８】製造プロセスの各工程におけるＴＦＴアレイ基板の構成を、順を追って示す工程断面図（その３）である。
【図９】図９（ａ）は、ＴＦＴアレイ基板の画素部のＡ−Ａ’線に沿った断面図であり、図９（ｂ）は、切断された状態の走査線の短絡部分ＣにおけるＢ−Ｂ’線に沿った断面図である。
【符号の説明】
【００５８】
１ａ  半導体膜、  ３ａ  ゲート電極、  ６ａ  データ線、  ９ａ  画素電極、  １３  共通配線、  ３０  ＴＦＴ、  ５０１  コンタクトホール、  ５０２  コンタクトホール、  ５０５  コンタクトホール、  ５０７  切断用孔、  ５１０  ドレイン電極、  ５２０  下地絶縁膜、  ５２１  第１層間絶縁膜、  ５２２  第２層間絶縁膜、  ５５０  エッチング停止層、  ５５１  下側遮光膜
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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