(57)【特許請求の範囲】
【請求項１】
乱数発生器（１〜ｎ）と、
該乱数発生器（１〜ｎ）が発生する乱数の更新をハードウェアにより指令する第１更新手段（１１、２１、３１）と、
前記乱数発生器（１〜ｎ）が発生する乱数の更新をソフトウェアにより指令する第２更新手段（１２、２２、３２）と、
前記乱数発生器（１〜ｎ）が発生する乱数のラッチをハードウェアにより指令する第１ラッチ手段（１４、２４、３４）と、
前記乱数発生器（１〜ｎ）が発生する乱数のラッチをソフトウェアにより指令する第２ラッチ手段（１５、２５、３５）とを具備することを特徴とする乱数発生装置。
【請求項２】
前記第１更新手段（１１、２１、３１）の出力と、前記第２更新手段（１２、２２、３２）の出力とを、切り替えて前記乱数発生器（１〜ｎ）に供給する第１セレクタ（１３、２３、３３）を更に具備することを特徴とする請求項１に記載の乱数発生装置。
【請求項３】
前記第１ラッチ手段（１４、２４、３４）の出力と、前記第２ラッチ手段（１５、２５、３５）の出力とを、切り替えて前記乱数発生器（１〜ｎ）に供給する第２セレクタ（１６、２６、３６）を更に具備することを特徴とする請求項１および請求項２に記載の乱数発生装置。
【請求項４】
前記第１セレクタ（１３、２３、３３）および／または前記第２セレクタ（１６、２６、３６）の切り替え状態を設定する切替状態設定手段（４００）を更に具備することを特徴とする請求項２および請求項３に記載の乱数発生装置。
【請求項５】
前記切替状態設定手段（４００）が、前記第１セレクタ（１３、２３、３３）および／または前記第２セレクタ（１６、２６、３６）の切り替え状態を、共通にまたは個別に設定することを特徴とする請求項４に記載の乱数発生装置。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、遊技機に最適な乱数発生装置に関する。
【０００２】
【従来の技術】
従来より、パチンコ遊技機では必要な乱数をソフトウェアで作成および更新していた。また、パチスロ遊技機では、ソフトウェアで作成および更新する場合と、
ハードウェアで乱数を保持し抽選タイミングにより読み出した乱数値を採用する場合とがあった。
【０００３】
【発明が解決しようとする課題】
しかしながら、パチンコ遊技機およびパチスロ遊技機のいずれにおいても、乱数の更新タイミングを選択することや、乱数を読み出すタイミングを選択することが出来ない点で改善余地があった。
【０００４】
本発明は、上記の問題点に鑑みてなされたもので、遊技機において、乱数の更新タイミングを選択することや乱数を読み出すタイミングを選択することが可能な乱数発生装置の提供を目的とする。
【０００５】
【課題を解決するための手段】
この目的を達成するために、請求項１の発明は、乱数発生器（１〜ｎ）と、乱数発生器（１〜ｎ）が発生する乱数の更新をハードウェアにより指令する第１更新手段（１１、２１、３１）と、乱数発生器（１〜ｎ）が発生する乱数の更新をソフトウェアにより指令する第２更新手段（１２、２２、３２）と、乱数発生器（１〜ｎ）が発生する乱数のラッチをハードウェアにより指令する第１ラッチ手段（１４、２４、３４）と、乱数発生器（１〜ｎ）が発生する乱数のラッチをソフトウェアにより指令する第２ラッチ手段（１５、２５、３５）とを具備することを特徴とする。
【０００６】
請求項２の発明は、請求項１において、第１更新手段（１１、２１、３１）の出力と、第２更新手段（１２、２２、３２）の出力とを、切り替えて乱数発生器（１〜ｎ）に供給する第１セレクタ（１３、２３、３３）を更に具備することを特徴とする。
【０００７】
請求項３の発明は、請求項１および請求項２において、第１ラッチ手段（１４、２４、３４）の出力と、第２ラッチ手段（１５、２５、３５）の出力とを、切り替えて乱数発生器（１〜ｎ）に供給する第２セレクタ（１６、２６、３６）を更に具備することを特徴とする。
【０００８】
請求項４の発明は、請求項２および請求項３において、第１セレクタ（１３、２３、３３）および／または第２セレクタ（１６、２６、３６）の切り替え状態を設定する切替状態設定手段（４００）を更に具備することを特徴とする。
【０００９】
請求項５の発明は、請求項４において、切替状態設定手段（４００）が、第１セレクタ（１３、２３、３３）および／または第２セレクタ（１６、２６、３６）の切り替え状態を、共通にまたは個別に設定することを特徴とする。
【００１０】
【発明の実施の形態】
以下、本発明の実施の形態を図面に基づいて説明する。
【００１１】
図１は、本発明による乱数発生装置の一実施形態を示すブロック結線図である。図１に示す回路は、遊技機内では図２に示す乱数発生回路５００としてデータバス１００に結線される。
【００１２】
図１において、複数の乱数発生器１〜ｎ（ｎは整数）は、データバス１００に接続されている。複数の乱数発生器１〜ｎは、例えば、大当り決定用乱数（１個）、大当り図柄決定用乱数（１個）、図柄決定用乱数（３個）、および普通図柄決定用乱数（１個）を生成するのに利用される。
【００１３】
大当り決定用乱数（１個）は、大当りを決定する乱数で例えば３００分の１の確率値で設定される。大当り図柄決定用乱数（１個）は、図柄により確率が変動するゲーム状態（次の大当りまで高確率状態となる）で図柄を決定する乱数として利用される。図柄決定用乱数（３個）は、パチンコ遊技機の、左、中央、右の各位置に配置される図柄を決定する乱数として利用される。普通図柄決定用乱数（１個）は、パチンコ遊技機の普通図柄（当り以外の図柄）を決定する乱数として利用される。
【００１４】
乱数発生器１には、発生する乱数の更新指令として、プリスケーラ１１の出力またはソフトウェア更新指令１２のいずれかがセレクタ１３で切り替えて供給される。プリスケーラ１１は、クロック回路２００（図２）から供給されるクロック信号を分周した信号を更新指令としてセレクタ１３に供給する。ソフトウェア更新指令１２は、遊技機制御用ＣＰＵ回路３００（図２）から供給される。また、乱数発生器１には、発生する乱数をラッチする指令として、ソフトウェアラッチ指令１４または外部端子ＣＴ１から供給されるラッチ指令１５のいずれかがセレクタ１６で切り替えて供給される。ソフトウェアラッチ指令１４は、遊技機制御用ＣＰＵ回路３００（図２）から供給される。ラッチ指令１５は、遊技機に設けられている外部端子ＣＴ１（図２）から供給される。
【００１５】
乱数発生器２には、発生する乱数の更新指令として、プリスケーラ２１の出力またはソフトウェア更新指令２２のいずれかがセレクタ２３で切り替えて供給される。プリスケーラ２１は、クロック回路２００（図２）から供給されるクロック信号から生成した信号を更新指令としてセレクタ２３に供給する。ソフトウェア更新指令２２は、遊技機制御用ＣＰＵ回路３００（図２）から供給される。また、乱数発生器２には、発生する乱数をラッチする指令として、ソフトウェアラッチ指令２４または外部端子ＣＴ２から供給されるラッチ指令２５のいずれかがセレクタ２６で切り替えて供給される。ソフトウェアラッチ指令２４は、遊技機制御用ＣＰＵ回路３００（図２）から供給される。ラッチ指令２５は、遊技機に設けられている外部端子ＣＴ２（図２）から供給される。
【００１６】
以下、乱数発生器ｎまで同様に構成される。
【００１７】
セレクタ１３、２３、および３３等は、設定レジスタ４００（図１）のロード値によって切り替えられる。切り替え状態は、セレクタ１３、２３、および３３等で共通（同一）であっても良いし個別に異なっていても良い。同様に、セレクタ１６、２６、および３６等は、設定レジスタ４００（図１）のロード値によって切り替えられる。切り替え状態は、セレクタ１６、２６、および３６等で共通（同一）であっても良いし個別に異なっていても良い。設定レジスタ４００のロード値は、遊技機制御用ＣＰＵ回路３００（図２）によって変更される。
【００１８】
【発明の効果】
以上のように、本発明の乱数発生装置によれば、乱数発生器（１〜ｎ）が発生する乱数の更新をハードウェアにより指令する第１更新手段（１１、２１、３１）と、乱数発生器（１〜ｎ）が発生する乱数の更新をソフトウェアにより指令する第２更新手段（１２、２２、３２）と、乱数発生器（１〜ｎ）が発生する乱数のラッチをハードウェアにより指令する第１ラッチ手段（１４、２４、３４）と、乱数発生器（１〜ｎ）が発生する乱数のラッチをソフトウェアにより指令する第２ラッチ手段（１５、２５、３５）とを設けたので、乱数の更新タイミングを選択することや乱数を読み出すタイミングを選択することが出来る。これにより、必要な機能を選択して使用することが可能となる。
【図面の簡単な説明】
【図１】本発明による乱数発生装置の一実施形態を示すブロック結線図である。
【図２】本発明による乱数発生装置が使用される遊技機を示すブロック結線図である。
【符号の説明】
１    乱数発生器
２    乱数発生器
３    乱数発生器
１１    プリスケーラ
１２    ソフトウェア更新指令
１３    セレクタ
１４    ソフトウェアラッチ指令
１５    ラッチ指令
１６    セレクタ
２１    プリスケーラ
２２    ソフトウェア更新指令
２３    セレクタ
２４    ソフトウェアラッチ指令
２５    ラッチ指令
２６    セレクタ
３１    プリスケーラ
３２    ソフトウェア更新指令
３３    セレクタ
３４    ソフトウェアラッチ指令
３５    ラッチ指令
３６    セレクタ
１００    データバス
２００    クロック回路
３００    遊技機制御用ＣＰＵ回路
４００    設定レジスタ
５００    乱数発生回路
ＣＴ１〜ＣＴｎ    外部端子
【図１】
0004477253.tif 000002
【図２】
0004477253.tif 000003