(57)【特許請求の範囲】
【請求項１】
ゲート配線と、
前記ゲート配線と交差するデータ配線と、
前記ゲート配線及び前記データ配線と電気的に接続される第１スイッチング素子と、
前記第１スイッチング素子と電気的に接続され、前記ゲート配線の延在方向に対して傾斜を有する開口パターンを有する画素電極と、
前記開口パターンに対応して形成され、前記ゲート配線の延在方向に対して傾斜を有する凸凹パターンを有する光遮断配線と、
前記画素電極と重なって画素領域に形成され、前記光遮断配線と接続されるストレージ配線と、
を含み、
前記光遮断配線は、
平面視において、前記光遮断配線の延在方向と交差する直線状の第１傾斜部及び第２傾斜部を有し、前記第１傾斜部及び前記第２傾斜部が互いに交差してなる単位パターンを含み、
前記単位パターンは、前記光遮断配線の延在方向に対向する第１辺及び第２辺のうち少なくとも１辺に繰り返し形成されている、アレイ基板。
【請求項２】
前記単位パターンは、前記光遮断配線の延在方向する方向において互いに隣接する単位パターンのうち一方の単位パターンの前記第１傾斜部と、他方の単位パターンの前記第２傾斜部とが交差するように互いに隣接して形成されている、請求項１に記載のアレイ基板。
【請求項３】
前記単位パターンは、前記第１辺及び前記第２辺に形成されており、
前記第１辺の前記単位パターンにおいて前記第１傾斜部と前記第２傾斜部とが交差してなる凸部と、前記第２辺の前記単位パターンにおいて前記第１傾斜部と前記第２傾斜部とが交差してなる凸部とは、前記光遮断配線の延在方向に対して互いにずれている、請求項２に記載のアレイ基板。
【請求項４】
前記単位パターンの前記第１傾斜部と前記第２傾斜部とが交差してなる凸部の一部と、前記画素電極とが互いに重畳する、請求項１に記載のアレイ基板。
【請求項５】
前記単位パターンは、前記第１辺及び前記第２辺に形成されており、
前記第１辺の前記単位パターンにおいて前記第１傾斜部と前記第２傾斜部とが交差してなる凸部と、前記第２辺の前記単位パターンにおいて前記第１傾斜部と前記第２傾斜部とが交差してなる凸部とは、前記光遮断配線の延在方向の中心線に対して互いに対称の位置に形成されている、請求項２に記載のアレイ基板。
【請求項６】
隣接する前記単位パターンの間には、前記光遮断配線の延在方向と平行な平坦部が形成されている、請求項１に記載のアレイ基板。
【請求項７】
前記単位パターンの前記第１傾斜部と前記第２傾斜部とが交差してなる角部は、前記平坦部に対して外側に突出して形成されている、請求項１又は６に記載のアレイ基板。
【請求項８】
前記単位パターンの前記第１傾斜部と前記第２傾斜部とが交差してなる角部は、前記平坦部に対して内側に凹んで形成されている、請求項１又は６に記載のアレイ基板。
【請求項９】
前記開口パターンの形状は、前記凸凹パターンの形状と同一であることを特徴とする請求項１記載のアレイ基板。
【請求項１０】
前記開口パターンの幅は、約３．５μｍ〜約１０μｍであること特徴とする請求項１記載のアレイ基板。
【請求項１１】
ゲート配線と、
前記ゲート配線と交差するデータ配線と、
前記ゲート配線及び前記データ配線と電気的に接続される第１スイッチング素子と、
前記第１スイッチング素子と電気的に接続され、前記ゲート配線の延在方向に対して傾斜を有する開口パターンを有する画素電極と、
前記開口パターンに対応して形成され、前記ゲート配線の延在方向に対して傾斜を有する凸凹パターンを有する光遮断配線と、
前記画素電極と重なって画素領域に形成され、前記光遮断配線と接続されるストレージ配線と、
を含み、
前記光遮断配線は、
平面視において、前記光遮断配線の延在方向と交差する曲線状の第１傾斜部及び第２傾斜部を有し、前記第１傾斜部及び前記第２傾斜部が互いに交差してなる単位パターンを含み、
前記単位パターンは、前記光遮断配線の延在方向に対向する第１辺及び第２辺のうち少なくとも１辺に繰り返し形成されている、アレイ基板。
【請求項１２】
前記第１傾斜部及び第２傾斜部がなす角度は６０°〜１２０°であることを特徴とする請求項１２記載のアレイ基板。
【請求項１３】
第１傾斜部及び第２傾斜部の長さは各々５μｍ〜１０μｍであることを特徴とする請求項１２記載のアレイ基板。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、アレイ基板及びこれを含む表示パネルに関する。より詳しくは、液晶表示装置に利用されるアレイ基板及びこれを含む表示パネルに関する。
【背景技術】
【０００２】
一般的に、液晶表示パネルは、各画素領域を駆動するためのスイッチング素子である薄膜トランジスター及び前記薄膜トランジスタと電気的につながる画素電極を含むアレイ基板と、前記アレイ基板と対向してカラーフィルターを含むカラーフィルター基板と、前記アレイ基板及び前記カラーフィルター基板の間に介在され、形成される液晶層と、を含む。
【０００３】
液晶表示パネルは、液晶層に電圧を印加し、光の透過率を制御する方式をもって画像を表示する。液晶表示パネルの視野角を向上させるために画素電極に開口パターンを形成し、液晶を制御する構造であるＰＶＡ（Ｐａｔｔｅｒｎｅｄ  Ｖｅｒｔｉｃａｌ  Ａｌｉｇｎｍｅｎｔ）構造を利用しつつ、最近では、薄膜トランジスタの画素電極を２つのサブ電極に分離し、サブ電極に互いに異なる電圧を印加する方法を利用している。サブ電極に互いに異なる電圧を印加する方法は、互いに異なる一対の薄膜トランジスタを利用する方法、１つの薄膜トランジスタ及びサブ電極の電圧をプルアップ及びプルダウンするためのアップ／ダウンコンデンサーを利用する方法などがある。
【０００４】
他方、サブ電極を含む画素電極が形成されるアレイ基板では、前記サブ電極が互いに離隔、分離される領域により、開口率が減少することになる。開口率を確保するために、サブ電極が離隔される領域にストレージ配線とつながる金属パターンを形成する。
【０００５】
しかし、基板と前記金属パターンの間の段差によって前記金属パターンと隣接する液晶が垂直に立つことができない。特に、前記金属パターンが画素領域のゲート配線に対して斜線方向に形成される場合には前記金属パターンに沿って前記液晶が配列され、偏光軸の方向とはずれることになる。これにより、前記液晶表示パネルの下部より提供されるバックライトが、前記サブ電極が離隔分離される領域を通じて漏れ出ることにより、漏れ光が発生する。前記漏れ光は、液晶表示パネルの表示品質を低下させる要因になる。
【発明の開示】
【発明が解決しようとする課題】
【０００６】
ここで、本発明の技術的な課題はこのような点において着眼されたことで、本発明の目的は、漏れ光を最小化して品質を向上させたアレイ基板を提供することにある。
【０００７】
本発明の他の目的は、前記アレイ基板を含む表示パネルを提供することにある。
【課題を解決するための手段】
【０００８】
このような本発明の目的を具現するためのアレイ基板は、ゲート配線、データ配線、第１スイッチング素子、画素電極、及び光遮断配線を含む。
【０００９】
発明１は、ゲート配線と、前記ゲート配線と交差するデータ配線と、前記ゲート配線及び前記データ配線と電気的に接続される第１スイッチング素子と、前記第１スイッチング素子と電気的に接続され、開口パターンを有する画素電極と、前記開口パターンに対応して形成され、凸凹パターンを有する光遮断配線と、を含むアレイ基板を提供する。
【００１０】
発明２は、発明１に対して、前記開口パターン及び前記光遮断配線は前記画素領域において、前記ゲート配線に対して斜線方向に形成されることができる。
【００１１】
発明３は、発明２に対して、前記開口パターンは、前記凸凹パターンと同一の形状でパターニングされることができる。
発明４は、発明２に対して、前記開口パターンの幅は、約３．５μｍ〜約１０μｍである。
【００１２】
発明５は、発明２に対して、前記凸凹パターンは、前記光遮断配線の第１エッジ及び前記第１エッジと向い合う第２エッジのうち、少なくともある１つに形成されることができる。
発明６は、発明５に対して、前記凸凹パターンは、前記光遮断配線の第１エッジ及び前記第１エッジと対向する第２エッジのうち、少なくとも一のエッジから外側に突出する凸形状を有する単位パターンを含む。
発明７は、発明５に対して、前記凸凹パターンは、前記光遮断配線の第１エッジ及び前記第１エッジと対向する第２エッジのうち、少なくとも一のエッジの内側に向かってくぼんだ凹形状を有する単位パターンを含む。
発明８は、発明５に対して、前記凸凹パターンは、互いに交差する第１傾斜部及び第２傾斜部を有する単位パターンを含み、前記第１傾斜部及び第２傾斜部が交差する部分は、角を有する形状又は曲率を有する形状に形成される。
発明９は、発明８に対して、前記第１傾斜部及び第２傾斜部がなす角度は６０°〜１２０°である。
発明１０は、発明８に対して、第１傾斜部及び第２傾斜部の長さは各々５μｍ〜１０μｍである。
光遮断配線上の凸凹パターン以外の前記光遮断配線の直線部の幅は２μｍ〜４．０μｍである。
【００１３】
前記アレイ基板は、ストレージ配線をさらに含むことができる。前記ストレージ配線は、前記画素電極と重なる前記画素領域に形成され、前記光遮断配線とつながることができる。
前記画素電極は、前記開口パターンによって離隔される第１サブ電極及び第２サブ電極を含み、前記第１サブ電極は、前記第２サブ電極の外側を取り囲むように形成される。
前記光遮断配線のエッジは、前記第１サブ電極及び前記第２サブ電極のうち、少なくともある１つのエッジと相接する。
前記光遮断配線は、前記第１サブ電極及び前記第２サブ電極のうち、少なくともある１つと重なる重なり部をさらに含み、前記重なり部は、補助ストレージコンデンサー用の電極であることを特徴とする。
前記第１スイッチング素子は、前記ゲート配線と重なり、前記データ配線と接続されるデュアルソース電極と、前記デュアルソース電極と離隔され、前記第１サブ電極と接続される第１ドレイン電極と、前記デュアルソース電極と離隔され、前記第２サブ電極と接続される第２ドレイン電極と、を含む。
前記第１サブ電極と接続されるソース電極及び前記第１サブ電極と重なる第３ドレイン電極を有する第２スイッチング素子をさらに含む。
【００１４】
また、アレイ基板は、前記第１及び第２ゲート配線と交差するデータ配線、前記ベース基板の画素領域に形成され、第１サブ電極と前記第１及び第２ゲート配線に対して斜線方向に形成される開口パターンによって前記第１サブ電極と離隔される第２サブ電極を含む画素電極、前記第１及び第２サブ電極と重なり、前記ゲート配線及び前記データ配線と平行するように前記画素領域に形成されるストレージ配線、前記開口パターンが形成される領域に形成されて前記ストレージ配線とつながり、凸凹パターンを含む光遮断配線、前記第１ゲート配線及び前記データ配線とつながり、前記第１サブ電極とコンタクトする第１ドレイン電極及び前記第２サブ電極とコンタクトする第２ドレイン電極を含むデュアルスイッチング素子及び前記第２ゲート配線及びデータ配線とつながり、前記第２サブ電極とコンタクトするソース電極及び前記第１サブ電極と重なる第３ドレイン電極を含むスイッチング素子を含む。
【００１５】
また、前述の本発明の他の目的を具現するための表示パネルは、アレイ基板及び対向基板を含む。
【００１６】
前記アレイ基板は、ベース基板上に形成されるゲート配線及びデータ配線とつながるスイッチング素子、前記スイッチング素子と電気的につながり、前記ゲート配線に対して斜線方向に第１開口パターンが形成される画素電極及び前記第１開口パターンが形成される領域に形成されて互いに交差する第１傾斜部及び第２傾斜部を有する凸凹パターンを有する光遮断配線を含む。
【００１７】
前記対向基板は、前記アレイ基板と対向し、前記第１開口パターンとともに液晶ドメインを形成する第２開口パターンが含む共通電極に形成される。
【００１８】
前記第１傾斜部及び第２傾斜部がなす角度は６０°〜１２０°であることができる。
【００１９】
前記表示パネルは、前記アレイ基板に付着され、第１偏光軸を含む第１偏光板、及び前記対向基板に付着され、前記第１偏光軸と垂直する第２偏光軸を含む第２偏光板をさらに含むことができる。前記第１傾斜部は、前記第１偏光軸と０°〜４５°をなし、前記第２傾斜部は、前記第２偏光軸と０°〜４５°をなすことができる。
【発明の効果】
【００２０】
本発明によれば、漏れ光を最小化して品質を向上させたアレイ基板を提供することができる。また、このようなアレイ基板を含む表示パネルを提供することができる。
【発明を実施するための最良の形態】
【００２１】
図面においては、幾層及び幾領域を明確に表示するために、厚さを拡大して示した。詳細な説明において、層、膜、領域、板などの部分が他の部分の上にあるとする場合、これは他の部分の上にある場合のみでなく、その中間にまた他の部分がある場合も含む。逆に、層、膜、領域、板などの部分が他の部分の下にあるとする場合、これは他の部分の直ぐ下にある場合のみでなく、その中間にまた他の部分がある場合も含む。
【００２２】
以下、添付図面を参照しながら、本発明の実施例についてより詳しく説明する。
【００２３】
図１（ａ）は、本発明の第１実施例による表示パネル５００の平面図である。図１（ｂ）は、第１サブ電極ＳＰＥ１と第２サブ電極ＳＰＥ２との関係を示す回路図である。
【００２４】
図１（ａ）に図示される構成要素のうち、第２開口パターン２５２を除いては、第１ベース基板に形成され、第２開口パターン２５２は前記第１ベース基板と対向する基板に形成される（後述の図５参照）。
【００２５】
図１（ａ）を参照すれば、本発明の第１実施例による表示パネル５００は、第１ゲート配線ＧＬ１及び第２ゲート配線ＧＬ２、第１データ配線ＤＬ１及び第２データ配線ＤＬ２、第１スイッチング素子１０、第１開口パターン１７２を含む画素電極ＰＥ及び光遮断配線１２２を含む。前記表示パネル５００は、ストレージ配線ＳＬ、第２スイッチング素子２０、第２開口パターン２５２をさらに含む。
【００２６】
前記第１ゲート配線ＧＬ１は、前記表示パネル５００の第１方向Ｄ１に延在し、前記第２ゲート配線ＧＬ２は、図１（ａ）中において、前記第１ゲート配線ＧＬ１に対して第２方向下部に配置されており、前記第１方向Ｄ１に向かって延在して互いに平行して配置される。前記第１方向Ｄ１と前記第２方向Ｄ２とは、互いに異なる方向であり、例えば互いに直交する方向であることができる。
【００２７】
前記第１データ配線ＤＬ１は、前記第２方向Ｄ２に延長し、前記第１ゲート配線ＧＬ１及び第２ゲート配線ＧＬ２と交差して形成される。前記第２データ配線ＤＬ２は、図１（ａ）中において、前記第１データ配線ＤＬ１に対して前記第１方向Ｄ１に配置されており、前記第１データ配線ＤＬ１と平行に配置される。前記第２データ配線ＤＬ２は前記第１ゲート配線ＧＬ１及び第２ゲート配線ＧＬ２と交差する。
【００２８】
前記第１スイッチング素子１０は、前記第１ゲート配線ＧＬ１及び前記第２ゲート配線ＤＬ２とつながる。前記第１スイッチング素子１０は、前記第１ゲート配線ＧＬ１に印加され、第１ゲート信号によってターン／オンされる。前記第１スイッチング素子１０は、前記画素電極ＰＥと電気的につながる。
【００２９】
前記第１スイッチング素子１０は、前記ゲート配線ＧＬ１と重なるデュアルソース電極ＤＳＥ、第１ドレイン電極ＤＥ１、及び第２ドレイン電極ＤＥ２を含む。前記デュアルソース電極ＤＳＥは例えば、図１（ａ）に示すように概ねＷ字形として形成され、第２データ配線ＤＬ２と接続されている。前記第１ドレイン電極ＤＥ１及び前記第２ドレイン電極ＤＥ２は、前記デュアルソース電極ＤＳＥと離隔するように形成される。前記第１ドレイン電極ＤＥ１及び第２ドレイン電極ＤＥ２が前記画素電極ＰＥと電気的に接続される。
【００３０】
第１アクティブパターンＡ１は、前記デュアルソース電極ＤＳＥと前記第１ドレイン電極ＤＥ１の間に配置される。前記第１アクティブパターンＡ１は、前記デュアルソース電極ＤＳＥと前記第２ドレイン電極ＤＥ２の間にも配置される。前記第１ドレイン電極ＤＥ１及び第２ドレイン電極ＤＥ２は、前記第１アクティブパターンＡ１を介して前記デュアルソース電極ＤＳＥと電気的に接続され、これによって、第２データ配線ＤＬ２に印加されるデータ信号は、前記第１ドレイン電極ＤＥ１及び第２ドレイン電極ＤＥ２に伝達される。
【００３１】
前記画素電極ＰＥは、画素領域Ｐを区画する。すなわち、前記画素電極ＰＥが形成される領域が、前記画素領域Ｐとして定義されることができる。一例として、前記画素電極ＰＥは、前記第１ゲート配線ＧＬ１及び第２ゲート配線ＧＬ２が前記第１データ配線ＤＬ１及び前記第２データ配線ＤＬ２と交差して区画する領域に形成されることができる。前記画素領域Ｐは、平面的に見た場合、実質的に長方形の形状を有することができる。前記第１開口パターン１７２は、前記画素領域Ｐに形成され、前記画素領域Ｐの液晶ドメインを形成することができる。前記画素電極ＰＥは、第１サブ電極ＳＰＥ１及び第２サブ電極ＳＰＥ２を含む。
【００３２】
前記第１開口パターン１７２は、前記画素領域Ｐにおいて、前記第１ゲート配線ＧＬ１及び第２ゲート配線ＧＬ２に対して斜め方向に形成される。前記第１開口パターン１７２は、前記第１方向Ｄ１及び第２方向Ｄ２の間の第３方向に延在するように形成される。前記第１開口パターン１７２は例えば、前記第１ゲート配線ＧＬ１及び第２ゲート配線ＧＬ２と、前記第１データ配線ＤＬ１及び第２データ配線ＤＬ２とは、約４５°傾いて前記第３方向に延在される。前記第１開口パターン１７２は、互いに異なる方向に傾斜する２つの傾斜パターンが互いに交差してＶ字形またはＵ字形に形成されることができる。つまり、画素領域の上部の第１開口パターン１７２と画素領域の下部の第1開口パターン１７２とは、画素領域の中央を第1方向Ｄ１に横切る仮想の中心線Ｍ１−Ｍ１に対して互いに対称に形成されており、組み合わせることによりＶ字又はＵ字が形成され得る。
【００３３】
前記第１サブ電極ＳＰＥ１は、前記第２サブ電極ＳＰＥ２を取り囲むように形成されることができる。前記第１サブ電極ＳＰＥ１及び前記第２サブ電極ＳＰＥ２は前記第１開口パターン１７２の幅ほど離隔配置される。つまり、画素電極は、第1開口パターン１７２により開口が形成されることで、第１サブ電極ＳＰＥ１及び第２サブ電極ＳＰＥ２に分割されている。前記第１サブ電極ＳＰＥ１は前記第１ドレイン電極ＤＥ１と第１コンタクトホールＣＮＴ１を通じて接続される。前記第２サブ電極ＳＰＥ２は前記第２ドレイン電極ＤＥ２と第２コンタクトホールＣＮＴ２を通じて接続される。これにより、前記第１サブ電極ＳＰＥ１及び前記第２サブ電極ＳＰＥ２は、前記第１スイッチング素子１０と電気的につながる。
【００３４】
前記光遮断配線１２２は、前記第１開口パターン１７２が形成される領域に対応して形成される。前記光遮断配線１２２は、前記第１開口パターン１７２に沿って、前記第１開口パターン１７２の長さの方向に延在するように形成される。
【００３５】
以下、図２及び図３を参照しながら、本発明の一実施例による光遮断配線について詳しく後述する。
【００３６】
図２は、図１（ａ）の光遮断配線を拡大して示す平面図である。
【００３７】
図１（ａ）及び図２を参照すれば、本発明の一実施例による前記光遮断配線１２２は、前記第１開口パターン１７２が形成される領域に形成される。前記光遮断配線１２２は、前記第１開口パターン１７２に沿って前記第１開口パターン１７２の長さ方向に延在するように形成される。一例として、前記光遮断配線１２２の幅は約５μｍ〜約１０μｍであることができる。
【００３８】
前記光遮断配線１２２は、前記第１開口パターン１７２の長さの方向に沿って延在される第１エッジＥＤ１及び前記第１エッジＥＤ１と向い合う第２エッジＥＤ２に形成される凸凹パターンを含む。前記第１エッジＥＤ１は、前記第１サブ電極ＳＰＥ１と隣接し、前記第２エッジＥＤ２は、前記第２サブ電極ＳＰＥ２と隣接する。
【００３９】
前記凸凹パターンは、複数の単位パターン１２１を含み、複数の前記単位パターン１２１が前記第１エッジＥＤ１及び第２エッジＥＤ２に形成されて、本発明の第１実施例による前記光遮断配線１２２の前記凸凹パターンを定義する。前記凸凹パターンは、前記単位パターン１２１を連続的に繰り返して配置することで形成される。前記凸凹パターンは、前記第１エッジＥＤ１に形成される前記単位パターン１２１がなす第１パターンと、前記第２エッジＥＤ２に形成される前記単位パターン１２１がなす第２パターンと、が互いにずれるように配置し、形成されることができる。これにより、本発明の第１実施例による前記光遮断配線１２２の全体的な形状が、実質的にジグザグ形として形成されることができる。前記光遮断配線１２２の幅は、約５μｍ〜約１０μｍであることができ、前記光遮断配線１２２の前記凸凹パターンを除いた直線部の幅ｋは例えば、約２μｍ〜約４μｍであることができる。
【００４０】
前記単位パターン１２１は、互いに交差する第１傾斜部１２１ａ及び第２傾斜部１２１ｂを含む。前記単位パターン１２１は、前記光遮断配線１２２の外部に向かって前記第１傾斜部１２１ａ及び第２傾斜部１２１ｂが延長される凸形状であることができる。前記第１傾斜部１２１ａは、前記第２方向Ｄ２に延長され、前記第２傾斜部１２１ｂは、前記第１方向Ｄ１に延長されることができる。前記単位パターン１２１の前記第１傾斜部１２１ａ及び前記第２傾斜部１２１ｂが交差する部分は、点（Ｐｏｉｎｔ）であることができる。
【００４１】
前記第１傾斜部１２１ａの第１長さｘ及び第２傾斜部１２１ｂの第２長さｙは、各々約４μｍ〜約１０μｍであることができる。前記凸凹パターンは、互いに同一の単位パターンが繰り返して配置されて形成されることができる。これとは別に、１つの単位パターンから図２中の斜め上方又は斜め下方に進むにつれて、前記第１長さｘ及び前記第２長さｙの各々が徐々に短くなる単位パターンが配置され、形成されることができる。前記第１長さｘ及び前記第２長さｙは同一の値を有することができる。前記第１長さｘ及び前記第２長さｙは互いに異なる値を有することができる。
【００４２】
前記光遮断配線１２２の前記第１エッジＥＤ１に形成される単位パターンの前記第１傾斜部１２１ａと、前記第２エッジＥＤ２に形成される単位パターンの前記第２傾斜部１２１ｂと、の間の距離ｚは、約３μｍ〜約１０μｍであることができる。前記距離ｚは前記第１長さｘ及び前記第２長さｙと同一であることができる。但し、前記距離ｚは、前記光遮断配線１２２の光遮断の役割であることを顧慮すると、約３μｍよりは大きいことが望ましい。
【００４３】
前記第１エッジＥＤ１の前記第１傾斜部１２１ａ及び前記第２傾斜部１２１ｂが交差する部分と、前記第２エッジＥＤ２の前記第１傾斜部１２１ａ及び前記第２傾斜部１２１ｂが交差する部分との間の距離は、前記第１開口パターン１７２の幅ｗと同一であることができる。例えば、前記第１開口パターン１７２の幅ｗは約３．５μｍ〜約１０μｍであることができる。
【００４４】
前記第１傾斜部１２１ａ及び前記第２傾斜部１２１ｂがなす角度θは、約４５°〜約１３５°であることができる。前記角度θが、約４５°より狭い場合、あるいは、約１３５°より広い場合には、前記単位パターン１２１が形成する前記凸凹パターンにより、前記光遮断配線１２２の全体的な形状が実質的に長方形（ｒｅｃｔａｎｇｌｅ）になり、前記液晶を前記表示パネル５００の偏光軸の方向と同一または類似に配列させることができない。例えば、角度θが約４５°より小さい場合は第１エッジＥＤ１（又は第２エッジＥＤ２）が密に形成され、隣接する第１エッジＥＤ１（又は第２エッジＥＤ２）の頂点間の距離が短くなる。そのため、光遮断配線１２２は概ね長方形状とみなされるようになり、光遮断配線１２２に沿って液晶が配列され、液晶が偏光軸の方向とは異なる方向に配置されてしまう。また、角度θが約１３５°より大きい場合は第１エッジＥＤ１（又は第２エッジＥＤ２）の山が平坦となる。よって、光遮断配線１２２は概ね長方形状とみなされるようになり、光遮断配線１２２に沿って液晶が配列され、液晶が偏光軸の方向とは異なる方向に配置されてしまう。
【００４５】
望ましくは、前記角度θは約６０°〜約１２０°であることができる。一例として、角度θは約９０度であることができる。
【００４６】
本発明の第１実施例によれば、前記光遮断配線１２２により、前記液晶が前記表示パネル５００の偏光軸の方向と同一または類似に配列されることができる。
【００４７】
他方、前記光遮断配線１２２の幅Ｗは前記第１開口パターン１７２の幅と同一であるか、または前記第１開口パターン１７２の幅より狭く形成されることができる。すなわち、前記光遮断配線１２２の前記第１エッジＥＤ１は、前記第１サブ電極ＳＰＥ１と相接するように形成され、前記第２エッジＥＤ２は前記第２サブ電極ＳＥＰ２と相接するように形成されることにより、前記光遮断配線１２２は、前記第１サブ電極ＳＰＥ１及び前記第２サブ電極ＳＰＥ２と重ならないことができる。具体的に、図２に示すように、第１エッジＥＤ１の頂点が第１サブ電極ＳＰＥ１に接し、第２エッジＥＤ２の頂点が第２サブ電極ＳＰＥ２に接している。
【００４８】
これとは別に、前記光遮断配線１２２は、前記画素電極ＰＥと重なることができる。
【００４９】
図３は、図２の光遮断配線と画素電極の位置を説明するための平面図である。
【００５０】
図３を参照すれば、前記第１エッジＥＤ１は、前記第１サブ電極ＳＰＥ１と一部分が重なり、前記第２エッジＥＤ２は、前記第２サブ電極ＳＰＥ２と一部分が重なる。図３において、前記第１エッジＥＤ１と前記第１サブ電極ＳＰＥ１が重なる部分を「Ａ」と表示し、以下においては、「Ａ」を「重なり部」と称し、説明する。
【００５１】
前記光遮断配線１２２と前記画素電極ＰＥが重なる部分である重なり部Ａは、補助ストレージコンデンサーＣｓｔとして利用することができる。また、前記アレイ基板１００の設計の際、前記重なり部Ａの面積を考慮して設計することで、前記アレイ基板１００の製造工程上の調整不良による電気容量の変動が最小化されることができる。例えば、補助ストレージコンデンサーＣｓｔにより、液晶キャパシタの電圧維持能力を補償することができる。一例として、前記第１開口パターン１７２の幅ｗが約５μｍの際、前記第１傾斜部１２１ａ及び前記第２傾斜部１２１ｂが交差する部分と前記第１サブ電極ＳＰＥ１の端部との間の距離ａは、約１．５μｍ〜１．８μｍであることができる。
【００５２】
再び図１（ａ）を参照すれば、前記ストレージ配線ＳＬは、前記画素領域Ｐに形成される。前記ストレージ配線ＳＬは、前記第１ゲート配線ＧＬ１及び第２ゲート配線ＧＬ２と平行に延在する部分と、前記第１データ配線ＤＬ１及び第２データ配線ＤＬ２と平行に延在する部分と、により形成される。前記ストレージ配線ＳＬは、前記第１ベース基板１１０の前記第１ゲート配線ＧＬ１及び前記第２ゲート配線ＧＬ２の間の領域に形成される。前記ストレージ配線ＳＬは、例えば、画素領域内において、図１（ａ）に示すように概ねＵ字形として形成されることができる。前記ストレージ配線ＳＬは、前記画素電極ＰＥと部分的に重なって形成される。前記ストレージ配線ＳＬは、前記光遮断配線１２２と接続される。
【００５３】
前記第２スイッチング素子２０は、前記第２ゲート配線ＧＬ２及び前記ストレージ配線ＳＬと電気的に接続される。前記第２スイッチング素子２０は、前記第２ゲート配線ＧＬ２に印加される第２ゲート信号により、ターン／オンされる。前記第２スイッチング素子２０は、ソース電極ＳＥ及び第３ドレイン電極ＤＥ３を含む。前記ソース電極ＳＥ及び前記第３ドレイン電極ＤＥ３は、前記第２ゲート配線ＧＬ２と重なる。前記ソース電極ＳＥは、前記第１サブ電極ＳＰＥ２と第３コンタクトホールＣＮＴ３を通じて接続される。前記第３ドレイン電極ＤＥ３は、前記ストレージ配線ＳＬ及び前記第２サブ電極ＳＰＥ１と重なる。前記ストレージ配線ＳＬ及び前記第３ドレイン電極によってダウン電圧コンデンサー（Ｃ＿ｄｏｗｎ）が定義され、前記第３ドレイン電極ＤＥ３及び前記第１サブ電極ＳＰＥ１によってアップ電圧コンデンサー（Ｃ＿ｕｐ）が定義される（図１０参照）。
【００５４】
第２アクティブパターンＡ２は、前記第２ゲート配線ＧＬ２上に形成される。前記第２アクティブパターンＡ２上に前記ソース電極ＳＥ及び前記第３ドレイン電極ＤＥ３が形成される。前記第３ドレインＤＥ３は前記第２アクティブパターンＡ２を通じて前記ソース電極ＳＥと電気的につながる。
【００５５】
前記第２開口パターン２５２は、前記画素電極ＰＥと対向する共通電極層（図示せず）に形成される。前記第２開口パターン２５２は前記第１開口パターン１７２とずれて配置され、前記第１開口パターン１７２とともに前記液晶ドメインを形成することができる。前記第２開口パターン２５２は、Ｖ字形のパターンと、前記Ｖ字形のパターンと離隔されて前記Ｖ字形パターンの外郭を囲む斜線形パターンと、を含む。Ｖ字形パターンは、画素領域の中央を第1方向Ｄ１に横切る仮想の中心線Ｍ１−Ｍ１に対してＶ字の一辺が互いに対称となるように配置されている。斜線形パターンもまた、仮想の中心線Ｍ１−Ｍ１に対して対称となるように配置されている。前記Ｖ字形パターンと前記斜線形パターンとの間の領域に前記第１開口パターン１７２が配置されることができる。
【００５６】
他方、前記第１サブパターン電極ＳＰＥ１及び前記第２サブ電極ＳＰＥ２に互いに異なる電圧が印加される過程を説明する。ここで、前記第１サブ電極ＳＰＥ１に充電される電圧を第１電圧とし、前記第２サブ電極ＳＰＥ２に充電される電圧を第２電圧と定義する。ここで、第１サブ電極ＳＰＥ１と第２サブ電極ＳＰＥ２との関係を回路図で示すと図１（ｂ）に示す通りになる。
【００５７】
先ず、前記第1ゲート配線ＧＬ１に前記第１ゲート信号が印加されると、第１スイッチング素子１０がオンし、前記第１サブ電極ＳＰＥ１の前記第１電圧及び前記第２サブ電極ＳＰＥ２の前記第２電圧は同一の値を有し、その後、徐々に増加する。引き続き、前記第１ゲート信号が前記第１ゲート配線ＧＬ１に印加されなくなれば、前記第１サブ電極ＳＰＥ１の前記第１電圧及び前記第２サブ電極ＳＰＥ２の前記第２電圧は同一の値を有し、その後、徐々に減少して一定に維持される。
【００５８】
次に、前記第２ゲート配線ＧＬ２に前記第２ゲート信号が印加されると、第２スイッチング素子２０がオンし、ダウン電圧コンデンサー（Ｃ＿ｄｏｗｎ）及びアップ電圧コンデンサー（Ｃ＿ｕｐ）の作用により前記第１サブ電極ＳＰＥ１の前記第１電圧は徐々に増加して一定に維持される。反面、前記第２サブ電極ＳＰＥ２の前記第２電圧は、若干の変動はあるが、前記第２ゲート信号が印加される前とほぼ同一の値を維持することができる。
【００５９】
最後に、前記第２ゲート信号が前記第２ゲート配線ＧＬ２に印加されなくなれば、前記第１サブ電極ＳＰＥ１の前記第１電圧と前記第２サブ電極ＳＰＥ２の前記第２電圧は、互いに異なる値として一定に維持される。結局、前記第１サブ電極ＳＰＥ１の前記第１電圧は、前記第２サブ電極ＳＰＥ２の前記第２電圧より相対的に高い値を有することになる。すなわち、前記第１スイッチング素子１０によって前記第１サブ電極ＳＰＥ１及び前記第２サブ電極ＳＰＥ２に同一の電圧が印加されるが、前記第２スイッチング素子２０によって前記第１サブ電極ＳＰＥ１の前記第１電圧がアップ（ｕｐ）されることにより、前記第１サブ電極ＳＰＥ１及び前記第２サブ電極ＳＰＥ２に、実質的に互いに異なる電圧が印加されることと同一となる。
【００６０】
図４〜図９は、本発明の実施例１による要請配線の他の例を拡大して示す平面図である。
【００６１】
図４に図示される光遮断配線は、光遮断配線を除いては図１（ａ）に図示される表示パネル５００と同一の表示パネルに適用されることができる。よって、図１（ａ）及び図２の本発明の実施例１においての部材と同一の部材は、同一の参照符号をもって示し、重複される詳細な説明は省略する。
【００６２】
図４を参照すれば、本発明の実施例１による光遮断配線１２２の一例は、単位パターン１２１が連続的に繰り返して配置される。前記単位パターン１２１は、前記凸形状を有する。前記光遮断配線１２２は、前記第１エッジＥＤ１に形成される前記単位パターン１２１がなす第１パターンと、前記第２エッジＥＤ２に形成される前記単位パターン１２１がなす第２パターンとが、第1及び第２パターンが対向する中心線Ｍ２−Ｍ２に対して対称に配置されることができる。
【００６３】
前記第１傾斜部１２１ａ及び前記第２傾斜部１２１ｂがなす角度θは、約４５°〜約１３５°であることができる。前記角度θは、望ましくは、約６０°〜約１２０°であることができる。一例として、前記角度θは、約９０°であることができる。
【００６４】
図５〜図８に図示される光遮断配線は、光遮断配線を除いては図１（ａ）に図示される表示パネル５００と同一の表示パネルに適用されることができる。よって、図１（ａ）及び図２の本発明の実施例１においての部材と同一の部材は、同一の参照符号をもって示し、重複される詳細な説明は省略する。
【００６５】
図５を参照すれば、光遮断配線１２２は、前記単位パターン１２１が前記第１エッジＥＤ１のみに連続して繰り返し配置される凸凹パターンを含む。前記単位パターン１２１は、前記凸形状を有する。
【００６６】
前記光遮断配線１２２の前記第１エッジＥＤ１は、前記第１サブ電極ＳＰＥ１のエッジと相接して前記光遮断配線１２２と前記第１サブ電極ＳＰＥ１に重ならないことができる。
【００６７】
これとは別に、前記光遮断配線１２２の前記第１エッジＥＤ１は、前記第１サブ電極ＳＰＥ１のエッジと重なる重なり部をさらに含むことができる。前記重なり部は、補助ストレージコンデンサーを定義するための電極であることができる。この際、前記第２エッジＥＤ２は、前記第２サブ電極ＳＰＥ２のエッジと重なるか、あるいは重ならないことができる。
【００６８】
図６を参照すれば、光遮断配線１２２は、前記第１エッジＥＤ１に形成される前記単位パターン１２１が非連続的に繰り返して配置される第１パターンと、前記第２エッジＥＤ２に形成される前記単位パターン１２１が非連続的に繰り返して配置される第２パターンが定義する凸凹パターンを含む。つまり、第１エッジＥＤ１及び第２エッジＥＤ２の単位パターン１２１は互いにすぐ横に隣接するように形成されるのではなく、平坦部分を間に挟んで形成される。前記凸凹パターンの前記第１エッジＥＤ１に形成される第１パターンと、前記第２エッジＥＤ２に形成される第２パターンは、互いにずれて配置されることができる。つまり、第１エッジＥＤ１の平坦部分と第２エッジＥＤ２の第２パターンとが対応し、第１エッジＥＤ１の第１パターンと第２エッジＥＤ２の平坦部分とが対応するように配置される。これとは別に、前記第１エッジＥＤ１に形成される前記第１パターンと、前記第２エッジＥＤ２に形成される前記第２パターンが、第１及び第２パターンが対向する中心線に対して対称して配置されることができる。
【００６９】
図７を参照すれば、光遮断配線１２２は、単位パターン１２１が非連続的に繰り返して配置される。前記単位パターン１２１は、前記第１傾斜部１２１ａ及び前記第２傾斜部１２１ｂが前記光遮断配線の内側にくぼんだ凹形状を有する。前記光遮断配線１２２は、前記第１エッジＥＤ１に形成される前記単位パターン１２１がなす第１パターンと、前記第２エッジＥＤ２に形成される前記形成単位１２１とがなす第２パターンがずれて配置されることができる。つまり、第１エッジＥＤ１の平坦部分と第２エッジＥＤ２の第２パターンとが対応し、第１エッジＥＤ１の第１パターンと第２エッジＥＤ２の平坦部分とが対応するように配置される。これとは別に、前記第１エッジＥＤに形成される第１パターンと、前記第２エッジＥＤ２に形成される第２パターンとが第１及び第２パターンが対向する中心線に対して対称に配置されることができる。
【００７０】
前記第１傾斜部１２１ａ及び前記第２傾斜部１２１ｂがなす角度θは、約４５°〜約１３５°であることができる。前記角度θは望ましくは、約６０°〜約１２０°であることができる。一例として、前記角度θは、約９０°であることができる。
【００７１】
図８を参照すれば、光遮断配線１２２は、単位パターン１２１が前記第１エッジＥＤ１のみに連続的に繰り返して配置される凸凹パターンを含む。前記単位パターン１２１は、前記凹形状を有する。
【００７２】
図５及び図８においては、光遮断配線１２２の第１エッジＥＤ１のみに凸凹パターンが形成される場合を一例として図示し、説明したが、光遮断配線１２２の第２エッジＥＤ２のみに凸凹パターンが形成されることができる。
【００７３】
図９を参照すれば、前記第１傾斜部１２１ａ及び前記第２傾斜部１２１ｂが交差する部分は、丸みを帯びるように形成されることができる。この際、前記光遮断配線１２２の全体的な形状は、例えば、波模様に形成されることができる。前記第１傾斜部１２１ａ及び前記第２傾斜部１２１ｂが交差する部分は、設計者の意図によって所定の曲率を有するように形成することができ、前記光遮断配線１２２を形成する写真腐刻工程によって所定の曲率を有するように形成されることができる。
【００７４】
図面には図示していないが、図４〜図８に図示される凸凹パターンの各単位パターンが図９に図示される単位パターンのように第１傾斜部及び第２傾斜部が交差する部分を所定の曲率を有するように形成することができる。
【００７５】
本発明の実施例によれば、光遮断配線１２２によって液晶が表示パネル５００の偏光軸の方向と同一または類似に配列されることができる。よって、漏れ光を最小化し、対比比率を向上させることによって表示品質を向上させることができる。
【００７６】
図１０は、図１（ａ）のＩ‐Ｉ’ライン及びＩＩ‐ＩＩ’ラインに沿って切断した断面図である。
【００７７】
図１（ａ）及び図１０を参照すれば、前記表示パネル５００は、アレイ基板１００、対向基板２００、及び液晶層３００を含む。前記表示パネル５００は、第１偏光板４１０及び第２偏光板４２０をさらに含む。
【００７８】
前記アレイ基板１００は、第１ベース基板１１０上に形成される前記第１ゲート配線ＧＬ１及び第２ゲート配線ＧＬ２、前記第１データ配線ＤＬ１及び第２データ配線ＤＬ２、前記第１スイッチング素子１０、前記画素電極ＰＥ、前記光遮断配線１２２、前記ストレージ配線ＳＬ、前記第２スイッチング素子２０、前記第１アクティブパターンＡ１、及び前記第２アクティブパターンＡ２を含む。前記アレイ基板１１０は、前記第１ベース基板１１０上に形成されるゲート絶縁層１２０及びパシベーション層１６０をさらに含む。
【００７９】
前記第１ベース基板１１０は、プレート形状を有し、透明な物質で形成される。前記透明な物質は、例えば、ガラス、石英、合成樹脂などを含むことができる。
【００８０】
前記第１ベース基板１１０上にはゲートパターンが形成される。前記ゲートパターンは、前記第１ゲート配線ＧＬ１及び第２ゲート配線ＧＬ２、前記ストレージ配線ＳＬ及び前記光遮断配線１２２を含む。例えば、前記ゲートパターンは、前記第１ベース基板１１０上にゲート金属層を形成し、前記ゲート金属層を写真腐刻工程を通じ、パターニングして形成することができる。
【００８１】
前記ゲート絶縁層１２０は、前記ゲートパターンが形成される前記第１ベース基板１１０上に形成される。前記ゲート絶縁層１２０は、例えば、酸化シリコン（ＳｉＯｘ，０＜ｘ＜１）、窒化シリコン（ＳｉＮｙ、０＜ｙ＜１）などを含むことができる。
【００８２】
前記第１アクティブパターンＡ１及び前記第２アクティブパターンＡ２は、前記ゲート絶縁層１２０上に形成される。前記第１アクティブパターンＡ１及び前記第２アクティブパターンＡ２はシリコンを含むことができる。前記第１アクティブパターンＡ１及び前記第２アクティブパターンＡ２は、例えば、非結晶シリコン（Ａｍｏｒｐｈｏｕｓ  Ｓｉｌｉｃｏｎ，ａ‐Ｓｉ）及びｎ型不純物が高濃度ドーピングされた非結晶シリコン（ｎ＋ａ‐Ｓｉ）を含むことができる。 
【００８３】
前記第１アクティブパターンＡ１及び前記第２アクティブパターンＡ２が形成される前記第１ベース基板１１０上にソースパターンが形成される。前記ソースパターンは、前記第１データ配線ＤＬ１及び前記第２データ配線ＤＬ２、前記第１スイッチング素子１０及び第２スイッチング素子２０を含む。例えば、前記ソースパターンは、前記第１アクティブパターンＡ１及び前記第２アクティブパターンＡ２が形成される前記第１ベース基板１１０上にソース金属層を形成し、前記ソース金属層を写真腐刻工程を通じ、パターニングして形成されることができる。前記ストレージ配線ＳＬ及び前記第３ドレイン電極ＤＥ３によってダウン電圧コンデンサー（Ｃ＿ｄｏｗｎ）が定義される。
【００８４】
前記パシベーション層１６０は、前記ソースパターンが形成される前記第１ベース基板１１０上に形成される。前記パシベーション層１６０は、前記第１コンタクトホールＣＮＴ１、前記第２コンタクトホールＣＮＴ２、及び前記第３コンタクトホールＣＮＴ３を含む。前記第１コンタクトホールＣＮＴ１は、前記第１ドレイン電極ＤＥ１の一端部を露出させ、前記第２コンタクトホールＣＮＴ２は前記第２ドレイン電極ＤＥ２の一端部を露出させ、前記第３コンタクトホールＣＮＴ３は前記第３ドレイン電極ＤＥ３の一端部を露出させる。パシベーション層１６０は、例えば、酸化シリコン（ＳｉＯｘ，０＜ｘ＜１）、窒化シリコン（ＳｉＮｙ、０＜ｙ＜１）などを含むことができる。  
【００８５】
前記画素電極ＰＥは、前記パシベーション層１６０が形成される第１ベース基板１１０上に形成される。前記画素電極ＰＥは、透明な導電性物質で形成されることができる。前記画素電極ＰＥは、例えば、酸化錫インジウム（Ｉｎｄｉｕｍ  Ｔｉｎ  Ｏｘｉｄｅ，ＩＴＯ）、酸化亜鉛インジウム（Ｉｎｄｉｕｍ  Ｚｉｎｃ  Ｏｘｉｄｅ，ＩＺＯ）、アモルファス酸化錫インジウム（Ａｍｏｒｐｈｏｕｓ  Ｉｎｄｉｕｍ  Ｔｉｎ  Ｏｘｉｄｅ，ａ-ＩＴＯ）などを含むことができる。前記第３ドレイン電極ＤＥ３及び前記画素電極ＰＥの第１サブ電極ＳＰＥ１によってアップ電圧コンデンサー（Ｃ＿ｕｐ）が定義される。
【００８６】
前記対向基板２００は、第２ベース基板２１０、前記第２ベース基板２１０上に形成される遮光パターン２２０、カラーフィルター２３０及び共通電極層２５０を含む。前記第２開口パターン２５２は、前記共通電極層２５０に形成される。前記対向基板２００は、保護膜層２４０をさらに含むことができる。
【００８７】
前記第２ベース基板２１０は、前記第１ベース基板１１０と対向し、前記第１ベース基板１１０と同一にプレート形状を有し、透明な物質で形成される。
【００８８】
前記遮光パターン２２０は、前記第２ベース基板２１０上に形成される。例えば、前記遮光パターン２２０は、前記第１ゲート配線ＧＬ１及び前記第２ゲート配線、前記第１データ配線ＤＬ１及び前記第２データゲート配線ＤＬ２、前記第１スイッチング素子１０及び前記第２スイッチング素子２０が形成される領域と対応する前記第２ベース基板２１０に形成されることができる。前記遮光パターン２２０は、クロム（Ｃｒ）などのような金属、有機物質などを利用するか、あるいは顔料を含むインクを利用して形成されることができる。
【００８９】
前記カラーフィルター２３０は、前記画素電極ＰＥが形成される領域と対応する前記第１ベース基板２１０上に形成されることができる。前記カラーフィルター２３０は一部が前記遮光パターン２２０と重なることができる。前記カラーフィルター２３０は、顔料を含む有機物質で形成されることができる。前記顔料は、例えば、レッドカラー、グリーンカラー、ブルーカラーなどのカラーを表現することができる。前記カラーフィルター２３０は、写真腐刻工程を通じて形成されるか、あるいはインクジェッティング方式を通じて形成することができる。
【００９０】
前記保護膜層２４０は、前記第２ベース基板２１０上に前記遮光パターン２２０及び前記カラーフィルター２３０をカバーするように形成される。前記保護膜層２４０は、アクリル樹脂などのような有機物質で形成されることができる。
【００９１】
前記共通電極層２５０は、前記保護膜層２４０が形成される前記第２ベース基板２１０上に形成される。前記共通電極層２５０は、前記第２切開パターン２５２を含む。前記共通電極層２５０は、前記画素電極ＰＥと同一の透明な導電性物質で形成されることができる。
【００９２】
前記液晶層３００は、前記アレイ基板１００及び前記対向基板２００の間に介在され、複数の液晶（図示せず）を含む。前記液晶は、前記画素電極ＰＥ及び前記共通電極層２５０の間に印加される電気場によって配列されることができる。配列された前記液晶は、外部より印加される光の透過率を調節することができる。前記光は、前記表示パネル５００の下部より提供されるバックライトであることができる。
【００９３】
前記第１偏光板４１０は、前記アレイ基板１００と結合する。前記第１偏光板４１０は、前記第１ベース基板１１０が前記第２ベース基板２１０と向い合う面の反対面に付着される。前記第１偏光板４１０は、第１偏光軸を有する。前記第１偏光軸の方向は、例えば、図１（ａ）に図示される前記第２方向Ｄ２であることができる。前記単位パターンの前記第１傾斜部１２１ａは、前記第１偏光軸を基準に、０°〜４５°傾くことができる。例えば、第１傾斜部１２１ａの第１偏光軸に対する傾きが０°の場合は、前記第１傾斜部１２１ａは、前記第１偏光軸の方向である第２方向Ｄ２に沿って形成されることができる。
【００９４】
前記第２偏光板４２０は、前記対向基板２００と結合し、前記第１偏光板４１０と対向する。前記第２偏光板４２０は、前記第２ベース基板２１０が前記第１ベース基板１１０と向かい合う面の反対側の面に付着される。前記第２偏光板は、第２偏光軸を有する。前記第２偏光軸の方向は、前記第１偏光軸の方向と概ね直交する方向である。例えば、前記第２偏光軸の方向は、図１（ａ）に図示される前記第１方向Ｄ１であることができる。前記単位パターンの前記第２傾斜部１２１ｂは、前記第２偏光軸を基準に約０°〜約４５°傾くことができる。この際、前記第２傾斜部１２１ｂは、前記第１傾斜部１２１ａと約４５°〜約１３５°の傾斜をなす。例えば、第２傾斜部１２１ｂの第２偏光軸に対する傾きが０°の場合は、前記第２傾斜部１２１ｂは、前記第２偏光軸の方向である第１方向Ｄ１に沿って形成されることができる。
【００９５】
本発明によれば、光遮断配線１２２によって液晶が前記第１偏光軸及び／または前記第２偏光軸の方向と同一あるいは類似に配列されることができる。よって、漏れ光を最小化し、対比率を向上させることによって表示品質を向上させることができる。
【００９６】
図１１及び図１５は、図１０に図示されるアレイ基板を製造する方法を説明する平面図である。図１２、図１３、図１４、及び図１５は、図１０に図示されるアレイ基板を製造する方法を説明する断面図である。
【００９７】
図１１〜図１５において、図１（ａ）及び図１０と同一の部材は同一の参照符号をもって示して同一の名称で説明し、重複される詳細な説明は省略する。
【００９８】
図１１及び図１２を参照すれば、第１ベース基板１１０上にゲートパターンを形成する。
【００９９】
具体的に、前記第１ベース基板１１０上にゲート金属層（図示せず）を形成する。前記ゲート金属層は、例えば、写真腐刻工程を通じてパターニングし、前記ゲートパターンを形成することができる。前記ゲートパターンは、第１ゲート配線ＧＬ１、第２ゲート配線ＧＬ２、ストレージ配線ＳＬ、及び光遮断配線１２２を含む。
【０１００】
前記第１ゲート配線ＧＬ１及び前記第２ゲート配線ＧＬ２は、互いに平行に形成され、前記第１ゲート配線ＧＬ１、及び前記第２ゲート配線ＧＬ２の間に前記ストレージ配線ＳＬ及び前記光遮断配線１２２が形成される。前記光遮断配線１２２は、前記第１ゲート配線ＧＬ１及び前記第２ゲート配線ＧＬ２に対して斜線方向に形成される。前記光遮断配線１２２は、前記ストレージ配線ＳＬとつながる。
【０１０１】
図１３を参照すれば、前記ゲートパターンを含む前記第１ベース基板１１０上にゲート絶縁層１３０、活性層１４０、及びソース金属層１５０を形成する。
【０１０２】
具体的に、前記ゲートパターンが形成される前記第１ベース基板１１０上に前記ゲート絶縁層１３０を形成し、前記ゲート絶縁層１３０が前記ゲートパターンをカバーする。
【０１０３】
前記ゲート絶縁層１３０が形成される前記第１ベース基板１１０上に前記活性層１４０を形成する。前記活性層１４０は、順次に積層される半導体層１４２及びオーミックコンタクト層１４４を含むことができる。一例として、前記半導体層１４２は、非結晶シリコン（ｎ＋ａ‐Ｓｉ）として形成されることができ、前記オーミックコンタクト層１４４は、ｎ形の不純物が高濃度でドーピングされたｎ形の非結晶シリコン（ｎ＋ａ‐Ｓｉ）として形成されることができる。 
【０１０４】
続いて、前記活性層１４０が形成される第１ベース基板１１０上に前記ソース金属層１５０を形成する。
【０１０５】
図１４を参照すれば、第１アクティブパターンＡ１、第２アクティブパターンＡ２、及びソースパターンを形成する。
【０１０６】
具体的に、前記活性層１４０及び前記ソース金属層１５０を半透光部またはスリット部を含む１つのマスクを利用して写真腐刻工程を通じてパターニングすることによって、前記第１アクティブパターンＡ１、前記第２アクティブパターンＡ２、及び前記ソースパターンを形成することができる。前記ソースパターンは、第１データ配線ＤＬ１、第２データ配線ＤＬ２、第１スイッチング素子１０及び第２スイッチング素子２０を含む。前記第１スイッチング素子１０はデュアルソース電極ＤＳＥ、第１ドレイン電極ＤＥ１及び第２ドレイン電極ＤＥ２を含み、前記第２スイッチング素子２０は、ソース電極ＳＥ及び第３ドレイン電極ＤＥ３を含む。
【０１０７】
前記デュアルソース電極ＤＳＥと前記第１ドレイン電極ＤＥ１の間に前記第１アクティブパターンＡ１の前記半導体層１４２が露出され、前記デュアルソース電極ＤＳＥと前記第２ドレイン電極ＤＥ２の間に前記第１アクティブパターンＡ１の前記半導体層１４２が露出されることができる。また、前記ソース電極ＳＥと前記第３ドレイン電極ＤＥ３の間に前記第２アクティブパターンＡ２の前記半導体層１４２が露出されることができる。
【０１０８】
これとは別に、前記第１アクティブパターンＡ１及び前記第２アクティブパターンＡ２を１つのマスクを利用して形成した後、前記ソース金属層１５０を形成し、前記ソース金属層１５０を前記１つのマスクと別のマスクを利用してパターニングし、前記ソースパターンを形成することができる。
【０１０９】
図１５を参照すれば、前記ソースパターンが形成される前記第１ベース基板１１０上にパシベーション層１６０及び透明電極層１７０を形成する。
【０１１０】
前記パシベーション層１６０を前記ソースパターンが形成される第１ベース基板１１０上に形成し、前記パシベーション層１６０を写真腐刻工程を通じてパターニングして第１コンタクトホールＣＮＴ１、第２コンタクトホールＣＮＴ２、及び第３コンタクトホールＣＮＴ３を形成する。
【０１１１】
続いて、前記第１〜第３コンタクトホール（ＣＮＴ１〜ＣＮＴ３）を含む前記パシベーション層１６０が形成される第１ベース基板１１０上に透明電極層１７０を形成する。前記透明電極層１７０は、前記第１〜第３コンタクトホール（ＣＮＴ１〜ＣＮＴ３）を通じて第１ドレイン電極ＤＥ１、前記第２ドレイン電極ＤＥ２、及び第３ドレイン電極ＤＥ３とコンタクトすることができる。
【０１１２】
図１６を参照すれば、前記透明電極層１７０を写真腐刻工程を通じてパターニングし、画素電極ＰＥを形成する。前記画素電極ＰＥは、第１開口パターン１７２、第１サブ電極ＳＰＥ１、前記第１サブ電極ＳＰＥ１と前記第１開口パターン１７２の幅ほど離隔される第２サブ電極ＳＰＥ２を含む。前記第１サブ電極ＳＰＥ１は、前記第１ドレイン電極ＤＥ１と前記第２ドレインＤＥ２と接続され、これにより、前記第１スイッチング素子１０及び前記第２スイッチング素子２０と電気的につながる。前記第２サブ電極ＳＰＥ２は、前記ソース電極ＳＥと接続し、これにより、前記第１スイッチング素子１０と電気的につながる。
【０１１３】
これとは別に、前記ソースパターン上に前記パシベーション層１６０及び前記透明電極層１７０を順次に形成し、前記パシベーション層１６０と前記透明電極層１７０を１つのマスクをもってパターニングして前記第１〜第３コンタクトホール（ＣＮＴ１〜ＣＮＴ３）と前記画素電極ＰＥを形成することができる。
【０１１４】
図１７は、本発明の実施例２を説明するためのアレイ基板の平面図である。
【０１１５】
図１７に図示されるアレイ基板は、画素電極を除いては図１（ａ）に図示される表示パネルと同一の表示パネルを適用することができる。従って、図１７において、図１（ａ）及び図２の本発明の実施例１においての部材と同一の部材は同一の参照符号として示し、重複される説明は省略する。
【０１１６】
図１７を参照すれば、アレイ基板１００は、第１ゲート配線ＧＬ１及び第２ゲート配線ＧＬ２、第１データ配線ＤＬ１及び第２データゲート配線ＤＬ２、第１スイッチング素子１０、第１開口パターン１７２を含む画素電極ＰＥ、光遮断配線１２２、ストレージ配線ＳＬ、及び第２スイッチング素子２０を含む。
【０１１７】
前記光遮断配線１２２は、前記第１ゲート配線ＧＬ１及び前記第２ゲート配線ＧＬ２に対して傾斜する方向に形成される。前記光遮断配線１２２は、前記傾斜方向に沿って複数の単位パターンが配置されて形成される凸凹パターンを含む。前記光遮断配線１２２は、前記ストレージ配線ＳＬとつながる。
【０１１８】
前記画素電極ＰＥは、第１サブ電極ＳＰＥ１、第２サブ電極ＳＰＥ２、及び第１開口を含む。前記第１サブ電極ＳＰＥ１と前記第２サブ電極ＳＰＥ２は、前記第１開口パターン１７２ほど離隔されて形成されることができる。前記第１開口パターン１７２は、前記光遮断配線１２２が形成される領域に形成される。前記第１開口パターン１７２は、前記凸凹パターンと同一の形状でパターニングされて形成される凸凹を含む。前記第１開口パターン１７２の凸凹は、前記光遮断配線１２２の前記凸凹パターンと１対１に対応することができる。
【０１１９】
このように、前記凸凹を含む前記第１開口パターン１７２を形成するとともに、前記光遮断配線１２２を形成することにより、液晶が第１偏光軸及び／または前記第２偏光軸の方向と同一または類似に配列されることができる。よって、漏れ光を最小化し、対比率を向上させることによって表示品質を向上させることができる。
【０１２０】
以上、本発明の実施例によって詳細に説明したが、本発明はこれに限定されず、本発明が属する技術分野において通常の知識を有するものであれば本発明の思想と精神を離れることなく、本発明を修正または変更できる。
【図面の簡単な説明】
【０１２１】
【図１】（ａ）本発明の実施例１による表示パネルの平面図である。（ｂ）第１サブ電極ＳＰＥ１と第２サブ電極ＳＰＥ２との関係を示す回路図である。
【図２】図１の光遮断配線を拡大して示す平面図である。
【図３】図２の光遮断配線と画素電極の位置を説明するための平面図である。
【図４】本発明の実施例１による光遮断配線の他の例を拡大して示す平面図である。
【図５】本発明の実施例１による光遮断配線の他の例を拡大して示す平面図である。
【図６】本発明の実施例１による光遮断配線の他の例を拡大して示す平面図である。
【図７】本発明の実施例１による光遮断配線の他の例を拡大して示す平面図である。
【図８】本発明の実施例１による光遮断配線の他の例を拡大して示す平面図である。
【図９】本発明の実施例１による光遮断配線の他の例を拡大して示す平面図である。
【図１０】図１のＩ‐Ｉ’ライン及びＩＩ‐ＩＩ’ラインに沿って切断した断面図である。
【図１１】図１０に図示される表示基板を製造する方法を説明するための平面図である。
【図１２】図１０のアレイ基板の断面図である。
【図１３】図１０のアレイ基板の断面図である。
【図１４】図１０のアレイ基板の断面図である。
【図１５】図１０のアレイ基板の断面図である。
【図１６】図１０に図示される表示基板を製造する方法を説明するための平面図である。
【図１７】本発明の実施例２を説明するための表示基板の平面図である。
【符号の説明】
【０１２２】
５００    表示パネル
１０    第１スイッチング素子
２０    第２スイッチング素子
１００    アレイ基板
２００    対向基板
３００    液晶層
１２２    光遮断配線
１２１    単位パターン
１２１ａ    第１傾斜部
１２１ｂ    第２傾斜部
１７２    第１開口パターン
ＰＥ    画素電極
ＳＰＥ１    第１サブ電極
ＳＰＥ２    第２サブ電極
ＳＬ    ストレージ配線
２５２    第２開口パターン
【図１】
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【図２】
0005355952.tif 000003
【図３】
0005355952.tif 000004
【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【図１６】
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【図１７】
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