(57)【要約】【課題】入力電圧と非線形素子に流れる電流を一次比例関係にすることで、入力映像信号に忠実な薄膜画素素子の輝度を得ること【解決手段】一画素毎に薄膜画素素子ＥＬと、該薄膜画素素子ＥＬの発光制御用の非線形素子Ｍと、該非線形素子Ｍのゲート電極に接続された信号保持用のキャパシタＣと、該キャパシタＣへのデータ書き込み用の非線形素子Ｔｙと、前記発光制御用の非線形素子Ｍと任意の固定電位との間に、電流−電圧特性が一次比例である負荷素子Ｒｓとを有する。【選択図】        図１
2005092237.tif 000002
【特許請求の範囲】
【請求項１】
一画素毎に薄膜画素素子と、
前記薄膜画素素子の発光制御用の第一の非線形素子と、
前記第一の非線形素子のゲート電極に接続された信号保持用のキャパシタと、
前記キャパシタへのデータ書き込み用の第二の非線形素子と、
前記第一の非線形素子と任意の固定電位との間に、電流−電圧特性が一次比例である負荷素子とを有し、
前記負荷素子は、前記第一の非線形素子の相互コンダクタンスの逆数の１０倍以上の抵抗を有するポリシリコンからなる高抵抗薄膜であることを特徴とする画像表示装置。
【請求項２】
一画素毎に薄膜画素素子と、
前記薄膜画素素子の発光制御用の第一の非線形素子と、
前記第一の非線形素子のゲート電極に接続された信号保持用のキャパシタと、
前記キャパシタへのデータ書き込み用の第二の非線形素子と、
前記第一の非線形素子と任意の固定電位との間に、電流−電圧特性が一次比例である負荷素子とを有し、
前記負荷素子は、前記第一の非線形素子の相互コンダクタンスの逆数の１０倍以上の抵抗を有する第三の非線形素子の出力抵抗であることを特徴とする画像表示装置。
【請求項３】
前記第一の非線形素子又は前記第二の非線形素子は、薄膜トランジスタであることを特徴とする請求項１又は２記載の画像表示装置。
【請求項４】
前記第一の非線形素子は、飽和領域で駆動されていることを特徴とする請求項１乃至３のいずれか１項に記載の画像表示装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、画像表示装置に係り、例えば有機ＥＬ画像表示装置のような、エレクトロルミネセンス（ＥＬ）画像表示装置に関する。
【背景技術】
【０００２】
図５、図６は従来例を示した図である。以下、これらの図面に基づいて従来例を説明する。
【０００３】
図５（Ａ）は、パネルブロック図であり、ディスプレイ（表示）パネル１０には、ディスプレイ画面１１、Ｘ軸のシフトレジスタ１２、Ｙ軸のシフトレジスタ１３が設けてある。
【０００４】
ディスプレイ画面１１には、ＥＬ電源が供給されており、またＸ軸のシフトレジスタ１２には、シフトレジスタ電源の供給とＸ軸同期信号の入力が行われる。さらにＹ軸のシフトレジスタ１３には、シフトレジスタ電源の供給とＹ軸同期信号の入力が行われる。また、Ｘ軸のシフトレジスタ１２の出力部に画像データ信号の出力が設けてある。
【０００５】
図５（Ｂ）は、図５（Ａ）のＡ部の拡大説明図であり、ディスプレイ画面１１の一画素（点線の四角で示す）は、トランジスタが２個、コンデンサが１個、ＥＬ素子が１個より構成されている。
【０００６】
この１画素の発光動作は、例えば、Ｙ軸のシフトレジスタ１３で選択信号Ｙ１の出力があり、またＸ軸のシフトレジスタ１２で選択信号Ｘ１の出力があった場合、トランジスタＴｙ１１とトランジスタＴｘ１がオンとなる。
【０００７】
このため、画像データ（映像信号）Ｄｉは、非線形素子（ＢＩＡＳ  ＴＦＴ）Ｍ１１である薄膜トランジスタのゲートに入力される。これにより、このゲート電圧に応じた電流がＥＬ電源から非線形素子Ｍ１１のドレイン、ソース間に流れ、ＥＬ素子ＥＬ１１が発光する。
【０００８】
次のタイミングでは、Ｘ軸のシフトレジスタ１２は、選択信号Ｘ１の出力をオフとし、選択信号Ｘ２を出力することになるが、非線形素子Ｍ１１のゲート電圧は、コンデンサＣ１１で保持されるため、次にこの画素が選択されるまでＥＬ素子ＥＬ１１の前記発光は、持続することになる。
【０００９】
図６に一画素を抜き出して示す如く、一画素毎のＥＬ素子を発光制御用の非線形素子（ＢＩＡＳ  ＴＦＴ）Ｍに直列接続し、この非線形素子（ＢＩＡＳ  ＴＦＴ）Ｍのゲート電極に信号保持用のキャパシタＣを接続する。
【００１０】
そしてこの信号保持用のキャパシタＣにデータ書き込み用の非線形素子（ＳＥＬＥＣＴ−ＳＷ用ＴＦＴ）Ｔｙを接続し、このデータ書き込み用の非線形素子（ＳＥＬＥＣＴ−ＳＷ用ＴＦＴ）ＴｙにＹ座標選択信号ＹｎとＸ座標選択信号により選択された画像データ（映像信号）Ｄｉを印加する。
【００１１】
この画像データＤｉにより前記信号保持用のキャパシタＣに電荷を蓄積し、この信号保持用のキャパシタＣに蓄積された電圧により前記発光制御用の非線形素子（ＢＩＡＳ  ＴＦＴ）Ｍに流れる電流を制御することにより、ＥＬ素子の発光強度が決定される。（“Ａ６×６−in  20−lpi  Electroluminescent Display Panel ”T.P.BRODY,FANG CHEN LUO,et.al.IEEE Trans.Electron Devices,Vol.ED-22,No.9,Sept.1975、p739〜p749参照）
【発明の開示】
【発明が解決しようとする課題】
【００１２】
ところが、発光制御用の非線形素子（ＢＩＡＳ  ＴＦＴ）Ｍに流れる電流と、キャパシタＣに蓄積された電圧との特性関係は必ずしも一次比例の関係ではない。このため入力された映像信号の大きさとＥＬ素子の発光輝度との関係が直線的でないため、入力映像信号に忠実にＥＬ素子の発光輝度が得られないため、映像信号の大きさに忠実な発光輝度の再現が難しかった。
【００１３】
例えばこの非線形素子Ｍが電界効果トランジスタ（ＴＦＴ）の場合、これに流れる電流は飽和領域で次式のものとなる。
【００１４】
Ｉｄｓ＝（１／２）（Ｗ／Ｌ）μ0 Ｃ0 （Ｖｇｓ−Ｖｔｈ）2 
Ｉｄｓ  ＴＦＴに流れる電流
Ｖｇｓ  ゲートソース間電圧（キャパシタに蓄積された電圧）
Ｃ0     単位面積当りのゲート容量
μ0     移動度
Ｗ      ＴＦＴのゲートのチャネル幅
Ｌ      ＴＦＴのゲートのチャネル長
Ｖｔｈ  ＴＦＴの閾値電圧
前記式より明らかな如く、ＩｄｓとＶｇｓとは比例関係でなく、このため映像信号に比例した発光輝度を得ることができなかった。
【００１５】
本発明は、前記従来の課題を解決し、入力電圧と非線形素子に流れる電流を一次比例関係にすることで、入力映像信号に忠実な薄膜画素素子の輝度を得ることを目的とする。
【課題を解決するための手段】
【００１６】
この目的を達成するため、本発明では図１（Ａ）に示す如く、この発光制御用の非線形素子（ＢＩＡＳ  ＴＦＴ）Ｍと任意の固定電位ＣＯＭとの間に、電流−電圧特性が一次比例特性を有する負荷素子として抵抗Ｒｓを接続する。
【００１７】
（作用）
前記一次比例特性を有する負荷素子としてソース抵抗Ｒｓを接続したので、下記の如く負帰還が非線形素子（ＢＩＡＳ  ＴＦＴ）Ｍに係り、非線形素子Ｍに流れる電流ＩｄｓとキャパシタＣに蓄積された電圧Ｖｇとの間に一次比例特性の関係が得られる。
【００１８】
即ち、図１（Ａ）において、非線形素子Ｍのゲート電圧Ｖｇが変化すると非線形素子Ｍに流れる電流Ｉｄｓが変化し、Ｉｄｓ・Ｒｓつまり、非線形素子Ｍのソース電極と固定電位である共通電位ＣＯＭ間の電位Ｖｓが変化する。これにもとづきＶｇ−ＶｓつまりＶｇｓが変化し、非線形素子Ｍに流れる電流が変化する。これにより負帰還が係りゲート電圧Ｖｇが大きくなったとき、Ｉｄｓは増加するものの、ソースフォロア回路を構成しているため負帰還が係りＶｇ−Ｉｄｓ特性は一次比例特性が得られる。
【発明の効果】
【００１９】
以上のように、本発明によれば次のような効果がある。
【００２０】
(1) 入力電圧と第一の非線形素子に流れる電流を一次比例関係に構成することができるので、入力映像信号に忠実な薄膜画素素子の輝度を得ることができる。
【００２１】
(2) 高抵抗導線を使用して前記一次比例関係を得ることができるので、特別な抵抗を必要とせず、入力映像信号に忠実な薄膜画素素子の輝度を得ることができる。
【００２２】
(3) 第一の非線形素子の寄生抵抗を用いて前記一次比例関係を得ることができるので、これまた特別な抵抗を必要とせず、入力映像信号に忠実な薄膜画素素子の輝度を得ることができる。
【００２３】
(4) 薄膜画素素子の寄生抵抗を用いたので、特別な抵抗を必要とせず、入力映像信号に忠実な薄膜画素素子の輝度を得ることができる。
【００２４】
(5) 薄膜画素素子に抵抗薄膜を形成したので、非常に簡単な構成で、入力映像信号に忠実な薄膜画素素子の輝度を得ることができる。
【００２５】
(6) 負荷素子として第一の非線形素子の出力抵抗を用いたので出力抵抗の制御が容易に行うことができ、かつ、大きな抵抗値を小さな面積で作ることができる。
【発明を実施するための最良の形態】
【００２６】
本発明の一実施例を図１に基づき説明する。
【００２７】
本発明では、図１（Ａ）に示す如く、ＥＬ素子に直列接続された発光制御用の非線形素子（ＢＩＡＳ  ＴＦＴ）Ｍと共通電位ＣＯＭとの間に、電流−電圧特性が一次比例特性を有する負荷素子として抵抗Ｒｓを接続する。
【００２８】
これにより、非線形素子Ｍのゲート電圧Ｖｇ、つまりコンデンサＣの充電電圧が大きくなるとき、図１（Ｂ）に示す如く、この非線形素子Ｍに流れる電流Ｉｄｓが増加する。この電流Ｉｄｓが増大することにより抵抗Ｒｓにおける電圧降下が大きくなり、ソース電位Ｖｓが上昇する。
【００２９】
これにより下記の式で得られるソースゲート間電圧Ｖｇｓ、Ｖｇｓ＝Ｖｇ−Ｖｓも、ソース電位Ｖｓが上昇するため小さくなり、これによりＢＩＡＳ  ＴＦＴに流れる電流Ｉｄｓが減少する。このようにして負帰還がＢＩＡＳ  ＴＦＴにかかるので、Ｉｄｓ対Ｖｇ特性は一次比例の関係を持つ範囲を得ることができる。
【００３０】
この場合、前記発光制御用の非線形素子（ＢＩＡＳ  ＴＦＴ）Ｍのソース電極と任意の共通電位ＣＯＭの間に、発光制御用の非線形素子の相互コンダクタンスの逆数よりも十分に大きな抵抗〔１０倍以上〜１Ｔ（テラ＝１０12）Ω以下〕を配したことにより負帰還が係り、発光制御用の非線形素子Ｍに流れる電流ＩｄｓとキャパシタＣに蓄積された電圧との間に一次比例の関係を持つ範囲を作ることができる。
【００３１】
例えばこの非線形素子Ｍが電界効果トランジスタ（ＴＦＴ：薄膜トランジスタ）の場合、ソース電位ＶｓとこのＴＦＴに流れる電流Ｉｄｓは、飽和領域で次式の通りとなる。
【００３２】
Ｖｓ＝ＲｓＩｄｓ    ・・・・・・・・・・・・・・・・・・・・・・(1) 
Ｉｄｓ＝（１／２）（Ｗ／Ｌ）μ0 Ｃ0 （Ｖｇ−Ｖｓ−Ｖｔｈ）2 ・・(2) 
Ｉｄｓ    ＴＦＴに流れる電流
Ｖｇ      キャパシタＣに蓄積された電圧
Ｖｓ      ソース電位
Ｖｔｈ    ＴＦＴの閾値電圧
Ｒｓ      電流−電圧特性が一次比例特性を有する抵抗
Ｃ0       単位面積当りのゲート容量
μ0       移動度
Ｗ        ＴＦＴのゲートのチャネル幅
Ｌ        ＴＦＴのゲートのチャネル長
この(1) 、(2) の両式を微分すると、
ΔＶｓ＝ＲｓΔＩｄｓ    ・・・・・・・・・・・・・・・・・・・・(3) 
ΔＩｄｓ＝ｇｍ（ΔＶｇ−ΔＶｓ）・・・・・・・・・・・・・・・・(4) 
ここで、ｇｍはＴＦＴの相互コンダクタンス〔ｇｍ＝（Ｗ／Ｌ）μ0 Ｃ0 （Ｖｇ−Ｖｓ−Ｖｔｈ）〕である。
【００３３】
(3) 式より
ΔＩｄｓ＝ΔＶｓ／Ｒｓ    ・・・・・・・・・・・・・・・・・・・(5) 
(5) 式を(4) 式に代入し、
ΔＶｓ／Ｒｓ＝ｇｍ（ΔＶｇ−ΔＶｓ）
これを変形し、
（１＋ｇｍＲｓ）ΔＶｓ＝ｇｍＲｓΔＶｇ
これにより、
ΔＶｓ＝（ｇｍＲｓ）／（１＋ｇｍＲｓ）・ΔＶｇ
ここで、抵抗Ｒｓが発光制御用の非線形素子（ＴＦＴ）の相互コンダクタンスｇｍの逆数より十分大きな場合、即ち、ｇｍＲｓ＞＞１のとき、
ΔＶｓ≒ΔＶｇ
これにより(5) 式から、
ΔＩｄｓ＝（１／Ｒｓ）ΔＶｓ＝（１／Ｒｓ）ΔＶｇ・・・・・・・・(6) 
この(6) 式の関係により、ＥＬ素子に流れる電流Ｉｄｓとゲート電圧Ｖｇとが一次比例の関係となっていることがわかる。
【００３４】
ところで、図１における抵抗Ｒｓは個別の抵抗体を使用せずに、ソース電極を共通電位ＣＯＭに接続する導線を、例えばポリシリコンの如き高抵抗な薄膜により作成することもできる。この場合の抵抗値の制御は、そのパターン寸法（例えば、幅、長さ、厚さ等）を調節することにより行うことができる。
【００３５】
また前記ソース電極に付加する抵抗は、非線形素子（ＢＩＡＳ  ＴＦＴ）に必ず存在する寄生抵抗、例えばソース抵抗、オフセット領域（ドーピングのない領域）等を使用して作ってもよい。このときの抵抗値の制御は、ドーピング量、オフセット距離、電極のパターン形状等により行う。図２（Ａ）に示す抵抗Ｒｓは、この寄生抵抗を等価的に示したものである。
【００３６】
図２（Ａ）において、非線形素子（ＢＩＡＳ  ＴＦＴ）ＭとしてＰチャネル電界効果トランジスタを使用し、この非線形素子Ｍのドレイン電極と任意の共通電位ＣＯＭの間に、ＥＬ素子が設けてある。また、ゲート電極と任意の固定電位ＶＤとの間に信号保持用のキャパシタＣが設けてある。
【００３７】
この場合も寄生抵抗である抵抗Ｒｓを発光制御用の非線形素子Ｍの相互コンダクタンスの逆数よりも十分に大きな抵抗（１０倍以上〜１ＴΩ以下）とすることにより負帰還が係り、非線形素子Ｍに流れる電流ＩｄｓとキャパシタＣに蓄積された電圧との間に一次比例の関係を持つ範囲を作ることができる。
【００３８】
図２（Ｂ）は非線形素子Ｍの寄生抵抗の一例を示しており、上からドレイン電極Ｄ、ドレインパターン、ゲート電極Ｇ、ソースパターン、ソース電極Ｓを示している。このソースパターンの一部にオフセット領域ＯＰを設け、抵抗Ｒｓを作ることができる。勿論このソースパターンの幅、長さ、厚さ等を調節して抵抗Ｒｓを作るようにしてもよい。
【００３９】
さらに前記ソース電極に付加する抵抗は、薄膜画素素子に必ず発生する寄生抵抗を用いてもよく、図３（Ａ）に示す抵抗Ｒｓは、この寄生抵抗を等価的に示したものである。
【００４０】
図３（Ａ）において、非線形素子（ＢＩＡＳ  ＴＦＴ）ＭとしてＰチャネル電界効果トランジスタを使用し、この非線形素子Ｍのゲート電極と固定電位ＶＤとの間に信号保持用のキャパシタＣが設けてある。また、ソース電極と固定電位ＶＤとの間に薄膜画素素子であるＥＬ素子とその寄生抵抗Ｒｓが設けてある。
【００４１】
この場合も寄生抵抗である抵抗Ｒｓを発光制御用の非線形素子Ｍの相互コンダクタンスの逆数よりも十分に大きな抵抗（１０倍以上〜１ＴΩ以下）とすることにより負帰還が係り、非線形素子Ｍに流れる電流ＩｄｓとキャパシタＣに蓄積された電圧との間に一次比例の関係を持つ範囲を作ることができる。
【００４２】
図３（Ｂ）は薄膜画素素子の一例（有機ＥＬ発光素子）を示す図であり、寄生抵抗としてこの図に示す如く、抵抗層１０２を使用してもよい。この場合もその等価回路は図３（Ａ）に示す通りである。なお図３（Ｂ）に示す有機ＥＬ発光素子において、１０１はＭｇＡｇ等の陰極、１０３は電子注入輸送層、１０４は発光層、１０５は正孔注入輸送層、１０６は透明電極である。
【００４３】
この寄生抵抗の値を制御するには、抵抗層１０２としてポリシリコン薄膜、アモルファスシリコン薄膜、高抵抗有機薄膜等の膜厚で制御を行う。勿論薄膜画素素子の電流−電圧特性が一次比例する場合には、これを用いてもよい。
【００４４】
また、前記ソース電極に付加する抵抗は非線形素子の出力抵抗を用いてもよい。図４（Ａ）は非線形素子である負荷ＴＦＴ（ＬＯＡＤ  ＴＦＴ）の出力抵抗を用いたときを示したものである。ＬＯＡＤ  ＴＦＴのゲート電極には抵抗Ｒ１、Ｒ２で分圧された一定の電位が加えられている。
【００４５】
図４（Ｂ）はこの時のＬＯＡＤ  ＴＦＴのＶDS−Ｉｄｓ特性（ドレインソース間の電圧電流特性）を示し、ＶDSに一定以上の値が加わるとき（飽和領域）、ＶDS−Ｉｄｓの関係は一次比例となりＬＯＡＤ  ＴＦＴが抵抗と見なせることを表している。なお、ここでのＶDSはＬＯＡＤ  ＴＦＴのドレインソース電極間にかかる電圧を表している。この出力抵抗値はＬＯＡＤ  ＴＦＴに印加される電圧、すなわち抵抗Ｒ１，Ｒ２の抵抗比、及びＬＯＡＤ  ＴＦＴのチャネル長で制御を行うものである。またＬＯＡＤ  ＴＦＴのゲート電極に加える一定の電位は抵抗Ｒ１，Ｒ２を使用しないで外部から一定の電位を与える等の他の手段を用いることもできる。
【００４６】
このように、ＬＯＡＤ  ＴＦＴのゲート電極に加える電位を制御することにより出力抵抗値の制御を容易に行うことができ、しかも、大きな抵抗値を小さな面積で作ることができる。
【００４７】
なお、前記実施例では非線形素子として薄膜で製造したＴＦＴを用いた場合の説明をしたが、これに限定されるものではなく、他の製法で製造した非線形素子を用いることもできる。
【図面の簡単な説明】
【００４８】
【図１】本発明の原理説明図である。
【図２】実施例における非線形素子の寄生抵抗を用いる場合の説明図である。
【図３】実施例における薄膜画素素子の寄生抵抗を用いる場合の説明図である。
【図４】実施例における非線形素子の出力抵抗を用いる場合の説明図である。
【図５】従来例の説明図（１）である。
【図６】従来例の説明図（２）である。
【符号の説明】
【００４９】
ＥＬ  薄膜画素素子
Ｍ  非線形素子
Ｃ  キャパシタ
Ｒｓ  負荷素子
Ｔｙ  非線形素子
Ｙｎ  Ｙ座標選択信号
Ｄｉ  画像データ
ＣＯＭ  共通電位（固定電位）
ＶＤ  固定電位
Ｖｓ  ソース電位
Ｖｇ  ゲート電圧
Ｖｇｓ  ソースゲート間電圧
Ｉｄｓ  非線形素子Ｍに流れる電流
【図１】
2005092237.tif 000003
【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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