(57)【要約】【課題】受信アンテナにて受信したテレビ放送信号の中から，希望波に対して送信周波数が所定周波数オフセットされた妨害波信号成分を除去する。【解決手段】複数のチャンネルからなるアナログのテレビ放送信号の中から，希望波に対して送信周波数が所定周波数オフセットされた妨害波を含む所定放送チャンネルのテレビ放送信号を選局して信号処理すると共に，この信号処理によって生成されたテレビ放送信号を出力するように構成された受信装置において，当該受信装置は，少なくとも選局手段と，当該選局手段の出力信号を直交検波することで得られた信号を処理する信号処理手段と，当該信号処理手段にて生成された信号から所定放送チャンネルのアナログのテレビ放送信号を生成するテレビ放送信号生成手段とを具備してなり，テレビ放送信号は前記信号処理手段においてディジタル処理される。【選択図】  図１
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【特許請求の範囲】
【請求項１】
アナログ信号をディジタル信号に変換するＡ／Ｄ変換器と，該生成したディジタル信号を処理するディジタル処理部と，該ディジタル処理部において処理された信号をＤ／Ａ変換してアナログ信号として出力するＤ／Ａ変換器とを具備したディジタル信号処理回路において，
前記ディジタル信号処理部と前記Ｄ／Ａ変換器とを抵抗を介して接続したことを特徴としたディジタル信号処理回路。
【請求項２】
前記ディジタル処理部はＡＳＩＣで構成されたことを特徴とした請求項１に記載のディジタル信号処理回路。
【請求項３】
請求項１又は請求項２に記載のディジタル信号処理回路を具備したことを特徴とした妨害波除去装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は，ディジタル信号処理回路に関し，詳しくは該ディジタル信号処理回路の安定的動作を行うための回路に関する。また，当該ディジタル信号処理回路を用いた妨害波除去装置に関する。
【背景技術】
【０００２】
従来の受信装置に示すように，例えばアナログ信号を直交検波する直交検波部から出力されたＩ信号及びＱ信号のアナログ信号は，Ａ／Ｄ変換器を用いてディジタル信号に変換されてディジタル処理部に入力される。更に該ディジタル処理部において処理された信号はＤ／Ａ変換されてアナログ信号として出力されていた。
（例えば，特許文献１参照）
【０００３】
【特許文献１】特開平７−７９３９０号公報
【発明の開示】
【発明が解決しようとする課題】
【０００４】
しかし，従来のディジタル信号処理回路によると，ディジタル処理部の出力信号が，当該ディジタル処理部とＤ／Ａ変換器とを接続する接続線，即ちプリント配線板に印刷されたパターン線の長さや線幅によって，オーバーシュートやアンダーシュートが生じ，Ｄ／Ａ変換器入力において過電圧となるといった問題が有った。
そこで本願においては，こうした問題点を解決するためになされたものであり，
その目的は，安定的の動作して信頼性に高いディジタル信号処理回路を提供することにある。
他の目的は，安定的に動作して信頼性の高いディジタル信号処理回路を具備した妨害波除去装置を提供することにある。
【課題を解決するための手段】
【０００５】
上記課題を解決するために，請求項１の発明はアナログ信号をディジタル信号に変換するＡ／Ｄ変換器と，該生成したディジタル信号を処理するディジタル処理部と，該ディジタル処理部において処理された信号をＤ／Ａ変換してアナログ信号として出力するＤ／Ａ変換器とを具備したディジタル信号処理回路において，
前記ディジタル信号処理部と前記Ｄ／Ａ変換器とを抵抗を介して接続するように構成される。
【０００６】
請求項２の発明は，前記ディジタル処理部はＡＳＩＣで構成される。
【０００７】
請求項３の発明は，請求項１又は請求項２に記載のディジタル信号処理回路を具備するように妨害波除去装置を構成する。
【発明の効果】
【０００８】
以上詳述したように，請求項１又は請求項２の発明によれば，アナログ信号をディジタル信号に変換するＡ／Ｄ変換器と，該生成したディジタル信号を処理するディジタル処理部と，該ディジタル処理部において処理された信号をＤ／Ａ変換してアナログ信号として出力するＤ／Ａ変換器とを具備したディジタル信号処理回路において，前記ディジタル信号処理部と前記Ｄ／Ａ変換器とを抵抗を介して接続するように構成したので小型で安価で，安定的に動作する信頼性の高いディジタル信号処理回路を提供することができる。
【０００９】
請求項４の発明によれば，前記受信装置は妨害波除去装置である様に構成したので，小型且つ安価で，安定的に動作する信頼性の高いディジタル信号処理回路を具備した妨害波除去装置を提供することができる。
【発明を実施するための最良の形態】
【００１０】
以下に，本発明を具体化した実施形態の例を，図面を基に詳細に説明する。
図１は本願に示すディジタル信号処理回路の出力波形を示す図であり，（ａ）は抵抗の無い場合を示し，（ｂ）は抵抗を具備した時の波形の概略図を示す。図２は本願に係る妨害波除去装置の概略説明図である。
【実施例１】
【００１１】
図１に本願に係る発明のディジタル信号処理回路の概略図を示す。この図において１４，１５はアナログ信号をディジタル信号に変換するＡ／Ｄ変換器である。１はディジタル信号処理部であり，本願の実施例ではＡＳＩＣを用いて構成されている。１８はディジタル信号処理部１の出力を伝送する信号線に介在させた抵抗である。１６は該ディジタル信号処理部において生成されたディジタル信号をアナログ信号に変換するＤ／Ａ変換器である。このように構成されたディジタル信号処理回路において，ディジタル処理部１における接続端子の相互間のピッチは０．２５ｍｍであり，Ｄ／Ａ変換器とを接続する接続線は，実装密度を上げるためにも幅を０．１ｍｍ程度となるように細く，さらにはその線路長は例えばおよそ３０ｍｍ程度の長さとなっている。これによって，ディジタル信号回路の出力パルスは，図の（ａ）に示すようにオーバーシュート，アンダーシュートが生じ，Ｄ／Ａ変換器の入力において過電圧になる場合がある。そこで本願においてはディジタル処理回路とＤ／Ａ変換器とを接続する接続線に抵抗１８を介在させることによって，図１の（ｂ）に示すようにＤ／Ａ変換器に対する過電圧保護をするように構成されている。尚，本願の実施例では抵抗１８は１５０Ωを使用している。
【００１２】
図２に本願に係る妨害波除去装置の概略説明図を示す。
この図において１は集積回路であり，本願の実施例では集積回路の代表例としてＡＳＩＣ（Ａｐｐｌｉｃａｔｉｏｎ  Ｓｐｅｃｉｆｉｃ  Ｉｎｔｅｇｒａｔｅｄ  Ｃｉｒｃｕｉｔ）を使用している。
２はリセット集積回路であり，本願の実施例では電源リセット用の集積回路である。３はスイッチング電源であり，本願の実施例においては入力電圧を少なくとも２つの異なる電源電圧に変換して出力するように構成されているものであり，例えば入力電圧が１５Ｖ，出力電圧はリセット集積回路用に５Ｖ，ＡＳＩＣ用として出力電圧の高い方の電源電圧が３．３Ｖ，低い方の電源電圧が１．８Ｖの時の場合を示している。
この回路において，低い電圧の電源電圧である出力はＡＳＩＣの低い電圧用の電源端子に接続されている。次に高い電圧の電源電圧は，１つはＡＳＩＣの高い電圧用の電源端子に接続されていると共に，リセット集積回路にも端子に接続されている。
【００１３】
次に本願の集積回路１の駆動回路を用いた妨害波除去装置１０について更に説明する。この妨害波除去装置（例えばオフセットビートキャンセラーを代表例として含まれる妨害波除去装置）１０は，受信アンテナ１１から入力端子１０ａを介して入力される受信信号の中から，希望波に対して送信周波数が所定周波数オフセットされた妨害波を含む所定放送チャンネルのテレビ放送信号を選局して，当該テレビ信号の映像中間周波周波数信号及び音声中間周波信号を出力するチューナ１２と，
当該チューナ１２から出力される映像中間周波信号を直交検波部１３において直交検波することによりＩ信号とＱ信号とを生成し，当該生成したI信号とＱ信号をＡ／Ｄ変換器１４，１５において変換したディジタル信号を， ディジタル処理部１においてディジタル処理することにより前記Ｉ信号に含まれる妨害波信号成分を生成し，当該生成した妨害波信号成分を前記Ｉ信号から除去し， 更にＤ／Ａ変換器１６によって変換することにより，前記妨害波信号成分を除去した映像信号を生成し，この映像信号と前記チューナ１２から出力される音声中間周波信号とに基づき，所定放送チャンネルのテレビ放送信号を生成する変調部１８とを備え，当該生成されたテレビ放送信号を受信信号として出力端子１０ｂから出力するように構成されている。
尚，この実施例に示すディジタル処理部はＡＳＩＣで構成されている。
このように，複数の電源電圧によって駆動される集積回路（例えばＡＳＩＣ）において，
供給される低い電圧の電源電圧と高い電圧の電源電圧とが入力されるタイミングに時間差が出来たとしても，ＡＳＩＣ１を強制的にリセットさせることで，ＡＳＩＣの誤動作を防止するＡＳＩＣ１の駆動回路であり，本発明の実施例では，高い電圧の電源電圧のＯＮ後に，所定時間を経てからＡＳＩＣ１のリセット端子にリセット集積回路２からリセット信号を出力（本願の場合，リセット集積回路２からＬｏｗ信号が出力されるように構成されている。）をさせて，ＡＳＩＣ１を強制リセットするように構成したので，少なくとも２つの電源電圧を必用とする集積回路１において電源投入に時間差が生じて集積回路が誤動作しても，僅かな時間の内に集積回路をリセットして動作を安定的に駆動することができるのである。
以上のように本願の実施例によれば，ディジタル信号処理部の主たる構成要素をＡＳＩＣで構成したので小型でコストの安い妨害波除去装置を提供できるのである。
尚，本発明は上記実施の形態に限定されるものではなく，本発明の趣旨を逸脱しない範囲で各部の構成等を適宜に変更して実施することも可能である。
【図面の簡単な説明】
【００１４】
【図１】図１は本願に示すディジタル信号処理回路の出力波形を示す図であり，（ａ）は抵抗の無い場合を示し，（ｂ）は抵抗を具備した時の波形の概略図を示す。
【図２】本願に係る妨害波除去装置の概略説明図である。
【符号の説明】
【００１５】
１…ディジタル信号処理部（ＡＳＩＣ），２…リセット集積回路，３…スイッチング電源，１０…妨害波除去装置，１０ａ…入力端子， １０ｂ…出力端子， １１…受信アンテナ，１２…チューナ，１３…直交検波部，１４…Ａ／Ｄ変換器，１５…Ａ／Ｄ変換器，１６…Ｄ／Ａ変換器，１７…変調部
【図１】
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【図２】
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