(57)【要約】【課題】  簡単な構成により、電源電圧の変動による出力レベルの変動を軽減することが出来るディジタル方式の増幅器の提供。【解決手段】  入力信号をパルス幅変調又はΔ−Σ変調したパルス信号に基づき、定電圧をスイッチングすることにより入力信号を増幅するように構成してある増幅器。定電圧をディジタル変換するアナログ／ディジタル変換器６と、アナログ／ディジタル変換器６がディジタル変換した電圧値及び所定電圧値の差を求める手段５と、その求めた差に応じた電圧を入力信号に付加する付加手段５，７とを備え、入力信号が増幅された電圧値の、前記差により生じる誤差を補正する構成である。【選択図】        図１
2005348361.tif 000002
【特許請求の範囲】
【請求項１】
入力信号をパルス幅変調又はΔ−Σ変調したパルス信号に基づき、定電圧をスイッチングすることにより前記入力信号を増幅するように構成してある増幅器において、
前記定電圧をディジタル変換するアナログ／ディジタル変換器と、該アナログ／ディジタル変換器がディジタル変換した電圧値及び所定電圧値の差を求める手段と、該手段が求めた差に応じた電圧を前記入力信号に付加する付加手段とを備え、前記入力信号が増幅された電圧値の、前記差により生じる誤差を補正するように構成してあることを特徴とする増幅器。
【請求項２】
入力信号をパルス幅変調又はΔ−Σ変調したパルス信号に基づき、極性が異なり絶対値が同じである２つの定電圧をスイッチングすることにより前記入力信号を増幅するように構成してある増幅器において、
前記２つの定電圧をディジタル変換する２つのアナログ／ディジタル変換器と、該２つのアナログ／ディジタル変換器がディジタル変換した電圧値、及び極性が異なり絶対値が同じである２つの所定電圧値の差をそれぞれ求める２つの手段と、該各手段が求めた差に応じた電圧を前記入力信号に付加する付加手段とを備え、前記入力信号が増幅された電圧値の、前記差により生じる誤差を補正するように構成してあることを特徴とする増幅器。
【請求項３】
前記付加手段は、前記差に応じたゲインにより前記入力信号を増幅するゲイン可変増幅器を備える請求項１又は２記載の増幅器。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、入力信号をパルス幅変調又はΔ−Σ変調したパルス信号に基づき、定電圧をスイッチングすることにより入力信号を増幅する、所謂ディジタル増幅器と称される増幅器に関するものである。
【背景技術】
【０００２】
図４は、従来のディジタル増幅器の概略構成例を示すブロック図である。このディジタル増幅器は、アナログの入力信号をΔ−Σ変換器１でΔ−Σ変換する。ディジタルドライバ回路２が、Δ−Σ変換して得られたパルス信号により、遅延を最小限に抑制して、スイッチング回路３を駆動し、電源４の電圧Ｖをスイッチングさせることにより、入力信号を増幅する。増幅された出力信号はカップリングコンデンサＣ１を通じて出力される。また、スイッチングによるノイズを吸収する為に、電源４には、陰極が接地された電解コンデンサＣ２の陽極が接続されている。
【０００３】
Δ−Σ変換（＝Σ−Δ変換）は、アナログ信号を、その値に比例した“１”（Ｈレベル）の時間的密度を有するパルス信号への変換であり、Δ−Σ変換器１に代えて、ＰＷＭ（Pulse Width Modulation）変換器を使用することも可能である。
【非特許文献１】「シャープ技報第７７号」６７〜７２頁、シャープ株式会社、２０００年８月
【発明の開示】
【発明が解決しようとする課題】
【０００４】
上述したような従来のディジタル増幅器では、効率の良さが特長とされ、通常、効率を損ねる虞がある、電源４を安定化させる仕組みは備えずに使用されることが多く、また、備えていても大掛かりなものになる。その為、電源４では、簡単な構成で、リップルによる電圧変動、及び出力電流による電圧の低下等を防止することは難しい。ディジタル増幅器の出力は、電源４の電圧Ｖをスイッチング回路３でスイッチングすることにより得ているが、その出力レベルは、電源４の電圧Ｖに依存しているので、その電圧Ｖの変動は、出力レベルに直接影響し、出力レベルの変動に直結するという問題がある。
【０００５】
電源電圧の変動の影響を受けないようにするには、電源回路を安定化させなければならないので、大型のトランスを用いたり、整流回路に大容量の平滑コンデンサを用いる必要がある。更に、電源電圧を安定化させる為には、整流回路の後段に電源安定化回路を追加する必要があるが、電源安定化回路には、通常、シリーズレギュレータが使われ、効率が良い筈のディジタル増幅器の効率を悪化させるという問題がある。
本発明は、上述したような事情に鑑みてなされたものであり、簡単な構成により、電源電圧の変動による出力レベルの変動を軽減することが出来るディジタル方式の増幅器を提供することを目的とする。
【課題を解決するための手段】
【０００６】
本発明に係る増幅器は、入力信号をパルス幅変調又はΔ−Σ変調したパルス信号に基づき、定電圧をスイッチングすることにより前記入力信号を増幅するように構成してある増幅器において、前記定電圧をディジタル変換するアナログ／ディジタル変換器と、該アナログ／ディジタル変換器がディジタル変換した電圧値及び所定電圧値の差を求める手段と、該手段が求めた差に応じた電圧を前記入力信号に付加する付加手段とを備え、前記入力信号が増幅された電圧値の、前記差により生じる誤差を補正するように構成してあることを特徴とする。
【０００７】
この増幅器では、入力信号をパルス幅変調又はΔ−Σ変調したパルス信号に基づき、定電圧をスイッチングすることにより入力信号を増幅する。アナログ／ディジタル変換器が、定電圧をディジタル変換し、求める手段が、そのディジタル変換した電圧値及び所定電圧値の差を求める。付加手段が、その求めた差に応じた電圧を入力信号に付加し、入力信号が増幅された電圧値の、前記差により生じる誤差を補正する。
定電圧をディジタル変換した電圧値及び所定電圧値の差に応じた電圧は、予め実測により求めて、差に対応させたテーブルとして、付加手段に備えておき、付加手段は、テーブルを参照することにより、差に対応する電圧を導出する。
【０００８】
本発明に係る増幅器は、入力信号をパルス幅変調又はΔ−Σ変調したパルス信号に基づき、極性が異なり絶対値が同じである２つの定電圧をスイッチングすることにより前記入力信号を増幅するように構成してある増幅器において、前記２つの定電圧をディジタル変換する２つのアナログ／ディジタル変換器と、該２つのアナログ／ディジタル変換器がディジタル変換した電圧値、及び極性が異なり絶対値が同じである２つの所定電圧値の差をそれぞれ求める２つの手段と、該各手段が求めた差に応じた電圧を前記入力信号に付加する付加手段とを備え、前記入力信号が増幅された電圧値の、前記差により生じる誤差を補正するように構成してあることを特徴とする。
【０００９】
この増幅器では、入力信号をパルス幅変調又はΔ−Σ変調したパルス信号に基づき、極性が異なり絶対値が同じである２つの定電圧をスイッチングすることにより、入力信号を増幅する。２つのアナログ／ディジタル変換器が、２つの定電圧をディジタル変換し、求める２つの手段が、その２つのディジタル変換した電圧値、及び極性が異なり絶対値が同じである２つの所定電圧値の差をそれぞれ求める。付加手段が、その求めた差に応じた電圧を入力信号に付加し、入力信号が増幅された電圧値の、前記差により生じる誤差を補正する。
定電圧をディジタル変換した２つの電圧値及び２つの所定電圧値の２つの差に応じた電圧は、予め実測により求めて、２つの差に対応させたテーブルとして、付加手段に備えておき、付加手段は、テーブルを参照することにより、２つの差に対応する電圧を導出する。
【００１０】
本発明に係る増幅器は、前記付加手段は、前記差に応じたゲインにより前記入力信号を増幅するゲイン可変増幅器を備えることを特徴とする。
【００１１】
この増幅器では、付加手段は、ゲイン可変増幅器が、定電圧をディジタル変換した電圧値及び所定電圧値の差に応じたゲインにより、入力信号を増幅する。
定電圧をディジタル変換した電圧値及び所定電圧値の差に応じたゲインは、予め実測により求めて、差に対応させたテーブルとして、付加手段に備えておき、付加手段は、テーブルを参照することにより、差に対応するゲインを導出し、導出したゲインをゲイン可変増幅器のゲインとする。
【発明の効果】
【００１２】
本発明に係る増幅器によれば、簡単な構成により、電源電圧の変動による出力レベルの変動を軽減することが出来、電源電圧の変動による出力信号の歪及びノイズを軽減することが出来る増幅器を実現することが出来る。また、電源回路を特に安定化させる必要がない為、電源回路を含む増幅器全体として高効率、小規模回路で高性能な増幅器を構成することが可能である。
【発明を実施するための最良の形態】
【００１３】
以下に、本発明を、その実施の形態を示す図面を参照しながら説明する。
（実施の形態１）
図１は、本発明に係る増幅器の実施の形態１の要部構成を示すブロック図である。このディジタル増幅器は、電源４の電圧ＶがＡ／Ｄ変換器６によりディジタル変換され、ディジタル変換された電圧値は、補正値導出部５に与えられる。補正値導出部５は、与えられた電圧値と、この電圧値が変動していない場合に取るべき電圧値である所定電圧値との差を求め、求めた差に応じた電圧値を、内蔵するテーブル（図示せず）を参照して導出し、導出した電圧値の電圧を付加回路７に与える。
【００１４】
一方、付加回路７には、アナログの入力信号が与えられ、付加回路７は、入力信号に、補正値導出部５から与えられた電圧を付加して出力する。付加回路７から出力された入力信号は、Δ−Σ変換器１でΔ−Σ変換される。ディジタルドライバ回路２は、Δ−Σ変換して得られたパルス信号により、遅延を最小限に抑制して、スイッチング回路３を駆動し、電源４の電圧Ｖをスイッチングさせることにより、入力信号を増幅する。増幅されたスイッチング回路３の出力信号はカップリングコンデンサＣ１を通じて出力される。また、スイッチングによるノイズを吸収する為に、電源４には、陰極が接地された電解コンデンサＣ２の陽極が接続されている。
【００１５】
Δ−Σ変換（＝Σ−Δ変換）は、アナログ信号を、その値に比例した“１”（Ｈレベル）の時間的密度を有するパルス信号への変換であり、Δ−Σ変換器１に代えて、ＰＷＭ（Pulse Width Modulation）変換器を使用することも可能である。
補正値導出部５が内蔵するテーブルは、電圧ＶのＡ／Ｄ変換器６によりディジタル変換された電圧値及び所定電圧値の差による出力信号への影響を、打ち消すことが出来る入力信号への補正電圧値を、予め実測により求めて、上記差に対応させて記録したものである。
【００１６】
以下に、このような構成の増幅器の動作を説明する。
この増幅器では、Ａ／Ｄ変換器６が電源４の電圧Ｖをディジタル変換し、補正値導出部５に与える。補正値導出部５は、与えられた電圧値と所定電圧値との差を求め、求めた差に応じた電圧値を、内蔵するテーブルを参照して導出し、導出した電圧値の電圧を付加回路７に与える。
【００１７】
付加回路７は、補正値導出部５から与えられた電圧を入力信号に付加して出力する。付加回路７が出力した入力信号は、Δ−Σ変換器１でΔ−Σ変換される。ディジタルドライバ回路２は、Δ−Σ変換して得られたパルス信号により、スイッチング回路３を駆動し、電源４の電圧Ｖをスイッチングさせて、入力信号を増幅する。増幅されたスイッチング回路３の出力信号はカップリングコンデンサＣ１を通じて出力される。
【００１８】
（実施の形態２）
図２は、本発明に係る増幅器の実施の形態２の要部構成を示すブロック図である。このディジタル増幅器は、電源４の電圧ＶがＡ／Ｄ変換器６によりディジタル変換され、ディジタル変換された電圧値は、補正値導出部５ａに与えられる。電源８の電圧−ＶがＡ／Ｄ変換器９によりディジタル変換され、ディジタル変換された電圧値は、補正値導出部５ａに与えられる。補正値導出部５ａは、与えられた２つの電圧値と、この２つの電圧値が変動していない場合に取るべき電圧値である２つの所定電圧値との差をそれぞれ求め、求めた２つの差に応じた電圧値を、内蔵するテーブル（図示せず）を参照して導出し、導出した電圧値の電圧を付加回路７に与える。
【００１９】
ディジタルドライバ回路２は、Δ−Σ変換して得られたパルス信号により、スイッチング回路３ａを駆動し、電源４，８の電圧Ｖ，−Ｖをスイッチングさせる（パルス信号が“１”のときは電圧Ｖを、“０”のときは電圧−Ｖをそれぞれスイッチングさせる）ことにより、入力信号を増幅する。増幅されたスイッチング回路３ａの出力信号は、カップリングコンデンサを介さずに直接出力される。また、スイッチングによるノイズを吸収する為に、電源８には、陽極が接地された電解コンデンサＣ３の陰極が接続されている。
【００２０】
補正値導出部５ａが内蔵するテーブルは、電圧ＶのＡ／Ｄ変換器６によりディジタル変換された電圧値及び所定電圧値の差と、電圧−ＶのＡ／Ｄ変換器９によりディジタル変換された電圧値及び所定電圧値の差とによる出力信号への影響を、打ち消すことが出来る入力信号への補正電圧値を、予め実測により求めて、上記２つの差に対応させて記録したものである。その他の構成は、上述した実施の形態１の増幅器の構成と同様であるので、同一箇所には同一符号を付して、説明を省略する。
【００２１】
以下に、このような構成の増幅器の動作を説明する。
この増幅器では、Ａ／Ｄ変換器６が電源４の電圧Ｖをディジタル変換し、Ａ／Ｄ変換器９が電源８の電圧−Ｖをディジタル変換し、それぞれ補正値導出部５ａに与える。補正値導出部５ａは、Ａ／Ｄ変換器６によりディジタル変換された電圧値及び所定電圧値の差と、Ａ／Ｄ変換器９によりディジタル変換された電圧値及び所定電圧値の差とを求め、求めた２つの差に応じた電圧値を、内蔵するテーブルを参照して導出し、導出した電圧値の電圧を付加回路７に与える。
【００２２】
付加回路７は、補正値導出部５ａから与えられた電圧を入力信号に付加して出力する。付加回路７が出力した入力信号は、Δ−Σ変換器１でΔ−Σ変換される。ディジタルドライバ回路２は、Δ−Σ変換して得られたパルス信号により、スイッチング回路３ａを駆動し、電源４，８の電圧Ｖ，−Ｖをスイッチングさせて、入力信号を増幅し出力する。
【００２３】
（実施の形態３）
図３は、本発明に係る増幅器の実施の形態３の要部構成を示すブロック図である。このディジタル増幅器では、電源４の電圧ＶがＡ／Ｄ変換器６によりディジタル変換され、ディジタル変換された電圧値は、補正値導出部５ｂに与えられる。電源８の電圧−ＶがＡ／Ｄ変換器９によりディジタル変換され、ディジタル変換された電圧値は、補正値導出部５ｂに与えられる。補正値導出部５ｂは、与えられた２つの電圧値と、この２つの電圧値が変動していない場合に取るべき電圧値である２つの所定電圧値との差をそれぞれ求め、求めた２つの差に応じた正負の２つのゲインを、内蔵するテーブル（図示せず）を参照して導出し、導出したゲインに変えるようにゲイン可変増幅器１０に指示する。
【００２４】
一方、補正値導出部５ｂ及びゲイン可変増幅器１０には、アナログの入力信号が与えられ、補正値導出部５ｂは、与えられた入力信号の極性を判定し、判定した極性に応じたゲインを選択し、ゲイン可変増幅器１０に指示する。尚、補正値導出部５ｂが、導出した正負２つのゲインをゲイン可変増幅器１０に指示するようにすれば、補正値導出部５ｂが入力信号の極性を判定する必要はない。
【００２５】
ゲイン可変増幅器１０は、入力信号を、補正値導出部５ｂから指示されたゲインにより増幅して出力する。ゲイン可変増幅器１０から出力された入力信号は、Δ−Σ変換器１でΔ−Σ変換される。
補正値導出部５ｂが内蔵するテーブルは、電圧ＶのＡ／Ｄ変換器６によりディジタル変換された電圧値及び所定電圧値の差による出力信号への影響を、打ち消すことが出来る正の入力信号の為の正極性のゲインと、電圧−ＶのＡ／Ｄ変換器９によりディジタル変換された電圧値及び所定電圧値の差による出力信号への影響を、打ち消すことが出来る負の入力信号の為の負極性のゲインとを、予め実測により求めて、上記２つの差にそれぞれ対応させて記録したものである。その他の構成は、上述した実施の形態２の増幅器の構成と同様であるので、同一箇所には同一符号を付して、説明を省略する。
【００２６】
以下に、このような構成の増幅器の動作を説明する。
この増幅器では、Ａ／Ｄ変換器６が電源４の電圧Ｖをディジタル変換し、Ａ／Ｄ変換器９が電源８の電圧−Ｖをディジタル変換し、それぞれ補正値導出部５ｂに与える。補正値導出部５ｂは、Ａ／Ｄ変換器６によりディジタル変換された電圧値及び所定電圧値の差と、Ａ／Ｄ変換器９によりディジタル変換された電圧値及び所定電圧値の差とを求め、求めた２つの差に応じたそれぞれのゲインを、内蔵するテーブルを参照して導出し、導出したゲインに変えるように、ゲイン可変増幅器１０に指示する。
【００２７】
ゲイン可変増幅器１０は、補正値導出部５ｂから指示されたゲインにより、入力信号を増幅して出力する。ゲイン可変増幅器１０が出力した入力信号は、Δ−Σ変換器１でΔ−Σ変換される。ディジタルドライバ回路２は、Δ−Σ変換して得られたパルス信号により、スイッチング回路３ａを駆動し、電源４，８の電圧Ｖ，−Ｖをスイッチングさせて、入力信号を増幅し出力する。
【００２８】
（実施の形態４）
図４は、本発明に係る増幅器の実施の形態４の要部構成を示すブロック図である。このディジタル増幅器は、電源４の電圧ＶがＡ／Ｄ変換器６によりディジタル変換され、ディジタル変換された電圧値は、補正値導出部５ｃに与えられる。補正値導出部５ｃは、与えられた電圧値と、この電圧値が変動していない場合に取るべき電圧値である所定電圧値との差を求め、求めた差に応じた電圧値を、内蔵するテーブル（図示せず）を参照して導出し、導出したディジタル信号の電圧値を付加回路７ａに与える。
【００２９】
一方、付加回路７ａには、Ａ／Ｄ変換器１１でマルチビット信号にディジタル変換された入力信号が与えられ、付加回路７ａは、入力信号に、補正値導出部５ｃから与えられた電圧値を付加して出力する。付加回路７ａから出力された入力信号は、Δ−Σ変換器１ａでΔ−Σ変換される。ディジタルドライバ回路２は、Δ−Σ変換して得られたパルス信号により、遅延を最小限に抑制して、スイッチング回路３を駆動し、電源４の電圧Ｖをスイッチングさせることにより、入力信号を増幅する。増幅されたスイッチング回路３の出力信号はカップリングコンデンサＣ１を通じて出力される。また、スイッチングによるノイズを吸収する為に、電源４には、陰極が接地された電解コンデンサＣ２の陽極が接続されている。
【００３０】
Δ−Σ変換器１ａは、マルチビット信号を、その値に比例した“１”（Ｈレベル）の時間的密度を有するパルス信号へ変換する変換器であり、Δ−Σ変換器１ａに代えて、ＰＷＭ（Pulse Width Modulation）変換器を使用することも可能である。
補正値導出部５ｃが内蔵するテーブルは、電圧ＶのＡ／Ｄ変換器６によりディジタル変換された電圧値及び所定電圧値の差による出力信号への影響を、打ち消すことが出来る入力信号への補正電圧値を、予め実測により求めて、上記差に対応させて記録したものである。
【００３１】
以下に、このような構成の増幅器の動作を説明する。
この増幅器では、Ａ／Ｄ変換器６が電源４の電圧Ｖをディジタル変換し、補正値導出部５ｃに与える。補正値導出部５ｃは、与えられた電圧値と所定電圧値との差を求め、求めた差に応じた電圧値を、内蔵するテーブルを参照して導出し、導出したディジタル信号の電圧値を付加回路７ａに与える。
【００３２】
付加回路７ａは、補正値導出部５ｃから与えられた電圧値を、Ａ／Ｄ変換器１１でマルチビット信号にディジタル変換された入力信号に付加して出力する。付加回路７ａが出力した入力信号は、Δ−Σ変換器１ａでΔ−Σ変換される。ディジタルドライバ回路２は、Δ−Σ変換して得られたパルス信号により、スイッチング回路３を駆動し、電源４の電圧Ｖをスイッチングさせて、入力信号を増幅する。増幅されたスイッチング回路３の出力信号はカップリングコンデンサＣ１を通じて出力される。
【００３３】
（実施の形態５）
図５は、本発明に係る増幅器の実施の形態５の要部構成を示すブロック図である。このディジタル増幅器は、電源４の電圧ＶがＡ／Ｄ変換器６によりディジタル変換され、ディジタル変換された電圧値は、補正値導出部５ｄに与えられる。電源８の電圧−ＶがＡ／Ｄ変換器９によりディジタル変換され、ディジタル変換された電圧値は、補正値導出部５ｄに与えられる。補正値導出部５ｄは、与えられた２つの電圧値と、この２つの電圧値が変動していない場合に取るべき電圧値である２つの所定電圧値との差をそれぞれ求め、求めた２つの差に応じた電圧値を、内蔵するテーブル（図示せず）を参照して導出し、導出したディジタル信号の電圧値を付加回路７ａに与える。
【００３４】
ディジタルドライバ回路２は、Δ−Σ変換して得られたパルス信号により、スイッチング回路３ａを駆動し、電源４，８の電圧Ｖ，−Ｖをスイッチングさせる（パルス信号が“１”のときは電圧Ｖを、“０”のときは電圧−Ｖをそれぞれスイッチングさせる）ことにより、入力信号を増幅する。増幅されたスイッチング回路３ａの出力信号は、カップリングコンデンサを介さずに直接出力される。また、スイッチングによるノイズを吸収する為に、電源８には、陽極が接地された電解コンデンサＣ３の陰極が接続されている。
【００３５】
補正値導出部５ｄが内蔵するテーブルは、電圧ＶのＡ／Ｄ変換器６によりディジタル変換された電圧値及び所定電圧値の差と、電圧−ＶのＡ／Ｄ変換器９によりディジタル変換された電圧値及び所定電圧値の差とによる出力信号への影響を、打ち消すことが出来る入力信号への補正電圧値を、予め実測により求めて、上記２つの差に対応させて記録したものである。その他の構成は、上述した実施の形態４の増幅器の構成と同様であるので、同一箇所には同一符号を付して、説明を省略する。
【００３６】
以下に、このような構成の増幅器の動作を説明する。
この増幅器では、Ａ／Ｄ変換器６が電源４の電圧Ｖをディジタル変換し、Ａ／Ｄ変換器９が電源８の電圧−Ｖをディジタル変換し、それぞれ補正値導出部５ｄに与える。補正値導出部５ｄは、Ａ／Ｄ変換器６によりディジタル変換された電圧値及び所定電圧値の差と、Ａ／Ｄ変換器９によりディジタル変換された電圧値及び所定電圧値の差とを求め、求めた２つの差に応じた電圧値を、内蔵するテーブルを参照して導出し、導出したディジタル信号の電圧値を付加回路７ａに与える。
【００３７】
付加回路７ａは、補正値導出部５ｄから与えられた電圧値を、Ａ／Ｄ変換器１１でマルチビット信号に変換された入力信号に付加して出力する。付加回路７ａが出力した入力信号は、Δ−Σ変換器１ａでΔ−Σ変換される。ディジタルドライバ回路２は、Δ−Σ変換して得られたパルス信号により、スイッチング回路３ａを駆動し、電源４，８の電圧Ｖ，−Ｖをスイッチングさせて、入力信号を増幅し出力する。
【００３８】
（実施の形態６）
図６は、本発明に係る増幅器の実施の形態６の要部構成を示すブロック図である。このディジタル増幅器では、電源４の電圧ＶがＡ／Ｄ変換器６によりディジタル変換され、ディジタル変換された電圧値は、補正値導出部５ｅに与えられる。電源８の電圧−ＶがＡ／Ｄ変換器９によりディジタル変換され、ディジタル変換された電圧値は、補正値導出部５ｅに与えられる。補正値導出部５ｅは、与えられた２つの電圧値と、この２つの電圧値が変動していない場合に取るべき電圧値である２つの所定電圧値との差をそれぞれ求め、求めた２つの差に応じた正負の２つのゲインを、内蔵するテーブル（図示せず）を参照して導出し、導出したゲインに変えるようにディジタル式のゲイン可変増幅器１０ａに指示する。
【００３９】
一方、補正値導出部５ｅ及びゲイン可変増幅器１０ａには、Ａ／Ｄ変換器１１でマルチビット信号に変換された入力信号が与えられ、補正値導出部５ｅは、与えられた入力信号の極性を判定し、判定した極性に応じたゲインを選択し、ゲイン可変増幅器１０ａに指示する。尚、補正値導出部５ｅが、導出した正負２つのゲインをゲイン可変増幅器１０ａに指示するようにすれば、補正値導出部５ｅが入力信号の極性を判定する必要はない。
【００４０】
ゲイン可変増幅器１０ａは、マルチビット信号である入力信号を、補正値導出部５ｅから指示されたゲインにより増幅して出力する。ゲイン可変増幅器１０ａから出力された入力信号は、Δ−Σ変換器１ａでΔ−Σ変換される。
補正値導出部５ｅが内蔵するテーブルは、電圧ＶのＡ／Ｄ変換器６によりディジタル変換された電圧値及び所定電圧値の差による出力信号への影響を、打ち消すことが出来る正の入力信号の為の正極性のゲインと、電圧−ＶのＡ／Ｄ変換器９によりディジタル変換された電圧値及び所定電圧値の差による出力信号への影響を、打ち消すことが出来る負の入力信号の為の負極性のゲインとを、予め実測により求めて、上記２つの差にそれぞれ対応させて記録したものである。その他の構成は、上述した実施の形態５の増幅器の構成と同様であるので、同一箇所には同一符号を付して、説明を省略する。
【００４１】
以下に、このような構成の増幅器の動作を説明する。
この増幅器では、Ａ／Ｄ変換器６が電源４の電圧Ｖをディジタル変換し、Ａ／Ｄ変換器９が電源８の電圧−Ｖをディジタル変換し、それぞれ補正値導出部５ｅに与える。補正値導出部５ｅは、Ａ／Ｄ変換器６によりディジタル変換された電圧値及び所定電圧値の差と、Ａ／Ｄ変換器９によりディジタル変換された電圧値及び所定電圧値の差とを求め、求めた２つの差に応じたそれぞれのゲインを、内蔵するテーブルを参照して導出し、導出したゲインに変えるように、ゲイン可変増幅器１０ａに指示する。
【００４２】
ゲイン可変増幅器１０ａは、補正値導出部５ｅから指示されたゲインにより、マルチビット信号である入力信号を増幅して出力する。ゲイン可変増幅器１０ａが出力した入力信号は、Δ−Σ変換器１ａでΔ−Σ変換される。ディジタルドライバ回路２は、Δ−Σ変換して得られたパルス信号により、スイッチング回路３ａを駆動し、電源４，８の電圧Ｖ，−Ｖをスイッチングさせて、入力信号を増幅し出力する。
【図面の簡単な説明】
【００４３】
【図１】本発明に係る増幅器の実施の形態の要部構成を示すブロック図である。
【図２】本発明に係る増幅器の実施の形態の要部構成を示すブロック図である。
【図３】本発明に係る増幅器の実施の形態の要部構成を示すブロック図である。
【図４】本発明に係る増幅器の実施の形態の要部構成を示すブロック図である。
【図５】本発明に係る増幅器の実施の形態の要部構成を示すブロック図である。
【図６】本発明に係る増幅器の実施の形態の要部構成を示すブロック図である。
【図７】従来のディジタル増幅器の概略構成例を示すブロック図である。
【符号の説明】
【００４４】
１，１ａ  Δ−Σ変換器
２  ディジタルドライバ回路
３，３ａ  スイッチング回路
４，８  電源
５，５ａ，５ｂ，５ｃ，５ｄ，５ｅ  補正値導出部（差を求める手段、付加手段）
６，９，１１  Ａ／Ｄ変換器
７，７ａ  付加回路（付加手段）
１０，１０ａ  ゲイン可変増幅器
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【手続補正書】
【提出日】平成16年8月2日(2004.8.2)
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】０００２
【補正方法】変更
【補正の内容】
【０００２】
図７は、従来のディジタル増幅器の概略構成例を示すブロック図である。このディジタル増幅器は、アナログの入力信号をΔ−Σ変換器１でΔ−Σ変換する。ディジタルドライバ回路２が、Δ−Σ変換して得られたパルス信号により、遅延を最小限に抑制して、スイッチング回路３を駆動し、電源４の電圧Ｖをスイッチングさせることにより、入力信号を増幅する。増幅された出力信号はカップリングコンデンサＣ１を通じて出力される。また、スイッチングによるノイズを吸収する為に、電源４には、陰極が接地された電解コンデンサＣ２の陽極が接続されている。