(57)【要約】【課題】    より小さな回路構成によってＩＦカウンタを実現するＩＦカウント方式を提供する。【解決手段】  ＩＦカウンタを、分周されたＩＦ信号をカウントするダウンカウント方式ＩＦカウント部１と、ＩＦ信号をカウントする期間を生成するＩＦカウント期間生成部２と、カウント開始の初期値を与えるＩＦカウント上限値プリセット部３と、カウント値の下位ｍビットについての情報とＩＦカウント上下限値差プリセット部に設定された情報とを比較する下位ｍビット比較部５と、カウント値の上位ｎ＋１−ｍビットについての情報と下位ｍビット比較器５の比較結果についての情報とからカウント値が所定の範囲内にあるかを判定する判定部６とによって構成する。【選択図】      図１
2005210610.tif 000002
【特許請求の範囲】
【請求項１】
所定の期間についてＩＦ信号をカウントするＩＦカウンタのカウント方式であって、
カウント開始の初期値として所望のカウント値の上限を与える上限値プリセット処理と、
前記ＩＦ信号をカウントする期間を生成するＩＦカウント期間生成処理と
該ＩＦカウント期間生成処理によって生成された期間内に前記上限値プリセット部で設定された初期値から前記ＩＦ信号に応じてダウンカウントを行なうダウンカウント方式ＩＦカウント処理と、
所望のカウント値の上限値と下限値との差の情報を与えるＩＦカウント上下限値差プリセット処理と、
該ＩＦカウント上下限値差プリセット処理に与えられたＩＦカウント上下限値差の情報と前記ダウンカウント方式ＩＦカウント処理によるカウント情報に基づく第一の情報とを比較する比較処理と、
前記ダウンカウント方式ＩＦカウント処理によるカウント情報に基づく第二の情報と前記比較処理による比較結果の情報とからカウント値が前記所望の上限値及び下限値の範囲内にあるかを判定する判定処理とを有することを特徴とするＩＦカウント方式。
【請求項２】
ｎ＞ｍの関係を有する１以上の整数ｍ、ｎにおいて、前記第一の情報は前記ダウンカウント方式ＩＦカウント処理によるｎ＋１ビットで構成されるカウント情報の下位ｍビットの情報であり、前記第二の情報は前記カウント情報の上位ｎ＋１−ｍビットであることを特徴とする請求項１に記載のＩＦカウント方式。
【請求項３】
前記ＩＦ信号は、分周比１／２、１／４、１／８、１／１６、１／３２のいずれか１つを選択的に使用して分周されたＩＦ信号であることを特徴とする請求項１に記載のＩＦカウント方式。
【請求項４】
所定の期間についてＩＦ信号をカウントするＩＦカウンタであって、
カウント開始の初期値として所望のカウント値の上限を与える上限値プリセット処理と、
前記ＩＦ信号をカウントする期間を生成するＩＦカウント期間生成処理と
該ＩＦカウント期間生成処理によって生成された期間内に前記上限値プリセット処理で設定された初期値から前記ＩＦ信号に応じてダウンカウントを行なうダウンカウント方式ＩＦカウント処理と、
前記ダウンカウント方式ＩＦカウント処理によるカウント情報に基づく第一の情報と第二の情報とからカウント値が前記所望の上限値及び下限値の範囲内にあるかを判定する判定部とを有することを特徴とするＩＦカウント方式。
【請求項５】
所定の期間についてＩＦ信号をカウントするＩＦカウンタであって、
カウント開始の初期値として所望のカウント値の上限を与える上限値プリセット部と、
前記ＩＦ信号をカウントする期間を生成するＩＦカウント期間生成部と
該ＩＦカウント期間生成部によって生成された期間内に前記上限値プリセット部で設定された初期値から前記ＩＦ信号に応じてダウンカウントを行なうダウンカウント方式ＩＦカウント部と、
所望のカウント値の上限値と下限値との差の情報を与えるＩＦカウント上下限値差プリセット部と、
該ＩＦカウント上下限値差プリセット部に設定された情報と前記ダウンカウント方式ＩＦカウント部におけるカウント情報に基づく第一の情報とを比較する比較部と、
前記ダウンカウント方式ＩＦカウント部におけるカウント情報に基づく第二の情報と前記比較部の比較結果の情報とからカウント値が前記所望の上限値及び下限値の範囲内にあるかを判定する判定部とを有することを特徴とするＩＦカウンタ。
【請求項６】
所定の期間についてＩＦ信号をカウントするＩＦカウンタであって、
カウント開始の初期値として所望のカウント値の上限を与える上限値プリセット部と、
前記ＩＦ信号をカウントする期間を生成するＩＦカウント期間生成部と
該ＩＦカウント期間生成部によって生成された期間内に前記上限値プリセット部で設定された初期値から前記ＩＦ信号に応じてダウンカウントを行なうダウンカウント方式ＩＦカウント部と、
前記ダウンカウント方式ＩＦカウント部におけるカウント情報に基づく第一の情報と第二の情報とからカウント値が前記所望の上限値及び下限値の範囲内にあるかを判定する判定部とを有することを特徴とするＩＦカウンタ。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、ラジオの受信機に使用されるＩＦカウンタにおけるＩＦカウント方式に関する。
【背景技術】
【０００２】
ラジオの受信機において、従来からＩＦ（Ｉｎｔｅｒｍｅｄｉａｔｅ  Ｆｒｅｑｕｅｎｃｙ）をカウントするために使用されているＩＦカウンタは、例えば図５に示すように、ｎビットで構成されるＩＦカウント部１５と、ＩＦカウント部１５に対してＩＦカウント期間を生成するＩＦカウント期間生成部１６と、ｎビットで構成されるＩＦカウント上限値を設定するためのＩＦカウント上限値プリセット部１７と、ｎビットで構成されるＩＦカウント下限値を設定するためのＩＦカウント下限値プリセット部１８と、ＩＦカウント部１５によってカウントされたカウント値とＩＦカウント上限値プリセット部１７の設定値とを比較するためにｎビットで構成される上限値比較部１９と、ＩＦカウント部１５によってカウントされたカウント値とＩＦカウント下限値プリセット部１８の設定値とを比較するための下限値比較部２０と、上限値比較部１９による比較結果と下限値比較部２０による比較結果とからＩＦカウント部１５によるカウント値が所定の範囲内にあるかを判断する判定部２１とによって構成される。
【０００３】
ＩＦカウント部１５は、リミッタ回路等を通されたＩＦ信号が入力されると、ＩＦカウント期間生成部１６で生成された所定の期間内に入力されるＩＦ信号をカウントする。
ＩＦカウント部１５によってカウントされたカウント値は、上限値比較部１９及び下限値比較部２０に入力される。上限値比較部１９は、入力されたカウント値とＩＦカウント上限値プリセット部１７に予め設定されているＩＦカウント上限値とを比較し、例えば「カウント値＞ＩＦカウント上限値」の場合に比較結果０を出力し、「カウント値≦ＩＦカウント下限値」の場合に比較結果１を出力する。
【０００４】
同様に、下限値比較部２０は、入力されたカウント値とＩＦカウント下限値プリセット部１８に予め設定されているＩＦカウント下限値とを比較し、例えば「カウント値＜ＩＦカウント下限値」の場合に比較結果０を出力し、「カウント値≧ＩＦカウント下限値」の場合に比較結果１を出力する。
【０００５】
上限値比較部１９及び下限値比較部２０による比較結果は、判定部２１に入力されカウント値がＩＦカウント上限値からＩＦカウント下限値の範囲内であるかを判定する。例えば、上限値比較部１９の比較結果と下限値比較部２０の比較結果の論理積を判定部２１で行なうことによって、判定部２１の出力が１の場合にカウント値がＩＦカウント値上限値からＩＦカウント下限値の範囲内にあることが検出される。
【０００６】
特許文献１は、自動的にＦＭ・ＲＤＳ隣接局の放送局名を最初に自動検知した放送局との比較を行い、その放送局名に基づき自動変更することが可能なＦＭラジオ受信機について開示したものであり、所望の周波数についてオートスキャンする場合の周波数の比較手段について開示されている。
【０００７】
特許文献２は、ＩＦパルス数のカウントと並行して復調回路によって復調されたデータの１／０の割合をカウントすることによって、一定時間内でのＩＦパルス数の誤差量を測定するＩＦカウント方式について開示されている。この方法では、測定した誤差量を用いて補正回路によりＩＦカウント数を修正してＩＦ周波数を測定する周波数カウント回路とし、変調によるカウント誤差の影響を受けないで正確なＩＦ周波数値を得ることが可能なる。
【特許文献１】特開平１０−３４１１３８号公報
【特許文献２】特開平１１−２３４３５３号公報
【発明の開示】
【発明が解決しようとする課題】
【０００８】
以上に説明したように、例えば図５に示した従来の回路では回路構成が大規模となってしまうという問題がある。特に、ラジオ受信機を１チップで実現するためには、従来以上の回路のスリム化が要求される。
本発明は、上述した問題に鑑みてなされたものであり、その解決しようとする課題は、従来より小さな回路構成によってＩＦカウンタを実現するＩＦカウント方式を提供することである。
【課題を解決するための手段】
【０００９】
請求項１記載の発明は、所定の期間についてＩＦ信号をカウントするＩＦカウンタのカウント方式であって、カウント開始の初期値として所望のカウント値の上限を与える上限値プリセット処理と、前記ＩＦ信号をカウントする期間を生成するＩＦカウント期間生成処理と、該ＩＦカウント期間生成処理によって生成された期間内に前記上限値プリセット部で設定された初期値から前記ＩＦ信号に応じてダウンカウントを行なうダウンカウント方式ＩＦカウント処理と、所望のカウント値の上限値と下限値との差の情報を与えるＩＦカウント上下限値差プリセット処理と、該ＩＦカウント上下限値差プリセット処理に与えられたＩＦカウント上下限値差の情報と前記ダウンカウント方式ＩＦカウント処理によるカウント情報に基づく第一の情報とを比較する比較処理と、前記ダウンカウント方式ＩＦカウント処理によるカウント情報に基づく第二の情報と前記比較処理による比較結果の情報とからカウント値が前記所望の上限値及び下限値の範囲内にあるかを判定する判定処理とを有することを特徴とするＩＦカウント方式である。
【００１０】
請求項１記載の発明によると、前記ダウンカウント方式ＩＦカウント処理によって前記上限値プリセット処理で設定された値から前記ＩＦ信号に応じてデクリメント処理を行なうことで、前記ＩＦ信号が前記上限値より大きい場合には０までカウントされてなおデクリメント処理が行なわれるため最上位ビットが１となり判定処理によって前記ＩＦ信号は前記所望の上限値より大きいと判定され、前記比較処理による比較結果が前記ＩＦカウント上下限値差プリセット処理で設定された値が前記第一の情報に基づく値以上で、かつ前記第二の情報を構成するビットが全て０である場合には、前記判定処理によって前記ＩＦ信号は前記所望の上限値及び下限値の範囲内にあると判定され、さらに、前記第二の情報を構成するビットが全て０でない場合には、前記判定処理によって前記ＩＦ信号は前記所望の下限値より小さいと判定される作用によって、前記上限値プリセット処理及び前記ＩＦカウント上下限値差プリセット処理を予め設定することでＩＦ信号が所定の範囲にあるかを判定することが可能となり、前記上下限値差プリセット処理で設定される前記所望の下限値を構成するビット数や比較処理において比較する情報を構成するビット数を小さくすることが可能となり、回路構成を小さくする効果を奏する。
【００１１】
請求項２記載の発明は、ｎ＞ｍの関係を有する１以上の整数ｍ、ｎにおいて、前記第一の情報は前記ダウンカウント方式ＩＦカウント処理によるｎ＋１ビットで構成されるカウント情報の下位ｍビットの情報であり、前記第二の情報は前記カウント情報の上位ｎ＋１−ｍビットであることを特徴とする請求項１に記載のＩＦカウント方式である。
【００１２】
請求項２に記載の発明によると、請求項１と同様の効果を奏し、前記ダウンカウント方式ＩＦカウント処理によってカウントされた前記ＩＦ信号のカウント値の上位ｎ＋１−ｍビットの情報の最上位ビットが１の場合には、ＩＦ信号が所望の上限値より大きいと判断し、ダウンカウント方式ＩＦカウント処理でカウントされたＩＦ信号のカウント値の上位ｎ＋１−ｍビットの情報の上位ｎ＋１−ｍビットが全て０、かつダウンカウント方式ＩＦカウント処理によってカウントされたＩＦ信号のカウント値の下位ｍビットの値がＩＦカウント上下限値差プリセット処理で設定された値以下の場合には、所望の上限値及び下限値の範囲内であると判断し、ダウンカウント方式ＩＦカウント処理によってカウントされたＩＦ信号のカウント値の上位ｎ＋１−ｍビットの情報の上位ｎ＋１−ｍビットが全て０でない場合には、所望の下限値より小さいと判断することが可能となる効果を奏する。
【００１３】
請求項３記載の発明は、前記ＩＦ信号は、分周比１／２、１／４、１／８、１／１６、１／３２のいずれか１つを選択的に使用して分周されたＩＦ信号であることを特徴とする請求項１に記載のＩＦカウント方式である。
請求項３に記載の発明によると、請求項１と同様の効果に加えて、前記ＩＦ信号の周波数が高い場合であっても分周比を変更することによってより高周波のＩＦ信号をカウントすることが可能となる効果を奏する。
【００１４】
請求項４記載の発明は、所定の期間についてＩＦ信号をカウントするＩＦカウンタであって、カウント開始の初期値として所望のカウント値の上限を与える上限値プリセット処理と、前記ＩＦ信号をカウントする期間を生成するＩＦカウント期間生成処理と、該ＩＦカウント期間生成処理によって生成された期間内に前記上限値プリセット処理で設定された初期値から前記ＩＦ信号に応じてダウンカウントを行なうダウンカウント方式ＩＦカウント処理と、前記ダウンカウント方式ＩＦカウント処理によるカウント情報に基づく第一の情報と第二の情報とからカウント値が前記所望の上限値及び下限値の範囲内にあるかを判定する判定部とを有することを特徴とするＩＦカウント方式である。
【００１５】
請求項４記載の発明によると、前記ダウンカウント方式ＩＦカウント処理によって前記上限値プリセット処理で設定された値から前記ＩＦ信号に応じてデクリメント処理を行なうことで、前記ＩＦ信号が前記上限値より大きい場合には０までカウントされてなおデクリメント処理が行なわれるため前記第一の情報を構成する最上位ビットが１となり判定処理によって前記ＩＦ信号は前記所望の上限値より大きいと判定され、前記第二の情報を構成するビットが全て０である場合には、前記判定処理によって前記ＩＦ信号は前記所望の上限値及び下限値の範囲内にあると判定され、さらに、前記第二の情報を構成するビットが全て０でない場合には、前記判定処理によって前記ＩＦ信号は前記所望の下限値より小さいと判定される作用によって、前記上限値プリセット処理で設定する上限値を予め設定することでＩＦ信号が所定の範囲にあるかを判定することが可能となり、下限値についてのプリセット処理を要しないため回路構成を小さくする効果を奏する。
【００１６】
請求項５記載の発明は、所定の期間についてＩＦ信号をカウントするＩＦカウンタであって、カウント開始の初期値として所望のカウント値の上限を与える上限値プリセット部と、前記ＩＦ信号をカウントする期間を生成するＩＦカウント期間生成部と、該ＩＦカウント期間生成部によって生成された期間内に前記上限値プリセット部で設定された初期値から前記ＩＦ信号に応じてダウンカウントを行なうダウンカウント方式ＩＦカウント部と、所望のカウント値の上限値と下限値との差の情報を与えるＩＦカウント上下限値差プリセット部と、該ＩＦカウント上下限値差プリセット部に設定された情報と前記ダウンカウント方式ＩＦカウント部におけるカウント情報に基づく第一の情報とを比較する比較部と、前記ダウンカウント方式ＩＦカウント部におけるカウント情報に基づく第二の情報と前記比較部の比較結果の情報とからカウント値が前記所望の上限値及び下限値の範囲内にあるかを判定する判定部とを有することを特徴とするＩＦカウンタである。
【００１７】
請求項５記載の発明によると、前記ダウンカウント方式ＩＦカウント部によって前記上限値プリセット部で設定された値から前記ＩＦ信号に応じてデクリメント処理を行なうことで、前記ＩＦ信号が前記上限値より大きい場合には０までカウントされてなおデクリメント処理が行なわれるため最上位ビットが１となり判定部によって前記ＩＦ信号は前記所望の上限値より大きいと判定され、前記比較部での比較結果が前記ＩＦカウント上下限値差プリセット部に設定された値が前記第一の情報に基づく値以上で、かつ前記第二の情報を構成するビットが全て０である場合には、前記判定部によって前記ＩＦ信号は前記所望の上限値及び下限値の範囲内にあると判定され、さらに、前記第二の情報を構成するビットが全て０でない場合には、前記判定部によって前記ＩＦ信号は前記所望の下限値より小さいと判定される作用によって、請求項１と同様の効果を奏し、前記上限値プリセット部及び前記ＩＦカウント上下限値差プリセット部に予め上限値を設定することによってＩＦ信号が所定の範囲にあるかを判定することが可能となり、前記上下限値差プリセット部を構成するビット数や比較部を構成するビット数を小さくすることが可能となり、回路構成を小さくする効果を奏する。
【００１８】
請求項６記載の発明は、所定の期間についてＩＦ信号をカウントするＩＦカウンタであって、カウント開始の初期値として所望のカウント値の上限を与える上限値プリセット部と、前記ＩＦ信号をカウントする期間を生成するＩＦカウント期間生成部と、該ＩＦカウント期間生成部によって生成された期間内に前記上限値プリセット部で設定された初期値から前記ＩＦ信号に応じてダウンカウントを行なうダウンカウント方式ＩＦカウント部と、前記ダウンカウント方式ＩＦカウント部におけるカウント情報に基づく第一の情報と第二の情報とからカウント値が前記所望の上限値及び下限値の範囲内にあるかを判定する判定部とを有することを特徴とするＩＦカウンタである。
【００１９】
請求項６記載の発明によると、前記ダウンカウント方式ＩＦカウント部によって前記上限値プリセット部に設定された値から前記ＩＦ信号に応じてデクリメント処理を行なうことで、前記ＩＦ信号が前記上限値より大きい場合には０までカウントされてなおデクリメント処理が行なわれるため前記第一の情報を構成する最上位ビットが１となり判定部によって前記ＩＦ信号が前記所望の上限値より大きいと判定され、前記第二の情報を構成するビットが全て０である場合には、前記判定部によって前記ＩＦ信号は前記所望の上限値及び下限値の範囲内にあると判定され、さらに、前記第二の情報を構成するビットが全て０でない場合には、前記判定部によって前記ＩＦ信号は前記所望の下限値より小さいと判定される作用によって、請求項４と同様の効果を奏し、前記上限値プリセット部で設定する上限値を予め設定することでＩＦ信号が所定の範囲にあるかを判定することが可能となり、下限値についてのプリセット処理を要しないため回路構成を小さくする効果を奏する。
【発明の効果】
【００２０】
以上のように、本発明のいずれの態様によっても、従来より小さな回路構成によってＩＦカウンタを実現するＩＦカウント方式を提供することが可能となる。
【発明を実施するための最良の形態】
【００２１】
以下、本発明の実施形態について図１から図４に基づいて説明する。
図１は、本発明の第一の実施形態の機能ブロック図である。
本実施形態に係るＩＦカウンタは、分周されたＩＦ信号をカウントするダウンカウント方式ＩＦカウント部１と、ダウンカウント方式ＩＦカウント部１でＩＦ信号をカウントする期間を生成するＩＦカウント期間生成部２と、ダウンカウント方式ＩＦカウント部１にカウントを開始する初期値を与えるＩＦカウント上限値プリセット部３と、ダウンカウント方式ＩＦカウント部１でカウントされたカウント値の下位ｍビットについての情報とＩＦカウント上下限値差プリセット部に予め設定された情報とを比較する下位ｍビット比較部５と、ダウンカウント方式ＩＦカウント部１でカウントされたカウント値の上位ｎ＋１−ｍビットについての情報と下位ｍビット比較器５の比較結果についての情報とからカウント値が所定の範囲内にあるかを判定する判定部６とを有する。また、本実施形態に係るＩＦカウンタは、ｐチャンネルとｎチャンネルＭＯＳトランジスタを製造できるＣＭＯＳプロセスにより半導体回路基盤上に成形される。
【００２２】
ダウンカウント方式ＩＦカウント部１はｎ＋１ビットで構成されるデータのカウント機能を有する。ＩＦカウント上限値プリセット部３に予め設定されたｎビットで構成されるデータを初期値として、ＩＦカウント期間生成部２によって生成される所定の期間内について、例えば１ずつデクリメント処理を行なってＩＦ信号をカウントする。
【００２３】
ＩＦカウント期間生成部２は、ダウンカウント方式ＩＦカウント部１がＩＦ信号をカウントする期間を生成する。すなわち、ダウンカウント方式ＩＦカウント部１へ入力されるクロック信号を監視し、前記生成された所定の期間を経過するとダウンカウント方式ＩＦカウント部１に対してリセット信号を送る。
【００２４】
ＩＦカウント上限値プリセット部３には、ｎビットで構成されるＩＦカウント値の上限値が予め設定され、ダウンカウント方式ＩＦカウント部１に対してカウント開始時の初期値を与える。
ＩＦカウント上下限値差プリセット部４には、ｍビットで構成されるＩＦカウント値の上限値と下限値との差の値が予め設定され、ダウンカウント方式ＩＦカウント部１でカウントされたｎ＋１ビットで構成されるカウント値の下位ｍビットのデータと比較するために使用される。
【００２５】
下位ｍビット比較部５は、ダウンカウント方式ＩＦカウント部１でカウントされたＩＦ信号のカウント値の下位ｍビットの情報とＩＦカウント上限値プリセット部４に設定されたＩＦカウント値の上下限値差の情報とを入力として比較し比較結果を判定部６へ出力する。
【００２６】
判定部６は、ダウンカウント方式ＩＦカウント部１でカウントされたＩＦ信号のカウント値の上位ｎ＋１−ｍビットの情報と下位ｍビット比較部５の比較結果の情報とからＩＦ信号のカウント値がＩＦカウント上限値プリセット部３で設定された上限値とＩＦカウント上限値プリセット部３及びＩＦカウント上下限値差プリセット部４で設定された値に基づく下限値との範囲にあるかを判定し結果を出力する。すなわち、ダウンカウント方式ＩＦカウント部１でカウントされたＩＦ信号のカウント値の上位ｎ＋１−ｍビットの情報の最上位ビットが１の場合には、ＩＦ信号が所望の上限値より大きいと判断し、ダウンカウント方式ＩＦカウント部１でカウントされたＩＦ信号のカウント値の上位ｎ＋１−ｍビットの情報の上位ｎ＋１−ｍビットが全て０、かつダウンカウント方式ＩＦカウント部１でカウントされたＩＦ信号のカウント値の下位ｍビットの値がＩＦカウント上下限値差プリセット部４に設定された値以下の場合には、所望の上限値及び下限値の範囲内であると判断し、ダウンカウント方式ＩＦカウント部１でカウントされたＩＦ信号のカウント値の上位ｎ＋１−ｍビットの情報の上位ｎ＋１−ｍビットが全て０でない場合には、所望の下限値より小さいと判断する。  以上の構成にすることによって、例えば、従来の回路構成ではｎビットで構成される比較部（図５の上限値比較部１９や下限値比較部２０）やＩＦカウント下限値プリセット部２０が必要とされたが、本発明の実施例ではｎ＞ｍの関係にあるｍビットで構成される下位ｍビット比較部５やＩＦカウント上下限値差プリセット部４を用いることによって各構成要素が少ないビット数で構成されるため全体として回路規模を小さくすることが可能となる。
【００２７】
したがって、図５に示すｎビットで構成されるＩＦカウント下限値プリセット部１８や下限値比較部２０等を用いることなく所望の上限値及び下限値にＩＦ信号の周波数があるかを判定することが可能となり、回路構成を従来に比べて小さくすることが可能となる。
図２は、本発明の第一の実施形態の主要部を示す回路図である。
【００２８】
本実施例で使用するＩＦカウンタは、分周されたＩＦ信号をカウントするための１２ビットダウンカウンタ７と、１２ビットダウンカウンタによってカウントされたカウント値の下位７ビットの値と信号線ＣＰから得る図示しない例えばＤＩＰ−ＳＷＩＴＣＨやレジスタ等で構成されるＩＦカウント上下限値差プリセット部に予め設定されている値とを比較するための７ビットコンパレータ８と、１２ビットダウンカウンタによってカウントされたカウント値の上位５ビットの全ビットが”０”かを判定するためのアンド回路９と、７ビットコンパレータ８での比較結果とアンド回路９での比較結果との論理積をとるためのアンド回路１０と、アンド回路１０による出力の反転ビットと１２ビットダウンカウンタによってカウントされた値の最上位ビット（１２ビット）の反転ビットとの論理積をとるためのアンド回路１１と、ＩＦ信号が図示しない例えばＤＩＰ−ＳＷＩＴＣＨやレジスタ等で構成されるＩＦカウント上限値プリセット部及びＩＦカウント上下限値差プリセット部に基づいて決定される上限値と下限値との間にあるかの判定結果を出力するための出力レジスタ１３と、出力レジスタ１３から出力する信号を制御するためのＲＳフリップフロップ１２とを少なくとも備えている。
【００２９】
１２ビットダウンカウンタ７は、図１に示したダウンカウント方式ＩＦカウント部１に対応する。１２ビットダウンカウンタ７には、図示しない例えばＤＩＰ−ＳＷＩＴＣＨやレジスタ等で構成される１１ビットのＩＦカウント上限値プリセット部に予め設定されたデータの信号Ｄと、カウント対象であるＩＦ信号が図示しないリミッタ回路を介しさらに図示しない分周器によって分周されたＩＦ信号ＣＫＳと、リセット信号であるＲＳＴとが入力される。
【００３０】
リセット信号ＲＳＴが入力されると図示しない例えばＤＩＰ−ＳＷＩＴＣＨやレジスタ等で構成されるＩＦカウント上限値プリセット部に設定されているデータが信号Ｄを介して１２ビットダウンカウンタ７にセットされる。１２ビットダウンカウンタ７は、上記セットされたＩＦカウント上限値を初期値としてＩＦ信号ＣＫＳに従ってダウンカウントを行なう。
【００３１】
ここで、上記分周器での分周比は例えば１／２、１／４、１／８、１／１６、１／３６等を選択的に使用することができ、タイムベースは必要に応じて４ｍＳ〜３２ｍＳ程度となるように設定する。
７ビットコンパレータ８は、図１に示した下位ｍビット比較器に対応する。７ビットコンパレータ８には、図示しないＤＩＰ−ＳＷＩＴＣＨやレジスタ等で構成される７ビットのＩＦカウント上下限値差プリセットに予め設定されたデータの信号ＣＰと１２ビットダウンカウンタ７の下位７ビットのデータＱ［６：０］とが入力され、信号Ｑ［６：０］＜信号ＣＰの場合に出力信号ＣＬＴＤとして”１”を出力する。
【００３２】
アンド回路９〜１１は、図１に示す判定部６に対応する。アンド回路９は、１２ビットダウンカウンタ７の上位５ビットのデータＱ［１１：７］が入力され各ビットが全て”０”の場合に出力信号ＵＤ０として”１”を出力する。アンド回路１０及び１１に対して、７ビットコンパレータ８からの出力信号ＣＬＴＤ、アンド回路９からの出力信号ＵＤ０及び１２ビットダウンカウンタ７の最上位ビットのデータＱ［１１］が入力されることによって、信号Ｑ［１１］が”１”の場合には出力信号ＪＵＸとして”１”が出力され（図３に示す（３）の区間）、信号ＣＬＴＤが”１”かつ信号ＵＤ０が”１”の場合には出力信号ＪＥＸとして”１”が出力され（図３に示す（２）の区間）、信号ＪＵＸが”０”かつ信号ＪＥＸが”０”の場合には出力信号ＪＬＸとして”１”が出力される（図３に示す（１）の区間）。
【００３３】
ＲＳフリップフロップ１２への入力信号である入力信号Ｊ＿ＳＲは、図示しないＩＦカウント期間生成回路から出力される信号であり、リセット信号ＲＳＴに同期してカウント期間の開始を指示する信号である。また、入力信号ＩＦ＿ＬＡは、図示しないＩＦカウント期間生成回路から出力される信号であり、タイムベース信号ＴＢＸに同期してカウント期間の終了を指示する信号である。
【００３４】
信号ＩＦ＿ＬＡに”１”が入力され、かつ信号Ｊ＿ＳＲに”０”入力される（すなわち、図示しないＩＦカウント期間生成回路で生成されるＩＦカウント期間を示す信号ＴＢＸがＯＦＦとなり、タイムベース期間の終了を示す信号ＩＦ＿ＬＡがＯＮとなる）と出力信号ＱＮに”１”が出力される。出力レジスタ１３は、入力信号ＱＮから”１”が入力されると信号ＪＥＸ、ＪＬＸ、ＪＵＸをそれぞれ出力信号ＪＥ、ＪＬ、ＬＵとして出力する。
【００３５】
以上により、ＩＦ信号ＣＫＳが図示しないＤＩＰ−ＳＷＩＴＣＨやレジスタ等で構成されるＩＦカウント上限値プリセット部に設定された上限値より大きい場合には出力信号（ＪＥ，ＪＬ，ＬＵ）が（０，０，１）となり、上限値とＩＦカウント上下限値差プリセット部及びＩＦカウント上限値プリセット部に基づく下限値との間にある場合には出力信号（ＪＥ，ＪＬ，ＪＵ）が（１，０，０）となり、下限値以下の場合には出力信号（ＪＥ，ＪＬ，ＪＵ）が（０，１，０）となる。
【００３６】
図３は、図２に示す回路によって出力される主要部の波形を示す図である。
信号ＲＳＴに同期してＲＳフリップフロップ１２への入力信号Ｊ＿ＳＲがＯＮとなることにより出力レジスタ１３がリセットされる。さらに、ＩＦカウント期間生成回路によってＩＦカウント期間（タイムベース期間）であることを示す信号ＴＢＸがＯＮ状態となり、信号Ｄから入力されるＤＩＰ−ＳＷＩＴＣＨやレジスタ等で構成されるＩＦカウント上限値プリセット部に設定された値を初期値として１２ビットダウンカウンタ７によるダウンカウントが開始される。
【００３７】
同図は、信号ＴＢＸが同図内に示す区間（１）内でＯＦＦとなる場合を示している。すなわち、信号ＴＢＸがＯＦＦとなるとＲＳフリップフロップ１２への入力信号ＩＦ＿ＬＡがＯＮとなり区間（１）での信号ＪＥＸ、ＪＬＸ、ＪＵＸの状態が出力レジスタ１３を介して信号ＪＥ、ＪＬ、ＪＵとして出力される（この場合の出力信号（ＪＥ，ＪＬ，ＪＵ）は（０，１，０）となる）。
【００３８】
図４は、本発明の第二の実施形態を示す機能ブロック図である。
本実施例に係るＩＦカウンタは、ｎ＋１ビットで構成されるダウンカウント方式ＩＦカウント部１と、ダウンカウント方式ＩＦカウント部１に対してＩＦカウント期間を生成するＩＦカウント期間生成部２と、ｎビットで構成されるＩＦカウント上限値を設定するためのＩＦカウント上限値プリセット部３と、ダウンカウント方式ＩＦカウント部１によってカウントされたカウント値がが所定の範囲内にあるかを判断する判定部１４とによって構成される。
【００３９】
ダウンカウント方式ＩＦカウント部１はｎ＋１ビットで構成されるデータのカウント機能を有する。ＩＦカウント上限値プリセット部３に予め設定されたｎビットで構成されるデータを初期値として、ＩＦカウント期間生成部２によって生成される所定の期間内について、例えば１ずつデクリメント処理を行なってＩＦ信号をカウントする。
【００４０】
ＩＦカウント期間生成部２は、ダウンカウント方式ＩＦカウント部１がＩＦ信号をカウントする期間を生成する。すなわち、ダウンカウント方式ＩＦカウント部１へ入力されるクロック信号を監視し、前記生成された所定の期間を経過するとダウンカウント方式ＩＦカウント部１に対してリセット信号を送る。
【００４１】
判定部１４は、ダウンカウント方式ＩＦカウント部１でカウントしたカウント値を入力として、カウント値が所定の上限値及び下限値の範囲内にあるかを判定する。ここで、所定の上限値はＩＦカウント上限値プリセット部３に予め設定される値であり、下限値はｎ＞ｍの関係を満たすｍビットのデータで与えられる。
【００４２】
ダウンカウント方式ＩＦカウント部１でカウントされたカウント値の最上位ビット（ｎ＋１ビット）が”１”の場合は、ＩＦカウント値＞ＩＦカウント上限値であると判定し、ダウンカウント方式ＩＦカウント部１でカウントされたカウント値の上位ｎ＋１−ｍビットが全て”０”である場合には、ＩＦカウント下限値≦ＩＦカウント値≦ＩＦカウント上限値であると判定する。さらに、ダウンカウント方式ＩＦカウント部１でカウントされたカウント値の上位ｎ＋１−ｍビットが全て”０”でない場合には、ＩＦカウント値＜ＩＦカウント下限値であると判定する。
【００４３】
以上の構成にすることによって、さらに回路規模を小さくすることが可能となる。
本実施例は、図２に示す回路図において７ビットコンパレータ８及びアンド回路１０を取り除いた回路を使用することによって実現される（従って信号ＣＰ及び信号Ｑ［６：０］は使用しない）。すなわち、アンド回路９からの出力信号ＵＤ０が出力信号ＪＥＸ及びアンド回路１１への入力信号となる。
【００４４】
他の回路構成については、図２に示した回路構成と同様である。すなわち、１２ビットダウンカウンタ７は、図４に示したダウンカウント方式ＩＦカウント部１に対応する。１２ビットダウンカウンタ７には、図示しない例えばＤＩＰ−ＳＷＩＴＣＨやレジスタ等で構成される１１ビットのＩＦカウント上限値プリセット部に予め設定されたデータの信号Ｄと、カウント対象であるＩＦ信号が図示しないリミッタ回路を介しさらに図示しない分周器によって分周されたＩＦ信号ＣＫＳと、リセット信号であるＲＳＴとが入力される。
【００４５】
リセット信号ＲＳＴが入力されると図示しないＤＩＰ−ＳＷＩＴＣＨやレジスタ等で構成されるＩＦカウント上限値プリセット部に設定されているデータが信号Ｄを介して１２ビットダウンカウンタ７にセットされる。１２ビットダウンカウンタ７は、上記セットされたＩＦカウント上限値を初期値としてＩＦ信号ＣＫＳに従ってダウンカウントを行なう。
【００４６】
ここで、上記分周器での分周比は例えば１／２、１／４、１／８、１／１６、１／３６等を選択的に使用するる。また、タイムベースは必要に応じて４ｍＳ〜３２ｍＳ程度となるように設定する。
アンド回路９及び１１は、図４に示す判定部１４に対応する。アンド回路９は、１２ビットダウンカウンタ７の上位５ビットのデータＱ［１１：７］が入力され各ビットが全て”０”の場合に出力信号ＵＤ０として”１”を出力する。アンド回路１１に対して、アンド回路９からの出力信号ＵＤ０及び１２ビットダウンカウンタ７の最上位ビットのデータＱ［１１］が入力されることによって、信号Ｑ［１１］が”１”の場合には出力信号ＪＵＸとして”１”が出力され（図３に示す（３）の区間）、信号ＵＤ０が”１”の場合には出力信号ＪＥＸとして”１”が出力され（図３に示す（２）の区間）、信号ＪＵＸが“０”かつ信号ＪＥＸが”０”の場合には出力信号ＪＬＸとして”１”が出力される（図３に示す（１）の区間）。
【００４７】
ＲＳフリップフロップ１２への入力信号である入力信号Ｊ＿ＳＲは、図示しないＩＦカウント期間生成回路から出力される信号であり、リセット信号ＲＳＴに同期してカウント期間の開始を指示する信号である。また、入力信号ＩＦ＿ＬＡは、図示しないＩＦカウント期間生成回路から出力される信号であり、タイムベース信号ＴＢＸに同期してカウント期間の終了を指示する信号である。
【００４８】
信号ＩＦ＿ＬＡに”０”が入力され、かつＪ＿信号ＳＲに”１”入力される（すなわち、図示しないＩＦカウント期間生成回路で生成されるＩＦカウント期間を示す信号ＴＢＸがＯＦＦとなり、タイムベース期間の終了を示す信号ＩＦ＿ＬＡがＯＮとなる）と出力信号ＱＮに”１”が出力される。出力レジスタ１３は、入力信号ＱＮから”１”が入力されると信号ＪＥＸ、ＪＬＸ、ＪＵＸをそれぞれ出力信号ＪＥ、ＪＬ、ＬＵとして出力する。
【００４９】
以上により、ＩＦ信号ＣＫＳが図示しないＤＩＰ−ＳＷＩＴＣＨやレジスタ等で構成されるＩＦカウント上限値プリセット部に設定された上限値より大きい場合には出力信号（ＪＥ，ＪＬ，ＬＵ）が（０，０，１）となり、上限値とＩＦカウント上限値プリセット部に基づく下限値との間にある場合には出力信号（ＪＥ，ＪＬ，ＪＵ）が（１，０，０）となり、下限値以下の場合には出力信号（ＪＥ，ＪＬ，ＪＵ）が（０，１，０）となる。
【００５０】
以上の構成によって第１の実施例に示した回路構成によるＩＦカウンタよりもさらに回路規模を小さくすることが可能となる。
【図面の簡単な説明】
【００５１】
【図１】本発明の第一の実施形態を示す機能ブロック図である。
【図２】本発明の第一の実施形態の主要部を示す回路図である。
【図３】図２に示す回路によって出力される主要部の波形を示す図である。
【図４】本発明の第二の実施形態を示す機能ブロック図である。
【図５】従来例を示す機能ブロック図である。
【符号の説明】
【００５２】
１      ・・・  ダウンカウント方式ＩＦカウント部
２      ・・・  ＩＦカウント期間生成部
３      ・・・  ＩＦカウント上限値プリセット部
４      ・・・  ＩＦカウント上下限値差プリセット部
５      ・・・  下位ｍビット比較部
６      ・・・  判定部
７      ・・・  １２ビットダウンカウンタ
８      ・・・  ７ビットコンパレータ
９      ・・・  アンド回路
１０      ・・・  アンド回路
１１      ・・・  アンド回路
１２      ・・・  ＲＳフリップフロップ
１３      ・・・  出力レジスタ
１４      ・・・  判定部
１５      ・・・  ＩＦカウント部
１６      ・・・  ＩＦカウント期間生成部
１７      ・・・  ＩＦカウント上限値プリセット部
１８      ・・・  ＩＦカウント下限値プリセット部
１９      ・・・  上限値比較部
２０      ・・・  下限値比較部
２１      ・・・  判定部
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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