(57)【要約】【課題】デジタルデータを再生する装置において、デジタル信号の等化処理特性を可変にするとともに、インターポレータのタイミング調整を容易化する。【解決手段】再生ヘッド２で再生した信号は、アナログフィルタ１０、Ａ／Ｄ１２、インターポレータ１４で順次処理され、デジタルイコライザ１５に供給される。デジタルイコライザ１５は、並列接続された可変フィルタ１８、１９を有する。可変フィルタ１８の特性調整中は可変フィルタ１９の出力でインターポレータ１４のタイミング制御を行い、調整終了後はＳＷを切り替えて可変フィルタ１８の出力でタイミング制御を行う。【選択図】図３
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【特許請求の範囲】
【請求項１】
デジタルデータを再生する再生手段と、
前記再生手段からのアナログ信号をデジタル信号に変換するアナログ／デジタル変換手段と、
前記アナログ／デジタル変換手段からのデジタル信号を内挿補間するインターポレート手段と、
前記インターポレート手段からのデジタル信号を所望の目標特性とすべく等化処理するデジタル等化手段と、
前記デジタル等化手段からのデジタル信号に基づき前記インターポレート手段での内挿補間タイミングを調整するタイミング調整手段と、
を有し、前記デジタル等化手段は、
互いに並列接続された複数の可変フィルタ手段と、
前記複数の可変フィルタ手段の出力を選択的に前記タイミング調整手段に切替出力するスイッチ手段と、
を有することを特徴とするデータ再生装置。
【請求項２】
請求項１記載の装置において、
前記複数の可変フィルタ手段は、第１可変フィルタ及び第２可変フィルタを含み、
前記スイッチ手段は、前記第２可変フィルタのフィルタ特性調整中は前記第１可変フィルタの出力を前記タイミング調整手段に出力し、前記第２可変フィルタのフィルタ特性調整後は前記第２可変フィルタの出力を前記タイミング調整手段に出力する
ことを特徴とするデータ再生装置。
【請求項３】
請求項１記載の装置において、
前記複数の可変フィルタ手段は、それぞれ、
入力デジタル信号の振幅を調整する可変フィルタと、
前記可変フィルタからのデジタル信号の群遅延を調整する可変全域通過フィルタと、
を有することを特徴とするデータ再生装置。
【請求項４】
請求項１記載の装置において、
前記デジタルデータは、ＰＲ４プリコードされたデジタルデータであることを特徴とするデータ再生装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明はデータ再生装置、特にデジタルデータ再生信号の等化処理及びタイミング制御に関する。
【背景技術】
【０００２】
従来より、磁気テープ等に記録されているデジタル画像信号やデジタル音声信号を再生する技術が知られている。この種の装置においては、再生された信号をイコライザにより等化処理することで、記録再生系における信号の劣化や磁気テープの種類による特性ばらつき、磁気ヘッドの特性ばらつき等を補償し、エラーを低減している。
【０００３】
図１２には、イコライザを備えた従来の再生装置の構成ブロック図が示されている。再生回路１０３は回転磁気ヘッドから構成され、磁気テープ１０１のトラックから画像信号、音声信号、サブコード等の情報を再生し、アナログ信号として出力する。アンプ１０５は、回転ヘッドからの再生信号を増幅し、イコライザ１０７に出力する。
【０００４】
イコライザ１０７は、高域強調用フィルタ、低域の群遅延を制御する全域通過（オールパス）フィルタ、高域の群遅延を制御する全域通過フィルタを有する。高域強調用フィルタは、アンプ１０５からの信号の高域成分の劣化を補償して低域群遅延制御用の全域通過フィルタに出力する。低域群遅延制御用の全域通過フィルタは、磁気テープのダイパルス特性を補償するためにアナログ再生信号の低域の群遅延を調整し、高域群遅延制御用の全域通過フィルタに出力する。高域群遅延制御用の全域通過フィルタは、アナログ再生信号の高域の群遅延を制御し、さらに積分処理してＡ／Ｄ１０９に出力する。
【０００５】
Ａ／Ｄ１０９は、イコライザ１０７からのアナログ再生信号をデジタル信号に変換し、ＦＩＲ（Finite Impulse Response）フィルタ１１１及びＰＬＬ１１３に出力する。Ａ／Ｄ１０９は、ＰＬＬ１１３からのクロックに応じてアナログ再生信号をサンプリングする。
【０００６】
ＦＩＲフィルタ１１１は、複数のラッチ及び係数器を備え、群遅延特性を調整してＰＲ４デコーダ１１５に出力する。ＰＲ４デコーダ１１５は、ＰＲ４のプリコード処理が施されて記憶されているデジタル信号の復調処理を行い、評価回路１１７及びビタビデコーダ１２１に出力する。評価回路１１７は、イコライザ１０７の特性を評価し、その結果をイコライザ制御回路１１９に出力し、イコライザ１０７の特性を調整する。また、ビタビデコーダ１２１は、ビタビアルゴリズムを用いてＰＲ４デコーダ１１５の出力から１サンプル１ビットのデジタル信号を検出し、信号処理回路１２３に出力する。信号処理回路１２３は、ビタビデコーダ１２１により得られたデジタル信号に基づいて再生画像信号や再生音声信号を得、出力端子１２５から出力する。
【０００７】
【特許文献１】特開２００１−２０９９０２号公報
【発明の開示】
【発明が解決しようとする課題】
【０００８】
このように、従来においては、再生回路１０３で得られたアナログ再生信号に対してイコライザ１０７で等化処理を行っており、ある程度の特性ばらつきにも対応することが可能であるが、より広範な特性ばらつきに対応する、あるいは一層のエラー低減を図るのに一定の限界があった。特に、近年においては多種多様な磁気テープや磁気ヘッドが存在し、その特性のばらつきが増大しているだけでなく、一層の性能の安定化、ユーザの多様な要求に応え得るフレキシビリティ、並びにコスト低下が要求されており、イコライザの等化特性をより柔軟にかつ高精度に可変調整できることが望まれている。
【０００９】
一方、イコライザの等化特性を可変調整できるように構成した場合には、タイミング制御が困難となる問題がある。すなわち、例えば非同期サンプリング（再生信号をそのシンボルとは非同期のクロックでサンプリングする）でデジタル信号に変換した場合、各サンプル点間のシンボル点データを推定するためにインターポレータで内挿補間する必要があり、内挿補間のタイミングは等化手段の出力に基づいて帰還制御して最適化することになるが、等化手段のフィルタ特性を変更すると内挿補間タイミングも同時に変更されてしまい、調整が困難となる問題がある。
【００１０】
本発明の目的は、再生信号の等化処理をより柔軟にかつ精度よく実行でき、かつ、タイミング制御も容易に行って再生エラーを低減できるデータ再生装置を提供することにある。
【課題を解決するための手段】
【００１１】
本発明のデータ再生装置は、デジタルデータを再生する再生手段と、前記再生手段からのアナログ信号をデジタル信号に変換するアナログ／デジタル変換手段と、前記アナログ／デジタル変換手段からのデジタル信号を内挿補間するインターポレート手段と、前記インターポレート手段からのデジタル信号を所望の目標特性とすべく等化処理するデジタル等化手段と、前記デジタル等化手段からのデジタル信号に基づき前記インターポレート手段での内挿補間タイミングを調整するタイミング調整手段とを有し、前記デジタル等化手段は、互いに並列接続された複数の可変フィルタ手段と、前記複数の可変フィルタ手段の出力を選択的に前記タイミング調整手段に切替出力するスイッチ手段とを有する。
【００１２】
等化手段で等化処理されたデジタル信号をタイミング調整手段に供給し、帰還制御することでインターポレート手段における内挿タイミングが最適化（タイミング同期）されるが、本発明においては、デジタル等化手段は互いに並列接続された複数の可変フィルタ手段を有し、いずれかの可変フィルタ手段からの出力を選択的にタイミング調整手段に供給する。したがって、デジタルデータの記録媒体その他の特性ばらつきにより、デジタル等化手段の等化特性を変更する必要が生じ、このため可変フィルタ手段のフィルタ特性を調整する際においても、複数の可変フィルタ手段のいずれかのフィルタ特性を調整中は、フィルタ特性を変化させていない残りの可変フィルタ手段の出力をタイミング調整手段に供給することが可能となる。これにより、フィルタ特性調整中はタイミング調整手段による同期タイミングは変更されることはなく、当該いずれかの可変フィルタ手段のフィルタ特性調整は、タイミング同期が確立された状態で実行されことになり、調整が容易化される。本発明では、複数の可変フィルタ手段を互いに並列に設けることで、タイミング調整とフィルタ特性調整とを互いに分離させ、それぞれ個別に調整可能とすると云うこともできる。
【００１３】
本発明の１つの実施形態では、複数の可変フィルタ手段は、第１可変フィルタ及び第２可変フィルタ手段を含み、前記スイッチ手段は、前記第２可変フィルタのフィルタ特性調整中は前記第１可変フィルタの出力を前記タイミング調整手段に出力し、前記第２可変フィルタのフィルタ特性調整後は前記第２可変フィルタの出力を前記タイミング調整手段に出力する。第１可変フィルタがそのフィルタ特性を維持する可変フィルタであり、第２可変フィルタがそのフィルタ特性を調整する可変フィルタである。
【発明を実施するための最良の形態】
【００１４】
以下、図面に基づき本発明の実施形態について説明する。
【００１５】
まず、本実施形態におけるデータ再生装置の構成を説明するに当たり、その前提となる基本構成について説明する。図１には、データ再生装置の基本構成ブロック図が示されている。再生ヘッド２は、磁気テープ等に記録されたデジタルデータを再生し、アンプにより増幅してアナログフィルタ１０に出力する。
【００１６】
アナログフィルタ１０は、アンチエイリアスフィルタであり、アナログ信号のｆｂ／２（ｆｂ：ビットレート）以上の周波数成分をカットしてＡ／Ｄ１２に出力する。
【００１７】
Ａ／Ｄ１２は、アナログフィルタ１０からのアナログ信号をデジタル信号に変換してインターポレータ１４に出力する。具体的には、Ａ／Ｄ１２は、図示しないＰＬＬからのクロックに応じてアナログ信号をサンプリングし、１サンプル複数ビットで量子化してデジタル化する。
【００１８】
インターポレータ１４は、Ａ／Ｄ１２からのデジタル信号に対し、そのサンプル点データからサンプル間にあるシンボル点のデータを推定する。Ａ／Ｄ１２では、ＰＬＬからのクロックに応じ、シンボルとは非同期のタイミングでサンプリングするため（非同期サンプル）、インターポレータ１４でシンボル点のデータを内挿補間する必要が生じる。インターポレータ１４は、Ａ／Ｄ１２のサンプルデータに対して補間したデータをリサンプル処理する。インターポレータ１４は、基本的にはＦＩＲフィルタで構成される。インターポレータ１４は、互いに直列接続された複数のラッチ、複数の係数器、及び加算器を含んで構成される。各ラッチは、デジタル信号をサンプル期間だけ保持して出力する。各係数器は、入力デジタル信号に対して所定の係数を乗じて加算器に出力する。加算器は、各係数器の出力を加算し、後段のデジタルイコライザに出力する。各係数器の係数は、予めセットとして設定されている。また、係数のセットは予め複数セット（例えば３２セット）用意され、これらのセットのいずれかが選択される。すなわち、内挿補間すべき位置に応じて複数セットの中のいずれかのセットが選択的に用いられる。内挿補間すべき位置、すなわち内挿補間のタイミングは、タイミングエラー検出器３４、ループフィルタ３６、ＮＣＯ(Number Control Oscillator)からなるタイミングコントロール回路により調整される。
【００１９】
インターポレータ１４にて内挿補間され、リサンプルされたデジタル信号は、等化処理を行うデジタルイコライザ１５に供給される。
【００２０】
デジタルイコライザ１５は、デジタル信号を所望の目標特性に一致させるためにデジタル信号の振幅及び群遅延を制御するもので、本実施形態ではデジタル信号に対して等化処理を施す。デジタルイコライザ１５は、具体的には、固定ＦＩＲフィルタ１６、可変フィルタ１８、可変ＦＩＲフィルタ２６、及び適応制御器２８を含んで構成される。
【００２１】
固定ＦＩＲフィルタ１６は、インターポレータ１４からのデジタル信号に対し、高域成分をブーストして高域成分の劣化を補償する。すなわち、再生ヘッド２、アナログフィルタ１０及びインターポレータ１４の各フィルタにより原信号の高域成分が劣化しているため、この高域成分を所定量（固定値）だけブーストするのである。
【００２２】
可変フィルタ１８は、固定ＦＩＲフィルタ１６からのデジタル信号の振幅及び群遅延を可変制御するフィルタであり、例えば複数のラッチ及び係数器で構成した場合の係数器の係数（タップ係数）を可変とするものである。
【００２３】
図２には、可変フィルタ１８の一つの構成例が示されている。可変フィルタ１８は、可変バンドパスフィルタ（ＢＰＦ）１８ａ、可変ハイパスフィルタ（ＨＰＦ）１８ｂ及び可変全域通過フィルタ１８ｃから構成される。可変ＢＰＦ１８ａ及び可変ＨＰＦ１８ｂでデジタル信号の振幅を調整し、可変全域通過フィルタ１８ｃでデジタル信号の群遅延量を制御する。各フィルタのタップ係数は外部からの調整信号により可変調整される。具体的には、図示しないレジスタに各係数器の係数データ値を書き込み、このレジスタ値を各フィルタに供給する。可変フィルタ１８で振幅及び群遅延が調整されたデジタル信号は可変ＦＩＲフィルタ２６に供給される。
【００２４】
再び図１に戻り、可変ＦＩＲフィルタ２６は、入力デジタル信号の特性を目標特性に一致させるためのＦＩＲフィルタであり、係数器の係数を可変とするフィルタである。係数器の可変係数は、適応制御器２８からの調整信号により調整設定される。適応制御器２８は、目標特性（仮に定めた目標特性である）と入力デジタル信号の特性との差分を演算し、この差分に応じて所定のアルゴリズムに従いＦＩＲフィルタの係数を増減調整する。より詳しくは、適応制御器２８は、判定器、減算器、及び適応アルゴリズム処理器を備える。判定器は、可変ＦＩＲフィルタ２６の出力をしきい値と比較し、出力デジタル値が所定のデジタル値のいずれであるかを判定する（所定のデジタル値が０、−１、＋１である場合、出力デジタル値をしきい値と比較してこれらの値のいずれであるかを判定する）。例えば、可変ＦＩＲフィルタ２６からの出力デジタル値が０．８であった場合、判定器はこれを＋１と判定して減算器に出力する。
【００２５】
減算器は、可変ＦＩＲフィルタ２６からの出力と、判定器からの判定結果を減算し、その差分を算出する。この差分あるいは相違が、入力デジタル信号の特性と目標特性との相違である。減算器は、差分を適応アルゴリズム処理器に出力する。適応アルゴリズム処理器は、ＬＭＳ（Least Mean Square）アルゴリズム、すなわち、差分（誤差信号）の２乗を最小にするように可変ＦＩＲフィルタ２６のタップ係数を時々刻々変化させる。適応アルゴリズム処理器は回路で構成されるが、ＤＳＰをプログラミングしてソフト的に処理してもよい。以上のようにして、入力デジタル信号を目標特性（目標ＰＲ４特性）に高速に等化収束させることができる。可変フィルタ１８でデジタル信号特性の振幅及び群遅延を粗調整し、可変ＦＩＲフィルタ２６でデジタル信号特性の群遅延を微調整して目標特性に一致させると云うこともできる。
【００２６】
可変ＦＩＲフィルタ２６で最終的に等化処理されたデジタル信号は、ビタビデコーダ４２に供給される。ビタビデコーダ４２は、ビタビアルゴリズムを用いてデジタル信号を検出し、信号処理回路４４に出力する。信号処理回路４４は、ビタビデコーダ４２により得られたデジタル信号に基づき、再生画像信号や再生音声信号を得て、モニタその他のデバイスに出力する。
【００２７】
なお、可変ＦＩＲフィルタ２６の出力は、タイミングエラー検出器３４にも供給され、ループフィルタ３６を介してＮＣＯ（Number Control Oscillator)３８に供給され、ＮＣＯ３８でタイミング誤差に応じた制御信号を生成してインターポレータ１４に供給し、タイミングを調整する。インターポレータ１４は、ＮＣＯ３８からの制御信号に基づいて、既述したように係数器の係数の複数セットの中から制御信号に応じたセットを用いて内挿補間し内挿タイミングを最適化（タイミングの同期確立）する。
【００２８】
このように、図１に示されたデータ再生装置では、インターポレータ１４からのデジタル信号に対し、デジタルイコライザ１５により等化処理するとともに、デジタルイコライザ１５を構成するフィルタを可変フィルタ（その特性を調整できるフィルタ）で構成することで、デジタルデータが記録された磁気テープ等の特性ばらつきや再生ヘッドの特性ばらつき、アナログフィルタ１０の特性ばらつきなどを柔軟かつ高精度に補償できる。
【００２９】
一方、可変フィルタのフィルタ特性を調整した場合、タイミングエラー検出器３４、ループフィルタ３６、ＮＣＯ３８からなるタイミング制御系の入力も変化するため、一旦確立したタイミング同期も変更されることとなる。本来であれば、タイミング同期とフィルタ特性とは個別に調整されるべきであり、タイミング同期が確立したことを前提としてフィルタ特性を最適化すべきである。
【００３０】
そこで、本実施形態では、図１の基本構成を前提としつつ、さらに新たな構成を付加してかかる問題を解決している。
【００３１】
図３には、本実施形態に係るデータ再生装置の全体構成図が示されている。図１の構成と異なる点は、デジタルイコライザ１５を構成する可変フィルタ１８の他に、可変フィルタ１９を設け、可変フィルタ１８と可変フィルタ１９とを互いに並列接続させた点、及び、可変フィルタ１８の信号系統（可変フィルタ１８と可変ＦＩＲフィルタ２６の系統）と、可変フィルタ１９の信号系統とを選択的に切り換えてタイミングエラー検出器３４に出力するスイッチＳＷを設けた点である。
【００３２】
可変フィルタ１９は、可変フィルタと同様にそのフィルタ特性を可変調整できるフィルタであり、その構成は可変フィルタ１８と同一である。従って、可変フィルタ１９も、図２に示された可変フィルタ１８と同様に、可変ＢＰＦ、可変ＨＰＦ、可変全域通過フィルタを備えてもよい。可変フィルタ１９の係数（タップ係数）も、可変フィルタ１８と同様に外部の調整信号により可変設定される。
【００３３】
可変フィルタ１８及び可変フィルタ１９は、当初はともに外部の調整信号によりある適当なフィルタ特性となるように設定される。その後、磁気テープ等の記録媒体特性のばらつき等によりデジタルイコライザ１５の等化特性を調整する必要が生じた場合には、フィ可変フィルタ１８のフィルタ特性のみを変化させて調整し、可変フィルタ１９のフィルタ特性はそのまま維持する。
【００３４】
スイッチＳＷは、接点ａ（可変フィルタ１９側）と接点ｂ（可変フィルタ１８側）とを選択的に切り替えるスイッチであり、スイッチＳＷの切り替えは、可変フィルタ１８での可変調整が終了したことをトリガとして行われる。図３においてＳＷに供給される切替信号は、可変調整終了をトリガとしてＳＷに供給され、ＳＷの接点を切り替える。ＳＷの接点を接点ａ側とすると可変フィルタ１９の出力に基づきタイミング制御が行われ、ＳＷの接点を接点ｂ側とすると可変フィルタ１８（及び可変ＦＩＲフィルタ２６）の出力に基づきタイミング制御が行われる。
【００３５】
以下、ＳＷの切替動作について、図４及び図５を用いて説明する。
【００３６】
図４及び図５には、図３における要部が示されている。図４に示されるように、当初はＳＷは接点ａ側に設定され、可変フィルタ１９の出力をタイミングエラー検出器３４に出力し、可変フィルタ１９の出力でタイミングの帰還制御を行いタイミングの同期を確立する。この状態から、磁気テープその他の記録媒体等の特性ばらつきに起因してデジタルイコライザ１５の等化特性を変化させ調整する必要が生じた場合、可変フィルタ１８のフィルタ特性（係数器のタップ係数）のみを変更し、可変フィルタ１９のフィルタ特性（係数器のタップ係数）はそのまま維持する。可変フィルタ１９のフィルタ特性は変更されずそのまま維持されるため、タイミングエラー検出器３４に供給される信号も変化なく、インターポレータ１４での内挿補間タイミングも維持される。
【００３７】
可変フィルタ１８の調整が終了したとき、すなわち可変フィルタ１８及び可変ＦＩＲフィルタ２６の出力が目標特性にほぼ一致したとき、可変フィルタ１８の係数が調整後の値に設定されるとともに、図５に示されるように、ＳＷの接点は接点ａ側から接点ｂ側に切り替えられる。これにより、フィルタ特性調整済みの可変フィルタ１８の出力がタイミングエラー検出器３４に供給されるようになり、可変フィルタ１８の出力で新たにタイミング同期が確立される。
【００３８】
可変フィルタ１８の係数調整が終了すると、係数はほぼ一定値に収束するため、このことを検出して切替信号をＳＷに出力し、ＳＷの接点を接点ａ側から接点ｂ側に切り替える構成としてもよい。
【００３９】
このように、本実施形態では、可変フィルタ１８と可変フィルタ１９とを互いに並列接続し、タイミング同期を確立するための可変フィルタと、フィルタ特性を変更するための可変フィルタとを分離独立させることで、タイミング同期を確立した状態でフィルタ特性のみを変更することが可能となり、フィルタ特性の調整が容易化される。
【００４０】
なお、本実施形態では、可変フィルタ１８と並列に可変フィルタ１９を設けているが、可変フィルタ１９に加え、可変フィルタ１９の後段に可変ＦＩＲフィルタを設けてもよい。スイッチＳＷは、可変フィルタ１９の後段に設けられた可変ＦＩＲフィルタの出力と、可変フィルタ１８の後段に設けられた可変ＦＩＲフィルタ２６の出力のいずれかを選択的にタイミングエラー検出器３４に出力する。フィルタ特性の調整中は、可変フィルタ１９及びその後段に設けられた可変ＦＩＲフィルタで等化処理されたデジタル信号でタイミング同期を確立し、可変フィルタ１８のフィルタ特性の調整終了後は、可変ＦＩＲフィルタ２６の出力でタイミング同期を再確立する。
【００４１】
本実施形態における可変フィルタ１８及び可変フィルタ１９の構成は任意であるが、以下にこれらを例示する。
【００４２】
図６には、可変ＢＰＦ１８ａの構成が示されている。可変ＢＰＦ１８ａは、直列接続された複数（図では４個）のラッチ１８ａ−１、並列接続された複数（図では２個）の係数器１８ａ−２、及び加算器１８ａ−３を含んで構成される。固定ＦＩＲフィルタ１６の出力はラッチ１８ａ−１に供給されるとともに、係数器１８ａ−２にも供給される。係数器１８ａ−２は、デジタル信号に対して可変係数Ｋｂを乗算し、加算器１８ａ−３に出力する。ラッチ１８ａ−１は、デジタル信号を保持した後、加算器１８ａ−３に出力する。また、複数のラッチ１８ａ−１を経由したデジタル信号は他の係数器１８ａ−２に供給され、当該他の係数器１８ａ−２は入力デジタル信号に対して可変係数Ｋｂを乗算して加算器１８ａ−３に出力する。加算器１８ａ−３は、これらの信号を加算して、次段の可変ＨＰＦ１８ｂに出力する。係数器１８ａ−２における可変係数Ｋｂを適宜調整することで、ＢＰＦのフィルタ特性が変化する。
【００４３】
図７には、可変ＨＰＦ１８ｂの構成が示されている。可変ＨＰＦ１８ｂも、複数（図では２個）のラッチ１８ｂ−１、複数（図では２個）の係数器１８ｂ−２、及び加算器１８ｂ−３を含んで構成される。可変ＢＰＦ１８ａからのデジタル信号は、ラッチ１８ｂ−１及び係数器１８ｂ−２に供給される。係数器１８ｂ−２は、デジタル信号に対して可変係数Ｋｈを乗算し、加算器１８ｂ−３に出力する。ラッチ１８ｂ−１は、デジタル信号を保持した後、加算器１８ｂ−３に出力する。また、２個のラッチ１８ｂ−１を経由したデジタル信号は他の係数器１８ｂ−２に供給され、当該他の係数器１８ｂ−２は入力デジタル信号に対して可変係数Ｋｈを乗算して加算器１８ｂ−３に出力する。加算器１８ｂ−３は、これらの信号を加算して、次段の全域通過フィルタ１８ｃに出力する。係数器１８ｂ−２における可変係数Ｋｈを適宜調整することで、ＨＰＦのフィルタ特性が変化する。
【００４４】
図８には、全域通過フィルタ１８ｃの構成が示されている。全域通過フィルタ１８ｃは、減算器１８ｃ−１、遅延器１８ｃ−２、１８ｃ−４、係数器１８ｃ−３、及び加算器１８ｃ−５を含んで構成される。可変ＢＰＦ１８ｂからのデジタル信号は、減算器１８ｃ−１に供給される。減算器１８ｃ−１は、入力デジタル信号と遅延器１８ｃ−４からの遅延デジタル信号との差分を演算し、係数器１８ｃ−３及び遅延器１８ｃ−２に出力する。係数器１８ｃ−３は、差分信号に対して可変係数Ａを乗算して加算器１８ｃ−５及び遅延器１８ｃ−４に出力する。遅延器１８ｃ−４は、差分信号を１サンプルだけ遅延させて減算器１８ｃ−１に供給し、加算器１８ｃ−５は、遅延器１８ｃ−２からの信号と係数器１８ｃ−３からの信号を加算して出力する。減算器１８ｃ−１、係数器１８ｃ−３、及び遅延器１８ｃ−４でＩＩＲフィルタを構成し、係数器１８ｃ−３、遅延器１８ｃ−２、及び加算器１８ｃ−５でＦＩＲフィルタを構成し、係数器１８ｃ−３の係数Ａを調整することで群遅延を制御する。係数器１８ｃ−３の係数Ａを負に設定することで、入力デジタル信号の低域成分の群遅延量が増大し、係数Ａの値を増減することでその遅延量を可変にできる。
【００４５】
図９〜図１１には、各フィルタの特性が示されている、図９は可変ＢＰＦ１８ａの特性、図１０は可変ＨＰＦ１８ｂの特性、図１１は可変全域通過フィルタ１８ｃの特性である。各図において、矢印は各フィルタにおける係数器の係数（タップ係数）を変化させることにより得られる特性変化を示す。また、ｆｂはビットレートである。
【００４６】
以上説明したように、本実施形態では、イコライザをデジタルフィルタで構成し、かつそのフィルタを可変フィルタとすることで、記録媒体や再生ヘッド等の特性ばらつきに応じた等化特性に柔軟かつ高精度に調整できる。
【００４７】
また、本実施形態では、可変フィルタを複数個（実施形態では２個）並列に設け、一方の可変フィルタの係数を調整している間に他方の可変フィルタの出力を用いてタイミング制御を行っているので、タイミング調整とフィルタ特性調整とを個別に実行することができ、速やかに調整を終了することができる。
【００４８】
以上、本発明の実施形態について説明したが、本発明はこれに限定されるものではなく種々の変更が可能である。
【００４９】
例えば、本実施形態において、可変フィルタ１８と可変ＦＩＲフィルタ２６との間にオートゲインコントローラ（ＡＧＣ）を設け、可変フィルタ１８の出力ゲインを調整した上で可変ＦＩＲフィルタ２６に供給する構成としてもよい。ゲイン調整は、具体的にはタイミング制御と同様に帰還制御され、デジタルイコライザ１５の出力をゲインエラー検出器に供給し、ループフィルタを介してＡＧＣを制御する。当初は、スイッチＳＷは接点ａ側に切り替えられるため、可変フィルタ１９の出力がゲインエラー検出器に供給されてゲイン制御され、可変フィルタ１８のフィルタ特性調整後はスイッチＳＷは接点ｂ側に切り替えられるため可変フィルタ１８（可変ＦＩＲフィルタ２６）の出力がゲインエラー検出器に供給されてゲイン制御される。
【００５０】
また、本実施形態のデータ再生装置は、ＤＶＣ（デジタルビデオカメラ）やＨＤＤ（ハードディスクドライブ）、ＣＤドライブやＤＶＤドライブの再生装置に組み込むことができ、ＰＲ４等のデジタルデータを再生ヘッドでアナログ信号として再生し、このアナログ再生信号をデジタル化して再生処理する任意のデバイスに適用することができる。
【図面の簡単な説明】
【００５１】
【図１】実施形態の基本構成図である。
【図２】図１における可変フィルタの構成図である。
【図３】実施形態の全体構成図である。
【図４】図３におけるＳＷの動作説明図である。
【図５】図３におけるＳＷの動作説明図である。
【図６】可変ＢＰＦの構成図である。
【図７】可変ＨＰＦの構成図である。
【図８】可変全域通過フィルタの構成図である。
【図９】可変ＢＰＦの特性説明図である。
【図１０】可変ＨＰＦの特性説明図である。
【図１１】可変全域通過フィルタの特性説明図である。
【図１２】従来装置の構成図である。
【符号の説明】
【００５２】
２  再生ヘッド、１０  アナログフィルタ、１２  Ａ／Ｄ、１４  インターポレータ、１５  デジタルイコライザ、１６  固定ＦＩＲフィルタ、１８  可変フィルタ、１９  可変フィルタ、２６  可変ＦＩＲフィルタ、３４  タイミングエラー検出器、３６  ループフィルタ、３８  ＮＣＯ。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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