(57)【要約】【課題】パネル書き込み制御信号を用いた書き込み制御により、表示不良の発生を抑止すると共に、バッファメモリのメモリ容量を小さくできる画像表示システム及びその制御方法を提供する。【解決手段】有機ＥＬ表示パネル３００の駆動を停止している１垂直期間中に、ＣＰＵ１００からフレームメモリ２１１へ表示データの書き込みを、一括して行うことで表示不良を防止している。ＣＰＵ１００から書き込み許可命令がＣＰＵバス１０１を介して駆動ＬＳＩ２００に出力されると、駆動ＬＳＩ２００はこれを解読して、パネル書き込み制御信号をＣＰＵ１００に出力する。すると、ＣＰＵ１００は表示データの出力を待機する。その待機中に、フレームメモリ２１１上にある表示データを読み出し、ＤＡ変換器２１２を介して、有機ＥＬ表示パネル３００に出力する。【選択図】  図１
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【特許請求の範囲】
【請求項１】
複数の画素を含む表示パネルと、
ＣＰＵバスを介して表示データを出力するＣＰＵと、
前記ＣＰＵから出力される前記表示データがバッファメモリを介して書き込まれるフレームメモリを有し、前記ＣＰＵから出力される書き込み許可命令に応じて、前記表示データの出力を待機させるための書き込み待機信号を前記ＣＰＵに出力すると共に、その内部で発生される駆動信号に応じて、前記フレームメモリに書き込まれた前記表示データを前記表示パネルに出力する駆動回路と、
書き込み待機命令の解除に応じて、前記駆動信号の出力を所定期間、停止する制御回路とを具備し、
前記所定期間中に、前記ＣＰＵから表示データを前記フレームメモリに一括して書き込むようにしたことを特徴とする画像表示システム。
【請求項２】
前記駆動信号は、水平スタート信号及び垂直スタート信号であることを特徴とする請求項１に記載の画像表示システム。
【請求項３】
前記複数の画素は、前記フレームメモリから出力された表示データを前記所定期間中、保持する保持回路を有することを特徴とする請求項１又は請求項２に記載の画像表示システム。
【請求項４】
前記所定期間は、１垂直期間以上の期間であることを特徴とする請求項１、２、３のいずれかに記載の画像表示システム。
【請求項５】
前記制御回路が、前記駆動回路に内蔵されたことを特徴とする請求項１、２、３、４のいずれかに記載の画像表示システム。
【請求項６】
前記表示パネルは有機ＥＬ表示パネルであることを特徴とする請求項１、２、３、４、５のいずれかに記載の画像表示システム。
【請求項７】
複数の画素を含む表示パネルと、
ＣＰＵバスを介して表示データを出力するＣＰＵと、
前記ＣＰＵから出力される前記表示データがバッファメモリを介して書き込まれるフレームメモリを有し、前記ＣＰＵから出力される書き込み許可命令に応じて、前記表示データの出力を待機させるための書き込み待機信号を前記ＣＰＵに出力すると共に、その内部で発生される駆動信号に応じて、前記フレームメモリに書き込まれた前記表示データを前記表示パネルに出力する駆動回路と、
前記書き込み待機命令の解除に応じて、前記駆動信号の出力を停止する制御回路と、を具備する画像表示システムの制御方法であって、
前記書き込み許可命令に応じて、前記表示データの出力を待機させるための書き込み待機信号を前記ＣＰＵに出力し、
前記フレームメモリに書き込まれた前記表示データを前記表示パネルに出力し表示を行い、
前記表示の完了後、前記書き込み待機信号を解除し、
前記駆動信号の出力を停止すると共に、この駆動信号の出力が停止されている所定期間中に、前記ＣＰＵから新たな表示データを前記フレームメモリに一括して書き込み、
前記所定期間の経過後に、前記駆動信号の出力を再開し、前記フレームメモリに書き込まれた新たな表示データを前記表示パネルに表示することを特徴とする画像表示システムの表示制御方法。
【請求項８】
前記駆動信号は、水平スタート信号及び垂直スタート信号であることを特徴とする請求項７に記載の画像表示システムの制御方法。
【請求項９】
前記複数の画素は、前記フレームメモリから出力された表示データを前記所定期間中、保持する保持回路を有することを特徴とする請求項７又は請求項８に記載の画像表示システムの制御方法。
【請求項１０】
前記所定期間は、１垂直期間以上の期間であることを特徴とする請求項７、８、９のいずれかに記載の画像表示システムの制御方法。
【請求項１１】
前記表示パネルは有機ＥＬ表示パネルであることを特徴とする請求項７、８、９、１０のいずれかに記載の画像表示システムの制御方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、画像表示システム及びその制御方法に関し、特にＣＰＵから出力される表示データをフレームメモリに書き込み、フレームメモリから表示データを読み出して表示パネルに出力する画像表示システム及びその制御方法に関する。
【背景技術】
【０００２】
従来より、ＣＰＵから表示データを、ＣＰＵバスを介して駆動ＬＳＩへ出力し、この駆動用ＬＳＩに内蔵されたフレームメモリに、バッファメモリを介して一旦書き込み、その後、このフレームメモリに書き込まれた表示データを読み出して、これを表示パネルに出力することで画像表示を行う画像表示システムが知られている。
【０００３】
このような画像表示システムでは、表示データのフレームメモリへの書き込みが、フレームメモリからの表示データの読み出しを追い越し、書き込み途中の表示データが表示パネルに出力されてしまい、これにより表示不良が生じるおそれがある。
【０００４】
ここで、フレームメモリが２フレーム（２画面）分の表示データを記憶するメモリ容量を有していれば、一方のフレームのメモリ領域に表示データを書き込み中に、他方のフレームのメモリ領域に既に書き込まれた表示データを読み出し、表示パネルに出力するように制御することで、フレームメモリの書き込みと読み出しとを別個に制御できるので、そのような表示不良を回避することができる。しかし、フレームメモリが１フレーム（１画面）分のメモリ容量しか有していない場合には、そのような表示不良を回避するのは困難である。
【０００５】
そこで、駆動用ＬＳＩからＣＰＵに対して、フレームメモリへの表示データの出力を一時的に待機させるパネル書き込み制御信号を出力し、表示データのフレームメモリへの書き込みが、フレームメモリからの表示データの読み出しを追い越さないように、フレームメモリへの表示データの書き込みを制御していた。
【０００６】
なお、ＣＰＵから出力される表示データをフレームメモリに書き込み、フレームメモリから表示データを読み出して表示パネルに出力する画像表示システムについては、以下の特許文献１に記載されている。
【特許文献１】特開平９−２４４５９４号公報
【発明の開示】
【発明が解決しようとする課題】
【０００７】
しかしながら、パネル書き込み制御信号を用いてフレームメモリへの表示データの書き込みを制御するに際して、フレームメモリの前段のバッファメモリのメモリ容量が小さいと、パネル書き込み制御信号を用いた書き込み制御を頻繁に行わなければならず、書き込み制御が複雑になるという欠点があった。一方、書き込み制御を容易にするために、表示データをまとめてバッファメモリを介してフレームメモリに書き込むことが考えられるが、バッファメモリのメモリ容量を相当大きくする必要がある。
【０００８】
そこで、本発明は、バッファメモリのメモリ容量が小さくても、パネル書き込み制御信号を用いた書き込み制御により、表示不良の発生を抑止した画像表示システム及びその制御方法を提供するものである。
【課題を解決するための手段】
【０００９】
本発明の画像表示システムは、複数の画素を含む表示パネルと、ＣＰＵバスを介して表示データを出力するＣＰＵと、ＣＰＵから出力される前記表示データが書き込まれるフレームメモリを有し、ＣＰＵから出力される書き込み許可命令に応じて、表示データの出力を待機させるための書き込み待機信号を前記ＣＰＵに出力すると共に、その内部で発生される駆動信号に応じて、フレームメモリに書き込まれた前記表示データを前記表示パネルに出力する駆動回路と、書き込み待機命令の解除に応じて、駆動信号の出力を所定期間、停止する制御回路と、を備えている。そして、所定期間中に、ＣＰＵから表示データをフレームメモリに一括して書き込むようにしたことを特徴とするものである。
【００１０】
また、画像表示システムの制御方法は、ＣＰＵからの書き込み許可命令に応じて、表示データの出力を待機させるための書き込み待機信号をＣＰＵに出力し、フレームメモリに書き込まれた表示データを表示パネルに出力し表示を行い、その表示の完了後、書き込み待機信号を解除し、表示パネルへの駆動信号の出力を停止すると共に、この駆動信号の出力が停止されている所定期間中に、ＣＰＵから新たな表示データをフレームメモリに一括して書き込み、所定期間の経過後に、駆動信号の出力を再開し、フレームメモリに書き込まれた新たな表示データを表示パネルに表示することを特徴とするものである。
【発明の効果】
【００１１】
本発明によれば、ＣＰＵから出力される表示データを、パネル書き込み制御信号を用いた制御により、バッファメモリを介してフレームメモリに書き込み、フレームメモリから表示データを読み出して表示パネルに出力する画像表示システムにおいて、表示不良の発生を防止すると共に、バッファメモリのメモリ容量が小さくすることが可能になる。
【実施例】
【００１２】
次に、本発明の実施例について図面を参照しながら説明する。図１は、本発明の実施例による画像表示システムのシステム構成を示す図である。
【００１３】
ＣＰＵ１００は、ＣＰＵバス１０１を介して、表示データをクロックに同期して駆動ＬＳＩ２００へ出力する。駆動用ＬＳＩ２００には、バッファメモリ２１０、フレームメモリ２１１、ＤＡ変換器２１２、垂直スタート信号、水平スタート信号、垂直クロック、水平クロック、垂直同期信号等の各種の駆動信号を発生するタイミングジェネレータ（不図示）が内蔵されている。
【００１４】
ＣＰＵ１００からＣＰＵバス１０１を介して出力された表示データは、バッファメモリ２１０を介してフレームメモリ２１１に書き込まれ、その後、このフレームメモリ２１１に書き込まれた表示データを読み出し、そのデジタルの表示データを、ＤＡ変換器２１２を通してアナログの表示データに変換した後に、有機ＥＬ表示パネル３００に出力することで画像表示を行う。
【００１５】
ここで、フレームメモリ２１１への表示データの書き込みは、有機ＥＬ表示パネル３００の駆動を停止し、有機ＥＬ表示パネル３００がその表示を保持している期間中に、一括して行うことで表示不良を防止している。
【００１６】
具体的には、ＣＰＵ１００から書き込み許可命令がＣＰＵバス１０１を介して駆動ＬＳＩ２００に出力されると、駆動ＬＳＩ２００はこれを解読して、パネル書き込み制御信号をＣＰＵ１００に出力する。すると、ＣＰＵ１００は表示データの出力を待機する。その待機中に、フレームメモリ２１１上にある表示データを読み出し、ＤＡ変換器２１２を介して、有機ＥＬ表示パネル３００に出力する。
【００１７】
そして、表示データの出力後、次の１垂直期間の間、水平スタート信号ＳＴＨ及び垂直スタート信号ＳＴＶの出力を停止することで有機ＥＬ表示パネル３００の駆動を停止すると共に、パネル書き込み制御信号を解除して、ＣＰＵ１００に対して表示データの出力を許可する。そして、有機ＥＬ表示パネル３００の駆動が停止している間に、ＣＰＵ１００から１フレーム分の表示データが出力され、バッファメモリ２１０を介してフレームメモリ２１１に一括して書き込まれる。
【００１８】
この有機ＥＬ表示パネル３００の駆動が停止している１垂直期間の間は、有機ＥＬ表示パネル３００が表示データの保持機能により、静止画像として表示が保持されるので、表示不良は発生しない。
【００１９】
次に、フレームメモリ２１１への表示データの書き込みを制御する制御回路４０及び有機ＥＬ表示パネル３００の構成について、図２及び図３を参照しながら説明する。図２は、制御回路４０、有機ＥＬ表示パネル３００を示す回路図である。図３は制御回路４０の具体的な構成例を示す回路図である。
【００２０】
有機ＥＬ表示パネル３００において、複数の画素は行及び列に配列され、画素領域１０を構成している。各画素は、ゲート信号線１１とドレイン信号線１２の各交差点付近に配置されている。なお、図２において、簡単のために、２行２列分の画素だけが図示されている。
【００２１】
ゲート信号線１１には、垂直駆動回路３０から画素選択信号が出力され、ドレイン信号線１２には垂直駆動回路２０が表示信号が出力される。そして、各画素は、ゲートがゲート信号線１１に接続され、ドレインがドレイン信号線１２に接続された画素選択ＴＦＴ１３と、ゲートに画素選択ＴＦＴ１３のソースが接続され、ソースに正駆動電圧ＰＶｄｄが供給された有機ＥＬ駆動ＴＦＴ１４と、アノードが有機ＥＬ駆動ＴＦＴ１４のドレインに接続され、カソードに負駆動電圧ＣＶが印加された有機ＥＬ素子１５と、一端が画素選択ＴＦＴ１３のソースに接続され、その他端に固定電圧が印加された容量素子１６と、から構成されている。
【００２２】
ここで、ＴＦＴは薄膜トランジスタ（thin film transistor）を表す。画素選択ＴＦＴ１３はＮチャネル型、有機ＥＬ駆動ＴＦＴ１４はＰチャネル型であるが、これに限られない。
【００２３】
いま、ゲート信号線１１に出力される画素選択信号がハイレベルになると、画素選択ＴＦＴ１３がオンし、ドレイン信号線１２から表示信号Ｖｓｉｇ（アナログ信号）が画素に書き込まれる。画素に書き込まれた表示信号は、容量素子１６に保持される。有機ＥＬ駆動ＴＦＴ１４はその表示信号に応じた電流を有機ＥＬ素子１５に流す。これにより、有機ＥＬ素子１５は、その電流に応じて発光する。
【００２４】
水平駆動回路２０には、駆動ＬＳＩ２００より表示信号Ｖｓｉｇ、水平クロック信号ＣＫＨ１，ＣＫＨ２が入力され、制御回路４０から水平スタート信号ＳＴＨａが入力される。水平駆動回路２０は、水平スタート信号ＳＴＨａを水平クロック信号ＣＫＨ１，ＣＫＨ２に同期してシフトし、複数のサンプリングパルスを順次発生するシフトレジスタ（不図示）を有している。表示信号Ｖｓｉｇは、これらのサンプリングパルスに同期してサンプリングされ、各ドレイン信号線１２に出力される。表示信号Ｖｓｉｇを各ドレイン信号線１２に出力する方式には、いわゆる点順次方式と線順次方式があるが、それらのどちらの方式を用いてもよい。
【００２５】
垂直駆動回路３０には、駆動ＬＳＩ２００より垂直クロック信号ＣＫＶ１，ＣＫＶ２が入力され、制御回路４０からの水平スタート信号ＳＴＶａが入力されている。そして、垂直駆動回路３０は、垂直スタート信号ＳＴＶａを水平クロック信号ＣＫＨ１，ＣＫＨ２に同期してシフトして画素選択信号を作成するシフトレジスタを有しており、それらの画素選択信号を各ゲート信号線１１に順次出力する。
【００２６】
制御回路４０は、図３に示すように、水平スタート信号ＳＴＨ及びパネル書き込み制御信号が入力された第１のアンド回路４１と、垂直スタート信号ＳＴＶ及びパネル書き込み制御信号が入力された第２のアンド回路４２から構成されている。パネル書き込み制御信号がＨレベルの時、第１のアンド回路４１の出力信号ＳＴＨａは、水平スタート信号ＳＴＨと同じ信号であり、第２のアンド回路４２の出力信号ＳＴＶａは、垂直スタート信号ＳＴＶと同じ信号である。パネル書き込み制御信号がＬレベルの時、出力信号ＳＴＨａ、ＳＴＶａともＬレベルに固定される。制御回路４０は、駆動ＬＳＩ２００に内蔵されていてもよいし、その外部に設けられていてもよい。
【００２７】
制御回路４０の出力信号ＳＴＨａ、ＳＴＶａがＬレベルに固定されると、水平駆動回路２０からサンプリングパルスは出力されず、垂直駆動回路３０から画素選択信号は出力されないので、有機ＥＬ表示パネル３００の駆動は１垂直期間停止される。そして、その駆動が停止されている１垂直期間中は、それ以前の１垂直期間に既に各画素に書き込まれた表示信号Ｖｓｉｇが各画素の容量素子１６に保持され、静止画像として表示が保持される。
【００２８】
次に、本実施例の画像表示システムの動作例について、図４のタイミング図を参照しながらさらに詳しく説明する。
【００２９】
いま、フレームメモリ２１１には、既に表示データＡ（１フレーム分の表示データ）が書き込まれており、フレームメモリ２１１からは表示データＡが順次読み出され、有機ＥＬ表示パネル３００に出力されているものとする。
【００３０】
そして、この１垂直期間中の途中で、ＣＰＵ１００から書き込み許可命令がＣＰＵバス１０１を介して駆動ＬＳＩ２００に出力されるとする。駆動ＬＳＩ２００は、この命令を解読して、パネル書き込み制御信号（Ｈレベル）をＣＰＵ１００に出力する。
【００３１】
すると、ＣＰＵ１００は表示データの出力を待機する。フレームメモリ２１１上にある表示データＡは引き続き、読み出され、ＤＡ変換器２１２を介して、有機ＥＬ表示パネル３００に出力され続ける。そして、その１垂直期間の間にすべての表示データＡが出力され、有機ＥＬ表示パネル３００に書き込まれる。
【００３２】
そして、表示データＡの出力の完了は垂直同期信号Ｖincによって検知され、これに応じて、パネル書き込み制御信号はＨレベルからはＬレベルに変化し、ＣＰＵ１００のウエイト状態が解除される。すると、制御回路４０により、水平スタート信号ＳＴＨ及び垂直スタート信号ＳＴＶの出力が次の１垂直期間中、停止され、有機ＥＬ表示パネル３００の駆動が停止される。
【００３３】
そして、有機ＥＬ表示パネル３００の駆動が停止している間に、ＣＰＵ１００から１フレーム分の新たな表示データＢが出力され、バッファメモリ２１０を介してフレームメモリ２１１に一括して書き込まれる。
【００３４】
この有機ＥＬ表示パネル３００の駆動が停止している１垂直期間の中は、書き込み途中の表示データＢが表示されることはない。また、有機ＥＬ表示パネル３００は表示データＡの保持機能を有しているので、表示データＡの表示が保持され、表示不良は発生しない。
【００３５】
そして、次の１垂直期間には、水平スタート信号ＳＴＨ及び垂直スタート信号ＳＴＶの出力が再び出力されるようになり、有機ＥＬ表示パネル３００の駆動が再開され、
フレームメモリ２１１に書き込まれた表示データＢが読み出され、この表示データＢが有機ＥＬ表示パネル３００に出力され、表示される。
【００３６】
このように、本実施例によれば、有機ＥＬ表示パネル３００の駆動が停止している１垂直期間中に、ＣＰＵ１００からフレームメモリ２１１へ表示データの一括書き込みを行うようにしたので、フレームメモリ２１１の前段のバッファメモリ２１０のメモリ容量が小さくても、表示不良を防止でき、しかもパネル書き込み制御信号による書き込み制御を頻繁に行う必要がなくなる。なお、水平スタート信号ＳＴＨ及び垂直スタート信号ＳＴＶの出力を停止させることで、有機ＥＬ表示パネル３００の駆動を停止させる期間は、１垂直期間以上の期間であってもよい。
【００３７】
また、本実施例では、有機ＥＬ表示パネル３００の各画素に有機ＥＬ素子１５を用いているが、これに限らず、無機ＥＬ素子や、その他のＥＬ素子、ＬＥＤ素子を用いてもよい。また、各画素の容量素子１６は、各画素に書き込まれた表示信号を保持する保持回路の一例であり、これに限らず、ＳＲＡＭ等の他の保持回路を用いてもよい。
【図面の簡単な説明】
【００３８】
【図１】本発明の実施例による画像表示システムを示すシステム図である。
【図２】制御回路４０、有機ＥＬ表示パネル３００を示す回路図である。
【図３】制御回路４０の具体的な構成例を示す回路図である。
【図４】本発明の実施例による画像表示システムの動作を説明するタイミング図である。
【符号の説明】
【００３９】
１０  画素領域            １１  ゲート信号線          １２  ドレイン信号線
１３  画素選択信号        １４  有機ＥＬ駆動ＴＦＴ    １５  有機ＥＬ素子
１６  容量素子            ２０  水平駆動回路          ３０  垂直駆動回路    
４０  制御回路            ４１  第１のアンド回路      ４２  第２のアンド回路
１００  ＣＰＵ            ２００  駆動ＬＳＩ          ２１０  バッファメモリ
２１１  フレームメモリ    ２１２  ＤＡ変換器          ３００  有機ＥＬ表示パネル
【図１】
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【図２】
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【図３】
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【図４】
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